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XC2C64A, XA2C64A

ParameterValue
IDCODE part0x6e58
Block count4
I/O banks2
Input-only pads0
Has VREF❌
BS columns274
IMUX width16
BS layoutwide
Block rows2
Macrocell width9
Block columns1

Bitstream columns

Column rangeBits
0..9Block column 0 even MCs
9..121Block column 0 even PTs
121..153Block column 0 IMUX
153..265Block column 0 odd PTs
265..274Block column 0 odd MCs

I/O pins

Function Bank Pad distance xc2c64a-pc44 xc2c64a-vq44
xa2c64a-vq44		 xc2c64a-qfg48 xc2c64a-cp56 xc2c64a-cv64 xc2c64a-vq100
xa2c64a-vq100		 xc2c64a-di81
IDCODE part 0x6e5a 0x6e5e 0x6e59 0x6e5d 0x6e5c 0x6e5c 0x6e58
IOB_C0B0MC0 BANK1 80 P44 P38 - F1 D3 P13 P11
IOB_C0B0MC1 BANK1 79 P43 P37 P5 E3 D2 P12 P10
IOB_C0B0MC2 BANK1 78 P42 P36 P4 E1 D1 P11 P9
IOB_C0B0MC3 BANK1 77 - - - - - P10 P8
IOB_C0B0MC4 BANK1 76 - - - - D4 P9 P7
IOB_C0B0MC5 BANK1 75 - - - - C1 P8 P6
IOB_C0B0MC6 BANK1 74 - - - - C2 P7 P5
IOB_C0B0MC7 BANK1 73 - - - - - P6 P4
IOB_C0B0MC8 BANK1 71 P40 (GOE1) P34 (GOE1) P2 (GOE1) D1 (GOE1) B2 (GOE1) P4 (GOE1) P2 (GOE1)
IOB_C0B0MC9 BANK1 70 P39 (GOE0) P33 (GOE0) P1 (GOE0) C1 (GOE0) A1 (GOE0) P3 (GOE0) P1 (GOE0)
IOB_C0B0MC10 BANK1 69 P38 (GOE3) P32 (GOE3) P48 (GOE3) A3 (GOE3) C3 (GOE3) P2 (GOE3) P81 (GOE3)
IOB_C0B0MC11 BANK1 68 P37 (GOE2) P31 (GOE2) P47 (GOE2) A2 (GOE2) A2 (GOE2) P1 (GOE2) P80 (GOE2)
IOB_C0B0MC12 BANK1 66 P36 (GSR) P30 (GSR) P46 (GSR) B1 (GSR) B3 (GSR) P99 (GSR) P78 (GSR)
IOB_C0B0MC13 BANK1 64 - - - A1 A3 P97 P76
IOB_C0B0MC14 BANK1 63 - - - C3 C4 P94 P75
IOB_C0B0MC15 BANK1 62 - - - - - P92 P74
IOB_C0B1MC0 BANK0 0 P1 P39 P6 G1 E1 P14 P12
IOB_C0B1MC1 BANK0 1 P2 P40 P7 F3 E2 P15 P13
IOB_C0B1MC2 BANK0 2 - - P8 - E3 P16 P14
IOB_C0B1MC3 BANK0 3 - - P9 - F1 P17 P15
IOB_C0B1MC4 BANK0 4 P3 P41 P10 H1 F2 P18 P16
IOB_C0B1MC5 BANK0 5 P4 P42 - G3 G1 P19 P17
IOB_C0B1MC6 BANK0 7 P5 (GCLK0) P43 (GCLK0) P11 (GCLK0) J1 (GCLK0) F3 (GCLK0) P22 (GCLK0) P19 (GCLK0)
IOB_C0B1MC7 BANK0 8 P6 (GCLK1) P44 (GCLK1) P12 (GCLK1) K1 (GCLK1) H1 (GCLK1) P23 (GCLK1) P20 (GCLK1)
IOB_C0B1MC8 BANK0 9 - - - K4 G2 P24 P21
IOB_C0B1MC9 BANK0 11 P7 (GCLK2) P1 (GCLK2) P13 (GCLK2) K2 (GCLK2) H2 (GCLK2) P27 (GCLK2) P23 (GCLK2)
IOB_C0B1MC10 BANK0 12 - - - - - P28 P24
IOB_C0B1MC11 BANK0 13 P8 P2 P14 K3 G3 P29 P25
IOB_C0B1MC12 BANK0 14 P9 P3 P15 H3 H3 P30 P26
IOB_C0B1MC13 BANK0 16 - - - K5 H4 P32 P28
IOB_C0B1MC14 BANK0 17 - - - - - P33 P29
IOB_C0B1MC15 BANK0 18 - - - - - P34 P30
IOB_C0B2MC0 BANK1 61 P35 P29 P45 C4 B4 P91 P73
IOB_C0B2MC1 BANK1 60 P34 P28 P44 A4 A4 P90 P72
IOB_C0B2MC2 BANK1 59 P33 P27 P43 C5 C5 P89 P71
IOB_C0B2MC3 BANK1 55 - - - A7 A6 P81 P67
IOB_C0B2MC4 BANK1 54 - - P39 C8 B6 P79 P66
IOB_C0B2MC5 BANK1 53 P29 P23 P38 A8 A7 P78 P65
IOB_C0B2MC6 BANK1 52 - - - A9 B7 P77 P64
IOB_C0B2MC7 BANK1 51 - - - - - P76 P63
IOB_C0B2MC8 BANK1 50 - - P37 A5 A8 P74 P62
IOB_C0B2MC9 BANK1 49 P28 P22 P36 A10 C6 P72 P61
IOB_C0B2MC10 BANK1 48 P27 P21 P35 B10 B8 P71 P60
IOB_C0B2MC11 BANK1 47 P26 P20 P34 C10 C7 P70 P59
IOB_C0B2MC12 BANK1 45 - - - D8 C8 P68 P57
IOB_C0B2MC13 BANK1 44 P25 P19 P33 E8 D6 P67 P56
IOB_C0B2MC14 BANK1 43 P24 P18 P32 D10 D7 P64 P55
IOB_C0B2MC15 BANK1 41 - - - - E6 P61 P53
IOB_C0B3MC0 BANK0 19 P11 P5 P17 K6 G4 P35 P31
IOB_C0B3MC1 BANK0 20 P12 P6 P18 H5 F4 P36 P32
IOB_C0B3MC2 BANK0 21 - - - K7 H5 P37 P33
IOB_C0B3MC3 BANK0 23 - - - - - P39 P35
IOB_C0B3MC4 BANK0 24 - - - H7 F5 P40 P36
IOB_C0B3MC5 BANK0 25 - - - - - P41 P37
IOB_C0B3MC6 BANK0 26 P14 P8 P20 H8 H6 P42 P38
IOB_C0B3MC7 BANK0 27 - - - - - P43 P39
IOB_C0B3MC8 BANK0 31 - - - - - P49 P43
IOB_C0B3MC9 BANK0 32 - - P24 K8 H8 P50 P44
IOB_C0B3MC10 BANK0 34 P18 P12 P25 H10 G7 P52 P46
IOB_C0B3MC11 BANK0 35 - - P26 - G8 P53 P47
IOB_C0B3MC12 BANK0 36 P19 P13 P27 G10 F7 P55 P48
IOB_C0B3MC13 BANK0 37 P20 P14 P28 - F8 P56 P49
IOB_C0B3MC14 BANK0 39 P22 P16 - F10 E8 P58 P51
IOB_C0B3MC15 BANK0 40 - - P30 E10 E7 P60 P52
TCK AUX P17 P11 P23 K10 F6 P48 P42
TMS AUX P16 P10 P22 K9 H7 P47 P41
TDI AUX P15 P9 P21 J10 G6 P45 P40
TDO AUX P30 P24 P40 A6 D5 P83 P68
GND - P10
P23
P31		 P17
P25
P4		 P16
P31
P41		 C7
F8
H4		 A5
D8
E4		 P100
P21
P31
P62
P69
P84		 P18
P27
P54
P58
P69
P79
VCCINT - P21 P15 P29 G8 E5 P26
P57		 P22
P50
VCCIO0 BANK0 P13 P7 P19 H6 G5 P38
P51		 P34
P45
VCCIO1 BANK1 P32 P26 P42 C6 B5 P88
P98		 P70
P77
VCCAUX AUX P41 P35 P3 D3 B1 P5 P3
NC - - - - - - - -

Speed data

xc2c64a speed data
Key xc2c64a-5 xc2c64a-7
xa2c64a-7 		xa2c64a-8
DEL_CLK_Q 400ps 700ps 700ps
DEL_D_Q_COMB 500ps 700ps 700ps
DEL_D_Q_LATCH 1700ps 2500ps 2500ps
DEL_IBUF_D 2600ps 4000ps 3700ps
DEL_IBUF_FCLK 1600ps 2500ps 2500ps
DEL_IBUF_FOE 2700ps 3900ps 3900ps
DEL_IBUF_FSR 2400ps 3500ps 3500ps
DEL_IBUF_IMUX 1700ps 2400ps 2400ps
DEL_IBUF_PLAIN.LVCMOS18 0ps 0ps 0ps
DEL_IBUF_PLAIN.LVCMOS18_ANY 0ps 0ps 0ps
DEL_IBUF_PLAIN.LVCMOS25 500ps 600ps 700ps
DEL_IBUF_PLAIN.LVCMOS33 500ps 600ps 800ps
DEL_IBUF_PLAIN.LVTTL 500ps 600ps 800ps
DEL_IBUF_SCHMITT.LVCMOS15 4000ps 6000ps 6000ps
DEL_IBUF_SCHMITT.LVCMOS18 3000ps 4000ps 4000ps
DEL_IBUF_SCHMITT.LVCMOS18_ANY 3000ps 4000ps 4000ps
DEL_IBUF_SCHMITT.LVCMOS25 2500ps 3000ps 3000ps
DEL_IBUF_SCHMITT.LVCMOS33 2000ps 3000ps 3000ps
DEL_IBUF_SCHMITT.LVTTL 2000ps 3000ps 3000ps
DEL_IMUX_CT 2000ps 2500ps 2500ps
DEL_IMUX_OR 900ps 1600ps 1600ps
DEL_IMUX_PT 500ps 800ps 800ps
DEL_MC_FOE 1700ps 1700ps 1700ps
DEL_OBUF_FAST.LVCMOS15 2800ps 4300ps 4300ps
DEL_OBUF_FAST.LVCMOS18 1900ps 2800ps 2800ps
DEL_OBUF_FAST.LVCMOS18_ANY 1900ps 2800ps 2800ps
DEL_OBUF_FAST.LVCMOS25 2700ps 3700ps 3800ps
DEL_OBUF_FAST.LVCMOS33 3100ps 4200ps 4500ps
DEL_OBUF_FAST.LVTTL 3100ps 4200ps 4500ps
DEL_OBUF_OE 5300ps 6100ps 6100ps
DEL_OBUF_SLOW.LVCMOS15 6800ps 10300ps 10300ps
DEL_OBUF_SLOW.LVCMOS18 5400ps 7800ps 7800ps
DEL_OBUF_SLOW.LVCMOS18_ANY 5400ps 7800ps 7800ps
DEL_OBUF_SLOW.LVCMOS25 6700ps 8700ps 9300ps
DEL_OBUF_SLOW.LVCMOS33 7100ps 9200ps 11100ps
DEL_OBUF_SLOW.LVTTL 7100ps 9200ps 11100ps
DEL_SR_Q 1700ps 2000ps 2000ps
DEL_UIM_IMUX 1500ps 3000ps 3000ps
SETUPHOLD_CE_CLKhold 0ps 0ps 0ps
setup 900ps 1300ps 1300ps
SETUPHOLD_D_CLK_IBUF_FCLKhold 400ps 400ps 400ps
setup 1400ps 1800ps 2100ps
SETUPHOLD_D_CLK_IBUF_PThold 200ps 500ps 200ps
setup 2000ps 2600ps 2900ps
SETUPHOLD_D_CLK_PT_FCLKhold 400ps 400ps 400ps
setup 1400ps 1800ps 2100ps
SETUPHOLD_D_CLK_PT_PThold 0ps 0ps 0ps
setup 2100ps 2600ps 2600ps
WIDTH_CLK 1400ps 2200ps 2200ps
WIDTH_CLK_PT 5000ps 7500ps 7500ps
WIDTH_SR 5000ps 7500ps 7500ps

IMUX bits

xc2c64a imux bittile 0
FrameBit
0 1 2 3 4 5 6 7 8 9 10 11 12 13 14 15 16 17 18 19 20 21 22 23 24 25 26 27 28 29 30
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23 - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - -
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MC_C0B0MC10 1 1 1 1 1 1 1 1 0 1 0 1 0 1 1 1
MC_C0B1MC9 1 1 1 1 1 1 1 1 0 1 1 0 0 1 1 1
MC_C0B2MC1 1 1 1 1 1 1 1 1 0 1 1 1 0 0 1 1
MC_C0B3MC2 1 1 1 1 1 1 1 1 0 1 1 1 0 1 0 1
MC_C0B3MC11 1 1 1 1 1 1 1 1 0 1 1 1 0 1 1 0
VCC 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1
IM[38].MUX 0.46.0 0.46.2 0.46.4 0.46.6 0.46.8 0.46.10 0.46.12 0.46.14 0.46.16 0.46.18 0.46.20 0.46.22 0.46.24 0.46.26 0.46.28 0.46.30
IOB_C0B0MC9 0 1 1 0 1 1 1 1 0 1 1 1 1 1 1 1
IOB_C0B0MC11 1 0 1 0 1 1 1 1 0 1 1 1 1 1 1 1
IOB_C0B1MC8 1 1 0 0 1 1 1 1 0 1 1 1 1 1 1 1
IOB_C0B1MC14 1 1 1 0 0 1 1 1 0 1 1 1 1 1 1 1
IOB_C0B2MC13 1 1 1 0 1 0 1 1 0 1 1 1 1 1 1 1
IOB_C0B3MC13 1 1 1 0 1 1 0 1 0 1 1 1 1 1 1 1
MC_C0B0MC6 1 1 1 1 1 1 1 1 0 0 1 1 0 1 1 1
MC_C0B1MC0 1 1 1 1 1 1 1 1 0 1 0 1 0 1 1 1
MC_C0B1MC6 1 1 1 1 1 1 1 1 0 1 1 0 0 1 1 1
MC_C0B2MC5 1 1 1 1 1 1 1 1 0 1 1 1 0 0 1 1
MC_C0B2MC13 1 1 1 1 1 1 1 1 0 1 1 1 0 1 0 1
MC_C0B3MC13 1 1 1 1 1 1 1 1 0 1 1 1 0 1 1 0
VCC 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1
IM[39].MUX 0.47.0 0.47.2 0.47.4 0.47.6 0.47.8 0.47.10 0.47.12 0.47.14 0.47.16 0.47.18 0.47.20 0.47.22 0.47.24 0.47.26 0.47.28 0.47.30
IOB_C0B0MC4 0 1 1 0 1 1 1 1 0 1 1 1 1 1 1 1
IOB_C0B1MC3 1 0 1 0 1 1 1 1 0 1 1 1 1 1 1 1
IOB_C0B1MC6 1 1 0 0 1 1 1 1 0 1 1 1 1 1 1 1
IOB_C0B2MC3 1 1 1 0 0 1 1 1 0 1 1 1 1 1 1 1
IOB_C0B2MC14 1 1 1 0 1 0 1 1 0 1 1 1 1 1 1 1
IOB_C0B3MC3 1 1 1 0 1 1 0 1 0 1 1 1 1 1 1 1
IOB_C0B3MC15 1 1 1 1 1 1 1 1 0 0 1 1 0 1 1 1
MC_C0B1MC2 1 1 1 1 1 1 1 1 0 1 0 1 0 1 1 1
MC_C0B1MC12 1 1 1 1 1 1 1 1 0 1 1 0 0 1 1 1
MC_C0B2MC2 1 1 1 1 1 1 1 1 0 1 1 1 0 0 1 1
MC_C0B3MC1 1 1 1 1 1 1 1 1 0 1 1 1 0 1 0 1
MC_C0B3MC6 1 1 1 1 1 1 1 1 0 1 1 1 0 1 1 0
VCC 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1
IM[3].MUX 0.3.0 0.3.2 0.3.4 0.3.6 0.3.8 0.3.10 0.3.12 0.3.14 0.3.16 0.3.18 0.3.20 0.3.22 0.3.24 0.3.26 0.3.28 0.3.30
IOB_C0B0MC3 0 1 1 0 1 1 1 1 0 1 1 1 1 1 1 1
IOB_C0B0MC15 1 0 1 0 1 1 1 1 0 1 1 1 1 1 1 1
IOB_C0B1MC5 1 1 0 0 1 1 1 1 0 1 1 1 1 1 1 1
IOB_C0B2MC2 1 1 1 0 0 1 1 1 0 1 1 1 1 1 1 1
IOB_C0B2MC9 1 1 1 0 1 0 1 1 0 1 1 1 1 1 1 1
IOB_C0B3MC10 1 1 1 0 1 1 0 1 0 1 1 1 1 1 1 1
MC_C0B0MC7 1 1 1 1 1 1 1 1 0 0 1 1 0 1 1 1
MC_C0B0MC11 1 1 1 1 1 1 1 1 0 1 0 1 0 1 1 1
MC_C0B1MC4 1 1 1 1 1 1 1 1 0 1 1 0 0 1 1 1
MC_C0B2MC7 1 1 1 1 1 1 1 1 0 1 1 1 0 0 1 1
MC_C0B3MC0 1 1 1 1 1 1 1 1 0 1 1 1 0 1 0 1
MC_C0B3MC8 1 1 1 1 1 1 1 1 0 1 1 1 0 1 1 0
VCC 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1
IM[4].MUX 0.4.0 0.4.2 0.4.4 0.4.6 0.4.8 0.4.10 0.4.12 0.4.14 0.4.16 0.4.18 0.4.20 0.4.22 0.4.24 0.4.26 0.4.28 0.4.30
IOB_C0B0MC4 0 1 1 0 1 1 1 1 0 1 1 1 1 1 1 1
IOB_C0B1MC1 1 0 1 0 1 1 1 1 0 1 1 1 1 1 1 1
IOB_C0B1MC10 1 1 0 0 1 1 1 1 0 1 1 1 1 1 1 1
IOB_C0B1MC15 1 1 1 0 0 1 1 1 0 1 1 1 1 1 1 1
IOB_C0B2MC13 1 1 1 0 1 0 1 1 0 1 1 1 1 1 1 1
IOB_C0B3MC5 1 1 1 0 1 1 0 1 0 1 1 1 1 1 1 1
MC_C0B0MC6 1 1 1 1 1 1 1 1 0 0 1 1 0 1 1 1
MC_C0B1MC3 1 1 1 1 1 1 1 1 0 1 0 1 0 1 1 1
MC_C0B1MC7 1 1 1 1 1 1 1 1 0 1 1 0 0 1 1 1
MC_C0B1MC15 1 1 1 1 1 1 1 1 0 1 1 1 0 0 1 1
MC_C0B3MC3 1 1 1 1 1 1 1 1 0 1 1 1 0 1 0 1
MC_C0B3MC9 1 1 1 1 1 1 1 1 0 1 1 1 0 1 1 0
VCC 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1
IM[5].MUX 0.5.0 0.5.2 0.5.4 0.5.6 0.5.8 0.5.10 0.5.12 0.5.14 0.5.16 0.5.18 0.5.20 0.5.22 0.5.24 0.5.26 0.5.28 0.5.30
IOB_C0B0MC5 0 1 1 0 1 1 1 1 0 1 1 1 1 1 1 1
IOB_C0B0MC12 1 0 1 0 1 1 1 1 0 1 1 1 1 1 1 1
IOB_C0B1MC12 1 1 0 0 1 1 1 1 0 1 1 1 1 1 1 1
IOB_C0B2MC5 1 1 1 0 0 1 1 1 0 1 1 1 1 1 1 1
IOB_C0B2MC10 1 1 1 0 1 0 1 1 0 1 1 1 1 1 1 1
IOB_C0B3MC9 1 1 1 0 1 1 0 1 0 1 1 1 1 1 1 1
MC_C0B0MC1 1 1 1 1 1 1 1 1 0 0 1 1 0 1 1 1
MC_C0B1MC2 1 1 1 1 1 1 1 1 0 1 0 1 0 1 1 1
MC_C0B1MC5 1 1 1 1 1 1 1 1 0 1 1 0 0 1 1 1
MC_C0B2MC3 1 1 1 1 1 1 1 1 0 1 1 1 0 0 1 1
MC_C0B2MC10 1 1 1 1 1 1 1 1 0 1 1 1 0 1 0 1
MC_C0B3MC10 1 1 1 1 1 1 1 1 0 1 1 1 0 1 1 0
VCC 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1
IM[6].MUX 0.6.0 0.6.2 0.6.4 0.6.6 0.6.8 0.6.10 0.6.12 0.6.14 0.6.16 0.6.18 0.6.20 0.6.22 0.6.24 0.6.26 0.6.28 0.6.30
IOB_C0B0MC6 0 1 1 0 1 1 1 1 0 1 1 1 1 1 1 1
IOB_C0B0MC10 1 0 1 0 1 1 1 1 0 1 1 1 1 1 1 1
IOB_C0B1MC5 1 1 0 0 1 1 1 1 0 1 1 1 1 1 1 1
IOB_C0B2MC7 1 1 1 0 0 1 1 1 0 1 1 1 1 1 1 1
IOB_C0B3MC0 1 1 1 0 1 0 1 1 0 1 1 1 1 1 1 1
IOB_C0B3MC6 1 1 1 0 1 1 0 1 0 1 1 1 1 1 1 1
MC_C0B0MC5 1 1 1 1 1 1 1 1 0 0 1 1 0 1 1 1
MC_C0B0MC13 1 1 1 1 1 1 1 1 0 1 0 1 0 1 1 1
MC_C0B1MC14 1 1 1 1 1 1 1 1 0 1 1 0 0 1 1 1
MC_C0B2MC1 1 1 1 1 1 1 1 1 0 1 1 1 0 0 1 1
MC_C0B2MC15 1 1 1 1 1 1 1 1 0 1 1 1 0 1 0 1
MC_C0B3MC11 1 1 1 1 1 1 1 1 0 1 1 1 0 1 1 0
VCC 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1
IM[7].MUX 0.7.0 0.7.2 0.7.4 0.7.6 0.7.8 0.7.10 0.7.12 0.7.14 0.7.16 0.7.18 0.7.20 0.7.22 0.7.24 0.7.26 0.7.28 0.7.30
IOB_C0B0MC7 0 1 1 0 1 1 1 1 0 1 1 1 1 1 1 1
IOB_C0B1MC0 1 0 1 0 1 1 1 1 0 1 1 1 1 1 1 1
IOB_C0B1MC4 1 1 0 0 1 1 1 1 0 1 1 1 1 1 1 1
IOB_C0B2MC0 1 1 1 0 0 1 1 1 0 1 1 1 1 1 1 1
IOB_C0B3MC2 1 1 1 0 1 0 1 1 0 1 1 1 1 1 1 1
IOB_C0B3MC12 1 1 1 0 1 1 0 1 0 1 1 1 1 1 1 1
MC_C0B0MC2 1 1 1 1 1 1 1 1 0 0 1 1 0 1 1 1
MC_C0B1MC1 1 1 1 1 1 1 1 1 0 1 0 1 0 1 1 1
MC_C0B1MC9 1 1 1 1 1 1 1 1 0 1 1 0 0 1 1 1
MC_C0B2MC0 1 1 1 1 1 1 1 1 0 1 1 1 0 0 1 1
MC_C0B2MC13 1 1 1 1 1 1 1 1 0 1 1 1 0 1 0 1
MC_C0B3MC12 1 1 1 1 1 1 1 1 0 1 1 1 0 1 1 0
VCC 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1
IM[8].MUX 0.8.0 0.8.2 0.8.4 0.8.6 0.8.8 0.8.10 0.8.12 0.8.14 0.8.16 0.8.18 0.8.20 0.8.22 0.8.24 0.8.26 0.8.28 0.8.30
IOB_C0B0MC8 0 1 1 0 1 1 1 1 0 1 1 1 1 1 1 1
IOB_C0B0MC14 1 0 1 0 1 1 1 1 0 1 1 1 1 1 1 1
IOB_C0B1MC11 1 1 0 0 1 1 1 1 0 1 1 1 1 1 1 1
IOB_C0B1MC14 1 1 1 0 0 1 1 1 0 1 1 1 1 1 1 1
IOB_C0B2MC11 1 1 1 0 1 0 1 1 0 1 1 1 1 1 1 1
IOB_C0B3MC4 1 1 1 0 1 1 0 1 0 1 1 1 1 1 1 1
MC_C0B0MC8 1 1 1 1 1 1 1 1 0 0 1 1 0 1 1 1
MC_C0B0MC14 1 1 1 1 1 1 1 1 0 1 0 1 0 1 1 1
MC_C0B1MC13 1 1 1 1 1 1 1 1 0 1 1 0 0 1 1 1
MC_C0B2MC5 1 1 1 1 1 1 1 1 0 1 1 1 0 0 1 1
MC_C0B2MC12 1 1 1 1 1 1 1 1 0 1 1 1 0 1 0 1
MC_C0B3MC13 1 1 1 1 1 1 1 1 0 1 1 1 0 1 1 0
VCC 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1
IM[9].MUX 0.9.0 0.9.2 0.9.4 0.9.6 0.9.8 0.9.10 0.9.12 0.9.14 0.9.16 0.9.18 0.9.20 0.9.22 0.9.24 0.9.26 0.9.28 0.9.30
IOB_C0B0MC9 0 1 1 0 1 1 1 1 0 1 1 1 1 1 1 1
IOB_C0B0MC13 1 0 1 0 1 1 1 1 0 1 1 1 1 1 1 1
IOB_C0B1MC9 1 1 0 0 1 1 1 1 0 1 1 1 1 1 1 1
IOB_C0B2MC6 1 1 1 0 0 1 1 1 0 1 1 1 1 1 1 1
IOB_C0B2MC8 1 1 1 0 1 0 1 1 0 1 1 1 1 1 1 1
IOB_C0B3MC7 1 1 1 0 1 1 0 1 0 1 1 1 1 1 1 1
MC_C0B0MC0 1 1 1 1 1 1 1 1 0 0 1 1 0 1 1 1
MC_C0B0MC10 1 1 1 1 1 1 1 1 0 1 0 1 0 1 1 1
MC_C0B1MC10 1 1 1 1 1 1 1 1 0 1 1 0 0 1 1 1
MC_C0B2MC9 1 1 1 1 1 1 1 1 0 1 1 1 0 0 1 1
MC_C0B3MC1 1 1 1 1 1 1 1 1 0 1 1 1 0 1 0 1
MC_C0B3MC14 1 1 1 1 1 1 1 1 0 1 1 1 0 1 1 0
VCC 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1

Macrocell bits

xc2c64a mc bittile 0
FrameBit
0 1 2 3 4 5 6 7 8
0 SET_MUX[0] SET_MUX[1] RST_MUX[0] RST_MUX[1] CLK_DDR CLK_MUX[1] CLK_MUX[2] CLK_INV CLK_MUX[0]
1 MC_IOB_MUX[0] IBUF_MODE[0] REG_D_MUX[0] MC_ZIA_MUX[0] MC_ZIA_MUX[1] IOB_ZIA_MUX[0] IOB_ZIA_MUX[1] REG_MODE[0] REG_MODE[1]
2 ~REG_INIT IOB_SLEW[0] IOB_TERM_ENABLE OE_MUX[0] OE_MUX[1] OE_MUX[2] OE_MUX[3] XOR_MUX[0] XOR_MUX[1]
CLK_DDR 0.0.4
CLK_INV 0.0.7
IOB_TERM_ENABLE 0.2.2
non-inverted [0]
CLK_MUX 0.0.6 0.0.5 0.0.8
FCLK0 0 0 0
FCLK1 0 1 0
FCLK2 1 0 0
PT 1 1 0
CT4 1 1 1
IBUF_MODE 0.1.1
PLAIN 0
SCHMITT 1
IOB_SLEW 0.2.1
FAST 0
SLOW 1
IOB_ZIA_MUX 0.1.6 0.1.5
IBUF 0 0
REG 0 1
NONE 1 1
MC_IOB_MUX 0.1.0
REG 0
XOR 1
MC_ZIA_MUX 0.1.4 0.1.3
XOR 0 0
REG 0 1
NONE 1 1
OE_MUX 0.2.6 0.2.5 0.2.4 0.2.3
VCC 0 0 0 0
CT7 0 0 0 1
PT 0 0 1 0
FOE0 0 0 1 1
FOE1 0 1 0 0
FOE2 0 1 0 1
FOE3 0 1 1 0
IS_GND 0 1 1 1
OPEN_DRAIN 1 0 0 0
GND 1 1 1 1
REG_D_MUX 0.1.2
IBUF 0
XOR 1
REG_INIT 0.2.0
inverted ~[0]
REG_MODE 0.1.8 0.1.7
DFF 0 0
TFF 0 1
LATCH 1 0
DFFCE 1 1
RST_MUX 0.0.3 0.0.2
PT 0 0
CT5 0 1
FSR 1 0
GND 1 1
SET_MUX 0.0.1 0.0.0
PT 0 0
CT6 0 1
FSR 1 0
GND 1 1
XOR_MUX 0.2.8 0.2.7
GND 0 0
PT 0 1
PT_INV 1 0
VCC 1 1

JED mapping

JED offset Bit
0 CLK_MUX[0]
1 CLK_INV
2 CLK_MUX[1]
3 CLK_MUX[2]
4 CLK_DDR
5 RST_MUX[0]
6 RST_MUX[1]
7 SET_MUX[0]
8 SET_MUX[1]
9 REG_MODE[0]
10 REG_MODE[1]
11 IOB_ZIA_MUX[0]
12 IOB_ZIA_MUX[1]
13 MC_ZIA_MUX[0]
14 MC_ZIA_MUX[1]
15 REG_D_MUX[0]
16 IBUF_MODE[0]
17 XOR_MUX[0]
18 XOR_MUX[1]
19 MC_IOB_MUX[0]
20 OE_MUX[0]
21 OE_MUX[1]
22 OE_MUX[2]
23 OE_MUX[3]
24 IOB_TERM_ENABLE
25 IOB_SLEW[0]
26 REG_INIT

Global bits

xc2c64a global bittile 0
FrameBit
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96 ~READ_PROT[3] - ~READ_PROT[2] - ~READ_PROT[1] - ~READ_PROT[0] - ~DONE - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - -
97 - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - USERCODE[31] USERCODE[30] USERCODE[29] USERCODE[28] USERCODE[27] USERCODE[26] USERCODE[25] USERCODE[24] USERCODE[23] USERCODE[22] USERCODE[21] USERCODE[20] USERCODE[19] USERCODE[18] USERCODE[17] USERCODE[16] USERCODE[15] USERCODE[14] USERCODE[13] USERCODE[12] USERCODE[11] USERCODE[10] USERCODE[9] USERCODE[8] USERCODE[7] USERCODE[6] USERCODE[5] USERCODE[4] USERCODE[3] USERCODE[2] USERCODE[1] USERCODE[0]
BANK0_IBUF_VOLT 0.23.139
BANK0_OBUF_VOLT 0.23.140
BANK1_IBUF_VOLT 0.23.141
BANK1_OBUF_VOLT 0.23.142
IBUF_VOLT 0.23.137
OBUF_VOLT 0.23.138
HIGH 0
LOW 1
DONE 0.96.8
FSR_INV 0.73.135
inverted ~[0]
FCLK0_ENABLE 0.23.133
FCLK1_ENABLE 0.23.134
FCLK2_ENABLE 0.23.135
FSR_ENABLE 0.73.136
non-inverted [0]
FOE0_MUX 0.24.134 0.24.133
FOE1_MUX 0.24.136 0.24.135
FOE2_MUX 0.73.138 0.73.137
FOE3_MUX 0.24.138 0.24.137
IBUF_INV 0 0
IBUF 0 1
MC 1 0
NONE 1 1
READ_PROT 0.96.0 0.96.2 0.96.4 0.96.6
inverted ~[3] ~[2] ~[1] ~[0]
TERM_MODE 0.23.136
KEEPER 0
PULLUP 1
USERCODE 0.97.242 0.97.243 0.97.244 0.97.245 0.97.246 0.97.247 0.97.248 0.97.249 0.97.250 0.97.251 0.97.252 0.97.253 0.97.254 0.97.255 0.97.256 0.97.257 0.97.258 0.97.259 0.97.260 0.97.261 0.97.262 0.97.263 0.97.264 0.97.265 0.97.266 0.97.267 0.97.268 0.97.269 0.97.270 0.97.271 0.97.272 0.97.273
non-inverted [31] [30] [29] [28] [27] [26] [25] [24] [23] [22] [21] [20] [19] [18] [17] [16] [15] [14] [13] [12] [11] [10] [9] [8] [7] [6] [5] [4] [3] [2] [1] [0]

JED mapping

JED offset Bit
0 FCLK0_ENABLE
1 FCLK1_ENABLE
2 FCLK2_ENABLE
3 FSR_INV
4 FSR_ENABLE
5 FOE0_MUX[0]
6 FOE0_MUX[1]
7 FOE1_MUX[0]
8 FOE1_MUX[1]
9 FOE2_MUX[0]
10 FOE2_MUX[1]
11 FOE3_MUX[0]
12 FOE3_MUX[1]
13 TERM_MODE[0]
14 IBUF_VOLT[0]
15 OBUF_VOLT[0]
16 BANK0_IBUF_VOLT[0]
17 BANK0_OBUF_VOLT[0]
18 BANK1_IBUF_VOLT[0]
19 BANK1_OBUF_VOLT[0]