scm tile slots

Slot	Tiles	Bel slots
INT	INT_PLC, INT_EBR, INT_IO	INT
IO	IO_W4, IO_W12, IO_E4, IO_E12, IO_S4, IO_S12, IO_N4, IO_N8, IO_N12	IO0, IO1, IO2, IO3, IO4, IO5, IO6, IO7, IO8, IO9, IO10, IO11, PICTEST0, PICTEST1, PICTEST2
BEL	PLC, EBR_W, EBR_E, CONFIG, IO_INT_W, IO_INT_E, IO_INT_S, SERDES_W, SERDES_E, MACO_W, MACO_E, PLL_SW, PLL_SE, PLL_NW, PLL_NE	SLICE0, SLICE1, SLICE2, SLICE3, IO_INT, DQS0, DQS1, DQSTEST, DQSDLL, DQSDLLTEST, SERDES, SERDES_CENTER, SERDES_CORNER, MACO, MACO_INT, MIPI, CLKTEST_MIPI, CIBTEST_SEL, EBR0, EBR1, EBR2, EBR3, EBR_INT, DSP0, DSP1, PLL0, PLL1, PLL_SMI, PLLREFCS0, PLLREFCS1, DLL0, DLL1, DLL2, DLL3, DLL_DCNTL0, DLL_DCNTL1, PROMON, RNET, DDRDLL, DTR, DLLDEL0, DLLDEL1, DLLDEL2, DLLDEL3, DLLDEL4, DLLDEL5, DLLDEL6, DLLDEL7, ECLK_ALT_ROOT, SPLL, SYSBUS, START, OSC, JTAG, RDBK, GSR, TSALL, SED, M0, M1, M2, M3, RESETN, RDCFGN, CCLK, TCK, TMS, TDI, SPIM, SSPI, WAKEUP, STF, AMBOOT, PERREG, PCNTR, EFB, ESB, I2C, NVCMTEST, PMU, PMUTEST, CFGTEST, PVTTEST, PVTCAL, TESTIN, TESTOUT, DTS
BC		BCPG, BCINRD, BCLVDSO, BCSLEWRATE, BCPUSL, BREFTEST
CLK	CLK_W, CLK_E, CLK_N, CLK_S, CLK_SW, CLK_SE, CLK_ROOT	CLKDIV0, CLKDIV1, CLKDIV2, CLKDIV3, PCSCLKDIV0, PCSCLKDIV1, PCSCLKDIV2, PCSCLKDIV3, DCC_SW0, DCC_SW1, DCC_SW2, DCC_SW3, DCC_SW4, DCC_SW5, DCC_SE0, DCC_SE1, DCC_SE2, DCC_SE3, DCC_SE4, DCC_SE5, DCC_NW0, DCC_NW1, DCC_NW2, DCC_NW3, DCC_NW4, DCC_NW5, DCC_NE0, DCC_NE1, DCC_NE2, DCC_NE3, DCC_NE4, DCC_NE5, DCS_SW0, DCS_SW1, DCS_SE0, DCS_SE1, DCS_NW0, DCS_NW1, DCS_NE0, DCS_NE1, DCC0, DCC1, DCC2, DCC3, DCC4, DCC5, DCC6, DCC7, DCC8, DCC9, DCC10, DCC11, DCC12, DCC13, DCC14, DCC15, DCM0, DCM1, DCS0, DCS1, ECLKBRIDGECS0, ECLKBRIDGECS1, BRGECLKSYNC0, BRGECLKSYNC1, CLKFBBUF0, CLKFBBUF1, CLK_ROOT, CLK_EDGE, CLKTEST, ECLK_ROOT, ECLKSYNC0, ECLKSYNC1, ECLKSYNC2, ECLKSYNC3, ECLKSYNC4, ECLKSYNC5, ECLKSYNC6, ECLKSYNC7, ECLKSYNC8, ECLKSYNC9, ECLKSYNC10, ECLKSYNC11, ECLKSYNC12, ECLKSYNC13, ECLKSYNC14, ECLKSYNC15, CLKTEST_ECLK
SCLK_SOURCE		SCLK_SOURCE
PCLK_SOURCE		PCLK_SOURCE_W, PCLK_SOURCE_E, PCLK_DCC0, PCLK_DCC1
ECLK_TAP		ECLK_TAP
HSDCLK_SPLITTER		HSDCLK_ROOT, HSDCLK_SPLITTER

scm bel slots

Slot	Class	Tile slot	Tiles
INT	legacy	INT	INT_PLC, INT_EBR, INT_IO
SLICE0	legacy	BEL	PLC
SLICE1	legacy	BEL	PLC
SLICE2	legacy	BEL	PLC
SLICE3	legacy	BEL	PLC
IO0	legacy	IO	IO_W4, IO_W12, IO_E4, IO_E12, IO_S4, IO_S12, IO_N4, IO_N8, IO_N12
IO1	legacy	IO	IO_W4, IO_W12, IO_E4, IO_E12, IO_S4, IO_S12, IO_N4, IO_N8, IO_N12
IO2	legacy	IO	IO_W4, IO_W12, IO_E4, IO_E12, IO_S4, IO_S12, IO_N4, IO_N8, IO_N12
IO3	legacy	IO	IO_W4, IO_W12, IO_E4, IO_E12, IO_S4, IO_S12, IO_N4, IO_N8, IO_N12
IO4	legacy	IO	IO_W12, IO_E12, IO_S12, IO_N8, IO_N12
IO5	legacy	IO	IO_W12, IO_E12, IO_S12, IO_N8, IO_N12
IO6	legacy	IO	IO_W12, IO_E12, IO_S12, IO_N8, IO_N12
IO7	legacy	IO	IO_W12, IO_E12, IO_S12, IO_N8, IO_N12
IO8	legacy	IO	IO_W12, IO_E12, IO_S12, IO_N12
IO9	legacy	IO	IO_W12, IO_E12, IO_S12, IO_N12
IO10	legacy	IO	IO_W12, IO_E12, IO_S12, IO_N12
IO11	legacy	IO	IO_W12, IO_E12, IO_S12, IO_N12
PICTEST0	legacy	IO	IO_W4, IO_W12, IO_E4, IO_E12, IO_S4, IO_S12, IO_N4, IO_N8, IO_N12
PICTEST1	legacy	IO	IO_W12, IO_E12, IO_S12, IO_N8, IO_N12
PICTEST2	legacy	IO	IO_W12, IO_E12, IO_S12, IO_N12
IO_INT	legacy	BEL	IO_INT_W, IO_INT_E, IO_INT_S
DQS0	legacy	BEL
DQS1	legacy	BEL
DQSTEST	legacy	BEL
DQSDLL	legacy	BEL
DQSDLLTEST	legacy	BEL
SERDES	legacy	BEL	SERDES_W, SERDES_E
SERDES_CENTER	legacy	BEL	CONFIG
SERDES_CORNER	legacy	BEL	PLL_NW, PLL_NE
MACO	legacy	BEL	MACO_W, MACO_E
MACO_INT	legacy	BEL	MACO_W, MACO_E
MIPI	legacy	BEL
CLKTEST_MIPI	legacy	BEL
CIBTEST_SEL	legacy	BEL
EBR0	legacy	BEL	EBR_W, EBR_E
EBR1	legacy	BEL
EBR2	legacy	BEL
EBR3	legacy	BEL
EBR_INT	legacy	BEL	EBR_W, EBR_E
DSP0	legacy	BEL
DSP1	legacy	BEL
PLL0	legacy	BEL	PLL_SW, PLL_SE, PLL_NW, PLL_NE
PLL1	legacy	BEL	PLL_SW, PLL_SE, PLL_NW, PLL_NE
PLL_SMI	legacy	BEL	PLL_SW, PLL_SE, PLL_NW, PLL_NE
PLLREFCS0	legacy	BEL
PLLREFCS1	legacy	BEL
DLL0	legacy	BEL	PLL_SW, PLL_SE, PLL_NW, PLL_NE
DLL1	legacy	BEL	PLL_SW, PLL_SE, PLL_NW, PLL_NE
DLL2	legacy	BEL	PLL_SW, PLL_SE
DLL3	legacy	BEL	PLL_SW, PLL_SE
DLL_DCNTL0	legacy	BEL	PLL_SW, PLL_SE, PLL_NW, PLL_NE
DLL_DCNTL1	legacy	BEL	PLL_SW, PLL_SE, PLL_NW, PLL_NE
PROMON	legacy	BEL	PLL_SW, PLL_SE
RNET	legacy	BEL	PLL_SW
DDRDLL	legacy	BEL
DTR	legacy	BEL
DLLDEL0	legacy	BEL
DLLDEL1	legacy	BEL
DLLDEL2	legacy	BEL
DLLDEL3	legacy	BEL
DLLDEL4	legacy	BEL
DLLDEL5	legacy	BEL
DLLDEL6	legacy	BEL
DLLDEL7	legacy	BEL
CLKDIV0	legacy	CLK	CLK_W, CLK_E, CLK_N, CLK_SW, CLK_SE
CLKDIV1	legacy	CLK	CLK_W, CLK_E, CLK_N, CLK_SW, CLK_SE
CLKDIV2	legacy	CLK	CLK_W, CLK_E, CLK_N, CLK_SW, CLK_SE
CLKDIV3	legacy	CLK	CLK_W, CLK_E, CLK_N, CLK_SW, CLK_SE
PCSCLKDIV0	legacy	CLK
PCSCLKDIV1	legacy	CLK
PCSCLKDIV2	legacy	CLK
PCSCLKDIV3	legacy	CLK
ECLK_ALT_ROOT	legacy	BEL
SPLL	legacy	BEL
SYSBUS	legacy	BEL	CONFIG
START	legacy	BEL	CONFIG
OSC	legacy	BEL	CONFIG
JTAG	legacy	BEL	CONFIG
RDBK	legacy	BEL	CONFIG
GSR	legacy	BEL	CONFIG
TSALL	legacy	BEL
SED	legacy	BEL
M0	legacy	BEL	PLL_NW
M1	legacy	BEL	PLL_NW
M2	legacy	BEL	PLL_NW
M3	legacy	BEL	PLL_NW
RESETN	legacy	BEL	PLL_NW
RDCFGN	legacy	BEL	PLL_NW
CCLK	legacy	BEL	PLL_NE
TCK	legacy	BEL	PLL_NE
TMS	legacy	BEL	PLL_NE
TDI	legacy	BEL	PLL_NE
SPIM	legacy	BEL
SSPI	legacy	BEL
WAKEUP	legacy	BEL
STF	legacy	BEL
AMBOOT	legacy	BEL
PERREG	legacy	BEL
PCNTR	legacy	BEL
EFB	legacy	BEL
ESB	legacy	BEL
I2C	legacy	BEL
NVCMTEST	legacy	BEL
PMU	legacy	BEL
PMUTEST	legacy	BEL
CFGTEST	legacy	BEL
BCPG	legacy	BC
BCINRD	legacy	BC
BCLVDSO	legacy	BC
BCSLEWRATE	legacy	BC
BCPUSL	legacy	BC
BREFTEST	legacy	BC
PVTTEST	legacy	BEL
PVTCAL	legacy	BEL
DCC_SW0	legacy	CLK
DCC_SW1	legacy	CLK
DCC_SW2	legacy	CLK
DCC_SW3	legacy	CLK
DCC_SW4	legacy	CLK
DCC_SW5	legacy	CLK
DCC_SE0	legacy	CLK
DCC_SE1	legacy	CLK
DCC_SE2	legacy	CLK
DCC_SE3	legacy	CLK
DCC_SE4	legacy	CLK
DCC_SE5	legacy	CLK
DCC_NW0	legacy	CLK
DCC_NW1	legacy	CLK
DCC_NW2	legacy	CLK
DCC_NW3	legacy	CLK
DCC_NW4	legacy	CLK
DCC_NW5	legacy	CLK
DCC_NE0	legacy	CLK
DCC_NE1	legacy	CLK
DCC_NE2	legacy	CLK
DCC_NE3	legacy	CLK
DCC_NE4	legacy	CLK
DCC_NE5	legacy	CLK
DCS_SW0	legacy	CLK
DCS_SW1	legacy	CLK
DCS_SE0	legacy	CLK
DCS_SE1	legacy	CLK
DCS_NW0	legacy	CLK
DCS_NW1	legacy	CLK
DCS_NE0	legacy	CLK
DCS_NE1	legacy	CLK
DCC0	legacy	CLK
DCC1	legacy	CLK
DCC2	legacy	CLK
DCC3	legacy	CLK
DCC4	legacy	CLK
DCC5	legacy	CLK
DCC6	legacy	CLK
DCC7	legacy	CLK
DCC8	legacy	CLK
DCC9	legacy	CLK
DCC10	legacy	CLK
DCC11	legacy	CLK
DCC12	legacy	CLK
DCC13	legacy	CLK
DCC14	legacy	CLK
DCC15	legacy	CLK
DCM0	legacy	CLK
DCM1	legacy	CLK
DCS0	legacy	CLK	CLK_W, CLK_E, CLK_N, CLK_S
DCS1	legacy	CLK	CLK_W, CLK_E, CLK_N, CLK_S
ECLKBRIDGECS0	legacy	CLK
ECLKBRIDGECS1	legacy	CLK
BRGECLKSYNC0	legacy	CLK
BRGECLKSYNC1	legacy	CLK
CLKFBBUF0	legacy	CLK
CLKFBBUF1	legacy	CLK
CLK_ROOT	legacy	CLK	CLK_ROOT
CLK_EDGE	legacy	CLK	CLK_W, CLK_E, CLK_N, CLK_S
CLKTEST	legacy	CLK	CLK_ROOT
SCLK_SOURCE	legacy	SCLK_SOURCE
PCLK_SOURCE_W	legacy	PCLK_SOURCE
PCLK_SOURCE_E	legacy	PCLK_SOURCE
PCLK_DCC0	legacy	PCLK_SOURCE
PCLK_DCC1	legacy	PCLK_SOURCE
ECLK_ROOT	legacy	CLK	CLK_W, CLK_E, CLK_N, CLK_SW, CLK_SE
ECLKSYNC0	legacy	CLK
ECLKSYNC1	legacy	CLK
ECLKSYNC2	legacy	CLK
ECLKSYNC3	legacy	CLK
ECLKSYNC4	legacy	CLK
ECLKSYNC5	legacy	CLK
ECLKSYNC6	legacy	CLK
ECLKSYNC7	legacy	CLK
ECLKSYNC8	legacy	CLK
ECLKSYNC9	legacy	CLK
ECLKSYNC10	legacy	CLK
ECLKSYNC11	legacy	CLK
ECLKSYNC12	legacy	CLK
ECLKSYNC13	legacy	CLK
ECLKSYNC14	legacy	CLK
ECLKSYNC15	legacy	CLK
CLKTEST_ECLK	legacy	CLK
ECLK_TAP	legacy	ECLK_TAP
HSDCLK_ROOT	legacy	HSDCLK_SPLITTER
HSDCLK_SPLITTER	legacy	HSDCLK_SPLITTER
TESTIN	legacy	BEL
TESTOUT	legacy	BEL
DTS	legacy	BEL

scm connector slots

Slot	Opposite	Connectors
W	E	PASS_W, TERM_W
E	W	PASS_E, TERM_E
S	N	PASS_S, TERM_S
N	S	PASS_N, TERM_N
SW	SE	PASS_SW
SE	SW	PASS_SE
EBR_W	EBR_E	PASS_EBR_W_W, PASS_EBR_M_W, PASS_EBR_E_W
EBR_E	EBR_W	PASS_EBR_W_E, PASS_EBR_M_E, PASS_EBR_E_E
IO_W	IO_E	PASS_IO_W
IO_E	IO_W	PASS_IO_E

scm region slots

Slot	Wires
PCLK0	PCLK0, PCLK1, PCLK2, PCLK3, PCLK4, PCLK5, PCLK6, PCLK7, PCLK8, PCLK9, PCLK10, PCLK11
PCLK1
PCLK2
PCLK3
SCLK0
SCLK1
SCLK2
SCLK3
VSDCLK

scm wires

Wire	Kind
TIE0	tie 0
TIE1	tie 1
X0_W0	mux
X0_W1	mux
X0_E0	mux
X0_E1	mux
X0_S0	mux
X0_S1	mux
X0_N0	mux
X0_N1	mux
X1_W0_0	mux
X1_W0_1	branch E
X1_W1_0	mux
X1_W1_1	branch E
X1_W4_0	mux
X1_W4_1	branch E
X1_W5_0	mux
X1_W5_1	branch E
X1_W6_0	mux
X1_W6_1	branch E
X1_W7_0	mux
X1_W7_1	branch E
X1_E0_0	mux
X1_E0_1	branch W
X1_E1_0	mux
X1_E1_1	branch W
X1_E4_0	mux
X1_E4_1	branch W
X1_E5_0	mux
X1_E5_1	branch W
X1_E6_0	mux
X1_E6_1	branch W
X1_E7_0	mux
X1_E7_1	branch W
X1_S0_0	mux
X1_S0_1	branch N
X1_S1_0	mux
X1_S1_1	branch N
X1_S4_0	mux
X1_S4_1	branch N
X1_S5_0	mux
X1_S5_1	branch N
X1_S6_0	mux
X1_S6_1	branch N
X1_S7_0	mux
X1_S7_1	branch N
X1_N0_0	mux
X1_N0_1	branch S
X1_N1_0	mux
X1_N1_1	branch S
X1_N4_0	mux
X1_N4_1	branch S
X1_N5_0	mux
X1_N5_1	branch S
X1_N6_0	mux
X1_N6_1	branch S
X1_N7_0	mux
X1_N7_1	branch S
X2_W0_0	mux
X2_W0_1	branch E
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X2_W1_0	mux
X2_W1_1	branch E
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X2_W5_1	branch E
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X2_W6_0	mux
X2_W6_1	branch E
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X2_E5_0	mux
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X2_E7_0	mux
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X2_S0_0	mux
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X2_S0_2	branch N
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X2_S2_0	mux
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X2_S4_0	mux
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X2_S6_0	mux
X2_S6_1	branch N
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X2_S7_0	mux
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X2_N0_0	mux
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X2_N7_0	mux
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X2_N7_2	branch S
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X6_W6_0	mux
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X6_S5_0	mux
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X6_S6_0	mux
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X6_N0_1	branch S
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X6_N1_1	branch S
X6_N1_2	branch S
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X6_E7_2	→ X6_E7_1	← X6_W7_1
X6_E7_3	→ X6_E7_2	← X6_W7_2
X6_E7_4	→ X6_E7_3	← X6_W7_3
X6_E7_5	→ X6_E7_4	← X6_W7_4
X6_E7_6	→ X6_E7_5	← X6_W7_5
SCLK0_E	→ SCLK0	-
SCLK1_E	→ SCLK1	-
HSDCLK4	→ HSDCLK3	← HSDCLK3
HSDCLK5	→ HSDCLK4	← HSDCLK2
HSDCLK6	→ HSDCLK5	← HSDCLK1

scm wires

Wire	PASS_E	TERM_E
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SCLK0_W	→ SCLK0	-
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OUT_OFX3_W	→ OUT_OFX3	-

scm wires

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VSDCLK1	→ VSDCLK0	-
VSDCLK2	→ VSDCLK1	-
VSDCLK3	→ VSDCLK2	-
VSDCLK4	→ VSDCLK3	-
VSDCLK5	→ VSDCLK4	-
VSDCLK6	→ VSDCLK5	-