Configurable Logic Block

TODO: document

Tile CLBLL

Cells: 1

Bel SLICE0

virtex7 CLBLL bel SLICE0
Pin	Direction	Wires
A	output	OUT12
A1	input	IMUX.IMUX7
A2	input	IMUX.IMUX2
A3	input	IMUX.IMUX1
A4	input	IMUX.IMUX11
A5	input	IMUX.IMUX8
A6	input	IMUX.IMUX4
AMUX	output	OUT20
AQ	output	OUT4
AX	input	IMUX.BYP1.SITE
B	output	OUT13
B1	input	IMUX.IMUX15
B2	input	IMUX.IMUX18
B3	input	IMUX.IMUX17
B4	input	IMUX.IMUX27
B5	input	IMUX.IMUX24
B6	input	IMUX.IMUX12
BMUX	output	OUT21
BQ	output	OUT5
BX	input	IMUX.BYP4.SITE
C	output	OUT14
C1	input	IMUX.IMUX32
C2	input	IMUX.IMUX29
C3	input	IMUX.IMUX22
C4	input	IMUX.IMUX28
C5	input	IMUX.IMUX31
C6	input	IMUX.IMUX35
CE	input	IMUX.FAN7.SITE
CLK	input	IMUX.CLK1
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CQ	output	OUT6
CX	input	IMUX.BYP3.SITE
D	output	OUT15
D1	input	IMUX.IMUX40
D2	input	IMUX.IMUX45
D3	input	IMUX.IMUX38
D4	input	IMUX.IMUX44
D5	input	IMUX.IMUX47
D6	input	IMUX.IMUX43
DMUX	output	OUT23
DQ	output	OUT7
DX	input	IMUX.BYP6.SITE
SR	input	IMUX.CTRL1

Bel SLICE1

virtex7 CLBLL bel SLICE1
Pin	Direction	Wires
A	output	OUT8
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A3	input	IMUX.IMUX0
A4	input	IMUX.IMUX10
A5	input	IMUX.IMUX9
A6	input	IMUX.IMUX5
AMUX	output	OUT16
AQ	output	OUT0
AX	input	IMUX.BYP0.SITE
B	output	OUT9
B1	input	IMUX.IMUX14
B2	input	IMUX.IMUX19
B3	input	IMUX.IMUX16
B4	input	IMUX.IMUX26
B5	input	IMUX.IMUX25
B6	input	IMUX.IMUX13
BMUX	output	OUT17
BQ	output	OUT1
BX	input	IMUX.BYP5.SITE
C	output	OUT10
C1	input	IMUX.IMUX33
C2	input	IMUX.IMUX20
C3	input	IMUX.IMUX23
C4	input	IMUX.IMUX21
C5	input	IMUX.IMUX30
C6	input	IMUX.IMUX34
CE	input	IMUX.FAN6.SITE
CLK	input	IMUX.CLK0
CMUX	output	OUT18
CQ	output	OUT2
CX	input	IMUX.BYP2.SITE
D	output	OUT11
D1	input	IMUX.IMUX41
D2	input	IMUX.IMUX36
D3	input	IMUX.IMUX39
D4	input	IMUX.IMUX37
D5	input	IMUX.IMUX46
D6	input	IMUX.IMUX42
DMUX	output	OUT19
DQ	output	OUT3
DX	input	IMUX.BYP7.SITE
SR	input	IMUX.CTRL0

Bel wires

virtex7 CLBLL bel wires
Wire	Pins
IMUX.CLK0	SLICE1.CLK
IMUX.CLK1	SLICE0.CLK
IMUX.CTRL0	SLICE1.SR
IMUX.CTRL1	SLICE0.SR
IMUX.BYP0.SITE	SLICE1.AX
IMUX.BYP1.SITE	SLICE0.AX
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IMUX.BYP3.SITE	SLICE0.CX
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IMUX.IMUX1	SLICE0.A3
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IMUX.IMUX3	SLICE1.A2
IMUX.IMUX4	SLICE0.A6
IMUX.IMUX5	SLICE1.A6
IMUX.IMUX6	SLICE1.A1
IMUX.IMUX7	SLICE0.A1
IMUX.IMUX8	SLICE0.A5
IMUX.IMUX9	SLICE1.A5
IMUX.IMUX10	SLICE1.A4
IMUX.IMUX11	SLICE0.A4
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IMUX.IMUX13	SLICE1.B6
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IMUX.IMUX15	SLICE0.B1
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IMUX.IMUX17	SLICE0.B3
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IMUX.IMUX25	SLICE1.B5
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IMUX.IMUX29	SLICE0.C2
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IMUX.IMUX33	SLICE1.C1
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IMUX.IMUX38	SLICE0.D3
IMUX.IMUX39	SLICE1.D3
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OUT1	SLICE1.BQ
OUT2	SLICE1.CQ
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OUT4	SLICE0.AQ
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OUT20	SLICE0.AMUX
OUT21	SLICE0.BMUX
OUT22	SLICE0.CMUX
OUT23	SLICE0.DMUX

Bitstream

virtex7 CLBLL bittile 0
Bit	Frame
Bit	0	1	2	3	4	5	6	7	8	9	10	11	12	13	14	15	16	17	18	19	20	21	22	23	24	25	26	27	28	29	30	31	32	33	34	35
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62	-	-	-	-	-	-	-	-	-	-	-	-	-	-	-	-	-	-	-	-	-	-	-	-	-	-	SLICE1:D6LUT[2]	SLICE1:D6LUT[3]	SLICE1:D6LUT[11]	SLICE1:D6LUT[10]	SLICE0:DFFMUX[3]	SLICE1:DFFMUX[1]	SLICE0:D6LUT[2]	SLICE0:D6LUT[3]	SLICE0:D6LUT[11]	SLICE0:D6LUT[10]
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57	-	-	-	-	-	-	-	-	-	-	-	-	-	-	-	-	-	-	-	-	-	-	-	-	-	-	SLICE1:D6LUT[20]	SLICE1:D6LUT[21]	SLICE1:D6LUT[29]	SLICE1:D6LUT[28]	SLICE0:DOUTMUX[2]	SLICE1:DOUTMUX[3]	SLICE0:D6LUT[20]	SLICE0:D6LUT[21]	SLICE0:D6LUT[29]	SLICE0:D6LUT[28]
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55	-	~SLICE0:D5FFSR	-	-	-	-	-	-	-	-	-	-	-	-	-	-	-	-	-	-	-	-	-	-	-	-	SLICE1:D6LUT[32]	SLICE1:D6LUT[33]	SLICE1:D6LUT[41]	SLICE1:D6LUT[40]	SLICE0:D5FFMUX[0]	SLICE1:D5FFMUX[0]	SLICE0:D6LUT[32]	SLICE0:D6LUT[33]	SLICE0:D6LUT[41]	SLICE0:D6LUT[40]
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O5	1

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O6	0	0	0	1
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SLICE1:B5FFMUX	0.31.18	0.31.19
NONE	0	0
O5	0	1
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SLICE1:BCY0	0.0.8
BX	0
O5	1

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SLICE1:BFFMUX	0.31.25	0.31.27	0.31.26	0.31.24
NONE	0	0	0	0
O6	0	0	0	1
XOR	0	0	1	0
BX	0	1	0	0
O5	1	0	0	1
CY	1	0	1	0
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O5	0	1
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O5	1

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O6	0	0	0	1
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SLICE1:COUTMUX	0.31.40	0.30.41	0.30.42	0.31.43
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F7	1	1	0	0

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SLICE1:D5FFMUX	0.31.54	0.31.55
NONE	0	0
O5	0	1
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SLICE1:DCY0	0.31.49
DX	0
O5	1

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NONE	0	0	0	0
O6	0	0	0	1
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DX	0	1	0	0
O5	1	0	0	1
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SLICE1:DOUTMUX	0.31.57	0.31.53	0.30.53	0.31.56
NONE	0	0	0	0
O6	0	0	0	1
XOR	0	0	1	0
D5Q	0	1	0	0
O5	1	0	0	1
CY	1	0	1	0

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non-inverted	[0]

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0	0	0
AX	0	1
1	1	0

Tile CLBLM

Cells: 1

Bel SLICE0

virtex7 CLBLM bel SLICE0
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A	output	OUT12
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A2	input	IMUX.IMUX2
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AI	input	IMUX.FAN0.SITE
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AX	input	IMUX.BYP1.SITE
B	output	OUT13
B1	input	IMUX.IMUX15
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B6	input	IMUX.IMUX12
BI	input	IMUX.FAN2.SITE
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BQ	output	OUT5
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C	output	OUT14
C1	input	IMUX.IMUX32
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CE	input	IMUX.FAN7.SITE
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CQ	output	OUT6
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D6	input	IMUX.IMUX43
DI	input	IMUX.FAN3.SITE
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DQ	output	OUT7
DX	input	IMUX.BYP6.SITE
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Bel SLICE1

virtex7 CLBLM bel SLICE1
Pin	Direction	Wires
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A6	input	IMUX.IMUX5
AMUX	output	OUT16
AQ	output	OUT0
AX	input	IMUX.BYP0.SITE
B	output	OUT9
B1	input	IMUX.IMUX14
B2	input	IMUX.IMUX19
B3	input	IMUX.IMUX16
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B5	input	IMUX.IMUX25
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BQ	output	OUT1
BX	input	IMUX.BYP5.SITE
C	output	OUT10
C1	input	IMUX.IMUX33
C2	input	IMUX.IMUX20
C3	input	IMUX.IMUX23
C4	input	IMUX.IMUX21
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C6	input	IMUX.IMUX34
CE	input	IMUX.FAN6.SITE
CLK	input	IMUX.CLK0
CMUX	output	OUT18
CQ	output	OUT2
CX	input	IMUX.BYP2.SITE
D	output	OUT11
D1	input	IMUX.IMUX41
D2	input	IMUX.IMUX36
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D6	input	IMUX.IMUX42
DMUX	output	OUT19
DQ	output	OUT3
DX	input	IMUX.BYP7.SITE
SR	input	IMUX.CTRL0

Bel wires

virtex7 CLBLM bel wires
Wire	Pins
IMUX.CLK0	SLICE1.CLK
IMUX.CLK1	SLICE0.CLK
IMUX.CTRL0	SLICE1.SR
IMUX.CTRL1	SLICE0.SR
IMUX.BYP0.SITE	SLICE1.AX
IMUX.BYP1.SITE	SLICE0.AX
IMUX.BYP2.SITE	SLICE1.CX
IMUX.BYP3.SITE	SLICE0.CX
IMUX.BYP4.SITE	SLICE0.BX
IMUX.BYP5.SITE	SLICE1.BX
IMUX.BYP6.SITE	SLICE0.DX
IMUX.BYP7.SITE	SLICE1.DX
IMUX.FAN0.SITE	SLICE0.AI
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IMUX.FAN7.SITE	SLICE0.CE
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IMUX.IMUX2	SLICE0.A2
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IMUX.IMUX6	SLICE1.A1
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IMUX.IMUX8	SLICE0.A5
IMUX.IMUX9	SLICE1.A5
IMUX.IMUX10	SLICE1.A4
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IMUX.IMUX19	SLICE1.B2
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IMUX.IMUX21	SLICE1.C4
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IMUX.IMUX24	SLICE0.B5
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IMUX.IMUX47	SLICE0.D5
OUT0	SLICE1.AQ
OUT1	SLICE1.BQ
OUT2	SLICE1.CQ
OUT3	SLICE1.DQ
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SLICE1:D6LUT	0.28.48	0.29.48	0.28.49	0.29.49	0.28.50	0.29.50	0.28.51	0.29.51	0.27.48	0.26.48	0.27.49	0.26.49	0.27.50	0.26.50	0.27.51	0.26.51	0.28.52	0.29.52	0.28.53	0.29.53	0.28.54	0.29.54	0.28.55	0.29.55	0.27.52	0.26.52	0.27.53	0.26.53	0.27.54	0.26.54	0.27.55	0.26.55	0.28.56	0.29.56	0.28.57	0.29.57	0.28.58	0.29.58	0.28.59	0.29.59	0.27.56	0.26.56	0.27.57	0.26.57	0.27.58	0.26.58	0.27.59	0.26.59	0.28.60	0.29.60	0.28.61	0.29.61	0.28.62	0.29.62	0.28.63	0.29.63	0.27.60	0.26.60	0.27.61	0.26.61	0.27.62	0.26.62	0.27.63	0.26.63
non-inverted	[63]	[62]	[61]	[60]	[59]	[58]	[57]	[56]	[55]	[54]	[53]	[52]	[51]	[50]	[49]	[48]	[47]	[46]	[45]	[44]	[43]	[42]	[41]	[40]	[39]	[38]	[37]	[36]	[35]	[34]	[33]	[32]	[31]	[30]	[29]	[28]	[27]	[26]	[25]	[24]	[23]	[22]	[21]	[20]	[19]	[18]	[17]	[16]	[15]	[14]	[13]	[12]	[11]	[10]	[9]	[8]	[7]	[6]	[5]	[4]	[3]	[2]	[1]	[0]

SLICE0:ACY0	0.30.15
SLICE1:ACY0	0.31.14
AX	0
O5	1

SLICE0:ADI1MUX	0.0.0
ALT	0
AI	1

SLICE0:AFFMUX	0.30.0	0.30.1	0.30.2	0.30.3
SLICE1:AFFMUX	0.31.0	0.31.1	0.31.2	0.30.4
NONE	0	0	0	0
O6	0	0	0	1
XOR	0	0	1	0
AX	0	1	0	0
O5	1	0	0	1
CY	1	0	1	0
F7	1	1	0	0

SLICE0:AOUTMUX	0.30.6	0.30.7	0.30.8	0.30.11
SLICE1:AOUTMUX	0.31.10	0.30.5	0.31.7	0.31.9
NONE	0	0	0	0
O6	0	0	0	1
XOR	0	0	1	0
A5Q	0	1	0	0
O5	1	0	0	1
CY	1	0	1	0
F7	1	1	0	0

SLICE0:ARAMMODE	0.30.16	0.0.4	0.31.16
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SLICE0:CRAMMODE	0.30.46	0.0.28	0.31.46
SLICE0:DRAMMODE	0.30.47	0.1.59	0.31.47
RAM64	0	0	1
RAM32	0	1	1
SRL32	1	0	0
SRL16	1	1	0

SLICE0:B5FFMUX	0.30.18	0.30.19
SLICE1:B5FFMUX	0.31.18	0.31.19
NONE	0	0
O5	0	1
BX	1	0

SLICE0:BCY0	0.1.15
SLICE1:BCY0	0.0.8
BX	0
O5	1

SLICE0:BDI1MUX	0.0.20
ALT	0
BI	1

SLICE0:BFFMUX	0.30.27	0.30.26	0.30.25	0.30.24
SLICE1:BFFMUX	0.31.25	0.31.27	0.31.26	0.31.24
NONE	0	0	0	0
O6	0	0	0	1
XOR	0	0	1	0
BX	0	1	0	0
O5	1	0	0	1
CY	1	0	1	0
F8	1	1	0	0

SLICE0:BOUTMUX	0.30.22	0.30.23	0.30.21	0.30.20
SLICE1:BOUTMUX	0.31.21	0.30.29	0.30.28	0.31.20
NONE	0	0	0	0
O6	0	0	0	1
XOR	0	0	1	0
B5Q	0	1	0	0
O5	1	0	0	1
CY	1	0	1	0
F8	1	1	0	0

SLICE0:C5FFMUX	0.30.39	0.31.45
SLICE1:C5FFMUX	0.31.39	0.31.44
NONE	0	0
O5	0	1
CX	1	0

SLICE0:CCY0	0.30.48
SLICE1:CCY0	0.31.48
CX	0
O5	1

SLICE0:CDI1MUX	0.1.43
ALT	0
CI	1

SLICE0:CFFMUX	0.30.35	0.30.36	0.30.37	0.30.38
SLICE1:CFFMUX	0.31.35	0.31.38	0.31.37	0.31.36
NONE	0	0	0	0
O6	0	0	0	1
XOR	0	0	1	0
CX	0	1	0	0
O5	1	0	0	1
CY	1	0	1	0
F7	1	1	0	0

SLICE0:COUTMUX	0.30.40	0.30.43	0.30.44	0.30.45
SLICE1:COUTMUX	0.31.40	0.30.41	0.30.42	0.31.43
NONE	0	0	0	0
O6	0	0	0	1
XOR	0	0	1	0
C5Q	0	1	0	0
O5	1	0	0	1
CY	1	0	1	0
F7	1	1	0	0

SLICE0:CYINIT	0.30.13
SLICE1:CYINIT	0.31.12
PRECYINIT	0
CIN	1

SLICE0:D5FFMUX	0.30.54	0.30.55
SLICE1:D5FFMUX	0.31.54	0.31.55
NONE	0	0
O5	0	1
DX	1	0

SLICE0:DCY0	0.30.49
SLICE1:DCY0	0.31.49
DX	0
O5	1

SLICE0:DFFMUX	0.30.62	0.30.61	0.30.60	0.30.59
NONE	0	0	0	0
O6	0	0	0	1
XOR	0	0	1	0
DX	0	1	0	0
O5	1	0	0	1
CY	1	0	1	0
MC31	1	1	0	0

SLICE0:DOUTMUX	0.30.52	0.30.57	0.30.51	0.30.56
NONE	0	0	0	0
O6	0	0	0	1
XOR	0	0	1	0
D5Q	0	1	0	0
O5	1	0	0	1
CY	1	0	1	0
MC31	1	1	0	0

SLICE0:FF_CE_ENABLE	0.1.39
SLICE0:FF_LATCH	0.30.32
SLICE0:FF_SR_ENABLE	0.1.35
SLICE0:FF_SR_SYNC	0.0.48
SLICE0:INV.CLK	0.1.51
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SLICE0:WA8USED	0.1.27
SLICE1:FF_CE_ENABLE	0.0.36
SLICE1:FF_LATCH	0.31.32
SLICE1:FF_SR_ENABLE	0.0.32
SLICE1:FF_SR_SYNC	0.1.31
SLICE1:INV.CLK	0.0.52
non-inverted	[0]

SLICE0:PRECYINIT	0.0.12	0.30.14
SLICE1:PRECYINIT	0.1.11	0.31.13
0	0	0
AX	0	1
1	1	0

SLICE0:WEMUX	0.1.23
WE	0
CE	1

SLICE1:DFFMUX	0.30.58	0.31.61	0.31.62	0.31.60
NONE	0	0	0	0
O6	0	0	0	1
XOR	0	0	1	0
DX	0	1	0	0
O5	1	0	0	1
CY	1	0	1	0

SLICE1:DOUTMUX	0.31.57	0.31.53	0.30.53	0.31.56
NONE	0	0	0	0
O6	0	0	0	1
XOR	0	0	1	0
D5Q	0	1	0	0
O5	1	0	0	1
CY	1	0	1	0