XC2C32

ParameterValue
IDCODE part0x6c18
FB count2
I/O banks1
Input-only pads1
Has VREF❌
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IMUX width8
BS layoutwide
FB rows1
MC width9
FB columns1

Bitstream columns

Column rangeBits
0..1transfer
1..10FB column 0 even MCs
10..122FB column 0 even PTs
122..138FB column 0 IMUX
138..250FB column 0 odd PTs
250..259FB column 0 odd MCs
259..260transfer

I/O pins

Function Bank Pad distance xc2c32-pc44 xc2c32-vq44 xc2c32-cp56 xc2c32-di44
IDCODE part 0x6c1d 0x6c1c 0x6c1b 0x6c18
IPAD0 0 23 P24 P18 D10 P29
IOB_0_0 0 43 P44 P38 F1 P5
IOB_0_1 0 42 P43 P37 E3 P4
IOB_0_2 0 41 P42 P36 E1 P3
IOB_0_3 0 39 P40 (GOE1) P34 (GOE1) D1 (GOE1) P1 (GOE1)
IOB_0_4 0 38 P39 (GOE0) P33 (GOE0) C1 (GOE0) P44 (GOE0)
IOB_0_5 0 37 P38 (GOE3) P32 (GOE3) A3 (GOE3) P43 (GOE3)
IOB_0_6 0 36 P37 (GOE2) P31 (GOE2) A2 (GOE2) P42 (GOE2)
IOB_0_7 0 35 P36 (GSR) P30 (GSR) B1 (GSR) P41 (GSR)
IOB_0_8 0 34 P35 P29 A1 P40
IOB_0_9 0 33 P34 P28 C4 P39
IOB_0_10 0 32 P33 P27 C5 P38
IOB_0_11 0 28 P29 P23 C8 P34
IOB_0_12 0 27 P28 P22 A10 P33
IOB_0_13 0 26 P27 P21 B10 P32
IOB_0_14 0 25 P26 P20 C10 P31
IOB_0_15 0 24 P25 P19 E8 P30
IOB_1_0 0 0 P1 P39 G1 P6
IOB_1_1 0 1 P2 P40 F3 P7
IOB_1_2 0 2 P3 P41 H1 P8
IOB_1_3 0 3 P4 P42 G3 P9
IOB_1_4 0 4 P5 (GCLK0) P43 (GCLK0) J1 (GCLK0) P10 (GCLK0)
IOB_1_5 0 5 P6 (GCLK1) P44 (GCLK1) K1 (GCLK1) P11 (GCLK1)
IOB_1_6 0 6 P7 (GCLK2) P1 (GCLK2) K2 (GCLK2) P12 (GCLK2)
IOB_1_7 0 7 P8 P2 K3 P13
IOB_1_8 0 8 P9 P3 H3 P14
IOB_1_9 0 10 P11 P5 K5 P16
IOB_1_10 0 11 P12 P6 H5 P17
IOB_1_11 0 13 P14 P8 H8 P19
IOB_1_12 0 17 P18 P12 K8 P23
IOB_1_13 0 18 P19 P13 H10 P24
IOB_1_14 0 19 P20 P14 G10 P25
IOB_1_15 0 21 P22 P16 F10 P27
TCK AUX P17 P11 K10 P22
TMS AUX P16 P10 K9 P21
TDI AUX P15 P9 J10 P20
TDO AUX P30 P24 A6 P35
GND - P10
P23
P31		 P17
P25
P4		 C7
F8
H4		 P15
P28
P36
VCCINT - P21 P15 G8 P26
VCCIO0 0 P13
P32		 P26
P7		 C6
H6		 P18
P37
VCCAUX AUX P41 P35 D3 P2
NC - - - A4
A5
A7
A8
A9
C3
D8
E10
H7
K4
K6
K7		 -

Speed data

Timing parameter xc2c32-3 xc2c32-4 xc2c32-6
DEL_CLK_Q 200 600 700
DEL_D_Q_COMB 200 300 700
DEL_D_Q_LATCH 1000 1500 2500
DEL_IBUF_D 1200 1500 2400
DEL_IBUF_FCLK 1200 1300 2000
DEL_IBUF_FOE 800 1300 2100
DEL_IBUF_FSR 1200 1600 2000
DEL_IBUF_IMUX 800 1300 1700
DEL_IBUF_PLAIN.LVCMOS18 0 0 0
DEL_IBUF_PLAIN.LVCMOS18_ANY 0 0 0
DEL_IBUF_PLAIN.LVCMOS25 700 800 1000
DEL_IBUF_PLAIN.LVCMOS33 700 800 1000
DEL_IBUF_PLAIN.LVTTL 700 800 1000
DEL_IBUF_SCHMITT.LVCMOS15 2500 3000 4000
DEL_IBUF_SCHMITT.LVCMOS18 2000 3000 4000
DEL_IBUF_SCHMITT.LVCMOS18_ANY 2000 3000 4000
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DEL_IBUF_SCHMITT.LVCMOS33 2500 3000 4000
DEL_IBUF_SCHMITT.LVTTL 2500 3000 4000
DEL_IMUX_CT 1300 1300 1600
DEL_IMUX_OR 600 600 1600
DEL_IMUX_PT 400 400 1100
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DEL_OBUF_FAST.LVCMOS18 1400 1800 2000
DEL_OBUF_FAST.LVCMOS18_ANY 1400 1800 2000
DEL_OBUF_FAST.LVCMOS25 2200 2800 4000
DEL_OBUF_FAST.LVCMOS33 2600 3300 4500
DEL_OBUF_FAST.LVTTL 2600 3300 4500
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DEL_OBUF_SLOW.LVCMOS18 4400 5800 7000
DEL_OBUF_SLOW.LVCMOS18_ANY 4400 5800 7000
DEL_OBUF_SLOW.LVCMOS25 6200 7800 11000
DEL_OBUF_SLOW.LVCMOS33 6600 8300 11500
DEL_OBUF_SLOW.LVTTL 6600 8300 11500
DEL_SR_Q 1400 1100 1500
DEL_UIM_IMUX 300 600 1400
HOLD_CE_CLK 0 0 0
HOLD_D_CLK_IBUF_FCLK 0 200 200
HOLD_D_CLK_IBUF_PT 0 400 700
HOLD_D_CLK_PT_FCLK 0 200 200
HOLD_D_CLK_PT_PT 0 400 700
SETUP_CE_CLK 900 700 1700
SETUP_D_CLK_IBUF_FCLK 1500 1500 1800
SETUP_D_CLK_IBUF_PT 1500 1500 1800
SETUP_D_CLK_PT_FCLK 1500 1500 1800
SETUP_D_CLK_PT_PT 1500 1500 1800
WIDTH_CLK 900 1400 2200
WIDTH_CLK_PT 3000 4000 6000
WIDTH_SR 3000 4000 6000

IMUX bits

xc2c32 imux bittile 0
FrameBit
0 1 2 3 4 5 6 7 8 9 10 11 12 13 14
0 IM[0].MUX[7] - IM[0].MUX[6] - IM[0].MUX[5] - IM[0].MUX[4] - IM[0].MUX[3] - IM[0].MUX[2] - IM[0].MUX[1] - IM[0].MUX[0]
1 IM[1].MUX[7] - IM[1].MUX[6] - IM[1].MUX[5] - IM[1].MUX[4] - IM[1].MUX[3] - IM[1].MUX[2] - IM[1].MUX[1] - IM[1].MUX[0]
2 IM[2].MUX[7] - IM[2].MUX[6] - IM[2].MUX[5] - IM[2].MUX[4] - IM[2].MUX[3] - IM[2].MUX[2] - IM[2].MUX[1] - IM[2].MUX[0]
3 IM[3].MUX[7] - IM[3].MUX[6] - IM[3].MUX[5] - IM[3].MUX[4] - IM[3].MUX[3] - IM[3].MUX[2] - IM[3].MUX[1] - IM[3].MUX[0]
4 IM[4].MUX[7] - IM[4].MUX[6] - IM[4].MUX[5] - IM[4].MUX[4] - IM[4].MUX[3] - IM[4].MUX[2] - IM[4].MUX[1] - IM[4].MUX[0]
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8 IM[8].MUX[7] - IM[8].MUX[6] - IM[8].MUX[5] - IM[8].MUX[4] - IM[8].MUX[3] - IM[8].MUX[2] - IM[8].MUX[1] - IM[8].MUX[0]
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24 - - - - - - - - - - - - - - -
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IOB_0_10 1 0 1 1 1 1 1 0
IOB_1_5 1 1 0 1 1 1 1 0
MC_0_8 1 1 1 0 1 1 1 0
MC_1_2 1 1 1 1 0 1 1 0
MC_1_8 1 1 1 1 1 0 1 0
VCC 1 1 1 1 1 1 1 1
IM[18].MUX 0.18.0 0.18.2 0.18.4 0.18.6 0.18.8 0.18.10 0.18.12 0.18.14
IOB_0_7 0 1 1 1 1 1 1 0
IPAD0 1 0 1 1 1 1 1 0
IOB_1_4 1 1 0 1 1 1 1 0
MC_0_1 1 1 1 0 1 1 1 0
MC_1_4 1 1 1 1 0 1 1 0
MC_1_14 1 1 1 1 1 0 1 0
VCC 1 1 1 1 1 1 1 1
IM[19].MUX 0.19.0 0.19.2 0.19.4 0.19.6 0.19.8 0.19.10 0.19.12 0.19.14
IOB_0_8 0 1 1 1 1 1 1 0
IOB_0_14 1 0 1 1 1 1 1 0
IOB_1_11 1 1 0 1 1 1 1 0
IOB_1_15 1 1 1 0 1 1 1 0
MC_0_13 1 1 1 1 0 1 1 0
MC_1_6 1 1 1 1 1 0 1 0
VCC 1 1 1 1 1 1 1 1
IM[1].MUX 0.1.0 0.1.2 0.1.4 0.1.6 0.1.8 0.1.10 0.1.12 0.1.14
IOB_0_1 0 1 1 1 1 1 1 0
IOB_0_11 1 0 1 1 1 1 1 0
IOB_1_6 1 1 0 1 1 1 1 0
MC_0_8 1 1 1 0 1 1 1 0
MC_0_15 1 1 1 1 0 1 1 0
MC_1_12 1 1 1 1 1 0 1 0
VCC 1 1 1 1 1 1 1 1
IM[20].MUX 0.28.0 0.28.2 0.28.4 0.28.6 0.28.8 0.28.10 0.28.12 0.28.14
IOB_0_9 0 1 1 1 1 1 1 0
IOB_0_13 1 0 1 1 1 1 1 0
IOB_1_9 1 1 0 1 1 1 1 0
MC_0_7 1 1 1 0 1 1 1 0
MC_0_10 1 1 1 1 0 1 1 0
MC_1_9 1 1 1 1 1 0 1 0
VCC 1 1 1 1 1 1 1 1
IM[21].MUX 0.29.0 0.29.2 0.29.4 0.29.6 0.29.8 0.29.10 0.29.12 0.29.14
IOB_0_8 0 1 1 1 1 1 1 0
IOB_1_1 1 0 1 1 1 1 1 0
IOB_1_8 1 1 0 1 1 1 1 0
MC_0_5 1 1 1 0 1 1 1 0
MC_1_3 1 1 1 1 0 1 1 0
MC_1_5 1 1 1 1 1 0 1 0
VCC 1 1 1 1 1 1 1 1
IM[22].MUX 0.30.0 0.30.2 0.30.4 0.30.6 0.30.8 0.30.10 0.30.12 0.30.14
IOB_0_0 0 1 1 1 1 1 1 0
IOB_0_12 1 0 1 1 1 1 1 0
IOB_1_7 1 1 0 1 1 1 1 0
MC_0_3 1 1 1 0 1 1 1 0
MC_0_15 1 1 1 1 0 1 1 0
MC_1_11 1 1 1 1 1 0 1 0
VCC 1 1 1 1 1 1 1 1
IM[23].MUX 0.31.0 0.31.2 0.31.4 0.31.6 0.31.8 0.31.10 0.31.12 0.31.14
IOB_0_1 0 1 1 1 1 1 1 0
IOB_1_2 1 0 1 1 1 1 1 0
IOB_1_9 1 1 0 1 1 1 1 0
MC_0_6 1 1 1 0 1 1 1 0
MC_1_4 1 1 1 1 0 1 1 0
MC_1_5 1 1 1 1 1 0 1 0
VCC 1 1 1 1 1 1 1 1
IM[24].MUX 0.32.0 0.32.2 0.32.4 0.32.6 0.32.8 0.32.10 0.32.12 0.32.14
IOB_0_2 0 1 1 1 1 1 1 0
IOB_0_13 1 0 1 1 1 1 1 0
IOB_1_14 1 1 0 1 1 1 1 0
MC_0_5 1 1 1 0 1 1 1 0
MC_1_2 1 1 1 1 0 1 1 0
MC_1_6 1 1 1 1 1 0 1 0
VCC 1 1 1 1 1 1 1 1
IM[25].MUX 0.33.0 0.33.2 0.33.4 0.33.6 0.33.8 0.33.10 0.33.12 0.33.14
IOB_0_3 0 1 1 1 1 1 1 0
IOB_1_3 1 0 1 1 1 1 1 0
IOB_1_8 1 1 0 1 1 1 1 0
MC_0_0 1 1 1 0 1 1 1 0
MC_1_1 1 1 1 1 0 1 1 0
MC_1_14 1 1 1 1 1 0 1 0
VCC 1 1 1 1 1 1 1 1
IM[26].MUX 0.34.0 0.34.2 0.34.4 0.34.6 0.34.8 0.34.10 0.34.12 0.34.14
IOB_0_4 0 1 1 1 1 1 1 0
IPAD0 1 0 1 1 1 1 1 0
IOB_1_5 1 1 0 1 1 1 1 0
MC_0_4 1 1 1 0 1 1 1 0
MC_0_12 1 1 1 1 0 1 1 0
MC_1_13 1 1 1 1 1 0 1 0
VCC 1 1 1 1 1 1 1 1
IM[27].MUX 0.35.0 0.35.2 0.35.4 0.35.6 0.35.8 0.35.10 0.35.12 0.35.14
IOB_0_5 0 1 1 1 1 1 1 0
IOB_1_1 1 0 1 1 1 1 1 0
IOB_1_11 1 1 0 1 1 1 1 0
MC_0_1 1 1 1 0 1 1 1 0
MC_1_0 1 1 1 1 0 1 1 0
MC_1_8 1 1 1 1 1 0 1 0
VCC 1 1 1 1 1 1 1 1
IM[28].MUX 0.36.0 0.36.2 0.36.4 0.36.6 0.36.8 0.36.10 0.36.12 0.36.14
IOB_0_6 0 1 1 1 1 1 1 0
IOB_0_11 1 0 1 1 1 1 1 0
IOB_1_13 1 1 0 1 1 1 1 0
MC_0_7 1 1 1 0 1 1 1 0
MC_0_13 1 1 1 1 0 1 1 0
MC_1_12 1 1 1 1 1 0 1 0
VCC 1 1 1 1 1 1 1 1
IM[29].MUX 0.37.0 0.37.2 0.37.4 0.37.6 0.37.8 0.37.10 0.37.12 0.37.14
IOB_0_7 0 1 1 1 1 1 1 0
IOB_0_10 1 0 1 1 1 1 1 0
IOB_1_6 1 1 0 1 1 1 1 0
MC_0_9 1 1 1 0 1 1 1 0
MC_1_3 1 1 1 1 0 1 1 0
MC_1_9 1 1 1 1 1 0 1 0
VCC 1 1 1 1 1 1 1 1
IM[2].MUX 0.2.0 0.2.2 0.2.4 0.2.6 0.2.8 0.2.10 0.2.12 0.2.14
IOB_0_2 0 1 1 1 1 1 1 0
IOB_0_12 1 0 1 1 1 1 1 0
IOB_1_13 1 1 0 1 1 1 1 0
MC_0_2 1 1 1 0 1 1 1 0
MC_1_4 1 1 1 1 0 1 1 0
MC_1_11 1 1 1 1 1 0 1 0
VCC 1 1 1 1 1 1 1 1
IM[30].MUX 0.38.0 0.38.2 0.38.4 0.38.6 0.38.8 0.38.10 0.38.12 0.38.14
IOB_0_8 0 1 1 1 1 1 1 0
IOB_1_0 1 0 1 1 1 1 1 0
IOB_1_4 1 1 0 1 1 1 1 0
MC_0_2 1 1 1 0 1 1 1 0
MC_0_11 1 1 1 1 0 1 1 0
MC_1_15 1 1 1 1 1 0 1 0
VCC 1 1 1 1 1 1 1 1
IM[31].MUX 0.39.0 0.39.2 0.39.4 0.39.6 0.39.8 0.39.10 0.39.12 0.39.14
IOB_0_9 0 1 1 1 1 1 1 0
IOB_0_15 1 0 1 1 1 1 1 0
IOB_1_12 1 1 0 1 1 1 1 0
IOB_1_15 1 1 1 0 1 1 1 0
MC_0_14 1 1 1 1 0 1 1 0
MC_1_7 1 1 1 1 1 0 1 0
VCC 1 1 1 1 1 1 1 1
IM[32].MUX 0.40.0 0.40.2 0.40.4 0.40.6 0.40.8 0.40.10 0.40.12 0.40.14
IOB_0_9 0 1 1 1 1 1 1 0
IOB_0_14 1 0 1 1 1 1 1 0
IOB_1_10 1 1 0 1 1 1 1 0
MC_0_8 1 1 1 0 1 1 1 0
MC_0_10 1 1 1 1 0 1 1 0
MC_1_10 1 1 1 1 1 0 1 0
VCC 1 1 1 1 1 1 1 1
IM[33].MUX 0.41.0 0.41.2 0.41.4 0.41.6 0.41.8 0.41.10 0.41.12 0.41.14
IOB_0_0 0 1 1 1 1 1 1 0
IOB_0_13 1 0 1 1 1 1 1 0
IOB_1_8 1 1 0 1 1 1 1 0
MC_0_4 1 1 1 0 1 1 1 0
MC_1_0 1 1 1 1 0 1 1 0
MC_1_12 1 1 1 1 1 0 1 0
VCC 1 1 1 1 1 1 1 1
IM[34].MUX 0.42.0 0.42.2 0.42.4 0.42.6 0.42.8 0.42.10 0.42.12 0.42.14
IOB_0_1 0 1 1 1 1 1 1 0
IOB_0_15 1 0 1 1 1 1 1 0
IOB_1_11 1 1 0 1 1 1 1 0
MC_0_9 1 1 1 0 1 1 1 0
MC_0_10 1 1 1 1 0 1 1 0
MC_1_11 1 1 1 1 1 0 1 0
VCC 1 1 1 1 1 1 1 1
IM[35].MUX 0.43.0 0.43.2 0.43.4 0.43.6 0.43.8 0.43.10 0.43.12 0.43.14
IOB_0_2 0 1 1 1 1 1 1 0
IOB_1_3 1 0 1 1 1 1 1 0
IOB_1_10 1 1 0 1 1 1 1 0
MC_0_7 1 1 1 0 1 1 1 0
MC_0_11 1 1 1 1 0 1 1 0
MC_1_5 1 1 1 1 1 0 1 0
VCC 1 1 1 1 1 1 1 1
IM[36].MUX 0.44.0 0.44.2 0.44.4 0.44.6 0.44.8 0.44.10 0.44.12 0.44.14
IOB_0_3 0 1 1 1 1 1 1 0
IOB_0_14 1 0 1 1 1 1 1 0
IOB_1_5 1 1 0 1 1 1 1 0
MC_0_6 1 1 1 0 1 1 1 0
MC_1_3 1 1 1 1 0 1 1 0
MC_1_7 1 1 1 1 1 0 1 0
VCC 1 1 1 1 1 1 1 1
IM[37].MUX 0.45.0 0.45.2 0.45.4 0.45.6 0.45.8 0.45.10 0.45.12 0.45.14
IOB_0_4 0 1 1 1 1 1 1 0
IOB_0_11 1 0 1 1 1 1 1 0
IOB_1_9 1 1 0 1 1 1 1 0
MC_0_1 1 1 1 0 1 1 1 0
MC_1_2 1 1 1 1 0 1 1 0
MC_1_15 1 1 1 1 1 0 1 0
VCC 1 1 1 1 1 1 1 1
IM[38].MUX 0.46.0 0.46.2 0.46.4 0.46.6 0.46.8 0.46.10 0.46.12 0.46.14
IOB_0_5 0 1 1 1 1 1 1 0
IOB_1_0 1 0 1 1 1 1 1 0
IOB_1_6 1 1 0 1 1 1 1 0
MC_0_5 1 1 1 0 1 1 1 0
MC_0_13 1 1 1 1 0 1 1 0
MC_1_14 1 1 1 1 1 0 1 0
VCC 1 1 1 1 1 1 1 1
IM[39].MUX 0.47.0 0.47.2 0.47.4 0.47.6 0.47.8 0.47.10 0.47.12 0.47.14
IOB_0_6 0 1 1 1 1 1 1 0
IOB_1_2 1 0 1 1 1 1 1 0
IOB_1_12 1 1 0 1 1 1 1 0
MC_0_2 1 1 1 0 1 1 1 0
MC_1_1 1 1 1 1 0 1 1 0
MC_1_9 1 1 1 1 1 0 1 0
VCC 1 1 1 1 1 1 1 1
IM[3].MUX 0.3.0 0.3.2 0.3.4 0.3.6 0.3.8 0.3.10 0.3.12 0.3.14
IOB_0_3 0 1 1 1 1 1 1 0
IOB_0_13 1 0 1 1 1 1 1 0
IOB_1_9 1 1 0 1 1 1 1 0
MC_0_9 1 1 1 0 1 1 1 0
MC_0_14 1 1 1 1 0 1 1 0
MC_1_6 1 1 1 1 1 0 1 0
VCC 1 1 1 1 1 1 1 1
IM[4].MUX 0.4.0 0.4.2 0.4.4 0.4.6 0.4.8 0.4.10 0.4.12 0.4.14
IOB_0_4 0 1 1 1 1 1 1 0
IOB_0_14 1 0 1 1 1 1 1 0
IOB_1_11 1 1 0 1 1 1 1 0
MC_0_5 1 1 1 0 1 1 1 0
MC_0_11 1 1 1 1 0 1 1 0
MC_1_10 1 1 1 1 1 0 1 0
VCC 1 1 1 1 1 1 1 1
IM[5].MUX 0.5.0 0.5.2 0.5.4 0.5.6 0.5.8 0.5.10 0.5.12 0.5.14
IOB_0_5 0 1 1 1 1 1 1 0
IOB_0_15 1 0 1 1 1 1 1 0
IOB_1_14 1 1 0 1 1 1 1 0
MC_0_7 1 1 1 0 1 1 1 0
MC_1_1 1 1 1 1 0 1 1 0
MC_1_7 1 1 1 1 1 0 1 0
VCC 1 1 1 1 1 1 1 1
IM[6].MUX 0.6.0 0.6.2 0.6.4 0.6.6 0.6.8 0.6.10 0.6.12 0.6.14
IOB_0_6 0 1 1 1 1 1 1 0
IPAD0 1 0 1 1 1 1 1 0
IOB_1_4 1 1 0 1 1 1 1 0
MC_0_0 1 1 1 0 1 1 1 0
MC_1_3 1 1 1 1 0 1 1 0
MC_1_13 1 1 1 1 1 0 1 0
VCC 1 1 1 1 1 1 1 1
IM[7].MUX 0.7.0 0.7.2 0.7.4 0.7.6 0.7.8 0.7.10 0.7.12 0.7.14
IOB_0_7 0 1 1 1 1 1 1 0
IOB_1_0 1 0 1 1 1 1 1 0
IOB_1_10 1 1 0 1 1 1 1 0
IOB_1_15 1 1 1 0 1 1 1 0
MC_0_12 1 1 1 1 0 1 1 0
MC_1_15 1 1 1 1 1 0 1 0
VCC 1 1 1 1 1 1 1 1
IM[8].MUX 0.8.0 0.8.2 0.8.4 0.8.6 0.8.8 0.8.10 0.8.12 0.8.14
IOB_0_8 0 1 1 1 1 1 1 0
IOB_1_1 1 0 1 1 1 1 1 0
IOB_1_8 1 1 0 1 1 1 1 0
MC_0_6 1 1 1 0 1 1 1 0
MC_0_10 1 1 1 1 0 1 1 0
MC_1_8 1 1 1 1 1 0 1 0
VCC 1 1 1 1 1 1 1 1
IM[9].MUX 0.9.0 0.9.2 0.9.4 0.9.6 0.9.8 0.9.10 0.9.12 0.9.14
IOB_0_9 0 1 1 1 1 1 1 0
IOB_1_2 1 0 1 1 1 1 1 0
IOB_1_7 1 1 0 1 1 1 1 0
MC_0_4 1 1 1 0 1 1 1 0
MC_1_2 1 1 1 1 0 1 1 0
MC_1_5 1 1 1 1 1 0 1 0
VCC 1 1 1 1 1 1 1 1

MC bits

xc2c32 mc bittile 0
FrameBit
0 1 2 3 4 5 6 7 8
0 CLK_MUX[0] CLK_INV CLK_MUX[1] CLK_MUX[2] CLK_DDR RST_MUX[0] RST_MUX[1] SET_MUX[0] SET_MUX[1]
1 REG_MODE[0] REG_MODE[1] IOB_ZIA_MUX[0] IOB_ZIA_MUX[1] MC_ZIA_MUX[0] MC_ZIA_MUX[1] REG_D_MUX[0] IBUF_MODE[0] XOR_MUX[0]
2 XOR_MUX[1] MC_IOB_MUX[0] OE_MUX[0] OE_MUX[1] OE_MUX[2] OE_MUX[3] IOB_TERM_ENABLE IOB_SLEW[0] ~REG_INIT
CLK_DDR 0.0.4
CLK_INV 0.0.1
IOB_TERM_ENABLE 0.2.6
non-inverted [0]
CLK_MUX 0.0.3 0.0.2 0.0.0
FCLK0 0 0 0
FCLK1 0 1 0
FCLK2 1 0 0
PT 1 1 0
CT4 1 1 1
IBUF_MODE 0.1.7
PLAIN 0
SCHMITT 1
IOB_SLEW 0.2.7
FAST 0
SLOW 1
IOB_ZIA_MUX 0.1.3 0.1.2
IBUF 0 0
REG 0 1
NONE 1 1
MC_IOB_MUX 0.2.1
REG 0
XOR 1
MC_ZIA_MUX 0.1.5 0.1.4
XOR 0 0
REG 0 1
NONE 1 1
OE_MUX 0.2.5 0.2.4 0.2.3 0.2.2
VCC 0 0 0 0
CT7 0 0 0 1
PT 0 0 1 0
FOE0 0 0 1 1
FOE1 0 1 0 0
FOE2 0 1 0 1
FOE3 0 1 1 0
IS_GND 0 1 1 1
OPEN_DRAIN 1 0 0 0
GND 1 1 1 1
REG_D_MUX 0.1.6
IBUF 0
XOR 1
REG_INIT 0.2.8
inverted ~[0]
REG_MODE 0.1.1 0.1.0
DFF 0 0
TFF 0 1
LATCH 1 0
DFFCE 1 1
RST_MUX 0.0.6 0.0.5
PT 0 0
CT5 0 1
FSR 1 0
GND 1 1
SET_MUX 0.0.8 0.0.7
PT 0 0
CT6 0 1
FSR 1 0
GND 1 1
XOR_MUX 0.2.0 0.1.8
GND 0 0
PT 0 1
PT_INV 1 0
VCC 1 1

JED mapping

JED offset Bit
0 CLK_MUX[0]
1 CLK_INV
2 CLK_MUX[1]
3 CLK_MUX[2]
4 CLK_DDR
5 RST_MUX[0]
6 RST_MUX[1]
7 SET_MUX[0]
8 SET_MUX[1]
9 REG_MODE[0]
10 REG_MODE[1]
11 IOB_ZIA_MUX[0]
12 IOB_ZIA_MUX[1]
13 MC_ZIA_MUX[0]
14 MC_ZIA_MUX[1]
15 REG_D_MUX[0]
16 IBUF_MODE[0]
17 XOR_MUX[0]
18 XOR_MUX[1]
19 MC_IOB_MUX[0]
20 OE_MUX[0]
21 OE_MUX[1]
22 OE_MUX[2]
23 OE_MUX[3]
24 IOB_TERM_ENABLE
25 IOB_SLEW[0]
26 REG_INIT

Global bits

xc2c32 global bittile 0
FrameBit
0 1 2 3 4 5 6 7 8 9 10 11 12 13 14 15 16 17 18 19 20 21 22 23 24 25 26 27 28 29 30 31 32 33 34 35 36 37 38 39 40 41 42 43 44 45 46 47 48 49 50 51 52 53 54 55 56 57 58 59 60 61 62 63 64 65 66 67 68 69 70 71 72 73 74 75 76 77 78 79 80 81 82 83 84 85 86 87 88 89 90 91 92 93 94 95 96 97 98 99 100 101 102 103 104 105 106 107 108 109 110 111 112 113 114 115 116 117 118 119 120 121 122 123 124 125 126 127 128 129 130 131 132 133 134 135 136 137 138 139 140 141 142 143 144 145 146 147 148 149 150 151 152 153 154 155 156 157 158 159 160 161 162 163 164 165 166 167 168 169 170 171 172 173 174 175 176 177 178 179 180 181 182 183 184 185 186 187 188 189 190 191 192 193 194 195 196 197 198 199 200 201 202 203 204 205 206 207 208 209 210 211 212 213 214 215 216 217 218 219 220 221 222 223 224 225 226 227 228 229 230 231 232 233 234 235 236 237 238 239 240 241 242 243 244 245 246 247 248 249
0 - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - -
1 - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - -
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6 - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - -
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24 - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - FOE0_MUX[0] FOE0_MUX[1] FOE1_MUX[0] FOE1_MUX[1] OBUF_VOLT[0] IPAD0_IBUF_MODE[0] IPAD0_TERM_ENABLE - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - -
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41 - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - -
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43 - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - -
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45 - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - -
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48 - ~READ_PROT[3] - ~READ_PROT[2] - ~READ_PROT[1] - ~READ_PROT[0] - ~DONE - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - -
49 - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - - USERCODE[0] USERCODE[1] USERCODE[2] USERCODE[3] USERCODE[4] USERCODE[5] USERCODE[6] USERCODE[7] USERCODE[8] USERCODE[9] USERCODE[10] USERCODE[11] USERCODE[12] USERCODE[13] USERCODE[14] USERCODE[15] USERCODE[16] USERCODE[17] USERCODE[18] USERCODE[19] USERCODE[20] USERCODE[21] USERCODE[22] USERCODE[23] USERCODE[24] USERCODE[25] USERCODE[26] USERCODE[27] USERCODE[28] USERCODE[29] USERCODE[30] USERCODE[31]
DONE 0.48.9
FSR_INV 0.23.129
inverted ~[0]
FCLK0_ENABLE 0.23.126
FCLK1_ENABLE 0.23.127
FCLK2_ENABLE 0.23.128
FSR_ENABLE 0.23.130
IPAD0_TERM_ENABLE 0.24.132
non-inverted [0]
FOE0_MUX 0.24.127 0.24.126
FOE1_MUX 0.24.129 0.24.128
FOE2_MUX 0.25.127 0.25.126
FOE3_MUX 0.25.129 0.25.128
IBUF_INV 0 0
IBUF 0 1
MC 1 0
NONE 1 1
IBUF_VOLT 0.25.130
OBUF_VOLT 0.24.130
HIGH 0
LOW 1
IPAD0_IBUF_MODE 0.24.131
PLAIN 0
SCHMITT 1
READ_PROT 0.48.1 0.48.3 0.48.5 0.48.7
inverted ~[3] ~[2] ~[1] ~[0]
TERM_MODE 0.23.131
KEEPER 0
PULLUP 1
USERCODE 0.49.249 0.49.248 0.49.247 0.49.246 0.49.245 0.49.244 0.49.243 0.49.242 0.49.241 0.49.240 0.49.239 0.49.238 0.49.237 0.49.236 0.49.235 0.49.234 0.49.233 0.49.232 0.49.231 0.49.230 0.49.229 0.49.228 0.49.227 0.49.226 0.49.225 0.49.224 0.49.223 0.49.222 0.49.221 0.49.220 0.49.219 0.49.218
non-inverted [31] [30] [29] [28] [27] [26] [25] [24] [23] [22] [21] [20] [19] [18] [17] [16] [15] [14] [13] [12] [11] [10] [9] [8] [7] [6] [5] [4] [3] [2] [1] [0]

JED mapping

JED offset Bit
0 FCLK0_ENABLE
1 FCLK1_ENABLE
2 FCLK2_ENABLE
3 FSR_INV
4 FSR_ENABLE
5 FOE0_MUX[0]
6 FOE0_MUX[1]
7 FOE1_MUX[0]
8 FOE1_MUX[1]
9 FOE2_MUX[0]
10 FOE2_MUX[1]
11 FOE3_MUX[0]
12 FOE3_MUX[1]
13 TERM_MODE[0]
14 OBUF_VOLT[0]
15 IBUF_VOLT[0]
16 IPAD0_IBUF_MODE[0]
17 IPAD0_TERM_ENABLE