Keyboard shortcuts

Press or to navigate between chapters

Press ? to show this help

Press Esc to hide this help

SERDES

Tile SERDES1

Cells: 62

Bel SERDES

ecp4 SERDES1 bel SERDES
PinDirectionWires
CORNER_FCSCANMODEinputTCELL61:IMUX_C0
CORNER_FCSYNCTOGGLEinputTCELL61:IMUX_B0
CORNER_FOREFCK2COREoutputTCELL61:OUT_F0
CORNER_LSPLLLOLoutputTCELL61:OUT_Q0
CORNER_LSPLLPWRUPinputTCELL61:IMUX_A0
CORNER_LSPLLREFCLKIinputTCELL61:IMUX_CLK0_DELAY
CORNER_LSPLLRSTinputTCELL61:IMUX_LSR0
Q0CH0_FCALIGNENinputTCELL0:IMUX_B0
Q0CH0_FCCDRFORCEDLOCKinputTCELL16:IMUX_A0
Q0CH0_FCDFERDENinputTCELL6:IMUX_CE3
Q0CH0_FCDFEUPDinputTCELL7:IMUX_CE3
Q0CH0_FCLDRTXENinputTCELL0:IMUX_A0
Q0CH0_FCLSMENinputTCELL15:IMUX_D2
Q0CH0_FCPCIEDETENinputTCELL15:IMUX_B2
Q0CH0_FCPCSRXRSTinputTCELL12:IMUX_LSR0
Q0CH0_FCPCSTXRSTinputTCELL10:IMUX_LSR0
Q0CH0_FCPIPEPHYRESETNinputTCELL7:IMUX_LSR0
Q0CH0_FCPLLLOLinputTCELL16:IMUX_A4
Q0CH0_FCRATE0inputTCELL0:IMUX_B6
Q0CH0_FCRATE1inputTCELL1:IMUX_A3
Q0CH0_FCRATE2inputTCELL1:IMUX_A2
Q0CH0_FCRRSTinputTCELL14:IMUX_LSR0
Q0CH0_FCRXPOLARITYinputTCELL15:IMUX_C0
Q0CH0_FCRXPWRUPinputTCELL0:IMUX_D1
Q0CH0_FCTMRSTARTinputTCELL3:IMUX_A6
Q0CH0_FCTMRSTOPinputTCELL4:IMUX_A2
Q0CH0_FCTRSTinputTCELL16:IMUX_LSR0
Q0CH0_FCTXMARGIN0inputTCELL16:IMUX_C2
Q0CH0_FCTXMARGIN1inputTCELL16:IMUX_C1
Q0CH0_FCTXMARGIN2inputTCELL16:IMUX_C0
Q0CH0_FCTXPWRUPinputTCELL0:IMUX_C1
Q0CH0_FCWORDALGNENinputTCELL15:IMUX_C4
Q0CH0_FDLDRRXoutputTCELL3:OUT_F0
Q0CH0_FDLDRTXinputTCELL16:IMUX_B2
Q0CH0_FDRX0outputTCELL9:OUT_Q5
Q0CH0_FDRX1outputTCELL9:OUT_Q4
Q0CH0_FDRX10outputTCELL9:OUT_F3
Q0CH0_FDRX11outputTCELL9:OUT_F2
Q0CH0_FDRX12outputTCELL9:OUT_F1
Q0CH0_FDRX13outputTCELL9:OUT_F0
Q0CH0_FDRX14outputTCELL8:OUT_F7
Q0CH0_FDRX15outputTCELL8:OUT_F6
Q0CH0_FDRX16outputTCELL8:OUT_Q5
Q0CH0_FDRX17outputTCELL8:OUT_Q4
Q0CH0_FDRX18outputTCELL8:OUT_Q3
Q0CH0_FDRX19outputTCELL8:OUT_Q2
Q0CH0_FDRX2outputTCELL9:OUT_Q3
Q0CH0_FDRX20outputTCELL8:OUT_Q1
Q0CH0_FDRX21outputTCELL8:OUT_Q0
Q0CH0_FDRX22outputTCELL7:OUT_Q7
Q0CH0_FDRX23outputTCELL7:OUT_Q6
Q0CH0_FDRX24outputTCELL8:OUT_F5
Q0CH0_FDRX25outputTCELL8:OUT_F4
Q0CH0_FDRX26outputTCELL8:OUT_F3
Q0CH0_FDRX27outputTCELL8:OUT_F2
Q0CH0_FDRX28outputTCELL8:OUT_F1
Q0CH0_FDRX29outputTCELL8:OUT_F0
Q0CH0_FDRX3outputTCELL9:OUT_Q2
Q0CH0_FDRX30outputTCELL7:OUT_F7
Q0CH0_FDRX31outputTCELL7:OUT_F6
Q0CH0_FDRX32outputTCELL7:OUT_Q5
Q0CH0_FDRX33outputTCELL7:OUT_Q4
Q0CH0_FDRX34outputTCELL7:OUT_Q3
Q0CH0_FDRX35outputTCELL7:OUT_Q2
Q0CH0_FDRX36outputTCELL7:OUT_Q1
Q0CH0_FDRX37outputTCELL7:OUT_Q0
Q0CH0_FDRX38outputTCELL6:OUT_Q7
Q0CH0_FDRX39outputTCELL6:OUT_Q6
Q0CH0_FDRX4outputTCELL9:OUT_Q1
Q0CH0_FDRX40outputTCELL7:OUT_F5
Q0CH0_FDRX41outputTCELL7:OUT_F4
Q0CH0_FDRX42outputTCELL7:OUT_F3
Q0CH0_FDRX43outputTCELL7:OUT_F2
Q0CH0_FDRX44outputTCELL7:OUT_F1
Q0CH0_FDRX45outputTCELL7:OUT_F0
Q0CH0_FDRX46outputTCELL6:OUT_F7
Q0CH0_FDRX47outputTCELL6:OUT_F6
Q0CH0_FDRX5outputTCELL9:OUT_Q0
Q0CH0_FDRX6outputTCELL8:OUT_Q7
Q0CH0_FDRX7outputTCELL8:OUT_Q6
Q0CH0_FDRX8outputTCELL9:OUT_F5
Q0CH0_FDRX9outputTCELL9:OUT_F4
Q0CH0_FDTX0inputTCELL8:IMUX_A7
Q0CH0_FDTX1inputTCELL8:IMUX_A6
Q0CH0_FDTX10inputTCELL8:IMUX_C1
Q0CH0_FDTX11inputTCELL8:IMUX_C0
Q0CH0_FDTX12inputTCELL7:IMUX_C7
Q0CH0_FDTX13inputTCELL7:IMUX_C6
Q0CH0_FDTX14inputTCELL8:IMUX_B3
Q0CH0_FDTX15inputTCELL8:IMUX_B2
Q0CH0_FDTX16inputTCELL8:IMUX_B1
Q0CH0_FDTX17inputTCELL8:IMUX_B0
Q0CH0_FDTX18inputTCELL7:IMUX_B7
Q0CH0_FDTX19inputTCELL7:IMUX_B6
Q0CH0_FDTX2inputTCELL8:IMUX_D3
Q0CH0_FDTX20inputTCELL8:IMUX_A3
Q0CH0_FDTX21inputTCELL8:IMUX_A2
Q0CH0_FDTX22inputTCELL8:IMUX_A1
Q0CH0_FDTX23inputTCELL8:IMUX_A0
Q0CH0_FDTX24inputTCELL7:IMUX_A7
Q0CH0_FDTX25inputTCELL7:IMUX_A6
Q0CH0_FDTX26inputTCELL7:IMUX_D3
Q0CH0_FDTX27inputTCELL7:IMUX_D2
Q0CH0_FDTX28inputTCELL7:IMUX_D1
Q0CH0_FDTX29inputTCELL7:IMUX_D0
Q0CH0_FDTX3inputTCELL8:IMUX_D2
Q0CH0_FDTX30inputTCELL6:IMUX_D7
Q0CH0_FDTX31inputTCELL6:IMUX_D6
Q0CH0_FDTX32inputTCELL7:IMUX_C3
Q0CH0_FDTX33inputTCELL7:IMUX_C2
Q0CH0_FDTX34inputTCELL7:IMUX_C1
Q0CH0_FDTX35inputTCELL7:IMUX_C0
Q0CH0_FDTX36inputTCELL6:IMUX_C7
Q0CH0_FDTX37inputTCELL6:IMUX_C6
Q0CH0_FDTX38inputTCELL7:IMUX_B3
Q0CH0_FDTX39inputTCELL7:IMUX_B2
Q0CH0_FDTX4inputTCELL8:IMUX_D1
Q0CH0_FDTX40inputTCELL7:IMUX_B1
Q0CH0_FDTX41inputTCELL7:IMUX_B0
Q0CH0_FDTX42inputTCELL6:IMUX_B7
Q0CH0_FDTX43inputTCELL6:IMUX_B6
Q0CH0_FDTX44inputTCELL7:IMUX_A3
Q0CH0_FDTX45inputTCELL7:IMUX_A2
Q0CH0_FDTX46inputTCELL7:IMUX_A1
Q0CH0_FDTX47inputTCELL7:IMUX_A0
Q0CH0_FDTX48inputTCELL6:IMUX_A7
Q0CH0_FDTX49inputTCELL6:IMUX_A6
Q0CH0_FDTX5inputTCELL8:IMUX_D0
Q0CH0_FDTX6inputTCELL7:IMUX_D7
Q0CH0_FDTX7inputTCELL7:IMUX_D6
Q0CH0_FDTX8inputTCELL8:IMUX_C3
Q0CH0_FDTX9inputTCELL8:IMUX_C2
Q0CH0_FIRCLKinputTCELL10:IMUX_CLK0_DELAY
Q0CH0_FIREFRXCLKinputTCELL8:IMUX_CLK0_DELAY
Q0CH0_FITCLKinputTCELL12:IMUX_CLK0_DELAY
Q0CH0_FITMRSTARTCLKinputTCELL1:IMUX_CLK1_DELAY
Q0CH0_FITMRSTOPCLKinputTCELL3:IMUX_CLK1_DELAY
Q0CH0_FSCCOVERRUNoutputTCELL1:OUT_Q6
Q0CH0_FSCCUNDERRUNoutputTCELL2:OUT_F2
Q0CH0_FSDFEVLDoutputTCELL5:OUT_Q1
Q0CH0_FSLSMoutputTCELL1:OUT_F6
Q0CH0_FSPCIECONoutputTCELL0:OUT_Q6
Q0CH0_FSPCIEDONEoutputTCELL1:OUT_F2
Q0CH0_FSRCDONEoutputTCELL4:OUT_F1
Q0CH0_FSRLOLoutputTCELL2:OUT_Q2
Q0CH0_FSRLOSoutputTCELL1:OUT_Q2
Q0CH0_FSSKPADDEDoutputTCELL3:OUT_F4
Q0CH0_FSSKPDELETEDoutputTCELL3:OUT_Q0
Q0CH1_FCALIGNENinputTCELL0:IMUX_B1
Q0CH1_FCCDRFORCEDLOCKinputTCELL16:IMUX_A1
Q0CH1_FCDFERDENinputTCELL7:IMUX_CE0
Q0CH1_FCDFEUPDinputTCELL8:IMUX_CE0
Q0CH1_FCLDRTXENinputTCELL0:IMUX_A1
Q0CH1_FCLSMENinputTCELL15:IMUX_D3
Q0CH1_FCPCIEDETENinputTCELL15:IMUX_B3
Q0CH1_FCPCSRXRSTinputTCELL12:IMUX_LSR1
Q0CH1_FCPCSTXRSTinputTCELL10:IMUX_LSR1
Q0CH1_FCPIPEPHYRESETNinputTCELL7:IMUX_LSR1
Q0CH1_FCPLLLOLinputTCELL16:IMUX_A5
Q0CH1_FCRATE0inputTCELL1:IMUX_B1
Q0CH1_FCRATE1inputTCELL1:IMUX_B0
Q0CH1_FCRATE2inputTCELL0:IMUX_B7
Q0CH1_FCRRSTinputTCELL14:IMUX_LSR1
Q0CH1_FCRXPOLARITYinputTCELL15:IMUX_C1
Q0CH1_FCRXPWRUPinputTCELL0:IMUX_D2
Q0CH1_FCTMRSTARTinputTCELL3:IMUX_A7
Q0CH1_FCTMRSTOPinputTCELL4:IMUX_A3
Q0CH1_FCTRSTinputTCELL16:IMUX_LSR1
Q0CH1_FCTXMARGIN0inputTCELL16:IMUX_C5
Q0CH1_FCTXMARGIN1inputTCELL16:IMUX_C4
Q0CH1_FCTXMARGIN2inputTCELL16:IMUX_C3
Q0CH1_FCTXPWRUPinputTCELL0:IMUX_C2
Q0CH1_FCWORDALGNENinputTCELL15:IMUX_C5
Q0CH1_FDLDRRXoutputTCELL3:OUT_F1
Q0CH1_FDLDRTXinputTCELL16:IMUX_B3
Q0CH1_FDRX0outputTCELL12:OUT_Q7
Q0CH1_FDRX1outputTCELL12:OUT_Q6
Q0CH1_FDRX10outputTCELL12:OUT_F5
Q0CH1_FDRX11outputTCELL12:OUT_F4
Q0CH1_FDRX12outputTCELL12:OUT_F3
Q0CH1_FDRX13outputTCELL12:OUT_F2
Q0CH1_FDRX14outputTCELL12:OUT_F1
Q0CH1_FDRX15outputTCELL12:OUT_F0
Q0CH1_FDRX16outputTCELL11:OUT_Q5
Q0CH1_FDRX17outputTCELL11:OUT_Q4
Q0CH1_FDRX18outputTCELL11:OUT_Q3
Q0CH1_FDRX19outputTCELL11:OUT_Q2
Q0CH1_FDRX2outputTCELL12:OUT_Q5
Q0CH1_FDRX20outputTCELL11:OUT_Q1
Q0CH1_FDRX21outputTCELL11:OUT_Q0
Q0CH1_FDRX22outputTCELL10:OUT_Q7
Q0CH1_FDRX23outputTCELL10:OUT_Q6
Q0CH1_FDRX24outputTCELL11:OUT_F5
Q0CH1_FDRX25outputTCELL11:OUT_F4
Q0CH1_FDRX26outputTCELL11:OUT_F3
Q0CH1_FDRX27outputTCELL11:OUT_F2
Q0CH1_FDRX28outputTCELL11:OUT_F1
Q0CH1_FDRX29outputTCELL11:OUT_F0
Q0CH1_FDRX3outputTCELL12:OUT_Q4
Q0CH1_FDRX30outputTCELL10:OUT_F7
Q0CH1_FDRX31outputTCELL10:OUT_F6
Q0CH1_FDRX32outputTCELL10:OUT_Q5
Q0CH1_FDRX33outputTCELL10:OUT_Q4
Q0CH1_FDRX34outputTCELL10:OUT_Q3
Q0CH1_FDRX35outputTCELL10:OUT_Q2
Q0CH1_FDRX36outputTCELL10:OUT_Q1
Q0CH1_FDRX37outputTCELL10:OUT_Q0
Q0CH1_FDRX38outputTCELL9:OUT_Q7
Q0CH1_FDRX39outputTCELL9:OUT_Q6
Q0CH1_FDRX4outputTCELL12:OUT_Q3
Q0CH1_FDRX40outputTCELL10:OUT_F5
Q0CH1_FDRX41outputTCELL10:OUT_F4
Q0CH1_FDRX42outputTCELL10:OUT_F3
Q0CH1_FDRX43outputTCELL10:OUT_F2
Q0CH1_FDRX44outputTCELL10:OUT_F1
Q0CH1_FDRX45outputTCELL10:OUT_F0
Q0CH1_FDRX46outputTCELL9:OUT_F7
Q0CH1_FDRX47outputTCELL9:OUT_F6
Q0CH1_FDRX5outputTCELL12:OUT_Q2
Q0CH1_FDRX6outputTCELL12:OUT_Q1
Q0CH1_FDRX7outputTCELL12:OUT_Q0
Q0CH1_FDRX8outputTCELL12:OUT_F7
Q0CH1_FDRX9outputTCELL12:OUT_F6
Q0CH1_FDTX0inputTCELL11:IMUX_A1
Q0CH1_FDTX1inputTCELL11:IMUX_A0
Q0CH1_FDTX10inputTCELL10:IMUX_C3
Q0CH1_FDTX11inputTCELL10:IMUX_C2
Q0CH1_FDTX12inputTCELL10:IMUX_C1
Q0CH1_FDTX13inputTCELL10:IMUX_C0
Q0CH1_FDTX14inputTCELL9:IMUX_C7
Q0CH1_FDTX15inputTCELL9:IMUX_C6
Q0CH1_FDTX16inputTCELL10:IMUX_B3
Q0CH1_FDTX17inputTCELL10:IMUX_B2
Q0CH1_FDTX18inputTCELL10:IMUX_B1
Q0CH1_FDTX19inputTCELL10:IMUX_B0
Q0CH1_FDTX2inputTCELL10:IMUX_A7
Q0CH1_FDTX20inputTCELL9:IMUX_B7
Q0CH1_FDTX21inputTCELL9:IMUX_B6
Q0CH1_FDTX22inputTCELL10:IMUX_A3
Q0CH1_FDTX23inputTCELL10:IMUX_A2
Q0CH1_FDTX24inputTCELL10:IMUX_A1
Q0CH1_FDTX25inputTCELL10:IMUX_A0
Q0CH1_FDTX26inputTCELL9:IMUX_A7
Q0CH1_FDTX27inputTCELL9:IMUX_A6
Q0CH1_FDTX28inputTCELL9:IMUX_D3
Q0CH1_FDTX29inputTCELL9:IMUX_D2
Q0CH1_FDTX3inputTCELL10:IMUX_A6
Q0CH1_FDTX30inputTCELL9:IMUX_D1
Q0CH1_FDTX31inputTCELL9:IMUX_D0
Q0CH1_FDTX32inputTCELL8:IMUX_D7
Q0CH1_FDTX33inputTCELL8:IMUX_D6
Q0CH1_FDTX34inputTCELL9:IMUX_C3
Q0CH1_FDTX35inputTCELL9:IMUX_C2
Q0CH1_FDTX36inputTCELL9:IMUX_C1
Q0CH1_FDTX37inputTCELL9:IMUX_C0
Q0CH1_FDTX38inputTCELL8:IMUX_C7
Q0CH1_FDTX39inputTCELL8:IMUX_C6
Q0CH1_FDTX4inputTCELL10:IMUX_D3
Q0CH1_FDTX40inputTCELL9:IMUX_B3
Q0CH1_FDTX41inputTCELL9:IMUX_B2
Q0CH1_FDTX42inputTCELL9:IMUX_B1
Q0CH1_FDTX43inputTCELL9:IMUX_B0
Q0CH1_FDTX44inputTCELL8:IMUX_B7
Q0CH1_FDTX45inputTCELL8:IMUX_B6
Q0CH1_FDTX46inputTCELL9:IMUX_A3
Q0CH1_FDTX47inputTCELL9:IMUX_A2
Q0CH1_FDTX48inputTCELL9:IMUX_A1
Q0CH1_FDTX49inputTCELL9:IMUX_A0
Q0CH1_FDTX5inputTCELL10:IMUX_D2
Q0CH1_FDTX6inputTCELL10:IMUX_D1
Q0CH1_FDTX7inputTCELL10:IMUX_D0
Q0CH1_FDTX8inputTCELL9:IMUX_D7
Q0CH1_FDTX9inputTCELL9:IMUX_D6
Q0CH1_FIRCLKinputTCELL10:IMUX_CLK1_DELAY
Q0CH1_FIREFRXCLKinputTCELL8:IMUX_CLK1_DELAY
Q0CH1_FITCLKinputTCELL12:IMUX_CLK1_DELAY
Q0CH1_FITMRSTARTCLKinputTCELL2:IMUX_CLK0_DELAY
Q0CH1_FITMRSTOPCLKinputTCELL4:IMUX_CLK0_DELAY
Q0CH1_FSCCOVERRUNoutputTCELL1:OUT_Q7
Q0CH1_FSCCUNDERRUNoutputTCELL2:OUT_F3
Q0CH1_FSDFEVLDoutputTCELL5:OUT_Q2
Q0CH1_FSLSMoutputTCELL1:OUT_F7
Q0CH1_FSPCIECONoutputTCELL0:OUT_Q7
Q0CH1_FSPCIEDONEoutputTCELL1:OUT_F3
Q0CH1_FSRCDONEoutputTCELL4:OUT_F2
Q0CH1_FSRLOLoutputTCELL2:OUT_Q3
Q0CH1_FSRLOSoutputTCELL1:OUT_Q3
Q0CH1_FSSKPADDEDoutputTCELL3:OUT_F5
Q0CH1_FSSKPDELETEDoutputTCELL3:OUT_Q1
Q0CH2_FCALIGNENinputTCELL0:IMUX_B2
Q0CH2_FCCDRFORCEDLOCKinputTCELL16:IMUX_A2
Q0CH2_FCDFERDENinputTCELL7:IMUX_CE1
Q0CH2_FCDFEUPDinputTCELL8:IMUX_CE1
Q0CH2_FCLDRTXENinputTCELL0:IMUX_A2
Q0CH2_FCLSMENinputTCELL15:IMUX_D4
Q0CH2_FCPCIEDETENinputTCELL15:IMUX_B4
Q0CH2_FCPCSRXRSTinputTCELL13:IMUX_LSR0
Q0CH2_FCPCSTXRSTinputTCELL11:IMUX_LSR0
Q0CH2_FCPIPEPHYRESETNinputTCELL8:IMUX_LSR0
Q0CH2_FCPLLLOLinputTCELL16:IMUX_B0
Q0CH2_FCRATE0inputTCELL0:IMUX_C6
Q0CH2_FCRATE1inputTCELL1:IMUX_B3
Q0CH2_FCRATE2inputTCELL1:IMUX_B2
Q0CH2_FCRRSTinputTCELL15:IMUX_LSR0
Q0CH2_FCRXPOLARITYinputTCELL15:IMUX_C2
Q0CH2_FCRXPWRUPinputTCELL0:IMUX_D3
Q0CH2_FCTMRSTARTinputTCELL4:IMUX_A0
Q0CH2_FCTMRSTOPinputTCELL3:IMUX_B6
Q0CH2_FCTRSTinputTCELL1:IMUX_LSR0
Q0CH2_FCTXMARGIN0inputTCELL16:IMUX_D2
Q0CH2_FCTXMARGIN1inputTCELL16:IMUX_D1
Q0CH2_FCTXMARGIN2inputTCELL16:IMUX_D0
Q0CH2_FCTXPWRUPinputTCELL0:IMUX_C3
Q0CH2_FCWORDALGNENinputTCELL15:IMUX_D0
Q0CH2_FDLDRRXoutputTCELL3:OUT_F2
Q0CH2_FDLDRTXinputTCELL16:IMUX_B4
Q0CH2_FDRX0outputTCELL15:OUT_Q7
Q0CH2_FDRX1outputTCELL15:OUT_Q6
Q0CH2_FDRX10outputTCELL15:OUT_F5
Q0CH2_FDRX11outputTCELL15:OUT_F4
Q0CH2_FDRX12outputTCELL15:OUT_F3
Q0CH2_FDRX13outputTCELL15:OUT_F2
Q0CH2_FDRX14outputTCELL15:OUT_F1
Q0CH2_FDRX15outputTCELL15:OUT_F0
Q0CH2_FDRX16outputTCELL14:OUT_Q7
Q0CH2_FDRX17outputTCELL14:OUT_Q6
Q0CH2_FDRX18outputTCELL14:OUT_Q5
Q0CH2_FDRX19outputTCELL14:OUT_Q4
Q0CH2_FDRX2outputTCELL15:OUT_Q5
Q0CH2_FDRX20outputTCELL14:OUT_Q3
Q0CH2_FDRX21outputTCELL14:OUT_Q2
Q0CH2_FDRX22outputTCELL14:OUT_Q1
Q0CH2_FDRX23outputTCELL14:OUT_Q0
Q0CH2_FDRX24outputTCELL14:OUT_F7
Q0CH2_FDRX25outputTCELL14:OUT_F6
Q0CH2_FDRX26outputTCELL14:OUT_F5
Q0CH2_FDRX27outputTCELL14:OUT_F4
Q0CH2_FDRX28outputTCELL14:OUT_F3
Q0CH2_FDRX29outputTCELL14:OUT_F2
Q0CH2_FDRX3outputTCELL15:OUT_Q4
Q0CH2_FDRX30outputTCELL14:OUT_F1
Q0CH2_FDRX31outputTCELL14:OUT_F0
Q0CH2_FDRX32outputTCELL13:OUT_Q7
Q0CH2_FDRX33outputTCELL13:OUT_Q6
Q0CH2_FDRX34outputTCELL13:OUT_Q5
Q0CH2_FDRX35outputTCELL13:OUT_Q4
Q0CH2_FDRX36outputTCELL13:OUT_Q3
Q0CH2_FDRX37outputTCELL13:OUT_Q2
Q0CH2_FDRX38outputTCELL13:OUT_Q1
Q0CH2_FDRX39outputTCELL13:OUT_Q0
Q0CH2_FDRX4outputTCELL15:OUT_Q3
Q0CH2_FDRX40outputTCELL13:OUT_F7
Q0CH2_FDRX41outputTCELL13:OUT_F6
Q0CH2_FDRX42outputTCELL13:OUT_F5
Q0CH2_FDRX43outputTCELL13:OUT_F4
Q0CH2_FDRX44outputTCELL13:OUT_F3
Q0CH2_FDRX45outputTCELL13:OUT_F2
Q0CH2_FDRX46outputTCELL13:OUT_F1
Q0CH2_FDRX47outputTCELL13:OUT_F0
Q0CH2_FDRX5outputTCELL15:OUT_Q2
Q0CH2_FDRX6outputTCELL15:OUT_Q1
Q0CH2_FDRX7outputTCELL15:OUT_Q0
Q0CH2_FDRX8outputTCELL15:OUT_F7
Q0CH2_FDRX9outputTCELL15:OUT_F6
Q0CH2_FDTX0inputTCELL13:IMUX_A5
Q0CH2_FDTX1inputTCELL13:IMUX_A4
Q0CH2_FDTX10inputTCELL12:IMUX_D1
Q0CH2_FDTX11inputTCELL12:IMUX_D0
Q0CH2_FDTX12inputTCELL12:IMUX_C5
Q0CH2_FDTX13inputTCELL12:IMUX_C4
Q0CH2_FDTX14inputTCELL12:IMUX_C3
Q0CH2_FDTX15inputTCELL12:IMUX_C2
Q0CH2_FDTX16inputTCELL12:IMUX_C1
Q0CH2_FDTX17inputTCELL12:IMUX_C0
Q0CH2_FDTX18inputTCELL12:IMUX_B5
Q0CH2_FDTX19inputTCELL12:IMUX_B4
Q0CH2_FDTX2inputTCELL13:IMUX_A3
Q0CH2_FDTX20inputTCELL12:IMUX_B3
Q0CH2_FDTX21inputTCELL12:IMUX_B2
Q0CH2_FDTX22inputTCELL12:IMUX_B1
Q0CH2_FDTX23inputTCELL12:IMUX_B0
Q0CH2_FDTX24inputTCELL12:IMUX_A5
Q0CH2_FDTX25inputTCELL12:IMUX_A4
Q0CH2_FDTX26inputTCELL12:IMUX_A3
Q0CH2_FDTX27inputTCELL12:IMUX_A2
Q0CH2_FDTX28inputTCELL12:IMUX_A1
Q0CH2_FDTX29inputTCELL12:IMUX_A0
Q0CH2_FDTX3inputTCELL13:IMUX_A2
Q0CH2_FDTX30inputTCELL11:IMUX_D3
Q0CH2_FDTX31inputTCELL11:IMUX_D2
Q0CH2_FDTX32inputTCELL11:IMUX_D1
Q0CH2_FDTX33inputTCELL11:IMUX_D0
Q0CH2_FDTX34inputTCELL10:IMUX_D7
Q0CH2_FDTX35inputTCELL10:IMUX_D6
Q0CH2_FDTX36inputTCELL11:IMUX_C3
Q0CH2_FDTX37inputTCELL11:IMUX_C2
Q0CH2_FDTX38inputTCELL11:IMUX_C1
Q0CH2_FDTX39inputTCELL11:IMUX_C0
Q0CH2_FDTX4inputTCELL13:IMUX_A1
Q0CH2_FDTX40inputTCELL10:IMUX_C7
Q0CH2_FDTX41inputTCELL10:IMUX_C6
Q0CH2_FDTX42inputTCELL11:IMUX_B3
Q0CH2_FDTX43inputTCELL11:IMUX_B2
Q0CH2_FDTX44inputTCELL11:IMUX_B1
Q0CH2_FDTX45inputTCELL11:IMUX_B0
Q0CH2_FDTX46inputTCELL10:IMUX_B7
Q0CH2_FDTX47inputTCELL10:IMUX_B6
Q0CH2_FDTX48inputTCELL11:IMUX_A3
Q0CH2_FDTX49inputTCELL11:IMUX_A2
Q0CH2_FDTX5inputTCELL13:IMUX_A0
Q0CH2_FDTX6inputTCELL12:IMUX_D5
Q0CH2_FDTX7inputTCELL12:IMUX_D4
Q0CH2_FDTX8inputTCELL12:IMUX_D3
Q0CH2_FDTX9inputTCELL12:IMUX_D2
Q0CH2_FIRCLKinputTCELL11:IMUX_CLK0_DELAY
Q0CH2_FIREFRXCLKinputTCELL9:IMUX_CLK0_DELAY
Q0CH2_FITCLKinputTCELL13:IMUX_CLK0_DELAY
Q0CH2_FITMRSTARTCLKinputTCELL2:IMUX_CLK1_DELAY
Q0CH2_FITMRSTOPCLKinputTCELL4:IMUX_CLK1_DELAY
Q0CH2_FSCCOVERRUNoutputTCELL2:OUT_Q0
Q0CH2_FSCCUNDERRUNoutputTCELL2:OUT_F4
Q0CH2_FSDFEVLDoutputTCELL5:OUT_Q3
Q0CH2_FSLSMoutputTCELL2:OUT_F0
Q0CH2_FSPCIECONoutputTCELL1:OUT_Q0
Q0CH2_FSPCIEDONEoutputTCELL1:OUT_F4
Q0CH2_FSRCDONEoutputTCELL4:OUT_F3
Q0CH2_FSRLOLoutputTCELL2:OUT_Q4
Q0CH2_FSRLOSoutputTCELL1:OUT_Q4
Q0CH2_FSSKPADDEDoutputTCELL2:OUT_Q6
Q0CH2_FSSKPDELETEDoutputTCELL3:OUT_Q2
Q0CH3_FCALIGNENinputTCELL0:IMUX_B3
Q0CH3_FCCDRFORCEDLOCKinputTCELL16:IMUX_A3
Q0CH3_FCDFERDENinputTCELL7:IMUX_CE2
Q0CH3_FCDFEUPDinputTCELL8:IMUX_CE2
Q0CH3_FCLDRTXENinputTCELL0:IMUX_A3
Q0CH3_FCLSMENinputTCELL15:IMUX_D5
Q0CH3_FCPCIEDETENinputTCELL15:IMUX_B5
Q0CH3_FCPCSRXRSTinputTCELL13:IMUX_LSR1
Q0CH3_FCPCSTXRSTinputTCELL11:IMUX_LSR1
Q0CH3_FCPIPEPHYRESETNinputTCELL8:IMUX_LSR1
Q0CH3_FCPLLLOLinputTCELL16:IMUX_B1
Q0CH3_FCRATE0inputTCELL1:IMUX_C1
Q0CH3_FCRATE1inputTCELL1:IMUX_C0
Q0CH3_FCRATE2inputTCELL0:IMUX_C7
Q0CH3_FCRRSTinputTCELL15:IMUX_LSR1
Q0CH3_FCRXPOLARITYinputTCELL15:IMUX_C3
Q0CH3_FCRXPWRUPinputTCELL0:IMUX_A6
Q0CH3_FCTMRSTARTinputTCELL4:IMUX_A1
Q0CH3_FCTMRSTOPinputTCELL3:IMUX_B7
Q0CH3_FCTRSTinputTCELL1:IMUX_LSR1
Q0CH3_FCTXMARGIN0inputTCELL16:IMUX_D5
Q0CH3_FCTXMARGIN1inputTCELL16:IMUX_D4
Q0CH3_FCTXMARGIN2inputTCELL16:IMUX_D3
Q0CH3_FCTXPWRUPinputTCELL0:IMUX_D0
Q0CH3_FCWORDALGNENinputTCELL15:IMUX_D1
Q0CH3_FDLDRRXoutputTCELL3:OUT_F3
Q0CH3_FDLDRTXinputTCELL16:IMUX_B5
Q0CH3_FDRX0outputTCELL1:OUT_F1
Q0CH3_FDRX1outputTCELL1:OUT_F0
Q0CH3_FDRX10outputTCELL0:OUT_F5
Q0CH3_FDRX11outputTCELL0:OUT_F4
Q0CH3_FDRX12outputTCELL0:OUT_F3
Q0CH3_FDRX13outputTCELL0:OUT_F2
Q0CH3_FDRX14outputTCELL0:OUT_F1
Q0CH3_FDRX15outputTCELL0:OUT_F0
Q0CH3_FDRX16outputTCELL17:OUT_Q7
Q0CH3_FDRX17outputTCELL17:OUT_Q6
Q0CH3_FDRX18outputTCELL17:OUT_Q5
Q0CH3_FDRX19outputTCELL17:OUT_Q4
Q0CH3_FDRX2outputTCELL0:OUT_F7
Q0CH3_FDRX20outputTCELL17:OUT_Q3
Q0CH3_FDRX21outputTCELL17:OUT_Q2
Q0CH3_FDRX22outputTCELL17:OUT_Q1
Q0CH3_FDRX23outputTCELL17:OUT_Q0
Q0CH3_FDRX24outputTCELL17:OUT_F7
Q0CH3_FDRX25outputTCELL17:OUT_F6
Q0CH3_FDRX26outputTCELL17:OUT_F5
Q0CH3_FDRX27outputTCELL17:OUT_F4
Q0CH3_FDRX28outputTCELL17:OUT_F3
Q0CH3_FDRX29outputTCELL17:OUT_F2
Q0CH3_FDRX3outputTCELL0:OUT_F6
Q0CH3_FDRX30outputTCELL17:OUT_F1
Q0CH3_FDRX31outputTCELL17:OUT_F0
Q0CH3_FDRX32outputTCELL16:OUT_Q7
Q0CH3_FDRX33outputTCELL16:OUT_Q6
Q0CH3_FDRX34outputTCELL16:OUT_Q5
Q0CH3_FDRX35outputTCELL16:OUT_Q4
Q0CH3_FDRX36outputTCELL16:OUT_Q3
Q0CH3_FDRX37outputTCELL16:OUT_Q2
Q0CH3_FDRX38outputTCELL16:OUT_Q1
Q0CH3_FDRX39outputTCELL16:OUT_Q0
Q0CH3_FDRX4outputTCELL0:OUT_Q5
Q0CH3_FDRX40outputTCELL16:OUT_F7
Q0CH3_FDRX41outputTCELL16:OUT_F6
Q0CH3_FDRX42outputTCELL16:OUT_F5
Q0CH3_FDRX43outputTCELL16:OUT_F4
Q0CH3_FDRX44outputTCELL16:OUT_F3
Q0CH3_FDRX45outputTCELL16:OUT_F2
Q0CH3_FDRX46outputTCELL16:OUT_F1
Q0CH3_FDRX47outputTCELL16:OUT_F0
Q0CH3_FDRX5outputTCELL0:OUT_Q4
Q0CH3_FDRX6outputTCELL0:OUT_Q3
Q0CH3_FDRX7outputTCELL0:OUT_Q2
Q0CH3_FDRX8outputTCELL0:OUT_Q1
Q0CH3_FDRX9outputTCELL0:OUT_Q0
Q0CH3_FDTX0inputTCELL15:IMUX_B1
Q0CH3_FDTX1inputTCELL15:IMUX_B0
Q0CH3_FDTX10inputTCELL14:IMUX_D3
Q0CH3_FDTX11inputTCELL14:IMUX_D2
Q0CH3_FDTX12inputTCELL14:IMUX_D1
Q0CH3_FDTX13inputTCELL14:IMUX_D0
Q0CH3_FDTX14inputTCELL14:IMUX_C5
Q0CH3_FDTX15inputTCELL14:IMUX_C4
Q0CH3_FDTX16inputTCELL14:IMUX_C3
Q0CH3_FDTX17inputTCELL14:IMUX_C2
Q0CH3_FDTX18inputTCELL14:IMUX_C1
Q0CH3_FDTX19inputTCELL14:IMUX_C0
Q0CH3_FDTX2inputTCELL15:IMUX_A5
Q0CH3_FDTX20inputTCELL14:IMUX_B5
Q0CH3_FDTX21inputTCELL14:IMUX_B4
Q0CH3_FDTX22inputTCELL14:IMUX_B3
Q0CH3_FDTX23inputTCELL14:IMUX_B2
Q0CH3_FDTX24inputTCELL14:IMUX_B1
Q0CH3_FDTX25inputTCELL14:IMUX_B0
Q0CH3_FDTX26inputTCELL14:IMUX_A5
Q0CH3_FDTX27inputTCELL14:IMUX_A4
Q0CH3_FDTX28inputTCELL14:IMUX_A3
Q0CH3_FDTX29inputTCELL14:IMUX_A2
Q0CH3_FDTX3inputTCELL15:IMUX_A4
Q0CH3_FDTX30inputTCELL14:IMUX_A1
Q0CH3_FDTX31inputTCELL14:IMUX_A0
Q0CH3_FDTX32inputTCELL13:IMUX_D5
Q0CH3_FDTX33inputTCELL13:IMUX_D4
Q0CH3_FDTX34inputTCELL13:IMUX_D3
Q0CH3_FDTX35inputTCELL13:IMUX_D2
Q0CH3_FDTX36inputTCELL13:IMUX_D1
Q0CH3_FDTX37inputTCELL13:IMUX_D0
Q0CH3_FDTX38inputTCELL13:IMUX_C5
Q0CH3_FDTX39inputTCELL13:IMUX_C4
Q0CH3_FDTX4inputTCELL15:IMUX_A3
Q0CH3_FDTX40inputTCELL13:IMUX_C3
Q0CH3_FDTX41inputTCELL13:IMUX_C2
Q0CH3_FDTX42inputTCELL13:IMUX_C1
Q0CH3_FDTX43inputTCELL13:IMUX_C0
Q0CH3_FDTX44inputTCELL13:IMUX_B5
Q0CH3_FDTX45inputTCELL13:IMUX_B4
Q0CH3_FDTX46inputTCELL13:IMUX_B3
Q0CH3_FDTX47inputTCELL13:IMUX_B2
Q0CH3_FDTX48inputTCELL13:IMUX_B1
Q0CH3_FDTX49inputTCELL13:IMUX_B0
Q0CH3_FDTX5inputTCELL15:IMUX_A2
Q0CH3_FDTX6inputTCELL15:IMUX_A1
Q0CH3_FDTX7inputTCELL15:IMUX_A0
Q0CH3_FDTX8inputTCELL14:IMUX_D5
Q0CH3_FDTX9inputTCELL14:IMUX_D4
Q0CH3_FIRCLKinputTCELL11:IMUX_CLK1_DELAY
Q0CH3_FIREFRXCLKinputTCELL9:IMUX_CLK1_DELAY
Q0CH3_FITCLKinputTCELL13:IMUX_CLK1_DELAY
Q0CH3_FITMRSTARTCLKinputTCELL3:IMUX_CLK0_DELAY
Q0CH3_FITMRSTOPCLKinputTCELL5:IMUX_CLK0_DELAY
Q0CH3_FSCCOVERRUNoutputTCELL2:OUT_Q1
Q0CH3_FSCCUNDERRUNoutputTCELL2:OUT_F5
Q0CH3_FSDFEVLDoutputTCELL5:OUT_Q4
Q0CH3_FSLSMoutputTCELL2:OUT_F1
Q0CH3_FSPCIECONoutputTCELL1:OUT_Q1
Q0CH3_FSPCIEDONEoutputTCELL1:OUT_F5
Q0CH3_FSRCDONEoutputTCELL4:OUT_F4
Q0CH3_FSRLOLoutputTCELL2:OUT_Q5
Q0CH3_FSRLOSoutputTCELL1:OUT_Q5
Q0CH3_FSSKPADDEDoutputTCELL2:OUT_Q7
Q0CH3_FSSKPDELETEDoutputTCELL3:OUT_Q3
Q0D0_FCDERSTinputTCELL9:IMUX_LSR0
Q0D0_FSDEoutputTCELL3:OUT_Q4
Q0D0_FSDMoutputTCELL3:OUT_F6
Q0D1_FCDERSTinputTCELL9:IMUX_LSR1
Q0D1_FSDEoutputTCELL3:OUT_Q5
Q0D1_FSDMoutputTCELL3:OUT_F7
Q0P_CORERRINinputTCELL46:IMUX_A5
Q0P_CORERROUToutputTCELL41:OUT_F5
Q0P_DBGDATOUT0outputTCELL43:OUT_F4
Q0P_DBGDATOUT1outputTCELL43:OUT_F7
Q0P_DBGDATOUT10outputTCELL43:OUT_Q4
Q0P_DBGDATOUT11outputTCELL43:OUT_Q2
Q0P_DBGDATOUT12outputTCELL42:OUT_Q6
Q0P_DBGDATOUT13outputTCELL43:OUT_F6
Q0P_DBGDATOUT14outputTCELL43:OUT_F1
Q0P_DBGDATOUT15outputTCELL43:OUT_Q5
Q0P_DBGDATOUT2outputTCELL43:OUT_F5
Q0P_DBGDATOUT3outputTCELL43:OUT_Q1
Q0P_DBGDATOUT4outputTCELL43:OUT_F2
Q0P_DBGDATOUT5outputTCELL42:OUT_Q1
Q0P_DBGDATOUT6outputTCELL42:OUT_Q7
Q0P_DBGDATOUT7outputTCELL42:OUT_Q3
Q0P_DBGDATOUT8outputTCELL42:OUT_Q4
Q0P_DBGDATOUT9outputTCELL43:OUT_F3
Q0P_FTLERROUToutputTCELL40:OUT_Q4
Q0P_FUNCPWRSTATE0outputTCELL41:OUT_F3
Q0P_FUNCPWRSTATE1outputTCELL41:OUT_F1
Q0P_FUNCPWRSTATE2outputTCELL41:OUT_Q0
Q0P_FUNCSTS0outputTCELL41:OUT_Q3
Q0P_FUNCSTS1outputTCELL41:OUT_F6
Q0P_FUNCSTS2outputTCELL40:OUT_Q7
Q0P_FUNCSTS3outputTCELL41:OUT_Q7
Q0P_HALMSTACKoutputTCELL41:OUT_Q4
Q0P_HALMSTCOMPDES0outputTCELL35:OUT_F1
Q0P_HALMSTCOMPDES1outputTCELL35:OUT_F4
Q0P_HALMSTCOMPDES10outputTCELL39:OUT_F2
Q0P_HALMSTCOMPDES100outputTCELL35:OUT_F7
Q0P_HALMSTCOMPDES101outputTCELL31:OUT_Q3
Q0P_HALMSTCOMPDES102outputTCELL31:OUT_Q2
Q0P_HALMSTCOMPDES103outputTCELL31:OUT_Q4
Q0P_HALMSTCOMPDES104outputTCELL31:OUT_Q1
Q0P_HALMSTCOMPDES105outputTCELL32:OUT_F1
Q0P_HALMSTCOMPDES106outputTCELL32:OUT_F4
Q0P_HALMSTCOMPDES107outputTCELL31:OUT_F2
Q0P_HALMSTCOMPDES108outputTCELL31:OUT_F0
Q0P_HALMSTCOMPDES109outputTCELL30:OUT_Q6
Q0P_HALMSTCOMPDES11outputTCELL36:OUT_Q0
Q0P_HALMSTCOMPDES110outputTCELL31:OUT_F1
Q0P_HALMSTCOMPDES111outputTCELL31:OUT_F5
Q0P_HALMSTCOMPDES112outputTCELL30:OUT_Q7
Q0P_HALMSTCOMPDES113outputTCELL30:OUT_Q3
Q0P_HALMSTCOMPDES114outputTCELL30:OUT_Q2
Q0P_HALMSTCOMPDES115outputTCELL30:OUT_Q0
Q0P_HALMSTCOMPDES116outputTCELL30:OUT_F7
Q0P_HALMSTCOMPDES117outputTCELL30:OUT_Q1
Q0P_HALMSTCOMPDES118outputTCELL30:OUT_Q4
Q0P_HALMSTCOMPDES119outputTCELL31:OUT_F7
Q0P_HALMSTCOMPDES12outputTCELL39:OUT_F6
Q0P_HALMSTCOMPDES120outputTCELL34:OUT_F5
Q0P_HALMSTCOMPDES121outputTCELL37:OUT_F1
Q0P_HALMSTCOMPDES122outputTCELL36:OUT_Q5
Q0P_HALMSTCOMPDES123outputTCELL36:OUT_F6
Q0P_HALMSTCOMPDES124outputTCELL43:OUT_Q0
Q0P_HALMSTCOMPDES125outputTCELL31:OUT_F4
Q0P_HALMSTCOMPDES126outputTCELL31:OUT_F3
Q0P_HALMSTCOMPDES127outputTCELL31:OUT_F6
Q0P_HALMSTCOMPDES13outputTCELL37:OUT_Q7
Q0P_HALMSTCOMPDES14outputTCELL36:OUT_Q7
Q0P_HALMSTCOMPDES15outputTCELL37:OUT_Q6
Q0P_HALMSTCOMPDES16outputTCELL39:OUT_Q0
Q0P_HALMSTCOMPDES17outputTCELL38:OUT_F1
Q0P_HALMSTCOMPDES18outputTCELL40:OUT_Q2
Q0P_HALMSTCOMPDES19outputTCELL39:OUT_Q5
Q0P_HALMSTCOMPDES2outputTCELL35:OUT_Q0
Q0P_HALMSTCOMPDES20outputTCELL38:OUT_Q2
Q0P_HALMSTCOMPDES21outputTCELL40:OUT_Q3
Q0P_HALMSTCOMPDES22outputTCELL39:OUT_Q4
Q0P_HALMSTCOMPDES23outputTCELL38:OUT_Q5
Q0P_HALMSTCOMPDES24outputTCELL40:OUT_F7
Q0P_HALMSTCOMPDES25outputTCELL40:OUT_F6
Q0P_HALMSTCOMPDES26outputTCELL40:OUT_F3
Q0P_HALMSTCOMPDES27outputTCELL40:OUT_F5
Q0P_HALMSTCOMPDES28outputTCELL40:OUT_F2
Q0P_HALMSTCOMPDES29outputTCELL39:OUT_F5
Q0P_HALMSTCOMPDES3outputTCELL36:OUT_Q1
Q0P_HALMSTCOMPDES30outputTCELL35:OUT_Q5
Q0P_HALMSTCOMPDES31outputTCELL38:OUT_F0
Q0P_HALMSTCOMPDES32outputTCELL36:OUT_F3
Q0P_HALMSTCOMPDES33outputTCELL36:OUT_F7
Q0P_HALMSTCOMPDES34outputTCELL36:OUT_Q3
Q0P_HALMSTCOMPDES35outputTCELL37:OUT_Q3
Q0P_HALMSTCOMPDES36outputTCELL37:OUT_Q1
Q0P_HALMSTCOMPDES37outputTCELL36:OUT_F5
Q0P_HALMSTCOMPDES38outputTCELL35:OUT_Q7
Q0P_HALMSTCOMPDES39outputTCELL39:OUT_Q6
Q0P_HALMSTCOMPDES4outputTCELL36:OUT_Q6
Q0P_HALMSTCOMPDES40outputTCELL38:OUT_Q1
Q0P_HALMSTCOMPDES41outputTCELL39:OUT_F7
Q0P_HALMSTCOMPDES42outputTCELL39:OUT_Q3
Q0P_HALMSTCOMPDES43outputTCELL39:OUT_F3
Q0P_HALMSTCOMPDES44outputTCELL38:OUT_Q3
Q0P_HALMSTCOMPDES45outputTCELL38:OUT_F7
Q0P_HALMSTCOMPDES46outputTCELL38:OUT_F6
Q0P_HALMSTCOMPDES47outputTCELL37:OUT_Q2
Q0P_HALMSTCOMPDES48outputTCELL36:OUT_Q4
Q0P_HALMSTCOMPDES49outputTCELL38:OUT_F4
Q0P_HALMSTCOMPDES5outputTCELL36:OUT_Q2
Q0P_HALMSTCOMPDES50outputTCELL37:OUT_F6
Q0P_HALMSTCOMPDES51outputTCELL37:OUT_F7
Q0P_HALMSTCOMPDES52outputTCELL39:OUT_F0
Q0P_HALMSTCOMPDES53outputTCELL38:OUT_F3
Q0P_HALMSTCOMPDES54outputTCELL38:OUT_Q6
Q0P_HALMSTCOMPDES55outputTCELL36:OUT_F4
Q0P_HALMSTCOMPDES56outputTCELL38:OUT_Q7
Q0P_HALMSTCOMPDES57outputTCELL39:OUT_Q2
Q0P_HALMSTCOMPDES58outputTCELL38:OUT_Q0
Q0P_HALMSTCOMPDES59outputTCELL37:OUT_Q0
Q0P_HALMSTCOMPDES6outputTCELL37:OUT_F0
Q0P_HALMSTCOMPDES60outputTCELL37:OUT_F3
Q0P_HALMSTCOMPDES61outputTCELL38:OUT_F5
Q0P_HALMSTCOMPDES62outputTCELL39:OUT_Q1
Q0P_HALMSTCOMPDES63outputTCELL37:OUT_F2
Q0P_HALMSTCOMPDES64outputTCELL32:OUT_Q7
Q0P_HALMSTCOMPDES65outputTCELL33:OUT_F3
Q0P_HALMSTCOMPDES66outputTCELL32:OUT_Q4
Q0P_HALMSTCOMPDES67outputTCELL31:OUT_Q6
Q0P_HALMSTCOMPDES68outputTCELL32:OUT_Q1
Q0P_HALMSTCOMPDES69outputTCELL33:OUT_F2
Q0P_HALMSTCOMPDES7outputTCELL39:OUT_F4
Q0P_HALMSTCOMPDES70outputTCELL32:OUT_F2
Q0P_HALMSTCOMPDES71outputTCELL32:OUT_F7
Q0P_HALMSTCOMPDES72outputTCELL31:OUT_Q7
Q0P_HALMSTCOMPDES73outputTCELL32:OUT_F6
Q0P_HALMSTCOMPDES74outputTCELL32:OUT_F3
Q0P_HALMSTCOMPDES75outputTCELL32:OUT_F0
Q0P_HALMSTCOMPDES76outputTCELL31:OUT_Q5
Q0P_HALMSTCOMPDES77outputTCELL33:OUT_Q0
Q0P_HALMSTCOMPDES78outputTCELL33:OUT_Q2
Q0P_HALMSTCOMPDES79outputTCELL31:OUT_Q0
Q0P_HALMSTCOMPDES8outputTCELL38:OUT_Q4
Q0P_HALMSTCOMPDES80outputTCELL35:OUT_F6
Q0P_HALMSTCOMPDES81outputTCELL35:OUT_Q3
Q0P_HALMSTCOMPDES82outputTCELL36:OUT_F2
Q0P_HALMSTCOMPDES83outputTCELL35:OUT_F2
Q0P_HALMSTCOMPDES84outputTCELL34:OUT_F6
Q0P_HALMSTCOMPDES85outputTCELL34:OUT_F4
Q0P_HALMSTCOMPDES86outputTCELL34:OUT_Q2
Q0P_HALMSTCOMPDES87outputTCELL34:OUT_F7
Q0P_HALMSTCOMPDES88outputTCELL33:OUT_F7
Q0P_HALMSTCOMPDES89outputTCELL33:OUT_F6
Q0P_HALMSTCOMPDES9outputTCELL39:OUT_F1
Q0P_HALMSTCOMPDES90outputTCELL32:OUT_Q5
Q0P_HALMSTCOMPDES91outputTCELL32:OUT_Q2
Q0P_HALMSTCOMPDES92outputTCELL33:OUT_F1
Q0P_HALMSTCOMPDES93outputTCELL32:OUT_Q3
Q0P_HALMSTCOMPDES94outputTCELL33:OUT_F0
Q0P_HALMSTCOMPDES95outputTCELL33:OUT_F4
Q0P_HALMSTCOMPDES96outputTCELL35:OUT_Q6
Q0P_HALMSTCOMPDES97outputTCELL36:OUT_F0
Q0P_HALMSTCOMPDES98outputTCELL36:OUT_F1
Q0P_HALMSTCOMPDES99outputTCELL35:OUT_Q4
Q0P_HALMSTCOMPEOPoutputTCELL35:OUT_F3
Q0P_HALMSTCOMPRDYinputTCELL45:IMUX_A2
Q0P_HALMSTCOMPSOPoutputTCELL34:OUT_Q7
Q0P_HALMSTCOMPVLDoutputTCELL34:OUT_Q6
Q0P_HALMSTRBVLD0outputTCELL35:OUT_F0
Q0P_HALMSTRBVLD1outputTCELL34:OUT_Q3
Q0P_HALMSTRBVLD2outputTCELL35:OUT_Q2
Q0P_HALMSTRBVLD3outputTCELL34:OUT_F3
Q0P_HALMSTRBVLD4outputTCELL34:OUT_F2
Q0P_HALMSTRBVLD5outputTCELL35:OUT_F5
Q0P_HALMSTRBVLD6outputTCELL34:OUT_Q5
Q0P_HALMSTRBVLD7outputTCELL34:OUT_Q4
Q0P_HALMSTREJoutputTCELL41:OUT_Q1
Q0P_HALMSTREQinputTCELL41:IMUX_A5
Q0P_HALMSTREQATTR0inputTCELL45:IMUX_A0
Q0P_HALMSTREQATTR1inputTCELL45:IMUX_A1
Q0P_HALMSTREQATTR2inputTCELL46:IMUX_A3
Q0P_HALMSTREQDES0inputTCELL44:IMUX_B0
Q0P_HALMSTREQDES1inputTCELL43:IMUX_C1
Q0P_HALMSTREQDES10inputTCELL43:IMUX_C2
Q0P_HALMSTREQDES100inputTCELL39:IMUX_C5
Q0P_HALMSTREQDES101inputTCELL39:IMUX_C4
Q0P_HALMSTREQDES102inputTCELL39:IMUX_B5
Q0P_HALMSTREQDES103inputTCELL39:IMUX_B4
Q0P_HALMSTREQDES104inputTCELL39:IMUX_B3
Q0P_HALMSTREQDES105inputTCELL39:IMUX_B2
Q0P_HALMSTREQDES106inputTCELL39:IMUX_B1
Q0P_HALMSTREQDES107inputTCELL39:IMUX_C1
Q0P_HALMSTREQDES108inputTCELL39:IMUX_A5
Q0P_HALMSTREQDES109inputTCELL39:IMUX_A4
Q0P_HALMSTREQDES11inputTCELL43:IMUX_C3
Q0P_HALMSTREQDES110inputTCELL39:IMUX_C3
Q0P_HALMSTREQDES111inputTCELL39:IMUX_A3
Q0P_HALMSTREQDES112inputTCELL39:IMUX_A2
Q0P_HALMSTREQDES113inputTCELL39:IMUX_A1
Q0P_HALMSTREQDES114inputTCELL39:IMUX_B0
Q0P_HALMSTREQDES115inputTCELL39:IMUX_C2
Q0P_HALMSTREQDES116inputTCELL39:IMUX_A0
Q0P_HALMSTREQDES117inputTCELL38:IMUX_D5
Q0P_HALMSTREQDES118inputTCELL38:IMUX_D4
Q0P_HALMSTREQDES119inputTCELL38:IMUX_D3
Q0P_HALMSTREQDES12inputTCELL43:IMUX_B4
Q0P_HALMSTREQDES120inputTCELL38:IMUX_D2
Q0P_HALMSTREQDES121inputTCELL38:IMUX_D0
Q0P_HALMSTREQDES122inputTCELL38:IMUX_C5
Q0P_HALMSTREQDES123inputTCELL38:IMUX_C3
Q0P_HALMSTREQDES124inputTCELL38:IMUX_C2
Q0P_HALMSTREQDES125inputTCELL38:IMUX_C4
Q0P_HALMSTREQDES126inputTCELL39:IMUX_C0
Q0P_HALMSTREQDES127inputTCELL41:IMUX_A4
Q0P_HALMSTREQDES13inputTCELL44:IMUX_B3
Q0P_HALMSTREQDES14inputTCELL44:IMUX_B2
Q0P_HALMSTREQDES15inputTCELL44:IMUX_A0
Q0P_HALMSTREQDES16inputTCELL43:IMUX_C4
Q0P_HALMSTREQDES17inputTCELL43:IMUX_B1
Q0P_HALMSTREQDES18inputTCELL43:IMUX_D2
Q0P_HALMSTREQDES19inputTCELL43:IMUX_A4
Q0P_HALMSTREQDES2inputTCELL43:IMUX_D5
Q0P_HALMSTREQDES20inputTCELL43:IMUX_A1
Q0P_HALMSTREQDES21inputTCELL43:IMUX_B2
Q0P_HALMSTREQDES22inputTCELL43:IMUX_B3
Q0P_HALMSTREQDES23inputTCELL42:IMUX_D3
Q0P_HALMSTREQDES24inputTCELL44:IMUX_D2
Q0P_HALMSTREQDES25inputTCELL44:IMUX_C3
Q0P_HALMSTREQDES26inputTCELL44:IMUX_D4
Q0P_HALMSTREQDES27inputTCELL44:IMUX_D1
Q0P_HALMSTREQDES28inputTCELL44:IMUX_C4
Q0P_HALMSTREQDES29inputTCELL44:IMUX_D0
Q0P_HALMSTREQDES3inputTCELL43:IMUX_D4
Q0P_HALMSTREQDES30inputTCELL44:IMUX_C5
Q0P_HALMSTREQDES31inputTCELL44:IMUX_B1
Q0P_HALMSTREQDES32inputTCELL44:IMUX_A3
Q0P_HALMSTREQDES33inputTCELL44:IMUX_A1
Q0P_HALMSTREQDES34inputTCELL43:IMUX_C0
Q0P_HALMSTREQDES35inputTCELL43:IMUX_C5
Q0P_HALMSTREQDES36inputTCELL43:IMUX_A2
Q0P_HALMSTREQDES37inputTCELL42:IMUX_D4
Q0P_HALMSTREQDES38inputTCELL43:IMUX_A0
Q0P_HALMSTREQDES39inputTCELL42:IMUX_D2
Q0P_HALMSTREQDES4inputTCELL43:IMUX_D3
Q0P_HALMSTREQDES40inputTCELL42:IMUX_D0
Q0P_HALMSTREQDES41inputTCELL42:IMUX_D5
Q0P_HALMSTREQDES42inputTCELL42:IMUX_C4
Q0P_HALMSTREQDES43inputTCELL42:IMUX_C3
Q0P_HALMSTREQDES44inputTCELL42:IMUX_C5
Q0P_HALMSTREQDES45inputTCELL42:IMUX_C2
Q0P_HALMSTREQDES46inputTCELL42:IMUX_B2
Q0P_HALMSTREQDES47inputTCELL42:IMUX_B3
Q0P_HALMSTREQDES48inputTCELL42:IMUX_C1
Q0P_HALMSTREQDES49inputTCELL42:IMUX_C0
Q0P_HALMSTREQDES5inputTCELL43:IMUX_D1
Q0P_HALMSTREQDES50inputTCELL42:IMUX_B1
Q0P_HALMSTREQDES51inputTCELL42:IMUX_B4
Q0P_HALMSTREQDES52inputTCELL42:IMUX_B5
Q0P_HALMSTREQDES53inputTCELL42:IMUX_B0
Q0P_HALMSTREQDES54inputTCELL42:IMUX_A3
Q0P_HALMSTREQDES55inputTCELL42:IMUX_A4
Q0P_HALMSTREQDES56inputTCELL42:IMUX_A1
Q0P_HALMSTREQDES57inputTCELL41:IMUX_D0
Q0P_HALMSTREQDES58inputTCELL41:IMUX_D1
Q0P_HALMSTREQDES59inputTCELL42:IMUX_A0
Q0P_HALMSTREQDES6inputTCELL43:IMUX_D0
Q0P_HALMSTREQDES60inputTCELL41:IMUX_D2
Q0P_HALMSTREQDES61inputTCELL41:IMUX_D3
Q0P_HALMSTREQDES62inputTCELL41:IMUX_C4
Q0P_HALMSTREQDES63inputTCELL41:IMUX_C3
Q0P_HALMSTREQDES64inputTCELL41:IMUX_C0
Q0P_HALMSTREQDES65inputTCELL41:IMUX_C1
Q0P_HALMSTREQDES66inputTCELL41:IMUX_C5
Q0P_HALMSTREQDES67inputTCELL42:IMUX_A5
Q0P_HALMSTREQDES68inputTCELL41:IMUX_D5
Q0P_HALMSTREQDES69inputTCELL41:IMUX_D4
Q0P_HALMSTREQDES7inputTCELL42:IMUX_D1
Q0P_HALMSTREQDES70inputTCELL41:IMUX_B3
Q0P_HALMSTREQDES71inputTCELL41:IMUX_B0
Q0P_HALMSTREQDES72inputTCELL41:IMUX_A3
Q0P_HALMSTREQDES73inputTCELL42:IMUX_A2
Q0P_HALMSTREQDES74inputTCELL41:IMUX_A2
Q0P_HALMSTREQDES75inputTCELL41:IMUX_A1
Q0P_HALMSTREQDES76inputTCELL41:IMUX_B5
Q0P_HALMSTREQDES77inputTCELL41:IMUX_B1
Q0P_HALMSTREQDES78inputTCELL41:IMUX_C2
Q0P_HALMSTREQDES79inputTCELL40:IMUX_D5
Q0P_HALMSTREQDES8inputTCELL43:IMUX_B0
Q0P_HALMSTREQDES80inputTCELL41:IMUX_B2
Q0P_HALMSTREQDES81inputTCELL40:IMUX_D4
Q0P_HALMSTREQDES82inputTCELL40:IMUX_D3
Q0P_HALMSTREQDES83inputTCELL40:IMUX_D2
Q0P_HALMSTREQDES84inputTCELL40:IMUX_C2
Q0P_HALMSTREQDES85inputTCELL40:IMUX_B5
Q0P_HALMSTREQDES86inputTCELL45:IMUX_A4
Q0P_HALMSTREQDES87inputTCELL40:IMUX_B4
Q0P_HALMSTREQDES88inputTCELL40:IMUX_B3
Q0P_HALMSTREQDES89inputTCELL40:IMUX_B2
Q0P_HALMSTREQDES9inputTCELL43:IMUX_A3
Q0P_HALMSTREQDES90inputTCELL40:IMUX_A5
Q0P_HALMSTREQDES91inputTCELL40:IMUX_A4
Q0P_HALMSTREQDES92inputTCELL40:IMUX_A3
Q0P_HALMSTREQDES93inputTCELL40:IMUX_A2
Q0P_HALMSTREQDES94inputTCELL39:IMUX_D5
Q0P_HALMSTREQDES95inputTCELL39:IMUX_D4
Q0P_HALMSTREQDES96inputTCELL39:IMUX_D3
Q0P_HALMSTREQDES97inputTCELL39:IMUX_D2
Q0P_HALMSTREQDES98inputTCELL39:IMUX_D1
Q0P_HALMSTREQDES99inputTCELL39:IMUX_D0
Q0P_HALMSTREQTPHPRESENTinputTCELL47:IMUX_C7
Q0P_HALMSTREQTPHSTTAG0inputTCELL48:IMUX_C4
Q0P_HALMSTREQTPHSTTAG1inputTCELL48:IMUX_A7
Q0P_HALMSTREQTPHSTTAG2inputTCELL48:IMUX_A5
Q0P_HALMSTREQTPHSTTAG3inputTCELL48:IMUX_B7
Q0P_HALMSTREQTPHSTTAG4inputTCELL48:IMUX_A4
Q0P_HALMSTREQTPHSTTAG5inputTCELL48:IMUX_C5
Q0P_HALMSTREQTPHSTTAG6inputTCELL48:IMUX_B3
Q0P_HALMSTREQTPHSTTAG7inputTCELL48:IMUX_B5
Q0P_HALMSTREQTPHTYPE0inputTCELL47:IMUX_D6
Q0P_HALMSTREQTPHTYPE1inputTCELL47:IMUX_D4
Q0P_HALMSTRERRoutputTCELL44:OUT_F4
Q0P_HALMSTTAG0outputTCELL42:OUT_F6
Q0P_HALMSTTAG1outputTCELL42:OUT_F3
Q0P_HALMSTTAG2outputTCELL42:OUT_F1
Q0P_HALMSTTAG3outputTCELL42:OUT_F4
Q0P_HALMSTTAG4outputTCELL42:OUT_F5
Q0P_HALMSTWBVLD0inputTCELL44:IMUX_A4
Q0P_HALMSTWBVLD1inputTCELL43:IMUX_A5
Q0P_HALMSTWBVLD2inputTCELL43:IMUX_B5
Q0P_HALMSTWBVLD3inputTCELL44:IMUX_C1
Q0P_HALMSTWBVLD4inputTCELL44:IMUX_C2
Q0P_HALMSTWBVLD5inputTCELL44:IMUX_D3
Q0P_HALMSTWBVLD6inputTCELL44:IMUX_B5
Q0P_HALMSTWBVLD7inputTCELL44:IMUX_C0
Q0P_HALMSTWDATVLDinputTCELL44:IMUX_A5
Q0P_HALMSTWEOPinputTCELL44:IMUX_A2
Q0P_HALMSTWERRinputTCELL44:IMUX_B4
Q0P_HALMSTWRDYoutputTCELL30:OUT_F0
Q0P_HALTGTACKinputTCELL38:IMUX_B5
Q0P_HALTGTCAREQDES0inputTCELL38:IMUX_C1
Q0P_HALTGTCAREQDES1inputTCELL38:IMUX_B4
Q0P_HALTGTCAREQDES10inputTCELL38:IMUX_A1
Q0P_HALTGTCAREQDES100inputTCELL35:IMUX_D1
Q0P_HALTGTCAREQDES101inputTCELL36:IMUX_A1
Q0P_HALTGTCAREQDES102inputTCELL36:IMUX_C1
Q0P_HALTGTCAREQDES103inputTCELL36:IMUX_C2
Q0P_HALTGTCAREQDES104inputTCELL33:IMUX_B4
Q0P_HALTGTCAREQDES105inputTCELL33:IMUX_B3
Q0P_HALTGTCAREQDES106inputTCELL33:IMUX_B2
Q0P_HALTGTCAREQDES107inputTCELL46:IMUX_A2
Q0P_HALTGTCAREQDES108inputTCELL45:IMUX_A5
Q0P_HALTGTCAREQDES109inputTCELL45:IMUX_D5
Q0P_HALTGTCAREQDES11inputTCELL38:IMUX_A0
Q0P_HALTGTCAREQDES110inputTCELL45:IMUX_B0
Q0P_HALTGTCAREQDES111inputTCELL45:IMUX_D4
Q0P_HALTGTCAREQDES112inputTCELL45:IMUX_B1
Q0P_HALTGTCAREQDES113inputTCELL45:IMUX_B2
Q0P_HALTGTCAREQDES114inputTCELL45:IMUX_D3
Q0P_HALTGTCAREQDES115inputTCELL45:IMUX_D2
Q0P_HALTGTCAREQDES116inputTCELL45:IMUX_B3
Q0P_HALTGTCAREQDES117inputTCELL45:IMUX_D1
Q0P_HALTGTCAREQDES118inputTCELL45:IMUX_B4
Q0P_HALTGTCAREQDES119inputTCELL45:IMUX_D0
Q0P_HALTGTCAREQDES12inputTCELL37:IMUX_D3
Q0P_HALTGTCAREQDES120inputTCELL38:IMUX_D1
Q0P_HALTGTCAREQDES121inputTCELL33:IMUX_D5
Q0P_HALTGTCAREQDES122inputTCELL45:IMUX_C5
Q0P_HALTGTCAREQDES123inputTCELL45:IMUX_C4
Q0P_HALTGTCAREQDES124inputTCELL45:IMUX_B5
Q0P_HALTGTCAREQDES125inputTCELL45:IMUX_C3
Q0P_HALTGTCAREQDES126inputTCELL45:IMUX_C0
Q0P_HALTGTCAREQDES127inputTCELL45:IMUX_C2
Q0P_HALTGTCAREQDES13inputTCELL37:IMUX_D2
Q0P_HALTGTCAREQDES14inputTCELL37:IMUX_D1
Q0P_HALTGTCAREQDES15inputTCELL37:IMUX_D0
Q0P_HALTGTCAREQDES16inputTCELL37:IMUX_C3
Q0P_HALTGTCAREQDES17inputTCELL37:IMUX_C2
Q0P_HALTGTCAREQDES18inputTCELL37:IMUX_C1
Q0P_HALTGTCAREQDES19inputTCELL37:IMUX_C0
Q0P_HALTGTCAREQDES2inputTCELL38:IMUX_B3
Q0P_HALTGTCAREQDES20inputTCELL37:IMUX_B3
Q0P_HALTGTCAREQDES21inputTCELL37:IMUX_B2
Q0P_HALTGTCAREQDES22inputTCELL37:IMUX_B1
Q0P_HALTGTCAREQDES23inputTCELL37:IMUX_B0
Q0P_HALTGTCAREQDES24inputTCELL37:IMUX_A3
Q0P_HALTGTCAREQDES25inputTCELL37:IMUX_A2
Q0P_HALTGTCAREQDES26inputTCELL37:IMUX_A1
Q0P_HALTGTCAREQDES27inputTCELL37:IMUX_A0
Q0P_HALTGTCAREQDES28inputTCELL36:IMUX_D5
Q0P_HALTGTCAREQDES29inputTCELL36:IMUX_D4
Q0P_HALTGTCAREQDES3inputTCELL38:IMUX_B2
Q0P_HALTGTCAREQDES30inputTCELL36:IMUX_D3
Q0P_HALTGTCAREQDES31inputTCELL36:IMUX_D2
Q0P_HALTGTCAREQDES32inputTCELL36:IMUX_D1
Q0P_HALTGTCAREQDES33inputTCELL36:IMUX_D0
Q0P_HALTGTCAREQDES34inputTCELL36:IMUX_C5
Q0P_HALTGTCAREQDES35inputTCELL36:IMUX_C4
Q0P_HALTGTCAREQDES36inputTCELL36:IMUX_C3
Q0P_HALTGTCAREQDES37inputTCELL36:IMUX_C0
Q0P_HALTGTCAREQDES38inputTCELL36:IMUX_B5
Q0P_HALTGTCAREQDES39inputTCELL36:IMUX_B4
Q0P_HALTGTCAREQDES4inputTCELL38:IMUX_B1
Q0P_HALTGTCAREQDES40inputTCELL36:IMUX_B3
Q0P_HALTGTCAREQDES41inputTCELL36:IMUX_B2
Q0P_HALTGTCAREQDES42inputTCELL36:IMUX_B1
Q0P_HALTGTCAREQDES43inputTCELL36:IMUX_B0
Q0P_HALTGTCAREQDES44inputTCELL36:IMUX_A5
Q0P_HALTGTCAREQDES45inputTCELL36:IMUX_A4
Q0P_HALTGTCAREQDES46inputTCELL36:IMUX_A3
Q0P_HALTGTCAREQDES47inputTCELL36:IMUX_A2
Q0P_HALTGTCAREQDES48inputTCELL35:IMUX_D5
Q0P_HALTGTCAREQDES49inputTCELL35:IMUX_D4
Q0P_HALTGTCAREQDES5inputTCELL38:IMUX_B0
Q0P_HALTGTCAREQDES50inputTCELL35:IMUX_D3
Q0P_HALTGTCAREQDES51inputTCELL35:IMUX_D2
Q0P_HALTGTCAREQDES52inputTCELL35:IMUX_D0
Q0P_HALTGTCAREQDES53inputTCELL35:IMUX_C5
Q0P_HALTGTCAREQDES54inputTCELL35:IMUX_C4
Q0P_HALTGTCAREQDES55inputTCELL35:IMUX_C3
Q0P_HALTGTCAREQDES56inputTCELL35:IMUX_C2
Q0P_HALTGTCAREQDES57inputTCELL35:IMUX_C1
Q0P_HALTGTCAREQDES58inputTCELL35:IMUX_C0
Q0P_HALTGTCAREQDES59inputTCELL35:IMUX_B5
Q0P_HALTGTCAREQDES6inputTCELL38:IMUX_A5
Q0P_HALTGTCAREQDES60inputTCELL35:IMUX_B3
Q0P_HALTGTCAREQDES61inputTCELL35:IMUX_B2
Q0P_HALTGTCAREQDES62inputTCELL35:IMUX_B0
Q0P_HALTGTCAREQDES63inputTCELL35:IMUX_A5
Q0P_HALTGTCAREQDES64inputTCELL35:IMUX_A4
Q0P_HALTGTCAREQDES65inputTCELL35:IMUX_A3
Q0P_HALTGTCAREQDES66inputTCELL35:IMUX_A2
Q0P_HALTGTCAREQDES67inputTCELL35:IMUX_A1
Q0P_HALTGTCAREQDES68inputTCELL34:IMUX_D5
Q0P_HALTGTCAREQDES69inputTCELL34:IMUX_D4
Q0P_HALTGTCAREQDES7inputTCELL38:IMUX_A4
Q0P_HALTGTCAREQDES70inputTCELL34:IMUX_D3
Q0P_HALTGTCAREQDES71inputTCELL34:IMUX_D2
Q0P_HALTGTCAREQDES72inputTCELL34:IMUX_C5
Q0P_HALTGTCAREQDES73inputTCELL34:IMUX_C4
Q0P_HALTGTCAREQDES74inputTCELL34:IMUX_B5
Q0P_HALTGTCAREQDES75inputTCELL34:IMUX_B4
Q0P_HALTGTCAREQDES76inputTCELL34:IMUX_B3
Q0P_HALTGTCAREQDES77inputTCELL34:IMUX_B2
Q0P_HALTGTCAREQDES78inputTCELL34:IMUX_A5
Q0P_HALTGTCAREQDES79inputTCELL34:IMUX_A4
Q0P_HALTGTCAREQDES8inputTCELL38:IMUX_A3
Q0P_HALTGTCAREQDES80inputTCELL34:IMUX_A3
Q0P_HALTGTCAREQDES81inputTCELL36:IMUX_A0
Q0P_HALTGTCAREQDES82inputTCELL35:IMUX_A0
Q0P_HALTGTCAREQDES83inputTCELL35:IMUX_B1
Q0P_HALTGTCAREQDES84inputTCELL34:IMUX_A2
Q0P_HALTGTCAREQDES85inputTCELL33:IMUX_D4
Q0P_HALTGTCAREQDES86inputTCELL34:IMUX_C3
Q0P_HALTGTCAREQDES87inputTCELL33:IMUX_D3
Q0P_HALTGTCAREQDES88inputTCELL33:IMUX_D2
Q0P_HALTGTCAREQDES89inputTCELL33:IMUX_D1
Q0P_HALTGTCAREQDES9inputTCELL38:IMUX_A2
Q0P_HALTGTCAREQDES90inputTCELL33:IMUX_D0
Q0P_HALTGTCAREQDES91inputTCELL33:IMUX_C5
Q0P_HALTGTCAREQDES92inputTCELL33:IMUX_C4
Q0P_HALTGTCAREQDES93inputTCELL33:IMUX_C3
Q0P_HALTGTCAREQDES94inputTCELL33:IMUX_C2
Q0P_HALTGTCAREQDES95inputTCELL35:IMUX_B4
Q0P_HALTGTCAREQDES96inputTCELL33:IMUX_C1
Q0P_HALTGTCAREQDES97inputTCELL33:IMUX_C0
Q0P_HALTGTCAREQDES98inputTCELL33:IMUX_B5
Q0P_HALTGTCAREQDES99inputTCELL34:IMUX_C2
Q0P_HALTGTCLNTCOMPID0inputTCELL33:IMUX_B1
Q0P_HALTGTCLNTCOMPID1inputTCELL33:IMUX_B0
Q0P_HALTGTCLNTCOMPID10inputTCELL32:IMUX_D3
Q0P_HALTGTCLNTCOMPID11inputTCELL32:IMUX_D2
Q0P_HALTGTCLNTCOMPID12inputTCELL32:IMUX_D1
Q0P_HALTGTCLNTCOMPID13inputTCELL32:IMUX_D0
Q0P_HALTGTCLNTCOMPID14inputTCELL32:IMUX_C5
Q0P_HALTGTCLNTCOMPID15inputTCELL32:IMUX_C4
Q0P_HALTGTCLNTCOMPID2inputTCELL33:IMUX_A5
Q0P_HALTGTCLNTCOMPID3inputTCELL33:IMUX_A4
Q0P_HALTGTCLNTCOMPID4inputTCELL33:IMUX_A3
Q0P_HALTGTCLNTCOMPID5inputTCELL33:IMUX_A2
Q0P_HALTGTCLNTCOMPID6inputTCELL33:IMUX_A1
Q0P_HALTGTCLNTCOMPID7inputTCELL33:IMUX_A0
Q0P_HALTGTCLNTCOMPID8inputTCELL32:IMUX_D5
Q0P_HALTGTCLNTCOMPID9inputTCELL32:IMUX_D4
Q0P_HALTGTCLNTCOMPIDENinputTCELL28:IMUX_C0
Q0P_HALTGTCOMPBVLD0inputTCELL32:IMUX_C3
Q0P_HALTGTCOMPBVLD1inputTCELL32:IMUX_C2
Q0P_HALTGTCOMPBVLD2inputTCELL32:IMUX_C1
Q0P_HALTGTCOMPBVLD3inputTCELL32:IMUX_C0
Q0P_HALTGTCOMPBVLD4inputTCELL32:IMUX_B5
Q0P_HALTGTCOMPBVLD5inputTCELL32:IMUX_B4
Q0P_HALTGTCOMPBVLD6inputTCELL32:IMUX_B3
Q0P_HALTGTCOMPBVLD7inputTCELL32:IMUX_B2
Q0P_HALTGTCOMPDES0inputTCELL32:IMUX_B1
Q0P_HALTGTCOMPDES1inputTCELL32:IMUX_B0
Q0P_HALTGTCOMPDES10inputTCELL27:IMUX_A1
Q0P_HALTGTCOMPDES100inputTCELL29:IMUX_A5
Q0P_HALTGTCOMPDES101inputTCELL29:IMUX_A0
Q0P_HALTGTCOMPDES102inputTCELL28:IMUX_C4
Q0P_HALTGTCOMPDES103inputTCELL28:IMUX_D2
Q0P_HALTGTCOMPDES104inputTCELL29:IMUX_C3
Q0P_HALTGTCOMPDES105inputTCELL29:IMUX_C5
Q0P_HALTGTCOMPDES106inputTCELL30:IMUX_C0
Q0P_HALTGTCOMPDES107inputTCELL29:IMUX_D1
Q0P_HALTGTCOMPDES108inputTCELL29:IMUX_B2
Q0P_HALTGTCOMPDES109inputTCELL30:IMUX_B2
Q0P_HALTGTCOMPDES11inputTCELL27:IMUX_A2
Q0P_HALTGTCOMPDES110inputTCELL30:IMUX_B5
Q0P_HALTGTCOMPDES111inputTCELL30:IMUX_B3
Q0P_HALTGTCOMPDES112inputTCELL30:IMUX_A5
Q0P_HALTGTCOMPDES113inputTCELL30:IMUX_A0
Q0P_HALTGTCOMPDES114inputTCELL30:IMUX_A1
Q0P_HALTGTCOMPDES115inputTCELL29:IMUX_C1
Q0P_HALTGTCOMPDES116inputTCELL29:IMUX_C0
Q0P_HALTGTCOMPDES117inputTCELL30:IMUX_A3
Q0P_HALTGTCOMPDES118inputTCELL29:IMUX_B5
Q0P_HALTGTCOMPDES119inputTCELL45:IMUX_C1
Q0P_HALTGTCOMPDES12inputTCELL31:IMUX_D4
Q0P_HALTGTCOMPDES120inputTCELL29:IMUX_D2
Q0P_HALTGTCOMPDES121inputTCELL28:IMUX_C1
Q0P_HALTGTCOMPDES122inputTCELL29:IMUX_B1
Q0P_HALTGTCOMPDES123inputTCELL29:IMUX_B3
Q0P_HALTGTCOMPDES124inputTCELL29:IMUX_B4
Q0P_HALTGTCOMPDES125inputTCELL28:IMUX_D3
Q0P_HALTGTCOMPDES126inputTCELL28:IMUX_D5
Q0P_HALTGTCOMPDES127inputTCELL27:IMUX_D5
Q0P_HALTGTCOMPDES13inputTCELL27:IMUX_A3
Q0P_HALTGTCOMPDES14inputTCELL27:IMUX_A4
Q0P_HALTGTCOMPDES15inputTCELL31:IMUX_D3
Q0P_HALTGTCOMPDES16inputTCELL27:IMUX_A5
Q0P_HALTGTCOMPDES17inputTCELL27:IMUX_B0
Q0P_HALTGTCOMPDES18inputTCELL31:IMUX_D2
Q0P_HALTGTCOMPDES19inputTCELL31:IMUX_D1
Q0P_HALTGTCOMPDES2inputTCELL32:IMUX_A5
Q0P_HALTGTCOMPDES20inputTCELL31:IMUX_D0
Q0P_HALTGTCOMPDES21inputTCELL31:IMUX_C4
Q0P_HALTGTCOMPDES22inputTCELL27:IMUX_B1
Q0P_HALTGTCOMPDES23inputTCELL27:IMUX_B2
Q0P_HALTGTCOMPDES24inputTCELL27:IMUX_B3
Q0P_HALTGTCOMPDES25inputTCELL27:IMUX_B4
Q0P_HALTGTCOMPDES26inputTCELL27:IMUX_B5
Q0P_HALTGTCOMPDES27inputTCELL27:IMUX_C0
Q0P_HALTGTCOMPDES28inputTCELL27:IMUX_C1
Q0P_HALTGTCOMPDES29inputTCELL27:IMUX_C2
Q0P_HALTGTCOMPDES3inputTCELL32:IMUX_A4
Q0P_HALTGTCOMPDES30inputTCELL27:IMUX_C3
Q0P_HALTGTCOMPDES31inputTCELL27:IMUX_C4
Q0P_HALTGTCOMPDES32inputTCELL27:IMUX_C5
Q0P_HALTGTCOMPDES33inputTCELL27:IMUX_D0
Q0P_HALTGTCOMPDES34inputTCELL31:IMUX_C3
Q0P_HALTGTCOMPDES35inputTCELL31:IMUX_C2
Q0P_HALTGTCOMPDES36inputTCELL31:IMUX_C1
Q0P_HALTGTCOMPDES37inputTCELL31:IMUX_C0
Q0P_HALTGTCOMPDES38inputTCELL31:IMUX_B5
Q0P_HALTGTCOMPDES39inputTCELL31:IMUX_B4
Q0P_HALTGTCOMPDES4inputTCELL32:IMUX_A3
Q0P_HALTGTCOMPDES40inputTCELL31:IMUX_B3
Q0P_HALTGTCOMPDES41inputTCELL31:IMUX_B2
Q0P_HALTGTCOMPDES42inputTCELL31:IMUX_B1
Q0P_HALTGTCOMPDES43inputTCELL31:IMUX_B0
Q0P_HALTGTCOMPDES44inputTCELL31:IMUX_A5
Q0P_HALTGTCOMPDES45inputTCELL31:IMUX_A4
Q0P_HALTGTCOMPDES46inputTCELL31:IMUX_A3
Q0P_HALTGTCOMPDES47inputTCELL31:IMUX_A2
Q0P_HALTGTCOMPDES48inputTCELL31:IMUX_A1
Q0P_HALTGTCOMPDES49inputTCELL31:IMUX_A0
Q0P_HALTGTCOMPDES5inputTCELL32:IMUX_A2
Q0P_HALTGTCOMPDES50inputTCELL30:IMUX_D5
Q0P_HALTGTCOMPDES51inputTCELL30:IMUX_D4
Q0P_HALTGTCOMPDES52inputTCELL30:IMUX_D3
Q0P_HALTGTCOMPDES53inputTCELL30:IMUX_D2
Q0P_HALTGTCOMPDES54inputTCELL30:IMUX_D1
Q0P_HALTGTCOMPDES55inputTCELL30:IMUX_D0
Q0P_HALTGTCOMPDES56inputTCELL30:IMUX_C5
Q0P_HALTGTCOMPDES57inputTCELL30:IMUX_C4
Q0P_HALTGTCOMPDES58inputTCELL30:IMUX_C3
Q0P_HALTGTCOMPDES59inputTCELL27:IMUX_D1
Q0P_HALTGTCOMPDES6inputTCELL32:IMUX_A1
Q0P_HALTGTCOMPDES60inputTCELL30:IMUX_C2
Q0P_HALTGTCOMPDES61inputTCELL27:IMUX_D2
Q0P_HALTGTCOMPDES62inputTCELL27:IMUX_D3
Q0P_HALTGTCOMPDES63inputTCELL27:IMUX_D4
Q0P_HALTGTCOMPDES64inputTCELL28:IMUX_A0
Q0P_HALTGTCOMPDES65inputTCELL28:IMUX_A1
Q0P_HALTGTCOMPDES66inputTCELL28:IMUX_A2
Q0P_HALTGTCOMPDES67inputTCELL28:IMUX_A3
Q0P_HALTGTCOMPDES68inputTCELL31:IMUX_C5
Q0P_HALTGTCOMPDES69inputTCELL28:IMUX_A4
Q0P_HALTGTCOMPDES7inputTCELL32:IMUX_A0
Q0P_HALTGTCOMPDES70inputTCELL30:IMUX_C1
Q0P_HALTGTCOMPDES71inputTCELL28:IMUX_A5
Q0P_HALTGTCOMPDES72inputTCELL28:IMUX_B0
Q0P_HALTGTCOMPDES73inputTCELL28:IMUX_B1
Q0P_HALTGTCOMPDES74inputTCELL28:IMUX_B2
Q0P_HALTGTCOMPDES75inputTCELL30:IMUX_B4
Q0P_HALTGTCOMPDES76inputTCELL30:IMUX_B1
Q0P_HALTGTCOMPDES77inputTCELL28:IMUX_B3
Q0P_HALTGTCOMPDES78inputTCELL28:IMUX_B4
Q0P_HALTGTCOMPDES79inputTCELL28:IMUX_B5
Q0P_HALTGTCOMPDES8inputTCELL31:IMUX_D5
Q0P_HALTGTCOMPDES80inputTCELL28:IMUX_C2
Q0P_HALTGTCOMPDES81inputTCELL28:IMUX_C3
Q0P_HALTGTCOMPDES82inputTCELL30:IMUX_B0
Q0P_HALTGTCOMPDES83inputTCELL29:IMUX_D0
Q0P_HALTGTCOMPDES84inputTCELL29:IMUX_C4
Q0P_HALTGTCOMPDES85inputTCELL29:IMUX_A2
Q0P_HALTGTCOMPDES86inputTCELL29:IMUX_A1
Q0P_HALTGTCOMPDES87inputTCELL29:IMUX_D4
Q0P_HALTGTCOMPDES88inputTCELL30:IMUX_A2
Q0P_HALTGTCOMPDES89inputTCELL29:IMUX_D3
Q0P_HALTGTCOMPDES9inputTCELL27:IMUX_A0
Q0P_HALTGTCOMPDES90inputTCELL29:IMUX_A3
Q0P_HALTGTCOMPDES91inputTCELL29:IMUX_D5
Q0P_HALTGTCOMPDES92inputTCELL29:IMUX_A4
Q0P_HALTGTCOMPDES93inputTCELL29:IMUX_C2
Q0P_HALTGTCOMPDES94inputTCELL28:IMUX_D0
Q0P_HALTGTCOMPDES95inputTCELL28:IMUX_C5
Q0P_HALTGTCOMPDES96inputTCELL28:IMUX_D4
Q0P_HALTGTCOMPDES97inputTCELL30:IMUX_A4
Q0P_HALTGTCOMPDES98inputTCELL29:IMUX_B0
Q0P_HALTGTCOMPDES99inputTCELL28:IMUX_D1
Q0P_HALTGTCOMPEOPinputTCELL41:IMUX_A0
Q0P_HALTGTCOMPERRinputTCELL40:IMUX_C3
Q0P_HALTGTCOMPRDYoutputTCELL18:OUT_F4
Q0P_HALTGTCOMPSOPinputTCELL40:IMUX_C5
Q0P_HALTGTCOMPVLDinputTCELL40:IMUX_C4
Q0P_HALTGTNPREJinputTCELL41:IMUX_B4
Q0P_HALTGTREQoutputTCELL22:OUT_F0
Q0P_HALTGTREQDES0outputTCELL19:OUT_Q0
Q0P_HALTGTREQDES1outputTCELL19:OUT_F5
Q0P_HALTGTREQDES10outputTCELL18:OUT_Q4
Q0P_HALTGTREQDES100outputTCELL28:OUT_Q3
Q0P_HALTGTREQDES101outputTCELL27:OUT_F4
Q0P_HALTGTREQDES102outputTCELL23:OUT_Q0
Q0P_HALTGTREQDES103outputTCELL22:OUT_Q0
Q0P_HALTGTREQDES104outputTCELL23:OUT_F1
Q0P_HALTGTREQDES105outputTCELL22:OUT_Q4
Q0P_HALTGTREQDES106outputTCELL27:OUT_Q6
Q0P_HALTGTREQDES107outputTCELL45:OUT_F2
Q0P_HALTGTREQDES108outputTCELL45:OUT_F0
Q0P_HALTGTREQDES109outputTCELL28:OUT_F2
Q0P_HALTGTREQDES11outputTCELL18:OUT_Q3
Q0P_HALTGTREQDES110outputTCELL27:OUT_Q2
Q0P_HALTGTREQDES111outputTCELL24:OUT_Q4
Q0P_HALTGTREQDES112outputTCELL45:OUT_F1
Q0P_HALTGTREQDES113outputTCELL44:OUT_Q6
Q0P_HALTGTREQDES114outputTCELL44:OUT_Q5
Q0P_HALTGTREQDES115outputTCELL44:OUT_Q7
Q0P_HALTGTREQDES116outputTCELL44:OUT_Q4
Q0P_HALTGTREQDES117outputTCELL44:OUT_Q3
Q0P_HALTGTREQDES118outputTCELL44:OUT_Q1
Q0P_HALTGTREQDES119outputTCELL44:OUT_Q2
Q0P_HALTGTREQDES12outputTCELL18:OUT_Q2
Q0P_HALTGTREQDES120outputTCELL22:OUT_F7
Q0P_HALTGTREQDES121outputTCELL28:OUT_Q1
Q0P_HALTGTREQDES122outputTCELL29:OUT_Q5
Q0P_HALTGTREQDES123outputTCELL29:OUT_Q0
Q0P_HALTGTREQDES124outputTCELL23:OUT_F5
Q0P_HALTGTREQDES125outputTCELL27:OUT_F3
Q0P_HALTGTREQDES126outputTCELL22:OUT_F3
Q0P_HALTGTREQDES127outputTCELL23:OUT_Q4
Q0P_HALTGTREQDES13outputTCELL18:OUT_Q1
Q0P_HALTGTREQDES14outputTCELL18:OUT_Q0
Q0P_HALTGTREQDES15outputTCELL18:OUT_Q5
Q0P_HALTGTREQDES16outputTCELL19:OUT_Q1
Q0P_HALTGTREQDES17outputTCELL18:OUT_F7
Q0P_HALTGTREQDES18outputTCELL18:OUT_F6
Q0P_HALTGTREQDES19outputTCELL18:OUT_F5
Q0P_HALTGTREQDES2outputTCELL19:OUT_F4
Q0P_HALTGTREQDES20outputTCELL27:OUT_F0
Q0P_HALTGTREQDES21outputTCELL23:OUT_Q6
Q0P_HALTGTREQDES22outputTCELL24:OUT_F6
Q0P_HALTGTREQDES23outputTCELL23:OUT_Q7
Q0P_HALTGTREQDES24outputTCELL24:OUT_F2
Q0P_HALTGTREQDES25outputTCELL24:OUT_F3
Q0P_HALTGTREQDES26outputTCELL24:OUT_F7
Q0P_HALTGTREQDES27outputTCELL29:OUT_Q4
Q0P_HALTGTREQDES28outputTCELL29:OUT_F6
Q0P_HALTGTREQDES29outputTCELL29:OUT_F7
Q0P_HALTGTREQDES3outputTCELL19:OUT_F3
Q0P_HALTGTREQDES30outputTCELL24:OUT_F0
Q0P_HALTGTREQDES31outputTCELL23:OUT_Q3
Q0P_HALTGTREQDES32outputTCELL24:OUT_Q0
Q0P_HALTGTREQDES33outputTCELL24:OUT_F1
Q0P_HALTGTREQDES34outputTCELL24:OUT_F4
Q0P_HALTGTREQDES35outputTCELL22:OUT_F5
Q0P_HALTGTREQDES36outputTCELL30:OUT_F3
Q0P_HALTGTREQDES37outputTCELL30:OUT_F6
Q0P_HALTGTREQDES38outputTCELL30:OUT_F4
Q0P_HALTGTREQDES39outputTCELL32:OUT_Q0
Q0P_HALTGTREQDES4outputTCELL19:OUT_F2
Q0P_HALTGTREQDES40outputTCELL30:OUT_F1
Q0P_HALTGTREQDES41outputTCELL23:OUT_Q2
Q0P_HALTGTREQDES42outputTCELL29:OUT_Q6
Q0P_HALTGTREQDES43outputTCELL24:OUT_Q1
Q0P_HALTGTREQDES44outputTCELL22:OUT_Q7
Q0P_HALTGTREQDES45outputTCELL29:OUT_Q3
Q0P_HALTGTREQDES46outputTCELL29:OUT_Q2
Q0P_HALTGTREQDES47outputTCELL23:OUT_F6
Q0P_HALTGTREQDES48outputTCELL24:OUT_Q2
Q0P_HALTGTREQDES49outputTCELL24:OUT_Q3
Q0P_HALTGTREQDES5outputTCELL19:OUT_F1
Q0P_HALTGTREQDES50outputTCELL29:OUT_F5
Q0P_HALTGTREQDES51outputTCELL24:OUT_F5
Q0P_HALTGTREQDES52outputTCELL23:OUT_F0
Q0P_HALTGTREQDES53outputTCELL29:OUT_F4
Q0P_HALTGTREQDES54outputTCELL23:OUT_F4
Q0P_HALTGTREQDES55outputTCELL24:OUT_Q5
Q0P_HALTGTREQDES56outputTCELL27:OUT_F7
Q0P_HALTGTREQDES57outputTCELL22:OUT_Q2
Q0P_HALTGTREQDES58outputTCELL21:OUT_Q5
Q0P_HALTGTREQDES59outputTCELL29:OUT_Q1
Q0P_HALTGTREQDES6outputTCELL19:OUT_F0
Q0P_HALTGTREQDES60outputTCELL21:OUT_Q3
Q0P_HALTGTREQDES61outputTCELL22:OUT_Q5
Q0P_HALTGTREQDES62outputTCELL23:OUT_F2
Q0P_HALTGTREQDES63outputTCELL29:OUT_F1
Q0P_HALTGTREQDES64outputTCELL29:OUT_F0
Q0P_HALTGTREQDES65outputTCELL28:OUT_Q4
Q0P_HALTGTREQDES66outputTCELL24:OUT_Q6
Q0P_HALTGTREQDES67outputTCELL28:OUT_Q2
Q0P_HALTGTREQDES68outputTCELL22:OUT_Q6
Q0P_HALTGTREQDES69outputTCELL27:OUT_Q0
Q0P_HALTGTREQDES7outputTCELL18:OUT_Q7
Q0P_HALTGTREQDES70outputTCELL27:OUT_Q5
Q0P_HALTGTREQDES71outputTCELL28:OUT_F5
Q0P_HALTGTREQDES72outputTCELL28:OUT_Q6
Q0P_HALTGTREQDES73outputTCELL27:OUT_Q4
Q0P_HALTGTREQDES74outputTCELL28:OUT_F4
Q0P_HALTGTREQDES75outputTCELL28:OUT_F1
Q0P_HALTGTREQDES76outputTCELL22:OUT_F4
Q0P_HALTGTREQDES77outputTCELL23:OUT_F7
Q0P_HALTGTREQDES78outputTCELL27:OUT_Q1
Q0P_HALTGTREQDES79outputTCELL28:OUT_Q0
Q0P_HALTGTREQDES8outputTCELL18:OUT_Q6
Q0P_HALTGTREQDES80outputTCELL27:OUT_F6
Q0P_HALTGTREQDES81outputTCELL21:OUT_Q4
Q0P_HALTGTREQDES82outputTCELL28:OUT_F0
Q0P_HALTGTREQDES83outputTCELL28:OUT_F7
Q0P_HALTGTREQDES84outputTCELL27:OUT_Q3
Q0P_HALTGTREQDES85outputTCELL28:OUT_F3
Q0P_HALTGTREQDES86outputTCELL29:OUT_F2
Q0P_HALTGTREQDES87outputTCELL27:OUT_Q7
Q0P_HALTGTREQDES88outputTCELL28:OUT_Q5
Q0P_HALTGTREQDES89outputTCELL23:OUT_F3
Q0P_HALTGTREQDES9outputTCELL21:OUT_Q0
Q0P_HALTGTREQDES90outputTCELL22:OUT_Q3
Q0P_HALTGTREQDES91outputTCELL21:OUT_Q7
Q0P_HALTGTREQDES92outputTCELL29:OUT_F3
Q0P_HALTGTREQDES93outputTCELL24:OUT_Q7
Q0P_HALTGTREQDES94outputTCELL28:OUT_Q7
Q0P_HALTGTREQDES95outputTCELL27:OUT_F2
Q0P_HALTGTREQDES96outputTCELL27:OUT_F1
Q0P_HALTGTREQDES97outputTCELL22:OUT_Q1
Q0P_HALTGTREQDES98outputTCELL28:OUT_F6
Q0P_HALTGTREQDES99outputTCELL27:OUT_F5
Q0P_HALTGTREQMBA0outputTCELL20:OUT_F4
Q0P_HALTGTREQMBA1outputTCELL20:OUT_F3
Q0P_HALTGTREQMBA2outputTCELL20:OUT_F2
Q0P_HALTGTREQMBA3outputTCELL20:OUT_F1
Q0P_HALTGTREQMBA4outputTCELL20:OUT_F0
Q0P_HALTGTREQMBA5outputTCELL19:OUT_Q5
Q0P_HALTGTREQTPHPRESENToutputTCELL18:OUT_F1
Q0P_HALTGTREQTPHSTTAG0outputTCELL20:OUT_Q6
Q0P_HALTGTREQTPHSTTAG1outputTCELL20:OUT_Q5
Q0P_HALTGTREQTPHSTTAG2outputTCELL20:OUT_Q4
Q0P_HALTGTREQTPHSTTAG3outputTCELL20:OUT_Q3
Q0P_HALTGTREQTPHSTTAG4outputTCELL20:OUT_Q2
Q0P_HALTGTREQTPHSTTAG5outputTCELL20:OUT_Q1
Q0P_HALTGTREQTPHSTTAG6outputTCELL20:OUT_Q0
Q0P_HALTGTREQTPHSTTAG7outputTCELL20:OUT_F7
Q0P_HALTGTREQTPHTYPE0outputTCELL20:OUT_F6
Q0P_HALTGTREQTPHTYPE1outputTCELL20:OUT_F5
Q0P_HALTGTWBVLD0outputTCELL21:OUT_F6
Q0P_HALTGTWBVLD1outputTCELL21:OUT_F5
Q0P_HALTGTWBVLD2outputTCELL21:OUT_F4
Q0P_HALTGTWBVLD3outputTCELL21:OUT_F3
Q0P_HALTGTWBVLD4outputTCELL21:OUT_F2
Q0P_HALTGTWBVLD5outputTCELL21:OUT_F1
Q0P_HALTGTWBVLD6outputTCELL21:OUT_F0
Q0P_HALTGTWBVLD7outputTCELL20:OUT_Q7
Q0P_HALTGTWDATVLDoutputTCELL18:OUT_F2
Q0P_HALTGTWEOPoutputTCELL18:OUT_F3
Q0P_HALTGTWRDYinputTCELL38:IMUX_C0
Q0P_HALTSTREQATTR0outputTCELL19:OUT_Q4
Q0P_HALTSTREQATTR1outputTCELL19:OUT_Q3
Q0P_HALTSTREQATTR2outputTCELL19:OUT_Q2
Q0P_HOTRSTINinputTCELL30:IMUX_LSR0
Q0P_HOTRSTOUToutputTCELL46:OUT_F5
Q0P_INTACKoutputTCELL33:OUT_Q5
Q0P_INTAIinputTCELL44:IMUX_D5
Q0P_INTAOoutputTCELL23:OUT_Q1
Q0P_INTBIinputTCELL47:IMUX_C3
Q0P_INTBOoutputTCELL23:OUT_Q5
Q0P_INTCIinputTCELL47:IMUX_C4
Q0P_INTCOoutputTCELL22:OUT_F2
Q0P_INTDIinputTCELL47:IMUX_C5
Q0P_INTDOoutputTCELL22:OUT_F6
Q0P_INTPENDSTSinputTCELL47:IMUX_C6
Q0P_LCLINToutputTCELL42:OUT_F2
Q0P_LNKDWNRSTOUToutputTCELL45:OUT_Q1
Q0P_LNKPWRSTATE0outputTCELL46:OUT_F3
Q0P_LNKPWRSTATE1outputTCELL45:OUT_Q3
Q0P_LNKPWRSTATE2outputTCELL45:OUT_F7
Q0P_LNKPWRSTATE3outputTCELL44:OUT_F7
Q0P_LNKSTS0outputTCELL43:OUT_Q6
Q0P_LNKSTS1outputTCELL45:OUT_F4
Q0P_LTSSMSTATE0outputTCELL43:OUT_Q7
Q0P_LTSSMSTATE1outputTCELL44:OUT_F1
Q0P_LTSSMSTATE2outputTCELL44:OUT_F3
Q0P_LTSSMSTATE3outputTCELL44:OUT_F6
Q0P_LTSSMSTATE4outputTCELL44:OUT_F0
Q0P_LTSSMSTATE5outputTCELL43:OUT_Q3
Q0P_MAXPYLDSIZE0outputTCELL45:OUT_F6
Q0P_MAXPYLDSIZE1outputTCELL45:OUT_Q7
Q0P_MAXPYLDSIZE2outputTCELL45:OUT_Q0
Q0P_MAXREADREQSIZE0outputTCELL41:OUT_Q6
Q0P_MAXREADREQSIZE1outputTCELL38:OUT_F2
Q0P_MAXREADREQSIZE2outputTCELL40:OUT_Q5
Q0P_MBISTCLKinputTCELL27:IMUX_CLK1_DELAY
Q0P_MBISTMODEinputTCELL27:IMUX_LSR0
Q0P_MBISTRSTNinputTCELL28:IMUX_LSR1
Q0P_MSIASRTINT0inputTCELL50:IMUX_C6
Q0P_MSIASRTINT1inputTCELL51:IMUX_B2
Q0P_MSIASRTINT10inputTCELL50:IMUX_C7
Q0P_MSIASRTINT11inputTCELL51:IMUX_A2
Q0P_MSIASRTINT12inputTCELL51:IMUX_B4
Q0P_MSIASRTINT13inputTCELL51:IMUX_A6
Q0P_MSIASRTINT14inputTCELL50:IMUX_D2
Q0P_MSIASRTINT15inputTCELL51:IMUX_A5
Q0P_MSIASRTINT16inputTCELL51:IMUX_A4
Q0P_MSIASRTINT17inputTCELL50:IMUX_D4
Q0P_MSIASRTINT18inputTCELL50:IMUX_D3
Q0P_MSIASRTINT19inputTCELL51:IMUX_D4
Q0P_MSIASRTINT2inputTCELL51:IMUX_D2
Q0P_MSIASRTINT20inputTCELL52:IMUX_A7
Q0P_MSIASRTINT21inputTCELL51:IMUX_D5
Q0P_MSIASRTINT22inputTCELL52:IMUX_A4
Q0P_MSIASRTINT23inputTCELL52:IMUX_A3
Q0P_MSIASRTINT24inputTCELL51:IMUX_C7
Q0P_MSIASRTINT25inputTCELL51:IMUX_D7
Q0P_MSIASRTINT26inputTCELL51:IMUX_C6
Q0P_MSIASRTINT27inputTCELL51:IMUX_B5
Q0P_MSIASRTINT28inputTCELL51:IMUX_B3
Q0P_MSIASRTINT29inputTCELL51:IMUX_A3
Q0P_MSIASRTINT3inputTCELL51:IMUX_C4
Q0P_MSIASRTINT30inputTCELL50:IMUX_D6
Q0P_MSIASRTINT31inputTCELL50:IMUX_D7
Q0P_MSIASRTINT4inputTCELL50:IMUX_D5
Q0P_MSIASRTINT5inputTCELL51:IMUX_C5
Q0P_MSIASRTINT6inputTCELL51:IMUX_B6
Q0P_MSIASRTINT7inputTCELL51:IMUX_C3
Q0P_MSIASRTINT8inputTCELL51:IMUX_A7
Q0P_MSIASRTINT9inputTCELL51:IMUX_C2
Q0P_MSIATTRIN0inputTCELL49:IMUX_D3
Q0P_MSIATTRIN1inputTCELL49:IMUX_D2
Q0P_MSIATTRIN2inputTCELL45:IMUX_A3
Q0P_MSIENoutputTCELL33:OUT_Q6
Q0P_MSIMSGABRToutputTCELL42:OUT_F7
Q0P_MSIMSGSENToutputTCELL42:OUT_Q2
Q0P_MSIREQTPHPRESENTinputTCELL48:IMUX_D3
Q0P_MSIREQTPHSTTAG0inputTCELL50:IMUX_B6
Q0P_MSIREQTPHSTTAG1inputTCELL48:IMUX_D2
Q0P_MSIREQTPHSTTAG2inputTCELL48:IMUX_C7
Q0P_MSIREQTPHSTTAG3inputTCELL49:IMUX_A7
Q0P_MSIREQTPHSTTAG4inputTCELL48:IMUX_D4
Q0P_MSIREQTPHSTTAG5inputTCELL50:IMUX_B2
Q0P_MSIREQTPHSTTAG6inputTCELL49:IMUX_B2
Q0P_MSIREQTPHSTTAG7inputTCELL50:IMUX_A6
Q0P_MSIREQTPHTYPE0inputTCELL49:IMUX_D4
Q0P_MSIREQTPHTYPE1inputTCELL48:IMUX_D6
Q0P_MSIVECCNT0outputTCELL33:OUT_Q3
Q0P_MSIVECCNT1outputTCELL33:OUT_F5
Q0P_MSIVECCNT2outputTCELL33:OUT_Q1
Q0P_MSIXATTRIN0inputTCELL47:IMUX_D3
Q0P_MSIXATTRIN1inputTCELL47:IMUX_D2
Q0P_MSIXATTRIN2inputTCELL46:IMUX_A4
Q0P_MSIXENoutputTCELL41:OUT_Q5
Q0P_MSIXMASKoutputTCELL40:OUT_F4
Q0P_MSIXMSGADDR0inputTCELL48:IMUX_D7
Q0P_MSIXMSGADDR1inputTCELL49:IMUX_A2
Q0P_MSIXMSGADDR10inputTCELL49:IMUX_C3
Q0P_MSIXMSGADDR11inputTCELL49:IMUX_C6
Q0P_MSIXMSGADDR12inputTCELL50:IMUX_B3
Q0P_MSIXMSGADDR13inputTCELL49:IMUX_C7
Q0P_MSIXMSGADDR14inputTCELL49:IMUX_C5
Q0P_MSIXMSGADDR15inputTCELL49:IMUX_B7
Q0P_MSIXMSGADDR16inputTCELL50:IMUX_A4
Q0P_MSIXMSGADDR17inputTCELL49:IMUX_D7
Q0P_MSIXMSGADDR18inputTCELL49:IMUX_B6
Q0P_MSIXMSGADDR19inputTCELL50:IMUX_A3
Q0P_MSIXMSGADDR2inputTCELL49:IMUX_A3
Q0P_MSIXMSGADDR20inputTCELL49:IMUX_D6
Q0P_MSIXMSGADDR21inputTCELL50:IMUX_B7
Q0P_MSIXMSGADDR22inputTCELL50:IMUX_C4
Q0P_MSIXMSGADDR23inputTCELL50:IMUX_C5
Q0P_MSIXMSGADDR24inputTCELL50:IMUX_C2
Q0P_MSIXMSGADDR25inputTCELL50:IMUX_A5
Q0P_MSIXMSGADDR26inputTCELL49:IMUX_D5
Q0P_MSIXMSGADDR27inputTCELL50:IMUX_B5
Q0P_MSIXMSGADDR28inputTCELL50:IMUX_A7
Q0P_MSIXMSGADDR29inputTCELL50:IMUX_B4
Q0P_MSIXMSGADDR3inputTCELL49:IMUX_A4
Q0P_MSIXMSGADDR30inputTCELL50:IMUX_A2
Q0P_MSIXMSGADDR31inputTCELL50:IMUX_C3
Q0P_MSIXMSGADDR32inputTCELL53:IMUX_B3
Q0P_MSIXMSGADDR33inputTCELL53:IMUX_A7
Q0P_MSIXMSGADDR34inputTCELL53:IMUX_B2
Q0P_MSIXMSGADDR35inputTCELL53:IMUX_A4
Q0P_MSIXMSGADDR36inputTCELL53:IMUX_A5
Q0P_MSIXMSGADDR37inputTCELL52:IMUX_B4
Q0P_MSIXMSGADDR38inputTCELL53:IMUX_A3
Q0P_MSIXMSGADDR39inputTCELL53:IMUX_A2
Q0P_MSIXMSGADDR4inputTCELL49:IMUX_A5
Q0P_MSIXMSGADDR40inputTCELL52:IMUX_B5
Q0P_MSIXMSGADDR41inputTCELL53:IMUX_A6
Q0P_MSIXMSGADDR42inputTCELL52:IMUX_D5
Q0P_MSIXMSGADDR43inputTCELL52:IMUX_D6
Q0P_MSIXMSGADDR44inputTCELL52:IMUX_C5
Q0P_MSIXMSGADDR45inputTCELL52:IMUX_B7
Q0P_MSIXMSGADDR46inputTCELL52:IMUX_C6
Q0P_MSIXMSGADDR47inputTCELL52:IMUX_C4
Q0P_MSIXMSGADDR48inputTCELL52:IMUX_D7
Q0P_MSIXMSGADDR49inputTCELL52:IMUX_B6
Q0P_MSIXMSGADDR5inputTCELL49:IMUX_A6
Q0P_MSIXMSGADDR50inputTCELL52:IMUX_D3
Q0P_MSIXMSGADDR51inputTCELL52:IMUX_C3
Q0P_MSIXMSGADDR52inputTCELL52:IMUX_C7
Q0P_MSIXMSGADDR53inputTCELL52:IMUX_C2
Q0P_MSIXMSGADDR54inputTCELL52:IMUX_D4
Q0P_MSIXMSGADDR55inputTCELL52:IMUX_D2
Q0P_MSIXMSGADDR56inputTCELL52:IMUX_A6
Q0P_MSIXMSGADDR57inputTCELL52:IMUX_B3
Q0P_MSIXMSGADDR58inputTCELL52:IMUX_B2
Q0P_MSIXMSGADDR59inputTCELL52:IMUX_A5
Q0P_MSIXMSGADDR6inputTCELL49:IMUX_B4
Q0P_MSIXMSGADDR60inputTCELL51:IMUX_D3
Q0P_MSIXMSGADDR61inputTCELL52:IMUX_A2
Q0P_MSIXMSGADDR62inputTCELL51:IMUX_D6
Q0P_MSIXMSGADDR63inputTCELL51:IMUX_B7
Q0P_MSIXMSGADDR7inputTCELL49:IMUX_C2
Q0P_MSIXMSGADDR8inputTCELL49:IMUX_B3
Q0P_MSIXMSGADDR9inputTCELL49:IMUX_B5
Q0P_MSIXMSGDAT0inputTCELL47:IMUX_A6
Q0P_MSIXMSGDAT1inputTCELL47:IMUX_A5
Q0P_MSIXMSGDAT10inputTCELL46:IMUX_A7
Q0P_MSIXMSGDAT11inputTCELL46:IMUX_C4
Q0P_MSIXMSGDAT12inputTCELL47:IMUX_A7
Q0P_MSIXMSGDAT13inputTCELL47:IMUX_A4
Q0P_MSIXMSGDAT14inputTCELL47:IMUX_A3
Q0P_MSIXMSGDAT15inputTCELL46:IMUX_D6
Q0P_MSIXMSGDAT16inputTCELL46:IMUX_D5
Q0P_MSIXMSGDAT17inputTCELL46:IMUX_D4
Q0P_MSIXMSGDAT18inputTCELL46:IMUX_B7
Q0P_MSIXMSGDAT19inputTCELL47:IMUX_A2
Q0P_MSIXMSGDAT2inputTCELL47:IMUX_B3
Q0P_MSIXMSGDAT20inputTCELL46:IMUX_C5
Q0P_MSIXMSGDAT21inputTCELL46:IMUX_C2
Q0P_MSIXMSGDAT22inputTCELL46:IMUX_C6
Q0P_MSIXMSGDAT23inputTCELL46:IMUX_B5
Q0P_MSIXMSGDAT24inputTCELL46:IMUX_D2
Q0P_MSIXMSGDAT25inputTCELL46:IMUX_D3
Q0P_MSIXMSGDAT26inputTCELL46:IMUX_D7
Q0P_MSIXMSGDAT27inputTCELL46:IMUX_B2
Q0P_MSIXMSGDAT28inputTCELL46:IMUX_B4
Q0P_MSIXMSGDAT29inputTCELL46:IMUX_C3
Q0P_MSIXMSGDAT3inputTCELL47:IMUX_B6
Q0P_MSIXMSGDAT30inputTCELL46:IMUX_B3
Q0P_MSIXMSGDAT31inputTCELL46:IMUX_C7
Q0P_MSIXMSGDAT4inputTCELL46:IMUX_B6
Q0P_MSIXMSGDAT5inputTCELL47:IMUX_B5
Q0P_MSIXMSGDAT6inputTCELL47:IMUX_B2
Q0P_MSIXMSGDAT7inputTCELL47:IMUX_B4
Q0P_MSIXMSGDAT8inputTCELL47:IMUX_C2
Q0P_MSIXMSGDAT9inputTCELL47:IMUX_B7
Q0P_MSIXMSGSENToutputTCELL46:OUT_F4
Q0P_MSIXMSGVLDinputTCELL49:IMUX_C4
Q0P_MSIXREQTPHPRESENTinputTCELL48:IMUX_A2
Q0P_MSIXREQTPHSTTAG0inputTCELL48:IMUX_C3
Q0P_MSIXREQTPHSTTAG1inputTCELL48:IMUX_B2
Q0P_MSIXREQTPHSTTAG2inputTCELL48:IMUX_A6
Q0P_MSIXREQTPHSTTAG3inputTCELL48:IMUX_C2
Q0P_MSIXREQTPHSTTAG4inputTCELL48:IMUX_A3
Q0P_MSIXREQTPHSTTAG5inputTCELL48:IMUX_C6
Q0P_MSIXREQTPHSTTAG6inputTCELL48:IMUX_B4
Q0P_MSIXREQTPHSTTAG7inputTCELL48:IMUX_B6
Q0P_MSIXREQTPHTYPE0inputTCELL47:IMUX_D7
Q0P_MSIXREQTPHTYPE1inputTCELL47:IMUX_D5
Q0P_NEGLNKWIDTH0outputTCELL45:OUT_F3
Q0P_NEGLNKWIDTH1outputTCELL45:OUT_F5
Q0P_NEGSPEEDoutputTCELL45:OUT_Q2
Q0P_NFTLERROUToutputTCELL41:OUT_F7
Q0P_PWRSTATECHNGACKinputTCELL46:IMUX_A6
Q0P_PWRSTATECHNGINToutputTCELL30:OUT_F5
Q0P_RCBSTSoutputTCELL39:OUT_Q7
Q0P_RSTNinputTCELL29:IMUX_LSR0
Q0P_SCANCLKinputTCELL27:IMUX_CLK0_DELAY
Q0P_SCANENAinputTCELL29:IMUX_LSR1
Q0P_SCANI0inputTCELL28:IMUX_CE1
Q0P_SCANI1inputTCELL31:IMUX_CE3
Q0P_SCANI10inputTCELL27:IMUX_CE2
Q0P_SCANI11inputTCELL28:IMUX_CE2
Q0P_SCANI12inputTCELL29:IMUX_CE1
Q0P_SCANI13inputTCELL32:IMUX_CE0
Q0P_SCANI14inputTCELL31:IMUX_CE1
Q0P_SCANI15inputTCELL32:IMUX_CE2
Q0P_SCANI16inputTCELL31:IMUX_CE0
Q0P_SCANI17inputTCELL28:IMUX_CE3
Q0P_SCANI18inputTCELL29:IMUX_CE2
Q0P_SCANI19inputTCELL27:IMUX_CE0
Q0P_SCANI2inputTCELL30:IMUX_CE3
Q0P_SCANI20inputTCELL27:IMUX_CE3
Q0P_SCANI21inputTCELL31:IMUX_CE2
Q0P_SCANI22inputTCELL33:IMUX_CE0
Q0P_SCANI23inputTCELL32:IMUX_CE3
Q0P_SCANI24inputTCELL28:IMUX_CE0
Q0P_SCANI25inputTCELL30:IMUX_CE2
Q0P_SCANI26inputTCELL30:IMUX_CE1
Q0P_SCANI3inputTCELL32:IMUX_CE1
Q0P_SCANI4inputTCELL33:IMUX_CE1
Q0P_SCANI5inputTCELL33:IMUX_CE2
Q0P_SCANI6inputTCELL30:IMUX_CE0
Q0P_SCANI7inputTCELL29:IMUX_CE3
Q0P_SCANI8inputTCELL29:IMUX_CE0
Q0P_SCANI9inputTCELL27:IMUX_CE1
Q0P_SCANMODEinputTCELL28:IMUX_LSR0
Q0P_SCANO0outputTCELL45:OUT_Q4
Q0P_SCANO1outputTCELL22:OUT_F1
Q0P_SCANO10outputTCELL41:OUT_Q2
Q0P_SCANO11outputTCELL21:OUT_F7
Q0P_SCANO12outputTCELL42:OUT_Q5
Q0P_SCANO13outputTCELL44:OUT_F5
Q0P_SCANO14outputTCELL30:OUT_F2
Q0P_SCANO15outputTCELL45:OUT_Q6
Q0P_SCANO16outputTCELL45:OUT_Q5
Q0P_SCANO17outputTCELL44:OUT_Q0
Q0P_SCANO18outputTCELL21:OUT_Q6
Q0P_SCANO19outputTCELL30:OUT_Q5
Q0P_SCANO2outputTCELL21:OUT_Q1
Q0P_SCANO20outputTCELL18:OUT_F0
Q0P_SCANO21outputTCELL21:OUT_Q2
Q0P_SCANO22outputTCELL29:OUT_Q7
Q0P_SCANO23outputTCELL46:OUT_F6
Q0P_SCANO24outputTCELL46:OUT_F2
Q0P_SCANO3outputTCELL44:OUT_F2
Q0P_SCANO4outputTCELL43:OUT_F0
Q0P_SCANO5outputTCELL32:OUT_Q6
Q0P_SCANO6outputTCELL35:OUT_Q1
Q0P_SCANO7outputTCELL33:OUT_Q4
Q0P_SCANO8outputTCELL32:OUT_F5
Q0P_SCANO9outputTCELL33:OUT_Q7
Q0P_SCANRSTNinputTCELL27:IMUX_LSR1
Q0P_TPHREQENABLEoutputTCELL42:OUT_Q0
Q0P_TPHSTMODE0outputTCELL41:OUT_F2
Q0P_TPHSTMODE1outputTCELL42:OUT_F0
Q0P_TPHSTMODE2outputTCELL40:OUT_Q6
Q0P_UNCORRERRINinputTCELL48:IMUX_D5
Q0_FCDFECOEFF0_0inputTCELL2:IMUX_A0
Q0_FCDFECOEFF0_1inputTCELL1:IMUX_A7
Q0_FCDFECOEFF0_2inputTCELL1:IMUX_A6
Q0_FCDFECOEFF0_3inputTCELL1:IMUX_D3
Q0_FCDFECOEFF0_4inputTCELL1:IMUX_D2
Q0_FCDFECOEFF0_5inputTCELL1:IMUX_D1
Q0_FCDFECOEFF0_6inputTCELL1:IMUX_D0
Q0_FCDFECOEFF0_7inputTCELL0:IMUX_D7
Q0_FCDFECOEFF1_0inputTCELL2:IMUX_B2
Q0_FCDFECOEFF1_1inputTCELL2:IMUX_B1
Q0_FCDFECOEFF1_2inputTCELL2:IMUX_B0
Q0_FCDFECOEFF1_3inputTCELL1:IMUX_B7
Q0_FCDFECOEFF1_4inputTCELL1:IMUX_B6
Q0_FCDFECOEFF1_5inputTCELL2:IMUX_A3
Q0_FCDFECOEFF1_6inputTCELL2:IMUX_A2
Q0_FCDFECOEFF1_7inputTCELL2:IMUX_A1
Q0_FCDFECOEFF2_0inputTCELL1:IMUX_D6
Q0_FCDFECOEFF2_1inputTCELL2:IMUX_C3
Q0_FCDFECOEFF2_2inputTCELL2:IMUX_C2
Q0_FCDFECOEFF2_3inputTCELL2:IMUX_C1
Q0_FCDFECOEFF2_4inputTCELL2:IMUX_C0
Q0_FCDFECOEFF2_5inputTCELL1:IMUX_C7
Q0_FCDFECOEFF2_6inputTCELL1:IMUX_C6
Q0_FCDFECOEFF2_7inputTCELL2:IMUX_B3
Q0_FCDFECOEFF3_0inputTCELL3:IMUX_A0
Q0_FCDFECOEFF3_1inputTCELL2:IMUX_A7
Q0_FCDFECOEFF3_2inputTCELL2:IMUX_A6
Q0_FCDFECOEFF3_3inputTCELL2:IMUX_D3
Q0_FCDFECOEFF3_4inputTCELL2:IMUX_D2
Q0_FCDFECOEFF3_5inputTCELL2:IMUX_D1
Q0_FCDFECOEFF3_6inputTCELL2:IMUX_D0
Q0_FCDFECOEFF3_7inputTCELL1:IMUX_D7
Q0_FCDFECOEFF4_0inputTCELL3:IMUX_B2
Q0_FCDFECOEFF4_1inputTCELL3:IMUX_B1
Q0_FCDFECOEFF4_2inputTCELL3:IMUX_B0
Q0_FCDFECOEFF4_3inputTCELL2:IMUX_B7
Q0_FCDFECOEFF4_4inputTCELL2:IMUX_B6
Q0_FCDFECOEFF4_5inputTCELL3:IMUX_A3
Q0_FCDFECOEFF4_6inputTCELL3:IMUX_A2
Q0_FCDFECOEFF4_7inputTCELL3:IMUX_A1
Q0_FCDFECOEFF5_0inputTCELL2:IMUX_D6
Q0_FCDFECOEFF5_1inputTCELL3:IMUX_C3
Q0_FCDFECOEFF5_2inputTCELL3:IMUX_C2
Q0_FCDFECOEFF5_3inputTCELL3:IMUX_C1
Q0_FCDFECOEFF5_4inputTCELL3:IMUX_C0
Q0_FCDFECOEFF5_5inputTCELL2:IMUX_C7
Q0_FCDFECOEFF5_6inputTCELL2:IMUX_C6
Q0_FCDFECOEFF5_7inputTCELL3:IMUX_B3
Q0_FCDFESIGN1inputTCELL3:IMUX_D3
Q0_FCDFESIGN2inputTCELL3:IMUX_D2
Q0_FCDFESIGN3inputTCELL3:IMUX_D1
Q0_FCDFESIGN4inputTCELL3:IMUX_D0
Q0_FCDFESIGN5inputTCELL2:IMUX_D7
Q0_FCMPWRUPinputTCELL0:IMUX_A7
Q0_FCMRSTinputTCELL0:IMUX_C0
Q0_FCSCANMODEinputTCELL1:IMUX_C2
Q0_FDDFECHSEL0inputTCELL0:IMUX_D6
Q0_FDDFECHSEL1inputTCELL1:IMUX_C3
Q0_FDDFEDATA0outputTCELL4:OUT_F6
Q0_FDDFEDATA1outputTCELL4:OUT_Q5
Q0_FDDFEDATA2outputTCELL4:OUT_Q4
Q0_FDDFEDATA3outputTCELL4:OUT_Q3
Q0_FDDFEDATA4outputTCELL4:OUT_Q2
Q0_FDDFEDATA5outputTCELL4:OUT_Q1
Q0_FDDFEDATA6outputTCELL4:OUT_Q0
Q0_FDDFEDATA7outputTCELL3:OUT_Q7
Q0_FDDFEDATA8outputTCELL3:OUT_Q6
Q0_FDDFEDATA9outputTCELL4:OUT_F5
Q0_FDDFEERR0outputTCELL5:OUT_Q0
Q0_FDDFEERR1outputTCELL4:OUT_Q7
Q0_FDDFEERR2outputTCELL4:OUT_Q6
Q0_FDDFEERR3outputTCELL5:OUT_F5
Q0_FDDFEERR4outputTCELL5:OUT_F4
Q0_FDDFEERR5outputTCELL5:OUT_F3
Q0_FDDFEERR6outputTCELL5:OUT_F2
Q0_FDDFEERR7outputTCELL5:OUT_F1
Q0_FDDFEERR8outputTCELL5:OUT_F0
Q0_FDDFEERR9outputTCELL4:OUT_F7
Q0_FIGRPFBRRCLK0inputTCELL14:IMUX_CLK1_DELAY
Q0_FIGRPFBRRCLK1inputTCELL14:IMUX_CLK0_DELAY
Q0_FIGRPFBTWCLK0inputTCELL15:IMUX_CLK1_DELAY
Q0_FIGRPFBTWCLK1inputTCELL15:IMUX_CLK0_DELAY
Q0_FIRXTESTCLKinputTCELL16:IMUX_CLK1_DELAY
Q0_FISYNCCLKinputTCELL16:IMUX_CLK0_DELAY
Q0_FITMRCLKinputTCELL1:IMUX_CLK0_DELAY
Q0_FITXTESTCLKinputTCELL0:IMUX_CLK1_DELAY
Q0_FOREFCLK2FPGAoutputTCELL4:OUT_F0
Q0_HSPLLLOLoutputTCELL2:OUT_F6
Q0_HSPLLPWRUPinputTCELL1:IMUX_A0
Q0_HSPLLREFCLKIinputTCELL7:IMUX_CLK0_DELAY
Q0_HSPLLRSTinputTCELL2:IMUX_LSR1
Q0_LSPLLLOLoutputTCELL2:OUT_F7
Q0_LSPLLPWRUPinputTCELL1:IMUX_A1
Q0_LSPLLREFCLKIinputTCELL7:IMUX_CLK1_DELAY
Q0_LSPLLRSTinputTCELL2:IMUX_LSR0

Bel wires

ecp4 SERDES1 bel wires
WirePins
TCELL0:IMUX_A0SERDES.Q0CH0_FCLDRTXEN
TCELL0:IMUX_A1SERDES.Q0CH1_FCLDRTXEN
TCELL0:IMUX_A2SERDES.Q0CH2_FCLDRTXEN
TCELL0:IMUX_A3SERDES.Q0CH3_FCLDRTXEN
TCELL0:IMUX_A6SERDES.Q0CH3_FCRXPWRUP
TCELL0:IMUX_A7SERDES.Q0_FCMPWRUP
TCELL0:IMUX_B0SERDES.Q0CH0_FCALIGNEN
TCELL0:IMUX_B1SERDES.Q0CH1_FCALIGNEN
TCELL0:IMUX_B2SERDES.Q0CH2_FCALIGNEN
TCELL0:IMUX_B3SERDES.Q0CH3_FCALIGNEN
TCELL0:IMUX_B6SERDES.Q0CH0_FCRATE0
TCELL0:IMUX_B7SERDES.Q0CH1_FCRATE2
TCELL0:IMUX_C0SERDES.Q0_FCMRST
TCELL0:IMUX_C1SERDES.Q0CH0_FCTXPWRUP
TCELL0:IMUX_C2SERDES.Q0CH1_FCTXPWRUP
TCELL0:IMUX_C3SERDES.Q0CH2_FCTXPWRUP
TCELL0:IMUX_C6SERDES.Q0CH2_FCRATE0
TCELL0:IMUX_C7SERDES.Q0CH3_FCRATE2
TCELL0:IMUX_D0SERDES.Q0CH3_FCTXPWRUP
TCELL0:IMUX_D1SERDES.Q0CH0_FCRXPWRUP
TCELL0:IMUX_D2SERDES.Q0CH1_FCRXPWRUP
TCELL0:IMUX_D3SERDES.Q0CH2_FCRXPWRUP
TCELL0:IMUX_D6SERDES.Q0_FDDFECHSEL0
TCELL0:IMUX_D7SERDES.Q0_FCDFECOEFF0_7
TCELL0:IMUX_CLK1_DELAYSERDES.Q0_FITXTESTCLK
TCELL0:OUT_F0SERDES.Q0CH3_FDRX15
TCELL0:OUT_F1SERDES.Q0CH3_FDRX14
TCELL0:OUT_F2SERDES.Q0CH3_FDRX13
TCELL0:OUT_F3SERDES.Q0CH3_FDRX12
TCELL0:OUT_F4SERDES.Q0CH3_FDRX11
TCELL0:OUT_F5SERDES.Q0CH3_FDRX10
TCELL0:OUT_F6SERDES.Q0CH3_FDRX3
TCELL0:OUT_F7SERDES.Q0CH3_FDRX2
TCELL0:OUT_Q0SERDES.Q0CH3_FDRX9
TCELL0:OUT_Q1SERDES.Q0CH3_FDRX8
TCELL0:OUT_Q2SERDES.Q0CH3_FDRX7
TCELL0:OUT_Q3SERDES.Q0CH3_FDRX6
TCELL0:OUT_Q4SERDES.Q0CH3_FDRX5
TCELL0:OUT_Q5SERDES.Q0CH3_FDRX4
TCELL0:OUT_Q6SERDES.Q0CH0_FSPCIECON
TCELL0:OUT_Q7SERDES.Q0CH1_FSPCIECON
TCELL1:IMUX_A0SERDES.Q0_HSPLLPWRUP
TCELL1:IMUX_A1SERDES.Q0_LSPLLPWRUP
TCELL1:IMUX_A2SERDES.Q0CH0_FCRATE2
TCELL1:IMUX_A3SERDES.Q0CH0_FCRATE1
TCELL1:IMUX_A6SERDES.Q0_FCDFECOEFF0_2
TCELL1:IMUX_A7SERDES.Q0_FCDFECOEFF0_1
TCELL1:IMUX_B0SERDES.Q0CH1_FCRATE1
TCELL1:IMUX_B1SERDES.Q0CH1_FCRATE0
TCELL1:IMUX_B2SERDES.Q0CH2_FCRATE2
TCELL1:IMUX_B3SERDES.Q0CH2_FCRATE1
TCELL1:IMUX_B6SERDES.Q0_FCDFECOEFF1_4
TCELL1:IMUX_B7SERDES.Q0_FCDFECOEFF1_3
TCELL1:IMUX_C0SERDES.Q0CH3_FCRATE1
TCELL1:IMUX_C1SERDES.Q0CH3_FCRATE0
TCELL1:IMUX_C2SERDES.Q0_FCSCANMODE
TCELL1:IMUX_C3SERDES.Q0_FDDFECHSEL1
TCELL1:IMUX_C6SERDES.Q0_FCDFECOEFF2_6
TCELL1:IMUX_C7SERDES.Q0_FCDFECOEFF2_5
TCELL1:IMUX_D0SERDES.Q0_FCDFECOEFF0_6
TCELL1:IMUX_D1SERDES.Q0_FCDFECOEFF0_5
TCELL1:IMUX_D2SERDES.Q0_FCDFECOEFF0_4
TCELL1:IMUX_D3SERDES.Q0_FCDFECOEFF0_3
TCELL1:IMUX_D6SERDES.Q0_FCDFECOEFF2_0
TCELL1:IMUX_D7SERDES.Q0_FCDFECOEFF3_7
TCELL1:IMUX_LSR0SERDES.Q0CH2_FCTRST
TCELL1:IMUX_LSR1SERDES.Q0CH3_FCTRST
TCELL1:IMUX_CLK0_DELAYSERDES.Q0_FITMRCLK
TCELL1:IMUX_CLK1_DELAYSERDES.Q0CH0_FITMRSTARTCLK
TCELL1:OUT_F0SERDES.Q0CH3_FDRX1
TCELL1:OUT_F1SERDES.Q0CH3_FDRX0
TCELL1:OUT_F2SERDES.Q0CH0_FSPCIEDONE
TCELL1:OUT_F3SERDES.Q0CH1_FSPCIEDONE
TCELL1:OUT_F4SERDES.Q0CH2_FSPCIEDONE
TCELL1:OUT_F5SERDES.Q0CH3_FSPCIEDONE
TCELL1:OUT_F6SERDES.Q0CH0_FSLSM
TCELL1:OUT_F7SERDES.Q0CH1_FSLSM
TCELL1:OUT_Q0SERDES.Q0CH2_FSPCIECON
TCELL1:OUT_Q1SERDES.Q0CH3_FSPCIECON
TCELL1:OUT_Q2SERDES.Q0CH0_FSRLOS
TCELL1:OUT_Q3SERDES.Q0CH1_FSRLOS
TCELL1:OUT_Q4SERDES.Q0CH2_FSRLOS
TCELL1:OUT_Q5SERDES.Q0CH3_FSRLOS
TCELL1:OUT_Q6SERDES.Q0CH0_FSCCOVERRUN
TCELL1:OUT_Q7SERDES.Q0CH1_FSCCOVERRUN
TCELL2:IMUX_A0SERDES.Q0_FCDFECOEFF0_0
TCELL2:IMUX_A1SERDES.Q0_FCDFECOEFF1_7
TCELL2:IMUX_A2SERDES.Q0_FCDFECOEFF1_6
TCELL2:IMUX_A3SERDES.Q0_FCDFECOEFF1_5
TCELL2:IMUX_A6SERDES.Q0_FCDFECOEFF3_2
TCELL2:IMUX_A7SERDES.Q0_FCDFECOEFF3_1
TCELL2:IMUX_B0SERDES.Q0_FCDFECOEFF1_2
TCELL2:IMUX_B1SERDES.Q0_FCDFECOEFF1_1
TCELL2:IMUX_B2SERDES.Q0_FCDFECOEFF1_0
TCELL2:IMUX_B3SERDES.Q0_FCDFECOEFF2_7
TCELL2:IMUX_B6SERDES.Q0_FCDFECOEFF4_4
TCELL2:IMUX_B7SERDES.Q0_FCDFECOEFF4_3
TCELL2:IMUX_C0SERDES.Q0_FCDFECOEFF2_4
TCELL2:IMUX_C1SERDES.Q0_FCDFECOEFF2_3
TCELL2:IMUX_C2SERDES.Q0_FCDFECOEFF2_2
TCELL2:IMUX_C3SERDES.Q0_FCDFECOEFF2_1
TCELL2:IMUX_C6SERDES.Q0_FCDFECOEFF5_6
TCELL2:IMUX_C7SERDES.Q0_FCDFECOEFF5_5
TCELL2:IMUX_D0SERDES.Q0_FCDFECOEFF3_6
TCELL2:IMUX_D1SERDES.Q0_FCDFECOEFF3_5
TCELL2:IMUX_D2SERDES.Q0_FCDFECOEFF3_4
TCELL2:IMUX_D3SERDES.Q0_FCDFECOEFF3_3
TCELL2:IMUX_D6SERDES.Q0_FCDFECOEFF5_0
TCELL2:IMUX_D7SERDES.Q0_FCDFESIGN5
TCELL2:IMUX_LSR0SERDES.Q0_LSPLLRST
TCELL2:IMUX_LSR1SERDES.Q0_HSPLLRST
TCELL2:IMUX_CLK0_DELAYSERDES.Q0CH1_FITMRSTARTCLK
TCELL2:IMUX_CLK1_DELAYSERDES.Q0CH2_FITMRSTARTCLK
TCELL2:OUT_F0SERDES.Q0CH2_FSLSM
TCELL2:OUT_F1SERDES.Q0CH3_FSLSM
TCELL2:OUT_F2SERDES.Q0CH0_FSCCUNDERRUN
TCELL2:OUT_F3SERDES.Q0CH1_FSCCUNDERRUN
TCELL2:OUT_F4SERDES.Q0CH2_FSCCUNDERRUN
TCELL2:OUT_F5SERDES.Q0CH3_FSCCUNDERRUN
TCELL2:OUT_F6SERDES.Q0_HSPLLLOL
TCELL2:OUT_F7SERDES.Q0_LSPLLLOL
TCELL2:OUT_Q0SERDES.Q0CH2_FSCCOVERRUN
TCELL2:OUT_Q1SERDES.Q0CH3_FSCCOVERRUN
TCELL2:OUT_Q2SERDES.Q0CH0_FSRLOL
TCELL2:OUT_Q3SERDES.Q0CH1_FSRLOL
TCELL2:OUT_Q4SERDES.Q0CH2_FSRLOL
TCELL2:OUT_Q5SERDES.Q0CH3_FSRLOL
TCELL2:OUT_Q6SERDES.Q0CH2_FSSKPADDED
TCELL2:OUT_Q7SERDES.Q0CH3_FSSKPADDED
TCELL3:IMUX_A0SERDES.Q0_FCDFECOEFF3_0
TCELL3:IMUX_A1SERDES.Q0_FCDFECOEFF4_7
TCELL3:IMUX_A2SERDES.Q0_FCDFECOEFF4_6
TCELL3:IMUX_A3SERDES.Q0_FCDFECOEFF4_5
TCELL3:IMUX_A6SERDES.Q0CH0_FCTMRSTART
TCELL3:IMUX_A7SERDES.Q0CH1_FCTMRSTART
TCELL3:IMUX_B0SERDES.Q0_FCDFECOEFF4_2
TCELL3:IMUX_B1SERDES.Q0_FCDFECOEFF4_1
TCELL3:IMUX_B2SERDES.Q0_FCDFECOEFF4_0
TCELL3:IMUX_B3SERDES.Q0_FCDFECOEFF5_7
TCELL3:IMUX_B6SERDES.Q0CH2_FCTMRSTOP
TCELL3:IMUX_B7SERDES.Q0CH3_FCTMRSTOP
TCELL3:IMUX_C0SERDES.Q0_FCDFECOEFF5_4
TCELL3:IMUX_C1SERDES.Q0_FCDFECOEFF5_3
TCELL3:IMUX_C2SERDES.Q0_FCDFECOEFF5_2
TCELL3:IMUX_C3SERDES.Q0_FCDFECOEFF5_1
TCELL3:IMUX_D0SERDES.Q0_FCDFESIGN4
TCELL3:IMUX_D1SERDES.Q0_FCDFESIGN3
TCELL3:IMUX_D2SERDES.Q0_FCDFESIGN2
TCELL3:IMUX_D3SERDES.Q0_FCDFESIGN1
TCELL3:IMUX_CLK0_DELAYSERDES.Q0CH3_FITMRSTARTCLK
TCELL3:IMUX_CLK1_DELAYSERDES.Q0CH0_FITMRSTOPCLK
TCELL3:OUT_F0SERDES.Q0CH0_FDLDRRX
TCELL3:OUT_F1SERDES.Q0CH1_FDLDRRX
TCELL3:OUT_F2SERDES.Q0CH2_FDLDRRX
TCELL3:OUT_F3SERDES.Q0CH3_FDLDRRX
TCELL3:OUT_F4SERDES.Q0CH0_FSSKPADDED
TCELL3:OUT_F5SERDES.Q0CH1_FSSKPADDED
TCELL3:OUT_F6SERDES.Q0D0_FSDM
TCELL3:OUT_F7SERDES.Q0D1_FSDM
TCELL3:OUT_Q0SERDES.Q0CH0_FSSKPDELETED
TCELL3:OUT_Q1SERDES.Q0CH1_FSSKPDELETED
TCELL3:OUT_Q2SERDES.Q0CH2_FSSKPDELETED
TCELL3:OUT_Q3SERDES.Q0CH3_FSSKPDELETED
TCELL3:OUT_Q4SERDES.Q0D0_FSDE
TCELL3:OUT_Q5SERDES.Q0D1_FSDE
TCELL3:OUT_Q6SERDES.Q0_FDDFEDATA8
TCELL3:OUT_Q7SERDES.Q0_FDDFEDATA7
TCELL4:IMUX_A0SERDES.Q0CH2_FCTMRSTART
TCELL4:IMUX_A1SERDES.Q0CH3_FCTMRSTART
TCELL4:IMUX_A2SERDES.Q0CH0_FCTMRSTOP
TCELL4:IMUX_A3SERDES.Q0CH1_FCTMRSTOP
TCELL4:IMUX_CLK0_DELAYSERDES.Q0CH1_FITMRSTOPCLK
TCELL4:IMUX_CLK1_DELAYSERDES.Q0CH2_FITMRSTOPCLK
TCELL4:OUT_F0SERDES.Q0_FOREFCLK2FPGA
TCELL4:OUT_F1SERDES.Q0CH0_FSRCDONE
TCELL4:OUT_F2SERDES.Q0CH1_FSRCDONE
TCELL4:OUT_F3SERDES.Q0CH2_FSRCDONE
TCELL4:OUT_F4SERDES.Q0CH3_FSRCDONE
TCELL4:OUT_F5SERDES.Q0_FDDFEDATA9
TCELL4:OUT_F6SERDES.Q0_FDDFEDATA0
TCELL4:OUT_F7SERDES.Q0_FDDFEERR9
TCELL4:OUT_Q0SERDES.Q0_FDDFEDATA6
TCELL4:OUT_Q1SERDES.Q0_FDDFEDATA5
TCELL4:OUT_Q2SERDES.Q0_FDDFEDATA4
TCELL4:OUT_Q3SERDES.Q0_FDDFEDATA3
TCELL4:OUT_Q4SERDES.Q0_FDDFEDATA2
TCELL4:OUT_Q5SERDES.Q0_FDDFEDATA1
TCELL4:OUT_Q6SERDES.Q0_FDDFEERR2
TCELL4:OUT_Q7SERDES.Q0_FDDFEERR1
TCELL5:IMUX_CLK0_DELAYSERDES.Q0CH3_FITMRSTOPCLK
TCELL5:OUT_F0SERDES.Q0_FDDFEERR8
TCELL5:OUT_F1SERDES.Q0_FDDFEERR7
TCELL5:OUT_F2SERDES.Q0_FDDFEERR6
TCELL5:OUT_F3SERDES.Q0_FDDFEERR5
TCELL5:OUT_F4SERDES.Q0_FDDFEERR4
TCELL5:OUT_F5SERDES.Q0_FDDFEERR3
TCELL5:OUT_Q0SERDES.Q0_FDDFEERR0
TCELL5:OUT_Q1SERDES.Q0CH0_FSDFEVLD
TCELL5:OUT_Q2SERDES.Q0CH1_FSDFEVLD
TCELL5:OUT_Q3SERDES.Q0CH2_FSDFEVLD
TCELL5:OUT_Q4SERDES.Q0CH3_FSDFEVLD
TCELL6:IMUX_A6SERDES.Q0CH0_FDTX49
TCELL6:IMUX_A7SERDES.Q0CH0_FDTX48
TCELL6:IMUX_B6SERDES.Q0CH0_FDTX43
TCELL6:IMUX_B7SERDES.Q0CH0_FDTX42
TCELL6:IMUX_C6SERDES.Q0CH0_FDTX37
TCELL6:IMUX_C7SERDES.Q0CH0_FDTX36
TCELL6:IMUX_D6SERDES.Q0CH0_FDTX31
TCELL6:IMUX_D7SERDES.Q0CH0_FDTX30
TCELL6:IMUX_CE3SERDES.Q0CH0_FCDFERDEN
TCELL6:OUT_F6SERDES.Q0CH0_FDRX47
TCELL6:OUT_F7SERDES.Q0CH0_FDRX46
TCELL6:OUT_Q6SERDES.Q0CH0_FDRX39
TCELL6:OUT_Q7SERDES.Q0CH0_FDRX38
TCELL7:IMUX_A0SERDES.Q0CH0_FDTX47
TCELL7:IMUX_A1SERDES.Q0CH0_FDTX46
TCELL7:IMUX_A2SERDES.Q0CH0_FDTX45
TCELL7:IMUX_A3SERDES.Q0CH0_FDTX44
TCELL7:IMUX_A6SERDES.Q0CH0_FDTX25
TCELL7:IMUX_A7SERDES.Q0CH0_FDTX24
TCELL7:IMUX_B0SERDES.Q0CH0_FDTX41
TCELL7:IMUX_B1SERDES.Q0CH0_FDTX40
TCELL7:IMUX_B2SERDES.Q0CH0_FDTX39
TCELL7:IMUX_B3SERDES.Q0CH0_FDTX38
TCELL7:IMUX_B6SERDES.Q0CH0_FDTX19
TCELL7:IMUX_B7SERDES.Q0CH0_FDTX18
TCELL7:IMUX_C0SERDES.Q0CH0_FDTX35
TCELL7:IMUX_C1SERDES.Q0CH0_FDTX34
TCELL7:IMUX_C2SERDES.Q0CH0_FDTX33
TCELL7:IMUX_C3SERDES.Q0CH0_FDTX32
TCELL7:IMUX_C6SERDES.Q0CH0_FDTX13
TCELL7:IMUX_C7SERDES.Q0CH0_FDTX12
TCELL7:IMUX_D0SERDES.Q0CH0_FDTX29
TCELL7:IMUX_D1SERDES.Q0CH0_FDTX28
TCELL7:IMUX_D2SERDES.Q0CH0_FDTX27
TCELL7:IMUX_D3SERDES.Q0CH0_FDTX26
TCELL7:IMUX_D6SERDES.Q0CH0_FDTX7
TCELL7:IMUX_D7SERDES.Q0CH0_FDTX6
TCELL7:IMUX_LSR0SERDES.Q0CH0_FCPIPEPHYRESETN
TCELL7:IMUX_LSR1SERDES.Q0CH1_FCPIPEPHYRESETN
TCELL7:IMUX_CLK0_DELAYSERDES.Q0_HSPLLREFCLKI
TCELL7:IMUX_CLK1_DELAYSERDES.Q0_LSPLLREFCLKI
TCELL7:IMUX_CE0SERDES.Q0CH1_FCDFERDEN
TCELL7:IMUX_CE1SERDES.Q0CH2_FCDFERDEN
TCELL7:IMUX_CE2SERDES.Q0CH3_FCDFERDEN
TCELL7:IMUX_CE3SERDES.Q0CH0_FCDFEUPD
TCELL7:OUT_F0SERDES.Q0CH0_FDRX45
TCELL7:OUT_F1SERDES.Q0CH0_FDRX44
TCELL7:OUT_F2SERDES.Q0CH0_FDRX43
TCELL7:OUT_F3SERDES.Q0CH0_FDRX42
TCELL7:OUT_F4SERDES.Q0CH0_FDRX41
TCELL7:OUT_F5SERDES.Q0CH0_FDRX40
TCELL7:OUT_F6SERDES.Q0CH0_FDRX31
TCELL7:OUT_F7SERDES.Q0CH0_FDRX30
TCELL7:OUT_Q0SERDES.Q0CH0_FDRX37
TCELL7:OUT_Q1SERDES.Q0CH0_FDRX36
TCELL7:OUT_Q2SERDES.Q0CH0_FDRX35
TCELL7:OUT_Q3SERDES.Q0CH0_FDRX34
TCELL7:OUT_Q4SERDES.Q0CH0_FDRX33
TCELL7:OUT_Q5SERDES.Q0CH0_FDRX32
TCELL7:OUT_Q6SERDES.Q0CH0_FDRX23
TCELL7:OUT_Q7SERDES.Q0CH0_FDRX22
TCELL8:IMUX_A0SERDES.Q0CH0_FDTX23
TCELL8:IMUX_A1SERDES.Q0CH0_FDTX22
TCELL8:IMUX_A2SERDES.Q0CH0_FDTX21
TCELL8:IMUX_A3SERDES.Q0CH0_FDTX20
TCELL8:IMUX_A6SERDES.Q0CH0_FDTX1
TCELL8:IMUX_A7SERDES.Q0CH0_FDTX0
TCELL8:IMUX_B0SERDES.Q0CH0_FDTX17
TCELL8:IMUX_B1SERDES.Q0CH0_FDTX16
TCELL8:IMUX_B2SERDES.Q0CH0_FDTX15
TCELL8:IMUX_B3SERDES.Q0CH0_FDTX14
TCELL8:IMUX_B6SERDES.Q0CH1_FDTX45
TCELL8:IMUX_B7SERDES.Q0CH1_FDTX44
TCELL8:IMUX_C0SERDES.Q0CH0_FDTX11
TCELL8:IMUX_C1SERDES.Q0CH0_FDTX10
TCELL8:IMUX_C2SERDES.Q0CH0_FDTX9
TCELL8:IMUX_C3SERDES.Q0CH0_FDTX8
TCELL8:IMUX_C6SERDES.Q0CH1_FDTX39
TCELL8:IMUX_C7SERDES.Q0CH1_FDTX38
TCELL8:IMUX_D0SERDES.Q0CH0_FDTX5
TCELL8:IMUX_D1SERDES.Q0CH0_FDTX4
TCELL8:IMUX_D2SERDES.Q0CH0_FDTX3
TCELL8:IMUX_D3SERDES.Q0CH0_FDTX2
TCELL8:IMUX_D6SERDES.Q0CH1_FDTX33
TCELL8:IMUX_D7SERDES.Q0CH1_FDTX32
TCELL8:IMUX_LSR0SERDES.Q0CH2_FCPIPEPHYRESETN
TCELL8:IMUX_LSR1SERDES.Q0CH3_FCPIPEPHYRESETN
TCELL8:IMUX_CLK0_DELAYSERDES.Q0CH0_FIREFRXCLK
TCELL8:IMUX_CLK1_DELAYSERDES.Q0CH1_FIREFRXCLK
TCELL8:IMUX_CE0SERDES.Q0CH1_FCDFEUPD
TCELL8:IMUX_CE1SERDES.Q0CH2_FCDFEUPD
TCELL8:IMUX_CE2SERDES.Q0CH3_FCDFEUPD
TCELL8:OUT_F0SERDES.Q0CH0_FDRX29
TCELL8:OUT_F1SERDES.Q0CH0_FDRX28
TCELL8:OUT_F2SERDES.Q0CH0_FDRX27
TCELL8:OUT_F3SERDES.Q0CH0_FDRX26
TCELL8:OUT_F4SERDES.Q0CH0_FDRX25
TCELL8:OUT_F5SERDES.Q0CH0_FDRX24
TCELL8:OUT_F6SERDES.Q0CH0_FDRX15
TCELL8:OUT_F7SERDES.Q0CH0_FDRX14
TCELL8:OUT_Q0SERDES.Q0CH0_FDRX21
TCELL8:OUT_Q1SERDES.Q0CH0_FDRX20
TCELL8:OUT_Q2SERDES.Q0CH0_FDRX19
TCELL8:OUT_Q3SERDES.Q0CH0_FDRX18
TCELL8:OUT_Q4SERDES.Q0CH0_FDRX17
TCELL8:OUT_Q5SERDES.Q0CH0_FDRX16
TCELL8:OUT_Q6SERDES.Q0CH0_FDRX7
TCELL8:OUT_Q7SERDES.Q0CH0_FDRX6
TCELL9:IMUX_A0SERDES.Q0CH1_FDTX49
TCELL9:IMUX_A1SERDES.Q0CH1_FDTX48
TCELL9:IMUX_A2SERDES.Q0CH1_FDTX47
TCELL9:IMUX_A3SERDES.Q0CH1_FDTX46
TCELL9:IMUX_A6SERDES.Q0CH1_FDTX27
TCELL9:IMUX_A7SERDES.Q0CH1_FDTX26
TCELL9:IMUX_B0SERDES.Q0CH1_FDTX43
TCELL9:IMUX_B1SERDES.Q0CH1_FDTX42
TCELL9:IMUX_B2SERDES.Q0CH1_FDTX41
TCELL9:IMUX_B3SERDES.Q0CH1_FDTX40
TCELL9:IMUX_B6SERDES.Q0CH1_FDTX21
TCELL9:IMUX_B7SERDES.Q0CH1_FDTX20
TCELL9:IMUX_C0SERDES.Q0CH1_FDTX37
TCELL9:IMUX_C1SERDES.Q0CH1_FDTX36
TCELL9:IMUX_C2SERDES.Q0CH1_FDTX35
TCELL9:IMUX_C3SERDES.Q0CH1_FDTX34
TCELL9:IMUX_C6SERDES.Q0CH1_FDTX15
TCELL9:IMUX_C7SERDES.Q0CH1_FDTX14
TCELL9:IMUX_D0SERDES.Q0CH1_FDTX31
TCELL9:IMUX_D1SERDES.Q0CH1_FDTX30
TCELL9:IMUX_D2SERDES.Q0CH1_FDTX29
TCELL9:IMUX_D3SERDES.Q0CH1_FDTX28
TCELL9:IMUX_D6SERDES.Q0CH1_FDTX9
TCELL9:IMUX_D7SERDES.Q0CH1_FDTX8
TCELL9:IMUX_LSR0SERDES.Q0D0_FCDERST
TCELL9:IMUX_LSR1SERDES.Q0D1_FCDERST
TCELL9:IMUX_CLK0_DELAYSERDES.Q0CH2_FIREFRXCLK
TCELL9:IMUX_CLK1_DELAYSERDES.Q0CH3_FIREFRXCLK
TCELL9:OUT_F0SERDES.Q0CH0_FDRX13
TCELL9:OUT_F1SERDES.Q0CH0_FDRX12
TCELL9:OUT_F2SERDES.Q0CH0_FDRX11
TCELL9:OUT_F3SERDES.Q0CH0_FDRX10
TCELL9:OUT_F4SERDES.Q0CH0_FDRX9
TCELL9:OUT_F5SERDES.Q0CH0_FDRX8
TCELL9:OUT_F6SERDES.Q0CH1_FDRX47
TCELL9:OUT_F7SERDES.Q0CH1_FDRX46
TCELL9:OUT_Q0SERDES.Q0CH0_FDRX5
TCELL9:OUT_Q1SERDES.Q0CH0_FDRX4
TCELL9:OUT_Q2SERDES.Q0CH0_FDRX3
TCELL9:OUT_Q3SERDES.Q0CH0_FDRX2
TCELL9:OUT_Q4SERDES.Q0CH0_FDRX1
TCELL9:OUT_Q5SERDES.Q0CH0_FDRX0
TCELL9:OUT_Q6SERDES.Q0CH1_FDRX39
TCELL9:OUT_Q7SERDES.Q0CH1_FDRX38
TCELL10:IMUX_A0SERDES.Q0CH1_FDTX25
TCELL10:IMUX_A1SERDES.Q0CH1_FDTX24
TCELL10:IMUX_A2SERDES.Q0CH1_FDTX23
TCELL10:IMUX_A3SERDES.Q0CH1_FDTX22
TCELL10:IMUX_A6SERDES.Q0CH1_FDTX3
TCELL10:IMUX_A7SERDES.Q0CH1_FDTX2
TCELL10:IMUX_B0SERDES.Q0CH1_FDTX19
TCELL10:IMUX_B1SERDES.Q0CH1_FDTX18
TCELL10:IMUX_B2SERDES.Q0CH1_FDTX17
TCELL10:IMUX_B3SERDES.Q0CH1_FDTX16
TCELL10:IMUX_B6SERDES.Q0CH2_FDTX47
TCELL10:IMUX_B7SERDES.Q0CH2_FDTX46
TCELL10:IMUX_C0SERDES.Q0CH1_FDTX13
TCELL10:IMUX_C1SERDES.Q0CH1_FDTX12
TCELL10:IMUX_C2SERDES.Q0CH1_FDTX11
TCELL10:IMUX_C3SERDES.Q0CH1_FDTX10
TCELL10:IMUX_C6SERDES.Q0CH2_FDTX41
TCELL10:IMUX_C7SERDES.Q0CH2_FDTX40
TCELL10:IMUX_D0SERDES.Q0CH1_FDTX7
TCELL10:IMUX_D1SERDES.Q0CH1_FDTX6
TCELL10:IMUX_D2SERDES.Q0CH1_FDTX5
TCELL10:IMUX_D3SERDES.Q0CH1_FDTX4
TCELL10:IMUX_D6SERDES.Q0CH2_FDTX35
TCELL10:IMUX_D7SERDES.Q0CH2_FDTX34
TCELL10:IMUX_LSR0SERDES.Q0CH0_FCPCSTXRST
TCELL10:IMUX_LSR1SERDES.Q0CH1_FCPCSTXRST
TCELL10:IMUX_CLK0_DELAYSERDES.Q0CH0_FIRCLK
TCELL10:IMUX_CLK1_DELAYSERDES.Q0CH1_FIRCLK
TCELL10:OUT_F0SERDES.Q0CH1_FDRX45
TCELL10:OUT_F1SERDES.Q0CH1_FDRX44
TCELL10:OUT_F2SERDES.Q0CH1_FDRX43
TCELL10:OUT_F3SERDES.Q0CH1_FDRX42
TCELL10:OUT_F4SERDES.Q0CH1_FDRX41
TCELL10:OUT_F5SERDES.Q0CH1_FDRX40
TCELL10:OUT_F6SERDES.Q0CH1_FDRX31
TCELL10:OUT_F7SERDES.Q0CH1_FDRX30
TCELL10:OUT_Q0SERDES.Q0CH1_FDRX37
TCELL10:OUT_Q1SERDES.Q0CH1_FDRX36
TCELL10:OUT_Q2SERDES.Q0CH1_FDRX35
TCELL10:OUT_Q3SERDES.Q0CH1_FDRX34
TCELL10:OUT_Q4SERDES.Q0CH1_FDRX33
TCELL10:OUT_Q5SERDES.Q0CH1_FDRX32
TCELL10:OUT_Q6SERDES.Q0CH1_FDRX23
TCELL10:OUT_Q7SERDES.Q0CH1_FDRX22
TCELL11:IMUX_A0SERDES.Q0CH1_FDTX1
TCELL11:IMUX_A1SERDES.Q0CH1_FDTX0
TCELL11:IMUX_A2SERDES.Q0CH2_FDTX49
TCELL11:IMUX_A3SERDES.Q0CH2_FDTX48
TCELL11:IMUX_B0SERDES.Q0CH2_FDTX45
TCELL11:IMUX_B1SERDES.Q0CH2_FDTX44
TCELL11:IMUX_B2SERDES.Q0CH2_FDTX43
TCELL11:IMUX_B3SERDES.Q0CH2_FDTX42
TCELL11:IMUX_C0SERDES.Q0CH2_FDTX39
TCELL11:IMUX_C1SERDES.Q0CH2_FDTX38
TCELL11:IMUX_C2SERDES.Q0CH2_FDTX37
TCELL11:IMUX_C3SERDES.Q0CH2_FDTX36
TCELL11:IMUX_D0SERDES.Q0CH2_FDTX33
TCELL11:IMUX_D1SERDES.Q0CH2_FDTX32
TCELL11:IMUX_D2SERDES.Q0CH2_FDTX31
TCELL11:IMUX_D3SERDES.Q0CH2_FDTX30
TCELL11:IMUX_LSR0SERDES.Q0CH2_FCPCSTXRST
TCELL11:IMUX_LSR1SERDES.Q0CH3_FCPCSTXRST
TCELL11:IMUX_CLK0_DELAYSERDES.Q0CH2_FIRCLK
TCELL11:IMUX_CLK1_DELAYSERDES.Q0CH3_FIRCLK
TCELL11:OUT_F0SERDES.Q0CH1_FDRX29
TCELL11:OUT_F1SERDES.Q0CH1_FDRX28
TCELL11:OUT_F2SERDES.Q0CH1_FDRX27
TCELL11:OUT_F3SERDES.Q0CH1_FDRX26
TCELL11:OUT_F4SERDES.Q0CH1_FDRX25
TCELL11:OUT_F5SERDES.Q0CH1_FDRX24
TCELL11:OUT_Q0SERDES.Q0CH1_FDRX21
TCELL11:OUT_Q1SERDES.Q0CH1_FDRX20
TCELL11:OUT_Q2SERDES.Q0CH1_FDRX19
TCELL11:OUT_Q3SERDES.Q0CH1_FDRX18
TCELL11:OUT_Q4SERDES.Q0CH1_FDRX17
TCELL11:OUT_Q5SERDES.Q0CH1_FDRX16
TCELL12:IMUX_A0SERDES.Q0CH2_FDTX29
TCELL12:IMUX_A1SERDES.Q0CH2_FDTX28
TCELL12:IMUX_A2SERDES.Q0CH2_FDTX27
TCELL12:IMUX_A3SERDES.Q0CH2_FDTX26
TCELL12:IMUX_A4SERDES.Q0CH2_FDTX25
TCELL12:IMUX_A5SERDES.Q0CH2_FDTX24
TCELL12:IMUX_B0SERDES.Q0CH2_FDTX23
TCELL12:IMUX_B1SERDES.Q0CH2_FDTX22
TCELL12:IMUX_B2SERDES.Q0CH2_FDTX21
TCELL12:IMUX_B3SERDES.Q0CH2_FDTX20
TCELL12:IMUX_B4SERDES.Q0CH2_FDTX19
TCELL12:IMUX_B5SERDES.Q0CH2_FDTX18
TCELL12:IMUX_C0SERDES.Q0CH2_FDTX17
TCELL12:IMUX_C1SERDES.Q0CH2_FDTX16
TCELL12:IMUX_C2SERDES.Q0CH2_FDTX15
TCELL12:IMUX_C3SERDES.Q0CH2_FDTX14
TCELL12:IMUX_C4SERDES.Q0CH2_FDTX13
TCELL12:IMUX_C5SERDES.Q0CH2_FDTX12
TCELL12:IMUX_D0SERDES.Q0CH2_FDTX11
TCELL12:IMUX_D1SERDES.Q0CH2_FDTX10
TCELL12:IMUX_D2SERDES.Q0CH2_FDTX9
TCELL12:IMUX_D3SERDES.Q0CH2_FDTX8
TCELL12:IMUX_D4SERDES.Q0CH2_FDTX7
TCELL12:IMUX_D5SERDES.Q0CH2_FDTX6
TCELL12:IMUX_LSR0SERDES.Q0CH0_FCPCSRXRST
TCELL12:IMUX_LSR1SERDES.Q0CH1_FCPCSRXRST
TCELL12:IMUX_CLK0_DELAYSERDES.Q0CH0_FITCLK
TCELL12:IMUX_CLK1_DELAYSERDES.Q0CH1_FITCLK
TCELL12:OUT_F0SERDES.Q0CH1_FDRX15
TCELL12:OUT_F1SERDES.Q0CH1_FDRX14
TCELL12:OUT_F2SERDES.Q0CH1_FDRX13
TCELL12:OUT_F3SERDES.Q0CH1_FDRX12
TCELL12:OUT_F4SERDES.Q0CH1_FDRX11
TCELL12:OUT_F5SERDES.Q0CH1_FDRX10
TCELL12:OUT_F6SERDES.Q0CH1_FDRX9
TCELL12:OUT_F7SERDES.Q0CH1_FDRX8
TCELL12:OUT_Q0SERDES.Q0CH1_FDRX7
TCELL12:OUT_Q1SERDES.Q0CH1_FDRX6
TCELL12:OUT_Q2SERDES.Q0CH1_FDRX5
TCELL12:OUT_Q3SERDES.Q0CH1_FDRX4
TCELL12:OUT_Q4SERDES.Q0CH1_FDRX3
TCELL12:OUT_Q5SERDES.Q0CH1_FDRX2
TCELL12:OUT_Q6SERDES.Q0CH1_FDRX1
TCELL12:OUT_Q7SERDES.Q0CH1_FDRX0
TCELL13:IMUX_A0SERDES.Q0CH2_FDTX5
TCELL13:IMUX_A1SERDES.Q0CH2_FDTX4
TCELL13:IMUX_A2SERDES.Q0CH2_FDTX3
TCELL13:IMUX_A3SERDES.Q0CH2_FDTX2
TCELL13:IMUX_A4SERDES.Q0CH2_FDTX1
TCELL13:IMUX_A5SERDES.Q0CH2_FDTX0
TCELL13:IMUX_B0SERDES.Q0CH3_FDTX49
TCELL13:IMUX_B1SERDES.Q0CH3_FDTX48
TCELL13:IMUX_B2SERDES.Q0CH3_FDTX47
TCELL13:IMUX_B3SERDES.Q0CH3_FDTX46
TCELL13:IMUX_B4SERDES.Q0CH3_FDTX45
TCELL13:IMUX_B5SERDES.Q0CH3_FDTX44
TCELL13:IMUX_C0SERDES.Q0CH3_FDTX43
TCELL13:IMUX_C1SERDES.Q0CH3_FDTX42
TCELL13:IMUX_C2SERDES.Q0CH3_FDTX41
TCELL13:IMUX_C3SERDES.Q0CH3_FDTX40
TCELL13:IMUX_C4SERDES.Q0CH3_FDTX39
TCELL13:IMUX_C5SERDES.Q0CH3_FDTX38
TCELL13:IMUX_D0SERDES.Q0CH3_FDTX37
TCELL13:IMUX_D1SERDES.Q0CH3_FDTX36
TCELL13:IMUX_D2SERDES.Q0CH3_FDTX35
TCELL13:IMUX_D3SERDES.Q0CH3_FDTX34
TCELL13:IMUX_D4SERDES.Q0CH3_FDTX33
TCELL13:IMUX_D5SERDES.Q0CH3_FDTX32
TCELL13:IMUX_LSR0SERDES.Q0CH2_FCPCSRXRST
TCELL13:IMUX_LSR1SERDES.Q0CH3_FCPCSRXRST
TCELL13:IMUX_CLK0_DELAYSERDES.Q0CH2_FITCLK
TCELL13:IMUX_CLK1_DELAYSERDES.Q0CH3_FITCLK
TCELL13:OUT_F0SERDES.Q0CH2_FDRX47
TCELL13:OUT_F1SERDES.Q0CH2_FDRX46
TCELL13:OUT_F2SERDES.Q0CH2_FDRX45
TCELL13:OUT_F3SERDES.Q0CH2_FDRX44
TCELL13:OUT_F4SERDES.Q0CH2_FDRX43
TCELL13:OUT_F5SERDES.Q0CH2_FDRX42
TCELL13:OUT_F6SERDES.Q0CH2_FDRX41
TCELL13:OUT_F7SERDES.Q0CH2_FDRX40
TCELL13:OUT_Q0SERDES.Q0CH2_FDRX39
TCELL13:OUT_Q1SERDES.Q0CH2_FDRX38
TCELL13:OUT_Q2SERDES.Q0CH2_FDRX37
TCELL13:OUT_Q3SERDES.Q0CH2_FDRX36
TCELL13:OUT_Q4SERDES.Q0CH2_FDRX35
TCELL13:OUT_Q5SERDES.Q0CH2_FDRX34
TCELL13:OUT_Q6SERDES.Q0CH2_FDRX33
TCELL13:OUT_Q7SERDES.Q0CH2_FDRX32
TCELL14:IMUX_A0SERDES.Q0CH3_FDTX31
TCELL14:IMUX_A1SERDES.Q0CH3_FDTX30
TCELL14:IMUX_A2SERDES.Q0CH3_FDTX29
TCELL14:IMUX_A3SERDES.Q0CH3_FDTX28
TCELL14:IMUX_A4SERDES.Q0CH3_FDTX27
TCELL14:IMUX_A5SERDES.Q0CH3_FDTX26
TCELL14:IMUX_B0SERDES.Q0CH3_FDTX25
TCELL14:IMUX_B1SERDES.Q0CH3_FDTX24
TCELL14:IMUX_B2SERDES.Q0CH3_FDTX23
TCELL14:IMUX_B3SERDES.Q0CH3_FDTX22
TCELL14:IMUX_B4SERDES.Q0CH3_FDTX21
TCELL14:IMUX_B5SERDES.Q0CH3_FDTX20
TCELL14:IMUX_C0SERDES.Q0CH3_FDTX19
TCELL14:IMUX_C1SERDES.Q0CH3_FDTX18
TCELL14:IMUX_C2SERDES.Q0CH3_FDTX17
TCELL14:IMUX_C3SERDES.Q0CH3_FDTX16
TCELL14:IMUX_C4SERDES.Q0CH3_FDTX15
TCELL14:IMUX_C5SERDES.Q0CH3_FDTX14
TCELL14:IMUX_D0SERDES.Q0CH3_FDTX13
TCELL14:IMUX_D1SERDES.Q0CH3_FDTX12
TCELL14:IMUX_D2SERDES.Q0CH3_FDTX11
TCELL14:IMUX_D3SERDES.Q0CH3_FDTX10
TCELL14:IMUX_D4SERDES.Q0CH3_FDTX9
TCELL14:IMUX_D5SERDES.Q0CH3_FDTX8
TCELL14:IMUX_LSR0SERDES.Q0CH0_FCRRST
TCELL14:IMUX_LSR1SERDES.Q0CH1_FCRRST
TCELL14:IMUX_CLK0_DELAYSERDES.Q0_FIGRPFBRRCLK1
TCELL14:IMUX_CLK1_DELAYSERDES.Q0_FIGRPFBRRCLK0
TCELL14:OUT_F0SERDES.Q0CH2_FDRX31
TCELL14:OUT_F1SERDES.Q0CH2_FDRX30
TCELL14:OUT_F2SERDES.Q0CH2_FDRX29
TCELL14:OUT_F3SERDES.Q0CH2_FDRX28
TCELL14:OUT_F4SERDES.Q0CH2_FDRX27
TCELL14:OUT_F5SERDES.Q0CH2_FDRX26
TCELL14:OUT_F6SERDES.Q0CH2_FDRX25
TCELL14:OUT_F7SERDES.Q0CH2_FDRX24
TCELL14:OUT_Q0SERDES.Q0CH2_FDRX23
TCELL14:OUT_Q1SERDES.Q0CH2_FDRX22
TCELL14:OUT_Q2SERDES.Q0CH2_FDRX21
TCELL14:OUT_Q3SERDES.Q0CH2_FDRX20
TCELL14:OUT_Q4SERDES.Q0CH2_FDRX19
TCELL14:OUT_Q5SERDES.Q0CH2_FDRX18
TCELL14:OUT_Q6SERDES.Q0CH2_FDRX17
TCELL14:OUT_Q7SERDES.Q0CH2_FDRX16
TCELL15:IMUX_A0SERDES.Q0CH3_FDTX7
TCELL15:IMUX_A1SERDES.Q0CH3_FDTX6
TCELL15:IMUX_A2SERDES.Q0CH3_FDTX5
TCELL15:IMUX_A3SERDES.Q0CH3_FDTX4
TCELL15:IMUX_A4SERDES.Q0CH3_FDTX3
TCELL15:IMUX_A5SERDES.Q0CH3_FDTX2
TCELL15:IMUX_B0SERDES.Q0CH3_FDTX1
TCELL15:IMUX_B1SERDES.Q0CH3_FDTX0
TCELL15:IMUX_B2SERDES.Q0CH0_FCPCIEDETEN
TCELL15:IMUX_B3SERDES.Q0CH1_FCPCIEDETEN
TCELL15:IMUX_B4SERDES.Q0CH2_FCPCIEDETEN
TCELL15:IMUX_B5SERDES.Q0CH3_FCPCIEDETEN
TCELL15:IMUX_C0SERDES.Q0CH0_FCRXPOLARITY
TCELL15:IMUX_C1SERDES.Q0CH1_FCRXPOLARITY
TCELL15:IMUX_C2SERDES.Q0CH2_FCRXPOLARITY
TCELL15:IMUX_C3SERDES.Q0CH3_FCRXPOLARITY
TCELL15:IMUX_C4SERDES.Q0CH0_FCWORDALGNEN
TCELL15:IMUX_C5SERDES.Q0CH1_FCWORDALGNEN
TCELL15:IMUX_D0SERDES.Q0CH2_FCWORDALGNEN
TCELL15:IMUX_D1SERDES.Q0CH3_FCWORDALGNEN
TCELL15:IMUX_D2SERDES.Q0CH0_FCLSMEN
TCELL15:IMUX_D3SERDES.Q0CH1_FCLSMEN
TCELL15:IMUX_D4SERDES.Q0CH2_FCLSMEN
TCELL15:IMUX_D5SERDES.Q0CH3_FCLSMEN
TCELL15:IMUX_LSR0SERDES.Q0CH2_FCRRST
TCELL15:IMUX_LSR1SERDES.Q0CH3_FCRRST
TCELL15:IMUX_CLK0_DELAYSERDES.Q0_FIGRPFBTWCLK1
TCELL15:IMUX_CLK1_DELAYSERDES.Q0_FIGRPFBTWCLK0
TCELL15:OUT_F0SERDES.Q0CH2_FDRX15
TCELL15:OUT_F1SERDES.Q0CH2_FDRX14
TCELL15:OUT_F2SERDES.Q0CH2_FDRX13
TCELL15:OUT_F3SERDES.Q0CH2_FDRX12
TCELL15:OUT_F4SERDES.Q0CH2_FDRX11
TCELL15:OUT_F5SERDES.Q0CH2_FDRX10
TCELL15:OUT_F6SERDES.Q0CH2_FDRX9
TCELL15:OUT_F7SERDES.Q0CH2_FDRX8
TCELL15:OUT_Q0SERDES.Q0CH2_FDRX7
TCELL15:OUT_Q1SERDES.Q0CH2_FDRX6
TCELL15:OUT_Q2SERDES.Q0CH2_FDRX5
TCELL15:OUT_Q3SERDES.Q0CH2_FDRX4
TCELL15:OUT_Q4SERDES.Q0CH2_FDRX3
TCELL15:OUT_Q5SERDES.Q0CH2_FDRX2
TCELL15:OUT_Q6SERDES.Q0CH2_FDRX1
TCELL15:OUT_Q7SERDES.Q0CH2_FDRX0
TCELL16:IMUX_A0SERDES.Q0CH0_FCCDRFORCEDLOCK
TCELL16:IMUX_A1SERDES.Q0CH1_FCCDRFORCEDLOCK
TCELL16:IMUX_A2SERDES.Q0CH2_FCCDRFORCEDLOCK
TCELL16:IMUX_A3SERDES.Q0CH3_FCCDRFORCEDLOCK
TCELL16:IMUX_A4SERDES.Q0CH0_FCPLLLOL
TCELL16:IMUX_A5SERDES.Q0CH1_FCPLLLOL
TCELL16:IMUX_B0SERDES.Q0CH2_FCPLLLOL
TCELL16:IMUX_B1SERDES.Q0CH3_FCPLLLOL
TCELL16:IMUX_B2SERDES.Q0CH0_FDLDRTX
TCELL16:IMUX_B3SERDES.Q0CH1_FDLDRTX
TCELL16:IMUX_B4SERDES.Q0CH2_FDLDRTX
TCELL16:IMUX_B5SERDES.Q0CH3_FDLDRTX
TCELL16:IMUX_C0SERDES.Q0CH0_FCTXMARGIN2
TCELL16:IMUX_C1SERDES.Q0CH0_FCTXMARGIN1
TCELL16:IMUX_C2SERDES.Q0CH0_FCTXMARGIN0
TCELL16:IMUX_C3SERDES.Q0CH1_FCTXMARGIN2
TCELL16:IMUX_C4SERDES.Q0CH1_FCTXMARGIN1
TCELL16:IMUX_C5SERDES.Q0CH1_FCTXMARGIN0
TCELL16:IMUX_D0SERDES.Q0CH2_FCTXMARGIN2
TCELL16:IMUX_D1SERDES.Q0CH2_FCTXMARGIN1
TCELL16:IMUX_D2SERDES.Q0CH2_FCTXMARGIN0
TCELL16:IMUX_D3SERDES.Q0CH3_FCTXMARGIN2
TCELL16:IMUX_D4SERDES.Q0CH3_FCTXMARGIN1
TCELL16:IMUX_D5SERDES.Q0CH3_FCTXMARGIN0
TCELL16:IMUX_LSR0SERDES.Q0CH0_FCTRST
TCELL16:IMUX_LSR1SERDES.Q0CH1_FCTRST
TCELL16:IMUX_CLK0_DELAYSERDES.Q0_FISYNCCLK
TCELL16:IMUX_CLK1_DELAYSERDES.Q0_FIRXTESTCLK
TCELL16:OUT_F0SERDES.Q0CH3_FDRX47
TCELL16:OUT_F1SERDES.Q0CH3_FDRX46
TCELL16:OUT_F2SERDES.Q0CH3_FDRX45
TCELL16:OUT_F3SERDES.Q0CH3_FDRX44
TCELL16:OUT_F4SERDES.Q0CH3_FDRX43
TCELL16:OUT_F5SERDES.Q0CH3_FDRX42
TCELL16:OUT_F6SERDES.Q0CH3_FDRX41
TCELL16:OUT_F7SERDES.Q0CH3_FDRX40
TCELL16:OUT_Q0SERDES.Q0CH3_FDRX39
TCELL16:OUT_Q1SERDES.Q0CH3_FDRX38
TCELL16:OUT_Q2SERDES.Q0CH3_FDRX37
TCELL16:OUT_Q3SERDES.Q0CH3_FDRX36
TCELL16:OUT_Q4SERDES.Q0CH3_FDRX35
TCELL16:OUT_Q5SERDES.Q0CH3_FDRX34
TCELL16:OUT_Q6SERDES.Q0CH3_FDRX33
TCELL16:OUT_Q7SERDES.Q0CH3_FDRX32
TCELL17:OUT_F0SERDES.Q0CH3_FDRX31
TCELL17:OUT_F1SERDES.Q0CH3_FDRX30
TCELL17:OUT_F2SERDES.Q0CH3_FDRX29
TCELL17:OUT_F3SERDES.Q0CH3_FDRX28
TCELL17:OUT_F4SERDES.Q0CH3_FDRX27
TCELL17:OUT_F5SERDES.Q0CH3_FDRX26
TCELL17:OUT_F6SERDES.Q0CH3_FDRX25
TCELL17:OUT_F7SERDES.Q0CH3_FDRX24
TCELL17:OUT_Q0SERDES.Q0CH3_FDRX23
TCELL17:OUT_Q1SERDES.Q0CH3_FDRX22
TCELL17:OUT_Q2SERDES.Q0CH3_FDRX21
TCELL17:OUT_Q3SERDES.Q0CH3_FDRX20
TCELL17:OUT_Q4SERDES.Q0CH3_FDRX19
TCELL17:OUT_Q5SERDES.Q0CH3_FDRX18
TCELL17:OUT_Q6SERDES.Q0CH3_FDRX17
TCELL17:OUT_Q7SERDES.Q0CH3_FDRX16
TCELL18:OUT_F0SERDES.Q0P_SCANO20
TCELL18:OUT_F1SERDES.Q0P_HALTGTREQTPHPRESENT
TCELL18:OUT_F2SERDES.Q0P_HALTGTWDATVLD
TCELL18:OUT_F3SERDES.Q0P_HALTGTWEOP
TCELL18:OUT_F4SERDES.Q0P_HALTGTCOMPRDY
TCELL18:OUT_F5SERDES.Q0P_HALTGTREQDES19
TCELL18:OUT_F6SERDES.Q0P_HALTGTREQDES18
TCELL18:OUT_F7SERDES.Q0P_HALTGTREQDES17
TCELL18:OUT_Q0SERDES.Q0P_HALTGTREQDES14
TCELL18:OUT_Q1SERDES.Q0P_HALTGTREQDES13
TCELL18:OUT_Q2SERDES.Q0P_HALTGTREQDES12
TCELL18:OUT_Q3SERDES.Q0P_HALTGTREQDES11
TCELL18:OUT_Q4SERDES.Q0P_HALTGTREQDES10
TCELL18:OUT_Q5SERDES.Q0P_HALTGTREQDES15
TCELL18:OUT_Q6SERDES.Q0P_HALTGTREQDES8
TCELL18:OUT_Q7SERDES.Q0P_HALTGTREQDES7
TCELL19:OUT_F0SERDES.Q0P_HALTGTREQDES6
TCELL19:OUT_F1SERDES.Q0P_HALTGTREQDES5
TCELL19:OUT_F2SERDES.Q0P_HALTGTREQDES4
TCELL19:OUT_F3SERDES.Q0P_HALTGTREQDES3
TCELL19:OUT_F4SERDES.Q0P_HALTGTREQDES2
TCELL19:OUT_F5SERDES.Q0P_HALTGTREQDES1
TCELL19:OUT_Q0SERDES.Q0P_HALTGTREQDES0
TCELL19:OUT_Q1SERDES.Q0P_HALTGTREQDES16
TCELL19:OUT_Q2SERDES.Q0P_HALTSTREQATTR2
TCELL19:OUT_Q3SERDES.Q0P_HALTSTREQATTR1
TCELL19:OUT_Q4SERDES.Q0P_HALTSTREQATTR0
TCELL19:OUT_Q5SERDES.Q0P_HALTGTREQMBA5
TCELL20:OUT_F0SERDES.Q0P_HALTGTREQMBA4
TCELL20:OUT_F1SERDES.Q0P_HALTGTREQMBA3
TCELL20:OUT_F2SERDES.Q0P_HALTGTREQMBA2
TCELL20:OUT_F3SERDES.Q0P_HALTGTREQMBA1
TCELL20:OUT_F4SERDES.Q0P_HALTGTREQMBA0
TCELL20:OUT_F5SERDES.Q0P_HALTGTREQTPHTYPE1
TCELL20:OUT_F6SERDES.Q0P_HALTGTREQTPHTYPE0
TCELL20:OUT_F7SERDES.Q0P_HALTGTREQTPHSTTAG7
TCELL20:OUT_Q0SERDES.Q0P_HALTGTREQTPHSTTAG6
TCELL20:OUT_Q1SERDES.Q0P_HALTGTREQTPHSTTAG5
TCELL20:OUT_Q2SERDES.Q0P_HALTGTREQTPHSTTAG4
TCELL20:OUT_Q3SERDES.Q0P_HALTGTREQTPHSTTAG3
TCELL20:OUT_Q4SERDES.Q0P_HALTGTREQTPHSTTAG2
TCELL20:OUT_Q5SERDES.Q0P_HALTGTREQTPHSTTAG1
TCELL20:OUT_Q6SERDES.Q0P_HALTGTREQTPHSTTAG0
TCELL20:OUT_Q7SERDES.Q0P_HALTGTWBVLD7
TCELL21:OUT_F0SERDES.Q0P_HALTGTWBVLD6
TCELL21:OUT_F1SERDES.Q0P_HALTGTWBVLD5
TCELL21:OUT_F2SERDES.Q0P_HALTGTWBVLD4
TCELL21:OUT_F3SERDES.Q0P_HALTGTWBVLD3
TCELL21:OUT_F4SERDES.Q0P_HALTGTWBVLD2
TCELL21:OUT_F5SERDES.Q0P_HALTGTWBVLD1
TCELL21:OUT_F6SERDES.Q0P_HALTGTWBVLD0
TCELL21:OUT_F7SERDES.Q0P_SCANO11
TCELL21:OUT_Q0SERDES.Q0P_HALTGTREQDES9
TCELL21:OUT_Q1SERDES.Q0P_SCANO2
TCELL21:OUT_Q2SERDES.Q0P_SCANO21
TCELL21:OUT_Q3SERDES.Q0P_HALTGTREQDES60
TCELL21:OUT_Q4SERDES.Q0P_HALTGTREQDES81
TCELL21:OUT_Q5SERDES.Q0P_HALTGTREQDES58
TCELL21:OUT_Q6SERDES.Q0P_SCANO18
TCELL21:OUT_Q7SERDES.Q0P_HALTGTREQDES91
TCELL22:OUT_F0SERDES.Q0P_HALTGTREQ
TCELL22:OUT_F1SERDES.Q0P_SCANO1
TCELL22:OUT_F2SERDES.Q0P_INTCO
TCELL22:OUT_F3SERDES.Q0P_HALTGTREQDES126
TCELL22:OUT_F4SERDES.Q0P_HALTGTREQDES76
TCELL22:OUT_F5SERDES.Q0P_HALTGTREQDES35
TCELL22:OUT_F6SERDES.Q0P_INTDO
TCELL22:OUT_F7SERDES.Q0P_HALTGTREQDES120
TCELL22:OUT_Q0SERDES.Q0P_HALTGTREQDES103
TCELL22:OUT_Q1SERDES.Q0P_HALTGTREQDES97
TCELL22:OUT_Q2SERDES.Q0P_HALTGTREQDES57
TCELL22:OUT_Q3SERDES.Q0P_HALTGTREQDES90
TCELL22:OUT_Q4SERDES.Q0P_HALTGTREQDES105
TCELL22:OUT_Q5SERDES.Q0P_HALTGTREQDES61
TCELL22:OUT_Q6SERDES.Q0P_HALTGTREQDES68
TCELL22:OUT_Q7SERDES.Q0P_HALTGTREQDES44
TCELL23:OUT_F0SERDES.Q0P_HALTGTREQDES52
TCELL23:OUT_F1SERDES.Q0P_HALTGTREQDES104
TCELL23:OUT_F2SERDES.Q0P_HALTGTREQDES62
TCELL23:OUT_F3SERDES.Q0P_HALTGTREQDES89
TCELL23:OUT_F4SERDES.Q0P_HALTGTREQDES54
TCELL23:OUT_F5SERDES.Q0P_HALTGTREQDES124
TCELL23:OUT_F6SERDES.Q0P_HALTGTREQDES47
TCELL23:OUT_F7SERDES.Q0P_HALTGTREQDES77
TCELL23:OUT_Q0SERDES.Q0P_HALTGTREQDES102
TCELL23:OUT_Q1SERDES.Q0P_INTAO
TCELL23:OUT_Q2SERDES.Q0P_HALTGTREQDES41
TCELL23:OUT_Q3SERDES.Q0P_HALTGTREQDES31
TCELL23:OUT_Q4SERDES.Q0P_HALTGTREQDES127
TCELL23:OUT_Q5SERDES.Q0P_INTBO
TCELL23:OUT_Q6SERDES.Q0P_HALTGTREQDES21
TCELL23:OUT_Q7SERDES.Q0P_HALTGTREQDES23
TCELL24:OUT_F0SERDES.Q0P_HALTGTREQDES30
TCELL24:OUT_F1SERDES.Q0P_HALTGTREQDES33
TCELL24:OUT_F2SERDES.Q0P_HALTGTREQDES24
TCELL24:OUT_F3SERDES.Q0P_HALTGTREQDES25
TCELL24:OUT_F4SERDES.Q0P_HALTGTREQDES34
TCELL24:OUT_F5SERDES.Q0P_HALTGTREQDES51
TCELL24:OUT_F6SERDES.Q0P_HALTGTREQDES22
TCELL24:OUT_F7SERDES.Q0P_HALTGTREQDES26
TCELL24:OUT_Q0SERDES.Q0P_HALTGTREQDES32
TCELL24:OUT_Q1SERDES.Q0P_HALTGTREQDES43
TCELL24:OUT_Q2SERDES.Q0P_HALTGTREQDES48
TCELL24:OUT_Q3SERDES.Q0P_HALTGTREQDES49
TCELL24:OUT_Q4SERDES.Q0P_HALTGTREQDES111
TCELL24:OUT_Q5SERDES.Q0P_HALTGTREQDES55
TCELL24:OUT_Q6SERDES.Q0P_HALTGTREQDES66
TCELL24:OUT_Q7SERDES.Q0P_HALTGTREQDES93
TCELL27:IMUX_A0SERDES.Q0P_HALTGTCOMPDES9
TCELL27:IMUX_A1SERDES.Q0P_HALTGTCOMPDES10
TCELL27:IMUX_A2SERDES.Q0P_HALTGTCOMPDES11
TCELL27:IMUX_A3SERDES.Q0P_HALTGTCOMPDES13
TCELL27:IMUX_A4SERDES.Q0P_HALTGTCOMPDES14
TCELL27:IMUX_A5SERDES.Q0P_HALTGTCOMPDES16
TCELL27:IMUX_B0SERDES.Q0P_HALTGTCOMPDES17
TCELL27:IMUX_B1SERDES.Q0P_HALTGTCOMPDES22
TCELL27:IMUX_B2SERDES.Q0P_HALTGTCOMPDES23
TCELL27:IMUX_B3SERDES.Q0P_HALTGTCOMPDES24
TCELL27:IMUX_B4SERDES.Q0P_HALTGTCOMPDES25
TCELL27:IMUX_B5SERDES.Q0P_HALTGTCOMPDES26
TCELL27:IMUX_C0SERDES.Q0P_HALTGTCOMPDES27
TCELL27:IMUX_C1SERDES.Q0P_HALTGTCOMPDES28
TCELL27:IMUX_C2SERDES.Q0P_HALTGTCOMPDES29
TCELL27:IMUX_C3SERDES.Q0P_HALTGTCOMPDES30
TCELL27:IMUX_C4SERDES.Q0P_HALTGTCOMPDES31
TCELL27:IMUX_C5SERDES.Q0P_HALTGTCOMPDES32
TCELL27:IMUX_D0SERDES.Q0P_HALTGTCOMPDES33
TCELL27:IMUX_D1SERDES.Q0P_HALTGTCOMPDES59
TCELL27:IMUX_D2SERDES.Q0P_HALTGTCOMPDES61
TCELL27:IMUX_D3SERDES.Q0P_HALTGTCOMPDES62
TCELL27:IMUX_D4SERDES.Q0P_HALTGTCOMPDES63
TCELL27:IMUX_D5SERDES.Q0P_HALTGTCOMPDES127
TCELL27:IMUX_LSR0SERDES.Q0P_MBISTMODE
TCELL27:IMUX_LSR1SERDES.Q0P_SCANRSTN
TCELL27:IMUX_CLK0_DELAYSERDES.Q0P_SCANCLK
TCELL27:IMUX_CLK1_DELAYSERDES.Q0P_MBISTCLK
TCELL27:IMUX_CE0SERDES.Q0P_SCANI19
TCELL27:IMUX_CE1SERDES.Q0P_SCANI9
TCELL27:IMUX_CE2SERDES.Q0P_SCANI10
TCELL27:IMUX_CE3SERDES.Q0P_SCANI20
TCELL27:OUT_F0SERDES.Q0P_HALTGTREQDES20
TCELL27:OUT_F1SERDES.Q0P_HALTGTREQDES96
TCELL27:OUT_F2SERDES.Q0P_HALTGTREQDES95
TCELL27:OUT_F3SERDES.Q0P_HALTGTREQDES125
TCELL27:OUT_F4SERDES.Q0P_HALTGTREQDES101
TCELL27:OUT_F5SERDES.Q0P_HALTGTREQDES99
TCELL27:OUT_F6SERDES.Q0P_HALTGTREQDES80
TCELL27:OUT_F7SERDES.Q0P_HALTGTREQDES56
TCELL27:OUT_Q0SERDES.Q0P_HALTGTREQDES69
TCELL27:OUT_Q1SERDES.Q0P_HALTGTREQDES78
TCELL27:OUT_Q2SERDES.Q0P_HALTGTREQDES110
TCELL27:OUT_Q3SERDES.Q0P_HALTGTREQDES84
TCELL27:OUT_Q4SERDES.Q0P_HALTGTREQDES73
TCELL27:OUT_Q5SERDES.Q0P_HALTGTREQDES70
TCELL27:OUT_Q6SERDES.Q0P_HALTGTREQDES106
TCELL27:OUT_Q7SERDES.Q0P_HALTGTREQDES87
TCELL28:IMUX_A0SERDES.Q0P_HALTGTCOMPDES64
TCELL28:IMUX_A1SERDES.Q0P_HALTGTCOMPDES65
TCELL28:IMUX_A2SERDES.Q0P_HALTGTCOMPDES66
TCELL28:IMUX_A3SERDES.Q0P_HALTGTCOMPDES67
TCELL28:IMUX_A4SERDES.Q0P_HALTGTCOMPDES69
TCELL28:IMUX_A5SERDES.Q0P_HALTGTCOMPDES71
TCELL28:IMUX_B0SERDES.Q0P_HALTGTCOMPDES72
TCELL28:IMUX_B1SERDES.Q0P_HALTGTCOMPDES73
TCELL28:IMUX_B2SERDES.Q0P_HALTGTCOMPDES74
TCELL28:IMUX_B3SERDES.Q0P_HALTGTCOMPDES77
TCELL28:IMUX_B4SERDES.Q0P_HALTGTCOMPDES78
TCELL28:IMUX_B5SERDES.Q0P_HALTGTCOMPDES79
TCELL28:IMUX_C0SERDES.Q0P_HALTGTCLNTCOMPIDEN
TCELL28:IMUX_C1SERDES.Q0P_HALTGTCOMPDES121
TCELL28:IMUX_C2SERDES.Q0P_HALTGTCOMPDES80
TCELL28:IMUX_C3SERDES.Q0P_HALTGTCOMPDES81
TCELL28:IMUX_C4SERDES.Q0P_HALTGTCOMPDES102
TCELL28:IMUX_C5SERDES.Q0P_HALTGTCOMPDES95
TCELL28:IMUX_D0SERDES.Q0P_HALTGTCOMPDES94
TCELL28:IMUX_D1SERDES.Q0P_HALTGTCOMPDES99
TCELL28:IMUX_D2SERDES.Q0P_HALTGTCOMPDES103
TCELL28:IMUX_D3SERDES.Q0P_HALTGTCOMPDES125
TCELL28:IMUX_D4SERDES.Q0P_HALTGTCOMPDES96
TCELL28:IMUX_D5SERDES.Q0P_HALTGTCOMPDES126
TCELL28:IMUX_LSR0SERDES.Q0P_SCANMODE
TCELL28:IMUX_LSR1SERDES.Q0P_MBISTRSTN
TCELL28:IMUX_CE0SERDES.Q0P_SCANI24
TCELL28:IMUX_CE1SERDES.Q0P_SCANI0
TCELL28:IMUX_CE2SERDES.Q0P_SCANI11
TCELL28:IMUX_CE3SERDES.Q0P_SCANI17
TCELL28:OUT_F0SERDES.Q0P_HALTGTREQDES82
TCELL28:OUT_F1SERDES.Q0P_HALTGTREQDES75
TCELL28:OUT_F2SERDES.Q0P_HALTGTREQDES109
TCELL28:OUT_F3SERDES.Q0P_HALTGTREQDES85
TCELL28:OUT_F4SERDES.Q0P_HALTGTREQDES74
TCELL28:OUT_F5SERDES.Q0P_HALTGTREQDES71
TCELL28:OUT_F6SERDES.Q0P_HALTGTREQDES98
TCELL28:OUT_F7SERDES.Q0P_HALTGTREQDES83
TCELL28:OUT_Q0SERDES.Q0P_HALTGTREQDES79
TCELL28:OUT_Q1SERDES.Q0P_HALTGTREQDES121
TCELL28:OUT_Q2SERDES.Q0P_HALTGTREQDES67
TCELL28:OUT_Q3SERDES.Q0P_HALTGTREQDES100
TCELL28:OUT_Q4SERDES.Q0P_HALTGTREQDES65
TCELL28:OUT_Q5SERDES.Q0P_HALTGTREQDES88
TCELL28:OUT_Q6SERDES.Q0P_HALTGTREQDES72
TCELL28:OUT_Q7SERDES.Q0P_HALTGTREQDES94
TCELL29:IMUX_A0SERDES.Q0P_HALTGTCOMPDES101
TCELL29:IMUX_A1SERDES.Q0P_HALTGTCOMPDES86
TCELL29:IMUX_A2SERDES.Q0P_HALTGTCOMPDES85
TCELL29:IMUX_A3SERDES.Q0P_HALTGTCOMPDES90
TCELL29:IMUX_A4SERDES.Q0P_HALTGTCOMPDES92
TCELL29:IMUX_A5SERDES.Q0P_HALTGTCOMPDES100
TCELL29:IMUX_B0SERDES.Q0P_HALTGTCOMPDES98
TCELL29:IMUX_B1SERDES.Q0P_HALTGTCOMPDES122
TCELL29:IMUX_B2SERDES.Q0P_HALTGTCOMPDES108
TCELL29:IMUX_B3SERDES.Q0P_HALTGTCOMPDES123
TCELL29:IMUX_B4SERDES.Q0P_HALTGTCOMPDES124
TCELL29:IMUX_B5SERDES.Q0P_HALTGTCOMPDES118
TCELL29:IMUX_C0SERDES.Q0P_HALTGTCOMPDES116
TCELL29:IMUX_C1SERDES.Q0P_HALTGTCOMPDES115
TCELL29:IMUX_C2SERDES.Q0P_HALTGTCOMPDES93
TCELL29:IMUX_C3SERDES.Q0P_HALTGTCOMPDES104
TCELL29:IMUX_C4SERDES.Q0P_HALTGTCOMPDES84
TCELL29:IMUX_C5SERDES.Q0P_HALTGTCOMPDES105
TCELL29:IMUX_D0SERDES.Q0P_HALTGTCOMPDES83
TCELL29:IMUX_D1SERDES.Q0P_HALTGTCOMPDES107
TCELL29:IMUX_D2SERDES.Q0P_HALTGTCOMPDES120
TCELL29:IMUX_D3SERDES.Q0P_HALTGTCOMPDES89
TCELL29:IMUX_D4SERDES.Q0P_HALTGTCOMPDES87
TCELL29:IMUX_D5SERDES.Q0P_HALTGTCOMPDES91
TCELL29:IMUX_LSR0SERDES.Q0P_RSTN
TCELL29:IMUX_LSR1SERDES.Q0P_SCANENA
TCELL29:IMUX_CE0SERDES.Q0P_SCANI8
TCELL29:IMUX_CE1SERDES.Q0P_SCANI12
TCELL29:IMUX_CE2SERDES.Q0P_SCANI18
TCELL29:IMUX_CE3SERDES.Q0P_SCANI7
TCELL29:OUT_F0SERDES.Q0P_HALTGTREQDES64
TCELL29:OUT_F1SERDES.Q0P_HALTGTREQDES63
TCELL29:OUT_F2SERDES.Q0P_HALTGTREQDES86
TCELL29:OUT_F3SERDES.Q0P_HALTGTREQDES92
TCELL29:OUT_F4SERDES.Q0P_HALTGTREQDES53
TCELL29:OUT_F5SERDES.Q0P_HALTGTREQDES50
TCELL29:OUT_F6SERDES.Q0P_HALTGTREQDES28
TCELL29:OUT_F7SERDES.Q0P_HALTGTREQDES29
TCELL29:OUT_Q0SERDES.Q0P_HALTGTREQDES123
TCELL29:OUT_Q1SERDES.Q0P_HALTGTREQDES59
TCELL29:OUT_Q2SERDES.Q0P_HALTGTREQDES46
TCELL29:OUT_Q3SERDES.Q0P_HALTGTREQDES45
TCELL29:OUT_Q4SERDES.Q0P_HALTGTREQDES27
TCELL29:OUT_Q5SERDES.Q0P_HALTGTREQDES122
TCELL29:OUT_Q6SERDES.Q0P_HALTGTREQDES42
TCELL29:OUT_Q7SERDES.Q0P_SCANO22
TCELL30:IMUX_A0SERDES.Q0P_HALTGTCOMPDES113
TCELL30:IMUX_A1SERDES.Q0P_HALTGTCOMPDES114
TCELL30:IMUX_A2SERDES.Q0P_HALTGTCOMPDES88
TCELL30:IMUX_A3SERDES.Q0P_HALTGTCOMPDES117
TCELL30:IMUX_A4SERDES.Q0P_HALTGTCOMPDES97
TCELL30:IMUX_A5SERDES.Q0P_HALTGTCOMPDES112
TCELL30:IMUX_B0SERDES.Q0P_HALTGTCOMPDES82
TCELL30:IMUX_B1SERDES.Q0P_HALTGTCOMPDES76
TCELL30:IMUX_B2SERDES.Q0P_HALTGTCOMPDES109
TCELL30:IMUX_B3SERDES.Q0P_HALTGTCOMPDES111
TCELL30:IMUX_B4SERDES.Q0P_HALTGTCOMPDES75
TCELL30:IMUX_B5SERDES.Q0P_HALTGTCOMPDES110
TCELL30:IMUX_C0SERDES.Q0P_HALTGTCOMPDES106
TCELL30:IMUX_C1SERDES.Q0P_HALTGTCOMPDES70
TCELL30:IMUX_C2SERDES.Q0P_HALTGTCOMPDES60
TCELL30:IMUX_C3SERDES.Q0P_HALTGTCOMPDES58
TCELL30:IMUX_C4SERDES.Q0P_HALTGTCOMPDES57
TCELL30:IMUX_C5SERDES.Q0P_HALTGTCOMPDES56
TCELL30:IMUX_D0SERDES.Q0P_HALTGTCOMPDES55
TCELL30:IMUX_D1SERDES.Q0P_HALTGTCOMPDES54
TCELL30:IMUX_D2SERDES.Q0P_HALTGTCOMPDES53
TCELL30:IMUX_D3SERDES.Q0P_HALTGTCOMPDES52
TCELL30:IMUX_D4SERDES.Q0P_HALTGTCOMPDES51
TCELL30:IMUX_D5SERDES.Q0P_HALTGTCOMPDES50
TCELL30:IMUX_LSR0SERDES.Q0P_HOTRSTIN
TCELL30:IMUX_CE0SERDES.Q0P_SCANI6
TCELL30:IMUX_CE1SERDES.Q0P_SCANI26
TCELL30:IMUX_CE2SERDES.Q0P_SCANI25
TCELL30:IMUX_CE3SERDES.Q0P_SCANI2
TCELL30:OUT_F0SERDES.Q0P_HALMSTWRDY
TCELL30:OUT_F1SERDES.Q0P_HALTGTREQDES40
TCELL30:OUT_F2SERDES.Q0P_SCANO14
TCELL30:OUT_F3SERDES.Q0P_HALTGTREQDES36
TCELL30:OUT_F4SERDES.Q0P_HALTGTREQDES38
TCELL30:OUT_F5SERDES.Q0P_PWRSTATECHNGINT
TCELL30:OUT_F6SERDES.Q0P_HALTGTREQDES37
TCELL30:OUT_F7SERDES.Q0P_HALMSTCOMPDES116
TCELL30:OUT_Q0SERDES.Q0P_HALMSTCOMPDES115
TCELL30:OUT_Q1SERDES.Q0P_HALMSTCOMPDES117
TCELL30:OUT_Q2SERDES.Q0P_HALMSTCOMPDES114
TCELL30:OUT_Q3SERDES.Q0P_HALMSTCOMPDES113
TCELL30:OUT_Q4SERDES.Q0P_HALMSTCOMPDES118
TCELL30:OUT_Q5SERDES.Q0P_SCANO19
TCELL30:OUT_Q6SERDES.Q0P_HALMSTCOMPDES109
TCELL30:OUT_Q7SERDES.Q0P_HALMSTCOMPDES112
TCELL31:IMUX_A0SERDES.Q0P_HALTGTCOMPDES49
TCELL31:IMUX_A1SERDES.Q0P_HALTGTCOMPDES48
TCELL31:IMUX_A2SERDES.Q0P_HALTGTCOMPDES47
TCELL31:IMUX_A3SERDES.Q0P_HALTGTCOMPDES46
TCELL31:IMUX_A4SERDES.Q0P_HALTGTCOMPDES45
TCELL31:IMUX_A5SERDES.Q0P_HALTGTCOMPDES44
TCELL31:IMUX_B0SERDES.Q0P_HALTGTCOMPDES43
TCELL31:IMUX_B1SERDES.Q0P_HALTGTCOMPDES42
TCELL31:IMUX_B2SERDES.Q0P_HALTGTCOMPDES41
TCELL31:IMUX_B3SERDES.Q0P_HALTGTCOMPDES40
TCELL31:IMUX_B4SERDES.Q0P_HALTGTCOMPDES39
TCELL31:IMUX_B5SERDES.Q0P_HALTGTCOMPDES38
TCELL31:IMUX_C0SERDES.Q0P_HALTGTCOMPDES37
TCELL31:IMUX_C1SERDES.Q0P_HALTGTCOMPDES36
TCELL31:IMUX_C2SERDES.Q0P_HALTGTCOMPDES35
TCELL31:IMUX_C3SERDES.Q0P_HALTGTCOMPDES34
TCELL31:IMUX_C4SERDES.Q0P_HALTGTCOMPDES21
TCELL31:IMUX_C5SERDES.Q0P_HALTGTCOMPDES68
TCELL31:IMUX_D0SERDES.Q0P_HALTGTCOMPDES20
TCELL31:IMUX_D1SERDES.Q0P_HALTGTCOMPDES19
TCELL31:IMUX_D2SERDES.Q0P_HALTGTCOMPDES18
TCELL31:IMUX_D3SERDES.Q0P_HALTGTCOMPDES15
TCELL31:IMUX_D4SERDES.Q0P_HALTGTCOMPDES12
TCELL31:IMUX_D5SERDES.Q0P_HALTGTCOMPDES8
TCELL31:IMUX_CE0SERDES.Q0P_SCANI16
TCELL31:IMUX_CE1SERDES.Q0P_SCANI14
TCELL31:IMUX_CE2SERDES.Q0P_SCANI21
TCELL31:IMUX_CE3SERDES.Q0P_SCANI1
TCELL31:OUT_F0SERDES.Q0P_HALMSTCOMPDES108
TCELL31:OUT_F1SERDES.Q0P_HALMSTCOMPDES110
TCELL31:OUT_F2SERDES.Q0P_HALMSTCOMPDES107
TCELL31:OUT_F3SERDES.Q0P_HALMSTCOMPDES126
TCELL31:OUT_F4SERDES.Q0P_HALMSTCOMPDES125
TCELL31:OUT_F5SERDES.Q0P_HALMSTCOMPDES111
TCELL31:OUT_F6SERDES.Q0P_HALMSTCOMPDES127
TCELL31:OUT_F7SERDES.Q0P_HALMSTCOMPDES119
TCELL31:OUT_Q0SERDES.Q0P_HALMSTCOMPDES79
TCELL31:OUT_Q1SERDES.Q0P_HALMSTCOMPDES104
TCELL31:OUT_Q2SERDES.Q0P_HALMSTCOMPDES102
TCELL31:OUT_Q3SERDES.Q0P_HALMSTCOMPDES101
TCELL31:OUT_Q4SERDES.Q0P_HALMSTCOMPDES103
TCELL31:OUT_Q5SERDES.Q0P_HALMSTCOMPDES76
TCELL31:OUT_Q6SERDES.Q0P_HALMSTCOMPDES67
TCELL31:OUT_Q7SERDES.Q0P_HALMSTCOMPDES72
TCELL32:IMUX_A0SERDES.Q0P_HALTGTCOMPDES7
TCELL32:IMUX_A1SERDES.Q0P_HALTGTCOMPDES6
TCELL32:IMUX_A2SERDES.Q0P_HALTGTCOMPDES5
TCELL32:IMUX_A3SERDES.Q0P_HALTGTCOMPDES4
TCELL32:IMUX_A4SERDES.Q0P_HALTGTCOMPDES3
TCELL32:IMUX_A5SERDES.Q0P_HALTGTCOMPDES2
TCELL32:IMUX_B0SERDES.Q0P_HALTGTCOMPDES1
TCELL32:IMUX_B1SERDES.Q0P_HALTGTCOMPDES0
TCELL32:IMUX_B2SERDES.Q0P_HALTGTCOMPBVLD7
TCELL32:IMUX_B3SERDES.Q0P_HALTGTCOMPBVLD6
TCELL32:IMUX_B4SERDES.Q0P_HALTGTCOMPBVLD5
TCELL32:IMUX_B5SERDES.Q0P_HALTGTCOMPBVLD4
TCELL32:IMUX_C0SERDES.Q0P_HALTGTCOMPBVLD3
TCELL32:IMUX_C1SERDES.Q0P_HALTGTCOMPBVLD2
TCELL32:IMUX_C2SERDES.Q0P_HALTGTCOMPBVLD1
TCELL32:IMUX_C3SERDES.Q0P_HALTGTCOMPBVLD0
TCELL32:IMUX_C4SERDES.Q0P_HALTGTCLNTCOMPID15
TCELL32:IMUX_C5SERDES.Q0P_HALTGTCLNTCOMPID14
TCELL32:IMUX_D0SERDES.Q0P_HALTGTCLNTCOMPID13
TCELL32:IMUX_D1SERDES.Q0P_HALTGTCLNTCOMPID12
TCELL32:IMUX_D2SERDES.Q0P_HALTGTCLNTCOMPID11
TCELL32:IMUX_D3SERDES.Q0P_HALTGTCLNTCOMPID10
TCELL32:IMUX_D4SERDES.Q0P_HALTGTCLNTCOMPID9
TCELL32:IMUX_D5SERDES.Q0P_HALTGTCLNTCOMPID8
TCELL32:IMUX_CE0SERDES.Q0P_SCANI13
TCELL32:IMUX_CE1SERDES.Q0P_SCANI3
TCELL32:IMUX_CE2SERDES.Q0P_SCANI15
TCELL32:IMUX_CE3SERDES.Q0P_SCANI23
TCELL32:OUT_F0SERDES.Q0P_HALMSTCOMPDES75
TCELL32:OUT_F1SERDES.Q0P_HALMSTCOMPDES105
TCELL32:OUT_F2SERDES.Q0P_HALMSTCOMPDES70
TCELL32:OUT_F3SERDES.Q0P_HALMSTCOMPDES74
TCELL32:OUT_F4SERDES.Q0P_HALMSTCOMPDES106
TCELL32:OUT_F5SERDES.Q0P_SCANO8
TCELL32:OUT_F6SERDES.Q0P_HALMSTCOMPDES73
TCELL32:OUT_F7SERDES.Q0P_HALMSTCOMPDES71
TCELL32:OUT_Q0SERDES.Q0P_HALTGTREQDES39
TCELL32:OUT_Q1SERDES.Q0P_HALMSTCOMPDES68
TCELL32:OUT_Q2SERDES.Q0P_HALMSTCOMPDES91
TCELL32:OUT_Q3SERDES.Q0P_HALMSTCOMPDES93
TCELL32:OUT_Q4SERDES.Q0P_HALMSTCOMPDES66
TCELL32:OUT_Q5SERDES.Q0P_HALMSTCOMPDES90
TCELL32:OUT_Q6SERDES.Q0P_SCANO5
TCELL32:OUT_Q7SERDES.Q0P_HALMSTCOMPDES64
TCELL33:IMUX_A0SERDES.Q0P_HALTGTCLNTCOMPID7
TCELL33:IMUX_A1SERDES.Q0P_HALTGTCLNTCOMPID6
TCELL33:IMUX_A2SERDES.Q0P_HALTGTCLNTCOMPID5
TCELL33:IMUX_A3SERDES.Q0P_HALTGTCLNTCOMPID4
TCELL33:IMUX_A4SERDES.Q0P_HALTGTCLNTCOMPID3
TCELL33:IMUX_A5SERDES.Q0P_HALTGTCLNTCOMPID2
TCELL33:IMUX_B0SERDES.Q0P_HALTGTCLNTCOMPID1
TCELL33:IMUX_B1SERDES.Q0P_HALTGTCLNTCOMPID0
TCELL33:IMUX_B2SERDES.Q0P_HALTGTCAREQDES106
TCELL33:IMUX_B3SERDES.Q0P_HALTGTCAREQDES105
TCELL33:IMUX_B4SERDES.Q0P_HALTGTCAREQDES104
TCELL33:IMUX_B5SERDES.Q0P_HALTGTCAREQDES98
TCELL33:IMUX_C0SERDES.Q0P_HALTGTCAREQDES97
TCELL33:IMUX_C1SERDES.Q0P_HALTGTCAREQDES96
TCELL33:IMUX_C2SERDES.Q0P_HALTGTCAREQDES94
TCELL33:IMUX_C3SERDES.Q0P_HALTGTCAREQDES93
TCELL33:IMUX_C4SERDES.Q0P_HALTGTCAREQDES92
TCELL33:IMUX_C5SERDES.Q0P_HALTGTCAREQDES91
TCELL33:IMUX_D0SERDES.Q0P_HALTGTCAREQDES90
TCELL33:IMUX_D1SERDES.Q0P_HALTGTCAREQDES89
TCELL33:IMUX_D2SERDES.Q0P_HALTGTCAREQDES88
TCELL33:IMUX_D3SERDES.Q0P_HALTGTCAREQDES87
TCELL33:IMUX_D4SERDES.Q0P_HALTGTCAREQDES85
TCELL33:IMUX_D5SERDES.Q0P_HALTGTCAREQDES121
TCELL33:IMUX_CE0SERDES.Q0P_SCANI22
TCELL33:IMUX_CE1SERDES.Q0P_SCANI4
TCELL33:IMUX_CE2SERDES.Q0P_SCANI5
TCELL33:OUT_F0SERDES.Q0P_HALMSTCOMPDES94
TCELL33:OUT_F1SERDES.Q0P_HALMSTCOMPDES92
TCELL33:OUT_F2SERDES.Q0P_HALMSTCOMPDES69
TCELL33:OUT_F3SERDES.Q0P_HALMSTCOMPDES65
TCELL33:OUT_F4SERDES.Q0P_HALMSTCOMPDES95
TCELL33:OUT_F5SERDES.Q0P_MSIVECCNT1
TCELL33:OUT_F6SERDES.Q0P_HALMSTCOMPDES89
TCELL33:OUT_F7SERDES.Q0P_HALMSTCOMPDES88
TCELL33:OUT_Q0SERDES.Q0P_HALMSTCOMPDES77
TCELL33:OUT_Q1SERDES.Q0P_MSIVECCNT2
TCELL33:OUT_Q2SERDES.Q0P_HALMSTCOMPDES78
TCELL33:OUT_Q3SERDES.Q0P_MSIVECCNT0
TCELL33:OUT_Q4SERDES.Q0P_SCANO7
TCELL33:OUT_Q5SERDES.Q0P_INTACK
TCELL33:OUT_Q6SERDES.Q0P_MSIEN
TCELL33:OUT_Q7SERDES.Q0P_SCANO9
TCELL34:IMUX_A2SERDES.Q0P_HALTGTCAREQDES84
TCELL34:IMUX_A3SERDES.Q0P_HALTGTCAREQDES80
TCELL34:IMUX_A4SERDES.Q0P_HALTGTCAREQDES79
TCELL34:IMUX_A5SERDES.Q0P_HALTGTCAREQDES78
TCELL34:IMUX_B2SERDES.Q0P_HALTGTCAREQDES77
TCELL34:IMUX_B3SERDES.Q0P_HALTGTCAREQDES76
TCELL34:IMUX_B4SERDES.Q0P_HALTGTCAREQDES75
TCELL34:IMUX_B5SERDES.Q0P_HALTGTCAREQDES74
TCELL34:IMUX_C2SERDES.Q0P_HALTGTCAREQDES99
TCELL34:IMUX_C3SERDES.Q0P_HALTGTCAREQDES86
TCELL34:IMUX_C4SERDES.Q0P_HALTGTCAREQDES73
TCELL34:IMUX_C5SERDES.Q0P_HALTGTCAREQDES72
TCELL34:IMUX_D2SERDES.Q0P_HALTGTCAREQDES71
TCELL34:IMUX_D3SERDES.Q0P_HALTGTCAREQDES70
TCELL34:IMUX_D4SERDES.Q0P_HALTGTCAREQDES69
TCELL34:IMUX_D5SERDES.Q0P_HALTGTCAREQDES68
TCELL34:OUT_F2SERDES.Q0P_HALMSTRBVLD4
TCELL34:OUT_F3SERDES.Q0P_HALMSTRBVLD3
TCELL34:OUT_F4SERDES.Q0P_HALMSTCOMPDES85
TCELL34:OUT_F5SERDES.Q0P_HALMSTCOMPDES120
TCELL34:OUT_F6SERDES.Q0P_HALMSTCOMPDES84
TCELL34:OUT_F7SERDES.Q0P_HALMSTCOMPDES87
TCELL34:OUT_Q2SERDES.Q0P_HALMSTCOMPDES86
TCELL34:OUT_Q3SERDES.Q0P_HALMSTRBVLD1
TCELL34:OUT_Q4SERDES.Q0P_HALMSTRBVLD7
TCELL34:OUT_Q5SERDES.Q0P_HALMSTRBVLD6
TCELL34:OUT_Q6SERDES.Q0P_HALMSTCOMPVLD
TCELL34:OUT_Q7SERDES.Q0P_HALMSTCOMPSOP
TCELL35:IMUX_A0SERDES.Q0P_HALTGTCAREQDES82
TCELL35:IMUX_A1SERDES.Q0P_HALTGTCAREQDES67
TCELL35:IMUX_A2SERDES.Q0P_HALTGTCAREQDES66
TCELL35:IMUX_A3SERDES.Q0P_HALTGTCAREQDES65
TCELL35:IMUX_A4SERDES.Q0P_HALTGTCAREQDES64
TCELL35:IMUX_A5SERDES.Q0P_HALTGTCAREQDES63
TCELL35:IMUX_B0SERDES.Q0P_HALTGTCAREQDES62
TCELL35:IMUX_B1SERDES.Q0P_HALTGTCAREQDES83
TCELL35:IMUX_B2SERDES.Q0P_HALTGTCAREQDES61
TCELL35:IMUX_B3SERDES.Q0P_HALTGTCAREQDES60
TCELL35:IMUX_B4SERDES.Q0P_HALTGTCAREQDES95
TCELL35:IMUX_B5SERDES.Q0P_HALTGTCAREQDES59
TCELL35:IMUX_C0SERDES.Q0P_HALTGTCAREQDES58
TCELL35:IMUX_C1SERDES.Q0P_HALTGTCAREQDES57
TCELL35:IMUX_C2SERDES.Q0P_HALTGTCAREQDES56
TCELL35:IMUX_C3SERDES.Q0P_HALTGTCAREQDES55
TCELL35:IMUX_C4SERDES.Q0P_HALTGTCAREQDES54
TCELL35:IMUX_C5SERDES.Q0P_HALTGTCAREQDES53
TCELL35:IMUX_D0SERDES.Q0P_HALTGTCAREQDES52
TCELL35:IMUX_D1SERDES.Q0P_HALTGTCAREQDES100
TCELL35:IMUX_D2SERDES.Q0P_HALTGTCAREQDES51
TCELL35:IMUX_D3SERDES.Q0P_HALTGTCAREQDES50
TCELL35:IMUX_D4SERDES.Q0P_HALTGTCAREQDES49
TCELL35:IMUX_D5SERDES.Q0P_HALTGTCAREQDES48
TCELL35:OUT_F0SERDES.Q0P_HALMSTRBVLD0
TCELL35:OUT_F1SERDES.Q0P_HALMSTCOMPDES0
TCELL35:OUT_F2SERDES.Q0P_HALMSTCOMPDES83
TCELL35:OUT_F3SERDES.Q0P_HALMSTCOMPEOP
TCELL35:OUT_F4SERDES.Q0P_HALMSTCOMPDES1
TCELL35:OUT_F5SERDES.Q0P_HALMSTRBVLD5
TCELL35:OUT_F6SERDES.Q0P_HALMSTCOMPDES80
TCELL35:OUT_F7SERDES.Q0P_HALMSTCOMPDES100
TCELL35:OUT_Q0SERDES.Q0P_HALMSTCOMPDES2
TCELL35:OUT_Q1SERDES.Q0P_SCANO6
TCELL35:OUT_Q2SERDES.Q0P_HALMSTRBVLD2
TCELL35:OUT_Q3SERDES.Q0P_HALMSTCOMPDES81
TCELL35:OUT_Q4SERDES.Q0P_HALMSTCOMPDES99
TCELL35:OUT_Q5SERDES.Q0P_HALMSTCOMPDES30
TCELL35:OUT_Q6SERDES.Q0P_HALMSTCOMPDES96
TCELL35:OUT_Q7SERDES.Q0P_HALMSTCOMPDES38
TCELL36:IMUX_A0SERDES.Q0P_HALTGTCAREQDES81
TCELL36:IMUX_A1SERDES.Q0P_HALTGTCAREQDES101
TCELL36:IMUX_A2SERDES.Q0P_HALTGTCAREQDES47
TCELL36:IMUX_A3SERDES.Q0P_HALTGTCAREQDES46
TCELL36:IMUX_A4SERDES.Q0P_HALTGTCAREQDES45
TCELL36:IMUX_A5SERDES.Q0P_HALTGTCAREQDES44
TCELL36:IMUX_B0SERDES.Q0P_HALTGTCAREQDES43
TCELL36:IMUX_B1SERDES.Q0P_HALTGTCAREQDES42
TCELL36:IMUX_B2SERDES.Q0P_HALTGTCAREQDES41
TCELL36:IMUX_B3SERDES.Q0P_HALTGTCAREQDES40
TCELL36:IMUX_B4SERDES.Q0P_HALTGTCAREQDES39
TCELL36:IMUX_B5SERDES.Q0P_HALTGTCAREQDES38
TCELL36:IMUX_C0SERDES.Q0P_HALTGTCAREQDES37
TCELL36:IMUX_C1SERDES.Q0P_HALTGTCAREQDES102
TCELL36:IMUX_C2SERDES.Q0P_HALTGTCAREQDES103
TCELL36:IMUX_C3SERDES.Q0P_HALTGTCAREQDES36
TCELL36:IMUX_C4SERDES.Q0P_HALTGTCAREQDES35
TCELL36:IMUX_C5SERDES.Q0P_HALTGTCAREQDES34
TCELL36:IMUX_D0SERDES.Q0P_HALTGTCAREQDES33
TCELL36:IMUX_D1SERDES.Q0P_HALTGTCAREQDES32
TCELL36:IMUX_D2SERDES.Q0P_HALTGTCAREQDES31
TCELL36:IMUX_D3SERDES.Q0P_HALTGTCAREQDES30
TCELL36:IMUX_D4SERDES.Q0P_HALTGTCAREQDES29
TCELL36:IMUX_D5SERDES.Q0P_HALTGTCAREQDES28
TCELL36:OUT_F0SERDES.Q0P_HALMSTCOMPDES97
TCELL36:OUT_F1SERDES.Q0P_HALMSTCOMPDES98
TCELL36:OUT_F2SERDES.Q0P_HALMSTCOMPDES82
TCELL36:OUT_F3SERDES.Q0P_HALMSTCOMPDES32
TCELL36:OUT_F4SERDES.Q0P_HALMSTCOMPDES55
TCELL36:OUT_F5SERDES.Q0P_HALMSTCOMPDES37
TCELL36:OUT_F6SERDES.Q0P_HALMSTCOMPDES123
TCELL36:OUT_F7SERDES.Q0P_HALMSTCOMPDES33
TCELL36:OUT_Q0SERDES.Q0P_HALMSTCOMPDES11
TCELL36:OUT_Q1SERDES.Q0P_HALMSTCOMPDES3
TCELL36:OUT_Q2SERDES.Q0P_HALMSTCOMPDES5
TCELL36:OUT_Q3SERDES.Q0P_HALMSTCOMPDES34
TCELL36:OUT_Q4SERDES.Q0P_HALMSTCOMPDES48
TCELL36:OUT_Q5SERDES.Q0P_HALMSTCOMPDES122
TCELL36:OUT_Q6SERDES.Q0P_HALMSTCOMPDES4
TCELL36:OUT_Q7SERDES.Q0P_HALMSTCOMPDES14
TCELL37:IMUX_A0SERDES.Q0P_HALTGTCAREQDES27
TCELL37:IMUX_A1SERDES.Q0P_HALTGTCAREQDES26
TCELL37:IMUX_A2SERDES.Q0P_HALTGTCAREQDES25
TCELL37:IMUX_A3SERDES.Q0P_HALTGTCAREQDES24
TCELL37:IMUX_B0SERDES.Q0P_HALTGTCAREQDES23
TCELL37:IMUX_B1SERDES.Q0P_HALTGTCAREQDES22
TCELL37:IMUX_B2SERDES.Q0P_HALTGTCAREQDES21
TCELL37:IMUX_B3SERDES.Q0P_HALTGTCAREQDES20
TCELL37:IMUX_C0SERDES.Q0P_HALTGTCAREQDES19
TCELL37:IMUX_C1SERDES.Q0P_HALTGTCAREQDES18
TCELL37:IMUX_C2SERDES.Q0P_HALTGTCAREQDES17
TCELL37:IMUX_C3SERDES.Q0P_HALTGTCAREQDES16
TCELL37:IMUX_D0SERDES.Q0P_HALTGTCAREQDES15
TCELL37:IMUX_D1SERDES.Q0P_HALTGTCAREQDES14
TCELL37:IMUX_D2SERDES.Q0P_HALTGTCAREQDES13
TCELL37:IMUX_D3SERDES.Q0P_HALTGTCAREQDES12
TCELL37:OUT_F0SERDES.Q0P_HALMSTCOMPDES6
TCELL37:OUT_F1SERDES.Q0P_HALMSTCOMPDES121
TCELL37:OUT_F2SERDES.Q0P_HALMSTCOMPDES63
TCELL37:OUT_F3SERDES.Q0P_HALMSTCOMPDES60
TCELL37:OUT_F6SERDES.Q0P_HALMSTCOMPDES50
TCELL37:OUT_F7SERDES.Q0P_HALMSTCOMPDES51
TCELL37:OUT_Q0SERDES.Q0P_HALMSTCOMPDES59
TCELL37:OUT_Q1SERDES.Q0P_HALMSTCOMPDES36
TCELL37:OUT_Q2SERDES.Q0P_HALMSTCOMPDES47
TCELL37:OUT_Q3SERDES.Q0P_HALMSTCOMPDES35
TCELL37:OUT_Q6SERDES.Q0P_HALMSTCOMPDES15
TCELL37:OUT_Q7SERDES.Q0P_HALMSTCOMPDES13
TCELL38:IMUX_A0SERDES.Q0P_HALTGTCAREQDES11
TCELL38:IMUX_A1SERDES.Q0P_HALTGTCAREQDES10
TCELL38:IMUX_A2SERDES.Q0P_HALTGTCAREQDES9
TCELL38:IMUX_A3SERDES.Q0P_HALTGTCAREQDES8
TCELL38:IMUX_A4SERDES.Q0P_HALTGTCAREQDES7
TCELL38:IMUX_A5SERDES.Q0P_HALTGTCAREQDES6
TCELL38:IMUX_B0SERDES.Q0P_HALTGTCAREQDES5
TCELL38:IMUX_B1SERDES.Q0P_HALTGTCAREQDES4
TCELL38:IMUX_B2SERDES.Q0P_HALTGTCAREQDES3
TCELL38:IMUX_B3SERDES.Q0P_HALTGTCAREQDES2
TCELL38:IMUX_B4SERDES.Q0P_HALTGTCAREQDES1
TCELL38:IMUX_B5SERDES.Q0P_HALTGTACK
TCELL38:IMUX_C0SERDES.Q0P_HALTGTWRDY
TCELL38:IMUX_C1SERDES.Q0P_HALTGTCAREQDES0
TCELL38:IMUX_C2SERDES.Q0P_HALMSTREQDES124
TCELL38:IMUX_C3SERDES.Q0P_HALMSTREQDES123
TCELL38:IMUX_C4SERDES.Q0P_HALMSTREQDES125
TCELL38:IMUX_C5SERDES.Q0P_HALMSTREQDES122
TCELL38:IMUX_D0SERDES.Q0P_HALMSTREQDES121
TCELL38:IMUX_D1SERDES.Q0P_HALTGTCAREQDES120
TCELL38:IMUX_D2SERDES.Q0P_HALMSTREQDES120
TCELL38:IMUX_D3SERDES.Q0P_HALMSTREQDES119
TCELL38:IMUX_D4SERDES.Q0P_HALMSTREQDES118
TCELL38:IMUX_D5SERDES.Q0P_HALMSTREQDES117
TCELL38:OUT_F0SERDES.Q0P_HALMSTCOMPDES31
TCELL38:OUT_F1SERDES.Q0P_HALMSTCOMPDES17
TCELL38:OUT_F2SERDES.Q0P_MAXREADREQSIZE1
TCELL38:OUT_F3SERDES.Q0P_HALMSTCOMPDES53
TCELL38:OUT_F4SERDES.Q0P_HALMSTCOMPDES49
TCELL38:OUT_F5SERDES.Q0P_HALMSTCOMPDES61
TCELL38:OUT_F6SERDES.Q0P_HALMSTCOMPDES46
TCELL38:OUT_F7SERDES.Q0P_HALMSTCOMPDES45
TCELL38:OUT_Q0SERDES.Q0P_HALMSTCOMPDES58
TCELL38:OUT_Q1SERDES.Q0P_HALMSTCOMPDES40
TCELL38:OUT_Q2SERDES.Q0P_HALMSTCOMPDES20
TCELL38:OUT_Q3SERDES.Q0P_HALMSTCOMPDES44
TCELL38:OUT_Q4SERDES.Q0P_HALMSTCOMPDES8
TCELL38:OUT_Q5SERDES.Q0P_HALMSTCOMPDES23
TCELL38:OUT_Q6SERDES.Q0P_HALMSTCOMPDES54
TCELL38:OUT_Q7SERDES.Q0P_HALMSTCOMPDES56
TCELL39:IMUX_A0SERDES.Q0P_HALMSTREQDES116
TCELL39:IMUX_A1SERDES.Q0P_HALMSTREQDES113
TCELL39:IMUX_A2SERDES.Q0P_HALMSTREQDES112
TCELL39:IMUX_A3SERDES.Q0P_HALMSTREQDES111
TCELL39:IMUX_A4SERDES.Q0P_HALMSTREQDES109
TCELL39:IMUX_A5SERDES.Q0P_HALMSTREQDES108
TCELL39:IMUX_B0SERDES.Q0P_HALMSTREQDES114
TCELL39:IMUX_B1SERDES.Q0P_HALMSTREQDES106
TCELL39:IMUX_B2SERDES.Q0P_HALMSTREQDES105
TCELL39:IMUX_B3SERDES.Q0P_HALMSTREQDES104
TCELL39:IMUX_B4SERDES.Q0P_HALMSTREQDES103
TCELL39:IMUX_B5SERDES.Q0P_HALMSTREQDES102
TCELL39:IMUX_C0SERDES.Q0P_HALMSTREQDES126
TCELL39:IMUX_C1SERDES.Q0P_HALMSTREQDES107
TCELL39:IMUX_C2SERDES.Q0P_HALMSTREQDES115
TCELL39:IMUX_C3SERDES.Q0P_HALMSTREQDES110
TCELL39:IMUX_C4SERDES.Q0P_HALMSTREQDES101
TCELL39:IMUX_C5SERDES.Q0P_HALMSTREQDES100
TCELL39:IMUX_D0SERDES.Q0P_HALMSTREQDES99
TCELL39:IMUX_D1SERDES.Q0P_HALMSTREQDES98
TCELL39:IMUX_D2SERDES.Q0P_HALMSTREQDES97
TCELL39:IMUX_D3SERDES.Q0P_HALMSTREQDES96
TCELL39:IMUX_D4SERDES.Q0P_HALMSTREQDES95
TCELL39:IMUX_D5SERDES.Q0P_HALMSTREQDES94
TCELL39:OUT_F0SERDES.Q0P_HALMSTCOMPDES52
TCELL39:OUT_F1SERDES.Q0P_HALMSTCOMPDES9
TCELL39:OUT_F2SERDES.Q0P_HALMSTCOMPDES10
TCELL39:OUT_F3SERDES.Q0P_HALMSTCOMPDES43
TCELL39:OUT_F4SERDES.Q0P_HALMSTCOMPDES7
TCELL39:OUT_F5SERDES.Q0P_HALMSTCOMPDES29
TCELL39:OUT_F6SERDES.Q0P_HALMSTCOMPDES12
TCELL39:OUT_F7SERDES.Q0P_HALMSTCOMPDES41
TCELL39:OUT_Q0SERDES.Q0P_HALMSTCOMPDES16
TCELL39:OUT_Q1SERDES.Q0P_HALMSTCOMPDES62
TCELL39:OUT_Q2SERDES.Q0P_HALMSTCOMPDES57
TCELL39:OUT_Q3SERDES.Q0P_HALMSTCOMPDES42
TCELL39:OUT_Q4SERDES.Q0P_HALMSTCOMPDES22
TCELL39:OUT_Q5SERDES.Q0P_HALMSTCOMPDES19
TCELL39:OUT_Q6SERDES.Q0P_HALMSTCOMPDES39
TCELL39:OUT_Q7SERDES.Q0P_RCBSTS
TCELL40:IMUX_A2SERDES.Q0P_HALMSTREQDES93
TCELL40:IMUX_A3SERDES.Q0P_HALMSTREQDES92
TCELL40:IMUX_A4SERDES.Q0P_HALMSTREQDES91
TCELL40:IMUX_A5SERDES.Q0P_HALMSTREQDES90
TCELL40:IMUX_B2SERDES.Q0P_HALMSTREQDES89
TCELL40:IMUX_B3SERDES.Q0P_HALMSTREQDES88
TCELL40:IMUX_B4SERDES.Q0P_HALMSTREQDES87
TCELL40:IMUX_B5SERDES.Q0P_HALMSTREQDES85
TCELL40:IMUX_C2SERDES.Q0P_HALMSTREQDES84
TCELL40:IMUX_C3SERDES.Q0P_HALTGTCOMPERR
TCELL40:IMUX_C4SERDES.Q0P_HALTGTCOMPVLD
TCELL40:IMUX_C5SERDES.Q0P_HALTGTCOMPSOP
TCELL40:IMUX_D2SERDES.Q0P_HALMSTREQDES83
TCELL40:IMUX_D3SERDES.Q0P_HALMSTREQDES82
TCELL40:IMUX_D4SERDES.Q0P_HALMSTREQDES81
TCELL40:IMUX_D5SERDES.Q0P_HALMSTREQDES79
TCELL40:OUT_F2SERDES.Q0P_HALMSTCOMPDES28
TCELL40:OUT_F3SERDES.Q0P_HALMSTCOMPDES26
TCELL40:OUT_F4SERDES.Q0P_MSIXMASK
TCELL40:OUT_F5SERDES.Q0P_HALMSTCOMPDES27
TCELL40:OUT_F6SERDES.Q0P_HALMSTCOMPDES25
TCELL40:OUT_F7SERDES.Q0P_HALMSTCOMPDES24
TCELL40:OUT_Q2SERDES.Q0P_HALMSTCOMPDES18
TCELL40:OUT_Q3SERDES.Q0P_HALMSTCOMPDES21
TCELL40:OUT_Q4SERDES.Q0P_FTLERROUT
TCELL40:OUT_Q5SERDES.Q0P_MAXREADREQSIZE2
TCELL40:OUT_Q6SERDES.Q0P_TPHSTMODE2
TCELL40:OUT_Q7SERDES.Q0P_FUNCSTS2
TCELL41:IMUX_A0SERDES.Q0P_HALTGTCOMPEOP
TCELL41:IMUX_A1SERDES.Q0P_HALMSTREQDES75
TCELL41:IMUX_A2SERDES.Q0P_HALMSTREQDES74
TCELL41:IMUX_A3SERDES.Q0P_HALMSTREQDES72
TCELL41:IMUX_A4SERDES.Q0P_HALMSTREQDES127
TCELL41:IMUX_A5SERDES.Q0P_HALMSTREQ
TCELL41:IMUX_B0SERDES.Q0P_HALMSTREQDES71
TCELL41:IMUX_B1SERDES.Q0P_HALMSTREQDES77
TCELL41:IMUX_B2SERDES.Q0P_HALMSTREQDES80
TCELL41:IMUX_B3SERDES.Q0P_HALMSTREQDES70
TCELL41:IMUX_B4SERDES.Q0P_HALTGTNPREJ
TCELL41:IMUX_B5SERDES.Q0P_HALMSTREQDES76
TCELL41:IMUX_C0SERDES.Q0P_HALMSTREQDES64
TCELL41:IMUX_C1SERDES.Q0P_HALMSTREQDES65
TCELL41:IMUX_C2SERDES.Q0P_HALMSTREQDES78
TCELL41:IMUX_C3SERDES.Q0P_HALMSTREQDES63
TCELL41:IMUX_C4SERDES.Q0P_HALMSTREQDES62
TCELL41:IMUX_C5SERDES.Q0P_HALMSTREQDES66
TCELL41:IMUX_D0SERDES.Q0P_HALMSTREQDES57
TCELL41:IMUX_D1SERDES.Q0P_HALMSTREQDES58
TCELL41:IMUX_D2SERDES.Q0P_HALMSTREQDES60
TCELL41:IMUX_D3SERDES.Q0P_HALMSTREQDES61
TCELL41:IMUX_D4SERDES.Q0P_HALMSTREQDES69
TCELL41:IMUX_D5SERDES.Q0P_HALMSTREQDES68
TCELL41:OUT_F1SERDES.Q0P_FUNCPWRSTATE1
TCELL41:OUT_F2SERDES.Q0P_TPHSTMODE0
TCELL41:OUT_F3SERDES.Q0P_FUNCPWRSTATE0
TCELL41:OUT_F5SERDES.Q0P_CORERROUT
TCELL41:OUT_F6SERDES.Q0P_FUNCSTS1
TCELL41:OUT_F7SERDES.Q0P_NFTLERROUT
TCELL41:OUT_Q0SERDES.Q0P_FUNCPWRSTATE2
TCELL41:OUT_Q1SERDES.Q0P_HALMSTREJ
TCELL41:OUT_Q2SERDES.Q0P_SCANO10
TCELL41:OUT_Q3SERDES.Q0P_FUNCSTS0
TCELL41:OUT_Q4SERDES.Q0P_HALMSTACK
TCELL41:OUT_Q5SERDES.Q0P_MSIXEN
TCELL41:OUT_Q6SERDES.Q0P_MAXREADREQSIZE0
TCELL41:OUT_Q7SERDES.Q0P_FUNCSTS3
TCELL42:IMUX_A0SERDES.Q0P_HALMSTREQDES59
TCELL42:IMUX_A1SERDES.Q0P_HALMSTREQDES56
TCELL42:IMUX_A2SERDES.Q0P_HALMSTREQDES73
TCELL42:IMUX_A3SERDES.Q0P_HALMSTREQDES54
TCELL42:IMUX_A4SERDES.Q0P_HALMSTREQDES55
TCELL42:IMUX_A5SERDES.Q0P_HALMSTREQDES67
TCELL42:IMUX_B0SERDES.Q0P_HALMSTREQDES53
TCELL42:IMUX_B1SERDES.Q0P_HALMSTREQDES50
TCELL42:IMUX_B2SERDES.Q0P_HALMSTREQDES46
TCELL42:IMUX_B3SERDES.Q0P_HALMSTREQDES47
TCELL42:IMUX_B4SERDES.Q0P_HALMSTREQDES51
TCELL42:IMUX_B5SERDES.Q0P_HALMSTREQDES52
TCELL42:IMUX_C0SERDES.Q0P_HALMSTREQDES49
TCELL42:IMUX_C1SERDES.Q0P_HALMSTREQDES48
TCELL42:IMUX_C2SERDES.Q0P_HALMSTREQDES45
TCELL42:IMUX_C3SERDES.Q0P_HALMSTREQDES43
TCELL42:IMUX_C4SERDES.Q0P_HALMSTREQDES42
TCELL42:IMUX_C5SERDES.Q0P_HALMSTREQDES44
TCELL42:IMUX_D0SERDES.Q0P_HALMSTREQDES40
TCELL42:IMUX_D1SERDES.Q0P_HALMSTREQDES7
TCELL42:IMUX_D2SERDES.Q0P_HALMSTREQDES39
TCELL42:IMUX_D3SERDES.Q0P_HALMSTREQDES23
TCELL42:IMUX_D4SERDES.Q0P_HALMSTREQDES37
TCELL42:IMUX_D5SERDES.Q0P_HALMSTREQDES41
TCELL42:OUT_F0SERDES.Q0P_TPHSTMODE1
TCELL42:OUT_F1SERDES.Q0P_HALMSTTAG2
TCELL42:OUT_F2SERDES.Q0P_LCLINT
TCELL42:OUT_F3SERDES.Q0P_HALMSTTAG1
TCELL42:OUT_F4SERDES.Q0P_HALMSTTAG3
TCELL42:OUT_F5SERDES.Q0P_HALMSTTAG4
TCELL42:OUT_F6SERDES.Q0P_HALMSTTAG0
TCELL42:OUT_F7SERDES.Q0P_MSIMSGABRT
TCELL42:OUT_Q0SERDES.Q0P_TPHREQENABLE
TCELL42:OUT_Q1SERDES.Q0P_DBGDATOUT5
TCELL42:OUT_Q2SERDES.Q0P_MSIMSGSENT
TCELL42:OUT_Q3SERDES.Q0P_DBGDATOUT7
TCELL42:OUT_Q4SERDES.Q0P_DBGDATOUT8
TCELL42:OUT_Q5SERDES.Q0P_SCANO12
TCELL42:OUT_Q6SERDES.Q0P_DBGDATOUT12
TCELL42:OUT_Q7SERDES.Q0P_DBGDATOUT6
TCELL43:IMUX_A0SERDES.Q0P_HALMSTREQDES38
TCELL43:IMUX_A1SERDES.Q0P_HALMSTREQDES20
TCELL43:IMUX_A2SERDES.Q0P_HALMSTREQDES36
TCELL43:IMUX_A3SERDES.Q0P_HALMSTREQDES9
TCELL43:IMUX_A4SERDES.Q0P_HALMSTREQDES19
TCELL43:IMUX_A5SERDES.Q0P_HALMSTWBVLD1
TCELL43:IMUX_B0SERDES.Q0P_HALMSTREQDES8
TCELL43:IMUX_B1SERDES.Q0P_HALMSTREQDES17
TCELL43:IMUX_B2SERDES.Q0P_HALMSTREQDES21
TCELL43:IMUX_B3SERDES.Q0P_HALMSTREQDES22
TCELL43:IMUX_B4SERDES.Q0P_HALMSTREQDES12
TCELL43:IMUX_B5SERDES.Q0P_HALMSTWBVLD2
TCELL43:IMUX_C0SERDES.Q0P_HALMSTREQDES34
TCELL43:IMUX_C1SERDES.Q0P_HALMSTREQDES1
TCELL43:IMUX_C2SERDES.Q0P_HALMSTREQDES10
TCELL43:IMUX_C3SERDES.Q0P_HALMSTREQDES11
TCELL43:IMUX_C4SERDES.Q0P_HALMSTREQDES16
TCELL43:IMUX_C5SERDES.Q0P_HALMSTREQDES35
TCELL43:IMUX_D0SERDES.Q0P_HALMSTREQDES6
TCELL43:IMUX_D1SERDES.Q0P_HALMSTREQDES5
TCELL43:IMUX_D2SERDES.Q0P_HALMSTREQDES18
TCELL43:IMUX_D3SERDES.Q0P_HALMSTREQDES4
TCELL43:IMUX_D4SERDES.Q0P_HALMSTREQDES3
TCELL43:IMUX_D5SERDES.Q0P_HALMSTREQDES2
TCELL43:OUT_F0SERDES.Q0P_SCANO4
TCELL43:OUT_F1SERDES.Q0P_DBGDATOUT14
TCELL43:OUT_F2SERDES.Q0P_DBGDATOUT4
TCELL43:OUT_F3SERDES.Q0P_DBGDATOUT9
TCELL43:OUT_F4SERDES.Q0P_DBGDATOUT0
TCELL43:OUT_F5SERDES.Q0P_DBGDATOUT2
TCELL43:OUT_F6SERDES.Q0P_DBGDATOUT13
TCELL43:OUT_F7SERDES.Q0P_DBGDATOUT1
TCELL43:OUT_Q0SERDES.Q0P_HALMSTCOMPDES124
TCELL43:OUT_Q1SERDES.Q0P_DBGDATOUT3
TCELL43:OUT_Q2SERDES.Q0P_DBGDATOUT11
TCELL43:OUT_Q3SERDES.Q0P_LTSSMSTATE5
TCELL43:OUT_Q4SERDES.Q0P_DBGDATOUT10
TCELL43:OUT_Q5SERDES.Q0P_DBGDATOUT15
TCELL43:OUT_Q6SERDES.Q0P_LNKSTS0
TCELL43:OUT_Q7SERDES.Q0P_LTSSMSTATE0
TCELL44:IMUX_A0SERDES.Q0P_HALMSTREQDES15
TCELL44:IMUX_A1SERDES.Q0P_HALMSTREQDES33
TCELL44:IMUX_A2SERDES.Q0P_HALMSTWEOP
TCELL44:IMUX_A3SERDES.Q0P_HALMSTREQDES32
TCELL44:IMUX_A4SERDES.Q0P_HALMSTWBVLD0
TCELL44:IMUX_A5SERDES.Q0P_HALMSTWDATVLD
TCELL44:IMUX_B0SERDES.Q0P_HALMSTREQDES0
TCELL44:IMUX_B1SERDES.Q0P_HALMSTREQDES31
TCELL44:IMUX_B2SERDES.Q0P_HALMSTREQDES14
TCELL44:IMUX_B3SERDES.Q0P_HALMSTREQDES13
TCELL44:IMUX_B4SERDES.Q0P_HALMSTWERR
TCELL44:IMUX_B5SERDES.Q0P_HALMSTWBVLD6
TCELL44:IMUX_C0SERDES.Q0P_HALMSTWBVLD7
TCELL44:IMUX_C1SERDES.Q0P_HALMSTWBVLD3
TCELL44:IMUX_C2SERDES.Q0P_HALMSTWBVLD4
TCELL44:IMUX_C3SERDES.Q0P_HALMSTREQDES25
TCELL44:IMUX_C4SERDES.Q0P_HALMSTREQDES28
TCELL44:IMUX_C5SERDES.Q0P_HALMSTREQDES30
TCELL44:IMUX_D0SERDES.Q0P_HALMSTREQDES29
TCELL44:IMUX_D1SERDES.Q0P_HALMSTREQDES27
TCELL44:IMUX_D2SERDES.Q0P_HALMSTREQDES24
TCELL44:IMUX_D3SERDES.Q0P_HALMSTWBVLD5
TCELL44:IMUX_D4SERDES.Q0P_HALMSTREQDES26
TCELL44:IMUX_D5SERDES.Q0P_INTAI
TCELL44:OUT_F0SERDES.Q0P_LTSSMSTATE4
TCELL44:OUT_F1SERDES.Q0P_LTSSMSTATE1
TCELL44:OUT_F2SERDES.Q0P_SCANO3
TCELL44:OUT_F3SERDES.Q0P_LTSSMSTATE2
TCELL44:OUT_F4SERDES.Q0P_HALMSTRERR
TCELL44:OUT_F5SERDES.Q0P_SCANO13
TCELL44:OUT_F6SERDES.Q0P_LTSSMSTATE3
TCELL44:OUT_F7SERDES.Q0P_LNKPWRSTATE3
TCELL44:OUT_Q0SERDES.Q0P_SCANO17
TCELL44:OUT_Q1SERDES.Q0P_HALTGTREQDES118
TCELL44:OUT_Q2SERDES.Q0P_HALTGTREQDES119
TCELL44:OUT_Q3SERDES.Q0P_HALTGTREQDES117
TCELL44:OUT_Q4SERDES.Q0P_HALTGTREQDES116
TCELL44:OUT_Q5SERDES.Q0P_HALTGTREQDES114
TCELL44:OUT_Q6SERDES.Q0P_HALTGTREQDES113
TCELL44:OUT_Q7SERDES.Q0P_HALTGTREQDES115
TCELL45:IMUX_A0SERDES.Q0P_HALMSTREQATTR0
TCELL45:IMUX_A1SERDES.Q0P_HALMSTREQATTR1
TCELL45:IMUX_A2SERDES.Q0P_HALMSTCOMPRDY
TCELL45:IMUX_A3SERDES.Q0P_MSIATTRIN2
TCELL45:IMUX_A4SERDES.Q0P_HALMSTREQDES86
TCELL45:IMUX_A5SERDES.Q0P_HALTGTCAREQDES108
TCELL45:IMUX_B0SERDES.Q0P_HALTGTCAREQDES110
TCELL45:IMUX_B1SERDES.Q0P_HALTGTCAREQDES112
TCELL45:IMUX_B2SERDES.Q0P_HALTGTCAREQDES113
TCELL45:IMUX_B3SERDES.Q0P_HALTGTCAREQDES116
TCELL45:IMUX_B4SERDES.Q0P_HALTGTCAREQDES118
TCELL45:IMUX_B5SERDES.Q0P_HALTGTCAREQDES124
TCELL45:IMUX_C0SERDES.Q0P_HALTGTCAREQDES126
TCELL45:IMUX_C1SERDES.Q0P_HALTGTCOMPDES119
TCELL45:IMUX_C2SERDES.Q0P_HALTGTCAREQDES127
TCELL45:IMUX_C3SERDES.Q0P_HALTGTCAREQDES125
TCELL45:IMUX_C4SERDES.Q0P_HALTGTCAREQDES123
TCELL45:IMUX_C5SERDES.Q0P_HALTGTCAREQDES122
TCELL45:IMUX_D0SERDES.Q0P_HALTGTCAREQDES119
TCELL45:IMUX_D1SERDES.Q0P_HALTGTCAREQDES117
TCELL45:IMUX_D2SERDES.Q0P_HALTGTCAREQDES115
TCELL45:IMUX_D3SERDES.Q0P_HALTGTCAREQDES114
TCELL45:IMUX_D4SERDES.Q0P_HALTGTCAREQDES111
TCELL45:IMUX_D5SERDES.Q0P_HALTGTCAREQDES109
TCELL45:OUT_F0SERDES.Q0P_HALTGTREQDES108
TCELL45:OUT_F1SERDES.Q0P_HALTGTREQDES112
TCELL45:OUT_F2SERDES.Q0P_HALTGTREQDES107
TCELL45:OUT_F3SERDES.Q0P_NEGLNKWIDTH0
TCELL45:OUT_F4SERDES.Q0P_LNKSTS1
TCELL45:OUT_F5SERDES.Q0P_NEGLNKWIDTH1
TCELL45:OUT_F6SERDES.Q0P_MAXPYLDSIZE0
TCELL45:OUT_F7SERDES.Q0P_LNKPWRSTATE2
TCELL45:OUT_Q0SERDES.Q0P_MAXPYLDSIZE2
TCELL45:OUT_Q1SERDES.Q0P_LNKDWNRSTOUT
TCELL45:OUT_Q2SERDES.Q0P_NEGSPEED
TCELL45:OUT_Q3SERDES.Q0P_LNKPWRSTATE1
TCELL45:OUT_Q4SERDES.Q0P_SCANO0
TCELL45:OUT_Q5SERDES.Q0P_SCANO16
TCELL45:OUT_Q6SERDES.Q0P_SCANO15
TCELL45:OUT_Q7SERDES.Q0P_MAXPYLDSIZE1
TCELL46:IMUX_A2SERDES.Q0P_HALTGTCAREQDES107
TCELL46:IMUX_A3SERDES.Q0P_HALMSTREQATTR2
TCELL46:IMUX_A4SERDES.Q0P_MSIXATTRIN2
TCELL46:IMUX_A5SERDES.Q0P_CORERRIN
TCELL46:IMUX_A6SERDES.Q0P_PWRSTATECHNGACK
TCELL46:IMUX_A7SERDES.Q0P_MSIXMSGDAT10
TCELL46:IMUX_B2SERDES.Q0P_MSIXMSGDAT27
TCELL46:IMUX_B3SERDES.Q0P_MSIXMSGDAT30
TCELL46:IMUX_B4SERDES.Q0P_MSIXMSGDAT28
TCELL46:IMUX_B5SERDES.Q0P_MSIXMSGDAT23
TCELL46:IMUX_B6SERDES.Q0P_MSIXMSGDAT4
TCELL46:IMUX_B7SERDES.Q0P_MSIXMSGDAT18
TCELL46:IMUX_C2SERDES.Q0P_MSIXMSGDAT21
TCELL46:IMUX_C3SERDES.Q0P_MSIXMSGDAT29
TCELL46:IMUX_C4SERDES.Q0P_MSIXMSGDAT11
TCELL46:IMUX_C5SERDES.Q0P_MSIXMSGDAT20
TCELL46:IMUX_C6SERDES.Q0P_MSIXMSGDAT22
TCELL46:IMUX_C7SERDES.Q0P_MSIXMSGDAT31
TCELL46:IMUX_D2SERDES.Q0P_MSIXMSGDAT24
TCELL46:IMUX_D3SERDES.Q0P_MSIXMSGDAT25
TCELL46:IMUX_D4SERDES.Q0P_MSIXMSGDAT17
TCELL46:IMUX_D5SERDES.Q0P_MSIXMSGDAT16
TCELL46:IMUX_D6SERDES.Q0P_MSIXMSGDAT15
TCELL46:IMUX_D7SERDES.Q0P_MSIXMSGDAT26
TCELL46:OUT_F2SERDES.Q0P_SCANO24
TCELL46:OUT_F3SERDES.Q0P_LNKPWRSTATE0
TCELL46:OUT_F4SERDES.Q0P_MSIXMSGSENT
TCELL46:OUT_F5SERDES.Q0P_HOTRSTOUT
TCELL46:OUT_F6SERDES.Q0P_SCANO23
TCELL47:IMUX_A2SERDES.Q0P_MSIXMSGDAT19
TCELL47:IMUX_A3SERDES.Q0P_MSIXMSGDAT14
TCELL47:IMUX_A4SERDES.Q0P_MSIXMSGDAT13
TCELL47:IMUX_A5SERDES.Q0P_MSIXMSGDAT1
TCELL47:IMUX_A6SERDES.Q0P_MSIXMSGDAT0
TCELL47:IMUX_A7SERDES.Q0P_MSIXMSGDAT12
TCELL47:IMUX_B2SERDES.Q0P_MSIXMSGDAT6
TCELL47:IMUX_B3SERDES.Q0P_MSIXMSGDAT2
TCELL47:IMUX_B4SERDES.Q0P_MSIXMSGDAT7
TCELL47:IMUX_B5SERDES.Q0P_MSIXMSGDAT5
TCELL47:IMUX_B6SERDES.Q0P_MSIXMSGDAT3
TCELL47:IMUX_B7SERDES.Q0P_MSIXMSGDAT9
TCELL47:IMUX_C2SERDES.Q0P_MSIXMSGDAT8
TCELL47:IMUX_C3SERDES.Q0P_INTBI
TCELL47:IMUX_C4SERDES.Q0P_INTCI
TCELL47:IMUX_C5SERDES.Q0P_INTDI
TCELL47:IMUX_C6SERDES.Q0P_INTPENDSTS
TCELL47:IMUX_C7SERDES.Q0P_HALMSTREQTPHPRESENT
TCELL47:IMUX_D2SERDES.Q0P_MSIXATTRIN1
TCELL47:IMUX_D3SERDES.Q0P_MSIXATTRIN0
TCELL47:IMUX_D4SERDES.Q0P_HALMSTREQTPHTYPE1
TCELL47:IMUX_D5SERDES.Q0P_MSIXREQTPHTYPE1
TCELL47:IMUX_D6SERDES.Q0P_HALMSTREQTPHTYPE0
TCELL47:IMUX_D7SERDES.Q0P_MSIXREQTPHTYPE0
TCELL48:IMUX_A2SERDES.Q0P_MSIXREQTPHPRESENT
TCELL48:IMUX_A3SERDES.Q0P_MSIXREQTPHSTTAG4
TCELL48:IMUX_A4SERDES.Q0P_HALMSTREQTPHSTTAG4
TCELL48:IMUX_A5SERDES.Q0P_HALMSTREQTPHSTTAG2
TCELL48:IMUX_A6SERDES.Q0P_MSIXREQTPHSTTAG2
TCELL48:IMUX_A7SERDES.Q0P_HALMSTREQTPHSTTAG1
TCELL48:IMUX_B2SERDES.Q0P_MSIXREQTPHSTTAG1
TCELL48:IMUX_B3SERDES.Q0P_HALMSTREQTPHSTTAG6
TCELL48:IMUX_B4SERDES.Q0P_MSIXREQTPHSTTAG6
TCELL48:IMUX_B5SERDES.Q0P_HALMSTREQTPHSTTAG7
TCELL48:IMUX_B6SERDES.Q0P_MSIXREQTPHSTTAG7
TCELL48:IMUX_B7SERDES.Q0P_HALMSTREQTPHSTTAG3
TCELL48:IMUX_C2SERDES.Q0P_MSIXREQTPHSTTAG3
TCELL48:IMUX_C3SERDES.Q0P_MSIXREQTPHSTTAG0
TCELL48:IMUX_C4SERDES.Q0P_HALMSTREQTPHSTTAG0
TCELL48:IMUX_C5SERDES.Q0P_HALMSTREQTPHSTTAG5
TCELL48:IMUX_C6SERDES.Q0P_MSIXREQTPHSTTAG5
TCELL48:IMUX_C7SERDES.Q0P_MSIREQTPHSTTAG2
TCELL48:IMUX_D2SERDES.Q0P_MSIREQTPHSTTAG1
TCELL48:IMUX_D3SERDES.Q0P_MSIREQTPHPRESENT
TCELL48:IMUX_D4SERDES.Q0P_MSIREQTPHSTTAG4
TCELL48:IMUX_D5SERDES.Q0P_UNCORRERRIN
TCELL48:IMUX_D6SERDES.Q0P_MSIREQTPHTYPE1
TCELL48:IMUX_D7SERDES.Q0P_MSIXMSGADDR0
TCELL49:IMUX_A2SERDES.Q0P_MSIXMSGADDR1
TCELL49:IMUX_A3SERDES.Q0P_MSIXMSGADDR2
TCELL49:IMUX_A4SERDES.Q0P_MSIXMSGADDR3
TCELL49:IMUX_A5SERDES.Q0P_MSIXMSGADDR4
TCELL49:IMUX_A6SERDES.Q0P_MSIXMSGADDR5
TCELL49:IMUX_A7SERDES.Q0P_MSIREQTPHSTTAG3
TCELL49:IMUX_B2SERDES.Q0P_MSIREQTPHSTTAG6
TCELL49:IMUX_B3SERDES.Q0P_MSIXMSGADDR8
TCELL49:IMUX_B4SERDES.Q0P_MSIXMSGADDR6
TCELL49:IMUX_B5SERDES.Q0P_MSIXMSGADDR9
TCELL49:IMUX_B6SERDES.Q0P_MSIXMSGADDR18
TCELL49:IMUX_B7SERDES.Q0P_MSIXMSGADDR15
TCELL49:IMUX_C2SERDES.Q0P_MSIXMSGADDR7
TCELL49:IMUX_C3SERDES.Q0P_MSIXMSGADDR10
TCELL49:IMUX_C4SERDES.Q0P_MSIXMSGVLD
TCELL49:IMUX_C5SERDES.Q0P_MSIXMSGADDR14
TCELL49:IMUX_C6SERDES.Q0P_MSIXMSGADDR11
TCELL49:IMUX_C7SERDES.Q0P_MSIXMSGADDR13
TCELL49:IMUX_D2SERDES.Q0P_MSIATTRIN1
TCELL49:IMUX_D3SERDES.Q0P_MSIATTRIN0
TCELL49:IMUX_D4SERDES.Q0P_MSIREQTPHTYPE0
TCELL49:IMUX_D5SERDES.Q0P_MSIXMSGADDR26
TCELL49:IMUX_D6SERDES.Q0P_MSIXMSGADDR20
TCELL49:IMUX_D7SERDES.Q0P_MSIXMSGADDR17
TCELL50:IMUX_A2SERDES.Q0P_MSIXMSGADDR30
TCELL50:IMUX_A3SERDES.Q0P_MSIXMSGADDR19
TCELL50:IMUX_A4SERDES.Q0P_MSIXMSGADDR16
TCELL50:IMUX_A5SERDES.Q0P_MSIXMSGADDR25
TCELL50:IMUX_A6SERDES.Q0P_MSIREQTPHSTTAG7
TCELL50:IMUX_A7SERDES.Q0P_MSIXMSGADDR28
TCELL50:IMUX_B2SERDES.Q0P_MSIREQTPHSTTAG5
TCELL50:IMUX_B3SERDES.Q0P_MSIXMSGADDR12
TCELL50:IMUX_B4SERDES.Q0P_MSIXMSGADDR29
TCELL50:IMUX_B5SERDES.Q0P_MSIXMSGADDR27
TCELL50:IMUX_B6SERDES.Q0P_MSIREQTPHSTTAG0
TCELL50:IMUX_B7SERDES.Q0P_MSIXMSGADDR21
TCELL50:IMUX_C2SERDES.Q0P_MSIXMSGADDR24
TCELL50:IMUX_C3SERDES.Q0P_MSIXMSGADDR31
TCELL50:IMUX_C4SERDES.Q0P_MSIXMSGADDR22
TCELL50:IMUX_C5SERDES.Q0P_MSIXMSGADDR23
TCELL50:IMUX_C6SERDES.Q0P_MSIASRTINT0
TCELL50:IMUX_C7SERDES.Q0P_MSIASRTINT10
TCELL50:IMUX_D2SERDES.Q0P_MSIASRTINT14
TCELL50:IMUX_D3SERDES.Q0P_MSIASRTINT18
TCELL50:IMUX_D4SERDES.Q0P_MSIASRTINT17
TCELL50:IMUX_D5SERDES.Q0P_MSIASRTINT4
TCELL50:IMUX_D6SERDES.Q0P_MSIASRTINT30
TCELL50:IMUX_D7SERDES.Q0P_MSIASRTINT31
TCELL51:IMUX_A2SERDES.Q0P_MSIASRTINT11
TCELL51:IMUX_A3SERDES.Q0P_MSIASRTINT29
TCELL51:IMUX_A4SERDES.Q0P_MSIASRTINT16
TCELL51:IMUX_A5SERDES.Q0P_MSIASRTINT15
TCELL51:IMUX_A6SERDES.Q0P_MSIASRTINT13
TCELL51:IMUX_A7SERDES.Q0P_MSIASRTINT8
TCELL51:IMUX_B2SERDES.Q0P_MSIASRTINT1
TCELL51:IMUX_B3SERDES.Q0P_MSIASRTINT28
TCELL51:IMUX_B4SERDES.Q0P_MSIASRTINT12
TCELL51:IMUX_B5SERDES.Q0P_MSIASRTINT27
TCELL51:IMUX_B6SERDES.Q0P_MSIASRTINT6
TCELL51:IMUX_B7SERDES.Q0P_MSIXMSGADDR63
TCELL51:IMUX_C2SERDES.Q0P_MSIASRTINT9
TCELL51:IMUX_C3SERDES.Q0P_MSIASRTINT7
TCELL51:IMUX_C4SERDES.Q0P_MSIASRTINT3
TCELL51:IMUX_C5SERDES.Q0P_MSIASRTINT5
TCELL51:IMUX_C6SERDES.Q0P_MSIASRTINT26
TCELL51:IMUX_C7SERDES.Q0P_MSIASRTINT24
TCELL51:IMUX_D2SERDES.Q0P_MSIASRTINT2
TCELL51:IMUX_D3SERDES.Q0P_MSIXMSGADDR60
TCELL51:IMUX_D4SERDES.Q0P_MSIASRTINT19
TCELL51:IMUX_D5SERDES.Q0P_MSIASRTINT21
TCELL51:IMUX_D6SERDES.Q0P_MSIXMSGADDR62
TCELL51:IMUX_D7SERDES.Q0P_MSIASRTINT25
TCELL52:IMUX_A2SERDES.Q0P_MSIXMSGADDR61
TCELL52:IMUX_A3SERDES.Q0P_MSIASRTINT23
TCELL52:IMUX_A4SERDES.Q0P_MSIASRTINT22
TCELL52:IMUX_A5SERDES.Q0P_MSIXMSGADDR59
TCELL52:IMUX_A6SERDES.Q0P_MSIXMSGADDR56
TCELL52:IMUX_A7SERDES.Q0P_MSIASRTINT20
TCELL52:IMUX_B2SERDES.Q0P_MSIXMSGADDR58
TCELL52:IMUX_B3SERDES.Q0P_MSIXMSGADDR57
TCELL52:IMUX_B4SERDES.Q0P_MSIXMSGADDR37
TCELL52:IMUX_B5SERDES.Q0P_MSIXMSGADDR40
TCELL52:IMUX_B6SERDES.Q0P_MSIXMSGADDR49
TCELL52:IMUX_B7SERDES.Q0P_MSIXMSGADDR45
TCELL52:IMUX_C2SERDES.Q0P_MSIXMSGADDR53
TCELL52:IMUX_C3SERDES.Q0P_MSIXMSGADDR51
TCELL52:IMUX_C4SERDES.Q0P_MSIXMSGADDR47
TCELL52:IMUX_C5SERDES.Q0P_MSIXMSGADDR44
TCELL52:IMUX_C6SERDES.Q0P_MSIXMSGADDR46
TCELL52:IMUX_C7SERDES.Q0P_MSIXMSGADDR52
TCELL52:IMUX_D2SERDES.Q0P_MSIXMSGADDR55
TCELL52:IMUX_D3SERDES.Q0P_MSIXMSGADDR50
TCELL52:IMUX_D4SERDES.Q0P_MSIXMSGADDR54
TCELL52:IMUX_D5SERDES.Q0P_MSIXMSGADDR42
TCELL52:IMUX_D6SERDES.Q0P_MSIXMSGADDR43
TCELL52:IMUX_D7SERDES.Q0P_MSIXMSGADDR48
TCELL53:IMUX_A2SERDES.Q0P_MSIXMSGADDR39
TCELL53:IMUX_A3SERDES.Q0P_MSIXMSGADDR38
TCELL53:IMUX_A4SERDES.Q0P_MSIXMSGADDR35
TCELL53:IMUX_A5SERDES.Q0P_MSIXMSGADDR36
TCELL53:IMUX_A6SERDES.Q0P_MSIXMSGADDR41
TCELL53:IMUX_A7SERDES.Q0P_MSIXMSGADDR33
TCELL53:IMUX_B2SERDES.Q0P_MSIXMSGADDR34
TCELL53:IMUX_B3SERDES.Q0P_MSIXMSGADDR32
TCELL61:IMUX_A0SERDES.CORNER_LSPLLPWRUP
TCELL61:IMUX_B0SERDES.CORNER_FCSYNCTOGGLE
TCELL61:IMUX_C0SERDES.CORNER_FCSCANMODE
TCELL61:IMUX_LSR0SERDES.CORNER_LSPLLRST
TCELL61:IMUX_CLK0_DELAYSERDES.CORNER_LSPLLREFCLKI
TCELL61:OUT_F0SERDES.CORNER_FOREFCK2CORE
TCELL61:OUT_Q0SERDES.CORNER_LSPLLLOL

Tile SERDES2

Cells: 120

Bel SERDES

ecp4 SERDES2 bel SERDES
PinDirectionWires
CORNER_FCSCANMODEinputTCELL119:IMUX_C0
CORNER_FCSYNCTOGGLEinputTCELL119:IMUX_B0
CORNER_FOREFCK2COREoutputTCELL119:OUT_F0
CORNER_LSPLLLOLoutputTCELL119:OUT_Q0
CORNER_LSPLLPWRUPinputTCELL119:IMUX_A0
CORNER_LSPLLREFCLKIinputTCELL119:IMUX_CLK0_DELAY
CORNER_LSPLLRSTinputTCELL119:IMUX_LSR0
Q0CH0_FCALIGNENinputTCELL0:IMUX_B2
Q0CH0_FCCDRFORCEDLOCKinputTCELL16:IMUX_A2
Q0CH0_FCDFERDENinputTCELL7:IMUX_CE0
Q0CH0_FCDFEUPDinputTCELL8:IMUX_CE0
Q0CH0_FCLDRTXENinputTCELL0:IMUX_A2
Q0CH0_FCLSMENinputTCELL15:IMUX_D4
Q0CH0_FCPCIEDETENinputTCELL15:IMUX_B4
Q0CH0_FCPCSRXRSTinputTCELL12:IMUX_LSR0
Q0CH0_FCPCSTXRSTinputTCELL10:IMUX_LSR0
Q0CH0_FCPIPEPHYRESETNinputTCELL7:IMUX_LSR0
Q0CH0_FCPLLLOLinputTCELL16:IMUX_A6
Q0CH0_FCRATE0inputTCELL1:IMUX_B0
Q0CH0_FCRATE1inputTCELL1:IMUX_A5
Q0CH0_FCRATE2inputTCELL1:IMUX_A4
Q0CH0_FCRRSTinputTCELL14:IMUX_LSR0
Q0CH0_FCRXPOLARITYinputTCELL15:IMUX_C2
Q0CH0_FCRXPWRUPinputTCELL0:IMUX_D3
Q0CH0_FCTMRSTARTinputTCELL4:IMUX_A0
Q0CH0_FCTMRSTOPinputTCELL4:IMUX_A4
Q0CH0_FCTRSTinputTCELL16:IMUX_LSR0
Q0CH0_FCTXMARGIN0inputTCELL16:IMUX_C4
Q0CH0_FCTXMARGIN1inputTCELL16:IMUX_C3
Q0CH0_FCTXMARGIN2inputTCELL16:IMUX_C2
Q0CH0_FCTXPWRUPinputTCELL0:IMUX_C3
Q0CH0_FCWORDALGNENinputTCELL15:IMUX_C6
Q0CH0_FDLDRRXoutputTCELL3:OUT_F2
Q0CH0_FDLDRTXinputTCELL16:IMUX_B4
Q0CH0_FDRX0outputTCELL9:OUT_Q7
Q0CH0_FDRX1outputTCELL9:OUT_Q6
Q0CH0_FDRX10outputTCELL9:OUT_F5
Q0CH0_FDRX11outputTCELL9:OUT_F4
Q0CH0_FDRX12outputTCELL9:OUT_F3
Q0CH0_FDRX13outputTCELL9:OUT_F2
Q0CH0_FDRX14outputTCELL9:OUT_F1
Q0CH0_FDRX15outputTCELL9:OUT_F0
Q0CH0_FDRX16outputTCELL8:OUT_Q7
Q0CH0_FDRX17outputTCELL8:OUT_Q6
Q0CH0_FDRX18outputTCELL8:OUT_Q5
Q0CH0_FDRX19outputTCELL8:OUT_Q4
Q0CH0_FDRX2outputTCELL9:OUT_Q5
Q0CH0_FDRX20outputTCELL8:OUT_Q3
Q0CH0_FDRX21outputTCELL8:OUT_Q2
Q0CH0_FDRX22outputTCELL8:OUT_Q1
Q0CH0_FDRX23outputTCELL8:OUT_Q0
Q0CH0_FDRX24outputTCELL8:OUT_F7
Q0CH0_FDRX25outputTCELL8:OUT_F6
Q0CH0_FDRX26outputTCELL8:OUT_F5
Q0CH0_FDRX27outputTCELL8:OUT_F4
Q0CH0_FDRX28outputTCELL8:OUT_F3
Q0CH0_FDRX29outputTCELL8:OUT_F2
Q0CH0_FDRX3outputTCELL9:OUT_Q4
Q0CH0_FDRX30outputTCELL8:OUT_F1
Q0CH0_FDRX31outputTCELL8:OUT_F0
Q0CH0_FDRX32outputTCELL7:OUT_Q7
Q0CH0_FDRX33outputTCELL7:OUT_Q6
Q0CH0_FDRX34outputTCELL7:OUT_Q5
Q0CH0_FDRX35outputTCELL7:OUT_Q4
Q0CH0_FDRX36outputTCELL7:OUT_Q3
Q0CH0_FDRX37outputTCELL7:OUT_Q2
Q0CH0_FDRX38outputTCELL7:OUT_Q1
Q0CH0_FDRX39outputTCELL7:OUT_Q0
Q0CH0_FDRX4outputTCELL9:OUT_Q3
Q0CH0_FDRX40outputTCELL7:OUT_F7
Q0CH0_FDRX41outputTCELL7:OUT_F6
Q0CH0_FDRX42outputTCELL7:OUT_F5
Q0CH0_FDRX43outputTCELL7:OUT_F4
Q0CH0_FDRX44outputTCELL7:OUT_F3
Q0CH0_FDRX45outputTCELL7:OUT_F2
Q0CH0_FDRX46outputTCELL7:OUT_F1
Q0CH0_FDRX47outputTCELL7:OUT_F0
Q0CH0_FDRX5outputTCELL9:OUT_Q2
Q0CH0_FDRX6outputTCELL9:OUT_Q1
Q0CH0_FDRX7outputTCELL9:OUT_Q0
Q0CH0_FDRX8outputTCELL9:OUT_F7
Q0CH0_FDRX9outputTCELL9:OUT_F6
Q0CH0_FDTX0inputTCELL9:IMUX_A1
Q0CH0_FDTX1inputTCELL9:IMUX_A0
Q0CH0_FDTX10inputTCELL8:IMUX_C3
Q0CH0_FDTX11inputTCELL8:IMUX_C2
Q0CH0_FDTX12inputTCELL8:IMUX_C1
Q0CH0_FDTX13inputTCELL8:IMUX_C0
Q0CH0_FDTX14inputTCELL8:IMUX_B5
Q0CH0_FDTX15inputTCELL8:IMUX_B4
Q0CH0_FDTX16inputTCELL8:IMUX_B3
Q0CH0_FDTX17inputTCELL8:IMUX_B2
Q0CH0_FDTX18inputTCELL8:IMUX_B1
Q0CH0_FDTX19inputTCELL8:IMUX_B0
Q0CH0_FDTX2inputTCELL8:IMUX_D5
Q0CH0_FDTX20inputTCELL8:IMUX_A5
Q0CH0_FDTX21inputTCELL8:IMUX_A4
Q0CH0_FDTX22inputTCELL8:IMUX_A3
Q0CH0_FDTX23inputTCELL8:IMUX_A2
Q0CH0_FDTX24inputTCELL8:IMUX_A1
Q0CH0_FDTX25inputTCELL8:IMUX_A0
Q0CH0_FDTX26inputTCELL7:IMUX_D5
Q0CH0_FDTX27inputTCELL7:IMUX_D4
Q0CH0_FDTX28inputTCELL7:IMUX_D3
Q0CH0_FDTX29inputTCELL7:IMUX_D2
Q0CH0_FDTX3inputTCELL8:IMUX_D4
Q0CH0_FDTX30inputTCELL7:IMUX_D1
Q0CH0_FDTX31inputTCELL7:IMUX_D0
Q0CH0_FDTX32inputTCELL7:IMUX_C5
Q0CH0_FDTX33inputTCELL7:IMUX_C4
Q0CH0_FDTX34inputTCELL7:IMUX_C3
Q0CH0_FDTX35inputTCELL7:IMUX_C2
Q0CH0_FDTX36inputTCELL7:IMUX_C1
Q0CH0_FDTX37inputTCELL7:IMUX_C0
Q0CH0_FDTX38inputTCELL7:IMUX_B5
Q0CH0_FDTX39inputTCELL7:IMUX_B4
Q0CH0_FDTX4inputTCELL8:IMUX_D3
Q0CH0_FDTX40inputTCELL7:IMUX_B3
Q0CH0_FDTX41inputTCELL7:IMUX_B2
Q0CH0_FDTX42inputTCELL7:IMUX_B1
Q0CH0_FDTX43inputTCELL7:IMUX_B0
Q0CH0_FDTX44inputTCELL7:IMUX_A5
Q0CH0_FDTX45inputTCELL7:IMUX_A4
Q0CH0_FDTX46inputTCELL7:IMUX_A3
Q0CH0_FDTX47inputTCELL7:IMUX_A2
Q0CH0_FDTX48inputTCELL7:IMUX_A1
Q0CH0_FDTX49inputTCELL7:IMUX_A0
Q0CH0_FDTX5inputTCELL8:IMUX_D2
Q0CH0_FDTX6inputTCELL8:IMUX_D1
Q0CH0_FDTX7inputTCELL8:IMUX_D0
Q0CH0_FDTX8inputTCELL8:IMUX_C5
Q0CH0_FDTX9inputTCELL8:IMUX_C4
Q0CH0_FIRCLKinputTCELL10:IMUX_CLK0_DELAY
Q0CH0_FIREFRXCLKinputTCELL8:IMUX_CLK0_DELAY
Q0CH0_FITCLKinputTCELL12:IMUX_CLK0_DELAY
Q0CH0_FITMRSTARTCLKinputTCELL1:IMUX_CLK1_DELAY
Q0CH0_FITMRSTOPCLKinputTCELL3:IMUX_CLK1_DELAY
Q0CH0_FSCCOVERRUNoutputTCELL2:OUT_Q0
Q0CH0_FSCCUNDERRUNoutputTCELL2:OUT_F4
Q0CH0_FSDFEVLDoutputTCELL5:OUT_Q3
Q0CH0_FSLSMoutputTCELL2:OUT_F0
Q0CH0_FSPCIECONoutputTCELL1:OUT_Q0
Q0CH0_FSPCIEDONEoutputTCELL1:OUT_F4
Q0CH0_FSRCDONEoutputTCELL4:OUT_F3
Q0CH0_FSRLOLoutputTCELL2:OUT_Q4
Q0CH0_FSRLOSoutputTCELL1:OUT_Q4
Q0CH0_FSSKPADDEDoutputTCELL3:OUT_F6
Q0CH0_FSSKPDELETEDoutputTCELL3:OUT_Q2
Q0CH1_FCALIGNENinputTCELL0:IMUX_B3
Q0CH1_FCCDRFORCEDLOCKinputTCELL16:IMUX_A3
Q0CH1_FCDFERDENinputTCELL7:IMUX_CE1
Q0CH1_FCDFEUPDinputTCELL8:IMUX_CE1
Q0CH1_FCLDRTXENinputTCELL0:IMUX_A3
Q0CH1_FCLSMENinputTCELL15:IMUX_D5
Q0CH1_FCPCIEDETENinputTCELL15:IMUX_B5
Q0CH1_FCPCSRXRSTinputTCELL12:IMUX_LSR1
Q0CH1_FCPCSTXRSTinputTCELL10:IMUX_LSR1
Q0CH1_FCPIPEPHYRESETNinputTCELL7:IMUX_LSR1
Q0CH1_FCPLLLOLinputTCELL16:IMUX_A7
Q0CH1_FCRATE0inputTCELL1:IMUX_B3
Q0CH1_FCRATE1inputTCELL1:IMUX_B2
Q0CH1_FCRATE2inputTCELL1:IMUX_B1
Q0CH1_FCRRSTinputTCELL14:IMUX_LSR1
Q0CH1_FCRXPOLARITYinputTCELL15:IMUX_C3
Q0CH1_FCRXPWRUPinputTCELL0:IMUX_D4
Q0CH1_FCTMRSTARTinputTCELL4:IMUX_A1
Q0CH1_FCTMRSTOPinputTCELL4:IMUX_A5
Q0CH1_FCTRSTinputTCELL16:IMUX_LSR1
Q0CH1_FCTXMARGIN0inputTCELL16:IMUX_C7
Q0CH1_FCTXMARGIN1inputTCELL16:IMUX_C6
Q0CH1_FCTXMARGIN2inputTCELL16:IMUX_C5
Q0CH1_FCTXPWRUPinputTCELL0:IMUX_C4
Q0CH1_FCWORDALGNENinputTCELL15:IMUX_C7
Q0CH1_FDLDRRXoutputTCELL3:OUT_F3
Q0CH1_FDLDRTXinputTCELL16:IMUX_B5
Q0CH1_FDRX0outputTCELL13:OUT_Q1
Q0CH1_FDRX1outputTCELL13:OUT_Q0
Q0CH1_FDRX10outputTCELL12:OUT_F7
Q0CH1_FDRX11outputTCELL12:OUT_F6
Q0CH1_FDRX12outputTCELL12:OUT_F5
Q0CH1_FDRX13outputTCELL12:OUT_F4
Q0CH1_FDRX14outputTCELL12:OUT_F3
Q0CH1_FDRX15outputTCELL12:OUT_F2
Q0CH1_FDRX16outputTCELL11:OUT_Q7
Q0CH1_FDRX17outputTCELL11:OUT_Q6
Q0CH1_FDRX18outputTCELL11:OUT_Q5
Q0CH1_FDRX19outputTCELL11:OUT_Q4
Q0CH1_FDRX2outputTCELL12:OUT_Q7
Q0CH1_FDRX20outputTCELL11:OUT_Q3
Q0CH1_FDRX21outputTCELL11:OUT_Q2
Q0CH1_FDRX22outputTCELL11:OUT_Q1
Q0CH1_FDRX23outputTCELL11:OUT_Q0
Q0CH1_FDRX24outputTCELL11:OUT_F7
Q0CH1_FDRX25outputTCELL11:OUT_F6
Q0CH1_FDRX26outputTCELL11:OUT_F5
Q0CH1_FDRX27outputTCELL11:OUT_F4
Q0CH1_FDRX28outputTCELL11:OUT_F3
Q0CH1_FDRX29outputTCELL11:OUT_F2
Q0CH1_FDRX3outputTCELL12:OUT_Q6
Q0CH1_FDRX30outputTCELL11:OUT_F1
Q0CH1_FDRX31outputTCELL11:OUT_F0
Q0CH1_FDRX32outputTCELL10:OUT_Q7
Q0CH1_FDRX33outputTCELL10:OUT_Q6
Q0CH1_FDRX34outputTCELL10:OUT_Q5
Q0CH1_FDRX35outputTCELL10:OUT_Q4
Q0CH1_FDRX36outputTCELL10:OUT_Q3
Q0CH1_FDRX37outputTCELL10:OUT_Q2
Q0CH1_FDRX38outputTCELL10:OUT_Q1
Q0CH1_FDRX39outputTCELL10:OUT_Q0
Q0CH1_FDRX4outputTCELL12:OUT_Q5
Q0CH1_FDRX40outputTCELL10:OUT_F7
Q0CH1_FDRX41outputTCELL10:OUT_F6
Q0CH1_FDRX42outputTCELL10:OUT_F5
Q0CH1_FDRX43outputTCELL10:OUT_F4
Q0CH1_FDRX44outputTCELL10:OUT_F3
Q0CH1_FDRX45outputTCELL10:OUT_F2
Q0CH1_FDRX46outputTCELL10:OUT_F1
Q0CH1_FDRX47outputTCELL10:OUT_F0
Q0CH1_FDRX5outputTCELL12:OUT_Q4
Q0CH1_FDRX6outputTCELL12:OUT_Q3
Q0CH1_FDRX7outputTCELL12:OUT_Q2
Q0CH1_FDRX8outputTCELL13:OUT_F1
Q0CH1_FDRX9outputTCELL13:OUT_F0
Q0CH1_FDTX0inputTCELL11:IMUX_A3
Q0CH1_FDTX1inputTCELL11:IMUX_A2
Q0CH1_FDTX10inputTCELL10:IMUX_C5
Q0CH1_FDTX11inputTCELL10:IMUX_C4
Q0CH1_FDTX12inputTCELL10:IMUX_C3
Q0CH1_FDTX13inputTCELL10:IMUX_C2
Q0CH1_FDTX14inputTCELL10:IMUX_C1
Q0CH1_FDTX15inputTCELL10:IMUX_C0
Q0CH1_FDTX16inputTCELL10:IMUX_B5
Q0CH1_FDTX17inputTCELL10:IMUX_B4
Q0CH1_FDTX18inputTCELL10:IMUX_B3
Q0CH1_FDTX19inputTCELL10:IMUX_B2
Q0CH1_FDTX2inputTCELL11:IMUX_A1
Q0CH1_FDTX20inputTCELL10:IMUX_B1
Q0CH1_FDTX21inputTCELL10:IMUX_B0
Q0CH1_FDTX22inputTCELL10:IMUX_A5
Q0CH1_FDTX23inputTCELL10:IMUX_A4
Q0CH1_FDTX24inputTCELL10:IMUX_A3
Q0CH1_FDTX25inputTCELL10:IMUX_A2
Q0CH1_FDTX26inputTCELL10:IMUX_A1
Q0CH1_FDTX27inputTCELL10:IMUX_A0
Q0CH1_FDTX28inputTCELL9:IMUX_D5
Q0CH1_FDTX29inputTCELL9:IMUX_D4
Q0CH1_FDTX3inputTCELL11:IMUX_A0
Q0CH1_FDTX30inputTCELL9:IMUX_D3
Q0CH1_FDTX31inputTCELL9:IMUX_D2
Q0CH1_FDTX32inputTCELL9:IMUX_D1
Q0CH1_FDTX33inputTCELL9:IMUX_D0
Q0CH1_FDTX34inputTCELL9:IMUX_C5
Q0CH1_FDTX35inputTCELL9:IMUX_C4
Q0CH1_FDTX36inputTCELL9:IMUX_C3
Q0CH1_FDTX37inputTCELL9:IMUX_C2
Q0CH1_FDTX38inputTCELL9:IMUX_C1
Q0CH1_FDTX39inputTCELL9:IMUX_C0
Q0CH1_FDTX4inputTCELL10:IMUX_D5
Q0CH1_FDTX40inputTCELL9:IMUX_B5
Q0CH1_FDTX41inputTCELL9:IMUX_B4
Q0CH1_FDTX42inputTCELL9:IMUX_B3
Q0CH1_FDTX43inputTCELL9:IMUX_B2
Q0CH1_FDTX44inputTCELL9:IMUX_B1
Q0CH1_FDTX45inputTCELL9:IMUX_B0
Q0CH1_FDTX46inputTCELL9:IMUX_A5
Q0CH1_FDTX47inputTCELL9:IMUX_A4
Q0CH1_FDTX48inputTCELL9:IMUX_A3
Q0CH1_FDTX49inputTCELL9:IMUX_A2
Q0CH1_FDTX5inputTCELL10:IMUX_D4
Q0CH1_FDTX6inputTCELL10:IMUX_D3
Q0CH1_FDTX7inputTCELL10:IMUX_D2
Q0CH1_FDTX8inputTCELL10:IMUX_D1
Q0CH1_FDTX9inputTCELL10:IMUX_D0
Q0CH1_FIRCLKinputTCELL10:IMUX_CLK1_DELAY
Q0CH1_FIREFRXCLKinputTCELL8:IMUX_CLK1_DELAY
Q0CH1_FITCLKinputTCELL12:IMUX_CLK1_DELAY
Q0CH1_FITMRSTARTCLKinputTCELL2:IMUX_CLK0_DELAY
Q0CH1_FITMRSTOPCLKinputTCELL4:IMUX_CLK0_DELAY
Q0CH1_FSCCOVERRUNoutputTCELL2:OUT_Q1
Q0CH1_FSCCUNDERRUNoutputTCELL2:OUT_F5
Q0CH1_FSDFEVLDoutputTCELL5:OUT_Q4
Q0CH1_FSLSMoutputTCELL2:OUT_F1
Q0CH1_FSPCIECONoutputTCELL1:OUT_Q1
Q0CH1_FSPCIEDONEoutputTCELL1:OUT_F5
Q0CH1_FSRCDONEoutputTCELL4:OUT_F4
Q0CH1_FSRLOLoutputTCELL2:OUT_Q5
Q0CH1_FSRLOSoutputTCELL1:OUT_Q5
Q0CH1_FSSKPADDEDoutputTCELL3:OUT_F7
Q0CH1_FSSKPDELETEDoutputTCELL3:OUT_Q3
Q0CH2_FCALIGNENinputTCELL0:IMUX_B4
Q0CH2_FCCDRFORCEDLOCKinputTCELL16:IMUX_A4
Q0CH2_FCDFERDENinputTCELL7:IMUX_CE2
Q0CH2_FCDFEUPDinputTCELL8:IMUX_CE2
Q0CH2_FCLDRTXENinputTCELL0:IMUX_A4
Q0CH2_FCLSMENinputTCELL15:IMUX_D6
Q0CH2_FCPCIEDETENinputTCELL15:IMUX_B6
Q0CH2_FCPCSRXRSTinputTCELL13:IMUX_LSR0
Q0CH2_FCPCSTXRSTinputTCELL11:IMUX_LSR0
Q0CH2_FCPIPEPHYRESETNinputTCELL8:IMUX_LSR0
Q0CH2_FCPLLLOLinputTCELL16:IMUX_B2
Q0CH2_FCRATE0inputTCELL1:IMUX_C0
Q0CH2_FCRATE1inputTCELL1:IMUX_B5
Q0CH2_FCRATE2inputTCELL1:IMUX_B4
Q0CH2_FCRRSTinputTCELL15:IMUX_LSR0
Q0CH2_FCRXPOLARITYinputTCELL15:IMUX_C4
Q0CH2_FCRXPWRUPinputTCELL0:IMUX_D5
Q0CH2_FCTMRSTARTinputTCELL4:IMUX_A2
Q0CH2_FCTMRSTOPinputTCELL4:IMUX_B0
Q0CH2_FCTRSTinputTCELL1:IMUX_LSR0
Q0CH2_FCTXMARGIN0inputTCELL16:IMUX_D4
Q0CH2_FCTXMARGIN1inputTCELL16:IMUX_D3
Q0CH2_FCTXMARGIN2inputTCELL16:IMUX_D2
Q0CH2_FCTXPWRUPinputTCELL0:IMUX_C5
Q0CH2_FCWORDALGNENinputTCELL15:IMUX_D2
Q0CH2_FDLDRRXoutputTCELL3:OUT_F4
Q0CH2_FDLDRTXinputTCELL16:IMUX_B6
Q0CH2_FDRX0outputTCELL16:OUT_Q1
Q0CH2_FDRX1outputTCELL16:OUT_Q0
Q0CH2_FDRX10outputTCELL15:OUT_F7
Q0CH2_FDRX11outputTCELL15:OUT_F6
Q0CH2_FDRX12outputTCELL15:OUT_F5
Q0CH2_FDRX13outputTCELL15:OUT_F4
Q0CH2_FDRX14outputTCELL15:OUT_F3
Q0CH2_FDRX15outputTCELL15:OUT_F2
Q0CH2_FDRX16outputTCELL15:OUT_Q1
Q0CH2_FDRX17outputTCELL15:OUT_Q0
Q0CH2_FDRX18outputTCELL14:OUT_Q7
Q0CH2_FDRX19outputTCELL14:OUT_Q6
Q0CH2_FDRX2outputTCELL15:OUT_Q7
Q0CH2_FDRX20outputTCELL14:OUT_Q5
Q0CH2_FDRX21outputTCELL14:OUT_Q4
Q0CH2_FDRX22outputTCELL14:OUT_Q3
Q0CH2_FDRX23outputTCELL14:OUT_Q2
Q0CH2_FDRX24outputTCELL15:OUT_F1
Q0CH2_FDRX25outputTCELL15:OUT_F0
Q0CH2_FDRX26outputTCELL14:OUT_F7
Q0CH2_FDRX27outputTCELL14:OUT_F6
Q0CH2_FDRX28outputTCELL14:OUT_F5
Q0CH2_FDRX29outputTCELL14:OUT_F4
Q0CH2_FDRX3outputTCELL15:OUT_Q6
Q0CH2_FDRX30outputTCELL14:OUT_F3
Q0CH2_FDRX31outputTCELL14:OUT_F2
Q0CH2_FDRX32outputTCELL14:OUT_Q1
Q0CH2_FDRX33outputTCELL14:OUT_Q0
Q0CH2_FDRX34outputTCELL13:OUT_Q7
Q0CH2_FDRX35outputTCELL13:OUT_Q6
Q0CH2_FDRX36outputTCELL13:OUT_Q5
Q0CH2_FDRX37outputTCELL13:OUT_Q4
Q0CH2_FDRX38outputTCELL13:OUT_Q3
Q0CH2_FDRX39outputTCELL13:OUT_Q2
Q0CH2_FDRX4outputTCELL15:OUT_Q5
Q0CH2_FDRX40outputTCELL14:OUT_F1
Q0CH2_FDRX41outputTCELL14:OUT_F0
Q0CH2_FDRX42outputTCELL13:OUT_F7
Q0CH2_FDRX43outputTCELL13:OUT_F6
Q0CH2_FDRX44outputTCELL13:OUT_F5
Q0CH2_FDRX45outputTCELL13:OUT_F4
Q0CH2_FDRX46outputTCELL13:OUT_F3
Q0CH2_FDRX47outputTCELL13:OUT_F2
Q0CH2_FDRX5outputTCELL15:OUT_Q4
Q0CH2_FDRX6outputTCELL15:OUT_Q3
Q0CH2_FDRX7outputTCELL15:OUT_Q2
Q0CH2_FDRX8outputTCELL16:OUT_F1
Q0CH2_FDRX9outputTCELL16:OUT_F0
Q0CH2_FDTX0inputTCELL13:IMUX_A7
Q0CH2_FDTX1inputTCELL13:IMUX_A6
Q0CH2_FDTX10inputTCELL12:IMUX_D3
Q0CH2_FDTX11inputTCELL12:IMUX_D2
Q0CH2_FDTX12inputTCELL12:IMUX_C7
Q0CH2_FDTX13inputTCELL12:IMUX_C6
Q0CH2_FDTX14inputTCELL12:IMUX_C5
Q0CH2_FDTX15inputTCELL12:IMUX_C4
Q0CH2_FDTX16inputTCELL12:IMUX_C3
Q0CH2_FDTX17inputTCELL12:IMUX_C2
Q0CH2_FDTX18inputTCELL12:IMUX_B7
Q0CH2_FDTX19inputTCELL12:IMUX_B6
Q0CH2_FDTX2inputTCELL13:IMUX_A5
Q0CH2_FDTX20inputTCELL12:IMUX_B5
Q0CH2_FDTX21inputTCELL12:IMUX_B4
Q0CH2_FDTX22inputTCELL12:IMUX_B3
Q0CH2_FDTX23inputTCELL12:IMUX_B2
Q0CH2_FDTX24inputTCELL12:IMUX_A7
Q0CH2_FDTX25inputTCELL12:IMUX_A6
Q0CH2_FDTX26inputTCELL12:IMUX_A5
Q0CH2_FDTX27inputTCELL12:IMUX_A4
Q0CH2_FDTX28inputTCELL12:IMUX_A3
Q0CH2_FDTX29inputTCELL12:IMUX_A2
Q0CH2_FDTX3inputTCELL13:IMUX_A4
Q0CH2_FDTX30inputTCELL11:IMUX_D5
Q0CH2_FDTX31inputTCELL11:IMUX_D4
Q0CH2_FDTX32inputTCELL11:IMUX_D3
Q0CH2_FDTX33inputTCELL11:IMUX_D2
Q0CH2_FDTX34inputTCELL11:IMUX_D1
Q0CH2_FDTX35inputTCELL11:IMUX_D0
Q0CH2_FDTX36inputTCELL11:IMUX_C5
Q0CH2_FDTX37inputTCELL11:IMUX_C4
Q0CH2_FDTX38inputTCELL11:IMUX_C3
Q0CH2_FDTX39inputTCELL11:IMUX_C2
Q0CH2_FDTX4inputTCELL13:IMUX_A3
Q0CH2_FDTX40inputTCELL11:IMUX_C1
Q0CH2_FDTX41inputTCELL11:IMUX_C0
Q0CH2_FDTX42inputTCELL11:IMUX_B5
Q0CH2_FDTX43inputTCELL11:IMUX_B4
Q0CH2_FDTX44inputTCELL11:IMUX_B3
Q0CH2_FDTX45inputTCELL11:IMUX_B2
Q0CH2_FDTX46inputTCELL11:IMUX_B1
Q0CH2_FDTX47inputTCELL11:IMUX_B0
Q0CH2_FDTX48inputTCELL11:IMUX_A5
Q0CH2_FDTX49inputTCELL11:IMUX_A4
Q0CH2_FDTX5inputTCELL13:IMUX_A2
Q0CH2_FDTX6inputTCELL12:IMUX_D7
Q0CH2_FDTX7inputTCELL12:IMUX_D6
Q0CH2_FDTX8inputTCELL12:IMUX_D5
Q0CH2_FDTX9inputTCELL12:IMUX_D4
Q0CH2_FIRCLKinputTCELL11:IMUX_CLK0_DELAY
Q0CH2_FIREFRXCLKinputTCELL9:IMUX_CLK0_DELAY
Q0CH2_FITCLKinputTCELL13:IMUX_CLK0_DELAY
Q0CH2_FITMRSTARTCLKinputTCELL2:IMUX_CLK1_DELAY
Q0CH2_FITMRSTOPCLKinputTCELL4:IMUX_CLK1_DELAY
Q0CH2_FSCCOVERRUNoutputTCELL2:OUT_Q2
Q0CH2_FSCCUNDERRUNoutputTCELL2:OUT_F6
Q0CH2_FSDFEVLDoutputTCELL5:OUT_Q5
Q0CH2_FSLSMoutputTCELL2:OUT_F2
Q0CH2_FSPCIECONoutputTCELL1:OUT_Q2
Q0CH2_FSPCIEDONEoutputTCELL1:OUT_F6
Q0CH2_FSRCDONEoutputTCELL4:OUT_F5
Q0CH2_FSRLOLoutputTCELL2:OUT_Q6
Q0CH2_FSRLOSoutputTCELL1:OUT_Q6
Q0CH2_FSSKPADDEDoutputTCELL3:OUT_Q0
Q0CH2_FSSKPDELETEDoutputTCELL3:OUT_Q4
Q0CH3_FCALIGNENinputTCELL0:IMUX_B5
Q0CH3_FCCDRFORCEDLOCKinputTCELL16:IMUX_A5
Q0CH3_FCDFERDENinputTCELL7:IMUX_CE3
Q0CH3_FCDFEUPDinputTCELL8:IMUX_CE3
Q0CH3_FCLDRTXENinputTCELL0:IMUX_A5
Q0CH3_FCLSMENinputTCELL15:IMUX_D7
Q0CH3_FCPCIEDETENinputTCELL15:IMUX_B7
Q0CH3_FCPCSRXRSTinputTCELL13:IMUX_LSR1
Q0CH3_FCPCSTXRSTinputTCELL11:IMUX_LSR1
Q0CH3_FCPIPEPHYRESETNinputTCELL8:IMUX_LSR1
Q0CH3_FCPLLLOLinputTCELL16:IMUX_B3
Q0CH3_FCRATE0inputTCELL1:IMUX_C3
Q0CH3_FCRATE1inputTCELL1:IMUX_C2
Q0CH3_FCRATE2inputTCELL1:IMUX_C1
Q0CH3_FCRRSTinputTCELL15:IMUX_LSR1
Q0CH3_FCRXPOLARITYinputTCELL15:IMUX_C5
Q0CH3_FCRXPWRUPinputTCELL1:IMUX_A0
Q0CH3_FCTMRSTARTinputTCELL4:IMUX_A3
Q0CH3_FCTMRSTOPinputTCELL4:IMUX_B1
Q0CH3_FCTRSTinputTCELL1:IMUX_LSR1
Q0CH3_FCTXMARGIN0inputTCELL16:IMUX_D7
Q0CH3_FCTXMARGIN1inputTCELL16:IMUX_D6
Q0CH3_FCTXMARGIN2inputTCELL16:IMUX_D5
Q0CH3_FCTXPWRUPinputTCELL0:IMUX_D2
Q0CH3_FCWORDALGNENinputTCELL15:IMUX_D3
Q0CH3_FDLDRRXoutputTCELL3:OUT_F5
Q0CH3_FDLDRTXinputTCELL16:IMUX_B7
Q0CH3_FDRX0outputTCELL1:OUT_F3
Q0CH3_FDRX1outputTCELL1:OUT_F2
Q0CH3_FDRX10outputTCELL0:OUT_F7
Q0CH3_FDRX11outputTCELL0:OUT_F6
Q0CH3_FDRX12outputTCELL0:OUT_F5
Q0CH3_FDRX13outputTCELL0:OUT_F4
Q0CH3_FDRX14outputTCELL0:OUT_F3
Q0CH3_FDRX15outputTCELL0:OUT_F2
Q0CH3_FDRX16outputTCELL18:OUT_Q1
Q0CH3_FDRX17outputTCELL18:OUT_Q0
Q0CH3_FDRX18outputTCELL17:OUT_Q7
Q0CH3_FDRX19outputTCELL17:OUT_Q6
Q0CH3_FDRX2outputTCELL1:OUT_F1
Q0CH3_FDRX20outputTCELL17:OUT_Q5
Q0CH3_FDRX21outputTCELL17:OUT_Q4
Q0CH3_FDRX22outputTCELL17:OUT_Q3
Q0CH3_FDRX23outputTCELL17:OUT_Q2
Q0CH3_FDRX24outputTCELL18:OUT_F1
Q0CH3_FDRX25outputTCELL18:OUT_F0
Q0CH3_FDRX26outputTCELL17:OUT_F7
Q0CH3_FDRX27outputTCELL17:OUT_F6
Q0CH3_FDRX28outputTCELL17:OUT_F5
Q0CH3_FDRX29outputTCELL17:OUT_F4
Q0CH3_FDRX3outputTCELL1:OUT_F0
Q0CH3_FDRX30outputTCELL17:OUT_F3
Q0CH3_FDRX31outputTCELL17:OUT_F2
Q0CH3_FDRX32outputTCELL17:OUT_Q1
Q0CH3_FDRX33outputTCELL17:OUT_Q0
Q0CH3_FDRX34outputTCELL16:OUT_Q7
Q0CH3_FDRX35outputTCELL16:OUT_Q6
Q0CH3_FDRX36outputTCELL16:OUT_Q5
Q0CH3_FDRX37outputTCELL16:OUT_Q4
Q0CH3_FDRX38outputTCELL16:OUT_Q3
Q0CH3_FDRX39outputTCELL16:OUT_Q2
Q0CH3_FDRX4outputTCELL0:OUT_Q7
Q0CH3_FDRX40outputTCELL17:OUT_F1
Q0CH3_FDRX41outputTCELL17:OUT_F0
Q0CH3_FDRX42outputTCELL16:OUT_F7
Q0CH3_FDRX43outputTCELL16:OUT_F6
Q0CH3_FDRX44outputTCELL16:OUT_F5
Q0CH3_FDRX45outputTCELL16:OUT_F4
Q0CH3_FDRX46outputTCELL16:OUT_F3
Q0CH3_FDRX47outputTCELL16:OUT_F2
Q0CH3_FDRX5outputTCELL0:OUT_Q6
Q0CH3_FDRX6outputTCELL0:OUT_Q5
Q0CH3_FDRX7outputTCELL0:OUT_Q4
Q0CH3_FDRX8outputTCELL0:OUT_Q3
Q0CH3_FDRX9outputTCELL0:OUT_Q2
Q0CH3_FDTX0inputTCELL15:IMUX_B3
Q0CH3_FDTX1inputTCELL15:IMUX_B2
Q0CH3_FDTX10inputTCELL14:IMUX_D5
Q0CH3_FDTX11inputTCELL14:IMUX_D4
Q0CH3_FDTX12inputTCELL14:IMUX_D3
Q0CH3_FDTX13inputTCELL14:IMUX_D2
Q0CH3_FDTX14inputTCELL14:IMUX_C7
Q0CH3_FDTX15inputTCELL14:IMUX_C6
Q0CH3_FDTX16inputTCELL14:IMUX_C5
Q0CH3_FDTX17inputTCELL14:IMUX_C4
Q0CH3_FDTX18inputTCELL14:IMUX_C3
Q0CH3_FDTX19inputTCELL14:IMUX_C2
Q0CH3_FDTX2inputTCELL15:IMUX_A7
Q0CH3_FDTX20inputTCELL14:IMUX_B7
Q0CH3_FDTX21inputTCELL14:IMUX_B6
Q0CH3_FDTX22inputTCELL14:IMUX_B5
Q0CH3_FDTX23inputTCELL14:IMUX_B4
Q0CH3_FDTX24inputTCELL14:IMUX_B3
Q0CH3_FDTX25inputTCELL14:IMUX_B2
Q0CH3_FDTX26inputTCELL14:IMUX_A7
Q0CH3_FDTX27inputTCELL14:IMUX_A6
Q0CH3_FDTX28inputTCELL14:IMUX_A5
Q0CH3_FDTX29inputTCELL14:IMUX_A4
Q0CH3_FDTX3inputTCELL15:IMUX_A6
Q0CH3_FDTX30inputTCELL14:IMUX_A3
Q0CH3_FDTX31inputTCELL14:IMUX_A2
Q0CH3_FDTX32inputTCELL13:IMUX_D7
Q0CH3_FDTX33inputTCELL13:IMUX_D6
Q0CH3_FDTX34inputTCELL13:IMUX_D5
Q0CH3_FDTX35inputTCELL13:IMUX_D4
Q0CH3_FDTX36inputTCELL13:IMUX_D3
Q0CH3_FDTX37inputTCELL13:IMUX_D2
Q0CH3_FDTX38inputTCELL13:IMUX_C7
Q0CH3_FDTX39inputTCELL13:IMUX_C6
Q0CH3_FDTX4inputTCELL15:IMUX_A5
Q0CH3_FDTX40inputTCELL13:IMUX_C5
Q0CH3_FDTX41inputTCELL13:IMUX_C4
Q0CH3_FDTX42inputTCELL13:IMUX_C3
Q0CH3_FDTX43inputTCELL13:IMUX_C2
Q0CH3_FDTX44inputTCELL13:IMUX_B7
Q0CH3_FDTX45inputTCELL13:IMUX_B6
Q0CH3_FDTX46inputTCELL13:IMUX_B5
Q0CH3_FDTX47inputTCELL13:IMUX_B4
Q0CH3_FDTX48inputTCELL13:IMUX_B3
Q0CH3_FDTX49inputTCELL13:IMUX_B2
Q0CH3_FDTX5inputTCELL15:IMUX_A4
Q0CH3_FDTX6inputTCELL15:IMUX_A3
Q0CH3_FDTX7inputTCELL15:IMUX_A2
Q0CH3_FDTX8inputTCELL14:IMUX_D7
Q0CH3_FDTX9inputTCELL14:IMUX_D6
Q0CH3_FIRCLKinputTCELL11:IMUX_CLK1_DELAY
Q0CH3_FIREFRXCLKinputTCELL9:IMUX_CLK1_DELAY
Q0CH3_FITCLKinputTCELL13:IMUX_CLK1_DELAY
Q0CH3_FITMRSTARTCLKinputTCELL3:IMUX_CLK0_DELAY
Q0CH3_FITMRSTOPCLKinputTCELL5:IMUX_CLK0_DELAY
Q0CH3_FSCCOVERRUNoutputTCELL2:OUT_Q3
Q0CH3_FSCCUNDERRUNoutputTCELL2:OUT_F7
Q0CH3_FSDFEVLDoutputTCELL5:OUT_Q6
Q0CH3_FSLSMoutputTCELL2:OUT_F3
Q0CH3_FSPCIECONoutputTCELL1:OUT_Q3
Q0CH3_FSPCIEDONEoutputTCELL1:OUT_F7
Q0CH3_FSRCDONEoutputTCELL4:OUT_F6
Q0CH3_FSRLOLoutputTCELL2:OUT_Q7
Q0CH3_FSRLOSoutputTCELL1:OUT_Q7
Q0CH3_FSSKPADDEDoutputTCELL3:OUT_Q1
Q0CH3_FSSKPDELETEDoutputTCELL3:OUT_Q5
Q0D0_FCDERSTinputTCELL9:IMUX_LSR0
Q0D0_FSDEoutputTCELL3:OUT_Q6
Q0D0_FSDMoutputTCELL4:OUT_F0
Q0D1_FCDERSTinputTCELL9:IMUX_LSR1
Q0D1_FSDEoutputTCELL3:OUT_Q7
Q0D1_FSDMoutputTCELL4:OUT_F1
Q0P_CORERRINinputTCELL48:IMUX_A5
Q0P_CORERROUToutputTCELL43:OUT_F5
Q0P_DBGDATOUT0outputTCELL45:OUT_F4
Q0P_DBGDATOUT1outputTCELL45:OUT_F7
Q0P_DBGDATOUT10outputTCELL45:OUT_Q4
Q0P_DBGDATOUT11outputTCELL45:OUT_Q2
Q0P_DBGDATOUT12outputTCELL44:OUT_Q6
Q0P_DBGDATOUT13outputTCELL45:OUT_F6
Q0P_DBGDATOUT14outputTCELL45:OUT_F1
Q0P_DBGDATOUT15outputTCELL45:OUT_Q5
Q0P_DBGDATOUT2outputTCELL45:OUT_F5
Q0P_DBGDATOUT3outputTCELL45:OUT_Q1
Q0P_DBGDATOUT4outputTCELL45:OUT_F2
Q0P_DBGDATOUT5outputTCELL44:OUT_Q1
Q0P_DBGDATOUT6outputTCELL44:OUT_Q7
Q0P_DBGDATOUT7outputTCELL44:OUT_Q3
Q0P_DBGDATOUT8outputTCELL44:OUT_Q4
Q0P_DBGDATOUT9outputTCELL45:OUT_F3
Q0P_FTLERROUToutputTCELL42:OUT_Q4
Q0P_FUNCPWRSTATE0outputTCELL43:OUT_F3
Q0P_FUNCPWRSTATE1outputTCELL43:OUT_F1
Q0P_FUNCPWRSTATE2outputTCELL43:OUT_Q0
Q0P_FUNCSTS0outputTCELL43:OUT_Q3
Q0P_FUNCSTS1outputTCELL43:OUT_F6
Q0P_FUNCSTS2outputTCELL42:OUT_Q7
Q0P_FUNCSTS3outputTCELL43:OUT_Q7
Q0P_HALMSTACKoutputTCELL43:OUT_Q4
Q0P_HALMSTCOMPDES0outputTCELL37:OUT_F1
Q0P_HALMSTCOMPDES1outputTCELL37:OUT_F4
Q0P_HALMSTCOMPDES10outputTCELL41:OUT_F2
Q0P_HALMSTCOMPDES100outputTCELL37:OUT_F7
Q0P_HALMSTCOMPDES101outputTCELL33:OUT_Q3
Q0P_HALMSTCOMPDES102outputTCELL33:OUT_Q2
Q0P_HALMSTCOMPDES103outputTCELL33:OUT_Q4
Q0P_HALMSTCOMPDES104outputTCELL33:OUT_Q1
Q0P_HALMSTCOMPDES105outputTCELL34:OUT_F1
Q0P_HALMSTCOMPDES106outputTCELL34:OUT_F4
Q0P_HALMSTCOMPDES107outputTCELL33:OUT_F2
Q0P_HALMSTCOMPDES108outputTCELL33:OUT_F0
Q0P_HALMSTCOMPDES109outputTCELL32:OUT_Q6
Q0P_HALMSTCOMPDES11outputTCELL38:OUT_Q0
Q0P_HALMSTCOMPDES110outputTCELL33:OUT_F1
Q0P_HALMSTCOMPDES111outputTCELL33:OUT_F5
Q0P_HALMSTCOMPDES112outputTCELL32:OUT_Q7
Q0P_HALMSTCOMPDES113outputTCELL32:OUT_Q3
Q0P_HALMSTCOMPDES114outputTCELL32:OUT_Q2
Q0P_HALMSTCOMPDES115outputTCELL32:OUT_Q0
Q0P_HALMSTCOMPDES116outputTCELL32:OUT_F7
Q0P_HALMSTCOMPDES117outputTCELL32:OUT_Q1
Q0P_HALMSTCOMPDES118outputTCELL32:OUT_Q4
Q0P_HALMSTCOMPDES119outputTCELL33:OUT_F7
Q0P_HALMSTCOMPDES12outputTCELL41:OUT_F6
Q0P_HALMSTCOMPDES120outputTCELL36:OUT_F5
Q0P_HALMSTCOMPDES121outputTCELL39:OUT_F1
Q0P_HALMSTCOMPDES122outputTCELL38:OUT_Q5
Q0P_HALMSTCOMPDES123outputTCELL38:OUT_F6
Q0P_HALMSTCOMPDES124outputTCELL45:OUT_Q0
Q0P_HALMSTCOMPDES125outputTCELL33:OUT_F4
Q0P_HALMSTCOMPDES126outputTCELL33:OUT_F3
Q0P_HALMSTCOMPDES127outputTCELL33:OUT_F6
Q0P_HALMSTCOMPDES13outputTCELL39:OUT_Q7
Q0P_HALMSTCOMPDES14outputTCELL38:OUT_Q7
Q0P_HALMSTCOMPDES15outputTCELL39:OUT_Q6
Q0P_HALMSTCOMPDES16outputTCELL41:OUT_Q0
Q0P_HALMSTCOMPDES17outputTCELL40:OUT_F1
Q0P_HALMSTCOMPDES18outputTCELL42:OUT_Q2
Q0P_HALMSTCOMPDES19outputTCELL41:OUT_Q5
Q0P_HALMSTCOMPDES2outputTCELL37:OUT_Q0
Q0P_HALMSTCOMPDES20outputTCELL40:OUT_Q2
Q0P_HALMSTCOMPDES21outputTCELL42:OUT_Q3
Q0P_HALMSTCOMPDES22outputTCELL41:OUT_Q4
Q0P_HALMSTCOMPDES23outputTCELL40:OUT_Q5
Q0P_HALMSTCOMPDES24outputTCELL42:OUT_F7
Q0P_HALMSTCOMPDES25outputTCELL42:OUT_F6
Q0P_HALMSTCOMPDES26outputTCELL42:OUT_F3
Q0P_HALMSTCOMPDES27outputTCELL42:OUT_F5
Q0P_HALMSTCOMPDES28outputTCELL42:OUT_F2
Q0P_HALMSTCOMPDES29outputTCELL41:OUT_F5
Q0P_HALMSTCOMPDES3outputTCELL38:OUT_Q1
Q0P_HALMSTCOMPDES30outputTCELL37:OUT_Q5
Q0P_HALMSTCOMPDES31outputTCELL40:OUT_F0
Q0P_HALMSTCOMPDES32outputTCELL38:OUT_F3
Q0P_HALMSTCOMPDES33outputTCELL38:OUT_F7
Q0P_HALMSTCOMPDES34outputTCELL38:OUT_Q3
Q0P_HALMSTCOMPDES35outputTCELL39:OUT_Q3
Q0P_HALMSTCOMPDES36outputTCELL39:OUT_Q1
Q0P_HALMSTCOMPDES37outputTCELL38:OUT_F5
Q0P_HALMSTCOMPDES38outputTCELL37:OUT_Q7
Q0P_HALMSTCOMPDES39outputTCELL41:OUT_Q6
Q0P_HALMSTCOMPDES4outputTCELL38:OUT_Q6
Q0P_HALMSTCOMPDES40outputTCELL40:OUT_Q1
Q0P_HALMSTCOMPDES41outputTCELL41:OUT_F7
Q0P_HALMSTCOMPDES42outputTCELL41:OUT_Q3
Q0P_HALMSTCOMPDES43outputTCELL41:OUT_F3
Q0P_HALMSTCOMPDES44outputTCELL40:OUT_Q3
Q0P_HALMSTCOMPDES45outputTCELL40:OUT_F7
Q0P_HALMSTCOMPDES46outputTCELL40:OUT_F6
Q0P_HALMSTCOMPDES47outputTCELL39:OUT_Q2
Q0P_HALMSTCOMPDES48outputTCELL38:OUT_Q4
Q0P_HALMSTCOMPDES49outputTCELL40:OUT_F4
Q0P_HALMSTCOMPDES5outputTCELL38:OUT_Q2
Q0P_HALMSTCOMPDES50outputTCELL39:OUT_F6
Q0P_HALMSTCOMPDES51outputTCELL39:OUT_F7
Q0P_HALMSTCOMPDES52outputTCELL41:OUT_F0
Q0P_HALMSTCOMPDES53outputTCELL40:OUT_F3
Q0P_HALMSTCOMPDES54outputTCELL40:OUT_Q6
Q0P_HALMSTCOMPDES55outputTCELL38:OUT_F4
Q0P_HALMSTCOMPDES56outputTCELL40:OUT_Q7
Q0P_HALMSTCOMPDES57outputTCELL41:OUT_Q2
Q0P_HALMSTCOMPDES58outputTCELL40:OUT_Q0
Q0P_HALMSTCOMPDES59outputTCELL39:OUT_Q0
Q0P_HALMSTCOMPDES6outputTCELL39:OUT_F0
Q0P_HALMSTCOMPDES60outputTCELL39:OUT_F3
Q0P_HALMSTCOMPDES61outputTCELL40:OUT_F5
Q0P_HALMSTCOMPDES62outputTCELL41:OUT_Q1
Q0P_HALMSTCOMPDES63outputTCELL39:OUT_F2
Q0P_HALMSTCOMPDES64outputTCELL34:OUT_Q7
Q0P_HALMSTCOMPDES65outputTCELL35:OUT_F3
Q0P_HALMSTCOMPDES66outputTCELL34:OUT_Q4
Q0P_HALMSTCOMPDES67outputTCELL33:OUT_Q6
Q0P_HALMSTCOMPDES68outputTCELL34:OUT_Q1
Q0P_HALMSTCOMPDES69outputTCELL35:OUT_F2
Q0P_HALMSTCOMPDES7outputTCELL41:OUT_F4
Q0P_HALMSTCOMPDES70outputTCELL34:OUT_F2
Q0P_HALMSTCOMPDES71outputTCELL34:OUT_F7
Q0P_HALMSTCOMPDES72outputTCELL33:OUT_Q7
Q0P_HALMSTCOMPDES73outputTCELL34:OUT_F6
Q0P_HALMSTCOMPDES74outputTCELL34:OUT_F3
Q0P_HALMSTCOMPDES75outputTCELL34:OUT_F0
Q0P_HALMSTCOMPDES76outputTCELL33:OUT_Q5
Q0P_HALMSTCOMPDES77outputTCELL35:OUT_Q0
Q0P_HALMSTCOMPDES78outputTCELL35:OUT_Q2
Q0P_HALMSTCOMPDES79outputTCELL33:OUT_Q0
Q0P_HALMSTCOMPDES8outputTCELL40:OUT_Q4
Q0P_HALMSTCOMPDES80outputTCELL37:OUT_F6
Q0P_HALMSTCOMPDES81outputTCELL37:OUT_Q3
Q0P_HALMSTCOMPDES82outputTCELL38:OUT_F2
Q0P_HALMSTCOMPDES83outputTCELL37:OUT_F2
Q0P_HALMSTCOMPDES84outputTCELL36:OUT_F6
Q0P_HALMSTCOMPDES85outputTCELL36:OUT_F4
Q0P_HALMSTCOMPDES86outputTCELL36:OUT_Q2
Q0P_HALMSTCOMPDES87outputTCELL36:OUT_F7
Q0P_HALMSTCOMPDES88outputTCELL35:OUT_F7
Q0P_HALMSTCOMPDES89outputTCELL35:OUT_F6
Q0P_HALMSTCOMPDES9outputTCELL41:OUT_F1
Q0P_HALMSTCOMPDES90outputTCELL34:OUT_Q5
Q0P_HALMSTCOMPDES91outputTCELL34:OUT_Q2
Q0P_HALMSTCOMPDES92outputTCELL35:OUT_F1
Q0P_HALMSTCOMPDES93outputTCELL34:OUT_Q3
Q0P_HALMSTCOMPDES94outputTCELL35:OUT_F0
Q0P_HALMSTCOMPDES95outputTCELL35:OUT_F4
Q0P_HALMSTCOMPDES96outputTCELL37:OUT_Q6
Q0P_HALMSTCOMPDES97outputTCELL38:OUT_F0
Q0P_HALMSTCOMPDES98outputTCELL38:OUT_F1
Q0P_HALMSTCOMPDES99outputTCELL37:OUT_Q4
Q0P_HALMSTCOMPEOPoutputTCELL37:OUT_F3
Q0P_HALMSTCOMPRDYinputTCELL47:IMUX_A2
Q0P_HALMSTCOMPSOPoutputTCELL36:OUT_Q7
Q0P_HALMSTCOMPVLDoutputTCELL36:OUT_Q6
Q0P_HALMSTRBVLD0outputTCELL37:OUT_F0
Q0P_HALMSTRBVLD1outputTCELL36:OUT_Q3
Q0P_HALMSTRBVLD2outputTCELL37:OUT_Q2
Q0P_HALMSTRBVLD3outputTCELL36:OUT_F3
Q0P_HALMSTRBVLD4outputTCELL36:OUT_F2
Q0P_HALMSTRBVLD5outputTCELL37:OUT_F5
Q0P_HALMSTRBVLD6outputTCELL36:OUT_Q5
Q0P_HALMSTRBVLD7outputTCELL36:OUT_Q4
Q0P_HALMSTREJoutputTCELL43:OUT_Q1
Q0P_HALMSTREQinputTCELL43:IMUX_A5
Q0P_HALMSTREQATTR0inputTCELL47:IMUX_A0
Q0P_HALMSTREQATTR1inputTCELL47:IMUX_A1
Q0P_HALMSTREQATTR2inputTCELL48:IMUX_A3
Q0P_HALMSTREQDES0inputTCELL46:IMUX_B0
Q0P_HALMSTREQDES1inputTCELL45:IMUX_C1
Q0P_HALMSTREQDES10inputTCELL45:IMUX_C2
Q0P_HALMSTREQDES100inputTCELL41:IMUX_C5
Q0P_HALMSTREQDES101inputTCELL41:IMUX_C4
Q0P_HALMSTREQDES102inputTCELL41:IMUX_B5
Q0P_HALMSTREQDES103inputTCELL41:IMUX_B4
Q0P_HALMSTREQDES104inputTCELL41:IMUX_B3
Q0P_HALMSTREQDES105inputTCELL41:IMUX_B2
Q0P_HALMSTREQDES106inputTCELL41:IMUX_B1
Q0P_HALMSTREQDES107inputTCELL41:IMUX_C1
Q0P_HALMSTREQDES108inputTCELL41:IMUX_A5
Q0P_HALMSTREQDES109inputTCELL41:IMUX_A4
Q0P_HALMSTREQDES11inputTCELL45:IMUX_C3
Q0P_HALMSTREQDES110inputTCELL41:IMUX_C3
Q0P_HALMSTREQDES111inputTCELL41:IMUX_A3
Q0P_HALMSTREQDES112inputTCELL41:IMUX_A2
Q0P_HALMSTREQDES113inputTCELL41:IMUX_A1
Q0P_HALMSTREQDES114inputTCELL41:IMUX_B0
Q0P_HALMSTREQDES115inputTCELL41:IMUX_C2
Q0P_HALMSTREQDES116inputTCELL41:IMUX_A0
Q0P_HALMSTREQDES117inputTCELL40:IMUX_D5
Q0P_HALMSTREQDES118inputTCELL40:IMUX_D4
Q0P_HALMSTREQDES119inputTCELL40:IMUX_D3
Q0P_HALMSTREQDES12inputTCELL45:IMUX_B4
Q0P_HALMSTREQDES120inputTCELL40:IMUX_D2
Q0P_HALMSTREQDES121inputTCELL40:IMUX_D0
Q0P_HALMSTREQDES122inputTCELL40:IMUX_C5
Q0P_HALMSTREQDES123inputTCELL40:IMUX_C3
Q0P_HALMSTREQDES124inputTCELL40:IMUX_C2
Q0P_HALMSTREQDES125inputTCELL40:IMUX_C4
Q0P_HALMSTREQDES126inputTCELL41:IMUX_C0
Q0P_HALMSTREQDES127inputTCELL43:IMUX_A4
Q0P_HALMSTREQDES13inputTCELL46:IMUX_B3
Q0P_HALMSTREQDES14inputTCELL46:IMUX_B2
Q0P_HALMSTREQDES15inputTCELL46:IMUX_A0
Q0P_HALMSTREQDES16inputTCELL45:IMUX_C4
Q0P_HALMSTREQDES17inputTCELL45:IMUX_B1
Q0P_HALMSTREQDES18inputTCELL45:IMUX_D2
Q0P_HALMSTREQDES19inputTCELL45:IMUX_A4
Q0P_HALMSTREQDES2inputTCELL45:IMUX_D5
Q0P_HALMSTREQDES20inputTCELL45:IMUX_A1
Q0P_HALMSTREQDES21inputTCELL45:IMUX_B2
Q0P_HALMSTREQDES22inputTCELL45:IMUX_B3
Q0P_HALMSTREQDES23inputTCELL44:IMUX_D3
Q0P_HALMSTREQDES24inputTCELL46:IMUX_D2
Q0P_HALMSTREQDES25inputTCELL46:IMUX_C3
Q0P_HALMSTREQDES26inputTCELL46:IMUX_D4
Q0P_HALMSTREQDES27inputTCELL46:IMUX_D1
Q0P_HALMSTREQDES28inputTCELL46:IMUX_C4
Q0P_HALMSTREQDES29inputTCELL46:IMUX_D0
Q0P_HALMSTREQDES3inputTCELL45:IMUX_D4
Q0P_HALMSTREQDES30inputTCELL46:IMUX_C5
Q0P_HALMSTREQDES31inputTCELL46:IMUX_B1
Q0P_HALMSTREQDES32inputTCELL46:IMUX_A3
Q0P_HALMSTREQDES33inputTCELL46:IMUX_A1
Q0P_HALMSTREQDES34inputTCELL45:IMUX_C0
Q0P_HALMSTREQDES35inputTCELL45:IMUX_C5
Q0P_HALMSTREQDES36inputTCELL45:IMUX_A2
Q0P_HALMSTREQDES37inputTCELL44:IMUX_D4
Q0P_HALMSTREQDES38inputTCELL45:IMUX_A0
Q0P_HALMSTREQDES39inputTCELL44:IMUX_D2
Q0P_HALMSTREQDES4inputTCELL45:IMUX_D3
Q0P_HALMSTREQDES40inputTCELL44:IMUX_D0
Q0P_HALMSTREQDES41inputTCELL44:IMUX_D5
Q0P_HALMSTREQDES42inputTCELL44:IMUX_C4
Q0P_HALMSTREQDES43inputTCELL44:IMUX_C3
Q0P_HALMSTREQDES44inputTCELL44:IMUX_C5
Q0P_HALMSTREQDES45inputTCELL44:IMUX_C2
Q0P_HALMSTREQDES46inputTCELL44:IMUX_B2
Q0P_HALMSTREQDES47inputTCELL44:IMUX_B3
Q0P_HALMSTREQDES48inputTCELL44:IMUX_C1
Q0P_HALMSTREQDES49inputTCELL44:IMUX_C0
Q0P_HALMSTREQDES5inputTCELL45:IMUX_D1
Q0P_HALMSTREQDES50inputTCELL44:IMUX_B1
Q0P_HALMSTREQDES51inputTCELL44:IMUX_B4
Q0P_HALMSTREQDES52inputTCELL44:IMUX_B5
Q0P_HALMSTREQDES53inputTCELL44:IMUX_B0
Q0P_HALMSTREQDES54inputTCELL44:IMUX_A3
Q0P_HALMSTREQDES55inputTCELL44:IMUX_A4
Q0P_HALMSTREQDES56inputTCELL44:IMUX_A1
Q0P_HALMSTREQDES57inputTCELL43:IMUX_D0
Q0P_HALMSTREQDES58inputTCELL43:IMUX_D1
Q0P_HALMSTREQDES59inputTCELL44:IMUX_A0
Q0P_HALMSTREQDES6inputTCELL45:IMUX_D0
Q0P_HALMSTREQDES60inputTCELL43:IMUX_D2
Q0P_HALMSTREQDES61inputTCELL43:IMUX_D3
Q0P_HALMSTREQDES62inputTCELL43:IMUX_C4
Q0P_HALMSTREQDES63inputTCELL43:IMUX_C3
Q0P_HALMSTREQDES64inputTCELL43:IMUX_C0
Q0P_HALMSTREQDES65inputTCELL43:IMUX_C1
Q0P_HALMSTREQDES66inputTCELL43:IMUX_C5
Q0P_HALMSTREQDES67inputTCELL44:IMUX_A5
Q0P_HALMSTREQDES68inputTCELL43:IMUX_D5
Q0P_HALMSTREQDES69inputTCELL43:IMUX_D4
Q0P_HALMSTREQDES7inputTCELL44:IMUX_D1
Q0P_HALMSTREQDES70inputTCELL43:IMUX_B3
Q0P_HALMSTREQDES71inputTCELL43:IMUX_B0
Q0P_HALMSTREQDES72inputTCELL43:IMUX_A3
Q0P_HALMSTREQDES73inputTCELL44:IMUX_A2
Q0P_HALMSTREQDES74inputTCELL43:IMUX_A2
Q0P_HALMSTREQDES75inputTCELL43:IMUX_A1
Q0P_HALMSTREQDES76inputTCELL43:IMUX_B5
Q0P_HALMSTREQDES77inputTCELL43:IMUX_B1
Q0P_HALMSTREQDES78inputTCELL43:IMUX_C2
Q0P_HALMSTREQDES79inputTCELL42:IMUX_D5
Q0P_HALMSTREQDES8inputTCELL45:IMUX_B0
Q0P_HALMSTREQDES80inputTCELL43:IMUX_B2
Q0P_HALMSTREQDES81inputTCELL42:IMUX_D4
Q0P_HALMSTREQDES82inputTCELL42:IMUX_D3
Q0P_HALMSTREQDES83inputTCELL42:IMUX_D2
Q0P_HALMSTREQDES84inputTCELL42:IMUX_C2
Q0P_HALMSTREQDES85inputTCELL42:IMUX_B5
Q0P_HALMSTREQDES86inputTCELL47:IMUX_A4
Q0P_HALMSTREQDES87inputTCELL42:IMUX_B4
Q0P_HALMSTREQDES88inputTCELL42:IMUX_B3
Q0P_HALMSTREQDES89inputTCELL42:IMUX_B2
Q0P_HALMSTREQDES9inputTCELL45:IMUX_A3
Q0P_HALMSTREQDES90inputTCELL42:IMUX_A5
Q0P_HALMSTREQDES91inputTCELL42:IMUX_A4
Q0P_HALMSTREQDES92inputTCELL42:IMUX_A3
Q0P_HALMSTREQDES93inputTCELL42:IMUX_A2
Q0P_HALMSTREQDES94inputTCELL41:IMUX_D5
Q0P_HALMSTREQDES95inputTCELL41:IMUX_D4
Q0P_HALMSTREQDES96inputTCELL41:IMUX_D3
Q0P_HALMSTREQDES97inputTCELL41:IMUX_D2
Q0P_HALMSTREQDES98inputTCELL41:IMUX_D1
Q0P_HALMSTREQDES99inputTCELL41:IMUX_D0
Q0P_HALMSTREQTPHPRESENTinputTCELL49:IMUX_C7
Q0P_HALMSTREQTPHSTTAG0inputTCELL50:IMUX_C4
Q0P_HALMSTREQTPHSTTAG1inputTCELL50:IMUX_A7
Q0P_HALMSTREQTPHSTTAG2inputTCELL50:IMUX_A5
Q0P_HALMSTREQTPHSTTAG3inputTCELL50:IMUX_B7
Q0P_HALMSTREQTPHSTTAG4inputTCELL50:IMUX_A4
Q0P_HALMSTREQTPHSTTAG5inputTCELL50:IMUX_C5
Q0P_HALMSTREQTPHSTTAG6inputTCELL50:IMUX_B3
Q0P_HALMSTREQTPHSTTAG7inputTCELL50:IMUX_B5
Q0P_HALMSTREQTPHTYPE0inputTCELL49:IMUX_D6
Q0P_HALMSTREQTPHTYPE1inputTCELL49:IMUX_D4
Q0P_HALMSTRERRoutputTCELL46:OUT_F4
Q0P_HALMSTTAG0outputTCELL44:OUT_F6
Q0P_HALMSTTAG1outputTCELL44:OUT_F3
Q0P_HALMSTTAG2outputTCELL44:OUT_F1
Q0P_HALMSTTAG3outputTCELL44:OUT_F4
Q0P_HALMSTTAG4outputTCELL44:OUT_F5
Q0P_HALMSTWBVLD0inputTCELL46:IMUX_A4
Q0P_HALMSTWBVLD1inputTCELL45:IMUX_A5
Q0P_HALMSTWBVLD2inputTCELL45:IMUX_B5
Q0P_HALMSTWBVLD3inputTCELL46:IMUX_C1
Q0P_HALMSTWBVLD4inputTCELL46:IMUX_C2
Q0P_HALMSTWBVLD5inputTCELL46:IMUX_D3
Q0P_HALMSTWBVLD6inputTCELL46:IMUX_B5
Q0P_HALMSTWBVLD7inputTCELL46:IMUX_C0
Q0P_HALMSTWDATVLDinputTCELL46:IMUX_A5
Q0P_HALMSTWEOPinputTCELL46:IMUX_A2
Q0P_HALMSTWERRinputTCELL46:IMUX_B4
Q0P_HALMSTWRDYoutputTCELL32:OUT_F0
Q0P_HALTGTACKinputTCELL40:IMUX_B5
Q0P_HALTGTCAREQDES0inputTCELL40:IMUX_C1
Q0P_HALTGTCAREQDES1inputTCELL40:IMUX_B4
Q0P_HALTGTCAREQDES10inputTCELL40:IMUX_A1
Q0P_HALTGTCAREQDES100inputTCELL37:IMUX_D1
Q0P_HALTGTCAREQDES101inputTCELL38:IMUX_A1
Q0P_HALTGTCAREQDES102inputTCELL38:IMUX_C1
Q0P_HALTGTCAREQDES103inputTCELL38:IMUX_C2
Q0P_HALTGTCAREQDES104inputTCELL35:IMUX_B4
Q0P_HALTGTCAREQDES105inputTCELL35:IMUX_B3
Q0P_HALTGTCAREQDES106inputTCELL35:IMUX_B2
Q0P_HALTGTCAREQDES107inputTCELL48:IMUX_A2
Q0P_HALTGTCAREQDES108inputTCELL47:IMUX_A5
Q0P_HALTGTCAREQDES109inputTCELL47:IMUX_D5
Q0P_HALTGTCAREQDES11inputTCELL40:IMUX_A0
Q0P_HALTGTCAREQDES110inputTCELL47:IMUX_B0
Q0P_HALTGTCAREQDES111inputTCELL47:IMUX_D4
Q0P_HALTGTCAREQDES112inputTCELL47:IMUX_B1
Q0P_HALTGTCAREQDES113inputTCELL47:IMUX_B2
Q0P_HALTGTCAREQDES114inputTCELL47:IMUX_D3
Q0P_HALTGTCAREQDES115inputTCELL47:IMUX_D2
Q0P_HALTGTCAREQDES116inputTCELL47:IMUX_B3
Q0P_HALTGTCAREQDES117inputTCELL47:IMUX_D1
Q0P_HALTGTCAREQDES118inputTCELL47:IMUX_B4
Q0P_HALTGTCAREQDES119inputTCELL47:IMUX_D0
Q0P_HALTGTCAREQDES12inputTCELL39:IMUX_D3
Q0P_HALTGTCAREQDES120inputTCELL40:IMUX_D1
Q0P_HALTGTCAREQDES121inputTCELL35:IMUX_D5
Q0P_HALTGTCAREQDES122inputTCELL47:IMUX_C5
Q0P_HALTGTCAREQDES123inputTCELL47:IMUX_C4
Q0P_HALTGTCAREQDES124inputTCELL47:IMUX_B5
Q0P_HALTGTCAREQDES125inputTCELL47:IMUX_C3
Q0P_HALTGTCAREQDES126inputTCELL47:IMUX_C0
Q0P_HALTGTCAREQDES127inputTCELL47:IMUX_C2
Q0P_HALTGTCAREQDES13inputTCELL39:IMUX_D2
Q0P_HALTGTCAREQDES14inputTCELL39:IMUX_D1
Q0P_HALTGTCAREQDES15inputTCELL39:IMUX_D0
Q0P_HALTGTCAREQDES16inputTCELL39:IMUX_C3
Q0P_HALTGTCAREQDES17inputTCELL39:IMUX_C2
Q0P_HALTGTCAREQDES18inputTCELL39:IMUX_C1
Q0P_HALTGTCAREQDES19inputTCELL39:IMUX_C0
Q0P_HALTGTCAREQDES2inputTCELL40:IMUX_B3
Q0P_HALTGTCAREQDES20inputTCELL39:IMUX_B3
Q0P_HALTGTCAREQDES21inputTCELL39:IMUX_B2
Q0P_HALTGTCAREQDES22inputTCELL39:IMUX_B1
Q0P_HALTGTCAREQDES23inputTCELL39:IMUX_B0
Q0P_HALTGTCAREQDES24inputTCELL39:IMUX_A3
Q0P_HALTGTCAREQDES25inputTCELL39:IMUX_A2
Q0P_HALTGTCAREQDES26inputTCELL39:IMUX_A1
Q0P_HALTGTCAREQDES27inputTCELL39:IMUX_A0
Q0P_HALTGTCAREQDES28inputTCELL38:IMUX_D5
Q0P_HALTGTCAREQDES29inputTCELL38:IMUX_D4
Q0P_HALTGTCAREQDES3inputTCELL40:IMUX_B2
Q0P_HALTGTCAREQDES30inputTCELL38:IMUX_D3
Q0P_HALTGTCAREQDES31inputTCELL38:IMUX_D2
Q0P_HALTGTCAREQDES32inputTCELL38:IMUX_D1
Q0P_HALTGTCAREQDES33inputTCELL38:IMUX_D0
Q0P_HALTGTCAREQDES34inputTCELL38:IMUX_C5
Q0P_HALTGTCAREQDES35inputTCELL38:IMUX_C4
Q0P_HALTGTCAREQDES36inputTCELL38:IMUX_C3
Q0P_HALTGTCAREQDES37inputTCELL38:IMUX_C0
Q0P_HALTGTCAREQDES38inputTCELL38:IMUX_B5
Q0P_HALTGTCAREQDES39inputTCELL38:IMUX_B4
Q0P_HALTGTCAREQDES4inputTCELL40:IMUX_B1
Q0P_HALTGTCAREQDES40inputTCELL38:IMUX_B3
Q0P_HALTGTCAREQDES41inputTCELL38:IMUX_B2
Q0P_HALTGTCAREQDES42inputTCELL38:IMUX_B1
Q0P_HALTGTCAREQDES43inputTCELL38:IMUX_B0
Q0P_HALTGTCAREQDES44inputTCELL38:IMUX_A5
Q0P_HALTGTCAREQDES45inputTCELL38:IMUX_A4
Q0P_HALTGTCAREQDES46inputTCELL38:IMUX_A3
Q0P_HALTGTCAREQDES47inputTCELL38:IMUX_A2
Q0P_HALTGTCAREQDES48inputTCELL37:IMUX_D5
Q0P_HALTGTCAREQDES49inputTCELL37:IMUX_D4
Q0P_HALTGTCAREQDES5inputTCELL40:IMUX_B0
Q0P_HALTGTCAREQDES50inputTCELL37:IMUX_D3
Q0P_HALTGTCAREQDES51inputTCELL37:IMUX_D2
Q0P_HALTGTCAREQDES52inputTCELL37:IMUX_D0
Q0P_HALTGTCAREQDES53inputTCELL37:IMUX_C5
Q0P_HALTGTCAREQDES54inputTCELL37:IMUX_C4
Q0P_HALTGTCAREQDES55inputTCELL37:IMUX_C3
Q0P_HALTGTCAREQDES56inputTCELL37:IMUX_C2
Q0P_HALTGTCAREQDES57inputTCELL37:IMUX_C1
Q0P_HALTGTCAREQDES58inputTCELL37:IMUX_C0
Q0P_HALTGTCAREQDES59inputTCELL37:IMUX_B5
Q0P_HALTGTCAREQDES6inputTCELL40:IMUX_A5
Q0P_HALTGTCAREQDES60inputTCELL37:IMUX_B3
Q0P_HALTGTCAREQDES61inputTCELL37:IMUX_B2
Q0P_HALTGTCAREQDES62inputTCELL37:IMUX_B0
Q0P_HALTGTCAREQDES63inputTCELL37:IMUX_A5
Q0P_HALTGTCAREQDES64inputTCELL37:IMUX_A4
Q0P_HALTGTCAREQDES65inputTCELL37:IMUX_A3
Q0P_HALTGTCAREQDES66inputTCELL37:IMUX_A2
Q0P_HALTGTCAREQDES67inputTCELL37:IMUX_A1
Q0P_HALTGTCAREQDES68inputTCELL36:IMUX_D5
Q0P_HALTGTCAREQDES69inputTCELL36:IMUX_D4
Q0P_HALTGTCAREQDES7inputTCELL40:IMUX_A4
Q0P_HALTGTCAREQDES70inputTCELL36:IMUX_D3
Q0P_HALTGTCAREQDES71inputTCELL36:IMUX_D2
Q0P_HALTGTCAREQDES72inputTCELL36:IMUX_C5
Q0P_HALTGTCAREQDES73inputTCELL36:IMUX_C4
Q0P_HALTGTCAREQDES74inputTCELL36:IMUX_B5
Q0P_HALTGTCAREQDES75inputTCELL36:IMUX_B4
Q0P_HALTGTCAREQDES76inputTCELL36:IMUX_B3
Q0P_HALTGTCAREQDES77inputTCELL36:IMUX_B2
Q0P_HALTGTCAREQDES78inputTCELL36:IMUX_A5
Q0P_HALTGTCAREQDES79inputTCELL36:IMUX_A4
Q0P_HALTGTCAREQDES8inputTCELL40:IMUX_A3
Q0P_HALTGTCAREQDES80inputTCELL36:IMUX_A3
Q0P_HALTGTCAREQDES81inputTCELL38:IMUX_A0
Q0P_HALTGTCAREQDES82inputTCELL37:IMUX_A0
Q0P_HALTGTCAREQDES83inputTCELL37:IMUX_B1
Q0P_HALTGTCAREQDES84inputTCELL36:IMUX_A2
Q0P_HALTGTCAREQDES85inputTCELL35:IMUX_D4
Q0P_HALTGTCAREQDES86inputTCELL36:IMUX_C3
Q0P_HALTGTCAREQDES87inputTCELL35:IMUX_D3
Q0P_HALTGTCAREQDES88inputTCELL35:IMUX_D2
Q0P_HALTGTCAREQDES89inputTCELL35:IMUX_D1
Q0P_HALTGTCAREQDES9inputTCELL40:IMUX_A2
Q0P_HALTGTCAREQDES90inputTCELL35:IMUX_D0
Q0P_HALTGTCAREQDES91inputTCELL35:IMUX_C5
Q0P_HALTGTCAREQDES92inputTCELL35:IMUX_C4
Q0P_HALTGTCAREQDES93inputTCELL35:IMUX_C3
Q0P_HALTGTCAREQDES94inputTCELL35:IMUX_C2
Q0P_HALTGTCAREQDES95inputTCELL37:IMUX_B4
Q0P_HALTGTCAREQDES96inputTCELL35:IMUX_C1
Q0P_HALTGTCAREQDES97inputTCELL35:IMUX_C0
Q0P_HALTGTCAREQDES98inputTCELL35:IMUX_B5
Q0P_HALTGTCAREQDES99inputTCELL36:IMUX_C2
Q0P_HALTGTCLNTCOMPID0inputTCELL35:IMUX_B1
Q0P_HALTGTCLNTCOMPID1inputTCELL35:IMUX_B0
Q0P_HALTGTCLNTCOMPID10inputTCELL34:IMUX_D3
Q0P_HALTGTCLNTCOMPID11inputTCELL34:IMUX_D2
Q0P_HALTGTCLNTCOMPID12inputTCELL34:IMUX_D1
Q0P_HALTGTCLNTCOMPID13inputTCELL34:IMUX_D0
Q0P_HALTGTCLNTCOMPID14inputTCELL34:IMUX_C5
Q0P_HALTGTCLNTCOMPID15inputTCELL34:IMUX_C4
Q0P_HALTGTCLNTCOMPID2inputTCELL35:IMUX_A5
Q0P_HALTGTCLNTCOMPID3inputTCELL35:IMUX_A4
Q0P_HALTGTCLNTCOMPID4inputTCELL35:IMUX_A3
Q0P_HALTGTCLNTCOMPID5inputTCELL35:IMUX_A2
Q0P_HALTGTCLNTCOMPID6inputTCELL35:IMUX_A1
Q0P_HALTGTCLNTCOMPID7inputTCELL35:IMUX_A0
Q0P_HALTGTCLNTCOMPID8inputTCELL34:IMUX_D5
Q0P_HALTGTCLNTCOMPID9inputTCELL34:IMUX_D4
Q0P_HALTGTCLNTCOMPIDENinputTCELL30:IMUX_C0
Q0P_HALTGTCOMPBVLD0inputTCELL34:IMUX_C3
Q0P_HALTGTCOMPBVLD1inputTCELL34:IMUX_C2
Q0P_HALTGTCOMPBVLD2inputTCELL34:IMUX_C1
Q0P_HALTGTCOMPBVLD3inputTCELL34:IMUX_C0
Q0P_HALTGTCOMPBVLD4inputTCELL34:IMUX_B5
Q0P_HALTGTCOMPBVLD5inputTCELL34:IMUX_B4
Q0P_HALTGTCOMPBVLD6inputTCELL34:IMUX_B3
Q0P_HALTGTCOMPBVLD7inputTCELL34:IMUX_B2
Q0P_HALTGTCOMPDES0inputTCELL34:IMUX_B1
Q0P_HALTGTCOMPDES1inputTCELL34:IMUX_B0
Q0P_HALTGTCOMPDES10inputTCELL29:IMUX_A1
Q0P_HALTGTCOMPDES100inputTCELL31:IMUX_A5
Q0P_HALTGTCOMPDES101inputTCELL31:IMUX_A0
Q0P_HALTGTCOMPDES102inputTCELL30:IMUX_C4
Q0P_HALTGTCOMPDES103inputTCELL30:IMUX_D2
Q0P_HALTGTCOMPDES104inputTCELL31:IMUX_C3
Q0P_HALTGTCOMPDES105inputTCELL31:IMUX_C5
Q0P_HALTGTCOMPDES106inputTCELL32:IMUX_C0
Q0P_HALTGTCOMPDES107inputTCELL31:IMUX_D1
Q0P_HALTGTCOMPDES108inputTCELL31:IMUX_B2
Q0P_HALTGTCOMPDES109inputTCELL32:IMUX_B2
Q0P_HALTGTCOMPDES11inputTCELL29:IMUX_A2
Q0P_HALTGTCOMPDES110inputTCELL32:IMUX_B5
Q0P_HALTGTCOMPDES111inputTCELL32:IMUX_B3
Q0P_HALTGTCOMPDES112inputTCELL32:IMUX_A5
Q0P_HALTGTCOMPDES113inputTCELL32:IMUX_A0
Q0P_HALTGTCOMPDES114inputTCELL32:IMUX_A1
Q0P_HALTGTCOMPDES115inputTCELL31:IMUX_C1
Q0P_HALTGTCOMPDES116inputTCELL31:IMUX_C0
Q0P_HALTGTCOMPDES117inputTCELL32:IMUX_A3
Q0P_HALTGTCOMPDES118inputTCELL31:IMUX_B5
Q0P_HALTGTCOMPDES119inputTCELL47:IMUX_C1
Q0P_HALTGTCOMPDES12inputTCELL33:IMUX_D4
Q0P_HALTGTCOMPDES120inputTCELL31:IMUX_D2
Q0P_HALTGTCOMPDES121inputTCELL30:IMUX_C1
Q0P_HALTGTCOMPDES122inputTCELL31:IMUX_B1
Q0P_HALTGTCOMPDES123inputTCELL31:IMUX_B3
Q0P_HALTGTCOMPDES124inputTCELL31:IMUX_B4
Q0P_HALTGTCOMPDES125inputTCELL30:IMUX_D3
Q0P_HALTGTCOMPDES126inputTCELL30:IMUX_D5
Q0P_HALTGTCOMPDES127inputTCELL29:IMUX_D5
Q0P_HALTGTCOMPDES13inputTCELL29:IMUX_A3
Q0P_HALTGTCOMPDES14inputTCELL29:IMUX_A4
Q0P_HALTGTCOMPDES15inputTCELL33:IMUX_D3
Q0P_HALTGTCOMPDES16inputTCELL29:IMUX_A5
Q0P_HALTGTCOMPDES17inputTCELL29:IMUX_B0
Q0P_HALTGTCOMPDES18inputTCELL33:IMUX_D2
Q0P_HALTGTCOMPDES19inputTCELL33:IMUX_D1
Q0P_HALTGTCOMPDES2inputTCELL34:IMUX_A5
Q0P_HALTGTCOMPDES20inputTCELL33:IMUX_D0
Q0P_HALTGTCOMPDES21inputTCELL33:IMUX_C4
Q0P_HALTGTCOMPDES22inputTCELL29:IMUX_B1
Q0P_HALTGTCOMPDES23inputTCELL29:IMUX_B2
Q0P_HALTGTCOMPDES24inputTCELL29:IMUX_B3
Q0P_HALTGTCOMPDES25inputTCELL29:IMUX_B4
Q0P_HALTGTCOMPDES26inputTCELL29:IMUX_B5
Q0P_HALTGTCOMPDES27inputTCELL29:IMUX_C0
Q0P_HALTGTCOMPDES28inputTCELL29:IMUX_C1
Q0P_HALTGTCOMPDES29inputTCELL29:IMUX_C2
Q0P_HALTGTCOMPDES3inputTCELL34:IMUX_A4
Q0P_HALTGTCOMPDES30inputTCELL29:IMUX_C3
Q0P_HALTGTCOMPDES31inputTCELL29:IMUX_C4
Q0P_HALTGTCOMPDES32inputTCELL29:IMUX_C5
Q0P_HALTGTCOMPDES33inputTCELL29:IMUX_D0
Q0P_HALTGTCOMPDES34inputTCELL33:IMUX_C3
Q0P_HALTGTCOMPDES35inputTCELL33:IMUX_C2
Q0P_HALTGTCOMPDES36inputTCELL33:IMUX_C1
Q0P_HALTGTCOMPDES37inputTCELL33:IMUX_C0
Q0P_HALTGTCOMPDES38inputTCELL33:IMUX_B5
Q0P_HALTGTCOMPDES39inputTCELL33:IMUX_B4
Q0P_HALTGTCOMPDES4inputTCELL34:IMUX_A3
Q0P_HALTGTCOMPDES40inputTCELL33:IMUX_B3
Q0P_HALTGTCOMPDES41inputTCELL33:IMUX_B2
Q0P_HALTGTCOMPDES42inputTCELL33:IMUX_B1
Q0P_HALTGTCOMPDES43inputTCELL33:IMUX_B0
Q0P_HALTGTCOMPDES44inputTCELL33:IMUX_A5
Q0P_HALTGTCOMPDES45inputTCELL33:IMUX_A4
Q0P_HALTGTCOMPDES46inputTCELL33:IMUX_A3
Q0P_HALTGTCOMPDES47inputTCELL33:IMUX_A2
Q0P_HALTGTCOMPDES48inputTCELL33:IMUX_A1
Q0P_HALTGTCOMPDES49inputTCELL33:IMUX_A0
Q0P_HALTGTCOMPDES5inputTCELL34:IMUX_A2
Q0P_HALTGTCOMPDES50inputTCELL32:IMUX_D5
Q0P_HALTGTCOMPDES51inputTCELL32:IMUX_D4
Q0P_HALTGTCOMPDES52inputTCELL32:IMUX_D3
Q0P_HALTGTCOMPDES53inputTCELL32:IMUX_D2
Q0P_HALTGTCOMPDES54inputTCELL32:IMUX_D1
Q0P_HALTGTCOMPDES55inputTCELL32:IMUX_D0
Q0P_HALTGTCOMPDES56inputTCELL32:IMUX_C5
Q0P_HALTGTCOMPDES57inputTCELL32:IMUX_C4
Q0P_HALTGTCOMPDES58inputTCELL32:IMUX_C3
Q0P_HALTGTCOMPDES59inputTCELL29:IMUX_D1
Q0P_HALTGTCOMPDES6inputTCELL34:IMUX_A1
Q0P_HALTGTCOMPDES60inputTCELL32:IMUX_C2
Q0P_HALTGTCOMPDES61inputTCELL29:IMUX_D2
Q0P_HALTGTCOMPDES62inputTCELL29:IMUX_D3
Q0P_HALTGTCOMPDES63inputTCELL29:IMUX_D4
Q0P_HALTGTCOMPDES64inputTCELL30:IMUX_A0
Q0P_HALTGTCOMPDES65inputTCELL30:IMUX_A1
Q0P_HALTGTCOMPDES66inputTCELL30:IMUX_A2
Q0P_HALTGTCOMPDES67inputTCELL30:IMUX_A3
Q0P_HALTGTCOMPDES68inputTCELL33:IMUX_C5
Q0P_HALTGTCOMPDES69inputTCELL30:IMUX_A4
Q0P_HALTGTCOMPDES7inputTCELL34:IMUX_A0
Q0P_HALTGTCOMPDES70inputTCELL32:IMUX_C1
Q0P_HALTGTCOMPDES71inputTCELL30:IMUX_A5
Q0P_HALTGTCOMPDES72inputTCELL30:IMUX_B0
Q0P_HALTGTCOMPDES73inputTCELL30:IMUX_B1
Q0P_HALTGTCOMPDES74inputTCELL30:IMUX_B2
Q0P_HALTGTCOMPDES75inputTCELL32:IMUX_B4
Q0P_HALTGTCOMPDES76inputTCELL32:IMUX_B1
Q0P_HALTGTCOMPDES77inputTCELL30:IMUX_B3
Q0P_HALTGTCOMPDES78inputTCELL30:IMUX_B4
Q0P_HALTGTCOMPDES79inputTCELL30:IMUX_B5
Q0P_HALTGTCOMPDES8inputTCELL33:IMUX_D5
Q0P_HALTGTCOMPDES80inputTCELL30:IMUX_C2
Q0P_HALTGTCOMPDES81inputTCELL30:IMUX_C3
Q0P_HALTGTCOMPDES82inputTCELL32:IMUX_B0
Q0P_HALTGTCOMPDES83inputTCELL31:IMUX_D0
Q0P_HALTGTCOMPDES84inputTCELL31:IMUX_C4
Q0P_HALTGTCOMPDES85inputTCELL31:IMUX_A2
Q0P_HALTGTCOMPDES86inputTCELL31:IMUX_A1
Q0P_HALTGTCOMPDES87inputTCELL31:IMUX_D4
Q0P_HALTGTCOMPDES88inputTCELL32:IMUX_A2
Q0P_HALTGTCOMPDES89inputTCELL31:IMUX_D3
Q0P_HALTGTCOMPDES9inputTCELL29:IMUX_A0
Q0P_HALTGTCOMPDES90inputTCELL31:IMUX_A3
Q0P_HALTGTCOMPDES91inputTCELL31:IMUX_D5
Q0P_HALTGTCOMPDES92inputTCELL31:IMUX_A4
Q0P_HALTGTCOMPDES93inputTCELL31:IMUX_C2
Q0P_HALTGTCOMPDES94inputTCELL30:IMUX_D0
Q0P_HALTGTCOMPDES95inputTCELL30:IMUX_C5
Q0P_HALTGTCOMPDES96inputTCELL30:IMUX_D4
Q0P_HALTGTCOMPDES97inputTCELL32:IMUX_A4
Q0P_HALTGTCOMPDES98inputTCELL31:IMUX_B0
Q0P_HALTGTCOMPDES99inputTCELL30:IMUX_D1
Q0P_HALTGTCOMPEOPinputTCELL43:IMUX_A0
Q0P_HALTGTCOMPERRinputTCELL42:IMUX_C3
Q0P_HALTGTCOMPRDYoutputTCELL18:OUT_F6
Q0P_HALTGTCOMPSOPinputTCELL42:IMUX_C5
Q0P_HALTGTCOMPVLDinputTCELL42:IMUX_C4
Q0P_HALTGTNPREJinputTCELL43:IMUX_B4
Q0P_HALTGTREQoutputTCELL22:OUT_F0
Q0P_HALTGTREQDES0outputTCELL19:OUT_Q2
Q0P_HALTGTREQDES1outputTCELL19:OUT_F7
Q0P_HALTGTREQDES10outputTCELL18:OUT_Q6
Q0P_HALTGTREQDES100outputTCELL30:OUT_Q3
Q0P_HALTGTREQDES101outputTCELL29:OUT_F4
Q0P_HALTGTREQDES102outputTCELL23:OUT_Q0
Q0P_HALTGTREQDES103outputTCELL22:OUT_Q0
Q0P_HALTGTREQDES104outputTCELL23:OUT_F1
Q0P_HALTGTREQDES105outputTCELL22:OUT_Q4
Q0P_HALTGTREQDES106outputTCELL29:OUT_Q6
Q0P_HALTGTREQDES107outputTCELL47:OUT_F2
Q0P_HALTGTREQDES108outputTCELL47:OUT_F0
Q0P_HALTGTREQDES109outputTCELL30:OUT_F2
Q0P_HALTGTREQDES11outputTCELL18:OUT_Q5
Q0P_HALTGTREQDES110outputTCELL29:OUT_Q2
Q0P_HALTGTREQDES111outputTCELL24:OUT_Q4
Q0P_HALTGTREQDES112outputTCELL47:OUT_F1
Q0P_HALTGTREQDES113outputTCELL46:OUT_Q6
Q0P_HALTGTREQDES114outputTCELL46:OUT_Q5
Q0P_HALTGTREQDES115outputTCELL46:OUT_Q7
Q0P_HALTGTREQDES116outputTCELL46:OUT_Q4
Q0P_HALTGTREQDES117outputTCELL46:OUT_Q3
Q0P_HALTGTREQDES118outputTCELL46:OUT_Q1
Q0P_HALTGTREQDES119outputTCELL46:OUT_Q2
Q0P_HALTGTREQDES12outputTCELL18:OUT_Q4
Q0P_HALTGTREQDES120outputTCELL22:OUT_F7
Q0P_HALTGTREQDES121outputTCELL30:OUT_Q1
Q0P_HALTGTREQDES122outputTCELL31:OUT_Q5
Q0P_HALTGTREQDES123outputTCELL31:OUT_Q0
Q0P_HALTGTREQDES124outputTCELL23:OUT_F5
Q0P_HALTGTREQDES125outputTCELL29:OUT_F3
Q0P_HALTGTREQDES126outputTCELL22:OUT_F3
Q0P_HALTGTREQDES127outputTCELL23:OUT_Q4
Q0P_HALTGTREQDES13outputTCELL18:OUT_Q3
Q0P_HALTGTREQDES14outputTCELL18:OUT_Q2
Q0P_HALTGTREQDES15outputTCELL18:OUT_Q7
Q0P_HALTGTREQDES16outputTCELL19:OUT_Q3
Q0P_HALTGTREQDES17outputTCELL19:OUT_F1
Q0P_HALTGTREQDES18outputTCELL19:OUT_F0
Q0P_HALTGTREQDES19outputTCELL18:OUT_F7
Q0P_HALTGTREQDES2outputTCELL19:OUT_F6
Q0P_HALTGTREQDES20outputTCELL29:OUT_F0
Q0P_HALTGTREQDES21outputTCELL23:OUT_Q6
Q0P_HALTGTREQDES22outputTCELL24:OUT_F6
Q0P_HALTGTREQDES23outputTCELL23:OUT_Q7
Q0P_HALTGTREQDES24outputTCELL24:OUT_F2
Q0P_HALTGTREQDES25outputTCELL24:OUT_F3
Q0P_HALTGTREQDES26outputTCELL24:OUT_F7
Q0P_HALTGTREQDES27outputTCELL31:OUT_Q4
Q0P_HALTGTREQDES28outputTCELL31:OUT_F6
Q0P_HALTGTREQDES29outputTCELL31:OUT_F7
Q0P_HALTGTREQDES3outputTCELL19:OUT_F5
Q0P_HALTGTREQDES30outputTCELL24:OUT_F0
Q0P_HALTGTREQDES31outputTCELL23:OUT_Q3
Q0P_HALTGTREQDES32outputTCELL24:OUT_Q0
Q0P_HALTGTREQDES33outputTCELL24:OUT_F1
Q0P_HALTGTREQDES34outputTCELL24:OUT_F4
Q0P_HALTGTREQDES35outputTCELL22:OUT_F5
Q0P_HALTGTREQDES36outputTCELL32:OUT_F3
Q0P_HALTGTREQDES37outputTCELL32:OUT_F6
Q0P_HALTGTREQDES38outputTCELL32:OUT_F4
Q0P_HALTGTREQDES39outputTCELL34:OUT_Q0
Q0P_HALTGTREQDES4outputTCELL19:OUT_F4
Q0P_HALTGTREQDES40outputTCELL32:OUT_F1
Q0P_HALTGTREQDES41outputTCELL23:OUT_Q2
Q0P_HALTGTREQDES42outputTCELL31:OUT_Q6
Q0P_HALTGTREQDES43outputTCELL24:OUT_Q1
Q0P_HALTGTREQDES44outputTCELL22:OUT_Q7
Q0P_HALTGTREQDES45outputTCELL31:OUT_Q3
Q0P_HALTGTREQDES46outputTCELL31:OUT_Q2
Q0P_HALTGTREQDES47outputTCELL23:OUT_F6
Q0P_HALTGTREQDES48outputTCELL24:OUT_Q2
Q0P_HALTGTREQDES49outputTCELL24:OUT_Q3
Q0P_HALTGTREQDES5outputTCELL19:OUT_F3
Q0P_HALTGTREQDES50outputTCELL31:OUT_F5
Q0P_HALTGTREQDES51outputTCELL24:OUT_F5
Q0P_HALTGTREQDES52outputTCELL23:OUT_F0
Q0P_HALTGTREQDES53outputTCELL31:OUT_F4
Q0P_HALTGTREQDES54outputTCELL23:OUT_F4
Q0P_HALTGTREQDES55outputTCELL24:OUT_Q5
Q0P_HALTGTREQDES56outputTCELL29:OUT_F7
Q0P_HALTGTREQDES57outputTCELL22:OUT_Q2
Q0P_HALTGTREQDES58outputTCELL21:OUT_Q5
Q0P_HALTGTREQDES59outputTCELL31:OUT_Q1
Q0P_HALTGTREQDES6outputTCELL19:OUT_F2
Q0P_HALTGTREQDES60outputTCELL21:OUT_Q3
Q0P_HALTGTREQDES61outputTCELL22:OUT_Q5
Q0P_HALTGTREQDES62outputTCELL23:OUT_F2
Q0P_HALTGTREQDES63outputTCELL31:OUT_F1
Q0P_HALTGTREQDES64outputTCELL31:OUT_F0
Q0P_HALTGTREQDES65outputTCELL30:OUT_Q4
Q0P_HALTGTREQDES66outputTCELL24:OUT_Q6
Q0P_HALTGTREQDES67outputTCELL30:OUT_Q2
Q0P_HALTGTREQDES68outputTCELL22:OUT_Q6
Q0P_HALTGTREQDES69outputTCELL29:OUT_Q0
Q0P_HALTGTREQDES7outputTCELL19:OUT_Q1
Q0P_HALTGTREQDES70outputTCELL29:OUT_Q5
Q0P_HALTGTREQDES71outputTCELL30:OUT_F5
Q0P_HALTGTREQDES72outputTCELL30:OUT_Q6
Q0P_HALTGTREQDES73outputTCELL29:OUT_Q4
Q0P_HALTGTREQDES74outputTCELL30:OUT_F4
Q0P_HALTGTREQDES75outputTCELL30:OUT_F1
Q0P_HALTGTREQDES76outputTCELL22:OUT_F4
Q0P_HALTGTREQDES77outputTCELL23:OUT_F7
Q0P_HALTGTREQDES78outputTCELL29:OUT_Q1
Q0P_HALTGTREQDES79outputTCELL30:OUT_Q0
Q0P_HALTGTREQDES8outputTCELL19:OUT_Q0
Q0P_HALTGTREQDES80outputTCELL29:OUT_F6
Q0P_HALTGTREQDES81outputTCELL21:OUT_Q4
Q0P_HALTGTREQDES82outputTCELL30:OUT_F0
Q0P_HALTGTREQDES83outputTCELL30:OUT_F7
Q0P_HALTGTREQDES84outputTCELL29:OUT_Q3
Q0P_HALTGTREQDES85outputTCELL30:OUT_F3
Q0P_HALTGTREQDES86outputTCELL31:OUT_F2
Q0P_HALTGTREQDES87outputTCELL29:OUT_Q7
Q0P_HALTGTREQDES88outputTCELL30:OUT_Q5
Q0P_HALTGTREQDES89outputTCELL23:OUT_F3
Q0P_HALTGTREQDES9outputTCELL21:OUT_Q0
Q0P_HALTGTREQDES90outputTCELL22:OUT_Q3
Q0P_HALTGTREQDES91outputTCELL21:OUT_Q7
Q0P_HALTGTREQDES92outputTCELL31:OUT_F3
Q0P_HALTGTREQDES93outputTCELL24:OUT_Q7
Q0P_HALTGTREQDES94outputTCELL30:OUT_Q7
Q0P_HALTGTREQDES95outputTCELL29:OUT_F2
Q0P_HALTGTREQDES96outputTCELL29:OUT_F1
Q0P_HALTGTREQDES97outputTCELL22:OUT_Q1
Q0P_HALTGTREQDES98outputTCELL30:OUT_F6
Q0P_HALTGTREQDES99outputTCELL29:OUT_F5
Q0P_HALTGTREQMBA0outputTCELL20:OUT_F4
Q0P_HALTGTREQMBA1outputTCELL20:OUT_F3
Q0P_HALTGTREQMBA2outputTCELL20:OUT_F2
Q0P_HALTGTREQMBA3outputTCELL20:OUT_F1
Q0P_HALTGTREQMBA4outputTCELL20:OUT_F0
Q0P_HALTGTREQMBA5outputTCELL19:OUT_Q7
Q0P_HALTGTREQTPHPRESENToutputTCELL18:OUT_F3
Q0P_HALTGTREQTPHSTTAG0outputTCELL20:OUT_Q6
Q0P_HALTGTREQTPHSTTAG1outputTCELL20:OUT_Q5
Q0P_HALTGTREQTPHSTTAG2outputTCELL20:OUT_Q4
Q0P_HALTGTREQTPHSTTAG3outputTCELL20:OUT_Q3
Q0P_HALTGTREQTPHSTTAG4outputTCELL20:OUT_Q2
Q0P_HALTGTREQTPHSTTAG5outputTCELL20:OUT_Q1
Q0P_HALTGTREQTPHSTTAG6outputTCELL20:OUT_Q0
Q0P_HALTGTREQTPHSTTAG7outputTCELL20:OUT_F7
Q0P_HALTGTREQTPHTYPE0outputTCELL20:OUT_F6
Q0P_HALTGTREQTPHTYPE1outputTCELL20:OUT_F5
Q0P_HALTGTWBVLD0outputTCELL21:OUT_F6
Q0P_HALTGTWBVLD1outputTCELL21:OUT_F5
Q0P_HALTGTWBVLD2outputTCELL21:OUT_F4
Q0P_HALTGTWBVLD3outputTCELL21:OUT_F3
Q0P_HALTGTWBVLD4outputTCELL21:OUT_F2
Q0P_HALTGTWBVLD5outputTCELL21:OUT_F1
Q0P_HALTGTWBVLD6outputTCELL21:OUT_F0
Q0P_HALTGTWBVLD7outputTCELL20:OUT_Q7
Q0P_HALTGTWDATVLDoutputTCELL18:OUT_F4
Q0P_HALTGTWEOPoutputTCELL18:OUT_F5
Q0P_HALTGTWRDYinputTCELL40:IMUX_C0
Q0P_HALTSTREQATTR0outputTCELL19:OUT_Q6
Q0P_HALTSTREQATTR1outputTCELL19:OUT_Q5
Q0P_HALTSTREQATTR2outputTCELL19:OUT_Q4
Q0P_HOTRSTINinputTCELL32:IMUX_LSR0
Q0P_HOTRSTOUToutputTCELL48:OUT_F5
Q0P_INTACKoutputTCELL35:OUT_Q5
Q0P_INTAIinputTCELL46:IMUX_D5
Q0P_INTAOoutputTCELL23:OUT_Q1
Q0P_INTBIinputTCELL49:IMUX_C3
Q0P_INTBOoutputTCELL23:OUT_Q5
Q0P_INTCIinputTCELL49:IMUX_C4
Q0P_INTCOoutputTCELL22:OUT_F2
Q0P_INTDIinputTCELL49:IMUX_C5
Q0P_INTDOoutputTCELL22:OUT_F6
Q0P_INTPENDSTSinputTCELL49:IMUX_C6
Q0P_LCLINToutputTCELL44:OUT_F2
Q0P_LNKDWNRSTOUToutputTCELL47:OUT_Q1
Q0P_LNKPWRSTATE0outputTCELL48:OUT_F3
Q0P_LNKPWRSTATE1outputTCELL47:OUT_Q3
Q0P_LNKPWRSTATE2outputTCELL47:OUT_F7
Q0P_LNKPWRSTATE3outputTCELL46:OUT_F7
Q0P_LNKSTS0outputTCELL45:OUT_Q6
Q0P_LNKSTS1outputTCELL47:OUT_F4
Q0P_LTSSMSTATE0outputTCELL45:OUT_Q7
Q0P_LTSSMSTATE1outputTCELL46:OUT_F1
Q0P_LTSSMSTATE2outputTCELL46:OUT_F3
Q0P_LTSSMSTATE3outputTCELL46:OUT_F6
Q0P_LTSSMSTATE4outputTCELL46:OUT_F0
Q0P_LTSSMSTATE5outputTCELL45:OUT_Q3
Q0P_MAXPYLDSIZE0outputTCELL47:OUT_F6
Q0P_MAXPYLDSIZE1outputTCELL47:OUT_Q7
Q0P_MAXPYLDSIZE2outputTCELL47:OUT_Q0
Q0P_MAXREADREQSIZE0outputTCELL43:OUT_Q6
Q0P_MAXREADREQSIZE1outputTCELL40:OUT_F2
Q0P_MAXREADREQSIZE2outputTCELL42:OUT_Q5
Q0P_MBISTCLKinputTCELL29:IMUX_CLK1_DELAY
Q0P_MBISTMODEinputTCELL29:IMUX_LSR0
Q0P_MBISTRSTNinputTCELL30:IMUX_LSR1
Q0P_MSIASRTINT0inputTCELL52:IMUX_C6
Q0P_MSIASRTINT1inputTCELL53:IMUX_B2
Q0P_MSIASRTINT10inputTCELL52:IMUX_C7
Q0P_MSIASRTINT11inputTCELL53:IMUX_A2
Q0P_MSIASRTINT12inputTCELL53:IMUX_B4
Q0P_MSIASRTINT13inputTCELL53:IMUX_A6
Q0P_MSIASRTINT14inputTCELL52:IMUX_D2
Q0P_MSIASRTINT15inputTCELL53:IMUX_A5
Q0P_MSIASRTINT16inputTCELL53:IMUX_A4
Q0P_MSIASRTINT17inputTCELL52:IMUX_D4
Q0P_MSIASRTINT18inputTCELL52:IMUX_D3
Q0P_MSIASRTINT19inputTCELL53:IMUX_D4
Q0P_MSIASRTINT2inputTCELL53:IMUX_D2
Q0P_MSIASRTINT20inputTCELL54:IMUX_A7
Q0P_MSIASRTINT21inputTCELL53:IMUX_D5
Q0P_MSIASRTINT22inputTCELL54:IMUX_A4
Q0P_MSIASRTINT23inputTCELL54:IMUX_A3
Q0P_MSIASRTINT24inputTCELL53:IMUX_C7
Q0P_MSIASRTINT25inputTCELL53:IMUX_D7
Q0P_MSIASRTINT26inputTCELL53:IMUX_C6
Q0P_MSIASRTINT27inputTCELL53:IMUX_B5
Q0P_MSIASRTINT28inputTCELL53:IMUX_B3
Q0P_MSIASRTINT29inputTCELL53:IMUX_A3
Q0P_MSIASRTINT3inputTCELL53:IMUX_C4
Q0P_MSIASRTINT30inputTCELL52:IMUX_D6
Q0P_MSIASRTINT31inputTCELL52:IMUX_D7
Q0P_MSIASRTINT4inputTCELL52:IMUX_D5
Q0P_MSIASRTINT5inputTCELL53:IMUX_C5
Q0P_MSIASRTINT6inputTCELL53:IMUX_B6
Q0P_MSIASRTINT7inputTCELL53:IMUX_C3
Q0P_MSIASRTINT8inputTCELL53:IMUX_A7
Q0P_MSIASRTINT9inputTCELL53:IMUX_C2
Q0P_MSIATTRIN0inputTCELL51:IMUX_D3
Q0P_MSIATTRIN1inputTCELL51:IMUX_D2
Q0P_MSIATTRIN2inputTCELL47:IMUX_A3
Q0P_MSIENoutputTCELL35:OUT_Q6
Q0P_MSIMSGABRToutputTCELL44:OUT_F7
Q0P_MSIMSGSENToutputTCELL44:OUT_Q2
Q0P_MSIREQTPHPRESENTinputTCELL50:IMUX_D3
Q0P_MSIREQTPHSTTAG0inputTCELL52:IMUX_B6
Q0P_MSIREQTPHSTTAG1inputTCELL50:IMUX_D2
Q0P_MSIREQTPHSTTAG2inputTCELL50:IMUX_C7
Q0P_MSIREQTPHSTTAG3inputTCELL51:IMUX_A7
Q0P_MSIREQTPHSTTAG4inputTCELL50:IMUX_D4
Q0P_MSIREQTPHSTTAG5inputTCELL52:IMUX_B2
Q0P_MSIREQTPHSTTAG6inputTCELL51:IMUX_B2
Q0P_MSIREQTPHSTTAG7inputTCELL52:IMUX_A6
Q0P_MSIREQTPHTYPE0inputTCELL51:IMUX_D4
Q0P_MSIREQTPHTYPE1inputTCELL50:IMUX_D6
Q0P_MSIVECCNT0outputTCELL35:OUT_Q3
Q0P_MSIVECCNT1outputTCELL35:OUT_F5
Q0P_MSIVECCNT2outputTCELL35:OUT_Q1
Q0P_MSIXATTRIN0inputTCELL49:IMUX_D3
Q0P_MSIXATTRIN1inputTCELL49:IMUX_D2
Q0P_MSIXATTRIN2inputTCELL48:IMUX_A4
Q0P_MSIXENoutputTCELL43:OUT_Q5
Q0P_MSIXMASKoutputTCELL42:OUT_F4
Q0P_MSIXMSGADDR0inputTCELL50:IMUX_D7
Q0P_MSIXMSGADDR1inputTCELL51:IMUX_A2
Q0P_MSIXMSGADDR10inputTCELL51:IMUX_C3
Q0P_MSIXMSGADDR11inputTCELL51:IMUX_C6
Q0P_MSIXMSGADDR12inputTCELL52:IMUX_B3
Q0P_MSIXMSGADDR13inputTCELL51:IMUX_C7
Q0P_MSIXMSGADDR14inputTCELL51:IMUX_C5
Q0P_MSIXMSGADDR15inputTCELL51:IMUX_B7
Q0P_MSIXMSGADDR16inputTCELL52:IMUX_A4
Q0P_MSIXMSGADDR17inputTCELL51:IMUX_D7
Q0P_MSIXMSGADDR18inputTCELL51:IMUX_B6
Q0P_MSIXMSGADDR19inputTCELL52:IMUX_A3
Q0P_MSIXMSGADDR2inputTCELL51:IMUX_A3
Q0P_MSIXMSGADDR20inputTCELL51:IMUX_D6
Q0P_MSIXMSGADDR21inputTCELL52:IMUX_B7
Q0P_MSIXMSGADDR22inputTCELL52:IMUX_C4
Q0P_MSIXMSGADDR23inputTCELL52:IMUX_C5
Q0P_MSIXMSGADDR24inputTCELL52:IMUX_C2
Q0P_MSIXMSGADDR25inputTCELL52:IMUX_A5
Q0P_MSIXMSGADDR26inputTCELL51:IMUX_D5
Q0P_MSIXMSGADDR27inputTCELL52:IMUX_B5
Q0P_MSIXMSGADDR28inputTCELL52:IMUX_A7
Q0P_MSIXMSGADDR29inputTCELL52:IMUX_B4
Q0P_MSIXMSGADDR3inputTCELL51:IMUX_A4
Q0P_MSIXMSGADDR30inputTCELL52:IMUX_A2
Q0P_MSIXMSGADDR31inputTCELL52:IMUX_C3
Q0P_MSIXMSGADDR32inputTCELL55:IMUX_B3
Q0P_MSIXMSGADDR33inputTCELL55:IMUX_A7
Q0P_MSIXMSGADDR34inputTCELL55:IMUX_B2
Q0P_MSIXMSGADDR35inputTCELL55:IMUX_A4
Q0P_MSIXMSGADDR36inputTCELL55:IMUX_A5
Q0P_MSIXMSGADDR37inputTCELL54:IMUX_B4
Q0P_MSIXMSGADDR38inputTCELL55:IMUX_A3
Q0P_MSIXMSGADDR39inputTCELL55:IMUX_A2
Q0P_MSIXMSGADDR4inputTCELL51:IMUX_A5
Q0P_MSIXMSGADDR40inputTCELL54:IMUX_B5
Q0P_MSIXMSGADDR41inputTCELL55:IMUX_A6
Q0P_MSIXMSGADDR42inputTCELL54:IMUX_D5
Q0P_MSIXMSGADDR43inputTCELL54:IMUX_D6
Q0P_MSIXMSGADDR44inputTCELL54:IMUX_C5
Q0P_MSIXMSGADDR45inputTCELL54:IMUX_B7
Q0P_MSIXMSGADDR46inputTCELL54:IMUX_C6
Q0P_MSIXMSGADDR47inputTCELL54:IMUX_C4
Q0P_MSIXMSGADDR48inputTCELL54:IMUX_D7
Q0P_MSIXMSGADDR49inputTCELL54:IMUX_B6
Q0P_MSIXMSGADDR5inputTCELL51:IMUX_A6
Q0P_MSIXMSGADDR50inputTCELL54:IMUX_D3
Q0P_MSIXMSGADDR51inputTCELL54:IMUX_C3
Q0P_MSIXMSGADDR52inputTCELL54:IMUX_C7
Q0P_MSIXMSGADDR53inputTCELL54:IMUX_C2
Q0P_MSIXMSGADDR54inputTCELL54:IMUX_D4
Q0P_MSIXMSGADDR55inputTCELL54:IMUX_D2
Q0P_MSIXMSGADDR56inputTCELL54:IMUX_A6
Q0P_MSIXMSGADDR57inputTCELL54:IMUX_B3
Q0P_MSIXMSGADDR58inputTCELL54:IMUX_B2
Q0P_MSIXMSGADDR59inputTCELL54:IMUX_A5
Q0P_MSIXMSGADDR6inputTCELL51:IMUX_B4
Q0P_MSIXMSGADDR60inputTCELL53:IMUX_D3
Q0P_MSIXMSGADDR61inputTCELL54:IMUX_A2
Q0P_MSIXMSGADDR62inputTCELL53:IMUX_D6
Q0P_MSIXMSGADDR63inputTCELL53:IMUX_B7
Q0P_MSIXMSGADDR7inputTCELL51:IMUX_C2
Q0P_MSIXMSGADDR8inputTCELL51:IMUX_B3
Q0P_MSIXMSGADDR9inputTCELL51:IMUX_B5
Q0P_MSIXMSGDAT0inputTCELL49:IMUX_A6
Q0P_MSIXMSGDAT1inputTCELL49:IMUX_A5
Q0P_MSIXMSGDAT10inputTCELL48:IMUX_A7
Q0P_MSIXMSGDAT11inputTCELL48:IMUX_C4
Q0P_MSIXMSGDAT12inputTCELL49:IMUX_A7
Q0P_MSIXMSGDAT13inputTCELL49:IMUX_A4
Q0P_MSIXMSGDAT14inputTCELL49:IMUX_A3
Q0P_MSIXMSGDAT15inputTCELL48:IMUX_D6
Q0P_MSIXMSGDAT16inputTCELL48:IMUX_D5
Q0P_MSIXMSGDAT17inputTCELL48:IMUX_D4
Q0P_MSIXMSGDAT18inputTCELL48:IMUX_B7
Q0P_MSIXMSGDAT19inputTCELL49:IMUX_A2
Q0P_MSIXMSGDAT2inputTCELL49:IMUX_B3
Q0P_MSIXMSGDAT20inputTCELL48:IMUX_C5
Q0P_MSIXMSGDAT21inputTCELL48:IMUX_C2
Q0P_MSIXMSGDAT22inputTCELL48:IMUX_C6
Q0P_MSIXMSGDAT23inputTCELL48:IMUX_B5
Q0P_MSIXMSGDAT24inputTCELL48:IMUX_D2
Q0P_MSIXMSGDAT25inputTCELL48:IMUX_D3
Q0P_MSIXMSGDAT26inputTCELL48:IMUX_D7
Q0P_MSIXMSGDAT27inputTCELL48:IMUX_B2
Q0P_MSIXMSGDAT28inputTCELL48:IMUX_B4
Q0P_MSIXMSGDAT29inputTCELL48:IMUX_C3
Q0P_MSIXMSGDAT3inputTCELL49:IMUX_B6
Q0P_MSIXMSGDAT30inputTCELL48:IMUX_B3
Q0P_MSIXMSGDAT31inputTCELL48:IMUX_C7
Q0P_MSIXMSGDAT4inputTCELL48:IMUX_B6
Q0P_MSIXMSGDAT5inputTCELL49:IMUX_B5
Q0P_MSIXMSGDAT6inputTCELL49:IMUX_B2
Q0P_MSIXMSGDAT7inputTCELL49:IMUX_B4
Q0P_MSIXMSGDAT8inputTCELL49:IMUX_C2
Q0P_MSIXMSGDAT9inputTCELL49:IMUX_B7
Q0P_MSIXMSGSENToutputTCELL48:OUT_F4
Q0P_MSIXMSGVLDinputTCELL51:IMUX_C4
Q0P_MSIXREQTPHPRESENTinputTCELL50:IMUX_A2
Q0P_MSIXREQTPHSTTAG0inputTCELL50:IMUX_C3
Q0P_MSIXREQTPHSTTAG1inputTCELL50:IMUX_B2
Q0P_MSIXREQTPHSTTAG2inputTCELL50:IMUX_A6
Q0P_MSIXREQTPHSTTAG3inputTCELL50:IMUX_C2
Q0P_MSIXREQTPHSTTAG4inputTCELL50:IMUX_A3
Q0P_MSIXREQTPHSTTAG5inputTCELL50:IMUX_C6
Q0P_MSIXREQTPHSTTAG6inputTCELL50:IMUX_B4
Q0P_MSIXREQTPHSTTAG7inputTCELL50:IMUX_B6
Q0P_MSIXREQTPHTYPE0inputTCELL49:IMUX_D7
Q0P_MSIXREQTPHTYPE1inputTCELL49:IMUX_D5
Q0P_NEGLNKWIDTH0outputTCELL47:OUT_F3
Q0P_NEGLNKWIDTH1outputTCELL47:OUT_F5
Q0P_NEGSPEEDoutputTCELL47:OUT_Q2
Q0P_NFTLERROUToutputTCELL43:OUT_F7
Q0P_PWRSTATECHNGACKinputTCELL48:IMUX_A6
Q0P_PWRSTATECHNGINToutputTCELL32:OUT_F5
Q0P_RCBSTSoutputTCELL41:OUT_Q7
Q0P_RSTNinputTCELL31:IMUX_LSR0
Q0P_SCANCLKinputTCELL29:IMUX_CLK0_DELAY
Q0P_SCANENAinputTCELL31:IMUX_LSR1
Q0P_SCANI0inputTCELL30:IMUX_CE1
Q0P_SCANI1inputTCELL33:IMUX_CE3
Q0P_SCANI10inputTCELL29:IMUX_CE2
Q0P_SCANI11inputTCELL30:IMUX_CE2
Q0P_SCANI12inputTCELL31:IMUX_CE1
Q0P_SCANI13inputTCELL34:IMUX_CE0
Q0P_SCANI14inputTCELL33:IMUX_CE1
Q0P_SCANI15inputTCELL34:IMUX_CE2
Q0P_SCANI16inputTCELL33:IMUX_CE0
Q0P_SCANI17inputTCELL30:IMUX_CE3
Q0P_SCANI18inputTCELL31:IMUX_CE2
Q0P_SCANI19inputTCELL29:IMUX_CE0
Q0P_SCANI2inputTCELL32:IMUX_CE3
Q0P_SCANI20inputTCELL29:IMUX_CE3
Q0P_SCANI21inputTCELL33:IMUX_CE2
Q0P_SCANI22inputTCELL35:IMUX_CE0
Q0P_SCANI23inputTCELL34:IMUX_CE3
Q0P_SCANI24inputTCELL30:IMUX_CE0
Q0P_SCANI25inputTCELL32:IMUX_CE2
Q0P_SCANI26inputTCELL32:IMUX_CE1
Q0P_SCANI3inputTCELL34:IMUX_CE1
Q0P_SCANI4inputTCELL35:IMUX_CE1
Q0P_SCANI5inputTCELL35:IMUX_CE2
Q0P_SCANI6inputTCELL32:IMUX_CE0
Q0P_SCANI7inputTCELL31:IMUX_CE3
Q0P_SCANI8inputTCELL31:IMUX_CE0
Q0P_SCANI9inputTCELL29:IMUX_CE1
Q0P_SCANMODEinputTCELL30:IMUX_LSR0
Q0P_SCANO0outputTCELL47:OUT_Q4
Q0P_SCANO1outputTCELL22:OUT_F1
Q0P_SCANO10outputTCELL43:OUT_Q2
Q0P_SCANO11outputTCELL21:OUT_F7
Q0P_SCANO12outputTCELL44:OUT_Q5
Q0P_SCANO13outputTCELL46:OUT_F5
Q0P_SCANO14outputTCELL32:OUT_F2
Q0P_SCANO15outputTCELL47:OUT_Q6
Q0P_SCANO16outputTCELL47:OUT_Q5
Q0P_SCANO17outputTCELL46:OUT_Q0
Q0P_SCANO18outputTCELL21:OUT_Q6
Q0P_SCANO19outputTCELL32:OUT_Q5
Q0P_SCANO2outputTCELL21:OUT_Q1
Q0P_SCANO20outputTCELL18:OUT_F2
Q0P_SCANO21outputTCELL21:OUT_Q2
Q0P_SCANO22outputTCELL31:OUT_Q7
Q0P_SCANO23outputTCELL48:OUT_F6
Q0P_SCANO24outputTCELL48:OUT_F2
Q0P_SCANO3outputTCELL46:OUT_F2
Q0P_SCANO4outputTCELL45:OUT_F0
Q0P_SCANO5outputTCELL34:OUT_Q6
Q0P_SCANO6outputTCELL37:OUT_Q1
Q0P_SCANO7outputTCELL35:OUT_Q4
Q0P_SCANO8outputTCELL34:OUT_F5
Q0P_SCANO9outputTCELL35:OUT_Q7
Q0P_SCANRSTNinputTCELL29:IMUX_LSR1
Q0P_TPHREQENABLEoutputTCELL44:OUT_Q0
Q0P_TPHSTMODE0outputTCELL43:OUT_F2
Q0P_TPHSTMODE1outputTCELL44:OUT_F0
Q0P_TPHSTMODE2outputTCELL42:OUT_Q6
Q0P_UNCORRERRINinputTCELL50:IMUX_D5
Q0_FCDFECOEFF0_0inputTCELL2:IMUX_A2
Q0_FCDFECOEFF0_1inputTCELL2:IMUX_A1
Q0_FCDFECOEFF0_2inputTCELL2:IMUX_A0
Q0_FCDFECOEFF0_3inputTCELL1:IMUX_D5
Q0_FCDFECOEFF0_4inputTCELL1:IMUX_D4
Q0_FCDFECOEFF0_5inputTCELL1:IMUX_D3
Q0_FCDFECOEFF0_6inputTCELL1:IMUX_D2
Q0_FCDFECOEFF0_7inputTCELL1:IMUX_D1
Q0_FCDFECOEFF1_0inputTCELL2:IMUX_B4
Q0_FCDFECOEFF1_1inputTCELL2:IMUX_B3
Q0_FCDFECOEFF1_2inputTCELL2:IMUX_B2
Q0_FCDFECOEFF1_3inputTCELL2:IMUX_B1
Q0_FCDFECOEFF1_4inputTCELL2:IMUX_B0
Q0_FCDFECOEFF1_5inputTCELL2:IMUX_A5
Q0_FCDFECOEFF1_6inputTCELL2:IMUX_A4
Q0_FCDFECOEFF1_7inputTCELL2:IMUX_A3
Q0_FCDFECOEFF2_0inputTCELL2:IMUX_D0
Q0_FCDFECOEFF2_1inputTCELL2:IMUX_C5
Q0_FCDFECOEFF2_2inputTCELL2:IMUX_C4
Q0_FCDFECOEFF2_3inputTCELL2:IMUX_C3
Q0_FCDFECOEFF2_4inputTCELL2:IMUX_C2
Q0_FCDFECOEFF2_5inputTCELL2:IMUX_C1
Q0_FCDFECOEFF2_6inputTCELL2:IMUX_C0
Q0_FCDFECOEFF2_7inputTCELL2:IMUX_B5
Q0_FCDFECOEFF3_0inputTCELL3:IMUX_A2
Q0_FCDFECOEFF3_1inputTCELL3:IMUX_A1
Q0_FCDFECOEFF3_2inputTCELL3:IMUX_A0
Q0_FCDFECOEFF3_3inputTCELL2:IMUX_D5
Q0_FCDFECOEFF3_4inputTCELL2:IMUX_D4
Q0_FCDFECOEFF3_5inputTCELL2:IMUX_D3
Q0_FCDFECOEFF3_6inputTCELL2:IMUX_D2
Q0_FCDFECOEFF3_7inputTCELL2:IMUX_D1
Q0_FCDFECOEFF4_0inputTCELL3:IMUX_B4
Q0_FCDFECOEFF4_1inputTCELL3:IMUX_B3
Q0_FCDFECOEFF4_2inputTCELL3:IMUX_B2
Q0_FCDFECOEFF4_3inputTCELL3:IMUX_B1
Q0_FCDFECOEFF4_4inputTCELL3:IMUX_B0
Q0_FCDFECOEFF4_5inputTCELL3:IMUX_A5
Q0_FCDFECOEFF4_6inputTCELL3:IMUX_A4
Q0_FCDFECOEFF4_7inputTCELL3:IMUX_A3
Q0_FCDFECOEFF5_0inputTCELL3:IMUX_D0
Q0_FCDFECOEFF5_1inputTCELL3:IMUX_C5
Q0_FCDFECOEFF5_2inputTCELL3:IMUX_C4
Q0_FCDFECOEFF5_3inputTCELL3:IMUX_C3
Q0_FCDFECOEFF5_4inputTCELL3:IMUX_C2
Q0_FCDFECOEFF5_5inputTCELL3:IMUX_C1
Q0_FCDFECOEFF5_6inputTCELL3:IMUX_C0
Q0_FCDFECOEFF5_7inputTCELL3:IMUX_B5
Q0_FCDFESIGN1inputTCELL3:IMUX_D5
Q0_FCDFESIGN2inputTCELL3:IMUX_D4
Q0_FCDFESIGN3inputTCELL3:IMUX_D3
Q0_FCDFESIGN4inputTCELL3:IMUX_D2
Q0_FCDFESIGN5inputTCELL3:IMUX_D1
Q0_FCMPWRUPinputTCELL1:IMUX_A1
Q0_FCMRSTinputTCELL0:IMUX_C2
Q0_FCSCANMODEinputTCELL1:IMUX_C4
Q0_FDDFECHSEL0inputTCELL1:IMUX_D0
Q0_FDDFECHSEL1inputTCELL1:IMUX_C5
Q0_FDDFEDATA0outputTCELL5:OUT_F0
Q0_FDDFEDATA1outputTCELL4:OUT_Q7
Q0_FDDFEDATA2outputTCELL4:OUT_Q6
Q0_FDDFEDATA3outputTCELL4:OUT_Q5
Q0_FDDFEDATA4outputTCELL4:OUT_Q4
Q0_FDDFEDATA5outputTCELL4:OUT_Q3
Q0_FDDFEDATA6outputTCELL4:OUT_Q2
Q0_FDDFEDATA7outputTCELL4:OUT_Q1
Q0_FDDFEDATA8outputTCELL4:OUT_Q0
Q0_FDDFEDATA9outputTCELL4:OUT_F7
Q0_FDDFEERR0outputTCELL5:OUT_Q2
Q0_FDDFEERR1outputTCELL5:OUT_Q1
Q0_FDDFEERR2outputTCELL5:OUT_Q0
Q0_FDDFEERR3outputTCELL5:OUT_F7
Q0_FDDFEERR4outputTCELL5:OUT_F6
Q0_FDDFEERR5outputTCELL5:OUT_F5
Q0_FDDFEERR6outputTCELL5:OUT_F4
Q0_FDDFEERR7outputTCELL5:OUT_F3
Q0_FDDFEERR8outputTCELL5:OUT_F2
Q0_FDDFEERR9outputTCELL5:OUT_F1
Q0_FIGRPFBRRCLK0inputTCELL14:IMUX_CLK1_DELAY
Q0_FIGRPFBRRCLK1inputTCELL14:IMUX_CLK0_DELAY
Q0_FIGRPFBTWCLK0inputTCELL15:IMUX_CLK1_DELAY
Q0_FIGRPFBTWCLK1inputTCELL15:IMUX_CLK0_DELAY
Q0_FIRXTESTCLKinputTCELL16:IMUX_CLK1_DELAY
Q0_FISYNCCLKinputTCELL16:IMUX_CLK0_DELAY
Q0_FITMRCLKinputTCELL1:IMUX_CLK0_DELAY
Q0_FITXTESTCLKinputTCELL0:IMUX_CLK1_DELAY
Q0_FOREFCLK2FPGAoutputTCELL4:OUT_F2
Q0_HSPLLLOLoutputTCELL3:OUT_F0
Q0_HSPLLPWRUPinputTCELL1:IMUX_A2
Q0_HSPLLREFCLKIinputTCELL7:IMUX_CLK0_DELAY
Q0_HSPLLRSTinputTCELL2:IMUX_LSR1
Q0_LSPLLLOLoutputTCELL3:OUT_F1
Q0_LSPLLPWRUPinputTCELL1:IMUX_A3
Q0_LSPLLREFCLKIinputTCELL7:IMUX_CLK1_DELAY
Q0_LSPLLRSTinputTCELL2:IMUX_LSR0
Q1CH0_FCALIGNENinputTCELL113:IMUX_B5
Q1CH0_FCCDRFORCEDLOCKinputTCELL97:IMUX_A5
Q1CH0_FCDFERDENinputTCELL106:IMUX_CE3
Q1CH0_FCDFEUPDinputTCELL105:IMUX_CE3
Q1CH0_FCLDRTXENinputTCELL113:IMUX_A5
Q1CH0_FCLSMENinputTCELL98:IMUX_D3
Q1CH0_FCPCIEDETENinputTCELL98:IMUX_B3
Q1CH0_FCPCSRXRSTinputTCELL101:IMUX_LSR1
Q1CH0_FCPCSTXRSTinputTCELL103:IMUX_LSR1
Q1CH0_FCPIPEPHYRESETNinputTCELL106:IMUX_LSR1
Q1CH0_FCPLLLOLinputTCELL97:IMUX_A1
Q1CH0_FCRATE0inputTCELL112:IMUX_B7
Q1CH0_FCRATE1inputTCELL112:IMUX_A2
Q1CH0_FCRATE2inputTCELL112:IMUX_A3
Q1CH0_FCRRSTinputTCELL99:IMUX_LSR1
Q1CH0_FCRXPOLARITYinputTCELL98:IMUX_C5
Q1CH0_FCRXPWRUPinputTCELL113:IMUX_D4
Q1CH0_FCTMRSTARTinputTCELL109:IMUX_A7
Q1CH0_FCTMRSTOPinputTCELL109:IMUX_A3
Q1CH0_FCTRSTinputTCELL97:IMUX_LSR1
Q1CH0_FCTXMARGIN0inputTCELL97:IMUX_C3
Q1CH0_FCTXMARGIN1inputTCELL97:IMUX_C4
Q1CH0_FCTXMARGIN2inputTCELL97:IMUX_C5
Q1CH0_FCTXPWRUPinputTCELL113:IMUX_C4
Q1CH0_FCWORDALGNENinputTCELL98:IMUX_C1
Q1CH0_FDLDRRXoutputTCELL110:OUT_F5
Q1CH0_FDLDRTXinputTCELL97:IMUX_B3
Q1CH0_FDRX0outputTCELL104:OUT_Q0
Q1CH0_FDRX1outputTCELL104:OUT_Q1
Q1CH0_FDRX10outputTCELL104:OUT_F2
Q1CH0_FDRX11outputTCELL104:OUT_F3
Q1CH0_FDRX12outputTCELL104:OUT_F4
Q1CH0_FDRX13outputTCELL104:OUT_F5
Q1CH0_FDRX14outputTCELL104:OUT_F6
Q1CH0_FDRX15outputTCELL104:OUT_F7
Q1CH0_FDRX16outputTCELL105:OUT_Q0
Q1CH0_FDRX17outputTCELL105:OUT_Q1
Q1CH0_FDRX18outputTCELL105:OUT_Q2
Q1CH0_FDRX19outputTCELL105:OUT_Q3
Q1CH0_FDRX2outputTCELL104:OUT_Q2
Q1CH0_FDRX20outputTCELL105:OUT_Q4
Q1CH0_FDRX21outputTCELL105:OUT_Q5
Q1CH0_FDRX22outputTCELL105:OUT_Q6
Q1CH0_FDRX23outputTCELL105:OUT_Q7
Q1CH0_FDRX24outputTCELL105:OUT_F0
Q1CH0_FDRX25outputTCELL105:OUT_F1
Q1CH0_FDRX26outputTCELL105:OUT_F2
Q1CH0_FDRX27outputTCELL105:OUT_F3
Q1CH0_FDRX28outputTCELL105:OUT_F4
Q1CH0_FDRX29outputTCELL105:OUT_F5
Q1CH0_FDRX3outputTCELL104:OUT_Q3
Q1CH0_FDRX30outputTCELL105:OUT_F6
Q1CH0_FDRX31outputTCELL105:OUT_F7
Q1CH0_FDRX32outputTCELL106:OUT_Q0
Q1CH0_FDRX33outputTCELL106:OUT_Q1
Q1CH0_FDRX34outputTCELL106:OUT_Q2
Q1CH0_FDRX35outputTCELL106:OUT_Q3
Q1CH0_FDRX36outputTCELL106:OUT_Q4
Q1CH0_FDRX37outputTCELL106:OUT_Q5
Q1CH0_FDRX38outputTCELL106:OUT_Q6
Q1CH0_FDRX39outputTCELL106:OUT_Q7
Q1CH0_FDRX4outputTCELL104:OUT_Q4
Q1CH0_FDRX40outputTCELL106:OUT_F0
Q1CH0_FDRX41outputTCELL106:OUT_F1
Q1CH0_FDRX42outputTCELL106:OUT_F2
Q1CH0_FDRX43outputTCELL106:OUT_F3
Q1CH0_FDRX44outputTCELL106:OUT_F4
Q1CH0_FDRX45outputTCELL106:OUT_F5
Q1CH0_FDRX46outputTCELL106:OUT_F6
Q1CH0_FDRX47outputTCELL106:OUT_F7
Q1CH0_FDRX5outputTCELL104:OUT_Q5
Q1CH0_FDRX6outputTCELL104:OUT_Q6
Q1CH0_FDRX7outputTCELL104:OUT_Q7
Q1CH0_FDRX8outputTCELL104:OUT_F0
Q1CH0_FDRX9outputTCELL104:OUT_F1
Q1CH0_FDTX0inputTCELL104:IMUX_A6
Q1CH0_FDTX1inputTCELL104:IMUX_A7
Q1CH0_FDTX10inputTCELL105:IMUX_C4
Q1CH0_FDTX11inputTCELL105:IMUX_C5
Q1CH0_FDTX12inputTCELL105:IMUX_C6
Q1CH0_FDTX13inputTCELL105:IMUX_C7
Q1CH0_FDTX14inputTCELL105:IMUX_B2
Q1CH0_FDTX15inputTCELL105:IMUX_B3
Q1CH0_FDTX16inputTCELL105:IMUX_B4
Q1CH0_FDTX17inputTCELL105:IMUX_B5
Q1CH0_FDTX18inputTCELL105:IMUX_B6
Q1CH0_FDTX19inputTCELL105:IMUX_B7
Q1CH0_FDTX2inputTCELL105:IMUX_D2
Q1CH0_FDTX20inputTCELL105:IMUX_A2
Q1CH0_FDTX21inputTCELL105:IMUX_A3
Q1CH0_FDTX22inputTCELL105:IMUX_A4
Q1CH0_FDTX23inputTCELL105:IMUX_A5
Q1CH0_FDTX24inputTCELL105:IMUX_A6
Q1CH0_FDTX25inputTCELL105:IMUX_A7
Q1CH0_FDTX26inputTCELL106:IMUX_D2
Q1CH0_FDTX27inputTCELL106:IMUX_D3
Q1CH0_FDTX28inputTCELL106:IMUX_D4
Q1CH0_FDTX29inputTCELL106:IMUX_D5
Q1CH0_FDTX3inputTCELL105:IMUX_D3
Q1CH0_FDTX30inputTCELL106:IMUX_D6
Q1CH0_FDTX31inputTCELL106:IMUX_D7
Q1CH0_FDTX32inputTCELL106:IMUX_C2
Q1CH0_FDTX33inputTCELL106:IMUX_C3
Q1CH0_FDTX34inputTCELL106:IMUX_C4
Q1CH0_FDTX35inputTCELL106:IMUX_C5
Q1CH0_FDTX36inputTCELL106:IMUX_C6
Q1CH0_FDTX37inputTCELL106:IMUX_C7
Q1CH0_FDTX38inputTCELL106:IMUX_B2
Q1CH0_FDTX39inputTCELL106:IMUX_B3
Q1CH0_FDTX4inputTCELL105:IMUX_D4
Q1CH0_FDTX40inputTCELL106:IMUX_B4
Q1CH0_FDTX41inputTCELL106:IMUX_B5
Q1CH0_FDTX42inputTCELL106:IMUX_B6
Q1CH0_FDTX43inputTCELL106:IMUX_B7
Q1CH0_FDTX44inputTCELL106:IMUX_A2
Q1CH0_FDTX45inputTCELL106:IMUX_A3
Q1CH0_FDTX46inputTCELL106:IMUX_A4
Q1CH0_FDTX47inputTCELL106:IMUX_A5
Q1CH0_FDTX48inputTCELL106:IMUX_A6
Q1CH0_FDTX49inputTCELL106:IMUX_A7
Q1CH0_FDTX5inputTCELL105:IMUX_D5
Q1CH0_FDTX6inputTCELL105:IMUX_D6
Q1CH0_FDTX7inputTCELL105:IMUX_D7
Q1CH0_FDTX8inputTCELL105:IMUX_C2
Q1CH0_FDTX9inputTCELL105:IMUX_C3
Q1CH0_FIRCLKinputTCELL103:IMUX_CLK0_DELAY
Q1CH0_FIREFRXCLKinputTCELL105:IMUX_CLK0_DELAY
Q1CH0_FITCLKinputTCELL101:IMUX_CLK0_DELAY
Q1CH0_FITMRSTARTCLKinputTCELL112:IMUX_CLK1_DELAY
Q1CH0_FITMRSTOPCLKinputTCELL110:IMUX_CLK1_DELAY
Q1CH0_FSCCOVERRUNoutputTCELL111:OUT_Q7
Q1CH0_FSCCUNDERRUNoutputTCELL111:OUT_F3
Q1CH0_FSDFEVLDoutputTCELL108:OUT_Q4
Q1CH0_FSLSMoutputTCELL111:OUT_F7
Q1CH0_FSPCIECONoutputTCELL112:OUT_Q7
Q1CH0_FSPCIEDONEoutputTCELL112:OUT_F3
Q1CH0_FSRCDONEoutputTCELL109:OUT_F4
Q1CH0_FSRLOLoutputTCELL111:OUT_Q3
Q1CH0_FSRLOSoutputTCELL112:OUT_Q3
Q1CH0_FSSKPADDEDoutputTCELL110:OUT_F1
Q1CH0_FSSKPDELETEDoutputTCELL110:OUT_Q5
Q1CH1_FCALIGNENinputTCELL113:IMUX_B4
Q1CH1_FCCDRFORCEDLOCKinputTCELL97:IMUX_A4
Q1CH1_FCDFERDENinputTCELL106:IMUX_CE2
Q1CH1_FCDFEUPDinputTCELL105:IMUX_CE2
Q1CH1_FCLDRTXENinputTCELL113:IMUX_A4
Q1CH1_FCLSMENinputTCELL98:IMUX_D2
Q1CH1_FCPCIEDETENinputTCELL98:IMUX_B2
Q1CH1_FCPCSRXRSTinputTCELL101:IMUX_LSR0
Q1CH1_FCPCSTXRSTinputTCELL103:IMUX_LSR0
Q1CH1_FCPIPEPHYRESETNinputTCELL106:IMUX_LSR0
Q1CH1_FCPLLLOLinputTCELL97:IMUX_A0
Q1CH1_FCRATE0inputTCELL112:IMUX_B4
Q1CH1_FCRATE1inputTCELL112:IMUX_B5
Q1CH1_FCRATE2inputTCELL112:IMUX_B6
Q1CH1_FCRRSTinputTCELL99:IMUX_LSR0
Q1CH1_FCRXPOLARITYinputTCELL98:IMUX_C4
Q1CH1_FCRXPWRUPinputTCELL113:IMUX_D3
Q1CH1_FCTMRSTARTinputTCELL109:IMUX_A6
Q1CH1_FCTMRSTOPinputTCELL109:IMUX_A2
Q1CH1_FCTRSTinputTCELL97:IMUX_LSR0
Q1CH1_FCTXMARGIN0inputTCELL97:IMUX_C0
Q1CH1_FCTXMARGIN1inputTCELL97:IMUX_C1
Q1CH1_FCTXMARGIN2inputTCELL97:IMUX_C2
Q1CH1_FCTXPWRUPinputTCELL113:IMUX_C3
Q1CH1_FCWORDALGNENinputTCELL98:IMUX_C0
Q1CH1_FDLDRRXoutputTCELL110:OUT_F4
Q1CH1_FDLDRTXinputTCELL97:IMUX_B2
Q1CH1_FDRX0outputTCELL100:OUT_Q6
Q1CH1_FDRX1outputTCELL100:OUT_Q7
Q1CH1_FDRX10outputTCELL101:OUT_F0
Q1CH1_FDRX11outputTCELL101:OUT_F1
Q1CH1_FDRX12outputTCELL101:OUT_F2
Q1CH1_FDRX13outputTCELL101:OUT_F3
Q1CH1_FDRX14outputTCELL101:OUT_F4
Q1CH1_FDRX15outputTCELL101:OUT_F5
Q1CH1_FDRX16outputTCELL102:OUT_Q0
Q1CH1_FDRX17outputTCELL102:OUT_Q1
Q1CH1_FDRX18outputTCELL102:OUT_Q2
Q1CH1_FDRX19outputTCELL102:OUT_Q3
Q1CH1_FDRX2outputTCELL101:OUT_Q0
Q1CH1_FDRX20outputTCELL102:OUT_Q4
Q1CH1_FDRX21outputTCELL102:OUT_Q5
Q1CH1_FDRX22outputTCELL102:OUT_Q6
Q1CH1_FDRX23outputTCELL102:OUT_Q7
Q1CH1_FDRX24outputTCELL102:OUT_F0
Q1CH1_FDRX25outputTCELL102:OUT_F1
Q1CH1_FDRX26outputTCELL102:OUT_F2
Q1CH1_FDRX27outputTCELL102:OUT_F3
Q1CH1_FDRX28outputTCELL102:OUT_F4
Q1CH1_FDRX29outputTCELL102:OUT_F5
Q1CH1_FDRX3outputTCELL101:OUT_Q1
Q1CH1_FDRX30outputTCELL102:OUT_F6
Q1CH1_FDRX31outputTCELL102:OUT_F7
Q1CH1_FDRX32outputTCELL103:OUT_Q0
Q1CH1_FDRX33outputTCELL103:OUT_Q1
Q1CH1_FDRX34outputTCELL103:OUT_Q2
Q1CH1_FDRX35outputTCELL103:OUT_Q3
Q1CH1_FDRX36outputTCELL103:OUT_Q4
Q1CH1_FDRX37outputTCELL103:OUT_Q5
Q1CH1_FDRX38outputTCELL103:OUT_Q6
Q1CH1_FDRX39outputTCELL103:OUT_Q7
Q1CH1_FDRX4outputTCELL101:OUT_Q2
Q1CH1_FDRX40outputTCELL103:OUT_F0
Q1CH1_FDRX41outputTCELL103:OUT_F1
Q1CH1_FDRX42outputTCELL103:OUT_F2
Q1CH1_FDRX43outputTCELL103:OUT_F3
Q1CH1_FDRX44outputTCELL103:OUT_F4
Q1CH1_FDRX45outputTCELL103:OUT_F5
Q1CH1_FDRX46outputTCELL103:OUT_F6
Q1CH1_FDRX47outputTCELL103:OUT_F7
Q1CH1_FDRX5outputTCELL101:OUT_Q3
Q1CH1_FDRX6outputTCELL101:OUT_Q4
Q1CH1_FDRX7outputTCELL101:OUT_Q5
Q1CH1_FDRX8outputTCELL100:OUT_F6
Q1CH1_FDRX9outputTCELL100:OUT_F7
Q1CH1_FDTX0inputTCELL102:IMUX_A4
Q1CH1_FDTX1inputTCELL102:IMUX_A5
Q1CH1_FDTX10inputTCELL103:IMUX_C2
Q1CH1_FDTX11inputTCELL103:IMUX_C3
Q1CH1_FDTX12inputTCELL103:IMUX_C4
Q1CH1_FDTX13inputTCELL103:IMUX_C5
Q1CH1_FDTX14inputTCELL103:IMUX_C6
Q1CH1_FDTX15inputTCELL103:IMUX_C7
Q1CH1_FDTX16inputTCELL103:IMUX_B2
Q1CH1_FDTX17inputTCELL103:IMUX_B3
Q1CH1_FDTX18inputTCELL103:IMUX_B4
Q1CH1_FDTX19inputTCELL103:IMUX_B5
Q1CH1_FDTX2inputTCELL102:IMUX_A6
Q1CH1_FDTX20inputTCELL103:IMUX_B6
Q1CH1_FDTX21inputTCELL103:IMUX_B7
Q1CH1_FDTX22inputTCELL103:IMUX_A2
Q1CH1_FDTX23inputTCELL103:IMUX_A3
Q1CH1_FDTX24inputTCELL103:IMUX_A4
Q1CH1_FDTX25inputTCELL103:IMUX_A5
Q1CH1_FDTX26inputTCELL103:IMUX_A6
Q1CH1_FDTX27inputTCELL103:IMUX_A7
Q1CH1_FDTX28inputTCELL104:IMUX_D2
Q1CH1_FDTX29inputTCELL104:IMUX_D3
Q1CH1_FDTX3inputTCELL102:IMUX_A7
Q1CH1_FDTX30inputTCELL104:IMUX_D4
Q1CH1_FDTX31inputTCELL104:IMUX_D5
Q1CH1_FDTX32inputTCELL104:IMUX_D6
Q1CH1_FDTX33inputTCELL104:IMUX_D7
Q1CH1_FDTX34inputTCELL104:IMUX_C2
Q1CH1_FDTX35inputTCELL104:IMUX_C3
Q1CH1_FDTX36inputTCELL104:IMUX_C4
Q1CH1_FDTX37inputTCELL104:IMUX_C5
Q1CH1_FDTX38inputTCELL104:IMUX_C6
Q1CH1_FDTX39inputTCELL104:IMUX_C7
Q1CH1_FDTX4inputTCELL103:IMUX_D2
Q1CH1_FDTX40inputTCELL104:IMUX_B2
Q1CH1_FDTX41inputTCELL104:IMUX_B3
Q1CH1_FDTX42inputTCELL104:IMUX_B4
Q1CH1_FDTX43inputTCELL104:IMUX_B5
Q1CH1_FDTX44inputTCELL104:IMUX_B6
Q1CH1_FDTX45inputTCELL104:IMUX_B7
Q1CH1_FDTX46inputTCELL104:IMUX_A2
Q1CH1_FDTX47inputTCELL104:IMUX_A3
Q1CH1_FDTX48inputTCELL104:IMUX_A4
Q1CH1_FDTX49inputTCELL104:IMUX_A5
Q1CH1_FDTX5inputTCELL103:IMUX_D3
Q1CH1_FDTX6inputTCELL103:IMUX_D4
Q1CH1_FDTX7inputTCELL103:IMUX_D5
Q1CH1_FDTX8inputTCELL103:IMUX_D6
Q1CH1_FDTX9inputTCELL103:IMUX_D7
Q1CH1_FIRCLKinputTCELL103:IMUX_CLK1_DELAY
Q1CH1_FIREFRXCLKinputTCELL105:IMUX_CLK1_DELAY
Q1CH1_FITCLKinputTCELL101:IMUX_CLK1_DELAY
Q1CH1_FITMRSTARTCLKinputTCELL111:IMUX_CLK0_DELAY
Q1CH1_FITMRSTOPCLKinputTCELL109:IMUX_CLK0_DELAY
Q1CH1_FSCCOVERRUNoutputTCELL111:OUT_Q6
Q1CH1_FSCCUNDERRUNoutputTCELL111:OUT_F2
Q1CH1_FSDFEVLDoutputTCELL108:OUT_Q3
Q1CH1_FSLSMoutputTCELL111:OUT_F6
Q1CH1_FSPCIECONoutputTCELL112:OUT_Q6
Q1CH1_FSPCIEDONEoutputTCELL112:OUT_F2
Q1CH1_FSRCDONEoutputTCELL109:OUT_F3
Q1CH1_FSRLOLoutputTCELL111:OUT_Q2
Q1CH1_FSRLOSoutputTCELL112:OUT_Q2
Q1CH1_FSSKPADDEDoutputTCELL110:OUT_F0
Q1CH1_FSSKPDELETEDoutputTCELL110:OUT_Q4
Q1CH2_FCALIGNENinputTCELL113:IMUX_B3
Q1CH2_FCCDRFORCEDLOCKinputTCELL97:IMUX_A3
Q1CH2_FCDFERDENinputTCELL106:IMUX_CE1
Q1CH2_FCDFEUPDinputTCELL105:IMUX_CE1
Q1CH2_FCLDRTXENinputTCELL113:IMUX_A3
Q1CH2_FCLSMENinputTCELL98:IMUX_D1
Q1CH2_FCPCIEDETENinputTCELL98:IMUX_B1
Q1CH2_FCPCSRXRSTinputTCELL100:IMUX_LSR1
Q1CH2_FCPCSTXRSTinputTCELL102:IMUX_LSR1
Q1CH2_FCPIPEPHYRESETNinputTCELL105:IMUX_LSR1
Q1CH2_FCPLLLOLinputTCELL97:IMUX_B5
Q1CH2_FCRATE0inputTCELL112:IMUX_C7
Q1CH2_FCRATE1inputTCELL112:IMUX_B2
Q1CH2_FCRATE2inputTCELL112:IMUX_B3
Q1CH2_FCRRSTinputTCELL98:IMUX_LSR1
Q1CH2_FCRXPOLARITYinputTCELL98:IMUX_C3
Q1CH2_FCRXPWRUPinputTCELL113:IMUX_D2
Q1CH2_FCTMRSTARTinputTCELL109:IMUX_A5
Q1CH2_FCTMRSTOPinputTCELL109:IMUX_B7
Q1CH2_FCTRSTinputTCELL112:IMUX_LSR1
Q1CH2_FCTXMARGIN0inputTCELL97:IMUX_D3
Q1CH2_FCTXMARGIN1inputTCELL97:IMUX_D4
Q1CH2_FCTXMARGIN2inputTCELL97:IMUX_D5
Q1CH2_FCTXPWRUPinputTCELL113:IMUX_C2
Q1CH2_FCWORDALGNENinputTCELL98:IMUX_D5
Q1CH2_FDLDRRXoutputTCELL110:OUT_F3
Q1CH2_FDLDRTXinputTCELL97:IMUX_B1
Q1CH2_FDRX0outputTCELL97:OUT_Q6
Q1CH2_FDRX1outputTCELL97:OUT_Q7
Q1CH2_FDRX10outputTCELL98:OUT_F0
Q1CH2_FDRX11outputTCELL98:OUT_F1
Q1CH2_FDRX12outputTCELL98:OUT_F2
Q1CH2_FDRX13outputTCELL98:OUT_F3
Q1CH2_FDRX14outputTCELL98:OUT_F4
Q1CH2_FDRX15outputTCELL98:OUT_F5
Q1CH2_FDRX16outputTCELL98:OUT_Q6
Q1CH2_FDRX17outputTCELL98:OUT_Q7
Q1CH2_FDRX18outputTCELL99:OUT_Q0
Q1CH2_FDRX19outputTCELL99:OUT_Q1
Q1CH2_FDRX2outputTCELL98:OUT_Q0
Q1CH2_FDRX20outputTCELL99:OUT_Q2
Q1CH2_FDRX21outputTCELL99:OUT_Q3
Q1CH2_FDRX22outputTCELL99:OUT_Q4
Q1CH2_FDRX23outputTCELL99:OUT_Q5
Q1CH2_FDRX24outputTCELL98:OUT_F6
Q1CH2_FDRX25outputTCELL98:OUT_F7
Q1CH2_FDRX26outputTCELL99:OUT_F0
Q1CH2_FDRX27outputTCELL99:OUT_F1
Q1CH2_FDRX28outputTCELL99:OUT_F2
Q1CH2_FDRX29outputTCELL99:OUT_F3
Q1CH2_FDRX3outputTCELL98:OUT_Q1
Q1CH2_FDRX30outputTCELL99:OUT_F4
Q1CH2_FDRX31outputTCELL99:OUT_F5
Q1CH2_FDRX32outputTCELL99:OUT_Q6
Q1CH2_FDRX33outputTCELL99:OUT_Q7
Q1CH2_FDRX34outputTCELL100:OUT_Q0
Q1CH2_FDRX35outputTCELL100:OUT_Q1
Q1CH2_FDRX36outputTCELL100:OUT_Q2
Q1CH2_FDRX37outputTCELL100:OUT_Q3
Q1CH2_FDRX38outputTCELL100:OUT_Q4
Q1CH2_FDRX39outputTCELL100:OUT_Q5
Q1CH2_FDRX4outputTCELL98:OUT_Q2
Q1CH2_FDRX40outputTCELL99:OUT_F6
Q1CH2_FDRX41outputTCELL99:OUT_F7
Q1CH2_FDRX42outputTCELL100:OUT_F0
Q1CH2_FDRX43outputTCELL100:OUT_F1
Q1CH2_FDRX44outputTCELL100:OUT_F2
Q1CH2_FDRX45outputTCELL100:OUT_F3
Q1CH2_FDRX46outputTCELL100:OUT_F4
Q1CH2_FDRX47outputTCELL100:OUT_F5
Q1CH2_FDRX5outputTCELL98:OUT_Q3
Q1CH2_FDRX6outputTCELL98:OUT_Q4
Q1CH2_FDRX7outputTCELL98:OUT_Q5
Q1CH2_FDRX8outputTCELL97:OUT_F6
Q1CH2_FDRX9outputTCELL97:OUT_F7
Q1CH2_FDTX0inputTCELL100:IMUX_A0
Q1CH2_FDTX1inputTCELL100:IMUX_A1
Q1CH2_FDTX10inputTCELL101:IMUX_D4
Q1CH2_FDTX11inputTCELL101:IMUX_D5
Q1CH2_FDTX12inputTCELL101:IMUX_C0
Q1CH2_FDTX13inputTCELL101:IMUX_C1
Q1CH2_FDTX14inputTCELL101:IMUX_C2
Q1CH2_FDTX15inputTCELL101:IMUX_C3
Q1CH2_FDTX16inputTCELL101:IMUX_C4
Q1CH2_FDTX17inputTCELL101:IMUX_C5
Q1CH2_FDTX18inputTCELL101:IMUX_B0
Q1CH2_FDTX19inputTCELL101:IMUX_B1
Q1CH2_FDTX2inputTCELL100:IMUX_A2
Q1CH2_FDTX20inputTCELL101:IMUX_B2
Q1CH2_FDTX21inputTCELL101:IMUX_B3
Q1CH2_FDTX22inputTCELL101:IMUX_B4
Q1CH2_FDTX23inputTCELL101:IMUX_B5
Q1CH2_FDTX24inputTCELL101:IMUX_A0
Q1CH2_FDTX25inputTCELL101:IMUX_A1
Q1CH2_FDTX26inputTCELL101:IMUX_A2
Q1CH2_FDTX27inputTCELL101:IMUX_A3
Q1CH2_FDTX28inputTCELL101:IMUX_A4
Q1CH2_FDTX29inputTCELL101:IMUX_A5
Q1CH2_FDTX3inputTCELL100:IMUX_A3
Q1CH2_FDTX30inputTCELL102:IMUX_D2
Q1CH2_FDTX31inputTCELL102:IMUX_D3
Q1CH2_FDTX32inputTCELL102:IMUX_D4
Q1CH2_FDTX33inputTCELL102:IMUX_D5
Q1CH2_FDTX34inputTCELL102:IMUX_D6
Q1CH2_FDTX35inputTCELL102:IMUX_D7
Q1CH2_FDTX36inputTCELL102:IMUX_C2
Q1CH2_FDTX37inputTCELL102:IMUX_C3
Q1CH2_FDTX38inputTCELL102:IMUX_C4
Q1CH2_FDTX39inputTCELL102:IMUX_C5
Q1CH2_FDTX4inputTCELL100:IMUX_A4
Q1CH2_FDTX40inputTCELL102:IMUX_C6
Q1CH2_FDTX41inputTCELL102:IMUX_C7
Q1CH2_FDTX42inputTCELL102:IMUX_B2
Q1CH2_FDTX43inputTCELL102:IMUX_B3
Q1CH2_FDTX44inputTCELL102:IMUX_B4
Q1CH2_FDTX45inputTCELL102:IMUX_B5
Q1CH2_FDTX46inputTCELL102:IMUX_B6
Q1CH2_FDTX47inputTCELL102:IMUX_B7
Q1CH2_FDTX48inputTCELL102:IMUX_A2
Q1CH2_FDTX49inputTCELL102:IMUX_A3
Q1CH2_FDTX5inputTCELL100:IMUX_A5
Q1CH2_FDTX6inputTCELL101:IMUX_D0
Q1CH2_FDTX7inputTCELL101:IMUX_D1
Q1CH2_FDTX8inputTCELL101:IMUX_D2
Q1CH2_FDTX9inputTCELL101:IMUX_D3
Q1CH2_FIRCLKinputTCELL102:IMUX_CLK0_DELAY
Q1CH2_FIREFRXCLKinputTCELL104:IMUX_CLK0_DELAY
Q1CH2_FITCLKinputTCELL100:IMUX_CLK0_DELAY
Q1CH2_FITMRSTARTCLKinputTCELL111:IMUX_CLK1_DELAY
Q1CH2_FITMRSTOPCLKinputTCELL109:IMUX_CLK1_DELAY
Q1CH2_FSCCOVERRUNoutputTCELL111:OUT_Q5
Q1CH2_FSCCUNDERRUNoutputTCELL111:OUT_F1
Q1CH2_FSDFEVLDoutputTCELL108:OUT_Q2
Q1CH2_FSLSMoutputTCELL111:OUT_F5
Q1CH2_FSPCIECONoutputTCELL112:OUT_Q5
Q1CH2_FSPCIEDONEoutputTCELL112:OUT_F1
Q1CH2_FSRCDONEoutputTCELL109:OUT_F2
Q1CH2_FSRLOLoutputTCELL111:OUT_Q1
Q1CH2_FSRLOSoutputTCELL112:OUT_Q1
Q1CH2_FSSKPADDEDoutputTCELL110:OUT_Q7
Q1CH2_FSSKPDELETEDoutputTCELL110:OUT_Q3
Q1CH3_FCALIGNENinputTCELL113:IMUX_B2
Q1CH3_FCCDRFORCEDLOCKinputTCELL97:IMUX_A2
Q1CH3_FCDFERDENinputTCELL106:IMUX_CE0
Q1CH3_FCDFEUPDinputTCELL105:IMUX_CE0
Q1CH3_FCLDRTXENinputTCELL113:IMUX_A2
Q1CH3_FCLSMENinputTCELL98:IMUX_D0
Q1CH3_FCPCIEDETENinputTCELL98:IMUX_B0
Q1CH3_FCPCSRXRSTinputTCELL100:IMUX_LSR0
Q1CH3_FCPCSTXRSTinputTCELL102:IMUX_LSR0
Q1CH3_FCPIPEPHYRESETNinputTCELL105:IMUX_LSR0
Q1CH3_FCPLLLOLinputTCELL97:IMUX_B4
Q1CH3_FCRATE0inputTCELL112:IMUX_C4
Q1CH3_FCRATE1inputTCELL112:IMUX_C5
Q1CH3_FCRATE2inputTCELL112:IMUX_C6
Q1CH3_FCRRSTinputTCELL98:IMUX_LSR0
Q1CH3_FCRXPOLARITYinputTCELL98:IMUX_C2
Q1CH3_FCRXPWRUPinputTCELL112:IMUX_A7
Q1CH3_FCTMRSTARTinputTCELL109:IMUX_A4
Q1CH3_FCTMRSTOPinputTCELL109:IMUX_B6
Q1CH3_FCTRSTinputTCELL112:IMUX_LSR0
Q1CH3_FCTXMARGIN0inputTCELL97:IMUX_D0
Q1CH3_FCTXMARGIN1inputTCELL97:IMUX_D1
Q1CH3_FCTXMARGIN2inputTCELL97:IMUX_D2
Q1CH3_FCTXPWRUPinputTCELL113:IMUX_D5
Q1CH3_FCWORDALGNENinputTCELL98:IMUX_D4
Q1CH3_FDLDRRXoutputTCELL110:OUT_F2
Q1CH3_FDLDRTXinputTCELL97:IMUX_B0
Q1CH3_FDRX0outputTCELL112:OUT_F4
Q1CH3_FDRX1outputTCELL112:OUT_F5
Q1CH3_FDRX10outputTCELL113:OUT_F0
Q1CH3_FDRX11outputTCELL113:OUT_F1
Q1CH3_FDRX12outputTCELL113:OUT_F2
Q1CH3_FDRX13outputTCELL113:OUT_F3
Q1CH3_FDRX14outputTCELL113:OUT_F4
Q1CH3_FDRX15outputTCELL113:OUT_F5
Q1CH3_FDRX16outputTCELL95:OUT_Q6
Q1CH3_FDRX17outputTCELL95:OUT_Q7
Q1CH3_FDRX18outputTCELL96:OUT_Q0
Q1CH3_FDRX19outputTCELL96:OUT_Q1
Q1CH3_FDRX2outputTCELL112:OUT_F6
Q1CH3_FDRX20outputTCELL96:OUT_Q2
Q1CH3_FDRX21outputTCELL96:OUT_Q3
Q1CH3_FDRX22outputTCELL96:OUT_Q4
Q1CH3_FDRX23outputTCELL96:OUT_Q5
Q1CH3_FDRX24outputTCELL95:OUT_F6
Q1CH3_FDRX25outputTCELL95:OUT_F7
Q1CH3_FDRX26outputTCELL96:OUT_F0
Q1CH3_FDRX27outputTCELL96:OUT_F1
Q1CH3_FDRX28outputTCELL96:OUT_F2
Q1CH3_FDRX29outputTCELL96:OUT_F3
Q1CH3_FDRX3outputTCELL112:OUT_F7
Q1CH3_FDRX30outputTCELL96:OUT_F4
Q1CH3_FDRX31outputTCELL96:OUT_F5
Q1CH3_FDRX32outputTCELL96:OUT_Q6
Q1CH3_FDRX33outputTCELL96:OUT_Q7
Q1CH3_FDRX34outputTCELL97:OUT_Q0
Q1CH3_FDRX35outputTCELL97:OUT_Q1
Q1CH3_FDRX36outputTCELL97:OUT_Q2
Q1CH3_FDRX37outputTCELL97:OUT_Q3
Q1CH3_FDRX38outputTCELL97:OUT_Q4
Q1CH3_FDRX39outputTCELL97:OUT_Q5
Q1CH3_FDRX4outputTCELL113:OUT_Q0
Q1CH3_FDRX40outputTCELL96:OUT_F6
Q1CH3_FDRX41outputTCELL96:OUT_F7
Q1CH3_FDRX42outputTCELL97:OUT_F0
Q1CH3_FDRX43outputTCELL97:OUT_F1
Q1CH3_FDRX44outputTCELL97:OUT_F2
Q1CH3_FDRX45outputTCELL97:OUT_F3
Q1CH3_FDRX46outputTCELL97:OUT_F4
Q1CH3_FDRX47outputTCELL97:OUT_F5
Q1CH3_FDRX5outputTCELL113:OUT_Q1
Q1CH3_FDRX6outputTCELL113:OUT_Q2
Q1CH3_FDRX7outputTCELL113:OUT_Q3
Q1CH3_FDRX8outputTCELL113:OUT_Q4
Q1CH3_FDRX9outputTCELL113:OUT_Q5
Q1CH3_FDTX0inputTCELL98:IMUX_B4
Q1CH3_FDTX1inputTCELL98:IMUX_B5
Q1CH3_FDTX10inputTCELL99:IMUX_D2
Q1CH3_FDTX11inputTCELL99:IMUX_D3
Q1CH3_FDTX12inputTCELL99:IMUX_D4
Q1CH3_FDTX13inputTCELL99:IMUX_D5
Q1CH3_FDTX14inputTCELL99:IMUX_C0
Q1CH3_FDTX15inputTCELL99:IMUX_C1
Q1CH3_FDTX16inputTCELL99:IMUX_C2
Q1CH3_FDTX17inputTCELL99:IMUX_C3
Q1CH3_FDTX18inputTCELL99:IMUX_C4
Q1CH3_FDTX19inputTCELL99:IMUX_C5
Q1CH3_FDTX2inputTCELL98:IMUX_A0
Q1CH3_FDTX20inputTCELL99:IMUX_B0
Q1CH3_FDTX21inputTCELL99:IMUX_B1
Q1CH3_FDTX22inputTCELL99:IMUX_B2
Q1CH3_FDTX23inputTCELL99:IMUX_B3
Q1CH3_FDTX24inputTCELL99:IMUX_B4
Q1CH3_FDTX25inputTCELL99:IMUX_B5
Q1CH3_FDTX26inputTCELL99:IMUX_A0
Q1CH3_FDTX27inputTCELL99:IMUX_A1
Q1CH3_FDTX28inputTCELL99:IMUX_A2
Q1CH3_FDTX29inputTCELL99:IMUX_A3
Q1CH3_FDTX3inputTCELL98:IMUX_A1
Q1CH3_FDTX30inputTCELL99:IMUX_A4
Q1CH3_FDTX31inputTCELL99:IMUX_A5
Q1CH3_FDTX32inputTCELL100:IMUX_D0
Q1CH3_FDTX33inputTCELL100:IMUX_D1
Q1CH3_FDTX34inputTCELL100:IMUX_D2
Q1CH3_FDTX35inputTCELL100:IMUX_D3
Q1CH3_FDTX36inputTCELL100:IMUX_D4
Q1CH3_FDTX37inputTCELL100:IMUX_D5
Q1CH3_FDTX38inputTCELL100:IMUX_C0
Q1CH3_FDTX39inputTCELL100:IMUX_C1
Q1CH3_FDTX4inputTCELL98:IMUX_A2
Q1CH3_FDTX40inputTCELL100:IMUX_C2
Q1CH3_FDTX41inputTCELL100:IMUX_C3
Q1CH3_FDTX42inputTCELL100:IMUX_C4
Q1CH3_FDTX43inputTCELL100:IMUX_C5
Q1CH3_FDTX44inputTCELL100:IMUX_B0
Q1CH3_FDTX45inputTCELL100:IMUX_B1
Q1CH3_FDTX46inputTCELL100:IMUX_B2
Q1CH3_FDTX47inputTCELL100:IMUX_B3
Q1CH3_FDTX48inputTCELL100:IMUX_B4
Q1CH3_FDTX49inputTCELL100:IMUX_B5
Q1CH3_FDTX5inputTCELL98:IMUX_A3
Q1CH3_FDTX6inputTCELL98:IMUX_A4
Q1CH3_FDTX7inputTCELL98:IMUX_A5
Q1CH3_FDTX8inputTCELL99:IMUX_D0
Q1CH3_FDTX9inputTCELL99:IMUX_D1
Q1CH3_FIRCLKinputTCELL102:IMUX_CLK1_DELAY
Q1CH3_FIREFRXCLKinputTCELL104:IMUX_CLK1_DELAY
Q1CH3_FITCLKinputTCELL100:IMUX_CLK1_DELAY
Q1CH3_FITMRSTARTCLKinputTCELL110:IMUX_CLK0_DELAY
Q1CH3_FITMRSTOPCLKinputTCELL108:IMUX_CLK0_DELAY
Q1CH3_FSCCOVERRUNoutputTCELL111:OUT_Q4
Q1CH3_FSCCUNDERRUNoutputTCELL111:OUT_F0
Q1CH3_FSDFEVLDoutputTCELL108:OUT_Q1
Q1CH3_FSLSMoutputTCELL111:OUT_F4
Q1CH3_FSPCIECONoutputTCELL112:OUT_Q4
Q1CH3_FSPCIEDONEoutputTCELL112:OUT_F0
Q1CH3_FSRCDONEoutputTCELL109:OUT_F1
Q1CH3_FSRLOLoutputTCELL111:OUT_Q0
Q1CH3_FSRLOSoutputTCELL112:OUT_Q0
Q1CH3_FSSKPADDEDoutputTCELL110:OUT_Q6
Q1CH3_FSSKPDELETEDoutputTCELL110:OUT_Q2
Q1D0_FCDERSTinputTCELL104:IMUX_LSR1
Q1D0_FSDEoutputTCELL110:OUT_Q1
Q1D0_FSDMoutputTCELL109:OUT_F7
Q1D1_FCDERSTinputTCELL104:IMUX_LSR0
Q1D1_FSDEoutputTCELL110:OUT_Q0
Q1D1_FSDMoutputTCELL109:OUT_F6
Q1EA0_CIRXFULLinputTCELL66:IMUX_A5
Q1EA0_CIRXIGNOREPKTinputTCELL67:IMUX_A2
Q1EA0_CITXDATA0inputTCELL63:IMUX_D2
Q1EA0_CITXDATA1inputTCELL63:IMUX_D1
Q1EA0_CITXDATA10inputTCELL62:IMUX_B4
Q1EA0_CITXDATA11inputTCELL62:IMUX_B3
Q1EA0_CITXDATA12inputTCELL62:IMUX_B2
Q1EA0_CITXDATA13inputTCELL62:IMUX_B1
Q1EA0_CITXDATA14inputTCELL62:IMUX_B0
Q1EA0_CITXDATA15inputTCELL62:IMUX_C5
Q1EA0_CITXDATA2inputTCELL63:IMUX_D0
Q1EA0_CITXDATA3inputTCELL62:IMUX_A5
Q1EA0_CITXDATA4inputTCELL62:IMUX_A4
Q1EA0_CITXDATA5inputTCELL62:IMUX_A3
Q1EA0_CITXDATA6inputTCELL62:IMUX_A2
Q1EA0_CITXDATA7inputTCELL62:IMUX_A1
Q1EA0_CITXDATA8inputTCELL62:IMUX_A0
Q1EA0_CITXDATA9inputTCELL62:IMUX_B5
Q1EA0_CITXDATAAVAILinputTCELL63:IMUX_B4
Q1EA0_CITXEMPTYinputTCELL64:IMUX_C2
Q1EA0_CITXEOFinputTCELL60:IMUX_A4
Q1EA0_CITXFIFOCTRLinputTCELL65:IMUX_B3
Q1EA0_CITXFORCEERRinputTCELL65:IMUX_C3
Q1EA0_CITXLASTBYTEVLDinputTCELL61:IMUX_D1
Q1EA0_CITXPAUSREQinputTCELL64:IMUX_A1
Q1EA0_CITXPAUSTIM0inputTCELL65:IMUX_B0
Q1EA0_CITXPAUSTIM1inputTCELL65:IMUX_D3
Q1EA0_CITXPAUSTIM10inputTCELL65:IMUX_C0
Q1EA0_CITXPAUSTIM11inputTCELL65:IMUX_C4
Q1EA0_CITXPAUSTIM12inputTCELL65:IMUX_C5
Q1EA0_CITXPAUSTIM13inputTCELL64:IMUX_A3
Q1EA0_CITXPAUSTIM14inputTCELL65:IMUX_B1
Q1EA0_CITXPAUSTIM15inputTCELL64:IMUX_A5
Q1EA0_CITXPAUSTIM2inputTCELL64:IMUX_B5
Q1EA0_CITXPAUSTIM3inputTCELL65:IMUX_D1
Q1EA0_CITXPAUSTIM4inputTCELL65:IMUX_C1
Q1EA0_CITXPAUSTIM5inputTCELL64:IMUX_A4
Q1EA0_CITXPAUSTIM6inputTCELL65:IMUX_D2
Q1EA0_CITXPAUSTIM7inputTCELL65:IMUX_D4
Q1EA0_CITXPAUSTIM8inputTCELL65:IMUX_C2
Q1EA0_CITXPAUSTIM9inputTCELL65:IMUX_D5
Q1EA0_CORXDATA0outputTCELL66:OUT_F5
Q1EA0_CORXDATA1outputTCELL67:OUT_Q2
Q1EA0_CORXDATA10outputTCELL66:OUT_Q1
Q1EA0_CORXDATA11outputTCELL66:OUT_Q3
Q1EA0_CORXDATA12outputTCELL66:OUT_Q7
Q1EA0_CORXDATA13outputTCELL66:OUT_Q0
Q1EA0_CORXDATA14outputTCELL65:OUT_Q4
Q1EA0_CORXDATA15outputTCELL66:OUT_Q2
Q1EA0_CORXDATA2outputTCELL66:OUT_F6
Q1EA0_CORXDATA3outputTCELL66:OUT_F4
Q1EA0_CORXDATA4outputTCELL66:OUT_F7
Q1EA0_CORXDATA5outputTCELL67:OUT_Q6
Q1EA0_CORXDATA6outputTCELL67:OUT_Q1
Q1EA0_CORXDATA7outputTCELL67:OUT_Q4
Q1EA0_CORXDATA8outputTCELL66:OUT_F1
Q1EA0_CORXDATA9outputTCELL66:OUT_F0
Q1EA0_CORXEOFoutputTCELL64:OUT_F1
Q1EA0_CORXERRORoutputTCELL64:OUT_Q7
Q1EA0_CORXFIFOFULLERRORoutputTCELL64:OUT_Q1
Q1EA0_CORXLASTBYTEVLDoutputTCELL62:OUT_F3
Q1EA0_CORXSTATENoutputTCELL65:OUT_Q0
Q1EA0_CORXSTATVEC0outputTCELL68:OUT_Q7
Q1EA0_CORXSTATVEC1outputTCELL67:OUT_Q7
Q1EA0_CORXSTATVEC2outputTCELL67:OUT_F0
Q1EA0_CORXSTATVEC3outputTCELL67:OUT_F1
Q1EA0_CORXSTATVEC4outputTCELL67:OUT_F2
Q1EA0_CORXSTATVEC5outputTCELL67:OUT_F3
Q1EA0_CORXSTATVEC6outputTCELL67:OUT_F4
Q1EA0_CORXSTATVEC7outputTCELL67:OUT_F6
Q1EA0_CORXWRITEoutputTCELL63:OUT_F4
Q1EA0_COTXDISCFRMoutputTCELL58:OUT_F4
Q1EA0_COTXDONEoutputTCELL59:OUT_F6
Q1EA0_COTXREADoutputTCELL58:OUT_F1
Q1EA0_COTXSTATENoutputTCELL59:OUT_Q1
Q1EA0_COTXSTATVEC0outputTCELL59:OUT_F1
Q1EA0_COTXSTATVEC1outputTCELL59:OUT_Q5
Q1EA0_COTXSTATVEC2outputTCELL60:OUT_Q0
Q1EA0_COTXSTATVEC3outputTCELL59:OUT_Q3
Q1EA0_COTXSTATVEC4outputTCELL59:OUT_F2
Q1EA0_COTXSTATVEC5outputTCELL60:OUT_Q4
Q1EA0_COTXSTATVEC6outputTCELL58:OUT_F7
Q1EA0_COTXSTATVEC7outputTCELL58:OUT_F6
Q1EA0_GIIPGSHRINKinputTCELL67:IMUX_C3
Q1EA0_GINONPADRXDVinputTCELL67:IMUX_A4
Q1EA0_GISYNCCOLinputTCELL65:IMUX_B4
Q1EA0_GISYNCCRSinputTCELL65:IMUX_A1
Q1EA0_GISYNCNIBDRIBinputTCELL67:IMUX_C4
Q1EA0_GISYNCRXD0inputTCELL67:IMUX_A3
Q1EA0_GISYNCRXD1inputTCELL67:IMUX_D7
Q1EA0_GISYNCRXD2inputTCELL67:IMUX_C6
Q1EA0_GISYNCRXD3inputTCELL67:IMUX_B5
Q1EA0_GISYNCRXD4inputTCELL67:IMUX_C2
Q1EA0_GISYNCRXD5inputTCELL67:IMUX_C7
Q1EA0_GISYNCRXD6inputTCELL67:IMUX_C5
Q1EA0_GISYNCRXD7inputTCELL67:IMUX_B6
Q1EA0_GISYNCRXDVinputTCELL67:IMUX_A6
Q1EA0_GISYNCRXERinputTCELL67:IMUX_B4
Q1EA0_GODISCARDFCSoutputTCELL62:OUT_Q4
Q1EA0_GOTXMACDATA0outputTCELL62:OUT_Q0
Q1EA0_GOTXMACDATA1outputTCELL61:OUT_F1
Q1EA0_GOTXMACDATA2outputTCELL61:OUT_Q2
Q1EA0_GOTXMACDATA3outputTCELL61:OUT_F3
Q1EA0_GOTXMACDATA4outputTCELL60:OUT_Q6
Q1EA0_GOTXMACDATA5outputTCELL60:OUT_F6
Q1EA0_GOTXMACDATA6outputTCELL61:OUT_F5
Q1EA0_GOTXMACDATA7outputTCELL61:OUT_F2
Q1EA0_GOTXMACERRoutputTCELL60:OUT_F1
Q1EA0_GOTXMACWRoutputTCELL61:OUT_Q5
Q1EA0_KIRSTNinputTCELL79:IMUX_LSR1
Q1EA0_KIRXMACCLKinputTCELL80:IMUX_CLK1_DELAY
Q1EA0_KIRXMACCLKENEXTinputTCELL67:IMUX_D5
Q1EA0_KIRXTXFECLKinputTCELL76:IMUX_CLK1_DELAY
Q1EA0_KITXGMIILPBKinputTCELL67:IMUX_D4
Q1EA0_KITXMACCLKinputTCELL75:IMUX_CLK0_DELAY
Q1EA0_KITXMACCLKENEXTinputTCELL66:IMUX_D7
Q1EA0_KOGBITENoutputTCELL63:OUT_Q4
Q1EA0_KORXMACCLKENoutputTCELL64:OUT_F4
Q1EA1_CIRXFULLinputTCELL65:IMUX_B2
Q1EA1_CIRXIGNOREPKTinputTCELL70:IMUX_D7
Q1EA1_CITXDATA0inputTCELL62:IMUX_C4
Q1EA1_CITXDATA1inputTCELL62:IMUX_C3
Q1EA1_CITXDATA10inputTCELL62:IMUX_D0
Q1EA1_CITXDATA11inputTCELL61:IMUX_A5
Q1EA1_CITXDATA12inputTCELL61:IMUX_A4
Q1EA1_CITXDATA13inputTCELL61:IMUX_A3
Q1EA1_CITXDATA14inputTCELL61:IMUX_A2
Q1EA1_CITXDATA15inputTCELL61:IMUX_A1
Q1EA1_CITXDATA2inputTCELL62:IMUX_C2
Q1EA1_CITXDATA3inputTCELL62:IMUX_C1
Q1EA1_CITXDATA4inputTCELL62:IMUX_C0
Q1EA1_CITXDATA5inputTCELL62:IMUX_D5
Q1EA1_CITXDATA6inputTCELL62:IMUX_D4
Q1EA1_CITXDATA7inputTCELL62:IMUX_D3
Q1EA1_CITXDATA8inputTCELL62:IMUX_D2
Q1EA1_CITXDATA9inputTCELL62:IMUX_D1
Q1EA1_CITXDATAAVAILinputTCELL64:IMUX_D2
Q1EA1_CITXEMPTYinputTCELL63:IMUX_A1
Q1EA1_CITXEOFinputTCELL60:IMUX_A3
Q1EA1_CITXFIFOCTRLinputTCELL64:IMUX_A2
Q1EA1_CITXFORCEERRinputTCELL65:IMUX_D0
Q1EA1_CITXLASTBYTEVLDinputTCELL61:IMUX_D0
Q1EA1_CITXPAUSREQinputTCELL64:IMUX_A0
Q1EA1_CITXPAUSTIM0inputTCELL64:IMUX_C3
Q1EA1_CITXPAUSTIM1inputTCELL64:IMUX_C1
Q1EA1_CITXPAUSTIM10inputTCELL64:IMUX_B1
Q1EA1_CITXPAUSTIM11inputTCELL63:IMUX_A2
Q1EA1_CITXPAUSTIM12inputTCELL64:IMUX_D5
Q1EA1_CITXPAUSTIM13inputTCELL64:IMUX_B0
Q1EA1_CITXPAUSTIM14inputTCELL63:IMUX_A4
Q1EA1_CITXPAUSTIM15inputTCELL64:IMUX_C0
Q1EA1_CITXPAUSTIM2inputTCELL64:IMUX_D4
Q1EA1_CITXPAUSTIM3inputTCELL63:IMUX_B0
Q1EA1_CITXPAUSTIM4inputTCELL63:IMUX_A3
Q1EA1_CITXPAUSTIM5inputTCELL63:IMUX_C5
Q1EA1_CITXPAUSTIM6inputTCELL63:IMUX_B1
Q1EA1_CITXPAUSTIM7inputTCELL64:IMUX_D3
Q1EA1_CITXPAUSTIM8inputTCELL63:IMUX_A0
Q1EA1_CITXPAUSTIM9inputTCELL63:IMUX_B5
Q1EA1_CORXDATA0outputTCELL73:OUT_Q3
Q1EA1_CORXDATA1outputTCELL73:OUT_F2
Q1EA1_CORXDATA10outputTCELL74:OUT_Q7
Q1EA1_CORXDATA11outputTCELL74:OUT_Q5
Q1EA1_CORXDATA12outputTCELL73:OUT_F7
Q1EA1_CORXDATA13outputTCELL74:OUT_F4
Q1EA1_CORXDATA14outputTCELL74:OUT_F7
Q1EA1_CORXDATA15outputTCELL74:OUT_Q1
Q1EA1_CORXDATA2outputTCELL72:OUT_F1
Q1EA1_CORXDATA3outputTCELL72:OUT_Q5
Q1EA1_CORXDATA4outputTCELL72:OUT_F6
Q1EA1_CORXDATA5outputTCELL73:OUT_Q6
Q1EA1_CORXDATA6outputTCELL73:OUT_Q0
Q1EA1_CORXDATA7outputTCELL72:OUT_F7
Q1EA1_CORXDATA8outputTCELL72:OUT_Q7
Q1EA1_CORXDATA9outputTCELL73:OUT_Q1
Q1EA1_CORXEOFoutputTCELL73:OUT_Q2
Q1EA1_CORXERRORoutputTCELL72:OUT_Q6
Q1EA1_CORXFIFOFULLERRORoutputTCELL72:OUT_F0
Q1EA1_CORXLASTBYTEVLDoutputTCELL63:OUT_Q1
Q1EA1_CORXSTATENoutputTCELL69:OUT_Q3
Q1EA1_CORXSTATVEC0outputTCELL71:OUT_F5
Q1EA1_CORXSTATVEC1outputTCELL71:OUT_F0
Q1EA1_CORXSTATVEC2outputTCELL71:OUT_Q3
Q1EA1_CORXSTATVEC3outputTCELL70:OUT_F2
Q1EA1_CORXSTATVEC4outputTCELL70:OUT_F1
Q1EA1_CORXSTATVEC5outputTCELL71:OUT_Q0
Q1EA1_CORXSTATVEC6outputTCELL72:OUT_Q2
Q1EA1_CORXSTATVEC7outputTCELL72:OUT_Q0
Q1EA1_CORXWRITEoutputTCELL72:OUT_F5
Q1EA1_COTXDISCFRMoutputTCELL58:OUT_F5
Q1EA1_COTXDONEoutputTCELL59:OUT_Q2
Q1EA1_COTXREADoutputTCELL58:OUT_F0
Q1EA1_COTXSTATENoutputTCELL59:OUT_Q0
Q1EA1_COTXSTATVEC0outputTCELL59:OUT_F5
Q1EA1_COTXSTATVEC1outputTCELL59:OUT_Q6
Q1EA1_COTXSTATVEC2outputTCELL59:OUT_F0
Q1EA1_COTXSTATVEC3outputTCELL59:OUT_F3
Q1EA1_COTXSTATVEC4outputTCELL60:OUT_Q1
Q1EA1_COTXSTATVEC5outputTCELL59:OUT_F4
Q1EA1_COTXSTATVEC6outputTCELL60:OUT_Q2
Q1EA1_COTXSTATVEC7outputTCELL59:OUT_Q7
Q1EA1_GIIPGSHRINKinputTCELL69:IMUX_A5
Q1EA1_GINONPADRXDVinputTCELL70:IMUX_D5
Q1EA1_GISYNCCOLinputTCELL65:IMUX_B5
Q1EA1_GISYNCCRSinputTCELL65:IMUX_A0
Q1EA1_GISYNCNIBDRIBinputTCELL69:IMUX_B3
Q1EA1_GISYNCRXD0inputTCELL70:IMUX_D3
Q1EA1_GISYNCRXD1inputTCELL70:IMUX_C4
Q1EA1_GISYNCRXD2inputTCELL70:IMUX_D4
Q1EA1_GISYNCRXD3inputTCELL69:IMUX_B2
Q1EA1_GISYNCRXD4inputTCELL70:IMUX_C6
Q1EA1_GISYNCRXD5inputTCELL70:IMUX_B4
Q1EA1_GISYNCRXD6inputTCELL70:IMUX_B3
Q1EA1_GISYNCRXD7inputTCELL70:IMUX_C2
Q1EA1_GISYNCRXDVinputTCELL69:IMUX_A6
Q1EA1_GISYNCRXERinputTCELL70:IMUX_A2
Q1EA1_GODISCARDFCSoutputTCELL62:OUT_Q5
Q1EA1_GOTXMACDATA0outputTCELL60:OUT_F5
Q1EA1_GOTXMACDATA1outputTCELL62:OUT_Q2
Q1EA1_GOTXMACDATA2outputTCELL60:OUT_F4
Q1EA1_GOTXMACDATA3outputTCELL61:OUT_Q0
Q1EA1_GOTXMACDATA4outputTCELL60:OUT_F2
Q1EA1_GOTXMACDATA5outputTCELL61:OUT_Q1
Q1EA1_GOTXMACDATA6outputTCELL59:OUT_F7
Q1EA1_GOTXMACDATA7outputTCELL60:OUT_F0
Q1EA1_GOTXMACERRoutputTCELL59:OUT_Q4
Q1EA1_GOTXMACWRoutputTCELL60:OUT_F3
Q1EA1_KIRSTNinputTCELL80:IMUX_LSR1
Q1EA1_KIRXMACCLKinputTCELL80:IMUX_CLK0_DELAY
Q1EA1_KIRXMACCLKENEXTinputTCELL67:IMUX_D6
Q1EA1_KIRXTXFECLKinputTCELL78:IMUX_CLK0_DELAY
Q1EA1_KITXGMIILPBKinputTCELL67:IMUX_D3
Q1EA1_KITXMACCLKinputTCELL79:IMUX_CLK1_DELAY
Q1EA1_KITXMACCLKENEXTinputTCELL66:IMUX_A4
Q1EA1_KOGBITENoutputTCELL62:OUT_F4
Q1EA1_KORXMACCLKENoutputTCELL63:OUT_Q0
Q1EA2_CIRXFULLinputTCELL69:IMUX_D7
Q1EA2_CIRXIGNOREPKTinputTCELL70:IMUX_D6
Q1EA2_CITXDATA0inputTCELL64:IMUX_B3
Q1EA2_CITXDATA1inputTCELL64:IMUX_C4
Q1EA2_CITXDATA10inputTCELL63:IMUX_C3
Q1EA2_CITXDATA11inputTCELL63:IMUX_D5
Q1EA2_CITXDATA12inputTCELL61:IMUX_A0
Q1EA2_CITXDATA13inputTCELL63:IMUX_D3
Q1EA2_CITXDATA14inputTCELL63:IMUX_C0
Q1EA2_CITXDATA15inputTCELL63:IMUX_C2
Q1EA2_CITXDATA2inputTCELL64:IMUX_B2
Q1EA2_CITXDATA3inputTCELL64:IMUX_B4
Q1EA2_CITXDATA4inputTCELL64:IMUX_C5
Q1EA2_CITXDATA5inputTCELL63:IMUX_A5
Q1EA2_CITXDATA6inputTCELL64:IMUX_D0
Q1EA2_CITXDATA7inputTCELL63:IMUX_B2
Q1EA2_CITXDATA8inputTCELL64:IMUX_D1
Q1EA2_CITXDATA9inputTCELL63:IMUX_C4
Q1EA2_CITXDATAAVAILinputTCELL63:IMUX_D4
Q1EA2_CITXEMPTYinputTCELL66:IMUX_B7
Q1EA2_CITXEOFinputTCELL63:IMUX_C1
Q1EA2_CITXFIFOCTRLinputTCELL67:IMUX_B7
Q1EA2_CITXFORCEERRinputTCELL67:IMUX_B3
Q1EA2_CITXLASTBYTEVLDinputTCELL63:IMUX_B3
Q1EA2_CITXPAUSREQinputTCELL66:IMUX_A3
Q1EA2_CITXPAUSTIM0inputTCELL67:IMUX_A7
Q1EA2_CITXPAUSTIM1inputTCELL68:IMUX_D2
Q1EA2_CITXPAUSTIM10inputTCELL68:IMUX_C4
Q1EA2_CITXPAUSTIM11inputTCELL68:IMUX_D7
Q1EA2_CITXPAUSTIM12inputTCELL68:IMUX_C2
Q1EA2_CITXPAUSTIM13inputTCELL68:IMUX_C7
Q1EA2_CITXPAUSTIM14inputTCELL68:IMUX_B4
Q1EA2_CITXPAUSTIM15inputTCELL68:IMUX_D5
Q1EA2_CITXPAUSTIM2inputTCELL68:IMUX_C6
Q1EA2_CITXPAUSTIM3inputTCELL68:IMUX_D4
Q1EA2_CITXPAUSTIM4inputTCELL68:IMUX_B3
Q1EA2_CITXPAUSTIM5inputTCELL68:IMUX_C5
Q1EA2_CITXPAUSTIM6inputTCELL68:IMUX_B2
Q1EA2_CITXPAUSTIM7inputTCELL68:IMUX_D6
Q1EA2_CITXPAUSTIM8inputTCELL68:IMUX_D3
Q1EA2_CITXPAUSTIM9inputTCELL68:IMUX_C3
Q1EA2_CORXDATA0outputTCELL73:OUT_Q7
Q1EA2_CORXDATA1outputTCELL73:OUT_F6
Q1EA2_CORXDATA10outputTCELL72:OUT_Q4
Q1EA2_CORXDATA11outputTCELL72:OUT_F2
Q1EA2_CORXDATA12outputTCELL74:OUT_F0
Q1EA2_CORXDATA13outputTCELL75:OUT_Q0
Q1EA2_CORXDATA14outputTCELL74:OUT_F6
Q1EA2_CORXDATA15outputTCELL74:OUT_F5
Q1EA2_CORXDATA2outputTCELL73:OUT_F3
Q1EA2_CORXDATA3outputTCELL72:OUT_F4
Q1EA2_CORXDATA4outputTCELL73:OUT_F5
Q1EA2_CORXDATA5outputTCELL73:OUT_F0
Q1EA2_CORXDATA6outputTCELL73:OUT_Q4
Q1EA2_CORXDATA7outputTCELL74:OUT_Q0
Q1EA2_CORXDATA8outputTCELL74:OUT_F1
Q1EA2_CORXDATA9outputTCELL74:OUT_Q6
Q1EA2_CORXEOFoutputTCELL71:OUT_F2
Q1EA2_CORXERRORoutputTCELL71:OUT_F3
Q1EA2_CORXFIFOFULLERRORoutputTCELL71:OUT_F4
Q1EA2_CORXLASTBYTEVLDoutputTCELL63:OUT_F7
Q1EA2_CORXSTATENoutputTCELL70:OUT_Q0
Q1EA2_CORXSTATVEC0outputTCELL71:OUT_Q1
Q1EA2_CORXSTATVEC1outputTCELL71:OUT_F1
Q1EA2_CORXSTATVEC2outputTCELL72:OUT_F3
Q1EA2_CORXSTATVEC3outputTCELL73:OUT_F1
Q1EA2_CORXSTATVEC4outputTCELL73:OUT_Q5
Q1EA2_CORXSTATVEC5outputTCELL72:OUT_Q3
Q1EA2_CORXSTATVEC6outputTCELL72:OUT_Q1
Q1EA2_CORXSTATVEC7outputTCELL71:OUT_Q2
Q1EA2_CORXWRITEoutputTCELL71:OUT_Q5
Q1EA2_COTXDISCFRMoutputTCELL63:OUT_F5
Q1EA2_COTXDONEoutputTCELL64:OUT_F2
Q1EA2_COTXREADoutputTCELL62:OUT_Q7
Q1EA2_COTXSTATENoutputTCELL64:OUT_F0
Q1EA2_COTXSTATVEC0outputTCELL65:OUT_F0
Q1EA2_COTXSTATVEC1outputTCELL65:OUT_Q5
Q1EA2_COTXSTATVEC2outputTCELL65:OUT_Q3
Q1EA2_COTXSTATVEC3outputTCELL64:OUT_F5
Q1EA2_COTXSTATVEC4outputTCELL65:OUT_Q2
Q1EA2_COTXSTATVEC5outputTCELL65:OUT_F5
Q1EA2_COTXSTATVEC6outputTCELL64:OUT_Q6
Q1EA2_COTXSTATVEC7outputTCELL65:OUT_F2
Q1EA2_GIIPGSHRINKinputTCELL69:IMUX_B4
Q1EA2_GINONPADRXDVinputTCELL71:IMUX_D2
Q1EA2_GISYNCCOLinputTCELL68:IMUX_B6
Q1EA2_GISYNCCRSinputTCELL68:IMUX_B5
Q1EA2_GISYNCNIBDRIBinputTCELL70:IMUX_C5
Q1EA2_GISYNCRXD0inputTCELL70:IMUX_C7
Q1EA2_GISYNCRXD1inputTCELL70:IMUX_B7
Q1EA2_GISYNCRXD2inputTCELL69:IMUX_A3
Q1EA2_GISYNCRXD3inputTCELL69:IMUX_A4
Q1EA2_GISYNCRXD4inputTCELL69:IMUX_A2
Q1EA2_GISYNCRXD5inputTCELL69:IMUX_B7
Q1EA2_GISYNCRXD6inputTCELL69:IMUX_B5
Q1EA2_GISYNCRXD7inputTCELL69:IMUX_B6
Q1EA2_GISYNCRXDVinputTCELL70:IMUX_A4
Q1EA2_GISYNCRXERinputTCELL70:IMUX_B6
Q1EA2_GODISCARDFCSoutputTCELL68:OUT_Q3
Q1EA2_GOTXMACDATA0outputTCELL61:OUT_F4
Q1EA2_GOTXMACDATA1outputTCELL61:OUT_Q3
Q1EA2_GOTXMACDATA2outputTCELL61:OUT_Q4
Q1EA2_GOTXMACDATA3outputTCELL60:OUT_F7
Q1EA2_GOTXMACDATA4outputTCELL64:OUT_Q5
Q1EA2_GOTXMACDATA5outputTCELL64:OUT_F7
Q1EA2_GOTXMACDATA6outputTCELL65:OUT_F1
Q1EA2_GOTXMACDATA7outputTCELL61:OUT_Q6
Q1EA2_GOTXMACERRoutputTCELL61:OUT_Q7
Q1EA2_GOTXMACWRoutputTCELL61:OUT_F0
Q1EA2_KIRSTNinputTCELL80:IMUX_LSR0
Q1EA2_KIRXMACCLKinputTCELL81:IMUX_CLK0_DELAY
Q1EA2_KIRXMACCLKENEXTinputTCELL68:IMUX_A5
Q1EA2_KIRXTXFECLKinputTCELL78:IMUX_CLK1_DELAY
Q1EA2_KITXGMIILPBKinputTCELL68:IMUX_A2
Q1EA2_KITXMACCLKinputTCELL79:IMUX_CLK0_DELAY
Q1EA2_KITXMACCLKENEXTinputTCELL68:IMUX_B7
Q1EA2_KOGBITENoutputTCELL63:OUT_Q3
Q1EA2_KORXMACCLKENoutputTCELL62:OUT_F0
Q1EA3_CIRXFULLinputTCELL68:IMUX_A6
Q1EA3_CIRXIGNOREPKTinputTCELL69:IMUX_C2
Q1EA3_CITXDATA0inputTCELL61:IMUX_B5
Q1EA3_CITXDATA1inputTCELL61:IMUX_B4
Q1EA3_CITXDATA10inputTCELL61:IMUX_C1
Q1EA3_CITXDATA11inputTCELL61:IMUX_C0
Q1EA3_CITXDATA12inputTCELL61:IMUX_D5
Q1EA3_CITXDATA13inputTCELL61:IMUX_D4
Q1EA3_CITXDATA14inputTCELL61:IMUX_D3
Q1EA3_CITXDATA15inputTCELL61:IMUX_D2
Q1EA3_CITXDATA2inputTCELL61:IMUX_B2
Q1EA3_CITXDATA3inputTCELL61:IMUX_B3
Q1EA3_CITXDATA4inputTCELL61:IMUX_B1
Q1EA3_CITXDATA5inputTCELL61:IMUX_B0
Q1EA3_CITXDATA6inputTCELL61:IMUX_C5
Q1EA3_CITXDATA7inputTCELL61:IMUX_C4
Q1EA3_CITXDATA8inputTCELL61:IMUX_C3
Q1EA3_CITXDATA9inputTCELL61:IMUX_C2
Q1EA3_CITXDATAAVAILinputTCELL65:IMUX_A2
Q1EA3_CITXEMPTYinputTCELL65:IMUX_A3
Q1EA3_CITXEOFinputTCELL60:IMUX_A2
Q1EA3_CITXFIFOCTRLinputTCELL66:IMUX_A2
Q1EA3_CITXFORCEERRinputTCELL66:IMUX_C7
Q1EA3_CITXLASTBYTEVLDinputTCELL60:IMUX_A5
Q1EA3_CITXPAUSREQinputTCELL65:IMUX_A4
Q1EA3_CITXPAUSTIM0inputTCELL66:IMUX_B6
Q1EA3_CITXPAUSTIM1inputTCELL66:IMUX_B4
Q1EA3_CITXPAUSTIM10inputTCELL66:IMUX_D6
Q1EA3_CITXPAUSTIM11inputTCELL66:IMUX_B3
Q1EA3_CITXPAUSTIM12inputTCELL66:IMUX_D3
Q1EA3_CITXPAUSTIM13inputTCELL65:IMUX_A5
Q1EA3_CITXPAUSTIM14inputTCELL66:IMUX_C6
Q1EA3_CITXPAUSTIM15inputTCELL66:IMUX_B2
Q1EA3_CITXPAUSTIM2inputTCELL66:IMUX_C4
Q1EA3_CITXPAUSTIM3inputTCELL66:IMUX_B5
Q1EA3_CITXPAUSTIM4inputTCELL66:IMUX_D5
Q1EA3_CITXPAUSTIM5inputTCELL66:IMUX_D4
Q1EA3_CITXPAUSTIM6inputTCELL66:IMUX_D2
Q1EA3_CITXPAUSTIM7inputTCELL66:IMUX_C3
Q1EA3_CITXPAUSTIM8inputTCELL66:IMUX_C5
Q1EA3_CITXPAUSTIM9inputTCELL66:IMUX_C2
Q1EA3_CORXDATA0outputTCELL69:OUT_F0
Q1EA3_CORXDATA1outputTCELL69:OUT_Q1
Q1EA3_CORXDATA10outputTCELL70:OUT_Q7
Q1EA3_CORXDATA11outputTCELL70:OUT_F3
Q1EA3_CORXDATA12outputTCELL70:OUT_Q1
Q1EA3_CORXDATA13outputTCELL70:OUT_F5
Q1EA3_CORXDATA14outputTCELL70:OUT_Q5
Q1EA3_CORXDATA15outputTCELL69:OUT_F5
Q1EA3_CORXDATA2outputTCELL69:OUT_F2
Q1EA3_CORXDATA3outputTCELL69:OUT_Q6
Q1EA3_CORXDATA4outputTCELL69:OUT_Q2
Q1EA3_CORXDATA5outputTCELL69:OUT_Q7
Q1EA3_CORXDATA6outputTCELL69:OUT_F4
Q1EA3_CORXDATA7outputTCELL69:OUT_F6
Q1EA3_CORXDATA8outputTCELL70:OUT_F0
Q1EA3_CORXDATA9outputTCELL69:OUT_F7
Q1EA3_CORXEOFoutputTCELL68:OUT_F6
Q1EA3_CORXERRORoutputTCELL69:OUT_Q0
Q1EA3_CORXFIFOFULLERRORoutputTCELL68:OUT_F4
Q1EA3_CORXLASTBYTEVLDoutputTCELL63:OUT_F6
Q1EA3_CORXSTATENoutputTCELL68:OUT_F7
Q1EA3_CORXSTATVEC0outputTCELL70:OUT_F7
Q1EA3_CORXSTATVEC1outputTCELL70:OUT_F4
Q1EA3_CORXSTATVEC2outputTCELL70:OUT_Q6
Q1EA3_CORXSTATVEC3outputTCELL69:OUT_F1
Q1EA3_CORXSTATVEC4outputTCELL70:OUT_Q4
Q1EA3_CORXSTATVEC5outputTCELL70:OUT_F6
Q1EA3_CORXSTATVEC6outputTCELL70:OUT_Q3
Q1EA3_CORXSTATVEC7outputTCELL69:OUT_Q5
Q1EA3_CORXWRITEoutputTCELL68:OUT_F3
Q1EA3_COTXDISCFRMoutputTCELL62:OUT_Q3
Q1EA3_COTXDONEoutputTCELL61:OUT_F7
Q1EA3_COTXREADoutputTCELL58:OUT_Q7
Q1EA3_COTXSTATENoutputTCELL62:OUT_F2
Q1EA3_COTXSTATVEC0outputTCELL63:OUT_F2
Q1EA3_COTXSTATVEC1outputTCELL63:OUT_Q5
Q1EA3_COTXSTATVEC2outputTCELL64:OUT_Q4
Q1EA3_COTXSTATVEC3outputTCELL63:OUT_F1
Q1EA3_COTXSTATVEC4outputTCELL63:OUT_Q6
Q1EA3_COTXSTATVEC5outputTCELL62:OUT_F7
Q1EA3_COTXSTATVEC6outputTCELL63:OUT_F0
Q1EA3_COTXSTATVEC7outputTCELL62:OUT_F6
Q1EA3_GIIPGSHRINKinputTCELL69:IMUX_D5
Q1EA3_GINONPADRXDVinputTCELL69:IMUX_C6
Q1EA3_GISYNCCOLinputTCELL66:IMUX_A6
Q1EA3_GISYNCCRSinputTCELL66:IMUX_A7
Q1EA3_GISYNCNIBDRIBinputTCELL69:IMUX_C5
Q1EA3_GISYNCRXD0inputTCELL69:IMUX_C7
Q1EA3_GISYNCRXD1inputTCELL69:IMUX_D6
Q1EA3_GISYNCRXD2inputTCELL69:IMUX_D4
Q1EA3_GISYNCRXD3inputTCELL68:IMUX_A3
Q1EA3_GISYNCRXD4inputTCELL69:IMUX_D3
Q1EA3_GISYNCRXD5inputTCELL68:IMUX_A4
Q1EA3_GISYNCRXD6inputTCELL69:IMUX_D2
Q1EA3_GISYNCRXD7inputTCELL68:IMUX_A7
Q1EA3_GISYNCRXDVinputTCELL69:IMUX_C4
Q1EA3_GISYNCRXERinputTCELL69:IMUX_C3
Q1EA3_GODISCARDFCSoutputTCELL60:OUT_Q5
Q1EA3_GOTXMACDATA0outputTCELL62:OUT_F5
Q1EA3_GOTXMACDATA1outputTCELL61:OUT_F6
Q1EA3_GOTXMACDATA2outputTCELL60:OUT_Q3
Q1EA3_GOTXMACDATA3outputTCELL62:OUT_F1
Q1EA3_GOTXMACDATA4outputTCELL64:OUT_Q2
Q1EA3_GOTXMACDATA5outputTCELL63:OUT_Q2
Q1EA3_GOTXMACDATA6outputTCELL63:OUT_F3
Q1EA3_GOTXMACDATA7outputTCELL64:OUT_Q0
Q1EA3_GOTXMACERRoutputTCELL62:OUT_Q1
Q1EA3_GOTXMACWRoutputTCELL58:OUT_F3
Q1EA3_KIRSTNinputTCELL79:IMUX_LSR0
Q1EA3_KIRXMACCLKinputTCELL81:IMUX_CLK1_DELAY
Q1EA3_KIRXMACCLKENEXTinputTCELL67:IMUX_A5
Q1EA3_KIRXTXFECLKinputTCELL77:IMUX_CLK1_DELAY
Q1EA3_KITXGMIILPBKinputTCELL67:IMUX_B2
Q1EA3_KITXMACCLKinputTCELL76:IMUX_CLK0_DELAY
Q1EA3_KITXMACCLKENEXTinputTCELL67:IMUX_D2
Q1EA3_KOGBITENoutputTCELL63:OUT_Q7
Q1EA3_KORXMACCLKENoutputTCELL60:OUT_Q7
Q1S_BAUDSUPPORT0inputTCELL78:IMUX_A2
Q1S_BAUDSUPPORT1inputTCELL79:IMUX_D3
Q1S_BAUDSUPPORT2inputTCELL79:IMUX_D2
Q1S_BAUDSUPPORT3inputTCELL79:IMUX_D5
Q1S_BAUDSUPPORT4inputTCELL72:IMUX_A5
Q1S_BUFFDEQACKADVPTRNoutputTCELL81:OUT_F3
Q1S_DECRBUFCNTVECTOR0outputTCELL90:OUT_Q4
Q1S_DECRBUFCNTVECTOR1outputTCELL90:OUT_Q3
Q1S_DECRBUFCNTVECTOR2outputTCELL90:OUT_Q2
Q1S_DECRBUFCNTVECTOR3outputTCELL90:OUT_Q1
Q1S_DECRBUFCNTVECTOR4outputTCELL90:OUT_Q0
Q1S_DECRBUFCNTVECTOR5outputTCELL89:OUT_F7
Q1S_DECRBUFCNTVECTOR6outputTCELL95:OUT_F5
Q1S_DECRBUFCNTVECTOR7outputTCELL89:OUT_F6
Q1S_DECRBUFCNTVECTOR8outputTCELL89:OUT_F5
Q1S_DECRBUFCNTVECTOR9outputTCELL89:OUT_F4
Q1S_ENABLETXFLOWCONTROLNinputTCELL79:IMUX_A4
Q1S_FLOWFIFOACKON0outputTCELL82:OUT_Q3
Q1S_FLOWFIFOACKON1outputTCELL81:OUT_F4
Q1S_FLOWFIFOACKON2outputTCELL81:OUT_F7
Q1S_FLOWFIFOACKON3outputTCELL81:OUT_F1
Q1S_GEARinputTCELL81:IMUX_A6
Q1S_LNKCLKinputTCELL84:IMUX_CLK1_DELAY
Q1S_LNKCLKDIV2inputTCELL84:IMUX_CLK0_DELAY
Q1S_LNKCLKDIV2RSTNoutputTCELL92:OUT_F7
Q1S_LNKCLKRSTNoutputTCELL94:OUT_Q1
Q1S_LNKDIV2RSTNinputTCELL84:IMUX_LSR0
Q1S_LNKMCERXACKNinputTCELL80:IMUX_A4
Q1S_LNKMCERXREQNoutputTCELL78:OUT_F4
Q1S_LNKMCETXACKNoutputTCELL81:OUT_F5
Q1S_LNKMCETXREQNinputTCELL81:IMUX_D6
Q1S_LNKRSTNinputTCELL84:IMUX_LSR1
Q1S_LNKTOUTPUTPORTENABLEoutputTCELL81:OUT_Q1
Q1S_LOOPBACK0inputTCELL80:IMUX_A7
Q1S_LOOPBACK1inputTCELL81:IMUX_D3
Q1S_LOOPBACK2inputTCELL81:IMUX_D4
Q1S_MASTERENABLEoutputTCELL84:OUT_Q2
Q1S_MGTA0inputTCELL77:IMUX_A4
Q1S_MGTA1inputTCELL77:IMUX_B4
Q1S_MGTA10inputTCELL76:IMUX_A6
Q1S_MGTA11inputTCELL77:IMUX_D2
Q1S_MGTA12inputTCELL76:IMUX_A5
Q1S_MGTA13inputTCELL77:IMUX_D4
Q1S_MGTA14inputTCELL76:IMUX_B3
Q1S_MGTA15inputTCELL76:IMUX_A4
Q1S_MGTA16inputTCELL77:IMUX_D3
Q1S_MGTA17inputTCELL76:IMUX_B4
Q1S_MGTA18inputTCELL73:IMUX_B7
Q1S_MGTA19inputTCELL78:IMUX_D7
Q1S_MGTA2inputTCELL77:IMUX_A5
Q1S_MGTA20inputTCELL78:IMUX_D3
Q1S_MGTA21inputTCELL77:IMUX_A2
Q1S_MGTA3inputTCELL77:IMUX_A3
Q1S_MGTA4inputTCELL78:IMUX_D5
Q1S_MGTA5inputTCELL78:IMUX_D4
Q1S_MGTA6inputTCELL78:IMUX_D2
Q1S_MGTA7inputTCELL77:IMUX_D5
Q1S_MGTA8inputTCELL76:IMUX_A7
Q1S_MGTA9inputTCELL77:IMUX_C4
Q1S_MGTCLKinputTCELL83:IMUX_CLK1_DELAY
Q1S_MGTCLKRSTNoutputTCELL82:OUT_Q5
Q1S_MGTDI0inputTCELL80:IMUX_B5
Q1S_MGTDI1inputTCELL80:IMUX_B6
Q1S_MGTDI10inputTCELL79:IMUX_C2
Q1S_MGTDI11inputTCELL79:IMUX_B5
Q1S_MGTDI12inputTCELL79:IMUX_A6
Q1S_MGTDI13inputTCELL80:IMUX_B4
Q1S_MGTDI14inputTCELL79:IMUX_A2
Q1S_MGTDI15inputTCELL78:IMUX_A6
Q1S_MGTDI16inputTCELL80:IMUX_D6
Q1S_MGTDI17inputTCELL80:IMUX_D4
Q1S_MGTDI18inputTCELL79:IMUX_A7
Q1S_MGTDI19inputTCELL79:IMUX_B4
Q1S_MGTDI2inputTCELL80:IMUX_B3
Q1S_MGTDI20inputTCELL79:IMUX_B3
Q1S_MGTDI21inputTCELL79:IMUX_C6
Q1S_MGTDI22inputTCELL79:IMUX_B2
Q1S_MGTDI23inputTCELL79:IMUX_C7
Q1S_MGTDI24inputTCELL78:IMUX_B2
Q1S_MGTDI25inputTCELL78:IMUX_B3
Q1S_MGTDI26inputTCELL79:IMUX_D4
Q1S_MGTDI27inputTCELL78:IMUX_A7
Q1S_MGTDI28inputTCELL78:IMUX_B5
Q1S_MGTDI29inputTCELL78:IMUX_B4
Q1S_MGTDI3inputTCELL79:IMUX_C5
Q1S_MGTDI30inputTCELL78:IMUX_B7
Q1S_MGTDI31inputTCELL78:IMUX_B6
Q1S_MGTDI4inputTCELL79:IMUX_C4
Q1S_MGTDI5inputTCELL79:IMUX_D6
Q1S_MGTDI6inputTCELL79:IMUX_C3
Q1S_MGTDI7inputTCELL78:IMUX_A3
Q1S_MGTDI8inputTCELL80:IMUX_B7
Q1S_MGTDI9inputTCELL80:IMUX_A2
Q1S_MGTRDNinputTCELL78:IMUX_C6
Q1S_MGTRSTNinputTCELL83:IMUX_LSR0
Q1S_MGTWRN0inputTCELL78:IMUX_C5
Q1S_MGTWRN1inputTCELL78:IMUX_C4
Q1S_MGTWRN2inputTCELL78:IMUX_D6
Q1S_MGTWRN3inputTCELL77:IMUX_B5
Q1S_OLLMEFPTR0inputTCELL79:IMUX_D7
Q1S_OLLMEFPTR1inputTCELL80:IMUX_D7
Q1S_OLLMEFPTR10inputTCELL79:IMUX_A3
Q1S_OLLMEFPTR11inputTCELL80:IMUX_C7
Q1S_OLLMEFPTR12inputTCELL80:IMUX_B2
Q1S_OLLMEFPTR13inputTCELL80:IMUX_C4
Q1S_OLLMEFPTR14inputTCELL80:IMUX_C3
Q1S_OLLMEFPTR15inputTCELL79:IMUX_A5
Q1S_OLLMEFPTR2inputTCELL80:IMUX_D5
Q1S_OLLMEFPTR3inputTCELL80:IMUX_C5
Q1S_OLLMEFPTR4inputTCELL80:IMUX_C2
Q1S_OLLMEFPTR5inputTCELL80:IMUX_D2
Q1S_OLLMEFPTR6inputTCELL79:IMUX_B7
Q1S_OLLMEFPTR7inputTCELL79:IMUX_B6
Q1S_OLLMEFPTR8inputTCELL80:IMUX_D3
Q1S_OLLMEFPTR9inputTCELL80:IMUX_C6
Q1S_OLLMMGTDI0outputTCELL76:OUT_Q4
Q1S_OLLMMGTDI1outputTCELL78:OUT_Q2
Q1S_OLLMMGTDI10outputTCELL77:OUT_F0
Q1S_OLLMMGTDI11outputTCELL78:OUT_Q7
Q1S_OLLMMGTDI12outputTCELL76:OUT_Q3
Q1S_OLLMMGTDI13outputTCELL76:OUT_Q0
Q1S_OLLMMGTDI14outputTCELL77:OUT_Q3
Q1S_OLLMMGTDI15outputTCELL76:OUT_F3
Q1S_OLLMMGTDI16outputTCELL75:OUT_F5
Q1S_OLLMMGTDI17outputTCELL78:OUT_Q5
Q1S_OLLMMGTDI18outputTCELL77:OUT_Q1
Q1S_OLLMMGTDI19outputTCELL77:OUT_Q0
Q1S_OLLMMGTDI2outputTCELL77:OUT_Q2
Q1S_OLLMMGTDI20outputTCELL76:OUT_F7
Q1S_OLLMMGTDI21outputTCELL75:OUT_F7
Q1S_OLLMMGTDI22outputTCELL76:OUT_Q6
Q1S_OLLMMGTDI23outputTCELL76:OUT_F0
Q1S_OLLMMGTDI24outputTCELL76:OUT_F6
Q1S_OLLMMGTDI25outputTCELL76:OUT_F5
Q1S_OLLMMGTDI26outputTCELL78:OUT_Q0
Q1S_OLLMMGTDI27outputTCELL77:OUT_F1
Q1S_OLLMMGTDI28outputTCELL78:OUT_Q1
Q1S_OLLMMGTDI29outputTCELL75:OUT_F6
Q1S_OLLMMGTDI3outputTCELL76:OUT_Q2
Q1S_OLLMMGTDI30outputTCELL76:OUT_F4
Q1S_OLLMMGTDI31outputTCELL77:OUT_F2
Q1S_OLLMMGTDI4outputTCELL77:OUT_F3
Q1S_OLLMMGTDI5outputTCELL76:OUT_Q1
Q1S_OLLMMGTDI6outputTCELL76:OUT_Q7
Q1S_OLLMMGTDI7outputTCELL76:OUT_F2
Q1S_OLLMMGTDI8outputTCELL78:OUT_F5
Q1S_OLLMMGTDI9outputTCELL78:OUT_F3
Q1S_OLLMMGTINTNoutputTCELL76:OUT_F1
Q1S_OLLMMGTRDYNoutputTCELL78:OUT_Q6
Q1S_OUTPUTUNRECOVERREVENTACKNinputTCELL80:IMUX_A3
Q1S_OUTPUTUNRECOVERREVENTREQNoutputTCELL79:OUT_Q5
Q1S_PHYCLKinputTCELL82:IMUX_CLK0_DELAY
Q1S_PHYEMEVENTACKNinputTCELL80:IMUX_A6
Q1S_PHYEMEVENTREQNoutputTCELL78:OUT_F7
Q1S_PHYMSTBinputTCELL80:IMUX_A5
Q1S_PHYRINITNinputTCELL78:IMUX_C7
Q1S_PHYRSTNinputTCELL81:IMUX_LSR1
Q1S_PHYTINITNinputTCELL78:IMUX_C3
Q1S_PHYUSTBinputTCELL78:IMUX_A4
Q1S_PORTDISABLEoutputTCELL84:OUT_Q7
Q1S_PORTNERRORDETECT0outputTCELL89:OUT_F3
Q1S_PORTNERRORDETECT1outputTCELL89:OUT_F2
Q1S_PORTNERRORDETECT10outputTCELL79:OUT_Q1
Q1S_PORTNERRORDETECT11outputTCELL79:OUT_F4
Q1S_PORTNERRORDETECT12outputTCELL80:OUT_Q0
Q1S_PORTNERRORDETECT13outputTCELL80:OUT_F4
Q1S_PORTNERRORDETECT14outputTCELL80:OUT_F7
Q1S_PORTNERRORDETECT15outputTCELL89:OUT_Q1
Q1S_PORTNERRORDETECT16outputTCELL89:OUT_Q4
Q1S_PORTNERRORDETECT17outputTCELL89:OUT_Q0
Q1S_PORTNERRORDETECT18outputTCELL84:OUT_F6
Q1S_PORTNERRORDETECT19outputTCELL84:OUT_F7
Q1S_PORTNERRORDETECT2outputTCELL89:OUT_F1
Q1S_PORTNERRORDETECT20outputTCELL84:OUT_F4
Q1S_PORTNERRORDETECT21outputTCELL84:OUT_F5
Q1S_PORTNERRORDETECT22outputTCELL89:OUT_Q5
Q1S_PORTNERRORDETECT23outputTCELL84:OUT_F1
Q1S_PORTNERRORDETECT24outputTCELL84:OUT_F2
Q1S_PORTNERRORDETECT25outputTCELL84:OUT_F3
Q1S_PORTNERRORDETECT26outputTCELL79:OUT_Q4
Q1S_PORTNERRORDETECT27outputTCELL79:OUT_F2
Q1S_PORTNERRORDETECT28outputTCELL79:OUT_Q0
Q1S_PORTNERRORDETECT29outputTCELL79:OUT_Q3
Q1S_PORTNERRORDETECT3outputTCELL89:OUT_F0
Q1S_PORTNERRORDETECT30outputTCELL79:OUT_Q2
Q1S_PORTNERRORDETECT31outputTCELL79:OUT_Q6
Q1S_PORTNERRORDETECT4outputTCELL89:OUT_Q6
Q1S_PORTNERRORDETECT5outputTCELL89:OUT_Q3
Q1S_PORTNERRORDETECT6outputTCELL89:OUT_Q7
Q1S_PORTNERRORDETECT7outputTCELL89:OUT_Q2
Q1S_PORTNERRORDETECT8outputTCELL80:OUT_Q7
Q1S_PORTNERRORDETECT9outputTCELL79:OUT_F7
Q1S_RCVCLKSEL0inputTCELL81:IMUX_C3
Q1S_RCVCLKSEL1inputTCELL78:IMUX_A5
Q1S_RCVCLKSEL2inputTCELL81:IMUX_C4
Q1S_RCVCLKSEL3inputTCELL78:IMUX_C2
Q1S_RECOVERRSTNinputTCELL73:IMUX_B2
Q1S_RESPTIMEOUT0outputTCELL78:OUT_F6
Q1S_RESPTIMEOUT1outputTCELL79:OUT_Q7
Q1S_RESPTIMEOUT10outputTCELL81:OUT_Q4
Q1S_RESPTIMEOUT11outputTCELL81:OUT_Q6
Q1S_RESPTIMEOUT12outputTCELL81:OUT_Q7
Q1S_RESPTIMEOUT13outputTCELL81:OUT_Q5
Q1S_RESPTIMEOUT14outputTCELL81:OUT_Q3
Q1S_RESPTIMEOUT15outputTCELL81:OUT_Q0
Q1S_RESPTIMEOUT16outputTCELL80:OUT_F3
Q1S_RESPTIMEOUT17outputTCELL79:OUT_F3
Q1S_RESPTIMEOUT18outputTCELL80:OUT_Q3
Q1S_RESPTIMEOUT19outputTCELL80:OUT_Q2
Q1S_RESPTIMEOUT2outputTCELL79:OUT_F5
Q1S_RESPTIMEOUT20outputTCELL80:OUT_Q1
Q1S_RESPTIMEOUT21outputTCELL79:OUT_F6
Q1S_RESPTIMEOUT22outputTCELL79:OUT_F1
Q1S_RESPTIMEOUT23outputTCELL79:OUT_F0
Q1S_RESPTIMEOUT3outputTCELL80:OUT_Q5
Q1S_RESPTIMEOUT4outputTCELL80:OUT_F5
Q1S_RESPTIMEOUT5outputTCELL80:OUT_F1
Q1S_RESPTIMEOUT6outputTCELL80:OUT_F0
Q1S_RESPTIMEOUT7outputTCELL80:OUT_Q6
Q1S_RESPTIMEOUT8outputTCELL80:OUT_F6
Q1S_RESPTIMEOUT9outputTCELL81:OUT_Q2
Q1S_RIOCLKinputTCELL83:IMUX_CLK0_DELAY
Q1S_RIORSTNinputTCELL83:IMUX_LSR1
Q1S_RLNKBEATS0outputTCELL90:OUT_F4
Q1S_RLNKBEATS1outputTCELL90:OUT_F3
Q1S_RLNKBEATS2outputTCELL90:OUT_F2
Q1S_RLNKBEATS3outputTCELL90:OUT_F1
Q1S_RLNKBEATS4outputTCELL90:OUT_F0
Q1S_RLNKBEATS5outputTCELL90:OUT_Q7
Q1S_RLNKBEATS6outputTCELL90:OUT_Q6
Q1S_RLNKBEATS7outputTCELL90:OUT_Q5
Q1S_RLNKD0outputTCELL95:OUT_Q2
Q1S_RLNKD1outputTCELL95:OUT_Q1
Q1S_RLNKD10outputTCELL94:OUT_F0
Q1S_RLNKD11outputTCELL94:OUT_Q5
Q1S_RLNKD12outputTCELL94:OUT_Q4
Q1S_RLNKD13outputTCELL94:OUT_Q3
Q1S_RLNKD14outputTCELL94:OUT_Q2
Q1S_RLNKD15outputTCELL94:OUT_Q0
Q1S_RLNKD16outputTCELL93:OUT_F7
Q1S_RLNKD17outputTCELL93:OUT_F6
Q1S_RLNKD18outputTCELL93:OUT_F5
Q1S_RLNKD19outputTCELL93:OUT_F4
Q1S_RLNKD2outputTCELL95:OUT_Q0
Q1S_RLNKD20outputTCELL93:OUT_F3
Q1S_RLNKD21outputTCELL93:OUT_F2
Q1S_RLNKD22outputTCELL93:OUT_F1
Q1S_RLNKD23outputTCELL93:OUT_F0
Q1S_RLNKD24outputTCELL93:OUT_Q7
Q1S_RLNKD25outputTCELL93:OUT_Q6
Q1S_RLNKD26outputTCELL93:OUT_Q5
Q1S_RLNKD27outputTCELL93:OUT_Q4
Q1S_RLNKD28outputTCELL93:OUT_Q3
Q1S_RLNKD29outputTCELL93:OUT_Q2
Q1S_RLNKD3outputTCELL94:OUT_Q7
Q1S_RLNKD30outputTCELL93:OUT_Q1
Q1S_RLNKD31outputTCELL92:OUT_F6
Q1S_RLNKD32outputTCELL92:OUT_F5
Q1S_RLNKD33outputTCELL92:OUT_F4
Q1S_RLNKD34outputTCELL92:OUT_F3
Q1S_RLNKD35outputTCELL92:OUT_F2
Q1S_RLNKD36outputTCELL92:OUT_F1
Q1S_RLNKD37outputTCELL92:OUT_F0
Q1S_RLNKD38outputTCELL92:OUT_Q7
Q1S_RLNKD39outputTCELL92:OUT_Q6
Q1S_RLNKD4outputTCELL94:OUT_Q6
Q1S_RLNKD40outputTCELL92:OUT_Q5
Q1S_RLNKD41outputTCELL92:OUT_Q4
Q1S_RLNKD42outputTCELL92:OUT_Q3
Q1S_RLNKD43outputTCELL92:OUT_Q2
Q1S_RLNKD44outputTCELL92:OUT_Q1
Q1S_RLNKD45outputTCELL92:OUT_Q0
Q1S_RLNKD46outputTCELL91:OUT_F7
Q1S_RLNKD47outputTCELL91:OUT_F6
Q1S_RLNKD48outputTCELL91:OUT_F5
Q1S_RLNKD49outputTCELL91:OUT_F4
Q1S_RLNKD5outputTCELL94:OUT_F5
Q1S_RLNKD50outputTCELL91:OUT_F3
Q1S_RLNKD51outputTCELL91:OUT_F2
Q1S_RLNKD52outputTCELL91:OUT_F1
Q1S_RLNKD53outputTCELL91:OUT_F0
Q1S_RLNKD54outputTCELL91:OUT_Q7
Q1S_RLNKD55outputTCELL91:OUT_Q5
Q1S_RLNKD56outputTCELL91:OUT_Q4
Q1S_RLNKD57outputTCELL91:OUT_Q3
Q1S_RLNKD58outputTCELL91:OUT_Q2
Q1S_RLNKD59outputTCELL91:OUT_Q1
Q1S_RLNKD6outputTCELL94:OUT_F4
Q1S_RLNKD60outputTCELL91:OUT_Q0
Q1S_RLNKD61outputTCELL90:OUT_F7
Q1S_RLNKD62outputTCELL90:OUT_F6
Q1S_RLNKD63outputTCELL90:OUT_F5
Q1S_RLNKD7outputTCELL94:OUT_F3
Q1S_RLNKD8outputTCELL94:OUT_F2
Q1S_RLNKD9outputTCELL94:OUT_F1
Q1S_RLNKDSTDSCNinputTCELL84:IMUX_D6
Q1S_RLNKDSTRDYNinputTCELL83:IMUX_A7
Q1S_RLNKEOFNoutputTCELL95:OUT_F1
Q1S_RLNKREM0outputTCELL95:OUT_Q5
Q1S_RLNKREM1outputTCELL95:OUT_Q4
Q1S_RLNKREM2outputTCELL95:OUT_Q3
Q1S_RLNKSOFNoutputTCELL95:OUT_F2
Q1S_RLNKSRCRDYNoutputTCELL95:OUT_F3
Q1S_RXINITNoutputTCELL83:OUT_F6
Q1S_RXPFORCERETRYNinputTCELL73:IMUX_B3
Q1S_RXSYNCCTRL0inputTCELL81:IMUX_D5
Q1S_RXSYNCCTRL1inputTCELL81:IMUX_D2
Q1S_SOFTRSTNinputTCELL82:IMUX_LSR0
Q1S_STATUS0outputTCELL83:OUT_F1
Q1S_STATUS1outputTCELL83:OUT_Q0
Q1S_STATUS10outputTCELL76:OUT_Q5
Q1S_STATUS11outputTCELL75:OUT_F4
Q1S_STATUS12outputTCELL82:OUT_F5
Q1S_STATUS13outputTCELL84:OUT_Q4
Q1S_STATUS14outputTCELL81:OUT_F0
Q1S_STATUS15outputTCELL94:OUT_F6
Q1S_STATUS16outputTCELL80:OUT_F2
Q1S_STATUS17outputTCELL77:OUT_F5
Q1S_STATUS18outputTCELL83:OUT_Q7
Q1S_STATUS19outputTCELL83:OUT_F3
Q1S_STATUS2outputTCELL83:OUT_Q4
Q1S_STATUS20outputTCELL78:OUT_F0
Q1S_STATUS21outputTCELL84:OUT_F0
Q1S_STATUS3outputTCELL82:OUT_F4
Q1S_STATUS4outputTCELL83:OUT_Q2
Q1S_STATUS5outputTCELL83:OUT_F0
Q1S_STATUS6outputTCELL82:OUT_F2
Q1S_STATUS7outputTCELL83:OUT_F2
Q1S_STATUS8outputTCELL82:OUT_F3
Q1S_STATUS9outputTCELL93:OUT_Q0
Q1S_SYSRSTINinputTCELL82:IMUX_LSR1
Q1S_SYSRSTONoutputTCELL80:OUT_Q4
Q1S_TIMBISTBANKSEL0inputTCELL72:IMUX_D6
Q1S_TIMBISTBANKSEL1inputTCELL72:IMUX_C5
Q1S_TIMBISTBANKSEL2inputTCELL72:IMUX_C2
Q1S_TIMBISTBANKSEL3inputTCELL72:IMUX_D7
Q1S_TIMBISTMODEinputTCELL72:IMUX_B5
Q1S_TIMBISTRA0inputTCELL72:IMUX_C3
Q1S_TIMBISTRA1inputTCELL72:IMUX_C4
Q1S_TIMBISTRA2inputTCELL72:IMUX_D4
Q1S_TIMBISTRA3inputTCELL72:IMUX_D3
Q1S_TIMBISTRA4inputTCELL71:IMUX_A5
Q1S_TIMBISTRA5inputTCELL71:IMUX_A2
Q1S_TIMBISTRA6inputTCELL71:IMUX_B4
Q1S_TIMBISTRA7inputTCELL71:IMUX_C5
Q1S_TIMBISTREinputTCELL72:IMUX_B2
Q1S_TIMBISTSDI0inputTCELL71:IMUX_D3
Q1S_TIMBISTSDI1inputTCELL70:IMUX_A5
Q1S_TIMBISTSDI10inputTCELL71:IMUX_D5
Q1S_TIMBISTSDI11inputTCELL71:IMUX_B5
Q1S_TIMBISTSDI12inputTCELL71:IMUX_A3
Q1S_TIMBISTSDI13inputTCELL72:IMUX_D5
Q1S_TIMBISTSDI14inputTCELL72:IMUX_C6
Q1S_TIMBISTSDI15inputTCELL72:IMUX_C7
Q1S_TIMBISTSDI16inputTCELL72:IMUX_B4
Q1S_TIMBISTSDI17inputTCELL72:IMUX_A3
Q1S_TIMBISTSDI18inputTCELL73:IMUX_D2
Q1S_TIMBISTSDI19inputTCELL73:IMUX_D3
Q1S_TIMBISTSDI2inputTCELL70:IMUX_A3
Q1S_TIMBISTSDI20inputTCELL73:IMUX_D5
Q1S_TIMBISTSDI21inputTCELL73:IMUX_D6
Q1S_TIMBISTSDI22inputTCELL73:IMUX_C2
Q1S_TIMBISTSDI23inputTCELL73:IMUX_C3
Q1S_TIMBISTSDI24inputTCELL73:IMUX_C4
Q1S_TIMBISTSDI25inputTCELL73:IMUX_C6
Q1S_TIMBISTSDI26inputTCELL73:IMUX_C7
Q1S_TIMBISTSDI27inputTCELL73:IMUX_C5
Q1S_TIMBISTSDI28inputTCELL73:IMUX_D7
Q1S_TIMBISTSDI29inputTCELL73:IMUX_D4
Q1S_TIMBISTSDI3inputTCELL70:IMUX_B5
Q1S_TIMBISTSDI30inputTCELL72:IMUX_A7
Q1S_TIMBISTSDI31inputTCELL72:IMUX_A6
Q1S_TIMBISTSDI32inputTCELL72:IMUX_A4
Q1S_TIMBISTSDI33inputTCELL72:IMUX_A2
Q1S_TIMBISTSDI34inputTCELL72:IMUX_B7
Q1S_TIMBISTSDI35inputTCELL72:IMUX_B6
Q1S_TIMBISTSDI4inputTCELL70:IMUX_B2
Q1S_TIMBISTSDI5inputTCELL70:IMUX_D2
Q1S_TIMBISTSDI6inputTCELL69:IMUX_A7
Q1S_TIMBISTSDI7inputTCELL70:IMUX_C3
Q1S_TIMBISTSDI8inputTCELL70:IMUX_A6
Q1S_TIMBISTSDI9inputTCELL70:IMUX_A7
Q1S_TIMBISTWA0inputTCELL71:IMUX_C4
Q1S_TIMBISTWA1inputTCELL71:IMUX_C2
Q1S_TIMBISTWA2inputTCELL71:IMUX_C3
Q1S_TIMBISTWA3inputTCELL71:IMUX_B3
Q1S_TIMBISTWA4inputTCELL71:IMUX_D4
Q1S_TIMBISTWA5inputTCELL71:IMUX_B2
Q1S_TIMBISTWA6inputTCELL71:IMUX_A4
Q1S_TIMBISTWA7inputTCELL72:IMUX_D2
Q1S_TIMBISTWEinputTCELL72:IMUX_B3
Q1S_TISCANCLKinputTCELL82:IMUX_CLK1_DELAY
Q1S_TISCANENAinputTCELL81:IMUX_LSR0
Q1S_TISCANI0inputTCELL77:IMUX_CE2
Q1S_TISCANI1inputTCELL84:IMUX_CE2
Q1S_TISCANI10inputTCELL78:IMUX_CE1
Q1S_TISCANI11inputTCELL79:IMUX_CE1
Q1S_TISCANI12inputTCELL79:IMUX_CE0
Q1S_TISCANI13inputTCELL78:IMUX_CE2
Q1S_TISCANI14inputTCELL82:IMUX_CE1
Q1S_TISCANI15inputTCELL84:IMUX_CE3
Q1S_TISCANI16inputTCELL84:IMUX_CE1
Q1S_TISCANI17inputTCELL82:IMUX_CE2
Q1S_TISCANI18inputTCELL83:IMUX_CE2
Q1S_TISCANI19inputTCELL84:IMUX_CE0
Q1S_TISCANI2inputTCELL77:IMUX_CE1
Q1S_TISCANI20inputTCELL82:IMUX_CE0
Q1S_TISCANI21inputTCELL79:IMUX_CE3
Q1S_TISCANI22inputTCELL81:IMUX_CE3
Q1S_TISCANI23inputTCELL80:IMUX_CE0
Q1S_TISCANI24inputTCELL81:IMUX_CE2
Q1S_TISCANI25inputTCELL80:IMUX_CE1
Q1S_TISCANI26inputTCELL81:IMUX_CE1
Q1S_TISCANI27inputTCELL81:IMUX_CE0
Q1S_TISCANI28inputTCELL80:IMUX_CE2
Q1S_TISCANI29inputTCELL80:IMUX_CE3
Q1S_TISCANI3inputTCELL79:IMUX_CE2
Q1S_TISCANI4inputTCELL83:IMUX_CE0
Q1S_TISCANI5inputTCELL82:IMUX_CE3
Q1S_TISCANI6inputTCELL78:IMUX_CE3
Q1S_TISCANI7inputTCELL83:IMUX_CE3
Q1S_TISCANI8inputTCELL83:IMUX_CE1
Q1S_TISCANI9inputTCELL78:IMUX_CE0
Q1S_TISCANMODEinputTCELL78:IMUX_LSR1
Q1S_TISCANO0outputTCELL64:OUT_F3
Q1S_TISCANO1outputTCELL94:OUT_F7
Q1S_TISCANO10outputTCELL71:OUT_Q4
Q1S_TISCANO11outputTCELL70:OUT_Q2
Q1S_TISCANO12outputTCELL62:OUT_Q6
Q1S_TISCANO13outputTCELL58:OUT_F2
Q1S_TISCANO14outputTCELL64:OUT_Q3
Q1S_TISCANO15outputTCELL75:OUT_F1
Q1S_TISCANO16outputTCELL91:OUT_Q6
Q1S_TISCANO17outputTCELL78:OUT_F2
Q1S_TISCANO18outputTCELL84:OUT_Q3
Q1S_TISCANO19outputTCELL75:OUT_F2
Q1S_TISCANO2outputTCELL95:OUT_F4
Q1S_TISCANO20outputTCELL82:OUT_Q7
Q1S_TISCANO21outputTCELL82:OUT_F0
Q1S_TISCANO22outputTCELL82:OUT_F1
Q1S_TISCANO23outputTCELL82:OUT_F6
Q1S_TISCANO24outputTCELL83:OUT_Q3
Q1S_TISCANO25outputTCELL83:OUT_Q5
Q1S_TISCANO26outputTCELL83:OUT_Q6
Q1S_TISCANO27outputTCELL83:OUT_F5
Q1S_TISCANO28outputTCELL84:OUT_Q1
Q1S_TISCANO29outputTCELL84:OUT_Q6
Q1S_TISCANO3outputTCELL78:OUT_Q3
Q1S_TISCANO4outputTCELL78:OUT_F1
Q1S_TISCANO5outputTCELL68:OUT_Q2
Q1S_TISCANO6outputTCELL81:OUT_F2
Q1S_TISCANO7outputTCELL81:OUT_F6
Q1S_TISCANO8outputTCELL82:OUT_Q2
Q1S_TISCANO9outputTCELL58:OUT_Q6
Q1S_TISCANRSTNinputTCELL78:IMUX_LSR0
Q1S_TLNKD0inputTCELL84:IMUX_A4
Q1S_TLNKD1inputTCELL84:IMUX_C7
Q1S_TLNKD10inputTCELL84:IMUX_B2
Q1S_TLNKD11inputTCELL84:IMUX_A7
Q1S_TLNKD12inputTCELL84:IMUX_C5
Q1S_TLNKD13inputTCELL84:IMUX_D3
Q1S_TLNKD14inputTCELL83:IMUX_C6
Q1S_TLNKD15inputTCELL84:IMUX_D2
Q1S_TLNKD16inputTCELL84:IMUX_C6
Q1S_TLNKD17inputTCELL83:IMUX_A2
Q1S_TLNKD18inputTCELL84:IMUX_C3
Q1S_TLNKD19inputTCELL83:IMUX_B2
Q1S_TLNKD2inputTCELL84:IMUX_B7
Q1S_TLNKD20inputTCELL84:IMUX_C2
Q1S_TLNKD21inputTCELL83:IMUX_A6
Q1S_TLNKD22inputTCELL83:IMUX_C5
Q1S_TLNKD23inputTCELL83:IMUX_C3
Q1S_TLNKD24inputTCELL83:IMUX_C2
Q1S_TLNKD25inputTCELL83:IMUX_D7
Q1S_TLNKD26inputTCELL83:IMUX_B5
Q1S_TLNKD27inputTCELL83:IMUX_D6
Q1S_TLNKD28inputTCELL83:IMUX_C4
Q1S_TLNKD29inputTCELL83:IMUX_B7
Q1S_TLNKD3inputTCELL84:IMUX_A5
Q1S_TLNKD30inputTCELL83:IMUX_A5
Q1S_TLNKD31inputTCELL83:IMUX_B3
Q1S_TLNKD32inputTCELL83:IMUX_A4
Q1S_TLNKD33inputTCELL83:IMUX_B6
Q1S_TLNKD34inputTCELL83:IMUX_B4
Q1S_TLNKD35inputTCELL83:IMUX_D5
Q1S_TLNKD36inputTCELL83:IMUX_D4
Q1S_TLNKD37inputTCELL83:IMUX_D3
Q1S_TLNKD38inputTCELL83:IMUX_D2
Q1S_TLNKD39inputTCELL82:IMUX_A7
Q1S_TLNKD4inputTCELL84:IMUX_A6
Q1S_TLNKD40inputTCELL82:IMUX_A6
Q1S_TLNKD41inputTCELL82:IMUX_A5
Q1S_TLNKD42inputTCELL82:IMUX_A4
Q1S_TLNKD43inputTCELL82:IMUX_A3
Q1S_TLNKD44inputTCELL82:IMUX_A2
Q1S_TLNKD45inputTCELL82:IMUX_B7
Q1S_TLNKD46inputTCELL82:IMUX_B6
Q1S_TLNKD47inputTCELL82:IMUX_B5
Q1S_TLNKD48inputTCELL82:IMUX_B4
Q1S_TLNKD49inputTCELL82:IMUX_B3
Q1S_TLNKD5inputTCELL84:IMUX_D4
Q1S_TLNKD50inputTCELL82:IMUX_B2
Q1S_TLNKD51inputTCELL82:IMUX_C7
Q1S_TLNKD52inputTCELL82:IMUX_C6
Q1S_TLNKD53inputTCELL82:IMUX_C5
Q1S_TLNKD54inputTCELL82:IMUX_C4
Q1S_TLNKD55inputTCELL82:IMUX_C3
Q1S_TLNKD56inputTCELL82:IMUX_C2
Q1S_TLNKD57inputTCELL82:IMUX_D7
Q1S_TLNKD58inputTCELL82:IMUX_D6
Q1S_TLNKD59inputTCELL82:IMUX_D5
Q1S_TLNKD6inputTCELL83:IMUX_A3
Q1S_TLNKD60inputTCELL82:IMUX_D4
Q1S_TLNKD61inputTCELL82:IMUX_D3
Q1S_TLNKD62inputTCELL82:IMUX_D2
Q1S_TLNKD63inputTCELL81:IMUX_A7
Q1S_TLNKD7inputTCELL84:IMUX_B5
Q1S_TLNKD8inputTCELL84:IMUX_B4
Q1S_TLNKD9inputTCELL84:IMUX_B3
Q1S_TLNKDSTRDYNoutputTCELL95:OUT_F0
Q1S_TLNKEOFNinputTCELL84:IMUX_D5
Q1S_TLNKREM0inputTCELL84:IMUX_A3
Q1S_TLNKREM1inputTCELL84:IMUX_A2
Q1S_TLNKREM2inputTCELL83:IMUX_C7
Q1S_TLNKSOFNinputTCELL84:IMUX_D7
Q1S_TLNKSRCDSCNinputTCELL84:IMUX_C4
Q1S_TLNKSRCRDYNinputTCELL84:IMUX_B6
Q1S_TOMBISTDO0outputTCELL75:OUT_F3
Q1S_TOMBISTDO1outputTCELL69:OUT_F3
Q1S_TOMBISTDO10outputTCELL66:OUT_Q5
Q1S_TOMBISTDO11outputTCELL66:OUT_Q4
Q1S_TOMBISTDO12outputTCELL66:OUT_F2
Q1S_TOMBISTDO13outputTCELL66:OUT_F3
Q1S_TOMBISTDO14outputTCELL67:OUT_Q3
Q1S_TOMBISTDO15outputTCELL67:OUT_Q5
Q1S_TOMBISTDO16outputTCELL67:OUT_F5
Q1S_TOMBISTDO17outputTCELL68:OUT_Q0
Q1S_TOMBISTDO18outputTCELL68:OUT_Q1
Q1S_TOMBISTDO19outputTCELL68:OUT_Q5
Q1S_TOMBISTDO2outputTCELL68:OUT_Q6
Q1S_TOMBISTDO20outputTCELL68:OUT_Q4
Q1S_TOMBISTDO21outputTCELL68:OUT_F1
Q1S_TOMBISTDO22outputTCELL68:OUT_F0
Q1S_TOMBISTDO23outputTCELL68:OUT_F2
Q1S_TOMBISTDO24outputTCELL68:OUT_F5
Q1S_TOMBISTDO25outputTCELL69:OUT_Q4
Q1S_TOMBISTDO26outputTCELL73:OUT_F4
Q1S_TOMBISTDO27outputTCELL75:OUT_Q1
Q1S_TOMBISTDO28outputTCELL75:OUT_Q3
Q1S_TOMBISTDO29outputTCELL75:OUT_F0
Q1S_TOMBISTDO3outputTCELL67:OUT_F7
Q1S_TOMBISTDO30outputTCELL75:OUT_Q6
Q1S_TOMBISTDO31outputTCELL75:OUT_Q7
Q1S_TOMBISTDO32outputTCELL75:OUT_Q5
Q1S_TOMBISTDO33outputTCELL75:OUT_Q4
Q1S_TOMBISTDO34outputTCELL75:OUT_Q2
Q1S_TOMBISTDO35outputTCELL74:OUT_Q4
Q1S_TOMBISTDO4outputTCELL67:OUT_Q0
Q1S_TOMBISTDO5outputTCELL66:OUT_Q6
Q1S_TOMBISTDO6outputTCELL65:OUT_F3
Q1S_TOMBISTDO7outputTCELL65:OUT_Q1
Q1S_TOMBISTDO8outputTCELL64:OUT_F6
Q1S_TOMBISTDO9outputTCELL65:OUT_F4
Q1S_TPORTCHARISK0inputTCELL77:IMUX_C2
Q1S_TPORTCHARISK1inputTCELL76:IMUX_A2
Q1S_TPORTCHARISK2inputTCELL76:IMUX_A3
Q1S_TPORTCHARISK3inputTCELL77:IMUX_C5
Q1S_TPORTCHARISK4inputTCELL76:IMUX_B6
Q1S_TPORTCHARISK5inputTCELL77:IMUX_B2
Q1S_TPORTCHARISK6inputTCELL77:IMUX_C3
Q1S_TPORTCHARISK7inputTCELL77:IMUX_B3
Q1S_TPORTENABLENinputTCELL81:IMUX_C5
Q1S_TPORTTDI0inputTCELL74:IMUX_D4
Q1S_TPORTTDI1inputTCELL75:IMUX_B5
Q1S_TPORTTDI10inputTCELL73:IMUX_A4
Q1S_TPORTTDI11inputTCELL74:IMUX_D5
Q1S_TPORTTDI12inputTCELL73:IMUX_A5
Q1S_TPORTTDI13inputTCELL76:IMUX_C2
Q1S_TPORTTDI14inputTCELL76:IMUX_D2
Q1S_TPORTTDI15inputTCELL76:IMUX_B7
Q1S_TPORTTDI16inputTCELL74:IMUX_D6
Q1S_TPORTTDI17inputTCELL75:IMUX_B4
Q1S_TPORTTDI18inputTCELL73:IMUX_A2
Q1S_TPORTTDI19inputTCELL73:IMUX_B4
Q1S_TPORTTDI2inputTCELL73:IMUX_A6
Q1S_TPORTTDI20inputTCELL73:IMUX_B6
Q1S_TPORTTDI21inputTCELL75:IMUX_A3
Q1S_TPORTTDI22inputTCELL76:IMUX_C5
Q1S_TPORTTDI23inputTCELL75:IMUX_A7
Q1S_TPORTTDI24inputTCELL74:IMUX_B4
Q1S_TPORTTDI25inputTCELL75:IMUX_B6
Q1S_TPORTTDI26inputTCELL74:IMUX_A6
Q1S_TPORTTDI27inputTCELL74:IMUX_B7
Q1S_TPORTTDI28inputTCELL74:IMUX_C5
Q1S_TPORTTDI29inputTCELL75:IMUX_C4
Q1S_TPORTTDI3inputTCELL73:IMUX_A3
Q1S_TPORTTDI30inputTCELL75:IMUX_A4
Q1S_TPORTTDI31inputTCELL76:IMUX_B2
Q1S_TPORTTDI32inputTCELL76:IMUX_D6
Q1S_TPORTTDI33inputTCELL75:IMUX_A6
Q1S_TPORTTDI34inputTCELL75:IMUX_D6
Q1S_TPORTTDI35inputTCELL74:IMUX_B6
Q1S_TPORTTDI36inputTCELL74:IMUX_A5
Q1S_TPORTTDI37inputTCELL76:IMUX_D4
Q1S_TPORTTDI38inputTCELL76:IMUX_C6
Q1S_TPORTTDI39inputTCELL76:IMUX_C4
Q1S_TPORTTDI4inputTCELL73:IMUX_A7
Q1S_TPORTTDI40inputTCELL75:IMUX_D3
Q1S_TPORTTDI41inputTCELL76:IMUX_D5
Q1S_TPORTTDI42inputTCELL74:IMUX_A4
Q1S_TPORTTDI43inputTCELL74:IMUX_C6
Q1S_TPORTTDI44inputTCELL75:IMUX_D7
Q1S_TPORTTDI45inputTCELL75:IMUX_A2
Q1S_TPORTTDI46inputTCELL75:IMUX_B2
Q1S_TPORTTDI47inputTCELL75:IMUX_B3
Q1S_TPORTTDI48inputTCELL74:IMUX_D7
Q1S_TPORTTDI49inputTCELL74:IMUX_C7
Q1S_TPORTTDI5inputTCELL75:IMUX_A5
Q1S_TPORTTDI50inputTCELL73:IMUX_B5
Q1S_TPORTTDI51inputTCELL75:IMUX_D2
Q1S_TPORTTDI52inputTCELL74:IMUX_C4
Q1S_TPORTTDI53inputTCELL76:IMUX_B5
Q1S_TPORTTDI54inputTCELL75:IMUX_C5
Q1S_TPORTTDI55inputTCELL75:IMUX_C2
Q1S_TPORTTDI56inputTCELL75:IMUX_D4
Q1S_TPORTTDI57inputTCELL75:IMUX_C7
Q1S_TPORTTDI58inputTCELL74:IMUX_A7
Q1S_TPORTTDI59inputTCELL74:IMUX_B5
Q1S_TPORTTDI6inputTCELL76:IMUX_D3
Q1S_TPORTTDI60inputTCELL75:IMUX_C3
Q1S_TPORTTDI61inputTCELL75:IMUX_C6
Q1S_TPORTTDI62inputTCELL75:IMUX_B7
Q1S_TPORTTDI63inputTCELL76:IMUX_C3
Q1S_TPORTTDI7inputTCELL76:IMUX_D7
Q1S_TPORTTDI8inputTCELL75:IMUX_D5
Q1S_TPORTTDI9inputTCELL76:IMUX_C7
Q1S_TXENQUEUEFLOWN0outputTCELL82:OUT_Q6
Q1S_TXENQUEUEFLOWN1outputTCELL82:OUT_Q4
Q1S_TXENQUEUEFLOWN2outputTCELL82:OUT_Q0
Q1S_TXENQUEUEFLOWN3outputTCELL82:OUT_Q1
Q1S_TXFLOWCTRLSTATE0outputTCELL82:OUT_F7
Q1S_TXFLOWCTRLSTATE1outputTCELL83:OUT_Q1
Q1S_TXFLOWCTRLSTATE2outputTCELL84:OUT_Q0
Q1S_TXFLOWCTRLSTATE3outputTCELL83:OUT_F4
Q1S_TXFLOWCTRLSTATE4outputTCELL84:OUT_Q5
Q1S_TXINITNoutputTCELL83:OUT_F7
Q1S_TXLANESILENCECH0outputTCELL78:OUT_Q4
Q1S_TXLANESILENCECH1outputTCELL77:OUT_Q4
Q1S_TXLANESILENCECH2outputTCELL77:OUT_F4
Q1S_TXLANESILENCECH3outputTCELL77:OUT_Q5
Q1S_TXSYNCCTRL0inputTCELL81:IMUX_C2
Q1S_TXSYNCCTRL1inputTCELL81:IMUX_D7
Q1S_WM00inputTCELL81:IMUX_B4
Q1S_WM01inputTCELL81:IMUX_B5
Q1S_WM02inputTCELL81:IMUX_C7
Q1S_WM03inputTCELL81:IMUX_A3
Q1S_WM10inputTCELL81:IMUX_B3
Q1S_WM11inputTCELL81:IMUX_A2
Q1S_WM12inputTCELL81:IMUX_B6
Q1S_WM13inputTCELL81:IMUX_B2
Q1S_WM20inputTCELL81:IMUX_C6
Q1S_WM21inputTCELL81:IMUX_A5
Q1S_WM22inputTCELL81:IMUX_A4
Q1S_WM23inputTCELL81:IMUX_B7
Q1_FCDFECOEFF0_0inputTCELL111:IMUX_A5
Q1_FCDFECOEFF0_1inputTCELL111:IMUX_A6
Q1_FCDFECOEFF0_2inputTCELL111:IMUX_A7
Q1_FCDFECOEFF0_3inputTCELL112:IMUX_D2
Q1_FCDFECOEFF0_4inputTCELL112:IMUX_D3
Q1_FCDFECOEFF0_5inputTCELL112:IMUX_D4
Q1_FCDFECOEFF0_6inputTCELL112:IMUX_D5
Q1_FCDFECOEFF0_7inputTCELL112:IMUX_D6
Q1_FCDFECOEFF1_0inputTCELL111:IMUX_B3
Q1_FCDFECOEFF1_1inputTCELL111:IMUX_B4
Q1_FCDFECOEFF1_2inputTCELL111:IMUX_B5
Q1_FCDFECOEFF1_3inputTCELL111:IMUX_B6
Q1_FCDFECOEFF1_4inputTCELL111:IMUX_B7
Q1_FCDFECOEFF1_5inputTCELL111:IMUX_A2
Q1_FCDFECOEFF1_6inputTCELL111:IMUX_A3
Q1_FCDFECOEFF1_7inputTCELL111:IMUX_A4
Q1_FCDFECOEFF2_0inputTCELL111:IMUX_D7
Q1_FCDFECOEFF2_1inputTCELL111:IMUX_C2
Q1_FCDFECOEFF2_2inputTCELL111:IMUX_C3
Q1_FCDFECOEFF2_3inputTCELL111:IMUX_C4
Q1_FCDFECOEFF2_4inputTCELL111:IMUX_C5
Q1_FCDFECOEFF2_5inputTCELL111:IMUX_C6
Q1_FCDFECOEFF2_6inputTCELL111:IMUX_C7
Q1_FCDFECOEFF2_7inputTCELL111:IMUX_B2
Q1_FCDFECOEFF3_0inputTCELL110:IMUX_A5
Q1_FCDFECOEFF3_1inputTCELL110:IMUX_A6
Q1_FCDFECOEFF3_2inputTCELL110:IMUX_A7
Q1_FCDFECOEFF3_3inputTCELL111:IMUX_D2
Q1_FCDFECOEFF3_4inputTCELL111:IMUX_D3
Q1_FCDFECOEFF3_5inputTCELL111:IMUX_D4
Q1_FCDFECOEFF3_6inputTCELL111:IMUX_D5
Q1_FCDFECOEFF3_7inputTCELL111:IMUX_D6
Q1_FCDFECOEFF4_0inputTCELL110:IMUX_B3
Q1_FCDFECOEFF4_1inputTCELL110:IMUX_B4
Q1_FCDFECOEFF4_2inputTCELL110:IMUX_B5
Q1_FCDFECOEFF4_3inputTCELL110:IMUX_B6
Q1_FCDFECOEFF4_4inputTCELL110:IMUX_B7
Q1_FCDFECOEFF4_5inputTCELL110:IMUX_A2
Q1_FCDFECOEFF4_6inputTCELL110:IMUX_A3
Q1_FCDFECOEFF4_7inputTCELL110:IMUX_A4
Q1_FCDFECOEFF5_0inputTCELL110:IMUX_D7
Q1_FCDFECOEFF5_1inputTCELL110:IMUX_C2
Q1_FCDFECOEFF5_2inputTCELL110:IMUX_C3
Q1_FCDFECOEFF5_3inputTCELL110:IMUX_C4
Q1_FCDFECOEFF5_4inputTCELL110:IMUX_C5
Q1_FCDFECOEFF5_5inputTCELL110:IMUX_C6
Q1_FCDFECOEFF5_6inputTCELL110:IMUX_C7
Q1_FCDFECOEFF5_7inputTCELL110:IMUX_B2
Q1_FCDFESIGN1inputTCELL110:IMUX_D2
Q1_FCDFESIGN2inputTCELL110:IMUX_D3
Q1_FCDFESIGN3inputTCELL110:IMUX_D4
Q1_FCDFESIGN4inputTCELL110:IMUX_D5
Q1_FCDFESIGN5inputTCELL110:IMUX_D6
Q1_FCMPWRUPinputTCELL112:IMUX_A6
Q1_FCMRSTinputTCELL113:IMUX_C5
Q1_FCSCANMODEinputTCELL112:IMUX_C3
Q1_FDDFECHSEL0inputTCELL112:IMUX_D7
Q1_FDDFECHSEL1inputTCELL112:IMUX_C2
Q1_FDDFEDATA0outputTCELL108:OUT_F7
Q1_FDDFEDATA1outputTCELL109:OUT_Q0
Q1_FDDFEDATA2outputTCELL109:OUT_Q1
Q1_FDDFEDATA3outputTCELL109:OUT_Q2
Q1_FDDFEDATA4outputTCELL109:OUT_Q3
Q1_FDDFEDATA5outputTCELL109:OUT_Q4
Q1_FDDFEDATA6outputTCELL109:OUT_Q5
Q1_FDDFEDATA7outputTCELL109:OUT_Q6
Q1_FDDFEDATA8outputTCELL109:OUT_Q7
Q1_FDDFEDATA9outputTCELL109:OUT_F0
Q1_FDDFEERR0outputTCELL108:OUT_Q5
Q1_FDDFEERR1outputTCELL108:OUT_Q6
Q1_FDDFEERR2outputTCELL108:OUT_Q7
Q1_FDDFEERR3outputTCELL108:OUT_F0
Q1_FDDFEERR4outputTCELL108:OUT_F1
Q1_FDDFEERR5outputTCELL108:OUT_F2
Q1_FDDFEERR6outputTCELL108:OUT_F3
Q1_FDDFEERR7outputTCELL108:OUT_F4
Q1_FDDFEERR8outputTCELL108:OUT_F5
Q1_FDDFEERR9outputTCELL108:OUT_F6
Q1_FIGRPFBRRCLK0inputTCELL99:IMUX_CLK1_DELAY
Q1_FIGRPFBRRCLK1inputTCELL99:IMUX_CLK0_DELAY
Q1_FIGRPFBTWCLK0inputTCELL98:IMUX_CLK1_DELAY
Q1_FIGRPFBTWCLK1inputTCELL98:IMUX_CLK0_DELAY
Q1_FIRXTESTCLKinputTCELL97:IMUX_CLK1_DELAY
Q1_FISYNCCLKinputTCELL97:IMUX_CLK0_DELAY
Q1_FITMRCLKinputTCELL112:IMUX_CLK0_DELAY
Q1_FITXTESTCLKinputTCELL113:IMUX_CLK1_DELAY
Q1_FOREFCLK2FPGAoutputTCELL109:OUT_F5
Q1_HSPLLLOLoutputTCELL110:OUT_F7
Q1_HSPLLPWRUPinputTCELL112:IMUX_A5
Q1_HSPLLREFCLKIinputTCELL106:IMUX_CLK0_DELAY
Q1_HSPLLRSTinputTCELL111:IMUX_LSR0
Q1_LSPLLLOLoutputTCELL110:OUT_F6
Q1_LSPLLPWRUPinputTCELL112:IMUX_A4
Q1_LSPLLREFCLKIinputTCELL106:IMUX_CLK1_DELAY
Q1_LSPLLRSTinputTCELL111:IMUX_LSR1

Bel wires

ecp4 SERDES2 bel wires
WirePins
TCELL0:IMUX_A2SERDES.Q0CH0_FCLDRTXEN
TCELL0:IMUX_A3SERDES.Q0CH1_FCLDRTXEN
TCELL0:IMUX_A4SERDES.Q0CH2_FCLDRTXEN
TCELL0:IMUX_A5SERDES.Q0CH3_FCLDRTXEN
TCELL0:IMUX_B2SERDES.Q0CH0_FCALIGNEN
TCELL0:IMUX_B3SERDES.Q0CH1_FCALIGNEN
TCELL0:IMUX_B4SERDES.Q0CH2_FCALIGNEN
TCELL0:IMUX_B5SERDES.Q0CH3_FCALIGNEN
TCELL0:IMUX_C2SERDES.Q0_FCMRST
TCELL0:IMUX_C3SERDES.Q0CH0_FCTXPWRUP
TCELL0:IMUX_C4SERDES.Q0CH1_FCTXPWRUP
TCELL0:IMUX_C5SERDES.Q0CH2_FCTXPWRUP
TCELL0:IMUX_D2SERDES.Q0CH3_FCTXPWRUP
TCELL0:IMUX_D3SERDES.Q0CH0_FCRXPWRUP
TCELL0:IMUX_D4SERDES.Q0CH1_FCRXPWRUP
TCELL0:IMUX_D5SERDES.Q0CH2_FCRXPWRUP
TCELL0:IMUX_CLK1_DELAYSERDES.Q0_FITXTESTCLK
TCELL0:OUT_F2SERDES.Q0CH3_FDRX15
TCELL0:OUT_F3SERDES.Q0CH3_FDRX14
TCELL0:OUT_F4SERDES.Q0CH3_FDRX13
TCELL0:OUT_F5SERDES.Q0CH3_FDRX12
TCELL0:OUT_F6SERDES.Q0CH3_FDRX11
TCELL0:OUT_F7SERDES.Q0CH3_FDRX10
TCELL0:OUT_Q2SERDES.Q0CH3_FDRX9
TCELL0:OUT_Q3SERDES.Q0CH3_FDRX8
TCELL0:OUT_Q4SERDES.Q0CH3_FDRX7
TCELL0:OUT_Q5SERDES.Q0CH3_FDRX6
TCELL0:OUT_Q6SERDES.Q0CH3_FDRX5
TCELL0:OUT_Q7SERDES.Q0CH3_FDRX4
TCELL1:IMUX_A0SERDES.Q0CH3_FCRXPWRUP
TCELL1:IMUX_A1SERDES.Q0_FCMPWRUP
TCELL1:IMUX_A2SERDES.Q0_HSPLLPWRUP
TCELL1:IMUX_A3SERDES.Q0_LSPLLPWRUP
TCELL1:IMUX_A4SERDES.Q0CH0_FCRATE2
TCELL1:IMUX_A5SERDES.Q0CH0_FCRATE1
TCELL1:IMUX_B0SERDES.Q0CH0_FCRATE0
TCELL1:IMUX_B1SERDES.Q0CH1_FCRATE2
TCELL1:IMUX_B2SERDES.Q0CH1_FCRATE1
TCELL1:IMUX_B3SERDES.Q0CH1_FCRATE0
TCELL1:IMUX_B4SERDES.Q0CH2_FCRATE2
TCELL1:IMUX_B5SERDES.Q0CH2_FCRATE1
TCELL1:IMUX_C0SERDES.Q0CH2_FCRATE0
TCELL1:IMUX_C1SERDES.Q0CH3_FCRATE2
TCELL1:IMUX_C2SERDES.Q0CH3_FCRATE1
TCELL1:IMUX_C3SERDES.Q0CH3_FCRATE0
TCELL1:IMUX_C4SERDES.Q0_FCSCANMODE
TCELL1:IMUX_C5SERDES.Q0_FDDFECHSEL1
TCELL1:IMUX_D0SERDES.Q0_FDDFECHSEL0
TCELL1:IMUX_D1SERDES.Q0_FCDFECOEFF0_7
TCELL1:IMUX_D2SERDES.Q0_FCDFECOEFF0_6
TCELL1:IMUX_D3SERDES.Q0_FCDFECOEFF0_5
TCELL1:IMUX_D4SERDES.Q0_FCDFECOEFF0_4
TCELL1:IMUX_D5SERDES.Q0_FCDFECOEFF0_3
TCELL1:IMUX_LSR0SERDES.Q0CH2_FCTRST
TCELL1:IMUX_LSR1SERDES.Q0CH3_FCTRST
TCELL1:IMUX_CLK0_DELAYSERDES.Q0_FITMRCLK
TCELL1:IMUX_CLK1_DELAYSERDES.Q0CH0_FITMRSTARTCLK
TCELL1:OUT_F0SERDES.Q0CH3_FDRX3
TCELL1:OUT_F1SERDES.Q0CH3_FDRX2
TCELL1:OUT_F2SERDES.Q0CH3_FDRX1
TCELL1:OUT_F3SERDES.Q0CH3_FDRX0
TCELL1:OUT_F4SERDES.Q0CH0_FSPCIEDONE
TCELL1:OUT_F5SERDES.Q0CH1_FSPCIEDONE
TCELL1:OUT_F6SERDES.Q0CH2_FSPCIEDONE
TCELL1:OUT_F7SERDES.Q0CH3_FSPCIEDONE
TCELL1:OUT_Q0SERDES.Q0CH0_FSPCIECON
TCELL1:OUT_Q1SERDES.Q0CH1_FSPCIECON
TCELL1:OUT_Q2SERDES.Q0CH2_FSPCIECON
TCELL1:OUT_Q3SERDES.Q0CH3_FSPCIECON
TCELL1:OUT_Q4SERDES.Q0CH0_FSRLOS
TCELL1:OUT_Q5SERDES.Q0CH1_FSRLOS
TCELL1:OUT_Q6SERDES.Q0CH2_FSRLOS
TCELL1:OUT_Q7SERDES.Q0CH3_FSRLOS
TCELL2:IMUX_A0SERDES.Q0_FCDFECOEFF0_2
TCELL2:IMUX_A1SERDES.Q0_FCDFECOEFF0_1
TCELL2:IMUX_A2SERDES.Q0_FCDFECOEFF0_0
TCELL2:IMUX_A3SERDES.Q0_FCDFECOEFF1_7
TCELL2:IMUX_A4SERDES.Q0_FCDFECOEFF1_6
TCELL2:IMUX_A5SERDES.Q0_FCDFECOEFF1_5
TCELL2:IMUX_B0SERDES.Q0_FCDFECOEFF1_4
TCELL2:IMUX_B1SERDES.Q0_FCDFECOEFF1_3
TCELL2:IMUX_B2SERDES.Q0_FCDFECOEFF1_2
TCELL2:IMUX_B3SERDES.Q0_FCDFECOEFF1_1
TCELL2:IMUX_B4SERDES.Q0_FCDFECOEFF1_0
TCELL2:IMUX_B5SERDES.Q0_FCDFECOEFF2_7
TCELL2:IMUX_C0SERDES.Q0_FCDFECOEFF2_6
TCELL2:IMUX_C1SERDES.Q0_FCDFECOEFF2_5
TCELL2:IMUX_C2SERDES.Q0_FCDFECOEFF2_4
TCELL2:IMUX_C3SERDES.Q0_FCDFECOEFF2_3
TCELL2:IMUX_C4SERDES.Q0_FCDFECOEFF2_2
TCELL2:IMUX_C5SERDES.Q0_FCDFECOEFF2_1
TCELL2:IMUX_D0SERDES.Q0_FCDFECOEFF2_0
TCELL2:IMUX_D1SERDES.Q0_FCDFECOEFF3_7
TCELL2:IMUX_D2SERDES.Q0_FCDFECOEFF3_6
TCELL2:IMUX_D3SERDES.Q0_FCDFECOEFF3_5
TCELL2:IMUX_D4SERDES.Q0_FCDFECOEFF3_4
TCELL2:IMUX_D5SERDES.Q0_FCDFECOEFF3_3
TCELL2:IMUX_LSR0SERDES.Q0_LSPLLRST
TCELL2:IMUX_LSR1SERDES.Q0_HSPLLRST
TCELL2:IMUX_CLK0_DELAYSERDES.Q0CH1_FITMRSTARTCLK
TCELL2:IMUX_CLK1_DELAYSERDES.Q0CH2_FITMRSTARTCLK
TCELL2:OUT_F0SERDES.Q0CH0_FSLSM
TCELL2:OUT_F1SERDES.Q0CH1_FSLSM
TCELL2:OUT_F2SERDES.Q0CH2_FSLSM
TCELL2:OUT_F3SERDES.Q0CH3_FSLSM
TCELL2:OUT_F4SERDES.Q0CH0_FSCCUNDERRUN
TCELL2:OUT_F5SERDES.Q0CH1_FSCCUNDERRUN
TCELL2:OUT_F6SERDES.Q0CH2_FSCCUNDERRUN
TCELL2:OUT_F7SERDES.Q0CH3_FSCCUNDERRUN
TCELL2:OUT_Q0SERDES.Q0CH0_FSCCOVERRUN
TCELL2:OUT_Q1SERDES.Q0CH1_FSCCOVERRUN
TCELL2:OUT_Q2SERDES.Q0CH2_FSCCOVERRUN
TCELL2:OUT_Q3SERDES.Q0CH3_FSCCOVERRUN
TCELL2:OUT_Q4SERDES.Q0CH0_FSRLOL
TCELL2:OUT_Q5SERDES.Q0CH1_FSRLOL
TCELL2:OUT_Q6SERDES.Q0CH2_FSRLOL
TCELL2:OUT_Q7SERDES.Q0CH3_FSRLOL
TCELL3:IMUX_A0SERDES.Q0_FCDFECOEFF3_2
TCELL3:IMUX_A1SERDES.Q0_FCDFECOEFF3_1
TCELL3:IMUX_A2SERDES.Q0_FCDFECOEFF3_0
TCELL3:IMUX_A3SERDES.Q0_FCDFECOEFF4_7
TCELL3:IMUX_A4SERDES.Q0_FCDFECOEFF4_6
TCELL3:IMUX_A5SERDES.Q0_FCDFECOEFF4_5
TCELL3:IMUX_B0SERDES.Q0_FCDFECOEFF4_4
TCELL3:IMUX_B1SERDES.Q0_FCDFECOEFF4_3
TCELL3:IMUX_B2SERDES.Q0_FCDFECOEFF4_2
TCELL3:IMUX_B3SERDES.Q0_FCDFECOEFF4_1
TCELL3:IMUX_B4SERDES.Q0_FCDFECOEFF4_0
TCELL3:IMUX_B5SERDES.Q0_FCDFECOEFF5_7
TCELL3:IMUX_C0SERDES.Q0_FCDFECOEFF5_6
TCELL3:IMUX_C1SERDES.Q0_FCDFECOEFF5_5
TCELL3:IMUX_C2SERDES.Q0_FCDFECOEFF5_4
TCELL3:IMUX_C3SERDES.Q0_FCDFECOEFF5_3
TCELL3:IMUX_C4SERDES.Q0_FCDFECOEFF5_2
TCELL3:IMUX_C5SERDES.Q0_FCDFECOEFF5_1
TCELL3:IMUX_D0SERDES.Q0_FCDFECOEFF5_0
TCELL3:IMUX_D1SERDES.Q0_FCDFESIGN5
TCELL3:IMUX_D2SERDES.Q0_FCDFESIGN4
TCELL3:IMUX_D3SERDES.Q0_FCDFESIGN3
TCELL3:IMUX_D4SERDES.Q0_FCDFESIGN2
TCELL3:IMUX_D5SERDES.Q0_FCDFESIGN1
TCELL3:IMUX_CLK0_DELAYSERDES.Q0CH3_FITMRSTARTCLK
TCELL3:IMUX_CLK1_DELAYSERDES.Q0CH0_FITMRSTOPCLK
TCELL3:OUT_F0SERDES.Q0_HSPLLLOL
TCELL3:OUT_F1SERDES.Q0_LSPLLLOL
TCELL3:OUT_F2SERDES.Q0CH0_FDLDRRX
TCELL3:OUT_F3SERDES.Q0CH1_FDLDRRX
TCELL3:OUT_F4SERDES.Q0CH2_FDLDRRX
TCELL3:OUT_F5SERDES.Q0CH3_FDLDRRX
TCELL3:OUT_F6SERDES.Q0CH0_FSSKPADDED
TCELL3:OUT_F7SERDES.Q0CH1_FSSKPADDED
TCELL3:OUT_Q0SERDES.Q0CH2_FSSKPADDED
TCELL3:OUT_Q1SERDES.Q0CH3_FSSKPADDED
TCELL3:OUT_Q2SERDES.Q0CH0_FSSKPDELETED
TCELL3:OUT_Q3SERDES.Q0CH1_FSSKPDELETED
TCELL3:OUT_Q4SERDES.Q0CH2_FSSKPDELETED
TCELL3:OUT_Q5SERDES.Q0CH3_FSSKPDELETED
TCELL3:OUT_Q6SERDES.Q0D0_FSDE
TCELL3:OUT_Q7SERDES.Q0D1_FSDE
TCELL4:IMUX_A0SERDES.Q0CH0_FCTMRSTART
TCELL4:IMUX_A1SERDES.Q0CH1_FCTMRSTART
TCELL4:IMUX_A2SERDES.Q0CH2_FCTMRSTART
TCELL4:IMUX_A3SERDES.Q0CH3_FCTMRSTART
TCELL4:IMUX_A4SERDES.Q0CH0_FCTMRSTOP
TCELL4:IMUX_A5SERDES.Q0CH1_FCTMRSTOP
TCELL4:IMUX_B0SERDES.Q0CH2_FCTMRSTOP
TCELL4:IMUX_B1SERDES.Q0CH3_FCTMRSTOP
TCELL4:IMUX_CLK0_DELAYSERDES.Q0CH1_FITMRSTOPCLK
TCELL4:IMUX_CLK1_DELAYSERDES.Q0CH2_FITMRSTOPCLK
TCELL4:OUT_F0SERDES.Q0D0_FSDM
TCELL4:OUT_F1SERDES.Q0D1_FSDM
TCELL4:OUT_F2SERDES.Q0_FOREFCLK2FPGA
TCELL4:OUT_F3SERDES.Q0CH0_FSRCDONE
TCELL4:OUT_F4SERDES.Q0CH1_FSRCDONE
TCELL4:OUT_F5SERDES.Q0CH2_FSRCDONE
TCELL4:OUT_F6SERDES.Q0CH3_FSRCDONE
TCELL4:OUT_F7SERDES.Q0_FDDFEDATA9
TCELL4:OUT_Q0SERDES.Q0_FDDFEDATA8
TCELL4:OUT_Q1SERDES.Q0_FDDFEDATA7
TCELL4:OUT_Q2SERDES.Q0_FDDFEDATA6
TCELL4:OUT_Q3SERDES.Q0_FDDFEDATA5
TCELL4:OUT_Q4SERDES.Q0_FDDFEDATA4
TCELL4:OUT_Q5SERDES.Q0_FDDFEDATA3
TCELL4:OUT_Q6SERDES.Q0_FDDFEDATA2
TCELL4:OUT_Q7SERDES.Q0_FDDFEDATA1
TCELL5:IMUX_CLK0_DELAYSERDES.Q0CH3_FITMRSTOPCLK
TCELL5:OUT_F0SERDES.Q0_FDDFEDATA0
TCELL5:OUT_F1SERDES.Q0_FDDFEERR9
TCELL5:OUT_F2SERDES.Q0_FDDFEERR8
TCELL5:OUT_F3SERDES.Q0_FDDFEERR7
TCELL5:OUT_F4SERDES.Q0_FDDFEERR6
TCELL5:OUT_F5SERDES.Q0_FDDFEERR5
TCELL5:OUT_F6SERDES.Q0_FDDFEERR4
TCELL5:OUT_F7SERDES.Q0_FDDFEERR3
TCELL5:OUT_Q0SERDES.Q0_FDDFEERR2
TCELL5:OUT_Q1SERDES.Q0_FDDFEERR1
TCELL5:OUT_Q2SERDES.Q0_FDDFEERR0
TCELL5:OUT_Q3SERDES.Q0CH0_FSDFEVLD
TCELL5:OUT_Q4SERDES.Q0CH1_FSDFEVLD
TCELL5:OUT_Q5SERDES.Q0CH2_FSDFEVLD
TCELL5:OUT_Q6SERDES.Q0CH3_FSDFEVLD
TCELL7:IMUX_A0SERDES.Q0CH0_FDTX49
TCELL7:IMUX_A1SERDES.Q0CH0_FDTX48
TCELL7:IMUX_A2SERDES.Q0CH0_FDTX47
TCELL7:IMUX_A3SERDES.Q0CH0_FDTX46
TCELL7:IMUX_A4SERDES.Q0CH0_FDTX45
TCELL7:IMUX_A5SERDES.Q0CH0_FDTX44
TCELL7:IMUX_B0SERDES.Q0CH0_FDTX43
TCELL7:IMUX_B1SERDES.Q0CH0_FDTX42
TCELL7:IMUX_B2SERDES.Q0CH0_FDTX41
TCELL7:IMUX_B3SERDES.Q0CH0_FDTX40
TCELL7:IMUX_B4SERDES.Q0CH0_FDTX39
TCELL7:IMUX_B5SERDES.Q0CH0_FDTX38
TCELL7:IMUX_C0SERDES.Q0CH0_FDTX37
TCELL7:IMUX_C1SERDES.Q0CH0_FDTX36
TCELL7:IMUX_C2SERDES.Q0CH0_FDTX35
TCELL7:IMUX_C3SERDES.Q0CH0_FDTX34
TCELL7:IMUX_C4SERDES.Q0CH0_FDTX33
TCELL7:IMUX_C5SERDES.Q0CH0_FDTX32
TCELL7:IMUX_D0SERDES.Q0CH0_FDTX31
TCELL7:IMUX_D1SERDES.Q0CH0_FDTX30
TCELL7:IMUX_D2SERDES.Q0CH0_FDTX29
TCELL7:IMUX_D3SERDES.Q0CH0_FDTX28
TCELL7:IMUX_D4SERDES.Q0CH0_FDTX27
TCELL7:IMUX_D5SERDES.Q0CH0_FDTX26
TCELL7:IMUX_LSR0SERDES.Q0CH0_FCPIPEPHYRESETN
TCELL7:IMUX_LSR1SERDES.Q0CH1_FCPIPEPHYRESETN
TCELL7:IMUX_CLK0_DELAYSERDES.Q0_HSPLLREFCLKI
TCELL7:IMUX_CLK1_DELAYSERDES.Q0_LSPLLREFCLKI
TCELL7:IMUX_CE0SERDES.Q0CH0_FCDFERDEN
TCELL7:IMUX_CE1SERDES.Q0CH1_FCDFERDEN
TCELL7:IMUX_CE2SERDES.Q0CH2_FCDFERDEN
TCELL7:IMUX_CE3SERDES.Q0CH3_FCDFERDEN
TCELL7:OUT_F0SERDES.Q0CH0_FDRX47
TCELL7:OUT_F1SERDES.Q0CH0_FDRX46
TCELL7:OUT_F2SERDES.Q0CH0_FDRX45
TCELL7:OUT_F3SERDES.Q0CH0_FDRX44
TCELL7:OUT_F4SERDES.Q0CH0_FDRX43
TCELL7:OUT_F5SERDES.Q0CH0_FDRX42
TCELL7:OUT_F6SERDES.Q0CH0_FDRX41
TCELL7:OUT_F7SERDES.Q0CH0_FDRX40
TCELL7:OUT_Q0SERDES.Q0CH0_FDRX39
TCELL7:OUT_Q1SERDES.Q0CH0_FDRX38
TCELL7:OUT_Q2SERDES.Q0CH0_FDRX37
TCELL7:OUT_Q3SERDES.Q0CH0_FDRX36
TCELL7:OUT_Q4SERDES.Q0CH0_FDRX35
TCELL7:OUT_Q5SERDES.Q0CH0_FDRX34
TCELL7:OUT_Q6SERDES.Q0CH0_FDRX33
TCELL7:OUT_Q7SERDES.Q0CH0_FDRX32
TCELL8:IMUX_A0SERDES.Q0CH0_FDTX25
TCELL8:IMUX_A1SERDES.Q0CH0_FDTX24
TCELL8:IMUX_A2SERDES.Q0CH0_FDTX23
TCELL8:IMUX_A3SERDES.Q0CH0_FDTX22
TCELL8:IMUX_A4SERDES.Q0CH0_FDTX21
TCELL8:IMUX_A5SERDES.Q0CH0_FDTX20
TCELL8:IMUX_B0SERDES.Q0CH0_FDTX19
TCELL8:IMUX_B1SERDES.Q0CH0_FDTX18
TCELL8:IMUX_B2SERDES.Q0CH0_FDTX17
TCELL8:IMUX_B3SERDES.Q0CH0_FDTX16
TCELL8:IMUX_B4SERDES.Q0CH0_FDTX15
TCELL8:IMUX_B5SERDES.Q0CH0_FDTX14
TCELL8:IMUX_C0SERDES.Q0CH0_FDTX13
TCELL8:IMUX_C1SERDES.Q0CH0_FDTX12
TCELL8:IMUX_C2SERDES.Q0CH0_FDTX11
TCELL8:IMUX_C3SERDES.Q0CH0_FDTX10
TCELL8:IMUX_C4SERDES.Q0CH0_FDTX9
TCELL8:IMUX_C5SERDES.Q0CH0_FDTX8
TCELL8:IMUX_D0SERDES.Q0CH0_FDTX7
TCELL8:IMUX_D1SERDES.Q0CH0_FDTX6
TCELL8:IMUX_D2SERDES.Q0CH0_FDTX5
TCELL8:IMUX_D3SERDES.Q0CH0_FDTX4
TCELL8:IMUX_D4SERDES.Q0CH0_FDTX3
TCELL8:IMUX_D5SERDES.Q0CH0_FDTX2
TCELL8:IMUX_LSR0SERDES.Q0CH2_FCPIPEPHYRESETN
TCELL8:IMUX_LSR1SERDES.Q0CH3_FCPIPEPHYRESETN
TCELL8:IMUX_CLK0_DELAYSERDES.Q0CH0_FIREFRXCLK
TCELL8:IMUX_CLK1_DELAYSERDES.Q0CH1_FIREFRXCLK
TCELL8:IMUX_CE0SERDES.Q0CH0_FCDFEUPD
TCELL8:IMUX_CE1SERDES.Q0CH1_FCDFEUPD
TCELL8:IMUX_CE2SERDES.Q0CH2_FCDFEUPD
TCELL8:IMUX_CE3SERDES.Q0CH3_FCDFEUPD
TCELL8:OUT_F0SERDES.Q0CH0_FDRX31
TCELL8:OUT_F1SERDES.Q0CH0_FDRX30
TCELL8:OUT_F2SERDES.Q0CH0_FDRX29
TCELL8:OUT_F3SERDES.Q0CH0_FDRX28
TCELL8:OUT_F4SERDES.Q0CH0_FDRX27
TCELL8:OUT_F5SERDES.Q0CH0_FDRX26
TCELL8:OUT_F6SERDES.Q0CH0_FDRX25
TCELL8:OUT_F7SERDES.Q0CH0_FDRX24
TCELL8:OUT_Q0SERDES.Q0CH0_FDRX23
TCELL8:OUT_Q1SERDES.Q0CH0_FDRX22
TCELL8:OUT_Q2SERDES.Q0CH0_FDRX21
TCELL8:OUT_Q3SERDES.Q0CH0_FDRX20
TCELL8:OUT_Q4SERDES.Q0CH0_FDRX19
TCELL8:OUT_Q5SERDES.Q0CH0_FDRX18
TCELL8:OUT_Q6SERDES.Q0CH0_FDRX17
TCELL8:OUT_Q7SERDES.Q0CH0_FDRX16
TCELL9:IMUX_A0SERDES.Q0CH0_FDTX1
TCELL9:IMUX_A1SERDES.Q0CH0_FDTX0
TCELL9:IMUX_A2SERDES.Q0CH1_FDTX49
TCELL9:IMUX_A3SERDES.Q0CH1_FDTX48
TCELL9:IMUX_A4SERDES.Q0CH1_FDTX47
TCELL9:IMUX_A5SERDES.Q0CH1_FDTX46
TCELL9:IMUX_B0SERDES.Q0CH1_FDTX45
TCELL9:IMUX_B1SERDES.Q0CH1_FDTX44
TCELL9:IMUX_B2SERDES.Q0CH1_FDTX43
TCELL9:IMUX_B3SERDES.Q0CH1_FDTX42
TCELL9:IMUX_B4SERDES.Q0CH1_FDTX41
TCELL9:IMUX_B5SERDES.Q0CH1_FDTX40
TCELL9:IMUX_C0SERDES.Q0CH1_FDTX39
TCELL9:IMUX_C1SERDES.Q0CH1_FDTX38
TCELL9:IMUX_C2SERDES.Q0CH1_FDTX37
TCELL9:IMUX_C3SERDES.Q0CH1_FDTX36
TCELL9:IMUX_C4SERDES.Q0CH1_FDTX35
TCELL9:IMUX_C5SERDES.Q0CH1_FDTX34
TCELL9:IMUX_D0SERDES.Q0CH1_FDTX33
TCELL9:IMUX_D1SERDES.Q0CH1_FDTX32
TCELL9:IMUX_D2SERDES.Q0CH1_FDTX31
TCELL9:IMUX_D3SERDES.Q0CH1_FDTX30
TCELL9:IMUX_D4SERDES.Q0CH1_FDTX29
TCELL9:IMUX_D5SERDES.Q0CH1_FDTX28
TCELL9:IMUX_LSR0SERDES.Q0D0_FCDERST
TCELL9:IMUX_LSR1SERDES.Q0D1_FCDERST
TCELL9:IMUX_CLK0_DELAYSERDES.Q0CH2_FIREFRXCLK
TCELL9:IMUX_CLK1_DELAYSERDES.Q0CH3_FIREFRXCLK
TCELL9:OUT_F0SERDES.Q0CH0_FDRX15
TCELL9:OUT_F1SERDES.Q0CH0_FDRX14
TCELL9:OUT_F2SERDES.Q0CH0_FDRX13
TCELL9:OUT_F3SERDES.Q0CH0_FDRX12
TCELL9:OUT_F4SERDES.Q0CH0_FDRX11
TCELL9:OUT_F5SERDES.Q0CH0_FDRX10
TCELL9:OUT_F6SERDES.Q0CH0_FDRX9
TCELL9:OUT_F7SERDES.Q0CH0_FDRX8
TCELL9:OUT_Q0SERDES.Q0CH0_FDRX7
TCELL9:OUT_Q1SERDES.Q0CH0_FDRX6
TCELL9:OUT_Q2SERDES.Q0CH0_FDRX5
TCELL9:OUT_Q3SERDES.Q0CH0_FDRX4
TCELL9:OUT_Q4SERDES.Q0CH0_FDRX3
TCELL9:OUT_Q5SERDES.Q0CH0_FDRX2
TCELL9:OUT_Q6SERDES.Q0CH0_FDRX1
TCELL9:OUT_Q7SERDES.Q0CH0_FDRX0
TCELL10:IMUX_A0SERDES.Q0CH1_FDTX27
TCELL10:IMUX_A1SERDES.Q0CH1_FDTX26
TCELL10:IMUX_A2SERDES.Q0CH1_FDTX25
TCELL10:IMUX_A3SERDES.Q0CH1_FDTX24
TCELL10:IMUX_A4SERDES.Q0CH1_FDTX23
TCELL10:IMUX_A5SERDES.Q0CH1_FDTX22
TCELL10:IMUX_B0SERDES.Q0CH1_FDTX21
TCELL10:IMUX_B1SERDES.Q0CH1_FDTX20
TCELL10:IMUX_B2SERDES.Q0CH1_FDTX19
TCELL10:IMUX_B3SERDES.Q0CH1_FDTX18
TCELL10:IMUX_B4SERDES.Q0CH1_FDTX17
TCELL10:IMUX_B5SERDES.Q0CH1_FDTX16
TCELL10:IMUX_C0SERDES.Q0CH1_FDTX15
TCELL10:IMUX_C1SERDES.Q0CH1_FDTX14
TCELL10:IMUX_C2SERDES.Q0CH1_FDTX13
TCELL10:IMUX_C3SERDES.Q0CH1_FDTX12
TCELL10:IMUX_C4SERDES.Q0CH1_FDTX11
TCELL10:IMUX_C5SERDES.Q0CH1_FDTX10
TCELL10:IMUX_D0SERDES.Q0CH1_FDTX9
TCELL10:IMUX_D1SERDES.Q0CH1_FDTX8
TCELL10:IMUX_D2SERDES.Q0CH1_FDTX7
TCELL10:IMUX_D3SERDES.Q0CH1_FDTX6
TCELL10:IMUX_D4SERDES.Q0CH1_FDTX5
TCELL10:IMUX_D5SERDES.Q0CH1_FDTX4
TCELL10:IMUX_LSR0SERDES.Q0CH0_FCPCSTXRST
TCELL10:IMUX_LSR1SERDES.Q0CH1_FCPCSTXRST
TCELL10:IMUX_CLK0_DELAYSERDES.Q0CH0_FIRCLK
TCELL10:IMUX_CLK1_DELAYSERDES.Q0CH1_FIRCLK
TCELL10:OUT_F0SERDES.Q0CH1_FDRX47
TCELL10:OUT_F1SERDES.Q0CH1_FDRX46
TCELL10:OUT_F2SERDES.Q0CH1_FDRX45
TCELL10:OUT_F3SERDES.Q0CH1_FDRX44
TCELL10:OUT_F4SERDES.Q0CH1_FDRX43
TCELL10:OUT_F5SERDES.Q0CH1_FDRX42
TCELL10:OUT_F6SERDES.Q0CH1_FDRX41
TCELL10:OUT_F7SERDES.Q0CH1_FDRX40
TCELL10:OUT_Q0SERDES.Q0CH1_FDRX39
TCELL10:OUT_Q1SERDES.Q0CH1_FDRX38
TCELL10:OUT_Q2SERDES.Q0CH1_FDRX37
TCELL10:OUT_Q3SERDES.Q0CH1_FDRX36
TCELL10:OUT_Q4SERDES.Q0CH1_FDRX35
TCELL10:OUT_Q5SERDES.Q0CH1_FDRX34
TCELL10:OUT_Q6SERDES.Q0CH1_FDRX33
TCELL10:OUT_Q7SERDES.Q0CH1_FDRX32
TCELL11:IMUX_A0SERDES.Q0CH1_FDTX3
TCELL11:IMUX_A1SERDES.Q0CH1_FDTX2
TCELL11:IMUX_A2SERDES.Q0CH1_FDTX1
TCELL11:IMUX_A3SERDES.Q0CH1_FDTX0
TCELL11:IMUX_A4SERDES.Q0CH2_FDTX49
TCELL11:IMUX_A5SERDES.Q0CH2_FDTX48
TCELL11:IMUX_B0SERDES.Q0CH2_FDTX47
TCELL11:IMUX_B1SERDES.Q0CH2_FDTX46
TCELL11:IMUX_B2SERDES.Q0CH2_FDTX45
TCELL11:IMUX_B3SERDES.Q0CH2_FDTX44
TCELL11:IMUX_B4SERDES.Q0CH2_FDTX43
TCELL11:IMUX_B5SERDES.Q0CH2_FDTX42
TCELL11:IMUX_C0SERDES.Q0CH2_FDTX41
TCELL11:IMUX_C1SERDES.Q0CH2_FDTX40
TCELL11:IMUX_C2SERDES.Q0CH2_FDTX39
TCELL11:IMUX_C3SERDES.Q0CH2_FDTX38
TCELL11:IMUX_C4SERDES.Q0CH2_FDTX37
TCELL11:IMUX_C5SERDES.Q0CH2_FDTX36
TCELL11:IMUX_D0SERDES.Q0CH2_FDTX35
TCELL11:IMUX_D1SERDES.Q0CH2_FDTX34
TCELL11:IMUX_D2SERDES.Q0CH2_FDTX33
TCELL11:IMUX_D3SERDES.Q0CH2_FDTX32
TCELL11:IMUX_D4SERDES.Q0CH2_FDTX31
TCELL11:IMUX_D5SERDES.Q0CH2_FDTX30
TCELL11:IMUX_LSR0SERDES.Q0CH2_FCPCSTXRST
TCELL11:IMUX_LSR1SERDES.Q0CH3_FCPCSTXRST
TCELL11:IMUX_CLK0_DELAYSERDES.Q0CH2_FIRCLK
TCELL11:IMUX_CLK1_DELAYSERDES.Q0CH3_FIRCLK
TCELL11:OUT_F0SERDES.Q0CH1_FDRX31
TCELL11:OUT_F1SERDES.Q0CH1_FDRX30
TCELL11:OUT_F2SERDES.Q0CH1_FDRX29
TCELL11:OUT_F3SERDES.Q0CH1_FDRX28
TCELL11:OUT_F4SERDES.Q0CH1_FDRX27
TCELL11:OUT_F5SERDES.Q0CH1_FDRX26
TCELL11:OUT_F6SERDES.Q0CH1_FDRX25
TCELL11:OUT_F7SERDES.Q0CH1_FDRX24
TCELL11:OUT_Q0SERDES.Q0CH1_FDRX23
TCELL11:OUT_Q1SERDES.Q0CH1_FDRX22
TCELL11:OUT_Q2SERDES.Q0CH1_FDRX21
TCELL11:OUT_Q3SERDES.Q0CH1_FDRX20
TCELL11:OUT_Q4SERDES.Q0CH1_FDRX19
TCELL11:OUT_Q5SERDES.Q0CH1_FDRX18
TCELL11:OUT_Q6SERDES.Q0CH1_FDRX17
TCELL11:OUT_Q7SERDES.Q0CH1_FDRX16
TCELL12:IMUX_A2SERDES.Q0CH2_FDTX29
TCELL12:IMUX_A3SERDES.Q0CH2_FDTX28
TCELL12:IMUX_A4SERDES.Q0CH2_FDTX27
TCELL12:IMUX_A5SERDES.Q0CH2_FDTX26
TCELL12:IMUX_A6SERDES.Q0CH2_FDTX25
TCELL12:IMUX_A7SERDES.Q0CH2_FDTX24
TCELL12:IMUX_B2SERDES.Q0CH2_FDTX23
TCELL12:IMUX_B3SERDES.Q0CH2_FDTX22
TCELL12:IMUX_B4SERDES.Q0CH2_FDTX21
TCELL12:IMUX_B5SERDES.Q0CH2_FDTX20
TCELL12:IMUX_B6SERDES.Q0CH2_FDTX19
TCELL12:IMUX_B7SERDES.Q0CH2_FDTX18
TCELL12:IMUX_C2SERDES.Q0CH2_FDTX17
TCELL12:IMUX_C3SERDES.Q0CH2_FDTX16
TCELL12:IMUX_C4SERDES.Q0CH2_FDTX15
TCELL12:IMUX_C5SERDES.Q0CH2_FDTX14
TCELL12:IMUX_C6SERDES.Q0CH2_FDTX13
TCELL12:IMUX_C7SERDES.Q0CH2_FDTX12
TCELL12:IMUX_D2SERDES.Q0CH2_FDTX11
TCELL12:IMUX_D3SERDES.Q0CH2_FDTX10
TCELL12:IMUX_D4SERDES.Q0CH2_FDTX9
TCELL12:IMUX_D5SERDES.Q0CH2_FDTX8
TCELL12:IMUX_D6SERDES.Q0CH2_FDTX7
TCELL12:IMUX_D7SERDES.Q0CH2_FDTX6
TCELL12:IMUX_LSR0SERDES.Q0CH0_FCPCSRXRST
TCELL12:IMUX_LSR1SERDES.Q0CH1_FCPCSRXRST
TCELL12:IMUX_CLK0_DELAYSERDES.Q0CH0_FITCLK
TCELL12:IMUX_CLK1_DELAYSERDES.Q0CH1_FITCLK
TCELL12:OUT_F2SERDES.Q0CH1_FDRX15
TCELL12:OUT_F3SERDES.Q0CH1_FDRX14
TCELL12:OUT_F4SERDES.Q0CH1_FDRX13
TCELL12:OUT_F5SERDES.Q0CH1_FDRX12
TCELL12:OUT_F6SERDES.Q0CH1_FDRX11
TCELL12:OUT_F7SERDES.Q0CH1_FDRX10
TCELL12:OUT_Q2SERDES.Q0CH1_FDRX7
TCELL12:OUT_Q3SERDES.Q0CH1_FDRX6
TCELL12:OUT_Q4SERDES.Q0CH1_FDRX5
TCELL12:OUT_Q5SERDES.Q0CH1_FDRX4
TCELL12:OUT_Q6SERDES.Q0CH1_FDRX3
TCELL12:OUT_Q7SERDES.Q0CH1_FDRX2
TCELL13:IMUX_A2SERDES.Q0CH2_FDTX5
TCELL13:IMUX_A3SERDES.Q0CH2_FDTX4
TCELL13:IMUX_A4SERDES.Q0CH2_FDTX3
TCELL13:IMUX_A5SERDES.Q0CH2_FDTX2
TCELL13:IMUX_A6SERDES.Q0CH2_FDTX1
TCELL13:IMUX_A7SERDES.Q0CH2_FDTX0
TCELL13:IMUX_B2SERDES.Q0CH3_FDTX49
TCELL13:IMUX_B3SERDES.Q0CH3_FDTX48
TCELL13:IMUX_B4SERDES.Q0CH3_FDTX47
TCELL13:IMUX_B5SERDES.Q0CH3_FDTX46
TCELL13:IMUX_B6SERDES.Q0CH3_FDTX45
TCELL13:IMUX_B7SERDES.Q0CH3_FDTX44
TCELL13:IMUX_C2SERDES.Q0CH3_FDTX43
TCELL13:IMUX_C3SERDES.Q0CH3_FDTX42
TCELL13:IMUX_C4SERDES.Q0CH3_FDTX41
TCELL13:IMUX_C5SERDES.Q0CH3_FDTX40
TCELL13:IMUX_C6SERDES.Q0CH3_FDTX39
TCELL13:IMUX_C7SERDES.Q0CH3_FDTX38
TCELL13:IMUX_D2SERDES.Q0CH3_FDTX37
TCELL13:IMUX_D3SERDES.Q0CH3_FDTX36
TCELL13:IMUX_D4SERDES.Q0CH3_FDTX35
TCELL13:IMUX_D5SERDES.Q0CH3_FDTX34
TCELL13:IMUX_D6SERDES.Q0CH3_FDTX33
TCELL13:IMUX_D7SERDES.Q0CH3_FDTX32
TCELL13:IMUX_LSR0SERDES.Q0CH2_FCPCSRXRST
TCELL13:IMUX_LSR1SERDES.Q0CH3_FCPCSRXRST
TCELL13:IMUX_CLK0_DELAYSERDES.Q0CH2_FITCLK
TCELL13:IMUX_CLK1_DELAYSERDES.Q0CH3_FITCLK
TCELL13:OUT_F0SERDES.Q0CH1_FDRX9
TCELL13:OUT_F1SERDES.Q0CH1_FDRX8
TCELL13:OUT_F2SERDES.Q0CH2_FDRX47
TCELL13:OUT_F3SERDES.Q0CH2_FDRX46
TCELL13:OUT_F4SERDES.Q0CH2_FDRX45
TCELL13:OUT_F5SERDES.Q0CH2_FDRX44
TCELL13:OUT_F6SERDES.Q0CH2_FDRX43
TCELL13:OUT_F7SERDES.Q0CH2_FDRX42
TCELL13:OUT_Q0SERDES.Q0CH1_FDRX1
TCELL13:OUT_Q1SERDES.Q0CH1_FDRX0
TCELL13:OUT_Q2SERDES.Q0CH2_FDRX39
TCELL13:OUT_Q3SERDES.Q0CH2_FDRX38
TCELL13:OUT_Q4SERDES.Q0CH2_FDRX37
TCELL13:OUT_Q5SERDES.Q0CH2_FDRX36
TCELL13:OUT_Q6SERDES.Q0CH2_FDRX35
TCELL13:OUT_Q7SERDES.Q0CH2_FDRX34
TCELL14:IMUX_A2SERDES.Q0CH3_FDTX31
TCELL14:IMUX_A3SERDES.Q0CH3_FDTX30
TCELL14:IMUX_A4SERDES.Q0CH3_FDTX29
TCELL14:IMUX_A5SERDES.Q0CH3_FDTX28
TCELL14:IMUX_A6SERDES.Q0CH3_FDTX27
TCELL14:IMUX_A7SERDES.Q0CH3_FDTX26
TCELL14:IMUX_B2SERDES.Q0CH3_FDTX25
TCELL14:IMUX_B3SERDES.Q0CH3_FDTX24
TCELL14:IMUX_B4SERDES.Q0CH3_FDTX23
TCELL14:IMUX_B5SERDES.Q0CH3_FDTX22
TCELL14:IMUX_B6SERDES.Q0CH3_FDTX21
TCELL14:IMUX_B7SERDES.Q0CH3_FDTX20
TCELL14:IMUX_C2SERDES.Q0CH3_FDTX19
TCELL14:IMUX_C3SERDES.Q0CH3_FDTX18
TCELL14:IMUX_C4SERDES.Q0CH3_FDTX17
TCELL14:IMUX_C5SERDES.Q0CH3_FDTX16
TCELL14:IMUX_C6SERDES.Q0CH3_FDTX15
TCELL14:IMUX_C7SERDES.Q0CH3_FDTX14
TCELL14:IMUX_D2SERDES.Q0CH3_FDTX13
TCELL14:IMUX_D3SERDES.Q0CH3_FDTX12
TCELL14:IMUX_D4SERDES.Q0CH3_FDTX11
TCELL14:IMUX_D5SERDES.Q0CH3_FDTX10
TCELL14:IMUX_D6SERDES.Q0CH3_FDTX9
TCELL14:IMUX_D7SERDES.Q0CH3_FDTX8
TCELL14:IMUX_LSR0SERDES.Q0CH0_FCRRST
TCELL14:IMUX_LSR1SERDES.Q0CH1_FCRRST
TCELL14:IMUX_CLK0_DELAYSERDES.Q0_FIGRPFBRRCLK1
TCELL14:IMUX_CLK1_DELAYSERDES.Q0_FIGRPFBRRCLK0
TCELL14:OUT_F0SERDES.Q0CH2_FDRX41
TCELL14:OUT_F1SERDES.Q0CH2_FDRX40
TCELL14:OUT_F2SERDES.Q0CH2_FDRX31
TCELL14:OUT_F3SERDES.Q0CH2_FDRX30
TCELL14:OUT_F4SERDES.Q0CH2_FDRX29
TCELL14:OUT_F5SERDES.Q0CH2_FDRX28
TCELL14:OUT_F6SERDES.Q0CH2_FDRX27
TCELL14:OUT_F7SERDES.Q0CH2_FDRX26
TCELL14:OUT_Q0SERDES.Q0CH2_FDRX33
TCELL14:OUT_Q1SERDES.Q0CH2_FDRX32
TCELL14:OUT_Q2SERDES.Q0CH2_FDRX23
TCELL14:OUT_Q3SERDES.Q0CH2_FDRX22
TCELL14:OUT_Q4SERDES.Q0CH2_FDRX21
TCELL14:OUT_Q5SERDES.Q0CH2_FDRX20
TCELL14:OUT_Q6SERDES.Q0CH2_FDRX19
TCELL14:OUT_Q7SERDES.Q0CH2_FDRX18
TCELL15:IMUX_A2SERDES.Q0CH3_FDTX7
TCELL15:IMUX_A3SERDES.Q0CH3_FDTX6
TCELL15:IMUX_A4SERDES.Q0CH3_FDTX5
TCELL15:IMUX_A5SERDES.Q0CH3_FDTX4
TCELL15:IMUX_A6SERDES.Q0CH3_FDTX3
TCELL15:IMUX_A7SERDES.Q0CH3_FDTX2
TCELL15:IMUX_B2SERDES.Q0CH3_FDTX1
TCELL15:IMUX_B3SERDES.Q0CH3_FDTX0
TCELL15:IMUX_B4SERDES.Q0CH0_FCPCIEDETEN
TCELL15:IMUX_B5SERDES.Q0CH1_FCPCIEDETEN
TCELL15:IMUX_B6SERDES.Q0CH2_FCPCIEDETEN
TCELL15:IMUX_B7SERDES.Q0CH3_FCPCIEDETEN
TCELL15:IMUX_C2SERDES.Q0CH0_FCRXPOLARITY
TCELL15:IMUX_C3SERDES.Q0CH1_FCRXPOLARITY
TCELL15:IMUX_C4SERDES.Q0CH2_FCRXPOLARITY
TCELL15:IMUX_C5SERDES.Q0CH3_FCRXPOLARITY
TCELL15:IMUX_C6SERDES.Q0CH0_FCWORDALGNEN
TCELL15:IMUX_C7SERDES.Q0CH1_FCWORDALGNEN
TCELL15:IMUX_D2SERDES.Q0CH2_FCWORDALGNEN
TCELL15:IMUX_D3SERDES.Q0CH3_FCWORDALGNEN
TCELL15:IMUX_D4SERDES.Q0CH0_FCLSMEN
TCELL15:IMUX_D5SERDES.Q0CH1_FCLSMEN
TCELL15:IMUX_D6SERDES.Q0CH2_FCLSMEN
TCELL15:IMUX_D7SERDES.Q0CH3_FCLSMEN
TCELL15:IMUX_LSR0SERDES.Q0CH2_FCRRST
TCELL15:IMUX_LSR1SERDES.Q0CH3_FCRRST
TCELL15:IMUX_CLK0_DELAYSERDES.Q0_FIGRPFBTWCLK1
TCELL15:IMUX_CLK1_DELAYSERDES.Q0_FIGRPFBTWCLK0
TCELL15:OUT_F0SERDES.Q0CH2_FDRX25
TCELL15:OUT_F1SERDES.Q0CH2_FDRX24
TCELL15:OUT_F2SERDES.Q0CH2_FDRX15
TCELL15:OUT_F3SERDES.Q0CH2_FDRX14
TCELL15:OUT_F4SERDES.Q0CH2_FDRX13
TCELL15:OUT_F5SERDES.Q0CH2_FDRX12
TCELL15:OUT_F6SERDES.Q0CH2_FDRX11
TCELL15:OUT_F7SERDES.Q0CH2_FDRX10
TCELL15:OUT_Q0SERDES.Q0CH2_FDRX17
TCELL15:OUT_Q1SERDES.Q0CH2_FDRX16
TCELL15:OUT_Q2SERDES.Q0CH2_FDRX7
TCELL15:OUT_Q3SERDES.Q0CH2_FDRX6
TCELL15:OUT_Q4SERDES.Q0CH2_FDRX5
TCELL15:OUT_Q5SERDES.Q0CH2_FDRX4
TCELL15:OUT_Q6SERDES.Q0CH2_FDRX3
TCELL15:OUT_Q7SERDES.Q0CH2_FDRX2
TCELL16:IMUX_A2SERDES.Q0CH0_FCCDRFORCEDLOCK
TCELL16:IMUX_A3SERDES.Q0CH1_FCCDRFORCEDLOCK
TCELL16:IMUX_A4SERDES.Q0CH2_FCCDRFORCEDLOCK
TCELL16:IMUX_A5SERDES.Q0CH3_FCCDRFORCEDLOCK
TCELL16:IMUX_A6SERDES.Q0CH0_FCPLLLOL
TCELL16:IMUX_A7SERDES.Q0CH1_FCPLLLOL
TCELL16:IMUX_B2SERDES.Q0CH2_FCPLLLOL
TCELL16:IMUX_B3SERDES.Q0CH3_FCPLLLOL
TCELL16:IMUX_B4SERDES.Q0CH0_FDLDRTX
TCELL16:IMUX_B5SERDES.Q0CH1_FDLDRTX
TCELL16:IMUX_B6SERDES.Q0CH2_FDLDRTX
TCELL16:IMUX_B7SERDES.Q0CH3_FDLDRTX
TCELL16:IMUX_C2SERDES.Q0CH0_FCTXMARGIN2
TCELL16:IMUX_C3SERDES.Q0CH0_FCTXMARGIN1
TCELL16:IMUX_C4SERDES.Q0CH0_FCTXMARGIN0
TCELL16:IMUX_C5SERDES.Q0CH1_FCTXMARGIN2
TCELL16:IMUX_C6SERDES.Q0CH1_FCTXMARGIN1
TCELL16:IMUX_C7SERDES.Q0CH1_FCTXMARGIN0
TCELL16:IMUX_D2SERDES.Q0CH2_FCTXMARGIN2
TCELL16:IMUX_D3SERDES.Q0CH2_FCTXMARGIN1
TCELL16:IMUX_D4SERDES.Q0CH2_FCTXMARGIN0
TCELL16:IMUX_D5SERDES.Q0CH3_FCTXMARGIN2
TCELL16:IMUX_D6SERDES.Q0CH3_FCTXMARGIN1
TCELL16:IMUX_D7SERDES.Q0CH3_FCTXMARGIN0
TCELL16:IMUX_LSR0SERDES.Q0CH0_FCTRST
TCELL16:IMUX_LSR1SERDES.Q0CH1_FCTRST
TCELL16:IMUX_CLK0_DELAYSERDES.Q0_FISYNCCLK
TCELL16:IMUX_CLK1_DELAYSERDES.Q0_FIRXTESTCLK
TCELL16:OUT_F0SERDES.Q0CH2_FDRX9
TCELL16:OUT_F1SERDES.Q0CH2_FDRX8
TCELL16:OUT_F2SERDES.Q0CH3_FDRX47
TCELL16:OUT_F3SERDES.Q0CH3_FDRX46
TCELL16:OUT_F4SERDES.Q0CH3_FDRX45
TCELL16:OUT_F5SERDES.Q0CH3_FDRX44
TCELL16:OUT_F6SERDES.Q0CH3_FDRX43
TCELL16:OUT_F7SERDES.Q0CH3_FDRX42
TCELL16:OUT_Q0SERDES.Q0CH2_FDRX1
TCELL16:OUT_Q1SERDES.Q0CH2_FDRX0
TCELL16:OUT_Q2SERDES.Q0CH3_FDRX39
TCELL16:OUT_Q3SERDES.Q0CH3_FDRX38
TCELL16:OUT_Q4SERDES.Q0CH3_FDRX37
TCELL16:OUT_Q5SERDES.Q0CH3_FDRX36
TCELL16:OUT_Q6SERDES.Q0CH3_FDRX35
TCELL16:OUT_Q7SERDES.Q0CH3_FDRX34
TCELL17:OUT_F0SERDES.Q0CH3_FDRX41
TCELL17:OUT_F1SERDES.Q0CH3_FDRX40
TCELL17:OUT_F2SERDES.Q0CH3_FDRX31
TCELL17:OUT_F3SERDES.Q0CH3_FDRX30
TCELL17:OUT_F4SERDES.Q0CH3_FDRX29
TCELL17:OUT_F5SERDES.Q0CH3_FDRX28
TCELL17:OUT_F6SERDES.Q0CH3_FDRX27
TCELL17:OUT_F7SERDES.Q0CH3_FDRX26
TCELL17:OUT_Q0SERDES.Q0CH3_FDRX33
TCELL17:OUT_Q1SERDES.Q0CH3_FDRX32
TCELL17:OUT_Q2SERDES.Q0CH3_FDRX23
TCELL17:OUT_Q3SERDES.Q0CH3_FDRX22
TCELL17:OUT_Q4SERDES.Q0CH3_FDRX21
TCELL17:OUT_Q5SERDES.Q0CH3_FDRX20
TCELL17:OUT_Q6SERDES.Q0CH3_FDRX19
TCELL17:OUT_Q7SERDES.Q0CH3_FDRX18
TCELL18:OUT_F0SERDES.Q0CH3_FDRX25
TCELL18:OUT_F1SERDES.Q0CH3_FDRX24
TCELL18:OUT_F2SERDES.Q0P_SCANO20
TCELL18:OUT_F3SERDES.Q0P_HALTGTREQTPHPRESENT
TCELL18:OUT_F4SERDES.Q0P_HALTGTWDATVLD
TCELL18:OUT_F5SERDES.Q0P_HALTGTWEOP
TCELL18:OUT_F6SERDES.Q0P_HALTGTCOMPRDY
TCELL18:OUT_F7SERDES.Q0P_HALTGTREQDES19
TCELL18:OUT_Q0SERDES.Q0CH3_FDRX17
TCELL18:OUT_Q1SERDES.Q0CH3_FDRX16
TCELL18:OUT_Q2SERDES.Q0P_HALTGTREQDES14
TCELL18:OUT_Q3SERDES.Q0P_HALTGTREQDES13
TCELL18:OUT_Q4SERDES.Q0P_HALTGTREQDES12
TCELL18:OUT_Q5SERDES.Q0P_HALTGTREQDES11
TCELL18:OUT_Q6SERDES.Q0P_HALTGTREQDES10
TCELL18:OUT_Q7SERDES.Q0P_HALTGTREQDES15
TCELL19:OUT_F0SERDES.Q0P_HALTGTREQDES18
TCELL19:OUT_F1SERDES.Q0P_HALTGTREQDES17
TCELL19:OUT_F2SERDES.Q0P_HALTGTREQDES6
TCELL19:OUT_F3SERDES.Q0P_HALTGTREQDES5
TCELL19:OUT_F4SERDES.Q0P_HALTGTREQDES4
TCELL19:OUT_F5SERDES.Q0P_HALTGTREQDES3
TCELL19:OUT_F6SERDES.Q0P_HALTGTREQDES2
TCELL19:OUT_F7SERDES.Q0P_HALTGTREQDES1
TCELL19:OUT_Q0SERDES.Q0P_HALTGTREQDES8
TCELL19:OUT_Q1SERDES.Q0P_HALTGTREQDES7
TCELL19:OUT_Q2SERDES.Q0P_HALTGTREQDES0
TCELL19:OUT_Q3SERDES.Q0P_HALTGTREQDES16
TCELL19:OUT_Q4SERDES.Q0P_HALTSTREQATTR2
TCELL19:OUT_Q5SERDES.Q0P_HALTSTREQATTR1
TCELL19:OUT_Q6SERDES.Q0P_HALTSTREQATTR0
TCELL19:OUT_Q7SERDES.Q0P_HALTGTREQMBA5
TCELL20:OUT_F0SERDES.Q0P_HALTGTREQMBA4
TCELL20:OUT_F1SERDES.Q0P_HALTGTREQMBA3
TCELL20:OUT_F2SERDES.Q0P_HALTGTREQMBA2
TCELL20:OUT_F3SERDES.Q0P_HALTGTREQMBA1
TCELL20:OUT_F4SERDES.Q0P_HALTGTREQMBA0
TCELL20:OUT_F5SERDES.Q0P_HALTGTREQTPHTYPE1
TCELL20:OUT_F6SERDES.Q0P_HALTGTREQTPHTYPE0
TCELL20:OUT_F7SERDES.Q0P_HALTGTREQTPHSTTAG7
TCELL20:OUT_Q0SERDES.Q0P_HALTGTREQTPHSTTAG6
TCELL20:OUT_Q1SERDES.Q0P_HALTGTREQTPHSTTAG5
TCELL20:OUT_Q2SERDES.Q0P_HALTGTREQTPHSTTAG4
TCELL20:OUT_Q3SERDES.Q0P_HALTGTREQTPHSTTAG3
TCELL20:OUT_Q4SERDES.Q0P_HALTGTREQTPHSTTAG2
TCELL20:OUT_Q5SERDES.Q0P_HALTGTREQTPHSTTAG1
TCELL20:OUT_Q6SERDES.Q0P_HALTGTREQTPHSTTAG0
TCELL20:OUT_Q7SERDES.Q0P_HALTGTWBVLD7
TCELL21:OUT_F0SERDES.Q0P_HALTGTWBVLD6
TCELL21:OUT_F1SERDES.Q0P_HALTGTWBVLD5
TCELL21:OUT_F2SERDES.Q0P_HALTGTWBVLD4
TCELL21:OUT_F3SERDES.Q0P_HALTGTWBVLD3
TCELL21:OUT_F4SERDES.Q0P_HALTGTWBVLD2
TCELL21:OUT_F5SERDES.Q0P_HALTGTWBVLD1
TCELL21:OUT_F6SERDES.Q0P_HALTGTWBVLD0
TCELL21:OUT_F7SERDES.Q0P_SCANO11
TCELL21:OUT_Q0SERDES.Q0P_HALTGTREQDES9
TCELL21:OUT_Q1SERDES.Q0P_SCANO2
TCELL21:OUT_Q2SERDES.Q0P_SCANO21
TCELL21:OUT_Q3SERDES.Q0P_HALTGTREQDES60
TCELL21:OUT_Q4SERDES.Q0P_HALTGTREQDES81
TCELL21:OUT_Q5SERDES.Q0P_HALTGTREQDES58
TCELL21:OUT_Q6SERDES.Q0P_SCANO18
TCELL21:OUT_Q7SERDES.Q0P_HALTGTREQDES91
TCELL22:OUT_F0SERDES.Q0P_HALTGTREQ
TCELL22:OUT_F1SERDES.Q0P_SCANO1
TCELL22:OUT_F2SERDES.Q0P_INTCO
TCELL22:OUT_F3SERDES.Q0P_HALTGTREQDES126
TCELL22:OUT_F4SERDES.Q0P_HALTGTREQDES76
TCELL22:OUT_F5SERDES.Q0P_HALTGTREQDES35
TCELL22:OUT_F6SERDES.Q0P_INTDO
TCELL22:OUT_F7SERDES.Q0P_HALTGTREQDES120
TCELL22:OUT_Q0SERDES.Q0P_HALTGTREQDES103
TCELL22:OUT_Q1SERDES.Q0P_HALTGTREQDES97
TCELL22:OUT_Q2SERDES.Q0P_HALTGTREQDES57
TCELL22:OUT_Q3SERDES.Q0P_HALTGTREQDES90
TCELL22:OUT_Q4SERDES.Q0P_HALTGTREQDES105
TCELL22:OUT_Q5SERDES.Q0P_HALTGTREQDES61
TCELL22:OUT_Q6SERDES.Q0P_HALTGTREQDES68
TCELL22:OUT_Q7SERDES.Q0P_HALTGTREQDES44
TCELL23:OUT_F0SERDES.Q0P_HALTGTREQDES52
TCELL23:OUT_F1SERDES.Q0P_HALTGTREQDES104
TCELL23:OUT_F2SERDES.Q0P_HALTGTREQDES62
TCELL23:OUT_F3SERDES.Q0P_HALTGTREQDES89
TCELL23:OUT_F4SERDES.Q0P_HALTGTREQDES54
TCELL23:OUT_F5SERDES.Q0P_HALTGTREQDES124
TCELL23:OUT_F6SERDES.Q0P_HALTGTREQDES47
TCELL23:OUT_F7SERDES.Q0P_HALTGTREQDES77
TCELL23:OUT_Q0SERDES.Q0P_HALTGTREQDES102
TCELL23:OUT_Q1SERDES.Q0P_INTAO
TCELL23:OUT_Q2SERDES.Q0P_HALTGTREQDES41
TCELL23:OUT_Q3SERDES.Q0P_HALTGTREQDES31
TCELL23:OUT_Q4SERDES.Q0P_HALTGTREQDES127
TCELL23:OUT_Q5SERDES.Q0P_INTBO
TCELL23:OUT_Q6SERDES.Q0P_HALTGTREQDES21
TCELL23:OUT_Q7SERDES.Q0P_HALTGTREQDES23
TCELL24:OUT_F0SERDES.Q0P_HALTGTREQDES30
TCELL24:OUT_F1SERDES.Q0P_HALTGTREQDES33
TCELL24:OUT_F2SERDES.Q0P_HALTGTREQDES24
TCELL24:OUT_F3SERDES.Q0P_HALTGTREQDES25
TCELL24:OUT_F4SERDES.Q0P_HALTGTREQDES34
TCELL24:OUT_F5SERDES.Q0P_HALTGTREQDES51
TCELL24:OUT_F6SERDES.Q0P_HALTGTREQDES22
TCELL24:OUT_F7SERDES.Q0P_HALTGTREQDES26
TCELL24:OUT_Q0SERDES.Q0P_HALTGTREQDES32
TCELL24:OUT_Q1SERDES.Q0P_HALTGTREQDES43
TCELL24:OUT_Q2SERDES.Q0P_HALTGTREQDES48
TCELL24:OUT_Q3SERDES.Q0P_HALTGTREQDES49
TCELL24:OUT_Q4SERDES.Q0P_HALTGTREQDES111
TCELL24:OUT_Q5SERDES.Q0P_HALTGTREQDES55
TCELL24:OUT_Q6SERDES.Q0P_HALTGTREQDES66
TCELL24:OUT_Q7SERDES.Q0P_HALTGTREQDES93
TCELL29:IMUX_A0SERDES.Q0P_HALTGTCOMPDES9
TCELL29:IMUX_A1SERDES.Q0P_HALTGTCOMPDES10
TCELL29:IMUX_A2SERDES.Q0P_HALTGTCOMPDES11
TCELL29:IMUX_A3SERDES.Q0P_HALTGTCOMPDES13
TCELL29:IMUX_A4SERDES.Q0P_HALTGTCOMPDES14
TCELL29:IMUX_A5SERDES.Q0P_HALTGTCOMPDES16
TCELL29:IMUX_B0SERDES.Q0P_HALTGTCOMPDES17
TCELL29:IMUX_B1SERDES.Q0P_HALTGTCOMPDES22
TCELL29:IMUX_B2SERDES.Q0P_HALTGTCOMPDES23
TCELL29:IMUX_B3SERDES.Q0P_HALTGTCOMPDES24
TCELL29:IMUX_B4SERDES.Q0P_HALTGTCOMPDES25
TCELL29:IMUX_B5SERDES.Q0P_HALTGTCOMPDES26
TCELL29:IMUX_C0SERDES.Q0P_HALTGTCOMPDES27
TCELL29:IMUX_C1SERDES.Q0P_HALTGTCOMPDES28
TCELL29:IMUX_C2SERDES.Q0P_HALTGTCOMPDES29
TCELL29:IMUX_C3SERDES.Q0P_HALTGTCOMPDES30
TCELL29:IMUX_C4SERDES.Q0P_HALTGTCOMPDES31
TCELL29:IMUX_C5SERDES.Q0P_HALTGTCOMPDES32
TCELL29:IMUX_D0SERDES.Q0P_HALTGTCOMPDES33
TCELL29:IMUX_D1SERDES.Q0P_HALTGTCOMPDES59
TCELL29:IMUX_D2SERDES.Q0P_HALTGTCOMPDES61
TCELL29:IMUX_D3SERDES.Q0P_HALTGTCOMPDES62
TCELL29:IMUX_D4SERDES.Q0P_HALTGTCOMPDES63
TCELL29:IMUX_D5SERDES.Q0P_HALTGTCOMPDES127
TCELL29:IMUX_LSR0SERDES.Q0P_MBISTMODE
TCELL29:IMUX_LSR1SERDES.Q0P_SCANRSTN
TCELL29:IMUX_CLK0_DELAYSERDES.Q0P_SCANCLK
TCELL29:IMUX_CLK1_DELAYSERDES.Q0P_MBISTCLK
TCELL29:IMUX_CE0SERDES.Q0P_SCANI19
TCELL29:IMUX_CE1SERDES.Q0P_SCANI9
TCELL29:IMUX_CE2SERDES.Q0P_SCANI10
TCELL29:IMUX_CE3SERDES.Q0P_SCANI20
TCELL29:OUT_F0SERDES.Q0P_HALTGTREQDES20
TCELL29:OUT_F1SERDES.Q0P_HALTGTREQDES96
TCELL29:OUT_F2SERDES.Q0P_HALTGTREQDES95
TCELL29:OUT_F3SERDES.Q0P_HALTGTREQDES125
TCELL29:OUT_F4SERDES.Q0P_HALTGTREQDES101
TCELL29:OUT_F5SERDES.Q0P_HALTGTREQDES99
TCELL29:OUT_F6SERDES.Q0P_HALTGTREQDES80
TCELL29:OUT_F7SERDES.Q0P_HALTGTREQDES56
TCELL29:OUT_Q0SERDES.Q0P_HALTGTREQDES69
TCELL29:OUT_Q1SERDES.Q0P_HALTGTREQDES78
TCELL29:OUT_Q2SERDES.Q0P_HALTGTREQDES110
TCELL29:OUT_Q3SERDES.Q0P_HALTGTREQDES84
TCELL29:OUT_Q4SERDES.Q0P_HALTGTREQDES73
TCELL29:OUT_Q5SERDES.Q0P_HALTGTREQDES70
TCELL29:OUT_Q6SERDES.Q0P_HALTGTREQDES106
TCELL29:OUT_Q7SERDES.Q0P_HALTGTREQDES87
TCELL30:IMUX_A0SERDES.Q0P_HALTGTCOMPDES64
TCELL30:IMUX_A1SERDES.Q0P_HALTGTCOMPDES65
TCELL30:IMUX_A2SERDES.Q0P_HALTGTCOMPDES66
TCELL30:IMUX_A3SERDES.Q0P_HALTGTCOMPDES67
TCELL30:IMUX_A4SERDES.Q0P_HALTGTCOMPDES69
TCELL30:IMUX_A5SERDES.Q0P_HALTGTCOMPDES71
TCELL30:IMUX_B0SERDES.Q0P_HALTGTCOMPDES72
TCELL30:IMUX_B1SERDES.Q0P_HALTGTCOMPDES73
TCELL30:IMUX_B2SERDES.Q0P_HALTGTCOMPDES74
TCELL30:IMUX_B3SERDES.Q0P_HALTGTCOMPDES77
TCELL30:IMUX_B4SERDES.Q0P_HALTGTCOMPDES78
TCELL30:IMUX_B5SERDES.Q0P_HALTGTCOMPDES79
TCELL30:IMUX_C0SERDES.Q0P_HALTGTCLNTCOMPIDEN
TCELL30:IMUX_C1SERDES.Q0P_HALTGTCOMPDES121
TCELL30:IMUX_C2SERDES.Q0P_HALTGTCOMPDES80
TCELL30:IMUX_C3SERDES.Q0P_HALTGTCOMPDES81
TCELL30:IMUX_C4SERDES.Q0P_HALTGTCOMPDES102
TCELL30:IMUX_C5SERDES.Q0P_HALTGTCOMPDES95
TCELL30:IMUX_D0SERDES.Q0P_HALTGTCOMPDES94
TCELL30:IMUX_D1SERDES.Q0P_HALTGTCOMPDES99
TCELL30:IMUX_D2SERDES.Q0P_HALTGTCOMPDES103
TCELL30:IMUX_D3SERDES.Q0P_HALTGTCOMPDES125
TCELL30:IMUX_D4SERDES.Q0P_HALTGTCOMPDES96
TCELL30:IMUX_D5SERDES.Q0P_HALTGTCOMPDES126
TCELL30:IMUX_LSR0SERDES.Q0P_SCANMODE
TCELL30:IMUX_LSR1SERDES.Q0P_MBISTRSTN
TCELL30:IMUX_CE0SERDES.Q0P_SCANI24
TCELL30:IMUX_CE1SERDES.Q0P_SCANI0
TCELL30:IMUX_CE2SERDES.Q0P_SCANI11
TCELL30:IMUX_CE3SERDES.Q0P_SCANI17
TCELL30:OUT_F0SERDES.Q0P_HALTGTREQDES82
TCELL30:OUT_F1SERDES.Q0P_HALTGTREQDES75
TCELL30:OUT_F2SERDES.Q0P_HALTGTREQDES109
TCELL30:OUT_F3SERDES.Q0P_HALTGTREQDES85
TCELL30:OUT_F4SERDES.Q0P_HALTGTREQDES74
TCELL30:OUT_F5SERDES.Q0P_HALTGTREQDES71
TCELL30:OUT_F6SERDES.Q0P_HALTGTREQDES98
TCELL30:OUT_F7SERDES.Q0P_HALTGTREQDES83
TCELL30:OUT_Q0SERDES.Q0P_HALTGTREQDES79
TCELL30:OUT_Q1SERDES.Q0P_HALTGTREQDES121
TCELL30:OUT_Q2SERDES.Q0P_HALTGTREQDES67
TCELL30:OUT_Q3SERDES.Q0P_HALTGTREQDES100
TCELL30:OUT_Q4SERDES.Q0P_HALTGTREQDES65
TCELL30:OUT_Q5SERDES.Q0P_HALTGTREQDES88
TCELL30:OUT_Q6SERDES.Q0P_HALTGTREQDES72
TCELL30:OUT_Q7SERDES.Q0P_HALTGTREQDES94
TCELL31:IMUX_A0SERDES.Q0P_HALTGTCOMPDES101
TCELL31:IMUX_A1SERDES.Q0P_HALTGTCOMPDES86
TCELL31:IMUX_A2SERDES.Q0P_HALTGTCOMPDES85
TCELL31:IMUX_A3SERDES.Q0P_HALTGTCOMPDES90
TCELL31:IMUX_A4SERDES.Q0P_HALTGTCOMPDES92
TCELL31:IMUX_A5SERDES.Q0P_HALTGTCOMPDES100
TCELL31:IMUX_B0SERDES.Q0P_HALTGTCOMPDES98
TCELL31:IMUX_B1SERDES.Q0P_HALTGTCOMPDES122
TCELL31:IMUX_B2SERDES.Q0P_HALTGTCOMPDES108
TCELL31:IMUX_B3SERDES.Q0P_HALTGTCOMPDES123
TCELL31:IMUX_B4SERDES.Q0P_HALTGTCOMPDES124
TCELL31:IMUX_B5SERDES.Q0P_HALTGTCOMPDES118
TCELL31:IMUX_C0SERDES.Q0P_HALTGTCOMPDES116
TCELL31:IMUX_C1SERDES.Q0P_HALTGTCOMPDES115
TCELL31:IMUX_C2SERDES.Q0P_HALTGTCOMPDES93
TCELL31:IMUX_C3SERDES.Q0P_HALTGTCOMPDES104
TCELL31:IMUX_C4SERDES.Q0P_HALTGTCOMPDES84
TCELL31:IMUX_C5SERDES.Q0P_HALTGTCOMPDES105
TCELL31:IMUX_D0SERDES.Q0P_HALTGTCOMPDES83
TCELL31:IMUX_D1SERDES.Q0P_HALTGTCOMPDES107
TCELL31:IMUX_D2SERDES.Q0P_HALTGTCOMPDES120
TCELL31:IMUX_D3SERDES.Q0P_HALTGTCOMPDES89
TCELL31:IMUX_D4SERDES.Q0P_HALTGTCOMPDES87
TCELL31:IMUX_D5SERDES.Q0P_HALTGTCOMPDES91
TCELL31:IMUX_LSR0SERDES.Q0P_RSTN
TCELL31:IMUX_LSR1SERDES.Q0P_SCANENA
TCELL31:IMUX_CE0SERDES.Q0P_SCANI8
TCELL31:IMUX_CE1SERDES.Q0P_SCANI12
TCELL31:IMUX_CE2SERDES.Q0P_SCANI18
TCELL31:IMUX_CE3SERDES.Q0P_SCANI7
TCELL31:OUT_F0SERDES.Q0P_HALTGTREQDES64
TCELL31:OUT_F1SERDES.Q0P_HALTGTREQDES63
TCELL31:OUT_F2SERDES.Q0P_HALTGTREQDES86
TCELL31:OUT_F3SERDES.Q0P_HALTGTREQDES92
TCELL31:OUT_F4SERDES.Q0P_HALTGTREQDES53
TCELL31:OUT_F5SERDES.Q0P_HALTGTREQDES50
TCELL31:OUT_F6SERDES.Q0P_HALTGTREQDES28
TCELL31:OUT_F7SERDES.Q0P_HALTGTREQDES29
TCELL31:OUT_Q0SERDES.Q0P_HALTGTREQDES123
TCELL31:OUT_Q1SERDES.Q0P_HALTGTREQDES59
TCELL31:OUT_Q2SERDES.Q0P_HALTGTREQDES46
TCELL31:OUT_Q3SERDES.Q0P_HALTGTREQDES45
TCELL31:OUT_Q4SERDES.Q0P_HALTGTREQDES27
TCELL31:OUT_Q5SERDES.Q0P_HALTGTREQDES122
TCELL31:OUT_Q6SERDES.Q0P_HALTGTREQDES42
TCELL31:OUT_Q7SERDES.Q0P_SCANO22
TCELL32:IMUX_A0SERDES.Q0P_HALTGTCOMPDES113
TCELL32:IMUX_A1SERDES.Q0P_HALTGTCOMPDES114
TCELL32:IMUX_A2SERDES.Q0P_HALTGTCOMPDES88
TCELL32:IMUX_A3SERDES.Q0P_HALTGTCOMPDES117
TCELL32:IMUX_A4SERDES.Q0P_HALTGTCOMPDES97
TCELL32:IMUX_A5SERDES.Q0P_HALTGTCOMPDES112
TCELL32:IMUX_B0SERDES.Q0P_HALTGTCOMPDES82
TCELL32:IMUX_B1SERDES.Q0P_HALTGTCOMPDES76
TCELL32:IMUX_B2SERDES.Q0P_HALTGTCOMPDES109
TCELL32:IMUX_B3SERDES.Q0P_HALTGTCOMPDES111
TCELL32:IMUX_B4SERDES.Q0P_HALTGTCOMPDES75
TCELL32:IMUX_B5SERDES.Q0P_HALTGTCOMPDES110
TCELL32:IMUX_C0SERDES.Q0P_HALTGTCOMPDES106
TCELL32:IMUX_C1SERDES.Q0P_HALTGTCOMPDES70
TCELL32:IMUX_C2SERDES.Q0P_HALTGTCOMPDES60
TCELL32:IMUX_C3SERDES.Q0P_HALTGTCOMPDES58
TCELL32:IMUX_C4SERDES.Q0P_HALTGTCOMPDES57
TCELL32:IMUX_C5SERDES.Q0P_HALTGTCOMPDES56
TCELL32:IMUX_D0SERDES.Q0P_HALTGTCOMPDES55
TCELL32:IMUX_D1SERDES.Q0P_HALTGTCOMPDES54
TCELL32:IMUX_D2SERDES.Q0P_HALTGTCOMPDES53
TCELL32:IMUX_D3SERDES.Q0P_HALTGTCOMPDES52
TCELL32:IMUX_D4SERDES.Q0P_HALTGTCOMPDES51
TCELL32:IMUX_D5SERDES.Q0P_HALTGTCOMPDES50
TCELL32:IMUX_LSR0SERDES.Q0P_HOTRSTIN
TCELL32:IMUX_CE0SERDES.Q0P_SCANI6
TCELL32:IMUX_CE1SERDES.Q0P_SCANI26
TCELL32:IMUX_CE2SERDES.Q0P_SCANI25
TCELL32:IMUX_CE3SERDES.Q0P_SCANI2
TCELL32:OUT_F0SERDES.Q0P_HALMSTWRDY
TCELL32:OUT_F1SERDES.Q0P_HALTGTREQDES40
TCELL32:OUT_F2SERDES.Q0P_SCANO14
TCELL32:OUT_F3SERDES.Q0P_HALTGTREQDES36
TCELL32:OUT_F4SERDES.Q0P_HALTGTREQDES38
TCELL32:OUT_F5SERDES.Q0P_PWRSTATECHNGINT
TCELL32:OUT_F6SERDES.Q0P_HALTGTREQDES37
TCELL32:OUT_F7SERDES.Q0P_HALMSTCOMPDES116
TCELL32:OUT_Q0SERDES.Q0P_HALMSTCOMPDES115
TCELL32:OUT_Q1SERDES.Q0P_HALMSTCOMPDES117
TCELL32:OUT_Q2SERDES.Q0P_HALMSTCOMPDES114
TCELL32:OUT_Q3SERDES.Q0P_HALMSTCOMPDES113
TCELL32:OUT_Q4SERDES.Q0P_HALMSTCOMPDES118
TCELL32:OUT_Q5SERDES.Q0P_SCANO19
TCELL32:OUT_Q6SERDES.Q0P_HALMSTCOMPDES109
TCELL32:OUT_Q7SERDES.Q0P_HALMSTCOMPDES112
TCELL33:IMUX_A0SERDES.Q0P_HALTGTCOMPDES49
TCELL33:IMUX_A1SERDES.Q0P_HALTGTCOMPDES48
TCELL33:IMUX_A2SERDES.Q0P_HALTGTCOMPDES47
TCELL33:IMUX_A3SERDES.Q0P_HALTGTCOMPDES46
TCELL33:IMUX_A4SERDES.Q0P_HALTGTCOMPDES45
TCELL33:IMUX_A5SERDES.Q0P_HALTGTCOMPDES44
TCELL33:IMUX_B0SERDES.Q0P_HALTGTCOMPDES43
TCELL33:IMUX_B1SERDES.Q0P_HALTGTCOMPDES42
TCELL33:IMUX_B2SERDES.Q0P_HALTGTCOMPDES41
TCELL33:IMUX_B3SERDES.Q0P_HALTGTCOMPDES40
TCELL33:IMUX_B4SERDES.Q0P_HALTGTCOMPDES39
TCELL33:IMUX_B5SERDES.Q0P_HALTGTCOMPDES38
TCELL33:IMUX_C0SERDES.Q0P_HALTGTCOMPDES37
TCELL33:IMUX_C1SERDES.Q0P_HALTGTCOMPDES36
TCELL33:IMUX_C2SERDES.Q0P_HALTGTCOMPDES35
TCELL33:IMUX_C3SERDES.Q0P_HALTGTCOMPDES34
TCELL33:IMUX_C4SERDES.Q0P_HALTGTCOMPDES21
TCELL33:IMUX_C5SERDES.Q0P_HALTGTCOMPDES68
TCELL33:IMUX_D0SERDES.Q0P_HALTGTCOMPDES20
TCELL33:IMUX_D1SERDES.Q0P_HALTGTCOMPDES19
TCELL33:IMUX_D2SERDES.Q0P_HALTGTCOMPDES18
TCELL33:IMUX_D3SERDES.Q0P_HALTGTCOMPDES15
TCELL33:IMUX_D4SERDES.Q0P_HALTGTCOMPDES12
TCELL33:IMUX_D5SERDES.Q0P_HALTGTCOMPDES8
TCELL33:IMUX_CE0SERDES.Q0P_SCANI16
TCELL33:IMUX_CE1SERDES.Q0P_SCANI14
TCELL33:IMUX_CE2SERDES.Q0P_SCANI21
TCELL33:IMUX_CE3SERDES.Q0P_SCANI1
TCELL33:OUT_F0SERDES.Q0P_HALMSTCOMPDES108
TCELL33:OUT_F1SERDES.Q0P_HALMSTCOMPDES110
TCELL33:OUT_F2SERDES.Q0P_HALMSTCOMPDES107
TCELL33:OUT_F3SERDES.Q0P_HALMSTCOMPDES126
TCELL33:OUT_F4SERDES.Q0P_HALMSTCOMPDES125
TCELL33:OUT_F5SERDES.Q0P_HALMSTCOMPDES111
TCELL33:OUT_F6SERDES.Q0P_HALMSTCOMPDES127
TCELL33:OUT_F7SERDES.Q0P_HALMSTCOMPDES119
TCELL33:OUT_Q0SERDES.Q0P_HALMSTCOMPDES79
TCELL33:OUT_Q1SERDES.Q0P_HALMSTCOMPDES104
TCELL33:OUT_Q2SERDES.Q0P_HALMSTCOMPDES102
TCELL33:OUT_Q3SERDES.Q0P_HALMSTCOMPDES101
TCELL33:OUT_Q4SERDES.Q0P_HALMSTCOMPDES103
TCELL33:OUT_Q5SERDES.Q0P_HALMSTCOMPDES76
TCELL33:OUT_Q6SERDES.Q0P_HALMSTCOMPDES67
TCELL33:OUT_Q7SERDES.Q0P_HALMSTCOMPDES72
TCELL34:IMUX_A0SERDES.Q0P_HALTGTCOMPDES7
TCELL34:IMUX_A1SERDES.Q0P_HALTGTCOMPDES6
TCELL34:IMUX_A2SERDES.Q0P_HALTGTCOMPDES5
TCELL34:IMUX_A3SERDES.Q0P_HALTGTCOMPDES4
TCELL34:IMUX_A4SERDES.Q0P_HALTGTCOMPDES3
TCELL34:IMUX_A5SERDES.Q0P_HALTGTCOMPDES2
TCELL34:IMUX_B0SERDES.Q0P_HALTGTCOMPDES1
TCELL34:IMUX_B1SERDES.Q0P_HALTGTCOMPDES0
TCELL34:IMUX_B2SERDES.Q0P_HALTGTCOMPBVLD7
TCELL34:IMUX_B3SERDES.Q0P_HALTGTCOMPBVLD6
TCELL34:IMUX_B4SERDES.Q0P_HALTGTCOMPBVLD5
TCELL34:IMUX_B5SERDES.Q0P_HALTGTCOMPBVLD4
TCELL34:IMUX_C0SERDES.Q0P_HALTGTCOMPBVLD3
TCELL34:IMUX_C1SERDES.Q0P_HALTGTCOMPBVLD2
TCELL34:IMUX_C2SERDES.Q0P_HALTGTCOMPBVLD1
TCELL34:IMUX_C3SERDES.Q0P_HALTGTCOMPBVLD0
TCELL34:IMUX_C4SERDES.Q0P_HALTGTCLNTCOMPID15
TCELL34:IMUX_C5SERDES.Q0P_HALTGTCLNTCOMPID14
TCELL34:IMUX_D0SERDES.Q0P_HALTGTCLNTCOMPID13
TCELL34:IMUX_D1SERDES.Q0P_HALTGTCLNTCOMPID12
TCELL34:IMUX_D2SERDES.Q0P_HALTGTCLNTCOMPID11
TCELL34:IMUX_D3SERDES.Q0P_HALTGTCLNTCOMPID10
TCELL34:IMUX_D4SERDES.Q0P_HALTGTCLNTCOMPID9
TCELL34:IMUX_D5SERDES.Q0P_HALTGTCLNTCOMPID8
TCELL34:IMUX_CE0SERDES.Q0P_SCANI13
TCELL34:IMUX_CE1SERDES.Q0P_SCANI3
TCELL34:IMUX_CE2SERDES.Q0P_SCANI15
TCELL34:IMUX_CE3SERDES.Q0P_SCANI23
TCELL34:OUT_F0SERDES.Q0P_HALMSTCOMPDES75
TCELL34:OUT_F1SERDES.Q0P_HALMSTCOMPDES105
TCELL34:OUT_F2SERDES.Q0P_HALMSTCOMPDES70
TCELL34:OUT_F3SERDES.Q0P_HALMSTCOMPDES74
TCELL34:OUT_F4SERDES.Q0P_HALMSTCOMPDES106
TCELL34:OUT_F5SERDES.Q0P_SCANO8
TCELL34:OUT_F6SERDES.Q0P_HALMSTCOMPDES73
TCELL34:OUT_F7SERDES.Q0P_HALMSTCOMPDES71
TCELL34:OUT_Q0SERDES.Q0P_HALTGTREQDES39
TCELL34:OUT_Q1SERDES.Q0P_HALMSTCOMPDES68
TCELL34:OUT_Q2SERDES.Q0P_HALMSTCOMPDES91
TCELL34:OUT_Q3SERDES.Q0P_HALMSTCOMPDES93
TCELL34:OUT_Q4SERDES.Q0P_HALMSTCOMPDES66
TCELL34:OUT_Q5SERDES.Q0P_HALMSTCOMPDES90
TCELL34:OUT_Q6SERDES.Q0P_SCANO5
TCELL34:OUT_Q7SERDES.Q0P_HALMSTCOMPDES64
TCELL35:IMUX_A0SERDES.Q0P_HALTGTCLNTCOMPID7
TCELL35:IMUX_A1SERDES.Q0P_HALTGTCLNTCOMPID6
TCELL35:IMUX_A2SERDES.Q0P_HALTGTCLNTCOMPID5
TCELL35:IMUX_A3SERDES.Q0P_HALTGTCLNTCOMPID4
TCELL35:IMUX_A4SERDES.Q0P_HALTGTCLNTCOMPID3
TCELL35:IMUX_A5SERDES.Q0P_HALTGTCLNTCOMPID2
TCELL35:IMUX_B0SERDES.Q0P_HALTGTCLNTCOMPID1
TCELL35:IMUX_B1SERDES.Q0P_HALTGTCLNTCOMPID0
TCELL35:IMUX_B2SERDES.Q0P_HALTGTCAREQDES106
TCELL35:IMUX_B3SERDES.Q0P_HALTGTCAREQDES105
TCELL35:IMUX_B4SERDES.Q0P_HALTGTCAREQDES104
TCELL35:IMUX_B5SERDES.Q0P_HALTGTCAREQDES98
TCELL35:IMUX_C0SERDES.Q0P_HALTGTCAREQDES97
TCELL35:IMUX_C1SERDES.Q0P_HALTGTCAREQDES96
TCELL35:IMUX_C2SERDES.Q0P_HALTGTCAREQDES94
TCELL35:IMUX_C3SERDES.Q0P_HALTGTCAREQDES93
TCELL35:IMUX_C4SERDES.Q0P_HALTGTCAREQDES92
TCELL35:IMUX_C5SERDES.Q0P_HALTGTCAREQDES91
TCELL35:IMUX_D0SERDES.Q0P_HALTGTCAREQDES90
TCELL35:IMUX_D1SERDES.Q0P_HALTGTCAREQDES89
TCELL35:IMUX_D2SERDES.Q0P_HALTGTCAREQDES88
TCELL35:IMUX_D3SERDES.Q0P_HALTGTCAREQDES87
TCELL35:IMUX_D4SERDES.Q0P_HALTGTCAREQDES85
TCELL35:IMUX_D5SERDES.Q0P_HALTGTCAREQDES121
TCELL35:IMUX_CE0SERDES.Q0P_SCANI22
TCELL35:IMUX_CE1SERDES.Q0P_SCANI4
TCELL35:IMUX_CE2SERDES.Q0P_SCANI5
TCELL35:OUT_F0SERDES.Q0P_HALMSTCOMPDES94
TCELL35:OUT_F1SERDES.Q0P_HALMSTCOMPDES92
TCELL35:OUT_F2SERDES.Q0P_HALMSTCOMPDES69
TCELL35:OUT_F3SERDES.Q0P_HALMSTCOMPDES65
TCELL35:OUT_F4SERDES.Q0P_HALMSTCOMPDES95
TCELL35:OUT_F5SERDES.Q0P_MSIVECCNT1
TCELL35:OUT_F6SERDES.Q0P_HALMSTCOMPDES89
TCELL35:OUT_F7SERDES.Q0P_HALMSTCOMPDES88
TCELL35:OUT_Q0SERDES.Q0P_HALMSTCOMPDES77
TCELL35:OUT_Q1SERDES.Q0P_MSIVECCNT2
TCELL35:OUT_Q2SERDES.Q0P_HALMSTCOMPDES78
TCELL35:OUT_Q3SERDES.Q0P_MSIVECCNT0
TCELL35:OUT_Q4SERDES.Q0P_SCANO7
TCELL35:OUT_Q5SERDES.Q0P_INTACK
TCELL35:OUT_Q6SERDES.Q0P_MSIEN
TCELL35:OUT_Q7SERDES.Q0P_SCANO9
TCELL36:IMUX_A2SERDES.Q0P_HALTGTCAREQDES84
TCELL36:IMUX_A3SERDES.Q0P_HALTGTCAREQDES80
TCELL36:IMUX_A4SERDES.Q0P_HALTGTCAREQDES79
TCELL36:IMUX_A5SERDES.Q0P_HALTGTCAREQDES78
TCELL36:IMUX_B2SERDES.Q0P_HALTGTCAREQDES77
TCELL36:IMUX_B3SERDES.Q0P_HALTGTCAREQDES76
TCELL36:IMUX_B4SERDES.Q0P_HALTGTCAREQDES75
TCELL36:IMUX_B5SERDES.Q0P_HALTGTCAREQDES74
TCELL36:IMUX_C2SERDES.Q0P_HALTGTCAREQDES99
TCELL36:IMUX_C3SERDES.Q0P_HALTGTCAREQDES86
TCELL36:IMUX_C4SERDES.Q0P_HALTGTCAREQDES73
TCELL36:IMUX_C5SERDES.Q0P_HALTGTCAREQDES72
TCELL36:IMUX_D2SERDES.Q0P_HALTGTCAREQDES71
TCELL36:IMUX_D3SERDES.Q0P_HALTGTCAREQDES70
TCELL36:IMUX_D4SERDES.Q0P_HALTGTCAREQDES69
TCELL36:IMUX_D5SERDES.Q0P_HALTGTCAREQDES68
TCELL36:OUT_F2SERDES.Q0P_HALMSTRBVLD4
TCELL36:OUT_F3SERDES.Q0P_HALMSTRBVLD3
TCELL36:OUT_F4SERDES.Q0P_HALMSTCOMPDES85
TCELL36:OUT_F5SERDES.Q0P_HALMSTCOMPDES120
TCELL36:OUT_F6SERDES.Q0P_HALMSTCOMPDES84
TCELL36:OUT_F7SERDES.Q0P_HALMSTCOMPDES87
TCELL36:OUT_Q2SERDES.Q0P_HALMSTCOMPDES86
TCELL36:OUT_Q3SERDES.Q0P_HALMSTRBVLD1
TCELL36:OUT_Q4SERDES.Q0P_HALMSTRBVLD7
TCELL36:OUT_Q5SERDES.Q0P_HALMSTRBVLD6
TCELL36:OUT_Q6SERDES.Q0P_HALMSTCOMPVLD
TCELL36:OUT_Q7SERDES.Q0P_HALMSTCOMPSOP
TCELL37:IMUX_A0SERDES.Q0P_HALTGTCAREQDES82
TCELL37:IMUX_A1SERDES.Q0P_HALTGTCAREQDES67
TCELL37:IMUX_A2SERDES.Q0P_HALTGTCAREQDES66
TCELL37:IMUX_A3SERDES.Q0P_HALTGTCAREQDES65
TCELL37:IMUX_A4SERDES.Q0P_HALTGTCAREQDES64
TCELL37:IMUX_A5SERDES.Q0P_HALTGTCAREQDES63
TCELL37:IMUX_B0SERDES.Q0P_HALTGTCAREQDES62
TCELL37:IMUX_B1SERDES.Q0P_HALTGTCAREQDES83
TCELL37:IMUX_B2SERDES.Q0P_HALTGTCAREQDES61
TCELL37:IMUX_B3SERDES.Q0P_HALTGTCAREQDES60
TCELL37:IMUX_B4SERDES.Q0P_HALTGTCAREQDES95
TCELL37:IMUX_B5SERDES.Q0P_HALTGTCAREQDES59
TCELL37:IMUX_C0SERDES.Q0P_HALTGTCAREQDES58
TCELL37:IMUX_C1SERDES.Q0P_HALTGTCAREQDES57
TCELL37:IMUX_C2SERDES.Q0P_HALTGTCAREQDES56
TCELL37:IMUX_C3SERDES.Q0P_HALTGTCAREQDES55
TCELL37:IMUX_C4SERDES.Q0P_HALTGTCAREQDES54
TCELL37:IMUX_C5SERDES.Q0P_HALTGTCAREQDES53
TCELL37:IMUX_D0SERDES.Q0P_HALTGTCAREQDES52
TCELL37:IMUX_D1SERDES.Q0P_HALTGTCAREQDES100
TCELL37:IMUX_D2SERDES.Q0P_HALTGTCAREQDES51
TCELL37:IMUX_D3SERDES.Q0P_HALTGTCAREQDES50
TCELL37:IMUX_D4SERDES.Q0P_HALTGTCAREQDES49
TCELL37:IMUX_D5SERDES.Q0P_HALTGTCAREQDES48
TCELL37:OUT_F0SERDES.Q0P_HALMSTRBVLD0
TCELL37:OUT_F1SERDES.Q0P_HALMSTCOMPDES0
TCELL37:OUT_F2SERDES.Q0P_HALMSTCOMPDES83
TCELL37:OUT_F3SERDES.Q0P_HALMSTCOMPEOP
TCELL37:OUT_F4SERDES.Q0P_HALMSTCOMPDES1
TCELL37:OUT_F5SERDES.Q0P_HALMSTRBVLD5
TCELL37:OUT_F6SERDES.Q0P_HALMSTCOMPDES80
TCELL37:OUT_F7SERDES.Q0P_HALMSTCOMPDES100
TCELL37:OUT_Q0SERDES.Q0P_HALMSTCOMPDES2
TCELL37:OUT_Q1SERDES.Q0P_SCANO6
TCELL37:OUT_Q2SERDES.Q0P_HALMSTRBVLD2
TCELL37:OUT_Q3SERDES.Q0P_HALMSTCOMPDES81
TCELL37:OUT_Q4SERDES.Q0P_HALMSTCOMPDES99
TCELL37:OUT_Q5SERDES.Q0P_HALMSTCOMPDES30
TCELL37:OUT_Q6SERDES.Q0P_HALMSTCOMPDES96
TCELL37:OUT_Q7SERDES.Q0P_HALMSTCOMPDES38
TCELL38:IMUX_A0SERDES.Q0P_HALTGTCAREQDES81
TCELL38:IMUX_A1SERDES.Q0P_HALTGTCAREQDES101
TCELL38:IMUX_A2SERDES.Q0P_HALTGTCAREQDES47
TCELL38:IMUX_A3SERDES.Q0P_HALTGTCAREQDES46
TCELL38:IMUX_A4SERDES.Q0P_HALTGTCAREQDES45
TCELL38:IMUX_A5SERDES.Q0P_HALTGTCAREQDES44
TCELL38:IMUX_B0SERDES.Q0P_HALTGTCAREQDES43
TCELL38:IMUX_B1SERDES.Q0P_HALTGTCAREQDES42
TCELL38:IMUX_B2SERDES.Q0P_HALTGTCAREQDES41
TCELL38:IMUX_B3SERDES.Q0P_HALTGTCAREQDES40
TCELL38:IMUX_B4SERDES.Q0P_HALTGTCAREQDES39
TCELL38:IMUX_B5SERDES.Q0P_HALTGTCAREQDES38
TCELL38:IMUX_C0SERDES.Q0P_HALTGTCAREQDES37
TCELL38:IMUX_C1SERDES.Q0P_HALTGTCAREQDES102
TCELL38:IMUX_C2SERDES.Q0P_HALTGTCAREQDES103
TCELL38:IMUX_C3SERDES.Q0P_HALTGTCAREQDES36
TCELL38:IMUX_C4SERDES.Q0P_HALTGTCAREQDES35
TCELL38:IMUX_C5SERDES.Q0P_HALTGTCAREQDES34
TCELL38:IMUX_D0SERDES.Q0P_HALTGTCAREQDES33
TCELL38:IMUX_D1SERDES.Q0P_HALTGTCAREQDES32
TCELL38:IMUX_D2SERDES.Q0P_HALTGTCAREQDES31
TCELL38:IMUX_D3SERDES.Q0P_HALTGTCAREQDES30
TCELL38:IMUX_D4SERDES.Q0P_HALTGTCAREQDES29
TCELL38:IMUX_D5SERDES.Q0P_HALTGTCAREQDES28
TCELL38:OUT_F0SERDES.Q0P_HALMSTCOMPDES97
TCELL38:OUT_F1SERDES.Q0P_HALMSTCOMPDES98
TCELL38:OUT_F2SERDES.Q0P_HALMSTCOMPDES82
TCELL38:OUT_F3SERDES.Q0P_HALMSTCOMPDES32
TCELL38:OUT_F4SERDES.Q0P_HALMSTCOMPDES55
TCELL38:OUT_F5SERDES.Q0P_HALMSTCOMPDES37
TCELL38:OUT_F6SERDES.Q0P_HALMSTCOMPDES123
TCELL38:OUT_F7SERDES.Q0P_HALMSTCOMPDES33
TCELL38:OUT_Q0SERDES.Q0P_HALMSTCOMPDES11
TCELL38:OUT_Q1SERDES.Q0P_HALMSTCOMPDES3
TCELL38:OUT_Q2SERDES.Q0P_HALMSTCOMPDES5
TCELL38:OUT_Q3SERDES.Q0P_HALMSTCOMPDES34
TCELL38:OUT_Q4SERDES.Q0P_HALMSTCOMPDES48
TCELL38:OUT_Q5SERDES.Q0P_HALMSTCOMPDES122
TCELL38:OUT_Q6SERDES.Q0P_HALMSTCOMPDES4
TCELL38:OUT_Q7SERDES.Q0P_HALMSTCOMPDES14
TCELL39:IMUX_A0SERDES.Q0P_HALTGTCAREQDES27
TCELL39:IMUX_A1SERDES.Q0P_HALTGTCAREQDES26
TCELL39:IMUX_A2SERDES.Q0P_HALTGTCAREQDES25
TCELL39:IMUX_A3SERDES.Q0P_HALTGTCAREQDES24
TCELL39:IMUX_B0SERDES.Q0P_HALTGTCAREQDES23
TCELL39:IMUX_B1SERDES.Q0P_HALTGTCAREQDES22
TCELL39:IMUX_B2SERDES.Q0P_HALTGTCAREQDES21
TCELL39:IMUX_B3SERDES.Q0P_HALTGTCAREQDES20
TCELL39:IMUX_C0SERDES.Q0P_HALTGTCAREQDES19
TCELL39:IMUX_C1SERDES.Q0P_HALTGTCAREQDES18
TCELL39:IMUX_C2SERDES.Q0P_HALTGTCAREQDES17
TCELL39:IMUX_C3SERDES.Q0P_HALTGTCAREQDES16
TCELL39:IMUX_D0SERDES.Q0P_HALTGTCAREQDES15
TCELL39:IMUX_D1SERDES.Q0P_HALTGTCAREQDES14
TCELL39:IMUX_D2SERDES.Q0P_HALTGTCAREQDES13
TCELL39:IMUX_D3SERDES.Q0P_HALTGTCAREQDES12
TCELL39:OUT_F0SERDES.Q0P_HALMSTCOMPDES6
TCELL39:OUT_F1SERDES.Q0P_HALMSTCOMPDES121
TCELL39:OUT_F2SERDES.Q0P_HALMSTCOMPDES63
TCELL39:OUT_F3SERDES.Q0P_HALMSTCOMPDES60
TCELL39:OUT_F6SERDES.Q0P_HALMSTCOMPDES50
TCELL39:OUT_F7SERDES.Q0P_HALMSTCOMPDES51
TCELL39:OUT_Q0SERDES.Q0P_HALMSTCOMPDES59
TCELL39:OUT_Q1SERDES.Q0P_HALMSTCOMPDES36
TCELL39:OUT_Q2SERDES.Q0P_HALMSTCOMPDES47
TCELL39:OUT_Q3SERDES.Q0P_HALMSTCOMPDES35
TCELL39:OUT_Q6SERDES.Q0P_HALMSTCOMPDES15
TCELL39:OUT_Q7SERDES.Q0P_HALMSTCOMPDES13
TCELL40:IMUX_A0SERDES.Q0P_HALTGTCAREQDES11
TCELL40:IMUX_A1SERDES.Q0P_HALTGTCAREQDES10
TCELL40:IMUX_A2SERDES.Q0P_HALTGTCAREQDES9
TCELL40:IMUX_A3SERDES.Q0P_HALTGTCAREQDES8
TCELL40:IMUX_A4SERDES.Q0P_HALTGTCAREQDES7
TCELL40:IMUX_A5SERDES.Q0P_HALTGTCAREQDES6
TCELL40:IMUX_B0SERDES.Q0P_HALTGTCAREQDES5
TCELL40:IMUX_B1SERDES.Q0P_HALTGTCAREQDES4
TCELL40:IMUX_B2SERDES.Q0P_HALTGTCAREQDES3
TCELL40:IMUX_B3SERDES.Q0P_HALTGTCAREQDES2
TCELL40:IMUX_B4SERDES.Q0P_HALTGTCAREQDES1
TCELL40:IMUX_B5SERDES.Q0P_HALTGTACK
TCELL40:IMUX_C0SERDES.Q0P_HALTGTWRDY
TCELL40:IMUX_C1SERDES.Q0P_HALTGTCAREQDES0
TCELL40:IMUX_C2SERDES.Q0P_HALMSTREQDES124
TCELL40:IMUX_C3SERDES.Q0P_HALMSTREQDES123
TCELL40:IMUX_C4SERDES.Q0P_HALMSTREQDES125
TCELL40:IMUX_C5SERDES.Q0P_HALMSTREQDES122
TCELL40:IMUX_D0SERDES.Q0P_HALMSTREQDES121
TCELL40:IMUX_D1SERDES.Q0P_HALTGTCAREQDES120
TCELL40:IMUX_D2SERDES.Q0P_HALMSTREQDES120
TCELL40:IMUX_D3SERDES.Q0P_HALMSTREQDES119
TCELL40:IMUX_D4SERDES.Q0P_HALMSTREQDES118
TCELL40:IMUX_D5SERDES.Q0P_HALMSTREQDES117
TCELL40:OUT_F0SERDES.Q0P_HALMSTCOMPDES31
TCELL40:OUT_F1SERDES.Q0P_HALMSTCOMPDES17
TCELL40:OUT_F2SERDES.Q0P_MAXREADREQSIZE1
TCELL40:OUT_F3SERDES.Q0P_HALMSTCOMPDES53
TCELL40:OUT_F4SERDES.Q0P_HALMSTCOMPDES49
TCELL40:OUT_F5SERDES.Q0P_HALMSTCOMPDES61
TCELL40:OUT_F6SERDES.Q0P_HALMSTCOMPDES46
TCELL40:OUT_F7SERDES.Q0P_HALMSTCOMPDES45
TCELL40:OUT_Q0SERDES.Q0P_HALMSTCOMPDES58
TCELL40:OUT_Q1SERDES.Q0P_HALMSTCOMPDES40
TCELL40:OUT_Q2SERDES.Q0P_HALMSTCOMPDES20
TCELL40:OUT_Q3SERDES.Q0P_HALMSTCOMPDES44
TCELL40:OUT_Q4SERDES.Q0P_HALMSTCOMPDES8
TCELL40:OUT_Q5SERDES.Q0P_HALMSTCOMPDES23
TCELL40:OUT_Q6SERDES.Q0P_HALMSTCOMPDES54
TCELL40:OUT_Q7SERDES.Q0P_HALMSTCOMPDES56
TCELL41:IMUX_A0SERDES.Q0P_HALMSTREQDES116
TCELL41:IMUX_A1SERDES.Q0P_HALMSTREQDES113
TCELL41:IMUX_A2SERDES.Q0P_HALMSTREQDES112
TCELL41:IMUX_A3SERDES.Q0P_HALMSTREQDES111
TCELL41:IMUX_A4SERDES.Q0P_HALMSTREQDES109
TCELL41:IMUX_A5SERDES.Q0P_HALMSTREQDES108
TCELL41:IMUX_B0SERDES.Q0P_HALMSTREQDES114
TCELL41:IMUX_B1SERDES.Q0P_HALMSTREQDES106
TCELL41:IMUX_B2SERDES.Q0P_HALMSTREQDES105
TCELL41:IMUX_B3SERDES.Q0P_HALMSTREQDES104
TCELL41:IMUX_B4SERDES.Q0P_HALMSTREQDES103
TCELL41:IMUX_B5SERDES.Q0P_HALMSTREQDES102
TCELL41:IMUX_C0SERDES.Q0P_HALMSTREQDES126
TCELL41:IMUX_C1SERDES.Q0P_HALMSTREQDES107
TCELL41:IMUX_C2SERDES.Q0P_HALMSTREQDES115
TCELL41:IMUX_C3SERDES.Q0P_HALMSTREQDES110
TCELL41:IMUX_C4SERDES.Q0P_HALMSTREQDES101
TCELL41:IMUX_C5SERDES.Q0P_HALMSTREQDES100
TCELL41:IMUX_D0SERDES.Q0P_HALMSTREQDES99
TCELL41:IMUX_D1SERDES.Q0P_HALMSTREQDES98
TCELL41:IMUX_D2SERDES.Q0P_HALMSTREQDES97
TCELL41:IMUX_D3SERDES.Q0P_HALMSTREQDES96
TCELL41:IMUX_D4SERDES.Q0P_HALMSTREQDES95
TCELL41:IMUX_D5SERDES.Q0P_HALMSTREQDES94
TCELL41:OUT_F0SERDES.Q0P_HALMSTCOMPDES52
TCELL41:OUT_F1SERDES.Q0P_HALMSTCOMPDES9
TCELL41:OUT_F2SERDES.Q0P_HALMSTCOMPDES10
TCELL41:OUT_F3SERDES.Q0P_HALMSTCOMPDES43
TCELL41:OUT_F4SERDES.Q0P_HALMSTCOMPDES7
TCELL41:OUT_F5SERDES.Q0P_HALMSTCOMPDES29
TCELL41:OUT_F6SERDES.Q0P_HALMSTCOMPDES12
TCELL41:OUT_F7SERDES.Q0P_HALMSTCOMPDES41
TCELL41:OUT_Q0SERDES.Q0P_HALMSTCOMPDES16
TCELL41:OUT_Q1SERDES.Q0P_HALMSTCOMPDES62
TCELL41:OUT_Q2SERDES.Q0P_HALMSTCOMPDES57
TCELL41:OUT_Q3SERDES.Q0P_HALMSTCOMPDES42
TCELL41:OUT_Q4SERDES.Q0P_HALMSTCOMPDES22
TCELL41:OUT_Q5SERDES.Q0P_HALMSTCOMPDES19
TCELL41:OUT_Q6SERDES.Q0P_HALMSTCOMPDES39
TCELL41:OUT_Q7SERDES.Q0P_RCBSTS
TCELL42:IMUX_A2SERDES.Q0P_HALMSTREQDES93
TCELL42:IMUX_A3SERDES.Q0P_HALMSTREQDES92
TCELL42:IMUX_A4SERDES.Q0P_HALMSTREQDES91
TCELL42:IMUX_A5SERDES.Q0P_HALMSTREQDES90
TCELL42:IMUX_B2SERDES.Q0P_HALMSTREQDES89
TCELL42:IMUX_B3SERDES.Q0P_HALMSTREQDES88
TCELL42:IMUX_B4SERDES.Q0P_HALMSTREQDES87
TCELL42:IMUX_B5SERDES.Q0P_HALMSTREQDES85
TCELL42:IMUX_C2SERDES.Q0P_HALMSTREQDES84
TCELL42:IMUX_C3SERDES.Q0P_HALTGTCOMPERR
TCELL42:IMUX_C4SERDES.Q0P_HALTGTCOMPVLD
TCELL42:IMUX_C5SERDES.Q0P_HALTGTCOMPSOP
TCELL42:IMUX_D2SERDES.Q0P_HALMSTREQDES83
TCELL42:IMUX_D3SERDES.Q0P_HALMSTREQDES82
TCELL42:IMUX_D4SERDES.Q0P_HALMSTREQDES81
TCELL42:IMUX_D5SERDES.Q0P_HALMSTREQDES79
TCELL42:OUT_F2SERDES.Q0P_HALMSTCOMPDES28
TCELL42:OUT_F3SERDES.Q0P_HALMSTCOMPDES26
TCELL42:OUT_F4SERDES.Q0P_MSIXMASK
TCELL42:OUT_F5SERDES.Q0P_HALMSTCOMPDES27
TCELL42:OUT_F6SERDES.Q0P_HALMSTCOMPDES25
TCELL42:OUT_F7SERDES.Q0P_HALMSTCOMPDES24
TCELL42:OUT_Q2SERDES.Q0P_HALMSTCOMPDES18
TCELL42:OUT_Q3SERDES.Q0P_HALMSTCOMPDES21
TCELL42:OUT_Q4SERDES.Q0P_FTLERROUT
TCELL42:OUT_Q5SERDES.Q0P_MAXREADREQSIZE2
TCELL42:OUT_Q6SERDES.Q0P_TPHSTMODE2
TCELL42:OUT_Q7SERDES.Q0P_FUNCSTS2
TCELL43:IMUX_A0SERDES.Q0P_HALTGTCOMPEOP
TCELL43:IMUX_A1SERDES.Q0P_HALMSTREQDES75
TCELL43:IMUX_A2SERDES.Q0P_HALMSTREQDES74
TCELL43:IMUX_A3SERDES.Q0P_HALMSTREQDES72
TCELL43:IMUX_A4SERDES.Q0P_HALMSTREQDES127
TCELL43:IMUX_A5SERDES.Q0P_HALMSTREQ
TCELL43:IMUX_B0SERDES.Q0P_HALMSTREQDES71
TCELL43:IMUX_B1SERDES.Q0P_HALMSTREQDES77
TCELL43:IMUX_B2SERDES.Q0P_HALMSTREQDES80
TCELL43:IMUX_B3SERDES.Q0P_HALMSTREQDES70
TCELL43:IMUX_B4SERDES.Q0P_HALTGTNPREJ
TCELL43:IMUX_B5SERDES.Q0P_HALMSTREQDES76
TCELL43:IMUX_C0SERDES.Q0P_HALMSTREQDES64
TCELL43:IMUX_C1SERDES.Q0P_HALMSTREQDES65
TCELL43:IMUX_C2SERDES.Q0P_HALMSTREQDES78
TCELL43:IMUX_C3SERDES.Q0P_HALMSTREQDES63
TCELL43:IMUX_C4SERDES.Q0P_HALMSTREQDES62
TCELL43:IMUX_C5SERDES.Q0P_HALMSTREQDES66
TCELL43:IMUX_D0SERDES.Q0P_HALMSTREQDES57
TCELL43:IMUX_D1SERDES.Q0P_HALMSTREQDES58
TCELL43:IMUX_D2SERDES.Q0P_HALMSTREQDES60
TCELL43:IMUX_D3SERDES.Q0P_HALMSTREQDES61
TCELL43:IMUX_D4SERDES.Q0P_HALMSTREQDES69
TCELL43:IMUX_D5SERDES.Q0P_HALMSTREQDES68
TCELL43:OUT_F1SERDES.Q0P_FUNCPWRSTATE1
TCELL43:OUT_F2SERDES.Q0P_TPHSTMODE0
TCELL43:OUT_F3SERDES.Q0P_FUNCPWRSTATE0
TCELL43:OUT_F5SERDES.Q0P_CORERROUT
TCELL43:OUT_F6SERDES.Q0P_FUNCSTS1
TCELL43:OUT_F7SERDES.Q0P_NFTLERROUT
TCELL43:OUT_Q0SERDES.Q0P_FUNCPWRSTATE2
TCELL43:OUT_Q1SERDES.Q0P_HALMSTREJ
TCELL43:OUT_Q2SERDES.Q0P_SCANO10
TCELL43:OUT_Q3SERDES.Q0P_FUNCSTS0
TCELL43:OUT_Q4SERDES.Q0P_HALMSTACK
TCELL43:OUT_Q5SERDES.Q0P_MSIXEN
TCELL43:OUT_Q6SERDES.Q0P_MAXREADREQSIZE0
TCELL43:OUT_Q7SERDES.Q0P_FUNCSTS3
TCELL44:IMUX_A0SERDES.Q0P_HALMSTREQDES59
TCELL44:IMUX_A1SERDES.Q0P_HALMSTREQDES56
TCELL44:IMUX_A2SERDES.Q0P_HALMSTREQDES73
TCELL44:IMUX_A3SERDES.Q0P_HALMSTREQDES54
TCELL44:IMUX_A4SERDES.Q0P_HALMSTREQDES55
TCELL44:IMUX_A5SERDES.Q0P_HALMSTREQDES67
TCELL44:IMUX_B0SERDES.Q0P_HALMSTREQDES53
TCELL44:IMUX_B1SERDES.Q0P_HALMSTREQDES50
TCELL44:IMUX_B2SERDES.Q0P_HALMSTREQDES46
TCELL44:IMUX_B3SERDES.Q0P_HALMSTREQDES47
TCELL44:IMUX_B4SERDES.Q0P_HALMSTREQDES51
TCELL44:IMUX_B5SERDES.Q0P_HALMSTREQDES52
TCELL44:IMUX_C0SERDES.Q0P_HALMSTREQDES49
TCELL44:IMUX_C1SERDES.Q0P_HALMSTREQDES48
TCELL44:IMUX_C2SERDES.Q0P_HALMSTREQDES45
TCELL44:IMUX_C3SERDES.Q0P_HALMSTREQDES43
TCELL44:IMUX_C4SERDES.Q0P_HALMSTREQDES42
TCELL44:IMUX_C5SERDES.Q0P_HALMSTREQDES44
TCELL44:IMUX_D0SERDES.Q0P_HALMSTREQDES40
TCELL44:IMUX_D1SERDES.Q0P_HALMSTREQDES7
TCELL44:IMUX_D2SERDES.Q0P_HALMSTREQDES39
TCELL44:IMUX_D3SERDES.Q0P_HALMSTREQDES23
TCELL44:IMUX_D4SERDES.Q0P_HALMSTREQDES37
TCELL44:IMUX_D5SERDES.Q0P_HALMSTREQDES41
TCELL44:OUT_F0SERDES.Q0P_TPHSTMODE1
TCELL44:OUT_F1SERDES.Q0P_HALMSTTAG2
TCELL44:OUT_F2SERDES.Q0P_LCLINT
TCELL44:OUT_F3SERDES.Q0P_HALMSTTAG1
TCELL44:OUT_F4SERDES.Q0P_HALMSTTAG3
TCELL44:OUT_F5SERDES.Q0P_HALMSTTAG4
TCELL44:OUT_F6SERDES.Q0P_HALMSTTAG0
TCELL44:OUT_F7SERDES.Q0P_MSIMSGABRT
TCELL44:OUT_Q0SERDES.Q0P_TPHREQENABLE
TCELL44:OUT_Q1SERDES.Q0P_DBGDATOUT5
TCELL44:OUT_Q2SERDES.Q0P_MSIMSGSENT
TCELL44:OUT_Q3SERDES.Q0P_DBGDATOUT7
TCELL44:OUT_Q4SERDES.Q0P_DBGDATOUT8
TCELL44:OUT_Q5SERDES.Q0P_SCANO12
TCELL44:OUT_Q6SERDES.Q0P_DBGDATOUT12
TCELL44:OUT_Q7SERDES.Q0P_DBGDATOUT6
TCELL45:IMUX_A0SERDES.Q0P_HALMSTREQDES38
TCELL45:IMUX_A1SERDES.Q0P_HALMSTREQDES20
TCELL45:IMUX_A2SERDES.Q0P_HALMSTREQDES36
TCELL45:IMUX_A3SERDES.Q0P_HALMSTREQDES9
TCELL45:IMUX_A4SERDES.Q0P_HALMSTREQDES19
TCELL45:IMUX_A5SERDES.Q0P_HALMSTWBVLD1
TCELL45:IMUX_B0SERDES.Q0P_HALMSTREQDES8
TCELL45:IMUX_B1SERDES.Q0P_HALMSTREQDES17
TCELL45:IMUX_B2SERDES.Q0P_HALMSTREQDES21
TCELL45:IMUX_B3SERDES.Q0P_HALMSTREQDES22
TCELL45:IMUX_B4SERDES.Q0P_HALMSTREQDES12
TCELL45:IMUX_B5SERDES.Q0P_HALMSTWBVLD2
TCELL45:IMUX_C0SERDES.Q0P_HALMSTREQDES34
TCELL45:IMUX_C1SERDES.Q0P_HALMSTREQDES1
TCELL45:IMUX_C2SERDES.Q0P_HALMSTREQDES10
TCELL45:IMUX_C3SERDES.Q0P_HALMSTREQDES11
TCELL45:IMUX_C4SERDES.Q0P_HALMSTREQDES16
TCELL45:IMUX_C5SERDES.Q0P_HALMSTREQDES35
TCELL45:IMUX_D0SERDES.Q0P_HALMSTREQDES6
TCELL45:IMUX_D1SERDES.Q0P_HALMSTREQDES5
TCELL45:IMUX_D2SERDES.Q0P_HALMSTREQDES18
TCELL45:IMUX_D3SERDES.Q0P_HALMSTREQDES4
TCELL45:IMUX_D4SERDES.Q0P_HALMSTREQDES3
TCELL45:IMUX_D5SERDES.Q0P_HALMSTREQDES2
TCELL45:OUT_F0SERDES.Q0P_SCANO4
TCELL45:OUT_F1SERDES.Q0P_DBGDATOUT14
TCELL45:OUT_F2SERDES.Q0P_DBGDATOUT4
TCELL45:OUT_F3SERDES.Q0P_DBGDATOUT9
TCELL45:OUT_F4SERDES.Q0P_DBGDATOUT0
TCELL45:OUT_F5SERDES.Q0P_DBGDATOUT2
TCELL45:OUT_F6SERDES.Q0P_DBGDATOUT13
TCELL45:OUT_F7SERDES.Q0P_DBGDATOUT1
TCELL45:OUT_Q0SERDES.Q0P_HALMSTCOMPDES124
TCELL45:OUT_Q1SERDES.Q0P_DBGDATOUT3
TCELL45:OUT_Q2SERDES.Q0P_DBGDATOUT11
TCELL45:OUT_Q3SERDES.Q0P_LTSSMSTATE5
TCELL45:OUT_Q4SERDES.Q0P_DBGDATOUT10
TCELL45:OUT_Q5SERDES.Q0P_DBGDATOUT15
TCELL45:OUT_Q6SERDES.Q0P_LNKSTS0
TCELL45:OUT_Q7SERDES.Q0P_LTSSMSTATE0
TCELL46:IMUX_A0SERDES.Q0P_HALMSTREQDES15
TCELL46:IMUX_A1SERDES.Q0P_HALMSTREQDES33
TCELL46:IMUX_A2SERDES.Q0P_HALMSTWEOP
TCELL46:IMUX_A3SERDES.Q0P_HALMSTREQDES32
TCELL46:IMUX_A4SERDES.Q0P_HALMSTWBVLD0
TCELL46:IMUX_A5SERDES.Q0P_HALMSTWDATVLD
TCELL46:IMUX_B0SERDES.Q0P_HALMSTREQDES0
TCELL46:IMUX_B1SERDES.Q0P_HALMSTREQDES31
TCELL46:IMUX_B2SERDES.Q0P_HALMSTREQDES14
TCELL46:IMUX_B3SERDES.Q0P_HALMSTREQDES13
TCELL46:IMUX_B4SERDES.Q0P_HALMSTWERR
TCELL46:IMUX_B5SERDES.Q0P_HALMSTWBVLD6
TCELL46:IMUX_C0SERDES.Q0P_HALMSTWBVLD7
TCELL46:IMUX_C1SERDES.Q0P_HALMSTWBVLD3
TCELL46:IMUX_C2SERDES.Q0P_HALMSTWBVLD4
TCELL46:IMUX_C3SERDES.Q0P_HALMSTREQDES25
TCELL46:IMUX_C4SERDES.Q0P_HALMSTREQDES28
TCELL46:IMUX_C5SERDES.Q0P_HALMSTREQDES30
TCELL46:IMUX_D0SERDES.Q0P_HALMSTREQDES29
TCELL46:IMUX_D1SERDES.Q0P_HALMSTREQDES27
TCELL46:IMUX_D2SERDES.Q0P_HALMSTREQDES24
TCELL46:IMUX_D3SERDES.Q0P_HALMSTWBVLD5
TCELL46:IMUX_D4SERDES.Q0P_HALMSTREQDES26
TCELL46:IMUX_D5SERDES.Q0P_INTAI
TCELL46:OUT_F0SERDES.Q0P_LTSSMSTATE4
TCELL46:OUT_F1SERDES.Q0P_LTSSMSTATE1
TCELL46:OUT_F2SERDES.Q0P_SCANO3
TCELL46:OUT_F3SERDES.Q0P_LTSSMSTATE2
TCELL46:OUT_F4SERDES.Q0P_HALMSTRERR
TCELL46:OUT_F5SERDES.Q0P_SCANO13
TCELL46:OUT_F6SERDES.Q0P_LTSSMSTATE3
TCELL46:OUT_F7SERDES.Q0P_LNKPWRSTATE3
TCELL46:OUT_Q0SERDES.Q0P_SCANO17
TCELL46:OUT_Q1SERDES.Q0P_HALTGTREQDES118
TCELL46:OUT_Q2SERDES.Q0P_HALTGTREQDES119
TCELL46:OUT_Q3SERDES.Q0P_HALTGTREQDES117
TCELL46:OUT_Q4SERDES.Q0P_HALTGTREQDES116
TCELL46:OUT_Q5SERDES.Q0P_HALTGTREQDES114
TCELL46:OUT_Q6SERDES.Q0P_HALTGTREQDES113
TCELL46:OUT_Q7SERDES.Q0P_HALTGTREQDES115
TCELL47:IMUX_A0SERDES.Q0P_HALMSTREQATTR0
TCELL47:IMUX_A1SERDES.Q0P_HALMSTREQATTR1
TCELL47:IMUX_A2SERDES.Q0P_HALMSTCOMPRDY
TCELL47:IMUX_A3SERDES.Q0P_MSIATTRIN2
TCELL47:IMUX_A4SERDES.Q0P_HALMSTREQDES86
TCELL47:IMUX_A5SERDES.Q0P_HALTGTCAREQDES108
TCELL47:IMUX_B0SERDES.Q0P_HALTGTCAREQDES110
TCELL47:IMUX_B1SERDES.Q0P_HALTGTCAREQDES112
TCELL47:IMUX_B2SERDES.Q0P_HALTGTCAREQDES113
TCELL47:IMUX_B3SERDES.Q0P_HALTGTCAREQDES116
TCELL47:IMUX_B4SERDES.Q0P_HALTGTCAREQDES118
TCELL47:IMUX_B5SERDES.Q0P_HALTGTCAREQDES124
TCELL47:IMUX_C0SERDES.Q0P_HALTGTCAREQDES126
TCELL47:IMUX_C1SERDES.Q0P_HALTGTCOMPDES119
TCELL47:IMUX_C2SERDES.Q0P_HALTGTCAREQDES127
TCELL47:IMUX_C3SERDES.Q0P_HALTGTCAREQDES125
TCELL47:IMUX_C4SERDES.Q0P_HALTGTCAREQDES123
TCELL47:IMUX_C5SERDES.Q0P_HALTGTCAREQDES122
TCELL47:IMUX_D0SERDES.Q0P_HALTGTCAREQDES119
TCELL47:IMUX_D1SERDES.Q0P_HALTGTCAREQDES117
TCELL47:IMUX_D2SERDES.Q0P_HALTGTCAREQDES115
TCELL47:IMUX_D3SERDES.Q0P_HALTGTCAREQDES114
TCELL47:IMUX_D4SERDES.Q0P_HALTGTCAREQDES111
TCELL47:IMUX_D5SERDES.Q0P_HALTGTCAREQDES109
TCELL47:OUT_F0SERDES.Q0P_HALTGTREQDES108
TCELL47:OUT_F1SERDES.Q0P_HALTGTREQDES112
TCELL47:OUT_F2SERDES.Q0P_HALTGTREQDES107
TCELL47:OUT_F3SERDES.Q0P_NEGLNKWIDTH0
TCELL47:OUT_F4SERDES.Q0P_LNKSTS1
TCELL47:OUT_F5SERDES.Q0P_NEGLNKWIDTH1
TCELL47:OUT_F6SERDES.Q0P_MAXPYLDSIZE0
TCELL47:OUT_F7SERDES.Q0P_LNKPWRSTATE2
TCELL47:OUT_Q0SERDES.Q0P_MAXPYLDSIZE2
TCELL47:OUT_Q1SERDES.Q0P_LNKDWNRSTOUT
TCELL47:OUT_Q2SERDES.Q0P_NEGSPEED
TCELL47:OUT_Q3SERDES.Q0P_LNKPWRSTATE1
TCELL47:OUT_Q4SERDES.Q0P_SCANO0
TCELL47:OUT_Q5SERDES.Q0P_SCANO16
TCELL47:OUT_Q6SERDES.Q0P_SCANO15
TCELL47:OUT_Q7SERDES.Q0P_MAXPYLDSIZE1
TCELL48:IMUX_A2SERDES.Q0P_HALTGTCAREQDES107
TCELL48:IMUX_A3SERDES.Q0P_HALMSTREQATTR2
TCELL48:IMUX_A4SERDES.Q0P_MSIXATTRIN2
TCELL48:IMUX_A5SERDES.Q0P_CORERRIN
TCELL48:IMUX_A6SERDES.Q0P_PWRSTATECHNGACK
TCELL48:IMUX_A7SERDES.Q0P_MSIXMSGDAT10
TCELL48:IMUX_B2SERDES.Q0P_MSIXMSGDAT27
TCELL48:IMUX_B3SERDES.Q0P_MSIXMSGDAT30
TCELL48:IMUX_B4SERDES.Q0P_MSIXMSGDAT28
TCELL48:IMUX_B5SERDES.Q0P_MSIXMSGDAT23
TCELL48:IMUX_B6SERDES.Q0P_MSIXMSGDAT4
TCELL48:IMUX_B7SERDES.Q0P_MSIXMSGDAT18
TCELL48:IMUX_C2SERDES.Q0P_MSIXMSGDAT21
TCELL48:IMUX_C3SERDES.Q0P_MSIXMSGDAT29
TCELL48:IMUX_C4SERDES.Q0P_MSIXMSGDAT11
TCELL48:IMUX_C5SERDES.Q0P_MSIXMSGDAT20
TCELL48:IMUX_C6SERDES.Q0P_MSIXMSGDAT22
TCELL48:IMUX_C7SERDES.Q0P_MSIXMSGDAT31
TCELL48:IMUX_D2SERDES.Q0P_MSIXMSGDAT24
TCELL48:IMUX_D3SERDES.Q0P_MSIXMSGDAT25
TCELL48:IMUX_D4SERDES.Q0P_MSIXMSGDAT17
TCELL48:IMUX_D5SERDES.Q0P_MSIXMSGDAT16
TCELL48:IMUX_D6SERDES.Q0P_MSIXMSGDAT15
TCELL48:IMUX_D7SERDES.Q0P_MSIXMSGDAT26
TCELL48:OUT_F2SERDES.Q0P_SCANO24
TCELL48:OUT_F3SERDES.Q0P_LNKPWRSTATE0
TCELL48:OUT_F4SERDES.Q0P_MSIXMSGSENT
TCELL48:OUT_F5SERDES.Q0P_HOTRSTOUT
TCELL48:OUT_F6SERDES.Q0P_SCANO23
TCELL49:IMUX_A2SERDES.Q0P_MSIXMSGDAT19
TCELL49:IMUX_A3SERDES.Q0P_MSIXMSGDAT14
TCELL49:IMUX_A4SERDES.Q0P_MSIXMSGDAT13
TCELL49:IMUX_A5SERDES.Q0P_MSIXMSGDAT1
TCELL49:IMUX_A6SERDES.Q0P_MSIXMSGDAT0
TCELL49:IMUX_A7SERDES.Q0P_MSIXMSGDAT12
TCELL49:IMUX_B2SERDES.Q0P_MSIXMSGDAT6
TCELL49:IMUX_B3SERDES.Q0P_MSIXMSGDAT2
TCELL49:IMUX_B4SERDES.Q0P_MSIXMSGDAT7
TCELL49:IMUX_B5SERDES.Q0P_MSIXMSGDAT5
TCELL49:IMUX_B6SERDES.Q0P_MSIXMSGDAT3
TCELL49:IMUX_B7SERDES.Q0P_MSIXMSGDAT9
TCELL49:IMUX_C2SERDES.Q0P_MSIXMSGDAT8
TCELL49:IMUX_C3SERDES.Q0P_INTBI
TCELL49:IMUX_C4SERDES.Q0P_INTCI
TCELL49:IMUX_C5SERDES.Q0P_INTDI
TCELL49:IMUX_C6SERDES.Q0P_INTPENDSTS
TCELL49:IMUX_C7SERDES.Q0P_HALMSTREQTPHPRESENT
TCELL49:IMUX_D2SERDES.Q0P_MSIXATTRIN1
TCELL49:IMUX_D3SERDES.Q0P_MSIXATTRIN0
TCELL49:IMUX_D4SERDES.Q0P_HALMSTREQTPHTYPE1
TCELL49:IMUX_D5SERDES.Q0P_MSIXREQTPHTYPE1
TCELL49:IMUX_D6SERDES.Q0P_HALMSTREQTPHTYPE0
TCELL49:IMUX_D7SERDES.Q0P_MSIXREQTPHTYPE0
TCELL50:IMUX_A2SERDES.Q0P_MSIXREQTPHPRESENT
TCELL50:IMUX_A3SERDES.Q0P_MSIXREQTPHSTTAG4
TCELL50:IMUX_A4SERDES.Q0P_HALMSTREQTPHSTTAG4
TCELL50:IMUX_A5SERDES.Q0P_HALMSTREQTPHSTTAG2
TCELL50:IMUX_A6SERDES.Q0P_MSIXREQTPHSTTAG2
TCELL50:IMUX_A7SERDES.Q0P_HALMSTREQTPHSTTAG1
TCELL50:IMUX_B2SERDES.Q0P_MSIXREQTPHSTTAG1
TCELL50:IMUX_B3SERDES.Q0P_HALMSTREQTPHSTTAG6
TCELL50:IMUX_B4SERDES.Q0P_MSIXREQTPHSTTAG6
TCELL50:IMUX_B5SERDES.Q0P_HALMSTREQTPHSTTAG7
TCELL50:IMUX_B6SERDES.Q0P_MSIXREQTPHSTTAG7
TCELL50:IMUX_B7SERDES.Q0P_HALMSTREQTPHSTTAG3
TCELL50:IMUX_C2SERDES.Q0P_MSIXREQTPHSTTAG3
TCELL50:IMUX_C3SERDES.Q0P_MSIXREQTPHSTTAG0
TCELL50:IMUX_C4SERDES.Q0P_HALMSTREQTPHSTTAG0
TCELL50:IMUX_C5SERDES.Q0P_HALMSTREQTPHSTTAG5
TCELL50:IMUX_C6SERDES.Q0P_MSIXREQTPHSTTAG5
TCELL50:IMUX_C7SERDES.Q0P_MSIREQTPHSTTAG2
TCELL50:IMUX_D2SERDES.Q0P_MSIREQTPHSTTAG1
TCELL50:IMUX_D3SERDES.Q0P_MSIREQTPHPRESENT
TCELL50:IMUX_D4SERDES.Q0P_MSIREQTPHSTTAG4
TCELL50:IMUX_D5SERDES.Q0P_UNCORRERRIN
TCELL50:IMUX_D6SERDES.Q0P_MSIREQTPHTYPE1
TCELL50:IMUX_D7SERDES.Q0P_MSIXMSGADDR0
TCELL51:IMUX_A2SERDES.Q0P_MSIXMSGADDR1
TCELL51:IMUX_A3SERDES.Q0P_MSIXMSGADDR2
TCELL51:IMUX_A4SERDES.Q0P_MSIXMSGADDR3
TCELL51:IMUX_A5SERDES.Q0P_MSIXMSGADDR4
TCELL51:IMUX_A6SERDES.Q0P_MSIXMSGADDR5
TCELL51:IMUX_A7SERDES.Q0P_MSIREQTPHSTTAG3
TCELL51:IMUX_B2SERDES.Q0P_MSIREQTPHSTTAG6
TCELL51:IMUX_B3SERDES.Q0P_MSIXMSGADDR8
TCELL51:IMUX_B4SERDES.Q0P_MSIXMSGADDR6
TCELL51:IMUX_B5SERDES.Q0P_MSIXMSGADDR9
TCELL51:IMUX_B6SERDES.Q0P_MSIXMSGADDR18
TCELL51:IMUX_B7SERDES.Q0P_MSIXMSGADDR15
TCELL51:IMUX_C2SERDES.Q0P_MSIXMSGADDR7
TCELL51:IMUX_C3SERDES.Q0P_MSIXMSGADDR10
TCELL51:IMUX_C4SERDES.Q0P_MSIXMSGVLD
TCELL51:IMUX_C5SERDES.Q0P_MSIXMSGADDR14
TCELL51:IMUX_C6SERDES.Q0P_MSIXMSGADDR11
TCELL51:IMUX_C7SERDES.Q0P_MSIXMSGADDR13
TCELL51:IMUX_D2SERDES.Q0P_MSIATTRIN1
TCELL51:IMUX_D3SERDES.Q0P_MSIATTRIN0
TCELL51:IMUX_D4SERDES.Q0P_MSIREQTPHTYPE0
TCELL51:IMUX_D5SERDES.Q0P_MSIXMSGADDR26
TCELL51:IMUX_D6SERDES.Q0P_MSIXMSGADDR20
TCELL51:IMUX_D7SERDES.Q0P_MSIXMSGADDR17
TCELL52:IMUX_A2SERDES.Q0P_MSIXMSGADDR30
TCELL52:IMUX_A3SERDES.Q0P_MSIXMSGADDR19
TCELL52:IMUX_A4SERDES.Q0P_MSIXMSGADDR16
TCELL52:IMUX_A5SERDES.Q0P_MSIXMSGADDR25
TCELL52:IMUX_A6SERDES.Q0P_MSIREQTPHSTTAG7
TCELL52:IMUX_A7SERDES.Q0P_MSIXMSGADDR28
TCELL52:IMUX_B2SERDES.Q0P_MSIREQTPHSTTAG5
TCELL52:IMUX_B3SERDES.Q0P_MSIXMSGADDR12
TCELL52:IMUX_B4SERDES.Q0P_MSIXMSGADDR29
TCELL52:IMUX_B5SERDES.Q0P_MSIXMSGADDR27
TCELL52:IMUX_B6SERDES.Q0P_MSIREQTPHSTTAG0
TCELL52:IMUX_B7SERDES.Q0P_MSIXMSGADDR21
TCELL52:IMUX_C2SERDES.Q0P_MSIXMSGADDR24
TCELL52:IMUX_C3SERDES.Q0P_MSIXMSGADDR31
TCELL52:IMUX_C4SERDES.Q0P_MSIXMSGADDR22
TCELL52:IMUX_C5SERDES.Q0P_MSIXMSGADDR23
TCELL52:IMUX_C6SERDES.Q0P_MSIASRTINT0
TCELL52:IMUX_C7SERDES.Q0P_MSIASRTINT10
TCELL52:IMUX_D2SERDES.Q0P_MSIASRTINT14
TCELL52:IMUX_D3SERDES.Q0P_MSIASRTINT18
TCELL52:IMUX_D4SERDES.Q0P_MSIASRTINT17
TCELL52:IMUX_D5SERDES.Q0P_MSIASRTINT4
TCELL52:IMUX_D6SERDES.Q0P_MSIASRTINT30
TCELL52:IMUX_D7SERDES.Q0P_MSIASRTINT31
TCELL53:IMUX_A2SERDES.Q0P_MSIASRTINT11
TCELL53:IMUX_A3SERDES.Q0P_MSIASRTINT29
TCELL53:IMUX_A4SERDES.Q0P_MSIASRTINT16
TCELL53:IMUX_A5SERDES.Q0P_MSIASRTINT15
TCELL53:IMUX_A6SERDES.Q0P_MSIASRTINT13
TCELL53:IMUX_A7SERDES.Q0P_MSIASRTINT8
TCELL53:IMUX_B2SERDES.Q0P_MSIASRTINT1
TCELL53:IMUX_B3SERDES.Q0P_MSIASRTINT28
TCELL53:IMUX_B4SERDES.Q0P_MSIASRTINT12
TCELL53:IMUX_B5SERDES.Q0P_MSIASRTINT27
TCELL53:IMUX_B6SERDES.Q0P_MSIASRTINT6
TCELL53:IMUX_B7SERDES.Q0P_MSIXMSGADDR63
TCELL53:IMUX_C2SERDES.Q0P_MSIASRTINT9
TCELL53:IMUX_C3SERDES.Q0P_MSIASRTINT7
TCELL53:IMUX_C4SERDES.Q0P_MSIASRTINT3
TCELL53:IMUX_C5SERDES.Q0P_MSIASRTINT5
TCELL53:IMUX_C6SERDES.Q0P_MSIASRTINT26
TCELL53:IMUX_C7SERDES.Q0P_MSIASRTINT24
TCELL53:IMUX_D2SERDES.Q0P_MSIASRTINT2
TCELL53:IMUX_D3SERDES.Q0P_MSIXMSGADDR60
TCELL53:IMUX_D4SERDES.Q0P_MSIASRTINT19
TCELL53:IMUX_D5SERDES.Q0P_MSIASRTINT21
TCELL53:IMUX_D6SERDES.Q0P_MSIXMSGADDR62
TCELL53:IMUX_D7SERDES.Q0P_MSIASRTINT25
TCELL54:IMUX_A2SERDES.Q0P_MSIXMSGADDR61
TCELL54:IMUX_A3SERDES.Q0P_MSIASRTINT23
TCELL54:IMUX_A4SERDES.Q0P_MSIASRTINT22
TCELL54:IMUX_A5SERDES.Q0P_MSIXMSGADDR59
TCELL54:IMUX_A6SERDES.Q0P_MSIXMSGADDR56
TCELL54:IMUX_A7SERDES.Q0P_MSIASRTINT20
TCELL54:IMUX_B2SERDES.Q0P_MSIXMSGADDR58
TCELL54:IMUX_B3SERDES.Q0P_MSIXMSGADDR57
TCELL54:IMUX_B4SERDES.Q0P_MSIXMSGADDR37
TCELL54:IMUX_B5SERDES.Q0P_MSIXMSGADDR40
TCELL54:IMUX_B6SERDES.Q0P_MSIXMSGADDR49
TCELL54:IMUX_B7SERDES.Q0P_MSIXMSGADDR45
TCELL54:IMUX_C2SERDES.Q0P_MSIXMSGADDR53
TCELL54:IMUX_C3SERDES.Q0P_MSIXMSGADDR51
TCELL54:IMUX_C4SERDES.Q0P_MSIXMSGADDR47
TCELL54:IMUX_C5SERDES.Q0P_MSIXMSGADDR44
TCELL54:IMUX_C6SERDES.Q0P_MSIXMSGADDR46
TCELL54:IMUX_C7SERDES.Q0P_MSIXMSGADDR52
TCELL54:IMUX_D2SERDES.Q0P_MSIXMSGADDR55
TCELL54:IMUX_D3SERDES.Q0P_MSIXMSGADDR50
TCELL54:IMUX_D4SERDES.Q0P_MSIXMSGADDR54
TCELL54:IMUX_D5SERDES.Q0P_MSIXMSGADDR42
TCELL54:IMUX_D6SERDES.Q0P_MSIXMSGADDR43
TCELL54:IMUX_D7SERDES.Q0P_MSIXMSGADDR48
TCELL55:IMUX_A2SERDES.Q0P_MSIXMSGADDR39
TCELL55:IMUX_A3SERDES.Q0P_MSIXMSGADDR38
TCELL55:IMUX_A4SERDES.Q0P_MSIXMSGADDR35
TCELL55:IMUX_A5SERDES.Q0P_MSIXMSGADDR36
TCELL55:IMUX_A6SERDES.Q0P_MSIXMSGADDR41
TCELL55:IMUX_A7SERDES.Q0P_MSIXMSGADDR33
TCELL55:IMUX_B2SERDES.Q0P_MSIXMSGADDR34
TCELL55:IMUX_B3SERDES.Q0P_MSIXMSGADDR32
TCELL58:OUT_F0SERDES.Q1EA1_COTXREAD
TCELL58:OUT_F1SERDES.Q1EA0_COTXREAD
TCELL58:OUT_F2SERDES.Q1S_TISCANO13
TCELL58:OUT_F3SERDES.Q1EA3_GOTXMACWR
TCELL58:OUT_F4SERDES.Q1EA0_COTXDISCFRM
TCELL58:OUT_F5SERDES.Q1EA1_COTXDISCFRM
TCELL58:OUT_F6SERDES.Q1EA0_COTXSTATVEC7
TCELL58:OUT_F7SERDES.Q1EA0_COTXSTATVEC6
TCELL58:OUT_Q6SERDES.Q1S_TISCANO9
TCELL58:OUT_Q7SERDES.Q1EA3_COTXREAD
TCELL59:OUT_F0SERDES.Q1EA1_COTXSTATVEC2
TCELL59:OUT_F1SERDES.Q1EA0_COTXSTATVEC0
TCELL59:OUT_F2SERDES.Q1EA0_COTXSTATVEC4
TCELL59:OUT_F3SERDES.Q1EA1_COTXSTATVEC3
TCELL59:OUT_F4SERDES.Q1EA1_COTXSTATVEC5
TCELL59:OUT_F5SERDES.Q1EA1_COTXSTATVEC0
TCELL59:OUT_F6SERDES.Q1EA0_COTXDONE
TCELL59:OUT_F7SERDES.Q1EA1_GOTXMACDATA6
TCELL59:OUT_Q0SERDES.Q1EA1_COTXSTATEN
TCELL59:OUT_Q1SERDES.Q1EA0_COTXSTATEN
TCELL59:OUT_Q2SERDES.Q1EA1_COTXDONE
TCELL59:OUT_Q3SERDES.Q1EA0_COTXSTATVEC3
TCELL59:OUT_Q4SERDES.Q1EA1_GOTXMACERR
TCELL59:OUT_Q5SERDES.Q1EA0_COTXSTATVEC1
TCELL59:OUT_Q6SERDES.Q1EA1_COTXSTATVEC1
TCELL59:OUT_Q7SERDES.Q1EA1_COTXSTATVEC7
TCELL60:IMUX_A2SERDES.Q1EA3_CITXEOF
TCELL60:IMUX_A3SERDES.Q1EA1_CITXEOF
TCELL60:IMUX_A4SERDES.Q1EA0_CITXEOF
TCELL60:IMUX_A5SERDES.Q1EA3_CITXLASTBYTEVLD
TCELL60:OUT_F0SERDES.Q1EA1_GOTXMACDATA7
TCELL60:OUT_F1SERDES.Q1EA0_GOTXMACERR
TCELL60:OUT_F2SERDES.Q1EA1_GOTXMACDATA4
TCELL60:OUT_F3SERDES.Q1EA1_GOTXMACWR
TCELL60:OUT_F4SERDES.Q1EA1_GOTXMACDATA2
TCELL60:OUT_F5SERDES.Q1EA1_GOTXMACDATA0
TCELL60:OUT_F6SERDES.Q1EA0_GOTXMACDATA5
TCELL60:OUT_F7SERDES.Q1EA2_GOTXMACDATA3
TCELL60:OUT_Q0SERDES.Q1EA0_COTXSTATVEC2
TCELL60:OUT_Q1SERDES.Q1EA1_COTXSTATVEC4
TCELL60:OUT_Q2SERDES.Q1EA1_COTXSTATVEC6
TCELL60:OUT_Q3SERDES.Q1EA3_GOTXMACDATA2
TCELL60:OUT_Q4SERDES.Q1EA0_COTXSTATVEC5
TCELL60:OUT_Q5SERDES.Q1EA3_GODISCARDFCS
TCELL60:OUT_Q6SERDES.Q1EA0_GOTXMACDATA4
TCELL60:OUT_Q7SERDES.Q1EA3_KORXMACCLKEN
TCELL61:IMUX_A0SERDES.Q1EA2_CITXDATA12
TCELL61:IMUX_A1SERDES.Q1EA1_CITXDATA15
TCELL61:IMUX_A2SERDES.Q1EA1_CITXDATA14
TCELL61:IMUX_A3SERDES.Q1EA1_CITXDATA13
TCELL61:IMUX_A4SERDES.Q1EA1_CITXDATA12
TCELL61:IMUX_A5SERDES.Q1EA1_CITXDATA11
TCELL61:IMUX_B0SERDES.Q1EA3_CITXDATA5
TCELL61:IMUX_B1SERDES.Q1EA3_CITXDATA4
TCELL61:IMUX_B2SERDES.Q1EA3_CITXDATA2
TCELL61:IMUX_B3SERDES.Q1EA3_CITXDATA3
TCELL61:IMUX_B4SERDES.Q1EA3_CITXDATA1
TCELL61:IMUX_B5SERDES.Q1EA3_CITXDATA0
TCELL61:IMUX_C0SERDES.Q1EA3_CITXDATA11
TCELL61:IMUX_C1SERDES.Q1EA3_CITXDATA10
TCELL61:IMUX_C2SERDES.Q1EA3_CITXDATA9
TCELL61:IMUX_C3SERDES.Q1EA3_CITXDATA8
TCELL61:IMUX_C4SERDES.Q1EA3_CITXDATA7
TCELL61:IMUX_C5SERDES.Q1EA3_CITXDATA6
TCELL61:IMUX_D0SERDES.Q1EA1_CITXLASTBYTEVLD
TCELL61:IMUX_D1SERDES.Q1EA0_CITXLASTBYTEVLD
TCELL61:IMUX_D2SERDES.Q1EA3_CITXDATA15
TCELL61:IMUX_D3SERDES.Q1EA3_CITXDATA14
TCELL61:IMUX_D4SERDES.Q1EA3_CITXDATA13
TCELL61:IMUX_D5SERDES.Q1EA3_CITXDATA12
TCELL61:OUT_F0SERDES.Q1EA2_GOTXMACWR
TCELL61:OUT_F1SERDES.Q1EA0_GOTXMACDATA1
TCELL61:OUT_F2SERDES.Q1EA0_GOTXMACDATA7
TCELL61:OUT_F3SERDES.Q1EA0_GOTXMACDATA3
TCELL61:OUT_F4SERDES.Q1EA2_GOTXMACDATA0
TCELL61:OUT_F5SERDES.Q1EA0_GOTXMACDATA6
TCELL61:OUT_F6SERDES.Q1EA3_GOTXMACDATA1
TCELL61:OUT_F7SERDES.Q1EA3_COTXDONE
TCELL61:OUT_Q0SERDES.Q1EA1_GOTXMACDATA3
TCELL61:OUT_Q1SERDES.Q1EA1_GOTXMACDATA5
TCELL61:OUT_Q2SERDES.Q1EA0_GOTXMACDATA2
TCELL61:OUT_Q3SERDES.Q1EA2_GOTXMACDATA1
TCELL61:OUT_Q4SERDES.Q1EA2_GOTXMACDATA2
TCELL61:OUT_Q5SERDES.Q1EA0_GOTXMACWR
TCELL61:OUT_Q6SERDES.Q1EA2_GOTXMACDATA7
TCELL61:OUT_Q7SERDES.Q1EA2_GOTXMACERR
TCELL62:IMUX_A0SERDES.Q1EA0_CITXDATA8
TCELL62:IMUX_A1SERDES.Q1EA0_CITXDATA7
TCELL62:IMUX_A2SERDES.Q1EA0_CITXDATA6
TCELL62:IMUX_A3SERDES.Q1EA0_CITXDATA5
TCELL62:IMUX_A4SERDES.Q1EA0_CITXDATA4
TCELL62:IMUX_A5SERDES.Q1EA0_CITXDATA3
TCELL62:IMUX_B0SERDES.Q1EA0_CITXDATA14
TCELL62:IMUX_B1SERDES.Q1EA0_CITXDATA13
TCELL62:IMUX_B2SERDES.Q1EA0_CITXDATA12
TCELL62:IMUX_B3SERDES.Q1EA0_CITXDATA11
TCELL62:IMUX_B4SERDES.Q1EA0_CITXDATA10
TCELL62:IMUX_B5SERDES.Q1EA0_CITXDATA9
TCELL62:IMUX_C0SERDES.Q1EA1_CITXDATA4
TCELL62:IMUX_C1SERDES.Q1EA1_CITXDATA3
TCELL62:IMUX_C2SERDES.Q1EA1_CITXDATA2
TCELL62:IMUX_C3SERDES.Q1EA1_CITXDATA1
TCELL62:IMUX_C4SERDES.Q1EA1_CITXDATA0
TCELL62:IMUX_C5SERDES.Q1EA0_CITXDATA15
TCELL62:IMUX_D0SERDES.Q1EA1_CITXDATA10
TCELL62:IMUX_D1SERDES.Q1EA1_CITXDATA9
TCELL62:IMUX_D2SERDES.Q1EA1_CITXDATA8
TCELL62:IMUX_D3SERDES.Q1EA1_CITXDATA7
TCELL62:IMUX_D4SERDES.Q1EA1_CITXDATA6
TCELL62:IMUX_D5SERDES.Q1EA1_CITXDATA5
TCELL62:OUT_F0SERDES.Q1EA2_KORXMACCLKEN
TCELL62:OUT_F1SERDES.Q1EA3_GOTXMACDATA3
TCELL62:OUT_F2SERDES.Q1EA3_COTXSTATEN
TCELL62:OUT_F3SERDES.Q1EA0_CORXLASTBYTEVLD
TCELL62:OUT_F4SERDES.Q1EA1_KOGBITEN
TCELL62:OUT_F5SERDES.Q1EA3_GOTXMACDATA0
TCELL62:OUT_F6SERDES.Q1EA3_COTXSTATVEC7
TCELL62:OUT_F7SERDES.Q1EA3_COTXSTATVEC5
TCELL62:OUT_Q0SERDES.Q1EA0_GOTXMACDATA0
TCELL62:OUT_Q1SERDES.Q1EA3_GOTXMACERR
TCELL62:OUT_Q2SERDES.Q1EA1_GOTXMACDATA1
TCELL62:OUT_Q3SERDES.Q1EA3_COTXDISCFRM
TCELL62:OUT_Q4SERDES.Q1EA0_GODISCARDFCS
TCELL62:OUT_Q5SERDES.Q1EA1_GODISCARDFCS
TCELL62:OUT_Q6SERDES.Q1S_TISCANO12
TCELL62:OUT_Q7SERDES.Q1EA2_COTXREAD
TCELL63:IMUX_A0SERDES.Q1EA1_CITXPAUSTIM8
TCELL63:IMUX_A1SERDES.Q1EA1_CITXEMPTY
TCELL63:IMUX_A2SERDES.Q1EA1_CITXPAUSTIM11
TCELL63:IMUX_A3SERDES.Q1EA1_CITXPAUSTIM4
TCELL63:IMUX_A4SERDES.Q1EA1_CITXPAUSTIM14
TCELL63:IMUX_A5SERDES.Q1EA2_CITXDATA5
TCELL63:IMUX_B0SERDES.Q1EA1_CITXPAUSTIM3
TCELL63:IMUX_B1SERDES.Q1EA1_CITXPAUSTIM6
TCELL63:IMUX_B2SERDES.Q1EA2_CITXDATA7
TCELL63:IMUX_B3SERDES.Q1EA2_CITXLASTBYTEVLD
TCELL63:IMUX_B4SERDES.Q1EA0_CITXDATAAVAIL
TCELL63:IMUX_B5SERDES.Q1EA1_CITXPAUSTIM9
TCELL63:IMUX_C0SERDES.Q1EA2_CITXDATA14
TCELL63:IMUX_C1SERDES.Q1EA2_CITXEOF
TCELL63:IMUX_C2SERDES.Q1EA2_CITXDATA15
TCELL63:IMUX_C3SERDES.Q1EA2_CITXDATA10
TCELL63:IMUX_C4SERDES.Q1EA2_CITXDATA9
TCELL63:IMUX_C5SERDES.Q1EA1_CITXPAUSTIM5
TCELL63:IMUX_D0SERDES.Q1EA0_CITXDATA2
TCELL63:IMUX_D1SERDES.Q1EA0_CITXDATA1
TCELL63:IMUX_D2SERDES.Q1EA0_CITXDATA0
TCELL63:IMUX_D3SERDES.Q1EA2_CITXDATA13
TCELL63:IMUX_D4SERDES.Q1EA2_CITXDATAAVAIL
TCELL63:IMUX_D5SERDES.Q1EA2_CITXDATA11
TCELL63:OUT_F0SERDES.Q1EA3_COTXSTATVEC6
TCELL63:OUT_F1SERDES.Q1EA3_COTXSTATVEC3
TCELL63:OUT_F2SERDES.Q1EA3_COTXSTATVEC0
TCELL63:OUT_F3SERDES.Q1EA3_GOTXMACDATA6
TCELL63:OUT_F4SERDES.Q1EA0_CORXWRITE
TCELL63:OUT_F5SERDES.Q1EA2_COTXDISCFRM
TCELL63:OUT_F6SERDES.Q1EA3_CORXLASTBYTEVLD
TCELL63:OUT_F7SERDES.Q1EA2_CORXLASTBYTEVLD
TCELL63:OUT_Q0SERDES.Q1EA1_KORXMACCLKEN
TCELL63:OUT_Q1SERDES.Q1EA1_CORXLASTBYTEVLD
TCELL63:OUT_Q2SERDES.Q1EA3_GOTXMACDATA5
TCELL63:OUT_Q3SERDES.Q1EA2_KOGBITEN
TCELL63:OUT_Q4SERDES.Q1EA0_KOGBITEN
TCELL63:OUT_Q5SERDES.Q1EA3_COTXSTATVEC1
TCELL63:OUT_Q6SERDES.Q1EA3_COTXSTATVEC4
TCELL63:OUT_Q7SERDES.Q1EA3_KOGBITEN
TCELL64:IMUX_A0SERDES.Q1EA1_CITXPAUSREQ
TCELL64:IMUX_A1SERDES.Q1EA0_CITXPAUSREQ
TCELL64:IMUX_A2SERDES.Q1EA1_CITXFIFOCTRL
TCELL64:IMUX_A3SERDES.Q1EA0_CITXPAUSTIM13
TCELL64:IMUX_A4SERDES.Q1EA0_CITXPAUSTIM5
TCELL64:IMUX_A5SERDES.Q1EA0_CITXPAUSTIM15
TCELL64:IMUX_B0SERDES.Q1EA1_CITXPAUSTIM13
TCELL64:IMUX_B1SERDES.Q1EA1_CITXPAUSTIM10
TCELL64:IMUX_B2SERDES.Q1EA2_CITXDATA2
TCELL64:IMUX_B3SERDES.Q1EA2_CITXDATA0
TCELL64:IMUX_B4SERDES.Q1EA2_CITXDATA3
TCELL64:IMUX_B5SERDES.Q1EA0_CITXPAUSTIM2
TCELL64:IMUX_C0SERDES.Q1EA1_CITXPAUSTIM15
TCELL64:IMUX_C1SERDES.Q1EA1_CITXPAUSTIM1
TCELL64:IMUX_C2SERDES.Q1EA0_CITXEMPTY
TCELL64:IMUX_C3SERDES.Q1EA1_CITXPAUSTIM0
TCELL64:IMUX_C4SERDES.Q1EA2_CITXDATA1
TCELL64:IMUX_C5SERDES.Q1EA2_CITXDATA4
TCELL64:IMUX_D0SERDES.Q1EA2_CITXDATA6
TCELL64:IMUX_D1SERDES.Q1EA2_CITXDATA8
TCELL64:IMUX_D2SERDES.Q1EA1_CITXDATAAVAIL
TCELL64:IMUX_D3SERDES.Q1EA1_CITXPAUSTIM7
TCELL64:IMUX_D4SERDES.Q1EA1_CITXPAUSTIM2
TCELL64:IMUX_D5SERDES.Q1EA1_CITXPAUSTIM12
TCELL64:OUT_F0SERDES.Q1EA2_COTXSTATEN
TCELL64:OUT_F1SERDES.Q1EA0_CORXEOF
TCELL64:OUT_F2SERDES.Q1EA2_COTXDONE
TCELL64:OUT_F3SERDES.Q1S_TISCANO0
TCELL64:OUT_F4SERDES.Q1EA0_KORXMACCLKEN
TCELL64:OUT_F5SERDES.Q1EA2_COTXSTATVEC3
TCELL64:OUT_F6SERDES.Q1S_TOMBISTDO8
TCELL64:OUT_F7SERDES.Q1EA2_GOTXMACDATA5
TCELL64:OUT_Q0SERDES.Q1EA3_GOTXMACDATA7
TCELL64:OUT_Q1SERDES.Q1EA0_CORXFIFOFULLERROR
TCELL64:OUT_Q2SERDES.Q1EA3_GOTXMACDATA4
TCELL64:OUT_Q3SERDES.Q1S_TISCANO14
TCELL64:OUT_Q4SERDES.Q1EA3_COTXSTATVEC2
TCELL64:OUT_Q5SERDES.Q1EA2_GOTXMACDATA4
TCELL64:OUT_Q6SERDES.Q1EA2_COTXSTATVEC6
TCELL64:OUT_Q7SERDES.Q1EA0_CORXERROR
TCELL65:IMUX_A0SERDES.Q1EA1_GISYNCCRS
TCELL65:IMUX_A1SERDES.Q1EA0_GISYNCCRS
TCELL65:IMUX_A2SERDES.Q1EA3_CITXDATAAVAIL
TCELL65:IMUX_A3SERDES.Q1EA3_CITXEMPTY
TCELL65:IMUX_A4SERDES.Q1EA3_CITXPAUSREQ
TCELL65:IMUX_A5SERDES.Q1EA3_CITXPAUSTIM13
TCELL65:IMUX_B0SERDES.Q1EA0_CITXPAUSTIM0
TCELL65:IMUX_B1SERDES.Q1EA0_CITXPAUSTIM14
TCELL65:IMUX_B2SERDES.Q1EA1_CIRXFULL
TCELL65:IMUX_B3SERDES.Q1EA0_CITXFIFOCTRL
TCELL65:IMUX_B4SERDES.Q1EA0_GISYNCCOL
TCELL65:IMUX_B5SERDES.Q1EA1_GISYNCCOL
TCELL65:IMUX_C0SERDES.Q1EA0_CITXPAUSTIM10
TCELL65:IMUX_C1SERDES.Q1EA0_CITXPAUSTIM4
TCELL65:IMUX_C2SERDES.Q1EA0_CITXPAUSTIM8
TCELL65:IMUX_C3SERDES.Q1EA0_CITXFORCEERR
TCELL65:IMUX_C4SERDES.Q1EA0_CITXPAUSTIM11
TCELL65:IMUX_C5SERDES.Q1EA0_CITXPAUSTIM12
TCELL65:IMUX_D0SERDES.Q1EA1_CITXFORCEERR
TCELL65:IMUX_D1SERDES.Q1EA0_CITXPAUSTIM3
TCELL65:IMUX_D2SERDES.Q1EA0_CITXPAUSTIM6
TCELL65:IMUX_D3SERDES.Q1EA0_CITXPAUSTIM1
TCELL65:IMUX_D4SERDES.Q1EA0_CITXPAUSTIM7
TCELL65:IMUX_D5SERDES.Q1EA0_CITXPAUSTIM9
TCELL65:OUT_F0SERDES.Q1EA2_COTXSTATVEC0
TCELL65:OUT_F1SERDES.Q1EA2_GOTXMACDATA6
TCELL65:OUT_F2SERDES.Q1EA2_COTXSTATVEC7
TCELL65:OUT_F3SERDES.Q1S_TOMBISTDO6
TCELL65:OUT_F4SERDES.Q1S_TOMBISTDO9
TCELL65:OUT_F5SERDES.Q1EA2_COTXSTATVEC5
TCELL65:OUT_Q0SERDES.Q1EA0_CORXSTATEN
TCELL65:OUT_Q1SERDES.Q1S_TOMBISTDO7
TCELL65:OUT_Q2SERDES.Q1EA2_COTXSTATVEC4
TCELL65:OUT_Q3SERDES.Q1EA2_COTXSTATVEC2
TCELL65:OUT_Q4SERDES.Q1EA0_CORXDATA14
TCELL65:OUT_Q5SERDES.Q1EA2_COTXSTATVEC1
TCELL66:IMUX_A2SERDES.Q1EA3_CITXFIFOCTRL
TCELL66:IMUX_A3SERDES.Q1EA2_CITXPAUSREQ
TCELL66:IMUX_A4SERDES.Q1EA1_KITXMACCLKENEXT
TCELL66:IMUX_A5SERDES.Q1EA0_CIRXFULL
TCELL66:IMUX_A6SERDES.Q1EA3_GISYNCCOL
TCELL66:IMUX_A7SERDES.Q1EA3_GISYNCCRS
TCELL66:IMUX_B2SERDES.Q1EA3_CITXPAUSTIM15
TCELL66:IMUX_B3SERDES.Q1EA3_CITXPAUSTIM11
TCELL66:IMUX_B4SERDES.Q1EA3_CITXPAUSTIM1
TCELL66:IMUX_B5SERDES.Q1EA3_CITXPAUSTIM3
TCELL66:IMUX_B6SERDES.Q1EA3_CITXPAUSTIM0
TCELL66:IMUX_B7SERDES.Q1EA2_CITXEMPTY
TCELL66:IMUX_C2SERDES.Q1EA3_CITXPAUSTIM9
TCELL66:IMUX_C3SERDES.Q1EA3_CITXPAUSTIM7
TCELL66:IMUX_C4SERDES.Q1EA3_CITXPAUSTIM2
TCELL66:IMUX_C5SERDES.Q1EA3_CITXPAUSTIM8
TCELL66:IMUX_C6SERDES.Q1EA3_CITXPAUSTIM14
TCELL66:IMUX_C7SERDES.Q1EA3_CITXFORCEERR
TCELL66:IMUX_D2SERDES.Q1EA3_CITXPAUSTIM6
TCELL66:IMUX_D3SERDES.Q1EA3_CITXPAUSTIM12
TCELL66:IMUX_D4SERDES.Q1EA3_CITXPAUSTIM5
TCELL66:IMUX_D5SERDES.Q1EA3_CITXPAUSTIM4
TCELL66:IMUX_D6SERDES.Q1EA3_CITXPAUSTIM10
TCELL66:IMUX_D7SERDES.Q1EA0_KITXMACCLKENEXT
TCELL66:OUT_F0SERDES.Q1EA0_CORXDATA9
TCELL66:OUT_F1SERDES.Q1EA0_CORXDATA8
TCELL66:OUT_F2SERDES.Q1S_TOMBISTDO12
TCELL66:OUT_F3SERDES.Q1S_TOMBISTDO13
TCELL66:OUT_F4SERDES.Q1EA0_CORXDATA3
TCELL66:OUT_F5SERDES.Q1EA0_CORXDATA0
TCELL66:OUT_F6SERDES.Q1EA0_CORXDATA2
TCELL66:OUT_F7SERDES.Q1EA0_CORXDATA4
TCELL66:OUT_Q0SERDES.Q1EA0_CORXDATA13
TCELL66:OUT_Q1SERDES.Q1EA0_CORXDATA10
TCELL66:OUT_Q2SERDES.Q1EA0_CORXDATA15
TCELL66:OUT_Q3SERDES.Q1EA0_CORXDATA11
TCELL66:OUT_Q4SERDES.Q1S_TOMBISTDO11
TCELL66:OUT_Q5SERDES.Q1S_TOMBISTDO10
TCELL66:OUT_Q6SERDES.Q1S_TOMBISTDO5
TCELL66:OUT_Q7SERDES.Q1EA0_CORXDATA12
TCELL67:IMUX_A2SERDES.Q1EA0_CIRXIGNOREPKT
TCELL67:IMUX_A3SERDES.Q1EA0_GISYNCRXD0
TCELL67:IMUX_A4SERDES.Q1EA0_GINONPADRXDV
TCELL67:IMUX_A5SERDES.Q1EA3_KIRXMACCLKENEXT
TCELL67:IMUX_A6SERDES.Q1EA0_GISYNCRXDV
TCELL67:IMUX_A7SERDES.Q1EA2_CITXPAUSTIM0
TCELL67:IMUX_B2SERDES.Q1EA3_KITXGMIILPBK
TCELL67:IMUX_B3SERDES.Q1EA2_CITXFORCEERR
TCELL67:IMUX_B4SERDES.Q1EA0_GISYNCRXER
TCELL67:IMUX_B5SERDES.Q1EA0_GISYNCRXD3
TCELL67:IMUX_B6SERDES.Q1EA0_GISYNCRXD7
TCELL67:IMUX_B7SERDES.Q1EA2_CITXFIFOCTRL
TCELL67:IMUX_C2SERDES.Q1EA0_GISYNCRXD4
TCELL67:IMUX_C3SERDES.Q1EA0_GIIPGSHRINK
TCELL67:IMUX_C4SERDES.Q1EA0_GISYNCNIBDRIB
TCELL67:IMUX_C5SERDES.Q1EA0_GISYNCRXD6
TCELL67:IMUX_C6SERDES.Q1EA0_GISYNCRXD2
TCELL67:IMUX_C7SERDES.Q1EA0_GISYNCRXD5
TCELL67:IMUX_D2SERDES.Q1EA3_KITXMACCLKENEXT
TCELL67:IMUX_D3SERDES.Q1EA1_KITXGMIILPBK
TCELL67:IMUX_D4SERDES.Q1EA0_KITXGMIILPBK
TCELL67:IMUX_D5SERDES.Q1EA0_KIRXMACCLKENEXT
TCELL67:IMUX_D6SERDES.Q1EA1_KIRXMACCLKENEXT
TCELL67:IMUX_D7SERDES.Q1EA0_GISYNCRXD1
TCELL67:OUT_F0SERDES.Q1EA0_CORXSTATVEC2
TCELL67:OUT_F1SERDES.Q1EA0_CORXSTATVEC3
TCELL67:OUT_F2SERDES.Q1EA0_CORXSTATVEC4
TCELL67:OUT_F3SERDES.Q1EA0_CORXSTATVEC5
TCELL67:OUT_F4SERDES.Q1EA0_CORXSTATVEC6
TCELL67:OUT_F5SERDES.Q1S_TOMBISTDO16
TCELL67:OUT_F6SERDES.Q1EA0_CORXSTATVEC7
TCELL67:OUT_F7SERDES.Q1S_TOMBISTDO3
TCELL67:OUT_Q0SERDES.Q1S_TOMBISTDO4
TCELL67:OUT_Q1SERDES.Q1EA0_CORXDATA6
TCELL67:OUT_Q2SERDES.Q1EA0_CORXDATA1
TCELL67:OUT_Q3SERDES.Q1S_TOMBISTDO14
TCELL67:OUT_Q4SERDES.Q1EA0_CORXDATA7
TCELL67:OUT_Q5SERDES.Q1S_TOMBISTDO15
TCELL67:OUT_Q6SERDES.Q1EA0_CORXDATA5
TCELL67:OUT_Q7SERDES.Q1EA0_CORXSTATVEC1
TCELL68:IMUX_A2SERDES.Q1EA2_KITXGMIILPBK
TCELL68:IMUX_A3SERDES.Q1EA3_GISYNCRXD3
TCELL68:IMUX_A4SERDES.Q1EA3_GISYNCRXD5
TCELL68:IMUX_A5SERDES.Q1EA2_KIRXMACCLKENEXT
TCELL68:IMUX_A6SERDES.Q1EA3_CIRXFULL
TCELL68:IMUX_A7SERDES.Q1EA3_GISYNCRXD7
TCELL68:IMUX_B2SERDES.Q1EA2_CITXPAUSTIM6
TCELL68:IMUX_B3SERDES.Q1EA2_CITXPAUSTIM4
TCELL68:IMUX_B4SERDES.Q1EA2_CITXPAUSTIM14
TCELL68:IMUX_B5SERDES.Q1EA2_GISYNCCRS
TCELL68:IMUX_B6SERDES.Q1EA2_GISYNCCOL
TCELL68:IMUX_B7SERDES.Q1EA2_KITXMACCLKENEXT
TCELL68:IMUX_C2SERDES.Q1EA2_CITXPAUSTIM12
TCELL68:IMUX_C3SERDES.Q1EA2_CITXPAUSTIM9
TCELL68:IMUX_C4SERDES.Q1EA2_CITXPAUSTIM10
TCELL68:IMUX_C5SERDES.Q1EA2_CITXPAUSTIM5
TCELL68:IMUX_C6SERDES.Q1EA2_CITXPAUSTIM2
TCELL68:IMUX_C7SERDES.Q1EA2_CITXPAUSTIM13
TCELL68:IMUX_D2SERDES.Q1EA2_CITXPAUSTIM1
TCELL68:IMUX_D3SERDES.Q1EA2_CITXPAUSTIM8
TCELL68:IMUX_D4SERDES.Q1EA2_CITXPAUSTIM3
TCELL68:IMUX_D5SERDES.Q1EA2_CITXPAUSTIM15
TCELL68:IMUX_D6SERDES.Q1EA2_CITXPAUSTIM7
TCELL68:IMUX_D7SERDES.Q1EA2_CITXPAUSTIM11
TCELL68:OUT_F0SERDES.Q1S_TOMBISTDO22
TCELL68:OUT_F1SERDES.Q1S_TOMBISTDO21
TCELL68:OUT_F2SERDES.Q1S_TOMBISTDO23
TCELL68:OUT_F3SERDES.Q1EA3_CORXWRITE
TCELL68:OUT_F4SERDES.Q1EA3_CORXFIFOFULLERROR
TCELL68:OUT_F5SERDES.Q1S_TOMBISTDO24
TCELL68:OUT_F6SERDES.Q1EA3_CORXEOF
TCELL68:OUT_F7SERDES.Q1EA3_CORXSTATEN
TCELL68:OUT_Q0SERDES.Q1S_TOMBISTDO17
TCELL68:OUT_Q1SERDES.Q1S_TOMBISTDO18
TCELL68:OUT_Q2SERDES.Q1S_TISCANO5
TCELL68:OUT_Q3SERDES.Q1EA2_GODISCARDFCS
TCELL68:OUT_Q4SERDES.Q1S_TOMBISTDO20
TCELL68:OUT_Q5SERDES.Q1S_TOMBISTDO19
TCELL68:OUT_Q6SERDES.Q1S_TOMBISTDO2
TCELL68:OUT_Q7SERDES.Q1EA0_CORXSTATVEC0
TCELL69:IMUX_A2SERDES.Q1EA2_GISYNCRXD4
TCELL69:IMUX_A3SERDES.Q1EA2_GISYNCRXD2
TCELL69:IMUX_A4SERDES.Q1EA2_GISYNCRXD3
TCELL69:IMUX_A5SERDES.Q1EA1_GIIPGSHRINK
TCELL69:IMUX_A6SERDES.Q1EA1_GISYNCRXDV
TCELL69:IMUX_A7SERDES.Q1S_TIMBISTSDI6
TCELL69:IMUX_B2SERDES.Q1EA1_GISYNCRXD3
TCELL69:IMUX_B3SERDES.Q1EA1_GISYNCNIBDRIB
TCELL69:IMUX_B4SERDES.Q1EA2_GIIPGSHRINK
TCELL69:IMUX_B5SERDES.Q1EA2_GISYNCRXD6
TCELL69:IMUX_B6SERDES.Q1EA2_GISYNCRXD7
TCELL69:IMUX_B7SERDES.Q1EA2_GISYNCRXD5
TCELL69:IMUX_C2SERDES.Q1EA3_CIRXIGNOREPKT
TCELL69:IMUX_C3SERDES.Q1EA3_GISYNCRXER
TCELL69:IMUX_C4SERDES.Q1EA3_GISYNCRXDV
TCELL69:IMUX_C5SERDES.Q1EA3_GISYNCNIBDRIB
TCELL69:IMUX_C6SERDES.Q1EA3_GINONPADRXDV
TCELL69:IMUX_C7SERDES.Q1EA3_GISYNCRXD0
TCELL69:IMUX_D2SERDES.Q1EA3_GISYNCRXD6
TCELL69:IMUX_D3SERDES.Q1EA3_GISYNCRXD4
TCELL69:IMUX_D4SERDES.Q1EA3_GISYNCRXD2
TCELL69:IMUX_D5SERDES.Q1EA3_GIIPGSHRINK
TCELL69:IMUX_D6SERDES.Q1EA3_GISYNCRXD1
TCELL69:IMUX_D7SERDES.Q1EA2_CIRXFULL
TCELL69:OUT_F0SERDES.Q1EA3_CORXDATA0
TCELL69:OUT_F1SERDES.Q1EA3_CORXSTATVEC3
TCELL69:OUT_F2SERDES.Q1EA3_CORXDATA2
TCELL69:OUT_F3SERDES.Q1S_TOMBISTDO1
TCELL69:OUT_F4SERDES.Q1EA3_CORXDATA6
TCELL69:OUT_F5SERDES.Q1EA3_CORXDATA15
TCELL69:OUT_F6SERDES.Q1EA3_CORXDATA7
TCELL69:OUT_F7SERDES.Q1EA3_CORXDATA9
TCELL69:OUT_Q0SERDES.Q1EA3_CORXERROR
TCELL69:OUT_Q1SERDES.Q1EA3_CORXDATA1
TCELL69:OUT_Q2SERDES.Q1EA3_CORXDATA4
TCELL69:OUT_Q3SERDES.Q1EA1_CORXSTATEN
TCELL69:OUT_Q4SERDES.Q1S_TOMBISTDO25
TCELL69:OUT_Q5SERDES.Q1EA3_CORXSTATVEC7
TCELL69:OUT_Q6SERDES.Q1EA3_CORXDATA3
TCELL69:OUT_Q7SERDES.Q1EA3_CORXDATA5
TCELL70:IMUX_A2SERDES.Q1EA1_GISYNCRXER
TCELL70:IMUX_A3SERDES.Q1S_TIMBISTSDI2
TCELL70:IMUX_A4SERDES.Q1EA2_GISYNCRXDV
TCELL70:IMUX_A5SERDES.Q1S_TIMBISTSDI1
TCELL70:IMUX_A6SERDES.Q1S_TIMBISTSDI8
TCELL70:IMUX_A7SERDES.Q1S_TIMBISTSDI9
TCELL70:IMUX_B2SERDES.Q1S_TIMBISTSDI4
TCELL70:IMUX_B3SERDES.Q1EA1_GISYNCRXD6
TCELL70:IMUX_B4SERDES.Q1EA1_GISYNCRXD5
TCELL70:IMUX_B5SERDES.Q1S_TIMBISTSDI3
TCELL70:IMUX_B6SERDES.Q1EA2_GISYNCRXER
TCELL70:IMUX_B7SERDES.Q1EA2_GISYNCRXD1
TCELL70:IMUX_C2SERDES.Q1EA1_GISYNCRXD7
TCELL70:IMUX_C3SERDES.Q1S_TIMBISTSDI7
TCELL70:IMUX_C4SERDES.Q1EA1_GISYNCRXD1
TCELL70:IMUX_C5SERDES.Q1EA2_GISYNCNIBDRIB
TCELL70:IMUX_C6SERDES.Q1EA1_GISYNCRXD4
TCELL70:IMUX_C7SERDES.Q1EA2_GISYNCRXD0
TCELL70:IMUX_D2SERDES.Q1S_TIMBISTSDI5
TCELL70:IMUX_D3SERDES.Q1EA1_GISYNCRXD0
TCELL70:IMUX_D4SERDES.Q1EA1_GISYNCRXD2
TCELL70:IMUX_D5SERDES.Q1EA1_GINONPADRXDV
TCELL70:IMUX_D6SERDES.Q1EA2_CIRXIGNOREPKT
TCELL70:IMUX_D7SERDES.Q1EA1_CIRXIGNOREPKT
TCELL70:OUT_F0SERDES.Q1EA3_CORXDATA8
TCELL70:OUT_F1SERDES.Q1EA1_CORXSTATVEC4
TCELL70:OUT_F2SERDES.Q1EA1_CORXSTATVEC3
TCELL70:OUT_F3SERDES.Q1EA3_CORXDATA11
TCELL70:OUT_F4SERDES.Q1EA3_CORXSTATVEC1
TCELL70:OUT_F5SERDES.Q1EA3_CORXDATA13
TCELL70:OUT_F6SERDES.Q1EA3_CORXSTATVEC5
TCELL70:OUT_F7SERDES.Q1EA3_CORXSTATVEC0
TCELL70:OUT_Q0SERDES.Q1EA2_CORXSTATEN
TCELL70:OUT_Q1SERDES.Q1EA3_CORXDATA12
TCELL70:OUT_Q2SERDES.Q1S_TISCANO11
TCELL70:OUT_Q3SERDES.Q1EA3_CORXSTATVEC6
TCELL70:OUT_Q4SERDES.Q1EA3_CORXSTATVEC4
TCELL70:OUT_Q5SERDES.Q1EA3_CORXDATA14
TCELL70:OUT_Q6SERDES.Q1EA3_CORXSTATVEC2
TCELL70:OUT_Q7SERDES.Q1EA3_CORXDATA10
TCELL71:IMUX_A2SERDES.Q1S_TIMBISTRA5
TCELL71:IMUX_A3SERDES.Q1S_TIMBISTSDI12
TCELL71:IMUX_A4SERDES.Q1S_TIMBISTWA6
TCELL71:IMUX_A5SERDES.Q1S_TIMBISTRA4
TCELL71:IMUX_B2SERDES.Q1S_TIMBISTWA5
TCELL71:IMUX_B3SERDES.Q1S_TIMBISTWA3
TCELL71:IMUX_B4SERDES.Q1S_TIMBISTRA6
TCELL71:IMUX_B5SERDES.Q1S_TIMBISTSDI11
TCELL71:IMUX_C2SERDES.Q1S_TIMBISTWA1
TCELL71:IMUX_C3SERDES.Q1S_TIMBISTWA2
TCELL71:IMUX_C4SERDES.Q1S_TIMBISTWA0
TCELL71:IMUX_C5SERDES.Q1S_TIMBISTRA7
TCELL71:IMUX_D2SERDES.Q1EA2_GINONPADRXDV
TCELL71:IMUX_D3SERDES.Q1S_TIMBISTSDI0
TCELL71:IMUX_D4SERDES.Q1S_TIMBISTWA4
TCELL71:IMUX_D5SERDES.Q1S_TIMBISTSDI10
TCELL71:OUT_F0SERDES.Q1EA1_CORXSTATVEC1
TCELL71:OUT_F1SERDES.Q1EA2_CORXSTATVEC1
TCELL71:OUT_F2SERDES.Q1EA2_CORXEOF
TCELL71:OUT_F3SERDES.Q1EA2_CORXERROR
TCELL71:OUT_F4SERDES.Q1EA2_CORXFIFOFULLERROR
TCELL71:OUT_F5SERDES.Q1EA1_CORXSTATVEC0
TCELL71:OUT_Q0SERDES.Q1EA1_CORXSTATVEC5
TCELL71:OUT_Q1SERDES.Q1EA2_CORXSTATVEC0
TCELL71:OUT_Q2SERDES.Q1EA2_CORXSTATVEC7
TCELL71:OUT_Q3SERDES.Q1EA1_CORXSTATVEC2
TCELL71:OUT_Q4SERDES.Q1S_TISCANO10
TCELL71:OUT_Q5SERDES.Q1EA2_CORXWRITE
TCELL72:IMUX_A2SERDES.Q1S_TIMBISTSDI33
TCELL72:IMUX_A3SERDES.Q1S_TIMBISTSDI17
TCELL72:IMUX_A4SERDES.Q1S_TIMBISTSDI32
TCELL72:IMUX_A5SERDES.Q1S_BAUDSUPPORT4
TCELL72:IMUX_A6SERDES.Q1S_TIMBISTSDI31
TCELL72:IMUX_A7SERDES.Q1S_TIMBISTSDI30
TCELL72:IMUX_B2SERDES.Q1S_TIMBISTRE
TCELL72:IMUX_B3SERDES.Q1S_TIMBISTWE
TCELL72:IMUX_B4SERDES.Q1S_TIMBISTSDI16
TCELL72:IMUX_B5SERDES.Q1S_TIMBISTMODE
TCELL72:IMUX_B6SERDES.Q1S_TIMBISTSDI35
TCELL72:IMUX_B7SERDES.Q1S_TIMBISTSDI34
TCELL72:IMUX_C2SERDES.Q1S_TIMBISTBANKSEL2
TCELL72:IMUX_C3SERDES.Q1S_TIMBISTRA0
TCELL72:IMUX_C4SERDES.Q1S_TIMBISTRA1
TCELL72:IMUX_C5SERDES.Q1S_TIMBISTBANKSEL1
TCELL72:IMUX_C6SERDES.Q1S_TIMBISTSDI14
TCELL72:IMUX_C7SERDES.Q1S_TIMBISTSDI15
TCELL72:IMUX_D2SERDES.Q1S_TIMBISTWA7
TCELL72:IMUX_D3SERDES.Q1S_TIMBISTRA3
TCELL72:IMUX_D4SERDES.Q1S_TIMBISTRA2
TCELL72:IMUX_D5SERDES.Q1S_TIMBISTSDI13
TCELL72:IMUX_D6SERDES.Q1S_TIMBISTBANKSEL0
TCELL72:IMUX_D7SERDES.Q1S_TIMBISTBANKSEL3
TCELL72:OUT_F0SERDES.Q1EA1_CORXFIFOFULLERROR
TCELL72:OUT_F1SERDES.Q1EA1_CORXDATA2
TCELL72:OUT_F2SERDES.Q1EA2_CORXDATA11
TCELL72:OUT_F3SERDES.Q1EA2_CORXSTATVEC2
TCELL72:OUT_F4SERDES.Q1EA2_CORXDATA3
TCELL72:OUT_F5SERDES.Q1EA1_CORXWRITE
TCELL72:OUT_F6SERDES.Q1EA1_CORXDATA4
TCELL72:OUT_F7SERDES.Q1EA1_CORXDATA7
TCELL72:OUT_Q0SERDES.Q1EA1_CORXSTATVEC7
TCELL72:OUT_Q1SERDES.Q1EA2_CORXSTATVEC6
TCELL72:OUT_Q2SERDES.Q1EA1_CORXSTATVEC6
TCELL72:OUT_Q3SERDES.Q1EA2_CORXSTATVEC5
TCELL72:OUT_Q4SERDES.Q1EA2_CORXDATA10
TCELL72:OUT_Q5SERDES.Q1EA1_CORXDATA3
TCELL72:OUT_Q6SERDES.Q1EA1_CORXERROR
TCELL72:OUT_Q7SERDES.Q1EA1_CORXDATA8
TCELL73:IMUX_A2SERDES.Q1S_TPORTTDI18
TCELL73:IMUX_A3SERDES.Q1S_TPORTTDI3
TCELL73:IMUX_A4SERDES.Q1S_TPORTTDI10
TCELL73:IMUX_A5SERDES.Q1S_TPORTTDI12
TCELL73:IMUX_A6SERDES.Q1S_TPORTTDI2
TCELL73:IMUX_A7SERDES.Q1S_TPORTTDI4
TCELL73:IMUX_B2SERDES.Q1S_RECOVERRSTN
TCELL73:IMUX_B3SERDES.Q1S_RXPFORCERETRYN
TCELL73:IMUX_B4SERDES.Q1S_TPORTTDI19
TCELL73:IMUX_B5SERDES.Q1S_TPORTTDI50
TCELL73:IMUX_B6SERDES.Q1S_TPORTTDI20
TCELL73:IMUX_B7SERDES.Q1S_MGTA18
TCELL73:IMUX_C2SERDES.Q1S_TIMBISTSDI22
TCELL73:IMUX_C3SERDES.Q1S_TIMBISTSDI23
TCELL73:IMUX_C4SERDES.Q1S_TIMBISTSDI24
TCELL73:IMUX_C5SERDES.Q1S_TIMBISTSDI27
TCELL73:IMUX_C6SERDES.Q1S_TIMBISTSDI25
TCELL73:IMUX_C7SERDES.Q1S_TIMBISTSDI26
TCELL73:IMUX_D2SERDES.Q1S_TIMBISTSDI18
TCELL73:IMUX_D3SERDES.Q1S_TIMBISTSDI19
TCELL73:IMUX_D4SERDES.Q1S_TIMBISTSDI29
TCELL73:IMUX_D5SERDES.Q1S_TIMBISTSDI20
TCELL73:IMUX_D6SERDES.Q1S_TIMBISTSDI21
TCELL73:IMUX_D7SERDES.Q1S_TIMBISTSDI28
TCELL73:OUT_F0SERDES.Q1EA2_CORXDATA5
TCELL73:OUT_F1SERDES.Q1EA2_CORXSTATVEC3
TCELL73:OUT_F2SERDES.Q1EA1_CORXDATA1
TCELL73:OUT_F3SERDES.Q1EA2_CORXDATA2
TCELL73:OUT_F4SERDES.Q1S_TOMBISTDO26
TCELL73:OUT_F5SERDES.Q1EA2_CORXDATA4
TCELL73:OUT_F6SERDES.Q1EA2_CORXDATA1
TCELL73:OUT_F7SERDES.Q1EA1_CORXDATA12
TCELL73:OUT_Q0SERDES.Q1EA1_CORXDATA6
TCELL73:OUT_Q1SERDES.Q1EA1_CORXDATA9
TCELL73:OUT_Q2SERDES.Q1EA1_CORXEOF
TCELL73:OUT_Q3SERDES.Q1EA1_CORXDATA0
TCELL73:OUT_Q4SERDES.Q1EA2_CORXDATA6
TCELL73:OUT_Q5SERDES.Q1EA2_CORXSTATVEC4
TCELL73:OUT_Q6SERDES.Q1EA1_CORXDATA5
TCELL73:OUT_Q7SERDES.Q1EA2_CORXDATA0
TCELL74:IMUX_A4SERDES.Q1S_TPORTTDI42
TCELL74:IMUX_A5SERDES.Q1S_TPORTTDI36
TCELL74:IMUX_A6SERDES.Q1S_TPORTTDI26
TCELL74:IMUX_A7SERDES.Q1S_TPORTTDI58
TCELL74:IMUX_B4SERDES.Q1S_TPORTTDI24
TCELL74:IMUX_B5SERDES.Q1S_TPORTTDI59
TCELL74:IMUX_B6SERDES.Q1S_TPORTTDI35
TCELL74:IMUX_B7SERDES.Q1S_TPORTTDI27
TCELL74:IMUX_C4SERDES.Q1S_TPORTTDI52
TCELL74:IMUX_C5SERDES.Q1S_TPORTTDI28
TCELL74:IMUX_C6SERDES.Q1S_TPORTTDI43
TCELL74:IMUX_C7SERDES.Q1S_TPORTTDI49
TCELL74:IMUX_D4SERDES.Q1S_TPORTTDI0
TCELL74:IMUX_D5SERDES.Q1S_TPORTTDI11
TCELL74:IMUX_D6SERDES.Q1S_TPORTTDI16
TCELL74:IMUX_D7SERDES.Q1S_TPORTTDI48
TCELL74:OUT_F0SERDES.Q1EA2_CORXDATA12
TCELL74:OUT_F1SERDES.Q1EA2_CORXDATA8
TCELL74:OUT_F4SERDES.Q1EA1_CORXDATA13
TCELL74:OUT_F5SERDES.Q1EA2_CORXDATA15
TCELL74:OUT_F6SERDES.Q1EA2_CORXDATA14
TCELL74:OUT_F7SERDES.Q1EA1_CORXDATA14
TCELL74:OUT_Q0SERDES.Q1EA2_CORXDATA7
TCELL74:OUT_Q1SERDES.Q1EA1_CORXDATA15
TCELL74:OUT_Q4SERDES.Q1S_TOMBISTDO35
TCELL74:OUT_Q5SERDES.Q1EA1_CORXDATA11
TCELL74:OUT_Q6SERDES.Q1EA2_CORXDATA9
TCELL74:OUT_Q7SERDES.Q1EA1_CORXDATA10
TCELL75:IMUX_A2SERDES.Q1S_TPORTTDI45
TCELL75:IMUX_A3SERDES.Q1S_TPORTTDI21
TCELL75:IMUX_A4SERDES.Q1S_TPORTTDI30
TCELL75:IMUX_A5SERDES.Q1S_TPORTTDI5
TCELL75:IMUX_A6SERDES.Q1S_TPORTTDI33
TCELL75:IMUX_A7SERDES.Q1S_TPORTTDI23
TCELL75:IMUX_B2SERDES.Q1S_TPORTTDI46
TCELL75:IMUX_B3SERDES.Q1S_TPORTTDI47
TCELL75:IMUX_B4SERDES.Q1S_TPORTTDI17
TCELL75:IMUX_B5SERDES.Q1S_TPORTTDI1
TCELL75:IMUX_B6SERDES.Q1S_TPORTTDI25
TCELL75:IMUX_B7SERDES.Q1S_TPORTTDI62
TCELL75:IMUX_C2SERDES.Q1S_TPORTTDI55
TCELL75:IMUX_C3SERDES.Q1S_TPORTTDI60
TCELL75:IMUX_C4SERDES.Q1S_TPORTTDI29
TCELL75:IMUX_C5SERDES.Q1S_TPORTTDI54
TCELL75:IMUX_C6SERDES.Q1S_TPORTTDI61
TCELL75:IMUX_C7SERDES.Q1S_TPORTTDI57
TCELL75:IMUX_D2SERDES.Q1S_TPORTTDI51
TCELL75:IMUX_D3SERDES.Q1S_TPORTTDI40
TCELL75:IMUX_D4SERDES.Q1S_TPORTTDI56
TCELL75:IMUX_D5SERDES.Q1S_TPORTTDI8
TCELL75:IMUX_D6SERDES.Q1S_TPORTTDI34
TCELL75:IMUX_D7SERDES.Q1S_TPORTTDI44
TCELL75:IMUX_CLK0_DELAYSERDES.Q1EA0_KITXMACCLK
TCELL75:OUT_F0SERDES.Q1S_TOMBISTDO29
TCELL75:OUT_F1SERDES.Q1S_TISCANO15
TCELL75:OUT_F2SERDES.Q1S_TISCANO19
TCELL75:OUT_F3SERDES.Q1S_TOMBISTDO0
TCELL75:OUT_F4SERDES.Q1S_STATUS11
TCELL75:OUT_F5SERDES.Q1S_OLLMMGTDI16
TCELL75:OUT_F6SERDES.Q1S_OLLMMGTDI29
TCELL75:OUT_F7SERDES.Q1S_OLLMMGTDI21
TCELL75:OUT_Q0SERDES.Q1EA2_CORXDATA13
TCELL75:OUT_Q1SERDES.Q1S_TOMBISTDO27
TCELL75:OUT_Q2SERDES.Q1S_TOMBISTDO34
TCELL75:OUT_Q3SERDES.Q1S_TOMBISTDO28
TCELL75:OUT_Q4SERDES.Q1S_TOMBISTDO33
TCELL75:OUT_Q5SERDES.Q1S_TOMBISTDO32
TCELL75:OUT_Q6SERDES.Q1S_TOMBISTDO30
TCELL75:OUT_Q7SERDES.Q1S_TOMBISTDO31
TCELL76:IMUX_A2SERDES.Q1S_TPORTCHARISK1
TCELL76:IMUX_A3SERDES.Q1S_TPORTCHARISK2
TCELL76:IMUX_A4SERDES.Q1S_MGTA15
TCELL76:IMUX_A5SERDES.Q1S_MGTA12
TCELL76:IMUX_A6SERDES.Q1S_MGTA10
TCELL76:IMUX_A7SERDES.Q1S_MGTA8
TCELL76:IMUX_B2SERDES.Q1S_TPORTTDI31
TCELL76:IMUX_B3SERDES.Q1S_MGTA14
TCELL76:IMUX_B4SERDES.Q1S_MGTA17
TCELL76:IMUX_B5SERDES.Q1S_TPORTTDI53
TCELL76:IMUX_B6SERDES.Q1S_TPORTCHARISK4
TCELL76:IMUX_B7SERDES.Q1S_TPORTTDI15
TCELL76:IMUX_C2SERDES.Q1S_TPORTTDI13
TCELL76:IMUX_C3SERDES.Q1S_TPORTTDI63
TCELL76:IMUX_C4SERDES.Q1S_TPORTTDI39
TCELL76:IMUX_C5SERDES.Q1S_TPORTTDI22
TCELL76:IMUX_C6SERDES.Q1S_TPORTTDI38
TCELL76:IMUX_C7SERDES.Q1S_TPORTTDI9
TCELL76:IMUX_D2SERDES.Q1S_TPORTTDI14
TCELL76:IMUX_D3SERDES.Q1S_TPORTTDI6
TCELL76:IMUX_D4SERDES.Q1S_TPORTTDI37
TCELL76:IMUX_D5SERDES.Q1S_TPORTTDI41
TCELL76:IMUX_D6SERDES.Q1S_TPORTTDI32
TCELL76:IMUX_D7SERDES.Q1S_TPORTTDI7
TCELL76:IMUX_CLK0_DELAYSERDES.Q1EA3_KITXMACCLK
TCELL76:IMUX_CLK1_DELAYSERDES.Q1EA0_KIRXTXFECLK
TCELL76:OUT_F0SERDES.Q1S_OLLMMGTDI23
TCELL76:OUT_F1SERDES.Q1S_OLLMMGTINTN
TCELL76:OUT_F2SERDES.Q1S_OLLMMGTDI7
TCELL76:OUT_F3SERDES.Q1S_OLLMMGTDI15
TCELL76:OUT_F4SERDES.Q1S_OLLMMGTDI30
TCELL76:OUT_F5SERDES.Q1S_OLLMMGTDI25
TCELL76:OUT_F6SERDES.Q1S_OLLMMGTDI24
TCELL76:OUT_F7SERDES.Q1S_OLLMMGTDI20
TCELL76:OUT_Q0SERDES.Q1S_OLLMMGTDI13
TCELL76:OUT_Q1SERDES.Q1S_OLLMMGTDI5
TCELL76:OUT_Q2SERDES.Q1S_OLLMMGTDI3
TCELL76:OUT_Q3SERDES.Q1S_OLLMMGTDI12
TCELL76:OUT_Q4SERDES.Q1S_OLLMMGTDI0
TCELL76:OUT_Q5SERDES.Q1S_STATUS10
TCELL76:OUT_Q6SERDES.Q1S_OLLMMGTDI22
TCELL76:OUT_Q7SERDES.Q1S_OLLMMGTDI6
TCELL77:IMUX_A2SERDES.Q1S_MGTA21
TCELL77:IMUX_A3SERDES.Q1S_MGTA3
TCELL77:IMUX_A4SERDES.Q1S_MGTA0
TCELL77:IMUX_A5SERDES.Q1S_MGTA2
TCELL77:IMUX_B2SERDES.Q1S_TPORTCHARISK5
TCELL77:IMUX_B3SERDES.Q1S_TPORTCHARISK7
TCELL77:IMUX_B4SERDES.Q1S_MGTA1
TCELL77:IMUX_B5SERDES.Q1S_MGTWRN3
TCELL77:IMUX_C2SERDES.Q1S_TPORTCHARISK0
TCELL77:IMUX_C3SERDES.Q1S_TPORTCHARISK6
TCELL77:IMUX_C4SERDES.Q1S_MGTA9
TCELL77:IMUX_C5SERDES.Q1S_TPORTCHARISK3
TCELL77:IMUX_D2SERDES.Q1S_MGTA11
TCELL77:IMUX_D3SERDES.Q1S_MGTA16
TCELL77:IMUX_D4SERDES.Q1S_MGTA13
TCELL77:IMUX_D5SERDES.Q1S_MGTA7
TCELL77:IMUX_CLK1_DELAYSERDES.Q1EA3_KIRXTXFECLK
TCELL77:IMUX_CE1SERDES.Q1S_TISCANI2
TCELL77:IMUX_CE2SERDES.Q1S_TISCANI0
TCELL77:OUT_F0SERDES.Q1S_OLLMMGTDI10
TCELL77:OUT_F1SERDES.Q1S_OLLMMGTDI27
TCELL77:OUT_F2SERDES.Q1S_OLLMMGTDI31
TCELL77:OUT_F3SERDES.Q1S_OLLMMGTDI4
TCELL77:OUT_F4SERDES.Q1S_TXLANESILENCECH2
TCELL77:OUT_F5SERDES.Q1S_STATUS17
TCELL77:OUT_Q0SERDES.Q1S_OLLMMGTDI19
TCELL77:OUT_Q1SERDES.Q1S_OLLMMGTDI18
TCELL77:OUT_Q2SERDES.Q1S_OLLMMGTDI2
TCELL77:OUT_Q3SERDES.Q1S_OLLMMGTDI14
TCELL77:OUT_Q4SERDES.Q1S_TXLANESILENCECH1
TCELL77:OUT_Q5SERDES.Q1S_TXLANESILENCECH3
TCELL78:IMUX_A2SERDES.Q1S_BAUDSUPPORT0
TCELL78:IMUX_A3SERDES.Q1S_MGTDI7
TCELL78:IMUX_A4SERDES.Q1S_PHYUSTB
TCELL78:IMUX_A5SERDES.Q1S_RCVCLKSEL1
TCELL78:IMUX_A6SERDES.Q1S_MGTDI15
TCELL78:IMUX_A7SERDES.Q1S_MGTDI27
TCELL78:IMUX_B2SERDES.Q1S_MGTDI24
TCELL78:IMUX_B3SERDES.Q1S_MGTDI25
TCELL78:IMUX_B4SERDES.Q1S_MGTDI29
TCELL78:IMUX_B5SERDES.Q1S_MGTDI28
TCELL78:IMUX_B6SERDES.Q1S_MGTDI31
TCELL78:IMUX_B7SERDES.Q1S_MGTDI30
TCELL78:IMUX_C2SERDES.Q1S_RCVCLKSEL3
TCELL78:IMUX_C3SERDES.Q1S_PHYTINITN
TCELL78:IMUX_C4SERDES.Q1S_MGTWRN1
TCELL78:IMUX_C5SERDES.Q1S_MGTWRN0
TCELL78:IMUX_C6SERDES.Q1S_MGTRDN
TCELL78:IMUX_C7SERDES.Q1S_PHYRINITN
TCELL78:IMUX_D2SERDES.Q1S_MGTA6
TCELL78:IMUX_D3SERDES.Q1S_MGTA20
TCELL78:IMUX_D4SERDES.Q1S_MGTA5
TCELL78:IMUX_D5SERDES.Q1S_MGTA4
TCELL78:IMUX_D6SERDES.Q1S_MGTWRN2
TCELL78:IMUX_D7SERDES.Q1S_MGTA19
TCELL78:IMUX_LSR0SERDES.Q1S_TISCANRSTN
TCELL78:IMUX_LSR1SERDES.Q1S_TISCANMODE
TCELL78:IMUX_CLK0_DELAYSERDES.Q1EA1_KIRXTXFECLK
TCELL78:IMUX_CLK1_DELAYSERDES.Q1EA2_KIRXTXFECLK
TCELL78:IMUX_CE0SERDES.Q1S_TISCANI9
TCELL78:IMUX_CE1SERDES.Q1S_TISCANI10
TCELL78:IMUX_CE2SERDES.Q1S_TISCANI13
TCELL78:IMUX_CE3SERDES.Q1S_TISCANI6
TCELL78:OUT_F0SERDES.Q1S_STATUS20
TCELL78:OUT_F1SERDES.Q1S_TISCANO4
TCELL78:OUT_F2SERDES.Q1S_TISCANO17
TCELL78:OUT_F3SERDES.Q1S_OLLMMGTDI9
TCELL78:OUT_F4SERDES.Q1S_LNKMCERXREQN
TCELL78:OUT_F5SERDES.Q1S_OLLMMGTDI8
TCELL78:OUT_F6SERDES.Q1S_RESPTIMEOUT0
TCELL78:OUT_F7SERDES.Q1S_PHYEMEVENTREQN
TCELL78:OUT_Q0SERDES.Q1S_OLLMMGTDI26
TCELL78:OUT_Q1SERDES.Q1S_OLLMMGTDI28
TCELL78:OUT_Q2SERDES.Q1S_OLLMMGTDI1
TCELL78:OUT_Q3SERDES.Q1S_TISCANO3
TCELL78:OUT_Q4SERDES.Q1S_TXLANESILENCECH0
TCELL78:OUT_Q5SERDES.Q1S_OLLMMGTDI17
TCELL78:OUT_Q6SERDES.Q1S_OLLMMGTRDYN
TCELL78:OUT_Q7SERDES.Q1S_OLLMMGTDI11
TCELL79:IMUX_A2SERDES.Q1S_MGTDI14
TCELL79:IMUX_A3SERDES.Q1S_OLLMEFPTR10
TCELL79:IMUX_A4SERDES.Q1S_ENABLETXFLOWCONTROLN
TCELL79:IMUX_A5SERDES.Q1S_OLLMEFPTR15
TCELL79:IMUX_A6SERDES.Q1S_MGTDI12
TCELL79:IMUX_A7SERDES.Q1S_MGTDI18
TCELL79:IMUX_B2SERDES.Q1S_MGTDI22
TCELL79:IMUX_B3SERDES.Q1S_MGTDI20
TCELL79:IMUX_B4SERDES.Q1S_MGTDI19
TCELL79:IMUX_B5SERDES.Q1S_MGTDI11
TCELL79:IMUX_B6SERDES.Q1S_OLLMEFPTR7
TCELL79:IMUX_B7SERDES.Q1S_OLLMEFPTR6
TCELL79:IMUX_C2SERDES.Q1S_MGTDI10
TCELL79:IMUX_C3SERDES.Q1S_MGTDI6
TCELL79:IMUX_C4SERDES.Q1S_MGTDI4
TCELL79:IMUX_C5SERDES.Q1S_MGTDI3
TCELL79:IMUX_C6SERDES.Q1S_MGTDI21
TCELL79:IMUX_C7SERDES.Q1S_MGTDI23
TCELL79:IMUX_D2SERDES.Q1S_BAUDSUPPORT2
TCELL79:IMUX_D3SERDES.Q1S_BAUDSUPPORT1
TCELL79:IMUX_D4SERDES.Q1S_MGTDI26
TCELL79:IMUX_D5SERDES.Q1S_BAUDSUPPORT3
TCELL79:IMUX_D6SERDES.Q1S_MGTDI5
TCELL79:IMUX_D7SERDES.Q1S_OLLMEFPTR0
TCELL79:IMUX_LSR0SERDES.Q1EA3_KIRSTN
TCELL79:IMUX_LSR1SERDES.Q1EA0_KIRSTN
TCELL79:IMUX_CLK0_DELAYSERDES.Q1EA2_KITXMACCLK
TCELL79:IMUX_CLK1_DELAYSERDES.Q1EA1_KITXMACCLK
TCELL79:IMUX_CE0SERDES.Q1S_TISCANI12
TCELL79:IMUX_CE1SERDES.Q1S_TISCANI11
TCELL79:IMUX_CE2SERDES.Q1S_TISCANI3
TCELL79:IMUX_CE3SERDES.Q1S_TISCANI21
TCELL79:OUT_F0SERDES.Q1S_RESPTIMEOUT23
TCELL79:OUT_F1SERDES.Q1S_RESPTIMEOUT22
TCELL79:OUT_F2SERDES.Q1S_PORTNERRORDETECT27
TCELL79:OUT_F3SERDES.Q1S_RESPTIMEOUT17
TCELL79:OUT_F4SERDES.Q1S_PORTNERRORDETECT11
TCELL79:OUT_F5SERDES.Q1S_RESPTIMEOUT2
TCELL79:OUT_F6SERDES.Q1S_RESPTIMEOUT21
TCELL79:OUT_F7SERDES.Q1S_PORTNERRORDETECT9
TCELL79:OUT_Q0SERDES.Q1S_PORTNERRORDETECT28
TCELL79:OUT_Q1SERDES.Q1S_PORTNERRORDETECT10
TCELL79:OUT_Q2SERDES.Q1S_PORTNERRORDETECT30
TCELL79:OUT_Q3SERDES.Q1S_PORTNERRORDETECT29
TCELL79:OUT_Q4SERDES.Q1S_PORTNERRORDETECT26
TCELL79:OUT_Q5SERDES.Q1S_OUTPUTUNRECOVERREVENTREQN
TCELL79:OUT_Q6SERDES.Q1S_PORTNERRORDETECT31
TCELL79:OUT_Q7SERDES.Q1S_RESPTIMEOUT1
TCELL80:IMUX_A2SERDES.Q1S_MGTDI9
TCELL80:IMUX_A3SERDES.Q1S_OUTPUTUNRECOVERREVENTACKN
TCELL80:IMUX_A4SERDES.Q1S_LNKMCERXACKN
TCELL80:IMUX_A5SERDES.Q1S_PHYMSTB
TCELL80:IMUX_A6SERDES.Q1S_PHYEMEVENTACKN
TCELL80:IMUX_A7SERDES.Q1S_LOOPBACK0
TCELL80:IMUX_B2SERDES.Q1S_OLLMEFPTR12
TCELL80:IMUX_B3SERDES.Q1S_MGTDI2
TCELL80:IMUX_B4SERDES.Q1S_MGTDI13
TCELL80:IMUX_B5SERDES.Q1S_MGTDI0
TCELL80:IMUX_B6SERDES.Q1S_MGTDI1
TCELL80:IMUX_B7SERDES.Q1S_MGTDI8
TCELL80:IMUX_C2SERDES.Q1S_OLLMEFPTR4
TCELL80:IMUX_C3SERDES.Q1S_OLLMEFPTR14
TCELL80:IMUX_C4SERDES.Q1S_OLLMEFPTR13
TCELL80:IMUX_C5SERDES.Q1S_OLLMEFPTR3
TCELL80:IMUX_C6SERDES.Q1S_OLLMEFPTR9
TCELL80:IMUX_C7SERDES.Q1S_OLLMEFPTR11
TCELL80:IMUX_D2SERDES.Q1S_OLLMEFPTR5
TCELL80:IMUX_D3SERDES.Q1S_OLLMEFPTR8
TCELL80:IMUX_D4SERDES.Q1S_MGTDI17
TCELL80:IMUX_D5SERDES.Q1S_OLLMEFPTR2
TCELL80:IMUX_D6SERDES.Q1S_MGTDI16
TCELL80:IMUX_D7SERDES.Q1S_OLLMEFPTR1
TCELL80:IMUX_LSR0SERDES.Q1EA2_KIRSTN
TCELL80:IMUX_LSR1SERDES.Q1EA1_KIRSTN
TCELL80:IMUX_CLK0_DELAYSERDES.Q1EA1_KIRXMACCLK
TCELL80:IMUX_CLK1_DELAYSERDES.Q1EA0_KIRXMACCLK
TCELL80:IMUX_CE0SERDES.Q1S_TISCANI23
TCELL80:IMUX_CE1SERDES.Q1S_TISCANI25
TCELL80:IMUX_CE2SERDES.Q1S_TISCANI28
TCELL80:IMUX_CE3SERDES.Q1S_TISCANI29
TCELL80:OUT_F0SERDES.Q1S_RESPTIMEOUT6
TCELL80:OUT_F1SERDES.Q1S_RESPTIMEOUT5
TCELL80:OUT_F2SERDES.Q1S_STATUS16
TCELL80:OUT_F3SERDES.Q1S_RESPTIMEOUT16
TCELL80:OUT_F4SERDES.Q1S_PORTNERRORDETECT13
TCELL80:OUT_F5SERDES.Q1S_RESPTIMEOUT4
TCELL80:OUT_F6SERDES.Q1S_RESPTIMEOUT8
TCELL80:OUT_F7SERDES.Q1S_PORTNERRORDETECT14
TCELL80:OUT_Q0SERDES.Q1S_PORTNERRORDETECT12
TCELL80:OUT_Q1SERDES.Q1S_RESPTIMEOUT20
TCELL80:OUT_Q2SERDES.Q1S_RESPTIMEOUT19
TCELL80:OUT_Q3SERDES.Q1S_RESPTIMEOUT18
TCELL80:OUT_Q4SERDES.Q1S_SYSRSTON
TCELL80:OUT_Q5SERDES.Q1S_RESPTIMEOUT3
TCELL80:OUT_Q6SERDES.Q1S_RESPTIMEOUT7
TCELL80:OUT_Q7SERDES.Q1S_PORTNERRORDETECT8
TCELL81:IMUX_A2SERDES.Q1S_WM11
TCELL81:IMUX_A3SERDES.Q1S_WM03
TCELL81:IMUX_A4SERDES.Q1S_WM22
TCELL81:IMUX_A5SERDES.Q1S_WM21
TCELL81:IMUX_A6SERDES.Q1S_GEAR
TCELL81:IMUX_A7SERDES.Q1S_TLNKD63
TCELL81:IMUX_B2SERDES.Q1S_WM13
TCELL81:IMUX_B3SERDES.Q1S_WM10
TCELL81:IMUX_B4SERDES.Q1S_WM00
TCELL81:IMUX_B5SERDES.Q1S_WM01
TCELL81:IMUX_B6SERDES.Q1S_WM12
TCELL81:IMUX_B7SERDES.Q1S_WM23
TCELL81:IMUX_C2SERDES.Q1S_TXSYNCCTRL0
TCELL81:IMUX_C3SERDES.Q1S_RCVCLKSEL0
TCELL81:IMUX_C4SERDES.Q1S_RCVCLKSEL2
TCELL81:IMUX_C5SERDES.Q1S_TPORTENABLEN
TCELL81:IMUX_C6SERDES.Q1S_WM20
TCELL81:IMUX_C7SERDES.Q1S_WM02
TCELL81:IMUX_D2SERDES.Q1S_RXSYNCCTRL1
TCELL81:IMUX_D3SERDES.Q1S_LOOPBACK1
TCELL81:IMUX_D4SERDES.Q1S_LOOPBACK2
TCELL81:IMUX_D5SERDES.Q1S_RXSYNCCTRL0
TCELL81:IMUX_D6SERDES.Q1S_LNKMCETXREQN
TCELL81:IMUX_D7SERDES.Q1S_TXSYNCCTRL1
TCELL81:IMUX_LSR0SERDES.Q1S_TISCANENA
TCELL81:IMUX_LSR1SERDES.Q1S_PHYRSTN
TCELL81:IMUX_CLK0_DELAYSERDES.Q1EA2_KIRXMACCLK
TCELL81:IMUX_CLK1_DELAYSERDES.Q1EA3_KIRXMACCLK
TCELL81:IMUX_CE0SERDES.Q1S_TISCANI27
TCELL81:IMUX_CE1SERDES.Q1S_TISCANI26
TCELL81:IMUX_CE2SERDES.Q1S_TISCANI24
TCELL81:IMUX_CE3SERDES.Q1S_TISCANI22
TCELL81:OUT_F0SERDES.Q1S_STATUS14
TCELL81:OUT_F1SERDES.Q1S_FLOWFIFOACKON3
TCELL81:OUT_F2SERDES.Q1S_TISCANO6
TCELL81:OUT_F3SERDES.Q1S_BUFFDEQACKADVPTRN
TCELL81:OUT_F4SERDES.Q1S_FLOWFIFOACKON1
TCELL81:OUT_F5SERDES.Q1S_LNKMCETXACKN
TCELL81:OUT_F6SERDES.Q1S_TISCANO7
TCELL81:OUT_F7SERDES.Q1S_FLOWFIFOACKON2
TCELL81:OUT_Q0SERDES.Q1S_RESPTIMEOUT15
TCELL81:OUT_Q1SERDES.Q1S_LNKTOUTPUTPORTENABLE
TCELL81:OUT_Q2SERDES.Q1S_RESPTIMEOUT9
TCELL81:OUT_Q3SERDES.Q1S_RESPTIMEOUT14
TCELL81:OUT_Q4SERDES.Q1S_RESPTIMEOUT10
TCELL81:OUT_Q5SERDES.Q1S_RESPTIMEOUT13
TCELL81:OUT_Q6SERDES.Q1S_RESPTIMEOUT11
TCELL81:OUT_Q7SERDES.Q1S_RESPTIMEOUT12
TCELL82:IMUX_A2SERDES.Q1S_TLNKD44
TCELL82:IMUX_A3SERDES.Q1S_TLNKD43
TCELL82:IMUX_A4SERDES.Q1S_TLNKD42
TCELL82:IMUX_A5SERDES.Q1S_TLNKD41
TCELL82:IMUX_A6SERDES.Q1S_TLNKD40
TCELL82:IMUX_A7SERDES.Q1S_TLNKD39
TCELL82:IMUX_B2SERDES.Q1S_TLNKD50
TCELL82:IMUX_B3SERDES.Q1S_TLNKD49
TCELL82:IMUX_B4SERDES.Q1S_TLNKD48
TCELL82:IMUX_B5SERDES.Q1S_TLNKD47
TCELL82:IMUX_B6SERDES.Q1S_TLNKD46
TCELL82:IMUX_B7SERDES.Q1S_TLNKD45
TCELL82:IMUX_C2SERDES.Q1S_TLNKD56
TCELL82:IMUX_C3SERDES.Q1S_TLNKD55
TCELL82:IMUX_C4SERDES.Q1S_TLNKD54
TCELL82:IMUX_C5SERDES.Q1S_TLNKD53
TCELL82:IMUX_C6SERDES.Q1S_TLNKD52
TCELL82:IMUX_C7SERDES.Q1S_TLNKD51
TCELL82:IMUX_D2SERDES.Q1S_TLNKD62
TCELL82:IMUX_D3SERDES.Q1S_TLNKD61
TCELL82:IMUX_D4SERDES.Q1S_TLNKD60
TCELL82:IMUX_D5SERDES.Q1S_TLNKD59
TCELL82:IMUX_D6SERDES.Q1S_TLNKD58
TCELL82:IMUX_D7SERDES.Q1S_TLNKD57
TCELL82:IMUX_LSR0SERDES.Q1S_SOFTRSTN
TCELL82:IMUX_LSR1SERDES.Q1S_SYSRSTIN
TCELL82:IMUX_CLK0_DELAYSERDES.Q1S_PHYCLK
TCELL82:IMUX_CLK1_DELAYSERDES.Q1S_TISCANCLK
TCELL82:IMUX_CE0SERDES.Q1S_TISCANI20
TCELL82:IMUX_CE1SERDES.Q1S_TISCANI14
TCELL82:IMUX_CE2SERDES.Q1S_TISCANI17
TCELL82:IMUX_CE3SERDES.Q1S_TISCANI5
TCELL82:OUT_F0SERDES.Q1S_TISCANO21
TCELL82:OUT_F1SERDES.Q1S_TISCANO22
TCELL82:OUT_F2SERDES.Q1S_STATUS6
TCELL82:OUT_F3SERDES.Q1S_STATUS8
TCELL82:OUT_F4SERDES.Q1S_STATUS3
TCELL82:OUT_F5SERDES.Q1S_STATUS12
TCELL82:OUT_F6SERDES.Q1S_TISCANO23
TCELL82:OUT_F7SERDES.Q1S_TXFLOWCTRLSTATE0
TCELL82:OUT_Q0SERDES.Q1S_TXENQUEUEFLOWN2
TCELL82:OUT_Q1SERDES.Q1S_TXENQUEUEFLOWN3
TCELL82:OUT_Q2SERDES.Q1S_TISCANO8
TCELL82:OUT_Q3SERDES.Q1S_FLOWFIFOACKON0
TCELL82:OUT_Q4SERDES.Q1S_TXENQUEUEFLOWN1
TCELL82:OUT_Q5SERDES.Q1S_MGTCLKRSTN
TCELL82:OUT_Q6SERDES.Q1S_TXENQUEUEFLOWN0
TCELL82:OUT_Q7SERDES.Q1S_TISCANO20
TCELL83:IMUX_A2SERDES.Q1S_TLNKD17
TCELL83:IMUX_A3SERDES.Q1S_TLNKD6
TCELL83:IMUX_A4SERDES.Q1S_TLNKD32
TCELL83:IMUX_A5SERDES.Q1S_TLNKD30
TCELL83:IMUX_A6SERDES.Q1S_TLNKD21
TCELL83:IMUX_A7SERDES.Q1S_RLNKDSTRDYN
TCELL83:IMUX_B2SERDES.Q1S_TLNKD19
TCELL83:IMUX_B3SERDES.Q1S_TLNKD31
TCELL83:IMUX_B4SERDES.Q1S_TLNKD34
TCELL83:IMUX_B5SERDES.Q1S_TLNKD26
TCELL83:IMUX_B6SERDES.Q1S_TLNKD33
TCELL83:IMUX_B7SERDES.Q1S_TLNKD29
TCELL83:IMUX_C2SERDES.Q1S_TLNKD24
TCELL83:IMUX_C3SERDES.Q1S_TLNKD23
TCELL83:IMUX_C4SERDES.Q1S_TLNKD28
TCELL83:IMUX_C5SERDES.Q1S_TLNKD22
TCELL83:IMUX_C6SERDES.Q1S_TLNKD14
TCELL83:IMUX_C7SERDES.Q1S_TLNKREM2
TCELL83:IMUX_D2SERDES.Q1S_TLNKD38
TCELL83:IMUX_D3SERDES.Q1S_TLNKD37
TCELL83:IMUX_D4SERDES.Q1S_TLNKD36
TCELL83:IMUX_D5SERDES.Q1S_TLNKD35
TCELL83:IMUX_D6SERDES.Q1S_TLNKD27
TCELL83:IMUX_D7SERDES.Q1S_TLNKD25
TCELL83:IMUX_LSR0SERDES.Q1S_MGTRSTN
TCELL83:IMUX_LSR1SERDES.Q1S_RIORSTN
TCELL83:IMUX_CLK0_DELAYSERDES.Q1S_RIOCLK
TCELL83:IMUX_CLK1_DELAYSERDES.Q1S_MGTCLK
TCELL83:IMUX_CE0SERDES.Q1S_TISCANI4
TCELL83:IMUX_CE1SERDES.Q1S_TISCANI8
TCELL83:IMUX_CE2SERDES.Q1S_TISCANI18
TCELL83:IMUX_CE3SERDES.Q1S_TISCANI7
TCELL83:OUT_F0SERDES.Q1S_STATUS5
TCELL83:OUT_F1SERDES.Q1S_STATUS0
TCELL83:OUT_F2SERDES.Q1S_STATUS7
TCELL83:OUT_F3SERDES.Q1S_STATUS19
TCELL83:OUT_F4SERDES.Q1S_TXFLOWCTRLSTATE3
TCELL83:OUT_F5SERDES.Q1S_TISCANO27
TCELL83:OUT_F6SERDES.Q1S_RXINITN
TCELL83:OUT_F7SERDES.Q1S_TXINITN
TCELL83:OUT_Q0SERDES.Q1S_STATUS1
TCELL83:OUT_Q1SERDES.Q1S_TXFLOWCTRLSTATE1
TCELL83:OUT_Q2SERDES.Q1S_STATUS4
TCELL83:OUT_Q3SERDES.Q1S_TISCANO24
TCELL83:OUT_Q4SERDES.Q1S_STATUS2
TCELL83:OUT_Q5SERDES.Q1S_TISCANO25
TCELL83:OUT_Q6SERDES.Q1S_TISCANO26
TCELL83:OUT_Q7SERDES.Q1S_STATUS18
TCELL84:IMUX_A2SERDES.Q1S_TLNKREM1
TCELL84:IMUX_A3SERDES.Q1S_TLNKREM0
TCELL84:IMUX_A4SERDES.Q1S_TLNKD0
TCELL84:IMUX_A5SERDES.Q1S_TLNKD3
TCELL84:IMUX_A6SERDES.Q1S_TLNKD4
TCELL84:IMUX_A7SERDES.Q1S_TLNKD11
TCELL84:IMUX_B2SERDES.Q1S_TLNKD10
TCELL84:IMUX_B3SERDES.Q1S_TLNKD9
TCELL84:IMUX_B4SERDES.Q1S_TLNKD8
TCELL84:IMUX_B5SERDES.Q1S_TLNKD7
TCELL84:IMUX_B6SERDES.Q1S_TLNKSRCRDYN
TCELL84:IMUX_B7SERDES.Q1S_TLNKD2
TCELL84:IMUX_C2SERDES.Q1S_TLNKD20
TCELL84:IMUX_C3SERDES.Q1S_TLNKD18
TCELL84:IMUX_C4SERDES.Q1S_TLNKSRCDSCN
TCELL84:IMUX_C5SERDES.Q1S_TLNKD12
TCELL84:IMUX_C6SERDES.Q1S_TLNKD16
TCELL84:IMUX_C7SERDES.Q1S_TLNKD1
TCELL84:IMUX_D2SERDES.Q1S_TLNKD15
TCELL84:IMUX_D3SERDES.Q1S_TLNKD13
TCELL84:IMUX_D4SERDES.Q1S_TLNKD5
TCELL84:IMUX_D5SERDES.Q1S_TLNKEOFN
TCELL84:IMUX_D6SERDES.Q1S_RLNKDSTDSCN
TCELL84:IMUX_D7SERDES.Q1S_TLNKSOFN
TCELL84:IMUX_LSR0SERDES.Q1S_LNKDIV2RSTN
TCELL84:IMUX_LSR1SERDES.Q1S_LNKRSTN
TCELL84:IMUX_CLK0_DELAYSERDES.Q1S_LNKCLKDIV2
TCELL84:IMUX_CLK1_DELAYSERDES.Q1S_LNKCLK
TCELL84:IMUX_CE0SERDES.Q1S_TISCANI19
TCELL84:IMUX_CE1SERDES.Q1S_TISCANI16
TCELL84:IMUX_CE2SERDES.Q1S_TISCANI1
TCELL84:IMUX_CE3SERDES.Q1S_TISCANI15
TCELL84:OUT_F0SERDES.Q1S_STATUS21
TCELL84:OUT_F1SERDES.Q1S_PORTNERRORDETECT23
TCELL84:OUT_F2SERDES.Q1S_PORTNERRORDETECT24
TCELL84:OUT_F3SERDES.Q1S_PORTNERRORDETECT25
TCELL84:OUT_F4SERDES.Q1S_PORTNERRORDETECT20
TCELL84:OUT_F5SERDES.Q1S_PORTNERRORDETECT21
TCELL84:OUT_F6SERDES.Q1S_PORTNERRORDETECT18
TCELL84:OUT_F7SERDES.Q1S_PORTNERRORDETECT19
TCELL84:OUT_Q0SERDES.Q1S_TXFLOWCTRLSTATE2
TCELL84:OUT_Q1SERDES.Q1S_TISCANO28
TCELL84:OUT_Q2SERDES.Q1S_MASTERENABLE
TCELL84:OUT_Q3SERDES.Q1S_TISCANO18
TCELL84:OUT_Q4SERDES.Q1S_STATUS13
TCELL84:OUT_Q5SERDES.Q1S_TXFLOWCTRLSTATE4
TCELL84:OUT_Q6SERDES.Q1S_TISCANO29
TCELL84:OUT_Q7SERDES.Q1S_PORTDISABLE
TCELL89:OUT_F0SERDES.Q1S_PORTNERRORDETECT3
TCELL89:OUT_F1SERDES.Q1S_PORTNERRORDETECT2
TCELL89:OUT_F2SERDES.Q1S_PORTNERRORDETECT1
TCELL89:OUT_F3SERDES.Q1S_PORTNERRORDETECT0
TCELL89:OUT_F4SERDES.Q1S_DECRBUFCNTVECTOR9
TCELL89:OUT_F5SERDES.Q1S_DECRBUFCNTVECTOR8
TCELL89:OUT_F6SERDES.Q1S_DECRBUFCNTVECTOR7
TCELL89:OUT_F7SERDES.Q1S_DECRBUFCNTVECTOR5
TCELL89:OUT_Q0SERDES.Q1S_PORTNERRORDETECT17
TCELL89:OUT_Q1SERDES.Q1S_PORTNERRORDETECT15
TCELL89:OUT_Q2SERDES.Q1S_PORTNERRORDETECT7
TCELL89:OUT_Q3SERDES.Q1S_PORTNERRORDETECT5
TCELL89:OUT_Q4SERDES.Q1S_PORTNERRORDETECT16
TCELL89:OUT_Q5SERDES.Q1S_PORTNERRORDETECT22
TCELL89:OUT_Q6SERDES.Q1S_PORTNERRORDETECT4
TCELL89:OUT_Q7SERDES.Q1S_PORTNERRORDETECT6
TCELL90:OUT_F0SERDES.Q1S_RLNKBEATS4
TCELL90:OUT_F1SERDES.Q1S_RLNKBEATS3
TCELL90:OUT_F2SERDES.Q1S_RLNKBEATS2
TCELL90:OUT_F3SERDES.Q1S_RLNKBEATS1
TCELL90:OUT_F4SERDES.Q1S_RLNKBEATS0
TCELL90:OUT_F5SERDES.Q1S_RLNKD63
TCELL90:OUT_F6SERDES.Q1S_RLNKD62
TCELL90:OUT_F7SERDES.Q1S_RLNKD61
TCELL90:OUT_Q0SERDES.Q1S_DECRBUFCNTVECTOR4
TCELL90:OUT_Q1SERDES.Q1S_DECRBUFCNTVECTOR3
TCELL90:OUT_Q2SERDES.Q1S_DECRBUFCNTVECTOR2
TCELL90:OUT_Q3SERDES.Q1S_DECRBUFCNTVECTOR1
TCELL90:OUT_Q4SERDES.Q1S_DECRBUFCNTVECTOR0
TCELL90:OUT_Q5SERDES.Q1S_RLNKBEATS7
TCELL90:OUT_Q6SERDES.Q1S_RLNKBEATS6
TCELL90:OUT_Q7SERDES.Q1S_RLNKBEATS5
TCELL91:OUT_F0SERDES.Q1S_RLNKD53
TCELL91:OUT_F1SERDES.Q1S_RLNKD52
TCELL91:OUT_F2SERDES.Q1S_RLNKD51
TCELL91:OUT_F3SERDES.Q1S_RLNKD50
TCELL91:OUT_F4SERDES.Q1S_RLNKD49
TCELL91:OUT_F5SERDES.Q1S_RLNKD48
TCELL91:OUT_F6SERDES.Q1S_RLNKD47
TCELL91:OUT_F7SERDES.Q1S_RLNKD46
TCELL91:OUT_Q0SERDES.Q1S_RLNKD60
TCELL91:OUT_Q1SERDES.Q1S_RLNKD59
TCELL91:OUT_Q2SERDES.Q1S_RLNKD58
TCELL91:OUT_Q3SERDES.Q1S_RLNKD57
TCELL91:OUT_Q4SERDES.Q1S_RLNKD56
TCELL91:OUT_Q5SERDES.Q1S_RLNKD55
TCELL91:OUT_Q6SERDES.Q1S_TISCANO16
TCELL91:OUT_Q7SERDES.Q1S_RLNKD54
TCELL92:OUT_F0SERDES.Q1S_RLNKD37
TCELL92:OUT_F1SERDES.Q1S_RLNKD36
TCELL92:OUT_F2SERDES.Q1S_RLNKD35
TCELL92:OUT_F3SERDES.Q1S_RLNKD34
TCELL92:OUT_F4SERDES.Q1S_RLNKD33
TCELL92:OUT_F5SERDES.Q1S_RLNKD32
TCELL92:OUT_F6SERDES.Q1S_RLNKD31
TCELL92:OUT_F7SERDES.Q1S_LNKCLKDIV2RSTN
TCELL92:OUT_Q0SERDES.Q1S_RLNKD45
TCELL92:OUT_Q1SERDES.Q1S_RLNKD44
TCELL92:OUT_Q2SERDES.Q1S_RLNKD43
TCELL92:OUT_Q3SERDES.Q1S_RLNKD42
TCELL92:OUT_Q4SERDES.Q1S_RLNKD41
TCELL92:OUT_Q5SERDES.Q1S_RLNKD40
TCELL92:OUT_Q6SERDES.Q1S_RLNKD39
TCELL92:OUT_Q7SERDES.Q1S_RLNKD38
TCELL93:OUT_F0SERDES.Q1S_RLNKD23
TCELL93:OUT_F1SERDES.Q1S_RLNKD22
TCELL93:OUT_F2SERDES.Q1S_RLNKD21
TCELL93:OUT_F3SERDES.Q1S_RLNKD20
TCELL93:OUT_F4SERDES.Q1S_RLNKD19
TCELL93:OUT_F5SERDES.Q1S_RLNKD18
TCELL93:OUT_F6SERDES.Q1S_RLNKD17
TCELL93:OUT_F7SERDES.Q1S_RLNKD16
TCELL93:OUT_Q0SERDES.Q1S_STATUS9
TCELL93:OUT_Q1SERDES.Q1S_RLNKD30
TCELL93:OUT_Q2SERDES.Q1S_RLNKD29
TCELL93:OUT_Q3SERDES.Q1S_RLNKD28
TCELL93:OUT_Q4SERDES.Q1S_RLNKD27
TCELL93:OUT_Q5SERDES.Q1S_RLNKD26
TCELL93:OUT_Q6SERDES.Q1S_RLNKD25
TCELL93:OUT_Q7SERDES.Q1S_RLNKD24
TCELL94:OUT_F0SERDES.Q1S_RLNKD10
TCELL94:OUT_F1SERDES.Q1S_RLNKD9
TCELL94:OUT_F2SERDES.Q1S_RLNKD8
TCELL94:OUT_F3SERDES.Q1S_RLNKD7
TCELL94:OUT_F4SERDES.Q1S_RLNKD6
TCELL94:OUT_F5SERDES.Q1S_RLNKD5
TCELL94:OUT_F6SERDES.Q1S_STATUS15
TCELL94:OUT_F7SERDES.Q1S_TISCANO1
TCELL94:OUT_Q0SERDES.Q1S_RLNKD15
TCELL94:OUT_Q1SERDES.Q1S_LNKCLKRSTN
TCELL94:OUT_Q2SERDES.Q1S_RLNKD14
TCELL94:OUT_Q3SERDES.Q1S_RLNKD13
TCELL94:OUT_Q4SERDES.Q1S_RLNKD12
TCELL94:OUT_Q5SERDES.Q1S_RLNKD11
TCELL94:OUT_Q6SERDES.Q1S_RLNKD4
TCELL94:OUT_Q7SERDES.Q1S_RLNKD3
TCELL95:OUT_F0SERDES.Q1S_TLNKDSTRDYN
TCELL95:OUT_F1SERDES.Q1S_RLNKEOFN
TCELL95:OUT_F2SERDES.Q1S_RLNKSOFN
TCELL95:OUT_F3SERDES.Q1S_RLNKSRCRDYN
TCELL95:OUT_F4SERDES.Q1S_TISCANO2
TCELL95:OUT_F5SERDES.Q1S_DECRBUFCNTVECTOR6
TCELL95:OUT_F6SERDES.Q1CH3_FDRX24
TCELL95:OUT_F7SERDES.Q1CH3_FDRX25
TCELL95:OUT_Q0SERDES.Q1S_RLNKD2
TCELL95:OUT_Q1SERDES.Q1S_RLNKD1
TCELL95:OUT_Q2SERDES.Q1S_RLNKD0
TCELL95:OUT_Q3SERDES.Q1S_RLNKREM2
TCELL95:OUT_Q4SERDES.Q1S_RLNKREM1
TCELL95:OUT_Q5SERDES.Q1S_RLNKREM0
TCELL95:OUT_Q6SERDES.Q1CH3_FDRX16
TCELL95:OUT_Q7SERDES.Q1CH3_FDRX17
TCELL96:OUT_F0SERDES.Q1CH3_FDRX26
TCELL96:OUT_F1SERDES.Q1CH3_FDRX27
TCELL96:OUT_F2SERDES.Q1CH3_FDRX28
TCELL96:OUT_F3SERDES.Q1CH3_FDRX29
TCELL96:OUT_F4SERDES.Q1CH3_FDRX30
TCELL96:OUT_F5SERDES.Q1CH3_FDRX31
TCELL96:OUT_F6SERDES.Q1CH3_FDRX40
TCELL96:OUT_F7SERDES.Q1CH3_FDRX41
TCELL96:OUT_Q0SERDES.Q1CH3_FDRX18
TCELL96:OUT_Q1SERDES.Q1CH3_FDRX19
TCELL96:OUT_Q2SERDES.Q1CH3_FDRX20
TCELL96:OUT_Q3SERDES.Q1CH3_FDRX21
TCELL96:OUT_Q4SERDES.Q1CH3_FDRX22
TCELL96:OUT_Q5SERDES.Q1CH3_FDRX23
TCELL96:OUT_Q6SERDES.Q1CH3_FDRX32
TCELL96:OUT_Q7SERDES.Q1CH3_FDRX33
TCELL97:IMUX_A0SERDES.Q1CH1_FCPLLLOL
TCELL97:IMUX_A1SERDES.Q1CH0_FCPLLLOL
TCELL97:IMUX_A2SERDES.Q1CH3_FCCDRFORCEDLOCK
TCELL97:IMUX_A3SERDES.Q1CH2_FCCDRFORCEDLOCK
TCELL97:IMUX_A4SERDES.Q1CH1_FCCDRFORCEDLOCK
TCELL97:IMUX_A5SERDES.Q1CH0_FCCDRFORCEDLOCK
TCELL97:IMUX_B0SERDES.Q1CH3_FDLDRTX
TCELL97:IMUX_B1SERDES.Q1CH2_FDLDRTX
TCELL97:IMUX_B2SERDES.Q1CH1_FDLDRTX
TCELL97:IMUX_B3SERDES.Q1CH0_FDLDRTX
TCELL97:IMUX_B4SERDES.Q1CH3_FCPLLLOL
TCELL97:IMUX_B5SERDES.Q1CH2_FCPLLLOL
TCELL97:IMUX_C0SERDES.Q1CH1_FCTXMARGIN0
TCELL97:IMUX_C1SERDES.Q1CH1_FCTXMARGIN1
TCELL97:IMUX_C2SERDES.Q1CH1_FCTXMARGIN2
TCELL97:IMUX_C3SERDES.Q1CH0_FCTXMARGIN0
TCELL97:IMUX_C4SERDES.Q1CH0_FCTXMARGIN1
TCELL97:IMUX_C5SERDES.Q1CH0_FCTXMARGIN2
TCELL97:IMUX_D0SERDES.Q1CH3_FCTXMARGIN0
TCELL97:IMUX_D1SERDES.Q1CH3_FCTXMARGIN1
TCELL97:IMUX_D2SERDES.Q1CH3_FCTXMARGIN2
TCELL97:IMUX_D3SERDES.Q1CH2_FCTXMARGIN0
TCELL97:IMUX_D4SERDES.Q1CH2_FCTXMARGIN1
TCELL97:IMUX_D5SERDES.Q1CH2_FCTXMARGIN2
TCELL97:IMUX_LSR0SERDES.Q1CH1_FCTRST
TCELL97:IMUX_LSR1SERDES.Q1CH0_FCTRST
TCELL97:IMUX_CLK0_DELAYSERDES.Q1_FISYNCCLK
TCELL97:IMUX_CLK1_DELAYSERDES.Q1_FIRXTESTCLK
TCELL97:OUT_F0SERDES.Q1CH3_FDRX42
TCELL97:OUT_F1SERDES.Q1CH3_FDRX43
TCELL97:OUT_F2SERDES.Q1CH3_FDRX44
TCELL97:OUT_F3SERDES.Q1CH3_FDRX45
TCELL97:OUT_F4SERDES.Q1CH3_FDRX46
TCELL97:OUT_F5SERDES.Q1CH3_FDRX47
TCELL97:OUT_F6SERDES.Q1CH2_FDRX8
TCELL97:OUT_F7SERDES.Q1CH2_FDRX9
TCELL97:OUT_Q0SERDES.Q1CH3_FDRX34
TCELL97:OUT_Q1SERDES.Q1CH3_FDRX35
TCELL97:OUT_Q2SERDES.Q1CH3_FDRX36
TCELL97:OUT_Q3SERDES.Q1CH3_FDRX37
TCELL97:OUT_Q4SERDES.Q1CH3_FDRX38
TCELL97:OUT_Q5SERDES.Q1CH3_FDRX39
TCELL97:OUT_Q6SERDES.Q1CH2_FDRX0
TCELL97:OUT_Q7SERDES.Q1CH2_FDRX1
TCELL98:IMUX_A0SERDES.Q1CH3_FDTX2
TCELL98:IMUX_A1SERDES.Q1CH3_FDTX3
TCELL98:IMUX_A2SERDES.Q1CH3_FDTX4
TCELL98:IMUX_A3SERDES.Q1CH3_FDTX5
TCELL98:IMUX_A4SERDES.Q1CH3_FDTX6
TCELL98:IMUX_A5SERDES.Q1CH3_FDTX7
TCELL98:IMUX_B0SERDES.Q1CH3_FCPCIEDETEN
TCELL98:IMUX_B1SERDES.Q1CH2_FCPCIEDETEN
TCELL98:IMUX_B2SERDES.Q1CH1_FCPCIEDETEN
TCELL98:IMUX_B3SERDES.Q1CH0_FCPCIEDETEN
TCELL98:IMUX_B4SERDES.Q1CH3_FDTX0
TCELL98:IMUX_B5SERDES.Q1CH3_FDTX1
TCELL98:IMUX_C0SERDES.Q1CH1_FCWORDALGNEN
TCELL98:IMUX_C1SERDES.Q1CH0_FCWORDALGNEN
TCELL98:IMUX_C2SERDES.Q1CH3_FCRXPOLARITY
TCELL98:IMUX_C3SERDES.Q1CH2_FCRXPOLARITY
TCELL98:IMUX_C4SERDES.Q1CH1_FCRXPOLARITY
TCELL98:IMUX_C5SERDES.Q1CH0_FCRXPOLARITY
TCELL98:IMUX_D0SERDES.Q1CH3_FCLSMEN
TCELL98:IMUX_D1SERDES.Q1CH2_FCLSMEN
TCELL98:IMUX_D2SERDES.Q1CH1_FCLSMEN
TCELL98:IMUX_D3SERDES.Q1CH0_FCLSMEN
TCELL98:IMUX_D4SERDES.Q1CH3_FCWORDALGNEN
TCELL98:IMUX_D5SERDES.Q1CH2_FCWORDALGNEN
TCELL98:IMUX_LSR0SERDES.Q1CH3_FCRRST
TCELL98:IMUX_LSR1SERDES.Q1CH2_FCRRST
TCELL98:IMUX_CLK0_DELAYSERDES.Q1_FIGRPFBTWCLK1
TCELL98:IMUX_CLK1_DELAYSERDES.Q1_FIGRPFBTWCLK0
TCELL98:OUT_F0SERDES.Q1CH2_FDRX10
TCELL98:OUT_F1SERDES.Q1CH2_FDRX11
TCELL98:OUT_F2SERDES.Q1CH2_FDRX12
TCELL98:OUT_F3SERDES.Q1CH2_FDRX13
TCELL98:OUT_F4SERDES.Q1CH2_FDRX14
TCELL98:OUT_F5SERDES.Q1CH2_FDRX15
TCELL98:OUT_F6SERDES.Q1CH2_FDRX24
TCELL98:OUT_F7SERDES.Q1CH2_FDRX25
TCELL98:OUT_Q0SERDES.Q1CH2_FDRX2
TCELL98:OUT_Q1SERDES.Q1CH2_FDRX3
TCELL98:OUT_Q2SERDES.Q1CH2_FDRX4
TCELL98:OUT_Q3SERDES.Q1CH2_FDRX5
TCELL98:OUT_Q4SERDES.Q1CH2_FDRX6
TCELL98:OUT_Q5SERDES.Q1CH2_FDRX7
TCELL98:OUT_Q6SERDES.Q1CH2_FDRX16
TCELL98:OUT_Q7SERDES.Q1CH2_FDRX17
TCELL99:IMUX_A0SERDES.Q1CH3_FDTX26
TCELL99:IMUX_A1SERDES.Q1CH3_FDTX27
TCELL99:IMUX_A2SERDES.Q1CH3_FDTX28
TCELL99:IMUX_A3SERDES.Q1CH3_FDTX29
TCELL99:IMUX_A4SERDES.Q1CH3_FDTX30
TCELL99:IMUX_A5SERDES.Q1CH3_FDTX31
TCELL99:IMUX_B0SERDES.Q1CH3_FDTX20
TCELL99:IMUX_B1SERDES.Q1CH3_FDTX21
TCELL99:IMUX_B2SERDES.Q1CH3_FDTX22
TCELL99:IMUX_B3SERDES.Q1CH3_FDTX23
TCELL99:IMUX_B4SERDES.Q1CH3_FDTX24
TCELL99:IMUX_B5SERDES.Q1CH3_FDTX25
TCELL99:IMUX_C0SERDES.Q1CH3_FDTX14
TCELL99:IMUX_C1SERDES.Q1CH3_FDTX15
TCELL99:IMUX_C2SERDES.Q1CH3_FDTX16
TCELL99:IMUX_C3SERDES.Q1CH3_FDTX17
TCELL99:IMUX_C4SERDES.Q1CH3_FDTX18
TCELL99:IMUX_C5SERDES.Q1CH3_FDTX19
TCELL99:IMUX_D0SERDES.Q1CH3_FDTX8
TCELL99:IMUX_D1SERDES.Q1CH3_FDTX9
TCELL99:IMUX_D2SERDES.Q1CH3_FDTX10
TCELL99:IMUX_D3SERDES.Q1CH3_FDTX11
TCELL99:IMUX_D4SERDES.Q1CH3_FDTX12
TCELL99:IMUX_D5SERDES.Q1CH3_FDTX13
TCELL99:IMUX_LSR0SERDES.Q1CH1_FCRRST
TCELL99:IMUX_LSR1SERDES.Q1CH0_FCRRST
TCELL99:IMUX_CLK0_DELAYSERDES.Q1_FIGRPFBRRCLK1
TCELL99:IMUX_CLK1_DELAYSERDES.Q1_FIGRPFBRRCLK0
TCELL99:OUT_F0SERDES.Q1CH2_FDRX26
TCELL99:OUT_F1SERDES.Q1CH2_FDRX27
TCELL99:OUT_F2SERDES.Q1CH2_FDRX28
TCELL99:OUT_F3SERDES.Q1CH2_FDRX29
TCELL99:OUT_F4SERDES.Q1CH2_FDRX30
TCELL99:OUT_F5SERDES.Q1CH2_FDRX31
TCELL99:OUT_F6SERDES.Q1CH2_FDRX40
TCELL99:OUT_F7SERDES.Q1CH2_FDRX41
TCELL99:OUT_Q0SERDES.Q1CH2_FDRX18
TCELL99:OUT_Q1SERDES.Q1CH2_FDRX19
TCELL99:OUT_Q2SERDES.Q1CH2_FDRX20
TCELL99:OUT_Q3SERDES.Q1CH2_FDRX21
TCELL99:OUT_Q4SERDES.Q1CH2_FDRX22
TCELL99:OUT_Q5SERDES.Q1CH2_FDRX23
TCELL99:OUT_Q6SERDES.Q1CH2_FDRX32
TCELL99:OUT_Q7SERDES.Q1CH2_FDRX33
TCELL100:IMUX_A0SERDES.Q1CH2_FDTX0
TCELL100:IMUX_A1SERDES.Q1CH2_FDTX1
TCELL100:IMUX_A2SERDES.Q1CH2_FDTX2
TCELL100:IMUX_A3SERDES.Q1CH2_FDTX3
TCELL100:IMUX_A4SERDES.Q1CH2_FDTX4
TCELL100:IMUX_A5SERDES.Q1CH2_FDTX5
TCELL100:IMUX_B0SERDES.Q1CH3_FDTX44
TCELL100:IMUX_B1SERDES.Q1CH3_FDTX45
TCELL100:IMUX_B2SERDES.Q1CH3_FDTX46
TCELL100:IMUX_B3SERDES.Q1CH3_FDTX47
TCELL100:IMUX_B4SERDES.Q1CH3_FDTX48
TCELL100:IMUX_B5SERDES.Q1CH3_FDTX49
TCELL100:IMUX_C0SERDES.Q1CH3_FDTX38
TCELL100:IMUX_C1SERDES.Q1CH3_FDTX39
TCELL100:IMUX_C2SERDES.Q1CH3_FDTX40
TCELL100:IMUX_C3SERDES.Q1CH3_FDTX41
TCELL100:IMUX_C4SERDES.Q1CH3_FDTX42
TCELL100:IMUX_C5SERDES.Q1CH3_FDTX43
TCELL100:IMUX_D0SERDES.Q1CH3_FDTX32
TCELL100:IMUX_D1SERDES.Q1CH3_FDTX33
TCELL100:IMUX_D2SERDES.Q1CH3_FDTX34
TCELL100:IMUX_D3SERDES.Q1CH3_FDTX35
TCELL100:IMUX_D4SERDES.Q1CH3_FDTX36
TCELL100:IMUX_D5SERDES.Q1CH3_FDTX37
TCELL100:IMUX_LSR0SERDES.Q1CH3_FCPCSRXRST
TCELL100:IMUX_LSR1SERDES.Q1CH2_FCPCSRXRST
TCELL100:IMUX_CLK0_DELAYSERDES.Q1CH2_FITCLK
TCELL100:IMUX_CLK1_DELAYSERDES.Q1CH3_FITCLK
TCELL100:OUT_F0SERDES.Q1CH2_FDRX42
TCELL100:OUT_F1SERDES.Q1CH2_FDRX43
TCELL100:OUT_F2SERDES.Q1CH2_FDRX44
TCELL100:OUT_F3SERDES.Q1CH2_FDRX45
TCELL100:OUT_F4SERDES.Q1CH2_FDRX46
TCELL100:OUT_F5SERDES.Q1CH2_FDRX47
TCELL100:OUT_F6SERDES.Q1CH1_FDRX8
TCELL100:OUT_F7SERDES.Q1CH1_FDRX9
TCELL100:OUT_Q0SERDES.Q1CH2_FDRX34
TCELL100:OUT_Q1SERDES.Q1CH2_FDRX35
TCELL100:OUT_Q2SERDES.Q1CH2_FDRX36
TCELL100:OUT_Q3SERDES.Q1CH2_FDRX37
TCELL100:OUT_Q4SERDES.Q1CH2_FDRX38
TCELL100:OUT_Q5SERDES.Q1CH2_FDRX39
TCELL100:OUT_Q6SERDES.Q1CH1_FDRX0
TCELL100:OUT_Q7SERDES.Q1CH1_FDRX1
TCELL101:IMUX_A0SERDES.Q1CH2_FDTX24
TCELL101:IMUX_A1SERDES.Q1CH2_FDTX25
TCELL101:IMUX_A2SERDES.Q1CH2_FDTX26
TCELL101:IMUX_A3SERDES.Q1CH2_FDTX27
TCELL101:IMUX_A4SERDES.Q1CH2_FDTX28
TCELL101:IMUX_A5SERDES.Q1CH2_FDTX29
TCELL101:IMUX_B0SERDES.Q1CH2_FDTX18
TCELL101:IMUX_B1SERDES.Q1CH2_FDTX19
TCELL101:IMUX_B2SERDES.Q1CH2_FDTX20
TCELL101:IMUX_B3SERDES.Q1CH2_FDTX21
TCELL101:IMUX_B4SERDES.Q1CH2_FDTX22
TCELL101:IMUX_B5SERDES.Q1CH2_FDTX23
TCELL101:IMUX_C0SERDES.Q1CH2_FDTX12
TCELL101:IMUX_C1SERDES.Q1CH2_FDTX13
TCELL101:IMUX_C2SERDES.Q1CH2_FDTX14
TCELL101:IMUX_C3SERDES.Q1CH2_FDTX15
TCELL101:IMUX_C4SERDES.Q1CH2_FDTX16
TCELL101:IMUX_C5SERDES.Q1CH2_FDTX17
TCELL101:IMUX_D0SERDES.Q1CH2_FDTX6
TCELL101:IMUX_D1SERDES.Q1CH2_FDTX7
TCELL101:IMUX_D2SERDES.Q1CH2_FDTX8
TCELL101:IMUX_D3SERDES.Q1CH2_FDTX9
TCELL101:IMUX_D4SERDES.Q1CH2_FDTX10
TCELL101:IMUX_D5SERDES.Q1CH2_FDTX11
TCELL101:IMUX_LSR0SERDES.Q1CH1_FCPCSRXRST
TCELL101:IMUX_LSR1SERDES.Q1CH0_FCPCSRXRST
TCELL101:IMUX_CLK0_DELAYSERDES.Q1CH0_FITCLK
TCELL101:IMUX_CLK1_DELAYSERDES.Q1CH1_FITCLK
TCELL101:OUT_F0SERDES.Q1CH1_FDRX10
TCELL101:OUT_F1SERDES.Q1CH1_FDRX11
TCELL101:OUT_F2SERDES.Q1CH1_FDRX12
TCELL101:OUT_F3SERDES.Q1CH1_FDRX13
TCELL101:OUT_F4SERDES.Q1CH1_FDRX14
TCELL101:OUT_F5SERDES.Q1CH1_FDRX15
TCELL101:OUT_Q0SERDES.Q1CH1_FDRX2
TCELL101:OUT_Q1SERDES.Q1CH1_FDRX3
TCELL101:OUT_Q2SERDES.Q1CH1_FDRX4
TCELL101:OUT_Q3SERDES.Q1CH1_FDRX5
TCELL101:OUT_Q4SERDES.Q1CH1_FDRX6
TCELL101:OUT_Q5SERDES.Q1CH1_FDRX7
TCELL102:IMUX_A2SERDES.Q1CH2_FDTX48
TCELL102:IMUX_A3SERDES.Q1CH2_FDTX49
TCELL102:IMUX_A4SERDES.Q1CH1_FDTX0
TCELL102:IMUX_A5SERDES.Q1CH1_FDTX1
TCELL102:IMUX_A6SERDES.Q1CH1_FDTX2
TCELL102:IMUX_A7SERDES.Q1CH1_FDTX3
TCELL102:IMUX_B2SERDES.Q1CH2_FDTX42
TCELL102:IMUX_B3SERDES.Q1CH2_FDTX43
TCELL102:IMUX_B4SERDES.Q1CH2_FDTX44
TCELL102:IMUX_B5SERDES.Q1CH2_FDTX45
TCELL102:IMUX_B6SERDES.Q1CH2_FDTX46
TCELL102:IMUX_B7SERDES.Q1CH2_FDTX47
TCELL102:IMUX_C2SERDES.Q1CH2_FDTX36
TCELL102:IMUX_C3SERDES.Q1CH2_FDTX37
TCELL102:IMUX_C4SERDES.Q1CH2_FDTX38
TCELL102:IMUX_C5SERDES.Q1CH2_FDTX39
TCELL102:IMUX_C6SERDES.Q1CH2_FDTX40
TCELL102:IMUX_C7SERDES.Q1CH2_FDTX41
TCELL102:IMUX_D2SERDES.Q1CH2_FDTX30
TCELL102:IMUX_D3SERDES.Q1CH2_FDTX31
TCELL102:IMUX_D4SERDES.Q1CH2_FDTX32
TCELL102:IMUX_D5SERDES.Q1CH2_FDTX33
TCELL102:IMUX_D6SERDES.Q1CH2_FDTX34
TCELL102:IMUX_D7SERDES.Q1CH2_FDTX35
TCELL102:IMUX_LSR0SERDES.Q1CH3_FCPCSTXRST
TCELL102:IMUX_LSR1SERDES.Q1CH2_FCPCSTXRST
TCELL102:IMUX_CLK0_DELAYSERDES.Q1CH2_FIRCLK
TCELL102:IMUX_CLK1_DELAYSERDES.Q1CH3_FIRCLK
TCELL102:OUT_F0SERDES.Q1CH1_FDRX24
TCELL102:OUT_F1SERDES.Q1CH1_FDRX25
TCELL102:OUT_F2SERDES.Q1CH1_FDRX26
TCELL102:OUT_F3SERDES.Q1CH1_FDRX27
TCELL102:OUT_F4SERDES.Q1CH1_FDRX28
TCELL102:OUT_F5SERDES.Q1CH1_FDRX29
TCELL102:OUT_F6SERDES.Q1CH1_FDRX30
TCELL102:OUT_F7SERDES.Q1CH1_FDRX31
TCELL102:OUT_Q0SERDES.Q1CH1_FDRX16
TCELL102:OUT_Q1SERDES.Q1CH1_FDRX17
TCELL102:OUT_Q2SERDES.Q1CH1_FDRX18
TCELL102:OUT_Q3SERDES.Q1CH1_FDRX19
TCELL102:OUT_Q4SERDES.Q1CH1_FDRX20
TCELL102:OUT_Q5SERDES.Q1CH1_FDRX21
TCELL102:OUT_Q6SERDES.Q1CH1_FDRX22
TCELL102:OUT_Q7SERDES.Q1CH1_FDRX23
TCELL103:IMUX_A2SERDES.Q1CH1_FDTX22
TCELL103:IMUX_A3SERDES.Q1CH1_FDTX23
TCELL103:IMUX_A4SERDES.Q1CH1_FDTX24
TCELL103:IMUX_A5SERDES.Q1CH1_FDTX25
TCELL103:IMUX_A6SERDES.Q1CH1_FDTX26
TCELL103:IMUX_A7SERDES.Q1CH1_FDTX27
TCELL103:IMUX_B2SERDES.Q1CH1_FDTX16
TCELL103:IMUX_B3SERDES.Q1CH1_FDTX17
TCELL103:IMUX_B4SERDES.Q1CH1_FDTX18
TCELL103:IMUX_B5SERDES.Q1CH1_FDTX19
TCELL103:IMUX_B6SERDES.Q1CH1_FDTX20
TCELL103:IMUX_B7SERDES.Q1CH1_FDTX21
TCELL103:IMUX_C2SERDES.Q1CH1_FDTX10
TCELL103:IMUX_C3SERDES.Q1CH1_FDTX11
TCELL103:IMUX_C4SERDES.Q1CH1_FDTX12
TCELL103:IMUX_C5SERDES.Q1CH1_FDTX13
TCELL103:IMUX_C6SERDES.Q1CH1_FDTX14
TCELL103:IMUX_C7SERDES.Q1CH1_FDTX15
TCELL103:IMUX_D2SERDES.Q1CH1_FDTX4
TCELL103:IMUX_D3SERDES.Q1CH1_FDTX5
TCELL103:IMUX_D4SERDES.Q1CH1_FDTX6
TCELL103:IMUX_D5SERDES.Q1CH1_FDTX7
TCELL103:IMUX_D6SERDES.Q1CH1_FDTX8
TCELL103:IMUX_D7SERDES.Q1CH1_FDTX9
TCELL103:IMUX_LSR0SERDES.Q1CH1_FCPCSTXRST
TCELL103:IMUX_LSR1SERDES.Q1CH0_FCPCSTXRST
TCELL103:IMUX_CLK0_DELAYSERDES.Q1CH0_FIRCLK
TCELL103:IMUX_CLK1_DELAYSERDES.Q1CH1_FIRCLK
TCELL103:OUT_F0SERDES.Q1CH1_FDRX40
TCELL103:OUT_F1SERDES.Q1CH1_FDRX41
TCELL103:OUT_F2SERDES.Q1CH1_FDRX42
TCELL103:OUT_F3SERDES.Q1CH1_FDRX43
TCELL103:OUT_F4SERDES.Q1CH1_FDRX44
TCELL103:OUT_F5SERDES.Q1CH1_FDRX45
TCELL103:OUT_F6SERDES.Q1CH1_FDRX46
TCELL103:OUT_F7SERDES.Q1CH1_FDRX47
TCELL103:OUT_Q0SERDES.Q1CH1_FDRX32
TCELL103:OUT_Q1SERDES.Q1CH1_FDRX33
TCELL103:OUT_Q2SERDES.Q1CH1_FDRX34
TCELL103:OUT_Q3SERDES.Q1CH1_FDRX35
TCELL103:OUT_Q4SERDES.Q1CH1_FDRX36
TCELL103:OUT_Q5SERDES.Q1CH1_FDRX37
TCELL103:OUT_Q6SERDES.Q1CH1_FDRX38
TCELL103:OUT_Q7SERDES.Q1CH1_FDRX39
TCELL104:IMUX_A2SERDES.Q1CH1_FDTX46
TCELL104:IMUX_A3SERDES.Q1CH1_FDTX47
TCELL104:IMUX_A4SERDES.Q1CH1_FDTX48
TCELL104:IMUX_A5SERDES.Q1CH1_FDTX49
TCELL104:IMUX_A6SERDES.Q1CH0_FDTX0
TCELL104:IMUX_A7SERDES.Q1CH0_FDTX1
TCELL104:IMUX_B2SERDES.Q1CH1_FDTX40
TCELL104:IMUX_B3SERDES.Q1CH1_FDTX41
TCELL104:IMUX_B4SERDES.Q1CH1_FDTX42
TCELL104:IMUX_B5SERDES.Q1CH1_FDTX43
TCELL104:IMUX_B6SERDES.Q1CH1_FDTX44
TCELL104:IMUX_B7SERDES.Q1CH1_FDTX45
TCELL104:IMUX_C2SERDES.Q1CH1_FDTX34
TCELL104:IMUX_C3SERDES.Q1CH1_FDTX35
TCELL104:IMUX_C4SERDES.Q1CH1_FDTX36
TCELL104:IMUX_C5SERDES.Q1CH1_FDTX37
TCELL104:IMUX_C6SERDES.Q1CH1_FDTX38
TCELL104:IMUX_C7SERDES.Q1CH1_FDTX39
TCELL104:IMUX_D2SERDES.Q1CH1_FDTX28
TCELL104:IMUX_D3SERDES.Q1CH1_FDTX29
TCELL104:IMUX_D4SERDES.Q1CH1_FDTX30
TCELL104:IMUX_D5SERDES.Q1CH1_FDTX31
TCELL104:IMUX_D6SERDES.Q1CH1_FDTX32
TCELL104:IMUX_D7SERDES.Q1CH1_FDTX33
TCELL104:IMUX_LSR0SERDES.Q1D1_FCDERST
TCELL104:IMUX_LSR1SERDES.Q1D0_FCDERST
TCELL104:IMUX_CLK0_DELAYSERDES.Q1CH2_FIREFRXCLK
TCELL104:IMUX_CLK1_DELAYSERDES.Q1CH3_FIREFRXCLK
TCELL104:OUT_F0SERDES.Q1CH0_FDRX8
TCELL104:OUT_F1SERDES.Q1CH0_FDRX9
TCELL104:OUT_F2SERDES.Q1CH0_FDRX10
TCELL104:OUT_F3SERDES.Q1CH0_FDRX11
TCELL104:OUT_F4SERDES.Q1CH0_FDRX12
TCELL104:OUT_F5SERDES.Q1CH0_FDRX13
TCELL104:OUT_F6SERDES.Q1CH0_FDRX14
TCELL104:OUT_F7SERDES.Q1CH0_FDRX15
TCELL104:OUT_Q0SERDES.Q1CH0_FDRX0
TCELL104:OUT_Q1SERDES.Q1CH0_FDRX1
TCELL104:OUT_Q2SERDES.Q1CH0_FDRX2
TCELL104:OUT_Q3SERDES.Q1CH0_FDRX3
TCELL104:OUT_Q4SERDES.Q1CH0_FDRX4
TCELL104:OUT_Q5SERDES.Q1CH0_FDRX5
TCELL104:OUT_Q6SERDES.Q1CH0_FDRX6
TCELL104:OUT_Q7SERDES.Q1CH0_FDRX7
TCELL105:IMUX_A2SERDES.Q1CH0_FDTX20
TCELL105:IMUX_A3SERDES.Q1CH0_FDTX21
TCELL105:IMUX_A4SERDES.Q1CH0_FDTX22
TCELL105:IMUX_A5SERDES.Q1CH0_FDTX23
TCELL105:IMUX_A6SERDES.Q1CH0_FDTX24
TCELL105:IMUX_A7SERDES.Q1CH0_FDTX25
TCELL105:IMUX_B2SERDES.Q1CH0_FDTX14
TCELL105:IMUX_B3SERDES.Q1CH0_FDTX15
TCELL105:IMUX_B4SERDES.Q1CH0_FDTX16
TCELL105:IMUX_B5SERDES.Q1CH0_FDTX17
TCELL105:IMUX_B6SERDES.Q1CH0_FDTX18
TCELL105:IMUX_B7SERDES.Q1CH0_FDTX19
TCELL105:IMUX_C2SERDES.Q1CH0_FDTX8
TCELL105:IMUX_C3SERDES.Q1CH0_FDTX9
TCELL105:IMUX_C4SERDES.Q1CH0_FDTX10
TCELL105:IMUX_C5SERDES.Q1CH0_FDTX11
TCELL105:IMUX_C6SERDES.Q1CH0_FDTX12
TCELL105:IMUX_C7SERDES.Q1CH0_FDTX13
TCELL105:IMUX_D2SERDES.Q1CH0_FDTX2
TCELL105:IMUX_D3SERDES.Q1CH0_FDTX3
TCELL105:IMUX_D4SERDES.Q1CH0_FDTX4
TCELL105:IMUX_D5SERDES.Q1CH0_FDTX5
TCELL105:IMUX_D6SERDES.Q1CH0_FDTX6
TCELL105:IMUX_D7SERDES.Q1CH0_FDTX7
TCELL105:IMUX_LSR0SERDES.Q1CH3_FCPIPEPHYRESETN
TCELL105:IMUX_LSR1SERDES.Q1CH2_FCPIPEPHYRESETN
TCELL105:IMUX_CLK0_DELAYSERDES.Q1CH0_FIREFRXCLK
TCELL105:IMUX_CLK1_DELAYSERDES.Q1CH1_FIREFRXCLK
TCELL105:IMUX_CE0SERDES.Q1CH3_FCDFEUPD
TCELL105:IMUX_CE1SERDES.Q1CH2_FCDFEUPD
TCELL105:IMUX_CE2SERDES.Q1CH1_FCDFEUPD
TCELL105:IMUX_CE3SERDES.Q1CH0_FCDFEUPD
TCELL105:OUT_F0SERDES.Q1CH0_FDRX24
TCELL105:OUT_F1SERDES.Q1CH0_FDRX25
TCELL105:OUT_F2SERDES.Q1CH0_FDRX26
TCELL105:OUT_F3SERDES.Q1CH0_FDRX27
TCELL105:OUT_F4SERDES.Q1CH0_FDRX28
TCELL105:OUT_F5SERDES.Q1CH0_FDRX29
TCELL105:OUT_F6SERDES.Q1CH0_FDRX30
TCELL105:OUT_F7SERDES.Q1CH0_FDRX31
TCELL105:OUT_Q0SERDES.Q1CH0_FDRX16
TCELL105:OUT_Q1SERDES.Q1CH0_FDRX17
TCELL105:OUT_Q2SERDES.Q1CH0_FDRX18
TCELL105:OUT_Q3SERDES.Q1CH0_FDRX19
TCELL105:OUT_Q4SERDES.Q1CH0_FDRX20
TCELL105:OUT_Q5SERDES.Q1CH0_FDRX21
TCELL105:OUT_Q6SERDES.Q1CH0_FDRX22
TCELL105:OUT_Q7SERDES.Q1CH0_FDRX23
TCELL106:IMUX_A2SERDES.Q1CH0_FDTX44
TCELL106:IMUX_A3SERDES.Q1CH0_FDTX45
TCELL106:IMUX_A4SERDES.Q1CH0_FDTX46
TCELL106:IMUX_A5SERDES.Q1CH0_FDTX47
TCELL106:IMUX_A6SERDES.Q1CH0_FDTX48
TCELL106:IMUX_A7SERDES.Q1CH0_FDTX49
TCELL106:IMUX_B2SERDES.Q1CH0_FDTX38
TCELL106:IMUX_B3SERDES.Q1CH0_FDTX39
TCELL106:IMUX_B4SERDES.Q1CH0_FDTX40
TCELL106:IMUX_B5SERDES.Q1CH0_FDTX41
TCELL106:IMUX_B6SERDES.Q1CH0_FDTX42
TCELL106:IMUX_B7SERDES.Q1CH0_FDTX43
TCELL106:IMUX_C2SERDES.Q1CH0_FDTX32
TCELL106:IMUX_C3SERDES.Q1CH0_FDTX33
TCELL106:IMUX_C4SERDES.Q1CH0_FDTX34
TCELL106:IMUX_C5SERDES.Q1CH0_FDTX35
TCELL106:IMUX_C6SERDES.Q1CH0_FDTX36
TCELL106:IMUX_C7SERDES.Q1CH0_FDTX37
TCELL106:IMUX_D2SERDES.Q1CH0_FDTX26
TCELL106:IMUX_D3SERDES.Q1CH0_FDTX27
TCELL106:IMUX_D4SERDES.Q1CH0_FDTX28
TCELL106:IMUX_D5SERDES.Q1CH0_FDTX29
TCELL106:IMUX_D6SERDES.Q1CH0_FDTX30
TCELL106:IMUX_D7SERDES.Q1CH0_FDTX31
TCELL106:IMUX_LSR0SERDES.Q1CH1_FCPIPEPHYRESETN
TCELL106:IMUX_LSR1SERDES.Q1CH0_FCPIPEPHYRESETN
TCELL106:IMUX_CLK0_DELAYSERDES.Q1_HSPLLREFCLKI
TCELL106:IMUX_CLK1_DELAYSERDES.Q1_LSPLLREFCLKI
TCELL106:IMUX_CE0SERDES.Q1CH3_FCDFERDEN
TCELL106:IMUX_CE1SERDES.Q1CH2_FCDFERDEN
TCELL106:IMUX_CE2SERDES.Q1CH1_FCDFERDEN
TCELL106:IMUX_CE3SERDES.Q1CH0_FCDFERDEN
TCELL106:OUT_F0SERDES.Q1CH0_FDRX40
TCELL106:OUT_F1SERDES.Q1CH0_FDRX41
TCELL106:OUT_F2SERDES.Q1CH0_FDRX42
TCELL106:OUT_F3SERDES.Q1CH0_FDRX43
TCELL106:OUT_F4SERDES.Q1CH0_FDRX44
TCELL106:OUT_F5SERDES.Q1CH0_FDRX45
TCELL106:OUT_F6SERDES.Q1CH0_FDRX46
TCELL106:OUT_F7SERDES.Q1CH0_FDRX47
TCELL106:OUT_Q0SERDES.Q1CH0_FDRX32
TCELL106:OUT_Q1SERDES.Q1CH0_FDRX33
TCELL106:OUT_Q2SERDES.Q1CH0_FDRX34
TCELL106:OUT_Q3SERDES.Q1CH0_FDRX35
TCELL106:OUT_Q4SERDES.Q1CH0_FDRX36
TCELL106:OUT_Q5SERDES.Q1CH0_FDRX37
TCELL106:OUT_Q6SERDES.Q1CH0_FDRX38
TCELL106:OUT_Q7SERDES.Q1CH0_FDRX39
TCELL108:IMUX_CLK0_DELAYSERDES.Q1CH3_FITMRSTOPCLK
TCELL108:OUT_F0SERDES.Q1_FDDFEERR3
TCELL108:OUT_F1SERDES.Q1_FDDFEERR4
TCELL108:OUT_F2SERDES.Q1_FDDFEERR5
TCELL108:OUT_F3SERDES.Q1_FDDFEERR6
TCELL108:OUT_F4SERDES.Q1_FDDFEERR7
TCELL108:OUT_F5SERDES.Q1_FDDFEERR8
TCELL108:OUT_F6SERDES.Q1_FDDFEERR9
TCELL108:OUT_F7SERDES.Q1_FDDFEDATA0
TCELL108:OUT_Q1SERDES.Q1CH3_FSDFEVLD
TCELL108:OUT_Q2SERDES.Q1CH2_FSDFEVLD
TCELL108:OUT_Q3SERDES.Q1CH1_FSDFEVLD
TCELL108:OUT_Q4SERDES.Q1CH0_FSDFEVLD
TCELL108:OUT_Q5SERDES.Q1_FDDFEERR0
TCELL108:OUT_Q6SERDES.Q1_FDDFEERR1
TCELL108:OUT_Q7SERDES.Q1_FDDFEERR2
TCELL109:IMUX_A2SERDES.Q1CH1_FCTMRSTOP
TCELL109:IMUX_A3SERDES.Q1CH0_FCTMRSTOP
TCELL109:IMUX_A4SERDES.Q1CH3_FCTMRSTART
TCELL109:IMUX_A5SERDES.Q1CH2_FCTMRSTART
TCELL109:IMUX_A6SERDES.Q1CH1_FCTMRSTART
TCELL109:IMUX_A7SERDES.Q1CH0_FCTMRSTART
TCELL109:IMUX_B6SERDES.Q1CH3_FCTMRSTOP
TCELL109:IMUX_B7SERDES.Q1CH2_FCTMRSTOP
TCELL109:IMUX_CLK0_DELAYSERDES.Q1CH1_FITMRSTOPCLK
TCELL109:IMUX_CLK1_DELAYSERDES.Q1CH2_FITMRSTOPCLK
TCELL109:OUT_F0SERDES.Q1_FDDFEDATA9
TCELL109:OUT_F1SERDES.Q1CH3_FSRCDONE
TCELL109:OUT_F2SERDES.Q1CH2_FSRCDONE
TCELL109:OUT_F3SERDES.Q1CH1_FSRCDONE
TCELL109:OUT_F4SERDES.Q1CH0_FSRCDONE
TCELL109:OUT_F5SERDES.Q1_FOREFCLK2FPGA
TCELL109:OUT_F6SERDES.Q1D1_FSDM
TCELL109:OUT_F7SERDES.Q1D0_FSDM
TCELL109:OUT_Q0SERDES.Q1_FDDFEDATA1
TCELL109:OUT_Q1SERDES.Q1_FDDFEDATA2
TCELL109:OUT_Q2SERDES.Q1_FDDFEDATA3
TCELL109:OUT_Q3SERDES.Q1_FDDFEDATA4
TCELL109:OUT_Q4SERDES.Q1_FDDFEDATA5
TCELL109:OUT_Q5SERDES.Q1_FDDFEDATA6
TCELL109:OUT_Q6SERDES.Q1_FDDFEDATA7
TCELL109:OUT_Q7SERDES.Q1_FDDFEDATA8
TCELL110:IMUX_A2SERDES.Q1_FCDFECOEFF4_5
TCELL110:IMUX_A3SERDES.Q1_FCDFECOEFF4_6
TCELL110:IMUX_A4SERDES.Q1_FCDFECOEFF4_7
TCELL110:IMUX_A5SERDES.Q1_FCDFECOEFF3_0
TCELL110:IMUX_A6SERDES.Q1_FCDFECOEFF3_1
TCELL110:IMUX_A7SERDES.Q1_FCDFECOEFF3_2
TCELL110:IMUX_B2SERDES.Q1_FCDFECOEFF5_7
TCELL110:IMUX_B3SERDES.Q1_FCDFECOEFF4_0
TCELL110:IMUX_B4SERDES.Q1_FCDFECOEFF4_1
TCELL110:IMUX_B5SERDES.Q1_FCDFECOEFF4_2
TCELL110:IMUX_B6SERDES.Q1_FCDFECOEFF4_3
TCELL110:IMUX_B7SERDES.Q1_FCDFECOEFF4_4
TCELL110:IMUX_C2SERDES.Q1_FCDFECOEFF5_1
TCELL110:IMUX_C3SERDES.Q1_FCDFECOEFF5_2
TCELL110:IMUX_C4SERDES.Q1_FCDFECOEFF5_3
TCELL110:IMUX_C5SERDES.Q1_FCDFECOEFF5_4
TCELL110:IMUX_C6SERDES.Q1_FCDFECOEFF5_5
TCELL110:IMUX_C7SERDES.Q1_FCDFECOEFF5_6
TCELL110:IMUX_D2SERDES.Q1_FCDFESIGN1
TCELL110:IMUX_D3SERDES.Q1_FCDFESIGN2
TCELL110:IMUX_D4SERDES.Q1_FCDFESIGN3
TCELL110:IMUX_D5SERDES.Q1_FCDFESIGN4
TCELL110:IMUX_D6SERDES.Q1_FCDFESIGN5
TCELL110:IMUX_D7SERDES.Q1_FCDFECOEFF5_0
TCELL110:IMUX_CLK0_DELAYSERDES.Q1CH3_FITMRSTARTCLK
TCELL110:IMUX_CLK1_DELAYSERDES.Q1CH0_FITMRSTOPCLK
TCELL110:OUT_F0SERDES.Q1CH1_FSSKPADDED
TCELL110:OUT_F1SERDES.Q1CH0_FSSKPADDED
TCELL110:OUT_F2SERDES.Q1CH3_FDLDRRX
TCELL110:OUT_F3SERDES.Q1CH2_FDLDRRX
TCELL110:OUT_F4SERDES.Q1CH1_FDLDRRX
TCELL110:OUT_F5SERDES.Q1CH0_FDLDRRX
TCELL110:OUT_F6SERDES.Q1_LSPLLLOL
TCELL110:OUT_F7SERDES.Q1_HSPLLLOL
TCELL110:OUT_Q0SERDES.Q1D1_FSDE
TCELL110:OUT_Q1SERDES.Q1D0_FSDE
TCELL110:OUT_Q2SERDES.Q1CH3_FSSKPDELETED
TCELL110:OUT_Q3SERDES.Q1CH2_FSSKPDELETED
TCELL110:OUT_Q4SERDES.Q1CH1_FSSKPDELETED
TCELL110:OUT_Q5SERDES.Q1CH0_FSSKPDELETED
TCELL110:OUT_Q6SERDES.Q1CH3_FSSKPADDED
TCELL110:OUT_Q7SERDES.Q1CH2_FSSKPADDED
TCELL111:IMUX_A2SERDES.Q1_FCDFECOEFF1_5
TCELL111:IMUX_A3SERDES.Q1_FCDFECOEFF1_6
TCELL111:IMUX_A4SERDES.Q1_FCDFECOEFF1_7
TCELL111:IMUX_A5SERDES.Q1_FCDFECOEFF0_0
TCELL111:IMUX_A6SERDES.Q1_FCDFECOEFF0_1
TCELL111:IMUX_A7SERDES.Q1_FCDFECOEFF0_2
TCELL111:IMUX_B2SERDES.Q1_FCDFECOEFF2_7
TCELL111:IMUX_B3SERDES.Q1_FCDFECOEFF1_0
TCELL111:IMUX_B4SERDES.Q1_FCDFECOEFF1_1
TCELL111:IMUX_B5SERDES.Q1_FCDFECOEFF1_2
TCELL111:IMUX_B6SERDES.Q1_FCDFECOEFF1_3
TCELL111:IMUX_B7SERDES.Q1_FCDFECOEFF1_4
TCELL111:IMUX_C2SERDES.Q1_FCDFECOEFF2_1
TCELL111:IMUX_C3SERDES.Q1_FCDFECOEFF2_2
TCELL111:IMUX_C4SERDES.Q1_FCDFECOEFF2_3
TCELL111:IMUX_C5SERDES.Q1_FCDFECOEFF2_4
TCELL111:IMUX_C6SERDES.Q1_FCDFECOEFF2_5
TCELL111:IMUX_C7SERDES.Q1_FCDFECOEFF2_6
TCELL111:IMUX_D2SERDES.Q1_FCDFECOEFF3_3
TCELL111:IMUX_D3SERDES.Q1_FCDFECOEFF3_4
TCELL111:IMUX_D4SERDES.Q1_FCDFECOEFF3_5
TCELL111:IMUX_D5SERDES.Q1_FCDFECOEFF3_6
TCELL111:IMUX_D6SERDES.Q1_FCDFECOEFF3_7
TCELL111:IMUX_D7SERDES.Q1_FCDFECOEFF2_0
TCELL111:IMUX_LSR0SERDES.Q1_HSPLLRST
TCELL111:IMUX_LSR1SERDES.Q1_LSPLLRST
TCELL111:IMUX_CLK0_DELAYSERDES.Q1CH1_FITMRSTARTCLK
TCELL111:IMUX_CLK1_DELAYSERDES.Q1CH2_FITMRSTARTCLK
TCELL111:OUT_F0SERDES.Q1CH3_FSCCUNDERRUN
TCELL111:OUT_F1SERDES.Q1CH2_FSCCUNDERRUN
TCELL111:OUT_F2SERDES.Q1CH1_FSCCUNDERRUN
TCELL111:OUT_F3SERDES.Q1CH0_FSCCUNDERRUN
TCELL111:OUT_F4SERDES.Q1CH3_FSLSM
TCELL111:OUT_F5SERDES.Q1CH2_FSLSM
TCELL111:OUT_F6SERDES.Q1CH1_FSLSM
TCELL111:OUT_F7SERDES.Q1CH0_FSLSM
TCELL111:OUT_Q0SERDES.Q1CH3_FSRLOL
TCELL111:OUT_Q1SERDES.Q1CH2_FSRLOL
TCELL111:OUT_Q2SERDES.Q1CH1_FSRLOL
TCELL111:OUT_Q3SERDES.Q1CH0_FSRLOL
TCELL111:OUT_Q4SERDES.Q1CH3_FSCCOVERRUN
TCELL111:OUT_Q5SERDES.Q1CH2_FSCCOVERRUN
TCELL111:OUT_Q6SERDES.Q1CH1_FSCCOVERRUN
TCELL111:OUT_Q7SERDES.Q1CH0_FSCCOVERRUN
TCELL112:IMUX_A2SERDES.Q1CH0_FCRATE1
TCELL112:IMUX_A3SERDES.Q1CH0_FCRATE2
TCELL112:IMUX_A4SERDES.Q1_LSPLLPWRUP
TCELL112:IMUX_A5SERDES.Q1_HSPLLPWRUP
TCELL112:IMUX_A6SERDES.Q1_FCMPWRUP
TCELL112:IMUX_A7SERDES.Q1CH3_FCRXPWRUP
TCELL112:IMUX_B2SERDES.Q1CH2_FCRATE1
TCELL112:IMUX_B3SERDES.Q1CH2_FCRATE2
TCELL112:IMUX_B4SERDES.Q1CH1_FCRATE0
TCELL112:IMUX_B5SERDES.Q1CH1_FCRATE1
TCELL112:IMUX_B6SERDES.Q1CH1_FCRATE2
TCELL112:IMUX_B7SERDES.Q1CH0_FCRATE0
TCELL112:IMUX_C2SERDES.Q1_FDDFECHSEL1
TCELL112:IMUX_C3SERDES.Q1_FCSCANMODE
TCELL112:IMUX_C4SERDES.Q1CH3_FCRATE0
TCELL112:IMUX_C5SERDES.Q1CH3_FCRATE1
TCELL112:IMUX_C6SERDES.Q1CH3_FCRATE2
TCELL112:IMUX_C7SERDES.Q1CH2_FCRATE0
TCELL112:IMUX_D2SERDES.Q1_FCDFECOEFF0_3
TCELL112:IMUX_D3SERDES.Q1_FCDFECOEFF0_4
TCELL112:IMUX_D4SERDES.Q1_FCDFECOEFF0_5
TCELL112:IMUX_D5SERDES.Q1_FCDFECOEFF0_6
TCELL112:IMUX_D6SERDES.Q1_FCDFECOEFF0_7
TCELL112:IMUX_D7SERDES.Q1_FDDFECHSEL0
TCELL112:IMUX_LSR0SERDES.Q1CH3_FCTRST
TCELL112:IMUX_LSR1SERDES.Q1CH2_FCTRST
TCELL112:IMUX_CLK0_DELAYSERDES.Q1_FITMRCLK
TCELL112:IMUX_CLK1_DELAYSERDES.Q1CH0_FITMRSTARTCLK
TCELL112:OUT_F0SERDES.Q1CH3_FSPCIEDONE
TCELL112:OUT_F1SERDES.Q1CH2_FSPCIEDONE
TCELL112:OUT_F2SERDES.Q1CH1_FSPCIEDONE
TCELL112:OUT_F3SERDES.Q1CH0_FSPCIEDONE
TCELL112:OUT_F4SERDES.Q1CH3_FDRX0
TCELL112:OUT_F5SERDES.Q1CH3_FDRX1
TCELL112:OUT_F6SERDES.Q1CH3_FDRX2
TCELL112:OUT_F7SERDES.Q1CH3_FDRX3
TCELL112:OUT_Q0SERDES.Q1CH3_FSRLOS
TCELL112:OUT_Q1SERDES.Q1CH2_FSRLOS
TCELL112:OUT_Q2SERDES.Q1CH1_FSRLOS
TCELL112:OUT_Q3SERDES.Q1CH0_FSRLOS
TCELL112:OUT_Q4SERDES.Q1CH3_FSPCIECON
TCELL112:OUT_Q5SERDES.Q1CH2_FSPCIECON
TCELL112:OUT_Q6SERDES.Q1CH1_FSPCIECON
TCELL112:OUT_Q7SERDES.Q1CH0_FSPCIECON
TCELL113:IMUX_A2SERDES.Q1CH3_FCLDRTXEN
TCELL113:IMUX_A3SERDES.Q1CH2_FCLDRTXEN
TCELL113:IMUX_A4SERDES.Q1CH1_FCLDRTXEN
TCELL113:IMUX_A5SERDES.Q1CH0_FCLDRTXEN
TCELL113:IMUX_B2SERDES.Q1CH3_FCALIGNEN
TCELL113:IMUX_B3SERDES.Q1CH2_FCALIGNEN
TCELL113:IMUX_B4SERDES.Q1CH1_FCALIGNEN
TCELL113:IMUX_B5SERDES.Q1CH0_FCALIGNEN
TCELL113:IMUX_C2SERDES.Q1CH2_FCTXPWRUP
TCELL113:IMUX_C3SERDES.Q1CH1_FCTXPWRUP
TCELL113:IMUX_C4SERDES.Q1CH0_FCTXPWRUP
TCELL113:IMUX_C5SERDES.Q1_FCMRST
TCELL113:IMUX_D2SERDES.Q1CH2_FCRXPWRUP
TCELL113:IMUX_D3SERDES.Q1CH1_FCRXPWRUP
TCELL113:IMUX_D4SERDES.Q1CH0_FCRXPWRUP
TCELL113:IMUX_D5SERDES.Q1CH3_FCTXPWRUP
TCELL113:IMUX_CLK1_DELAYSERDES.Q1_FITXTESTCLK
TCELL113:OUT_F0SERDES.Q1CH3_FDRX10
TCELL113:OUT_F1SERDES.Q1CH3_FDRX11
TCELL113:OUT_F2SERDES.Q1CH3_FDRX12
TCELL113:OUT_F3SERDES.Q1CH3_FDRX13
TCELL113:OUT_F4SERDES.Q1CH3_FDRX14
TCELL113:OUT_F5SERDES.Q1CH3_FDRX15
TCELL113:OUT_Q0SERDES.Q1CH3_FDRX4
TCELL113:OUT_Q1SERDES.Q1CH3_FDRX5
TCELL113:OUT_Q2SERDES.Q1CH3_FDRX6
TCELL113:OUT_Q3SERDES.Q1CH3_FDRX7
TCELL113:OUT_Q4SERDES.Q1CH3_FDRX8
TCELL113:OUT_Q5SERDES.Q1CH3_FDRX9
TCELL119:IMUX_A0SERDES.CORNER_LSPLLPWRUP
TCELL119:IMUX_B0SERDES.CORNER_FCSYNCTOGGLE
TCELL119:IMUX_C0SERDES.CORNER_FCSCANMODE
TCELL119:IMUX_LSR0SERDES.CORNER_LSPLLRST
TCELL119:IMUX_CLK0_DELAYSERDES.CORNER_LSPLLREFCLKI
TCELL119:OUT_F0SERDES.CORNER_FOREFCK2CORE
TCELL119:OUT_Q0SERDES.CORNER_LSPLLLOL

Tile SERDES3

Cells: 177

Bel SERDES

ecp4 SERDES3 bel SERDES
PinDirectionWires
CORNER_FCSCANMODEinputTCELL176:IMUX_C0
CORNER_FCSYNCTOGGLEinputTCELL176:IMUX_B0
CORNER_FOREFCK2COREoutputTCELL176:OUT_F0
CORNER_LSPLLLOLoutputTCELL176:OUT_Q0
CORNER_LSPLLPWRUPinputTCELL176:IMUX_A0
CORNER_LSPLLREFCLKIinputTCELL176:IMUX_CLK0_DELAY
CORNER_LSPLLRSTinputTCELL176:IMUX_LSR0
Q0CH0_FCALIGNENinputTCELL0:IMUX_B2
Q0CH0_FCCDRFORCEDLOCKinputTCELL16:IMUX_A0
Q0CH0_FCDFERDENinputTCELL7:IMUX_CE0
Q0CH0_FCDFEUPDinputTCELL8:IMUX_CE0
Q0CH0_FCLDRTXENinputTCELL0:IMUX_A2
Q0CH0_FCLSMENinputTCELL15:IMUX_D2
Q0CH0_FCPCIEDETENinputTCELL15:IMUX_B2
Q0CH0_FCPCSRXRSTinputTCELL12:IMUX_LSR0
Q0CH0_FCPCSTXRSTinputTCELL10:IMUX_LSR0
Q0CH0_FCPIPEPHYRESETNinputTCELL7:IMUX_LSR0
Q0CH0_FCPLLLOLinputTCELL16:IMUX_A4
Q0CH0_FCRATE0inputTCELL1:IMUX_B0
Q0CH0_FCRATE1inputTCELL1:IMUX_A5
Q0CH0_FCRATE2inputTCELL1:IMUX_A4
Q0CH0_FCRRSTinputTCELL14:IMUX_LSR0
Q0CH0_FCRXPOLARITYinputTCELL15:IMUX_C0
Q0CH0_FCRXPWRUPinputTCELL0:IMUX_D3
Q0CH0_FCTMRSTARTinputTCELL4:IMUX_A0
Q0CH0_FCTMRSTOPinputTCELL4:IMUX_A4
Q0CH0_FCTRSTinputTCELL16:IMUX_LSR0
Q0CH0_FCTXMARGIN0inputTCELL16:IMUX_C2
Q0CH0_FCTXMARGIN1inputTCELL16:IMUX_C1
Q0CH0_FCTXMARGIN2inputTCELL16:IMUX_C0
Q0CH0_FCTXPWRUPinputTCELL0:IMUX_C3
Q0CH0_FCWORDALGNENinputTCELL15:IMUX_C4
Q0CH0_FDLDRRXoutputTCELL3:OUT_F2
Q0CH0_FDLDRTXinputTCELL16:IMUX_B2
Q0CH0_FDRX0outputTCELL17:OUT_Q7
Q0CH0_FDRX1outputTCELL17:OUT_Q6
Q0CH0_FDRX10outputTCELL17:OUT_F5
Q0CH0_FDRX11outputTCELL17:OUT_F4
Q0CH0_FDRX12outputTCELL17:OUT_F3
Q0CH0_FDRX13outputTCELL17:OUT_F2
Q0CH0_FDRX14outputTCELL17:OUT_F1
Q0CH0_FDRX15outputTCELL17:OUT_F0
Q0CH0_FDRX16outputTCELL16:OUT_Q7
Q0CH0_FDRX17outputTCELL16:OUT_Q6
Q0CH0_FDRX18outputTCELL16:OUT_Q5
Q0CH0_FDRX19outputTCELL16:OUT_Q4
Q0CH0_FDRX2outputTCELL17:OUT_Q5
Q0CH0_FDRX20outputTCELL16:OUT_Q3
Q0CH0_FDRX21outputTCELL16:OUT_Q2
Q0CH0_FDRX22outputTCELL16:OUT_Q1
Q0CH0_FDRX23outputTCELL16:OUT_Q0
Q0CH0_FDRX24outputTCELL16:OUT_F7
Q0CH0_FDRX25outputTCELL16:OUT_F6
Q0CH0_FDRX26outputTCELL16:OUT_F5
Q0CH0_FDRX27outputTCELL16:OUT_F4
Q0CH0_FDRX28outputTCELL16:OUT_F3
Q0CH0_FDRX29outputTCELL16:OUT_F2
Q0CH0_FDRX3outputTCELL17:OUT_Q4
Q0CH0_FDRX30outputTCELL16:OUT_F1
Q0CH0_FDRX31outputTCELL16:OUT_F0
Q0CH0_FDRX32outputTCELL15:OUT_Q7
Q0CH0_FDRX33outputTCELL15:OUT_Q6
Q0CH0_FDRX34outputTCELL15:OUT_Q5
Q0CH0_FDRX35outputTCELL15:OUT_Q4
Q0CH0_FDRX36outputTCELL15:OUT_Q3
Q0CH0_FDRX37outputTCELL15:OUT_Q2
Q0CH0_FDRX38outputTCELL15:OUT_Q1
Q0CH0_FDRX39outputTCELL15:OUT_Q0
Q0CH0_FDRX4outputTCELL17:OUT_Q3
Q0CH0_FDRX40outputTCELL15:OUT_F7
Q0CH0_FDRX41outputTCELL15:OUT_F6
Q0CH0_FDRX42outputTCELL15:OUT_F5
Q0CH0_FDRX43outputTCELL15:OUT_F4
Q0CH0_FDRX44outputTCELL15:OUT_F3
Q0CH0_FDRX45outputTCELL15:OUT_F2
Q0CH0_FDRX46outputTCELL15:OUT_F1
Q0CH0_FDRX47outputTCELL15:OUT_F0
Q0CH0_FDRX5outputTCELL17:OUT_Q2
Q0CH0_FDRX6outputTCELL17:OUT_Q1
Q0CH0_FDRX7outputTCELL17:OUT_Q0
Q0CH0_FDRX8outputTCELL17:OUT_F7
Q0CH0_FDRX9outputTCELL17:OUT_F6
Q0CH0_FDTX0inputTCELL15:IMUX_B1
Q0CH0_FDTX1inputTCELL15:IMUX_B0
Q0CH0_FDTX10inputTCELL14:IMUX_D3
Q0CH0_FDTX11inputTCELL14:IMUX_D2
Q0CH0_FDTX12inputTCELL14:IMUX_D1
Q0CH0_FDTX13inputTCELL14:IMUX_D0
Q0CH0_FDTX14inputTCELL14:IMUX_C5
Q0CH0_FDTX15inputTCELL14:IMUX_C4
Q0CH0_FDTX16inputTCELL14:IMUX_C3
Q0CH0_FDTX17inputTCELL14:IMUX_C2
Q0CH0_FDTX18inputTCELL14:IMUX_C1
Q0CH0_FDTX19inputTCELL14:IMUX_C0
Q0CH0_FDTX2inputTCELL15:IMUX_A5
Q0CH0_FDTX20inputTCELL14:IMUX_B5
Q0CH0_FDTX21inputTCELL14:IMUX_B4
Q0CH0_FDTX22inputTCELL14:IMUX_B3
Q0CH0_FDTX23inputTCELL14:IMUX_B2
Q0CH0_FDTX24inputTCELL14:IMUX_B1
Q0CH0_FDTX25inputTCELL14:IMUX_B0
Q0CH0_FDTX26inputTCELL14:IMUX_A5
Q0CH0_FDTX27inputTCELL14:IMUX_A4
Q0CH0_FDTX28inputTCELL14:IMUX_A3
Q0CH0_FDTX29inputTCELL14:IMUX_A2
Q0CH0_FDTX3inputTCELL15:IMUX_A4
Q0CH0_FDTX30inputTCELL14:IMUX_A1
Q0CH0_FDTX31inputTCELL14:IMUX_A0
Q0CH0_FDTX32inputTCELL13:IMUX_D5
Q0CH0_FDTX33inputTCELL13:IMUX_D4
Q0CH0_FDTX34inputTCELL13:IMUX_D3
Q0CH0_FDTX35inputTCELL13:IMUX_D2
Q0CH0_FDTX36inputTCELL13:IMUX_D1
Q0CH0_FDTX37inputTCELL13:IMUX_D0
Q0CH0_FDTX38inputTCELL13:IMUX_C5
Q0CH0_FDTX39inputTCELL13:IMUX_C4
Q0CH0_FDTX4inputTCELL15:IMUX_A3
Q0CH0_FDTX40inputTCELL13:IMUX_C3
Q0CH0_FDTX41inputTCELL13:IMUX_C2
Q0CH0_FDTX42inputTCELL13:IMUX_C1
Q0CH0_FDTX43inputTCELL13:IMUX_C0
Q0CH0_FDTX44inputTCELL13:IMUX_B5
Q0CH0_FDTX45inputTCELL13:IMUX_B4
Q0CH0_FDTX46inputTCELL13:IMUX_B3
Q0CH0_FDTX47inputTCELL13:IMUX_B2
Q0CH0_FDTX48inputTCELL13:IMUX_B1
Q0CH0_FDTX49inputTCELL13:IMUX_B0
Q0CH0_FDTX5inputTCELL15:IMUX_A2
Q0CH0_FDTX6inputTCELL15:IMUX_A1
Q0CH0_FDTX7inputTCELL15:IMUX_A0
Q0CH0_FDTX8inputTCELL14:IMUX_D5
Q0CH0_FDTX9inputTCELL14:IMUX_D4
Q0CH0_FIRCLKinputTCELL10:IMUX_CLK0_DELAY
Q0CH0_FIREFRXCLKinputTCELL8:IMUX_CLK0_DELAY
Q0CH0_FITCLKinputTCELL12:IMUX_CLK0_DELAY
Q0CH0_FITMRSTARTCLKinputTCELL1:IMUX_CLK1_DELAY
Q0CH0_FITMRSTOPCLKinputTCELL3:IMUX_CLK1_DELAY
Q0CH0_FSCCOVERRUNoutputTCELL2:OUT_Q0
Q0CH0_FSCCUNDERRUNoutputTCELL2:OUT_F4
Q0CH0_FSDFEVLDoutputTCELL5:OUT_Q3
Q0CH0_FSLSMoutputTCELL2:OUT_F0
Q0CH0_FSPCIECONoutputTCELL1:OUT_Q0
Q0CH0_FSPCIEDONEoutputTCELL1:OUT_F4
Q0CH0_FSRCDONEoutputTCELL4:OUT_F3
Q0CH0_FSRLOLoutputTCELL2:OUT_Q4
Q0CH0_FSRLOSoutputTCELL1:OUT_Q4
Q0CH0_FSSKPADDEDoutputTCELL3:OUT_F6
Q0CH0_FSSKPDELETEDoutputTCELL3:OUT_Q2
Q0CH1_FCALIGNENinputTCELL0:IMUX_B3
Q0CH1_FCCDRFORCEDLOCKinputTCELL16:IMUX_A1
Q0CH1_FCDFERDENinputTCELL7:IMUX_CE1
Q0CH1_FCDFEUPDinputTCELL8:IMUX_CE1
Q0CH1_FCLDRTXENinputTCELL0:IMUX_A3
Q0CH1_FCLSMENinputTCELL15:IMUX_D3
Q0CH1_FCPCIEDETENinputTCELL15:IMUX_B3
Q0CH1_FCPCSRXRSTinputTCELL12:IMUX_LSR1
Q0CH1_FCPCSTXRSTinputTCELL10:IMUX_LSR1
Q0CH1_FCPIPEPHYRESETNinputTCELL7:IMUX_LSR1
Q0CH1_FCPLLLOLinputTCELL16:IMUX_A5
Q0CH1_FCRATE0inputTCELL1:IMUX_B3
Q0CH1_FCRATE1inputTCELL1:IMUX_B2
Q0CH1_FCRATE2inputTCELL1:IMUX_B1
Q0CH1_FCRRSTinputTCELL14:IMUX_LSR1
Q0CH1_FCRXPOLARITYinputTCELL15:IMUX_C1
Q0CH1_FCRXPWRUPinputTCELL0:IMUX_D4
Q0CH1_FCTMRSTARTinputTCELL4:IMUX_A1
Q0CH1_FCTMRSTOPinputTCELL4:IMUX_A5
Q0CH1_FCTRSTinputTCELL16:IMUX_LSR1
Q0CH1_FCTXMARGIN0inputTCELL16:IMUX_C5
Q0CH1_FCTXMARGIN1inputTCELL16:IMUX_C4
Q0CH1_FCTXMARGIN2inputTCELL16:IMUX_C3
Q0CH1_FCTXPWRUPinputTCELL0:IMUX_C4
Q0CH1_FCWORDALGNENinputTCELL15:IMUX_C5
Q0CH1_FDLDRRXoutputTCELL3:OUT_F3
Q0CH1_FDLDRTXinputTCELL16:IMUX_B3
Q0CH1_FDRX0outputTCELL14:OUT_Q7
Q0CH1_FDRX1outputTCELL14:OUT_Q6
Q0CH1_FDRX10outputTCELL14:OUT_F5
Q0CH1_FDRX11outputTCELL14:OUT_F4
Q0CH1_FDRX12outputTCELL14:OUT_F3
Q0CH1_FDRX13outputTCELL14:OUT_F2
Q0CH1_FDRX14outputTCELL14:OUT_F1
Q0CH1_FDRX15outputTCELL14:OUT_F0
Q0CH1_FDRX16outputTCELL13:OUT_Q7
Q0CH1_FDRX17outputTCELL13:OUT_Q6
Q0CH1_FDRX18outputTCELL13:OUT_Q5
Q0CH1_FDRX19outputTCELL13:OUT_Q4
Q0CH1_FDRX2outputTCELL14:OUT_Q5
Q0CH1_FDRX20outputTCELL13:OUT_Q3
Q0CH1_FDRX21outputTCELL13:OUT_Q2
Q0CH1_FDRX22outputTCELL13:OUT_Q1
Q0CH1_FDRX23outputTCELL13:OUT_Q0
Q0CH1_FDRX24outputTCELL13:OUT_F7
Q0CH1_FDRX25outputTCELL13:OUT_F6
Q0CH1_FDRX26outputTCELL13:OUT_F5
Q0CH1_FDRX27outputTCELL13:OUT_F4
Q0CH1_FDRX28outputTCELL13:OUT_F3
Q0CH1_FDRX29outputTCELL13:OUT_F2
Q0CH1_FDRX3outputTCELL14:OUT_Q4
Q0CH1_FDRX30outputTCELL13:OUT_F1
Q0CH1_FDRX31outputTCELL13:OUT_F0
Q0CH1_FDRX32outputTCELL12:OUT_Q7
Q0CH1_FDRX33outputTCELL12:OUT_Q6
Q0CH1_FDRX34outputTCELL12:OUT_Q5
Q0CH1_FDRX35outputTCELL12:OUT_Q4
Q0CH1_FDRX36outputTCELL12:OUT_Q3
Q0CH1_FDRX37outputTCELL12:OUT_Q2
Q0CH1_FDRX38outputTCELL12:OUT_Q1
Q0CH1_FDRX39outputTCELL12:OUT_Q0
Q0CH1_FDRX4outputTCELL14:OUT_Q3
Q0CH1_FDRX40outputTCELL12:OUT_F7
Q0CH1_FDRX41outputTCELL12:OUT_F6
Q0CH1_FDRX42outputTCELL12:OUT_F5
Q0CH1_FDRX43outputTCELL12:OUT_F4
Q0CH1_FDRX44outputTCELL12:OUT_F3
Q0CH1_FDRX45outputTCELL12:OUT_F2
Q0CH1_FDRX46outputTCELL12:OUT_F1
Q0CH1_FDRX47outputTCELL12:OUT_F0
Q0CH1_FDRX5outputTCELL14:OUT_Q2
Q0CH1_FDRX6outputTCELL14:OUT_Q1
Q0CH1_FDRX7outputTCELL14:OUT_Q0
Q0CH1_FDRX8outputTCELL14:OUT_F7
Q0CH1_FDRX9outputTCELL14:OUT_F6
Q0CH1_FDTX0inputTCELL13:IMUX_A5
Q0CH1_FDTX1inputTCELL13:IMUX_A4
Q0CH1_FDTX10inputTCELL12:IMUX_D1
Q0CH1_FDTX11inputTCELL12:IMUX_D0
Q0CH1_FDTX12inputTCELL12:IMUX_C5
Q0CH1_FDTX13inputTCELL12:IMUX_C4
Q0CH1_FDTX14inputTCELL12:IMUX_C3
Q0CH1_FDTX15inputTCELL12:IMUX_C2
Q0CH1_FDTX16inputTCELL12:IMUX_C1
Q0CH1_FDTX17inputTCELL12:IMUX_C0
Q0CH1_FDTX18inputTCELL12:IMUX_B5
Q0CH1_FDTX19inputTCELL12:IMUX_B4
Q0CH1_FDTX2inputTCELL13:IMUX_A3
Q0CH1_FDTX20inputTCELL12:IMUX_B3
Q0CH1_FDTX21inputTCELL12:IMUX_B2
Q0CH1_FDTX22inputTCELL12:IMUX_B1
Q0CH1_FDTX23inputTCELL12:IMUX_B0
Q0CH1_FDTX24inputTCELL12:IMUX_A5
Q0CH1_FDTX25inputTCELL12:IMUX_A4
Q0CH1_FDTX26inputTCELL12:IMUX_A3
Q0CH1_FDTX27inputTCELL12:IMUX_A2
Q0CH1_FDTX28inputTCELL12:IMUX_A1
Q0CH1_FDTX29inputTCELL12:IMUX_A0
Q0CH1_FDTX3inputTCELL13:IMUX_A2
Q0CH1_FDTX30inputTCELL11:IMUX_D5
Q0CH1_FDTX31inputTCELL11:IMUX_D4
Q0CH1_FDTX32inputTCELL11:IMUX_D3
Q0CH1_FDTX33inputTCELL11:IMUX_D2
Q0CH1_FDTX34inputTCELL11:IMUX_D1
Q0CH1_FDTX35inputTCELL11:IMUX_D0
Q0CH1_FDTX36inputTCELL11:IMUX_C5
Q0CH1_FDTX37inputTCELL11:IMUX_C4
Q0CH1_FDTX38inputTCELL11:IMUX_C3
Q0CH1_FDTX39inputTCELL11:IMUX_C2
Q0CH1_FDTX4inputTCELL13:IMUX_A1
Q0CH1_FDTX40inputTCELL11:IMUX_C1
Q0CH1_FDTX41inputTCELL11:IMUX_C0
Q0CH1_FDTX42inputTCELL11:IMUX_B5
Q0CH1_FDTX43inputTCELL11:IMUX_B4
Q0CH1_FDTX44inputTCELL11:IMUX_B3
Q0CH1_FDTX45inputTCELL11:IMUX_B2
Q0CH1_FDTX46inputTCELL11:IMUX_B1
Q0CH1_FDTX47inputTCELL11:IMUX_B0
Q0CH1_FDTX48inputTCELL11:IMUX_A5
Q0CH1_FDTX49inputTCELL11:IMUX_A4
Q0CH1_FDTX5inputTCELL13:IMUX_A0
Q0CH1_FDTX6inputTCELL12:IMUX_D5
Q0CH1_FDTX7inputTCELL12:IMUX_D4
Q0CH1_FDTX8inputTCELL12:IMUX_D3
Q0CH1_FDTX9inputTCELL12:IMUX_D2
Q0CH1_FIRCLKinputTCELL10:IMUX_CLK1_DELAY
Q0CH1_FIREFRXCLKinputTCELL8:IMUX_CLK1_DELAY
Q0CH1_FITCLKinputTCELL12:IMUX_CLK1_DELAY
Q0CH1_FITMRSTARTCLKinputTCELL2:IMUX_CLK0_DELAY
Q0CH1_FITMRSTOPCLKinputTCELL4:IMUX_CLK0_DELAY
Q0CH1_FSCCOVERRUNoutputTCELL2:OUT_Q1
Q0CH1_FSCCUNDERRUNoutputTCELL2:OUT_F5
Q0CH1_FSDFEVLDoutputTCELL5:OUT_Q4
Q0CH1_FSLSMoutputTCELL2:OUT_F1
Q0CH1_FSPCIECONoutputTCELL1:OUT_Q1
Q0CH1_FSPCIEDONEoutputTCELL1:OUT_F5
Q0CH1_FSRCDONEoutputTCELL4:OUT_F4
Q0CH1_FSRLOLoutputTCELL2:OUT_Q5
Q0CH1_FSRLOSoutputTCELL1:OUT_Q5
Q0CH1_FSSKPADDEDoutputTCELL3:OUT_F7
Q0CH1_FSSKPDELETEDoutputTCELL3:OUT_Q3
Q0CH2_FCALIGNENinputTCELL0:IMUX_B4
Q0CH2_FCCDRFORCEDLOCKinputTCELL16:IMUX_A2
Q0CH2_FCDFERDENinputTCELL7:IMUX_CE2
Q0CH2_FCDFEUPDinputTCELL8:IMUX_CE2
Q0CH2_FCLDRTXENinputTCELL0:IMUX_A4
Q0CH2_FCLSMENinputTCELL15:IMUX_D4
Q0CH2_FCPCIEDETENinputTCELL15:IMUX_B4
Q0CH2_FCPCSRXRSTinputTCELL13:IMUX_LSR0
Q0CH2_FCPCSTXRSTinputTCELL11:IMUX_LSR0
Q0CH2_FCPIPEPHYRESETNinputTCELL8:IMUX_LSR0
Q0CH2_FCPLLLOLinputTCELL16:IMUX_B0
Q0CH2_FCRATE0inputTCELL1:IMUX_C0
Q0CH2_FCRATE1inputTCELL1:IMUX_B5
Q0CH2_FCRATE2inputTCELL1:IMUX_B4
Q0CH2_FCRRSTinputTCELL15:IMUX_LSR0
Q0CH2_FCRXPOLARITYinputTCELL15:IMUX_C2
Q0CH2_FCRXPWRUPinputTCELL0:IMUX_D5
Q0CH2_FCTMRSTARTinputTCELL4:IMUX_A2
Q0CH2_FCTMRSTOPinputTCELL4:IMUX_B0
Q0CH2_FCTRSTinputTCELL1:IMUX_LSR0
Q0CH2_FCTXMARGIN0inputTCELL16:IMUX_D2
Q0CH2_FCTXMARGIN1inputTCELL16:IMUX_D1
Q0CH2_FCTXMARGIN2inputTCELL16:IMUX_D0
Q0CH2_FCTXPWRUPinputTCELL0:IMUX_C5
Q0CH2_FCWORDALGNENinputTCELL15:IMUX_D0
Q0CH2_FDLDRRXoutputTCELL3:OUT_F4
Q0CH2_FDLDRTXinputTCELL16:IMUX_B4
Q0CH2_FDRX0outputTCELL11:OUT_Q7
Q0CH2_FDRX1outputTCELL11:OUT_Q6
Q0CH2_FDRX10outputTCELL11:OUT_F5
Q0CH2_FDRX11outputTCELL11:OUT_F4
Q0CH2_FDRX12outputTCELL11:OUT_F3
Q0CH2_FDRX13outputTCELL11:OUT_F2
Q0CH2_FDRX14outputTCELL11:OUT_F1
Q0CH2_FDRX15outputTCELL11:OUT_F0
Q0CH2_FDRX16outputTCELL10:OUT_Q7
Q0CH2_FDRX17outputTCELL10:OUT_Q6
Q0CH2_FDRX18outputTCELL10:OUT_Q5
Q0CH2_FDRX19outputTCELL10:OUT_Q4
Q0CH2_FDRX2outputTCELL11:OUT_Q5
Q0CH2_FDRX20outputTCELL10:OUT_Q3
Q0CH2_FDRX21outputTCELL10:OUT_Q2
Q0CH2_FDRX22outputTCELL10:OUT_Q1
Q0CH2_FDRX23outputTCELL10:OUT_Q0
Q0CH2_FDRX24outputTCELL10:OUT_F7
Q0CH2_FDRX25outputTCELL10:OUT_F6
Q0CH2_FDRX26outputTCELL10:OUT_F5
Q0CH2_FDRX27outputTCELL10:OUT_F4
Q0CH2_FDRX28outputTCELL10:OUT_F3
Q0CH2_FDRX29outputTCELL10:OUT_F2
Q0CH2_FDRX3outputTCELL11:OUT_Q4
Q0CH2_FDRX30outputTCELL10:OUT_F1
Q0CH2_FDRX31outputTCELL10:OUT_F0
Q0CH2_FDRX32outputTCELL9:OUT_Q7
Q0CH2_FDRX33outputTCELL9:OUT_Q6
Q0CH2_FDRX34outputTCELL9:OUT_Q5
Q0CH2_FDRX35outputTCELL9:OUT_Q4
Q0CH2_FDRX36outputTCELL9:OUT_Q3
Q0CH2_FDRX37outputTCELL9:OUT_Q2
Q0CH2_FDRX38outputTCELL9:OUT_Q1
Q0CH2_FDRX39outputTCELL9:OUT_Q0
Q0CH2_FDRX4outputTCELL11:OUT_Q3
Q0CH2_FDRX40outputTCELL9:OUT_F7
Q0CH2_FDRX41outputTCELL9:OUT_F6
Q0CH2_FDRX42outputTCELL9:OUT_F5
Q0CH2_FDRX43outputTCELL9:OUT_F4
Q0CH2_FDRX44outputTCELL9:OUT_F3
Q0CH2_FDRX45outputTCELL9:OUT_F2
Q0CH2_FDRX46outputTCELL9:OUT_F1
Q0CH2_FDRX47outputTCELL9:OUT_F0
Q0CH2_FDRX5outputTCELL11:OUT_Q2
Q0CH2_FDRX6outputTCELL11:OUT_Q1
Q0CH2_FDRX7outputTCELL11:OUT_Q0
Q0CH2_FDRX8outputTCELL11:OUT_F7
Q0CH2_FDRX9outputTCELL11:OUT_F6
Q0CH2_FDTX0inputTCELL11:IMUX_A3
Q0CH2_FDTX1inputTCELL11:IMUX_A2
Q0CH2_FDTX10inputTCELL10:IMUX_C5
Q0CH2_FDTX11inputTCELL10:IMUX_C4
Q0CH2_FDTX12inputTCELL10:IMUX_C3
Q0CH2_FDTX13inputTCELL10:IMUX_C2
Q0CH2_FDTX14inputTCELL10:IMUX_C1
Q0CH2_FDTX15inputTCELL10:IMUX_C0
Q0CH2_FDTX16inputTCELL10:IMUX_B5
Q0CH2_FDTX17inputTCELL10:IMUX_B4
Q0CH2_FDTX18inputTCELL10:IMUX_B3
Q0CH2_FDTX19inputTCELL10:IMUX_B2
Q0CH2_FDTX2inputTCELL11:IMUX_A1
Q0CH2_FDTX20inputTCELL10:IMUX_B1
Q0CH2_FDTX21inputTCELL10:IMUX_B0
Q0CH2_FDTX22inputTCELL10:IMUX_A5
Q0CH2_FDTX23inputTCELL10:IMUX_A4
Q0CH2_FDTX24inputTCELL10:IMUX_A3
Q0CH2_FDTX25inputTCELL10:IMUX_A2
Q0CH2_FDTX26inputTCELL10:IMUX_A1
Q0CH2_FDTX27inputTCELL10:IMUX_A0
Q0CH2_FDTX28inputTCELL9:IMUX_D5
Q0CH2_FDTX29inputTCELL9:IMUX_D4
Q0CH2_FDTX3inputTCELL11:IMUX_A0
Q0CH2_FDTX30inputTCELL9:IMUX_D3
Q0CH2_FDTX31inputTCELL9:IMUX_D2
Q0CH2_FDTX32inputTCELL9:IMUX_D1
Q0CH2_FDTX33inputTCELL9:IMUX_D0
Q0CH2_FDTX34inputTCELL9:IMUX_C5
Q0CH2_FDTX35inputTCELL9:IMUX_C4
Q0CH2_FDTX36inputTCELL9:IMUX_C3
Q0CH2_FDTX37inputTCELL9:IMUX_C2
Q0CH2_FDTX38inputTCELL9:IMUX_C1
Q0CH2_FDTX39inputTCELL9:IMUX_C0
Q0CH2_FDTX4inputTCELL10:IMUX_D5
Q0CH2_FDTX40inputTCELL9:IMUX_B5
Q0CH2_FDTX41inputTCELL9:IMUX_B4
Q0CH2_FDTX42inputTCELL9:IMUX_B3
Q0CH2_FDTX43inputTCELL9:IMUX_B2
Q0CH2_FDTX44inputTCELL9:IMUX_B1
Q0CH2_FDTX45inputTCELL9:IMUX_B0
Q0CH2_FDTX46inputTCELL9:IMUX_A5
Q0CH2_FDTX47inputTCELL9:IMUX_A4
Q0CH2_FDTX48inputTCELL9:IMUX_A3
Q0CH2_FDTX49inputTCELL9:IMUX_A2
Q0CH2_FDTX5inputTCELL10:IMUX_D4
Q0CH2_FDTX6inputTCELL10:IMUX_D3
Q0CH2_FDTX7inputTCELL10:IMUX_D2
Q0CH2_FDTX8inputTCELL10:IMUX_D1
Q0CH2_FDTX9inputTCELL10:IMUX_D0
Q0CH2_FIRCLKinputTCELL11:IMUX_CLK0_DELAY
Q0CH2_FIREFRXCLKinputTCELL9:IMUX_CLK0_DELAY
Q0CH2_FITCLKinputTCELL13:IMUX_CLK0_DELAY
Q0CH2_FITMRSTARTCLKinputTCELL2:IMUX_CLK1_DELAY
Q0CH2_FITMRSTOPCLKinputTCELL4:IMUX_CLK1_DELAY
Q0CH2_FSCCOVERRUNoutputTCELL2:OUT_Q2
Q0CH2_FSCCUNDERRUNoutputTCELL2:OUT_F6
Q0CH2_FSDFEVLDoutputTCELL5:OUT_Q5
Q0CH2_FSLSMoutputTCELL2:OUT_F2
Q0CH2_FSPCIECONoutputTCELL1:OUT_Q2
Q0CH2_FSPCIEDONEoutputTCELL1:OUT_F6
Q0CH2_FSRCDONEoutputTCELL4:OUT_F5
Q0CH2_FSRLOLoutputTCELL2:OUT_Q6
Q0CH2_FSRLOSoutputTCELL1:OUT_Q6
Q0CH2_FSSKPADDEDoutputTCELL3:OUT_Q0
Q0CH2_FSSKPDELETEDoutputTCELL3:OUT_Q4
Q0CH3_FCALIGNENinputTCELL0:IMUX_B5
Q0CH3_FCCDRFORCEDLOCKinputTCELL16:IMUX_A3
Q0CH3_FCDFERDENinputTCELL7:IMUX_CE3
Q0CH3_FCDFEUPDinputTCELL8:IMUX_CE3
Q0CH3_FCLDRTXENinputTCELL0:IMUX_A5
Q0CH3_FCLSMENinputTCELL15:IMUX_D5
Q0CH3_FCPCIEDETENinputTCELL15:IMUX_B5
Q0CH3_FCPCSRXRSTinputTCELL13:IMUX_LSR1
Q0CH3_FCPCSTXRSTinputTCELL11:IMUX_LSR1
Q0CH3_FCPIPEPHYRESETNinputTCELL8:IMUX_LSR1
Q0CH3_FCPLLLOLinputTCELL16:IMUX_B1
Q0CH3_FCRATE0inputTCELL1:IMUX_C3
Q0CH3_FCRATE1inputTCELL1:IMUX_C2
Q0CH3_FCRATE2inputTCELL1:IMUX_C1
Q0CH3_FCRRSTinputTCELL15:IMUX_LSR1
Q0CH3_FCRXPOLARITYinputTCELL15:IMUX_C3
Q0CH3_FCRXPWRUPinputTCELL1:IMUX_A0
Q0CH3_FCTMRSTARTinputTCELL4:IMUX_A3
Q0CH3_FCTMRSTOPinputTCELL4:IMUX_B1
Q0CH3_FCTRSTinputTCELL1:IMUX_LSR1
Q0CH3_FCTXMARGIN0inputTCELL16:IMUX_D5
Q0CH3_FCTXMARGIN1inputTCELL16:IMUX_D4
Q0CH3_FCTXMARGIN2inputTCELL16:IMUX_D3
Q0CH3_FCTXPWRUPinputTCELL0:IMUX_D2
Q0CH3_FCWORDALGNENinputTCELL15:IMUX_D1
Q0CH3_FDLDRRXoutputTCELL3:OUT_F5
Q0CH3_FDLDRTXinputTCELL16:IMUX_B5
Q0CH3_FDRX0outputTCELL8:OUT_Q7
Q0CH3_FDRX1outputTCELL8:OUT_Q6
Q0CH3_FDRX10outputTCELL8:OUT_F5
Q0CH3_FDRX11outputTCELL8:OUT_F4
Q0CH3_FDRX12outputTCELL8:OUT_F3
Q0CH3_FDRX13outputTCELL8:OUT_F2
Q0CH3_FDRX14outputTCELL8:OUT_F1
Q0CH3_FDRX15outputTCELL8:OUT_F0
Q0CH3_FDRX16outputTCELL7:OUT_Q7
Q0CH3_FDRX17outputTCELL7:OUT_Q6
Q0CH3_FDRX18outputTCELL7:OUT_Q5
Q0CH3_FDRX19outputTCELL7:OUT_Q4
Q0CH3_FDRX2outputTCELL8:OUT_Q5
Q0CH3_FDRX20outputTCELL7:OUT_Q3
Q0CH3_FDRX21outputTCELL7:OUT_Q2
Q0CH3_FDRX22outputTCELL7:OUT_Q1
Q0CH3_FDRX23outputTCELL7:OUT_Q0
Q0CH3_FDRX24outputTCELL7:OUT_F7
Q0CH3_FDRX25outputTCELL7:OUT_F6
Q0CH3_FDRX26outputTCELL7:OUT_F5
Q0CH3_FDRX27outputTCELL7:OUT_F4
Q0CH3_FDRX28outputTCELL7:OUT_F3
Q0CH3_FDRX29outputTCELL7:OUT_F2
Q0CH3_FDRX3outputTCELL8:OUT_Q4
Q0CH3_FDRX30outputTCELL7:OUT_F1
Q0CH3_FDRX31outputTCELL7:OUT_F0
Q0CH3_FDRX32outputTCELL1:OUT_F3
Q0CH3_FDRX33outputTCELL1:OUT_F2
Q0CH3_FDRX34outputTCELL1:OUT_F1
Q0CH3_FDRX35outputTCELL1:OUT_F0
Q0CH3_FDRX36outputTCELL0:OUT_Q7
Q0CH3_FDRX37outputTCELL0:OUT_Q6
Q0CH3_FDRX38outputTCELL0:OUT_Q5
Q0CH3_FDRX39outputTCELL0:OUT_Q4
Q0CH3_FDRX4outputTCELL8:OUT_Q3
Q0CH3_FDRX40outputTCELL0:OUT_Q3
Q0CH3_FDRX41outputTCELL0:OUT_Q2
Q0CH3_FDRX42outputTCELL0:OUT_F7
Q0CH3_FDRX43outputTCELL0:OUT_F6
Q0CH3_FDRX44outputTCELL0:OUT_F5
Q0CH3_FDRX45outputTCELL0:OUT_F4
Q0CH3_FDRX46outputTCELL0:OUT_F3
Q0CH3_FDRX47outputTCELL0:OUT_F2
Q0CH3_FDRX5outputTCELL8:OUT_Q2
Q0CH3_FDRX6outputTCELL8:OUT_Q1
Q0CH3_FDRX7outputTCELL8:OUT_Q0
Q0CH3_FDRX8outputTCELL8:OUT_F7
Q0CH3_FDRX9outputTCELL8:OUT_F6
Q0CH3_FDTX0inputTCELL9:IMUX_A1
Q0CH3_FDTX1inputTCELL9:IMUX_A0
Q0CH3_FDTX10inputTCELL8:IMUX_C3
Q0CH3_FDTX11inputTCELL8:IMUX_C2
Q0CH3_FDTX12inputTCELL8:IMUX_C1
Q0CH3_FDTX13inputTCELL8:IMUX_C0
Q0CH3_FDTX14inputTCELL8:IMUX_B5
Q0CH3_FDTX15inputTCELL8:IMUX_B4
Q0CH3_FDTX16inputTCELL8:IMUX_B3
Q0CH3_FDTX17inputTCELL8:IMUX_B2
Q0CH3_FDTX18inputTCELL8:IMUX_B1
Q0CH3_FDTX19inputTCELL8:IMUX_B0
Q0CH3_FDTX2inputTCELL8:IMUX_D5
Q0CH3_FDTX20inputTCELL8:IMUX_A5
Q0CH3_FDTX21inputTCELL8:IMUX_A4
Q0CH3_FDTX22inputTCELL8:IMUX_A3
Q0CH3_FDTX23inputTCELL8:IMUX_A2
Q0CH3_FDTX24inputTCELL8:IMUX_A1
Q0CH3_FDTX25inputTCELL8:IMUX_A0
Q0CH3_FDTX26inputTCELL7:IMUX_D5
Q0CH3_FDTX27inputTCELL7:IMUX_D4
Q0CH3_FDTX28inputTCELL7:IMUX_D3
Q0CH3_FDTX29inputTCELL7:IMUX_D2
Q0CH3_FDTX3inputTCELL8:IMUX_D4
Q0CH3_FDTX30inputTCELL7:IMUX_D1
Q0CH3_FDTX31inputTCELL7:IMUX_D0
Q0CH3_FDTX32inputTCELL7:IMUX_C5
Q0CH3_FDTX33inputTCELL7:IMUX_C4
Q0CH3_FDTX34inputTCELL7:IMUX_C3
Q0CH3_FDTX35inputTCELL7:IMUX_C2
Q0CH3_FDTX36inputTCELL7:IMUX_C1
Q0CH3_FDTX37inputTCELL7:IMUX_C0
Q0CH3_FDTX38inputTCELL7:IMUX_B5
Q0CH3_FDTX39inputTCELL7:IMUX_B4
Q0CH3_FDTX4inputTCELL8:IMUX_D3
Q0CH3_FDTX40inputTCELL7:IMUX_B3
Q0CH3_FDTX41inputTCELL7:IMUX_B2
Q0CH3_FDTX42inputTCELL7:IMUX_B1
Q0CH3_FDTX43inputTCELL7:IMUX_B0
Q0CH3_FDTX44inputTCELL7:IMUX_A5
Q0CH3_FDTX45inputTCELL7:IMUX_A4
Q0CH3_FDTX46inputTCELL7:IMUX_A3
Q0CH3_FDTX47inputTCELL7:IMUX_A2
Q0CH3_FDTX48inputTCELL7:IMUX_A1
Q0CH3_FDTX49inputTCELL7:IMUX_A0
Q0CH3_FDTX5inputTCELL8:IMUX_D2
Q0CH3_FDTX6inputTCELL8:IMUX_D1
Q0CH3_FDTX7inputTCELL8:IMUX_D0
Q0CH3_FDTX8inputTCELL8:IMUX_C5
Q0CH3_FDTX9inputTCELL8:IMUX_C4
Q0CH3_FIRCLKinputTCELL11:IMUX_CLK1_DELAY
Q0CH3_FIREFRXCLKinputTCELL9:IMUX_CLK1_DELAY
Q0CH3_FITCLKinputTCELL13:IMUX_CLK1_DELAY
Q0CH3_FITMRSTARTCLKinputTCELL3:IMUX_CLK0_DELAY
Q0CH3_FITMRSTOPCLKinputTCELL5:IMUX_CLK0_DELAY
Q0CH3_FSCCOVERRUNoutputTCELL2:OUT_Q3
Q0CH3_FSCCUNDERRUNoutputTCELL2:OUT_F7
Q0CH3_FSDFEVLDoutputTCELL5:OUT_Q6
Q0CH3_FSLSMoutputTCELL2:OUT_F3
Q0CH3_FSPCIECONoutputTCELL1:OUT_Q3
Q0CH3_FSPCIEDONEoutputTCELL1:OUT_F7
Q0CH3_FSRCDONEoutputTCELL4:OUT_F6
Q0CH3_FSRLOLoutputTCELL2:OUT_Q7
Q0CH3_FSRLOSoutputTCELL1:OUT_Q7
Q0CH3_FSSKPADDEDoutputTCELL3:OUT_Q1
Q0CH3_FSSKPDELETEDoutputTCELL3:OUT_Q5
Q0D0_FCDERSTinputTCELL9:IMUX_LSR0
Q0D0_FSDEoutputTCELL3:OUT_Q6
Q0D0_FSDMoutputTCELL4:OUT_F0
Q0D1_FCDERSTinputTCELL9:IMUX_LSR1
Q0D1_FSDEoutputTCELL3:OUT_Q7
Q0D1_FSDMoutputTCELL4:OUT_F1
Q0P_CORERRINinputTCELL48:IMUX_A3
Q0P_CORERROUToutputTCELL43:OUT_F5
Q0P_DBGDATOUT0outputTCELL45:OUT_F4
Q0P_DBGDATOUT1outputTCELL45:OUT_F7
Q0P_DBGDATOUT10outputTCELL45:OUT_Q4
Q0P_DBGDATOUT11outputTCELL45:OUT_Q2
Q0P_DBGDATOUT12outputTCELL44:OUT_Q6
Q0P_DBGDATOUT13outputTCELL45:OUT_F6
Q0P_DBGDATOUT14outputTCELL45:OUT_F1
Q0P_DBGDATOUT15outputTCELL45:OUT_Q5
Q0P_DBGDATOUT2outputTCELL45:OUT_F5
Q0P_DBGDATOUT3outputTCELL45:OUT_Q1
Q0P_DBGDATOUT4outputTCELL45:OUT_F2
Q0P_DBGDATOUT5outputTCELL44:OUT_Q1
Q0P_DBGDATOUT6outputTCELL44:OUT_Q7
Q0P_DBGDATOUT7outputTCELL44:OUT_Q3
Q0P_DBGDATOUT8outputTCELL44:OUT_Q4
Q0P_DBGDATOUT9outputTCELL45:OUT_F3
Q0P_FTLERROUToutputTCELL42:OUT_Q4
Q0P_FUNCPWRSTATE0outputTCELL43:OUT_F3
Q0P_FUNCPWRSTATE1outputTCELL43:OUT_F1
Q0P_FUNCPWRSTATE2outputTCELL43:OUT_Q0
Q0P_FUNCSTS0outputTCELL43:OUT_Q3
Q0P_FUNCSTS1outputTCELL43:OUT_F6
Q0P_FUNCSTS2outputTCELL42:OUT_Q7
Q0P_FUNCSTS3outputTCELL43:OUT_Q7
Q0P_HALMSTACKoutputTCELL43:OUT_Q4
Q0P_HALMSTCOMPDES0outputTCELL37:OUT_F1
Q0P_HALMSTCOMPDES1outputTCELL37:OUT_F4
Q0P_HALMSTCOMPDES10outputTCELL41:OUT_F2
Q0P_HALMSTCOMPDES100outputTCELL37:OUT_F7
Q0P_HALMSTCOMPDES101outputTCELL33:OUT_Q3
Q0P_HALMSTCOMPDES102outputTCELL33:OUT_Q2
Q0P_HALMSTCOMPDES103outputTCELL33:OUT_Q4
Q0P_HALMSTCOMPDES104outputTCELL33:OUT_Q1
Q0P_HALMSTCOMPDES105outputTCELL34:OUT_F1
Q0P_HALMSTCOMPDES106outputTCELL34:OUT_F4
Q0P_HALMSTCOMPDES107outputTCELL33:OUT_F2
Q0P_HALMSTCOMPDES108outputTCELL33:OUT_F0
Q0P_HALMSTCOMPDES109outputTCELL32:OUT_Q6
Q0P_HALMSTCOMPDES11outputTCELL38:OUT_Q0
Q0P_HALMSTCOMPDES110outputTCELL33:OUT_F1
Q0P_HALMSTCOMPDES111outputTCELL33:OUT_F5
Q0P_HALMSTCOMPDES112outputTCELL32:OUT_Q7
Q0P_HALMSTCOMPDES113outputTCELL32:OUT_Q3
Q0P_HALMSTCOMPDES114outputTCELL32:OUT_Q2
Q0P_HALMSTCOMPDES115outputTCELL32:OUT_Q0
Q0P_HALMSTCOMPDES116outputTCELL32:OUT_F7
Q0P_HALMSTCOMPDES117outputTCELL32:OUT_Q1
Q0P_HALMSTCOMPDES118outputTCELL32:OUT_Q4
Q0P_HALMSTCOMPDES119outputTCELL33:OUT_F7
Q0P_HALMSTCOMPDES12outputTCELL41:OUT_F6
Q0P_HALMSTCOMPDES120outputTCELL36:OUT_F5
Q0P_HALMSTCOMPDES121outputTCELL39:OUT_F1
Q0P_HALMSTCOMPDES122outputTCELL38:OUT_Q5
Q0P_HALMSTCOMPDES123outputTCELL38:OUT_F6
Q0P_HALMSTCOMPDES124outputTCELL45:OUT_Q0
Q0P_HALMSTCOMPDES125outputTCELL33:OUT_F4
Q0P_HALMSTCOMPDES126outputTCELL33:OUT_F3
Q0P_HALMSTCOMPDES127outputTCELL33:OUT_F6
Q0P_HALMSTCOMPDES13outputTCELL39:OUT_Q7
Q0P_HALMSTCOMPDES14outputTCELL38:OUT_Q7
Q0P_HALMSTCOMPDES15outputTCELL39:OUT_Q6
Q0P_HALMSTCOMPDES16outputTCELL41:OUT_Q0
Q0P_HALMSTCOMPDES17outputTCELL40:OUT_F1
Q0P_HALMSTCOMPDES18outputTCELL42:OUT_Q2
Q0P_HALMSTCOMPDES19outputTCELL41:OUT_Q5
Q0P_HALMSTCOMPDES2outputTCELL37:OUT_Q0
Q0P_HALMSTCOMPDES20outputTCELL40:OUT_Q2
Q0P_HALMSTCOMPDES21outputTCELL42:OUT_Q3
Q0P_HALMSTCOMPDES22outputTCELL41:OUT_Q4
Q0P_HALMSTCOMPDES23outputTCELL40:OUT_Q5
Q0P_HALMSTCOMPDES24outputTCELL42:OUT_F7
Q0P_HALMSTCOMPDES25outputTCELL42:OUT_F6
Q0P_HALMSTCOMPDES26outputTCELL42:OUT_F3
Q0P_HALMSTCOMPDES27outputTCELL42:OUT_F5
Q0P_HALMSTCOMPDES28outputTCELL42:OUT_F2
Q0P_HALMSTCOMPDES29outputTCELL41:OUT_F5
Q0P_HALMSTCOMPDES3outputTCELL38:OUT_Q1
Q0P_HALMSTCOMPDES30outputTCELL37:OUT_Q5
Q0P_HALMSTCOMPDES31outputTCELL40:OUT_F0
Q0P_HALMSTCOMPDES32outputTCELL38:OUT_F3
Q0P_HALMSTCOMPDES33outputTCELL38:OUT_F7
Q0P_HALMSTCOMPDES34outputTCELL38:OUT_Q3
Q0P_HALMSTCOMPDES35outputTCELL39:OUT_Q3
Q0P_HALMSTCOMPDES36outputTCELL39:OUT_Q1
Q0P_HALMSTCOMPDES37outputTCELL38:OUT_F5
Q0P_HALMSTCOMPDES38outputTCELL37:OUT_Q7
Q0P_HALMSTCOMPDES39outputTCELL41:OUT_Q6
Q0P_HALMSTCOMPDES4outputTCELL38:OUT_Q6
Q0P_HALMSTCOMPDES40outputTCELL40:OUT_Q1
Q0P_HALMSTCOMPDES41outputTCELL41:OUT_F7
Q0P_HALMSTCOMPDES42outputTCELL41:OUT_Q3
Q0P_HALMSTCOMPDES43outputTCELL41:OUT_F3
Q0P_HALMSTCOMPDES44outputTCELL40:OUT_Q3
Q0P_HALMSTCOMPDES45outputTCELL40:OUT_F7
Q0P_HALMSTCOMPDES46outputTCELL40:OUT_F6
Q0P_HALMSTCOMPDES47outputTCELL39:OUT_Q2
Q0P_HALMSTCOMPDES48outputTCELL38:OUT_Q4
Q0P_HALMSTCOMPDES49outputTCELL40:OUT_F4
Q0P_HALMSTCOMPDES5outputTCELL38:OUT_Q2
Q0P_HALMSTCOMPDES50outputTCELL39:OUT_F6
Q0P_HALMSTCOMPDES51outputTCELL39:OUT_F7
Q0P_HALMSTCOMPDES52outputTCELL41:OUT_F0
Q0P_HALMSTCOMPDES53outputTCELL40:OUT_F3
Q0P_HALMSTCOMPDES54outputTCELL40:OUT_Q6
Q0P_HALMSTCOMPDES55outputTCELL38:OUT_F4
Q0P_HALMSTCOMPDES56outputTCELL40:OUT_Q7
Q0P_HALMSTCOMPDES57outputTCELL41:OUT_Q2
Q0P_HALMSTCOMPDES58outputTCELL40:OUT_Q0
Q0P_HALMSTCOMPDES59outputTCELL39:OUT_Q0
Q0P_HALMSTCOMPDES6outputTCELL39:OUT_F0
Q0P_HALMSTCOMPDES60outputTCELL39:OUT_F3
Q0P_HALMSTCOMPDES61outputTCELL40:OUT_F5
Q0P_HALMSTCOMPDES62outputTCELL41:OUT_Q1
Q0P_HALMSTCOMPDES63outputTCELL39:OUT_F2
Q0P_HALMSTCOMPDES64outputTCELL34:OUT_Q7
Q0P_HALMSTCOMPDES65outputTCELL35:OUT_F3
Q0P_HALMSTCOMPDES66outputTCELL34:OUT_Q4
Q0P_HALMSTCOMPDES67outputTCELL33:OUT_Q6
Q0P_HALMSTCOMPDES68outputTCELL34:OUT_Q1
Q0P_HALMSTCOMPDES69outputTCELL35:OUT_F2
Q0P_HALMSTCOMPDES7outputTCELL41:OUT_F4
Q0P_HALMSTCOMPDES70outputTCELL34:OUT_F2
Q0P_HALMSTCOMPDES71outputTCELL34:OUT_F7
Q0P_HALMSTCOMPDES72outputTCELL33:OUT_Q7
Q0P_HALMSTCOMPDES73outputTCELL34:OUT_F6
Q0P_HALMSTCOMPDES74outputTCELL34:OUT_F3
Q0P_HALMSTCOMPDES75outputTCELL34:OUT_F0
Q0P_HALMSTCOMPDES76outputTCELL33:OUT_Q5
Q0P_HALMSTCOMPDES77outputTCELL35:OUT_Q0
Q0P_HALMSTCOMPDES78outputTCELL35:OUT_Q2
Q0P_HALMSTCOMPDES79outputTCELL33:OUT_Q0
Q0P_HALMSTCOMPDES8outputTCELL40:OUT_Q4
Q0P_HALMSTCOMPDES80outputTCELL37:OUT_F6
Q0P_HALMSTCOMPDES81outputTCELL37:OUT_Q3
Q0P_HALMSTCOMPDES82outputTCELL38:OUT_F2
Q0P_HALMSTCOMPDES83outputTCELL37:OUT_F2
Q0P_HALMSTCOMPDES84outputTCELL36:OUT_F6
Q0P_HALMSTCOMPDES85outputTCELL36:OUT_F4
Q0P_HALMSTCOMPDES86outputTCELL36:OUT_Q2
Q0P_HALMSTCOMPDES87outputTCELL36:OUT_F7
Q0P_HALMSTCOMPDES88outputTCELL35:OUT_F7
Q0P_HALMSTCOMPDES89outputTCELL35:OUT_F6
Q0P_HALMSTCOMPDES9outputTCELL41:OUT_F1
Q0P_HALMSTCOMPDES90outputTCELL34:OUT_Q5
Q0P_HALMSTCOMPDES91outputTCELL34:OUT_Q2
Q0P_HALMSTCOMPDES92outputTCELL35:OUT_F1
Q0P_HALMSTCOMPDES93outputTCELL34:OUT_Q3
Q0P_HALMSTCOMPDES94outputTCELL35:OUT_F0
Q0P_HALMSTCOMPDES95outputTCELL35:OUT_F4
Q0P_HALMSTCOMPDES96outputTCELL37:OUT_Q6
Q0P_HALMSTCOMPDES97outputTCELL38:OUT_F0
Q0P_HALMSTCOMPDES98outputTCELL38:OUT_F1
Q0P_HALMSTCOMPDES99outputTCELL37:OUT_Q4
Q0P_HALMSTCOMPEOPoutputTCELL37:OUT_F3
Q0P_HALMSTCOMPRDYinputTCELL47:IMUX_A2
Q0P_HALMSTCOMPSOPoutputTCELL36:OUT_Q7
Q0P_HALMSTCOMPVLDoutputTCELL36:OUT_Q6
Q0P_HALMSTRBVLD0outputTCELL37:OUT_F0
Q0P_HALMSTRBVLD1outputTCELL36:OUT_Q3
Q0P_HALMSTRBVLD2outputTCELL37:OUT_Q2
Q0P_HALMSTRBVLD3outputTCELL36:OUT_F3
Q0P_HALMSTRBVLD4outputTCELL36:OUT_F2
Q0P_HALMSTRBVLD5outputTCELL37:OUT_F5
Q0P_HALMSTRBVLD6outputTCELL36:OUT_Q5
Q0P_HALMSTRBVLD7outputTCELL36:OUT_Q4
Q0P_HALMSTREJoutputTCELL43:OUT_Q1
Q0P_HALMSTREQinputTCELL43:IMUX_A5
Q0P_HALMSTREQATTR0inputTCELL47:IMUX_A0
Q0P_HALMSTREQATTR1inputTCELL47:IMUX_A1
Q0P_HALMSTREQATTR2inputTCELL48:IMUX_A1
Q0P_HALMSTREQDES0inputTCELL46:IMUX_B0
Q0P_HALMSTREQDES1inputTCELL45:IMUX_C1
Q0P_HALMSTREQDES10inputTCELL45:IMUX_C2
Q0P_HALMSTREQDES100inputTCELL41:IMUX_C5
Q0P_HALMSTREQDES101inputTCELL41:IMUX_C4
Q0P_HALMSTREQDES102inputTCELL41:IMUX_B5
Q0P_HALMSTREQDES103inputTCELL41:IMUX_B4
Q0P_HALMSTREQDES104inputTCELL41:IMUX_B3
Q0P_HALMSTREQDES105inputTCELL41:IMUX_B2
Q0P_HALMSTREQDES106inputTCELL41:IMUX_B1
Q0P_HALMSTREQDES107inputTCELL41:IMUX_C1
Q0P_HALMSTREQDES108inputTCELL41:IMUX_A5
Q0P_HALMSTREQDES109inputTCELL41:IMUX_A4
Q0P_HALMSTREQDES11inputTCELL45:IMUX_C3
Q0P_HALMSTREQDES110inputTCELL41:IMUX_C3
Q0P_HALMSTREQDES111inputTCELL41:IMUX_A3
Q0P_HALMSTREQDES112inputTCELL41:IMUX_A2
Q0P_HALMSTREQDES113inputTCELL41:IMUX_A1
Q0P_HALMSTREQDES114inputTCELL41:IMUX_B0
Q0P_HALMSTREQDES115inputTCELL41:IMUX_C2
Q0P_HALMSTREQDES116inputTCELL41:IMUX_A0
Q0P_HALMSTREQDES117inputTCELL40:IMUX_D5
Q0P_HALMSTREQDES118inputTCELL40:IMUX_D4
Q0P_HALMSTREQDES119inputTCELL40:IMUX_D3
Q0P_HALMSTREQDES12inputTCELL45:IMUX_B4
Q0P_HALMSTREQDES120inputTCELL40:IMUX_D2
Q0P_HALMSTREQDES121inputTCELL40:IMUX_D0
Q0P_HALMSTREQDES122inputTCELL40:IMUX_C5
Q0P_HALMSTREQDES123inputTCELL40:IMUX_C3
Q0P_HALMSTREQDES124inputTCELL40:IMUX_C2
Q0P_HALMSTREQDES125inputTCELL40:IMUX_C4
Q0P_HALMSTREQDES126inputTCELL41:IMUX_C0
Q0P_HALMSTREQDES127inputTCELL43:IMUX_A4
Q0P_HALMSTREQDES13inputTCELL46:IMUX_B3
Q0P_HALMSTREQDES14inputTCELL46:IMUX_B2
Q0P_HALMSTREQDES15inputTCELL46:IMUX_A0
Q0P_HALMSTREQDES16inputTCELL45:IMUX_C4
Q0P_HALMSTREQDES17inputTCELL45:IMUX_B1
Q0P_HALMSTREQDES18inputTCELL45:IMUX_D2
Q0P_HALMSTREQDES19inputTCELL45:IMUX_A4
Q0P_HALMSTREQDES2inputTCELL45:IMUX_D5
Q0P_HALMSTREQDES20inputTCELL45:IMUX_A1
Q0P_HALMSTREQDES21inputTCELL45:IMUX_B2
Q0P_HALMSTREQDES22inputTCELL45:IMUX_B3
Q0P_HALMSTREQDES23inputTCELL44:IMUX_D3
Q0P_HALMSTREQDES24inputTCELL46:IMUX_D2
Q0P_HALMSTREQDES25inputTCELL46:IMUX_C3
Q0P_HALMSTREQDES26inputTCELL46:IMUX_D4
Q0P_HALMSTREQDES27inputTCELL46:IMUX_D1
Q0P_HALMSTREQDES28inputTCELL46:IMUX_C4
Q0P_HALMSTREQDES29inputTCELL46:IMUX_D0
Q0P_HALMSTREQDES3inputTCELL45:IMUX_D4
Q0P_HALMSTREQDES30inputTCELL46:IMUX_C5
Q0P_HALMSTREQDES31inputTCELL46:IMUX_B1
Q0P_HALMSTREQDES32inputTCELL46:IMUX_A3
Q0P_HALMSTREQDES33inputTCELL46:IMUX_A1
Q0P_HALMSTREQDES34inputTCELL45:IMUX_C0
Q0P_HALMSTREQDES35inputTCELL45:IMUX_C5
Q0P_HALMSTREQDES36inputTCELL45:IMUX_A2
Q0P_HALMSTREQDES37inputTCELL44:IMUX_D4
Q0P_HALMSTREQDES38inputTCELL45:IMUX_A0
Q0P_HALMSTREQDES39inputTCELL44:IMUX_D2
Q0P_HALMSTREQDES4inputTCELL45:IMUX_D3
Q0P_HALMSTREQDES40inputTCELL44:IMUX_D0
Q0P_HALMSTREQDES41inputTCELL44:IMUX_D5
Q0P_HALMSTREQDES42inputTCELL44:IMUX_C4
Q0P_HALMSTREQDES43inputTCELL44:IMUX_C3
Q0P_HALMSTREQDES44inputTCELL44:IMUX_C5
Q0P_HALMSTREQDES45inputTCELL44:IMUX_C2
Q0P_HALMSTREQDES46inputTCELL44:IMUX_B2
Q0P_HALMSTREQDES47inputTCELL44:IMUX_B3
Q0P_HALMSTREQDES48inputTCELL44:IMUX_C1
Q0P_HALMSTREQDES49inputTCELL44:IMUX_C0
Q0P_HALMSTREQDES5inputTCELL45:IMUX_D1
Q0P_HALMSTREQDES50inputTCELL44:IMUX_B1
Q0P_HALMSTREQDES51inputTCELL44:IMUX_B4
Q0P_HALMSTREQDES52inputTCELL44:IMUX_B5
Q0P_HALMSTREQDES53inputTCELL44:IMUX_B0
Q0P_HALMSTREQDES54inputTCELL44:IMUX_A3
Q0P_HALMSTREQDES55inputTCELL44:IMUX_A4
Q0P_HALMSTREQDES56inputTCELL44:IMUX_A1
Q0P_HALMSTREQDES57inputTCELL43:IMUX_D0
Q0P_HALMSTREQDES58inputTCELL43:IMUX_D1
Q0P_HALMSTREQDES59inputTCELL44:IMUX_A0
Q0P_HALMSTREQDES6inputTCELL45:IMUX_D0
Q0P_HALMSTREQDES60inputTCELL43:IMUX_D2
Q0P_HALMSTREQDES61inputTCELL43:IMUX_D3
Q0P_HALMSTREQDES62inputTCELL43:IMUX_C4
Q0P_HALMSTREQDES63inputTCELL43:IMUX_C3
Q0P_HALMSTREQDES64inputTCELL43:IMUX_C0
Q0P_HALMSTREQDES65inputTCELL43:IMUX_C1
Q0P_HALMSTREQDES66inputTCELL43:IMUX_C5
Q0P_HALMSTREQDES67inputTCELL44:IMUX_A5
Q0P_HALMSTREQDES68inputTCELL43:IMUX_D5
Q0P_HALMSTREQDES69inputTCELL43:IMUX_D4
Q0P_HALMSTREQDES7inputTCELL44:IMUX_D1
Q0P_HALMSTREQDES70inputTCELL43:IMUX_B3
Q0P_HALMSTREQDES71inputTCELL43:IMUX_B0
Q0P_HALMSTREQDES72inputTCELL43:IMUX_A3
Q0P_HALMSTREQDES73inputTCELL44:IMUX_A2
Q0P_HALMSTREQDES74inputTCELL43:IMUX_A2
Q0P_HALMSTREQDES75inputTCELL43:IMUX_A1
Q0P_HALMSTREQDES76inputTCELL43:IMUX_B5
Q0P_HALMSTREQDES77inputTCELL43:IMUX_B1
Q0P_HALMSTREQDES78inputTCELL43:IMUX_C2
Q0P_HALMSTREQDES79inputTCELL42:IMUX_D5
Q0P_HALMSTREQDES8inputTCELL45:IMUX_B0
Q0P_HALMSTREQDES80inputTCELL43:IMUX_B2
Q0P_HALMSTREQDES81inputTCELL42:IMUX_D4
Q0P_HALMSTREQDES82inputTCELL42:IMUX_D3
Q0P_HALMSTREQDES83inputTCELL42:IMUX_D2
Q0P_HALMSTREQDES84inputTCELL42:IMUX_C2
Q0P_HALMSTREQDES85inputTCELL42:IMUX_B5
Q0P_HALMSTREQDES86inputTCELL47:IMUX_A4
Q0P_HALMSTREQDES87inputTCELL42:IMUX_B4
Q0P_HALMSTREQDES88inputTCELL42:IMUX_B3
Q0P_HALMSTREQDES89inputTCELL42:IMUX_B2
Q0P_HALMSTREQDES9inputTCELL45:IMUX_A3
Q0P_HALMSTREQDES90inputTCELL42:IMUX_A5
Q0P_HALMSTREQDES91inputTCELL42:IMUX_A4
Q0P_HALMSTREQDES92inputTCELL42:IMUX_A3
Q0P_HALMSTREQDES93inputTCELL42:IMUX_A2
Q0P_HALMSTREQDES94inputTCELL41:IMUX_D5
Q0P_HALMSTREQDES95inputTCELL41:IMUX_D4
Q0P_HALMSTREQDES96inputTCELL41:IMUX_D3
Q0P_HALMSTREQDES97inputTCELL41:IMUX_D2
Q0P_HALMSTREQDES98inputTCELL41:IMUX_D1
Q0P_HALMSTREQDES99inputTCELL41:IMUX_D0
Q0P_HALMSTREQTPHPRESENTinputTCELL49:IMUX_C5
Q0P_HALMSTREQTPHSTTAG0inputTCELL50:IMUX_C2
Q0P_HALMSTREQTPHSTTAG1inputTCELL50:IMUX_A5
Q0P_HALMSTREQTPHSTTAG2inputTCELL50:IMUX_A3
Q0P_HALMSTREQTPHSTTAG3inputTCELL50:IMUX_B5
Q0P_HALMSTREQTPHSTTAG4inputTCELL50:IMUX_A2
Q0P_HALMSTREQTPHSTTAG5inputTCELL50:IMUX_C3
Q0P_HALMSTREQTPHSTTAG6inputTCELL50:IMUX_B1
Q0P_HALMSTREQTPHSTTAG7inputTCELL50:IMUX_B3
Q0P_HALMSTREQTPHTYPE0inputTCELL49:IMUX_D4
Q0P_HALMSTREQTPHTYPE1inputTCELL49:IMUX_D2
Q0P_HALMSTRERRoutputTCELL46:OUT_F4
Q0P_HALMSTTAG0outputTCELL44:OUT_F6
Q0P_HALMSTTAG1outputTCELL44:OUT_F3
Q0P_HALMSTTAG2outputTCELL44:OUT_F1
Q0P_HALMSTTAG3outputTCELL44:OUT_F4
Q0P_HALMSTTAG4outputTCELL44:OUT_F5
Q0P_HALMSTWBVLD0inputTCELL46:IMUX_A4
Q0P_HALMSTWBVLD1inputTCELL45:IMUX_A5
Q0P_HALMSTWBVLD2inputTCELL45:IMUX_B5
Q0P_HALMSTWBVLD3inputTCELL46:IMUX_C1
Q0P_HALMSTWBVLD4inputTCELL46:IMUX_C2
Q0P_HALMSTWBVLD5inputTCELL46:IMUX_D3
Q0P_HALMSTWBVLD6inputTCELL46:IMUX_B5
Q0P_HALMSTWBVLD7inputTCELL46:IMUX_C0
Q0P_HALMSTWDATVLDinputTCELL46:IMUX_A5
Q0P_HALMSTWEOPinputTCELL46:IMUX_A2
Q0P_HALMSTWERRinputTCELL46:IMUX_B4
Q0P_HALMSTWRDYoutputTCELL32:OUT_F0
Q0P_HALTGTACKinputTCELL40:IMUX_B5
Q0P_HALTGTCAREQDES0inputTCELL40:IMUX_C1
Q0P_HALTGTCAREQDES1inputTCELL40:IMUX_B4
Q0P_HALTGTCAREQDES10inputTCELL40:IMUX_A1
Q0P_HALTGTCAREQDES100inputTCELL37:IMUX_D1
Q0P_HALTGTCAREQDES101inputTCELL38:IMUX_A1
Q0P_HALTGTCAREQDES102inputTCELL38:IMUX_C1
Q0P_HALTGTCAREQDES103inputTCELL38:IMUX_C2
Q0P_HALTGTCAREQDES104inputTCELL35:IMUX_B4
Q0P_HALTGTCAREQDES105inputTCELL35:IMUX_B3
Q0P_HALTGTCAREQDES106inputTCELL35:IMUX_B2
Q0P_HALTGTCAREQDES107inputTCELL48:IMUX_A0
Q0P_HALTGTCAREQDES108inputTCELL47:IMUX_A5
Q0P_HALTGTCAREQDES109inputTCELL47:IMUX_D5
Q0P_HALTGTCAREQDES11inputTCELL40:IMUX_A0
Q0P_HALTGTCAREQDES110inputTCELL47:IMUX_B0
Q0P_HALTGTCAREQDES111inputTCELL47:IMUX_D4
Q0P_HALTGTCAREQDES112inputTCELL47:IMUX_B1
Q0P_HALTGTCAREQDES113inputTCELL47:IMUX_B2
Q0P_HALTGTCAREQDES114inputTCELL47:IMUX_D3
Q0P_HALTGTCAREQDES115inputTCELL47:IMUX_D2
Q0P_HALTGTCAREQDES116inputTCELL47:IMUX_B3
Q0P_HALTGTCAREQDES117inputTCELL47:IMUX_D1
Q0P_HALTGTCAREQDES118inputTCELL47:IMUX_B4
Q0P_HALTGTCAREQDES119inputTCELL47:IMUX_D0
Q0P_HALTGTCAREQDES12inputTCELL39:IMUX_D3
Q0P_HALTGTCAREQDES120inputTCELL40:IMUX_D1
Q0P_HALTGTCAREQDES121inputTCELL35:IMUX_D5
Q0P_HALTGTCAREQDES122inputTCELL47:IMUX_C5
Q0P_HALTGTCAREQDES123inputTCELL47:IMUX_C4
Q0P_HALTGTCAREQDES124inputTCELL47:IMUX_B5
Q0P_HALTGTCAREQDES125inputTCELL47:IMUX_C3
Q0P_HALTGTCAREQDES126inputTCELL47:IMUX_C0
Q0P_HALTGTCAREQDES127inputTCELL47:IMUX_C2
Q0P_HALTGTCAREQDES13inputTCELL39:IMUX_D2
Q0P_HALTGTCAREQDES14inputTCELL39:IMUX_D1
Q0P_HALTGTCAREQDES15inputTCELL39:IMUX_D0
Q0P_HALTGTCAREQDES16inputTCELL39:IMUX_C3
Q0P_HALTGTCAREQDES17inputTCELL39:IMUX_C2
Q0P_HALTGTCAREQDES18inputTCELL39:IMUX_C1
Q0P_HALTGTCAREQDES19inputTCELL39:IMUX_C0
Q0P_HALTGTCAREQDES2inputTCELL40:IMUX_B3
Q0P_HALTGTCAREQDES20inputTCELL39:IMUX_B3
Q0P_HALTGTCAREQDES21inputTCELL39:IMUX_B2
Q0P_HALTGTCAREQDES22inputTCELL39:IMUX_B1
Q0P_HALTGTCAREQDES23inputTCELL39:IMUX_B0
Q0P_HALTGTCAREQDES24inputTCELL39:IMUX_A3
Q0P_HALTGTCAREQDES25inputTCELL39:IMUX_A2
Q0P_HALTGTCAREQDES26inputTCELL39:IMUX_A1
Q0P_HALTGTCAREQDES27inputTCELL39:IMUX_A0
Q0P_HALTGTCAREQDES28inputTCELL38:IMUX_D5
Q0P_HALTGTCAREQDES29inputTCELL38:IMUX_D4
Q0P_HALTGTCAREQDES3inputTCELL40:IMUX_B2
Q0P_HALTGTCAREQDES30inputTCELL38:IMUX_D3
Q0P_HALTGTCAREQDES31inputTCELL38:IMUX_D2
Q0P_HALTGTCAREQDES32inputTCELL38:IMUX_D1
Q0P_HALTGTCAREQDES33inputTCELL38:IMUX_D0
Q0P_HALTGTCAREQDES34inputTCELL38:IMUX_C5
Q0P_HALTGTCAREQDES35inputTCELL38:IMUX_C4
Q0P_HALTGTCAREQDES36inputTCELL38:IMUX_C3
Q0P_HALTGTCAREQDES37inputTCELL38:IMUX_C0
Q0P_HALTGTCAREQDES38inputTCELL38:IMUX_B5
Q0P_HALTGTCAREQDES39inputTCELL38:IMUX_B4
Q0P_HALTGTCAREQDES4inputTCELL40:IMUX_B1
Q0P_HALTGTCAREQDES40inputTCELL38:IMUX_B3
Q0P_HALTGTCAREQDES41inputTCELL38:IMUX_B2
Q0P_HALTGTCAREQDES42inputTCELL38:IMUX_B1
Q0P_HALTGTCAREQDES43inputTCELL38:IMUX_B0
Q0P_HALTGTCAREQDES44inputTCELL38:IMUX_A5
Q0P_HALTGTCAREQDES45inputTCELL38:IMUX_A4
Q0P_HALTGTCAREQDES46inputTCELL38:IMUX_A3
Q0P_HALTGTCAREQDES47inputTCELL38:IMUX_A2
Q0P_HALTGTCAREQDES48inputTCELL37:IMUX_D5
Q0P_HALTGTCAREQDES49inputTCELL37:IMUX_D4
Q0P_HALTGTCAREQDES5inputTCELL40:IMUX_B0
Q0P_HALTGTCAREQDES50inputTCELL37:IMUX_D3
Q0P_HALTGTCAREQDES51inputTCELL37:IMUX_D2
Q0P_HALTGTCAREQDES52inputTCELL37:IMUX_D0
Q0P_HALTGTCAREQDES53inputTCELL37:IMUX_C5
Q0P_HALTGTCAREQDES54inputTCELL37:IMUX_C4
Q0P_HALTGTCAREQDES55inputTCELL37:IMUX_C3
Q0P_HALTGTCAREQDES56inputTCELL37:IMUX_C2
Q0P_HALTGTCAREQDES57inputTCELL37:IMUX_C1
Q0P_HALTGTCAREQDES58inputTCELL37:IMUX_C0
Q0P_HALTGTCAREQDES59inputTCELL37:IMUX_B5
Q0P_HALTGTCAREQDES6inputTCELL40:IMUX_A5
Q0P_HALTGTCAREQDES60inputTCELL37:IMUX_B3
Q0P_HALTGTCAREQDES61inputTCELL37:IMUX_B2
Q0P_HALTGTCAREQDES62inputTCELL37:IMUX_B0
Q0P_HALTGTCAREQDES63inputTCELL37:IMUX_A5
Q0P_HALTGTCAREQDES64inputTCELL37:IMUX_A4
Q0P_HALTGTCAREQDES65inputTCELL37:IMUX_A3
Q0P_HALTGTCAREQDES66inputTCELL37:IMUX_A2
Q0P_HALTGTCAREQDES67inputTCELL37:IMUX_A1
Q0P_HALTGTCAREQDES68inputTCELL36:IMUX_D5
Q0P_HALTGTCAREQDES69inputTCELL36:IMUX_D4
Q0P_HALTGTCAREQDES7inputTCELL40:IMUX_A4
Q0P_HALTGTCAREQDES70inputTCELL36:IMUX_D3
Q0P_HALTGTCAREQDES71inputTCELL36:IMUX_D2
Q0P_HALTGTCAREQDES72inputTCELL36:IMUX_C5
Q0P_HALTGTCAREQDES73inputTCELL36:IMUX_C4
Q0P_HALTGTCAREQDES74inputTCELL36:IMUX_B5
Q0P_HALTGTCAREQDES75inputTCELL36:IMUX_B4
Q0P_HALTGTCAREQDES76inputTCELL36:IMUX_B3
Q0P_HALTGTCAREQDES77inputTCELL36:IMUX_B2
Q0P_HALTGTCAREQDES78inputTCELL36:IMUX_A5
Q0P_HALTGTCAREQDES79inputTCELL36:IMUX_A4
Q0P_HALTGTCAREQDES8inputTCELL40:IMUX_A3
Q0P_HALTGTCAREQDES80inputTCELL36:IMUX_A3
Q0P_HALTGTCAREQDES81inputTCELL38:IMUX_A0
Q0P_HALTGTCAREQDES82inputTCELL37:IMUX_A0
Q0P_HALTGTCAREQDES83inputTCELL37:IMUX_B1
Q0P_HALTGTCAREQDES84inputTCELL36:IMUX_A2
Q0P_HALTGTCAREQDES85inputTCELL35:IMUX_D4
Q0P_HALTGTCAREQDES86inputTCELL36:IMUX_C3
Q0P_HALTGTCAREQDES87inputTCELL35:IMUX_D3
Q0P_HALTGTCAREQDES88inputTCELL35:IMUX_D2
Q0P_HALTGTCAREQDES89inputTCELL35:IMUX_D1
Q0P_HALTGTCAREQDES9inputTCELL40:IMUX_A2
Q0P_HALTGTCAREQDES90inputTCELL35:IMUX_D0
Q0P_HALTGTCAREQDES91inputTCELL35:IMUX_C5
Q0P_HALTGTCAREQDES92inputTCELL35:IMUX_C4
Q0P_HALTGTCAREQDES93inputTCELL35:IMUX_C3
Q0P_HALTGTCAREQDES94inputTCELL35:IMUX_C2
Q0P_HALTGTCAREQDES95inputTCELL37:IMUX_B4
Q0P_HALTGTCAREQDES96inputTCELL35:IMUX_C1
Q0P_HALTGTCAREQDES97inputTCELL35:IMUX_C0
Q0P_HALTGTCAREQDES98inputTCELL35:IMUX_B5
Q0P_HALTGTCAREQDES99inputTCELL36:IMUX_C2
Q0P_HALTGTCLNTCOMPID0inputTCELL35:IMUX_B1
Q0P_HALTGTCLNTCOMPID1inputTCELL35:IMUX_B0
Q0P_HALTGTCLNTCOMPID10inputTCELL34:IMUX_D3
Q0P_HALTGTCLNTCOMPID11inputTCELL34:IMUX_D2
Q0P_HALTGTCLNTCOMPID12inputTCELL34:IMUX_D1
Q0P_HALTGTCLNTCOMPID13inputTCELL34:IMUX_D0
Q0P_HALTGTCLNTCOMPID14inputTCELL34:IMUX_C5
Q0P_HALTGTCLNTCOMPID15inputTCELL34:IMUX_C4
Q0P_HALTGTCLNTCOMPID2inputTCELL35:IMUX_A5
Q0P_HALTGTCLNTCOMPID3inputTCELL35:IMUX_A4
Q0P_HALTGTCLNTCOMPID4inputTCELL35:IMUX_A3
Q0P_HALTGTCLNTCOMPID5inputTCELL35:IMUX_A2
Q0P_HALTGTCLNTCOMPID6inputTCELL35:IMUX_A1
Q0P_HALTGTCLNTCOMPID7inputTCELL35:IMUX_A0
Q0P_HALTGTCLNTCOMPID8inputTCELL34:IMUX_D5
Q0P_HALTGTCLNTCOMPID9inputTCELL34:IMUX_D4
Q0P_HALTGTCLNTCOMPIDENinputTCELL30:IMUX_C0
Q0P_HALTGTCOMPBVLD0inputTCELL34:IMUX_C3
Q0P_HALTGTCOMPBVLD1inputTCELL34:IMUX_C2
Q0P_HALTGTCOMPBVLD2inputTCELL34:IMUX_C1
Q0P_HALTGTCOMPBVLD3inputTCELL34:IMUX_C0
Q0P_HALTGTCOMPBVLD4inputTCELL34:IMUX_B5
Q0P_HALTGTCOMPBVLD5inputTCELL34:IMUX_B4
Q0P_HALTGTCOMPBVLD6inputTCELL34:IMUX_B3
Q0P_HALTGTCOMPBVLD7inputTCELL34:IMUX_B2
Q0P_HALTGTCOMPDES0inputTCELL34:IMUX_B1
Q0P_HALTGTCOMPDES1inputTCELL34:IMUX_B0
Q0P_HALTGTCOMPDES10inputTCELL29:IMUX_A1
Q0P_HALTGTCOMPDES100inputTCELL31:IMUX_A5
Q0P_HALTGTCOMPDES101inputTCELL31:IMUX_A0
Q0P_HALTGTCOMPDES102inputTCELL30:IMUX_C4
Q0P_HALTGTCOMPDES103inputTCELL30:IMUX_D2
Q0P_HALTGTCOMPDES104inputTCELL31:IMUX_C3
Q0P_HALTGTCOMPDES105inputTCELL31:IMUX_C5
Q0P_HALTGTCOMPDES106inputTCELL32:IMUX_C0
Q0P_HALTGTCOMPDES107inputTCELL31:IMUX_D1
Q0P_HALTGTCOMPDES108inputTCELL31:IMUX_B2
Q0P_HALTGTCOMPDES109inputTCELL32:IMUX_B2
Q0P_HALTGTCOMPDES11inputTCELL29:IMUX_A2
Q0P_HALTGTCOMPDES110inputTCELL32:IMUX_B5
Q0P_HALTGTCOMPDES111inputTCELL32:IMUX_B3
Q0P_HALTGTCOMPDES112inputTCELL32:IMUX_A5
Q0P_HALTGTCOMPDES113inputTCELL32:IMUX_A0
Q0P_HALTGTCOMPDES114inputTCELL32:IMUX_A1
Q0P_HALTGTCOMPDES115inputTCELL31:IMUX_C1
Q0P_HALTGTCOMPDES116inputTCELL31:IMUX_C0
Q0P_HALTGTCOMPDES117inputTCELL32:IMUX_A3
Q0P_HALTGTCOMPDES118inputTCELL31:IMUX_B5
Q0P_HALTGTCOMPDES119inputTCELL47:IMUX_C1
Q0P_HALTGTCOMPDES12inputTCELL33:IMUX_D4
Q0P_HALTGTCOMPDES120inputTCELL31:IMUX_D2
Q0P_HALTGTCOMPDES121inputTCELL30:IMUX_C1
Q0P_HALTGTCOMPDES122inputTCELL31:IMUX_B1
Q0P_HALTGTCOMPDES123inputTCELL31:IMUX_B3
Q0P_HALTGTCOMPDES124inputTCELL31:IMUX_B4
Q0P_HALTGTCOMPDES125inputTCELL30:IMUX_D3
Q0P_HALTGTCOMPDES126inputTCELL30:IMUX_D5
Q0P_HALTGTCOMPDES127inputTCELL29:IMUX_D5
Q0P_HALTGTCOMPDES13inputTCELL29:IMUX_A3
Q0P_HALTGTCOMPDES14inputTCELL29:IMUX_A4
Q0P_HALTGTCOMPDES15inputTCELL33:IMUX_D3
Q0P_HALTGTCOMPDES16inputTCELL29:IMUX_A5
Q0P_HALTGTCOMPDES17inputTCELL29:IMUX_B0
Q0P_HALTGTCOMPDES18inputTCELL33:IMUX_D2
Q0P_HALTGTCOMPDES19inputTCELL33:IMUX_D1
Q0P_HALTGTCOMPDES2inputTCELL34:IMUX_A5
Q0P_HALTGTCOMPDES20inputTCELL33:IMUX_D0
Q0P_HALTGTCOMPDES21inputTCELL33:IMUX_C4
Q0P_HALTGTCOMPDES22inputTCELL29:IMUX_B1
Q0P_HALTGTCOMPDES23inputTCELL29:IMUX_B2
Q0P_HALTGTCOMPDES24inputTCELL29:IMUX_B3
Q0P_HALTGTCOMPDES25inputTCELL29:IMUX_B4
Q0P_HALTGTCOMPDES26inputTCELL29:IMUX_B5
Q0P_HALTGTCOMPDES27inputTCELL29:IMUX_C0
Q0P_HALTGTCOMPDES28inputTCELL29:IMUX_C1
Q0P_HALTGTCOMPDES29inputTCELL29:IMUX_C2
Q0P_HALTGTCOMPDES3inputTCELL34:IMUX_A4
Q0P_HALTGTCOMPDES30inputTCELL29:IMUX_C3
Q0P_HALTGTCOMPDES31inputTCELL29:IMUX_C4
Q0P_HALTGTCOMPDES32inputTCELL29:IMUX_C5
Q0P_HALTGTCOMPDES33inputTCELL29:IMUX_D0
Q0P_HALTGTCOMPDES34inputTCELL33:IMUX_C3
Q0P_HALTGTCOMPDES35inputTCELL33:IMUX_C2
Q0P_HALTGTCOMPDES36inputTCELL33:IMUX_C1
Q0P_HALTGTCOMPDES37inputTCELL33:IMUX_C0
Q0P_HALTGTCOMPDES38inputTCELL33:IMUX_B5
Q0P_HALTGTCOMPDES39inputTCELL33:IMUX_B4
Q0P_HALTGTCOMPDES4inputTCELL34:IMUX_A3
Q0P_HALTGTCOMPDES40inputTCELL33:IMUX_B3
Q0P_HALTGTCOMPDES41inputTCELL33:IMUX_B2
Q0P_HALTGTCOMPDES42inputTCELL33:IMUX_B1
Q0P_HALTGTCOMPDES43inputTCELL33:IMUX_B0
Q0P_HALTGTCOMPDES44inputTCELL33:IMUX_A5
Q0P_HALTGTCOMPDES45inputTCELL33:IMUX_A4
Q0P_HALTGTCOMPDES46inputTCELL33:IMUX_A3
Q0P_HALTGTCOMPDES47inputTCELL33:IMUX_A2
Q0P_HALTGTCOMPDES48inputTCELL33:IMUX_A1
Q0P_HALTGTCOMPDES49inputTCELL33:IMUX_A0
Q0P_HALTGTCOMPDES5inputTCELL34:IMUX_A2
Q0P_HALTGTCOMPDES50inputTCELL32:IMUX_D5
Q0P_HALTGTCOMPDES51inputTCELL32:IMUX_D4
Q0P_HALTGTCOMPDES52inputTCELL32:IMUX_D3
Q0P_HALTGTCOMPDES53inputTCELL32:IMUX_D2
Q0P_HALTGTCOMPDES54inputTCELL32:IMUX_D1
Q0P_HALTGTCOMPDES55inputTCELL32:IMUX_D0
Q0P_HALTGTCOMPDES56inputTCELL32:IMUX_C5
Q0P_HALTGTCOMPDES57inputTCELL32:IMUX_C4
Q0P_HALTGTCOMPDES58inputTCELL32:IMUX_C3
Q0P_HALTGTCOMPDES59inputTCELL29:IMUX_D1
Q0P_HALTGTCOMPDES6inputTCELL34:IMUX_A1
Q0P_HALTGTCOMPDES60inputTCELL32:IMUX_C2
Q0P_HALTGTCOMPDES61inputTCELL29:IMUX_D2
Q0P_HALTGTCOMPDES62inputTCELL29:IMUX_D3
Q0P_HALTGTCOMPDES63inputTCELL29:IMUX_D4
Q0P_HALTGTCOMPDES64inputTCELL30:IMUX_A0
Q0P_HALTGTCOMPDES65inputTCELL30:IMUX_A1
Q0P_HALTGTCOMPDES66inputTCELL30:IMUX_A2
Q0P_HALTGTCOMPDES67inputTCELL30:IMUX_A3
Q0P_HALTGTCOMPDES68inputTCELL33:IMUX_C5
Q0P_HALTGTCOMPDES69inputTCELL30:IMUX_A4
Q0P_HALTGTCOMPDES7inputTCELL34:IMUX_A0
Q0P_HALTGTCOMPDES70inputTCELL32:IMUX_C1
Q0P_HALTGTCOMPDES71inputTCELL30:IMUX_A5
Q0P_HALTGTCOMPDES72inputTCELL30:IMUX_B0
Q0P_HALTGTCOMPDES73inputTCELL30:IMUX_B1
Q0P_HALTGTCOMPDES74inputTCELL30:IMUX_B2
Q0P_HALTGTCOMPDES75inputTCELL32:IMUX_B4
Q0P_HALTGTCOMPDES76inputTCELL32:IMUX_B1
Q0P_HALTGTCOMPDES77inputTCELL30:IMUX_B3
Q0P_HALTGTCOMPDES78inputTCELL30:IMUX_B4
Q0P_HALTGTCOMPDES79inputTCELL30:IMUX_B5
Q0P_HALTGTCOMPDES8inputTCELL33:IMUX_D5
Q0P_HALTGTCOMPDES80inputTCELL30:IMUX_C2
Q0P_HALTGTCOMPDES81inputTCELL30:IMUX_C3
Q0P_HALTGTCOMPDES82inputTCELL32:IMUX_B0
Q0P_HALTGTCOMPDES83inputTCELL31:IMUX_D0
Q0P_HALTGTCOMPDES84inputTCELL31:IMUX_C4
Q0P_HALTGTCOMPDES85inputTCELL31:IMUX_A2
Q0P_HALTGTCOMPDES86inputTCELL31:IMUX_A1
Q0P_HALTGTCOMPDES87inputTCELL31:IMUX_D4
Q0P_HALTGTCOMPDES88inputTCELL32:IMUX_A2
Q0P_HALTGTCOMPDES89inputTCELL31:IMUX_D3
Q0P_HALTGTCOMPDES9inputTCELL29:IMUX_A0
Q0P_HALTGTCOMPDES90inputTCELL31:IMUX_A3
Q0P_HALTGTCOMPDES91inputTCELL31:IMUX_D5
Q0P_HALTGTCOMPDES92inputTCELL31:IMUX_A4
Q0P_HALTGTCOMPDES93inputTCELL31:IMUX_C2
Q0P_HALTGTCOMPDES94inputTCELL30:IMUX_D0
Q0P_HALTGTCOMPDES95inputTCELL30:IMUX_C5
Q0P_HALTGTCOMPDES96inputTCELL30:IMUX_D4
Q0P_HALTGTCOMPDES97inputTCELL32:IMUX_A4
Q0P_HALTGTCOMPDES98inputTCELL31:IMUX_B0
Q0P_HALTGTCOMPDES99inputTCELL30:IMUX_D1
Q0P_HALTGTCOMPEOPinputTCELL43:IMUX_A0
Q0P_HALTGTCOMPERRinputTCELL42:IMUX_C3
Q0P_HALTGTCOMPRDYoutputTCELL18:OUT_F4
Q0P_HALTGTCOMPSOPinputTCELL42:IMUX_C5
Q0P_HALTGTCOMPVLDinputTCELL42:IMUX_C4
Q0P_HALTGTNPREJinputTCELL43:IMUX_B4
Q0P_HALTGTREQoutputTCELL22:OUT_F0
Q0P_HALTGTREQDES0outputTCELL19:OUT_Q0
Q0P_HALTGTREQDES1outputTCELL19:OUT_F5
Q0P_HALTGTREQDES10outputTCELL18:OUT_Q4
Q0P_HALTGTREQDES100outputTCELL30:OUT_Q3
Q0P_HALTGTREQDES101outputTCELL29:OUT_F4
Q0P_HALTGTREQDES102outputTCELL23:OUT_Q0
Q0P_HALTGTREQDES103outputTCELL22:OUT_Q0
Q0P_HALTGTREQDES104outputTCELL23:OUT_F1
Q0P_HALTGTREQDES105outputTCELL22:OUT_Q4
Q0P_HALTGTREQDES106outputTCELL29:OUT_Q6
Q0P_HALTGTREQDES107outputTCELL47:OUT_F2
Q0P_HALTGTREQDES108outputTCELL47:OUT_F0
Q0P_HALTGTREQDES109outputTCELL30:OUT_F2
Q0P_HALTGTREQDES11outputTCELL18:OUT_Q3
Q0P_HALTGTREQDES110outputTCELL29:OUT_Q2
Q0P_HALTGTREQDES111outputTCELL24:OUT_Q4
Q0P_HALTGTREQDES112outputTCELL47:OUT_F1
Q0P_HALTGTREQDES113outputTCELL46:OUT_Q6
Q0P_HALTGTREQDES114outputTCELL46:OUT_Q5
Q0P_HALTGTREQDES115outputTCELL46:OUT_Q7
Q0P_HALTGTREQDES116outputTCELL46:OUT_Q4
Q0P_HALTGTREQDES117outputTCELL46:OUT_Q3
Q0P_HALTGTREQDES118outputTCELL46:OUT_Q1
Q0P_HALTGTREQDES119outputTCELL46:OUT_Q2
Q0P_HALTGTREQDES12outputTCELL18:OUT_Q2
Q0P_HALTGTREQDES120outputTCELL22:OUT_F7
Q0P_HALTGTREQDES121outputTCELL30:OUT_Q1
Q0P_HALTGTREQDES122outputTCELL31:OUT_Q5
Q0P_HALTGTREQDES123outputTCELL31:OUT_Q0
Q0P_HALTGTREQDES124outputTCELL23:OUT_F5
Q0P_HALTGTREQDES125outputTCELL29:OUT_F3
Q0P_HALTGTREQDES126outputTCELL22:OUT_F3
Q0P_HALTGTREQDES127outputTCELL23:OUT_Q4
Q0P_HALTGTREQDES13outputTCELL18:OUT_Q1
Q0P_HALTGTREQDES14outputTCELL18:OUT_Q0
Q0P_HALTGTREQDES15outputTCELL18:OUT_Q5
Q0P_HALTGTREQDES16outputTCELL19:OUT_Q1
Q0P_HALTGTREQDES17outputTCELL18:OUT_F7
Q0P_HALTGTREQDES18outputTCELL18:OUT_F6
Q0P_HALTGTREQDES19outputTCELL18:OUT_F5
Q0P_HALTGTREQDES2outputTCELL19:OUT_F4
Q0P_HALTGTREQDES20outputTCELL29:OUT_F0
Q0P_HALTGTREQDES21outputTCELL23:OUT_Q6
Q0P_HALTGTREQDES22outputTCELL24:OUT_F6
Q0P_HALTGTREQDES23outputTCELL23:OUT_Q7
Q0P_HALTGTREQDES24outputTCELL24:OUT_F2
Q0P_HALTGTREQDES25outputTCELL24:OUT_F3
Q0P_HALTGTREQDES26outputTCELL24:OUT_F7
Q0P_HALTGTREQDES27outputTCELL31:OUT_Q4
Q0P_HALTGTREQDES28outputTCELL31:OUT_F6
Q0P_HALTGTREQDES29outputTCELL31:OUT_F7
Q0P_HALTGTREQDES3outputTCELL19:OUT_F3
Q0P_HALTGTREQDES30outputTCELL24:OUT_F0
Q0P_HALTGTREQDES31outputTCELL23:OUT_Q3
Q0P_HALTGTREQDES32outputTCELL24:OUT_Q0
Q0P_HALTGTREQDES33outputTCELL24:OUT_F1
Q0P_HALTGTREQDES34outputTCELL24:OUT_F4
Q0P_HALTGTREQDES35outputTCELL22:OUT_F5
Q0P_HALTGTREQDES36outputTCELL32:OUT_F3
Q0P_HALTGTREQDES37outputTCELL32:OUT_F6
Q0P_HALTGTREQDES38outputTCELL32:OUT_F4
Q0P_HALTGTREQDES39outputTCELL34:OUT_Q0
Q0P_HALTGTREQDES4outputTCELL19:OUT_F2
Q0P_HALTGTREQDES40outputTCELL32:OUT_F1
Q0P_HALTGTREQDES41outputTCELL23:OUT_Q2
Q0P_HALTGTREQDES42outputTCELL31:OUT_Q6
Q0P_HALTGTREQDES43outputTCELL24:OUT_Q1
Q0P_HALTGTREQDES44outputTCELL22:OUT_Q7
Q0P_HALTGTREQDES45outputTCELL31:OUT_Q3
Q0P_HALTGTREQDES46outputTCELL31:OUT_Q2
Q0P_HALTGTREQDES47outputTCELL23:OUT_F6
Q0P_HALTGTREQDES48outputTCELL24:OUT_Q2
Q0P_HALTGTREQDES49outputTCELL24:OUT_Q3
Q0P_HALTGTREQDES5outputTCELL19:OUT_F1
Q0P_HALTGTREQDES50outputTCELL31:OUT_F5
Q0P_HALTGTREQDES51outputTCELL24:OUT_F5
Q0P_HALTGTREQDES52outputTCELL23:OUT_F0
Q0P_HALTGTREQDES53outputTCELL31:OUT_F4
Q0P_HALTGTREQDES54outputTCELL23:OUT_F4
Q0P_HALTGTREQDES55outputTCELL24:OUT_Q5
Q0P_HALTGTREQDES56outputTCELL29:OUT_F7
Q0P_HALTGTREQDES57outputTCELL22:OUT_Q2
Q0P_HALTGTREQDES58outputTCELL21:OUT_Q5
Q0P_HALTGTREQDES59outputTCELL31:OUT_Q1
Q0P_HALTGTREQDES6outputTCELL19:OUT_F0
Q0P_HALTGTREQDES60outputTCELL21:OUT_Q3
Q0P_HALTGTREQDES61outputTCELL22:OUT_Q5
Q0P_HALTGTREQDES62outputTCELL23:OUT_F2
Q0P_HALTGTREQDES63outputTCELL31:OUT_F1
Q0P_HALTGTREQDES64outputTCELL31:OUT_F0
Q0P_HALTGTREQDES65outputTCELL30:OUT_Q4
Q0P_HALTGTREQDES66outputTCELL24:OUT_Q6
Q0P_HALTGTREQDES67outputTCELL30:OUT_Q2
Q0P_HALTGTREQDES68outputTCELL22:OUT_Q6
Q0P_HALTGTREQDES69outputTCELL29:OUT_Q0
Q0P_HALTGTREQDES7outputTCELL18:OUT_Q7
Q0P_HALTGTREQDES70outputTCELL29:OUT_Q5
Q0P_HALTGTREQDES71outputTCELL30:OUT_F5
Q0P_HALTGTREQDES72outputTCELL30:OUT_Q6
Q0P_HALTGTREQDES73outputTCELL29:OUT_Q4
Q0P_HALTGTREQDES74outputTCELL30:OUT_F4
Q0P_HALTGTREQDES75outputTCELL30:OUT_F1
Q0P_HALTGTREQDES76outputTCELL22:OUT_F4
Q0P_HALTGTREQDES77outputTCELL23:OUT_F7
Q0P_HALTGTREQDES78outputTCELL29:OUT_Q1
Q0P_HALTGTREQDES79outputTCELL30:OUT_Q0
Q0P_HALTGTREQDES8outputTCELL18:OUT_Q6
Q0P_HALTGTREQDES80outputTCELL29:OUT_F6
Q0P_HALTGTREQDES81outputTCELL21:OUT_Q4
Q0P_HALTGTREQDES82outputTCELL30:OUT_F0
Q0P_HALTGTREQDES83outputTCELL30:OUT_F7
Q0P_HALTGTREQDES84outputTCELL29:OUT_Q3
Q0P_HALTGTREQDES85outputTCELL30:OUT_F3
Q0P_HALTGTREQDES86outputTCELL31:OUT_F2
Q0P_HALTGTREQDES87outputTCELL29:OUT_Q7
Q0P_HALTGTREQDES88outputTCELL30:OUT_Q5
Q0P_HALTGTREQDES89outputTCELL23:OUT_F3
Q0P_HALTGTREQDES9outputTCELL21:OUT_Q0
Q0P_HALTGTREQDES90outputTCELL22:OUT_Q3
Q0P_HALTGTREQDES91outputTCELL21:OUT_Q7
Q0P_HALTGTREQDES92outputTCELL31:OUT_F3
Q0P_HALTGTREQDES93outputTCELL24:OUT_Q7
Q0P_HALTGTREQDES94outputTCELL30:OUT_Q7
Q0P_HALTGTREQDES95outputTCELL29:OUT_F2
Q0P_HALTGTREQDES96outputTCELL29:OUT_F1
Q0P_HALTGTREQDES97outputTCELL22:OUT_Q1
Q0P_HALTGTREQDES98outputTCELL30:OUT_F6
Q0P_HALTGTREQDES99outputTCELL29:OUT_F5
Q0P_HALTGTREQMBA0outputTCELL20:OUT_F4
Q0P_HALTGTREQMBA1outputTCELL20:OUT_F3
Q0P_HALTGTREQMBA2outputTCELL20:OUT_F2
Q0P_HALTGTREQMBA3outputTCELL20:OUT_F1
Q0P_HALTGTREQMBA4outputTCELL20:OUT_F0
Q0P_HALTGTREQMBA5outputTCELL19:OUT_Q5
Q0P_HALTGTREQTPHPRESENToutputTCELL18:OUT_F1
Q0P_HALTGTREQTPHSTTAG0outputTCELL20:OUT_Q6
Q0P_HALTGTREQTPHSTTAG1outputTCELL20:OUT_Q5
Q0P_HALTGTREQTPHSTTAG2outputTCELL20:OUT_Q4
Q0P_HALTGTREQTPHSTTAG3outputTCELL20:OUT_Q3
Q0P_HALTGTREQTPHSTTAG4outputTCELL20:OUT_Q2
Q0P_HALTGTREQTPHSTTAG5outputTCELL20:OUT_Q1
Q0P_HALTGTREQTPHSTTAG6outputTCELL20:OUT_Q0
Q0P_HALTGTREQTPHSTTAG7outputTCELL20:OUT_F7
Q0P_HALTGTREQTPHTYPE0outputTCELL20:OUT_F6
Q0P_HALTGTREQTPHTYPE1outputTCELL20:OUT_F5
Q0P_HALTGTWBVLD0outputTCELL21:OUT_F6
Q0P_HALTGTWBVLD1outputTCELL21:OUT_F5
Q0P_HALTGTWBVLD2outputTCELL21:OUT_F4
Q0P_HALTGTWBVLD3outputTCELL21:OUT_F3
Q0P_HALTGTWBVLD4outputTCELL21:OUT_F2
Q0P_HALTGTWBVLD5outputTCELL21:OUT_F1
Q0P_HALTGTWBVLD6outputTCELL21:OUT_F0
Q0P_HALTGTWBVLD7outputTCELL20:OUT_Q7
Q0P_HALTGTWDATVLDoutputTCELL18:OUT_F2
Q0P_HALTGTWEOPoutputTCELL18:OUT_F3
Q0P_HALTGTWRDYinputTCELL40:IMUX_C0
Q0P_HALTSTREQATTR0outputTCELL19:OUT_Q4
Q0P_HALTSTREQATTR1outputTCELL19:OUT_Q3
Q0P_HALTSTREQATTR2outputTCELL19:OUT_Q2
Q0P_HOTRSTINinputTCELL32:IMUX_LSR0
Q0P_HOTRSTOUToutputTCELL48:OUT_F3
Q0P_INTACKoutputTCELL35:OUT_Q5
Q0P_INTAIinputTCELL46:IMUX_D5
Q0P_INTAOoutputTCELL23:OUT_Q1
Q0P_INTBIinputTCELL49:IMUX_C1
Q0P_INTBOoutputTCELL23:OUT_Q5
Q0P_INTCIinputTCELL49:IMUX_C2
Q0P_INTCOoutputTCELL22:OUT_F2
Q0P_INTDIinputTCELL49:IMUX_C3
Q0P_INTDOoutputTCELL22:OUT_F6
Q0P_INTPENDSTSinputTCELL49:IMUX_C4
Q0P_LCLINToutputTCELL44:OUT_F2
Q0P_LNKDWNRSTOUToutputTCELL47:OUT_Q1
Q0P_LNKPWRSTATE0outputTCELL48:OUT_F1
Q0P_LNKPWRSTATE1outputTCELL47:OUT_Q3
Q0P_LNKPWRSTATE2outputTCELL47:OUT_F7
Q0P_LNKPWRSTATE3outputTCELL46:OUT_F7
Q0P_LNKSTS0outputTCELL45:OUT_Q6
Q0P_LNKSTS1outputTCELL47:OUT_F4
Q0P_LTSSMSTATE0outputTCELL45:OUT_Q7
Q0P_LTSSMSTATE1outputTCELL46:OUT_F1
Q0P_LTSSMSTATE2outputTCELL46:OUT_F3
Q0P_LTSSMSTATE3outputTCELL46:OUT_F6
Q0P_LTSSMSTATE4outputTCELL46:OUT_F0
Q0P_LTSSMSTATE5outputTCELL45:OUT_Q3
Q0P_MAXPYLDSIZE0outputTCELL47:OUT_F6
Q0P_MAXPYLDSIZE1outputTCELL47:OUT_Q7
Q0P_MAXPYLDSIZE2outputTCELL47:OUT_Q0
Q0P_MAXREADREQSIZE0outputTCELL43:OUT_Q6
Q0P_MAXREADREQSIZE1outputTCELL40:OUT_F2
Q0P_MAXREADREQSIZE2outputTCELL42:OUT_Q5
Q0P_MBISTCLKinputTCELL29:IMUX_CLK1_DELAY
Q0P_MBISTMODEinputTCELL29:IMUX_LSR0
Q0P_MBISTRSTNinputTCELL30:IMUX_LSR1
Q0P_MSIASRTINT0inputTCELL52:IMUX_C4
Q0P_MSIASRTINT1inputTCELL53:IMUX_B0
Q0P_MSIASRTINT10inputTCELL52:IMUX_C5
Q0P_MSIASRTINT11inputTCELL53:IMUX_A0
Q0P_MSIASRTINT12inputTCELL53:IMUX_B2
Q0P_MSIASRTINT13inputTCELL53:IMUX_A4
Q0P_MSIASRTINT14inputTCELL52:IMUX_D0
Q0P_MSIASRTINT15inputTCELL53:IMUX_A3
Q0P_MSIASRTINT16inputTCELL53:IMUX_A2
Q0P_MSIASRTINT17inputTCELL52:IMUX_D2
Q0P_MSIASRTINT18inputTCELL52:IMUX_D1
Q0P_MSIASRTINT19inputTCELL53:IMUX_D2
Q0P_MSIASRTINT2inputTCELL53:IMUX_D0
Q0P_MSIASRTINT20inputTCELL54:IMUX_A5
Q0P_MSIASRTINT21inputTCELL53:IMUX_D3
Q0P_MSIASRTINT22inputTCELL54:IMUX_A2
Q0P_MSIASRTINT23inputTCELL54:IMUX_A1
Q0P_MSIASRTINT24inputTCELL53:IMUX_C5
Q0P_MSIASRTINT25inputTCELL53:IMUX_D5
Q0P_MSIASRTINT26inputTCELL53:IMUX_C4
Q0P_MSIASRTINT27inputTCELL53:IMUX_B3
Q0P_MSIASRTINT28inputTCELL53:IMUX_B1
Q0P_MSIASRTINT29inputTCELL53:IMUX_A1
Q0P_MSIASRTINT3inputTCELL53:IMUX_C2
Q0P_MSIASRTINT30inputTCELL52:IMUX_D4
Q0P_MSIASRTINT31inputTCELL52:IMUX_D5
Q0P_MSIASRTINT4inputTCELL52:IMUX_D3
Q0P_MSIASRTINT5inputTCELL53:IMUX_C3
Q0P_MSIASRTINT6inputTCELL53:IMUX_B4
Q0P_MSIASRTINT7inputTCELL53:IMUX_C1
Q0P_MSIASRTINT8inputTCELL53:IMUX_A5
Q0P_MSIASRTINT9inputTCELL53:IMUX_C0
Q0P_MSIATTRIN0inputTCELL51:IMUX_D1
Q0P_MSIATTRIN1inputTCELL51:IMUX_D0
Q0P_MSIATTRIN2inputTCELL47:IMUX_A3
Q0P_MSIENoutputTCELL35:OUT_Q6
Q0P_MSIMSGABRToutputTCELL44:OUT_F7
Q0P_MSIMSGSENToutputTCELL44:OUT_Q2
Q0P_MSIREQTPHPRESENTinputTCELL50:IMUX_D1
Q0P_MSIREQTPHSTTAG0inputTCELL52:IMUX_B4
Q0P_MSIREQTPHSTTAG1inputTCELL50:IMUX_D0
Q0P_MSIREQTPHSTTAG2inputTCELL50:IMUX_C5
Q0P_MSIREQTPHSTTAG3inputTCELL51:IMUX_A5
Q0P_MSIREQTPHSTTAG4inputTCELL50:IMUX_D2
Q0P_MSIREQTPHSTTAG5inputTCELL52:IMUX_B0
Q0P_MSIREQTPHSTTAG6inputTCELL51:IMUX_B0
Q0P_MSIREQTPHSTTAG7inputTCELL52:IMUX_A4
Q0P_MSIREQTPHTYPE0inputTCELL51:IMUX_D2
Q0P_MSIREQTPHTYPE1inputTCELL50:IMUX_D4
Q0P_MSIVECCNT0outputTCELL35:OUT_Q3
Q0P_MSIVECCNT1outputTCELL35:OUT_F5
Q0P_MSIVECCNT2outputTCELL35:OUT_Q1
Q0P_MSIXATTRIN0inputTCELL49:IMUX_D1
Q0P_MSIXATTRIN1inputTCELL49:IMUX_D0
Q0P_MSIXATTRIN2inputTCELL48:IMUX_A2
Q0P_MSIXENoutputTCELL43:OUT_Q5
Q0P_MSIXMASKoutputTCELL42:OUT_F4
Q0P_MSIXMSGADDR0inputTCELL50:IMUX_D5
Q0P_MSIXMSGADDR1inputTCELL51:IMUX_A0
Q0P_MSIXMSGADDR10inputTCELL51:IMUX_C1
Q0P_MSIXMSGADDR11inputTCELL51:IMUX_C4
Q0P_MSIXMSGADDR12inputTCELL52:IMUX_B1
Q0P_MSIXMSGADDR13inputTCELL51:IMUX_C5
Q0P_MSIXMSGADDR14inputTCELL51:IMUX_C3
Q0P_MSIXMSGADDR15inputTCELL51:IMUX_B5
Q0P_MSIXMSGADDR16inputTCELL52:IMUX_A2
Q0P_MSIXMSGADDR17inputTCELL51:IMUX_D5
Q0P_MSIXMSGADDR18inputTCELL51:IMUX_B4
Q0P_MSIXMSGADDR19inputTCELL52:IMUX_A1
Q0P_MSIXMSGADDR2inputTCELL51:IMUX_A1
Q0P_MSIXMSGADDR20inputTCELL51:IMUX_D4
Q0P_MSIXMSGADDR21inputTCELL52:IMUX_B5
Q0P_MSIXMSGADDR22inputTCELL52:IMUX_C2
Q0P_MSIXMSGADDR23inputTCELL52:IMUX_C3
Q0P_MSIXMSGADDR24inputTCELL52:IMUX_C0
Q0P_MSIXMSGADDR25inputTCELL52:IMUX_A3
Q0P_MSIXMSGADDR26inputTCELL51:IMUX_D3
Q0P_MSIXMSGADDR27inputTCELL52:IMUX_B3
Q0P_MSIXMSGADDR28inputTCELL52:IMUX_A5
Q0P_MSIXMSGADDR29inputTCELL52:IMUX_B2
Q0P_MSIXMSGADDR3inputTCELL51:IMUX_A2
Q0P_MSIXMSGADDR30inputTCELL52:IMUX_A0
Q0P_MSIXMSGADDR31inputTCELL52:IMUX_C1
Q0P_MSIXMSGADDR32inputTCELL55:IMUX_B1
Q0P_MSIXMSGADDR33inputTCELL55:IMUX_A5
Q0P_MSIXMSGADDR34inputTCELL55:IMUX_B0
Q0P_MSIXMSGADDR35inputTCELL55:IMUX_A2
Q0P_MSIXMSGADDR36inputTCELL55:IMUX_A3
Q0P_MSIXMSGADDR37inputTCELL54:IMUX_B2
Q0P_MSIXMSGADDR38inputTCELL55:IMUX_A1
Q0P_MSIXMSGADDR39inputTCELL55:IMUX_A0
Q0P_MSIXMSGADDR4inputTCELL51:IMUX_A3
Q0P_MSIXMSGADDR40inputTCELL54:IMUX_B3
Q0P_MSIXMSGADDR41inputTCELL55:IMUX_A4
Q0P_MSIXMSGADDR42inputTCELL54:IMUX_D3
Q0P_MSIXMSGADDR43inputTCELL54:IMUX_D4
Q0P_MSIXMSGADDR44inputTCELL54:IMUX_C3
Q0P_MSIXMSGADDR45inputTCELL54:IMUX_B5
Q0P_MSIXMSGADDR46inputTCELL54:IMUX_C4
Q0P_MSIXMSGADDR47inputTCELL54:IMUX_C2
Q0P_MSIXMSGADDR48inputTCELL54:IMUX_D5
Q0P_MSIXMSGADDR49inputTCELL54:IMUX_B4
Q0P_MSIXMSGADDR5inputTCELL51:IMUX_A4
Q0P_MSIXMSGADDR50inputTCELL54:IMUX_D1
Q0P_MSIXMSGADDR51inputTCELL54:IMUX_C1
Q0P_MSIXMSGADDR52inputTCELL54:IMUX_C5
Q0P_MSIXMSGADDR53inputTCELL54:IMUX_C0
Q0P_MSIXMSGADDR54inputTCELL54:IMUX_D2
Q0P_MSIXMSGADDR55inputTCELL54:IMUX_D0
Q0P_MSIXMSGADDR56inputTCELL54:IMUX_A4
Q0P_MSIXMSGADDR57inputTCELL54:IMUX_B1
Q0P_MSIXMSGADDR58inputTCELL54:IMUX_B0
Q0P_MSIXMSGADDR59inputTCELL54:IMUX_A3
Q0P_MSIXMSGADDR6inputTCELL51:IMUX_B2
Q0P_MSIXMSGADDR60inputTCELL53:IMUX_D1
Q0P_MSIXMSGADDR61inputTCELL54:IMUX_A0
Q0P_MSIXMSGADDR62inputTCELL53:IMUX_D4
Q0P_MSIXMSGADDR63inputTCELL53:IMUX_B5
Q0P_MSIXMSGADDR7inputTCELL51:IMUX_C0
Q0P_MSIXMSGADDR8inputTCELL51:IMUX_B1
Q0P_MSIXMSGADDR9inputTCELL51:IMUX_B3
Q0P_MSIXMSGDAT0inputTCELL49:IMUX_A4
Q0P_MSIXMSGDAT1inputTCELL49:IMUX_A3
Q0P_MSIXMSGDAT10inputTCELL48:IMUX_A5
Q0P_MSIXMSGDAT11inputTCELL48:IMUX_C2
Q0P_MSIXMSGDAT12inputTCELL49:IMUX_A5
Q0P_MSIXMSGDAT13inputTCELL49:IMUX_A2
Q0P_MSIXMSGDAT14inputTCELL49:IMUX_A1
Q0P_MSIXMSGDAT15inputTCELL48:IMUX_D4
Q0P_MSIXMSGDAT16inputTCELL48:IMUX_D3
Q0P_MSIXMSGDAT17inputTCELL48:IMUX_D2
Q0P_MSIXMSGDAT18inputTCELL48:IMUX_B5
Q0P_MSIXMSGDAT19inputTCELL49:IMUX_A0
Q0P_MSIXMSGDAT2inputTCELL49:IMUX_B1
Q0P_MSIXMSGDAT20inputTCELL48:IMUX_C3
Q0P_MSIXMSGDAT21inputTCELL48:IMUX_C0
Q0P_MSIXMSGDAT22inputTCELL48:IMUX_C4
Q0P_MSIXMSGDAT23inputTCELL48:IMUX_B3
Q0P_MSIXMSGDAT24inputTCELL48:IMUX_D0
Q0P_MSIXMSGDAT25inputTCELL48:IMUX_D1
Q0P_MSIXMSGDAT26inputTCELL48:IMUX_D5
Q0P_MSIXMSGDAT27inputTCELL48:IMUX_B0
Q0P_MSIXMSGDAT28inputTCELL48:IMUX_B2
Q0P_MSIXMSGDAT29inputTCELL48:IMUX_C1
Q0P_MSIXMSGDAT3inputTCELL49:IMUX_B4
Q0P_MSIXMSGDAT30inputTCELL48:IMUX_B1
Q0P_MSIXMSGDAT31inputTCELL48:IMUX_C5
Q0P_MSIXMSGDAT4inputTCELL48:IMUX_B4
Q0P_MSIXMSGDAT5inputTCELL49:IMUX_B3
Q0P_MSIXMSGDAT6inputTCELL49:IMUX_B0
Q0P_MSIXMSGDAT7inputTCELL49:IMUX_B2
Q0P_MSIXMSGDAT8inputTCELL49:IMUX_C0
Q0P_MSIXMSGDAT9inputTCELL49:IMUX_B5
Q0P_MSIXMSGSENToutputTCELL48:OUT_F2
Q0P_MSIXMSGVLDinputTCELL51:IMUX_C2
Q0P_MSIXREQTPHPRESENTinputTCELL50:IMUX_A0
Q0P_MSIXREQTPHSTTAG0inputTCELL50:IMUX_C1
Q0P_MSIXREQTPHSTTAG1inputTCELL50:IMUX_B0
Q0P_MSIXREQTPHSTTAG2inputTCELL50:IMUX_A4
Q0P_MSIXREQTPHSTTAG3inputTCELL50:IMUX_C0
Q0P_MSIXREQTPHSTTAG4inputTCELL50:IMUX_A1
Q0P_MSIXREQTPHSTTAG5inputTCELL50:IMUX_C4
Q0P_MSIXREQTPHSTTAG6inputTCELL50:IMUX_B2
Q0P_MSIXREQTPHSTTAG7inputTCELL50:IMUX_B4
Q0P_MSIXREQTPHTYPE0inputTCELL49:IMUX_D5
Q0P_MSIXREQTPHTYPE1inputTCELL49:IMUX_D3
Q0P_NEGLNKWIDTH0outputTCELL47:OUT_F3
Q0P_NEGLNKWIDTH1outputTCELL47:OUT_F5
Q0P_NEGSPEEDoutputTCELL47:OUT_Q2
Q0P_NFTLERROUToutputTCELL43:OUT_F7
Q0P_PWRSTATECHNGACKinputTCELL48:IMUX_A4
Q0P_PWRSTATECHNGINToutputTCELL32:OUT_F5
Q0P_RCBSTSoutputTCELL41:OUT_Q7
Q0P_RSTNinputTCELL31:IMUX_LSR0
Q0P_SCANCLKinputTCELL29:IMUX_CLK0_DELAY
Q0P_SCANENAinputTCELL31:IMUX_LSR1
Q0P_SCANI0inputTCELL30:IMUX_CE1
Q0P_SCANI1inputTCELL33:IMUX_CE3
Q0P_SCANI10inputTCELL29:IMUX_CE2
Q0P_SCANI11inputTCELL30:IMUX_CE2
Q0P_SCANI12inputTCELL31:IMUX_CE1
Q0P_SCANI13inputTCELL34:IMUX_CE0
Q0P_SCANI14inputTCELL33:IMUX_CE1
Q0P_SCANI15inputTCELL34:IMUX_CE2
Q0P_SCANI16inputTCELL33:IMUX_CE0
Q0P_SCANI17inputTCELL30:IMUX_CE3
Q0P_SCANI18inputTCELL31:IMUX_CE2
Q0P_SCANI19inputTCELL29:IMUX_CE0
Q0P_SCANI2inputTCELL32:IMUX_CE3
Q0P_SCANI20inputTCELL29:IMUX_CE3
Q0P_SCANI21inputTCELL33:IMUX_CE2
Q0P_SCANI22inputTCELL35:IMUX_CE0
Q0P_SCANI23inputTCELL34:IMUX_CE3
Q0P_SCANI24inputTCELL30:IMUX_CE0
Q0P_SCANI25inputTCELL32:IMUX_CE2
Q0P_SCANI26inputTCELL32:IMUX_CE1
Q0P_SCANI3inputTCELL34:IMUX_CE1
Q0P_SCANI4inputTCELL35:IMUX_CE1
Q0P_SCANI5inputTCELL35:IMUX_CE2
Q0P_SCANI6inputTCELL32:IMUX_CE0
Q0P_SCANI7inputTCELL31:IMUX_CE3
Q0P_SCANI8inputTCELL31:IMUX_CE0
Q0P_SCANI9inputTCELL29:IMUX_CE1
Q0P_SCANMODEinputTCELL30:IMUX_LSR0
Q0P_SCANO0outputTCELL47:OUT_Q4
Q0P_SCANO1outputTCELL22:OUT_F1
Q0P_SCANO10outputTCELL43:OUT_Q2
Q0P_SCANO11outputTCELL21:OUT_F7
Q0P_SCANO12outputTCELL44:OUT_Q5
Q0P_SCANO13outputTCELL46:OUT_F5
Q0P_SCANO14outputTCELL32:OUT_F2
Q0P_SCANO15outputTCELL47:OUT_Q6
Q0P_SCANO16outputTCELL47:OUT_Q5
Q0P_SCANO17outputTCELL46:OUT_Q0
Q0P_SCANO18outputTCELL21:OUT_Q6
Q0P_SCANO19outputTCELL32:OUT_Q5
Q0P_SCANO2outputTCELL21:OUT_Q1
Q0P_SCANO20outputTCELL18:OUT_F0
Q0P_SCANO21outputTCELL21:OUT_Q2
Q0P_SCANO22outputTCELL31:OUT_Q7
Q0P_SCANO23outputTCELL48:OUT_F4
Q0P_SCANO24outputTCELL48:OUT_F0
Q0P_SCANO3outputTCELL46:OUT_F2
Q0P_SCANO4outputTCELL45:OUT_F0
Q0P_SCANO5outputTCELL34:OUT_Q6
Q0P_SCANO6outputTCELL37:OUT_Q1
Q0P_SCANO7outputTCELL35:OUT_Q4
Q0P_SCANO8outputTCELL34:OUT_F5
Q0P_SCANO9outputTCELL35:OUT_Q7
Q0P_SCANRSTNinputTCELL29:IMUX_LSR1
Q0P_TPHREQENABLEoutputTCELL44:OUT_Q0
Q0P_TPHSTMODE0outputTCELL43:OUT_F2
Q0P_TPHSTMODE1outputTCELL44:OUT_F0
Q0P_TPHSTMODE2outputTCELL42:OUT_Q6
Q0P_UNCORRERRINinputTCELL50:IMUX_D3
Q0_FCDFECOEFF0_0inputTCELL2:IMUX_A2
Q0_FCDFECOEFF0_1inputTCELL2:IMUX_A1
Q0_FCDFECOEFF0_2inputTCELL2:IMUX_A0
Q0_FCDFECOEFF0_3inputTCELL1:IMUX_D5
Q0_FCDFECOEFF0_4inputTCELL1:IMUX_D4
Q0_FCDFECOEFF0_5inputTCELL1:IMUX_D3
Q0_FCDFECOEFF0_6inputTCELL1:IMUX_D2
Q0_FCDFECOEFF0_7inputTCELL1:IMUX_D1
Q0_FCDFECOEFF1_0inputTCELL2:IMUX_B4
Q0_FCDFECOEFF1_1inputTCELL2:IMUX_B3
Q0_FCDFECOEFF1_2inputTCELL2:IMUX_B2
Q0_FCDFECOEFF1_3inputTCELL2:IMUX_B1
Q0_FCDFECOEFF1_4inputTCELL2:IMUX_B0
Q0_FCDFECOEFF1_5inputTCELL2:IMUX_A5
Q0_FCDFECOEFF1_6inputTCELL2:IMUX_A4
Q0_FCDFECOEFF1_7inputTCELL2:IMUX_A3
Q0_FCDFECOEFF2_0inputTCELL2:IMUX_D0
Q0_FCDFECOEFF2_1inputTCELL2:IMUX_C5
Q0_FCDFECOEFF2_2inputTCELL2:IMUX_C4
Q0_FCDFECOEFF2_3inputTCELL2:IMUX_C3
Q0_FCDFECOEFF2_4inputTCELL2:IMUX_C2
Q0_FCDFECOEFF2_5inputTCELL2:IMUX_C1
Q0_FCDFECOEFF2_6inputTCELL2:IMUX_C0
Q0_FCDFECOEFF2_7inputTCELL2:IMUX_B5
Q0_FCDFECOEFF3_0inputTCELL3:IMUX_A2
Q0_FCDFECOEFF3_1inputTCELL3:IMUX_A1
Q0_FCDFECOEFF3_2inputTCELL3:IMUX_A0
Q0_FCDFECOEFF3_3inputTCELL2:IMUX_D5
Q0_FCDFECOEFF3_4inputTCELL2:IMUX_D4
Q0_FCDFECOEFF3_5inputTCELL2:IMUX_D3
Q0_FCDFECOEFF3_6inputTCELL2:IMUX_D2
Q0_FCDFECOEFF3_7inputTCELL2:IMUX_D1
Q0_FCDFECOEFF4_0inputTCELL3:IMUX_B4
Q0_FCDFECOEFF4_1inputTCELL3:IMUX_B3
Q0_FCDFECOEFF4_2inputTCELL3:IMUX_B2
Q0_FCDFECOEFF4_3inputTCELL3:IMUX_B1
Q0_FCDFECOEFF4_4inputTCELL3:IMUX_B0
Q0_FCDFECOEFF4_5inputTCELL3:IMUX_A5
Q0_FCDFECOEFF4_6inputTCELL3:IMUX_A4
Q0_FCDFECOEFF4_7inputTCELL3:IMUX_A3
Q0_FCDFECOEFF5_0inputTCELL3:IMUX_D0
Q0_FCDFECOEFF5_1inputTCELL3:IMUX_C5
Q0_FCDFECOEFF5_2inputTCELL3:IMUX_C4
Q0_FCDFECOEFF5_3inputTCELL3:IMUX_C3
Q0_FCDFECOEFF5_4inputTCELL3:IMUX_C2
Q0_FCDFECOEFF5_5inputTCELL3:IMUX_C1
Q0_FCDFECOEFF5_6inputTCELL3:IMUX_C0
Q0_FCDFECOEFF5_7inputTCELL3:IMUX_B5
Q0_FCDFESIGN1inputTCELL3:IMUX_D5
Q0_FCDFESIGN2inputTCELL3:IMUX_D4
Q0_FCDFESIGN3inputTCELL3:IMUX_D3
Q0_FCDFESIGN4inputTCELL3:IMUX_D2
Q0_FCDFESIGN5inputTCELL3:IMUX_D1
Q0_FCMPWRUPinputTCELL1:IMUX_A1
Q0_FCMRSTinputTCELL0:IMUX_C2
Q0_FCSCANMODEinputTCELL1:IMUX_C4
Q0_FDDFECHSEL0inputTCELL1:IMUX_D0
Q0_FDDFECHSEL1inputTCELL1:IMUX_C5
Q0_FDDFEDATA0outputTCELL5:OUT_F0
Q0_FDDFEDATA1outputTCELL4:OUT_Q7
Q0_FDDFEDATA2outputTCELL4:OUT_Q6
Q0_FDDFEDATA3outputTCELL4:OUT_Q5
Q0_FDDFEDATA4outputTCELL4:OUT_Q4
Q0_FDDFEDATA5outputTCELL4:OUT_Q3
Q0_FDDFEDATA6outputTCELL4:OUT_Q2
Q0_FDDFEDATA7outputTCELL4:OUT_Q1
Q0_FDDFEDATA8outputTCELL4:OUT_Q0
Q0_FDDFEDATA9outputTCELL4:OUT_F7
Q0_FDDFEERR0outputTCELL5:OUT_Q2
Q0_FDDFEERR1outputTCELL5:OUT_Q1
Q0_FDDFEERR2outputTCELL5:OUT_Q0
Q0_FDDFEERR3outputTCELL5:OUT_F7
Q0_FDDFEERR4outputTCELL5:OUT_F6
Q0_FDDFEERR5outputTCELL5:OUT_F5
Q0_FDDFEERR6outputTCELL5:OUT_F4
Q0_FDDFEERR7outputTCELL5:OUT_F3
Q0_FDDFEERR8outputTCELL5:OUT_F2
Q0_FDDFEERR9outputTCELL5:OUT_F1
Q0_FIGRPFBRRCLK0inputTCELL14:IMUX_CLK1_DELAY
Q0_FIGRPFBRRCLK1inputTCELL14:IMUX_CLK0_DELAY
Q0_FIGRPFBTWCLK0inputTCELL15:IMUX_CLK1_DELAY
Q0_FIGRPFBTWCLK1inputTCELL15:IMUX_CLK0_DELAY
Q0_FIRXTESTCLKinputTCELL16:IMUX_CLK1_DELAY
Q0_FISYNCCLKinputTCELL16:IMUX_CLK0_DELAY
Q0_FITMRCLKinputTCELL1:IMUX_CLK0_DELAY
Q0_FITXTESTCLKinputTCELL17:IMUX_CLK1_DELAY
Q0_FOREFCLK2FPGAoutputTCELL4:OUT_F2
Q0_HSPLLLOLoutputTCELL3:OUT_F0
Q0_HSPLLPWRUPinputTCELL1:IMUX_A2
Q0_HSPLLREFCLKIinputTCELL7:IMUX_CLK0_DELAY
Q0_HSPLLRSTinputTCELL2:IMUX_LSR1
Q0_LSPLLLOLoutputTCELL3:OUT_F1
Q0_LSPLLPWRUPinputTCELL1:IMUX_A3
Q0_LSPLLREFCLKIinputTCELL7:IMUX_CLK1_DELAY
Q0_LSPLLRSTinputTCELL2:IMUX_LSR0
Q1CH0_FCALIGNENinputTCELL110:IMUX_B7
Q1CH0_FCCDRFORCEDLOCKinputTCELL94:IMUX_A7
Q1CH0_FCDFERDENinputTCELL104:IMUX_CE0
Q1CH0_FCDFEUPDinputTCELL103:IMUX_CE0
Q1CH0_FCLDRTXENinputTCELL110:IMUX_A7
Q1CH0_FCLSMENinputTCELL95:IMUX_D5
Q1CH0_FCPCIEDETENinputTCELL95:IMUX_B5
Q1CH0_FCPCSRXRSTinputTCELL98:IMUX_LSR1
Q1CH0_FCPCSTXRSTinputTCELL101:IMUX_LSR1
Q1CH0_FCPIPEPHYRESETNinputTCELL104:IMUX_LSR1
Q1CH0_FCPLLLOLinputTCELL94:IMUX_A3
Q1CH0_FCRATE0inputTCELL110:IMUX_B1
Q1CH0_FCRATE1inputTCELL109:IMUX_A4
Q1CH0_FCRATE2inputTCELL109:IMUX_A5
Q1CH0_FCRRSTinputTCELL96:IMUX_LSR1
Q1CH0_FCRXPOLARITYinputTCELL95:IMUX_C7
Q1CH0_FCRXPWRUPinputTCELL110:IMUX_D6
Q1CH0_FCTMRSTARTinputTCELL107:IMUX_A1
Q1CH0_FCTMRSTOPinputTCELL106:IMUX_A5
Q1CH0_FCTRSTinputTCELL94:IMUX_LSR1
Q1CH0_FCTXMARGIN0inputTCELL94:IMUX_C5
Q1CH0_FCTXMARGIN1inputTCELL94:IMUX_C6
Q1CH0_FCTXMARGIN2inputTCELL94:IMUX_C7
Q1CH0_FCTXPWRUPinputTCELL110:IMUX_C6
Q1CH0_FCWORDALGNENinputTCELL95:IMUX_C3
Q1CH0_FDLDRRXoutputTCELL107:OUT_F7
Q1CH0_FDLDRTXinputTCELL94:IMUX_B5
Q1CH0_FDRX0outputTCELL93:OUT_Q0
Q1CH0_FDRX1outputTCELL93:OUT_Q1
Q1CH0_FDRX10outputTCELL93:OUT_F2
Q1CH0_FDRX11outputTCELL93:OUT_F3
Q1CH0_FDRX12outputTCELL93:OUT_F4
Q1CH0_FDRX13outputTCELL93:OUT_F5
Q1CH0_FDRX14outputTCELL93:OUT_F6
Q1CH0_FDRX15outputTCELL93:OUT_F7
Q1CH0_FDRX16outputTCELL94:OUT_Q0
Q1CH0_FDRX17outputTCELL94:OUT_Q1
Q1CH0_FDRX18outputTCELL94:OUT_Q2
Q1CH0_FDRX19outputTCELL94:OUT_Q3
Q1CH0_FDRX2outputTCELL93:OUT_Q2
Q1CH0_FDRX20outputTCELL94:OUT_Q4
Q1CH0_FDRX21outputTCELL94:OUT_Q5
Q1CH0_FDRX22outputTCELL94:OUT_Q6
Q1CH0_FDRX23outputTCELL94:OUT_Q7
Q1CH0_FDRX24outputTCELL94:OUT_F0
Q1CH0_FDRX25outputTCELL94:OUT_F1
Q1CH0_FDRX26outputTCELL94:OUT_F2
Q1CH0_FDRX27outputTCELL94:OUT_F3
Q1CH0_FDRX28outputTCELL94:OUT_F4
Q1CH0_FDRX29outputTCELL94:OUT_F5
Q1CH0_FDRX3outputTCELL93:OUT_Q3
Q1CH0_FDRX30outputTCELL94:OUT_F6
Q1CH0_FDRX31outputTCELL94:OUT_F7
Q1CH0_FDRX32outputTCELL95:OUT_Q0
Q1CH0_FDRX33outputTCELL95:OUT_Q1
Q1CH0_FDRX34outputTCELL95:OUT_Q2
Q1CH0_FDRX35outputTCELL95:OUT_Q3
Q1CH0_FDRX36outputTCELL95:OUT_Q4
Q1CH0_FDRX37outputTCELL95:OUT_Q5
Q1CH0_FDRX38outputTCELL95:OUT_Q6
Q1CH0_FDRX39outputTCELL95:OUT_Q7
Q1CH0_FDRX4outputTCELL93:OUT_Q4
Q1CH0_FDRX40outputTCELL95:OUT_F0
Q1CH0_FDRX41outputTCELL95:OUT_F1
Q1CH0_FDRX42outputTCELL95:OUT_F2
Q1CH0_FDRX43outputTCELL95:OUT_F3
Q1CH0_FDRX44outputTCELL95:OUT_F4
Q1CH0_FDRX45outputTCELL95:OUT_F5
Q1CH0_FDRX46outputTCELL95:OUT_F6
Q1CH0_FDRX47outputTCELL95:OUT_F7
Q1CH0_FDRX5outputTCELL93:OUT_Q5
Q1CH0_FDRX6outputTCELL93:OUT_Q6
Q1CH0_FDRX7outputTCELL93:OUT_Q7
Q1CH0_FDRX8outputTCELL93:OUT_F0
Q1CH0_FDRX9outputTCELL93:OUT_F1
Q1CH0_FDTX0inputTCELL95:IMUX_B6
Q1CH0_FDTX1inputTCELL95:IMUX_B7
Q1CH0_FDTX10inputTCELL96:IMUX_D4
Q1CH0_FDTX11inputTCELL96:IMUX_D5
Q1CH0_FDTX12inputTCELL96:IMUX_D6
Q1CH0_FDTX13inputTCELL96:IMUX_D7
Q1CH0_FDTX14inputTCELL96:IMUX_C2
Q1CH0_FDTX15inputTCELL96:IMUX_C3
Q1CH0_FDTX16inputTCELL96:IMUX_C4
Q1CH0_FDTX17inputTCELL96:IMUX_C5
Q1CH0_FDTX18inputTCELL96:IMUX_C6
Q1CH0_FDTX19inputTCELL96:IMUX_C7
Q1CH0_FDTX2inputTCELL95:IMUX_A2
Q1CH0_FDTX20inputTCELL96:IMUX_B2
Q1CH0_FDTX21inputTCELL96:IMUX_B3
Q1CH0_FDTX22inputTCELL96:IMUX_B4
Q1CH0_FDTX23inputTCELL96:IMUX_B5
Q1CH0_FDTX24inputTCELL96:IMUX_B6
Q1CH0_FDTX25inputTCELL96:IMUX_B7
Q1CH0_FDTX26inputTCELL96:IMUX_A2
Q1CH0_FDTX27inputTCELL96:IMUX_A3
Q1CH0_FDTX28inputTCELL96:IMUX_A4
Q1CH0_FDTX29inputTCELL96:IMUX_A5
Q1CH0_FDTX3inputTCELL95:IMUX_A3
Q1CH0_FDTX30inputTCELL96:IMUX_A6
Q1CH0_FDTX31inputTCELL96:IMUX_A7
Q1CH0_FDTX32inputTCELL97:IMUX_D2
Q1CH0_FDTX33inputTCELL97:IMUX_D3
Q1CH0_FDTX34inputTCELL97:IMUX_D4
Q1CH0_FDTX35inputTCELL97:IMUX_D5
Q1CH0_FDTX36inputTCELL97:IMUX_D6
Q1CH0_FDTX37inputTCELL97:IMUX_D7
Q1CH0_FDTX38inputTCELL97:IMUX_C2
Q1CH0_FDTX39inputTCELL97:IMUX_C3
Q1CH0_FDTX4inputTCELL95:IMUX_A4
Q1CH0_FDTX40inputTCELL97:IMUX_C4
Q1CH0_FDTX41inputTCELL97:IMUX_C5
Q1CH0_FDTX42inputTCELL97:IMUX_C6
Q1CH0_FDTX43inputTCELL97:IMUX_C7
Q1CH0_FDTX44inputTCELL97:IMUX_B2
Q1CH0_FDTX45inputTCELL97:IMUX_B3
Q1CH0_FDTX46inputTCELL97:IMUX_B4
Q1CH0_FDTX47inputTCELL97:IMUX_B5
Q1CH0_FDTX48inputTCELL97:IMUX_B6
Q1CH0_FDTX49inputTCELL97:IMUX_B7
Q1CH0_FDTX5inputTCELL95:IMUX_A5
Q1CH0_FDTX6inputTCELL95:IMUX_A6
Q1CH0_FDTX7inputTCELL95:IMUX_A7
Q1CH0_FDTX8inputTCELL96:IMUX_D2
Q1CH0_FDTX9inputTCELL96:IMUX_D3
Q1CH0_FIRCLKinputTCELL100:IMUX_CLK1_DELAY
Q1CH0_FIREFRXCLKinputTCELL102:IMUX_CLK1_DELAY
Q1CH0_FITCLKinputTCELL98:IMUX_CLK0_DELAY
Q1CH0_FITMRSTARTCLKinputTCELL109:IMUX_CLK0_DELAY
Q1CH0_FITMRSTOPCLKinputTCELL107:IMUX_CLK0_DELAY
Q1CH0_FSCCOVERRUNoutputTCELL109:OUT_Q1
Q1CH0_FSCCUNDERRUNoutputTCELL108:OUT_F5
Q1CH0_FSDFEVLDoutputTCELL105:OUT_Q6
Q1CH0_FSLSMoutputTCELL109:OUT_F1
Q1CH0_FSPCIECONoutputTCELL110:OUT_Q1
Q1CH0_FSPCIEDONEoutputTCELL109:OUT_F5
Q1CH0_FSRCDONEoutputTCELL106:OUT_F6
Q1CH0_FSRLOLoutputTCELL108:OUT_Q5
Q1CH0_FSRLOSoutputTCELL109:OUT_Q5
Q1CH0_FSSKPADDEDoutputTCELL107:OUT_F3
Q1CH0_FSSKPDELETEDoutputTCELL107:OUT_Q7
Q1CH1_FCALIGNENinputTCELL110:IMUX_B6
Q1CH1_FCCDRFORCEDLOCKinputTCELL94:IMUX_A6
Q1CH1_FCDFERDENinputTCELL103:IMUX_CE3
Q1CH1_FCDFEUPDinputTCELL102:IMUX_CE3
Q1CH1_FCLDRTXENinputTCELL110:IMUX_A6
Q1CH1_FCLSMENinputTCELL95:IMUX_D4
Q1CH1_FCPCIEDETENinputTCELL95:IMUX_B4
Q1CH1_FCPCSRXRSTinputTCELL98:IMUX_LSR0
Q1CH1_FCPCSTXRSTinputTCELL101:IMUX_LSR0
Q1CH1_FCPIPEPHYRESETNinputTCELL104:IMUX_LSR0
Q1CH1_FCPLLLOLinputTCELL94:IMUX_A2
Q1CH1_FCRATE0inputTCELL109:IMUX_B6
Q1CH1_FCRATE1inputTCELL109:IMUX_B7
Q1CH1_FCRATE2inputTCELL110:IMUX_B0
Q1CH1_FCRRSTinputTCELL96:IMUX_LSR0
Q1CH1_FCRXPOLARITYinputTCELL95:IMUX_C6
Q1CH1_FCRXPWRUPinputTCELL110:IMUX_D5
Q1CH1_FCTMRSTARTinputTCELL107:IMUX_A0
Q1CH1_FCTMRSTOPinputTCELL106:IMUX_A4
Q1CH1_FCTRSTinputTCELL94:IMUX_LSR0
Q1CH1_FCTXMARGIN0inputTCELL94:IMUX_C2
Q1CH1_FCTXMARGIN1inputTCELL94:IMUX_C3
Q1CH1_FCTXMARGIN2inputTCELL94:IMUX_C4
Q1CH1_FCTXPWRUPinputTCELL110:IMUX_C5
Q1CH1_FCWORDALGNENinputTCELL95:IMUX_C2
Q1CH1_FDLDRRXoutputTCELL107:OUT_F6
Q1CH1_FDLDRTXinputTCELL94:IMUX_B4
Q1CH1_FDRX0outputTCELL96:OUT_Q0
Q1CH1_FDRX1outputTCELL96:OUT_Q1
Q1CH1_FDRX10outputTCELL96:OUT_F2
Q1CH1_FDRX11outputTCELL96:OUT_F3
Q1CH1_FDRX12outputTCELL96:OUT_F4
Q1CH1_FDRX13outputTCELL96:OUT_F5
Q1CH1_FDRX14outputTCELL96:OUT_F6
Q1CH1_FDRX15outputTCELL96:OUT_F7
Q1CH1_FDRX16outputTCELL97:OUT_Q0
Q1CH1_FDRX17outputTCELL97:OUT_Q1
Q1CH1_FDRX18outputTCELL97:OUT_Q2
Q1CH1_FDRX19outputTCELL97:OUT_Q3
Q1CH1_FDRX2outputTCELL96:OUT_Q2
Q1CH1_FDRX20outputTCELL97:OUT_Q4
Q1CH1_FDRX21outputTCELL97:OUT_Q5
Q1CH1_FDRX22outputTCELL97:OUT_Q6
Q1CH1_FDRX23outputTCELL97:OUT_Q7
Q1CH1_FDRX24outputTCELL97:OUT_F0
Q1CH1_FDRX25outputTCELL97:OUT_F1
Q1CH1_FDRX26outputTCELL97:OUT_F2
Q1CH1_FDRX27outputTCELL97:OUT_F3
Q1CH1_FDRX28outputTCELL97:OUT_F4
Q1CH1_FDRX29outputTCELL97:OUT_F5
Q1CH1_FDRX3outputTCELL96:OUT_Q3
Q1CH1_FDRX30outputTCELL97:OUT_F6
Q1CH1_FDRX31outputTCELL97:OUT_F7
Q1CH1_FDRX32outputTCELL98:OUT_Q0
Q1CH1_FDRX33outputTCELL98:OUT_Q1
Q1CH1_FDRX34outputTCELL98:OUT_Q2
Q1CH1_FDRX35outputTCELL98:OUT_Q3
Q1CH1_FDRX36outputTCELL98:OUT_Q4
Q1CH1_FDRX37outputTCELL98:OUT_Q5
Q1CH1_FDRX38outputTCELL98:OUT_Q6
Q1CH1_FDRX39outputTCELL98:OUT_Q7
Q1CH1_FDRX4outputTCELL96:OUT_Q4
Q1CH1_FDRX40outputTCELL98:OUT_F0
Q1CH1_FDRX41outputTCELL98:OUT_F1
Q1CH1_FDRX42outputTCELL98:OUT_F2
Q1CH1_FDRX43outputTCELL98:OUT_F3
Q1CH1_FDRX44outputTCELL98:OUT_F4
Q1CH1_FDRX45outputTCELL98:OUT_F5
Q1CH1_FDRX46outputTCELL98:OUT_F6
Q1CH1_FDRX47outputTCELL98:OUT_F7
Q1CH1_FDRX5outputTCELL96:OUT_Q5
Q1CH1_FDRX6outputTCELL96:OUT_Q6
Q1CH1_FDRX7outputTCELL96:OUT_Q7
Q1CH1_FDRX8outputTCELL96:OUT_F0
Q1CH1_FDRX9outputTCELL96:OUT_F1
Q1CH1_FDTX0inputTCELL97:IMUX_A2
Q1CH1_FDTX1inputTCELL97:IMUX_A3
Q1CH1_FDTX10inputTCELL98:IMUX_D6
Q1CH1_FDTX11inputTCELL98:IMUX_D7
Q1CH1_FDTX12inputTCELL98:IMUX_C2
Q1CH1_FDTX13inputTCELL98:IMUX_C3
Q1CH1_FDTX14inputTCELL98:IMUX_C4
Q1CH1_FDTX15inputTCELL98:IMUX_C5
Q1CH1_FDTX16inputTCELL98:IMUX_C6
Q1CH1_FDTX17inputTCELL98:IMUX_C7
Q1CH1_FDTX18inputTCELL98:IMUX_B2
Q1CH1_FDTX19inputTCELL98:IMUX_B3
Q1CH1_FDTX2inputTCELL97:IMUX_A4
Q1CH1_FDTX20inputTCELL98:IMUX_B4
Q1CH1_FDTX21inputTCELL98:IMUX_B5
Q1CH1_FDTX22inputTCELL98:IMUX_B6
Q1CH1_FDTX23inputTCELL98:IMUX_B7
Q1CH1_FDTX24inputTCELL98:IMUX_A2
Q1CH1_FDTX25inputTCELL98:IMUX_A3
Q1CH1_FDTX26inputTCELL98:IMUX_A4
Q1CH1_FDTX27inputTCELL98:IMUX_A5
Q1CH1_FDTX28inputTCELL98:IMUX_A6
Q1CH1_FDTX29inputTCELL98:IMUX_A7
Q1CH1_FDTX3inputTCELL97:IMUX_A5
Q1CH1_FDTX30inputTCELL99:IMUX_D4
Q1CH1_FDTX31inputTCELL99:IMUX_D5
Q1CH1_FDTX32inputTCELL99:IMUX_D6
Q1CH1_FDTX33inputTCELL99:IMUX_D7
Q1CH1_FDTX34inputTCELL100:IMUX_D0
Q1CH1_FDTX35inputTCELL100:IMUX_D1
Q1CH1_FDTX36inputTCELL99:IMUX_C4
Q1CH1_FDTX37inputTCELL99:IMUX_C5
Q1CH1_FDTX38inputTCELL99:IMUX_C6
Q1CH1_FDTX39inputTCELL99:IMUX_C7
Q1CH1_FDTX4inputTCELL97:IMUX_A6
Q1CH1_FDTX40inputTCELL100:IMUX_C0
Q1CH1_FDTX41inputTCELL100:IMUX_C1
Q1CH1_FDTX42inputTCELL99:IMUX_B4
Q1CH1_FDTX43inputTCELL99:IMUX_B5
Q1CH1_FDTX44inputTCELL99:IMUX_B6
Q1CH1_FDTX45inputTCELL99:IMUX_B7
Q1CH1_FDTX46inputTCELL100:IMUX_B0
Q1CH1_FDTX47inputTCELL100:IMUX_B1
Q1CH1_FDTX48inputTCELL99:IMUX_A4
Q1CH1_FDTX49inputTCELL99:IMUX_A5
Q1CH1_FDTX5inputTCELL97:IMUX_A7
Q1CH1_FDTX6inputTCELL98:IMUX_D2
Q1CH1_FDTX7inputTCELL98:IMUX_D3
Q1CH1_FDTX8inputTCELL98:IMUX_D4
Q1CH1_FDTX9inputTCELL98:IMUX_D5
Q1CH1_FIRCLKinputTCELL100:IMUX_CLK0_DELAY
Q1CH1_FIREFRXCLKinputTCELL102:IMUX_CLK0_DELAY
Q1CH1_FITCLKinputTCELL98:IMUX_CLK1_DELAY
Q1CH1_FITMRSTARTCLKinputTCELL108:IMUX_CLK1_DELAY
Q1CH1_FITMRSTOPCLKinputTCELL106:IMUX_CLK1_DELAY
Q1CH1_FSCCOVERRUNoutputTCELL109:OUT_Q0
Q1CH1_FSCCUNDERRUNoutputTCELL108:OUT_F4
Q1CH1_FSDFEVLDoutputTCELL105:OUT_Q5
Q1CH1_FSLSMoutputTCELL109:OUT_F0
Q1CH1_FSPCIECONoutputTCELL110:OUT_Q0
Q1CH1_FSPCIEDONEoutputTCELL109:OUT_F4
Q1CH1_FSRCDONEoutputTCELL106:OUT_F5
Q1CH1_FSRLOLoutputTCELL108:OUT_Q4
Q1CH1_FSRLOSoutputTCELL109:OUT_Q4
Q1CH1_FSSKPADDEDoutputTCELL107:OUT_F2
Q1CH1_FSSKPDELETEDoutputTCELL107:OUT_Q6
Q1CH2_FCALIGNENinputTCELL110:IMUX_B5
Q1CH2_FCCDRFORCEDLOCKinputTCELL94:IMUX_A5
Q1CH2_FCDFERDENinputTCELL103:IMUX_CE2
Q1CH2_FCDFEUPDinputTCELL102:IMUX_CE2
Q1CH2_FCLDRTXENinputTCELL110:IMUX_A5
Q1CH2_FCLSMENinputTCELL95:IMUX_D3
Q1CH2_FCPCIEDETENinputTCELL95:IMUX_B3
Q1CH2_FCPCSRXRSTinputTCELL97:IMUX_LSR1
Q1CH2_FCPCSTXRSTinputTCELL100:IMUX_LSR1
Q1CH2_FCPIPEPHYRESETNinputTCELL103:IMUX_LSR1
Q1CH2_FCPLLLOLinputTCELL94:IMUX_B7
Q1CH2_FCRATE0inputTCELL110:IMUX_C1
Q1CH2_FCRATE1inputTCELL109:IMUX_B4
Q1CH2_FCRATE2inputTCELL109:IMUX_B5
Q1CH2_FCRRSTinputTCELL95:IMUX_LSR1
Q1CH2_FCRXPOLARITYinputTCELL95:IMUX_C5
Q1CH2_FCRXPWRUPinputTCELL110:IMUX_D4
Q1CH2_FCTMRSTARTinputTCELL106:IMUX_A7
Q1CH2_FCTMRSTOPinputTCELL107:IMUX_B1
Q1CH2_FCTRSTinputTCELL110:IMUX_LSR1
Q1CH2_FCTXMARGIN0inputTCELL94:IMUX_D5
Q1CH2_FCTXMARGIN1inputTCELL94:IMUX_D6
Q1CH2_FCTXMARGIN2inputTCELL94:IMUX_D7
Q1CH2_FCTXPWRUPinputTCELL110:IMUX_C4
Q1CH2_FCWORDALGNENinputTCELL95:IMUX_D7
Q1CH2_FDLDRRXoutputTCELL107:OUT_F5
Q1CH2_FDLDRTXinputTCELL94:IMUX_B3
Q1CH2_FDRX0outputTCELL99:OUT_Q2
Q1CH2_FDRX1outputTCELL99:OUT_Q3
Q1CH2_FDRX10outputTCELL99:OUT_F4
Q1CH2_FDRX11outputTCELL99:OUT_F5
Q1CH2_FDRX12outputTCELL99:OUT_F6
Q1CH2_FDRX13outputTCELL99:OUT_F7
Q1CH2_FDRX14outputTCELL100:OUT_F0
Q1CH2_FDRX15outputTCELL100:OUT_F1
Q1CH2_FDRX16outputTCELL100:OUT_Q2
Q1CH2_FDRX17outputTCELL100:OUT_Q3
Q1CH2_FDRX18outputTCELL100:OUT_Q4
Q1CH2_FDRX19outputTCELL100:OUT_Q5
Q1CH2_FDRX2outputTCELL99:OUT_Q4
Q1CH2_FDRX20outputTCELL100:OUT_Q6
Q1CH2_FDRX21outputTCELL100:OUT_Q7
Q1CH2_FDRX22outputTCELL101:OUT_Q0
Q1CH2_FDRX23outputTCELL101:OUT_Q1
Q1CH2_FDRX24outputTCELL100:OUT_F2
Q1CH2_FDRX25outputTCELL100:OUT_F3
Q1CH2_FDRX26outputTCELL100:OUT_F4
Q1CH2_FDRX27outputTCELL100:OUT_F5
Q1CH2_FDRX28outputTCELL100:OUT_F6
Q1CH2_FDRX29outputTCELL100:OUT_F7
Q1CH2_FDRX3outputTCELL99:OUT_Q5
Q1CH2_FDRX30outputTCELL101:OUT_F0
Q1CH2_FDRX31outputTCELL101:OUT_F1
Q1CH2_FDRX32outputTCELL101:OUT_Q2
Q1CH2_FDRX33outputTCELL101:OUT_Q3
Q1CH2_FDRX34outputTCELL101:OUT_Q4
Q1CH2_FDRX35outputTCELL101:OUT_Q5
Q1CH2_FDRX36outputTCELL101:OUT_Q6
Q1CH2_FDRX37outputTCELL101:OUT_Q7
Q1CH2_FDRX38outputTCELL102:OUT_Q0
Q1CH2_FDRX39outputTCELL102:OUT_Q1
Q1CH2_FDRX4outputTCELL99:OUT_Q6
Q1CH2_FDRX40outputTCELL101:OUT_F2
Q1CH2_FDRX41outputTCELL101:OUT_F3
Q1CH2_FDRX42outputTCELL101:OUT_F4
Q1CH2_FDRX43outputTCELL101:OUT_F5
Q1CH2_FDRX44outputTCELL101:OUT_F6
Q1CH2_FDRX45outputTCELL101:OUT_F7
Q1CH2_FDRX46outputTCELL102:OUT_F0
Q1CH2_FDRX47outputTCELL102:OUT_F1
Q1CH2_FDRX5outputTCELL99:OUT_Q7
Q1CH2_FDRX6outputTCELL100:OUT_Q0
Q1CH2_FDRX7outputTCELL100:OUT_Q1
Q1CH2_FDRX8outputTCELL99:OUT_F2
Q1CH2_FDRX9outputTCELL99:OUT_F3
Q1CH2_FDTX0inputTCELL99:IMUX_A6
Q1CH2_FDTX1inputTCELL99:IMUX_A7
Q1CH2_FDTX10inputTCELL100:IMUX_C4
Q1CH2_FDTX11inputTCELL100:IMUX_C5
Q1CH2_FDTX12inputTCELL100:IMUX_C6
Q1CH2_FDTX13inputTCELL100:IMUX_C7
Q1CH2_FDTX14inputTCELL101:IMUX_C0
Q1CH2_FDTX15inputTCELL101:IMUX_C1
Q1CH2_FDTX16inputTCELL100:IMUX_B4
Q1CH2_FDTX17inputTCELL100:IMUX_B5
Q1CH2_FDTX18inputTCELL100:IMUX_B6
Q1CH2_FDTX19inputTCELL100:IMUX_B7
Q1CH2_FDTX2inputTCELL100:IMUX_A0
Q1CH2_FDTX20inputTCELL101:IMUX_B0
Q1CH2_FDTX21inputTCELL101:IMUX_B1
Q1CH2_FDTX22inputTCELL100:IMUX_A4
Q1CH2_FDTX23inputTCELL100:IMUX_A5
Q1CH2_FDTX24inputTCELL100:IMUX_A6
Q1CH2_FDTX25inputTCELL100:IMUX_A7
Q1CH2_FDTX26inputTCELL101:IMUX_A0
Q1CH2_FDTX27inputTCELL101:IMUX_A1
Q1CH2_FDTX28inputTCELL101:IMUX_D4
Q1CH2_FDTX29inputTCELL101:IMUX_D5
Q1CH2_FDTX3inputTCELL100:IMUX_A1
Q1CH2_FDTX30inputTCELL101:IMUX_D6
Q1CH2_FDTX31inputTCELL101:IMUX_D7
Q1CH2_FDTX32inputTCELL102:IMUX_D0
Q1CH2_FDTX33inputTCELL102:IMUX_D1
Q1CH2_FDTX34inputTCELL101:IMUX_C4
Q1CH2_FDTX35inputTCELL101:IMUX_C5
Q1CH2_FDTX36inputTCELL101:IMUX_C6
Q1CH2_FDTX37inputTCELL101:IMUX_C7
Q1CH2_FDTX38inputTCELL102:IMUX_C0
Q1CH2_FDTX39inputTCELL102:IMUX_C1
Q1CH2_FDTX4inputTCELL100:IMUX_D4
Q1CH2_FDTX40inputTCELL101:IMUX_B4
Q1CH2_FDTX41inputTCELL101:IMUX_B5
Q1CH2_FDTX42inputTCELL101:IMUX_B6
Q1CH2_FDTX43inputTCELL101:IMUX_B7
Q1CH2_FDTX44inputTCELL102:IMUX_B0
Q1CH2_FDTX45inputTCELL102:IMUX_B1
Q1CH2_FDTX46inputTCELL101:IMUX_A4
Q1CH2_FDTX47inputTCELL101:IMUX_A5
Q1CH2_FDTX48inputTCELL101:IMUX_A6
Q1CH2_FDTX49inputTCELL101:IMUX_A7
Q1CH2_FDTX5inputTCELL100:IMUX_D5
Q1CH2_FDTX6inputTCELL100:IMUX_D6
Q1CH2_FDTX7inputTCELL100:IMUX_D7
Q1CH2_FDTX8inputTCELL101:IMUX_D0
Q1CH2_FDTX9inputTCELL101:IMUX_D1
Q1CH2_FIRCLKinputTCELL99:IMUX_CLK1_DELAY
Q1CH2_FIREFRXCLKinputTCELL101:IMUX_CLK1_DELAY
Q1CH2_FITCLKinputTCELL97:IMUX_CLK0_DELAY
Q1CH2_FITMRSTARTCLKinputTCELL108:IMUX_CLK0_DELAY
Q1CH2_FITMRSTOPCLKinputTCELL106:IMUX_CLK0_DELAY
Q1CH2_FSCCOVERRUNoutputTCELL108:OUT_Q7
Q1CH2_FSCCUNDERRUNoutputTCELL108:OUT_F3
Q1CH2_FSDFEVLDoutputTCELL105:OUT_Q4
Q1CH2_FSLSMoutputTCELL108:OUT_F7
Q1CH2_FSPCIECONoutputTCELL109:OUT_Q7
Q1CH2_FSPCIEDONEoutputTCELL109:OUT_F3
Q1CH2_FSRCDONEoutputTCELL106:OUT_F4
Q1CH2_FSRLOLoutputTCELL108:OUT_Q3
Q1CH2_FSRLOSoutputTCELL109:OUT_Q3
Q1CH2_FSSKPADDEDoutputTCELL108:OUT_Q1
Q1CH2_FSSKPDELETEDoutputTCELL107:OUT_Q5
Q1CH3_FCALIGNENinputTCELL110:IMUX_B4
Q1CH3_FCCDRFORCEDLOCKinputTCELL94:IMUX_A4
Q1CH3_FCDFERDENinputTCELL103:IMUX_CE1
Q1CH3_FCDFEUPDinputTCELL102:IMUX_CE1
Q1CH3_FCLDRTXENinputTCELL110:IMUX_A4
Q1CH3_FCLSMENinputTCELL95:IMUX_D2
Q1CH3_FCPCIEDETENinputTCELL95:IMUX_B2
Q1CH3_FCPCSRXRSTinputTCELL97:IMUX_LSR0
Q1CH3_FCPCSTXRSTinputTCELL100:IMUX_LSR0
Q1CH3_FCPIPEPHYRESETNinputTCELL103:IMUX_LSR0
Q1CH3_FCPLLLOLinputTCELL94:IMUX_B6
Q1CH3_FCRATE0inputTCELL109:IMUX_C6
Q1CH3_FCRATE1inputTCELL109:IMUX_C7
Q1CH3_FCRATE2inputTCELL110:IMUX_C0
Q1CH3_FCRRSTinputTCELL95:IMUX_LSR0
Q1CH3_FCRXPOLARITYinputTCELL95:IMUX_C4
Q1CH3_FCRXPWRUPinputTCELL110:IMUX_A1
Q1CH3_FCTMRSTARTinputTCELL106:IMUX_A6
Q1CH3_FCTMRSTOPinputTCELL107:IMUX_B0
Q1CH3_FCTRSTinputTCELL110:IMUX_LSR0
Q1CH3_FCTXMARGIN0inputTCELL94:IMUX_D2
Q1CH3_FCTXMARGIN1inputTCELL94:IMUX_D3
Q1CH3_FCTXMARGIN2inputTCELL94:IMUX_D4
Q1CH3_FCTXPWRUPinputTCELL110:IMUX_D7
Q1CH3_FCWORDALGNENinputTCELL95:IMUX_D6
Q1CH3_FDLDRRXoutputTCELL107:OUT_F4
Q1CH3_FDLDRTXinputTCELL94:IMUX_B2
Q1CH3_FDRX0outputTCELL102:OUT_Q2
Q1CH3_FDRX1outputTCELL102:OUT_Q3
Q1CH3_FDRX10outputTCELL102:OUT_F4
Q1CH3_FDRX11outputTCELL102:OUT_F5
Q1CH3_FDRX12outputTCELL102:OUT_F6
Q1CH3_FDRX13outputTCELL102:OUT_F7
Q1CH3_FDRX14outputTCELL103:OUT_F0
Q1CH3_FDRX15outputTCELL103:OUT_F1
Q1CH3_FDRX16outputTCELL103:OUT_Q2
Q1CH3_FDRX17outputTCELL103:OUT_Q3
Q1CH3_FDRX18outputTCELL103:OUT_Q4
Q1CH3_FDRX19outputTCELL103:OUT_Q5
Q1CH3_FDRX2outputTCELL102:OUT_Q4
Q1CH3_FDRX20outputTCELL103:OUT_Q6
Q1CH3_FDRX21outputTCELL103:OUT_Q7
Q1CH3_FDRX22outputTCELL104:OUT_Q0
Q1CH3_FDRX23outputTCELL104:OUT_Q1
Q1CH3_FDRX24outputTCELL103:OUT_F2
Q1CH3_FDRX25outputTCELL103:OUT_F3
Q1CH3_FDRX26outputTCELL103:OUT_F4
Q1CH3_FDRX27outputTCELL103:OUT_F5
Q1CH3_FDRX28outputTCELL103:OUT_F6
Q1CH3_FDRX29outputTCELL103:OUT_F7
Q1CH3_FDRX3outputTCELL102:OUT_Q5
Q1CH3_FDRX30outputTCELL104:OUT_F0
Q1CH3_FDRX31outputTCELL104:OUT_F1
Q1CH3_FDRX32outputTCELL109:OUT_F6
Q1CH3_FDRX33outputTCELL109:OUT_F7
Q1CH3_FDRX34outputTCELL110:OUT_F0
Q1CH3_FDRX35outputTCELL110:OUT_F1
Q1CH3_FDRX36outputTCELL110:OUT_Q2
Q1CH3_FDRX37outputTCELL110:OUT_Q3
Q1CH3_FDRX38outputTCELL110:OUT_Q4
Q1CH3_FDRX39outputTCELL110:OUT_Q5
Q1CH3_FDRX4outputTCELL102:OUT_Q6
Q1CH3_FDRX40outputTCELL110:OUT_Q6
Q1CH3_FDRX41outputTCELL110:OUT_Q7
Q1CH3_FDRX42outputTCELL110:OUT_F2
Q1CH3_FDRX43outputTCELL110:OUT_F3
Q1CH3_FDRX44outputTCELL110:OUT_F4
Q1CH3_FDRX45outputTCELL110:OUT_F5
Q1CH3_FDRX46outputTCELL110:OUT_F6
Q1CH3_FDRX47outputTCELL110:OUT_F7
Q1CH3_FDRX5outputTCELL102:OUT_Q7
Q1CH3_FDRX6outputTCELL103:OUT_Q0
Q1CH3_FDRX7outputTCELL103:OUT_Q1
Q1CH3_FDRX8outputTCELL102:OUT_F2
Q1CH3_FDRX9outputTCELL102:OUT_F3
Q1CH3_FDTX0inputTCELL102:IMUX_A0
Q1CH3_FDTX1inputTCELL102:IMUX_A1
Q1CH3_FDTX10inputTCELL102:IMUX_C6
Q1CH3_FDTX11inputTCELL102:IMUX_C7
Q1CH3_FDTX12inputTCELL103:IMUX_C0
Q1CH3_FDTX13inputTCELL103:IMUX_C1
Q1CH3_FDTX14inputTCELL102:IMUX_B4
Q1CH3_FDTX15inputTCELL102:IMUX_B5
Q1CH3_FDTX16inputTCELL102:IMUX_B6
Q1CH3_FDTX17inputTCELL102:IMUX_B7
Q1CH3_FDTX18inputTCELL103:IMUX_B0
Q1CH3_FDTX19inputTCELL103:IMUX_B1
Q1CH3_FDTX2inputTCELL102:IMUX_D4
Q1CH3_FDTX20inputTCELL102:IMUX_A4
Q1CH3_FDTX21inputTCELL102:IMUX_A5
Q1CH3_FDTX22inputTCELL102:IMUX_A6
Q1CH3_FDTX23inputTCELL102:IMUX_A7
Q1CH3_FDTX24inputTCELL103:IMUX_A0
Q1CH3_FDTX25inputTCELL103:IMUX_A1
Q1CH3_FDTX26inputTCELL103:IMUX_D4
Q1CH3_FDTX27inputTCELL103:IMUX_D5
Q1CH3_FDTX28inputTCELL103:IMUX_D6
Q1CH3_FDTX29inputTCELL103:IMUX_D7
Q1CH3_FDTX3inputTCELL102:IMUX_D5
Q1CH3_FDTX30inputTCELL104:IMUX_D0
Q1CH3_FDTX31inputTCELL104:IMUX_D1
Q1CH3_FDTX32inputTCELL103:IMUX_C4
Q1CH3_FDTX33inputTCELL103:IMUX_C5
Q1CH3_FDTX34inputTCELL103:IMUX_C6
Q1CH3_FDTX35inputTCELL103:IMUX_C7
Q1CH3_FDTX36inputTCELL104:IMUX_C0
Q1CH3_FDTX37inputTCELL104:IMUX_C1
Q1CH3_FDTX38inputTCELL103:IMUX_B4
Q1CH3_FDTX39inputTCELL103:IMUX_B5
Q1CH3_FDTX4inputTCELL102:IMUX_D6
Q1CH3_FDTX40inputTCELL103:IMUX_B6
Q1CH3_FDTX41inputTCELL103:IMUX_B7
Q1CH3_FDTX42inputTCELL104:IMUX_B0
Q1CH3_FDTX43inputTCELL104:IMUX_B1
Q1CH3_FDTX44inputTCELL103:IMUX_A4
Q1CH3_FDTX45inputTCELL103:IMUX_A5
Q1CH3_FDTX46inputTCELL103:IMUX_A6
Q1CH3_FDTX47inputTCELL103:IMUX_A7
Q1CH3_FDTX48inputTCELL104:IMUX_A0
Q1CH3_FDTX49inputTCELL104:IMUX_A1
Q1CH3_FDTX5inputTCELL102:IMUX_D7
Q1CH3_FDTX6inputTCELL103:IMUX_D0
Q1CH3_FDTX7inputTCELL103:IMUX_D1
Q1CH3_FDTX8inputTCELL102:IMUX_C4
Q1CH3_FDTX9inputTCELL102:IMUX_C5
Q1CH3_FIRCLKinputTCELL99:IMUX_CLK0_DELAY
Q1CH3_FIREFRXCLKinputTCELL101:IMUX_CLK0_DELAY
Q1CH3_FITCLKinputTCELL97:IMUX_CLK1_DELAY
Q1CH3_FITMRSTARTCLKinputTCELL107:IMUX_CLK1_DELAY
Q1CH3_FITMRSTOPCLKinputTCELL105:IMUX_CLK1_DELAY
Q1CH3_FSCCOVERRUNoutputTCELL108:OUT_Q6
Q1CH3_FSCCUNDERRUNoutputTCELL108:OUT_F2
Q1CH3_FSDFEVLDoutputTCELL105:OUT_Q3
Q1CH3_FSLSMoutputTCELL108:OUT_F6
Q1CH3_FSPCIECONoutputTCELL109:OUT_Q6
Q1CH3_FSPCIEDONEoutputTCELL109:OUT_F2
Q1CH3_FSRCDONEoutputTCELL106:OUT_F3
Q1CH3_FSRLOLoutputTCELL108:OUT_Q2
Q1CH3_FSRLOSoutputTCELL109:OUT_Q2
Q1CH3_FSSKPADDEDoutputTCELL108:OUT_Q0
Q1CH3_FSSKPDELETEDoutputTCELL107:OUT_Q4
Q1D0_FCDERSTinputTCELL102:IMUX_LSR1
Q1D0_FSDEoutputTCELL107:OUT_Q3
Q1D0_FSDMoutputTCELL107:OUT_F1
Q1D1_FCDERSTinputTCELL102:IMUX_LSR0
Q1D1_FSDEoutputTCELL107:OUT_Q2
Q1D1_FSDMoutputTCELL107:OUT_F0
Q1EA0_CIRXFULLinputTCELL65:IMUX_A5
Q1EA0_CIRXIGNOREPKTinputTCELL66:IMUX_A2
Q1EA0_CITXDATA0inputTCELL62:IMUX_D2
Q1EA0_CITXDATA1inputTCELL62:IMUX_D1
Q1EA0_CITXDATA10inputTCELL61:IMUX_B4
Q1EA0_CITXDATA11inputTCELL61:IMUX_B3
Q1EA0_CITXDATA12inputTCELL61:IMUX_B2
Q1EA0_CITXDATA13inputTCELL61:IMUX_B1
Q1EA0_CITXDATA14inputTCELL61:IMUX_B0
Q1EA0_CITXDATA15inputTCELL61:IMUX_C5
Q1EA0_CITXDATA2inputTCELL62:IMUX_D0
Q1EA0_CITXDATA3inputTCELL61:IMUX_A5
Q1EA0_CITXDATA4inputTCELL61:IMUX_A4
Q1EA0_CITXDATA5inputTCELL61:IMUX_A3
Q1EA0_CITXDATA6inputTCELL61:IMUX_A2
Q1EA0_CITXDATA7inputTCELL61:IMUX_A1
Q1EA0_CITXDATA8inputTCELL61:IMUX_A0
Q1EA0_CITXDATA9inputTCELL61:IMUX_B5
Q1EA0_CITXDATAAVAILinputTCELL62:IMUX_B4
Q1EA0_CITXEMPTYinputTCELL63:IMUX_C2
Q1EA0_CITXEOFinputTCELL59:IMUX_A4
Q1EA0_CITXFIFOCTRLinputTCELL64:IMUX_B3
Q1EA0_CITXFORCEERRinputTCELL64:IMUX_C3
Q1EA0_CITXLASTBYTEVLDinputTCELL60:IMUX_D1
Q1EA0_CITXPAUSREQinputTCELL63:IMUX_A1
Q1EA0_CITXPAUSTIM0inputTCELL64:IMUX_B0
Q1EA0_CITXPAUSTIM1inputTCELL64:IMUX_D3
Q1EA0_CITXPAUSTIM10inputTCELL64:IMUX_C0
Q1EA0_CITXPAUSTIM11inputTCELL64:IMUX_C4
Q1EA0_CITXPAUSTIM12inputTCELL64:IMUX_C5
Q1EA0_CITXPAUSTIM13inputTCELL63:IMUX_A3
Q1EA0_CITXPAUSTIM14inputTCELL64:IMUX_B1
Q1EA0_CITXPAUSTIM15inputTCELL63:IMUX_A5
Q1EA0_CITXPAUSTIM2inputTCELL63:IMUX_B5
Q1EA0_CITXPAUSTIM3inputTCELL64:IMUX_D1
Q1EA0_CITXPAUSTIM4inputTCELL64:IMUX_C1
Q1EA0_CITXPAUSTIM5inputTCELL63:IMUX_A4
Q1EA0_CITXPAUSTIM6inputTCELL64:IMUX_D2
Q1EA0_CITXPAUSTIM7inputTCELL64:IMUX_D4
Q1EA0_CITXPAUSTIM8inputTCELL64:IMUX_C2
Q1EA0_CITXPAUSTIM9inputTCELL64:IMUX_D5
Q1EA0_CORXDATA0outputTCELL65:OUT_F5
Q1EA0_CORXDATA1outputTCELL66:OUT_Q2
Q1EA0_CORXDATA10outputTCELL65:OUT_Q1
Q1EA0_CORXDATA11outputTCELL65:OUT_Q3
Q1EA0_CORXDATA12outputTCELL65:OUT_Q7
Q1EA0_CORXDATA13outputTCELL65:OUT_Q0
Q1EA0_CORXDATA14outputTCELL64:OUT_Q4
Q1EA0_CORXDATA15outputTCELL65:OUT_Q2
Q1EA0_CORXDATA2outputTCELL65:OUT_F6
Q1EA0_CORXDATA3outputTCELL65:OUT_F4
Q1EA0_CORXDATA4outputTCELL65:OUT_F7
Q1EA0_CORXDATA5outputTCELL66:OUT_Q6
Q1EA0_CORXDATA6outputTCELL66:OUT_Q1
Q1EA0_CORXDATA7outputTCELL66:OUT_Q4
Q1EA0_CORXDATA8outputTCELL65:OUT_F1
Q1EA0_CORXDATA9outputTCELL65:OUT_F0
Q1EA0_CORXEOFoutputTCELL63:OUT_F1
Q1EA0_CORXERRORoutputTCELL63:OUT_Q7
Q1EA0_CORXFIFOFULLERRORoutputTCELL63:OUT_Q1
Q1EA0_CORXLASTBYTEVLDoutputTCELL61:OUT_F3
Q1EA0_CORXSTATENoutputTCELL64:OUT_Q0
Q1EA0_CORXSTATVEC0outputTCELL67:OUT_Q7
Q1EA0_CORXSTATVEC1outputTCELL66:OUT_Q7
Q1EA0_CORXSTATVEC2outputTCELL66:OUT_F0
Q1EA0_CORXSTATVEC3outputTCELL66:OUT_F1
Q1EA0_CORXSTATVEC4outputTCELL66:OUT_F2
Q1EA0_CORXSTATVEC5outputTCELL66:OUT_F3
Q1EA0_CORXSTATVEC6outputTCELL66:OUT_F4
Q1EA0_CORXSTATVEC7outputTCELL66:OUT_F6
Q1EA0_CORXWRITEoutputTCELL62:OUT_F4
Q1EA0_COTXDISCFRMoutputTCELL57:OUT_F4
Q1EA0_COTXDONEoutputTCELL58:OUT_F6
Q1EA0_COTXREADoutputTCELL57:OUT_F1
Q1EA0_COTXSTATENoutputTCELL58:OUT_Q1
Q1EA0_COTXSTATVEC0outputTCELL58:OUT_F1
Q1EA0_COTXSTATVEC1outputTCELL58:OUT_Q5
Q1EA0_COTXSTATVEC2outputTCELL59:OUT_Q0
Q1EA0_COTXSTATVEC3outputTCELL58:OUT_Q3
Q1EA0_COTXSTATVEC4outputTCELL58:OUT_F2
Q1EA0_COTXSTATVEC5outputTCELL59:OUT_Q4
Q1EA0_COTXSTATVEC6outputTCELL57:OUT_F7
Q1EA0_COTXSTATVEC7outputTCELL57:OUT_F6
Q1EA0_GIIPGSHRINKinputTCELL66:IMUX_C3
Q1EA0_GINONPADRXDVinputTCELL66:IMUX_A4
Q1EA0_GISYNCCOLinputTCELL64:IMUX_B4
Q1EA0_GISYNCCRSinputTCELL64:IMUX_A1
Q1EA0_GISYNCNIBDRIBinputTCELL66:IMUX_C4
Q1EA0_GISYNCRXD0inputTCELL66:IMUX_A3
Q1EA0_GISYNCRXD1inputTCELL66:IMUX_D7
Q1EA0_GISYNCRXD2inputTCELL66:IMUX_C6
Q1EA0_GISYNCRXD3inputTCELL66:IMUX_B5
Q1EA0_GISYNCRXD4inputTCELL66:IMUX_C2
Q1EA0_GISYNCRXD5inputTCELL66:IMUX_C7
Q1EA0_GISYNCRXD6inputTCELL66:IMUX_C5
Q1EA0_GISYNCRXD7inputTCELL66:IMUX_B6
Q1EA0_GISYNCRXDVinputTCELL66:IMUX_A6
Q1EA0_GISYNCRXERinputTCELL66:IMUX_B4
Q1EA0_GODISCARDFCSoutputTCELL61:OUT_Q4
Q1EA0_GOTXMACDATA0outputTCELL61:OUT_Q0
Q1EA0_GOTXMACDATA1outputTCELL60:OUT_F1
Q1EA0_GOTXMACDATA2outputTCELL60:OUT_Q2
Q1EA0_GOTXMACDATA3outputTCELL60:OUT_F3
Q1EA0_GOTXMACDATA4outputTCELL59:OUT_Q6
Q1EA0_GOTXMACDATA5outputTCELL59:OUT_F6
Q1EA0_GOTXMACDATA6outputTCELL60:OUT_F5
Q1EA0_GOTXMACDATA7outputTCELL60:OUT_F2
Q1EA0_GOTXMACERRoutputTCELL59:OUT_F1
Q1EA0_GOTXMACWRoutputTCELL60:OUT_Q5
Q1EA0_KIRSTNinputTCELL78:IMUX_LSR1
Q1EA0_KIRXMACCLKinputTCELL79:IMUX_CLK1_DELAY
Q1EA0_KIRXMACCLKENEXTinputTCELL66:IMUX_D5
Q1EA0_KIRXTXFECLKinputTCELL75:IMUX_CLK1_DELAY
Q1EA0_KITXGMIILPBKinputTCELL66:IMUX_D4
Q1EA0_KITXMACCLKinputTCELL74:IMUX_CLK0_DELAY
Q1EA0_KITXMACCLKENEXTinputTCELL65:IMUX_D7
Q1EA0_KOGBITENoutputTCELL62:OUT_Q4
Q1EA0_KORXMACCLKENoutputTCELL63:OUT_F4
Q1EA1_CIRXFULLinputTCELL64:IMUX_B2
Q1EA1_CIRXIGNOREPKTinputTCELL69:IMUX_D7
Q1EA1_CITXDATA0inputTCELL61:IMUX_C4
Q1EA1_CITXDATA1inputTCELL61:IMUX_C3
Q1EA1_CITXDATA10inputTCELL61:IMUX_D0
Q1EA1_CITXDATA11inputTCELL60:IMUX_A5
Q1EA1_CITXDATA12inputTCELL60:IMUX_A4
Q1EA1_CITXDATA13inputTCELL60:IMUX_A3
Q1EA1_CITXDATA14inputTCELL60:IMUX_A2
Q1EA1_CITXDATA15inputTCELL60:IMUX_A1
Q1EA1_CITXDATA2inputTCELL61:IMUX_C2
Q1EA1_CITXDATA3inputTCELL61:IMUX_C1
Q1EA1_CITXDATA4inputTCELL61:IMUX_C0
Q1EA1_CITXDATA5inputTCELL61:IMUX_D5
Q1EA1_CITXDATA6inputTCELL61:IMUX_D4
Q1EA1_CITXDATA7inputTCELL61:IMUX_D3
Q1EA1_CITXDATA8inputTCELL61:IMUX_D2
Q1EA1_CITXDATA9inputTCELL61:IMUX_D1
Q1EA1_CITXDATAAVAILinputTCELL63:IMUX_D2
Q1EA1_CITXEMPTYinputTCELL62:IMUX_A1
Q1EA1_CITXEOFinputTCELL59:IMUX_A3
Q1EA1_CITXFIFOCTRLinputTCELL63:IMUX_A2
Q1EA1_CITXFORCEERRinputTCELL64:IMUX_D0
Q1EA1_CITXLASTBYTEVLDinputTCELL60:IMUX_D0
Q1EA1_CITXPAUSREQinputTCELL63:IMUX_A0
Q1EA1_CITXPAUSTIM0inputTCELL63:IMUX_C3
Q1EA1_CITXPAUSTIM1inputTCELL63:IMUX_C1
Q1EA1_CITXPAUSTIM10inputTCELL63:IMUX_B1
Q1EA1_CITXPAUSTIM11inputTCELL62:IMUX_A2
Q1EA1_CITXPAUSTIM12inputTCELL63:IMUX_D5
Q1EA1_CITXPAUSTIM13inputTCELL63:IMUX_B0
Q1EA1_CITXPAUSTIM14inputTCELL62:IMUX_A4
Q1EA1_CITXPAUSTIM15inputTCELL63:IMUX_C0
Q1EA1_CITXPAUSTIM2inputTCELL63:IMUX_D4
Q1EA1_CITXPAUSTIM3inputTCELL62:IMUX_B0
Q1EA1_CITXPAUSTIM4inputTCELL62:IMUX_A3
Q1EA1_CITXPAUSTIM5inputTCELL62:IMUX_C5
Q1EA1_CITXPAUSTIM6inputTCELL62:IMUX_B1
Q1EA1_CITXPAUSTIM7inputTCELL63:IMUX_D3
Q1EA1_CITXPAUSTIM8inputTCELL62:IMUX_A0
Q1EA1_CITXPAUSTIM9inputTCELL62:IMUX_B5
Q1EA1_CORXDATA0outputTCELL72:OUT_Q3
Q1EA1_CORXDATA1outputTCELL72:OUT_F2
Q1EA1_CORXDATA10outputTCELL73:OUT_Q7
Q1EA1_CORXDATA11outputTCELL73:OUT_Q5
Q1EA1_CORXDATA12outputTCELL72:OUT_F7
Q1EA1_CORXDATA13outputTCELL73:OUT_F4
Q1EA1_CORXDATA14outputTCELL73:OUT_F7
Q1EA1_CORXDATA15outputTCELL73:OUT_Q1
Q1EA1_CORXDATA2outputTCELL71:OUT_F1
Q1EA1_CORXDATA3outputTCELL71:OUT_Q5
Q1EA1_CORXDATA4outputTCELL71:OUT_F6
Q1EA1_CORXDATA5outputTCELL72:OUT_Q6
Q1EA1_CORXDATA6outputTCELL72:OUT_Q0
Q1EA1_CORXDATA7outputTCELL71:OUT_F7
Q1EA1_CORXDATA8outputTCELL71:OUT_Q7
Q1EA1_CORXDATA9outputTCELL72:OUT_Q1
Q1EA1_CORXEOFoutputTCELL72:OUT_Q2
Q1EA1_CORXERRORoutputTCELL71:OUT_Q6
Q1EA1_CORXFIFOFULLERRORoutputTCELL71:OUT_F0
Q1EA1_CORXLASTBYTEVLDoutputTCELL62:OUT_Q1
Q1EA1_CORXSTATENoutputTCELL68:OUT_Q3
Q1EA1_CORXSTATVEC0outputTCELL70:OUT_F5
Q1EA1_CORXSTATVEC1outputTCELL70:OUT_F0
Q1EA1_CORXSTATVEC2outputTCELL70:OUT_Q3
Q1EA1_CORXSTATVEC3outputTCELL69:OUT_F2
Q1EA1_CORXSTATVEC4outputTCELL69:OUT_F1
Q1EA1_CORXSTATVEC5outputTCELL70:OUT_Q0
Q1EA1_CORXSTATVEC6outputTCELL71:OUT_Q2
Q1EA1_CORXSTATVEC7outputTCELL71:OUT_Q0
Q1EA1_CORXWRITEoutputTCELL71:OUT_F5
Q1EA1_COTXDISCFRMoutputTCELL57:OUT_F5
Q1EA1_COTXDONEoutputTCELL58:OUT_Q2
Q1EA1_COTXREADoutputTCELL57:OUT_F0
Q1EA1_COTXSTATENoutputTCELL58:OUT_Q0
Q1EA1_COTXSTATVEC0outputTCELL58:OUT_F5
Q1EA1_COTXSTATVEC1outputTCELL58:OUT_Q6
Q1EA1_COTXSTATVEC2outputTCELL58:OUT_F0
Q1EA1_COTXSTATVEC3outputTCELL58:OUT_F3
Q1EA1_COTXSTATVEC4outputTCELL59:OUT_Q1
Q1EA1_COTXSTATVEC5outputTCELL58:OUT_F4
Q1EA1_COTXSTATVEC6outputTCELL59:OUT_Q2
Q1EA1_COTXSTATVEC7outputTCELL58:OUT_Q7
Q1EA1_GIIPGSHRINKinputTCELL68:IMUX_A5
Q1EA1_GINONPADRXDVinputTCELL69:IMUX_D5
Q1EA1_GISYNCCOLinputTCELL64:IMUX_B5
Q1EA1_GISYNCCRSinputTCELL64:IMUX_A0
Q1EA1_GISYNCNIBDRIBinputTCELL68:IMUX_B3
Q1EA1_GISYNCRXD0inputTCELL69:IMUX_D3
Q1EA1_GISYNCRXD1inputTCELL69:IMUX_C4
Q1EA1_GISYNCRXD2inputTCELL69:IMUX_D4
Q1EA1_GISYNCRXD3inputTCELL68:IMUX_B2
Q1EA1_GISYNCRXD4inputTCELL69:IMUX_C6
Q1EA1_GISYNCRXD5inputTCELL69:IMUX_B4
Q1EA1_GISYNCRXD6inputTCELL69:IMUX_B3
Q1EA1_GISYNCRXD7inputTCELL69:IMUX_C2
Q1EA1_GISYNCRXDVinputTCELL68:IMUX_A6
Q1EA1_GISYNCRXERinputTCELL69:IMUX_A2
Q1EA1_GODISCARDFCSoutputTCELL61:OUT_Q5
Q1EA1_GOTXMACDATA0outputTCELL59:OUT_F5
Q1EA1_GOTXMACDATA1outputTCELL61:OUT_Q2
Q1EA1_GOTXMACDATA2outputTCELL59:OUT_F4
Q1EA1_GOTXMACDATA3outputTCELL60:OUT_Q0
Q1EA1_GOTXMACDATA4outputTCELL59:OUT_F2
Q1EA1_GOTXMACDATA5outputTCELL60:OUT_Q1
Q1EA1_GOTXMACDATA6outputTCELL58:OUT_F7
Q1EA1_GOTXMACDATA7outputTCELL59:OUT_F0
Q1EA1_GOTXMACERRoutputTCELL58:OUT_Q4
Q1EA1_GOTXMACWRoutputTCELL59:OUT_F3
Q1EA1_KIRSTNinputTCELL79:IMUX_LSR1
Q1EA1_KIRXMACCLKinputTCELL79:IMUX_CLK0_DELAY
Q1EA1_KIRXMACCLKENEXTinputTCELL66:IMUX_D6
Q1EA1_KIRXTXFECLKinputTCELL77:IMUX_CLK0_DELAY
Q1EA1_KITXGMIILPBKinputTCELL66:IMUX_D3
Q1EA1_KITXMACCLKinputTCELL78:IMUX_CLK1_DELAY
Q1EA1_KITXMACCLKENEXTinputTCELL65:IMUX_A4
Q1EA1_KOGBITENoutputTCELL61:OUT_F4
Q1EA1_KORXMACCLKENoutputTCELL62:OUT_Q0
Q1EA2_CIRXFULLinputTCELL68:IMUX_D7
Q1EA2_CIRXIGNOREPKTinputTCELL69:IMUX_D6
Q1EA2_CITXDATA0inputTCELL63:IMUX_B3
Q1EA2_CITXDATA1inputTCELL63:IMUX_C4
Q1EA2_CITXDATA10inputTCELL62:IMUX_C3
Q1EA2_CITXDATA11inputTCELL62:IMUX_D5
Q1EA2_CITXDATA12inputTCELL60:IMUX_A0
Q1EA2_CITXDATA13inputTCELL62:IMUX_D3
Q1EA2_CITXDATA14inputTCELL62:IMUX_C0
Q1EA2_CITXDATA15inputTCELL62:IMUX_C2
Q1EA2_CITXDATA2inputTCELL63:IMUX_B2
Q1EA2_CITXDATA3inputTCELL63:IMUX_B4
Q1EA2_CITXDATA4inputTCELL63:IMUX_C5
Q1EA2_CITXDATA5inputTCELL62:IMUX_A5
Q1EA2_CITXDATA6inputTCELL63:IMUX_D0
Q1EA2_CITXDATA7inputTCELL62:IMUX_B2
Q1EA2_CITXDATA8inputTCELL63:IMUX_D1
Q1EA2_CITXDATA9inputTCELL62:IMUX_C4
Q1EA2_CITXDATAAVAILinputTCELL62:IMUX_D4
Q1EA2_CITXEMPTYinputTCELL65:IMUX_B7
Q1EA2_CITXEOFinputTCELL62:IMUX_C1
Q1EA2_CITXFIFOCTRLinputTCELL66:IMUX_B7
Q1EA2_CITXFORCEERRinputTCELL66:IMUX_B3
Q1EA2_CITXLASTBYTEVLDinputTCELL62:IMUX_B3
Q1EA2_CITXPAUSREQinputTCELL65:IMUX_A3
Q1EA2_CITXPAUSTIM0inputTCELL66:IMUX_A7
Q1EA2_CITXPAUSTIM1inputTCELL67:IMUX_D2
Q1EA2_CITXPAUSTIM10inputTCELL67:IMUX_C4
Q1EA2_CITXPAUSTIM11inputTCELL67:IMUX_D7
Q1EA2_CITXPAUSTIM12inputTCELL67:IMUX_C2
Q1EA2_CITXPAUSTIM13inputTCELL67:IMUX_C7
Q1EA2_CITXPAUSTIM14inputTCELL67:IMUX_B4
Q1EA2_CITXPAUSTIM15inputTCELL67:IMUX_D5
Q1EA2_CITXPAUSTIM2inputTCELL67:IMUX_C6
Q1EA2_CITXPAUSTIM3inputTCELL67:IMUX_D4
Q1EA2_CITXPAUSTIM4inputTCELL67:IMUX_B3
Q1EA2_CITXPAUSTIM5inputTCELL67:IMUX_C5
Q1EA2_CITXPAUSTIM6inputTCELL67:IMUX_B2
Q1EA2_CITXPAUSTIM7inputTCELL67:IMUX_D6
Q1EA2_CITXPAUSTIM8inputTCELL67:IMUX_D3
Q1EA2_CITXPAUSTIM9inputTCELL67:IMUX_C3
Q1EA2_CORXDATA0outputTCELL72:OUT_Q7
Q1EA2_CORXDATA1outputTCELL72:OUT_F6
Q1EA2_CORXDATA10outputTCELL71:OUT_Q4
Q1EA2_CORXDATA11outputTCELL71:OUT_F2
Q1EA2_CORXDATA12outputTCELL73:OUT_F0
Q1EA2_CORXDATA13outputTCELL74:OUT_Q0
Q1EA2_CORXDATA14outputTCELL73:OUT_F6
Q1EA2_CORXDATA15outputTCELL73:OUT_F5
Q1EA2_CORXDATA2outputTCELL72:OUT_F3
Q1EA2_CORXDATA3outputTCELL71:OUT_F4
Q1EA2_CORXDATA4outputTCELL72:OUT_F5
Q1EA2_CORXDATA5outputTCELL72:OUT_F0
Q1EA2_CORXDATA6outputTCELL72:OUT_Q4
Q1EA2_CORXDATA7outputTCELL73:OUT_Q0
Q1EA2_CORXDATA8outputTCELL73:OUT_F1
Q1EA2_CORXDATA9outputTCELL73:OUT_Q6
Q1EA2_CORXEOFoutputTCELL70:OUT_F2
Q1EA2_CORXERRORoutputTCELL70:OUT_F3
Q1EA2_CORXFIFOFULLERRORoutputTCELL70:OUT_F4
Q1EA2_CORXLASTBYTEVLDoutputTCELL62:OUT_F7
Q1EA2_CORXSTATENoutputTCELL69:OUT_Q0
Q1EA2_CORXSTATVEC0outputTCELL70:OUT_Q1
Q1EA2_CORXSTATVEC1outputTCELL70:OUT_F1
Q1EA2_CORXSTATVEC2outputTCELL71:OUT_F3
Q1EA2_CORXSTATVEC3outputTCELL72:OUT_F1
Q1EA2_CORXSTATVEC4outputTCELL72:OUT_Q5
Q1EA2_CORXSTATVEC5outputTCELL71:OUT_Q3
Q1EA2_CORXSTATVEC6outputTCELL71:OUT_Q1
Q1EA2_CORXSTATVEC7outputTCELL70:OUT_Q2
Q1EA2_CORXWRITEoutputTCELL70:OUT_Q5
Q1EA2_COTXDISCFRMoutputTCELL62:OUT_F5
Q1EA2_COTXDONEoutputTCELL63:OUT_F2
Q1EA2_COTXREADoutputTCELL61:OUT_Q7
Q1EA2_COTXSTATENoutputTCELL63:OUT_F0
Q1EA2_COTXSTATVEC0outputTCELL64:OUT_F0
Q1EA2_COTXSTATVEC1outputTCELL64:OUT_Q5
Q1EA2_COTXSTATVEC2outputTCELL64:OUT_Q3
Q1EA2_COTXSTATVEC3outputTCELL63:OUT_F5
Q1EA2_COTXSTATVEC4outputTCELL64:OUT_Q2
Q1EA2_COTXSTATVEC5outputTCELL64:OUT_F5
Q1EA2_COTXSTATVEC6outputTCELL63:OUT_Q6
Q1EA2_COTXSTATVEC7outputTCELL64:OUT_F2
Q1EA2_GIIPGSHRINKinputTCELL68:IMUX_B4
Q1EA2_GINONPADRXDVinputTCELL70:IMUX_D2
Q1EA2_GISYNCCOLinputTCELL67:IMUX_B6
Q1EA2_GISYNCCRSinputTCELL67:IMUX_B5
Q1EA2_GISYNCNIBDRIBinputTCELL69:IMUX_C5
Q1EA2_GISYNCRXD0inputTCELL69:IMUX_C7
Q1EA2_GISYNCRXD1inputTCELL69:IMUX_B7
Q1EA2_GISYNCRXD2inputTCELL68:IMUX_A3
Q1EA2_GISYNCRXD3inputTCELL68:IMUX_A4
Q1EA2_GISYNCRXD4inputTCELL68:IMUX_A2
Q1EA2_GISYNCRXD5inputTCELL68:IMUX_B7
Q1EA2_GISYNCRXD6inputTCELL68:IMUX_B5
Q1EA2_GISYNCRXD7inputTCELL68:IMUX_B6
Q1EA2_GISYNCRXDVinputTCELL69:IMUX_A4
Q1EA2_GISYNCRXERinputTCELL69:IMUX_B6
Q1EA2_GODISCARDFCSoutputTCELL67:OUT_Q3
Q1EA2_GOTXMACDATA0outputTCELL60:OUT_F4
Q1EA2_GOTXMACDATA1outputTCELL60:OUT_Q3
Q1EA2_GOTXMACDATA2outputTCELL60:OUT_Q4
Q1EA2_GOTXMACDATA3outputTCELL59:OUT_F7
Q1EA2_GOTXMACDATA4outputTCELL63:OUT_Q5
Q1EA2_GOTXMACDATA5outputTCELL63:OUT_F7
Q1EA2_GOTXMACDATA6outputTCELL64:OUT_F1
Q1EA2_GOTXMACDATA7outputTCELL60:OUT_Q6
Q1EA2_GOTXMACERRoutputTCELL60:OUT_Q7
Q1EA2_GOTXMACWRoutputTCELL60:OUT_F0
Q1EA2_KIRSTNinputTCELL79:IMUX_LSR0
Q1EA2_KIRXMACCLKinputTCELL80:IMUX_CLK0_DELAY
Q1EA2_KIRXMACCLKENEXTinputTCELL67:IMUX_A5
Q1EA2_KIRXTXFECLKinputTCELL77:IMUX_CLK1_DELAY
Q1EA2_KITXGMIILPBKinputTCELL67:IMUX_A2
Q1EA2_KITXMACCLKinputTCELL78:IMUX_CLK0_DELAY
Q1EA2_KITXMACCLKENEXTinputTCELL67:IMUX_B7
Q1EA2_KOGBITENoutputTCELL62:OUT_Q3
Q1EA2_KORXMACCLKENoutputTCELL61:OUT_F0
Q1EA3_CIRXFULLinputTCELL67:IMUX_A6
Q1EA3_CIRXIGNOREPKTinputTCELL68:IMUX_C2
Q1EA3_CITXDATA0inputTCELL60:IMUX_B5
Q1EA3_CITXDATA1inputTCELL60:IMUX_B4
Q1EA3_CITXDATA10inputTCELL60:IMUX_C1
Q1EA3_CITXDATA11inputTCELL60:IMUX_C0
Q1EA3_CITXDATA12inputTCELL60:IMUX_D5
Q1EA3_CITXDATA13inputTCELL60:IMUX_D4
Q1EA3_CITXDATA14inputTCELL60:IMUX_D3
Q1EA3_CITXDATA15inputTCELL60:IMUX_D2
Q1EA3_CITXDATA2inputTCELL60:IMUX_B2
Q1EA3_CITXDATA3inputTCELL60:IMUX_B3
Q1EA3_CITXDATA4inputTCELL60:IMUX_B1
Q1EA3_CITXDATA5inputTCELL60:IMUX_B0
Q1EA3_CITXDATA6inputTCELL60:IMUX_C5
Q1EA3_CITXDATA7inputTCELL60:IMUX_C4
Q1EA3_CITXDATA8inputTCELL60:IMUX_C3
Q1EA3_CITXDATA9inputTCELL60:IMUX_C2
Q1EA3_CITXDATAAVAILinputTCELL64:IMUX_A2
Q1EA3_CITXEMPTYinputTCELL64:IMUX_A3
Q1EA3_CITXEOFinputTCELL59:IMUX_A2
Q1EA3_CITXFIFOCTRLinputTCELL65:IMUX_A2
Q1EA3_CITXFORCEERRinputTCELL65:IMUX_C7
Q1EA3_CITXLASTBYTEVLDinputTCELL59:IMUX_A5
Q1EA3_CITXPAUSREQinputTCELL64:IMUX_A4
Q1EA3_CITXPAUSTIM0inputTCELL65:IMUX_B6
Q1EA3_CITXPAUSTIM1inputTCELL65:IMUX_B4
Q1EA3_CITXPAUSTIM10inputTCELL65:IMUX_D6
Q1EA3_CITXPAUSTIM11inputTCELL65:IMUX_B3
Q1EA3_CITXPAUSTIM12inputTCELL65:IMUX_D3
Q1EA3_CITXPAUSTIM13inputTCELL64:IMUX_A5
Q1EA3_CITXPAUSTIM14inputTCELL65:IMUX_C6
Q1EA3_CITXPAUSTIM15inputTCELL65:IMUX_B2
Q1EA3_CITXPAUSTIM2inputTCELL65:IMUX_C4
Q1EA3_CITXPAUSTIM3inputTCELL65:IMUX_B5
Q1EA3_CITXPAUSTIM4inputTCELL65:IMUX_D5
Q1EA3_CITXPAUSTIM5inputTCELL65:IMUX_D4
Q1EA3_CITXPAUSTIM6inputTCELL65:IMUX_D2
Q1EA3_CITXPAUSTIM7inputTCELL65:IMUX_C3
Q1EA3_CITXPAUSTIM8inputTCELL65:IMUX_C5
Q1EA3_CITXPAUSTIM9inputTCELL65:IMUX_C2
Q1EA3_CORXDATA0outputTCELL68:OUT_F0
Q1EA3_CORXDATA1outputTCELL68:OUT_Q1
Q1EA3_CORXDATA10outputTCELL69:OUT_Q7
Q1EA3_CORXDATA11outputTCELL69:OUT_F3
Q1EA3_CORXDATA12outputTCELL69:OUT_Q1
Q1EA3_CORXDATA13outputTCELL69:OUT_F5
Q1EA3_CORXDATA14outputTCELL69:OUT_Q5
Q1EA3_CORXDATA15outputTCELL68:OUT_F5
Q1EA3_CORXDATA2outputTCELL68:OUT_F2
Q1EA3_CORXDATA3outputTCELL68:OUT_Q6
Q1EA3_CORXDATA4outputTCELL68:OUT_Q2
Q1EA3_CORXDATA5outputTCELL68:OUT_Q7
Q1EA3_CORXDATA6outputTCELL68:OUT_F4
Q1EA3_CORXDATA7outputTCELL68:OUT_F6
Q1EA3_CORXDATA8outputTCELL69:OUT_F0
Q1EA3_CORXDATA9outputTCELL68:OUT_F7
Q1EA3_CORXEOFoutputTCELL67:OUT_F6
Q1EA3_CORXERRORoutputTCELL68:OUT_Q0
Q1EA3_CORXFIFOFULLERRORoutputTCELL67:OUT_F4
Q1EA3_CORXLASTBYTEVLDoutputTCELL62:OUT_F6
Q1EA3_CORXSTATENoutputTCELL67:OUT_F7
Q1EA3_CORXSTATVEC0outputTCELL69:OUT_F7
Q1EA3_CORXSTATVEC1outputTCELL69:OUT_F4
Q1EA3_CORXSTATVEC2outputTCELL69:OUT_Q6
Q1EA3_CORXSTATVEC3outputTCELL68:OUT_F1
Q1EA3_CORXSTATVEC4outputTCELL69:OUT_Q4
Q1EA3_CORXSTATVEC5outputTCELL69:OUT_F6
Q1EA3_CORXSTATVEC6outputTCELL69:OUT_Q3
Q1EA3_CORXSTATVEC7outputTCELL68:OUT_Q5
Q1EA3_CORXWRITEoutputTCELL67:OUT_F3
Q1EA3_COTXDISCFRMoutputTCELL61:OUT_Q3
Q1EA3_COTXDONEoutputTCELL60:OUT_F7
Q1EA3_COTXREADoutputTCELL57:OUT_Q7
Q1EA3_COTXSTATENoutputTCELL61:OUT_F2
Q1EA3_COTXSTATVEC0outputTCELL62:OUT_F2
Q1EA3_COTXSTATVEC1outputTCELL62:OUT_Q5
Q1EA3_COTXSTATVEC2outputTCELL63:OUT_Q4
Q1EA3_COTXSTATVEC3outputTCELL62:OUT_F1
Q1EA3_COTXSTATVEC4outputTCELL62:OUT_Q6
Q1EA3_COTXSTATVEC5outputTCELL61:OUT_F7
Q1EA3_COTXSTATVEC6outputTCELL62:OUT_F0
Q1EA3_COTXSTATVEC7outputTCELL61:OUT_F6
Q1EA3_GIIPGSHRINKinputTCELL68:IMUX_D5
Q1EA3_GINONPADRXDVinputTCELL68:IMUX_C6
Q1EA3_GISYNCCOLinputTCELL65:IMUX_A6
Q1EA3_GISYNCCRSinputTCELL65:IMUX_A7
Q1EA3_GISYNCNIBDRIBinputTCELL68:IMUX_C5
Q1EA3_GISYNCRXD0inputTCELL68:IMUX_C7
Q1EA3_GISYNCRXD1inputTCELL68:IMUX_D6
Q1EA3_GISYNCRXD2inputTCELL68:IMUX_D4
Q1EA3_GISYNCRXD3inputTCELL67:IMUX_A3
Q1EA3_GISYNCRXD4inputTCELL68:IMUX_D3
Q1EA3_GISYNCRXD5inputTCELL67:IMUX_A4
Q1EA3_GISYNCRXD6inputTCELL68:IMUX_D2
Q1EA3_GISYNCRXD7inputTCELL67:IMUX_A7
Q1EA3_GISYNCRXDVinputTCELL68:IMUX_C4
Q1EA3_GISYNCRXERinputTCELL68:IMUX_C3
Q1EA3_GODISCARDFCSoutputTCELL59:OUT_Q5
Q1EA3_GOTXMACDATA0outputTCELL61:OUT_F5
Q1EA3_GOTXMACDATA1outputTCELL60:OUT_F6
Q1EA3_GOTXMACDATA2outputTCELL59:OUT_Q3
Q1EA3_GOTXMACDATA3outputTCELL61:OUT_F1
Q1EA3_GOTXMACDATA4outputTCELL63:OUT_Q2
Q1EA3_GOTXMACDATA5outputTCELL62:OUT_Q2
Q1EA3_GOTXMACDATA6outputTCELL62:OUT_F3
Q1EA3_GOTXMACDATA7outputTCELL63:OUT_Q0
Q1EA3_GOTXMACERRoutputTCELL61:OUT_Q1
Q1EA3_GOTXMACWRoutputTCELL57:OUT_F3
Q1EA3_KIRSTNinputTCELL78:IMUX_LSR0
Q1EA3_KIRXMACCLKinputTCELL80:IMUX_CLK1_DELAY
Q1EA3_KIRXMACCLKENEXTinputTCELL66:IMUX_A5
Q1EA3_KIRXTXFECLKinputTCELL76:IMUX_CLK1_DELAY
Q1EA3_KITXGMIILPBKinputTCELL66:IMUX_B2
Q1EA3_KITXMACCLKinputTCELL75:IMUX_CLK0_DELAY
Q1EA3_KITXMACCLKENEXTinputTCELL66:IMUX_D2
Q1EA3_KOGBITENoutputTCELL62:OUT_Q7
Q1EA3_KORXMACCLKENoutputTCELL59:OUT_Q7
Q1S_BAUDSUPPORT0inputTCELL77:IMUX_A2
Q1S_BAUDSUPPORT1inputTCELL78:IMUX_D3
Q1S_BAUDSUPPORT2inputTCELL78:IMUX_D2
Q1S_BAUDSUPPORT3inputTCELL78:IMUX_D5
Q1S_BAUDSUPPORT4inputTCELL71:IMUX_A5
Q1S_BUFFDEQACKADVPTRNoutputTCELL80:OUT_F3
Q1S_DECRBUFCNTVECTOR0outputTCELL87:OUT_Q4
Q1S_DECRBUFCNTVECTOR1outputTCELL87:OUT_Q3
Q1S_DECRBUFCNTVECTOR2outputTCELL87:OUT_Q2
Q1S_DECRBUFCNTVECTOR3outputTCELL87:OUT_Q1
Q1S_DECRBUFCNTVECTOR4outputTCELL87:OUT_Q0
Q1S_DECRBUFCNTVECTOR5outputTCELL86:OUT_F7
Q1S_DECRBUFCNTVECTOR6outputTCELL92:OUT_F7
Q1S_DECRBUFCNTVECTOR7outputTCELL86:OUT_F6
Q1S_DECRBUFCNTVECTOR8outputTCELL86:OUT_F5
Q1S_DECRBUFCNTVECTOR9outputTCELL86:OUT_F4
Q1S_ENABLETXFLOWCONTROLNinputTCELL78:IMUX_A4
Q1S_FLOWFIFOACKON0outputTCELL81:OUT_Q3
Q1S_FLOWFIFOACKON1outputTCELL80:OUT_F4
Q1S_FLOWFIFOACKON2outputTCELL80:OUT_F7
Q1S_FLOWFIFOACKON3outputTCELL80:OUT_F1
Q1S_GEARinputTCELL80:IMUX_A6
Q1S_LNKCLKinputTCELL83:IMUX_CLK1_DELAY
Q1S_LNKCLKDIV2inputTCELL83:IMUX_CLK0_DELAY
Q1S_LNKCLKDIV2RSTNoutputTCELL89:OUT_F7
Q1S_LNKCLKRSTNoutputTCELL91:OUT_Q3
Q1S_LNKDIV2RSTNinputTCELL83:IMUX_LSR0
Q1S_LNKMCERXACKNinputTCELL79:IMUX_A4
Q1S_LNKMCERXREQNoutputTCELL77:OUT_F4
Q1S_LNKMCETXACKNoutputTCELL80:OUT_F5
Q1S_LNKMCETXREQNinputTCELL80:IMUX_D6
Q1S_LNKRSTNinputTCELL83:IMUX_LSR1
Q1S_LNKTOUTPUTPORTENABLEoutputTCELL80:OUT_Q1
Q1S_LOOPBACK0inputTCELL79:IMUX_A7
Q1S_LOOPBACK1inputTCELL80:IMUX_D3
Q1S_LOOPBACK2inputTCELL80:IMUX_D4
Q1S_MASTERENABLEoutputTCELL83:OUT_Q2
Q1S_MGTA0inputTCELL76:IMUX_A4
Q1S_MGTA1inputTCELL76:IMUX_B4
Q1S_MGTA10inputTCELL75:IMUX_A6
Q1S_MGTA11inputTCELL76:IMUX_D2
Q1S_MGTA12inputTCELL75:IMUX_A5
Q1S_MGTA13inputTCELL76:IMUX_D4
Q1S_MGTA14inputTCELL75:IMUX_B3
Q1S_MGTA15inputTCELL75:IMUX_A4
Q1S_MGTA16inputTCELL76:IMUX_D3
Q1S_MGTA17inputTCELL75:IMUX_B4
Q1S_MGTA18inputTCELL72:IMUX_B7
Q1S_MGTA19inputTCELL77:IMUX_D7
Q1S_MGTA2inputTCELL76:IMUX_A5
Q1S_MGTA20inputTCELL77:IMUX_D3
Q1S_MGTA21inputTCELL76:IMUX_A2
Q1S_MGTA3inputTCELL76:IMUX_A3
Q1S_MGTA4inputTCELL77:IMUX_D5
Q1S_MGTA5inputTCELL77:IMUX_D4
Q1S_MGTA6inputTCELL77:IMUX_D2
Q1S_MGTA7inputTCELL76:IMUX_D5
Q1S_MGTA8inputTCELL75:IMUX_A7
Q1S_MGTA9inputTCELL76:IMUX_C4
Q1S_MGTCLKinputTCELL82:IMUX_CLK1_DELAY
Q1S_MGTCLKRSTNoutputTCELL81:OUT_Q5
Q1S_MGTDI0inputTCELL79:IMUX_B5
Q1S_MGTDI1inputTCELL79:IMUX_B6
Q1S_MGTDI10inputTCELL78:IMUX_C2
Q1S_MGTDI11inputTCELL78:IMUX_B5
Q1S_MGTDI12inputTCELL78:IMUX_A6
Q1S_MGTDI13inputTCELL79:IMUX_B4
Q1S_MGTDI14inputTCELL78:IMUX_A2
Q1S_MGTDI15inputTCELL77:IMUX_A6
Q1S_MGTDI16inputTCELL79:IMUX_D6
Q1S_MGTDI17inputTCELL79:IMUX_D4
Q1S_MGTDI18inputTCELL78:IMUX_A7
Q1S_MGTDI19inputTCELL78:IMUX_B4
Q1S_MGTDI2inputTCELL79:IMUX_B3
Q1S_MGTDI20inputTCELL78:IMUX_B3
Q1S_MGTDI21inputTCELL78:IMUX_C6
Q1S_MGTDI22inputTCELL78:IMUX_B2
Q1S_MGTDI23inputTCELL78:IMUX_C7
Q1S_MGTDI24inputTCELL77:IMUX_B2
Q1S_MGTDI25inputTCELL77:IMUX_B3
Q1S_MGTDI26inputTCELL78:IMUX_D4
Q1S_MGTDI27inputTCELL77:IMUX_A7
Q1S_MGTDI28inputTCELL77:IMUX_B5
Q1S_MGTDI29inputTCELL77:IMUX_B4
Q1S_MGTDI3inputTCELL78:IMUX_C5
Q1S_MGTDI30inputTCELL77:IMUX_B7
Q1S_MGTDI31inputTCELL77:IMUX_B6
Q1S_MGTDI4inputTCELL78:IMUX_C4
Q1S_MGTDI5inputTCELL78:IMUX_D6
Q1S_MGTDI6inputTCELL78:IMUX_C3
Q1S_MGTDI7inputTCELL77:IMUX_A3
Q1S_MGTDI8inputTCELL79:IMUX_B7
Q1S_MGTDI9inputTCELL79:IMUX_A2
Q1S_MGTRDNinputTCELL77:IMUX_C6
Q1S_MGTRSTNinputTCELL82:IMUX_LSR0
Q1S_MGTWRN0inputTCELL77:IMUX_C5
Q1S_MGTWRN1inputTCELL77:IMUX_C4
Q1S_MGTWRN2inputTCELL77:IMUX_D6
Q1S_MGTWRN3inputTCELL76:IMUX_B5
Q1S_OLLMEFPTR0inputTCELL78:IMUX_D7
Q1S_OLLMEFPTR1inputTCELL79:IMUX_D7
Q1S_OLLMEFPTR10inputTCELL78:IMUX_A3
Q1S_OLLMEFPTR11inputTCELL79:IMUX_C7
Q1S_OLLMEFPTR12inputTCELL79:IMUX_B2
Q1S_OLLMEFPTR13inputTCELL79:IMUX_C4
Q1S_OLLMEFPTR14inputTCELL79:IMUX_C3
Q1S_OLLMEFPTR15inputTCELL78:IMUX_A5
Q1S_OLLMEFPTR2inputTCELL79:IMUX_D5
Q1S_OLLMEFPTR3inputTCELL79:IMUX_C5
Q1S_OLLMEFPTR4inputTCELL79:IMUX_C2
Q1S_OLLMEFPTR5inputTCELL79:IMUX_D2
Q1S_OLLMEFPTR6inputTCELL78:IMUX_B7
Q1S_OLLMEFPTR7inputTCELL78:IMUX_B6
Q1S_OLLMEFPTR8inputTCELL79:IMUX_D3
Q1S_OLLMEFPTR9inputTCELL79:IMUX_C6
Q1S_OLLMMGTDI0outputTCELL75:OUT_Q4
Q1S_OLLMMGTDI1outputTCELL77:OUT_Q2
Q1S_OLLMMGTDI10outputTCELL76:OUT_F0
Q1S_OLLMMGTDI11outputTCELL77:OUT_Q7
Q1S_OLLMMGTDI12outputTCELL75:OUT_Q3
Q1S_OLLMMGTDI13outputTCELL75:OUT_Q0
Q1S_OLLMMGTDI14outputTCELL76:OUT_Q3
Q1S_OLLMMGTDI15outputTCELL75:OUT_F3
Q1S_OLLMMGTDI16outputTCELL74:OUT_F5
Q1S_OLLMMGTDI17outputTCELL77:OUT_Q5
Q1S_OLLMMGTDI18outputTCELL76:OUT_Q1
Q1S_OLLMMGTDI19outputTCELL76:OUT_Q0
Q1S_OLLMMGTDI2outputTCELL76:OUT_Q2
Q1S_OLLMMGTDI20outputTCELL75:OUT_F7
Q1S_OLLMMGTDI21outputTCELL74:OUT_F7
Q1S_OLLMMGTDI22outputTCELL75:OUT_Q6
Q1S_OLLMMGTDI23outputTCELL75:OUT_F0
Q1S_OLLMMGTDI24outputTCELL75:OUT_F6
Q1S_OLLMMGTDI25outputTCELL75:OUT_F5
Q1S_OLLMMGTDI26outputTCELL77:OUT_Q0
Q1S_OLLMMGTDI27outputTCELL76:OUT_F1
Q1S_OLLMMGTDI28outputTCELL77:OUT_Q1
Q1S_OLLMMGTDI29outputTCELL74:OUT_F6
Q1S_OLLMMGTDI3outputTCELL75:OUT_Q2
Q1S_OLLMMGTDI30outputTCELL75:OUT_F4
Q1S_OLLMMGTDI31outputTCELL76:OUT_F2
Q1S_OLLMMGTDI4outputTCELL76:OUT_F3
Q1S_OLLMMGTDI5outputTCELL75:OUT_Q1
Q1S_OLLMMGTDI6outputTCELL75:OUT_Q7
Q1S_OLLMMGTDI7outputTCELL75:OUT_F2
Q1S_OLLMMGTDI8outputTCELL77:OUT_F5
Q1S_OLLMMGTDI9outputTCELL77:OUT_F3
Q1S_OLLMMGTINTNoutputTCELL75:OUT_F1
Q1S_OLLMMGTRDYNoutputTCELL77:OUT_Q6
Q1S_OUTPUTUNRECOVERREVENTACKNinputTCELL79:IMUX_A3
Q1S_OUTPUTUNRECOVERREVENTREQNoutputTCELL78:OUT_Q5
Q1S_PHYCLKinputTCELL81:IMUX_CLK0_DELAY
Q1S_PHYEMEVENTACKNinputTCELL79:IMUX_A6
Q1S_PHYEMEVENTREQNoutputTCELL77:OUT_F7
Q1S_PHYMSTBinputTCELL79:IMUX_A5
Q1S_PHYRINITNinputTCELL77:IMUX_C7
Q1S_PHYRSTNinputTCELL80:IMUX_LSR1
Q1S_PHYTINITNinputTCELL77:IMUX_C3
Q1S_PHYUSTBinputTCELL77:IMUX_A4
Q1S_PORTDISABLEoutputTCELL83:OUT_Q7
Q1S_PORTNERRORDETECT0outputTCELL86:OUT_F3
Q1S_PORTNERRORDETECT1outputTCELL86:OUT_F2
Q1S_PORTNERRORDETECT10outputTCELL78:OUT_Q1
Q1S_PORTNERRORDETECT11outputTCELL78:OUT_F4
Q1S_PORTNERRORDETECT12outputTCELL79:OUT_Q0
Q1S_PORTNERRORDETECT13outputTCELL79:OUT_F4
Q1S_PORTNERRORDETECT14outputTCELL79:OUT_F7
Q1S_PORTNERRORDETECT15outputTCELL86:OUT_Q1
Q1S_PORTNERRORDETECT16outputTCELL86:OUT_Q4
Q1S_PORTNERRORDETECT17outputTCELL86:OUT_Q0
Q1S_PORTNERRORDETECT18outputTCELL83:OUT_F6
Q1S_PORTNERRORDETECT19outputTCELL83:OUT_F7
Q1S_PORTNERRORDETECT2outputTCELL86:OUT_F1
Q1S_PORTNERRORDETECT20outputTCELL83:OUT_F4
Q1S_PORTNERRORDETECT21outputTCELL83:OUT_F5
Q1S_PORTNERRORDETECT22outputTCELL86:OUT_Q5
Q1S_PORTNERRORDETECT23outputTCELL83:OUT_F1
Q1S_PORTNERRORDETECT24outputTCELL83:OUT_F2
Q1S_PORTNERRORDETECT25outputTCELL83:OUT_F3
Q1S_PORTNERRORDETECT26outputTCELL78:OUT_Q4
Q1S_PORTNERRORDETECT27outputTCELL78:OUT_F2
Q1S_PORTNERRORDETECT28outputTCELL78:OUT_Q0
Q1S_PORTNERRORDETECT29outputTCELL78:OUT_Q3
Q1S_PORTNERRORDETECT3outputTCELL86:OUT_F0
Q1S_PORTNERRORDETECT30outputTCELL78:OUT_Q2
Q1S_PORTNERRORDETECT31outputTCELL78:OUT_Q6
Q1S_PORTNERRORDETECT4outputTCELL86:OUT_Q6
Q1S_PORTNERRORDETECT5outputTCELL86:OUT_Q3
Q1S_PORTNERRORDETECT6outputTCELL86:OUT_Q7
Q1S_PORTNERRORDETECT7outputTCELL86:OUT_Q2
Q1S_PORTNERRORDETECT8outputTCELL79:OUT_Q7
Q1S_PORTNERRORDETECT9outputTCELL78:OUT_F7
Q1S_RCVCLKSEL0inputTCELL80:IMUX_C3
Q1S_RCVCLKSEL1inputTCELL77:IMUX_A5
Q1S_RCVCLKSEL2inputTCELL80:IMUX_C4
Q1S_RCVCLKSEL3inputTCELL77:IMUX_C2
Q1S_RECOVERRSTNinputTCELL72:IMUX_B2
Q1S_RESPTIMEOUT0outputTCELL77:OUT_F6
Q1S_RESPTIMEOUT1outputTCELL78:OUT_Q7
Q1S_RESPTIMEOUT10outputTCELL80:OUT_Q4
Q1S_RESPTIMEOUT11outputTCELL80:OUT_Q6
Q1S_RESPTIMEOUT12outputTCELL80:OUT_Q7
Q1S_RESPTIMEOUT13outputTCELL80:OUT_Q5
Q1S_RESPTIMEOUT14outputTCELL80:OUT_Q3
Q1S_RESPTIMEOUT15outputTCELL80:OUT_Q0
Q1S_RESPTIMEOUT16outputTCELL79:OUT_F3
Q1S_RESPTIMEOUT17outputTCELL78:OUT_F3
Q1S_RESPTIMEOUT18outputTCELL79:OUT_Q3
Q1S_RESPTIMEOUT19outputTCELL79:OUT_Q2
Q1S_RESPTIMEOUT2outputTCELL78:OUT_F5
Q1S_RESPTIMEOUT20outputTCELL79:OUT_Q1
Q1S_RESPTIMEOUT21outputTCELL78:OUT_F6
Q1S_RESPTIMEOUT22outputTCELL78:OUT_F1
Q1S_RESPTIMEOUT23outputTCELL78:OUT_F0
Q1S_RESPTIMEOUT3outputTCELL79:OUT_Q5
Q1S_RESPTIMEOUT4outputTCELL79:OUT_F5
Q1S_RESPTIMEOUT5outputTCELL79:OUT_F1
Q1S_RESPTIMEOUT6outputTCELL79:OUT_F0
Q1S_RESPTIMEOUT7outputTCELL79:OUT_Q6
Q1S_RESPTIMEOUT8outputTCELL79:OUT_F6
Q1S_RESPTIMEOUT9outputTCELL80:OUT_Q2
Q1S_RIOCLKinputTCELL82:IMUX_CLK0_DELAY
Q1S_RIORSTNinputTCELL82:IMUX_LSR1
Q1S_RLNKBEATS0outputTCELL87:OUT_F4
Q1S_RLNKBEATS1outputTCELL87:OUT_F3
Q1S_RLNKBEATS2outputTCELL87:OUT_F2
Q1S_RLNKBEATS3outputTCELL87:OUT_F1
Q1S_RLNKBEATS4outputTCELL87:OUT_F0
Q1S_RLNKBEATS5outputTCELL87:OUT_Q7
Q1S_RLNKBEATS6outputTCELL87:OUT_Q6
Q1S_RLNKBEATS7outputTCELL87:OUT_Q5
Q1S_RLNKD0outputTCELL92:OUT_Q4
Q1S_RLNKD1outputTCELL92:OUT_Q3
Q1S_RLNKD10outputTCELL91:OUT_F2
Q1S_RLNKD11outputTCELL91:OUT_Q7
Q1S_RLNKD12outputTCELL91:OUT_Q6
Q1S_RLNKD13outputTCELL91:OUT_Q5
Q1S_RLNKD14outputTCELL91:OUT_Q4
Q1S_RLNKD15outputTCELL91:OUT_Q2
Q1S_RLNKD16outputTCELL90:OUT_F7
Q1S_RLNKD17outputTCELL90:OUT_F6
Q1S_RLNKD18outputTCELL90:OUT_F5
Q1S_RLNKD19outputTCELL90:OUT_F4
Q1S_RLNKD2outputTCELL92:OUT_Q2
Q1S_RLNKD20outputTCELL90:OUT_F3
Q1S_RLNKD21outputTCELL90:OUT_F2
Q1S_RLNKD22outputTCELL90:OUT_F1
Q1S_RLNKD23outputTCELL90:OUT_F0
Q1S_RLNKD24outputTCELL90:OUT_Q7
Q1S_RLNKD25outputTCELL90:OUT_Q6
Q1S_RLNKD26outputTCELL90:OUT_Q5
Q1S_RLNKD27outputTCELL90:OUT_Q4
Q1S_RLNKD28outputTCELL90:OUT_Q3
Q1S_RLNKD29outputTCELL90:OUT_Q2
Q1S_RLNKD3outputTCELL92:OUT_Q1
Q1S_RLNKD30outputTCELL90:OUT_Q1
Q1S_RLNKD31outputTCELL89:OUT_F6
Q1S_RLNKD32outputTCELL89:OUT_F5
Q1S_RLNKD33outputTCELL89:OUT_F4
Q1S_RLNKD34outputTCELL89:OUT_F3
Q1S_RLNKD35outputTCELL89:OUT_F2
Q1S_RLNKD36outputTCELL89:OUT_F1
Q1S_RLNKD37outputTCELL89:OUT_F0
Q1S_RLNKD38outputTCELL89:OUT_Q7
Q1S_RLNKD39outputTCELL89:OUT_Q6
Q1S_RLNKD4outputTCELL92:OUT_Q0
Q1S_RLNKD40outputTCELL89:OUT_Q5
Q1S_RLNKD41outputTCELL89:OUT_Q4
Q1S_RLNKD42outputTCELL89:OUT_Q3
Q1S_RLNKD43outputTCELL89:OUT_Q2
Q1S_RLNKD44outputTCELL89:OUT_Q1
Q1S_RLNKD45outputTCELL89:OUT_Q0
Q1S_RLNKD46outputTCELL88:OUT_F7
Q1S_RLNKD47outputTCELL88:OUT_F6
Q1S_RLNKD48outputTCELL88:OUT_F5
Q1S_RLNKD49outputTCELL88:OUT_F4
Q1S_RLNKD5outputTCELL91:OUT_F7
Q1S_RLNKD50outputTCELL88:OUT_F3
Q1S_RLNKD51outputTCELL88:OUT_F2
Q1S_RLNKD52outputTCELL88:OUT_F1
Q1S_RLNKD53outputTCELL88:OUT_F0
Q1S_RLNKD54outputTCELL88:OUT_Q7
Q1S_RLNKD55outputTCELL88:OUT_Q5
Q1S_RLNKD56outputTCELL88:OUT_Q4
Q1S_RLNKD57outputTCELL88:OUT_Q3
Q1S_RLNKD58outputTCELL88:OUT_Q2
Q1S_RLNKD59outputTCELL88:OUT_Q1
Q1S_RLNKD6outputTCELL91:OUT_F6
Q1S_RLNKD60outputTCELL88:OUT_Q0
Q1S_RLNKD61outputTCELL87:OUT_F7
Q1S_RLNKD62outputTCELL87:OUT_F6
Q1S_RLNKD63outputTCELL87:OUT_F5
Q1S_RLNKD7outputTCELL91:OUT_F5
Q1S_RLNKD8outputTCELL91:OUT_F4
Q1S_RLNKD9outputTCELL91:OUT_F3
Q1S_RLNKDSTDSCNinputTCELL83:IMUX_D6
Q1S_RLNKDSTRDYNinputTCELL82:IMUX_A7
Q1S_RLNKEOFNoutputTCELL92:OUT_F3
Q1S_RLNKREM0outputTCELL92:OUT_Q7
Q1S_RLNKREM1outputTCELL92:OUT_Q6
Q1S_RLNKREM2outputTCELL92:OUT_Q5
Q1S_RLNKSOFNoutputTCELL92:OUT_F4
Q1S_RLNKSRCRDYNoutputTCELL92:OUT_F5
Q1S_RXINITNoutputTCELL82:OUT_F6
Q1S_RXPFORCERETRYNinputTCELL72:IMUX_B3
Q1S_RXSYNCCTRL0inputTCELL80:IMUX_D5
Q1S_RXSYNCCTRL1inputTCELL80:IMUX_D2
Q1S_SOFTRSTNinputTCELL81:IMUX_LSR0
Q1S_STATUS0outputTCELL82:OUT_F1
Q1S_STATUS1outputTCELL82:OUT_Q0
Q1S_STATUS10outputTCELL75:OUT_Q5
Q1S_STATUS11outputTCELL74:OUT_F4
Q1S_STATUS12outputTCELL81:OUT_F5
Q1S_STATUS13outputTCELL83:OUT_Q4
Q1S_STATUS14outputTCELL80:OUT_F0
Q1S_STATUS15outputTCELL92:OUT_F0
Q1S_STATUS16outputTCELL79:OUT_F2
Q1S_STATUS17outputTCELL76:OUT_F5
Q1S_STATUS18outputTCELL82:OUT_Q7
Q1S_STATUS19outputTCELL82:OUT_F3
Q1S_STATUS2outputTCELL82:OUT_Q4
Q1S_STATUS20outputTCELL77:OUT_F0
Q1S_STATUS21outputTCELL83:OUT_F0
Q1S_STATUS3outputTCELL81:OUT_F4
Q1S_STATUS4outputTCELL82:OUT_Q2
Q1S_STATUS5outputTCELL82:OUT_F0
Q1S_STATUS6outputTCELL81:OUT_F2
Q1S_STATUS7outputTCELL82:OUT_F2
Q1S_STATUS8outputTCELL81:OUT_F3
Q1S_STATUS9outputTCELL90:OUT_Q0
Q1S_SYSRSTINinputTCELL81:IMUX_LSR1
Q1S_SYSRSTONoutputTCELL79:OUT_Q4
Q1S_TIMBISTBANKSEL0inputTCELL71:IMUX_D6
Q1S_TIMBISTBANKSEL1inputTCELL71:IMUX_C5
Q1S_TIMBISTBANKSEL2inputTCELL71:IMUX_C2
Q1S_TIMBISTBANKSEL3inputTCELL71:IMUX_D7
Q1S_TIMBISTMODEinputTCELL71:IMUX_B5
Q1S_TIMBISTRA0inputTCELL71:IMUX_C3
Q1S_TIMBISTRA1inputTCELL71:IMUX_C4
Q1S_TIMBISTRA2inputTCELL71:IMUX_D4
Q1S_TIMBISTRA3inputTCELL71:IMUX_D3
Q1S_TIMBISTRA4inputTCELL70:IMUX_A5
Q1S_TIMBISTRA5inputTCELL70:IMUX_A2
Q1S_TIMBISTRA6inputTCELL70:IMUX_B4
Q1S_TIMBISTRA7inputTCELL70:IMUX_C5
Q1S_TIMBISTREinputTCELL71:IMUX_B2
Q1S_TIMBISTSDI0inputTCELL70:IMUX_D3
Q1S_TIMBISTSDI1inputTCELL69:IMUX_A5
Q1S_TIMBISTSDI10inputTCELL70:IMUX_D5
Q1S_TIMBISTSDI11inputTCELL70:IMUX_B5
Q1S_TIMBISTSDI12inputTCELL70:IMUX_A3
Q1S_TIMBISTSDI13inputTCELL71:IMUX_D5
Q1S_TIMBISTSDI14inputTCELL71:IMUX_C6
Q1S_TIMBISTSDI15inputTCELL71:IMUX_C7
Q1S_TIMBISTSDI16inputTCELL71:IMUX_B4
Q1S_TIMBISTSDI17inputTCELL71:IMUX_A3
Q1S_TIMBISTSDI18inputTCELL72:IMUX_D2
Q1S_TIMBISTSDI19inputTCELL72:IMUX_D3
Q1S_TIMBISTSDI2inputTCELL69:IMUX_A3
Q1S_TIMBISTSDI20inputTCELL72:IMUX_D5
Q1S_TIMBISTSDI21inputTCELL72:IMUX_D6
Q1S_TIMBISTSDI22inputTCELL72:IMUX_C2
Q1S_TIMBISTSDI23inputTCELL72:IMUX_C3
Q1S_TIMBISTSDI24inputTCELL72:IMUX_C4
Q1S_TIMBISTSDI25inputTCELL72:IMUX_C6
Q1S_TIMBISTSDI26inputTCELL72:IMUX_C7
Q1S_TIMBISTSDI27inputTCELL72:IMUX_C5
Q1S_TIMBISTSDI28inputTCELL72:IMUX_D7
Q1S_TIMBISTSDI29inputTCELL72:IMUX_D4
Q1S_TIMBISTSDI3inputTCELL69:IMUX_B5
Q1S_TIMBISTSDI30inputTCELL71:IMUX_A7
Q1S_TIMBISTSDI31inputTCELL71:IMUX_A6
Q1S_TIMBISTSDI32inputTCELL71:IMUX_A4
Q1S_TIMBISTSDI33inputTCELL71:IMUX_A2
Q1S_TIMBISTSDI34inputTCELL71:IMUX_B7
Q1S_TIMBISTSDI35inputTCELL71:IMUX_B6
Q1S_TIMBISTSDI4inputTCELL69:IMUX_B2
Q1S_TIMBISTSDI5inputTCELL69:IMUX_D2
Q1S_TIMBISTSDI6inputTCELL68:IMUX_A7
Q1S_TIMBISTSDI7inputTCELL69:IMUX_C3
Q1S_TIMBISTSDI8inputTCELL69:IMUX_A6
Q1S_TIMBISTSDI9inputTCELL69:IMUX_A7
Q1S_TIMBISTWA0inputTCELL70:IMUX_C4
Q1S_TIMBISTWA1inputTCELL70:IMUX_C2
Q1S_TIMBISTWA2inputTCELL70:IMUX_C3
Q1S_TIMBISTWA3inputTCELL70:IMUX_B3
Q1S_TIMBISTWA4inputTCELL70:IMUX_D4
Q1S_TIMBISTWA5inputTCELL70:IMUX_B2
Q1S_TIMBISTWA6inputTCELL70:IMUX_A4
Q1S_TIMBISTWA7inputTCELL71:IMUX_D2
Q1S_TIMBISTWEinputTCELL71:IMUX_B3
Q1S_TISCANCLKinputTCELL81:IMUX_CLK1_DELAY
Q1S_TISCANENAinputTCELL80:IMUX_LSR0
Q1S_TISCANI0inputTCELL76:IMUX_CE2
Q1S_TISCANI1inputTCELL83:IMUX_CE2
Q1S_TISCANI10inputTCELL77:IMUX_CE1
Q1S_TISCANI11inputTCELL78:IMUX_CE1
Q1S_TISCANI12inputTCELL78:IMUX_CE0
Q1S_TISCANI13inputTCELL77:IMUX_CE2
Q1S_TISCANI14inputTCELL81:IMUX_CE1
Q1S_TISCANI15inputTCELL83:IMUX_CE3
Q1S_TISCANI16inputTCELL83:IMUX_CE1
Q1S_TISCANI17inputTCELL81:IMUX_CE2
Q1S_TISCANI18inputTCELL82:IMUX_CE2
Q1S_TISCANI19inputTCELL83:IMUX_CE0
Q1S_TISCANI2inputTCELL76:IMUX_CE1
Q1S_TISCANI20inputTCELL81:IMUX_CE0
Q1S_TISCANI21inputTCELL78:IMUX_CE3
Q1S_TISCANI22inputTCELL80:IMUX_CE3
Q1S_TISCANI23inputTCELL79:IMUX_CE0
Q1S_TISCANI24inputTCELL80:IMUX_CE2
Q1S_TISCANI25inputTCELL79:IMUX_CE1
Q1S_TISCANI26inputTCELL80:IMUX_CE1
Q1S_TISCANI27inputTCELL80:IMUX_CE0
Q1S_TISCANI28inputTCELL79:IMUX_CE2
Q1S_TISCANI29inputTCELL79:IMUX_CE3
Q1S_TISCANI3inputTCELL78:IMUX_CE2
Q1S_TISCANI4inputTCELL82:IMUX_CE0
Q1S_TISCANI5inputTCELL81:IMUX_CE3
Q1S_TISCANI6inputTCELL77:IMUX_CE3
Q1S_TISCANI7inputTCELL82:IMUX_CE3
Q1S_TISCANI8inputTCELL82:IMUX_CE1
Q1S_TISCANI9inputTCELL77:IMUX_CE0
Q1S_TISCANMODEinputTCELL77:IMUX_LSR1
Q1S_TISCANO0outputTCELL63:OUT_F3
Q1S_TISCANO1outputTCELL92:OUT_F1
Q1S_TISCANO10outputTCELL70:OUT_Q4
Q1S_TISCANO11outputTCELL69:OUT_Q2
Q1S_TISCANO12outputTCELL61:OUT_Q6
Q1S_TISCANO13outputTCELL57:OUT_F2
Q1S_TISCANO14outputTCELL63:OUT_Q3
Q1S_TISCANO15outputTCELL74:OUT_F1
Q1S_TISCANO16outputTCELL88:OUT_Q6
Q1S_TISCANO17outputTCELL77:OUT_F2
Q1S_TISCANO18outputTCELL83:OUT_Q3
Q1S_TISCANO19outputTCELL74:OUT_F2
Q1S_TISCANO2outputTCELL92:OUT_F6
Q1S_TISCANO20outputTCELL81:OUT_Q7
Q1S_TISCANO21outputTCELL81:OUT_F0
Q1S_TISCANO22outputTCELL81:OUT_F1
Q1S_TISCANO23outputTCELL81:OUT_F6
Q1S_TISCANO24outputTCELL82:OUT_Q3
Q1S_TISCANO25outputTCELL82:OUT_Q5
Q1S_TISCANO26outputTCELL82:OUT_Q6
Q1S_TISCANO27outputTCELL82:OUT_F5
Q1S_TISCANO28outputTCELL83:OUT_Q1
Q1S_TISCANO29outputTCELL83:OUT_Q6
Q1S_TISCANO3outputTCELL77:OUT_Q3
Q1S_TISCANO4outputTCELL77:OUT_F1
Q1S_TISCANO5outputTCELL67:OUT_Q2
Q1S_TISCANO6outputTCELL80:OUT_F2
Q1S_TISCANO7outputTCELL80:OUT_F6
Q1S_TISCANO8outputTCELL81:OUT_Q2
Q1S_TISCANO9outputTCELL57:OUT_Q6
Q1S_TISCANRSTNinputTCELL77:IMUX_LSR0
Q1S_TLNKD0inputTCELL83:IMUX_A4
Q1S_TLNKD1inputTCELL83:IMUX_C7
Q1S_TLNKD10inputTCELL83:IMUX_B2
Q1S_TLNKD11inputTCELL83:IMUX_A7
Q1S_TLNKD12inputTCELL83:IMUX_C5
Q1S_TLNKD13inputTCELL83:IMUX_D3
Q1S_TLNKD14inputTCELL82:IMUX_C6
Q1S_TLNKD15inputTCELL83:IMUX_D2
Q1S_TLNKD16inputTCELL83:IMUX_C6
Q1S_TLNKD17inputTCELL82:IMUX_A2
Q1S_TLNKD18inputTCELL83:IMUX_C3
Q1S_TLNKD19inputTCELL82:IMUX_B2
Q1S_TLNKD2inputTCELL83:IMUX_B7
Q1S_TLNKD20inputTCELL83:IMUX_C2
Q1S_TLNKD21inputTCELL82:IMUX_A6
Q1S_TLNKD22inputTCELL82:IMUX_C5
Q1S_TLNKD23inputTCELL82:IMUX_C3
Q1S_TLNKD24inputTCELL82:IMUX_C2
Q1S_TLNKD25inputTCELL82:IMUX_D7
Q1S_TLNKD26inputTCELL82:IMUX_B5
Q1S_TLNKD27inputTCELL82:IMUX_D6
Q1S_TLNKD28inputTCELL82:IMUX_C4
Q1S_TLNKD29inputTCELL82:IMUX_B7
Q1S_TLNKD3inputTCELL83:IMUX_A5
Q1S_TLNKD30inputTCELL82:IMUX_A5
Q1S_TLNKD31inputTCELL82:IMUX_B3
Q1S_TLNKD32inputTCELL82:IMUX_A4
Q1S_TLNKD33inputTCELL82:IMUX_B6
Q1S_TLNKD34inputTCELL82:IMUX_B4
Q1S_TLNKD35inputTCELL82:IMUX_D5
Q1S_TLNKD36inputTCELL82:IMUX_D4
Q1S_TLNKD37inputTCELL82:IMUX_D3
Q1S_TLNKD38inputTCELL82:IMUX_D2
Q1S_TLNKD39inputTCELL81:IMUX_A7
Q1S_TLNKD4inputTCELL83:IMUX_A6
Q1S_TLNKD40inputTCELL81:IMUX_A6
Q1S_TLNKD41inputTCELL81:IMUX_A5
Q1S_TLNKD42inputTCELL81:IMUX_A4
Q1S_TLNKD43inputTCELL81:IMUX_A3
Q1S_TLNKD44inputTCELL81:IMUX_A2
Q1S_TLNKD45inputTCELL81:IMUX_B7
Q1S_TLNKD46inputTCELL81:IMUX_B6
Q1S_TLNKD47inputTCELL81:IMUX_B5
Q1S_TLNKD48inputTCELL81:IMUX_B4
Q1S_TLNKD49inputTCELL81:IMUX_B3
Q1S_TLNKD5inputTCELL83:IMUX_D4
Q1S_TLNKD50inputTCELL81:IMUX_B2
Q1S_TLNKD51inputTCELL81:IMUX_C7
Q1S_TLNKD52inputTCELL81:IMUX_C6
Q1S_TLNKD53inputTCELL81:IMUX_C5
Q1S_TLNKD54inputTCELL81:IMUX_C4
Q1S_TLNKD55inputTCELL81:IMUX_C3
Q1S_TLNKD56inputTCELL81:IMUX_C2
Q1S_TLNKD57inputTCELL81:IMUX_D7
Q1S_TLNKD58inputTCELL81:IMUX_D6
Q1S_TLNKD59inputTCELL81:IMUX_D5
Q1S_TLNKD6inputTCELL82:IMUX_A3
Q1S_TLNKD60inputTCELL81:IMUX_D4
Q1S_TLNKD61inputTCELL81:IMUX_D3
Q1S_TLNKD62inputTCELL81:IMUX_D2
Q1S_TLNKD63inputTCELL80:IMUX_A7
Q1S_TLNKD7inputTCELL83:IMUX_B5
Q1S_TLNKD8inputTCELL83:IMUX_B4
Q1S_TLNKD9inputTCELL83:IMUX_B3
Q1S_TLNKDSTRDYNoutputTCELL92:OUT_F2
Q1S_TLNKEOFNinputTCELL83:IMUX_D5
Q1S_TLNKREM0inputTCELL83:IMUX_A3
Q1S_TLNKREM1inputTCELL83:IMUX_A2
Q1S_TLNKREM2inputTCELL82:IMUX_C7
Q1S_TLNKSOFNinputTCELL83:IMUX_D7
Q1S_TLNKSRCDSCNinputTCELL83:IMUX_C4
Q1S_TLNKSRCRDYNinputTCELL83:IMUX_B6
Q1S_TOMBISTDO0outputTCELL74:OUT_F3
Q1S_TOMBISTDO1outputTCELL68:OUT_F3
Q1S_TOMBISTDO10outputTCELL65:OUT_Q5
Q1S_TOMBISTDO11outputTCELL65:OUT_Q4
Q1S_TOMBISTDO12outputTCELL65:OUT_F2
Q1S_TOMBISTDO13outputTCELL65:OUT_F3
Q1S_TOMBISTDO14outputTCELL66:OUT_Q3
Q1S_TOMBISTDO15outputTCELL66:OUT_Q5
Q1S_TOMBISTDO16outputTCELL66:OUT_F5
Q1S_TOMBISTDO17outputTCELL67:OUT_Q0
Q1S_TOMBISTDO18outputTCELL67:OUT_Q1
Q1S_TOMBISTDO19outputTCELL67:OUT_Q5
Q1S_TOMBISTDO2outputTCELL67:OUT_Q6
Q1S_TOMBISTDO20outputTCELL67:OUT_Q4
Q1S_TOMBISTDO21outputTCELL67:OUT_F1
Q1S_TOMBISTDO22outputTCELL67:OUT_F0
Q1S_TOMBISTDO23outputTCELL67:OUT_F2
Q1S_TOMBISTDO24outputTCELL67:OUT_F5
Q1S_TOMBISTDO25outputTCELL68:OUT_Q4
Q1S_TOMBISTDO26outputTCELL72:OUT_F4
Q1S_TOMBISTDO27outputTCELL74:OUT_Q1
Q1S_TOMBISTDO28outputTCELL74:OUT_Q3
Q1S_TOMBISTDO29outputTCELL74:OUT_F0
Q1S_TOMBISTDO3outputTCELL66:OUT_F7
Q1S_TOMBISTDO30outputTCELL74:OUT_Q6
Q1S_TOMBISTDO31outputTCELL74:OUT_Q7
Q1S_TOMBISTDO32outputTCELL74:OUT_Q5
Q1S_TOMBISTDO33outputTCELL74:OUT_Q4
Q1S_TOMBISTDO34outputTCELL74:OUT_Q2
Q1S_TOMBISTDO35outputTCELL73:OUT_Q4
Q1S_TOMBISTDO4outputTCELL66:OUT_Q0
Q1S_TOMBISTDO5outputTCELL65:OUT_Q6
Q1S_TOMBISTDO6outputTCELL64:OUT_F3
Q1S_TOMBISTDO7outputTCELL64:OUT_Q1
Q1S_TOMBISTDO8outputTCELL63:OUT_F6
Q1S_TOMBISTDO9outputTCELL64:OUT_F4
Q1S_TPORTCHARISK0inputTCELL76:IMUX_C2
Q1S_TPORTCHARISK1inputTCELL75:IMUX_A2
Q1S_TPORTCHARISK2inputTCELL75:IMUX_A3
Q1S_TPORTCHARISK3inputTCELL76:IMUX_C5
Q1S_TPORTCHARISK4inputTCELL75:IMUX_B6
Q1S_TPORTCHARISK5inputTCELL76:IMUX_B2
Q1S_TPORTCHARISK6inputTCELL76:IMUX_C3
Q1S_TPORTCHARISK7inputTCELL76:IMUX_B3
Q1S_TPORTENABLENinputTCELL80:IMUX_C5
Q1S_TPORTTDI0inputTCELL73:IMUX_D4
Q1S_TPORTTDI1inputTCELL74:IMUX_B5
Q1S_TPORTTDI10inputTCELL72:IMUX_A4
Q1S_TPORTTDI11inputTCELL73:IMUX_D5
Q1S_TPORTTDI12inputTCELL72:IMUX_A5
Q1S_TPORTTDI13inputTCELL75:IMUX_C2
Q1S_TPORTTDI14inputTCELL75:IMUX_D2
Q1S_TPORTTDI15inputTCELL75:IMUX_B7
Q1S_TPORTTDI16inputTCELL73:IMUX_D6
Q1S_TPORTTDI17inputTCELL74:IMUX_B4
Q1S_TPORTTDI18inputTCELL72:IMUX_A2
Q1S_TPORTTDI19inputTCELL72:IMUX_B4
Q1S_TPORTTDI2inputTCELL72:IMUX_A6
Q1S_TPORTTDI20inputTCELL72:IMUX_B6
Q1S_TPORTTDI21inputTCELL74:IMUX_A3
Q1S_TPORTTDI22inputTCELL75:IMUX_C5
Q1S_TPORTTDI23inputTCELL74:IMUX_A7
Q1S_TPORTTDI24inputTCELL73:IMUX_B4
Q1S_TPORTTDI25inputTCELL74:IMUX_B6
Q1S_TPORTTDI26inputTCELL73:IMUX_A6
Q1S_TPORTTDI27inputTCELL73:IMUX_B7
Q1S_TPORTTDI28inputTCELL73:IMUX_C5
Q1S_TPORTTDI29inputTCELL74:IMUX_C4
Q1S_TPORTTDI3inputTCELL72:IMUX_A3
Q1S_TPORTTDI30inputTCELL74:IMUX_A4
Q1S_TPORTTDI31inputTCELL75:IMUX_B2
Q1S_TPORTTDI32inputTCELL75:IMUX_D6
Q1S_TPORTTDI33inputTCELL74:IMUX_A6
Q1S_TPORTTDI34inputTCELL74:IMUX_D6
Q1S_TPORTTDI35inputTCELL73:IMUX_B6
Q1S_TPORTTDI36inputTCELL73:IMUX_A5
Q1S_TPORTTDI37inputTCELL75:IMUX_D4
Q1S_TPORTTDI38inputTCELL75:IMUX_C6
Q1S_TPORTTDI39inputTCELL75:IMUX_C4
Q1S_TPORTTDI4inputTCELL72:IMUX_A7
Q1S_TPORTTDI40inputTCELL74:IMUX_D3
Q1S_TPORTTDI41inputTCELL75:IMUX_D5
Q1S_TPORTTDI42inputTCELL73:IMUX_A4
Q1S_TPORTTDI43inputTCELL73:IMUX_C6
Q1S_TPORTTDI44inputTCELL74:IMUX_D7
Q1S_TPORTTDI45inputTCELL74:IMUX_A2
Q1S_TPORTTDI46inputTCELL74:IMUX_B2
Q1S_TPORTTDI47inputTCELL74:IMUX_B3
Q1S_TPORTTDI48inputTCELL73:IMUX_D7
Q1S_TPORTTDI49inputTCELL73:IMUX_C7
Q1S_TPORTTDI5inputTCELL74:IMUX_A5
Q1S_TPORTTDI50inputTCELL72:IMUX_B5
Q1S_TPORTTDI51inputTCELL74:IMUX_D2
Q1S_TPORTTDI52inputTCELL73:IMUX_C4
Q1S_TPORTTDI53inputTCELL75:IMUX_B5
Q1S_TPORTTDI54inputTCELL74:IMUX_C5
Q1S_TPORTTDI55inputTCELL74:IMUX_C2
Q1S_TPORTTDI56inputTCELL74:IMUX_D4
Q1S_TPORTTDI57inputTCELL74:IMUX_C7
Q1S_TPORTTDI58inputTCELL73:IMUX_A7
Q1S_TPORTTDI59inputTCELL73:IMUX_B5
Q1S_TPORTTDI6inputTCELL75:IMUX_D3
Q1S_TPORTTDI60inputTCELL74:IMUX_C3
Q1S_TPORTTDI61inputTCELL74:IMUX_C6
Q1S_TPORTTDI62inputTCELL74:IMUX_B7
Q1S_TPORTTDI63inputTCELL75:IMUX_C3
Q1S_TPORTTDI7inputTCELL75:IMUX_D7
Q1S_TPORTTDI8inputTCELL74:IMUX_D5
Q1S_TPORTTDI9inputTCELL75:IMUX_C7
Q1S_TXENQUEUEFLOWN0outputTCELL81:OUT_Q6
Q1S_TXENQUEUEFLOWN1outputTCELL81:OUT_Q4
Q1S_TXENQUEUEFLOWN2outputTCELL81:OUT_Q0
Q1S_TXENQUEUEFLOWN3outputTCELL81:OUT_Q1
Q1S_TXFLOWCTRLSTATE0outputTCELL81:OUT_F7
Q1S_TXFLOWCTRLSTATE1outputTCELL82:OUT_Q1
Q1S_TXFLOWCTRLSTATE2outputTCELL83:OUT_Q0
Q1S_TXFLOWCTRLSTATE3outputTCELL82:OUT_F4
Q1S_TXFLOWCTRLSTATE4outputTCELL83:OUT_Q5
Q1S_TXINITNoutputTCELL82:OUT_F7
Q1S_TXLANESILENCECH0outputTCELL77:OUT_Q4
Q1S_TXLANESILENCECH1outputTCELL76:OUT_Q4
Q1S_TXLANESILENCECH2outputTCELL76:OUT_F4
Q1S_TXLANESILENCECH3outputTCELL76:OUT_Q5
Q1S_TXSYNCCTRL0inputTCELL80:IMUX_C2
Q1S_TXSYNCCTRL1inputTCELL80:IMUX_D7
Q1S_WM00inputTCELL80:IMUX_B4
Q1S_WM01inputTCELL80:IMUX_B5
Q1S_WM02inputTCELL80:IMUX_C7
Q1S_WM03inputTCELL80:IMUX_A3
Q1S_WM10inputTCELL80:IMUX_B3
Q1S_WM11inputTCELL80:IMUX_A2
Q1S_WM12inputTCELL80:IMUX_B6
Q1S_WM13inputTCELL80:IMUX_B2
Q1S_WM20inputTCELL80:IMUX_C6
Q1S_WM21inputTCELL80:IMUX_A5
Q1S_WM22inputTCELL80:IMUX_A4
Q1S_WM23inputTCELL80:IMUX_B7
Q1_FCDFECOEFF0_0inputTCELL108:IMUX_A7
Q1_FCDFECOEFF0_1inputTCELL109:IMUX_A0
Q1_FCDFECOEFF0_2inputTCELL109:IMUX_A1
Q1_FCDFECOEFF0_3inputTCELL109:IMUX_D4
Q1_FCDFECOEFF0_4inputTCELL109:IMUX_D5
Q1_FCDFECOEFF0_5inputTCELL109:IMUX_D6
Q1_FCDFECOEFF0_6inputTCELL109:IMUX_D7
Q1_FCDFECOEFF0_7inputTCELL110:IMUX_D0
Q1_FCDFECOEFF1_0inputTCELL108:IMUX_B5
Q1_FCDFECOEFF1_1inputTCELL108:IMUX_B6
Q1_FCDFECOEFF1_2inputTCELL108:IMUX_B7
Q1_FCDFECOEFF1_3inputTCELL109:IMUX_B0
Q1_FCDFECOEFF1_4inputTCELL109:IMUX_B1
Q1_FCDFECOEFF1_5inputTCELL108:IMUX_A4
Q1_FCDFECOEFF1_6inputTCELL108:IMUX_A5
Q1_FCDFECOEFF1_7inputTCELL108:IMUX_A6
Q1_FCDFECOEFF2_0inputTCELL109:IMUX_D1
Q1_FCDFECOEFF2_1inputTCELL108:IMUX_C4
Q1_FCDFECOEFF2_2inputTCELL108:IMUX_C5
Q1_FCDFECOEFF2_3inputTCELL108:IMUX_C6
Q1_FCDFECOEFF2_4inputTCELL108:IMUX_C7
Q1_FCDFECOEFF2_5inputTCELL109:IMUX_C0
Q1_FCDFECOEFF2_6inputTCELL109:IMUX_C1
Q1_FCDFECOEFF2_7inputTCELL108:IMUX_B4
Q1_FCDFECOEFF3_0inputTCELL107:IMUX_A7
Q1_FCDFECOEFF3_1inputTCELL108:IMUX_A0
Q1_FCDFECOEFF3_2inputTCELL108:IMUX_A1
Q1_FCDFECOEFF3_3inputTCELL108:IMUX_D4
Q1_FCDFECOEFF3_4inputTCELL108:IMUX_D5
Q1_FCDFECOEFF3_5inputTCELL108:IMUX_D6
Q1_FCDFECOEFF3_6inputTCELL108:IMUX_D7
Q1_FCDFECOEFF3_7inputTCELL109:IMUX_D0
Q1_FCDFECOEFF4_0inputTCELL107:IMUX_B5
Q1_FCDFECOEFF4_1inputTCELL107:IMUX_B6
Q1_FCDFECOEFF4_2inputTCELL107:IMUX_B7
Q1_FCDFECOEFF4_3inputTCELL108:IMUX_B0
Q1_FCDFECOEFF4_4inputTCELL108:IMUX_B1
Q1_FCDFECOEFF4_5inputTCELL107:IMUX_A4
Q1_FCDFECOEFF4_6inputTCELL107:IMUX_A5
Q1_FCDFECOEFF4_7inputTCELL107:IMUX_A6
Q1_FCDFECOEFF5_0inputTCELL108:IMUX_D1
Q1_FCDFECOEFF5_1inputTCELL107:IMUX_C4
Q1_FCDFECOEFF5_2inputTCELL107:IMUX_C5
Q1_FCDFECOEFF5_3inputTCELL107:IMUX_C6
Q1_FCDFECOEFF5_4inputTCELL107:IMUX_C7
Q1_FCDFECOEFF5_5inputTCELL108:IMUX_C0
Q1_FCDFECOEFF5_6inputTCELL108:IMUX_C1
Q1_FCDFECOEFF5_7inputTCELL107:IMUX_B4
Q1_FCDFESIGN1inputTCELL107:IMUX_D4
Q1_FCDFESIGN2inputTCELL107:IMUX_D5
Q1_FCDFESIGN3inputTCELL107:IMUX_D6
Q1_FCDFESIGN4inputTCELL107:IMUX_D7
Q1_FCDFESIGN5inputTCELL108:IMUX_D0
Q1_FCMPWRUPinputTCELL110:IMUX_A0
Q1_FCMRSTinputTCELL110:IMUX_C7
Q1_FCSCANMODEinputTCELL109:IMUX_C5
Q1_FDDFECHSEL0inputTCELL110:IMUX_D1
Q1_FDDFECHSEL1inputTCELL109:IMUX_C4
Q1_FDDFEDATA0outputTCELL106:OUT_F1
Q1_FDDFEDATA1outputTCELL106:OUT_Q2
Q1_FDDFEDATA2outputTCELL106:OUT_Q3
Q1_FDDFEDATA3outputTCELL106:OUT_Q4
Q1_FDDFEDATA4outputTCELL106:OUT_Q5
Q1_FDDFEDATA5outputTCELL106:OUT_Q6
Q1_FDDFEDATA6outputTCELL106:OUT_Q7
Q1_FDDFEDATA7outputTCELL107:OUT_Q0
Q1_FDDFEDATA8outputTCELL107:OUT_Q1
Q1_FDDFEDATA9outputTCELL106:OUT_F2
Q1_FDDFEERR0outputTCELL105:OUT_Q7
Q1_FDDFEERR1outputTCELL106:OUT_Q0
Q1_FDDFEERR2outputTCELL106:OUT_Q1
Q1_FDDFEERR3outputTCELL105:OUT_F2
Q1_FDDFEERR4outputTCELL105:OUT_F3
Q1_FDDFEERR5outputTCELL105:OUT_F4
Q1_FDDFEERR6outputTCELL105:OUT_F5
Q1_FDDFEERR7outputTCELL105:OUT_F6
Q1_FDDFEERR8outputTCELL105:OUT_F7
Q1_FDDFEERR9outputTCELL106:OUT_F0
Q1_FIGRPFBRRCLK0inputTCELL96:IMUX_CLK1_DELAY
Q1_FIGRPFBRRCLK1inputTCELL96:IMUX_CLK0_DELAY
Q1_FIGRPFBTWCLK0inputTCELL95:IMUX_CLK1_DELAY
Q1_FIGRPFBTWCLK1inputTCELL95:IMUX_CLK0_DELAY
Q1_FIRXTESTCLKinputTCELL94:IMUX_CLK1_DELAY
Q1_FISYNCCLKinputTCELL94:IMUX_CLK0_DELAY
Q1_FITMRCLKinputTCELL109:IMUX_CLK1_DELAY
Q1_FITXTESTCLKinputTCELL93:IMUX_CLK1_DELAY
Q1_FOREFCLK2FPGAoutputTCELL106:OUT_F7
Q1_HSPLLLOLoutputTCELL108:OUT_F1
Q1_HSPLLPWRUPinputTCELL109:IMUX_A7
Q1_HSPLLREFCLKIinputTCELL103:IMUX_CLK1_DELAY
Q1_HSPLLRSTinputTCELL109:IMUX_LSR0
Q1_LSPLLLOLoutputTCELL108:OUT_F0
Q1_LSPLLPWRUPinputTCELL109:IMUX_A6
Q1_LSPLLREFCLKIinputTCELL103:IMUX_CLK0_DELAY
Q1_LSPLLRSTinputTCELL109:IMUX_LSR1
Q2CH0_FCALIGNENinputTCELL116:IMUX_B2
Q2CH0_FCCDRFORCEDLOCKinputTCELL132:IMUX_A0
Q2CH0_FCDFERDENinputTCELL122:IMUX_CE3
Q2CH0_FCDFEUPDinputTCELL123:IMUX_CE3
Q2CH0_FCLDRTXENinputTCELL116:IMUX_A2
Q2CH0_FCLSMENinputTCELL131:IMUX_D2
Q2CH0_FCPCIEDETENinputTCELL131:IMUX_B2
Q2CH0_FCPCSRXRSTinputTCELL128:IMUX_LSR0
Q2CH0_FCPCSTXRSTinputTCELL125:IMUX_LSR0
Q2CH0_FCPIPEPHYRESETNinputTCELL122:IMUX_LSR0
Q2CH0_FCPLLLOLinputTCELL132:IMUX_A4
Q2CH0_FCRATE0inputTCELL117:IMUX_B0
Q2CH0_FCRATE1inputTCELL117:IMUX_A5
Q2CH0_FCRATE2inputTCELL117:IMUX_A4
Q2CH0_FCRRSTinputTCELL130:IMUX_LSR0
Q2CH0_FCRXPOLARITYinputTCELL131:IMUX_C0
Q2CH0_FCRXPWRUPinputTCELL116:IMUX_D3
Q2CH0_FCTMRSTARTinputTCELL120:IMUX_A0
Q2CH0_FCTMRSTOPinputTCELL120:IMUX_A4
Q2CH0_FCTRSTinputTCELL132:IMUX_LSR0
Q2CH0_FCTXMARGIN0inputTCELL132:IMUX_C2
Q2CH0_FCTXMARGIN1inputTCELL132:IMUX_C1
Q2CH0_FCTXMARGIN2inputTCELL132:IMUX_C0
Q2CH0_FCTXPWRUPinputTCELL116:IMUX_C3
Q2CH0_FCWORDALGNENinputTCELL131:IMUX_C4
Q2CH0_FDLDRRXoutputTCELL119:OUT_F2
Q2CH0_FDLDRTXinputTCELL132:IMUX_B2
Q2CH0_FDRX0outputTCELL133:OUT_Q7
Q2CH0_FDRX1outputTCELL133:OUT_Q6
Q2CH0_FDRX10outputTCELL133:OUT_F5
Q2CH0_FDRX11outputTCELL133:OUT_F4
Q2CH0_FDRX12outputTCELL133:OUT_F3
Q2CH0_FDRX13outputTCELL133:OUT_F2
Q2CH0_FDRX14outputTCELL133:OUT_F1
Q2CH0_FDRX15outputTCELL133:OUT_F0
Q2CH0_FDRX16outputTCELL132:OUT_Q7
Q2CH0_FDRX17outputTCELL132:OUT_Q6
Q2CH0_FDRX18outputTCELL132:OUT_Q5
Q2CH0_FDRX19outputTCELL132:OUT_Q4
Q2CH0_FDRX2outputTCELL133:OUT_Q5
Q2CH0_FDRX20outputTCELL132:OUT_Q3
Q2CH0_FDRX21outputTCELL132:OUT_Q2
Q2CH0_FDRX22outputTCELL132:OUT_Q1
Q2CH0_FDRX23outputTCELL132:OUT_Q0
Q2CH0_FDRX24outputTCELL132:OUT_F7
Q2CH0_FDRX25outputTCELL132:OUT_F6
Q2CH0_FDRX26outputTCELL132:OUT_F5
Q2CH0_FDRX27outputTCELL132:OUT_F4
Q2CH0_FDRX28outputTCELL132:OUT_F3
Q2CH0_FDRX29outputTCELL132:OUT_F2
Q2CH0_FDRX3outputTCELL133:OUT_Q4
Q2CH0_FDRX30outputTCELL132:OUT_F1
Q2CH0_FDRX31outputTCELL132:OUT_F0
Q2CH0_FDRX32outputTCELL131:OUT_Q7
Q2CH0_FDRX33outputTCELL131:OUT_Q6
Q2CH0_FDRX34outputTCELL131:OUT_Q5
Q2CH0_FDRX35outputTCELL131:OUT_Q4
Q2CH0_FDRX36outputTCELL131:OUT_Q3
Q2CH0_FDRX37outputTCELL131:OUT_Q2
Q2CH0_FDRX38outputTCELL131:OUT_Q1
Q2CH0_FDRX39outputTCELL131:OUT_Q0
Q2CH0_FDRX4outputTCELL133:OUT_Q3
Q2CH0_FDRX40outputTCELL131:OUT_F7
Q2CH0_FDRX41outputTCELL131:OUT_F6
Q2CH0_FDRX42outputTCELL131:OUT_F5
Q2CH0_FDRX43outputTCELL131:OUT_F4
Q2CH0_FDRX44outputTCELL131:OUT_F3
Q2CH0_FDRX45outputTCELL131:OUT_F2
Q2CH0_FDRX46outputTCELL131:OUT_F1
Q2CH0_FDRX47outputTCELL131:OUT_F0
Q2CH0_FDRX5outputTCELL133:OUT_Q2
Q2CH0_FDRX6outputTCELL133:OUT_Q1
Q2CH0_FDRX7outputTCELL133:OUT_Q0
Q2CH0_FDRX8outputTCELL133:OUT_F7
Q2CH0_FDRX9outputTCELL133:OUT_F6
Q2CH0_FDTX0inputTCELL131:IMUX_B1
Q2CH0_FDTX1inputTCELL131:IMUX_B0
Q2CH0_FDTX10inputTCELL130:IMUX_D3
Q2CH0_FDTX11inputTCELL130:IMUX_D2
Q2CH0_FDTX12inputTCELL130:IMUX_D1
Q2CH0_FDTX13inputTCELL130:IMUX_D0
Q2CH0_FDTX14inputTCELL130:IMUX_C5
Q2CH0_FDTX15inputTCELL130:IMUX_C4
Q2CH0_FDTX16inputTCELL130:IMUX_C3
Q2CH0_FDTX17inputTCELL130:IMUX_C2
Q2CH0_FDTX18inputTCELL130:IMUX_C1
Q2CH0_FDTX19inputTCELL130:IMUX_C0
Q2CH0_FDTX2inputTCELL131:IMUX_A5
Q2CH0_FDTX20inputTCELL130:IMUX_B5
Q2CH0_FDTX21inputTCELL130:IMUX_B4
Q2CH0_FDTX22inputTCELL130:IMUX_B3
Q2CH0_FDTX23inputTCELL130:IMUX_B2
Q2CH0_FDTX24inputTCELL130:IMUX_B1
Q2CH0_FDTX25inputTCELL130:IMUX_B0
Q2CH0_FDTX26inputTCELL130:IMUX_A5
Q2CH0_FDTX27inputTCELL130:IMUX_A4
Q2CH0_FDTX28inputTCELL130:IMUX_A3
Q2CH0_FDTX29inputTCELL130:IMUX_A2
Q2CH0_FDTX3inputTCELL131:IMUX_A4
Q2CH0_FDTX30inputTCELL130:IMUX_A1
Q2CH0_FDTX31inputTCELL130:IMUX_A0
Q2CH0_FDTX32inputTCELL129:IMUX_D5
Q2CH0_FDTX33inputTCELL129:IMUX_D4
Q2CH0_FDTX34inputTCELL129:IMUX_D3
Q2CH0_FDTX35inputTCELL129:IMUX_D2
Q2CH0_FDTX36inputTCELL129:IMUX_D1
Q2CH0_FDTX37inputTCELL129:IMUX_D0
Q2CH0_FDTX38inputTCELL129:IMUX_C5
Q2CH0_FDTX39inputTCELL129:IMUX_C4
Q2CH0_FDTX4inputTCELL131:IMUX_A3
Q2CH0_FDTX40inputTCELL129:IMUX_C3
Q2CH0_FDTX41inputTCELL129:IMUX_C2
Q2CH0_FDTX42inputTCELL129:IMUX_C1
Q2CH0_FDTX43inputTCELL129:IMUX_C0
Q2CH0_FDTX44inputTCELL129:IMUX_B5
Q2CH0_FDTX45inputTCELL129:IMUX_B4
Q2CH0_FDTX46inputTCELL129:IMUX_B3
Q2CH0_FDTX47inputTCELL129:IMUX_B2
Q2CH0_FDTX48inputTCELL129:IMUX_B1
Q2CH0_FDTX49inputTCELL129:IMUX_B0
Q2CH0_FDTX5inputTCELL131:IMUX_A2
Q2CH0_FDTX6inputTCELL131:IMUX_A1
Q2CH0_FDTX7inputTCELL131:IMUX_A0
Q2CH0_FDTX8inputTCELL130:IMUX_D5
Q2CH0_FDTX9inputTCELL130:IMUX_D4
Q2CH0_FIRCLKinputTCELL126:IMUX_CLK1_DELAY
Q2CH0_FIREFRXCLKinputTCELL124:IMUX_CLK1_DELAY
Q2CH0_FITCLKinputTCELL128:IMUX_CLK0_DELAY
Q2CH0_FITMRSTARTCLKinputTCELL117:IMUX_CLK1_DELAY
Q2CH0_FITMRSTOPCLKinputTCELL119:IMUX_CLK1_DELAY
Q2CH0_FSCCOVERRUNoutputTCELL118:OUT_Q0
Q2CH0_FSCCUNDERRUNoutputTCELL118:OUT_F4
Q2CH0_FSDFEVLDoutputTCELL121:OUT_Q3
Q2CH0_FSLSMoutputTCELL118:OUT_F0
Q2CH0_FSPCIECONoutputTCELL117:OUT_Q0
Q2CH0_FSPCIEDONEoutputTCELL117:OUT_F4
Q2CH0_FSRCDONEoutputTCELL120:OUT_F3
Q2CH0_FSRLOLoutputTCELL118:OUT_Q4
Q2CH0_FSRLOSoutputTCELL117:OUT_Q4
Q2CH0_FSSKPADDEDoutputTCELL119:OUT_F6
Q2CH0_FSSKPDELETEDoutputTCELL119:OUT_Q2
Q2CH1_FCALIGNENinputTCELL116:IMUX_B3
Q2CH1_FCCDRFORCEDLOCKinputTCELL132:IMUX_A1
Q2CH1_FCDFERDENinputTCELL123:IMUX_CE0
Q2CH1_FCDFEUPDinputTCELL124:IMUX_CE0
Q2CH1_FCLDRTXENinputTCELL116:IMUX_A3
Q2CH1_FCLSMENinputTCELL131:IMUX_D3
Q2CH1_FCPCIEDETENinputTCELL131:IMUX_B3
Q2CH1_FCPCSRXRSTinputTCELL128:IMUX_LSR1
Q2CH1_FCPCSTXRSTinputTCELL125:IMUX_LSR1
Q2CH1_FCPIPEPHYRESETNinputTCELL122:IMUX_LSR1
Q2CH1_FCPLLLOLinputTCELL132:IMUX_A5
Q2CH1_FCRATE0inputTCELL117:IMUX_B3
Q2CH1_FCRATE1inputTCELL117:IMUX_B2
Q2CH1_FCRATE2inputTCELL117:IMUX_B1
Q2CH1_FCRRSTinputTCELL130:IMUX_LSR1
Q2CH1_FCRXPOLARITYinputTCELL131:IMUX_C1
Q2CH1_FCRXPWRUPinputTCELL116:IMUX_D4
Q2CH1_FCTMRSTARTinputTCELL120:IMUX_A1
Q2CH1_FCTMRSTOPinputTCELL120:IMUX_A5
Q2CH1_FCTRSTinputTCELL132:IMUX_LSR1
Q2CH1_FCTXMARGIN0inputTCELL132:IMUX_C5
Q2CH1_FCTXMARGIN1inputTCELL132:IMUX_C4
Q2CH1_FCTXMARGIN2inputTCELL132:IMUX_C3
Q2CH1_FCTXPWRUPinputTCELL116:IMUX_C4
Q2CH1_FCWORDALGNENinputTCELL131:IMUX_C5
Q2CH1_FDLDRRXoutputTCELL119:OUT_F3
Q2CH1_FDLDRTXinputTCELL132:IMUX_B3
Q2CH1_FDRX0outputTCELL130:OUT_Q7
Q2CH1_FDRX1outputTCELL130:OUT_Q6
Q2CH1_FDRX10outputTCELL130:OUT_F5
Q2CH1_FDRX11outputTCELL130:OUT_F4
Q2CH1_FDRX12outputTCELL130:OUT_F3
Q2CH1_FDRX13outputTCELL130:OUT_F2
Q2CH1_FDRX14outputTCELL130:OUT_F1
Q2CH1_FDRX15outputTCELL130:OUT_F0
Q2CH1_FDRX16outputTCELL129:OUT_Q7
Q2CH1_FDRX17outputTCELL129:OUT_Q6
Q2CH1_FDRX18outputTCELL129:OUT_Q5
Q2CH1_FDRX19outputTCELL129:OUT_Q4
Q2CH1_FDRX2outputTCELL130:OUT_Q5
Q2CH1_FDRX20outputTCELL129:OUT_Q3
Q2CH1_FDRX21outputTCELL129:OUT_Q2
Q2CH1_FDRX22outputTCELL129:OUT_Q1
Q2CH1_FDRX23outputTCELL129:OUT_Q0
Q2CH1_FDRX24outputTCELL129:OUT_F7
Q2CH1_FDRX25outputTCELL129:OUT_F6
Q2CH1_FDRX26outputTCELL129:OUT_F5
Q2CH1_FDRX27outputTCELL129:OUT_F4
Q2CH1_FDRX28outputTCELL129:OUT_F3
Q2CH1_FDRX29outputTCELL129:OUT_F2
Q2CH1_FDRX3outputTCELL130:OUT_Q4
Q2CH1_FDRX30outputTCELL129:OUT_F1
Q2CH1_FDRX31outputTCELL129:OUT_F0
Q2CH1_FDRX32outputTCELL128:OUT_Q7
Q2CH1_FDRX33outputTCELL128:OUT_Q6
Q2CH1_FDRX34outputTCELL128:OUT_Q5
Q2CH1_FDRX35outputTCELL128:OUT_Q4
Q2CH1_FDRX36outputTCELL128:OUT_Q3
Q2CH1_FDRX37outputTCELL128:OUT_Q2
Q2CH1_FDRX38outputTCELL128:OUT_Q1
Q2CH1_FDRX39outputTCELL128:OUT_Q0
Q2CH1_FDRX4outputTCELL130:OUT_Q3
Q2CH1_FDRX40outputTCELL128:OUT_F7
Q2CH1_FDRX41outputTCELL128:OUT_F6
Q2CH1_FDRX42outputTCELL128:OUT_F5
Q2CH1_FDRX43outputTCELL128:OUT_F4
Q2CH1_FDRX44outputTCELL128:OUT_F3
Q2CH1_FDRX45outputTCELL128:OUT_F2
Q2CH1_FDRX46outputTCELL128:OUT_F1
Q2CH1_FDRX47outputTCELL128:OUT_F0
Q2CH1_FDRX5outputTCELL130:OUT_Q2
Q2CH1_FDRX6outputTCELL130:OUT_Q1
Q2CH1_FDRX7outputTCELL130:OUT_Q0
Q2CH1_FDRX8outputTCELL130:OUT_F7
Q2CH1_FDRX9outputTCELL130:OUT_F6
Q2CH1_FDTX0inputTCELL129:IMUX_A5
Q2CH1_FDTX1inputTCELL129:IMUX_A4
Q2CH1_FDTX10inputTCELL128:IMUX_D1
Q2CH1_FDTX11inputTCELL128:IMUX_D0
Q2CH1_FDTX12inputTCELL128:IMUX_C5
Q2CH1_FDTX13inputTCELL128:IMUX_C4
Q2CH1_FDTX14inputTCELL128:IMUX_C3
Q2CH1_FDTX15inputTCELL128:IMUX_C2
Q2CH1_FDTX16inputTCELL128:IMUX_C1
Q2CH1_FDTX17inputTCELL128:IMUX_C0
Q2CH1_FDTX18inputTCELL128:IMUX_B5
Q2CH1_FDTX19inputTCELL128:IMUX_B4
Q2CH1_FDTX2inputTCELL129:IMUX_A3
Q2CH1_FDTX20inputTCELL128:IMUX_B3
Q2CH1_FDTX21inputTCELL128:IMUX_B2
Q2CH1_FDTX22inputTCELL128:IMUX_B1
Q2CH1_FDTX23inputTCELL128:IMUX_B0
Q2CH1_FDTX24inputTCELL128:IMUX_A5
Q2CH1_FDTX25inputTCELL128:IMUX_A4
Q2CH1_FDTX26inputTCELL128:IMUX_A3
Q2CH1_FDTX27inputTCELL128:IMUX_A2
Q2CH1_FDTX28inputTCELL128:IMUX_A1
Q2CH1_FDTX29inputTCELL128:IMUX_A0
Q2CH1_FDTX3inputTCELL129:IMUX_A2
Q2CH1_FDTX30inputTCELL127:IMUX_D3
Q2CH1_FDTX31inputTCELL127:IMUX_D2
Q2CH1_FDTX32inputTCELL127:IMUX_D1
Q2CH1_FDTX33inputTCELL127:IMUX_D0
Q2CH1_FDTX34inputTCELL126:IMUX_D7
Q2CH1_FDTX35inputTCELL126:IMUX_D6
Q2CH1_FDTX36inputTCELL127:IMUX_C3
Q2CH1_FDTX37inputTCELL127:IMUX_C2
Q2CH1_FDTX38inputTCELL127:IMUX_C1
Q2CH1_FDTX39inputTCELL127:IMUX_C0
Q2CH1_FDTX4inputTCELL129:IMUX_A1
Q2CH1_FDTX40inputTCELL126:IMUX_C7
Q2CH1_FDTX41inputTCELL126:IMUX_C6
Q2CH1_FDTX42inputTCELL127:IMUX_B3
Q2CH1_FDTX43inputTCELL127:IMUX_B2
Q2CH1_FDTX44inputTCELL127:IMUX_B1
Q2CH1_FDTX45inputTCELL127:IMUX_B0
Q2CH1_FDTX46inputTCELL126:IMUX_B7
Q2CH1_FDTX47inputTCELL126:IMUX_B6
Q2CH1_FDTX48inputTCELL127:IMUX_A3
Q2CH1_FDTX49inputTCELL127:IMUX_A2
Q2CH1_FDTX5inputTCELL129:IMUX_A0
Q2CH1_FDTX6inputTCELL128:IMUX_D5
Q2CH1_FDTX7inputTCELL128:IMUX_D4
Q2CH1_FDTX8inputTCELL128:IMUX_D3
Q2CH1_FDTX9inputTCELL128:IMUX_D2
Q2CH1_FIRCLKinputTCELL126:IMUX_CLK0_DELAY
Q2CH1_FIREFRXCLKinputTCELL124:IMUX_CLK0_DELAY
Q2CH1_FITCLKinputTCELL128:IMUX_CLK1_DELAY
Q2CH1_FITMRSTARTCLKinputTCELL118:IMUX_CLK0_DELAY
Q2CH1_FITMRSTOPCLKinputTCELL120:IMUX_CLK0_DELAY
Q2CH1_FSCCOVERRUNoutputTCELL118:OUT_Q1
Q2CH1_FSCCUNDERRUNoutputTCELL118:OUT_F5
Q2CH1_FSDFEVLDoutputTCELL121:OUT_Q4
Q2CH1_FSLSMoutputTCELL118:OUT_F1
Q2CH1_FSPCIECONoutputTCELL117:OUT_Q1
Q2CH1_FSPCIEDONEoutputTCELL117:OUT_F5
Q2CH1_FSRCDONEoutputTCELL120:OUT_F4
Q2CH1_FSRLOLoutputTCELL118:OUT_Q5
Q2CH1_FSRLOSoutputTCELL117:OUT_Q5
Q2CH1_FSSKPADDEDoutputTCELL119:OUT_F7
Q2CH1_FSSKPDELETEDoutputTCELL119:OUT_Q3
Q2CH2_FCALIGNENinputTCELL116:IMUX_B4
Q2CH2_FCCDRFORCEDLOCKinputTCELL132:IMUX_A2
Q2CH2_FCDFERDENinputTCELL123:IMUX_CE1
Q2CH2_FCDFEUPDinputTCELL124:IMUX_CE1
Q2CH2_FCLDRTXENinputTCELL116:IMUX_A4
Q2CH2_FCLSMENinputTCELL131:IMUX_D4
Q2CH2_FCPCIEDETENinputTCELL131:IMUX_B4
Q2CH2_FCPCSRXRSTinputTCELL129:IMUX_LSR0
Q2CH2_FCPCSTXRSTinputTCELL126:IMUX_LSR0
Q2CH2_FCPIPEPHYRESETNinputTCELL123:IMUX_LSR0
Q2CH2_FCPLLLOLinputTCELL132:IMUX_B0
Q2CH2_FCRATE0inputTCELL117:IMUX_C0
Q2CH2_FCRATE1inputTCELL117:IMUX_B5
Q2CH2_FCRATE2inputTCELL117:IMUX_B4
Q2CH2_FCRRSTinputTCELL131:IMUX_LSR0
Q2CH2_FCRXPOLARITYinputTCELL131:IMUX_C2
Q2CH2_FCRXPWRUPinputTCELL116:IMUX_D5
Q2CH2_FCTMRSTARTinputTCELL120:IMUX_A2
Q2CH2_FCTMRSTOPinputTCELL120:IMUX_B0
Q2CH2_FCTRSTinputTCELL117:IMUX_LSR0
Q2CH2_FCTXMARGIN0inputTCELL132:IMUX_D2
Q2CH2_FCTXMARGIN1inputTCELL132:IMUX_D1
Q2CH2_FCTXMARGIN2inputTCELL132:IMUX_D0
Q2CH2_FCTXPWRUPinputTCELL116:IMUX_C5
Q2CH2_FCWORDALGNENinputTCELL131:IMUX_D0
Q2CH2_FDLDRRXoutputTCELL119:OUT_F4
Q2CH2_FDLDRTXinputTCELL132:IMUX_B4
Q2CH2_FDRX0outputTCELL127:OUT_Q5
Q2CH2_FDRX1outputTCELL127:OUT_Q4
Q2CH2_FDRX10outputTCELL127:OUT_F3
Q2CH2_FDRX11outputTCELL127:OUT_F2
Q2CH2_FDRX12outputTCELL127:OUT_F1
Q2CH2_FDRX13outputTCELL127:OUT_F0
Q2CH2_FDRX14outputTCELL126:OUT_F7
Q2CH2_FDRX15outputTCELL126:OUT_F6
Q2CH2_FDRX16outputTCELL126:OUT_Q5
Q2CH2_FDRX17outputTCELL126:OUT_Q4
Q2CH2_FDRX18outputTCELL126:OUT_Q3
Q2CH2_FDRX19outputTCELL126:OUT_Q2
Q2CH2_FDRX2outputTCELL127:OUT_Q3
Q2CH2_FDRX20outputTCELL126:OUT_Q1
Q2CH2_FDRX21outputTCELL126:OUT_Q0
Q2CH2_FDRX22outputTCELL125:OUT_Q7
Q2CH2_FDRX23outputTCELL125:OUT_Q6
Q2CH2_FDRX24outputTCELL126:OUT_F5
Q2CH2_FDRX25outputTCELL126:OUT_F4
Q2CH2_FDRX26outputTCELL126:OUT_F3
Q2CH2_FDRX27outputTCELL126:OUT_F2
Q2CH2_FDRX28outputTCELL126:OUT_F1
Q2CH2_FDRX29outputTCELL126:OUT_F0
Q2CH2_FDRX3outputTCELL127:OUT_Q2
Q2CH2_FDRX30outputTCELL125:OUT_F7
Q2CH2_FDRX31outputTCELL125:OUT_F6
Q2CH2_FDRX32outputTCELL125:OUT_Q5
Q2CH2_FDRX33outputTCELL125:OUT_Q4
Q2CH2_FDRX34outputTCELL125:OUT_Q3
Q2CH2_FDRX35outputTCELL125:OUT_Q2
Q2CH2_FDRX36outputTCELL125:OUT_Q1
Q2CH2_FDRX37outputTCELL125:OUT_Q0
Q2CH2_FDRX38outputTCELL124:OUT_Q7
Q2CH2_FDRX39outputTCELL124:OUT_Q6
Q2CH2_FDRX4outputTCELL127:OUT_Q1
Q2CH2_FDRX40outputTCELL125:OUT_F5
Q2CH2_FDRX41outputTCELL125:OUT_F4
Q2CH2_FDRX42outputTCELL125:OUT_F3
Q2CH2_FDRX43outputTCELL125:OUT_F2
Q2CH2_FDRX44outputTCELL125:OUT_F1
Q2CH2_FDRX45outputTCELL125:OUT_F0
Q2CH2_FDRX46outputTCELL124:OUT_F7
Q2CH2_FDRX47outputTCELL124:OUT_F6
Q2CH2_FDRX5outputTCELL127:OUT_Q0
Q2CH2_FDRX6outputTCELL126:OUT_Q7
Q2CH2_FDRX7outputTCELL126:OUT_Q6
Q2CH2_FDRX8outputTCELL127:OUT_F5
Q2CH2_FDRX9outputTCELL127:OUT_F4
Q2CH2_FDTX0inputTCELL127:IMUX_A1
Q2CH2_FDTX1inputTCELL127:IMUX_A0
Q2CH2_FDTX10inputTCELL126:IMUX_C3
Q2CH2_FDTX11inputTCELL126:IMUX_C2
Q2CH2_FDTX12inputTCELL126:IMUX_C1
Q2CH2_FDTX13inputTCELL126:IMUX_C0
Q2CH2_FDTX14inputTCELL125:IMUX_C7
Q2CH2_FDTX15inputTCELL125:IMUX_C6
Q2CH2_FDTX16inputTCELL126:IMUX_B3
Q2CH2_FDTX17inputTCELL126:IMUX_B2
Q2CH2_FDTX18inputTCELL126:IMUX_B1
Q2CH2_FDTX19inputTCELL126:IMUX_B0
Q2CH2_FDTX2inputTCELL126:IMUX_A7
Q2CH2_FDTX20inputTCELL125:IMUX_B7
Q2CH2_FDTX21inputTCELL125:IMUX_B6
Q2CH2_FDTX22inputTCELL126:IMUX_A3
Q2CH2_FDTX23inputTCELL126:IMUX_A2
Q2CH2_FDTX24inputTCELL126:IMUX_A1
Q2CH2_FDTX25inputTCELL126:IMUX_A0
Q2CH2_FDTX26inputTCELL125:IMUX_A7
Q2CH2_FDTX27inputTCELL125:IMUX_A6
Q2CH2_FDTX28inputTCELL125:IMUX_D3
Q2CH2_FDTX29inputTCELL125:IMUX_D2
Q2CH2_FDTX3inputTCELL126:IMUX_A6
Q2CH2_FDTX30inputTCELL125:IMUX_D1
Q2CH2_FDTX31inputTCELL125:IMUX_D0
Q2CH2_FDTX32inputTCELL124:IMUX_D7
Q2CH2_FDTX33inputTCELL124:IMUX_D6
Q2CH2_FDTX34inputTCELL125:IMUX_C3
Q2CH2_FDTX35inputTCELL125:IMUX_C2
Q2CH2_FDTX36inputTCELL125:IMUX_C1
Q2CH2_FDTX37inputTCELL125:IMUX_C0
Q2CH2_FDTX38inputTCELL124:IMUX_C7
Q2CH2_FDTX39inputTCELL124:IMUX_C6
Q2CH2_FDTX4inputTCELL126:IMUX_D3
Q2CH2_FDTX40inputTCELL125:IMUX_B3
Q2CH2_FDTX41inputTCELL125:IMUX_B2
Q2CH2_FDTX42inputTCELL125:IMUX_B1
Q2CH2_FDTX43inputTCELL125:IMUX_B0
Q2CH2_FDTX44inputTCELL124:IMUX_B7
Q2CH2_FDTX45inputTCELL124:IMUX_B6
Q2CH2_FDTX46inputTCELL125:IMUX_A3
Q2CH2_FDTX47inputTCELL125:IMUX_A2
Q2CH2_FDTX48inputTCELL125:IMUX_A1
Q2CH2_FDTX49inputTCELL125:IMUX_A0
Q2CH2_FDTX5inputTCELL126:IMUX_D2
Q2CH2_FDTX6inputTCELL126:IMUX_D1
Q2CH2_FDTX7inputTCELL126:IMUX_D0
Q2CH2_FDTX8inputTCELL125:IMUX_D7
Q2CH2_FDTX9inputTCELL125:IMUX_D6
Q2CH2_FIRCLKinputTCELL127:IMUX_CLK1_DELAY
Q2CH2_FIREFRXCLKinputTCELL125:IMUX_CLK1_DELAY
Q2CH2_FITCLKinputTCELL129:IMUX_CLK0_DELAY
Q2CH2_FITMRSTARTCLKinputTCELL118:IMUX_CLK1_DELAY
Q2CH2_FITMRSTOPCLKinputTCELL120:IMUX_CLK1_DELAY
Q2CH2_FSCCOVERRUNoutputTCELL118:OUT_Q2
Q2CH2_FSCCUNDERRUNoutputTCELL118:OUT_F6
Q2CH2_FSDFEVLDoutputTCELL121:OUT_Q5
Q2CH2_FSLSMoutputTCELL118:OUT_F2
Q2CH2_FSPCIECONoutputTCELL117:OUT_Q2
Q2CH2_FSPCIEDONEoutputTCELL117:OUT_F6
Q2CH2_FSRCDONEoutputTCELL120:OUT_F5
Q2CH2_FSRLOLoutputTCELL118:OUT_Q6
Q2CH2_FSRLOSoutputTCELL117:OUT_Q6
Q2CH2_FSSKPADDEDoutputTCELL119:OUT_Q0
Q2CH2_FSSKPDELETEDoutputTCELL119:OUT_Q4
Q2CH3_FCALIGNENinputTCELL116:IMUX_B5
Q2CH3_FCCDRFORCEDLOCKinputTCELL132:IMUX_A3
Q2CH3_FCDFERDENinputTCELL123:IMUX_CE2
Q2CH3_FCDFEUPDinputTCELL124:IMUX_CE2
Q2CH3_FCLDRTXENinputTCELL116:IMUX_A5
Q2CH3_FCLSMENinputTCELL131:IMUX_D5
Q2CH3_FCPCIEDETENinputTCELL131:IMUX_B5
Q2CH3_FCPCSRXRSTinputTCELL129:IMUX_LSR1
Q2CH3_FCPCSTXRSTinputTCELL126:IMUX_LSR1
Q2CH3_FCPIPEPHYRESETNinputTCELL123:IMUX_LSR1
Q2CH3_FCPLLLOLinputTCELL132:IMUX_B1
Q2CH3_FCRATE0inputTCELL117:IMUX_C3
Q2CH3_FCRATE1inputTCELL117:IMUX_C2
Q2CH3_FCRATE2inputTCELL117:IMUX_C1
Q2CH3_FCRRSTinputTCELL131:IMUX_LSR1
Q2CH3_FCRXPOLARITYinputTCELL131:IMUX_C3
Q2CH3_FCRXPWRUPinputTCELL117:IMUX_A0
Q2CH3_FCTMRSTARTinputTCELL120:IMUX_A3
Q2CH3_FCTMRSTOPinputTCELL120:IMUX_B1
Q2CH3_FCTRSTinputTCELL117:IMUX_LSR1
Q2CH3_FCTXMARGIN0inputTCELL132:IMUX_D5
Q2CH3_FCTXMARGIN1inputTCELL132:IMUX_D4
Q2CH3_FCTXMARGIN2inputTCELL132:IMUX_D3
Q2CH3_FCTXPWRUPinputTCELL116:IMUX_D2
Q2CH3_FCWORDALGNENinputTCELL131:IMUX_D1
Q2CH3_FDLDRRXoutputTCELL119:OUT_F5
Q2CH3_FDLDRTXinputTCELL132:IMUX_B5
Q2CH3_FDRX0outputTCELL124:OUT_Q5
Q2CH3_FDRX1outputTCELL124:OUT_Q4
Q2CH3_FDRX10outputTCELL124:OUT_F3
Q2CH3_FDRX11outputTCELL124:OUT_F2
Q2CH3_FDRX12outputTCELL124:OUT_F1
Q2CH3_FDRX13outputTCELL124:OUT_F0
Q2CH3_FDRX14outputTCELL123:OUT_F7
Q2CH3_FDRX15outputTCELL123:OUT_F6
Q2CH3_FDRX16outputTCELL123:OUT_Q5
Q2CH3_FDRX17outputTCELL123:OUT_Q4
Q2CH3_FDRX18outputTCELL123:OUT_Q3
Q2CH3_FDRX19outputTCELL123:OUT_Q2
Q2CH3_FDRX2outputTCELL124:OUT_Q3
Q2CH3_FDRX20outputTCELL123:OUT_Q1
Q2CH3_FDRX21outputTCELL123:OUT_Q0
Q2CH3_FDRX22outputTCELL122:OUT_Q7
Q2CH3_FDRX23outputTCELL122:OUT_Q6
Q2CH3_FDRX24outputTCELL123:OUT_F5
Q2CH3_FDRX25outputTCELL123:OUT_F4
Q2CH3_FDRX26outputTCELL123:OUT_F3
Q2CH3_FDRX27outputTCELL123:OUT_F2
Q2CH3_FDRX28outputTCELL123:OUT_F1
Q2CH3_FDRX29outputTCELL123:OUT_F0
Q2CH3_FDRX3outputTCELL124:OUT_Q2
Q2CH3_FDRX30outputTCELL122:OUT_F7
Q2CH3_FDRX31outputTCELL122:OUT_F6
Q2CH3_FDRX32outputTCELL117:OUT_F3
Q2CH3_FDRX33outputTCELL117:OUT_F2
Q2CH3_FDRX34outputTCELL117:OUT_F1
Q2CH3_FDRX35outputTCELL117:OUT_F0
Q2CH3_FDRX36outputTCELL116:OUT_Q7
Q2CH3_FDRX37outputTCELL116:OUT_Q6
Q2CH3_FDRX38outputTCELL116:OUT_Q5
Q2CH3_FDRX39outputTCELL116:OUT_Q4
Q2CH3_FDRX4outputTCELL124:OUT_Q1
Q2CH3_FDRX40outputTCELL116:OUT_Q3
Q2CH3_FDRX41outputTCELL116:OUT_Q2
Q2CH3_FDRX42outputTCELL116:OUT_F7
Q2CH3_FDRX43outputTCELL116:OUT_F6
Q2CH3_FDRX44outputTCELL116:OUT_F5
Q2CH3_FDRX45outputTCELL116:OUT_F4
Q2CH3_FDRX46outputTCELL116:OUT_F3
Q2CH3_FDRX47outputTCELL116:OUT_F2
Q2CH3_FDRX5outputTCELL124:OUT_Q0
Q2CH3_FDRX6outputTCELL123:OUT_Q7
Q2CH3_FDRX7outputTCELL123:OUT_Q6
Q2CH3_FDRX8outputTCELL124:OUT_F5
Q2CH3_FDRX9outputTCELL124:OUT_F4
Q2CH3_FDTX0inputTCELL124:IMUX_A7
Q2CH3_FDTX1inputTCELL124:IMUX_A6
Q2CH3_FDTX10inputTCELL124:IMUX_C1
Q2CH3_FDTX11inputTCELL124:IMUX_C0
Q2CH3_FDTX12inputTCELL123:IMUX_C7
Q2CH3_FDTX13inputTCELL123:IMUX_C6
Q2CH3_FDTX14inputTCELL124:IMUX_B3
Q2CH3_FDTX15inputTCELL124:IMUX_B2
Q2CH3_FDTX16inputTCELL124:IMUX_B1
Q2CH3_FDTX17inputTCELL124:IMUX_B0
Q2CH3_FDTX18inputTCELL123:IMUX_B7
Q2CH3_FDTX19inputTCELL123:IMUX_B6
Q2CH3_FDTX2inputTCELL124:IMUX_D3
Q2CH3_FDTX20inputTCELL124:IMUX_A3
Q2CH3_FDTX21inputTCELL124:IMUX_A2
Q2CH3_FDTX22inputTCELL124:IMUX_A1
Q2CH3_FDTX23inputTCELL124:IMUX_A0
Q2CH3_FDTX24inputTCELL123:IMUX_A7
Q2CH3_FDTX25inputTCELL123:IMUX_A6
Q2CH3_FDTX26inputTCELL123:IMUX_D3
Q2CH3_FDTX27inputTCELL123:IMUX_D2
Q2CH3_FDTX28inputTCELL123:IMUX_D1
Q2CH3_FDTX29inputTCELL123:IMUX_D0
Q2CH3_FDTX3inputTCELL124:IMUX_D2
Q2CH3_FDTX30inputTCELL122:IMUX_D7
Q2CH3_FDTX31inputTCELL122:IMUX_D6
Q2CH3_FDTX32inputTCELL123:IMUX_C3
Q2CH3_FDTX33inputTCELL123:IMUX_C2
Q2CH3_FDTX34inputTCELL123:IMUX_C1
Q2CH3_FDTX35inputTCELL123:IMUX_C0
Q2CH3_FDTX36inputTCELL122:IMUX_C7
Q2CH3_FDTX37inputTCELL122:IMUX_C6
Q2CH3_FDTX38inputTCELL123:IMUX_B3
Q2CH3_FDTX39inputTCELL123:IMUX_B2
Q2CH3_FDTX4inputTCELL124:IMUX_D1
Q2CH3_FDTX40inputTCELL123:IMUX_B1
Q2CH3_FDTX41inputTCELL123:IMUX_B0
Q2CH3_FDTX42inputTCELL122:IMUX_B7
Q2CH3_FDTX43inputTCELL122:IMUX_B6
Q2CH3_FDTX44inputTCELL123:IMUX_A3
Q2CH3_FDTX45inputTCELL123:IMUX_A2
Q2CH3_FDTX46inputTCELL123:IMUX_A1
Q2CH3_FDTX47inputTCELL123:IMUX_A0
Q2CH3_FDTX48inputTCELL122:IMUX_A7
Q2CH3_FDTX49inputTCELL122:IMUX_A6
Q2CH3_FDTX5inputTCELL124:IMUX_D0
Q2CH3_FDTX6inputTCELL123:IMUX_D7
Q2CH3_FDTX7inputTCELL123:IMUX_D6
Q2CH3_FDTX8inputTCELL124:IMUX_C3
Q2CH3_FDTX9inputTCELL124:IMUX_C2
Q2CH3_FIRCLKinputTCELL127:IMUX_CLK0_DELAY
Q2CH3_FIREFRXCLKinputTCELL125:IMUX_CLK0_DELAY
Q2CH3_FITCLKinputTCELL129:IMUX_CLK1_DELAY
Q2CH3_FITMRSTARTCLKinputTCELL119:IMUX_CLK0_DELAY
Q2CH3_FITMRSTOPCLKinputTCELL121:IMUX_CLK0_DELAY
Q2CH3_FSCCOVERRUNoutputTCELL118:OUT_Q3
Q2CH3_FSCCUNDERRUNoutputTCELL118:OUT_F7
Q2CH3_FSDFEVLDoutputTCELL121:OUT_Q6
Q2CH3_FSLSMoutputTCELL118:OUT_F3
Q2CH3_FSPCIECONoutputTCELL117:OUT_Q3
Q2CH3_FSPCIEDONEoutputTCELL117:OUT_F7
Q2CH3_FSRCDONEoutputTCELL120:OUT_F6
Q2CH3_FSRLOLoutputTCELL118:OUT_Q7
Q2CH3_FSRLOSoutputTCELL117:OUT_Q7
Q2CH3_FSSKPADDEDoutputTCELL119:OUT_Q1
Q2CH3_FSSKPDELETEDoutputTCELL119:OUT_Q5
Q2D0_FCDERSTinputTCELL124:IMUX_LSR0
Q2D0_FSDEoutputTCELL119:OUT_Q6
Q2D0_FSDMoutputTCELL120:OUT_F0
Q2D1_FCDERSTinputTCELL124:IMUX_LSR1
Q2D1_FSDEoutputTCELL119:OUT_Q7
Q2D1_FSDMoutputTCELL120:OUT_F1
Q2EA0_CIRXFULLinputTCELL147:IMUX_B0
Q2EA0_CIRXIGNOREPKTinputTCELL151:IMUX_A0
Q2EA0_CITXDATA0inputTCELL145:IMUX_B5
Q2EA0_CITXDATA1inputTCELL146:IMUX_B1
Q2EA0_CITXDATA10inputTCELL145:IMUX_A3
Q2EA0_CITXDATA11inputTCELL145:IMUX_A0
Q2EA0_CITXDATA12inputTCELL145:IMUX_A1
Q2EA0_CITXDATA13inputTCELL145:IMUX_C1
Q2EA0_CITXDATA14inputTCELL145:IMUX_A2
Q2EA0_CITXDATA15inputTCELL145:IMUX_B4
Q2EA0_CITXDATA2inputTCELL146:IMUX_A1
Q2EA0_CITXDATA3inputTCELL146:IMUX_A5
Q2EA0_CITXDATA4inputTCELL145:IMUX_D3
Q2EA0_CITXDATA5inputTCELL146:IMUX_A2
Q2EA0_CITXDATA6inputTCELL145:IMUX_C3
Q2EA0_CITXDATA7inputTCELL145:IMUX_C5
Q2EA0_CITXDATA8inputTCELL145:IMUX_A5
Q2EA0_CITXDATA9inputTCELL145:IMUX_A4
Q2EA0_CITXDATAAVAILinputTCELL150:IMUX_D3
Q2EA0_CITXEMPTYinputTCELL150:IMUX_D1
Q2EA0_CITXEOFinputTCELL146:IMUX_B5
Q2EA0_CITXFIFOCTRLinputTCELL155:IMUX_A0
Q2EA0_CITXFORCEERRinputTCELL154:IMUX_B2
Q2EA0_CITXLASTBYTEVLDinputTCELL145:IMUX_C2
Q2EA0_CITXPAUSREQinputTCELL153:IMUX_C2
Q2EA0_CITXPAUSTIM0inputTCELL152:IMUX_C4
Q2EA0_CITXPAUSTIM1inputTCELL152:IMUX_B2
Q2EA0_CITXPAUSTIM10inputTCELL152:IMUX_B4
Q2EA0_CITXPAUSTIM11inputTCELL151:IMUX_D1
Q2EA0_CITXPAUSTIM12inputTCELL151:IMUX_C4
Q2EA0_CITXPAUSTIM13inputTCELL151:IMUX_C3
Q2EA0_CITXPAUSTIM14inputTCELL152:IMUX_B5
Q2EA0_CITXPAUSTIM15inputTCELL152:IMUX_D2
Q2EA0_CITXPAUSTIM2inputTCELL152:IMUX_B3
Q2EA0_CITXPAUSTIM3inputTCELL152:IMUX_A3
Q2EA0_CITXPAUSTIM4inputTCELL151:IMUX_C5
Q2EA0_CITXPAUSTIM5inputTCELL152:IMUX_A2
Q2EA0_CITXPAUSTIM6inputTCELL151:IMUX_D4
Q2EA0_CITXPAUSTIM7inputTCELL152:IMUX_C2
Q2EA0_CITXPAUSTIM8inputTCELL152:IMUX_C5
Q2EA0_CITXPAUSTIM9inputTCELL152:IMUX_C3
Q2EA0_CORXDATA0outputTCELL135:OUT_Q2
Q2EA0_CORXDATA1outputTCELL135:OUT_Q1
Q2EA0_CORXDATA10outputTCELL134:OUT_F1
Q2EA0_CORXDATA11outputTCELL134:OUT_F5
Q2EA0_CORXDATA12outputTCELL134:OUT_F3
Q2EA0_CORXDATA13outputTCELL134:OUT_F0
Q2EA0_CORXDATA14outputTCELL134:OUT_F2
Q2EA0_CORXDATA15outputTCELL134:OUT_F6
Q2EA0_CORXDATA2outputTCELL135:OUT_F5
Q2EA0_CORXDATA3outputTCELL134:OUT_Q7
Q2EA0_CORXDATA4outputTCELL134:OUT_Q3
Q2EA0_CORXDATA5outputTCELL134:OUT_Q2
Q2EA0_CORXDATA6outputTCELL134:OUT_Q0
Q2EA0_CORXDATA7outputTCELL134:OUT_Q4
Q2EA0_CORXDATA8outputTCELL134:OUT_F7
Q2EA0_CORXDATA9outputTCELL134:OUT_F4
Q2EA0_CORXEOFoutputTCELL136:OUT_F1
Q2EA0_CORXERRORoutputTCELL136:OUT_F2
Q2EA0_CORXFIFOFULLERRORoutputTCELL136:OUT_F0
Q2EA0_CORXLASTBYTEVLDoutputTCELL135:OUT_Q0
Q2EA0_CORXSTATENoutputTCELL138:OUT_Q2
Q2EA0_CORXSTATVEC0outputTCELL136:OUT_Q5
Q2EA0_CORXSTATVEC1outputTCELL137:OUT_F1
Q2EA0_CORXSTATVEC2outputTCELL137:OUT_F7
Q2EA0_CORXSTATVEC3outputTCELL138:OUT_F3
Q2EA0_CORXSTATVEC4outputTCELL137:OUT_Q4
Q2EA0_CORXSTATVEC5outputTCELL138:OUT_Q6
Q2EA0_CORXSTATVEC6outputTCELL139:OUT_F0
Q2EA0_CORXSTATVEC7outputTCELL138:OUT_Q4
Q2EA0_CORXWRITEoutputTCELL135:OUT_Q4
Q2EA0_COTXDISCFRMoutputTCELL150:OUT_Q0
Q2EA0_COTXDONEoutputTCELL150:OUT_Q3
Q2EA0_COTXREADoutputTCELL149:OUT_F3
Q2EA0_COTXSTATENoutputTCELL150:OUT_Q6
Q2EA0_COTXSTATVEC0outputTCELL150:OUT_F3
Q2EA0_COTXSTATVEC1outputTCELL151:OUT_F1
Q2EA0_COTXSTATVEC2outputTCELL150:OUT_F6
Q2EA0_COTXSTATVEC3outputTCELL150:OUT_F4
Q2EA0_COTXSTATVEC4outputTCELL151:OUT_F2
Q2EA0_COTXSTATVEC5outputTCELL150:OUT_F2
Q2EA0_COTXSTATVEC6outputTCELL150:OUT_F5
Q2EA0_COTXSTATVEC7outputTCELL149:OUT_F4
Q2EA0_GIIPGSHRINKinputTCELL152:IMUX_A4
Q2EA0_GINONPADRXDVinputTCELL151:IMUX_A5
Q2EA0_GISYNCCOLinputTCELL154:IMUX_C1
Q2EA0_GISYNCCRSinputTCELL154:IMUX_B5
Q2EA0_GISYNCNIBDRIBinputTCELL151:IMUX_B3
Q2EA0_GISYNCRXD0inputTCELL153:IMUX_A3
Q2EA0_GISYNCRXD1inputTCELL153:IMUX_B0
Q2EA0_GISYNCRXD2inputTCELL153:IMUX_C3
Q2EA0_GISYNCRXD3inputTCELL153:IMUX_B5
Q2EA0_GISYNCRXD4inputTCELL153:IMUX_A4
Q2EA0_GISYNCRXD5inputTCELL152:IMUX_D5
Q2EA0_GISYNCRXD6inputTCELL152:IMUX_D4
Q2EA0_GISYNCRXD7inputTCELL151:IMUX_D3
Q2EA0_GISYNCRXDVinputTCELL151:IMUX_B2
Q2EA0_GISYNCRXERinputTCELL151:IMUX_D2
Q2EA0_GODISCARDFCSoutputTCELL149:OUT_F5
Q2EA0_GOTXMACDATA0outputTCELL152:OUT_Q3
Q2EA0_GOTXMACDATA1outputTCELL153:OUT_F5
Q2EA0_GOTXMACDATA2outputTCELL151:OUT_Q7
Q2EA0_GOTXMACDATA3outputTCELL151:OUT_Q5
Q2EA0_GOTXMACDATA4outputTCELL151:OUT_Q3
Q2EA0_GOTXMACDATA5outputTCELL151:OUT_Q2
Q2EA0_GOTXMACDATA6outputTCELL151:OUT_F7
Q2EA0_GOTXMACDATA7outputTCELL151:OUT_Q0
Q2EA0_GOTXMACERRoutputTCELL152:OUT_Q4
Q2EA0_GOTXMACWRoutputTCELL151:OUT_Q1
Q2EA0_KIRSTNinputTCELL145:IMUX_LSR1
Q2EA0_KIRXMACCLKinputTCELL145:IMUX_CLK1_DELAY
Q2EA0_KIRXMACCLKENEXTinputTCELL154:IMUX_A3
Q2EA0_KIRXTXFECLKinputTCELL145:IMUX_CLK0_DELAY
Q2EA0_KITXGMIILPBKinputTCELL154:IMUX_A2
Q2EA0_KITXMACCLKinputTCELL150:IMUX_CLK1_DELAY
Q2EA0_KITXMACCLKENEXTinputTCELL153:IMUX_C1
Q2EA0_KOGBITENoutputTCELL150:OUT_Q2
Q2EA0_KORXMACCLKENoutputTCELL149:OUT_F2
Q2EA1_CIRXFULLinputTCELL148:IMUX_A4
Q2EA1_CIRXIGNOREPKTinputTCELL154:IMUX_A4
Q2EA1_CITXDATA0inputTCELL150:IMUX_C5
Q2EA1_CITXDATA1inputTCELL150:IMUX_B2
Q2EA1_CITXDATA10inputTCELL149:IMUX_B3
Q2EA1_CITXDATA11inputTCELL149:IMUX_B1
Q2EA1_CITXDATA12inputTCELL149:IMUX_C1
Q2EA1_CITXDATA13inputTCELL149:IMUX_C4
Q2EA1_CITXDATA14inputTCELL149:IMUX_C3
Q2EA1_CITXDATA15inputTCELL150:IMUX_A4
Q2EA1_CITXDATA2inputTCELL149:IMUX_D3
Q2EA1_CITXDATA3inputTCELL150:IMUX_B0
Q2EA1_CITXDATA4inputTCELL150:IMUX_A2
Q2EA1_CITXDATA5inputTCELL149:IMUX_D1
Q2EA1_CITXDATA6inputTCELL149:IMUX_D2
Q2EA1_CITXDATA7inputTCELL149:IMUX_C2
Q2EA1_CITXDATA8inputTCELL149:IMUX_B2
Q2EA1_CITXDATA9inputTCELL149:IMUX_B4
Q2EA1_CITXDATAAVAILinputTCELL150:IMUX_D4
Q2EA1_CITXEMPTYinputTCELL150:IMUX_D5
Q2EA1_CITXEOFinputTCELL150:IMUX_D2
Q2EA1_CITXFIFOCTRLinputTCELL153:IMUX_C5
Q2EA1_CITXFORCEERRinputTCELL154:IMUX_A5
Q2EA1_CITXLASTBYTEVLDinputTCELL150:IMUX_C3
Q2EA1_CITXPAUSREQinputTCELL154:IMUX_B1
Q2EA1_CITXPAUSTIM0inputTCELL153:IMUX_D1
Q2EA1_CITXPAUSTIM1inputTCELL153:IMUX_D0
Q2EA1_CITXPAUSTIM10inputTCELL153:IMUX_D4
Q2EA1_CITXPAUSTIM11inputTCELL153:IMUX_D3
Q2EA1_CITXPAUSTIM12inputTCELL153:IMUX_C4
Q2EA1_CITXPAUSTIM13inputTCELL153:IMUX_A5
Q2EA1_CITXPAUSTIM14inputTCELL153:IMUX_B4
Q2EA1_CITXPAUSTIM15inputTCELL154:IMUX_A0
Q2EA1_CITXPAUSTIM2inputTCELL153:IMUX_A2
Q2EA1_CITXPAUSTIM3inputTCELL153:IMUX_A1
Q2EA1_CITXPAUSTIM4inputTCELL153:IMUX_B1
Q2EA1_CITXPAUSTIM5inputTCELL153:IMUX_B2
Q2EA1_CITXPAUSTIM6inputTCELL153:IMUX_B3
Q2EA1_CITXPAUSTIM7inputTCELL153:IMUX_D2
Q2EA1_CITXPAUSTIM8inputTCELL153:IMUX_D5
Q2EA1_CITXPAUSTIM9inputTCELL154:IMUX_A1
Q2EA1_CORXDATA0outputTCELL146:OUT_Q7
Q2EA1_CORXDATA1outputTCELL146:OUT_Q5
Q2EA1_CORXDATA10outputTCELL139:OUT_F7
Q2EA1_CORXDATA11outputTCELL139:OUT_F5
Q2EA1_CORXDATA12outputTCELL139:OUT_F6
Q2EA1_CORXDATA13outputTCELL139:OUT_Q1
Q2EA1_CORXDATA14outputTCELL139:OUT_Q4
Q2EA1_CORXDATA15outputTCELL140:OUT_F6
Q2EA1_CORXDATA2outputTCELL146:OUT_F2
Q2EA1_CORXDATA3outputTCELL146:OUT_Q3
Q2EA1_CORXDATA4outputTCELL146:OUT_F6
Q2EA1_CORXDATA5outputTCELL146:OUT_Q2
Q2EA1_CORXDATA6outputTCELL146:OUT_F5
Q2EA1_CORXDATA7outputTCELL146:OUT_Q6
Q2EA1_CORXDATA8outputTCELL140:OUT_Q3
Q2EA1_CORXDATA9outputTCELL139:OUT_Q2
Q2EA1_CORXEOFoutputTCELL146:OUT_F4
Q2EA1_CORXERRORoutputTCELL146:OUT_Q4
Q2EA1_CORXFIFOFULLERRORoutputTCELL146:OUT_Q1
Q2EA1_CORXLASTBYTEVLDoutputTCELL145:OUT_F7
Q2EA1_CORXSTATENoutputTCELL147:OUT_Q2
Q2EA1_CORXSTATVEC0outputTCELL147:OUT_F1
Q2EA1_CORXSTATVEC1outputTCELL147:OUT_F0
Q2EA1_CORXSTATVEC2outputTCELL147:OUT_F2
Q2EA1_CORXSTATVEC3outputTCELL147:OUT_Q0
Q2EA1_CORXSTATVEC4outputTCELL147:OUT_Q4
Q2EA1_CORXSTATVEC5outputTCELL147:OUT_F7
Q2EA1_CORXSTATVEC6outputTCELL147:OUT_F6
Q2EA1_CORXSTATVEC7outputTCELL147:OUT_F5
Q2EA1_CORXWRITEoutputTCELL146:OUT_F7
Q2EA1_COTXDISCFRMoutputTCELL150:OUT_F7
Q2EA1_COTXDONEoutputTCELL151:OUT_F0
Q2EA1_COTXREADoutputTCELL149:OUT_Q7
Q2EA1_COTXSTATENoutputTCELL150:OUT_Q7
Q2EA1_COTXSTATVEC0outputTCELL151:OUT_F3
Q2EA1_COTXSTATVEC1outputTCELL151:OUT_F5
Q2EA1_COTXSTATVEC2outputTCELL151:OUT_F6
Q2EA1_COTXSTATVEC3outputTCELL149:OUT_Q2
Q2EA1_COTXSTATVEC4outputTCELL151:OUT_F4
Q2EA1_COTXSTATVEC5outputTCELL149:OUT_Q3
Q2EA1_COTXSTATVEC6outputTCELL149:OUT_Q4
Q2EA1_COTXSTATVEC7outputTCELL149:OUT_Q1
Q2EA1_GIIPGSHRINKinputTCELL154:IMUX_C4
Q2EA1_GINONPADRXDVinputTCELL154:IMUX_B4
Q2EA1_GISYNCCOLinputTCELL155:IMUX_A3
Q2EA1_GISYNCCRSinputTCELL155:IMUX_A2
Q2EA1_GISYNCNIBDRIBinputTCELL154:IMUX_B3
Q2EA1_GISYNCRXD0inputTCELL154:IMUX_C5
Q2EA1_GISYNCRXD1inputTCELL154:IMUX_D2
Q2EA1_GISYNCRXD2inputTCELL154:IMUX_D4
Q2EA1_GISYNCRXD3inputTCELL154:IMUX_C2
Q2EA1_GISYNCRXD4inputTCELL154:IMUX_D3
Q2EA1_GISYNCRXD5inputTCELL154:IMUX_D0
Q2EA1_GISYNCRXD6inputTCELL154:IMUX_D1
Q2EA1_GISYNCRXD7inputTCELL154:IMUX_C3
Q2EA1_GISYNCRXDVinputTCELL154:IMUX_B0
Q2EA1_GISYNCRXERinputTCELL154:IMUX_C0
Q2EA1_GODISCARDFCSoutputTCELL150:OUT_F0
Q2EA1_GOTXMACDATA0outputTCELL151:OUT_Q4
Q2EA1_GOTXMACDATA1outputTCELL152:OUT_Q6
Q2EA1_GOTXMACDATA2outputTCELL152:OUT_F4
Q2EA1_GOTXMACDATA3outputTCELL152:OUT_F2
Q2EA1_GOTXMACDATA4outputTCELL152:OUT_F5
Q2EA1_GOTXMACDATA5outputTCELL152:OUT_F3
Q2EA1_GOTXMACDATA6outputTCELL152:OUT_Q2
Q2EA1_GOTXMACDATA7outputTCELL152:OUT_F7
Q2EA1_GOTXMACERRoutputTCELL152:OUT_F6
Q2EA1_GOTXMACWRoutputTCELL151:OUT_Q6
Q2EA1_KIRSTNinputTCELL146:IMUX_LSR0
Q2EA1_KIRXMACCLKinputTCELL149:IMUX_CLK1_DELAY
Q2EA1_KIRXMACCLKENEXTinputTCELL154:IMUX_D5
Q2EA1_KIRXTXFECLKinputTCELL149:IMUX_CLK0_DELAY
Q2EA1_KITXGMIILPBKinputTCELL155:IMUX_A1
Q2EA1_KITXMACCLKinputTCELL150:IMUX_CLK0_DELAY
Q2EA1_KITXMACCLKENEXTinputTCELL153:IMUX_C0
Q2EA1_KOGBITENoutputTCELL150:OUT_Q1
Q2EA1_KORXMACCLKENoutputTCELL150:OUT_F1
Q2EA2_CIRXFULLinputTCELL147:IMUX_B5
Q2EA2_CIRXIGNOREPKTinputTCELL148:IMUX_D0
Q2EA2_CITXDATA0inputTCELL146:IMUX_B2
Q2EA2_CITXDATA1inputTCELL146:IMUX_B0
Q2EA2_CITXDATA10inputTCELL145:IMUX_B0
Q2EA2_CITXDATA11inputTCELL145:IMUX_B1
Q2EA2_CITXDATA12inputTCELL145:IMUX_B3
Q2EA2_CITXDATA13inputTCELL145:IMUX_C0
Q2EA2_CITXDATA14inputTCELL145:IMUX_D4
Q2EA2_CITXDATA15inputTCELL146:IMUX_A4
Q2EA2_CITXDATA2inputTCELL146:IMUX_A3
Q2EA2_CITXDATA3inputTCELL146:IMUX_A0
Q2EA2_CITXDATA4inputTCELL145:IMUX_D5
Q2EA2_CITXDATA5inputTCELL145:IMUX_D1
Q2EA2_CITXDATA6inputTCELL145:IMUX_C4
Q2EA2_CITXDATA7inputTCELL145:IMUX_D2
Q2EA2_CITXDATA8inputTCELL145:IMUX_D0
Q2EA2_CITXDATA9inputTCELL145:IMUX_B2
Q2EA2_CITXDATAAVAILinputTCELL147:IMUX_B1
Q2EA2_CITXEMPTYinputTCELL147:IMUX_A5
Q2EA2_CITXEOFinputTCELL146:IMUX_C1
Q2EA2_CITXFIFOCTRLinputTCELL147:IMUX_B2
Q2EA2_CITXFORCEERRinputTCELL147:IMUX_B3
Q2EA2_CITXLASTBYTEVLDinputTCELL146:IMUX_B3
Q2EA2_CITXPAUSREQinputTCELL147:IMUX_C0
Q2EA2_CITXPAUSTIM0inputTCELL147:IMUX_D2
Q2EA2_CITXPAUSTIM1inputTCELL147:IMUX_D1
Q2EA2_CITXPAUSTIM10inputTCELL148:IMUX_B5
Q2EA2_CITXPAUSTIM11inputTCELL148:IMUX_B4
Q2EA2_CITXPAUSTIM12inputTCELL148:IMUX_B1
Q2EA2_CITXPAUSTIM13inputTCELL148:IMUX_A3
Q2EA2_CITXPAUSTIM14inputTCELL148:IMUX_A0
Q2EA2_CITXPAUSTIM15inputTCELL147:IMUX_D3
Q2EA2_CITXPAUSTIM2inputTCELL147:IMUX_D5
Q2EA2_CITXPAUSTIM3inputTCELL148:IMUX_B3
Q2EA2_CITXPAUSTIM4inputTCELL148:IMUX_C0
Q2EA2_CITXPAUSTIM5inputTCELL147:IMUX_D4
Q2EA2_CITXPAUSTIM6inputTCELL148:IMUX_C1
Q2EA2_CITXPAUSTIM7inputTCELL148:IMUX_B0
Q2EA2_CITXPAUSTIM8inputTCELL148:IMUX_A5
Q2EA2_CITXPAUSTIM9inputTCELL148:IMUX_B2
Q2EA2_CORXDATA0outputTCELL137:OUT_F0
Q2EA2_CORXDATA1outputTCELL136:OUT_Q0
Q2EA2_CORXDATA10outputTCELL134:OUT_Q5
Q2EA2_CORXDATA11outputTCELL135:OUT_F1
Q2EA2_CORXDATA12outputTCELL134:OUT_Q6
Q2EA2_CORXDATA13outputTCELL135:OUT_F0
Q2EA2_CORXDATA14outputTCELL135:OUT_F2
Q2EA2_CORXDATA15outputTCELL135:OUT_Q3
Q2EA2_CORXDATA2outputTCELL136:OUT_F4
Q2EA2_CORXDATA3outputTCELL136:OUT_F7
Q2EA2_CORXDATA4outputTCELL136:OUT_F6
Q2EA2_CORXDATA5outputTCELL136:OUT_Q2
Q2EA2_CORXDATA6outputTCELL136:OUT_Q4
Q2EA2_CORXDATA7outputTCELL136:OUT_Q1
Q2EA2_CORXDATA8outputTCELL135:OUT_F3
Q2EA2_CORXDATA9outputTCELL135:OUT_F4
Q2EA2_CORXEOFoutputTCELL138:OUT_F6
Q2EA2_CORXERRORoutputTCELL139:OUT_F4
Q2EA2_CORXFIFOFULLERRORoutputTCELL137:OUT_F6
Q2EA2_CORXLASTBYTEVLDoutputTCELL136:OUT_F5
Q2EA2_CORXSTATENoutputTCELL139:OUT_Q5
Q2EA2_CORXSTATVEC0outputTCELL145:OUT_F1
Q2EA2_CORXSTATVEC1outputTCELL145:OUT_F3
Q2EA2_CORXSTATVEC2outputTCELL145:OUT_F0
Q2EA2_CORXSTATVEC3outputTCELL140:OUT_Q2
Q2EA2_CORXSTATVEC4outputTCELL139:OUT_Q6
Q2EA2_CORXSTATVEC5outputTCELL139:OUT_Q3
Q2EA2_CORXSTATVEC6outputTCELL140:OUT_F4
Q2EA2_CORXSTATVEC7outputTCELL140:OUT_Q7
Q2EA2_CORXWRITEoutputTCELL138:OUT_F1
Q2EA2_COTXDISCFRMoutputTCELL136:OUT_F3
Q2EA2_COTXDONEoutputTCELL136:OUT_Q6
Q2EA2_COTXREADoutputTCELL135:OUT_Q5
Q2EA2_COTXSTATENoutputTCELL136:OUT_Q3
Q2EA2_COTXSTATVEC0outputTCELL137:OUT_F2
Q2EA2_COTXSTATVEC1outputTCELL137:OUT_Q6
Q2EA2_COTXSTATVEC2outputTCELL138:OUT_Q0
Q2EA2_COTXSTATVEC3outputTCELL138:OUT_F4
Q2EA2_COTXSTATVEC4outputTCELL137:OUT_F5
Q2EA2_COTXSTATVEC5outputTCELL137:OUT_Q1
Q2EA2_COTXSTATVEC6outputTCELL137:OUT_Q2
Q2EA2_COTXSTATVEC7outputTCELL136:OUT_Q7
Q2EA2_GIIPGSHRINKinputTCELL148:IMUX_C4
Q2EA2_GINONPADRXDVinputTCELL148:IMUX_D2
Q2EA2_GISYNCCOLinputTCELL147:IMUX_C4
Q2EA2_GISYNCCRSinputTCELL147:IMUX_C3
Q2EA2_GISYNCNIBDRIBinputTCELL149:IMUX_A1
Q2EA2_GISYNCRXD0inputTCELL149:IMUX_A0
Q2EA2_GISYNCRXD1inputTCELL148:IMUX_C3
Q2EA2_GISYNCRXD2inputTCELL148:IMUX_D3
Q2EA2_GISYNCRXD3inputTCELL148:IMUX_C5
Q2EA2_GISYNCRXD4inputTCELL149:IMUX_A4
Q2EA2_GISYNCRXD5inputTCELL149:IMUX_A3
Q2EA2_GISYNCRXD6inputTCELL149:IMUX_A2
Q2EA2_GISYNCRXD7inputTCELL148:IMUX_D5
Q2EA2_GISYNCRXDVinputTCELL148:IMUX_D1
Q2EA2_GISYNCRXERinputTCELL148:IMUX_D4
Q2EA2_GODISCARDFCSoutputTCELL147:OUT_F4
Q2EA2_GOTXMACDATA0outputTCELL148:OUT_F7
Q2EA2_GOTXMACDATA1outputTCELL137:OUT_F3
Q2EA2_GOTXMACDATA2outputTCELL137:OUT_Q3
Q2EA2_GOTXMACDATA3outputTCELL137:OUT_F4
Q2EA2_GOTXMACDATA4outputTCELL137:OUT_Q0
Q2EA2_GOTXMACDATA5outputTCELL137:OUT_Q5
Q2EA2_GOTXMACDATA6outputTCELL138:OUT_F5
Q2EA2_GOTXMACDATA7outputTCELL139:OUT_Q0
Q2EA2_GOTXMACERRoutputTCELL140:OUT_Q5
Q2EA2_GOTXMACWRoutputTCELL145:OUT_F4
Q2EA2_KIRSTNinputTCELL145:IMUX_LSR0
Q2EA2_KIRXMACCLKinputTCELL147:IMUX_CLK0_DELAY
Q2EA2_KIRXMACCLKENEXTinputTCELL149:IMUX_C0
Q2EA2_KIRXTXFECLKinputTCELL146:IMUX_CLK1_DELAY
Q2EA2_KITXGMIILPBKinputTCELL149:IMUX_B5
Q2EA2_KITXMACCLKinputTCELL146:IMUX_CLK0_DELAY
Q2EA2_KITXMACCLKENEXTinputTCELL148:IMUX_A1
Q2EA2_KOGBITENoutputTCELL148:OUT_F6
Q2EA2_KORXMACCLKENoutputTCELL145:OUT_Q3
Q2EA3_CIRXFULLinputTCELL147:IMUX_D0
Q2EA3_CIRXIGNOREPKTinputTCELL151:IMUX_A1
Q2EA3_CITXDATA0inputTCELL146:IMUX_D4
Q2EA3_CITXDATA1inputTCELL146:IMUX_D2
Q2EA3_CITXDATA10inputTCELL146:IMUX_B4
Q2EA3_CITXDATA11inputTCELL146:IMUX_C0
Q2EA3_CITXDATA12inputTCELL146:IMUX_C2
Q2EA3_CITXDATA13inputTCELL146:IMUX_C5
Q2EA3_CITXDATA14inputTCELL146:IMUX_D0
Q2EA3_CITXDATA15inputTCELL146:IMUX_D5
Q2EA3_CITXDATA2inputTCELL147:IMUX_A4
Q2EA3_CITXDATA3inputTCELL147:IMUX_A1
Q2EA3_CITXDATA4inputTCELL147:IMUX_A2
Q2EA3_CITXDATA5inputTCELL147:IMUX_A0
Q2EA3_CITXDATA6inputTCELL146:IMUX_D3
Q2EA3_CITXDATA7inputTCELL146:IMUX_D1
Q2EA3_CITXDATA8inputTCELL146:IMUX_C4
Q2EA3_CITXDATA9inputTCELL146:IMUX_C3
Q2EA3_CITXDATAAVAILinputTCELL147:IMUX_C2
Q2EA3_CITXEMPTYinputTCELL147:IMUX_C1
Q2EA3_CITXEOFinputTCELL147:IMUX_B4
Q2EA3_CITXFIFOCTRLinputTCELL147:IMUX_C5
Q2EA3_CITXFORCEERRinputTCELL148:IMUX_A2
Q2EA3_CITXLASTBYTEVLDinputTCELL147:IMUX_A3
Q2EA3_CITXPAUSREQinputTCELL148:IMUX_C2
Q2EA3_CITXPAUSTIM0inputTCELL150:IMUX_A5
Q2EA3_CITXPAUSTIM1inputTCELL150:IMUX_C1
Q2EA3_CITXPAUSTIM10inputTCELL149:IMUX_D4
Q2EA3_CITXPAUSTIM11inputTCELL150:IMUX_B5
Q2EA3_CITXPAUSTIM12inputTCELL150:IMUX_A0
Q2EA3_CITXPAUSTIM13inputTCELL150:IMUX_B1
Q2EA3_CITXPAUSTIM14inputTCELL149:IMUX_D0
Q2EA3_CITXPAUSTIM15inputTCELL149:IMUX_C5
Q2EA3_CITXPAUSTIM2inputTCELL150:IMUX_C2
Q2EA3_CITXPAUSTIM3inputTCELL150:IMUX_C0
Q2EA3_CITXPAUSTIM4inputTCELL150:IMUX_C4
Q2EA3_CITXPAUSTIM5inputTCELL150:IMUX_B4
Q2EA3_CITXPAUSTIM6inputTCELL150:IMUX_B3
Q2EA3_CITXPAUSTIM7inputTCELL150:IMUX_A3
Q2EA3_CITXPAUSTIM8inputTCELL150:IMUX_A1
Q2EA3_CITXPAUSTIM9inputTCELL149:IMUX_D5
Q2EA3_CORXDATA0outputTCELL145:OUT_Q1
Q2EA3_CORXDATA1outputTCELL145:OUT_Q7
Q2EA3_CORXDATA10outputTCELL138:OUT_Q5
Q2EA3_CORXDATA11outputTCELL137:OUT_Q7
Q2EA3_CORXDATA12outputTCELL138:OUT_F2
Q2EA3_CORXDATA13outputTCELL138:OUT_Q1
Q2EA3_CORXDATA14outputTCELL138:OUT_F7
Q2EA3_CORXDATA15outputTCELL139:OUT_F3
Q2EA3_CORXDATA2outputTCELL145:OUT_Q4
Q2EA3_CORXDATA3outputTCELL145:OUT_Q6
Q2EA3_CORXDATA4outputTCELL146:OUT_F0
Q2EA3_CORXDATA5outputTCELL146:OUT_F3
Q2EA3_CORXDATA6outputTCELL146:OUT_Q0
Q2EA3_CORXDATA7outputTCELL145:OUT_Q5
Q2EA3_CORXDATA8outputTCELL139:OUT_F2
Q2EA3_CORXDATA9outputTCELL138:OUT_Q7
Q2EA3_CORXEOFoutputTCELL147:OUT_F3
Q2EA3_CORXERRORoutputTCELL148:OUT_F1
Q2EA3_CORXFIFOFULLERRORoutputTCELL145:OUT_Q0
Q2EA3_CORXLASTBYTEVLDoutputTCELL140:OUT_Q4
Q2EA3_CORXSTATENoutputTCELL148:OUT_Q0
Q2EA3_CORXSTATVEC0outputTCELL148:OUT_Q1
Q2EA3_CORXSTATVEC1outputTCELL148:OUT_Q3
Q2EA3_CORXSTATVEC2outputTCELL148:OUT_Q2
Q2EA3_CORXSTATVEC3outputTCELL148:OUT_Q4
Q2EA3_CORXSTATVEC4outputTCELL148:OUT_Q5
Q2EA3_CORXSTATVEC5outputTCELL149:OUT_F1
Q2EA3_CORXSTATVEC6outputTCELL149:OUT_F0
Q2EA3_CORXSTATVEC7outputTCELL148:OUT_Q6
Q2EA3_CORXWRITEoutputTCELL145:OUT_Q2
Q2EA3_COTXDISCFRMoutputTCELL140:OUT_F0
Q2EA3_COTXDONEoutputTCELL140:OUT_Q6
Q2EA3_COTXREADoutputTCELL140:OUT_F7
Q2EA3_COTXSTATENoutputTCELL140:OUT_Q0
Q2EA3_COTXSTATVEC0outputTCELL145:OUT_F2
Q2EA3_COTXSTATVEC1outputTCELL140:OUT_F5
Q2EA3_COTXSTATVEC2outputTCELL145:OUT_F6
Q2EA3_COTXSTATVEC3outputTCELL139:OUT_Q7
Q2EA3_COTXSTATVEC4outputTCELL140:OUT_F1
Q2EA3_COTXSTATVEC5outputTCELL140:OUT_Q1
Q2EA3_COTXSTATVEC6outputTCELL145:OUT_F5
Q2EA3_COTXSTATVEC7outputTCELL140:OUT_F2
Q2EA3_GIIPGSHRINKinputTCELL151:IMUX_C1
Q2EA3_GINONPADRXDVinputTCELL151:IMUX_B0
Q2EA3_GISYNCCOLinputTCELL149:IMUX_A5
Q2EA3_GISYNCCRSinputTCELL149:IMUX_B0
Q2EA3_GISYNCNIBDRIBinputTCELL151:IMUX_A3
Q2EA3_GISYNCRXD0inputTCELL151:IMUX_C2
Q2EA3_GISYNCRXD1inputTCELL151:IMUX_D0
Q2EA3_GISYNCRXD2inputTCELL152:IMUX_A5
Q2EA3_GISYNCRXD3inputTCELL151:IMUX_B5
Q2EA3_GISYNCRXD4inputTCELL151:IMUX_D5
Q2EA3_GISYNCRXD5inputTCELL151:IMUX_C0
Q2EA3_GISYNCRXD6inputTCELL151:IMUX_B4
Q2EA3_GISYNCRXD7inputTCELL151:IMUX_B1
Q2EA3_GISYNCRXDVinputTCELL151:IMUX_A2
Q2EA3_GISYNCRXERinputTCELL151:IMUX_A4
Q2EA3_GODISCARDFCSoutputTCELL148:OUT_Q7
Q2EA3_GOTXMACDATA0outputTCELL147:OUT_Q1
Q2EA3_GOTXMACDATA1outputTCELL149:OUT_Q0
Q2EA3_GOTXMACDATA2outputTCELL147:OUT_Q5
Q2EA3_GOTXMACDATA3outputTCELL148:OUT_F2
Q2EA3_GOTXMACDATA4outputTCELL148:OUT_F4
Q2EA3_GOTXMACDATA5outputTCELL148:OUT_F5
Q2EA3_GOTXMACDATA6outputTCELL148:OUT_F0
Q2EA3_GOTXMACDATA7outputTCELL147:OUT_Q7
Q2EA3_GOTXMACERRoutputTCELL148:OUT_F3
Q2EA3_GOTXMACWRoutputTCELL147:OUT_Q6
Q2EA3_KIRSTNinputTCELL146:IMUX_LSR1
Q2EA3_KIRXMACCLKinputTCELL148:IMUX_CLK1_DELAY
Q2EA3_KIRXMACCLKENEXTinputTCELL153:IMUX_A0
Q2EA3_KIRXTXFECLKinputTCELL147:IMUX_CLK1_DELAY
Q2EA3_KITXGMIILPBKinputTCELL152:IMUX_D3
Q2EA3_KITXMACCLKinputTCELL148:IMUX_CLK0_DELAY
Q2EA3_KITXMACCLKENEXTinputTCELL150:IMUX_D0
Q2EA3_KOGBITENoutputTCELL149:OUT_F7
Q2EA3_KORXMACCLKENoutputTCELL149:OUT_Q6
Q2EB0_CIRXFULLinputTCELL159:IMUX_B0
Q2EB0_CIRXIGNOREPKTinputTCELL155:IMUX_D1
Q2EB0_CITXDATA0inputTCELL157:IMUX_A3
Q2EB0_CITXDATA1inputTCELL156:IMUX_B4
Q2EB0_CITXDATA2inputTCELL156:IMUX_C2
Q2EB0_CITXDATA3inputTCELL156:IMUX_C0
Q2EB0_CITXDATA4inputTCELL156:IMUX_A5
Q2EB0_CITXDATA5inputTCELL156:IMUX_B0
Q2EB0_CITXDATA6inputTCELL156:IMUX_B1
Q2EB0_CITXDATA7inputTCELL156:IMUX_C4
Q2EB0_CITXDATAAVAILinputTCELL157:IMUX_B2
Q2EB0_CITXEMPTYinputTCELL158:IMUX_A0
Q2EB0_CITXEOFinputTCELL157:IMUX_A5
Q2EB0_CITXFIFOCTRLinputTCELL157:IMUX_D4
Q2EB0_CITXFORCEERRinputTCELL158:IMUX_A3
Q2EB0_CITXPAUSEREQinputTCELL157:IMUX_B3
Q2EB0_CITXPAUSTIM0inputTCELL157:IMUX_A2
Q2EB0_CITXPAUSTIM1inputTCELL156:IMUX_D5
Q2EB0_CITXPAUSTIM10inputTCELL157:IMUX_A0
Q2EB0_CITXPAUSTIM11inputTCELL156:IMUX_D3
Q2EB0_CITXPAUSTIM12inputTCELL156:IMUX_D2
Q2EB0_CITXPAUSTIM13inputTCELL156:IMUX_C3
Q2EB0_CITXPAUSTIM14inputTCELL156:IMUX_B5
Q2EB0_CITXPAUSTIM15inputTCELL157:IMUX_A4
Q2EB0_CITXPAUSTIM2inputTCELL156:IMUX_B2
Q2EB0_CITXPAUSTIM3inputTCELL156:IMUX_B3
Q2EB0_CITXPAUSTIM4inputTCELL156:IMUX_D1
Q2EB0_CITXPAUSTIM5inputTCELL156:IMUX_D0
Q2EB0_CITXPAUSTIM6inputTCELL156:IMUX_C1
Q2EB0_CITXPAUSTIM7inputTCELL156:IMUX_C5
Q2EB0_CITXPAUSTIM8inputTCELL156:IMUX_D4
Q2EB0_CITXPAUSTIM9inputTCELL157:IMUX_A1
Q2EB0_GIIPGSHRINKinputTCELL155:IMUX_B3
Q2EB0_GINONPADRXDVinputTCELL155:IMUX_B1
Q2EB0_GISYNCCOLinputTCELL157:IMUX_B0
Q2EB0_GISYNCCRSinputTCELL157:IMUX_B1
Q2EB0_GISYNCNIBDRIBinputTCELL155:IMUX_C2
Q2EB0_GISYNCRXD0inputTCELL155:IMUX_C3
Q2EB0_GISYNCRXD1inputTCELL156:IMUX_A1
Q2EB0_GISYNCRXD2inputTCELL155:IMUX_D0
Q2EB0_GISYNCRXD3inputTCELL155:IMUX_C1
Q2EB0_GISYNCRXD4inputTCELL155:IMUX_D3
Q2EB0_GISYNCRXD5inputTCELL155:IMUX_D2
Q2EB0_GISYNCRXD6inputTCELL155:IMUX_B2
Q2EB0_GISYNCRXD7inputTCELL156:IMUX_A0
Q2EB0_GISYNCRXDVinputTCELL155:IMUX_C0
Q2EB0_GISYNCRXERinputTCELL155:IMUX_B0
Q2EB0_KIRSTNinputTCELL148:IMUX_LSR0
Q2EB0_KIRXMACCLKinputTCELL151:IMUX_CLK0_DELAY
Q2EB0_KIRXMACCLKENEXTinputTCELL156:IMUX_A3
Q2EB0_KIRXTXFECLKinputTCELL151:IMUX_CLK1_DELAY
Q2EB0_KITXGMIILPBKinputTCELL156:IMUX_A2
Q2EB0_KITXMACCLKinputTCELL152:IMUX_CLK1_DELAY
Q2EB0_KITXMACCLKENEXTinputTCELL156:IMUX_A4
Q2EB1_CIRXFULLinputTCELL160:IMUX_B2
Q2EB1_CIRXIGNOREPKTinputTCELL157:IMUX_D3
Q2EB1_CITXDATA0inputTCELL159:IMUX_B7
Q2EB1_CITXDATA1inputTCELL160:IMUX_B0
Q2EB1_CITXDATA2inputTCELL159:IMUX_A7
Q2EB1_CITXDATA3inputTCELL160:IMUX_A2
Q2EB1_CITXDATA4inputTCELL160:IMUX_B1
Q2EB1_CITXDATA5inputTCELL160:IMUX_A3
Q2EB1_CITXDATA6inputTCELL160:IMUX_A0
Q2EB1_CITXDATA7inputTCELL159:IMUX_B6
Q2EB1_CITXDATAAVAILinputTCELL161:IMUX_B0
Q2EB1_CITXEMPTYinputTCELL160:IMUX_B3
Q2EB1_CITXEOFinputTCELL160:IMUX_A1
Q2EB1_CITXFIFOCTRLinputTCELL161:IMUX_A3
Q2EB1_CITXFORCEERRinputTCELL160:IMUX_A6
Q2EB1_CITXPAUSEREQinputTCELL160:IMUX_C3
Q2EB1_CITXPAUSTIM0inputTCELL159:IMUX_A3
Q2EB1_CITXPAUSTIM1inputTCELL159:IMUX_A1
Q2EB1_CITXPAUSTIM10inputTCELL159:IMUX_C1
Q2EB1_CITXPAUSTIM11inputTCELL159:IMUX_C0
Q2EB1_CITXPAUSTIM12inputTCELL159:IMUX_C3
Q2EB1_CITXPAUSTIM13inputTCELL159:IMUX_D0
Q2EB1_CITXPAUSTIM14inputTCELL158:IMUX_D6
Q2EB1_CITXPAUSTIM15inputTCELL158:IMUX_D7
Q2EB1_CITXPAUSTIM2inputTCELL158:IMUX_B7
Q2EB1_CITXPAUSTIM3inputTCELL158:IMUX_B6
Q2EB1_CITXPAUSTIM4inputTCELL159:IMUX_B1
Q2EB1_CITXPAUSTIM5inputTCELL159:IMUX_B3
Q2EB1_CITXPAUSTIM6inputTCELL159:IMUX_B2
Q2EB1_CITXPAUSTIM7inputTCELL158:IMUX_C7
Q2EB1_CITXPAUSTIM8inputTCELL158:IMUX_C6
Q2EB1_CITXPAUSTIM9inputTCELL159:IMUX_C2
Q2EB1_GIIPGSHRINKinputTCELL157:IMUX_D5
Q2EB1_GINONPADRXDVinputTCELL157:IMUX_B4
Q2EB1_GISYNCCOLinputTCELL159:IMUX_D3
Q2EB1_GISYNCCRSinputTCELL159:IMUX_D2
Q2EB1_GISYNCNIBDRIBinputTCELL157:IMUX_C2
Q2EB1_GISYNCRXD0inputTCELL157:IMUX_C0
Q2EB1_GISYNCRXD1inputTCELL158:IMUX_A1
Q2EB1_GISYNCRXD2inputTCELL157:IMUX_D0
Q2EB1_GISYNCRXD3inputTCELL157:IMUX_D2
Q2EB1_GISYNCRXD4inputTCELL157:IMUX_C5
Q2EB1_GISYNCRXD5inputTCELL157:IMUX_C4
Q2EB1_GISYNCRXD6inputTCELL157:IMUX_D1
Q2EB1_GISYNCRXD7inputTCELL157:IMUX_C3
Q2EB1_GISYNCRXDVinputTCELL157:IMUX_B5
Q2EB1_GISYNCRXERinputTCELL157:IMUX_C1
Q2EB1_KIRSTNinputTCELL150:IMUX_LSR0
Q2EB1_KIRXMACCLKinputTCELL153:IMUX_CLK0_DELAY
Q2EB1_KIRXMACCLKENEXTinputTCELL158:IMUX_B0
Q2EB1_KIRXTXFECLKinputTCELL154:IMUX_CLK0_DELAY
Q2EB1_KITXGMIILPBKinputTCELL158:IMUX_A2
Q2EB1_KITXMACCLKinputTCELL153:IMUX_CLK1_DELAY
Q2EB1_KITXMACCLKENEXTinputTCELL158:IMUX_B2
Q2EB2_CIRXFULLinputTCELL161:IMUX_B1
Q2EB2_CIRXIGNOREPKTinputTCELL158:IMUX_B1
Q2EB2_CITXDATA0inputTCELL166:IMUX_A1
Q2EB2_CITXDATA1inputTCELL166:IMUX_B0
Q2EB2_CITXDATA2inputTCELL166:IMUX_A4
Q2EB2_CITXDATA3inputTCELL166:IMUX_B2
Q2EB2_CITXDATA4inputTCELL166:IMUX_B4
Q2EB2_CITXDATA5inputTCELL166:IMUX_B3
Q2EB2_CITXDATA6inputTCELL166:IMUX_C1
Q2EB2_CITXDATA7inputTCELL166:IMUX_B1
Q2EB2_CITXDATAAVAILinputTCELL166:IMUX_A0
Q2EB2_CITXEMPTYinputTCELL166:IMUX_A3
Q2EB2_CITXEOFinputTCELL165:IMUX_D3
Q2EB2_CITXFIFOCTRLinputTCELL165:IMUX_D5
Q2EB2_CITXFORCEERRinputTCELL165:IMUX_D4
Q2EB2_CITXPAUSEREQinputTCELL165:IMUX_D2
Q2EB2_CITXPAUSTIM0inputTCELL161:IMUX_A1
Q2EB2_CITXPAUSTIM1inputTCELL161:IMUX_A0
Q2EB2_CITXPAUSTIM10inputTCELL161:IMUX_A2
Q2EB2_CITXPAUSTIM11inputTCELL160:IMUX_B6
Q2EB2_CITXPAUSTIM12inputTCELL160:IMUX_D1
Q2EB2_CITXPAUSTIM13inputTCELL160:IMUX_D0
Q2EB2_CITXPAUSTIM14inputTCELL159:IMUX_D7
Q2EB2_CITXPAUSTIM15inputTCELL160:IMUX_B7
Q2EB2_CITXPAUSTIM2inputTCELL160:IMUX_D2
Q2EB2_CITXPAUSTIM3inputTCELL160:IMUX_A7
Q2EB2_CITXPAUSTIM4inputTCELL159:IMUX_D6
Q2EB2_CITXPAUSTIM5inputTCELL159:IMUX_C7
Q2EB2_CITXPAUSTIM6inputTCELL159:IMUX_C6
Q2EB2_CITXPAUSTIM7inputTCELL160:IMUX_C0
Q2EB2_CITXPAUSTIM8inputTCELL160:IMUX_C2
Q2EB2_CITXPAUSTIM9inputTCELL160:IMUX_D3
Q2EB2_GIIPGSHRINKinputTCELL158:IMUX_D2
Q2EB2_GINONPADRXDVinputTCELL158:IMUX_C0
Q2EB2_GISYNCCOLinputTCELL164:IMUX_C4
Q2EB2_GISYNCCRSinputTCELL164:IMUX_C0
Q2EB2_GISYNCNIBDRIBinputTCELL158:IMUX_C1
Q2EB2_GISYNCRXD0inputTCELL158:IMUX_C3
Q2EB2_GISYNCRXD1inputTCELL158:IMUX_A6
Q2EB2_GISYNCRXD2inputTCELL158:IMUX_D0
Q2EB2_GISYNCRXD3inputTCELL159:IMUX_A2
Q2EB2_GISYNCRXD4inputTCELL158:IMUX_A7
Q2EB2_GISYNCRXD5inputTCELL159:IMUX_A0
Q2EB2_GISYNCRXD6inputTCELL158:IMUX_D3
Q2EB2_GISYNCRXD7inputTCELL158:IMUX_D1
Q2EB2_GISYNCRXDVinputTCELL158:IMUX_B3
Q2EB2_GISYNCRXERinputTCELL158:IMUX_C2
Q2EB2_KIRSTNinputTCELL149:IMUX_LSR0
Q2EB2_KIRXMACCLKinputTCELL154:IMUX_CLK1_DELAY
Q2EB2_KIRXMACCLKENEXTinputTCELL159:IMUX_A6
Q2EB2_KIRXTXFECLKinputTCELL156:IMUX_CLK1_DELAY
Q2EB2_KITXGMIILPBKinputTCELL159:IMUX_D1
Q2EB2_KITXMACCLKinputTCELL156:IMUX_CLK0_DELAY
Q2EB2_KITXMACCLKENEXTinputTCELL160:IMUX_C1
Q2EB3_CIRXFULLinputTCELL166:IMUX_A2
Q2EB3_CIRXIGNOREPKTinputTCELL164:IMUX_D5
Q2EB3_CITXDATA0inputTCELL167:IMUX_C2
Q2EB3_CITXDATA1inputTCELL167:IMUX_D0
Q2EB3_CITXDATA2inputTCELL167:IMUX_D2
Q2EB3_CITXDATA3inputTCELL167:IMUX_C1
Q2EB3_CITXDATA4inputTCELL167:IMUX_D1
Q2EB3_CITXDATA5inputTCELL167:IMUX_C4
Q2EB3_CITXDATA6inputTCELL167:IMUX_C3
Q2EB3_CITXDATA7inputTCELL167:IMUX_C5
Q2EB3_CITXDATAAVAILinputTCELL167:IMUX_C0
Q2EB3_CITXEMPTYinputTCELL167:IMUX_B5
Q2EB3_CITXEOFinputTCELL167:IMUX_B4
Q2EB3_CITXFIFOCTRLinputTCELL166:IMUX_C5
Q2EB3_CITXFORCEERRinputTCELL166:IMUX_C4
Q2EB3_CITXPAUSEREQinputTCELL166:IMUX_C3
Q2EB3_CITXPAUSTIM0inputTCELL163:IMUX_D0
Q2EB3_CITXPAUSTIM1inputTCELL162:IMUX_D7
Q2EB3_CITXPAUSTIM10inputTCELL164:IMUX_B0
Q2EB3_CITXPAUSTIM11inputTCELL164:IMUX_B1
Q2EB3_CITXPAUSTIM12inputTCELL163:IMUX_B3
Q2EB3_CITXPAUSTIM13inputTCELL164:IMUX_A0
Q2EB3_CITXPAUSTIM14inputTCELL163:IMUX_C3
Q2EB3_CITXPAUSTIM15inputTCELL164:IMUX_B5
Q2EB3_CITXPAUSTIM2inputTCELL164:IMUX_A4
Q2EB3_CITXPAUSTIM3inputTCELL164:IMUX_A2
Q2EB3_CITXPAUSTIM4inputTCELL162:IMUX_D6
Q2EB3_CITXPAUSTIM5inputTCELL163:IMUX_C0
Q2EB3_CITXPAUSTIM6inputTCELL162:IMUX_C7
Q2EB3_CITXPAUSTIM7inputTCELL163:IMUX_C1
Q2EB3_CITXPAUSTIM8inputTCELL164:IMUX_B3
Q2EB3_CITXPAUSTIM9inputTCELL164:IMUX_B2
Q2EB3_GIIPGSHRINKinputTCELL164:IMUX_D1
Q2EB3_GINONPADRXDVinputTCELL165:IMUX_A3
Q2EB3_GISYNCCOLinputTCELL166:IMUX_C0
Q2EB3_GISYNCCRSinputTCELL166:IMUX_B5
Q2EB3_GISYNCNIBDRIBinputTCELL165:IMUX_B3
Q2EB3_GISYNCRXD0inputTCELL165:IMUX_A5
Q2EB3_GISYNCRXD1inputTCELL165:IMUX_C0
Q2EB3_GISYNCRXD2inputTCELL165:IMUX_B5
Q2EB3_GISYNCRXD3inputTCELL165:IMUX_A4
Q2EB3_GISYNCRXD4inputTCELL165:IMUX_A0
Q2EB3_GISYNCRXD5inputTCELL164:IMUX_D4
Q2EB3_GISYNCRXD6inputTCELL165:IMUX_A2
Q2EB3_GISYNCRXD7inputTCELL164:IMUX_D3
Q2EB3_GISYNCRXDVinputTCELL165:IMUX_B0
Q2EB3_GISYNCRXERinputTCELL165:IMUX_B4
Q2EB3_KIRSTNinputTCELL149:IMUX_LSR1
Q2EB3_KIRXMACCLKinputTCELL157:IMUX_CLK1_DELAY
Q2EB3_KIRXMACCLKENEXTinputTCELL164:IMUX_A3
Q2EB3_KIRXTXFECLKinputTCELL159:IMUX_CLK1_DELAY
Q2EB3_KITXGMIILPBKinputTCELL164:IMUX_A5
Q2EB3_KITXMACCLKinputTCELL158:IMUX_CLK1_DELAY
Q2EB3_KITXMACCLKENEXTinputTCELL164:IMUX_A1
Q2X_CSO0outputTCELL155:OUT_Q2
Q2X_CSO1outputTCELL155:OUT_Q1
Q2X_CSO10outputTCELL159:OUT_Q2
Q2X_CSO100outputTCELL155:OUT_Q6
Q2X_CSO101outputTCELL156:OUT_F0
Q2X_CSO102outputTCELL156:OUT_F1
Q2X_CSO103outputTCELL155:OUT_Q3
Q2X_CSO104outputTCELL161:OUT_Q0
Q2X_CSO105outputTCELL160:OUT_Q4
Q2X_CSO106outputTCELL160:OUT_F3
Q2X_CSO107outputTCELL160:OUT_Q5
Q2X_CSO108outputTCELL160:OUT_F4
Q2X_CSO109outputTCELL160:OUT_F5
Q2X_CSO11outputTCELL162:OUT_F4
Q2X_CSO110outputTCELL159:OUT_Q6
Q2X_CSO111outputTCELL159:OUT_Q7
Q2X_CSO112outputTCELL164:OUT_F0
Q2X_CSO113outputTCELL163:OUT_Q4
Q2X_CSO114outputTCELL163:OUT_Q3
Q2X_CSO115outputTCELL164:OUT_F2
Q2X_CSO116outputTCELL164:OUT_F1
Q2X_CSO117outputTCELL164:OUT_F4
Q2X_CSO118outputTCELL164:OUT_F6
Q2X_CSO119outputTCELL164:OUT_F7
Q2X_CSO12outputTCELL159:OUT_Q4
Q2X_CSO120outputTCELL154:OUT_Q2
Q2X_CSO121outputTCELL156:OUT_Q1
Q2X_CSO122outputTCELL160:OUT_Q6
Q2X_CSO123outputTCELL165:OUT_Q4
Q2X_CSO124outputTCELL155:OUT_F6
Q2X_CSO125outputTCELL156:OUT_F5
Q2X_CSO126outputTCELL160:OUT_F6
Q2X_CSO127outputTCELL164:OUT_F3
Q2X_CSO128outputTCELL154:OUT_Q0
Q2X_CSO129outputTCELL156:OUT_Q4
Q2X_CSO13outputTCELL159:OUT_Q5
Q2X_CSO130outputTCELL160:OUT_Q0
Q2X_CSO131outputTCELL163:OUT_Q5
Q2X_CSO132outputTCELL153:OUT_Q0
Q2X_CSO133outputTCELL156:OUT_F4
Q2X_CSO134outputTCELL160:OUT_Q1
Q2X_CSO135outputTCELL163:OUT_Q2
Q2X_CSO136outputTCELL154:OUT_Q1
Q2X_CSO137outputTCELL156:OUT_F2
Q2X_CSO138outputTCELL160:OUT_Q7
Q2X_CSO139outputTCELL164:OUT_Q1
Q2X_CSO14outputTCELL159:OUT_F6
Q2X_CSO140outputTCELL164:OUT_Q0
Q2X_CSO15outputTCELL159:OUT_F7
Q2X_CSO16outputTCELL165:OUT_Q1
Q2X_CSO17outputTCELL165:OUT_Q0
Q2X_CSO18outputTCELL165:OUT_F1
Q2X_CSO19outputTCELL165:OUT_Q7
Q2X_CSO2outputTCELL153:OUT_Q6
Q2X_CSO20outputTCELL165:OUT_Q6
Q2X_CSO21outputTCELL165:OUT_Q2
Q2X_CSO22outputTCELL165:OUT_F4
Q2X_CSO23outputTCELL164:OUT_Q6
Q2X_CSO24outputTCELL167:OUT_F1
Q2X_CSO25outputTCELL167:OUT_F0
Q2X_CSO26outputTCELL166:OUT_Q2
Q2X_CSO27outputTCELL166:OUT_Q7
Q2X_CSO28outputTCELL167:OUT_F2
Q2X_CSO29outputTCELL167:OUT_F4
Q2X_CSO3outputTCELL154:OUT_Q7
Q2X_CSO30outputTCELL166:OUT_Q4
Q2X_CSO31outputTCELL167:OUT_F3
Q2X_CSO32outputTCELL153:OUT_Q7
Q2X_CSO33outputTCELL158:OUT_F6
Q2X_CSO34outputTCELL164:OUT_F5
Q2X_CSO35outputTCELL166:OUT_Q5
Q2X_CSO36outputTCELL154:OUT_F0
Q2X_CSO37outputTCELL159:OUT_Q3
Q2X_CSO38outputTCELL165:OUT_Q3
Q2X_CSO39outputTCELL166:OUT_Q6
Q2X_CSO4outputTCELL155:OUT_Q0
Q2X_CSO40outputTCELL154:OUT_Q6
Q2X_CSO41outputTCELL160:OUT_F0
Q2X_CSO42outputTCELL165:OUT_F7
Q2X_CSO43outputTCELL166:OUT_Q3
Q2X_CSO44outputTCELL154:OUT_Q4
Q2X_CSO45outputTCELL156:OUT_Q2
Q2X_CSO46outputTCELL165:OUT_Q5
Q2X_CSO47outputTCELL166:OUT_Q1
Q2X_CSO48outputTCELL166:OUT_Q0
Q2X_CSO49outputTCELL166:OUT_F6
Q2X_CSO5outputTCELL155:OUT_F1
Q2X_CSO50outputTCELL166:OUT_F7
Q2X_CSO51outputTCELL166:OUT_F5
Q2X_CSO52outputTCELL166:OUT_F2
Q2X_CSO53outputTCELL166:OUT_F4
Q2X_CSO54outputTCELL166:OUT_F0
Q2X_CSO55outputTCELL166:OUT_F3
Q2X_CSO56outputTCELL154:OUT_F1
Q2X_CSO57outputTCELL154:OUT_F2
Q2X_CSO58outputTCELL154:OUT_F5
Q2X_CSO59outputTCELL155:OUT_F7
Q2X_CSO6outputTCELL155:OUT_F2
Q2X_CSO60outputTCELL155:OUT_F0
Q2X_CSO61outputTCELL153:OUT_Q4
Q2X_CSO62outputTCELL153:OUT_Q1
Q2X_CSO63outputTCELL154:OUT_F4
Q2X_CSO64outputTCELL157:OUT_F4
Q2X_CSO65outputTCELL157:OUT_F5
Q2X_CSO66outputTCELL157:OUT_F6
Q2X_CSO67outputTCELL157:OUT_F7
Q2X_CSO68outputTCELL156:OUT_Q7
Q2X_CSO69outputTCELL156:OUT_Q0
Q2X_CSO7outputTCELL153:OUT_Q5
Q2X_CSO70outputTCELL156:OUT_Q5
Q2X_CSO71outputTCELL156:OUT_Q6
Q2X_CSO72outputTCELL162:OUT_F1
Q2X_CSO73outputTCELL161:OUT_F7
Q2X_CSO74outputTCELL161:OUT_F6
Q2X_CSO75outputTCELL160:OUT_F1
Q2X_CSO76outputTCELL161:OUT_Q5
Q2X_CSO77outputTCELL161:OUT_Q3
Q2X_CSO78outputTCELL161:OUT_Q1
Q2X_CSO79outputTCELL160:OUT_F2
Q2X_CSO8outputTCELL159:OUT_Q1
Q2X_CSO80outputTCELL164:OUT_Q2
Q2X_CSO81outputTCELL164:OUT_Q4
Q2X_CSO82outputTCELL165:OUT_F5
Q2X_CSO83outputTCELL165:OUT_F0
Q2X_CSO84outputTCELL165:OUT_F3
Q2X_CSO85outputTCELL164:OUT_Q5
Q2X_CSO86outputTCELL165:OUT_F6
Q2X_CSO87outputTCELL164:OUT_Q7
Q2X_CSO88outputTCELL154:OUT_F3
Q2X_CSO89outputTCELL153:OUT_Q3
Q2X_CSO9outputTCELL160:OUT_Q3
Q2X_CSO90outputTCELL154:OUT_F6
Q2X_CSO91outputTCELL154:OUT_Q3
Q2X_CSO92outputTCELL154:OUT_F7
Q2X_CSO93outputTCELL154:OUT_Q5
Q2X_CSO94outputTCELL153:OUT_Q2
Q2X_CSO95outputTCELL155:OUT_F3
Q2X_CSO96outputTCELL156:OUT_F7
Q2X_CSO97outputTCELL156:OUT_F6
Q2X_CSO98outputTCELL155:OUT_Q7
Q2X_CSO99outputTCELL156:OUT_F3
Q2X_GSO0outputTCELL160:OUT_Q2
Q2X_GSO1outputTCELL158:OUT_F0
Q2X_GSO10outputTCELL157:OUT_Q5
Q2X_GSO11outputTCELL157:OUT_F0
Q2X_GSO12outputTCELL158:OUT_F2
Q2X_GSO13outputTCELL157:OUT_Q3
Q2X_GSO14outputTCELL158:OUT_F3
Q2X_GSO15outputTCELL157:OUT_F1
Q2X_GSO16outputTCELL157:OUT_Q0
Q2X_GSO17outputTCELL157:OUT_Q4
Q2X_GSO18outputTCELL157:OUT_Q1
Q2X_GSO19outputTCELL157:OUT_F2
Q2X_GSO2outputTCELL159:OUT_F0
Q2X_GSO20outputTCELL157:OUT_F3
Q2X_GSO21outputTCELL157:OUT_Q6
Q2X_GSO22outputTCELL157:OUT_Q2
Q2X_GSO23outputTCELL158:OUT_F5
Q2X_GSO24outputTCELL163:OUT_F0
Q2X_GSO25outputTCELL161:OUT_F0
Q2X_GSO26outputTCELL159:OUT_F4
Q2X_GSO27outputTCELL162:OUT_Q1
Q2X_GSO28outputTCELL162:OUT_Q0
Q2X_GSO29outputTCELL161:OUT_Q7
Q2X_GSO3outputTCELL159:OUT_F1
Q2X_GSO30outputTCELL161:OUT_Q6
Q2X_GSO31outputTCELL161:OUT_F1
Q2X_GSO32outputTCELL162:OUT_F5
Q2X_GSO33outputTCELL160:OUT_F7
Q2X_GSO34outputTCELL161:OUT_F2
Q2X_GSO35outputTCELL161:OUT_F3
Q2X_GSO36outputTCELL162:OUT_F6
Q2X_GSO37outputTCELL161:OUT_Q4
Q2X_GSO38outputTCELL161:OUT_F5
Q2X_GSO39outputTCELL161:OUT_Q2
Q2X_GSO4outputTCELL156:OUT_Q3
Q2X_GSO40outputTCELL159:OUT_F5
Q2X_GSO41outputTCELL158:OUT_Q6
Q2X_GSO42outputTCELL158:OUT_Q7
Q2X_GSO43outputTCELL159:OUT_Q0
Q2X_GSO5outputTCELL158:OUT_F1
Q2X_GSO6outputTCELL159:OUT_F2
Q2X_GSO7outputTCELL159:OUT_F3
Q2X_GSO8outputTCELL158:OUT_F4
Q2X_GSO9outputTCELL157:OUT_Q7
Q2X_IIGNOREPKTinputTCELL166:IMUX_A5
Q2X_IRESETNinputTCELL148:IMUX_LSR1
Q2X_IRXMACCLKinputTCELL157:IMUX_CLK0_DELAY
Q2X_ITSMSGAVAILinputTCELL170:IMUX_C0
Q2X_ITXBYTEN0inputTCELL165:IMUX_C3
Q2X_ITXBYTEN1inputTCELL165:IMUX_C1
Q2X_ITXBYTEN2inputTCELL165:IMUX_B1
Q2X_ITXDATA0inputTCELL164:IMUX_C5
Q2X_ITXDATA1inputTCELL164:IMUX_C3
Q2X_ITXDATA10inputTCELL161:IMUX_C6
Q2X_ITXDATA11inputTCELL163:IMUX_A0
Q2X_ITXDATA12inputTCELL161:IMUX_C7
Q2X_ITXDATA13inputTCELL162:IMUX_D0
Q2X_ITXDATA14inputTCELL162:IMUX_D2
Q2X_ITXDATA15inputTCELL163:IMUX_D2
Q2X_ITXDATA16inputTCELL163:IMUX_B2
Q2X_ITXDATA17inputTCELL163:IMUX_D1
Q2X_ITXDATA18inputTCELL163:IMUX_C2
Q2X_ITXDATA19inputTCELL162:IMUX_A6
Q2X_ITXDATA2inputTCELL164:IMUX_B4
Q2X_ITXDATA20inputTCELL162:IMUX_D3
Q2X_ITXDATA21inputTCELL162:IMUX_B2
Q2X_ITXDATA22inputTCELL162:IMUX_B0
Q2X_ITXDATA23inputTCELL161:IMUX_B2
Q2X_ITXDATA24inputTCELL161:IMUX_D2
Q2X_ITXDATA25inputTCELL161:IMUX_D7
Q2X_ITXDATA26inputTCELL161:IMUX_B7
Q2X_ITXDATA27inputTCELL161:IMUX_D6
Q2X_ITXDATA28inputTCELL161:IMUX_D0
Q2X_ITXDATA29inputTCELL160:IMUX_D6
Q2X_ITXDATA3inputTCELL163:IMUX_D3
Q2X_ITXDATA30inputTCELL161:IMUX_B3
Q2X_ITXDATA31inputTCELL160:IMUX_D7
Q2X_ITXDATA32inputTCELL160:IMUX_C7
Q2X_ITXDATA33inputTCELL162:IMUX_C0
Q2X_ITXDATA34inputTCELL161:IMUX_C0
Q2X_ITXDATA35inputTCELL160:IMUX_C6
Q2X_ITXDATA36inputTCELL161:IMUX_D3
Q2X_ITXDATA37inputTCELL161:IMUX_A6
Q2X_ITXDATA38inputTCELL162:IMUX_C2
Q2X_ITXDATA39inputTCELL162:IMUX_C3
Q2X_ITXDATA4inputTCELL163:IMUX_A1
Q2X_ITXDATA40inputTCELL162:IMUX_A3
Q2X_ITXDATA41inputTCELL162:IMUX_A2
Q2X_ITXDATA42inputTCELL162:IMUX_C1
Q2X_ITXDATA43inputTCELL162:IMUX_C6
Q2X_ITXDATA44inputTCELL162:IMUX_B1
Q2X_ITXDATA45inputTCELL161:IMUX_C3
Q2X_ITXDATA46inputTCELL161:IMUX_C2
Q2X_ITXDATA47inputTCELL161:IMUX_D1
Q2X_ITXDATA48inputTCELL161:IMUX_C1
Q2X_ITXDATA49inputTCELL161:IMUX_B6
Q2X_ITXDATA5inputTCELL163:IMUX_A2
Q2X_ITXDATA50inputTCELL163:IMUX_A3
Q2X_ITXDATA51inputTCELL161:IMUX_A7
Q2X_ITXDATA52inputTCELL162:IMUX_A1
Q2X_ITXDATA53inputTCELL162:IMUX_A0
Q2X_ITXDATA54inputTCELL162:IMUX_D1
Q2X_ITXDATA55inputTCELL162:IMUX_A7
Q2X_ITXDATA56inputTCELL163:IMUX_B0
Q2X_ITXDATA57inputTCELL164:IMUX_C1
Q2X_ITXDATA58inputTCELL164:IMUX_C2
Q2X_ITXDATA59inputTCELL164:IMUX_D0
Q2X_ITXDATA6inputTCELL163:IMUX_B1
Q2X_ITXDATA60inputTCELL164:IMUX_D2
Q2X_ITXDATA61inputTCELL165:IMUX_A1
Q2X_ITXDATA62inputTCELL165:IMUX_B2
Q2X_ITXDATA63inputTCELL165:IMUX_C2
Q2X_ITXDATA7inputTCELL162:IMUX_B7
Q2X_ITXDATA8inputTCELL162:IMUX_B6
Q2X_ITXDATA9inputTCELL162:IMUX_B3
Q2X_ITXDATAAVAILinputTCELL165:IMUX_D0
Q2X_ITXEMPTYinputTCELL165:IMUX_C5
Q2X_ITXEOFinputTCELL165:IMUX_D1
Q2X_ITXFORCEERRinputTCELL165:IMUX_C4
Q2X_ITXMACCLKinputTCELL155:IMUX_CLK0_DELAY
Q2X_ITXMSG0inputTCELL168:IMUX_C1
Q2X_ITXMSG1inputTCELL168:IMUX_C2
Q2X_ITXMSG10inputTCELL169:IMUX_A1
Q2X_ITXMSG11inputTCELL169:IMUX_A3
Q2X_ITXMSG12inputTCELL169:IMUX_A4
Q2X_ITXMSG13inputTCELL169:IMUX_A5
Q2X_ITXMSG14inputTCELL169:IMUX_B0
Q2X_ITXMSG15inputTCELL169:IMUX_B1
Q2X_ITXMSG16inputTCELL169:IMUX_B2
Q2X_ITXMSG17inputTCELL169:IMUX_B3
Q2X_ITXMSG18inputTCELL169:IMUX_B4
Q2X_ITXMSG19inputTCELL169:IMUX_B5
Q2X_ITXMSG2inputTCELL168:IMUX_C4
Q2X_ITXMSG20inputTCELL169:IMUX_C1
Q2X_ITXMSG21inputTCELL169:IMUX_C2
Q2X_ITXMSG22inputTCELL169:IMUX_C3
Q2X_ITXMSG23inputTCELL169:IMUX_C4
Q2X_ITXMSG24inputTCELL169:IMUX_C5
Q2X_ITXMSG25inputTCELL169:IMUX_D1
Q2X_ITXMSG26inputTCELL169:IMUX_D4
Q2X_ITXMSG27inputTCELL169:IMUX_D5
Q2X_ITXMSG28inputTCELL170:IMUX_A0
Q2X_ITXMSG29inputTCELL170:IMUX_A1
Q2X_ITXMSG3inputTCELL168:IMUX_C5
Q2X_ITXMSG30inputTCELL170:IMUX_A2
Q2X_ITXMSG31inputTCELL170:IMUX_A3
Q2X_ITXMSG32inputTCELL170:IMUX_A5
Q2X_ITXMSG33inputTCELL170:IMUX_B0
Q2X_ITXMSG34inputTCELL170:IMUX_B1
Q2X_ITXMSG35inputTCELL170:IMUX_B2
Q2X_ITXMSG36inputTCELL170:IMUX_B3
Q2X_ITXMSG37inputTCELL169:IMUX_D3
Q2X_ITXMSG38inputTCELL170:IMUX_B4
Q2X_ITXMSG39inputTCELL170:IMUX_B5
Q2X_ITXMSG4inputTCELL168:IMUX_D0
Q2X_ITXMSG40inputTCELL170:IMUX_A4
Q2X_ITXMSG41inputTCELL169:IMUX_D2
Q2X_ITXMSG42inputTCELL169:IMUX_C0
Q2X_ITXMSG43inputTCELL169:IMUX_A2
Q2X_ITXMSG44inputTCELL168:IMUX_C3
Q2X_ITXMSG45inputTCELL168:IMUX_C0
Q2X_ITXMSG46inputTCELL168:IMUX_B5
Q2X_ITXMSG47inputTCELL168:IMUX_B4
Q2X_ITXMSG48inputTCELL168:IMUX_B0
Q2X_ITXMSG49inputTCELL168:IMUX_A5
Q2X_ITXMSG5inputTCELL168:IMUX_D2
Q2X_ITXMSG50inputTCELL168:IMUX_A2
Q2X_ITXMSG51inputTCELL168:IMUX_A3
Q2X_ITXMSG52inputTCELL167:IMUX_D3
Q2X_ITXMSG53inputTCELL167:IMUX_D5
Q2X_ITXMSG54inputTCELL168:IMUX_A1
Q2X_ITXMSG55inputTCELL167:IMUX_D4
Q2X_ITXMSG56inputTCELL168:IMUX_A0
Q2X_ITXMSG57inputTCELL168:IMUX_A4
Q2X_ITXMSG58inputTCELL168:IMUX_B1
Q2X_ITXMSG59inputTCELL168:IMUX_B2
Q2X_ITXMSG6inputTCELL168:IMUX_D3
Q2X_ITXMSG60inputTCELL168:IMUX_B3
Q2X_ITXMSG61inputTCELL168:IMUX_D1
Q2X_ITXMSG62inputTCELL169:IMUX_D0
Q2X_ITXMSG63inputTCELL170:IMUX_C1
Q2X_ITXMSG7inputTCELL168:IMUX_D4
Q2X_ITXMSG8inputTCELL168:IMUX_D5
Q2X_ITXMSG9inputTCELL169:IMUX_A0
Q2X_ITXPAUSREQinputTCELL166:IMUX_C2
Q2X_ITXPAUSTIM0inputTCELL166:IMUX_D2
Q2X_ITXPAUSTIM1inputTCELL167:IMUX_B1
Q2X_ITXPAUSTIM10inputTCELL167:IMUX_A1
Q2X_ITXPAUSTIM11inputTCELL166:IMUX_D0
Q2X_ITXPAUSTIM12inputTCELL166:IMUX_D3
Q2X_ITXPAUSTIM13inputTCELL167:IMUX_A2
Q2X_ITXPAUSTIM14inputTCELL167:IMUX_A0
Q2X_ITXPAUSTIM15inputTCELL166:IMUX_D5
Q2X_ITXPAUSTIM2inputTCELL167:IMUX_B3
Q2X_ITXPAUSTIM3inputTCELL167:IMUX_B2
Q2X_ITXPAUSTIM4inputTCELL167:IMUX_A4
Q2X_ITXPAUSTIM5inputTCELL167:IMUX_A5
Q2X_ITXPAUSTIM6inputTCELL167:IMUX_A3
Q2X_ITXPAUSTIM7inputTCELL167:IMUX_B0
Q2X_ITXPAUSTIM8inputTCELL166:IMUX_D4
Q2X_ITXPAUSTIM9inputTCELL166:IMUX_D1
Q2X_KSO0outputTCELL158:OUT_Q1
Q2X_KSO1outputTCELL158:OUT_Q2
Q2X_KSO10outputTCELL163:OUT_F4
Q2X_KSO11outputTCELL162:OUT_F0
Q2X_KSO12outputTCELL162:OUT_Q2
Q2X_KSO13outputTCELL163:OUT_F5
Q2X_KSO14outputTCELL161:OUT_F4
Q2X_KSO15outputTCELL162:OUT_Q6
Q2X_KSO16outputTCELL163:OUT_F2
Q2X_KSO17outputTCELL162:OUT_F2
Q2X_KSO18outputTCELL162:OUT_F7
Q2X_KSO19outputTCELL163:OUT_Q0
Q2X_KSO2outputTCELL162:OUT_F3
Q2X_KSO3outputTCELL158:OUT_Q3
Q2X_KSO4outputTCELL158:OUT_Q4
Q2X_KSO5outputTCELL158:OUT_Q5
Q2X_KSO6outputTCELL163:OUT_Q1
Q2X_KSO7outputTCELL158:OUT_F7
Q2X_KSO8outputTCELL162:OUT_Q3
Q2X_KSO9outputTCELL162:OUT_Q4
Q2X_TIBISTBANKSEL0inputTCELL150:IMUX_CE3
Q2X_TIBISTBANKSEL1inputTCELL150:IMUX_CE0
Q2X_TIBISTBANKSEL2inputTCELL150:IMUX_CE1
Q2X_TIBISTBANKSEL3inputTCELL150:IMUX_CE2
Q2X_TIBISTRA0inputTCELL163:IMUX_CE1
Q2X_TIBISTRA1inputTCELL162:IMUX_CE3
Q2X_TIBISTRA2inputTCELL163:IMUX_CE0
Q2X_TIBISTRA3inputTCELL161:IMUX_CE3
Q2X_TIBISTRA4inputTCELL165:IMUX_CE1
Q2X_TIBISTRA5inputTCELL164:IMUX_CE2
Q2X_TIBISTRA6inputTCELL160:IMUX_CE0
Q2X_TIBISTRA7inputTCELL157:IMUX_CE0
Q2X_TIBISTRENinputTCELL151:IMUX_CE1
Q2X_TIBISTTDI0inputTCELL152:IMUX_CE3
Q2X_TIBISTTDI1inputTCELL153:IMUX_CE2
Q2X_TIBISTTDI10inputTCELL158:IMUX_CE2
Q2X_TIBISTTDI11inputTCELL158:IMUX_CE1
Q2X_TIBISTTDI12inputTCELL159:IMUX_CE2
Q2X_TIBISTTDI13inputTCELL158:IMUX_CE0
Q2X_TIBISTTDI14inputTCELL161:IMUX_CE0
Q2X_TIBISTTDI15inputTCELL159:IMUX_CE1
Q2X_TIBISTTDI16inputTCELL162:IMUX_CE2
Q2X_TIBISTTDI17inputTCELL159:IMUX_CE3
Q2X_TIBISTTDI18inputTCELL162:IMUX_CE0
Q2X_TIBISTTDI19inputTCELL160:IMUX_CE1
Q2X_TIBISTTDI2inputTCELL153:IMUX_CE3
Q2X_TIBISTTDI20inputTCELL161:IMUX_CE2
Q2X_TIBISTTDI21inputTCELL164:IMUX_CE1
Q2X_TIBISTTDI22inputTCELL160:IMUX_CE3
Q2X_TIBISTTDI23inputTCELL165:IMUX_CE0
Q2X_TIBISTTDI24inputTCELL162:IMUX_CE1
Q2X_TIBISTTDI25inputTCELL164:IMUX_CE3
Q2X_TIBISTTDI26inputTCELL160:IMUX_CE2
Q2X_TIBISTTDI27inputTCELL163:IMUX_CE2
Q2X_TIBISTTDI28inputTCELL159:IMUX_CE0
Q2X_TIBISTTDI29inputTCELL161:IMUX_CE1
Q2X_TIBISTTDI3inputTCELL154:IMUX_CE0
Q2X_TIBISTTDI30inputTCELL158:IMUX_CE3
Q2X_TIBISTTDI31inputTCELL157:IMUX_CE3
Q2X_TIBISTTDI32inputTCELL156:IMUX_CE0
Q2X_TIBISTTDI33inputTCELL154:IMUX_CE1
Q2X_TIBISTTDI34inputTCELL155:IMUX_CE0
Q2X_TIBISTTDI35inputTCELL154:IMUX_CE2
Q2X_TIBISTTDI4inputTCELL155:IMUX_CE3
Q2X_TIBISTTDI5inputTCELL155:IMUX_CE1
Q2X_TIBISTTDI6inputTCELL154:IMUX_CE3
Q2X_TIBISTTDI7inputTCELL156:IMUX_CE3
Q2X_TIBISTTDI8inputTCELL156:IMUX_CE1
Q2X_TIBISTTDI9inputTCELL156:IMUX_CE2
Q2X_TIBISTTESTMODEinputTCELL151:IMUX_LSR0
Q2X_TIBISTWA0inputTCELL157:IMUX_CE1
Q2X_TIBISTWA1inputTCELL164:IMUX_CE0
Q2X_TIBISTWA2inputTCELL151:IMUX_CE2
Q2X_TIBISTWA3inputTCELL151:IMUX_CE3
Q2X_TIBISTWA4inputTCELL152:IMUX_CE1
Q2X_TIBISTWA5inputTCELL152:IMUX_CE2
Q2X_TIBISTWA6inputTCELL153:IMUX_CE0
Q2X_TIBISTWA7inputTCELL151:IMUX_CE0
Q2X_TIBISTWENinputTCELL153:IMUX_CE1
Q2X_TISCANENinputTCELL150:IMUX_LSR1
Q2X_TISCANIN0inputTCELL147:IMUX_CE0
Q2X_TISCANIN1inputTCELL147:IMUX_CE3
Q2X_TISCANIN10inputTCELL147:IMUX_CE1
Q2X_TISCANIN11inputTCELL148:IMUX_CE3
Q2X_TISCANIN12inputTCELL149:IMUX_CE2
Q2X_TISCANIN13inputTCELL149:IMUX_CE1
Q2X_TISCANIN14inputTCELL167:IMUX_CE0
Q2X_TISCANIN15inputTCELL149:IMUX_CE3
Q2X_TISCANIN16inputTCELL166:IMUX_CE1
Q2X_TISCANIN17inputTCELL165:IMUX_CE2
Q2X_TISCANIN18inputTCELL167:IMUX_CE1
Q2X_TISCANIN19inputTCELL166:IMUX_CE0
Q2X_TISCANIN2inputTCELL145:IMUX_CE0
Q2X_TISCANIN20inputTCELL166:IMUX_CE3
Q2X_TISCANIN21inputTCELL146:IMUX_CE0
Q2X_TISCANIN22inputTCELL145:IMUX_CE2
Q2X_TISCANIN23inputTCELL145:IMUX_CE3
Q2X_TISCANIN24inputTCELL149:IMUX_CE0
Q2X_TISCANIN25inputTCELL148:IMUX_CE2
Q2X_TISCANIN26inputTCELL167:IMUX_CE2
Q2X_TISCANIN27inputTCELL166:IMUX_CE2
Q2X_TISCANIN28inputTCELL157:IMUX_CE2
Q2X_TISCANIN29inputTCELL148:IMUX_CE1
Q2X_TISCANIN3inputTCELL145:IMUX_CE1
Q2X_TISCANIN4inputTCELL165:IMUX_CE3
Q2X_TISCANIN5inputTCELL146:IMUX_CE2
Q2X_TISCANIN6inputTCELL148:IMUX_CE0
Q2X_TISCANIN7inputTCELL146:IMUX_CE3
Q2X_TISCANIN8inputTCELL147:IMUX_CE2
Q2X_TISCANIN9inputTCELL146:IMUX_CE1
Q2X_TISCANMODEinputTCELL147:IMUX_LSR1
Q2X_TISCANRSTNinputTCELL147:IMUX_LSR0
Q2X_TOSCANOUT0outputTCELL163:OUT_F1
Q2X_TOSCANOUT1outputTCELL153:OUT_F4
Q2X_TOSCANOUT10outputTCELL140:OUT_F3
Q2X_TOSCANOUT11outputTCELL153:OUT_F3
Q2X_TOSCANOUT12outputTCELL152:OUT_Q7
Q2X_TOSCANOUT13outputTCELL153:OUT_F6
Q2X_TOSCANOUT14outputTCELL153:OUT_F7
Q2X_TOSCANOUT15outputTCELL158:OUT_Q0
Q2X_TOSCANOUT16outputTCELL165:OUT_F2
Q2X_TOSCANOUT17outputTCELL166:OUT_F1
Q2X_TOSCANOUT18outputTCELL167:OUT_F5
Q2X_TOSCANOUT19outputTCELL164:OUT_Q3
Q2X_TOSCANOUT2outputTCELL149:OUT_Q5
Q2X_TOSCANOUT20outputTCELL162:OUT_Q7
Q2X_TOSCANOUT21outputTCELL149:OUT_F6
Q2X_TOSCANOUT22outputTCELL146:OUT_F1
Q2X_TOSCANOUT23outputTCELL134:OUT_Q1
Q2X_TOSCANOUT24outputTCELL139:OUT_F1
Q2X_TOSCANOUT25outputTCELL153:OUT_F2
Q2X_TOSCANOUT26outputTCELL150:OUT_Q5
Q2X_TOSCANOUT27outputTCELL162:OUT_Q5
Q2X_TOSCANOUT28outputTCELL167:OUT_F6
Q2X_TOSCANOUT3outputTCELL150:OUT_Q4
Q2X_TOSCANOUT4outputTCELL153:OUT_F1
Q2X_TOSCANOUT5outputTCELL163:OUT_F3
Q2X_TOSCANOUT6outputTCELL153:OUT_F0
Q2X_TOSCANOUT7outputTCELL138:OUT_Q3
Q2X_TOSCANOUT8outputTCELL147:OUT_Q3
Q2X_TOSCANOUT9outputTCELL138:OUT_F0
Q2_FCDFECOEFF0_0inputTCELL118:IMUX_A2
Q2_FCDFECOEFF0_1inputTCELL118:IMUX_A1
Q2_FCDFECOEFF0_2inputTCELL118:IMUX_A0
Q2_FCDFECOEFF0_3inputTCELL117:IMUX_D5
Q2_FCDFECOEFF0_4inputTCELL117:IMUX_D4
Q2_FCDFECOEFF0_5inputTCELL117:IMUX_D3
Q2_FCDFECOEFF0_6inputTCELL117:IMUX_D2
Q2_FCDFECOEFF0_7inputTCELL117:IMUX_D1
Q2_FCDFECOEFF1_0inputTCELL118:IMUX_B4
Q2_FCDFECOEFF1_1inputTCELL118:IMUX_B3
Q2_FCDFECOEFF1_2inputTCELL118:IMUX_B2
Q2_FCDFECOEFF1_3inputTCELL118:IMUX_B1
Q2_FCDFECOEFF1_4inputTCELL118:IMUX_B0
Q2_FCDFECOEFF1_5inputTCELL118:IMUX_A5
Q2_FCDFECOEFF1_6inputTCELL118:IMUX_A4
Q2_FCDFECOEFF1_7inputTCELL118:IMUX_A3
Q2_FCDFECOEFF2_0inputTCELL118:IMUX_D0
Q2_FCDFECOEFF2_1inputTCELL118:IMUX_C5
Q2_FCDFECOEFF2_2inputTCELL118:IMUX_C4
Q2_FCDFECOEFF2_3inputTCELL118:IMUX_C3
Q2_FCDFECOEFF2_4inputTCELL118:IMUX_C2
Q2_FCDFECOEFF2_5inputTCELL118:IMUX_C1
Q2_FCDFECOEFF2_6inputTCELL118:IMUX_C0
Q2_FCDFECOEFF2_7inputTCELL118:IMUX_B5
Q2_FCDFECOEFF3_0inputTCELL119:IMUX_A2
Q2_FCDFECOEFF3_1inputTCELL119:IMUX_A1
Q2_FCDFECOEFF3_2inputTCELL119:IMUX_A0
Q2_FCDFECOEFF3_3inputTCELL118:IMUX_D5
Q2_FCDFECOEFF3_4inputTCELL118:IMUX_D4
Q2_FCDFECOEFF3_5inputTCELL118:IMUX_D3
Q2_FCDFECOEFF3_6inputTCELL118:IMUX_D2
Q2_FCDFECOEFF3_7inputTCELL118:IMUX_D1
Q2_FCDFECOEFF4_0inputTCELL119:IMUX_B4
Q2_FCDFECOEFF4_1inputTCELL119:IMUX_B3
Q2_FCDFECOEFF4_2inputTCELL119:IMUX_B2
Q2_FCDFECOEFF4_3inputTCELL119:IMUX_B1
Q2_FCDFECOEFF4_4inputTCELL119:IMUX_B0
Q2_FCDFECOEFF4_5inputTCELL119:IMUX_A5
Q2_FCDFECOEFF4_6inputTCELL119:IMUX_A4
Q2_FCDFECOEFF4_7inputTCELL119:IMUX_A3
Q2_FCDFECOEFF5_0inputTCELL119:IMUX_D0
Q2_FCDFECOEFF5_1inputTCELL119:IMUX_C5
Q2_FCDFECOEFF5_2inputTCELL119:IMUX_C4
Q2_FCDFECOEFF5_3inputTCELL119:IMUX_C3
Q2_FCDFECOEFF5_4inputTCELL119:IMUX_C2
Q2_FCDFECOEFF5_5inputTCELL119:IMUX_C1
Q2_FCDFECOEFF5_6inputTCELL119:IMUX_C0
Q2_FCDFECOEFF5_7inputTCELL119:IMUX_B5
Q2_FCDFESIGN1inputTCELL119:IMUX_D5
Q2_FCDFESIGN2inputTCELL119:IMUX_D4
Q2_FCDFESIGN3inputTCELL119:IMUX_D3
Q2_FCDFESIGN4inputTCELL119:IMUX_D2
Q2_FCDFESIGN5inputTCELL119:IMUX_D1
Q2_FCMPWRUPinputTCELL117:IMUX_A1
Q2_FCMRSTinputTCELL116:IMUX_C2
Q2_FCSCANMODEinputTCELL117:IMUX_C4
Q2_FDDFECHSEL0inputTCELL117:IMUX_D0
Q2_FDDFECHSEL1inputTCELL117:IMUX_C5
Q2_FDDFEDATA0outputTCELL121:OUT_F0
Q2_FDDFEDATA1outputTCELL120:OUT_Q7
Q2_FDDFEDATA2outputTCELL120:OUT_Q6
Q2_FDDFEDATA3outputTCELL120:OUT_Q5
Q2_FDDFEDATA4outputTCELL120:OUT_Q4
Q2_FDDFEDATA5outputTCELL120:OUT_Q3
Q2_FDDFEDATA6outputTCELL120:OUT_Q2
Q2_FDDFEDATA7outputTCELL120:OUT_Q1
Q2_FDDFEDATA8outputTCELL120:OUT_Q0
Q2_FDDFEDATA9outputTCELL120:OUT_F7
Q2_FDDFEERR0outputTCELL121:OUT_Q2
Q2_FDDFEERR1outputTCELL121:OUT_Q1
Q2_FDDFEERR2outputTCELL121:OUT_Q0
Q2_FDDFEERR3outputTCELL121:OUT_F7
Q2_FDDFEERR4outputTCELL121:OUT_F6
Q2_FDDFEERR5outputTCELL121:OUT_F5
Q2_FDDFEERR6outputTCELL121:OUT_F4
Q2_FDDFEERR7outputTCELL121:OUT_F3
Q2_FDDFEERR8outputTCELL121:OUT_F2
Q2_FDDFEERR9outputTCELL121:OUT_F1
Q2_FIGRPFBRRCLK0inputTCELL130:IMUX_CLK1_DELAY
Q2_FIGRPFBRRCLK1inputTCELL130:IMUX_CLK0_DELAY
Q2_FIGRPFBTWCLK0inputTCELL131:IMUX_CLK1_DELAY
Q2_FIGRPFBTWCLK1inputTCELL131:IMUX_CLK0_DELAY
Q2_FIRXTESTCLKinputTCELL132:IMUX_CLK1_DELAY
Q2_FISYNCCLKinputTCELL132:IMUX_CLK0_DELAY
Q2_FITMRCLKinputTCELL117:IMUX_CLK0_DELAY
Q2_FITXTESTCLKinputTCELL133:IMUX_CLK1_DELAY
Q2_FOREFCLK2FPGAoutputTCELL120:OUT_F2
Q2_HSPLLLOLoutputTCELL119:OUT_F0
Q2_HSPLLPWRUPinputTCELL117:IMUX_A2
Q2_HSPLLREFCLKIinputTCELL123:IMUX_CLK1_DELAY
Q2_HSPLLRSTinputTCELL118:IMUX_LSR1
Q2_LSPLLLOLoutputTCELL119:OUT_F1
Q2_LSPLLPWRUPinputTCELL117:IMUX_A3
Q2_LSPLLREFCLKIinputTCELL123:IMUX_CLK0_DELAY
Q2_LSPLLRSTinputTCELL118:IMUX_LSR0

Bel wires

ecp4 SERDES3 bel wires
WirePins
TCELL0:IMUX_A2SERDES.Q0CH0_FCLDRTXEN
TCELL0:IMUX_A3SERDES.Q0CH1_FCLDRTXEN
TCELL0:IMUX_A4SERDES.Q0CH2_FCLDRTXEN
TCELL0:IMUX_A5SERDES.Q0CH3_FCLDRTXEN
TCELL0:IMUX_B2SERDES.Q0CH0_FCALIGNEN
TCELL0:IMUX_B3SERDES.Q0CH1_FCALIGNEN
TCELL0:IMUX_B4SERDES.Q0CH2_FCALIGNEN
TCELL0:IMUX_B5SERDES.Q0CH3_FCALIGNEN
TCELL0:IMUX_C2SERDES.Q0_FCMRST
TCELL0:IMUX_C3SERDES.Q0CH0_FCTXPWRUP
TCELL0:IMUX_C4SERDES.Q0CH1_FCTXPWRUP
TCELL0:IMUX_C5SERDES.Q0CH2_FCTXPWRUP
TCELL0:IMUX_D2SERDES.Q0CH3_FCTXPWRUP
TCELL0:IMUX_D3SERDES.Q0CH0_FCRXPWRUP
TCELL0:IMUX_D4SERDES.Q0CH1_FCRXPWRUP
TCELL0:IMUX_D5SERDES.Q0CH2_FCRXPWRUP
TCELL0:OUT_F2SERDES.Q0CH3_FDRX47
TCELL0:OUT_F3SERDES.Q0CH3_FDRX46
TCELL0:OUT_F4SERDES.Q0CH3_FDRX45
TCELL0:OUT_F5SERDES.Q0CH3_FDRX44
TCELL0:OUT_F6SERDES.Q0CH3_FDRX43
TCELL0:OUT_F7SERDES.Q0CH3_FDRX42
TCELL0:OUT_Q2SERDES.Q0CH3_FDRX41
TCELL0:OUT_Q3SERDES.Q0CH3_FDRX40
TCELL0:OUT_Q4SERDES.Q0CH3_FDRX39
TCELL0:OUT_Q5SERDES.Q0CH3_FDRX38
TCELL0:OUT_Q6SERDES.Q0CH3_FDRX37
TCELL0:OUT_Q7SERDES.Q0CH3_FDRX36
TCELL1:IMUX_A0SERDES.Q0CH3_FCRXPWRUP
TCELL1:IMUX_A1SERDES.Q0_FCMPWRUP
TCELL1:IMUX_A2SERDES.Q0_HSPLLPWRUP
TCELL1:IMUX_A3SERDES.Q0_LSPLLPWRUP
TCELL1:IMUX_A4SERDES.Q0CH0_FCRATE2
TCELL1:IMUX_A5SERDES.Q0CH0_FCRATE1
TCELL1:IMUX_B0SERDES.Q0CH0_FCRATE0
TCELL1:IMUX_B1SERDES.Q0CH1_FCRATE2
TCELL1:IMUX_B2SERDES.Q0CH1_FCRATE1
TCELL1:IMUX_B3SERDES.Q0CH1_FCRATE0
TCELL1:IMUX_B4SERDES.Q0CH2_FCRATE2
TCELL1:IMUX_B5SERDES.Q0CH2_FCRATE1
TCELL1:IMUX_C0SERDES.Q0CH2_FCRATE0
TCELL1:IMUX_C1SERDES.Q0CH3_FCRATE2
TCELL1:IMUX_C2SERDES.Q0CH3_FCRATE1
TCELL1:IMUX_C3SERDES.Q0CH3_FCRATE0
TCELL1:IMUX_C4SERDES.Q0_FCSCANMODE
TCELL1:IMUX_C5SERDES.Q0_FDDFECHSEL1
TCELL1:IMUX_D0SERDES.Q0_FDDFECHSEL0
TCELL1:IMUX_D1SERDES.Q0_FCDFECOEFF0_7
TCELL1:IMUX_D2SERDES.Q0_FCDFECOEFF0_6
TCELL1:IMUX_D3SERDES.Q0_FCDFECOEFF0_5
TCELL1:IMUX_D4SERDES.Q0_FCDFECOEFF0_4
TCELL1:IMUX_D5SERDES.Q0_FCDFECOEFF0_3
TCELL1:IMUX_LSR0SERDES.Q0CH2_FCTRST
TCELL1:IMUX_LSR1SERDES.Q0CH3_FCTRST
TCELL1:IMUX_CLK0_DELAYSERDES.Q0_FITMRCLK
TCELL1:IMUX_CLK1_DELAYSERDES.Q0CH0_FITMRSTARTCLK
TCELL1:OUT_F0SERDES.Q0CH3_FDRX35
TCELL1:OUT_F1SERDES.Q0CH3_FDRX34
TCELL1:OUT_F2SERDES.Q0CH3_FDRX33
TCELL1:OUT_F3SERDES.Q0CH3_FDRX32
TCELL1:OUT_F4SERDES.Q0CH0_FSPCIEDONE
TCELL1:OUT_F5SERDES.Q0CH1_FSPCIEDONE
TCELL1:OUT_F6SERDES.Q0CH2_FSPCIEDONE
TCELL1:OUT_F7SERDES.Q0CH3_FSPCIEDONE
TCELL1:OUT_Q0SERDES.Q0CH0_FSPCIECON
TCELL1:OUT_Q1SERDES.Q0CH1_FSPCIECON
TCELL1:OUT_Q2SERDES.Q0CH2_FSPCIECON
TCELL1:OUT_Q3SERDES.Q0CH3_FSPCIECON
TCELL1:OUT_Q4SERDES.Q0CH0_FSRLOS
TCELL1:OUT_Q5SERDES.Q0CH1_FSRLOS
TCELL1:OUT_Q6SERDES.Q0CH2_FSRLOS
TCELL1:OUT_Q7SERDES.Q0CH3_FSRLOS
TCELL2:IMUX_A0SERDES.Q0_FCDFECOEFF0_2
TCELL2:IMUX_A1SERDES.Q0_FCDFECOEFF0_1
TCELL2:IMUX_A2SERDES.Q0_FCDFECOEFF0_0
TCELL2:IMUX_A3SERDES.Q0_FCDFECOEFF1_7
TCELL2:IMUX_A4SERDES.Q0_FCDFECOEFF1_6
TCELL2:IMUX_A5SERDES.Q0_FCDFECOEFF1_5
TCELL2:IMUX_B0SERDES.Q0_FCDFECOEFF1_4
TCELL2:IMUX_B1SERDES.Q0_FCDFECOEFF1_3
TCELL2:IMUX_B2SERDES.Q0_FCDFECOEFF1_2
TCELL2:IMUX_B3SERDES.Q0_FCDFECOEFF1_1
TCELL2:IMUX_B4SERDES.Q0_FCDFECOEFF1_0
TCELL2:IMUX_B5SERDES.Q0_FCDFECOEFF2_7
TCELL2:IMUX_C0SERDES.Q0_FCDFECOEFF2_6
TCELL2:IMUX_C1SERDES.Q0_FCDFECOEFF2_5
TCELL2:IMUX_C2SERDES.Q0_FCDFECOEFF2_4
TCELL2:IMUX_C3SERDES.Q0_FCDFECOEFF2_3
TCELL2:IMUX_C4SERDES.Q0_FCDFECOEFF2_2
TCELL2:IMUX_C5SERDES.Q0_FCDFECOEFF2_1
TCELL2:IMUX_D0SERDES.Q0_FCDFECOEFF2_0
TCELL2:IMUX_D1SERDES.Q0_FCDFECOEFF3_7
TCELL2:IMUX_D2SERDES.Q0_FCDFECOEFF3_6
TCELL2:IMUX_D3SERDES.Q0_FCDFECOEFF3_5
TCELL2:IMUX_D4SERDES.Q0_FCDFECOEFF3_4
TCELL2:IMUX_D5SERDES.Q0_FCDFECOEFF3_3
TCELL2:IMUX_LSR0SERDES.Q0_LSPLLRST
TCELL2:IMUX_LSR1SERDES.Q0_HSPLLRST
TCELL2:IMUX_CLK0_DELAYSERDES.Q0CH1_FITMRSTARTCLK
TCELL2:IMUX_CLK1_DELAYSERDES.Q0CH2_FITMRSTARTCLK
TCELL2:OUT_F0SERDES.Q0CH0_FSLSM
TCELL2:OUT_F1SERDES.Q0CH1_FSLSM
TCELL2:OUT_F2SERDES.Q0CH2_FSLSM
TCELL2:OUT_F3SERDES.Q0CH3_FSLSM
TCELL2:OUT_F4SERDES.Q0CH0_FSCCUNDERRUN
TCELL2:OUT_F5SERDES.Q0CH1_FSCCUNDERRUN
TCELL2:OUT_F6SERDES.Q0CH2_FSCCUNDERRUN
TCELL2:OUT_F7SERDES.Q0CH3_FSCCUNDERRUN
TCELL2:OUT_Q0SERDES.Q0CH0_FSCCOVERRUN
TCELL2:OUT_Q1SERDES.Q0CH1_FSCCOVERRUN
TCELL2:OUT_Q2SERDES.Q0CH2_FSCCOVERRUN
TCELL2:OUT_Q3SERDES.Q0CH3_FSCCOVERRUN
TCELL2:OUT_Q4SERDES.Q0CH0_FSRLOL
TCELL2:OUT_Q5SERDES.Q0CH1_FSRLOL
TCELL2:OUT_Q6SERDES.Q0CH2_FSRLOL
TCELL2:OUT_Q7SERDES.Q0CH3_FSRLOL
TCELL3:IMUX_A0SERDES.Q0_FCDFECOEFF3_2
TCELL3:IMUX_A1SERDES.Q0_FCDFECOEFF3_1
TCELL3:IMUX_A2SERDES.Q0_FCDFECOEFF3_0
TCELL3:IMUX_A3SERDES.Q0_FCDFECOEFF4_7
TCELL3:IMUX_A4SERDES.Q0_FCDFECOEFF4_6
TCELL3:IMUX_A5SERDES.Q0_FCDFECOEFF4_5
TCELL3:IMUX_B0SERDES.Q0_FCDFECOEFF4_4
TCELL3:IMUX_B1SERDES.Q0_FCDFECOEFF4_3
TCELL3:IMUX_B2SERDES.Q0_FCDFECOEFF4_2
TCELL3:IMUX_B3SERDES.Q0_FCDFECOEFF4_1
TCELL3:IMUX_B4SERDES.Q0_FCDFECOEFF4_0
TCELL3:IMUX_B5SERDES.Q0_FCDFECOEFF5_7
TCELL3:IMUX_C0SERDES.Q0_FCDFECOEFF5_6
TCELL3:IMUX_C1SERDES.Q0_FCDFECOEFF5_5
TCELL3:IMUX_C2SERDES.Q0_FCDFECOEFF5_4
TCELL3:IMUX_C3SERDES.Q0_FCDFECOEFF5_3
TCELL3:IMUX_C4SERDES.Q0_FCDFECOEFF5_2
TCELL3:IMUX_C5SERDES.Q0_FCDFECOEFF5_1
TCELL3:IMUX_D0SERDES.Q0_FCDFECOEFF5_0
TCELL3:IMUX_D1SERDES.Q0_FCDFESIGN5
TCELL3:IMUX_D2SERDES.Q0_FCDFESIGN4
TCELL3:IMUX_D3SERDES.Q0_FCDFESIGN3
TCELL3:IMUX_D4SERDES.Q0_FCDFESIGN2
TCELL3:IMUX_D5SERDES.Q0_FCDFESIGN1
TCELL3:IMUX_CLK0_DELAYSERDES.Q0CH3_FITMRSTARTCLK
TCELL3:IMUX_CLK1_DELAYSERDES.Q0CH0_FITMRSTOPCLK
TCELL3:OUT_F0SERDES.Q0_HSPLLLOL
TCELL3:OUT_F1SERDES.Q0_LSPLLLOL
TCELL3:OUT_F2SERDES.Q0CH0_FDLDRRX
TCELL3:OUT_F3SERDES.Q0CH1_FDLDRRX
TCELL3:OUT_F4SERDES.Q0CH2_FDLDRRX
TCELL3:OUT_F5SERDES.Q0CH3_FDLDRRX
TCELL3:OUT_F6SERDES.Q0CH0_FSSKPADDED
TCELL3:OUT_F7SERDES.Q0CH1_FSSKPADDED
TCELL3:OUT_Q0SERDES.Q0CH2_FSSKPADDED
TCELL3:OUT_Q1SERDES.Q0CH3_FSSKPADDED
TCELL3:OUT_Q2SERDES.Q0CH0_FSSKPDELETED
TCELL3:OUT_Q3SERDES.Q0CH1_FSSKPDELETED
TCELL3:OUT_Q4SERDES.Q0CH2_FSSKPDELETED
TCELL3:OUT_Q5SERDES.Q0CH3_FSSKPDELETED
TCELL3:OUT_Q6SERDES.Q0D0_FSDE
TCELL3:OUT_Q7SERDES.Q0D1_FSDE
TCELL4:IMUX_A0SERDES.Q0CH0_FCTMRSTART
TCELL4:IMUX_A1SERDES.Q0CH1_FCTMRSTART
TCELL4:IMUX_A2SERDES.Q0CH2_FCTMRSTART
TCELL4:IMUX_A3SERDES.Q0CH3_FCTMRSTART
TCELL4:IMUX_A4SERDES.Q0CH0_FCTMRSTOP
TCELL4:IMUX_A5SERDES.Q0CH1_FCTMRSTOP
TCELL4:IMUX_B0SERDES.Q0CH2_FCTMRSTOP
TCELL4:IMUX_B1SERDES.Q0CH3_FCTMRSTOP
TCELL4:IMUX_CLK0_DELAYSERDES.Q0CH1_FITMRSTOPCLK
TCELL4:IMUX_CLK1_DELAYSERDES.Q0CH2_FITMRSTOPCLK
TCELL4:OUT_F0SERDES.Q0D0_FSDM
TCELL4:OUT_F1SERDES.Q0D1_FSDM
TCELL4:OUT_F2SERDES.Q0_FOREFCLK2FPGA
TCELL4:OUT_F3SERDES.Q0CH0_FSRCDONE
TCELL4:OUT_F4SERDES.Q0CH1_FSRCDONE
TCELL4:OUT_F5SERDES.Q0CH2_FSRCDONE
TCELL4:OUT_F6SERDES.Q0CH3_FSRCDONE
TCELL4:OUT_F7SERDES.Q0_FDDFEDATA9
TCELL4:OUT_Q0SERDES.Q0_FDDFEDATA8
TCELL4:OUT_Q1SERDES.Q0_FDDFEDATA7
TCELL4:OUT_Q2SERDES.Q0_FDDFEDATA6
TCELL4:OUT_Q3SERDES.Q0_FDDFEDATA5
TCELL4:OUT_Q4SERDES.Q0_FDDFEDATA4
TCELL4:OUT_Q5SERDES.Q0_FDDFEDATA3
TCELL4:OUT_Q6SERDES.Q0_FDDFEDATA2
TCELL4:OUT_Q7SERDES.Q0_FDDFEDATA1
TCELL5:IMUX_CLK0_DELAYSERDES.Q0CH3_FITMRSTOPCLK
TCELL5:OUT_F0SERDES.Q0_FDDFEDATA0
TCELL5:OUT_F1SERDES.Q0_FDDFEERR9
TCELL5:OUT_F2SERDES.Q0_FDDFEERR8
TCELL5:OUT_F3SERDES.Q0_FDDFEERR7
TCELL5:OUT_F4SERDES.Q0_FDDFEERR6
TCELL5:OUT_F5SERDES.Q0_FDDFEERR5
TCELL5:OUT_F6SERDES.Q0_FDDFEERR4
TCELL5:OUT_F7SERDES.Q0_FDDFEERR3
TCELL5:OUT_Q0SERDES.Q0_FDDFEERR2
TCELL5:OUT_Q1SERDES.Q0_FDDFEERR1
TCELL5:OUT_Q2SERDES.Q0_FDDFEERR0
TCELL5:OUT_Q3SERDES.Q0CH0_FSDFEVLD
TCELL5:OUT_Q4SERDES.Q0CH1_FSDFEVLD
TCELL5:OUT_Q5SERDES.Q0CH2_FSDFEVLD
TCELL5:OUT_Q6SERDES.Q0CH3_FSDFEVLD
TCELL7:IMUX_A0SERDES.Q0CH3_FDTX49
TCELL7:IMUX_A1SERDES.Q0CH3_FDTX48
TCELL7:IMUX_A2SERDES.Q0CH3_FDTX47
TCELL7:IMUX_A3SERDES.Q0CH3_FDTX46
TCELL7:IMUX_A4SERDES.Q0CH3_FDTX45
TCELL7:IMUX_A5SERDES.Q0CH3_FDTX44
TCELL7:IMUX_B0SERDES.Q0CH3_FDTX43
TCELL7:IMUX_B1SERDES.Q0CH3_FDTX42
TCELL7:IMUX_B2SERDES.Q0CH3_FDTX41
TCELL7:IMUX_B3SERDES.Q0CH3_FDTX40
TCELL7:IMUX_B4SERDES.Q0CH3_FDTX39
TCELL7:IMUX_B5SERDES.Q0CH3_FDTX38
TCELL7:IMUX_C0SERDES.Q0CH3_FDTX37
TCELL7:IMUX_C1SERDES.Q0CH3_FDTX36
TCELL7:IMUX_C2SERDES.Q0CH3_FDTX35
TCELL7:IMUX_C3SERDES.Q0CH3_FDTX34
TCELL7:IMUX_C4SERDES.Q0CH3_FDTX33
TCELL7:IMUX_C5SERDES.Q0CH3_FDTX32
TCELL7:IMUX_D0SERDES.Q0CH3_FDTX31
TCELL7:IMUX_D1SERDES.Q0CH3_FDTX30
TCELL7:IMUX_D2SERDES.Q0CH3_FDTX29
TCELL7:IMUX_D3SERDES.Q0CH3_FDTX28
TCELL7:IMUX_D4SERDES.Q0CH3_FDTX27
TCELL7:IMUX_D5SERDES.Q0CH3_FDTX26
TCELL7:IMUX_LSR0SERDES.Q0CH0_FCPIPEPHYRESETN
TCELL7:IMUX_LSR1SERDES.Q0CH1_FCPIPEPHYRESETN
TCELL7:IMUX_CLK0_DELAYSERDES.Q0_HSPLLREFCLKI
TCELL7:IMUX_CLK1_DELAYSERDES.Q0_LSPLLREFCLKI
TCELL7:IMUX_CE0SERDES.Q0CH0_FCDFERDEN
TCELL7:IMUX_CE1SERDES.Q0CH1_FCDFERDEN
TCELL7:IMUX_CE2SERDES.Q0CH2_FCDFERDEN
TCELL7:IMUX_CE3SERDES.Q0CH3_FCDFERDEN
TCELL7:OUT_F0SERDES.Q0CH3_FDRX31
TCELL7:OUT_F1SERDES.Q0CH3_FDRX30
TCELL7:OUT_F2SERDES.Q0CH3_FDRX29
TCELL7:OUT_F3SERDES.Q0CH3_FDRX28
TCELL7:OUT_F4SERDES.Q0CH3_FDRX27
TCELL7:OUT_F5SERDES.Q0CH3_FDRX26
TCELL7:OUT_F6SERDES.Q0CH3_FDRX25
TCELL7:OUT_F7SERDES.Q0CH3_FDRX24
TCELL7:OUT_Q0SERDES.Q0CH3_FDRX23
TCELL7:OUT_Q1SERDES.Q0CH3_FDRX22
TCELL7:OUT_Q2SERDES.Q0CH3_FDRX21
TCELL7:OUT_Q3SERDES.Q0CH3_FDRX20
TCELL7:OUT_Q4SERDES.Q0CH3_FDRX19
TCELL7:OUT_Q5SERDES.Q0CH3_FDRX18
TCELL7:OUT_Q6SERDES.Q0CH3_FDRX17
TCELL7:OUT_Q7SERDES.Q0CH3_FDRX16
TCELL8:IMUX_A0SERDES.Q0CH3_FDTX25
TCELL8:IMUX_A1SERDES.Q0CH3_FDTX24
TCELL8:IMUX_A2SERDES.Q0CH3_FDTX23
TCELL8:IMUX_A3SERDES.Q0CH3_FDTX22
TCELL8:IMUX_A4SERDES.Q0CH3_FDTX21
TCELL8:IMUX_A5SERDES.Q0CH3_FDTX20
TCELL8:IMUX_B0SERDES.Q0CH3_FDTX19
TCELL8:IMUX_B1SERDES.Q0CH3_FDTX18
TCELL8:IMUX_B2SERDES.Q0CH3_FDTX17
TCELL8:IMUX_B3SERDES.Q0CH3_FDTX16
TCELL8:IMUX_B4SERDES.Q0CH3_FDTX15
TCELL8:IMUX_B5SERDES.Q0CH3_FDTX14
TCELL8:IMUX_C0SERDES.Q0CH3_FDTX13
TCELL8:IMUX_C1SERDES.Q0CH3_FDTX12
TCELL8:IMUX_C2SERDES.Q0CH3_FDTX11
TCELL8:IMUX_C3SERDES.Q0CH3_FDTX10
TCELL8:IMUX_C4SERDES.Q0CH3_FDTX9
TCELL8:IMUX_C5SERDES.Q0CH3_FDTX8
TCELL8:IMUX_D0SERDES.Q0CH3_FDTX7
TCELL8:IMUX_D1SERDES.Q0CH3_FDTX6
TCELL8:IMUX_D2SERDES.Q0CH3_FDTX5
TCELL8:IMUX_D3SERDES.Q0CH3_FDTX4
TCELL8:IMUX_D4SERDES.Q0CH3_FDTX3
TCELL8:IMUX_D5SERDES.Q0CH3_FDTX2
TCELL8:IMUX_LSR0SERDES.Q0CH2_FCPIPEPHYRESETN
TCELL8:IMUX_LSR1SERDES.Q0CH3_FCPIPEPHYRESETN
TCELL8:IMUX_CLK0_DELAYSERDES.Q0CH0_FIREFRXCLK
TCELL8:IMUX_CLK1_DELAYSERDES.Q0CH1_FIREFRXCLK
TCELL8:IMUX_CE0SERDES.Q0CH0_FCDFEUPD
TCELL8:IMUX_CE1SERDES.Q0CH1_FCDFEUPD
TCELL8:IMUX_CE2SERDES.Q0CH2_FCDFEUPD
TCELL8:IMUX_CE3SERDES.Q0CH3_FCDFEUPD
TCELL8:OUT_F0SERDES.Q0CH3_FDRX15
TCELL8:OUT_F1SERDES.Q0CH3_FDRX14
TCELL8:OUT_F2SERDES.Q0CH3_FDRX13
TCELL8:OUT_F3SERDES.Q0CH3_FDRX12
TCELL8:OUT_F4SERDES.Q0CH3_FDRX11
TCELL8:OUT_F5SERDES.Q0CH3_FDRX10
TCELL8:OUT_F6SERDES.Q0CH3_FDRX9
TCELL8:OUT_F7SERDES.Q0CH3_FDRX8
TCELL8:OUT_Q0SERDES.Q0CH3_FDRX7
TCELL8:OUT_Q1SERDES.Q0CH3_FDRX6
TCELL8:OUT_Q2SERDES.Q0CH3_FDRX5
TCELL8:OUT_Q3SERDES.Q0CH3_FDRX4
TCELL8:OUT_Q4SERDES.Q0CH3_FDRX3
TCELL8:OUT_Q5SERDES.Q0CH3_FDRX2
TCELL8:OUT_Q6SERDES.Q0CH3_FDRX1
TCELL8:OUT_Q7SERDES.Q0CH3_FDRX0
TCELL9:IMUX_A0SERDES.Q0CH3_FDTX1
TCELL9:IMUX_A1SERDES.Q0CH3_FDTX0
TCELL9:IMUX_A2SERDES.Q0CH2_FDTX49
TCELL9:IMUX_A3SERDES.Q0CH2_FDTX48
TCELL9:IMUX_A4SERDES.Q0CH2_FDTX47
TCELL9:IMUX_A5SERDES.Q0CH2_FDTX46
TCELL9:IMUX_B0SERDES.Q0CH2_FDTX45
TCELL9:IMUX_B1SERDES.Q0CH2_FDTX44
TCELL9:IMUX_B2SERDES.Q0CH2_FDTX43
TCELL9:IMUX_B3SERDES.Q0CH2_FDTX42
TCELL9:IMUX_B4SERDES.Q0CH2_FDTX41
TCELL9:IMUX_B5SERDES.Q0CH2_FDTX40
TCELL9:IMUX_C0SERDES.Q0CH2_FDTX39
TCELL9:IMUX_C1SERDES.Q0CH2_FDTX38
TCELL9:IMUX_C2SERDES.Q0CH2_FDTX37
TCELL9:IMUX_C3SERDES.Q0CH2_FDTX36
TCELL9:IMUX_C4SERDES.Q0CH2_FDTX35
TCELL9:IMUX_C5SERDES.Q0CH2_FDTX34
TCELL9:IMUX_D0SERDES.Q0CH2_FDTX33
TCELL9:IMUX_D1SERDES.Q0CH2_FDTX32
TCELL9:IMUX_D2SERDES.Q0CH2_FDTX31
TCELL9:IMUX_D3SERDES.Q0CH2_FDTX30
TCELL9:IMUX_D4SERDES.Q0CH2_FDTX29
TCELL9:IMUX_D5SERDES.Q0CH2_FDTX28
TCELL9:IMUX_LSR0SERDES.Q0D0_FCDERST
TCELL9:IMUX_LSR1SERDES.Q0D1_FCDERST
TCELL9:IMUX_CLK0_DELAYSERDES.Q0CH2_FIREFRXCLK
TCELL9:IMUX_CLK1_DELAYSERDES.Q0CH3_FIREFRXCLK
TCELL9:OUT_F0SERDES.Q0CH2_FDRX47
TCELL9:OUT_F1SERDES.Q0CH2_FDRX46
TCELL9:OUT_F2SERDES.Q0CH2_FDRX45
TCELL9:OUT_F3SERDES.Q0CH2_FDRX44
TCELL9:OUT_F4SERDES.Q0CH2_FDRX43
TCELL9:OUT_F5SERDES.Q0CH2_FDRX42
TCELL9:OUT_F6SERDES.Q0CH2_FDRX41
TCELL9:OUT_F7SERDES.Q0CH2_FDRX40
TCELL9:OUT_Q0SERDES.Q0CH2_FDRX39
TCELL9:OUT_Q1SERDES.Q0CH2_FDRX38
TCELL9:OUT_Q2SERDES.Q0CH2_FDRX37
TCELL9:OUT_Q3SERDES.Q0CH2_FDRX36
TCELL9:OUT_Q4SERDES.Q0CH2_FDRX35
TCELL9:OUT_Q5SERDES.Q0CH2_FDRX34
TCELL9:OUT_Q6SERDES.Q0CH2_FDRX33
TCELL9:OUT_Q7SERDES.Q0CH2_FDRX32
TCELL10:IMUX_A0SERDES.Q0CH2_FDTX27
TCELL10:IMUX_A1SERDES.Q0CH2_FDTX26
TCELL10:IMUX_A2SERDES.Q0CH2_FDTX25
TCELL10:IMUX_A3SERDES.Q0CH2_FDTX24
TCELL10:IMUX_A4SERDES.Q0CH2_FDTX23
TCELL10:IMUX_A5SERDES.Q0CH2_FDTX22
TCELL10:IMUX_B0SERDES.Q0CH2_FDTX21
TCELL10:IMUX_B1SERDES.Q0CH2_FDTX20
TCELL10:IMUX_B2SERDES.Q0CH2_FDTX19
TCELL10:IMUX_B3SERDES.Q0CH2_FDTX18
TCELL10:IMUX_B4SERDES.Q0CH2_FDTX17
TCELL10:IMUX_B5SERDES.Q0CH2_FDTX16
TCELL10:IMUX_C0SERDES.Q0CH2_FDTX15
TCELL10:IMUX_C1SERDES.Q0CH2_FDTX14
TCELL10:IMUX_C2SERDES.Q0CH2_FDTX13
TCELL10:IMUX_C3SERDES.Q0CH2_FDTX12
TCELL10:IMUX_C4SERDES.Q0CH2_FDTX11
TCELL10:IMUX_C5SERDES.Q0CH2_FDTX10
TCELL10:IMUX_D0SERDES.Q0CH2_FDTX9
TCELL10:IMUX_D1SERDES.Q0CH2_FDTX8
TCELL10:IMUX_D2SERDES.Q0CH2_FDTX7
TCELL10:IMUX_D3SERDES.Q0CH2_FDTX6
TCELL10:IMUX_D4SERDES.Q0CH2_FDTX5
TCELL10:IMUX_D5SERDES.Q0CH2_FDTX4
TCELL10:IMUX_LSR0SERDES.Q0CH0_FCPCSTXRST
TCELL10:IMUX_LSR1SERDES.Q0CH1_FCPCSTXRST
TCELL10:IMUX_CLK0_DELAYSERDES.Q0CH0_FIRCLK
TCELL10:IMUX_CLK1_DELAYSERDES.Q0CH1_FIRCLK
TCELL10:OUT_F0SERDES.Q0CH2_FDRX31
TCELL10:OUT_F1SERDES.Q0CH2_FDRX30
TCELL10:OUT_F2SERDES.Q0CH2_FDRX29
TCELL10:OUT_F3SERDES.Q0CH2_FDRX28
TCELL10:OUT_F4SERDES.Q0CH2_FDRX27
TCELL10:OUT_F5SERDES.Q0CH2_FDRX26
TCELL10:OUT_F6SERDES.Q0CH2_FDRX25
TCELL10:OUT_F7SERDES.Q0CH2_FDRX24
TCELL10:OUT_Q0SERDES.Q0CH2_FDRX23
TCELL10:OUT_Q1SERDES.Q0CH2_FDRX22
TCELL10:OUT_Q2SERDES.Q0CH2_FDRX21
TCELL10:OUT_Q3SERDES.Q0CH2_FDRX20
TCELL10:OUT_Q4SERDES.Q0CH2_FDRX19
TCELL10:OUT_Q5SERDES.Q0CH2_FDRX18
TCELL10:OUT_Q6SERDES.Q0CH2_FDRX17
TCELL10:OUT_Q7SERDES.Q0CH2_FDRX16
TCELL11:IMUX_A0SERDES.Q0CH2_FDTX3
TCELL11:IMUX_A1SERDES.Q0CH2_FDTX2
TCELL11:IMUX_A2SERDES.Q0CH2_FDTX1
TCELL11:IMUX_A3SERDES.Q0CH2_FDTX0
TCELL11:IMUX_A4SERDES.Q0CH1_FDTX49
TCELL11:IMUX_A5SERDES.Q0CH1_FDTX48
TCELL11:IMUX_B0SERDES.Q0CH1_FDTX47
TCELL11:IMUX_B1SERDES.Q0CH1_FDTX46
TCELL11:IMUX_B2SERDES.Q0CH1_FDTX45
TCELL11:IMUX_B3SERDES.Q0CH1_FDTX44
TCELL11:IMUX_B4SERDES.Q0CH1_FDTX43
TCELL11:IMUX_B5SERDES.Q0CH1_FDTX42
TCELL11:IMUX_C0SERDES.Q0CH1_FDTX41
TCELL11:IMUX_C1SERDES.Q0CH1_FDTX40
TCELL11:IMUX_C2SERDES.Q0CH1_FDTX39
TCELL11:IMUX_C3SERDES.Q0CH1_FDTX38
TCELL11:IMUX_C4SERDES.Q0CH1_FDTX37
TCELL11:IMUX_C5SERDES.Q0CH1_FDTX36
TCELL11:IMUX_D0SERDES.Q0CH1_FDTX35
TCELL11:IMUX_D1SERDES.Q0CH1_FDTX34
TCELL11:IMUX_D2SERDES.Q0CH1_FDTX33
TCELL11:IMUX_D3SERDES.Q0CH1_FDTX32
TCELL11:IMUX_D4SERDES.Q0CH1_FDTX31
TCELL11:IMUX_D5SERDES.Q0CH1_FDTX30
TCELL11:IMUX_LSR0SERDES.Q0CH2_FCPCSTXRST
TCELL11:IMUX_LSR1SERDES.Q0CH3_FCPCSTXRST
TCELL11:IMUX_CLK0_DELAYSERDES.Q0CH2_FIRCLK
TCELL11:IMUX_CLK1_DELAYSERDES.Q0CH3_FIRCLK
TCELL11:OUT_F0SERDES.Q0CH2_FDRX15
TCELL11:OUT_F1SERDES.Q0CH2_FDRX14
TCELL11:OUT_F2SERDES.Q0CH2_FDRX13
TCELL11:OUT_F3SERDES.Q0CH2_FDRX12
TCELL11:OUT_F4SERDES.Q0CH2_FDRX11
TCELL11:OUT_F5SERDES.Q0CH2_FDRX10
TCELL11:OUT_F6SERDES.Q0CH2_FDRX9
TCELL11:OUT_F7SERDES.Q0CH2_FDRX8
TCELL11:OUT_Q0SERDES.Q0CH2_FDRX7
TCELL11:OUT_Q1SERDES.Q0CH2_FDRX6
TCELL11:OUT_Q2SERDES.Q0CH2_FDRX5
TCELL11:OUT_Q3SERDES.Q0CH2_FDRX4
TCELL11:OUT_Q4SERDES.Q0CH2_FDRX3
TCELL11:OUT_Q5SERDES.Q0CH2_FDRX2
TCELL11:OUT_Q6SERDES.Q0CH2_FDRX1
TCELL11:OUT_Q7SERDES.Q0CH2_FDRX0
TCELL12:IMUX_A0SERDES.Q0CH1_FDTX29
TCELL12:IMUX_A1SERDES.Q0CH1_FDTX28
TCELL12:IMUX_A2SERDES.Q0CH1_FDTX27
TCELL12:IMUX_A3SERDES.Q0CH1_FDTX26
TCELL12:IMUX_A4SERDES.Q0CH1_FDTX25
TCELL12:IMUX_A5SERDES.Q0CH1_FDTX24
TCELL12:IMUX_B0SERDES.Q0CH1_FDTX23
TCELL12:IMUX_B1SERDES.Q0CH1_FDTX22
TCELL12:IMUX_B2SERDES.Q0CH1_FDTX21
TCELL12:IMUX_B3SERDES.Q0CH1_FDTX20
TCELL12:IMUX_B4SERDES.Q0CH1_FDTX19
TCELL12:IMUX_B5SERDES.Q0CH1_FDTX18
TCELL12:IMUX_C0SERDES.Q0CH1_FDTX17
TCELL12:IMUX_C1SERDES.Q0CH1_FDTX16
TCELL12:IMUX_C2SERDES.Q0CH1_FDTX15
TCELL12:IMUX_C3SERDES.Q0CH1_FDTX14
TCELL12:IMUX_C4SERDES.Q0CH1_FDTX13
TCELL12:IMUX_C5SERDES.Q0CH1_FDTX12
TCELL12:IMUX_D0SERDES.Q0CH1_FDTX11
TCELL12:IMUX_D1SERDES.Q0CH1_FDTX10
TCELL12:IMUX_D2SERDES.Q0CH1_FDTX9
TCELL12:IMUX_D3SERDES.Q0CH1_FDTX8
TCELL12:IMUX_D4SERDES.Q0CH1_FDTX7
TCELL12:IMUX_D5SERDES.Q0CH1_FDTX6
TCELL12:IMUX_LSR0SERDES.Q0CH0_FCPCSRXRST
TCELL12:IMUX_LSR1SERDES.Q0CH1_FCPCSRXRST
TCELL12:IMUX_CLK0_DELAYSERDES.Q0CH0_FITCLK
TCELL12:IMUX_CLK1_DELAYSERDES.Q0CH1_FITCLK
TCELL12:OUT_F0SERDES.Q0CH1_FDRX47
TCELL12:OUT_F1SERDES.Q0CH1_FDRX46
TCELL12:OUT_F2SERDES.Q0CH1_FDRX45
TCELL12:OUT_F3SERDES.Q0CH1_FDRX44
TCELL12:OUT_F4SERDES.Q0CH1_FDRX43
TCELL12:OUT_F5SERDES.Q0CH1_FDRX42
TCELL12:OUT_F6SERDES.Q0CH1_FDRX41
TCELL12:OUT_F7SERDES.Q0CH1_FDRX40
TCELL12:OUT_Q0SERDES.Q0CH1_FDRX39
TCELL12:OUT_Q1SERDES.Q0CH1_FDRX38
TCELL12:OUT_Q2SERDES.Q0CH1_FDRX37
TCELL12:OUT_Q3SERDES.Q0CH1_FDRX36
TCELL12:OUT_Q4SERDES.Q0CH1_FDRX35
TCELL12:OUT_Q5SERDES.Q0CH1_FDRX34
TCELL12:OUT_Q6SERDES.Q0CH1_FDRX33
TCELL12:OUT_Q7SERDES.Q0CH1_FDRX32
TCELL13:IMUX_A0SERDES.Q0CH1_FDTX5
TCELL13:IMUX_A1SERDES.Q0CH1_FDTX4
TCELL13:IMUX_A2SERDES.Q0CH1_FDTX3
TCELL13:IMUX_A3SERDES.Q0CH1_FDTX2
TCELL13:IMUX_A4SERDES.Q0CH1_FDTX1
TCELL13:IMUX_A5SERDES.Q0CH1_FDTX0
TCELL13:IMUX_B0SERDES.Q0CH0_FDTX49
TCELL13:IMUX_B1SERDES.Q0CH0_FDTX48
TCELL13:IMUX_B2SERDES.Q0CH0_FDTX47
TCELL13:IMUX_B3SERDES.Q0CH0_FDTX46
TCELL13:IMUX_B4SERDES.Q0CH0_FDTX45
TCELL13:IMUX_B5SERDES.Q0CH0_FDTX44
TCELL13:IMUX_C0SERDES.Q0CH0_FDTX43
TCELL13:IMUX_C1SERDES.Q0CH0_FDTX42
TCELL13:IMUX_C2SERDES.Q0CH0_FDTX41
TCELL13:IMUX_C3SERDES.Q0CH0_FDTX40
TCELL13:IMUX_C4SERDES.Q0CH0_FDTX39
TCELL13:IMUX_C5SERDES.Q0CH0_FDTX38
TCELL13:IMUX_D0SERDES.Q0CH0_FDTX37
TCELL13:IMUX_D1SERDES.Q0CH0_FDTX36
TCELL13:IMUX_D2SERDES.Q0CH0_FDTX35
TCELL13:IMUX_D3SERDES.Q0CH0_FDTX34
TCELL13:IMUX_D4SERDES.Q0CH0_FDTX33
TCELL13:IMUX_D5SERDES.Q0CH0_FDTX32
TCELL13:IMUX_LSR0SERDES.Q0CH2_FCPCSRXRST
TCELL13:IMUX_LSR1SERDES.Q0CH3_FCPCSRXRST
TCELL13:IMUX_CLK0_DELAYSERDES.Q0CH2_FITCLK
TCELL13:IMUX_CLK1_DELAYSERDES.Q0CH3_FITCLK
TCELL13:OUT_F0SERDES.Q0CH1_FDRX31
TCELL13:OUT_F1SERDES.Q0CH1_FDRX30
TCELL13:OUT_F2SERDES.Q0CH1_FDRX29
TCELL13:OUT_F3SERDES.Q0CH1_FDRX28
TCELL13:OUT_F4SERDES.Q0CH1_FDRX27
TCELL13:OUT_F5SERDES.Q0CH1_FDRX26
TCELL13:OUT_F6SERDES.Q0CH1_FDRX25
TCELL13:OUT_F7SERDES.Q0CH1_FDRX24
TCELL13:OUT_Q0SERDES.Q0CH1_FDRX23
TCELL13:OUT_Q1SERDES.Q0CH1_FDRX22
TCELL13:OUT_Q2SERDES.Q0CH1_FDRX21
TCELL13:OUT_Q3SERDES.Q0CH1_FDRX20
TCELL13:OUT_Q4SERDES.Q0CH1_FDRX19
TCELL13:OUT_Q5SERDES.Q0CH1_FDRX18
TCELL13:OUT_Q6SERDES.Q0CH1_FDRX17
TCELL13:OUT_Q7SERDES.Q0CH1_FDRX16
TCELL14:IMUX_A0SERDES.Q0CH0_FDTX31
TCELL14:IMUX_A1SERDES.Q0CH0_FDTX30
TCELL14:IMUX_A2SERDES.Q0CH0_FDTX29
TCELL14:IMUX_A3SERDES.Q0CH0_FDTX28
TCELL14:IMUX_A4SERDES.Q0CH0_FDTX27
TCELL14:IMUX_A5SERDES.Q0CH0_FDTX26
TCELL14:IMUX_B0SERDES.Q0CH0_FDTX25
TCELL14:IMUX_B1SERDES.Q0CH0_FDTX24
TCELL14:IMUX_B2SERDES.Q0CH0_FDTX23
TCELL14:IMUX_B3SERDES.Q0CH0_FDTX22
TCELL14:IMUX_B4SERDES.Q0CH0_FDTX21
TCELL14:IMUX_B5SERDES.Q0CH0_FDTX20
TCELL14:IMUX_C0SERDES.Q0CH0_FDTX19
TCELL14:IMUX_C1SERDES.Q0CH0_FDTX18
TCELL14:IMUX_C2SERDES.Q0CH0_FDTX17
TCELL14:IMUX_C3SERDES.Q0CH0_FDTX16
TCELL14:IMUX_C4SERDES.Q0CH0_FDTX15
TCELL14:IMUX_C5SERDES.Q0CH0_FDTX14
TCELL14:IMUX_D0SERDES.Q0CH0_FDTX13
TCELL14:IMUX_D1SERDES.Q0CH0_FDTX12
TCELL14:IMUX_D2SERDES.Q0CH0_FDTX11
TCELL14:IMUX_D3SERDES.Q0CH0_FDTX10
TCELL14:IMUX_D4SERDES.Q0CH0_FDTX9
TCELL14:IMUX_D5SERDES.Q0CH0_FDTX8
TCELL14:IMUX_LSR0SERDES.Q0CH0_FCRRST
TCELL14:IMUX_LSR1SERDES.Q0CH1_FCRRST
TCELL14:IMUX_CLK0_DELAYSERDES.Q0_FIGRPFBRRCLK1
TCELL14:IMUX_CLK1_DELAYSERDES.Q0_FIGRPFBRRCLK0
TCELL14:OUT_F0SERDES.Q0CH1_FDRX15
TCELL14:OUT_F1SERDES.Q0CH1_FDRX14
TCELL14:OUT_F2SERDES.Q0CH1_FDRX13
TCELL14:OUT_F3SERDES.Q0CH1_FDRX12
TCELL14:OUT_F4SERDES.Q0CH1_FDRX11
TCELL14:OUT_F5SERDES.Q0CH1_FDRX10
TCELL14:OUT_F6SERDES.Q0CH1_FDRX9
TCELL14:OUT_F7SERDES.Q0CH1_FDRX8
TCELL14:OUT_Q0SERDES.Q0CH1_FDRX7
TCELL14:OUT_Q1SERDES.Q0CH1_FDRX6
TCELL14:OUT_Q2SERDES.Q0CH1_FDRX5
TCELL14:OUT_Q3SERDES.Q0CH1_FDRX4
TCELL14:OUT_Q4SERDES.Q0CH1_FDRX3
TCELL14:OUT_Q5SERDES.Q0CH1_FDRX2
TCELL14:OUT_Q6SERDES.Q0CH1_FDRX1
TCELL14:OUT_Q7SERDES.Q0CH1_FDRX0
TCELL15:IMUX_A0SERDES.Q0CH0_FDTX7
TCELL15:IMUX_A1SERDES.Q0CH0_FDTX6
TCELL15:IMUX_A2SERDES.Q0CH0_FDTX5
TCELL15:IMUX_A3SERDES.Q0CH0_FDTX4
TCELL15:IMUX_A4SERDES.Q0CH0_FDTX3
TCELL15:IMUX_A5SERDES.Q0CH0_FDTX2
TCELL15:IMUX_B0SERDES.Q0CH0_FDTX1
TCELL15:IMUX_B1SERDES.Q0CH0_FDTX0
TCELL15:IMUX_B2SERDES.Q0CH0_FCPCIEDETEN
TCELL15:IMUX_B3SERDES.Q0CH1_FCPCIEDETEN
TCELL15:IMUX_B4SERDES.Q0CH2_FCPCIEDETEN
TCELL15:IMUX_B5SERDES.Q0CH3_FCPCIEDETEN
TCELL15:IMUX_C0SERDES.Q0CH0_FCRXPOLARITY
TCELL15:IMUX_C1SERDES.Q0CH1_FCRXPOLARITY
TCELL15:IMUX_C2SERDES.Q0CH2_FCRXPOLARITY
TCELL15:IMUX_C3SERDES.Q0CH3_FCRXPOLARITY
TCELL15:IMUX_C4SERDES.Q0CH0_FCWORDALGNEN
TCELL15:IMUX_C5SERDES.Q0CH1_FCWORDALGNEN
TCELL15:IMUX_D0SERDES.Q0CH2_FCWORDALGNEN
TCELL15:IMUX_D1SERDES.Q0CH3_FCWORDALGNEN
TCELL15:IMUX_D2SERDES.Q0CH0_FCLSMEN
TCELL15:IMUX_D3SERDES.Q0CH1_FCLSMEN
TCELL15:IMUX_D4SERDES.Q0CH2_FCLSMEN
TCELL15:IMUX_D5SERDES.Q0CH3_FCLSMEN
TCELL15:IMUX_LSR0SERDES.Q0CH2_FCRRST
TCELL15:IMUX_LSR1SERDES.Q0CH3_FCRRST
TCELL15:IMUX_CLK0_DELAYSERDES.Q0_FIGRPFBTWCLK1
TCELL15:IMUX_CLK1_DELAYSERDES.Q0_FIGRPFBTWCLK0
TCELL15:OUT_F0SERDES.Q0CH0_FDRX47
TCELL15:OUT_F1SERDES.Q0CH0_FDRX46
TCELL15:OUT_F2SERDES.Q0CH0_FDRX45
TCELL15:OUT_F3SERDES.Q0CH0_FDRX44
TCELL15:OUT_F4SERDES.Q0CH0_FDRX43
TCELL15:OUT_F5SERDES.Q0CH0_FDRX42
TCELL15:OUT_F6SERDES.Q0CH0_FDRX41
TCELL15:OUT_F7SERDES.Q0CH0_FDRX40
TCELL15:OUT_Q0SERDES.Q0CH0_FDRX39
TCELL15:OUT_Q1SERDES.Q0CH0_FDRX38
TCELL15:OUT_Q2SERDES.Q0CH0_FDRX37
TCELL15:OUT_Q3SERDES.Q0CH0_FDRX36
TCELL15:OUT_Q4SERDES.Q0CH0_FDRX35
TCELL15:OUT_Q5SERDES.Q0CH0_FDRX34
TCELL15:OUT_Q6SERDES.Q0CH0_FDRX33
TCELL15:OUT_Q7SERDES.Q0CH0_FDRX32
TCELL16:IMUX_A0SERDES.Q0CH0_FCCDRFORCEDLOCK
TCELL16:IMUX_A1SERDES.Q0CH1_FCCDRFORCEDLOCK
TCELL16:IMUX_A2SERDES.Q0CH2_FCCDRFORCEDLOCK
TCELL16:IMUX_A3SERDES.Q0CH3_FCCDRFORCEDLOCK
TCELL16:IMUX_A4SERDES.Q0CH0_FCPLLLOL
TCELL16:IMUX_A5SERDES.Q0CH1_FCPLLLOL
TCELL16:IMUX_B0SERDES.Q0CH2_FCPLLLOL
TCELL16:IMUX_B1SERDES.Q0CH3_FCPLLLOL
TCELL16:IMUX_B2SERDES.Q0CH0_FDLDRTX
TCELL16:IMUX_B3SERDES.Q0CH1_FDLDRTX
TCELL16:IMUX_B4SERDES.Q0CH2_FDLDRTX
TCELL16:IMUX_B5SERDES.Q0CH3_FDLDRTX
TCELL16:IMUX_C0SERDES.Q0CH0_FCTXMARGIN2
TCELL16:IMUX_C1SERDES.Q0CH0_FCTXMARGIN1
TCELL16:IMUX_C2SERDES.Q0CH0_FCTXMARGIN0
TCELL16:IMUX_C3SERDES.Q0CH1_FCTXMARGIN2
TCELL16:IMUX_C4SERDES.Q0CH1_FCTXMARGIN1
TCELL16:IMUX_C5SERDES.Q0CH1_FCTXMARGIN0
TCELL16:IMUX_D0SERDES.Q0CH2_FCTXMARGIN2
TCELL16:IMUX_D1SERDES.Q0CH2_FCTXMARGIN1
TCELL16:IMUX_D2SERDES.Q0CH2_FCTXMARGIN0
TCELL16:IMUX_D3SERDES.Q0CH3_FCTXMARGIN2
TCELL16:IMUX_D4SERDES.Q0CH3_FCTXMARGIN1
TCELL16:IMUX_D5SERDES.Q0CH3_FCTXMARGIN0
TCELL16:IMUX_LSR0SERDES.Q0CH0_FCTRST
TCELL16:IMUX_LSR1SERDES.Q0CH1_FCTRST
TCELL16:IMUX_CLK0_DELAYSERDES.Q0_FISYNCCLK
TCELL16:IMUX_CLK1_DELAYSERDES.Q0_FIRXTESTCLK
TCELL16:OUT_F0SERDES.Q0CH0_FDRX31
TCELL16:OUT_F1SERDES.Q0CH0_FDRX30
TCELL16:OUT_F2SERDES.Q0CH0_FDRX29
TCELL16:OUT_F3SERDES.Q0CH0_FDRX28
TCELL16:OUT_F4SERDES.Q0CH0_FDRX27
TCELL16:OUT_F5SERDES.Q0CH0_FDRX26
TCELL16:OUT_F6SERDES.Q0CH0_FDRX25
TCELL16:OUT_F7SERDES.Q0CH0_FDRX24
TCELL16:OUT_Q0SERDES.Q0CH0_FDRX23
TCELL16:OUT_Q1SERDES.Q0CH0_FDRX22
TCELL16:OUT_Q2SERDES.Q0CH0_FDRX21
TCELL16:OUT_Q3SERDES.Q0CH0_FDRX20
TCELL16:OUT_Q4SERDES.Q0CH0_FDRX19
TCELL16:OUT_Q5SERDES.Q0CH0_FDRX18
TCELL16:OUT_Q6SERDES.Q0CH0_FDRX17
TCELL16:OUT_Q7SERDES.Q0CH0_FDRX16
TCELL17:IMUX_CLK1_DELAYSERDES.Q0_FITXTESTCLK
TCELL17:OUT_F0SERDES.Q0CH0_FDRX15
TCELL17:OUT_F1SERDES.Q0CH0_FDRX14
TCELL17:OUT_F2SERDES.Q0CH0_FDRX13
TCELL17:OUT_F3SERDES.Q0CH0_FDRX12
TCELL17:OUT_F4SERDES.Q0CH0_FDRX11
TCELL17:OUT_F5SERDES.Q0CH0_FDRX10
TCELL17:OUT_F6SERDES.Q0CH0_FDRX9
TCELL17:OUT_F7SERDES.Q0CH0_FDRX8
TCELL17:OUT_Q0SERDES.Q0CH0_FDRX7
TCELL17:OUT_Q1SERDES.Q0CH0_FDRX6
TCELL17:OUT_Q2SERDES.Q0CH0_FDRX5
TCELL17:OUT_Q3SERDES.Q0CH0_FDRX4
TCELL17:OUT_Q4SERDES.Q0CH0_FDRX3
TCELL17:OUT_Q5SERDES.Q0CH0_FDRX2
TCELL17:OUT_Q6SERDES.Q0CH0_FDRX1
TCELL17:OUT_Q7SERDES.Q0CH0_FDRX0
TCELL18:OUT_F0SERDES.Q0P_SCANO20
TCELL18:OUT_F1SERDES.Q0P_HALTGTREQTPHPRESENT
TCELL18:OUT_F2SERDES.Q0P_HALTGTWDATVLD
TCELL18:OUT_F3SERDES.Q0P_HALTGTWEOP
TCELL18:OUT_F4SERDES.Q0P_HALTGTCOMPRDY
TCELL18:OUT_F5SERDES.Q0P_HALTGTREQDES19
TCELL18:OUT_F6SERDES.Q0P_HALTGTREQDES18
TCELL18:OUT_F7SERDES.Q0P_HALTGTREQDES17
TCELL18:OUT_Q0SERDES.Q0P_HALTGTREQDES14
TCELL18:OUT_Q1SERDES.Q0P_HALTGTREQDES13
TCELL18:OUT_Q2SERDES.Q0P_HALTGTREQDES12
TCELL18:OUT_Q3SERDES.Q0P_HALTGTREQDES11
TCELL18:OUT_Q4SERDES.Q0P_HALTGTREQDES10
TCELL18:OUT_Q5SERDES.Q0P_HALTGTREQDES15
TCELL18:OUT_Q6SERDES.Q0P_HALTGTREQDES8
TCELL18:OUT_Q7SERDES.Q0P_HALTGTREQDES7
TCELL19:OUT_F0SERDES.Q0P_HALTGTREQDES6
TCELL19:OUT_F1SERDES.Q0P_HALTGTREQDES5
TCELL19:OUT_F2SERDES.Q0P_HALTGTREQDES4
TCELL19:OUT_F3SERDES.Q0P_HALTGTREQDES3
TCELL19:OUT_F4SERDES.Q0P_HALTGTREQDES2
TCELL19:OUT_F5SERDES.Q0P_HALTGTREQDES1
TCELL19:OUT_Q0SERDES.Q0P_HALTGTREQDES0
TCELL19:OUT_Q1SERDES.Q0P_HALTGTREQDES16
TCELL19:OUT_Q2SERDES.Q0P_HALTSTREQATTR2
TCELL19:OUT_Q3SERDES.Q0P_HALTSTREQATTR1
TCELL19:OUT_Q4SERDES.Q0P_HALTSTREQATTR0
TCELL19:OUT_Q5SERDES.Q0P_HALTGTREQMBA5
TCELL20:OUT_F0SERDES.Q0P_HALTGTREQMBA4
TCELL20:OUT_F1SERDES.Q0P_HALTGTREQMBA3
TCELL20:OUT_F2SERDES.Q0P_HALTGTREQMBA2
TCELL20:OUT_F3SERDES.Q0P_HALTGTREQMBA1
TCELL20:OUT_F4SERDES.Q0P_HALTGTREQMBA0
TCELL20:OUT_F5SERDES.Q0P_HALTGTREQTPHTYPE1
TCELL20:OUT_F6SERDES.Q0P_HALTGTREQTPHTYPE0
TCELL20:OUT_F7SERDES.Q0P_HALTGTREQTPHSTTAG7
TCELL20:OUT_Q0SERDES.Q0P_HALTGTREQTPHSTTAG6
TCELL20:OUT_Q1SERDES.Q0P_HALTGTREQTPHSTTAG5
TCELL20:OUT_Q2SERDES.Q0P_HALTGTREQTPHSTTAG4
TCELL20:OUT_Q3SERDES.Q0P_HALTGTREQTPHSTTAG3
TCELL20:OUT_Q4SERDES.Q0P_HALTGTREQTPHSTTAG2
TCELL20:OUT_Q5SERDES.Q0P_HALTGTREQTPHSTTAG1
TCELL20:OUT_Q6SERDES.Q0P_HALTGTREQTPHSTTAG0
TCELL20:OUT_Q7SERDES.Q0P_HALTGTWBVLD7
TCELL21:OUT_F0SERDES.Q0P_HALTGTWBVLD6
TCELL21:OUT_F1SERDES.Q0P_HALTGTWBVLD5
TCELL21:OUT_F2SERDES.Q0P_HALTGTWBVLD4
TCELL21:OUT_F3SERDES.Q0P_HALTGTWBVLD3
TCELL21:OUT_F4SERDES.Q0P_HALTGTWBVLD2
TCELL21:OUT_F5SERDES.Q0P_HALTGTWBVLD1
TCELL21:OUT_F6SERDES.Q0P_HALTGTWBVLD0
TCELL21:OUT_F7SERDES.Q0P_SCANO11
TCELL21:OUT_Q0SERDES.Q0P_HALTGTREQDES9
TCELL21:OUT_Q1SERDES.Q0P_SCANO2
TCELL21:OUT_Q2SERDES.Q0P_SCANO21
TCELL21:OUT_Q3SERDES.Q0P_HALTGTREQDES60
TCELL21:OUT_Q4SERDES.Q0P_HALTGTREQDES81
TCELL21:OUT_Q5SERDES.Q0P_HALTGTREQDES58
TCELL21:OUT_Q6SERDES.Q0P_SCANO18
TCELL21:OUT_Q7SERDES.Q0P_HALTGTREQDES91
TCELL22:OUT_F0SERDES.Q0P_HALTGTREQ
TCELL22:OUT_F1SERDES.Q0P_SCANO1
TCELL22:OUT_F2SERDES.Q0P_INTCO
TCELL22:OUT_F3SERDES.Q0P_HALTGTREQDES126
TCELL22:OUT_F4SERDES.Q0P_HALTGTREQDES76
TCELL22:OUT_F5SERDES.Q0P_HALTGTREQDES35
TCELL22:OUT_F6SERDES.Q0P_INTDO
TCELL22:OUT_F7SERDES.Q0P_HALTGTREQDES120
TCELL22:OUT_Q0SERDES.Q0P_HALTGTREQDES103
TCELL22:OUT_Q1SERDES.Q0P_HALTGTREQDES97
TCELL22:OUT_Q2SERDES.Q0P_HALTGTREQDES57
TCELL22:OUT_Q3SERDES.Q0P_HALTGTREQDES90
TCELL22:OUT_Q4SERDES.Q0P_HALTGTREQDES105
TCELL22:OUT_Q5SERDES.Q0P_HALTGTREQDES61
TCELL22:OUT_Q6SERDES.Q0P_HALTGTREQDES68
TCELL22:OUT_Q7SERDES.Q0P_HALTGTREQDES44
TCELL23:OUT_F0SERDES.Q0P_HALTGTREQDES52
TCELL23:OUT_F1SERDES.Q0P_HALTGTREQDES104
TCELL23:OUT_F2SERDES.Q0P_HALTGTREQDES62
TCELL23:OUT_F3SERDES.Q0P_HALTGTREQDES89
TCELL23:OUT_F4SERDES.Q0P_HALTGTREQDES54
TCELL23:OUT_F5SERDES.Q0P_HALTGTREQDES124
TCELL23:OUT_F6SERDES.Q0P_HALTGTREQDES47
TCELL23:OUT_F7SERDES.Q0P_HALTGTREQDES77
TCELL23:OUT_Q0SERDES.Q0P_HALTGTREQDES102
TCELL23:OUT_Q1SERDES.Q0P_INTAO
TCELL23:OUT_Q2SERDES.Q0P_HALTGTREQDES41
TCELL23:OUT_Q3SERDES.Q0P_HALTGTREQDES31
TCELL23:OUT_Q4SERDES.Q0P_HALTGTREQDES127
TCELL23:OUT_Q5SERDES.Q0P_INTBO
TCELL23:OUT_Q6SERDES.Q0P_HALTGTREQDES21
TCELL23:OUT_Q7SERDES.Q0P_HALTGTREQDES23
TCELL24:OUT_F0SERDES.Q0P_HALTGTREQDES30
TCELL24:OUT_F1SERDES.Q0P_HALTGTREQDES33
TCELL24:OUT_F2SERDES.Q0P_HALTGTREQDES24
TCELL24:OUT_F3SERDES.Q0P_HALTGTREQDES25
TCELL24:OUT_F4SERDES.Q0P_HALTGTREQDES34
TCELL24:OUT_F5SERDES.Q0P_HALTGTREQDES51
TCELL24:OUT_F6SERDES.Q0P_HALTGTREQDES22
TCELL24:OUT_F7SERDES.Q0P_HALTGTREQDES26
TCELL24:OUT_Q0SERDES.Q0P_HALTGTREQDES32
TCELL24:OUT_Q1SERDES.Q0P_HALTGTREQDES43
TCELL24:OUT_Q2SERDES.Q0P_HALTGTREQDES48
TCELL24:OUT_Q3SERDES.Q0P_HALTGTREQDES49
TCELL24:OUT_Q4SERDES.Q0P_HALTGTREQDES111
TCELL24:OUT_Q5SERDES.Q0P_HALTGTREQDES55
TCELL24:OUT_Q6SERDES.Q0P_HALTGTREQDES66
TCELL24:OUT_Q7SERDES.Q0P_HALTGTREQDES93
TCELL29:IMUX_A0SERDES.Q0P_HALTGTCOMPDES9
TCELL29:IMUX_A1SERDES.Q0P_HALTGTCOMPDES10
TCELL29:IMUX_A2SERDES.Q0P_HALTGTCOMPDES11
TCELL29:IMUX_A3SERDES.Q0P_HALTGTCOMPDES13
TCELL29:IMUX_A4SERDES.Q0P_HALTGTCOMPDES14
TCELL29:IMUX_A5SERDES.Q0P_HALTGTCOMPDES16
TCELL29:IMUX_B0SERDES.Q0P_HALTGTCOMPDES17
TCELL29:IMUX_B1SERDES.Q0P_HALTGTCOMPDES22
TCELL29:IMUX_B2SERDES.Q0P_HALTGTCOMPDES23
TCELL29:IMUX_B3SERDES.Q0P_HALTGTCOMPDES24
TCELL29:IMUX_B4SERDES.Q0P_HALTGTCOMPDES25
TCELL29:IMUX_B5SERDES.Q0P_HALTGTCOMPDES26
TCELL29:IMUX_C0SERDES.Q0P_HALTGTCOMPDES27
TCELL29:IMUX_C1SERDES.Q0P_HALTGTCOMPDES28
TCELL29:IMUX_C2SERDES.Q0P_HALTGTCOMPDES29
TCELL29:IMUX_C3SERDES.Q0P_HALTGTCOMPDES30
TCELL29:IMUX_C4SERDES.Q0P_HALTGTCOMPDES31
TCELL29:IMUX_C5SERDES.Q0P_HALTGTCOMPDES32
TCELL29:IMUX_D0SERDES.Q0P_HALTGTCOMPDES33
TCELL29:IMUX_D1SERDES.Q0P_HALTGTCOMPDES59
TCELL29:IMUX_D2SERDES.Q0P_HALTGTCOMPDES61
TCELL29:IMUX_D3SERDES.Q0P_HALTGTCOMPDES62
TCELL29:IMUX_D4SERDES.Q0P_HALTGTCOMPDES63
TCELL29:IMUX_D5SERDES.Q0P_HALTGTCOMPDES127
TCELL29:IMUX_LSR0SERDES.Q0P_MBISTMODE
TCELL29:IMUX_LSR1SERDES.Q0P_SCANRSTN
TCELL29:IMUX_CLK0_DELAYSERDES.Q0P_SCANCLK
TCELL29:IMUX_CLK1_DELAYSERDES.Q0P_MBISTCLK
TCELL29:IMUX_CE0SERDES.Q0P_SCANI19
TCELL29:IMUX_CE1SERDES.Q0P_SCANI9
TCELL29:IMUX_CE2SERDES.Q0P_SCANI10
TCELL29:IMUX_CE3SERDES.Q0P_SCANI20
TCELL29:OUT_F0SERDES.Q0P_HALTGTREQDES20
TCELL29:OUT_F1SERDES.Q0P_HALTGTREQDES96
TCELL29:OUT_F2SERDES.Q0P_HALTGTREQDES95
TCELL29:OUT_F3SERDES.Q0P_HALTGTREQDES125
TCELL29:OUT_F4SERDES.Q0P_HALTGTREQDES101
TCELL29:OUT_F5SERDES.Q0P_HALTGTREQDES99
TCELL29:OUT_F6SERDES.Q0P_HALTGTREQDES80
TCELL29:OUT_F7SERDES.Q0P_HALTGTREQDES56
TCELL29:OUT_Q0SERDES.Q0P_HALTGTREQDES69
TCELL29:OUT_Q1SERDES.Q0P_HALTGTREQDES78
TCELL29:OUT_Q2SERDES.Q0P_HALTGTREQDES110
TCELL29:OUT_Q3SERDES.Q0P_HALTGTREQDES84
TCELL29:OUT_Q4SERDES.Q0P_HALTGTREQDES73
TCELL29:OUT_Q5SERDES.Q0P_HALTGTREQDES70
TCELL29:OUT_Q6SERDES.Q0P_HALTGTREQDES106
TCELL29:OUT_Q7SERDES.Q0P_HALTGTREQDES87
TCELL30:IMUX_A0SERDES.Q0P_HALTGTCOMPDES64
TCELL30:IMUX_A1SERDES.Q0P_HALTGTCOMPDES65
TCELL30:IMUX_A2SERDES.Q0P_HALTGTCOMPDES66
TCELL30:IMUX_A3SERDES.Q0P_HALTGTCOMPDES67
TCELL30:IMUX_A4SERDES.Q0P_HALTGTCOMPDES69
TCELL30:IMUX_A5SERDES.Q0P_HALTGTCOMPDES71
TCELL30:IMUX_B0SERDES.Q0P_HALTGTCOMPDES72
TCELL30:IMUX_B1SERDES.Q0P_HALTGTCOMPDES73
TCELL30:IMUX_B2SERDES.Q0P_HALTGTCOMPDES74
TCELL30:IMUX_B3SERDES.Q0P_HALTGTCOMPDES77
TCELL30:IMUX_B4SERDES.Q0P_HALTGTCOMPDES78
TCELL30:IMUX_B5SERDES.Q0P_HALTGTCOMPDES79
TCELL30:IMUX_C0SERDES.Q0P_HALTGTCLNTCOMPIDEN
TCELL30:IMUX_C1SERDES.Q0P_HALTGTCOMPDES121
TCELL30:IMUX_C2SERDES.Q0P_HALTGTCOMPDES80
TCELL30:IMUX_C3SERDES.Q0P_HALTGTCOMPDES81
TCELL30:IMUX_C4SERDES.Q0P_HALTGTCOMPDES102
TCELL30:IMUX_C5SERDES.Q0P_HALTGTCOMPDES95
TCELL30:IMUX_D0SERDES.Q0P_HALTGTCOMPDES94
TCELL30:IMUX_D1SERDES.Q0P_HALTGTCOMPDES99
TCELL30:IMUX_D2SERDES.Q0P_HALTGTCOMPDES103
TCELL30:IMUX_D3SERDES.Q0P_HALTGTCOMPDES125
TCELL30:IMUX_D4SERDES.Q0P_HALTGTCOMPDES96
TCELL30:IMUX_D5SERDES.Q0P_HALTGTCOMPDES126
TCELL30:IMUX_LSR0SERDES.Q0P_SCANMODE
TCELL30:IMUX_LSR1SERDES.Q0P_MBISTRSTN
TCELL30:IMUX_CE0SERDES.Q0P_SCANI24
TCELL30:IMUX_CE1SERDES.Q0P_SCANI0
TCELL30:IMUX_CE2SERDES.Q0P_SCANI11
TCELL30:IMUX_CE3SERDES.Q0P_SCANI17
TCELL30:OUT_F0SERDES.Q0P_HALTGTREQDES82
TCELL30:OUT_F1SERDES.Q0P_HALTGTREQDES75
TCELL30:OUT_F2SERDES.Q0P_HALTGTREQDES109
TCELL30:OUT_F3SERDES.Q0P_HALTGTREQDES85
TCELL30:OUT_F4SERDES.Q0P_HALTGTREQDES74
TCELL30:OUT_F5SERDES.Q0P_HALTGTREQDES71
TCELL30:OUT_F6SERDES.Q0P_HALTGTREQDES98
TCELL30:OUT_F7SERDES.Q0P_HALTGTREQDES83
TCELL30:OUT_Q0SERDES.Q0P_HALTGTREQDES79
TCELL30:OUT_Q1SERDES.Q0P_HALTGTREQDES121
TCELL30:OUT_Q2SERDES.Q0P_HALTGTREQDES67
TCELL30:OUT_Q3SERDES.Q0P_HALTGTREQDES100
TCELL30:OUT_Q4SERDES.Q0P_HALTGTREQDES65
TCELL30:OUT_Q5SERDES.Q0P_HALTGTREQDES88
TCELL30:OUT_Q6SERDES.Q0P_HALTGTREQDES72
TCELL30:OUT_Q7SERDES.Q0P_HALTGTREQDES94
TCELL31:IMUX_A0SERDES.Q0P_HALTGTCOMPDES101
TCELL31:IMUX_A1SERDES.Q0P_HALTGTCOMPDES86
TCELL31:IMUX_A2SERDES.Q0P_HALTGTCOMPDES85
TCELL31:IMUX_A3SERDES.Q0P_HALTGTCOMPDES90
TCELL31:IMUX_A4SERDES.Q0P_HALTGTCOMPDES92
TCELL31:IMUX_A5SERDES.Q0P_HALTGTCOMPDES100
TCELL31:IMUX_B0SERDES.Q0P_HALTGTCOMPDES98
TCELL31:IMUX_B1SERDES.Q0P_HALTGTCOMPDES122
TCELL31:IMUX_B2SERDES.Q0P_HALTGTCOMPDES108
TCELL31:IMUX_B3SERDES.Q0P_HALTGTCOMPDES123
TCELL31:IMUX_B4SERDES.Q0P_HALTGTCOMPDES124
TCELL31:IMUX_B5SERDES.Q0P_HALTGTCOMPDES118
TCELL31:IMUX_C0SERDES.Q0P_HALTGTCOMPDES116
TCELL31:IMUX_C1SERDES.Q0P_HALTGTCOMPDES115
TCELL31:IMUX_C2SERDES.Q0P_HALTGTCOMPDES93
TCELL31:IMUX_C3SERDES.Q0P_HALTGTCOMPDES104
TCELL31:IMUX_C4SERDES.Q0P_HALTGTCOMPDES84
TCELL31:IMUX_C5SERDES.Q0P_HALTGTCOMPDES105
TCELL31:IMUX_D0SERDES.Q0P_HALTGTCOMPDES83
TCELL31:IMUX_D1SERDES.Q0P_HALTGTCOMPDES107
TCELL31:IMUX_D2SERDES.Q0P_HALTGTCOMPDES120
TCELL31:IMUX_D3SERDES.Q0P_HALTGTCOMPDES89
TCELL31:IMUX_D4SERDES.Q0P_HALTGTCOMPDES87
TCELL31:IMUX_D5SERDES.Q0P_HALTGTCOMPDES91
TCELL31:IMUX_LSR0SERDES.Q0P_RSTN
TCELL31:IMUX_LSR1SERDES.Q0P_SCANENA
TCELL31:IMUX_CE0SERDES.Q0P_SCANI8
TCELL31:IMUX_CE1SERDES.Q0P_SCANI12
TCELL31:IMUX_CE2SERDES.Q0P_SCANI18
TCELL31:IMUX_CE3SERDES.Q0P_SCANI7
TCELL31:OUT_F0SERDES.Q0P_HALTGTREQDES64
TCELL31:OUT_F1SERDES.Q0P_HALTGTREQDES63
TCELL31:OUT_F2SERDES.Q0P_HALTGTREQDES86
TCELL31:OUT_F3SERDES.Q0P_HALTGTREQDES92
TCELL31:OUT_F4SERDES.Q0P_HALTGTREQDES53
TCELL31:OUT_F5SERDES.Q0P_HALTGTREQDES50
TCELL31:OUT_F6SERDES.Q0P_HALTGTREQDES28
TCELL31:OUT_F7SERDES.Q0P_HALTGTREQDES29
TCELL31:OUT_Q0SERDES.Q0P_HALTGTREQDES123
TCELL31:OUT_Q1SERDES.Q0P_HALTGTREQDES59
TCELL31:OUT_Q2SERDES.Q0P_HALTGTREQDES46
TCELL31:OUT_Q3SERDES.Q0P_HALTGTREQDES45
TCELL31:OUT_Q4SERDES.Q0P_HALTGTREQDES27
TCELL31:OUT_Q5SERDES.Q0P_HALTGTREQDES122
TCELL31:OUT_Q6SERDES.Q0P_HALTGTREQDES42
TCELL31:OUT_Q7SERDES.Q0P_SCANO22
TCELL32:IMUX_A0SERDES.Q0P_HALTGTCOMPDES113
TCELL32:IMUX_A1SERDES.Q0P_HALTGTCOMPDES114
TCELL32:IMUX_A2SERDES.Q0P_HALTGTCOMPDES88
TCELL32:IMUX_A3SERDES.Q0P_HALTGTCOMPDES117
TCELL32:IMUX_A4SERDES.Q0P_HALTGTCOMPDES97
TCELL32:IMUX_A5SERDES.Q0P_HALTGTCOMPDES112
TCELL32:IMUX_B0SERDES.Q0P_HALTGTCOMPDES82
TCELL32:IMUX_B1SERDES.Q0P_HALTGTCOMPDES76
TCELL32:IMUX_B2SERDES.Q0P_HALTGTCOMPDES109
TCELL32:IMUX_B3SERDES.Q0P_HALTGTCOMPDES111
TCELL32:IMUX_B4SERDES.Q0P_HALTGTCOMPDES75
TCELL32:IMUX_B5SERDES.Q0P_HALTGTCOMPDES110
TCELL32:IMUX_C0SERDES.Q0P_HALTGTCOMPDES106
TCELL32:IMUX_C1SERDES.Q0P_HALTGTCOMPDES70
TCELL32:IMUX_C2SERDES.Q0P_HALTGTCOMPDES60
TCELL32:IMUX_C3SERDES.Q0P_HALTGTCOMPDES58
TCELL32:IMUX_C4SERDES.Q0P_HALTGTCOMPDES57
TCELL32:IMUX_C5SERDES.Q0P_HALTGTCOMPDES56
TCELL32:IMUX_D0SERDES.Q0P_HALTGTCOMPDES55
TCELL32:IMUX_D1SERDES.Q0P_HALTGTCOMPDES54
TCELL32:IMUX_D2SERDES.Q0P_HALTGTCOMPDES53
TCELL32:IMUX_D3SERDES.Q0P_HALTGTCOMPDES52
TCELL32:IMUX_D4SERDES.Q0P_HALTGTCOMPDES51
TCELL32:IMUX_D5SERDES.Q0P_HALTGTCOMPDES50
TCELL32:IMUX_LSR0SERDES.Q0P_HOTRSTIN
TCELL32:IMUX_CE0SERDES.Q0P_SCANI6
TCELL32:IMUX_CE1SERDES.Q0P_SCANI26
TCELL32:IMUX_CE2SERDES.Q0P_SCANI25
TCELL32:IMUX_CE3SERDES.Q0P_SCANI2
TCELL32:OUT_F0SERDES.Q0P_HALMSTWRDY
TCELL32:OUT_F1SERDES.Q0P_HALTGTREQDES40
TCELL32:OUT_F2SERDES.Q0P_SCANO14
TCELL32:OUT_F3SERDES.Q0P_HALTGTREQDES36
TCELL32:OUT_F4SERDES.Q0P_HALTGTREQDES38
TCELL32:OUT_F5SERDES.Q0P_PWRSTATECHNGINT
TCELL32:OUT_F6SERDES.Q0P_HALTGTREQDES37
TCELL32:OUT_F7SERDES.Q0P_HALMSTCOMPDES116
TCELL32:OUT_Q0SERDES.Q0P_HALMSTCOMPDES115
TCELL32:OUT_Q1SERDES.Q0P_HALMSTCOMPDES117
TCELL32:OUT_Q2SERDES.Q0P_HALMSTCOMPDES114
TCELL32:OUT_Q3SERDES.Q0P_HALMSTCOMPDES113
TCELL32:OUT_Q4SERDES.Q0P_HALMSTCOMPDES118
TCELL32:OUT_Q5SERDES.Q0P_SCANO19
TCELL32:OUT_Q6SERDES.Q0P_HALMSTCOMPDES109
TCELL32:OUT_Q7SERDES.Q0P_HALMSTCOMPDES112
TCELL33:IMUX_A0SERDES.Q0P_HALTGTCOMPDES49
TCELL33:IMUX_A1SERDES.Q0P_HALTGTCOMPDES48
TCELL33:IMUX_A2SERDES.Q0P_HALTGTCOMPDES47
TCELL33:IMUX_A3SERDES.Q0P_HALTGTCOMPDES46
TCELL33:IMUX_A4SERDES.Q0P_HALTGTCOMPDES45
TCELL33:IMUX_A5SERDES.Q0P_HALTGTCOMPDES44
TCELL33:IMUX_B0SERDES.Q0P_HALTGTCOMPDES43
TCELL33:IMUX_B1SERDES.Q0P_HALTGTCOMPDES42
TCELL33:IMUX_B2SERDES.Q0P_HALTGTCOMPDES41
TCELL33:IMUX_B3SERDES.Q0P_HALTGTCOMPDES40
TCELL33:IMUX_B4SERDES.Q0P_HALTGTCOMPDES39
TCELL33:IMUX_B5SERDES.Q0P_HALTGTCOMPDES38
TCELL33:IMUX_C0SERDES.Q0P_HALTGTCOMPDES37
TCELL33:IMUX_C1SERDES.Q0P_HALTGTCOMPDES36
TCELL33:IMUX_C2SERDES.Q0P_HALTGTCOMPDES35
TCELL33:IMUX_C3SERDES.Q0P_HALTGTCOMPDES34
TCELL33:IMUX_C4SERDES.Q0P_HALTGTCOMPDES21
TCELL33:IMUX_C5SERDES.Q0P_HALTGTCOMPDES68
TCELL33:IMUX_D0SERDES.Q0P_HALTGTCOMPDES20
TCELL33:IMUX_D1SERDES.Q0P_HALTGTCOMPDES19
TCELL33:IMUX_D2SERDES.Q0P_HALTGTCOMPDES18
TCELL33:IMUX_D3SERDES.Q0P_HALTGTCOMPDES15
TCELL33:IMUX_D4SERDES.Q0P_HALTGTCOMPDES12
TCELL33:IMUX_D5SERDES.Q0P_HALTGTCOMPDES8
TCELL33:IMUX_CE0SERDES.Q0P_SCANI16
TCELL33:IMUX_CE1SERDES.Q0P_SCANI14
TCELL33:IMUX_CE2SERDES.Q0P_SCANI21
TCELL33:IMUX_CE3SERDES.Q0P_SCANI1
TCELL33:OUT_F0SERDES.Q0P_HALMSTCOMPDES108
TCELL33:OUT_F1SERDES.Q0P_HALMSTCOMPDES110
TCELL33:OUT_F2SERDES.Q0P_HALMSTCOMPDES107
TCELL33:OUT_F3SERDES.Q0P_HALMSTCOMPDES126
TCELL33:OUT_F4SERDES.Q0P_HALMSTCOMPDES125
TCELL33:OUT_F5SERDES.Q0P_HALMSTCOMPDES111
TCELL33:OUT_F6SERDES.Q0P_HALMSTCOMPDES127
TCELL33:OUT_F7SERDES.Q0P_HALMSTCOMPDES119
TCELL33:OUT_Q0SERDES.Q0P_HALMSTCOMPDES79
TCELL33:OUT_Q1SERDES.Q0P_HALMSTCOMPDES104
TCELL33:OUT_Q2SERDES.Q0P_HALMSTCOMPDES102
TCELL33:OUT_Q3SERDES.Q0P_HALMSTCOMPDES101
TCELL33:OUT_Q4SERDES.Q0P_HALMSTCOMPDES103
TCELL33:OUT_Q5SERDES.Q0P_HALMSTCOMPDES76
TCELL33:OUT_Q6SERDES.Q0P_HALMSTCOMPDES67
TCELL33:OUT_Q7SERDES.Q0P_HALMSTCOMPDES72
TCELL34:IMUX_A0SERDES.Q0P_HALTGTCOMPDES7
TCELL34:IMUX_A1SERDES.Q0P_HALTGTCOMPDES6
TCELL34:IMUX_A2SERDES.Q0P_HALTGTCOMPDES5
TCELL34:IMUX_A3SERDES.Q0P_HALTGTCOMPDES4
TCELL34:IMUX_A4SERDES.Q0P_HALTGTCOMPDES3
TCELL34:IMUX_A5SERDES.Q0P_HALTGTCOMPDES2
TCELL34:IMUX_B0SERDES.Q0P_HALTGTCOMPDES1
TCELL34:IMUX_B1SERDES.Q0P_HALTGTCOMPDES0
TCELL34:IMUX_B2SERDES.Q0P_HALTGTCOMPBVLD7
TCELL34:IMUX_B3SERDES.Q0P_HALTGTCOMPBVLD6
TCELL34:IMUX_B4SERDES.Q0P_HALTGTCOMPBVLD5
TCELL34:IMUX_B5SERDES.Q0P_HALTGTCOMPBVLD4
TCELL34:IMUX_C0SERDES.Q0P_HALTGTCOMPBVLD3
TCELL34:IMUX_C1SERDES.Q0P_HALTGTCOMPBVLD2
TCELL34:IMUX_C2SERDES.Q0P_HALTGTCOMPBVLD1
TCELL34:IMUX_C3SERDES.Q0P_HALTGTCOMPBVLD0
TCELL34:IMUX_C4SERDES.Q0P_HALTGTCLNTCOMPID15
TCELL34:IMUX_C5SERDES.Q0P_HALTGTCLNTCOMPID14
TCELL34:IMUX_D0SERDES.Q0P_HALTGTCLNTCOMPID13
TCELL34:IMUX_D1SERDES.Q0P_HALTGTCLNTCOMPID12
TCELL34:IMUX_D2SERDES.Q0P_HALTGTCLNTCOMPID11
TCELL34:IMUX_D3SERDES.Q0P_HALTGTCLNTCOMPID10
TCELL34:IMUX_D4SERDES.Q0P_HALTGTCLNTCOMPID9
TCELL34:IMUX_D5SERDES.Q0P_HALTGTCLNTCOMPID8
TCELL34:IMUX_CE0SERDES.Q0P_SCANI13
TCELL34:IMUX_CE1SERDES.Q0P_SCANI3
TCELL34:IMUX_CE2SERDES.Q0P_SCANI15
TCELL34:IMUX_CE3SERDES.Q0P_SCANI23
TCELL34:OUT_F0SERDES.Q0P_HALMSTCOMPDES75
TCELL34:OUT_F1SERDES.Q0P_HALMSTCOMPDES105
TCELL34:OUT_F2SERDES.Q0P_HALMSTCOMPDES70
TCELL34:OUT_F3SERDES.Q0P_HALMSTCOMPDES74
TCELL34:OUT_F4SERDES.Q0P_HALMSTCOMPDES106
TCELL34:OUT_F5SERDES.Q0P_SCANO8
TCELL34:OUT_F6SERDES.Q0P_HALMSTCOMPDES73
TCELL34:OUT_F7SERDES.Q0P_HALMSTCOMPDES71
TCELL34:OUT_Q0SERDES.Q0P_HALTGTREQDES39
TCELL34:OUT_Q1SERDES.Q0P_HALMSTCOMPDES68
TCELL34:OUT_Q2SERDES.Q0P_HALMSTCOMPDES91
TCELL34:OUT_Q3SERDES.Q0P_HALMSTCOMPDES93
TCELL34:OUT_Q4SERDES.Q0P_HALMSTCOMPDES66
TCELL34:OUT_Q5SERDES.Q0P_HALMSTCOMPDES90
TCELL34:OUT_Q6SERDES.Q0P_SCANO5
TCELL34:OUT_Q7SERDES.Q0P_HALMSTCOMPDES64
TCELL35:IMUX_A0SERDES.Q0P_HALTGTCLNTCOMPID7
TCELL35:IMUX_A1SERDES.Q0P_HALTGTCLNTCOMPID6
TCELL35:IMUX_A2SERDES.Q0P_HALTGTCLNTCOMPID5
TCELL35:IMUX_A3SERDES.Q0P_HALTGTCLNTCOMPID4
TCELL35:IMUX_A4SERDES.Q0P_HALTGTCLNTCOMPID3
TCELL35:IMUX_A5SERDES.Q0P_HALTGTCLNTCOMPID2
TCELL35:IMUX_B0SERDES.Q0P_HALTGTCLNTCOMPID1
TCELL35:IMUX_B1SERDES.Q0P_HALTGTCLNTCOMPID0
TCELL35:IMUX_B2SERDES.Q0P_HALTGTCAREQDES106
TCELL35:IMUX_B3SERDES.Q0P_HALTGTCAREQDES105
TCELL35:IMUX_B4SERDES.Q0P_HALTGTCAREQDES104
TCELL35:IMUX_B5SERDES.Q0P_HALTGTCAREQDES98
TCELL35:IMUX_C0SERDES.Q0P_HALTGTCAREQDES97
TCELL35:IMUX_C1SERDES.Q0P_HALTGTCAREQDES96
TCELL35:IMUX_C2SERDES.Q0P_HALTGTCAREQDES94
TCELL35:IMUX_C3SERDES.Q0P_HALTGTCAREQDES93
TCELL35:IMUX_C4SERDES.Q0P_HALTGTCAREQDES92
TCELL35:IMUX_C5SERDES.Q0P_HALTGTCAREQDES91
TCELL35:IMUX_D0SERDES.Q0P_HALTGTCAREQDES90
TCELL35:IMUX_D1SERDES.Q0P_HALTGTCAREQDES89
TCELL35:IMUX_D2SERDES.Q0P_HALTGTCAREQDES88
TCELL35:IMUX_D3SERDES.Q0P_HALTGTCAREQDES87
TCELL35:IMUX_D4SERDES.Q0P_HALTGTCAREQDES85
TCELL35:IMUX_D5SERDES.Q0P_HALTGTCAREQDES121
TCELL35:IMUX_CE0SERDES.Q0P_SCANI22
TCELL35:IMUX_CE1SERDES.Q0P_SCANI4
TCELL35:IMUX_CE2SERDES.Q0P_SCANI5
TCELL35:OUT_F0SERDES.Q0P_HALMSTCOMPDES94
TCELL35:OUT_F1SERDES.Q0P_HALMSTCOMPDES92
TCELL35:OUT_F2SERDES.Q0P_HALMSTCOMPDES69
TCELL35:OUT_F3SERDES.Q0P_HALMSTCOMPDES65
TCELL35:OUT_F4SERDES.Q0P_HALMSTCOMPDES95
TCELL35:OUT_F5SERDES.Q0P_MSIVECCNT1
TCELL35:OUT_F6SERDES.Q0P_HALMSTCOMPDES89
TCELL35:OUT_F7SERDES.Q0P_HALMSTCOMPDES88
TCELL35:OUT_Q0SERDES.Q0P_HALMSTCOMPDES77
TCELL35:OUT_Q1SERDES.Q0P_MSIVECCNT2
TCELL35:OUT_Q2SERDES.Q0P_HALMSTCOMPDES78
TCELL35:OUT_Q3SERDES.Q0P_MSIVECCNT0
TCELL35:OUT_Q4SERDES.Q0P_SCANO7
TCELL35:OUT_Q5SERDES.Q0P_INTACK
TCELL35:OUT_Q6SERDES.Q0P_MSIEN
TCELL35:OUT_Q7SERDES.Q0P_SCANO9
TCELL36:IMUX_A2SERDES.Q0P_HALTGTCAREQDES84
TCELL36:IMUX_A3SERDES.Q0P_HALTGTCAREQDES80
TCELL36:IMUX_A4SERDES.Q0P_HALTGTCAREQDES79
TCELL36:IMUX_A5SERDES.Q0P_HALTGTCAREQDES78
TCELL36:IMUX_B2SERDES.Q0P_HALTGTCAREQDES77
TCELL36:IMUX_B3SERDES.Q0P_HALTGTCAREQDES76
TCELL36:IMUX_B4SERDES.Q0P_HALTGTCAREQDES75
TCELL36:IMUX_B5SERDES.Q0P_HALTGTCAREQDES74
TCELL36:IMUX_C2SERDES.Q0P_HALTGTCAREQDES99
TCELL36:IMUX_C3SERDES.Q0P_HALTGTCAREQDES86
TCELL36:IMUX_C4SERDES.Q0P_HALTGTCAREQDES73
TCELL36:IMUX_C5SERDES.Q0P_HALTGTCAREQDES72
TCELL36:IMUX_D2SERDES.Q0P_HALTGTCAREQDES71
TCELL36:IMUX_D3SERDES.Q0P_HALTGTCAREQDES70
TCELL36:IMUX_D4SERDES.Q0P_HALTGTCAREQDES69
TCELL36:IMUX_D5SERDES.Q0P_HALTGTCAREQDES68
TCELL36:OUT_F2SERDES.Q0P_HALMSTRBVLD4
TCELL36:OUT_F3SERDES.Q0P_HALMSTRBVLD3
TCELL36:OUT_F4SERDES.Q0P_HALMSTCOMPDES85
TCELL36:OUT_F5SERDES.Q0P_HALMSTCOMPDES120
TCELL36:OUT_F6SERDES.Q0P_HALMSTCOMPDES84
TCELL36:OUT_F7SERDES.Q0P_HALMSTCOMPDES87
TCELL36:OUT_Q2SERDES.Q0P_HALMSTCOMPDES86
TCELL36:OUT_Q3SERDES.Q0P_HALMSTRBVLD1
TCELL36:OUT_Q4SERDES.Q0P_HALMSTRBVLD7
TCELL36:OUT_Q5SERDES.Q0P_HALMSTRBVLD6
TCELL36:OUT_Q6SERDES.Q0P_HALMSTCOMPVLD
TCELL36:OUT_Q7SERDES.Q0P_HALMSTCOMPSOP
TCELL37:IMUX_A0SERDES.Q0P_HALTGTCAREQDES82
TCELL37:IMUX_A1SERDES.Q0P_HALTGTCAREQDES67
TCELL37:IMUX_A2SERDES.Q0P_HALTGTCAREQDES66
TCELL37:IMUX_A3SERDES.Q0P_HALTGTCAREQDES65
TCELL37:IMUX_A4SERDES.Q0P_HALTGTCAREQDES64
TCELL37:IMUX_A5SERDES.Q0P_HALTGTCAREQDES63
TCELL37:IMUX_B0SERDES.Q0P_HALTGTCAREQDES62
TCELL37:IMUX_B1SERDES.Q0P_HALTGTCAREQDES83
TCELL37:IMUX_B2SERDES.Q0P_HALTGTCAREQDES61
TCELL37:IMUX_B3SERDES.Q0P_HALTGTCAREQDES60
TCELL37:IMUX_B4SERDES.Q0P_HALTGTCAREQDES95
TCELL37:IMUX_B5SERDES.Q0P_HALTGTCAREQDES59
TCELL37:IMUX_C0SERDES.Q0P_HALTGTCAREQDES58
TCELL37:IMUX_C1SERDES.Q0P_HALTGTCAREQDES57
TCELL37:IMUX_C2SERDES.Q0P_HALTGTCAREQDES56
TCELL37:IMUX_C3SERDES.Q0P_HALTGTCAREQDES55
TCELL37:IMUX_C4SERDES.Q0P_HALTGTCAREQDES54
TCELL37:IMUX_C5SERDES.Q0P_HALTGTCAREQDES53
TCELL37:IMUX_D0SERDES.Q0P_HALTGTCAREQDES52
TCELL37:IMUX_D1SERDES.Q0P_HALTGTCAREQDES100
TCELL37:IMUX_D2SERDES.Q0P_HALTGTCAREQDES51
TCELL37:IMUX_D3SERDES.Q0P_HALTGTCAREQDES50
TCELL37:IMUX_D4SERDES.Q0P_HALTGTCAREQDES49
TCELL37:IMUX_D5SERDES.Q0P_HALTGTCAREQDES48
TCELL37:OUT_F0SERDES.Q0P_HALMSTRBVLD0
TCELL37:OUT_F1SERDES.Q0P_HALMSTCOMPDES0
TCELL37:OUT_F2SERDES.Q0P_HALMSTCOMPDES83
TCELL37:OUT_F3SERDES.Q0P_HALMSTCOMPEOP
TCELL37:OUT_F4SERDES.Q0P_HALMSTCOMPDES1
TCELL37:OUT_F5SERDES.Q0P_HALMSTRBVLD5
TCELL37:OUT_F6SERDES.Q0P_HALMSTCOMPDES80
TCELL37:OUT_F7SERDES.Q0P_HALMSTCOMPDES100
TCELL37:OUT_Q0SERDES.Q0P_HALMSTCOMPDES2
TCELL37:OUT_Q1SERDES.Q0P_SCANO6
TCELL37:OUT_Q2SERDES.Q0P_HALMSTRBVLD2
TCELL37:OUT_Q3SERDES.Q0P_HALMSTCOMPDES81
TCELL37:OUT_Q4SERDES.Q0P_HALMSTCOMPDES99
TCELL37:OUT_Q5SERDES.Q0P_HALMSTCOMPDES30
TCELL37:OUT_Q6SERDES.Q0P_HALMSTCOMPDES96
TCELL37:OUT_Q7SERDES.Q0P_HALMSTCOMPDES38
TCELL38:IMUX_A0SERDES.Q0P_HALTGTCAREQDES81
TCELL38:IMUX_A1SERDES.Q0P_HALTGTCAREQDES101
TCELL38:IMUX_A2SERDES.Q0P_HALTGTCAREQDES47
TCELL38:IMUX_A3SERDES.Q0P_HALTGTCAREQDES46
TCELL38:IMUX_A4SERDES.Q0P_HALTGTCAREQDES45
TCELL38:IMUX_A5SERDES.Q0P_HALTGTCAREQDES44
TCELL38:IMUX_B0SERDES.Q0P_HALTGTCAREQDES43
TCELL38:IMUX_B1SERDES.Q0P_HALTGTCAREQDES42
TCELL38:IMUX_B2SERDES.Q0P_HALTGTCAREQDES41
TCELL38:IMUX_B3SERDES.Q0P_HALTGTCAREQDES40
TCELL38:IMUX_B4SERDES.Q0P_HALTGTCAREQDES39
TCELL38:IMUX_B5SERDES.Q0P_HALTGTCAREQDES38
TCELL38:IMUX_C0SERDES.Q0P_HALTGTCAREQDES37
TCELL38:IMUX_C1SERDES.Q0P_HALTGTCAREQDES102
TCELL38:IMUX_C2SERDES.Q0P_HALTGTCAREQDES103
TCELL38:IMUX_C3SERDES.Q0P_HALTGTCAREQDES36
TCELL38:IMUX_C4SERDES.Q0P_HALTGTCAREQDES35
TCELL38:IMUX_C5SERDES.Q0P_HALTGTCAREQDES34
TCELL38:IMUX_D0SERDES.Q0P_HALTGTCAREQDES33
TCELL38:IMUX_D1SERDES.Q0P_HALTGTCAREQDES32
TCELL38:IMUX_D2SERDES.Q0P_HALTGTCAREQDES31
TCELL38:IMUX_D3SERDES.Q0P_HALTGTCAREQDES30
TCELL38:IMUX_D4SERDES.Q0P_HALTGTCAREQDES29
TCELL38:IMUX_D5SERDES.Q0P_HALTGTCAREQDES28
TCELL38:OUT_F0SERDES.Q0P_HALMSTCOMPDES97
TCELL38:OUT_F1SERDES.Q0P_HALMSTCOMPDES98
TCELL38:OUT_F2SERDES.Q0P_HALMSTCOMPDES82
TCELL38:OUT_F3SERDES.Q0P_HALMSTCOMPDES32
TCELL38:OUT_F4SERDES.Q0P_HALMSTCOMPDES55
TCELL38:OUT_F5SERDES.Q0P_HALMSTCOMPDES37
TCELL38:OUT_F6SERDES.Q0P_HALMSTCOMPDES123
TCELL38:OUT_F7SERDES.Q0P_HALMSTCOMPDES33
TCELL38:OUT_Q0SERDES.Q0P_HALMSTCOMPDES11
TCELL38:OUT_Q1SERDES.Q0P_HALMSTCOMPDES3
TCELL38:OUT_Q2SERDES.Q0P_HALMSTCOMPDES5
TCELL38:OUT_Q3SERDES.Q0P_HALMSTCOMPDES34
TCELL38:OUT_Q4SERDES.Q0P_HALMSTCOMPDES48
TCELL38:OUT_Q5SERDES.Q0P_HALMSTCOMPDES122
TCELL38:OUT_Q6SERDES.Q0P_HALMSTCOMPDES4
TCELL38:OUT_Q7SERDES.Q0P_HALMSTCOMPDES14
TCELL39:IMUX_A0SERDES.Q0P_HALTGTCAREQDES27
TCELL39:IMUX_A1SERDES.Q0P_HALTGTCAREQDES26
TCELL39:IMUX_A2SERDES.Q0P_HALTGTCAREQDES25
TCELL39:IMUX_A3SERDES.Q0P_HALTGTCAREQDES24
TCELL39:IMUX_B0SERDES.Q0P_HALTGTCAREQDES23
TCELL39:IMUX_B1SERDES.Q0P_HALTGTCAREQDES22
TCELL39:IMUX_B2SERDES.Q0P_HALTGTCAREQDES21
TCELL39:IMUX_B3SERDES.Q0P_HALTGTCAREQDES20
TCELL39:IMUX_C0SERDES.Q0P_HALTGTCAREQDES19
TCELL39:IMUX_C1SERDES.Q0P_HALTGTCAREQDES18
TCELL39:IMUX_C2SERDES.Q0P_HALTGTCAREQDES17
TCELL39:IMUX_C3SERDES.Q0P_HALTGTCAREQDES16
TCELL39:IMUX_D0SERDES.Q0P_HALTGTCAREQDES15
TCELL39:IMUX_D1SERDES.Q0P_HALTGTCAREQDES14
TCELL39:IMUX_D2SERDES.Q0P_HALTGTCAREQDES13
TCELL39:IMUX_D3SERDES.Q0P_HALTGTCAREQDES12
TCELL39:OUT_F0SERDES.Q0P_HALMSTCOMPDES6
TCELL39:OUT_F1SERDES.Q0P_HALMSTCOMPDES121
TCELL39:OUT_F2SERDES.Q0P_HALMSTCOMPDES63
TCELL39:OUT_F3SERDES.Q0P_HALMSTCOMPDES60
TCELL39:OUT_F6SERDES.Q0P_HALMSTCOMPDES50
TCELL39:OUT_F7SERDES.Q0P_HALMSTCOMPDES51
TCELL39:OUT_Q0SERDES.Q0P_HALMSTCOMPDES59
TCELL39:OUT_Q1SERDES.Q0P_HALMSTCOMPDES36
TCELL39:OUT_Q2SERDES.Q0P_HALMSTCOMPDES47
TCELL39:OUT_Q3SERDES.Q0P_HALMSTCOMPDES35
TCELL39:OUT_Q6SERDES.Q0P_HALMSTCOMPDES15
TCELL39:OUT_Q7SERDES.Q0P_HALMSTCOMPDES13
TCELL40:IMUX_A0SERDES.Q0P_HALTGTCAREQDES11
TCELL40:IMUX_A1SERDES.Q0P_HALTGTCAREQDES10
TCELL40:IMUX_A2SERDES.Q0P_HALTGTCAREQDES9
TCELL40:IMUX_A3SERDES.Q0P_HALTGTCAREQDES8
TCELL40:IMUX_A4SERDES.Q0P_HALTGTCAREQDES7
TCELL40:IMUX_A5SERDES.Q0P_HALTGTCAREQDES6
TCELL40:IMUX_B0SERDES.Q0P_HALTGTCAREQDES5
TCELL40:IMUX_B1SERDES.Q0P_HALTGTCAREQDES4
TCELL40:IMUX_B2SERDES.Q0P_HALTGTCAREQDES3
TCELL40:IMUX_B3SERDES.Q0P_HALTGTCAREQDES2
TCELL40:IMUX_B4SERDES.Q0P_HALTGTCAREQDES1
TCELL40:IMUX_B5SERDES.Q0P_HALTGTACK
TCELL40:IMUX_C0SERDES.Q0P_HALTGTWRDY
TCELL40:IMUX_C1SERDES.Q0P_HALTGTCAREQDES0
TCELL40:IMUX_C2SERDES.Q0P_HALMSTREQDES124
TCELL40:IMUX_C3SERDES.Q0P_HALMSTREQDES123
TCELL40:IMUX_C4SERDES.Q0P_HALMSTREQDES125
TCELL40:IMUX_C5SERDES.Q0P_HALMSTREQDES122
TCELL40:IMUX_D0SERDES.Q0P_HALMSTREQDES121
TCELL40:IMUX_D1SERDES.Q0P_HALTGTCAREQDES120
TCELL40:IMUX_D2SERDES.Q0P_HALMSTREQDES120
TCELL40:IMUX_D3SERDES.Q0P_HALMSTREQDES119
TCELL40:IMUX_D4SERDES.Q0P_HALMSTREQDES118
TCELL40:IMUX_D5SERDES.Q0P_HALMSTREQDES117
TCELL40:OUT_F0SERDES.Q0P_HALMSTCOMPDES31
TCELL40:OUT_F1SERDES.Q0P_HALMSTCOMPDES17
TCELL40:OUT_F2SERDES.Q0P_MAXREADREQSIZE1
TCELL40:OUT_F3SERDES.Q0P_HALMSTCOMPDES53
TCELL40:OUT_F4SERDES.Q0P_HALMSTCOMPDES49
TCELL40:OUT_F5SERDES.Q0P_HALMSTCOMPDES61
TCELL40:OUT_F6SERDES.Q0P_HALMSTCOMPDES46
TCELL40:OUT_F7SERDES.Q0P_HALMSTCOMPDES45
TCELL40:OUT_Q0SERDES.Q0P_HALMSTCOMPDES58
TCELL40:OUT_Q1SERDES.Q0P_HALMSTCOMPDES40
TCELL40:OUT_Q2SERDES.Q0P_HALMSTCOMPDES20
TCELL40:OUT_Q3SERDES.Q0P_HALMSTCOMPDES44
TCELL40:OUT_Q4SERDES.Q0P_HALMSTCOMPDES8
TCELL40:OUT_Q5SERDES.Q0P_HALMSTCOMPDES23
TCELL40:OUT_Q6SERDES.Q0P_HALMSTCOMPDES54
TCELL40:OUT_Q7SERDES.Q0P_HALMSTCOMPDES56
TCELL41:IMUX_A0SERDES.Q0P_HALMSTREQDES116
TCELL41:IMUX_A1SERDES.Q0P_HALMSTREQDES113
TCELL41:IMUX_A2SERDES.Q0P_HALMSTREQDES112
TCELL41:IMUX_A3SERDES.Q0P_HALMSTREQDES111
TCELL41:IMUX_A4SERDES.Q0P_HALMSTREQDES109
TCELL41:IMUX_A5SERDES.Q0P_HALMSTREQDES108
TCELL41:IMUX_B0SERDES.Q0P_HALMSTREQDES114
TCELL41:IMUX_B1SERDES.Q0P_HALMSTREQDES106
TCELL41:IMUX_B2SERDES.Q0P_HALMSTREQDES105
TCELL41:IMUX_B3SERDES.Q0P_HALMSTREQDES104
TCELL41:IMUX_B4SERDES.Q0P_HALMSTREQDES103
TCELL41:IMUX_B5SERDES.Q0P_HALMSTREQDES102
TCELL41:IMUX_C0SERDES.Q0P_HALMSTREQDES126
TCELL41:IMUX_C1SERDES.Q0P_HALMSTREQDES107
TCELL41:IMUX_C2SERDES.Q0P_HALMSTREQDES115
TCELL41:IMUX_C3SERDES.Q0P_HALMSTREQDES110
TCELL41:IMUX_C4SERDES.Q0P_HALMSTREQDES101
TCELL41:IMUX_C5SERDES.Q0P_HALMSTREQDES100
TCELL41:IMUX_D0SERDES.Q0P_HALMSTREQDES99
TCELL41:IMUX_D1SERDES.Q0P_HALMSTREQDES98
TCELL41:IMUX_D2SERDES.Q0P_HALMSTREQDES97
TCELL41:IMUX_D3SERDES.Q0P_HALMSTREQDES96
TCELL41:IMUX_D4SERDES.Q0P_HALMSTREQDES95
TCELL41:IMUX_D5SERDES.Q0P_HALMSTREQDES94
TCELL41:OUT_F0SERDES.Q0P_HALMSTCOMPDES52
TCELL41:OUT_F1SERDES.Q0P_HALMSTCOMPDES9
TCELL41:OUT_F2SERDES.Q0P_HALMSTCOMPDES10
TCELL41:OUT_F3SERDES.Q0P_HALMSTCOMPDES43
TCELL41:OUT_F4SERDES.Q0P_HALMSTCOMPDES7
TCELL41:OUT_F5SERDES.Q0P_HALMSTCOMPDES29
TCELL41:OUT_F6SERDES.Q0P_HALMSTCOMPDES12
TCELL41:OUT_F7SERDES.Q0P_HALMSTCOMPDES41
TCELL41:OUT_Q0SERDES.Q0P_HALMSTCOMPDES16
TCELL41:OUT_Q1SERDES.Q0P_HALMSTCOMPDES62
TCELL41:OUT_Q2SERDES.Q0P_HALMSTCOMPDES57
TCELL41:OUT_Q3SERDES.Q0P_HALMSTCOMPDES42
TCELL41:OUT_Q4SERDES.Q0P_HALMSTCOMPDES22
TCELL41:OUT_Q5SERDES.Q0P_HALMSTCOMPDES19
TCELL41:OUT_Q6SERDES.Q0P_HALMSTCOMPDES39
TCELL41:OUT_Q7SERDES.Q0P_RCBSTS
TCELL42:IMUX_A2SERDES.Q0P_HALMSTREQDES93
TCELL42:IMUX_A3SERDES.Q0P_HALMSTREQDES92
TCELL42:IMUX_A4SERDES.Q0P_HALMSTREQDES91
TCELL42:IMUX_A5SERDES.Q0P_HALMSTREQDES90
TCELL42:IMUX_B2SERDES.Q0P_HALMSTREQDES89
TCELL42:IMUX_B3SERDES.Q0P_HALMSTREQDES88
TCELL42:IMUX_B4SERDES.Q0P_HALMSTREQDES87
TCELL42:IMUX_B5SERDES.Q0P_HALMSTREQDES85
TCELL42:IMUX_C2SERDES.Q0P_HALMSTREQDES84
TCELL42:IMUX_C3SERDES.Q0P_HALTGTCOMPERR
TCELL42:IMUX_C4SERDES.Q0P_HALTGTCOMPVLD
TCELL42:IMUX_C5SERDES.Q0P_HALTGTCOMPSOP
TCELL42:IMUX_D2SERDES.Q0P_HALMSTREQDES83
TCELL42:IMUX_D3SERDES.Q0P_HALMSTREQDES82
TCELL42:IMUX_D4SERDES.Q0P_HALMSTREQDES81
TCELL42:IMUX_D5SERDES.Q0P_HALMSTREQDES79
TCELL42:OUT_F2SERDES.Q0P_HALMSTCOMPDES28
TCELL42:OUT_F3SERDES.Q0P_HALMSTCOMPDES26
TCELL42:OUT_F4SERDES.Q0P_MSIXMASK
TCELL42:OUT_F5SERDES.Q0P_HALMSTCOMPDES27
TCELL42:OUT_F6SERDES.Q0P_HALMSTCOMPDES25
TCELL42:OUT_F7SERDES.Q0P_HALMSTCOMPDES24
TCELL42:OUT_Q2SERDES.Q0P_HALMSTCOMPDES18
TCELL42:OUT_Q3SERDES.Q0P_HALMSTCOMPDES21
TCELL42:OUT_Q4SERDES.Q0P_FTLERROUT
TCELL42:OUT_Q5SERDES.Q0P_MAXREADREQSIZE2
TCELL42:OUT_Q6SERDES.Q0P_TPHSTMODE2
TCELL42:OUT_Q7SERDES.Q0P_FUNCSTS2
TCELL43:IMUX_A0SERDES.Q0P_HALTGTCOMPEOP
TCELL43:IMUX_A1SERDES.Q0P_HALMSTREQDES75
TCELL43:IMUX_A2SERDES.Q0P_HALMSTREQDES74
TCELL43:IMUX_A3SERDES.Q0P_HALMSTREQDES72
TCELL43:IMUX_A4SERDES.Q0P_HALMSTREQDES127
TCELL43:IMUX_A5SERDES.Q0P_HALMSTREQ
TCELL43:IMUX_B0SERDES.Q0P_HALMSTREQDES71
TCELL43:IMUX_B1SERDES.Q0P_HALMSTREQDES77
TCELL43:IMUX_B2SERDES.Q0P_HALMSTREQDES80
TCELL43:IMUX_B3SERDES.Q0P_HALMSTREQDES70
TCELL43:IMUX_B4SERDES.Q0P_HALTGTNPREJ
TCELL43:IMUX_B5SERDES.Q0P_HALMSTREQDES76
TCELL43:IMUX_C0SERDES.Q0P_HALMSTREQDES64
TCELL43:IMUX_C1SERDES.Q0P_HALMSTREQDES65
TCELL43:IMUX_C2SERDES.Q0P_HALMSTREQDES78
TCELL43:IMUX_C3SERDES.Q0P_HALMSTREQDES63
TCELL43:IMUX_C4SERDES.Q0P_HALMSTREQDES62
TCELL43:IMUX_C5SERDES.Q0P_HALMSTREQDES66
TCELL43:IMUX_D0SERDES.Q0P_HALMSTREQDES57
TCELL43:IMUX_D1SERDES.Q0P_HALMSTREQDES58
TCELL43:IMUX_D2SERDES.Q0P_HALMSTREQDES60
TCELL43:IMUX_D3SERDES.Q0P_HALMSTREQDES61
TCELL43:IMUX_D4SERDES.Q0P_HALMSTREQDES69
TCELL43:IMUX_D5SERDES.Q0P_HALMSTREQDES68
TCELL43:OUT_F1SERDES.Q0P_FUNCPWRSTATE1
TCELL43:OUT_F2SERDES.Q0P_TPHSTMODE0
TCELL43:OUT_F3SERDES.Q0P_FUNCPWRSTATE0
TCELL43:OUT_F5SERDES.Q0P_CORERROUT
TCELL43:OUT_F6SERDES.Q0P_FUNCSTS1
TCELL43:OUT_F7SERDES.Q0P_NFTLERROUT
TCELL43:OUT_Q0SERDES.Q0P_FUNCPWRSTATE2
TCELL43:OUT_Q1SERDES.Q0P_HALMSTREJ
TCELL43:OUT_Q2SERDES.Q0P_SCANO10
TCELL43:OUT_Q3SERDES.Q0P_FUNCSTS0
TCELL43:OUT_Q4SERDES.Q0P_HALMSTACK
TCELL43:OUT_Q5SERDES.Q0P_MSIXEN
TCELL43:OUT_Q6SERDES.Q0P_MAXREADREQSIZE0
TCELL43:OUT_Q7SERDES.Q0P_FUNCSTS3
TCELL44:IMUX_A0SERDES.Q0P_HALMSTREQDES59
TCELL44:IMUX_A1SERDES.Q0P_HALMSTREQDES56
TCELL44:IMUX_A2SERDES.Q0P_HALMSTREQDES73
TCELL44:IMUX_A3SERDES.Q0P_HALMSTREQDES54
TCELL44:IMUX_A4SERDES.Q0P_HALMSTREQDES55
TCELL44:IMUX_A5SERDES.Q0P_HALMSTREQDES67
TCELL44:IMUX_B0SERDES.Q0P_HALMSTREQDES53
TCELL44:IMUX_B1SERDES.Q0P_HALMSTREQDES50
TCELL44:IMUX_B2SERDES.Q0P_HALMSTREQDES46
TCELL44:IMUX_B3SERDES.Q0P_HALMSTREQDES47
TCELL44:IMUX_B4SERDES.Q0P_HALMSTREQDES51
TCELL44:IMUX_B5SERDES.Q0P_HALMSTREQDES52
TCELL44:IMUX_C0SERDES.Q0P_HALMSTREQDES49
TCELL44:IMUX_C1SERDES.Q0P_HALMSTREQDES48
TCELL44:IMUX_C2SERDES.Q0P_HALMSTREQDES45
TCELL44:IMUX_C3SERDES.Q0P_HALMSTREQDES43
TCELL44:IMUX_C4SERDES.Q0P_HALMSTREQDES42
TCELL44:IMUX_C5SERDES.Q0P_HALMSTREQDES44
TCELL44:IMUX_D0SERDES.Q0P_HALMSTREQDES40
TCELL44:IMUX_D1SERDES.Q0P_HALMSTREQDES7
TCELL44:IMUX_D2SERDES.Q0P_HALMSTREQDES39
TCELL44:IMUX_D3SERDES.Q0P_HALMSTREQDES23
TCELL44:IMUX_D4SERDES.Q0P_HALMSTREQDES37
TCELL44:IMUX_D5SERDES.Q0P_HALMSTREQDES41
TCELL44:OUT_F0SERDES.Q0P_TPHSTMODE1
TCELL44:OUT_F1SERDES.Q0P_HALMSTTAG2
TCELL44:OUT_F2SERDES.Q0P_LCLINT
TCELL44:OUT_F3SERDES.Q0P_HALMSTTAG1
TCELL44:OUT_F4SERDES.Q0P_HALMSTTAG3
TCELL44:OUT_F5SERDES.Q0P_HALMSTTAG4
TCELL44:OUT_F6SERDES.Q0P_HALMSTTAG0
TCELL44:OUT_F7SERDES.Q0P_MSIMSGABRT
TCELL44:OUT_Q0SERDES.Q0P_TPHREQENABLE
TCELL44:OUT_Q1SERDES.Q0P_DBGDATOUT5
TCELL44:OUT_Q2SERDES.Q0P_MSIMSGSENT
TCELL44:OUT_Q3SERDES.Q0P_DBGDATOUT7
TCELL44:OUT_Q4SERDES.Q0P_DBGDATOUT8
TCELL44:OUT_Q5SERDES.Q0P_SCANO12
TCELL44:OUT_Q6SERDES.Q0P_DBGDATOUT12
TCELL44:OUT_Q7SERDES.Q0P_DBGDATOUT6
TCELL45:IMUX_A0SERDES.Q0P_HALMSTREQDES38
TCELL45:IMUX_A1SERDES.Q0P_HALMSTREQDES20
TCELL45:IMUX_A2SERDES.Q0P_HALMSTREQDES36
TCELL45:IMUX_A3SERDES.Q0P_HALMSTREQDES9
TCELL45:IMUX_A4SERDES.Q0P_HALMSTREQDES19
TCELL45:IMUX_A5SERDES.Q0P_HALMSTWBVLD1
TCELL45:IMUX_B0SERDES.Q0P_HALMSTREQDES8
TCELL45:IMUX_B1SERDES.Q0P_HALMSTREQDES17
TCELL45:IMUX_B2SERDES.Q0P_HALMSTREQDES21
TCELL45:IMUX_B3SERDES.Q0P_HALMSTREQDES22
TCELL45:IMUX_B4SERDES.Q0P_HALMSTREQDES12
TCELL45:IMUX_B5SERDES.Q0P_HALMSTWBVLD2
TCELL45:IMUX_C0SERDES.Q0P_HALMSTREQDES34
TCELL45:IMUX_C1SERDES.Q0P_HALMSTREQDES1
TCELL45:IMUX_C2SERDES.Q0P_HALMSTREQDES10
TCELL45:IMUX_C3SERDES.Q0P_HALMSTREQDES11
TCELL45:IMUX_C4SERDES.Q0P_HALMSTREQDES16
TCELL45:IMUX_C5SERDES.Q0P_HALMSTREQDES35
TCELL45:IMUX_D0SERDES.Q0P_HALMSTREQDES6
TCELL45:IMUX_D1SERDES.Q0P_HALMSTREQDES5
TCELL45:IMUX_D2SERDES.Q0P_HALMSTREQDES18
TCELL45:IMUX_D3SERDES.Q0P_HALMSTREQDES4
TCELL45:IMUX_D4SERDES.Q0P_HALMSTREQDES3
TCELL45:IMUX_D5SERDES.Q0P_HALMSTREQDES2
TCELL45:OUT_F0SERDES.Q0P_SCANO4
TCELL45:OUT_F1SERDES.Q0P_DBGDATOUT14
TCELL45:OUT_F2SERDES.Q0P_DBGDATOUT4
TCELL45:OUT_F3SERDES.Q0P_DBGDATOUT9
TCELL45:OUT_F4SERDES.Q0P_DBGDATOUT0
TCELL45:OUT_F5SERDES.Q0P_DBGDATOUT2
TCELL45:OUT_F6SERDES.Q0P_DBGDATOUT13
TCELL45:OUT_F7SERDES.Q0P_DBGDATOUT1
TCELL45:OUT_Q0SERDES.Q0P_HALMSTCOMPDES124
TCELL45:OUT_Q1SERDES.Q0P_DBGDATOUT3
TCELL45:OUT_Q2SERDES.Q0P_DBGDATOUT11
TCELL45:OUT_Q3SERDES.Q0P_LTSSMSTATE5
TCELL45:OUT_Q4SERDES.Q0P_DBGDATOUT10
TCELL45:OUT_Q5SERDES.Q0P_DBGDATOUT15
TCELL45:OUT_Q6SERDES.Q0P_LNKSTS0
TCELL45:OUT_Q7SERDES.Q0P_LTSSMSTATE0
TCELL46:IMUX_A0SERDES.Q0P_HALMSTREQDES15
TCELL46:IMUX_A1SERDES.Q0P_HALMSTREQDES33
TCELL46:IMUX_A2SERDES.Q0P_HALMSTWEOP
TCELL46:IMUX_A3SERDES.Q0P_HALMSTREQDES32
TCELL46:IMUX_A4SERDES.Q0P_HALMSTWBVLD0
TCELL46:IMUX_A5SERDES.Q0P_HALMSTWDATVLD
TCELL46:IMUX_B0SERDES.Q0P_HALMSTREQDES0
TCELL46:IMUX_B1SERDES.Q0P_HALMSTREQDES31
TCELL46:IMUX_B2SERDES.Q0P_HALMSTREQDES14
TCELL46:IMUX_B3SERDES.Q0P_HALMSTREQDES13
TCELL46:IMUX_B4SERDES.Q0P_HALMSTWERR
TCELL46:IMUX_B5SERDES.Q0P_HALMSTWBVLD6
TCELL46:IMUX_C0SERDES.Q0P_HALMSTWBVLD7
TCELL46:IMUX_C1SERDES.Q0P_HALMSTWBVLD3
TCELL46:IMUX_C2SERDES.Q0P_HALMSTWBVLD4
TCELL46:IMUX_C3SERDES.Q0P_HALMSTREQDES25
TCELL46:IMUX_C4SERDES.Q0P_HALMSTREQDES28
TCELL46:IMUX_C5SERDES.Q0P_HALMSTREQDES30
TCELL46:IMUX_D0SERDES.Q0P_HALMSTREQDES29
TCELL46:IMUX_D1SERDES.Q0P_HALMSTREQDES27
TCELL46:IMUX_D2SERDES.Q0P_HALMSTREQDES24
TCELL46:IMUX_D3SERDES.Q0P_HALMSTWBVLD5
TCELL46:IMUX_D4SERDES.Q0P_HALMSTREQDES26
TCELL46:IMUX_D5SERDES.Q0P_INTAI
TCELL46:OUT_F0SERDES.Q0P_LTSSMSTATE4
TCELL46:OUT_F1SERDES.Q0P_LTSSMSTATE1
TCELL46:OUT_F2SERDES.Q0P_SCANO3
TCELL46:OUT_F3SERDES.Q0P_LTSSMSTATE2
TCELL46:OUT_F4SERDES.Q0P_HALMSTRERR
TCELL46:OUT_F5SERDES.Q0P_SCANO13
TCELL46:OUT_F6SERDES.Q0P_LTSSMSTATE3
TCELL46:OUT_F7SERDES.Q0P_LNKPWRSTATE3
TCELL46:OUT_Q0SERDES.Q0P_SCANO17
TCELL46:OUT_Q1SERDES.Q0P_HALTGTREQDES118
TCELL46:OUT_Q2SERDES.Q0P_HALTGTREQDES119
TCELL46:OUT_Q3SERDES.Q0P_HALTGTREQDES117
TCELL46:OUT_Q4SERDES.Q0P_HALTGTREQDES116
TCELL46:OUT_Q5SERDES.Q0P_HALTGTREQDES114
TCELL46:OUT_Q6SERDES.Q0P_HALTGTREQDES113
TCELL46:OUT_Q7SERDES.Q0P_HALTGTREQDES115
TCELL47:IMUX_A0SERDES.Q0P_HALMSTREQATTR0
TCELL47:IMUX_A1SERDES.Q0P_HALMSTREQATTR1
TCELL47:IMUX_A2SERDES.Q0P_HALMSTCOMPRDY
TCELL47:IMUX_A3SERDES.Q0P_MSIATTRIN2
TCELL47:IMUX_A4SERDES.Q0P_HALMSTREQDES86
TCELL47:IMUX_A5SERDES.Q0P_HALTGTCAREQDES108
TCELL47:IMUX_B0SERDES.Q0P_HALTGTCAREQDES110
TCELL47:IMUX_B1SERDES.Q0P_HALTGTCAREQDES112
TCELL47:IMUX_B2SERDES.Q0P_HALTGTCAREQDES113
TCELL47:IMUX_B3SERDES.Q0P_HALTGTCAREQDES116
TCELL47:IMUX_B4SERDES.Q0P_HALTGTCAREQDES118
TCELL47:IMUX_B5SERDES.Q0P_HALTGTCAREQDES124
TCELL47:IMUX_C0SERDES.Q0P_HALTGTCAREQDES126
TCELL47:IMUX_C1SERDES.Q0P_HALTGTCOMPDES119
TCELL47:IMUX_C2SERDES.Q0P_HALTGTCAREQDES127
TCELL47:IMUX_C3SERDES.Q0P_HALTGTCAREQDES125
TCELL47:IMUX_C4SERDES.Q0P_HALTGTCAREQDES123
TCELL47:IMUX_C5SERDES.Q0P_HALTGTCAREQDES122
TCELL47:IMUX_D0SERDES.Q0P_HALTGTCAREQDES119
TCELL47:IMUX_D1SERDES.Q0P_HALTGTCAREQDES117
TCELL47:IMUX_D2SERDES.Q0P_HALTGTCAREQDES115
TCELL47:IMUX_D3SERDES.Q0P_HALTGTCAREQDES114
TCELL47:IMUX_D4SERDES.Q0P_HALTGTCAREQDES111
TCELL47:IMUX_D5SERDES.Q0P_HALTGTCAREQDES109
TCELL47:OUT_F0SERDES.Q0P_HALTGTREQDES108
TCELL47:OUT_F1SERDES.Q0P_HALTGTREQDES112
TCELL47:OUT_F2SERDES.Q0P_HALTGTREQDES107
TCELL47:OUT_F3SERDES.Q0P_NEGLNKWIDTH0
TCELL47:OUT_F4SERDES.Q0P_LNKSTS1
TCELL47:OUT_F5SERDES.Q0P_NEGLNKWIDTH1
TCELL47:OUT_F6SERDES.Q0P_MAXPYLDSIZE0
TCELL47:OUT_F7SERDES.Q0P_LNKPWRSTATE2
TCELL47:OUT_Q0SERDES.Q0P_MAXPYLDSIZE2
TCELL47:OUT_Q1SERDES.Q0P_LNKDWNRSTOUT
TCELL47:OUT_Q2SERDES.Q0P_NEGSPEED
TCELL47:OUT_Q3SERDES.Q0P_LNKPWRSTATE1
TCELL47:OUT_Q4SERDES.Q0P_SCANO0
TCELL47:OUT_Q5SERDES.Q0P_SCANO16
TCELL47:OUT_Q6SERDES.Q0P_SCANO15
TCELL47:OUT_Q7SERDES.Q0P_MAXPYLDSIZE1
TCELL48:IMUX_A0SERDES.Q0P_HALTGTCAREQDES107
TCELL48:IMUX_A1SERDES.Q0P_HALMSTREQATTR2
TCELL48:IMUX_A2SERDES.Q0P_MSIXATTRIN2
TCELL48:IMUX_A3SERDES.Q0P_CORERRIN
TCELL48:IMUX_A4SERDES.Q0P_PWRSTATECHNGACK
TCELL48:IMUX_A5SERDES.Q0P_MSIXMSGDAT10
TCELL48:IMUX_B0SERDES.Q0P_MSIXMSGDAT27
TCELL48:IMUX_B1SERDES.Q0P_MSIXMSGDAT30
TCELL48:IMUX_B2SERDES.Q0P_MSIXMSGDAT28
TCELL48:IMUX_B3SERDES.Q0P_MSIXMSGDAT23
TCELL48:IMUX_B4SERDES.Q0P_MSIXMSGDAT4
TCELL48:IMUX_B5SERDES.Q0P_MSIXMSGDAT18
TCELL48:IMUX_C0SERDES.Q0P_MSIXMSGDAT21
TCELL48:IMUX_C1SERDES.Q0P_MSIXMSGDAT29
TCELL48:IMUX_C2SERDES.Q0P_MSIXMSGDAT11
TCELL48:IMUX_C3SERDES.Q0P_MSIXMSGDAT20
TCELL48:IMUX_C4SERDES.Q0P_MSIXMSGDAT22
TCELL48:IMUX_C5SERDES.Q0P_MSIXMSGDAT31
TCELL48:IMUX_D0SERDES.Q0P_MSIXMSGDAT24
TCELL48:IMUX_D1SERDES.Q0P_MSIXMSGDAT25
TCELL48:IMUX_D2SERDES.Q0P_MSIXMSGDAT17
TCELL48:IMUX_D3SERDES.Q0P_MSIXMSGDAT16
TCELL48:IMUX_D4SERDES.Q0P_MSIXMSGDAT15
TCELL48:IMUX_D5SERDES.Q0P_MSIXMSGDAT26
TCELL48:OUT_F0SERDES.Q0P_SCANO24
TCELL48:OUT_F1SERDES.Q0P_LNKPWRSTATE0
TCELL48:OUT_F2SERDES.Q0P_MSIXMSGSENT
TCELL48:OUT_F3SERDES.Q0P_HOTRSTOUT
TCELL48:OUT_F4SERDES.Q0P_SCANO23
TCELL49:IMUX_A0SERDES.Q0P_MSIXMSGDAT19
TCELL49:IMUX_A1SERDES.Q0P_MSIXMSGDAT14
TCELL49:IMUX_A2SERDES.Q0P_MSIXMSGDAT13
TCELL49:IMUX_A3SERDES.Q0P_MSIXMSGDAT1
TCELL49:IMUX_A4SERDES.Q0P_MSIXMSGDAT0
TCELL49:IMUX_A5SERDES.Q0P_MSIXMSGDAT12
TCELL49:IMUX_B0SERDES.Q0P_MSIXMSGDAT6
TCELL49:IMUX_B1SERDES.Q0P_MSIXMSGDAT2
TCELL49:IMUX_B2SERDES.Q0P_MSIXMSGDAT7
TCELL49:IMUX_B3SERDES.Q0P_MSIXMSGDAT5
TCELL49:IMUX_B4SERDES.Q0P_MSIXMSGDAT3
TCELL49:IMUX_B5SERDES.Q0P_MSIXMSGDAT9
TCELL49:IMUX_C0SERDES.Q0P_MSIXMSGDAT8
TCELL49:IMUX_C1SERDES.Q0P_INTBI
TCELL49:IMUX_C2SERDES.Q0P_INTCI
TCELL49:IMUX_C3SERDES.Q0P_INTDI
TCELL49:IMUX_C4SERDES.Q0P_INTPENDSTS
TCELL49:IMUX_C5SERDES.Q0P_HALMSTREQTPHPRESENT
TCELL49:IMUX_D0SERDES.Q0P_MSIXATTRIN1
TCELL49:IMUX_D1SERDES.Q0P_MSIXATTRIN0
TCELL49:IMUX_D2SERDES.Q0P_HALMSTREQTPHTYPE1
TCELL49:IMUX_D3SERDES.Q0P_MSIXREQTPHTYPE1
TCELL49:IMUX_D4SERDES.Q0P_HALMSTREQTPHTYPE0
TCELL49:IMUX_D5SERDES.Q0P_MSIXREQTPHTYPE0
TCELL50:IMUX_A0SERDES.Q0P_MSIXREQTPHPRESENT
TCELL50:IMUX_A1SERDES.Q0P_MSIXREQTPHSTTAG4
TCELL50:IMUX_A2SERDES.Q0P_HALMSTREQTPHSTTAG4
TCELL50:IMUX_A3SERDES.Q0P_HALMSTREQTPHSTTAG2
TCELL50:IMUX_A4SERDES.Q0P_MSIXREQTPHSTTAG2
TCELL50:IMUX_A5SERDES.Q0P_HALMSTREQTPHSTTAG1
TCELL50:IMUX_B0SERDES.Q0P_MSIXREQTPHSTTAG1
TCELL50:IMUX_B1SERDES.Q0P_HALMSTREQTPHSTTAG6
TCELL50:IMUX_B2SERDES.Q0P_MSIXREQTPHSTTAG6
TCELL50:IMUX_B3SERDES.Q0P_HALMSTREQTPHSTTAG7
TCELL50:IMUX_B4SERDES.Q0P_MSIXREQTPHSTTAG7
TCELL50:IMUX_B5SERDES.Q0P_HALMSTREQTPHSTTAG3
TCELL50:IMUX_C0SERDES.Q0P_MSIXREQTPHSTTAG3
TCELL50:IMUX_C1SERDES.Q0P_MSIXREQTPHSTTAG0
TCELL50:IMUX_C2SERDES.Q0P_HALMSTREQTPHSTTAG0
TCELL50:IMUX_C3SERDES.Q0P_HALMSTREQTPHSTTAG5
TCELL50:IMUX_C4SERDES.Q0P_MSIXREQTPHSTTAG5
TCELL50:IMUX_C5SERDES.Q0P_MSIREQTPHSTTAG2
TCELL50:IMUX_D0SERDES.Q0P_MSIREQTPHSTTAG1
TCELL50:IMUX_D1SERDES.Q0P_MSIREQTPHPRESENT
TCELL50:IMUX_D2SERDES.Q0P_MSIREQTPHSTTAG4
TCELL50:IMUX_D3SERDES.Q0P_UNCORRERRIN
TCELL50:IMUX_D4SERDES.Q0P_MSIREQTPHTYPE1
TCELL50:IMUX_D5SERDES.Q0P_MSIXMSGADDR0
TCELL51:IMUX_A0SERDES.Q0P_MSIXMSGADDR1
TCELL51:IMUX_A1SERDES.Q0P_MSIXMSGADDR2
TCELL51:IMUX_A2SERDES.Q0P_MSIXMSGADDR3
TCELL51:IMUX_A3SERDES.Q0P_MSIXMSGADDR4
TCELL51:IMUX_A4SERDES.Q0P_MSIXMSGADDR5
TCELL51:IMUX_A5SERDES.Q0P_MSIREQTPHSTTAG3
TCELL51:IMUX_B0SERDES.Q0P_MSIREQTPHSTTAG6
TCELL51:IMUX_B1SERDES.Q0P_MSIXMSGADDR8
TCELL51:IMUX_B2SERDES.Q0P_MSIXMSGADDR6
TCELL51:IMUX_B3SERDES.Q0P_MSIXMSGADDR9
TCELL51:IMUX_B4SERDES.Q0P_MSIXMSGADDR18
TCELL51:IMUX_B5SERDES.Q0P_MSIXMSGADDR15
TCELL51:IMUX_C0SERDES.Q0P_MSIXMSGADDR7
TCELL51:IMUX_C1SERDES.Q0P_MSIXMSGADDR10
TCELL51:IMUX_C2SERDES.Q0P_MSIXMSGVLD
TCELL51:IMUX_C3SERDES.Q0P_MSIXMSGADDR14
TCELL51:IMUX_C4SERDES.Q0P_MSIXMSGADDR11
TCELL51:IMUX_C5SERDES.Q0P_MSIXMSGADDR13
TCELL51:IMUX_D0SERDES.Q0P_MSIATTRIN1
TCELL51:IMUX_D1SERDES.Q0P_MSIATTRIN0
TCELL51:IMUX_D2SERDES.Q0P_MSIREQTPHTYPE0
TCELL51:IMUX_D3SERDES.Q0P_MSIXMSGADDR26
TCELL51:IMUX_D4SERDES.Q0P_MSIXMSGADDR20
TCELL51:IMUX_D5SERDES.Q0P_MSIXMSGADDR17
TCELL52:IMUX_A0SERDES.Q0P_MSIXMSGADDR30
TCELL52:IMUX_A1SERDES.Q0P_MSIXMSGADDR19
TCELL52:IMUX_A2SERDES.Q0P_MSIXMSGADDR16
TCELL52:IMUX_A3SERDES.Q0P_MSIXMSGADDR25
TCELL52:IMUX_A4SERDES.Q0P_MSIREQTPHSTTAG7
TCELL52:IMUX_A5SERDES.Q0P_MSIXMSGADDR28
TCELL52:IMUX_B0SERDES.Q0P_MSIREQTPHSTTAG5
TCELL52:IMUX_B1SERDES.Q0P_MSIXMSGADDR12
TCELL52:IMUX_B2SERDES.Q0P_MSIXMSGADDR29
TCELL52:IMUX_B3SERDES.Q0P_MSIXMSGADDR27
TCELL52:IMUX_B4SERDES.Q0P_MSIREQTPHSTTAG0
TCELL52:IMUX_B5SERDES.Q0P_MSIXMSGADDR21
TCELL52:IMUX_C0SERDES.Q0P_MSIXMSGADDR24
TCELL52:IMUX_C1SERDES.Q0P_MSIXMSGADDR31
TCELL52:IMUX_C2SERDES.Q0P_MSIXMSGADDR22
TCELL52:IMUX_C3SERDES.Q0P_MSIXMSGADDR23
TCELL52:IMUX_C4SERDES.Q0P_MSIASRTINT0
TCELL52:IMUX_C5SERDES.Q0P_MSIASRTINT10
TCELL52:IMUX_D0SERDES.Q0P_MSIASRTINT14
TCELL52:IMUX_D1SERDES.Q0P_MSIASRTINT18
TCELL52:IMUX_D2SERDES.Q0P_MSIASRTINT17
TCELL52:IMUX_D3SERDES.Q0P_MSIASRTINT4
TCELL52:IMUX_D4SERDES.Q0P_MSIASRTINT30
TCELL52:IMUX_D5SERDES.Q0P_MSIASRTINT31
TCELL53:IMUX_A0SERDES.Q0P_MSIASRTINT11
TCELL53:IMUX_A1SERDES.Q0P_MSIASRTINT29
TCELL53:IMUX_A2SERDES.Q0P_MSIASRTINT16
TCELL53:IMUX_A3SERDES.Q0P_MSIASRTINT15
TCELL53:IMUX_A4SERDES.Q0P_MSIASRTINT13
TCELL53:IMUX_A5SERDES.Q0P_MSIASRTINT8
TCELL53:IMUX_B0SERDES.Q0P_MSIASRTINT1
TCELL53:IMUX_B1SERDES.Q0P_MSIASRTINT28
TCELL53:IMUX_B2SERDES.Q0P_MSIASRTINT12
TCELL53:IMUX_B3SERDES.Q0P_MSIASRTINT27
TCELL53:IMUX_B4SERDES.Q0P_MSIASRTINT6
TCELL53:IMUX_B5SERDES.Q0P_MSIXMSGADDR63
TCELL53:IMUX_C0SERDES.Q0P_MSIASRTINT9
TCELL53:IMUX_C1SERDES.Q0P_MSIASRTINT7
TCELL53:IMUX_C2SERDES.Q0P_MSIASRTINT3
TCELL53:IMUX_C3SERDES.Q0P_MSIASRTINT5
TCELL53:IMUX_C4SERDES.Q0P_MSIASRTINT26
TCELL53:IMUX_C5SERDES.Q0P_MSIASRTINT24
TCELL53:IMUX_D0SERDES.Q0P_MSIASRTINT2
TCELL53:IMUX_D1SERDES.Q0P_MSIXMSGADDR60
TCELL53:IMUX_D2SERDES.Q0P_MSIASRTINT19
TCELL53:IMUX_D3SERDES.Q0P_MSIASRTINT21
TCELL53:IMUX_D4SERDES.Q0P_MSIXMSGADDR62
TCELL53:IMUX_D5SERDES.Q0P_MSIASRTINT25
TCELL54:IMUX_A0SERDES.Q0P_MSIXMSGADDR61
TCELL54:IMUX_A1SERDES.Q0P_MSIASRTINT23
TCELL54:IMUX_A2SERDES.Q0P_MSIASRTINT22
TCELL54:IMUX_A3SERDES.Q0P_MSIXMSGADDR59
TCELL54:IMUX_A4SERDES.Q0P_MSIXMSGADDR56
TCELL54:IMUX_A5SERDES.Q0P_MSIASRTINT20
TCELL54:IMUX_B0SERDES.Q0P_MSIXMSGADDR58
TCELL54:IMUX_B1SERDES.Q0P_MSIXMSGADDR57
TCELL54:IMUX_B2SERDES.Q0P_MSIXMSGADDR37
TCELL54:IMUX_B3SERDES.Q0P_MSIXMSGADDR40
TCELL54:IMUX_B4SERDES.Q0P_MSIXMSGADDR49
TCELL54:IMUX_B5SERDES.Q0P_MSIXMSGADDR45
TCELL54:IMUX_C0SERDES.Q0P_MSIXMSGADDR53
TCELL54:IMUX_C1SERDES.Q0P_MSIXMSGADDR51
TCELL54:IMUX_C2SERDES.Q0P_MSIXMSGADDR47
TCELL54:IMUX_C3SERDES.Q0P_MSIXMSGADDR44
TCELL54:IMUX_C4SERDES.Q0P_MSIXMSGADDR46
TCELL54:IMUX_C5SERDES.Q0P_MSIXMSGADDR52
TCELL54:IMUX_D0SERDES.Q0P_MSIXMSGADDR55
TCELL54:IMUX_D1SERDES.Q0P_MSIXMSGADDR50
TCELL54:IMUX_D2SERDES.Q0P_MSIXMSGADDR54
TCELL54:IMUX_D3SERDES.Q0P_MSIXMSGADDR42
TCELL54:IMUX_D4SERDES.Q0P_MSIXMSGADDR43
TCELL54:IMUX_D5SERDES.Q0P_MSIXMSGADDR48
TCELL55:IMUX_A0SERDES.Q0P_MSIXMSGADDR39
TCELL55:IMUX_A1SERDES.Q0P_MSIXMSGADDR38
TCELL55:IMUX_A2SERDES.Q0P_MSIXMSGADDR35
TCELL55:IMUX_A3SERDES.Q0P_MSIXMSGADDR36
TCELL55:IMUX_A4SERDES.Q0P_MSIXMSGADDR41
TCELL55:IMUX_A5SERDES.Q0P_MSIXMSGADDR33
TCELL55:IMUX_B0SERDES.Q0P_MSIXMSGADDR34
TCELL55:IMUX_B1SERDES.Q0P_MSIXMSGADDR32
TCELL57:OUT_F0SERDES.Q1EA1_COTXREAD
TCELL57:OUT_F1SERDES.Q1EA0_COTXREAD
TCELL57:OUT_F2SERDES.Q1S_TISCANO13
TCELL57:OUT_F3SERDES.Q1EA3_GOTXMACWR
TCELL57:OUT_F4SERDES.Q1EA0_COTXDISCFRM
TCELL57:OUT_F5SERDES.Q1EA1_COTXDISCFRM
TCELL57:OUT_F6SERDES.Q1EA0_COTXSTATVEC7
TCELL57:OUT_F7SERDES.Q1EA0_COTXSTATVEC6
TCELL57:OUT_Q6SERDES.Q1S_TISCANO9
TCELL57:OUT_Q7SERDES.Q1EA3_COTXREAD
TCELL58:OUT_F0SERDES.Q1EA1_COTXSTATVEC2
TCELL58:OUT_F1SERDES.Q1EA0_COTXSTATVEC0
TCELL58:OUT_F2SERDES.Q1EA0_COTXSTATVEC4
TCELL58:OUT_F3SERDES.Q1EA1_COTXSTATVEC3
TCELL58:OUT_F4SERDES.Q1EA1_COTXSTATVEC5
TCELL58:OUT_F5SERDES.Q1EA1_COTXSTATVEC0
TCELL58:OUT_F6SERDES.Q1EA0_COTXDONE
TCELL58:OUT_F7SERDES.Q1EA1_GOTXMACDATA6
TCELL58:OUT_Q0SERDES.Q1EA1_COTXSTATEN
TCELL58:OUT_Q1SERDES.Q1EA0_COTXSTATEN
TCELL58:OUT_Q2SERDES.Q1EA1_COTXDONE
TCELL58:OUT_Q3SERDES.Q1EA0_COTXSTATVEC3
TCELL58:OUT_Q4SERDES.Q1EA1_GOTXMACERR
TCELL58:OUT_Q5SERDES.Q1EA0_COTXSTATVEC1
TCELL58:OUT_Q6SERDES.Q1EA1_COTXSTATVEC1
TCELL58:OUT_Q7SERDES.Q1EA1_COTXSTATVEC7
TCELL59:IMUX_A2SERDES.Q1EA3_CITXEOF
TCELL59:IMUX_A3SERDES.Q1EA1_CITXEOF
TCELL59:IMUX_A4SERDES.Q1EA0_CITXEOF
TCELL59:IMUX_A5SERDES.Q1EA3_CITXLASTBYTEVLD
TCELL59:OUT_F0SERDES.Q1EA1_GOTXMACDATA7
TCELL59:OUT_F1SERDES.Q1EA0_GOTXMACERR
TCELL59:OUT_F2SERDES.Q1EA1_GOTXMACDATA4
TCELL59:OUT_F3SERDES.Q1EA1_GOTXMACWR
TCELL59:OUT_F4SERDES.Q1EA1_GOTXMACDATA2
TCELL59:OUT_F5SERDES.Q1EA1_GOTXMACDATA0
TCELL59:OUT_F6SERDES.Q1EA0_GOTXMACDATA5
TCELL59:OUT_F7SERDES.Q1EA2_GOTXMACDATA3
TCELL59:OUT_Q0SERDES.Q1EA0_COTXSTATVEC2
TCELL59:OUT_Q1SERDES.Q1EA1_COTXSTATVEC4
TCELL59:OUT_Q2SERDES.Q1EA1_COTXSTATVEC6
TCELL59:OUT_Q3SERDES.Q1EA3_GOTXMACDATA2
TCELL59:OUT_Q4SERDES.Q1EA0_COTXSTATVEC5
TCELL59:OUT_Q5SERDES.Q1EA3_GODISCARDFCS
TCELL59:OUT_Q6SERDES.Q1EA0_GOTXMACDATA4
TCELL59:OUT_Q7SERDES.Q1EA3_KORXMACCLKEN
TCELL60:IMUX_A0SERDES.Q1EA2_CITXDATA12
TCELL60:IMUX_A1SERDES.Q1EA1_CITXDATA15
TCELL60:IMUX_A2SERDES.Q1EA1_CITXDATA14
TCELL60:IMUX_A3SERDES.Q1EA1_CITXDATA13
TCELL60:IMUX_A4SERDES.Q1EA1_CITXDATA12
TCELL60:IMUX_A5SERDES.Q1EA1_CITXDATA11
TCELL60:IMUX_B0SERDES.Q1EA3_CITXDATA5
TCELL60:IMUX_B1SERDES.Q1EA3_CITXDATA4
TCELL60:IMUX_B2SERDES.Q1EA3_CITXDATA2
TCELL60:IMUX_B3SERDES.Q1EA3_CITXDATA3
TCELL60:IMUX_B4SERDES.Q1EA3_CITXDATA1
TCELL60:IMUX_B5SERDES.Q1EA3_CITXDATA0
TCELL60:IMUX_C0SERDES.Q1EA3_CITXDATA11
TCELL60:IMUX_C1SERDES.Q1EA3_CITXDATA10
TCELL60:IMUX_C2SERDES.Q1EA3_CITXDATA9
TCELL60:IMUX_C3SERDES.Q1EA3_CITXDATA8
TCELL60:IMUX_C4SERDES.Q1EA3_CITXDATA7
TCELL60:IMUX_C5SERDES.Q1EA3_CITXDATA6
TCELL60:IMUX_D0SERDES.Q1EA1_CITXLASTBYTEVLD
TCELL60:IMUX_D1SERDES.Q1EA0_CITXLASTBYTEVLD
TCELL60:IMUX_D2SERDES.Q1EA3_CITXDATA15
TCELL60:IMUX_D3SERDES.Q1EA3_CITXDATA14
TCELL60:IMUX_D4SERDES.Q1EA3_CITXDATA13
TCELL60:IMUX_D5SERDES.Q1EA3_CITXDATA12
TCELL60:OUT_F0SERDES.Q1EA2_GOTXMACWR
TCELL60:OUT_F1SERDES.Q1EA0_GOTXMACDATA1
TCELL60:OUT_F2SERDES.Q1EA0_GOTXMACDATA7
TCELL60:OUT_F3SERDES.Q1EA0_GOTXMACDATA3
TCELL60:OUT_F4SERDES.Q1EA2_GOTXMACDATA0
TCELL60:OUT_F5SERDES.Q1EA0_GOTXMACDATA6
TCELL60:OUT_F6SERDES.Q1EA3_GOTXMACDATA1
TCELL60:OUT_F7SERDES.Q1EA3_COTXDONE
TCELL60:OUT_Q0SERDES.Q1EA1_GOTXMACDATA3
TCELL60:OUT_Q1SERDES.Q1EA1_GOTXMACDATA5
TCELL60:OUT_Q2SERDES.Q1EA0_GOTXMACDATA2
TCELL60:OUT_Q3SERDES.Q1EA2_GOTXMACDATA1
TCELL60:OUT_Q4SERDES.Q1EA2_GOTXMACDATA2
TCELL60:OUT_Q5SERDES.Q1EA0_GOTXMACWR
TCELL60:OUT_Q6SERDES.Q1EA2_GOTXMACDATA7
TCELL60:OUT_Q7SERDES.Q1EA2_GOTXMACERR
TCELL61:IMUX_A0SERDES.Q1EA0_CITXDATA8
TCELL61:IMUX_A1SERDES.Q1EA0_CITXDATA7
TCELL61:IMUX_A2SERDES.Q1EA0_CITXDATA6
TCELL61:IMUX_A3SERDES.Q1EA0_CITXDATA5
TCELL61:IMUX_A4SERDES.Q1EA0_CITXDATA4
TCELL61:IMUX_A5SERDES.Q1EA0_CITXDATA3
TCELL61:IMUX_B0SERDES.Q1EA0_CITXDATA14
TCELL61:IMUX_B1SERDES.Q1EA0_CITXDATA13
TCELL61:IMUX_B2SERDES.Q1EA0_CITXDATA12
TCELL61:IMUX_B3SERDES.Q1EA0_CITXDATA11
TCELL61:IMUX_B4SERDES.Q1EA0_CITXDATA10
TCELL61:IMUX_B5SERDES.Q1EA0_CITXDATA9
TCELL61:IMUX_C0SERDES.Q1EA1_CITXDATA4
TCELL61:IMUX_C1SERDES.Q1EA1_CITXDATA3
TCELL61:IMUX_C2SERDES.Q1EA1_CITXDATA2
TCELL61:IMUX_C3SERDES.Q1EA1_CITXDATA1
TCELL61:IMUX_C4SERDES.Q1EA1_CITXDATA0
TCELL61:IMUX_C5SERDES.Q1EA0_CITXDATA15
TCELL61:IMUX_D0SERDES.Q1EA1_CITXDATA10
TCELL61:IMUX_D1SERDES.Q1EA1_CITXDATA9
TCELL61:IMUX_D2SERDES.Q1EA1_CITXDATA8
TCELL61:IMUX_D3SERDES.Q1EA1_CITXDATA7
TCELL61:IMUX_D4SERDES.Q1EA1_CITXDATA6
TCELL61:IMUX_D5SERDES.Q1EA1_CITXDATA5
TCELL61:OUT_F0SERDES.Q1EA2_KORXMACCLKEN
TCELL61:OUT_F1SERDES.Q1EA3_GOTXMACDATA3
TCELL61:OUT_F2SERDES.Q1EA3_COTXSTATEN
TCELL61:OUT_F3SERDES.Q1EA0_CORXLASTBYTEVLD
TCELL61:OUT_F4SERDES.Q1EA1_KOGBITEN
TCELL61:OUT_F5SERDES.Q1EA3_GOTXMACDATA0
TCELL61:OUT_F6SERDES.Q1EA3_COTXSTATVEC7
TCELL61:OUT_F7SERDES.Q1EA3_COTXSTATVEC5
TCELL61:OUT_Q0SERDES.Q1EA0_GOTXMACDATA0
TCELL61:OUT_Q1SERDES.Q1EA3_GOTXMACERR
TCELL61:OUT_Q2SERDES.Q1EA1_GOTXMACDATA1
TCELL61:OUT_Q3SERDES.Q1EA3_COTXDISCFRM
TCELL61:OUT_Q4SERDES.Q1EA0_GODISCARDFCS
TCELL61:OUT_Q5SERDES.Q1EA1_GODISCARDFCS
TCELL61:OUT_Q6SERDES.Q1S_TISCANO12
TCELL61:OUT_Q7SERDES.Q1EA2_COTXREAD
TCELL62:IMUX_A0SERDES.Q1EA1_CITXPAUSTIM8
TCELL62:IMUX_A1SERDES.Q1EA1_CITXEMPTY
TCELL62:IMUX_A2SERDES.Q1EA1_CITXPAUSTIM11
TCELL62:IMUX_A3SERDES.Q1EA1_CITXPAUSTIM4
TCELL62:IMUX_A4SERDES.Q1EA1_CITXPAUSTIM14
TCELL62:IMUX_A5SERDES.Q1EA2_CITXDATA5
TCELL62:IMUX_B0SERDES.Q1EA1_CITXPAUSTIM3
TCELL62:IMUX_B1SERDES.Q1EA1_CITXPAUSTIM6
TCELL62:IMUX_B2SERDES.Q1EA2_CITXDATA7
TCELL62:IMUX_B3SERDES.Q1EA2_CITXLASTBYTEVLD
TCELL62:IMUX_B4SERDES.Q1EA0_CITXDATAAVAIL
TCELL62:IMUX_B5SERDES.Q1EA1_CITXPAUSTIM9
TCELL62:IMUX_C0SERDES.Q1EA2_CITXDATA14
TCELL62:IMUX_C1SERDES.Q1EA2_CITXEOF
TCELL62:IMUX_C2SERDES.Q1EA2_CITXDATA15
TCELL62:IMUX_C3SERDES.Q1EA2_CITXDATA10
TCELL62:IMUX_C4SERDES.Q1EA2_CITXDATA9
TCELL62:IMUX_C5SERDES.Q1EA1_CITXPAUSTIM5
TCELL62:IMUX_D0SERDES.Q1EA0_CITXDATA2
TCELL62:IMUX_D1SERDES.Q1EA0_CITXDATA1
TCELL62:IMUX_D2SERDES.Q1EA0_CITXDATA0
TCELL62:IMUX_D3SERDES.Q1EA2_CITXDATA13
TCELL62:IMUX_D4SERDES.Q1EA2_CITXDATAAVAIL
TCELL62:IMUX_D5SERDES.Q1EA2_CITXDATA11
TCELL62:OUT_F0SERDES.Q1EA3_COTXSTATVEC6
TCELL62:OUT_F1SERDES.Q1EA3_COTXSTATVEC3
TCELL62:OUT_F2SERDES.Q1EA3_COTXSTATVEC0
TCELL62:OUT_F3SERDES.Q1EA3_GOTXMACDATA6
TCELL62:OUT_F4SERDES.Q1EA0_CORXWRITE
TCELL62:OUT_F5SERDES.Q1EA2_COTXDISCFRM
TCELL62:OUT_F6SERDES.Q1EA3_CORXLASTBYTEVLD
TCELL62:OUT_F7SERDES.Q1EA2_CORXLASTBYTEVLD
TCELL62:OUT_Q0SERDES.Q1EA1_KORXMACCLKEN
TCELL62:OUT_Q1SERDES.Q1EA1_CORXLASTBYTEVLD
TCELL62:OUT_Q2SERDES.Q1EA3_GOTXMACDATA5
TCELL62:OUT_Q3SERDES.Q1EA2_KOGBITEN
TCELL62:OUT_Q4SERDES.Q1EA0_KOGBITEN
TCELL62:OUT_Q5SERDES.Q1EA3_COTXSTATVEC1
TCELL62:OUT_Q6SERDES.Q1EA3_COTXSTATVEC4
TCELL62:OUT_Q7SERDES.Q1EA3_KOGBITEN
TCELL63:IMUX_A0SERDES.Q1EA1_CITXPAUSREQ
TCELL63:IMUX_A1SERDES.Q1EA0_CITXPAUSREQ
TCELL63:IMUX_A2SERDES.Q1EA1_CITXFIFOCTRL
TCELL63:IMUX_A3SERDES.Q1EA0_CITXPAUSTIM13
TCELL63:IMUX_A4SERDES.Q1EA0_CITXPAUSTIM5
TCELL63:IMUX_A5SERDES.Q1EA0_CITXPAUSTIM15
TCELL63:IMUX_B0SERDES.Q1EA1_CITXPAUSTIM13
TCELL63:IMUX_B1SERDES.Q1EA1_CITXPAUSTIM10
TCELL63:IMUX_B2SERDES.Q1EA2_CITXDATA2
TCELL63:IMUX_B3SERDES.Q1EA2_CITXDATA0
TCELL63:IMUX_B4SERDES.Q1EA2_CITXDATA3
TCELL63:IMUX_B5SERDES.Q1EA0_CITXPAUSTIM2
TCELL63:IMUX_C0SERDES.Q1EA1_CITXPAUSTIM15
TCELL63:IMUX_C1SERDES.Q1EA1_CITXPAUSTIM1
TCELL63:IMUX_C2SERDES.Q1EA0_CITXEMPTY
TCELL63:IMUX_C3SERDES.Q1EA1_CITXPAUSTIM0
TCELL63:IMUX_C4SERDES.Q1EA2_CITXDATA1
TCELL63:IMUX_C5SERDES.Q1EA2_CITXDATA4
TCELL63:IMUX_D0SERDES.Q1EA2_CITXDATA6
TCELL63:IMUX_D1SERDES.Q1EA2_CITXDATA8
TCELL63:IMUX_D2SERDES.Q1EA1_CITXDATAAVAIL
TCELL63:IMUX_D3SERDES.Q1EA1_CITXPAUSTIM7
TCELL63:IMUX_D4SERDES.Q1EA1_CITXPAUSTIM2
TCELL63:IMUX_D5SERDES.Q1EA1_CITXPAUSTIM12
TCELL63:OUT_F0SERDES.Q1EA2_COTXSTATEN
TCELL63:OUT_F1SERDES.Q1EA0_CORXEOF
TCELL63:OUT_F2SERDES.Q1EA2_COTXDONE
TCELL63:OUT_F3SERDES.Q1S_TISCANO0
TCELL63:OUT_F4SERDES.Q1EA0_KORXMACCLKEN
TCELL63:OUT_F5SERDES.Q1EA2_COTXSTATVEC3
TCELL63:OUT_F6SERDES.Q1S_TOMBISTDO8
TCELL63:OUT_F7SERDES.Q1EA2_GOTXMACDATA5
TCELL63:OUT_Q0SERDES.Q1EA3_GOTXMACDATA7
TCELL63:OUT_Q1SERDES.Q1EA0_CORXFIFOFULLERROR
TCELL63:OUT_Q2SERDES.Q1EA3_GOTXMACDATA4
TCELL63:OUT_Q3SERDES.Q1S_TISCANO14
TCELL63:OUT_Q4SERDES.Q1EA3_COTXSTATVEC2
TCELL63:OUT_Q5SERDES.Q1EA2_GOTXMACDATA4
TCELL63:OUT_Q6SERDES.Q1EA2_COTXSTATVEC6
TCELL63:OUT_Q7SERDES.Q1EA0_CORXERROR
TCELL64:IMUX_A0SERDES.Q1EA1_GISYNCCRS
TCELL64:IMUX_A1SERDES.Q1EA0_GISYNCCRS
TCELL64:IMUX_A2SERDES.Q1EA3_CITXDATAAVAIL
TCELL64:IMUX_A3SERDES.Q1EA3_CITXEMPTY
TCELL64:IMUX_A4SERDES.Q1EA3_CITXPAUSREQ
TCELL64:IMUX_A5SERDES.Q1EA3_CITXPAUSTIM13
TCELL64:IMUX_B0SERDES.Q1EA0_CITXPAUSTIM0
TCELL64:IMUX_B1SERDES.Q1EA0_CITXPAUSTIM14
TCELL64:IMUX_B2SERDES.Q1EA1_CIRXFULL
TCELL64:IMUX_B3SERDES.Q1EA0_CITXFIFOCTRL
TCELL64:IMUX_B4SERDES.Q1EA0_GISYNCCOL
TCELL64:IMUX_B5SERDES.Q1EA1_GISYNCCOL
TCELL64:IMUX_C0SERDES.Q1EA0_CITXPAUSTIM10
TCELL64:IMUX_C1SERDES.Q1EA0_CITXPAUSTIM4
TCELL64:IMUX_C2SERDES.Q1EA0_CITXPAUSTIM8
TCELL64:IMUX_C3SERDES.Q1EA0_CITXFORCEERR
TCELL64:IMUX_C4SERDES.Q1EA0_CITXPAUSTIM11
TCELL64:IMUX_C5SERDES.Q1EA0_CITXPAUSTIM12
TCELL64:IMUX_D0SERDES.Q1EA1_CITXFORCEERR
TCELL64:IMUX_D1SERDES.Q1EA0_CITXPAUSTIM3
TCELL64:IMUX_D2SERDES.Q1EA0_CITXPAUSTIM6
TCELL64:IMUX_D3SERDES.Q1EA0_CITXPAUSTIM1
TCELL64:IMUX_D4SERDES.Q1EA0_CITXPAUSTIM7
TCELL64:IMUX_D5SERDES.Q1EA0_CITXPAUSTIM9
TCELL64:OUT_F0SERDES.Q1EA2_COTXSTATVEC0
TCELL64:OUT_F1SERDES.Q1EA2_GOTXMACDATA6
TCELL64:OUT_F2SERDES.Q1EA2_COTXSTATVEC7
TCELL64:OUT_F3SERDES.Q1S_TOMBISTDO6
TCELL64:OUT_F4SERDES.Q1S_TOMBISTDO9
TCELL64:OUT_F5SERDES.Q1EA2_COTXSTATVEC5
TCELL64:OUT_Q0SERDES.Q1EA0_CORXSTATEN
TCELL64:OUT_Q1SERDES.Q1S_TOMBISTDO7
TCELL64:OUT_Q2SERDES.Q1EA2_COTXSTATVEC4
TCELL64:OUT_Q3SERDES.Q1EA2_COTXSTATVEC2
TCELL64:OUT_Q4SERDES.Q1EA0_CORXDATA14
TCELL64:OUT_Q5SERDES.Q1EA2_COTXSTATVEC1
TCELL65:IMUX_A2SERDES.Q1EA3_CITXFIFOCTRL
TCELL65:IMUX_A3SERDES.Q1EA2_CITXPAUSREQ
TCELL65:IMUX_A4SERDES.Q1EA1_KITXMACCLKENEXT
TCELL65:IMUX_A5SERDES.Q1EA0_CIRXFULL
TCELL65:IMUX_A6SERDES.Q1EA3_GISYNCCOL
TCELL65:IMUX_A7SERDES.Q1EA3_GISYNCCRS
TCELL65:IMUX_B2SERDES.Q1EA3_CITXPAUSTIM15
TCELL65:IMUX_B3SERDES.Q1EA3_CITXPAUSTIM11
TCELL65:IMUX_B4SERDES.Q1EA3_CITXPAUSTIM1
TCELL65:IMUX_B5SERDES.Q1EA3_CITXPAUSTIM3
TCELL65:IMUX_B6SERDES.Q1EA3_CITXPAUSTIM0
TCELL65:IMUX_B7SERDES.Q1EA2_CITXEMPTY
TCELL65:IMUX_C2SERDES.Q1EA3_CITXPAUSTIM9
TCELL65:IMUX_C3SERDES.Q1EA3_CITXPAUSTIM7
TCELL65:IMUX_C4SERDES.Q1EA3_CITXPAUSTIM2
TCELL65:IMUX_C5SERDES.Q1EA3_CITXPAUSTIM8
TCELL65:IMUX_C6SERDES.Q1EA3_CITXPAUSTIM14
TCELL65:IMUX_C7SERDES.Q1EA3_CITXFORCEERR
TCELL65:IMUX_D2SERDES.Q1EA3_CITXPAUSTIM6
TCELL65:IMUX_D3SERDES.Q1EA3_CITXPAUSTIM12
TCELL65:IMUX_D4SERDES.Q1EA3_CITXPAUSTIM5
TCELL65:IMUX_D5SERDES.Q1EA3_CITXPAUSTIM4
TCELL65:IMUX_D6SERDES.Q1EA3_CITXPAUSTIM10
TCELL65:IMUX_D7SERDES.Q1EA0_KITXMACCLKENEXT
TCELL65:OUT_F0SERDES.Q1EA0_CORXDATA9
TCELL65:OUT_F1SERDES.Q1EA0_CORXDATA8
TCELL65:OUT_F2SERDES.Q1S_TOMBISTDO12
TCELL65:OUT_F3SERDES.Q1S_TOMBISTDO13
TCELL65:OUT_F4SERDES.Q1EA0_CORXDATA3
TCELL65:OUT_F5SERDES.Q1EA0_CORXDATA0
TCELL65:OUT_F6SERDES.Q1EA0_CORXDATA2
TCELL65:OUT_F7SERDES.Q1EA0_CORXDATA4
TCELL65:OUT_Q0SERDES.Q1EA0_CORXDATA13
TCELL65:OUT_Q1SERDES.Q1EA0_CORXDATA10
TCELL65:OUT_Q2SERDES.Q1EA0_CORXDATA15
TCELL65:OUT_Q3SERDES.Q1EA0_CORXDATA11
TCELL65:OUT_Q4SERDES.Q1S_TOMBISTDO11
TCELL65:OUT_Q5SERDES.Q1S_TOMBISTDO10
TCELL65:OUT_Q6SERDES.Q1S_TOMBISTDO5
TCELL65:OUT_Q7SERDES.Q1EA0_CORXDATA12
TCELL66:IMUX_A2SERDES.Q1EA0_CIRXIGNOREPKT
TCELL66:IMUX_A3SERDES.Q1EA0_GISYNCRXD0
TCELL66:IMUX_A4SERDES.Q1EA0_GINONPADRXDV
TCELL66:IMUX_A5SERDES.Q1EA3_KIRXMACCLKENEXT
TCELL66:IMUX_A6SERDES.Q1EA0_GISYNCRXDV
TCELL66:IMUX_A7SERDES.Q1EA2_CITXPAUSTIM0
TCELL66:IMUX_B2SERDES.Q1EA3_KITXGMIILPBK
TCELL66:IMUX_B3SERDES.Q1EA2_CITXFORCEERR
TCELL66:IMUX_B4SERDES.Q1EA0_GISYNCRXER
TCELL66:IMUX_B5SERDES.Q1EA0_GISYNCRXD3
TCELL66:IMUX_B6SERDES.Q1EA0_GISYNCRXD7
TCELL66:IMUX_B7SERDES.Q1EA2_CITXFIFOCTRL
TCELL66:IMUX_C2SERDES.Q1EA0_GISYNCRXD4
TCELL66:IMUX_C3SERDES.Q1EA0_GIIPGSHRINK
TCELL66:IMUX_C4SERDES.Q1EA0_GISYNCNIBDRIB
TCELL66:IMUX_C5SERDES.Q1EA0_GISYNCRXD6
TCELL66:IMUX_C6SERDES.Q1EA0_GISYNCRXD2
TCELL66:IMUX_C7SERDES.Q1EA0_GISYNCRXD5
TCELL66:IMUX_D2SERDES.Q1EA3_KITXMACCLKENEXT
TCELL66:IMUX_D3SERDES.Q1EA1_KITXGMIILPBK
TCELL66:IMUX_D4SERDES.Q1EA0_KITXGMIILPBK
TCELL66:IMUX_D5SERDES.Q1EA0_KIRXMACCLKENEXT
TCELL66:IMUX_D6SERDES.Q1EA1_KIRXMACCLKENEXT
TCELL66:IMUX_D7SERDES.Q1EA0_GISYNCRXD1
TCELL66:OUT_F0SERDES.Q1EA0_CORXSTATVEC2
TCELL66:OUT_F1SERDES.Q1EA0_CORXSTATVEC3
TCELL66:OUT_F2SERDES.Q1EA0_CORXSTATVEC4
TCELL66:OUT_F3SERDES.Q1EA0_CORXSTATVEC5
TCELL66:OUT_F4SERDES.Q1EA0_CORXSTATVEC6
TCELL66:OUT_F5SERDES.Q1S_TOMBISTDO16
TCELL66:OUT_F6SERDES.Q1EA0_CORXSTATVEC7
TCELL66:OUT_F7SERDES.Q1S_TOMBISTDO3
TCELL66:OUT_Q0SERDES.Q1S_TOMBISTDO4
TCELL66:OUT_Q1SERDES.Q1EA0_CORXDATA6
TCELL66:OUT_Q2SERDES.Q1EA0_CORXDATA1
TCELL66:OUT_Q3SERDES.Q1S_TOMBISTDO14
TCELL66:OUT_Q4SERDES.Q1EA0_CORXDATA7
TCELL66:OUT_Q5SERDES.Q1S_TOMBISTDO15
TCELL66:OUT_Q6SERDES.Q1EA0_CORXDATA5
TCELL66:OUT_Q7SERDES.Q1EA0_CORXSTATVEC1
TCELL67:IMUX_A2SERDES.Q1EA2_KITXGMIILPBK
TCELL67:IMUX_A3SERDES.Q1EA3_GISYNCRXD3
TCELL67:IMUX_A4SERDES.Q1EA3_GISYNCRXD5
TCELL67:IMUX_A5SERDES.Q1EA2_KIRXMACCLKENEXT
TCELL67:IMUX_A6SERDES.Q1EA3_CIRXFULL
TCELL67:IMUX_A7SERDES.Q1EA3_GISYNCRXD7
TCELL67:IMUX_B2SERDES.Q1EA2_CITXPAUSTIM6
TCELL67:IMUX_B3SERDES.Q1EA2_CITXPAUSTIM4
TCELL67:IMUX_B4SERDES.Q1EA2_CITXPAUSTIM14
TCELL67:IMUX_B5SERDES.Q1EA2_GISYNCCRS
TCELL67:IMUX_B6SERDES.Q1EA2_GISYNCCOL
TCELL67:IMUX_B7SERDES.Q1EA2_KITXMACCLKENEXT
TCELL67:IMUX_C2SERDES.Q1EA2_CITXPAUSTIM12
TCELL67:IMUX_C3SERDES.Q1EA2_CITXPAUSTIM9
TCELL67:IMUX_C4SERDES.Q1EA2_CITXPAUSTIM10
TCELL67:IMUX_C5SERDES.Q1EA2_CITXPAUSTIM5
TCELL67:IMUX_C6SERDES.Q1EA2_CITXPAUSTIM2
TCELL67:IMUX_C7SERDES.Q1EA2_CITXPAUSTIM13
TCELL67:IMUX_D2SERDES.Q1EA2_CITXPAUSTIM1
TCELL67:IMUX_D3SERDES.Q1EA2_CITXPAUSTIM8
TCELL67:IMUX_D4SERDES.Q1EA2_CITXPAUSTIM3
TCELL67:IMUX_D5SERDES.Q1EA2_CITXPAUSTIM15
TCELL67:IMUX_D6SERDES.Q1EA2_CITXPAUSTIM7
TCELL67:IMUX_D7SERDES.Q1EA2_CITXPAUSTIM11
TCELL67:OUT_F0SERDES.Q1S_TOMBISTDO22
TCELL67:OUT_F1SERDES.Q1S_TOMBISTDO21
TCELL67:OUT_F2SERDES.Q1S_TOMBISTDO23
TCELL67:OUT_F3SERDES.Q1EA3_CORXWRITE
TCELL67:OUT_F4SERDES.Q1EA3_CORXFIFOFULLERROR
TCELL67:OUT_F5SERDES.Q1S_TOMBISTDO24
TCELL67:OUT_F6SERDES.Q1EA3_CORXEOF
TCELL67:OUT_F7SERDES.Q1EA3_CORXSTATEN
TCELL67:OUT_Q0SERDES.Q1S_TOMBISTDO17
TCELL67:OUT_Q1SERDES.Q1S_TOMBISTDO18
TCELL67:OUT_Q2SERDES.Q1S_TISCANO5
TCELL67:OUT_Q3SERDES.Q1EA2_GODISCARDFCS
TCELL67:OUT_Q4SERDES.Q1S_TOMBISTDO20
TCELL67:OUT_Q5SERDES.Q1S_TOMBISTDO19
TCELL67:OUT_Q6SERDES.Q1S_TOMBISTDO2
TCELL67:OUT_Q7SERDES.Q1EA0_CORXSTATVEC0
TCELL68:IMUX_A2SERDES.Q1EA2_GISYNCRXD4
TCELL68:IMUX_A3SERDES.Q1EA2_GISYNCRXD2
TCELL68:IMUX_A4SERDES.Q1EA2_GISYNCRXD3
TCELL68:IMUX_A5SERDES.Q1EA1_GIIPGSHRINK
TCELL68:IMUX_A6SERDES.Q1EA1_GISYNCRXDV
TCELL68:IMUX_A7SERDES.Q1S_TIMBISTSDI6
TCELL68:IMUX_B2SERDES.Q1EA1_GISYNCRXD3
TCELL68:IMUX_B3SERDES.Q1EA1_GISYNCNIBDRIB
TCELL68:IMUX_B4SERDES.Q1EA2_GIIPGSHRINK
TCELL68:IMUX_B5SERDES.Q1EA2_GISYNCRXD6
TCELL68:IMUX_B6SERDES.Q1EA2_GISYNCRXD7
TCELL68:IMUX_B7SERDES.Q1EA2_GISYNCRXD5
TCELL68:IMUX_C2SERDES.Q1EA3_CIRXIGNOREPKT
TCELL68:IMUX_C3SERDES.Q1EA3_GISYNCRXER
TCELL68:IMUX_C4SERDES.Q1EA3_GISYNCRXDV
TCELL68:IMUX_C5SERDES.Q1EA3_GISYNCNIBDRIB
TCELL68:IMUX_C6SERDES.Q1EA3_GINONPADRXDV
TCELL68:IMUX_C7SERDES.Q1EA3_GISYNCRXD0
TCELL68:IMUX_D2SERDES.Q1EA3_GISYNCRXD6
TCELL68:IMUX_D3SERDES.Q1EA3_GISYNCRXD4
TCELL68:IMUX_D4SERDES.Q1EA3_GISYNCRXD2
TCELL68:IMUX_D5SERDES.Q1EA3_GIIPGSHRINK
TCELL68:IMUX_D6SERDES.Q1EA3_GISYNCRXD1
TCELL68:IMUX_D7SERDES.Q1EA2_CIRXFULL
TCELL68:OUT_F0SERDES.Q1EA3_CORXDATA0
TCELL68:OUT_F1SERDES.Q1EA3_CORXSTATVEC3
TCELL68:OUT_F2SERDES.Q1EA3_CORXDATA2
TCELL68:OUT_F3SERDES.Q1S_TOMBISTDO1
TCELL68:OUT_F4SERDES.Q1EA3_CORXDATA6
TCELL68:OUT_F5SERDES.Q1EA3_CORXDATA15
TCELL68:OUT_F6SERDES.Q1EA3_CORXDATA7
TCELL68:OUT_F7SERDES.Q1EA3_CORXDATA9
TCELL68:OUT_Q0SERDES.Q1EA3_CORXERROR
TCELL68:OUT_Q1SERDES.Q1EA3_CORXDATA1
TCELL68:OUT_Q2SERDES.Q1EA3_CORXDATA4
TCELL68:OUT_Q3SERDES.Q1EA1_CORXSTATEN
TCELL68:OUT_Q4SERDES.Q1S_TOMBISTDO25
TCELL68:OUT_Q5SERDES.Q1EA3_CORXSTATVEC7
TCELL68:OUT_Q6SERDES.Q1EA3_CORXDATA3
TCELL68:OUT_Q7SERDES.Q1EA3_CORXDATA5
TCELL69:IMUX_A2SERDES.Q1EA1_GISYNCRXER
TCELL69:IMUX_A3SERDES.Q1S_TIMBISTSDI2
TCELL69:IMUX_A4SERDES.Q1EA2_GISYNCRXDV
TCELL69:IMUX_A5SERDES.Q1S_TIMBISTSDI1
TCELL69:IMUX_A6SERDES.Q1S_TIMBISTSDI8
TCELL69:IMUX_A7SERDES.Q1S_TIMBISTSDI9
TCELL69:IMUX_B2SERDES.Q1S_TIMBISTSDI4
TCELL69:IMUX_B3SERDES.Q1EA1_GISYNCRXD6
TCELL69:IMUX_B4SERDES.Q1EA1_GISYNCRXD5
TCELL69:IMUX_B5SERDES.Q1S_TIMBISTSDI3
TCELL69:IMUX_B6SERDES.Q1EA2_GISYNCRXER
TCELL69:IMUX_B7SERDES.Q1EA2_GISYNCRXD1
TCELL69:IMUX_C2SERDES.Q1EA1_GISYNCRXD7
TCELL69:IMUX_C3SERDES.Q1S_TIMBISTSDI7
TCELL69:IMUX_C4SERDES.Q1EA1_GISYNCRXD1
TCELL69:IMUX_C5SERDES.Q1EA2_GISYNCNIBDRIB
TCELL69:IMUX_C6SERDES.Q1EA1_GISYNCRXD4
TCELL69:IMUX_C7SERDES.Q1EA2_GISYNCRXD0
TCELL69:IMUX_D2SERDES.Q1S_TIMBISTSDI5
TCELL69:IMUX_D3SERDES.Q1EA1_GISYNCRXD0
TCELL69:IMUX_D4SERDES.Q1EA1_GISYNCRXD2
TCELL69:IMUX_D5SERDES.Q1EA1_GINONPADRXDV
TCELL69:IMUX_D6SERDES.Q1EA2_CIRXIGNOREPKT
TCELL69:IMUX_D7SERDES.Q1EA1_CIRXIGNOREPKT
TCELL69:OUT_F0SERDES.Q1EA3_CORXDATA8
TCELL69:OUT_F1SERDES.Q1EA1_CORXSTATVEC4
TCELL69:OUT_F2SERDES.Q1EA1_CORXSTATVEC3
TCELL69:OUT_F3SERDES.Q1EA3_CORXDATA11
TCELL69:OUT_F4SERDES.Q1EA3_CORXSTATVEC1
TCELL69:OUT_F5SERDES.Q1EA3_CORXDATA13
TCELL69:OUT_F6SERDES.Q1EA3_CORXSTATVEC5
TCELL69:OUT_F7SERDES.Q1EA3_CORXSTATVEC0
TCELL69:OUT_Q0SERDES.Q1EA2_CORXSTATEN
TCELL69:OUT_Q1SERDES.Q1EA3_CORXDATA12
TCELL69:OUT_Q2SERDES.Q1S_TISCANO11
TCELL69:OUT_Q3SERDES.Q1EA3_CORXSTATVEC6
TCELL69:OUT_Q4SERDES.Q1EA3_CORXSTATVEC4
TCELL69:OUT_Q5SERDES.Q1EA3_CORXDATA14
TCELL69:OUT_Q6SERDES.Q1EA3_CORXSTATVEC2
TCELL69:OUT_Q7SERDES.Q1EA3_CORXDATA10
TCELL70:IMUX_A2SERDES.Q1S_TIMBISTRA5
TCELL70:IMUX_A3SERDES.Q1S_TIMBISTSDI12
TCELL70:IMUX_A4SERDES.Q1S_TIMBISTWA6
TCELL70:IMUX_A5SERDES.Q1S_TIMBISTRA4
TCELL70:IMUX_B2SERDES.Q1S_TIMBISTWA5
TCELL70:IMUX_B3SERDES.Q1S_TIMBISTWA3
TCELL70:IMUX_B4SERDES.Q1S_TIMBISTRA6
TCELL70:IMUX_B5SERDES.Q1S_TIMBISTSDI11
TCELL70:IMUX_C2SERDES.Q1S_TIMBISTWA1
TCELL70:IMUX_C3SERDES.Q1S_TIMBISTWA2
TCELL70:IMUX_C4SERDES.Q1S_TIMBISTWA0
TCELL70:IMUX_C5SERDES.Q1S_TIMBISTRA7
TCELL70:IMUX_D2SERDES.Q1EA2_GINONPADRXDV
TCELL70:IMUX_D3SERDES.Q1S_TIMBISTSDI0
TCELL70:IMUX_D4SERDES.Q1S_TIMBISTWA4
TCELL70:IMUX_D5SERDES.Q1S_TIMBISTSDI10
TCELL70:OUT_F0SERDES.Q1EA1_CORXSTATVEC1
TCELL70:OUT_F1SERDES.Q1EA2_CORXSTATVEC1
TCELL70:OUT_F2SERDES.Q1EA2_CORXEOF
TCELL70:OUT_F3SERDES.Q1EA2_CORXERROR
TCELL70:OUT_F4SERDES.Q1EA2_CORXFIFOFULLERROR
TCELL70:OUT_F5SERDES.Q1EA1_CORXSTATVEC0
TCELL70:OUT_Q0SERDES.Q1EA1_CORXSTATVEC5
TCELL70:OUT_Q1SERDES.Q1EA2_CORXSTATVEC0
TCELL70:OUT_Q2SERDES.Q1EA2_CORXSTATVEC7
TCELL70:OUT_Q3SERDES.Q1EA1_CORXSTATVEC2
TCELL70:OUT_Q4SERDES.Q1S_TISCANO10
TCELL70:OUT_Q5SERDES.Q1EA2_CORXWRITE
TCELL71:IMUX_A2SERDES.Q1S_TIMBISTSDI33
TCELL71:IMUX_A3SERDES.Q1S_TIMBISTSDI17
TCELL71:IMUX_A4SERDES.Q1S_TIMBISTSDI32
TCELL71:IMUX_A5SERDES.Q1S_BAUDSUPPORT4
TCELL71:IMUX_A6SERDES.Q1S_TIMBISTSDI31
TCELL71:IMUX_A7SERDES.Q1S_TIMBISTSDI30
TCELL71:IMUX_B2SERDES.Q1S_TIMBISTRE
TCELL71:IMUX_B3SERDES.Q1S_TIMBISTWE
TCELL71:IMUX_B4SERDES.Q1S_TIMBISTSDI16
TCELL71:IMUX_B5SERDES.Q1S_TIMBISTMODE
TCELL71:IMUX_B6SERDES.Q1S_TIMBISTSDI35
TCELL71:IMUX_B7SERDES.Q1S_TIMBISTSDI34
TCELL71:IMUX_C2SERDES.Q1S_TIMBISTBANKSEL2
TCELL71:IMUX_C3SERDES.Q1S_TIMBISTRA0
TCELL71:IMUX_C4SERDES.Q1S_TIMBISTRA1
TCELL71:IMUX_C5SERDES.Q1S_TIMBISTBANKSEL1
TCELL71:IMUX_C6SERDES.Q1S_TIMBISTSDI14
TCELL71:IMUX_C7SERDES.Q1S_TIMBISTSDI15
TCELL71:IMUX_D2SERDES.Q1S_TIMBISTWA7
TCELL71:IMUX_D3SERDES.Q1S_TIMBISTRA3
TCELL71:IMUX_D4SERDES.Q1S_TIMBISTRA2
TCELL71:IMUX_D5SERDES.Q1S_TIMBISTSDI13
TCELL71:IMUX_D6SERDES.Q1S_TIMBISTBANKSEL0
TCELL71:IMUX_D7SERDES.Q1S_TIMBISTBANKSEL3
TCELL71:OUT_F0SERDES.Q1EA1_CORXFIFOFULLERROR
TCELL71:OUT_F1SERDES.Q1EA1_CORXDATA2
TCELL71:OUT_F2SERDES.Q1EA2_CORXDATA11
TCELL71:OUT_F3SERDES.Q1EA2_CORXSTATVEC2
TCELL71:OUT_F4SERDES.Q1EA2_CORXDATA3
TCELL71:OUT_F5SERDES.Q1EA1_CORXWRITE
TCELL71:OUT_F6SERDES.Q1EA1_CORXDATA4
TCELL71:OUT_F7SERDES.Q1EA1_CORXDATA7
TCELL71:OUT_Q0SERDES.Q1EA1_CORXSTATVEC7
TCELL71:OUT_Q1SERDES.Q1EA2_CORXSTATVEC6
TCELL71:OUT_Q2SERDES.Q1EA1_CORXSTATVEC6
TCELL71:OUT_Q3SERDES.Q1EA2_CORXSTATVEC5
TCELL71:OUT_Q4SERDES.Q1EA2_CORXDATA10
TCELL71:OUT_Q5SERDES.Q1EA1_CORXDATA3
TCELL71:OUT_Q6SERDES.Q1EA1_CORXERROR
TCELL71:OUT_Q7SERDES.Q1EA1_CORXDATA8
TCELL72:IMUX_A2SERDES.Q1S_TPORTTDI18
TCELL72:IMUX_A3SERDES.Q1S_TPORTTDI3
TCELL72:IMUX_A4SERDES.Q1S_TPORTTDI10
TCELL72:IMUX_A5SERDES.Q1S_TPORTTDI12
TCELL72:IMUX_A6SERDES.Q1S_TPORTTDI2
TCELL72:IMUX_A7SERDES.Q1S_TPORTTDI4
TCELL72:IMUX_B2SERDES.Q1S_RECOVERRSTN
TCELL72:IMUX_B3SERDES.Q1S_RXPFORCERETRYN
TCELL72:IMUX_B4SERDES.Q1S_TPORTTDI19
TCELL72:IMUX_B5SERDES.Q1S_TPORTTDI50
TCELL72:IMUX_B6SERDES.Q1S_TPORTTDI20
TCELL72:IMUX_B7SERDES.Q1S_MGTA18
TCELL72:IMUX_C2SERDES.Q1S_TIMBISTSDI22
TCELL72:IMUX_C3SERDES.Q1S_TIMBISTSDI23
TCELL72:IMUX_C4SERDES.Q1S_TIMBISTSDI24
TCELL72:IMUX_C5SERDES.Q1S_TIMBISTSDI27
TCELL72:IMUX_C6SERDES.Q1S_TIMBISTSDI25
TCELL72:IMUX_C7SERDES.Q1S_TIMBISTSDI26
TCELL72:IMUX_D2SERDES.Q1S_TIMBISTSDI18
TCELL72:IMUX_D3SERDES.Q1S_TIMBISTSDI19
TCELL72:IMUX_D4SERDES.Q1S_TIMBISTSDI29
TCELL72:IMUX_D5SERDES.Q1S_TIMBISTSDI20
TCELL72:IMUX_D6SERDES.Q1S_TIMBISTSDI21
TCELL72:IMUX_D7SERDES.Q1S_TIMBISTSDI28
TCELL72:OUT_F0SERDES.Q1EA2_CORXDATA5
TCELL72:OUT_F1SERDES.Q1EA2_CORXSTATVEC3
TCELL72:OUT_F2SERDES.Q1EA1_CORXDATA1
TCELL72:OUT_F3SERDES.Q1EA2_CORXDATA2
TCELL72:OUT_F4SERDES.Q1S_TOMBISTDO26
TCELL72:OUT_F5SERDES.Q1EA2_CORXDATA4
TCELL72:OUT_F6SERDES.Q1EA2_CORXDATA1
TCELL72:OUT_F7SERDES.Q1EA1_CORXDATA12
TCELL72:OUT_Q0SERDES.Q1EA1_CORXDATA6
TCELL72:OUT_Q1SERDES.Q1EA1_CORXDATA9
TCELL72:OUT_Q2SERDES.Q1EA1_CORXEOF
TCELL72:OUT_Q3SERDES.Q1EA1_CORXDATA0
TCELL72:OUT_Q4SERDES.Q1EA2_CORXDATA6
TCELL72:OUT_Q5SERDES.Q1EA2_CORXSTATVEC4
TCELL72:OUT_Q6SERDES.Q1EA1_CORXDATA5
TCELL72:OUT_Q7SERDES.Q1EA2_CORXDATA0
TCELL73:IMUX_A4SERDES.Q1S_TPORTTDI42
TCELL73:IMUX_A5SERDES.Q1S_TPORTTDI36
TCELL73:IMUX_A6SERDES.Q1S_TPORTTDI26
TCELL73:IMUX_A7SERDES.Q1S_TPORTTDI58
TCELL73:IMUX_B4SERDES.Q1S_TPORTTDI24
TCELL73:IMUX_B5SERDES.Q1S_TPORTTDI59
TCELL73:IMUX_B6SERDES.Q1S_TPORTTDI35
TCELL73:IMUX_B7SERDES.Q1S_TPORTTDI27
TCELL73:IMUX_C4SERDES.Q1S_TPORTTDI52
TCELL73:IMUX_C5SERDES.Q1S_TPORTTDI28
TCELL73:IMUX_C6SERDES.Q1S_TPORTTDI43
TCELL73:IMUX_C7SERDES.Q1S_TPORTTDI49
TCELL73:IMUX_D4SERDES.Q1S_TPORTTDI0
TCELL73:IMUX_D5SERDES.Q1S_TPORTTDI11
TCELL73:IMUX_D6SERDES.Q1S_TPORTTDI16
TCELL73:IMUX_D7SERDES.Q1S_TPORTTDI48
TCELL73:OUT_F0SERDES.Q1EA2_CORXDATA12
TCELL73:OUT_F1SERDES.Q1EA2_CORXDATA8
TCELL73:OUT_F4SERDES.Q1EA1_CORXDATA13
TCELL73:OUT_F5SERDES.Q1EA2_CORXDATA15
TCELL73:OUT_F6SERDES.Q1EA2_CORXDATA14
TCELL73:OUT_F7SERDES.Q1EA1_CORXDATA14
TCELL73:OUT_Q0SERDES.Q1EA2_CORXDATA7
TCELL73:OUT_Q1SERDES.Q1EA1_CORXDATA15
TCELL73:OUT_Q4SERDES.Q1S_TOMBISTDO35
TCELL73:OUT_Q5SERDES.Q1EA1_CORXDATA11
TCELL73:OUT_Q6SERDES.Q1EA2_CORXDATA9
TCELL73:OUT_Q7SERDES.Q1EA1_CORXDATA10
TCELL74:IMUX_A2SERDES.Q1S_TPORTTDI45
TCELL74:IMUX_A3SERDES.Q1S_TPORTTDI21
TCELL74:IMUX_A4SERDES.Q1S_TPORTTDI30
TCELL74:IMUX_A5SERDES.Q1S_TPORTTDI5
TCELL74:IMUX_A6SERDES.Q1S_TPORTTDI33
TCELL74:IMUX_A7SERDES.Q1S_TPORTTDI23
TCELL74:IMUX_B2SERDES.Q1S_TPORTTDI46
TCELL74:IMUX_B3SERDES.Q1S_TPORTTDI47
TCELL74:IMUX_B4SERDES.Q1S_TPORTTDI17
TCELL74:IMUX_B5SERDES.Q1S_TPORTTDI1
TCELL74:IMUX_B6SERDES.Q1S_TPORTTDI25
TCELL74:IMUX_B7SERDES.Q1S_TPORTTDI62
TCELL74:IMUX_C2SERDES.Q1S_TPORTTDI55
TCELL74:IMUX_C3SERDES.Q1S_TPORTTDI60
TCELL74:IMUX_C4SERDES.Q1S_TPORTTDI29
TCELL74:IMUX_C5SERDES.Q1S_TPORTTDI54
TCELL74:IMUX_C6SERDES.Q1S_TPORTTDI61
TCELL74:IMUX_C7SERDES.Q1S_TPORTTDI57
TCELL74:IMUX_D2SERDES.Q1S_TPORTTDI51
TCELL74:IMUX_D3SERDES.Q1S_TPORTTDI40
TCELL74:IMUX_D4SERDES.Q1S_TPORTTDI56
TCELL74:IMUX_D5SERDES.Q1S_TPORTTDI8
TCELL74:IMUX_D6SERDES.Q1S_TPORTTDI34
TCELL74:IMUX_D7SERDES.Q1S_TPORTTDI44
TCELL74:IMUX_CLK0_DELAYSERDES.Q1EA0_KITXMACCLK
TCELL74:OUT_F0SERDES.Q1S_TOMBISTDO29
TCELL74:OUT_F1SERDES.Q1S_TISCANO15
TCELL74:OUT_F2SERDES.Q1S_TISCANO19
TCELL74:OUT_F3SERDES.Q1S_TOMBISTDO0
TCELL74:OUT_F4SERDES.Q1S_STATUS11
TCELL74:OUT_F5SERDES.Q1S_OLLMMGTDI16
TCELL74:OUT_F6SERDES.Q1S_OLLMMGTDI29
TCELL74:OUT_F7SERDES.Q1S_OLLMMGTDI21
TCELL74:OUT_Q0SERDES.Q1EA2_CORXDATA13
TCELL74:OUT_Q1SERDES.Q1S_TOMBISTDO27
TCELL74:OUT_Q2SERDES.Q1S_TOMBISTDO34
TCELL74:OUT_Q3SERDES.Q1S_TOMBISTDO28
TCELL74:OUT_Q4SERDES.Q1S_TOMBISTDO33
TCELL74:OUT_Q5SERDES.Q1S_TOMBISTDO32
TCELL74:OUT_Q6SERDES.Q1S_TOMBISTDO30
TCELL74:OUT_Q7SERDES.Q1S_TOMBISTDO31
TCELL75:IMUX_A2SERDES.Q1S_TPORTCHARISK1
TCELL75:IMUX_A3SERDES.Q1S_TPORTCHARISK2
TCELL75:IMUX_A4SERDES.Q1S_MGTA15
TCELL75:IMUX_A5SERDES.Q1S_MGTA12
TCELL75:IMUX_A6SERDES.Q1S_MGTA10
TCELL75:IMUX_A7SERDES.Q1S_MGTA8
TCELL75:IMUX_B2SERDES.Q1S_TPORTTDI31
TCELL75:IMUX_B3SERDES.Q1S_MGTA14
TCELL75:IMUX_B4SERDES.Q1S_MGTA17
TCELL75:IMUX_B5SERDES.Q1S_TPORTTDI53
TCELL75:IMUX_B6SERDES.Q1S_TPORTCHARISK4
TCELL75:IMUX_B7SERDES.Q1S_TPORTTDI15
TCELL75:IMUX_C2SERDES.Q1S_TPORTTDI13
TCELL75:IMUX_C3SERDES.Q1S_TPORTTDI63
TCELL75:IMUX_C4SERDES.Q1S_TPORTTDI39
TCELL75:IMUX_C5SERDES.Q1S_TPORTTDI22
TCELL75:IMUX_C6SERDES.Q1S_TPORTTDI38
TCELL75:IMUX_C7SERDES.Q1S_TPORTTDI9
TCELL75:IMUX_D2SERDES.Q1S_TPORTTDI14
TCELL75:IMUX_D3SERDES.Q1S_TPORTTDI6
TCELL75:IMUX_D4SERDES.Q1S_TPORTTDI37
TCELL75:IMUX_D5SERDES.Q1S_TPORTTDI41
TCELL75:IMUX_D6SERDES.Q1S_TPORTTDI32
TCELL75:IMUX_D7SERDES.Q1S_TPORTTDI7
TCELL75:IMUX_CLK0_DELAYSERDES.Q1EA3_KITXMACCLK
TCELL75:IMUX_CLK1_DELAYSERDES.Q1EA0_KIRXTXFECLK
TCELL75:OUT_F0SERDES.Q1S_OLLMMGTDI23
TCELL75:OUT_F1SERDES.Q1S_OLLMMGTINTN
TCELL75:OUT_F2SERDES.Q1S_OLLMMGTDI7
TCELL75:OUT_F3SERDES.Q1S_OLLMMGTDI15
TCELL75:OUT_F4SERDES.Q1S_OLLMMGTDI30
TCELL75:OUT_F5SERDES.Q1S_OLLMMGTDI25
TCELL75:OUT_F6SERDES.Q1S_OLLMMGTDI24
TCELL75:OUT_F7SERDES.Q1S_OLLMMGTDI20
TCELL75:OUT_Q0SERDES.Q1S_OLLMMGTDI13
TCELL75:OUT_Q1SERDES.Q1S_OLLMMGTDI5
TCELL75:OUT_Q2SERDES.Q1S_OLLMMGTDI3
TCELL75:OUT_Q3SERDES.Q1S_OLLMMGTDI12
TCELL75:OUT_Q4SERDES.Q1S_OLLMMGTDI0
TCELL75:OUT_Q5SERDES.Q1S_STATUS10
TCELL75:OUT_Q6SERDES.Q1S_OLLMMGTDI22
TCELL75:OUT_Q7SERDES.Q1S_OLLMMGTDI6
TCELL76:IMUX_A2SERDES.Q1S_MGTA21
TCELL76:IMUX_A3SERDES.Q1S_MGTA3
TCELL76:IMUX_A4SERDES.Q1S_MGTA0
TCELL76:IMUX_A5SERDES.Q1S_MGTA2
TCELL76:IMUX_B2SERDES.Q1S_TPORTCHARISK5
TCELL76:IMUX_B3SERDES.Q1S_TPORTCHARISK7
TCELL76:IMUX_B4SERDES.Q1S_MGTA1
TCELL76:IMUX_B5SERDES.Q1S_MGTWRN3
TCELL76:IMUX_C2SERDES.Q1S_TPORTCHARISK0
TCELL76:IMUX_C3SERDES.Q1S_TPORTCHARISK6
TCELL76:IMUX_C4SERDES.Q1S_MGTA9
TCELL76:IMUX_C5SERDES.Q1S_TPORTCHARISK3
TCELL76:IMUX_D2SERDES.Q1S_MGTA11
TCELL76:IMUX_D3SERDES.Q1S_MGTA16
TCELL76:IMUX_D4SERDES.Q1S_MGTA13
TCELL76:IMUX_D5SERDES.Q1S_MGTA7
TCELL76:IMUX_CLK1_DELAYSERDES.Q1EA3_KIRXTXFECLK
TCELL76:IMUX_CE1SERDES.Q1S_TISCANI2
TCELL76:IMUX_CE2SERDES.Q1S_TISCANI0
TCELL76:OUT_F0SERDES.Q1S_OLLMMGTDI10
TCELL76:OUT_F1SERDES.Q1S_OLLMMGTDI27
TCELL76:OUT_F2SERDES.Q1S_OLLMMGTDI31
TCELL76:OUT_F3SERDES.Q1S_OLLMMGTDI4
TCELL76:OUT_F4SERDES.Q1S_TXLANESILENCECH2
TCELL76:OUT_F5SERDES.Q1S_STATUS17
TCELL76:OUT_Q0SERDES.Q1S_OLLMMGTDI19
TCELL76:OUT_Q1SERDES.Q1S_OLLMMGTDI18
TCELL76:OUT_Q2SERDES.Q1S_OLLMMGTDI2
TCELL76:OUT_Q3SERDES.Q1S_OLLMMGTDI14
TCELL76:OUT_Q4SERDES.Q1S_TXLANESILENCECH1
TCELL76:OUT_Q5SERDES.Q1S_TXLANESILENCECH3
TCELL77:IMUX_A2SERDES.Q1S_BAUDSUPPORT0
TCELL77:IMUX_A3SERDES.Q1S_MGTDI7
TCELL77:IMUX_A4SERDES.Q1S_PHYUSTB
TCELL77:IMUX_A5SERDES.Q1S_RCVCLKSEL1
TCELL77:IMUX_A6SERDES.Q1S_MGTDI15
TCELL77:IMUX_A7SERDES.Q1S_MGTDI27
TCELL77:IMUX_B2SERDES.Q1S_MGTDI24
TCELL77:IMUX_B3SERDES.Q1S_MGTDI25
TCELL77:IMUX_B4SERDES.Q1S_MGTDI29
TCELL77:IMUX_B5SERDES.Q1S_MGTDI28
TCELL77:IMUX_B6SERDES.Q1S_MGTDI31
TCELL77:IMUX_B7SERDES.Q1S_MGTDI30
TCELL77:IMUX_C2SERDES.Q1S_RCVCLKSEL3
TCELL77:IMUX_C3SERDES.Q1S_PHYTINITN
TCELL77:IMUX_C4SERDES.Q1S_MGTWRN1
TCELL77:IMUX_C5SERDES.Q1S_MGTWRN0
TCELL77:IMUX_C6SERDES.Q1S_MGTRDN
TCELL77:IMUX_C7SERDES.Q1S_PHYRINITN
TCELL77:IMUX_D2SERDES.Q1S_MGTA6
TCELL77:IMUX_D3SERDES.Q1S_MGTA20
TCELL77:IMUX_D4SERDES.Q1S_MGTA5
TCELL77:IMUX_D5SERDES.Q1S_MGTA4
TCELL77:IMUX_D6SERDES.Q1S_MGTWRN2
TCELL77:IMUX_D7SERDES.Q1S_MGTA19
TCELL77:IMUX_LSR0SERDES.Q1S_TISCANRSTN
TCELL77:IMUX_LSR1SERDES.Q1S_TISCANMODE
TCELL77:IMUX_CLK0_DELAYSERDES.Q1EA1_KIRXTXFECLK
TCELL77:IMUX_CLK1_DELAYSERDES.Q1EA2_KIRXTXFECLK
TCELL77:IMUX_CE0SERDES.Q1S_TISCANI9
TCELL77:IMUX_CE1SERDES.Q1S_TISCANI10
TCELL77:IMUX_CE2SERDES.Q1S_TISCANI13
TCELL77:IMUX_CE3SERDES.Q1S_TISCANI6
TCELL77:OUT_F0SERDES.Q1S_STATUS20
TCELL77:OUT_F1SERDES.Q1S_TISCANO4
TCELL77:OUT_F2SERDES.Q1S_TISCANO17
TCELL77:OUT_F3SERDES.Q1S_OLLMMGTDI9
TCELL77:OUT_F4SERDES.Q1S_LNKMCERXREQN
TCELL77:OUT_F5SERDES.Q1S_OLLMMGTDI8
TCELL77:OUT_F6SERDES.Q1S_RESPTIMEOUT0
TCELL77:OUT_F7SERDES.Q1S_PHYEMEVENTREQN
TCELL77:OUT_Q0SERDES.Q1S_OLLMMGTDI26
TCELL77:OUT_Q1SERDES.Q1S_OLLMMGTDI28
TCELL77:OUT_Q2SERDES.Q1S_OLLMMGTDI1
TCELL77:OUT_Q3SERDES.Q1S_TISCANO3
TCELL77:OUT_Q4SERDES.Q1S_TXLANESILENCECH0
TCELL77:OUT_Q5SERDES.Q1S_OLLMMGTDI17
TCELL77:OUT_Q6SERDES.Q1S_OLLMMGTRDYN
TCELL77:OUT_Q7SERDES.Q1S_OLLMMGTDI11
TCELL78:IMUX_A2SERDES.Q1S_MGTDI14
TCELL78:IMUX_A3SERDES.Q1S_OLLMEFPTR10
TCELL78:IMUX_A4SERDES.Q1S_ENABLETXFLOWCONTROLN
TCELL78:IMUX_A5SERDES.Q1S_OLLMEFPTR15
TCELL78:IMUX_A6SERDES.Q1S_MGTDI12
TCELL78:IMUX_A7SERDES.Q1S_MGTDI18
TCELL78:IMUX_B2SERDES.Q1S_MGTDI22
TCELL78:IMUX_B3SERDES.Q1S_MGTDI20
TCELL78:IMUX_B4SERDES.Q1S_MGTDI19
TCELL78:IMUX_B5SERDES.Q1S_MGTDI11
TCELL78:IMUX_B6SERDES.Q1S_OLLMEFPTR7
TCELL78:IMUX_B7SERDES.Q1S_OLLMEFPTR6
TCELL78:IMUX_C2SERDES.Q1S_MGTDI10
TCELL78:IMUX_C3SERDES.Q1S_MGTDI6
TCELL78:IMUX_C4SERDES.Q1S_MGTDI4
TCELL78:IMUX_C5SERDES.Q1S_MGTDI3
TCELL78:IMUX_C6SERDES.Q1S_MGTDI21
TCELL78:IMUX_C7SERDES.Q1S_MGTDI23
TCELL78:IMUX_D2SERDES.Q1S_BAUDSUPPORT2
TCELL78:IMUX_D3SERDES.Q1S_BAUDSUPPORT1
TCELL78:IMUX_D4SERDES.Q1S_MGTDI26
TCELL78:IMUX_D5SERDES.Q1S_BAUDSUPPORT3
TCELL78:IMUX_D6SERDES.Q1S_MGTDI5
TCELL78:IMUX_D7SERDES.Q1S_OLLMEFPTR0
TCELL78:IMUX_LSR0SERDES.Q1EA3_KIRSTN
TCELL78:IMUX_LSR1SERDES.Q1EA0_KIRSTN
TCELL78:IMUX_CLK0_DELAYSERDES.Q1EA2_KITXMACCLK
TCELL78:IMUX_CLK1_DELAYSERDES.Q1EA1_KITXMACCLK
TCELL78:IMUX_CE0SERDES.Q1S_TISCANI12
TCELL78:IMUX_CE1SERDES.Q1S_TISCANI11
TCELL78:IMUX_CE2SERDES.Q1S_TISCANI3
TCELL78:IMUX_CE3SERDES.Q1S_TISCANI21
TCELL78:OUT_F0SERDES.Q1S_RESPTIMEOUT23
TCELL78:OUT_F1SERDES.Q1S_RESPTIMEOUT22
TCELL78:OUT_F2SERDES.Q1S_PORTNERRORDETECT27
TCELL78:OUT_F3SERDES.Q1S_RESPTIMEOUT17
TCELL78:OUT_F4SERDES.Q1S_PORTNERRORDETECT11
TCELL78:OUT_F5SERDES.Q1S_RESPTIMEOUT2
TCELL78:OUT_F6SERDES.Q1S_RESPTIMEOUT21
TCELL78:OUT_F7SERDES.Q1S_PORTNERRORDETECT9
TCELL78:OUT_Q0SERDES.Q1S_PORTNERRORDETECT28
TCELL78:OUT_Q1SERDES.Q1S_PORTNERRORDETECT10
TCELL78:OUT_Q2SERDES.Q1S_PORTNERRORDETECT30
TCELL78:OUT_Q3SERDES.Q1S_PORTNERRORDETECT29
TCELL78:OUT_Q4SERDES.Q1S_PORTNERRORDETECT26
TCELL78:OUT_Q5SERDES.Q1S_OUTPUTUNRECOVERREVENTREQN
TCELL78:OUT_Q6SERDES.Q1S_PORTNERRORDETECT31
TCELL78:OUT_Q7SERDES.Q1S_RESPTIMEOUT1
TCELL79:IMUX_A2SERDES.Q1S_MGTDI9
TCELL79:IMUX_A3SERDES.Q1S_OUTPUTUNRECOVERREVENTACKN
TCELL79:IMUX_A4SERDES.Q1S_LNKMCERXACKN
TCELL79:IMUX_A5SERDES.Q1S_PHYMSTB
TCELL79:IMUX_A6SERDES.Q1S_PHYEMEVENTACKN
TCELL79:IMUX_A7SERDES.Q1S_LOOPBACK0
TCELL79:IMUX_B2SERDES.Q1S_OLLMEFPTR12
TCELL79:IMUX_B3SERDES.Q1S_MGTDI2
TCELL79:IMUX_B4SERDES.Q1S_MGTDI13
TCELL79:IMUX_B5SERDES.Q1S_MGTDI0
TCELL79:IMUX_B6SERDES.Q1S_MGTDI1
TCELL79:IMUX_B7SERDES.Q1S_MGTDI8
TCELL79:IMUX_C2SERDES.Q1S_OLLMEFPTR4
TCELL79:IMUX_C3SERDES.Q1S_OLLMEFPTR14
TCELL79:IMUX_C4SERDES.Q1S_OLLMEFPTR13
TCELL79:IMUX_C5SERDES.Q1S_OLLMEFPTR3
TCELL79:IMUX_C6SERDES.Q1S_OLLMEFPTR9
TCELL79:IMUX_C7SERDES.Q1S_OLLMEFPTR11
TCELL79:IMUX_D2SERDES.Q1S_OLLMEFPTR5
TCELL79:IMUX_D3SERDES.Q1S_OLLMEFPTR8
TCELL79:IMUX_D4SERDES.Q1S_MGTDI17
TCELL79:IMUX_D5SERDES.Q1S_OLLMEFPTR2
TCELL79:IMUX_D6SERDES.Q1S_MGTDI16
TCELL79:IMUX_D7SERDES.Q1S_OLLMEFPTR1
TCELL79:IMUX_LSR0SERDES.Q1EA2_KIRSTN
TCELL79:IMUX_LSR1SERDES.Q1EA1_KIRSTN
TCELL79:IMUX_CLK0_DELAYSERDES.Q1EA1_KIRXMACCLK
TCELL79:IMUX_CLK1_DELAYSERDES.Q1EA0_KIRXMACCLK
TCELL79:IMUX_CE0SERDES.Q1S_TISCANI23
TCELL79:IMUX_CE1SERDES.Q1S_TISCANI25
TCELL79:IMUX_CE2SERDES.Q1S_TISCANI28
TCELL79:IMUX_CE3SERDES.Q1S_TISCANI29
TCELL79:OUT_F0SERDES.Q1S_RESPTIMEOUT6
TCELL79:OUT_F1SERDES.Q1S_RESPTIMEOUT5
TCELL79:OUT_F2SERDES.Q1S_STATUS16
TCELL79:OUT_F3SERDES.Q1S_RESPTIMEOUT16
TCELL79:OUT_F4SERDES.Q1S_PORTNERRORDETECT13
TCELL79:OUT_F5SERDES.Q1S_RESPTIMEOUT4
TCELL79:OUT_F6SERDES.Q1S_RESPTIMEOUT8
TCELL79:OUT_F7SERDES.Q1S_PORTNERRORDETECT14
TCELL79:OUT_Q0SERDES.Q1S_PORTNERRORDETECT12
TCELL79:OUT_Q1SERDES.Q1S_RESPTIMEOUT20
TCELL79:OUT_Q2SERDES.Q1S_RESPTIMEOUT19
TCELL79:OUT_Q3SERDES.Q1S_RESPTIMEOUT18
TCELL79:OUT_Q4SERDES.Q1S_SYSRSTON
TCELL79:OUT_Q5SERDES.Q1S_RESPTIMEOUT3
TCELL79:OUT_Q6SERDES.Q1S_RESPTIMEOUT7
TCELL79:OUT_Q7SERDES.Q1S_PORTNERRORDETECT8
TCELL80:IMUX_A2SERDES.Q1S_WM11
TCELL80:IMUX_A3SERDES.Q1S_WM03
TCELL80:IMUX_A4SERDES.Q1S_WM22
TCELL80:IMUX_A5SERDES.Q1S_WM21
TCELL80:IMUX_A6SERDES.Q1S_GEAR
TCELL80:IMUX_A7SERDES.Q1S_TLNKD63
TCELL80:IMUX_B2SERDES.Q1S_WM13
TCELL80:IMUX_B3SERDES.Q1S_WM10
TCELL80:IMUX_B4SERDES.Q1S_WM00
TCELL80:IMUX_B5SERDES.Q1S_WM01
TCELL80:IMUX_B6SERDES.Q1S_WM12
TCELL80:IMUX_B7SERDES.Q1S_WM23
TCELL80:IMUX_C2SERDES.Q1S_TXSYNCCTRL0
TCELL80:IMUX_C3SERDES.Q1S_RCVCLKSEL0
TCELL80:IMUX_C4SERDES.Q1S_RCVCLKSEL2
TCELL80:IMUX_C5SERDES.Q1S_TPORTENABLEN
TCELL80:IMUX_C6SERDES.Q1S_WM20
TCELL80:IMUX_C7SERDES.Q1S_WM02
TCELL80:IMUX_D2SERDES.Q1S_RXSYNCCTRL1
TCELL80:IMUX_D3SERDES.Q1S_LOOPBACK1
TCELL80:IMUX_D4SERDES.Q1S_LOOPBACK2
TCELL80:IMUX_D5SERDES.Q1S_RXSYNCCTRL0
TCELL80:IMUX_D6SERDES.Q1S_LNKMCETXREQN
TCELL80:IMUX_D7SERDES.Q1S_TXSYNCCTRL1
TCELL80:IMUX_LSR0SERDES.Q1S_TISCANENA
TCELL80:IMUX_LSR1SERDES.Q1S_PHYRSTN
TCELL80:IMUX_CLK0_DELAYSERDES.Q1EA2_KIRXMACCLK
TCELL80:IMUX_CLK1_DELAYSERDES.Q1EA3_KIRXMACCLK
TCELL80:IMUX_CE0SERDES.Q1S_TISCANI27
TCELL80:IMUX_CE1SERDES.Q1S_TISCANI26
TCELL80:IMUX_CE2SERDES.Q1S_TISCANI24
TCELL80:IMUX_CE3SERDES.Q1S_TISCANI22
TCELL80:OUT_F0SERDES.Q1S_STATUS14
TCELL80:OUT_F1SERDES.Q1S_FLOWFIFOACKON3
TCELL80:OUT_F2SERDES.Q1S_TISCANO6
TCELL80:OUT_F3SERDES.Q1S_BUFFDEQACKADVPTRN
TCELL80:OUT_F4SERDES.Q1S_FLOWFIFOACKON1
TCELL80:OUT_F5SERDES.Q1S_LNKMCETXACKN
TCELL80:OUT_F6SERDES.Q1S_TISCANO7
TCELL80:OUT_F7SERDES.Q1S_FLOWFIFOACKON2
TCELL80:OUT_Q0SERDES.Q1S_RESPTIMEOUT15
TCELL80:OUT_Q1SERDES.Q1S_LNKTOUTPUTPORTENABLE
TCELL80:OUT_Q2SERDES.Q1S_RESPTIMEOUT9
TCELL80:OUT_Q3SERDES.Q1S_RESPTIMEOUT14
TCELL80:OUT_Q4SERDES.Q1S_RESPTIMEOUT10
TCELL80:OUT_Q5SERDES.Q1S_RESPTIMEOUT13
TCELL80:OUT_Q6SERDES.Q1S_RESPTIMEOUT11
TCELL80:OUT_Q7SERDES.Q1S_RESPTIMEOUT12
TCELL81:IMUX_A2SERDES.Q1S_TLNKD44
TCELL81:IMUX_A3SERDES.Q1S_TLNKD43
TCELL81:IMUX_A4SERDES.Q1S_TLNKD42
TCELL81:IMUX_A5SERDES.Q1S_TLNKD41
TCELL81:IMUX_A6SERDES.Q1S_TLNKD40
TCELL81:IMUX_A7SERDES.Q1S_TLNKD39
TCELL81:IMUX_B2SERDES.Q1S_TLNKD50
TCELL81:IMUX_B3SERDES.Q1S_TLNKD49
TCELL81:IMUX_B4SERDES.Q1S_TLNKD48
TCELL81:IMUX_B5SERDES.Q1S_TLNKD47
TCELL81:IMUX_B6SERDES.Q1S_TLNKD46
TCELL81:IMUX_B7SERDES.Q1S_TLNKD45
TCELL81:IMUX_C2SERDES.Q1S_TLNKD56
TCELL81:IMUX_C3SERDES.Q1S_TLNKD55
TCELL81:IMUX_C4SERDES.Q1S_TLNKD54
TCELL81:IMUX_C5SERDES.Q1S_TLNKD53
TCELL81:IMUX_C6SERDES.Q1S_TLNKD52
TCELL81:IMUX_C7SERDES.Q1S_TLNKD51
TCELL81:IMUX_D2SERDES.Q1S_TLNKD62
TCELL81:IMUX_D3SERDES.Q1S_TLNKD61
TCELL81:IMUX_D4SERDES.Q1S_TLNKD60
TCELL81:IMUX_D5SERDES.Q1S_TLNKD59
TCELL81:IMUX_D6SERDES.Q1S_TLNKD58
TCELL81:IMUX_D7SERDES.Q1S_TLNKD57
TCELL81:IMUX_LSR0SERDES.Q1S_SOFTRSTN
TCELL81:IMUX_LSR1SERDES.Q1S_SYSRSTIN
TCELL81:IMUX_CLK0_DELAYSERDES.Q1S_PHYCLK
TCELL81:IMUX_CLK1_DELAYSERDES.Q1S_TISCANCLK
TCELL81:IMUX_CE0SERDES.Q1S_TISCANI20
TCELL81:IMUX_CE1SERDES.Q1S_TISCANI14
TCELL81:IMUX_CE2SERDES.Q1S_TISCANI17
TCELL81:IMUX_CE3SERDES.Q1S_TISCANI5
TCELL81:OUT_F0SERDES.Q1S_TISCANO21
TCELL81:OUT_F1SERDES.Q1S_TISCANO22
TCELL81:OUT_F2SERDES.Q1S_STATUS6
TCELL81:OUT_F3SERDES.Q1S_STATUS8
TCELL81:OUT_F4SERDES.Q1S_STATUS3
TCELL81:OUT_F5SERDES.Q1S_STATUS12
TCELL81:OUT_F6SERDES.Q1S_TISCANO23
TCELL81:OUT_F7SERDES.Q1S_TXFLOWCTRLSTATE0
TCELL81:OUT_Q0SERDES.Q1S_TXENQUEUEFLOWN2
TCELL81:OUT_Q1SERDES.Q1S_TXENQUEUEFLOWN3
TCELL81:OUT_Q2SERDES.Q1S_TISCANO8
TCELL81:OUT_Q3SERDES.Q1S_FLOWFIFOACKON0
TCELL81:OUT_Q4SERDES.Q1S_TXENQUEUEFLOWN1
TCELL81:OUT_Q5SERDES.Q1S_MGTCLKRSTN
TCELL81:OUT_Q6SERDES.Q1S_TXENQUEUEFLOWN0
TCELL81:OUT_Q7SERDES.Q1S_TISCANO20
TCELL82:IMUX_A2SERDES.Q1S_TLNKD17
TCELL82:IMUX_A3SERDES.Q1S_TLNKD6
TCELL82:IMUX_A4SERDES.Q1S_TLNKD32
TCELL82:IMUX_A5SERDES.Q1S_TLNKD30
TCELL82:IMUX_A6SERDES.Q1S_TLNKD21
TCELL82:IMUX_A7SERDES.Q1S_RLNKDSTRDYN
TCELL82:IMUX_B2SERDES.Q1S_TLNKD19
TCELL82:IMUX_B3SERDES.Q1S_TLNKD31
TCELL82:IMUX_B4SERDES.Q1S_TLNKD34
TCELL82:IMUX_B5SERDES.Q1S_TLNKD26
TCELL82:IMUX_B6SERDES.Q1S_TLNKD33
TCELL82:IMUX_B7SERDES.Q1S_TLNKD29
TCELL82:IMUX_C2SERDES.Q1S_TLNKD24
TCELL82:IMUX_C3SERDES.Q1S_TLNKD23
TCELL82:IMUX_C4SERDES.Q1S_TLNKD28
TCELL82:IMUX_C5SERDES.Q1S_TLNKD22
TCELL82:IMUX_C6SERDES.Q1S_TLNKD14
TCELL82:IMUX_C7SERDES.Q1S_TLNKREM2
TCELL82:IMUX_D2SERDES.Q1S_TLNKD38
TCELL82:IMUX_D3SERDES.Q1S_TLNKD37
TCELL82:IMUX_D4SERDES.Q1S_TLNKD36
TCELL82:IMUX_D5SERDES.Q1S_TLNKD35
TCELL82:IMUX_D6SERDES.Q1S_TLNKD27
TCELL82:IMUX_D7SERDES.Q1S_TLNKD25
TCELL82:IMUX_LSR0SERDES.Q1S_MGTRSTN
TCELL82:IMUX_LSR1SERDES.Q1S_RIORSTN
TCELL82:IMUX_CLK0_DELAYSERDES.Q1S_RIOCLK
TCELL82:IMUX_CLK1_DELAYSERDES.Q1S_MGTCLK
TCELL82:IMUX_CE0SERDES.Q1S_TISCANI4
TCELL82:IMUX_CE1SERDES.Q1S_TISCANI8
TCELL82:IMUX_CE2SERDES.Q1S_TISCANI18
TCELL82:IMUX_CE3SERDES.Q1S_TISCANI7
TCELL82:OUT_F0SERDES.Q1S_STATUS5
TCELL82:OUT_F1SERDES.Q1S_STATUS0
TCELL82:OUT_F2SERDES.Q1S_STATUS7
TCELL82:OUT_F3SERDES.Q1S_STATUS19
TCELL82:OUT_F4SERDES.Q1S_TXFLOWCTRLSTATE3
TCELL82:OUT_F5SERDES.Q1S_TISCANO27
TCELL82:OUT_F6SERDES.Q1S_RXINITN
TCELL82:OUT_F7SERDES.Q1S_TXINITN
TCELL82:OUT_Q0SERDES.Q1S_STATUS1
TCELL82:OUT_Q1SERDES.Q1S_TXFLOWCTRLSTATE1
TCELL82:OUT_Q2SERDES.Q1S_STATUS4
TCELL82:OUT_Q3SERDES.Q1S_TISCANO24
TCELL82:OUT_Q4SERDES.Q1S_STATUS2
TCELL82:OUT_Q5SERDES.Q1S_TISCANO25
TCELL82:OUT_Q6SERDES.Q1S_TISCANO26
TCELL82:OUT_Q7SERDES.Q1S_STATUS18
TCELL83:IMUX_A2SERDES.Q1S_TLNKREM1
TCELL83:IMUX_A3SERDES.Q1S_TLNKREM0
TCELL83:IMUX_A4SERDES.Q1S_TLNKD0
TCELL83:IMUX_A5SERDES.Q1S_TLNKD3
TCELL83:IMUX_A6SERDES.Q1S_TLNKD4
TCELL83:IMUX_A7SERDES.Q1S_TLNKD11
TCELL83:IMUX_B2SERDES.Q1S_TLNKD10
TCELL83:IMUX_B3SERDES.Q1S_TLNKD9
TCELL83:IMUX_B4SERDES.Q1S_TLNKD8
TCELL83:IMUX_B5SERDES.Q1S_TLNKD7
TCELL83:IMUX_B6SERDES.Q1S_TLNKSRCRDYN
TCELL83:IMUX_B7SERDES.Q1S_TLNKD2
TCELL83:IMUX_C2SERDES.Q1S_TLNKD20
TCELL83:IMUX_C3SERDES.Q1S_TLNKD18
TCELL83:IMUX_C4SERDES.Q1S_TLNKSRCDSCN
TCELL83:IMUX_C5SERDES.Q1S_TLNKD12
TCELL83:IMUX_C6SERDES.Q1S_TLNKD16
TCELL83:IMUX_C7SERDES.Q1S_TLNKD1
TCELL83:IMUX_D2SERDES.Q1S_TLNKD15
TCELL83:IMUX_D3SERDES.Q1S_TLNKD13
TCELL83:IMUX_D4SERDES.Q1S_TLNKD5
TCELL83:IMUX_D5SERDES.Q1S_TLNKEOFN
TCELL83:IMUX_D6SERDES.Q1S_RLNKDSTDSCN
TCELL83:IMUX_D7SERDES.Q1S_TLNKSOFN
TCELL83:IMUX_LSR0SERDES.Q1S_LNKDIV2RSTN
TCELL83:IMUX_LSR1SERDES.Q1S_LNKRSTN
TCELL83:IMUX_CLK0_DELAYSERDES.Q1S_LNKCLKDIV2
TCELL83:IMUX_CLK1_DELAYSERDES.Q1S_LNKCLK
TCELL83:IMUX_CE0SERDES.Q1S_TISCANI19
TCELL83:IMUX_CE1SERDES.Q1S_TISCANI16
TCELL83:IMUX_CE2SERDES.Q1S_TISCANI1
TCELL83:IMUX_CE3SERDES.Q1S_TISCANI15
TCELL83:OUT_F0SERDES.Q1S_STATUS21
TCELL83:OUT_F1SERDES.Q1S_PORTNERRORDETECT23
TCELL83:OUT_F2SERDES.Q1S_PORTNERRORDETECT24
TCELL83:OUT_F3SERDES.Q1S_PORTNERRORDETECT25
TCELL83:OUT_F4SERDES.Q1S_PORTNERRORDETECT20
TCELL83:OUT_F5SERDES.Q1S_PORTNERRORDETECT21
TCELL83:OUT_F6SERDES.Q1S_PORTNERRORDETECT18
TCELL83:OUT_F7SERDES.Q1S_PORTNERRORDETECT19
TCELL83:OUT_Q0SERDES.Q1S_TXFLOWCTRLSTATE2
TCELL83:OUT_Q1SERDES.Q1S_TISCANO28
TCELL83:OUT_Q2SERDES.Q1S_MASTERENABLE
TCELL83:OUT_Q3SERDES.Q1S_TISCANO18
TCELL83:OUT_Q4SERDES.Q1S_STATUS13
TCELL83:OUT_Q5SERDES.Q1S_TXFLOWCTRLSTATE4
TCELL83:OUT_Q6SERDES.Q1S_TISCANO29
TCELL83:OUT_Q7SERDES.Q1S_PORTDISABLE
TCELL86:OUT_F0SERDES.Q1S_PORTNERRORDETECT3
TCELL86:OUT_F1SERDES.Q1S_PORTNERRORDETECT2
TCELL86:OUT_F2SERDES.Q1S_PORTNERRORDETECT1
TCELL86:OUT_F3SERDES.Q1S_PORTNERRORDETECT0
TCELL86:OUT_F4SERDES.Q1S_DECRBUFCNTVECTOR9
TCELL86:OUT_F5SERDES.Q1S_DECRBUFCNTVECTOR8
TCELL86:OUT_F6SERDES.Q1S_DECRBUFCNTVECTOR7
TCELL86:OUT_F7SERDES.Q1S_DECRBUFCNTVECTOR5
TCELL86:OUT_Q0SERDES.Q1S_PORTNERRORDETECT17
TCELL86:OUT_Q1SERDES.Q1S_PORTNERRORDETECT15
TCELL86:OUT_Q2SERDES.Q1S_PORTNERRORDETECT7
TCELL86:OUT_Q3SERDES.Q1S_PORTNERRORDETECT5
TCELL86:OUT_Q4SERDES.Q1S_PORTNERRORDETECT16
TCELL86:OUT_Q5SERDES.Q1S_PORTNERRORDETECT22
TCELL86:OUT_Q6SERDES.Q1S_PORTNERRORDETECT4
TCELL86:OUT_Q7SERDES.Q1S_PORTNERRORDETECT6
TCELL87:OUT_F0SERDES.Q1S_RLNKBEATS4
TCELL87:OUT_F1SERDES.Q1S_RLNKBEATS3
TCELL87:OUT_F2SERDES.Q1S_RLNKBEATS2
TCELL87:OUT_F3SERDES.Q1S_RLNKBEATS1
TCELL87:OUT_F4SERDES.Q1S_RLNKBEATS0
TCELL87:OUT_F5SERDES.Q1S_RLNKD63
TCELL87:OUT_F6SERDES.Q1S_RLNKD62
TCELL87:OUT_F7SERDES.Q1S_RLNKD61
TCELL87:OUT_Q0SERDES.Q1S_DECRBUFCNTVECTOR4
TCELL87:OUT_Q1SERDES.Q1S_DECRBUFCNTVECTOR3
TCELL87:OUT_Q2SERDES.Q1S_DECRBUFCNTVECTOR2
TCELL87:OUT_Q3SERDES.Q1S_DECRBUFCNTVECTOR1
TCELL87:OUT_Q4SERDES.Q1S_DECRBUFCNTVECTOR0
TCELL87:OUT_Q5SERDES.Q1S_RLNKBEATS7
TCELL87:OUT_Q6SERDES.Q1S_RLNKBEATS6
TCELL87:OUT_Q7SERDES.Q1S_RLNKBEATS5
TCELL88:OUT_F0SERDES.Q1S_RLNKD53
TCELL88:OUT_F1SERDES.Q1S_RLNKD52
TCELL88:OUT_F2SERDES.Q1S_RLNKD51
TCELL88:OUT_F3SERDES.Q1S_RLNKD50
TCELL88:OUT_F4SERDES.Q1S_RLNKD49
TCELL88:OUT_F5SERDES.Q1S_RLNKD48
TCELL88:OUT_F6SERDES.Q1S_RLNKD47
TCELL88:OUT_F7SERDES.Q1S_RLNKD46
TCELL88:OUT_Q0SERDES.Q1S_RLNKD60
TCELL88:OUT_Q1SERDES.Q1S_RLNKD59
TCELL88:OUT_Q2SERDES.Q1S_RLNKD58
TCELL88:OUT_Q3SERDES.Q1S_RLNKD57
TCELL88:OUT_Q4SERDES.Q1S_RLNKD56
TCELL88:OUT_Q5SERDES.Q1S_RLNKD55
TCELL88:OUT_Q6SERDES.Q1S_TISCANO16
TCELL88:OUT_Q7SERDES.Q1S_RLNKD54
TCELL89:OUT_F0SERDES.Q1S_RLNKD37
TCELL89:OUT_F1SERDES.Q1S_RLNKD36
TCELL89:OUT_F2SERDES.Q1S_RLNKD35
TCELL89:OUT_F3SERDES.Q1S_RLNKD34
TCELL89:OUT_F4SERDES.Q1S_RLNKD33
TCELL89:OUT_F5SERDES.Q1S_RLNKD32
TCELL89:OUT_F6SERDES.Q1S_RLNKD31
TCELL89:OUT_F7SERDES.Q1S_LNKCLKDIV2RSTN
TCELL89:OUT_Q0SERDES.Q1S_RLNKD45
TCELL89:OUT_Q1SERDES.Q1S_RLNKD44
TCELL89:OUT_Q2SERDES.Q1S_RLNKD43
TCELL89:OUT_Q3SERDES.Q1S_RLNKD42
TCELL89:OUT_Q4SERDES.Q1S_RLNKD41
TCELL89:OUT_Q5SERDES.Q1S_RLNKD40
TCELL89:OUT_Q6SERDES.Q1S_RLNKD39
TCELL89:OUT_Q7SERDES.Q1S_RLNKD38
TCELL90:OUT_F0SERDES.Q1S_RLNKD23
TCELL90:OUT_F1SERDES.Q1S_RLNKD22
TCELL90:OUT_F2SERDES.Q1S_RLNKD21
TCELL90:OUT_F3SERDES.Q1S_RLNKD20
TCELL90:OUT_F4SERDES.Q1S_RLNKD19
TCELL90:OUT_F5SERDES.Q1S_RLNKD18
TCELL90:OUT_F6SERDES.Q1S_RLNKD17
TCELL90:OUT_F7SERDES.Q1S_RLNKD16
TCELL90:OUT_Q0SERDES.Q1S_STATUS9
TCELL90:OUT_Q1SERDES.Q1S_RLNKD30
TCELL90:OUT_Q2SERDES.Q1S_RLNKD29
TCELL90:OUT_Q3SERDES.Q1S_RLNKD28
TCELL90:OUT_Q4SERDES.Q1S_RLNKD27
TCELL90:OUT_Q5SERDES.Q1S_RLNKD26
TCELL90:OUT_Q6SERDES.Q1S_RLNKD25
TCELL90:OUT_Q7SERDES.Q1S_RLNKD24
TCELL91:OUT_F2SERDES.Q1S_RLNKD10
TCELL91:OUT_F3SERDES.Q1S_RLNKD9
TCELL91:OUT_F4SERDES.Q1S_RLNKD8
TCELL91:OUT_F5SERDES.Q1S_RLNKD7
TCELL91:OUT_F6SERDES.Q1S_RLNKD6
TCELL91:OUT_F7SERDES.Q1S_RLNKD5
TCELL91:OUT_Q2SERDES.Q1S_RLNKD15
TCELL91:OUT_Q3SERDES.Q1S_LNKCLKRSTN
TCELL91:OUT_Q4SERDES.Q1S_RLNKD14
TCELL91:OUT_Q5SERDES.Q1S_RLNKD13
TCELL91:OUT_Q6SERDES.Q1S_RLNKD12
TCELL91:OUT_Q7SERDES.Q1S_RLNKD11
TCELL92:OUT_F0SERDES.Q1S_STATUS15
TCELL92:OUT_F1SERDES.Q1S_TISCANO1
TCELL92:OUT_F2SERDES.Q1S_TLNKDSTRDYN
TCELL92:OUT_F3SERDES.Q1S_RLNKEOFN
TCELL92:OUT_F4SERDES.Q1S_RLNKSOFN
TCELL92:OUT_F5SERDES.Q1S_RLNKSRCRDYN
TCELL92:OUT_F6SERDES.Q1S_TISCANO2
TCELL92:OUT_F7SERDES.Q1S_DECRBUFCNTVECTOR6
TCELL92:OUT_Q0SERDES.Q1S_RLNKD4
TCELL92:OUT_Q1SERDES.Q1S_RLNKD3
TCELL92:OUT_Q2SERDES.Q1S_RLNKD2
TCELL92:OUT_Q3SERDES.Q1S_RLNKD1
TCELL92:OUT_Q4SERDES.Q1S_RLNKD0
TCELL92:OUT_Q5SERDES.Q1S_RLNKREM2
TCELL92:OUT_Q6SERDES.Q1S_RLNKREM1
TCELL92:OUT_Q7SERDES.Q1S_RLNKREM0
TCELL93:IMUX_CLK1_DELAYSERDES.Q1_FITXTESTCLK
TCELL93:OUT_F0SERDES.Q1CH0_FDRX8
TCELL93:OUT_F1SERDES.Q1CH0_FDRX9
TCELL93:OUT_F2SERDES.Q1CH0_FDRX10
TCELL93:OUT_F3SERDES.Q1CH0_FDRX11
TCELL93:OUT_F4SERDES.Q1CH0_FDRX12
TCELL93:OUT_F5SERDES.Q1CH0_FDRX13
TCELL93:OUT_F6SERDES.Q1CH0_FDRX14
TCELL93:OUT_F7SERDES.Q1CH0_FDRX15
TCELL93:OUT_Q0SERDES.Q1CH0_FDRX0
TCELL93:OUT_Q1SERDES.Q1CH0_FDRX1
TCELL93:OUT_Q2SERDES.Q1CH0_FDRX2
TCELL93:OUT_Q3SERDES.Q1CH0_FDRX3
TCELL93:OUT_Q4SERDES.Q1CH0_FDRX4
TCELL93:OUT_Q5SERDES.Q1CH0_FDRX5
TCELL93:OUT_Q6SERDES.Q1CH0_FDRX6
TCELL93:OUT_Q7SERDES.Q1CH0_FDRX7
TCELL94:IMUX_A2SERDES.Q1CH1_FCPLLLOL
TCELL94:IMUX_A3SERDES.Q1CH0_FCPLLLOL
TCELL94:IMUX_A4SERDES.Q1CH3_FCCDRFORCEDLOCK
TCELL94:IMUX_A5SERDES.Q1CH2_FCCDRFORCEDLOCK
TCELL94:IMUX_A6SERDES.Q1CH1_FCCDRFORCEDLOCK
TCELL94:IMUX_A7SERDES.Q1CH0_FCCDRFORCEDLOCK
TCELL94:IMUX_B2SERDES.Q1CH3_FDLDRTX
TCELL94:IMUX_B3SERDES.Q1CH2_FDLDRTX
TCELL94:IMUX_B4SERDES.Q1CH1_FDLDRTX
TCELL94:IMUX_B5SERDES.Q1CH0_FDLDRTX
TCELL94:IMUX_B6SERDES.Q1CH3_FCPLLLOL
TCELL94:IMUX_B7SERDES.Q1CH2_FCPLLLOL
TCELL94:IMUX_C2SERDES.Q1CH1_FCTXMARGIN0
TCELL94:IMUX_C3SERDES.Q1CH1_FCTXMARGIN1
TCELL94:IMUX_C4SERDES.Q1CH1_FCTXMARGIN2
TCELL94:IMUX_C5SERDES.Q1CH0_FCTXMARGIN0
TCELL94:IMUX_C6SERDES.Q1CH0_FCTXMARGIN1
TCELL94:IMUX_C7SERDES.Q1CH0_FCTXMARGIN2
TCELL94:IMUX_D2SERDES.Q1CH3_FCTXMARGIN0
TCELL94:IMUX_D3SERDES.Q1CH3_FCTXMARGIN1
TCELL94:IMUX_D4SERDES.Q1CH3_FCTXMARGIN2
TCELL94:IMUX_D5SERDES.Q1CH2_FCTXMARGIN0
TCELL94:IMUX_D6SERDES.Q1CH2_FCTXMARGIN1
TCELL94:IMUX_D7SERDES.Q1CH2_FCTXMARGIN2
TCELL94:IMUX_LSR0SERDES.Q1CH1_FCTRST
TCELL94:IMUX_LSR1SERDES.Q1CH0_FCTRST
TCELL94:IMUX_CLK0_DELAYSERDES.Q1_FISYNCCLK
TCELL94:IMUX_CLK1_DELAYSERDES.Q1_FIRXTESTCLK
TCELL94:OUT_F0SERDES.Q1CH0_FDRX24
TCELL94:OUT_F1SERDES.Q1CH0_FDRX25
TCELL94:OUT_F2SERDES.Q1CH0_FDRX26
TCELL94:OUT_F3SERDES.Q1CH0_FDRX27
TCELL94:OUT_F4SERDES.Q1CH0_FDRX28
TCELL94:OUT_F5SERDES.Q1CH0_FDRX29
TCELL94:OUT_F6SERDES.Q1CH0_FDRX30
TCELL94:OUT_F7SERDES.Q1CH0_FDRX31
TCELL94:OUT_Q0SERDES.Q1CH0_FDRX16
TCELL94:OUT_Q1SERDES.Q1CH0_FDRX17
TCELL94:OUT_Q2SERDES.Q1CH0_FDRX18
TCELL94:OUT_Q3SERDES.Q1CH0_FDRX19
TCELL94:OUT_Q4SERDES.Q1CH0_FDRX20
TCELL94:OUT_Q5SERDES.Q1CH0_FDRX21
TCELL94:OUT_Q6SERDES.Q1CH0_FDRX22
TCELL94:OUT_Q7SERDES.Q1CH0_FDRX23
TCELL95:IMUX_A2SERDES.Q1CH0_FDTX2
TCELL95:IMUX_A3SERDES.Q1CH0_FDTX3
TCELL95:IMUX_A4SERDES.Q1CH0_FDTX4
TCELL95:IMUX_A5SERDES.Q1CH0_FDTX5
TCELL95:IMUX_A6SERDES.Q1CH0_FDTX6
TCELL95:IMUX_A7SERDES.Q1CH0_FDTX7
TCELL95:IMUX_B2SERDES.Q1CH3_FCPCIEDETEN
TCELL95:IMUX_B3SERDES.Q1CH2_FCPCIEDETEN
TCELL95:IMUX_B4SERDES.Q1CH1_FCPCIEDETEN
TCELL95:IMUX_B5SERDES.Q1CH0_FCPCIEDETEN
TCELL95:IMUX_B6SERDES.Q1CH0_FDTX0
TCELL95:IMUX_B7SERDES.Q1CH0_FDTX1
TCELL95:IMUX_C2SERDES.Q1CH1_FCWORDALGNEN
TCELL95:IMUX_C3SERDES.Q1CH0_FCWORDALGNEN
TCELL95:IMUX_C4SERDES.Q1CH3_FCRXPOLARITY
TCELL95:IMUX_C5SERDES.Q1CH2_FCRXPOLARITY
TCELL95:IMUX_C6SERDES.Q1CH1_FCRXPOLARITY
TCELL95:IMUX_C7SERDES.Q1CH0_FCRXPOLARITY
TCELL95:IMUX_D2SERDES.Q1CH3_FCLSMEN
TCELL95:IMUX_D3SERDES.Q1CH2_FCLSMEN
TCELL95:IMUX_D4SERDES.Q1CH1_FCLSMEN
TCELL95:IMUX_D5SERDES.Q1CH0_FCLSMEN
TCELL95:IMUX_D6SERDES.Q1CH3_FCWORDALGNEN
TCELL95:IMUX_D7SERDES.Q1CH2_FCWORDALGNEN
TCELL95:IMUX_LSR0SERDES.Q1CH3_FCRRST
TCELL95:IMUX_LSR1SERDES.Q1CH2_FCRRST
TCELL95:IMUX_CLK0_DELAYSERDES.Q1_FIGRPFBTWCLK1
TCELL95:IMUX_CLK1_DELAYSERDES.Q1_FIGRPFBTWCLK0
TCELL95:OUT_F0SERDES.Q1CH0_FDRX40
TCELL95:OUT_F1SERDES.Q1CH0_FDRX41
TCELL95:OUT_F2SERDES.Q1CH0_FDRX42
TCELL95:OUT_F3SERDES.Q1CH0_FDRX43
TCELL95:OUT_F4SERDES.Q1CH0_FDRX44
TCELL95:OUT_F5SERDES.Q1CH0_FDRX45
TCELL95:OUT_F6SERDES.Q1CH0_FDRX46
TCELL95:OUT_F7SERDES.Q1CH0_FDRX47
TCELL95:OUT_Q0SERDES.Q1CH0_FDRX32
TCELL95:OUT_Q1SERDES.Q1CH0_FDRX33
TCELL95:OUT_Q2SERDES.Q1CH0_FDRX34
TCELL95:OUT_Q3SERDES.Q1CH0_FDRX35
TCELL95:OUT_Q4SERDES.Q1CH0_FDRX36
TCELL95:OUT_Q5SERDES.Q1CH0_FDRX37
TCELL95:OUT_Q6SERDES.Q1CH0_FDRX38
TCELL95:OUT_Q7SERDES.Q1CH0_FDRX39
TCELL96:IMUX_A2SERDES.Q1CH0_FDTX26
TCELL96:IMUX_A3SERDES.Q1CH0_FDTX27
TCELL96:IMUX_A4SERDES.Q1CH0_FDTX28
TCELL96:IMUX_A5SERDES.Q1CH0_FDTX29
TCELL96:IMUX_A6SERDES.Q1CH0_FDTX30
TCELL96:IMUX_A7SERDES.Q1CH0_FDTX31
TCELL96:IMUX_B2SERDES.Q1CH0_FDTX20
TCELL96:IMUX_B3SERDES.Q1CH0_FDTX21
TCELL96:IMUX_B4SERDES.Q1CH0_FDTX22
TCELL96:IMUX_B5SERDES.Q1CH0_FDTX23
TCELL96:IMUX_B6SERDES.Q1CH0_FDTX24
TCELL96:IMUX_B7SERDES.Q1CH0_FDTX25
TCELL96:IMUX_C2SERDES.Q1CH0_FDTX14
TCELL96:IMUX_C3SERDES.Q1CH0_FDTX15
TCELL96:IMUX_C4SERDES.Q1CH0_FDTX16
TCELL96:IMUX_C5SERDES.Q1CH0_FDTX17
TCELL96:IMUX_C6SERDES.Q1CH0_FDTX18
TCELL96:IMUX_C7SERDES.Q1CH0_FDTX19
TCELL96:IMUX_D2SERDES.Q1CH0_FDTX8
TCELL96:IMUX_D3SERDES.Q1CH0_FDTX9
TCELL96:IMUX_D4SERDES.Q1CH0_FDTX10
TCELL96:IMUX_D5SERDES.Q1CH0_FDTX11
TCELL96:IMUX_D6SERDES.Q1CH0_FDTX12
TCELL96:IMUX_D7SERDES.Q1CH0_FDTX13
TCELL96:IMUX_LSR0SERDES.Q1CH1_FCRRST
TCELL96:IMUX_LSR1SERDES.Q1CH0_FCRRST
TCELL96:IMUX_CLK0_DELAYSERDES.Q1_FIGRPFBRRCLK1
TCELL96:IMUX_CLK1_DELAYSERDES.Q1_FIGRPFBRRCLK0
TCELL96:OUT_F0SERDES.Q1CH1_FDRX8
TCELL96:OUT_F1SERDES.Q1CH1_FDRX9
TCELL96:OUT_F2SERDES.Q1CH1_FDRX10
TCELL96:OUT_F3SERDES.Q1CH1_FDRX11
TCELL96:OUT_F4SERDES.Q1CH1_FDRX12
TCELL96:OUT_F5SERDES.Q1CH1_FDRX13
TCELL96:OUT_F6SERDES.Q1CH1_FDRX14
TCELL96:OUT_F7SERDES.Q1CH1_FDRX15
TCELL96:OUT_Q0SERDES.Q1CH1_FDRX0
TCELL96:OUT_Q1SERDES.Q1CH1_FDRX1
TCELL96:OUT_Q2SERDES.Q1CH1_FDRX2
TCELL96:OUT_Q3SERDES.Q1CH1_FDRX3
TCELL96:OUT_Q4SERDES.Q1CH1_FDRX4
TCELL96:OUT_Q5SERDES.Q1CH1_FDRX5
TCELL96:OUT_Q6SERDES.Q1CH1_FDRX6
TCELL96:OUT_Q7SERDES.Q1CH1_FDRX7
TCELL97:IMUX_A2SERDES.Q1CH1_FDTX0
TCELL97:IMUX_A3SERDES.Q1CH1_FDTX1
TCELL97:IMUX_A4SERDES.Q1CH1_FDTX2
TCELL97:IMUX_A5SERDES.Q1CH1_FDTX3
TCELL97:IMUX_A6SERDES.Q1CH1_FDTX4
TCELL97:IMUX_A7SERDES.Q1CH1_FDTX5
TCELL97:IMUX_B2SERDES.Q1CH0_FDTX44
TCELL97:IMUX_B3SERDES.Q1CH0_FDTX45
TCELL97:IMUX_B4SERDES.Q1CH0_FDTX46
TCELL97:IMUX_B5SERDES.Q1CH0_FDTX47
TCELL97:IMUX_B6SERDES.Q1CH0_FDTX48
TCELL97:IMUX_B7SERDES.Q1CH0_FDTX49
TCELL97:IMUX_C2SERDES.Q1CH0_FDTX38
TCELL97:IMUX_C3SERDES.Q1CH0_FDTX39
TCELL97:IMUX_C4SERDES.Q1CH0_FDTX40
TCELL97:IMUX_C5SERDES.Q1CH0_FDTX41
TCELL97:IMUX_C6SERDES.Q1CH0_FDTX42
TCELL97:IMUX_C7SERDES.Q1CH0_FDTX43
TCELL97:IMUX_D2SERDES.Q1CH0_FDTX32
TCELL97:IMUX_D3SERDES.Q1CH0_FDTX33
TCELL97:IMUX_D4SERDES.Q1CH0_FDTX34
TCELL97:IMUX_D5SERDES.Q1CH0_FDTX35
TCELL97:IMUX_D6SERDES.Q1CH0_FDTX36
TCELL97:IMUX_D7SERDES.Q1CH0_FDTX37
TCELL97:IMUX_LSR0SERDES.Q1CH3_FCPCSRXRST
TCELL97:IMUX_LSR1SERDES.Q1CH2_FCPCSRXRST
TCELL97:IMUX_CLK0_DELAYSERDES.Q1CH2_FITCLK
TCELL97:IMUX_CLK1_DELAYSERDES.Q1CH3_FITCLK
TCELL97:OUT_F0SERDES.Q1CH1_FDRX24
TCELL97:OUT_F1SERDES.Q1CH1_FDRX25
TCELL97:OUT_F2SERDES.Q1CH1_FDRX26
TCELL97:OUT_F3SERDES.Q1CH1_FDRX27
TCELL97:OUT_F4SERDES.Q1CH1_FDRX28
TCELL97:OUT_F5SERDES.Q1CH1_FDRX29
TCELL97:OUT_F6SERDES.Q1CH1_FDRX30
TCELL97:OUT_F7SERDES.Q1CH1_FDRX31
TCELL97:OUT_Q0SERDES.Q1CH1_FDRX16
TCELL97:OUT_Q1SERDES.Q1CH1_FDRX17
TCELL97:OUT_Q2SERDES.Q1CH1_FDRX18
TCELL97:OUT_Q3SERDES.Q1CH1_FDRX19
TCELL97:OUT_Q4SERDES.Q1CH1_FDRX20
TCELL97:OUT_Q5SERDES.Q1CH1_FDRX21
TCELL97:OUT_Q6SERDES.Q1CH1_FDRX22
TCELL97:OUT_Q7SERDES.Q1CH1_FDRX23
TCELL98:IMUX_A2SERDES.Q1CH1_FDTX24
TCELL98:IMUX_A3SERDES.Q1CH1_FDTX25
TCELL98:IMUX_A4SERDES.Q1CH1_FDTX26
TCELL98:IMUX_A5SERDES.Q1CH1_FDTX27
TCELL98:IMUX_A6SERDES.Q1CH1_FDTX28
TCELL98:IMUX_A7SERDES.Q1CH1_FDTX29
TCELL98:IMUX_B2SERDES.Q1CH1_FDTX18
TCELL98:IMUX_B3SERDES.Q1CH1_FDTX19
TCELL98:IMUX_B4SERDES.Q1CH1_FDTX20
TCELL98:IMUX_B5SERDES.Q1CH1_FDTX21
TCELL98:IMUX_B6SERDES.Q1CH1_FDTX22
TCELL98:IMUX_B7SERDES.Q1CH1_FDTX23
TCELL98:IMUX_C2SERDES.Q1CH1_FDTX12
TCELL98:IMUX_C3SERDES.Q1CH1_FDTX13
TCELL98:IMUX_C4SERDES.Q1CH1_FDTX14
TCELL98:IMUX_C5SERDES.Q1CH1_FDTX15
TCELL98:IMUX_C6SERDES.Q1CH1_FDTX16
TCELL98:IMUX_C7SERDES.Q1CH1_FDTX17
TCELL98:IMUX_D2SERDES.Q1CH1_FDTX6
TCELL98:IMUX_D3SERDES.Q1CH1_FDTX7
TCELL98:IMUX_D4SERDES.Q1CH1_FDTX8
TCELL98:IMUX_D5SERDES.Q1CH1_FDTX9
TCELL98:IMUX_D6SERDES.Q1CH1_FDTX10
TCELL98:IMUX_D7SERDES.Q1CH1_FDTX11
TCELL98:IMUX_LSR0SERDES.Q1CH1_FCPCSRXRST
TCELL98:IMUX_LSR1SERDES.Q1CH0_FCPCSRXRST
TCELL98:IMUX_CLK0_DELAYSERDES.Q1CH0_FITCLK
TCELL98:IMUX_CLK1_DELAYSERDES.Q1CH1_FITCLK
TCELL98:OUT_F0SERDES.Q1CH1_FDRX40
TCELL98:OUT_F1SERDES.Q1CH1_FDRX41
TCELL98:OUT_F2SERDES.Q1CH1_FDRX42
TCELL98:OUT_F3SERDES.Q1CH1_FDRX43
TCELL98:OUT_F4SERDES.Q1CH1_FDRX44
TCELL98:OUT_F5SERDES.Q1CH1_FDRX45
TCELL98:OUT_F6SERDES.Q1CH1_FDRX46
TCELL98:OUT_F7SERDES.Q1CH1_FDRX47
TCELL98:OUT_Q0SERDES.Q1CH1_FDRX32
TCELL98:OUT_Q1SERDES.Q1CH1_FDRX33
TCELL98:OUT_Q2SERDES.Q1CH1_FDRX34
TCELL98:OUT_Q3SERDES.Q1CH1_FDRX35
TCELL98:OUT_Q4SERDES.Q1CH1_FDRX36
TCELL98:OUT_Q5SERDES.Q1CH1_FDRX37
TCELL98:OUT_Q6SERDES.Q1CH1_FDRX38
TCELL98:OUT_Q7SERDES.Q1CH1_FDRX39
TCELL99:IMUX_A4SERDES.Q1CH1_FDTX48
TCELL99:IMUX_A5SERDES.Q1CH1_FDTX49
TCELL99:IMUX_A6SERDES.Q1CH2_FDTX0
TCELL99:IMUX_A7SERDES.Q1CH2_FDTX1
TCELL99:IMUX_B4SERDES.Q1CH1_FDTX42
TCELL99:IMUX_B5SERDES.Q1CH1_FDTX43
TCELL99:IMUX_B6SERDES.Q1CH1_FDTX44
TCELL99:IMUX_B7SERDES.Q1CH1_FDTX45
TCELL99:IMUX_C4SERDES.Q1CH1_FDTX36
TCELL99:IMUX_C5SERDES.Q1CH1_FDTX37
TCELL99:IMUX_C6SERDES.Q1CH1_FDTX38
TCELL99:IMUX_C7SERDES.Q1CH1_FDTX39
TCELL99:IMUX_D4SERDES.Q1CH1_FDTX30
TCELL99:IMUX_D5SERDES.Q1CH1_FDTX31
TCELL99:IMUX_D6SERDES.Q1CH1_FDTX32
TCELL99:IMUX_D7SERDES.Q1CH1_FDTX33
TCELL99:IMUX_CLK0_DELAYSERDES.Q1CH3_FIRCLK
TCELL99:IMUX_CLK1_DELAYSERDES.Q1CH2_FIRCLK
TCELL99:OUT_F2SERDES.Q1CH2_FDRX8
TCELL99:OUT_F3SERDES.Q1CH2_FDRX9
TCELL99:OUT_F4SERDES.Q1CH2_FDRX10
TCELL99:OUT_F5SERDES.Q1CH2_FDRX11
TCELL99:OUT_F6SERDES.Q1CH2_FDRX12
TCELL99:OUT_F7SERDES.Q1CH2_FDRX13
TCELL99:OUT_Q2SERDES.Q1CH2_FDRX0
TCELL99:OUT_Q3SERDES.Q1CH2_FDRX1
TCELL99:OUT_Q4SERDES.Q1CH2_FDRX2
TCELL99:OUT_Q5SERDES.Q1CH2_FDRX3
TCELL99:OUT_Q6SERDES.Q1CH2_FDRX4
TCELL99:OUT_Q7SERDES.Q1CH2_FDRX5
TCELL100:IMUX_A0SERDES.Q1CH2_FDTX2
TCELL100:IMUX_A1SERDES.Q1CH2_FDTX3
TCELL100:IMUX_A4SERDES.Q1CH2_FDTX22
TCELL100:IMUX_A5SERDES.Q1CH2_FDTX23
TCELL100:IMUX_A6SERDES.Q1CH2_FDTX24
TCELL100:IMUX_A7SERDES.Q1CH2_FDTX25
TCELL100:IMUX_B0SERDES.Q1CH1_FDTX46
TCELL100:IMUX_B1SERDES.Q1CH1_FDTX47
TCELL100:IMUX_B4SERDES.Q1CH2_FDTX16
TCELL100:IMUX_B5SERDES.Q1CH2_FDTX17
TCELL100:IMUX_B6SERDES.Q1CH2_FDTX18
TCELL100:IMUX_B7SERDES.Q1CH2_FDTX19
TCELL100:IMUX_C0SERDES.Q1CH1_FDTX40
TCELL100:IMUX_C1SERDES.Q1CH1_FDTX41
TCELL100:IMUX_C4SERDES.Q1CH2_FDTX10
TCELL100:IMUX_C5SERDES.Q1CH2_FDTX11
TCELL100:IMUX_C6SERDES.Q1CH2_FDTX12
TCELL100:IMUX_C7SERDES.Q1CH2_FDTX13
TCELL100:IMUX_D0SERDES.Q1CH1_FDTX34
TCELL100:IMUX_D1SERDES.Q1CH1_FDTX35
TCELL100:IMUX_D4SERDES.Q1CH2_FDTX4
TCELL100:IMUX_D5SERDES.Q1CH2_FDTX5
TCELL100:IMUX_D6SERDES.Q1CH2_FDTX6
TCELL100:IMUX_D7SERDES.Q1CH2_FDTX7
TCELL100:IMUX_LSR0SERDES.Q1CH3_FCPCSTXRST
TCELL100:IMUX_LSR1SERDES.Q1CH2_FCPCSTXRST
TCELL100:IMUX_CLK0_DELAYSERDES.Q1CH1_FIRCLK
TCELL100:IMUX_CLK1_DELAYSERDES.Q1CH0_FIRCLK
TCELL100:OUT_F0SERDES.Q1CH2_FDRX14
TCELL100:OUT_F1SERDES.Q1CH2_FDRX15
TCELL100:OUT_F2SERDES.Q1CH2_FDRX24
TCELL100:OUT_F3SERDES.Q1CH2_FDRX25
TCELL100:OUT_F4SERDES.Q1CH2_FDRX26
TCELL100:OUT_F5SERDES.Q1CH2_FDRX27
TCELL100:OUT_F6SERDES.Q1CH2_FDRX28
TCELL100:OUT_F7SERDES.Q1CH2_FDRX29
TCELL100:OUT_Q0SERDES.Q1CH2_FDRX6
TCELL100:OUT_Q1SERDES.Q1CH2_FDRX7
TCELL100:OUT_Q2SERDES.Q1CH2_FDRX16
TCELL100:OUT_Q3SERDES.Q1CH2_FDRX17
TCELL100:OUT_Q4SERDES.Q1CH2_FDRX18
TCELL100:OUT_Q5SERDES.Q1CH2_FDRX19
TCELL100:OUT_Q6SERDES.Q1CH2_FDRX20
TCELL100:OUT_Q7SERDES.Q1CH2_FDRX21
TCELL101:IMUX_A0SERDES.Q1CH2_FDTX26
TCELL101:IMUX_A1SERDES.Q1CH2_FDTX27
TCELL101:IMUX_A4SERDES.Q1CH2_FDTX46
TCELL101:IMUX_A5SERDES.Q1CH2_FDTX47
TCELL101:IMUX_A6SERDES.Q1CH2_FDTX48
TCELL101:IMUX_A7SERDES.Q1CH2_FDTX49
TCELL101:IMUX_B0SERDES.Q1CH2_FDTX20
TCELL101:IMUX_B1SERDES.Q1CH2_FDTX21
TCELL101:IMUX_B4SERDES.Q1CH2_FDTX40
TCELL101:IMUX_B5SERDES.Q1CH2_FDTX41
TCELL101:IMUX_B6SERDES.Q1CH2_FDTX42
TCELL101:IMUX_B7SERDES.Q1CH2_FDTX43
TCELL101:IMUX_C0SERDES.Q1CH2_FDTX14
TCELL101:IMUX_C1SERDES.Q1CH2_FDTX15
TCELL101:IMUX_C4SERDES.Q1CH2_FDTX34
TCELL101:IMUX_C5SERDES.Q1CH2_FDTX35
TCELL101:IMUX_C6SERDES.Q1CH2_FDTX36
TCELL101:IMUX_C7SERDES.Q1CH2_FDTX37
TCELL101:IMUX_D0SERDES.Q1CH2_FDTX8
TCELL101:IMUX_D1SERDES.Q1CH2_FDTX9
TCELL101:IMUX_D4SERDES.Q1CH2_FDTX28
TCELL101:IMUX_D5SERDES.Q1CH2_FDTX29
TCELL101:IMUX_D6SERDES.Q1CH2_FDTX30
TCELL101:IMUX_D7SERDES.Q1CH2_FDTX31
TCELL101:IMUX_LSR0SERDES.Q1CH1_FCPCSTXRST
TCELL101:IMUX_LSR1SERDES.Q1CH0_FCPCSTXRST
TCELL101:IMUX_CLK0_DELAYSERDES.Q1CH3_FIREFRXCLK
TCELL101:IMUX_CLK1_DELAYSERDES.Q1CH2_FIREFRXCLK
TCELL101:OUT_F0SERDES.Q1CH2_FDRX30
TCELL101:OUT_F1SERDES.Q1CH2_FDRX31
TCELL101:OUT_F2SERDES.Q1CH2_FDRX40
TCELL101:OUT_F3SERDES.Q1CH2_FDRX41
TCELL101:OUT_F4SERDES.Q1CH2_FDRX42
TCELL101:OUT_F5SERDES.Q1CH2_FDRX43
TCELL101:OUT_F6SERDES.Q1CH2_FDRX44
TCELL101:OUT_F7SERDES.Q1CH2_FDRX45
TCELL101:OUT_Q0SERDES.Q1CH2_FDRX22
TCELL101:OUT_Q1SERDES.Q1CH2_FDRX23
TCELL101:OUT_Q2SERDES.Q1CH2_FDRX32
TCELL101:OUT_Q3SERDES.Q1CH2_FDRX33
TCELL101:OUT_Q4SERDES.Q1CH2_FDRX34
TCELL101:OUT_Q5SERDES.Q1CH2_FDRX35
TCELL101:OUT_Q6SERDES.Q1CH2_FDRX36
TCELL101:OUT_Q7SERDES.Q1CH2_FDRX37
TCELL102:IMUX_A0SERDES.Q1CH3_FDTX0
TCELL102:IMUX_A1SERDES.Q1CH3_FDTX1
TCELL102:IMUX_A4SERDES.Q1CH3_FDTX20
TCELL102:IMUX_A5SERDES.Q1CH3_FDTX21
TCELL102:IMUX_A6SERDES.Q1CH3_FDTX22
TCELL102:IMUX_A7SERDES.Q1CH3_FDTX23
TCELL102:IMUX_B0SERDES.Q1CH2_FDTX44
TCELL102:IMUX_B1SERDES.Q1CH2_FDTX45
TCELL102:IMUX_B4SERDES.Q1CH3_FDTX14
TCELL102:IMUX_B5SERDES.Q1CH3_FDTX15
TCELL102:IMUX_B6SERDES.Q1CH3_FDTX16
TCELL102:IMUX_B7SERDES.Q1CH3_FDTX17
TCELL102:IMUX_C0SERDES.Q1CH2_FDTX38
TCELL102:IMUX_C1SERDES.Q1CH2_FDTX39
TCELL102:IMUX_C4SERDES.Q1CH3_FDTX8
TCELL102:IMUX_C5SERDES.Q1CH3_FDTX9
TCELL102:IMUX_C6SERDES.Q1CH3_FDTX10
TCELL102:IMUX_C7SERDES.Q1CH3_FDTX11
TCELL102:IMUX_D0SERDES.Q1CH2_FDTX32
TCELL102:IMUX_D1SERDES.Q1CH2_FDTX33
TCELL102:IMUX_D4SERDES.Q1CH3_FDTX2
TCELL102:IMUX_D5SERDES.Q1CH3_FDTX3
TCELL102:IMUX_D6SERDES.Q1CH3_FDTX4
TCELL102:IMUX_D7SERDES.Q1CH3_FDTX5
TCELL102:IMUX_LSR0SERDES.Q1D1_FCDERST
TCELL102:IMUX_LSR1SERDES.Q1D0_FCDERST
TCELL102:IMUX_CLK0_DELAYSERDES.Q1CH1_FIREFRXCLK
TCELL102:IMUX_CLK1_DELAYSERDES.Q1CH0_FIREFRXCLK
TCELL102:IMUX_CE1SERDES.Q1CH3_FCDFEUPD
TCELL102:IMUX_CE2SERDES.Q1CH2_FCDFEUPD
TCELL102:IMUX_CE3SERDES.Q1CH1_FCDFEUPD
TCELL102:OUT_F0SERDES.Q1CH2_FDRX46
TCELL102:OUT_F1SERDES.Q1CH2_FDRX47
TCELL102:OUT_F2SERDES.Q1CH3_FDRX8
TCELL102:OUT_F3SERDES.Q1CH3_FDRX9
TCELL102:OUT_F4SERDES.Q1CH3_FDRX10
TCELL102:OUT_F5SERDES.Q1CH3_FDRX11
TCELL102:OUT_F6SERDES.Q1CH3_FDRX12
TCELL102:OUT_F7SERDES.Q1CH3_FDRX13
TCELL102:OUT_Q0SERDES.Q1CH2_FDRX38
TCELL102:OUT_Q1SERDES.Q1CH2_FDRX39
TCELL102:OUT_Q2SERDES.Q1CH3_FDRX0
TCELL102:OUT_Q3SERDES.Q1CH3_FDRX1
TCELL102:OUT_Q4SERDES.Q1CH3_FDRX2
TCELL102:OUT_Q5SERDES.Q1CH3_FDRX3
TCELL102:OUT_Q6SERDES.Q1CH3_FDRX4
TCELL102:OUT_Q7SERDES.Q1CH3_FDRX5
TCELL103:IMUX_A0SERDES.Q1CH3_FDTX24
TCELL103:IMUX_A1SERDES.Q1CH3_FDTX25
TCELL103:IMUX_A4SERDES.Q1CH3_FDTX44
TCELL103:IMUX_A5SERDES.Q1CH3_FDTX45
TCELL103:IMUX_A6SERDES.Q1CH3_FDTX46
TCELL103:IMUX_A7SERDES.Q1CH3_FDTX47
TCELL103:IMUX_B0SERDES.Q1CH3_FDTX18
TCELL103:IMUX_B1SERDES.Q1CH3_FDTX19
TCELL103:IMUX_B4SERDES.Q1CH3_FDTX38
TCELL103:IMUX_B5SERDES.Q1CH3_FDTX39
TCELL103:IMUX_B6SERDES.Q1CH3_FDTX40
TCELL103:IMUX_B7SERDES.Q1CH3_FDTX41
TCELL103:IMUX_C0SERDES.Q1CH3_FDTX12
TCELL103:IMUX_C1SERDES.Q1CH3_FDTX13
TCELL103:IMUX_C4SERDES.Q1CH3_FDTX32
TCELL103:IMUX_C5SERDES.Q1CH3_FDTX33
TCELL103:IMUX_C6SERDES.Q1CH3_FDTX34
TCELL103:IMUX_C7SERDES.Q1CH3_FDTX35
TCELL103:IMUX_D0SERDES.Q1CH3_FDTX6
TCELL103:IMUX_D1SERDES.Q1CH3_FDTX7
TCELL103:IMUX_D4SERDES.Q1CH3_FDTX26
TCELL103:IMUX_D5SERDES.Q1CH3_FDTX27
TCELL103:IMUX_D6SERDES.Q1CH3_FDTX28
TCELL103:IMUX_D7SERDES.Q1CH3_FDTX29
TCELL103:IMUX_LSR0SERDES.Q1CH3_FCPIPEPHYRESETN
TCELL103:IMUX_LSR1SERDES.Q1CH2_FCPIPEPHYRESETN
TCELL103:IMUX_CLK0_DELAYSERDES.Q1_LSPLLREFCLKI
TCELL103:IMUX_CLK1_DELAYSERDES.Q1_HSPLLREFCLKI
TCELL103:IMUX_CE0SERDES.Q1CH0_FCDFEUPD
TCELL103:IMUX_CE1SERDES.Q1CH3_FCDFERDEN
TCELL103:IMUX_CE2SERDES.Q1CH2_FCDFERDEN
TCELL103:IMUX_CE3SERDES.Q1CH1_FCDFERDEN
TCELL103:OUT_F0SERDES.Q1CH3_FDRX14
TCELL103:OUT_F1SERDES.Q1CH3_FDRX15
TCELL103:OUT_F2SERDES.Q1CH3_FDRX24
TCELL103:OUT_F3SERDES.Q1CH3_FDRX25
TCELL103:OUT_F4SERDES.Q1CH3_FDRX26
TCELL103:OUT_F5SERDES.Q1CH3_FDRX27
TCELL103:OUT_F6SERDES.Q1CH3_FDRX28
TCELL103:OUT_F7SERDES.Q1CH3_FDRX29
TCELL103:OUT_Q0SERDES.Q1CH3_FDRX6
TCELL103:OUT_Q1SERDES.Q1CH3_FDRX7
TCELL103:OUT_Q2SERDES.Q1CH3_FDRX16
TCELL103:OUT_Q3SERDES.Q1CH3_FDRX17
TCELL103:OUT_Q4SERDES.Q1CH3_FDRX18
TCELL103:OUT_Q5SERDES.Q1CH3_FDRX19
TCELL103:OUT_Q6SERDES.Q1CH3_FDRX20
TCELL103:OUT_Q7SERDES.Q1CH3_FDRX21
TCELL104:IMUX_A0SERDES.Q1CH3_FDTX48
TCELL104:IMUX_A1SERDES.Q1CH3_FDTX49
TCELL104:IMUX_B0SERDES.Q1CH3_FDTX42
TCELL104:IMUX_B1SERDES.Q1CH3_FDTX43
TCELL104:IMUX_C0SERDES.Q1CH3_FDTX36
TCELL104:IMUX_C1SERDES.Q1CH3_FDTX37
TCELL104:IMUX_D0SERDES.Q1CH3_FDTX30
TCELL104:IMUX_D1SERDES.Q1CH3_FDTX31
TCELL104:IMUX_LSR0SERDES.Q1CH1_FCPIPEPHYRESETN
TCELL104:IMUX_LSR1SERDES.Q1CH0_FCPIPEPHYRESETN
TCELL104:IMUX_CE0SERDES.Q1CH0_FCDFERDEN
TCELL104:OUT_F0SERDES.Q1CH3_FDRX30
TCELL104:OUT_F1SERDES.Q1CH3_FDRX31
TCELL104:OUT_Q0SERDES.Q1CH3_FDRX22
TCELL104:OUT_Q1SERDES.Q1CH3_FDRX23
TCELL105:IMUX_CLK1_DELAYSERDES.Q1CH3_FITMRSTOPCLK
TCELL105:OUT_F2SERDES.Q1_FDDFEERR3
TCELL105:OUT_F3SERDES.Q1_FDDFEERR4
TCELL105:OUT_F4SERDES.Q1_FDDFEERR5
TCELL105:OUT_F5SERDES.Q1_FDDFEERR6
TCELL105:OUT_F6SERDES.Q1_FDDFEERR7
TCELL105:OUT_F7SERDES.Q1_FDDFEERR8
TCELL105:OUT_Q3SERDES.Q1CH3_FSDFEVLD
TCELL105:OUT_Q4SERDES.Q1CH2_FSDFEVLD
TCELL105:OUT_Q5SERDES.Q1CH1_FSDFEVLD
TCELL105:OUT_Q6SERDES.Q1CH0_FSDFEVLD
TCELL105:OUT_Q7SERDES.Q1_FDDFEERR0
TCELL106:IMUX_A4SERDES.Q1CH1_FCTMRSTOP
TCELL106:IMUX_A5SERDES.Q1CH0_FCTMRSTOP
TCELL106:IMUX_A6SERDES.Q1CH3_FCTMRSTART
TCELL106:IMUX_A7SERDES.Q1CH2_FCTMRSTART
TCELL106:IMUX_CLK0_DELAYSERDES.Q1CH2_FITMRSTOPCLK
TCELL106:IMUX_CLK1_DELAYSERDES.Q1CH1_FITMRSTOPCLK
TCELL106:OUT_F0SERDES.Q1_FDDFEERR9
TCELL106:OUT_F1SERDES.Q1_FDDFEDATA0
TCELL106:OUT_F2SERDES.Q1_FDDFEDATA9
TCELL106:OUT_F3SERDES.Q1CH3_FSRCDONE
TCELL106:OUT_F4SERDES.Q1CH2_FSRCDONE
TCELL106:OUT_F5SERDES.Q1CH1_FSRCDONE
TCELL106:OUT_F6SERDES.Q1CH0_FSRCDONE
TCELL106:OUT_F7SERDES.Q1_FOREFCLK2FPGA
TCELL106:OUT_Q0SERDES.Q1_FDDFEERR1
TCELL106:OUT_Q1SERDES.Q1_FDDFEERR2
TCELL106:OUT_Q2SERDES.Q1_FDDFEDATA1
TCELL106:OUT_Q3SERDES.Q1_FDDFEDATA2
TCELL106:OUT_Q4SERDES.Q1_FDDFEDATA3
TCELL106:OUT_Q5SERDES.Q1_FDDFEDATA4
TCELL106:OUT_Q6SERDES.Q1_FDDFEDATA5
TCELL106:OUT_Q7SERDES.Q1_FDDFEDATA6
TCELL107:IMUX_A0SERDES.Q1CH1_FCTMRSTART
TCELL107:IMUX_A1SERDES.Q1CH0_FCTMRSTART
TCELL107:IMUX_A4SERDES.Q1_FCDFECOEFF4_5
TCELL107:IMUX_A5SERDES.Q1_FCDFECOEFF4_6
TCELL107:IMUX_A6SERDES.Q1_FCDFECOEFF4_7
TCELL107:IMUX_A7SERDES.Q1_FCDFECOEFF3_0
TCELL107:IMUX_B0SERDES.Q1CH3_FCTMRSTOP
TCELL107:IMUX_B1SERDES.Q1CH2_FCTMRSTOP
TCELL107:IMUX_B4SERDES.Q1_FCDFECOEFF5_7
TCELL107:IMUX_B5SERDES.Q1_FCDFECOEFF4_0
TCELL107:IMUX_B6SERDES.Q1_FCDFECOEFF4_1
TCELL107:IMUX_B7SERDES.Q1_FCDFECOEFF4_2
TCELL107:IMUX_C4SERDES.Q1_FCDFECOEFF5_1
TCELL107:IMUX_C5SERDES.Q1_FCDFECOEFF5_2
TCELL107:IMUX_C6SERDES.Q1_FCDFECOEFF5_3
TCELL107:IMUX_C7SERDES.Q1_FCDFECOEFF5_4
TCELL107:IMUX_D4SERDES.Q1_FCDFESIGN1
TCELL107:IMUX_D5SERDES.Q1_FCDFESIGN2
TCELL107:IMUX_D6SERDES.Q1_FCDFESIGN3
TCELL107:IMUX_D7SERDES.Q1_FCDFESIGN4
TCELL107:IMUX_CLK0_DELAYSERDES.Q1CH0_FITMRSTOPCLK
TCELL107:IMUX_CLK1_DELAYSERDES.Q1CH3_FITMRSTARTCLK
TCELL107:OUT_F0SERDES.Q1D1_FSDM
TCELL107:OUT_F1SERDES.Q1D0_FSDM
TCELL107:OUT_F2SERDES.Q1CH1_FSSKPADDED
TCELL107:OUT_F3SERDES.Q1CH0_FSSKPADDED
TCELL107:OUT_F4SERDES.Q1CH3_FDLDRRX
TCELL107:OUT_F5SERDES.Q1CH2_FDLDRRX
TCELL107:OUT_F6SERDES.Q1CH1_FDLDRRX
TCELL107:OUT_F7SERDES.Q1CH0_FDLDRRX
TCELL107:OUT_Q0SERDES.Q1_FDDFEDATA7
TCELL107:OUT_Q1SERDES.Q1_FDDFEDATA8
TCELL107:OUT_Q2SERDES.Q1D1_FSDE
TCELL107:OUT_Q3SERDES.Q1D0_FSDE
TCELL107:OUT_Q4SERDES.Q1CH3_FSSKPDELETED
TCELL107:OUT_Q5SERDES.Q1CH2_FSSKPDELETED
TCELL107:OUT_Q6SERDES.Q1CH1_FSSKPDELETED
TCELL107:OUT_Q7SERDES.Q1CH0_FSSKPDELETED
TCELL108:IMUX_A0SERDES.Q1_FCDFECOEFF3_1
TCELL108:IMUX_A1SERDES.Q1_FCDFECOEFF3_2
TCELL108:IMUX_A4SERDES.Q1_FCDFECOEFF1_5
TCELL108:IMUX_A5SERDES.Q1_FCDFECOEFF1_6
TCELL108:IMUX_A6SERDES.Q1_FCDFECOEFF1_7
TCELL108:IMUX_A7SERDES.Q1_FCDFECOEFF0_0
TCELL108:IMUX_B0SERDES.Q1_FCDFECOEFF4_3
TCELL108:IMUX_B1SERDES.Q1_FCDFECOEFF4_4
TCELL108:IMUX_B4SERDES.Q1_FCDFECOEFF2_7
TCELL108:IMUX_B5SERDES.Q1_FCDFECOEFF1_0
TCELL108:IMUX_B6SERDES.Q1_FCDFECOEFF1_1
TCELL108:IMUX_B7SERDES.Q1_FCDFECOEFF1_2
TCELL108:IMUX_C0SERDES.Q1_FCDFECOEFF5_5
TCELL108:IMUX_C1SERDES.Q1_FCDFECOEFF5_6
TCELL108:IMUX_C4SERDES.Q1_FCDFECOEFF2_1
TCELL108:IMUX_C5SERDES.Q1_FCDFECOEFF2_2
TCELL108:IMUX_C6SERDES.Q1_FCDFECOEFF2_3
TCELL108:IMUX_C7SERDES.Q1_FCDFECOEFF2_4
TCELL108:IMUX_D0SERDES.Q1_FCDFESIGN5
TCELL108:IMUX_D1SERDES.Q1_FCDFECOEFF5_0
TCELL108:IMUX_D4SERDES.Q1_FCDFECOEFF3_3
TCELL108:IMUX_D5SERDES.Q1_FCDFECOEFF3_4
TCELL108:IMUX_D6SERDES.Q1_FCDFECOEFF3_5
TCELL108:IMUX_D7SERDES.Q1_FCDFECOEFF3_6
TCELL108:IMUX_CLK0_DELAYSERDES.Q1CH2_FITMRSTARTCLK
TCELL108:IMUX_CLK1_DELAYSERDES.Q1CH1_FITMRSTARTCLK
TCELL108:OUT_F0SERDES.Q1_LSPLLLOL
TCELL108:OUT_F1SERDES.Q1_HSPLLLOL
TCELL108:OUT_F2SERDES.Q1CH3_FSCCUNDERRUN
TCELL108:OUT_F3SERDES.Q1CH2_FSCCUNDERRUN
TCELL108:OUT_F4SERDES.Q1CH1_FSCCUNDERRUN
TCELL108:OUT_F5SERDES.Q1CH0_FSCCUNDERRUN
TCELL108:OUT_F6SERDES.Q1CH3_FSLSM
TCELL108:OUT_F7SERDES.Q1CH2_FSLSM
TCELL108:OUT_Q0SERDES.Q1CH3_FSSKPADDED
TCELL108:OUT_Q1SERDES.Q1CH2_FSSKPADDED
TCELL108:OUT_Q2SERDES.Q1CH3_FSRLOL
TCELL108:OUT_Q3SERDES.Q1CH2_FSRLOL
TCELL108:OUT_Q4SERDES.Q1CH1_FSRLOL
TCELL108:OUT_Q5SERDES.Q1CH0_FSRLOL
TCELL108:OUT_Q6SERDES.Q1CH3_FSCCOVERRUN
TCELL108:OUT_Q7SERDES.Q1CH2_FSCCOVERRUN
TCELL109:IMUX_A0SERDES.Q1_FCDFECOEFF0_1
TCELL109:IMUX_A1SERDES.Q1_FCDFECOEFF0_2
TCELL109:IMUX_A4SERDES.Q1CH0_FCRATE1
TCELL109:IMUX_A5SERDES.Q1CH0_FCRATE2
TCELL109:IMUX_A6SERDES.Q1_LSPLLPWRUP
TCELL109:IMUX_A7SERDES.Q1_HSPLLPWRUP
TCELL109:IMUX_B0SERDES.Q1_FCDFECOEFF1_3
TCELL109:IMUX_B1SERDES.Q1_FCDFECOEFF1_4
TCELL109:IMUX_B4SERDES.Q1CH2_FCRATE1
TCELL109:IMUX_B5SERDES.Q1CH2_FCRATE2
TCELL109:IMUX_B6SERDES.Q1CH1_FCRATE0
TCELL109:IMUX_B7SERDES.Q1CH1_FCRATE1
TCELL109:IMUX_C0SERDES.Q1_FCDFECOEFF2_5
TCELL109:IMUX_C1SERDES.Q1_FCDFECOEFF2_6
TCELL109:IMUX_C4SERDES.Q1_FDDFECHSEL1
TCELL109:IMUX_C5SERDES.Q1_FCSCANMODE
TCELL109:IMUX_C6SERDES.Q1CH3_FCRATE0
TCELL109:IMUX_C7SERDES.Q1CH3_FCRATE1
TCELL109:IMUX_D0SERDES.Q1_FCDFECOEFF3_7
TCELL109:IMUX_D1SERDES.Q1_FCDFECOEFF2_0
TCELL109:IMUX_D4SERDES.Q1_FCDFECOEFF0_3
TCELL109:IMUX_D5SERDES.Q1_FCDFECOEFF0_4
TCELL109:IMUX_D6SERDES.Q1_FCDFECOEFF0_5
TCELL109:IMUX_D7SERDES.Q1_FCDFECOEFF0_6
TCELL109:IMUX_LSR0SERDES.Q1_HSPLLRST
TCELL109:IMUX_LSR1SERDES.Q1_LSPLLRST
TCELL109:IMUX_CLK0_DELAYSERDES.Q1CH0_FITMRSTARTCLK
TCELL109:IMUX_CLK1_DELAYSERDES.Q1_FITMRCLK
TCELL109:OUT_F0SERDES.Q1CH1_FSLSM
TCELL109:OUT_F1SERDES.Q1CH0_FSLSM
TCELL109:OUT_F2SERDES.Q1CH3_FSPCIEDONE
TCELL109:OUT_F3SERDES.Q1CH2_FSPCIEDONE
TCELL109:OUT_F4SERDES.Q1CH1_FSPCIEDONE
TCELL109:OUT_F5SERDES.Q1CH0_FSPCIEDONE
TCELL109:OUT_F6SERDES.Q1CH3_FDRX32
TCELL109:OUT_F7SERDES.Q1CH3_FDRX33
TCELL109:OUT_Q0SERDES.Q1CH1_FSCCOVERRUN
TCELL109:OUT_Q1SERDES.Q1CH0_FSCCOVERRUN
TCELL109:OUT_Q2SERDES.Q1CH3_FSRLOS
TCELL109:OUT_Q3SERDES.Q1CH2_FSRLOS
TCELL109:OUT_Q4SERDES.Q1CH1_FSRLOS
TCELL109:OUT_Q5SERDES.Q1CH0_FSRLOS
TCELL109:OUT_Q6SERDES.Q1CH3_FSPCIECON
TCELL109:OUT_Q7SERDES.Q1CH2_FSPCIECON
TCELL110:IMUX_A0SERDES.Q1_FCMPWRUP
TCELL110:IMUX_A1SERDES.Q1CH3_FCRXPWRUP
TCELL110:IMUX_A4SERDES.Q1CH3_FCLDRTXEN
TCELL110:IMUX_A5SERDES.Q1CH2_FCLDRTXEN
TCELL110:IMUX_A6SERDES.Q1CH1_FCLDRTXEN
TCELL110:IMUX_A7SERDES.Q1CH0_FCLDRTXEN
TCELL110:IMUX_B0SERDES.Q1CH1_FCRATE2
TCELL110:IMUX_B1SERDES.Q1CH0_FCRATE0
TCELL110:IMUX_B4SERDES.Q1CH3_FCALIGNEN
TCELL110:IMUX_B5SERDES.Q1CH2_FCALIGNEN
TCELL110:IMUX_B6SERDES.Q1CH1_FCALIGNEN
TCELL110:IMUX_B7SERDES.Q1CH0_FCALIGNEN
TCELL110:IMUX_C0SERDES.Q1CH3_FCRATE2
TCELL110:IMUX_C1SERDES.Q1CH2_FCRATE0
TCELL110:IMUX_C4SERDES.Q1CH2_FCTXPWRUP
TCELL110:IMUX_C5SERDES.Q1CH1_FCTXPWRUP
TCELL110:IMUX_C6SERDES.Q1CH0_FCTXPWRUP
TCELL110:IMUX_C7SERDES.Q1_FCMRST
TCELL110:IMUX_D0SERDES.Q1_FCDFECOEFF0_7
TCELL110:IMUX_D1SERDES.Q1_FDDFECHSEL0
TCELL110:IMUX_D4SERDES.Q1CH2_FCRXPWRUP
TCELL110:IMUX_D5SERDES.Q1CH1_FCRXPWRUP
TCELL110:IMUX_D6SERDES.Q1CH0_FCRXPWRUP
TCELL110:IMUX_D7SERDES.Q1CH3_FCTXPWRUP
TCELL110:IMUX_LSR0SERDES.Q1CH3_FCTRST
TCELL110:IMUX_LSR1SERDES.Q1CH2_FCTRST
TCELL110:OUT_F0SERDES.Q1CH3_FDRX34
TCELL110:OUT_F1SERDES.Q1CH3_FDRX35
TCELL110:OUT_F2SERDES.Q1CH3_FDRX42
TCELL110:OUT_F3SERDES.Q1CH3_FDRX43
TCELL110:OUT_F4SERDES.Q1CH3_FDRX44
TCELL110:OUT_F5SERDES.Q1CH3_FDRX45
TCELL110:OUT_F6SERDES.Q1CH3_FDRX46
TCELL110:OUT_F7SERDES.Q1CH3_FDRX47
TCELL110:OUT_Q0SERDES.Q1CH1_FSPCIECON
TCELL110:OUT_Q1SERDES.Q1CH0_FSPCIECON
TCELL110:OUT_Q2SERDES.Q1CH3_FDRX36
TCELL110:OUT_Q3SERDES.Q1CH3_FDRX37
TCELL110:OUT_Q4SERDES.Q1CH3_FDRX38
TCELL110:OUT_Q5SERDES.Q1CH3_FDRX39
TCELL110:OUT_Q6SERDES.Q1CH3_FDRX40
TCELL110:OUT_Q7SERDES.Q1CH3_FDRX41
TCELL116:IMUX_A2SERDES.Q2CH0_FCLDRTXEN
TCELL116:IMUX_A3SERDES.Q2CH1_FCLDRTXEN
TCELL116:IMUX_A4SERDES.Q2CH2_FCLDRTXEN
TCELL116:IMUX_A5SERDES.Q2CH3_FCLDRTXEN
TCELL116:IMUX_B2SERDES.Q2CH0_FCALIGNEN
TCELL116:IMUX_B3SERDES.Q2CH1_FCALIGNEN
TCELL116:IMUX_B4SERDES.Q2CH2_FCALIGNEN
TCELL116:IMUX_B5SERDES.Q2CH3_FCALIGNEN
TCELL116:IMUX_C2SERDES.Q2_FCMRST
TCELL116:IMUX_C3SERDES.Q2CH0_FCTXPWRUP
TCELL116:IMUX_C4SERDES.Q2CH1_FCTXPWRUP
TCELL116:IMUX_C5SERDES.Q2CH2_FCTXPWRUP
TCELL116:IMUX_D2SERDES.Q2CH3_FCTXPWRUP
TCELL116:IMUX_D3SERDES.Q2CH0_FCRXPWRUP
TCELL116:IMUX_D4SERDES.Q2CH1_FCRXPWRUP
TCELL116:IMUX_D5SERDES.Q2CH2_FCRXPWRUP
TCELL116:OUT_F2SERDES.Q2CH3_FDRX47
TCELL116:OUT_F3SERDES.Q2CH3_FDRX46
TCELL116:OUT_F4SERDES.Q2CH3_FDRX45
TCELL116:OUT_F5SERDES.Q2CH3_FDRX44
TCELL116:OUT_F6SERDES.Q2CH3_FDRX43
TCELL116:OUT_F7SERDES.Q2CH3_FDRX42
TCELL116:OUT_Q2SERDES.Q2CH3_FDRX41
TCELL116:OUT_Q3SERDES.Q2CH3_FDRX40
TCELL116:OUT_Q4SERDES.Q2CH3_FDRX39
TCELL116:OUT_Q5SERDES.Q2CH3_FDRX38
TCELL116:OUT_Q6SERDES.Q2CH3_FDRX37
TCELL116:OUT_Q7SERDES.Q2CH3_FDRX36
TCELL117:IMUX_A0SERDES.Q2CH3_FCRXPWRUP
TCELL117:IMUX_A1SERDES.Q2_FCMPWRUP
TCELL117:IMUX_A2SERDES.Q2_HSPLLPWRUP
TCELL117:IMUX_A3SERDES.Q2_LSPLLPWRUP
TCELL117:IMUX_A4SERDES.Q2CH0_FCRATE2
TCELL117:IMUX_A5SERDES.Q2CH0_FCRATE1
TCELL117:IMUX_B0SERDES.Q2CH0_FCRATE0
TCELL117:IMUX_B1SERDES.Q2CH1_FCRATE2
TCELL117:IMUX_B2SERDES.Q2CH1_FCRATE1
TCELL117:IMUX_B3SERDES.Q2CH1_FCRATE0
TCELL117:IMUX_B4SERDES.Q2CH2_FCRATE2
TCELL117:IMUX_B5SERDES.Q2CH2_FCRATE1
TCELL117:IMUX_C0SERDES.Q2CH2_FCRATE0
TCELL117:IMUX_C1SERDES.Q2CH3_FCRATE2
TCELL117:IMUX_C2SERDES.Q2CH3_FCRATE1
TCELL117:IMUX_C3SERDES.Q2CH3_FCRATE0
TCELL117:IMUX_C4SERDES.Q2_FCSCANMODE
TCELL117:IMUX_C5SERDES.Q2_FDDFECHSEL1
TCELL117:IMUX_D0SERDES.Q2_FDDFECHSEL0
TCELL117:IMUX_D1SERDES.Q2_FCDFECOEFF0_7
TCELL117:IMUX_D2SERDES.Q2_FCDFECOEFF0_6
TCELL117:IMUX_D3SERDES.Q2_FCDFECOEFF0_5
TCELL117:IMUX_D4SERDES.Q2_FCDFECOEFF0_4
TCELL117:IMUX_D5SERDES.Q2_FCDFECOEFF0_3
TCELL117:IMUX_LSR0SERDES.Q2CH2_FCTRST
TCELL117:IMUX_LSR1SERDES.Q2CH3_FCTRST
TCELL117:IMUX_CLK0_DELAYSERDES.Q2_FITMRCLK
TCELL117:IMUX_CLK1_DELAYSERDES.Q2CH0_FITMRSTARTCLK
TCELL117:OUT_F0SERDES.Q2CH3_FDRX35
TCELL117:OUT_F1SERDES.Q2CH3_FDRX34
TCELL117:OUT_F2SERDES.Q2CH3_FDRX33
TCELL117:OUT_F3SERDES.Q2CH3_FDRX32
TCELL117:OUT_F4SERDES.Q2CH0_FSPCIEDONE
TCELL117:OUT_F5SERDES.Q2CH1_FSPCIEDONE
TCELL117:OUT_F6SERDES.Q2CH2_FSPCIEDONE
TCELL117:OUT_F7SERDES.Q2CH3_FSPCIEDONE
TCELL117:OUT_Q0SERDES.Q2CH0_FSPCIECON
TCELL117:OUT_Q1SERDES.Q2CH1_FSPCIECON
TCELL117:OUT_Q2SERDES.Q2CH2_FSPCIECON
TCELL117:OUT_Q3SERDES.Q2CH3_FSPCIECON
TCELL117:OUT_Q4SERDES.Q2CH0_FSRLOS
TCELL117:OUT_Q5SERDES.Q2CH1_FSRLOS
TCELL117:OUT_Q6SERDES.Q2CH2_FSRLOS
TCELL117:OUT_Q7SERDES.Q2CH3_FSRLOS
TCELL118:IMUX_A0SERDES.Q2_FCDFECOEFF0_2
TCELL118:IMUX_A1SERDES.Q2_FCDFECOEFF0_1
TCELL118:IMUX_A2SERDES.Q2_FCDFECOEFF0_0
TCELL118:IMUX_A3SERDES.Q2_FCDFECOEFF1_7
TCELL118:IMUX_A4SERDES.Q2_FCDFECOEFF1_6
TCELL118:IMUX_A5SERDES.Q2_FCDFECOEFF1_5
TCELL118:IMUX_B0SERDES.Q2_FCDFECOEFF1_4
TCELL118:IMUX_B1SERDES.Q2_FCDFECOEFF1_3
TCELL118:IMUX_B2SERDES.Q2_FCDFECOEFF1_2
TCELL118:IMUX_B3SERDES.Q2_FCDFECOEFF1_1
TCELL118:IMUX_B4SERDES.Q2_FCDFECOEFF1_0
TCELL118:IMUX_B5SERDES.Q2_FCDFECOEFF2_7
TCELL118:IMUX_C0SERDES.Q2_FCDFECOEFF2_6
TCELL118:IMUX_C1SERDES.Q2_FCDFECOEFF2_5
TCELL118:IMUX_C2SERDES.Q2_FCDFECOEFF2_4
TCELL118:IMUX_C3SERDES.Q2_FCDFECOEFF2_3
TCELL118:IMUX_C4SERDES.Q2_FCDFECOEFF2_2
TCELL118:IMUX_C5SERDES.Q2_FCDFECOEFF2_1
TCELL118:IMUX_D0SERDES.Q2_FCDFECOEFF2_0
TCELL118:IMUX_D1SERDES.Q2_FCDFECOEFF3_7
TCELL118:IMUX_D2SERDES.Q2_FCDFECOEFF3_6
TCELL118:IMUX_D3SERDES.Q2_FCDFECOEFF3_5
TCELL118:IMUX_D4SERDES.Q2_FCDFECOEFF3_4
TCELL118:IMUX_D5SERDES.Q2_FCDFECOEFF3_3
TCELL118:IMUX_LSR0SERDES.Q2_LSPLLRST
TCELL118:IMUX_LSR1SERDES.Q2_HSPLLRST
TCELL118:IMUX_CLK0_DELAYSERDES.Q2CH1_FITMRSTARTCLK
TCELL118:IMUX_CLK1_DELAYSERDES.Q2CH2_FITMRSTARTCLK
TCELL118:OUT_F0SERDES.Q2CH0_FSLSM
TCELL118:OUT_F1SERDES.Q2CH1_FSLSM
TCELL118:OUT_F2SERDES.Q2CH2_FSLSM
TCELL118:OUT_F3SERDES.Q2CH3_FSLSM
TCELL118:OUT_F4SERDES.Q2CH0_FSCCUNDERRUN
TCELL118:OUT_F5SERDES.Q2CH1_FSCCUNDERRUN
TCELL118:OUT_F6SERDES.Q2CH2_FSCCUNDERRUN
TCELL118:OUT_F7SERDES.Q2CH3_FSCCUNDERRUN
TCELL118:OUT_Q0SERDES.Q2CH0_FSCCOVERRUN
TCELL118:OUT_Q1SERDES.Q2CH1_FSCCOVERRUN
TCELL118:OUT_Q2SERDES.Q2CH2_FSCCOVERRUN
TCELL118:OUT_Q3SERDES.Q2CH3_FSCCOVERRUN
TCELL118:OUT_Q4SERDES.Q2CH0_FSRLOL
TCELL118:OUT_Q5SERDES.Q2CH1_FSRLOL
TCELL118:OUT_Q6SERDES.Q2CH2_FSRLOL
TCELL118:OUT_Q7SERDES.Q2CH3_FSRLOL
TCELL119:IMUX_A0SERDES.Q2_FCDFECOEFF3_2
TCELL119:IMUX_A1SERDES.Q2_FCDFECOEFF3_1
TCELL119:IMUX_A2SERDES.Q2_FCDFECOEFF3_0
TCELL119:IMUX_A3SERDES.Q2_FCDFECOEFF4_7
TCELL119:IMUX_A4SERDES.Q2_FCDFECOEFF4_6
TCELL119:IMUX_A5SERDES.Q2_FCDFECOEFF4_5
TCELL119:IMUX_B0SERDES.Q2_FCDFECOEFF4_4
TCELL119:IMUX_B1SERDES.Q2_FCDFECOEFF4_3
TCELL119:IMUX_B2SERDES.Q2_FCDFECOEFF4_2
TCELL119:IMUX_B3SERDES.Q2_FCDFECOEFF4_1
TCELL119:IMUX_B4SERDES.Q2_FCDFECOEFF4_0
TCELL119:IMUX_B5SERDES.Q2_FCDFECOEFF5_7
TCELL119:IMUX_C0SERDES.Q2_FCDFECOEFF5_6
TCELL119:IMUX_C1SERDES.Q2_FCDFECOEFF5_5
TCELL119:IMUX_C2SERDES.Q2_FCDFECOEFF5_4
TCELL119:IMUX_C3SERDES.Q2_FCDFECOEFF5_3
TCELL119:IMUX_C4SERDES.Q2_FCDFECOEFF5_2
TCELL119:IMUX_C5SERDES.Q2_FCDFECOEFF5_1
TCELL119:IMUX_D0SERDES.Q2_FCDFECOEFF5_0
TCELL119:IMUX_D1SERDES.Q2_FCDFESIGN5
TCELL119:IMUX_D2SERDES.Q2_FCDFESIGN4
TCELL119:IMUX_D3SERDES.Q2_FCDFESIGN3
TCELL119:IMUX_D4SERDES.Q2_FCDFESIGN2
TCELL119:IMUX_D5SERDES.Q2_FCDFESIGN1
TCELL119:IMUX_CLK0_DELAYSERDES.Q2CH3_FITMRSTARTCLK
TCELL119:IMUX_CLK1_DELAYSERDES.Q2CH0_FITMRSTOPCLK
TCELL119:OUT_F0SERDES.Q2_HSPLLLOL
TCELL119:OUT_F1SERDES.Q2_LSPLLLOL
TCELL119:OUT_F2SERDES.Q2CH0_FDLDRRX
TCELL119:OUT_F3SERDES.Q2CH1_FDLDRRX
TCELL119:OUT_F4SERDES.Q2CH2_FDLDRRX
TCELL119:OUT_F5SERDES.Q2CH3_FDLDRRX
TCELL119:OUT_F6SERDES.Q2CH0_FSSKPADDED
TCELL119:OUT_F7SERDES.Q2CH1_FSSKPADDED
TCELL119:OUT_Q0SERDES.Q2CH2_FSSKPADDED
TCELL119:OUT_Q1SERDES.Q2CH3_FSSKPADDED
TCELL119:OUT_Q2SERDES.Q2CH0_FSSKPDELETED
TCELL119:OUT_Q3SERDES.Q2CH1_FSSKPDELETED
TCELL119:OUT_Q4SERDES.Q2CH2_FSSKPDELETED
TCELL119:OUT_Q5SERDES.Q2CH3_FSSKPDELETED
TCELL119:OUT_Q6SERDES.Q2D0_FSDE
TCELL119:OUT_Q7SERDES.Q2D1_FSDE
TCELL120:IMUX_A0SERDES.Q2CH0_FCTMRSTART
TCELL120:IMUX_A1SERDES.Q2CH1_FCTMRSTART
TCELL120:IMUX_A2SERDES.Q2CH2_FCTMRSTART
TCELL120:IMUX_A3SERDES.Q2CH3_FCTMRSTART
TCELL120:IMUX_A4SERDES.Q2CH0_FCTMRSTOP
TCELL120:IMUX_A5SERDES.Q2CH1_FCTMRSTOP
TCELL120:IMUX_B0SERDES.Q2CH2_FCTMRSTOP
TCELL120:IMUX_B1SERDES.Q2CH3_FCTMRSTOP
TCELL120:IMUX_CLK0_DELAYSERDES.Q2CH1_FITMRSTOPCLK
TCELL120:IMUX_CLK1_DELAYSERDES.Q2CH2_FITMRSTOPCLK
TCELL120:OUT_F0SERDES.Q2D0_FSDM
TCELL120:OUT_F1SERDES.Q2D1_FSDM
TCELL120:OUT_F2SERDES.Q2_FOREFCLK2FPGA
TCELL120:OUT_F3SERDES.Q2CH0_FSRCDONE
TCELL120:OUT_F4SERDES.Q2CH1_FSRCDONE
TCELL120:OUT_F5SERDES.Q2CH2_FSRCDONE
TCELL120:OUT_F6SERDES.Q2CH3_FSRCDONE
TCELL120:OUT_F7SERDES.Q2_FDDFEDATA9
TCELL120:OUT_Q0SERDES.Q2_FDDFEDATA8
TCELL120:OUT_Q1SERDES.Q2_FDDFEDATA7
TCELL120:OUT_Q2SERDES.Q2_FDDFEDATA6
TCELL120:OUT_Q3SERDES.Q2_FDDFEDATA5
TCELL120:OUT_Q4SERDES.Q2_FDDFEDATA4
TCELL120:OUT_Q5SERDES.Q2_FDDFEDATA3
TCELL120:OUT_Q6SERDES.Q2_FDDFEDATA2
TCELL120:OUT_Q7SERDES.Q2_FDDFEDATA1
TCELL121:IMUX_CLK0_DELAYSERDES.Q2CH3_FITMRSTOPCLK
TCELL121:OUT_F0SERDES.Q2_FDDFEDATA0
TCELL121:OUT_F1SERDES.Q2_FDDFEERR9
TCELL121:OUT_F2SERDES.Q2_FDDFEERR8
TCELL121:OUT_F3SERDES.Q2_FDDFEERR7
TCELL121:OUT_F4SERDES.Q2_FDDFEERR6
TCELL121:OUT_F5SERDES.Q2_FDDFEERR5
TCELL121:OUT_F6SERDES.Q2_FDDFEERR4
TCELL121:OUT_F7SERDES.Q2_FDDFEERR3
TCELL121:OUT_Q0SERDES.Q2_FDDFEERR2
TCELL121:OUT_Q1SERDES.Q2_FDDFEERR1
TCELL121:OUT_Q2SERDES.Q2_FDDFEERR0
TCELL121:OUT_Q3SERDES.Q2CH0_FSDFEVLD
TCELL121:OUT_Q4SERDES.Q2CH1_FSDFEVLD
TCELL121:OUT_Q5SERDES.Q2CH2_FSDFEVLD
TCELL121:OUT_Q6SERDES.Q2CH3_FSDFEVLD
TCELL122:IMUX_A6SERDES.Q2CH3_FDTX49
TCELL122:IMUX_A7SERDES.Q2CH3_FDTX48
TCELL122:IMUX_B6SERDES.Q2CH3_FDTX43
TCELL122:IMUX_B7SERDES.Q2CH3_FDTX42
TCELL122:IMUX_C6SERDES.Q2CH3_FDTX37
TCELL122:IMUX_C7SERDES.Q2CH3_FDTX36
TCELL122:IMUX_D6SERDES.Q2CH3_FDTX31
TCELL122:IMUX_D7SERDES.Q2CH3_FDTX30
TCELL122:IMUX_LSR0SERDES.Q2CH0_FCPIPEPHYRESETN
TCELL122:IMUX_LSR1SERDES.Q2CH1_FCPIPEPHYRESETN
TCELL122:IMUX_CE3SERDES.Q2CH0_FCDFERDEN
TCELL122:OUT_F6SERDES.Q2CH3_FDRX31
TCELL122:OUT_F7SERDES.Q2CH3_FDRX30
TCELL122:OUT_Q6SERDES.Q2CH3_FDRX23
TCELL122:OUT_Q7SERDES.Q2CH3_FDRX22
TCELL123:IMUX_A0SERDES.Q2CH3_FDTX47
TCELL123:IMUX_A1SERDES.Q2CH3_FDTX46
TCELL123:IMUX_A2SERDES.Q2CH3_FDTX45
TCELL123:IMUX_A3SERDES.Q2CH3_FDTX44
TCELL123:IMUX_A6SERDES.Q2CH3_FDTX25
TCELL123:IMUX_A7SERDES.Q2CH3_FDTX24
TCELL123:IMUX_B0SERDES.Q2CH3_FDTX41
TCELL123:IMUX_B1SERDES.Q2CH3_FDTX40
TCELL123:IMUX_B2SERDES.Q2CH3_FDTX39
TCELL123:IMUX_B3SERDES.Q2CH3_FDTX38
TCELL123:IMUX_B6SERDES.Q2CH3_FDTX19
TCELL123:IMUX_B7SERDES.Q2CH3_FDTX18
TCELL123:IMUX_C0SERDES.Q2CH3_FDTX35
TCELL123:IMUX_C1SERDES.Q2CH3_FDTX34
TCELL123:IMUX_C2SERDES.Q2CH3_FDTX33
TCELL123:IMUX_C3SERDES.Q2CH3_FDTX32
TCELL123:IMUX_C6SERDES.Q2CH3_FDTX13
TCELL123:IMUX_C7SERDES.Q2CH3_FDTX12
TCELL123:IMUX_D0SERDES.Q2CH3_FDTX29
TCELL123:IMUX_D1SERDES.Q2CH3_FDTX28
TCELL123:IMUX_D2SERDES.Q2CH3_FDTX27
TCELL123:IMUX_D3SERDES.Q2CH3_FDTX26
TCELL123:IMUX_D6SERDES.Q2CH3_FDTX7
TCELL123:IMUX_D7SERDES.Q2CH3_FDTX6
TCELL123:IMUX_LSR0SERDES.Q2CH2_FCPIPEPHYRESETN
TCELL123:IMUX_LSR1SERDES.Q2CH3_FCPIPEPHYRESETN
TCELL123:IMUX_CLK0_DELAYSERDES.Q2_LSPLLREFCLKI
TCELL123:IMUX_CLK1_DELAYSERDES.Q2_HSPLLREFCLKI
TCELL123:IMUX_CE0SERDES.Q2CH1_FCDFERDEN
TCELL123:IMUX_CE1SERDES.Q2CH2_FCDFERDEN
TCELL123:IMUX_CE2SERDES.Q2CH3_FCDFERDEN
TCELL123:IMUX_CE3SERDES.Q2CH0_FCDFEUPD
TCELL123:OUT_F0SERDES.Q2CH3_FDRX29
TCELL123:OUT_F1SERDES.Q2CH3_FDRX28
TCELL123:OUT_F2SERDES.Q2CH3_FDRX27
TCELL123:OUT_F3SERDES.Q2CH3_FDRX26
TCELL123:OUT_F4SERDES.Q2CH3_FDRX25
TCELL123:OUT_F5SERDES.Q2CH3_FDRX24
TCELL123:OUT_F6SERDES.Q2CH3_FDRX15
TCELL123:OUT_F7SERDES.Q2CH3_FDRX14
TCELL123:OUT_Q0SERDES.Q2CH3_FDRX21
TCELL123:OUT_Q1SERDES.Q2CH3_FDRX20
TCELL123:OUT_Q2SERDES.Q2CH3_FDRX19
TCELL123:OUT_Q3SERDES.Q2CH3_FDRX18
TCELL123:OUT_Q4SERDES.Q2CH3_FDRX17
TCELL123:OUT_Q5SERDES.Q2CH3_FDRX16
TCELL123:OUT_Q6SERDES.Q2CH3_FDRX7
TCELL123:OUT_Q7SERDES.Q2CH3_FDRX6
TCELL124:IMUX_A0SERDES.Q2CH3_FDTX23
TCELL124:IMUX_A1SERDES.Q2CH3_FDTX22
TCELL124:IMUX_A2SERDES.Q2CH3_FDTX21
TCELL124:IMUX_A3SERDES.Q2CH3_FDTX20
TCELL124:IMUX_A6SERDES.Q2CH3_FDTX1
TCELL124:IMUX_A7SERDES.Q2CH3_FDTX0
TCELL124:IMUX_B0SERDES.Q2CH3_FDTX17
TCELL124:IMUX_B1SERDES.Q2CH3_FDTX16
TCELL124:IMUX_B2SERDES.Q2CH3_FDTX15
TCELL124:IMUX_B3SERDES.Q2CH3_FDTX14
TCELL124:IMUX_B6SERDES.Q2CH2_FDTX45
TCELL124:IMUX_B7SERDES.Q2CH2_FDTX44
TCELL124:IMUX_C0SERDES.Q2CH3_FDTX11
TCELL124:IMUX_C1SERDES.Q2CH3_FDTX10
TCELL124:IMUX_C2SERDES.Q2CH3_FDTX9
TCELL124:IMUX_C3SERDES.Q2CH3_FDTX8
TCELL124:IMUX_C6SERDES.Q2CH2_FDTX39
TCELL124:IMUX_C7SERDES.Q2CH2_FDTX38
TCELL124:IMUX_D0SERDES.Q2CH3_FDTX5
TCELL124:IMUX_D1SERDES.Q2CH3_FDTX4
TCELL124:IMUX_D2SERDES.Q2CH3_FDTX3
TCELL124:IMUX_D3SERDES.Q2CH3_FDTX2
TCELL124:IMUX_D6SERDES.Q2CH2_FDTX33
TCELL124:IMUX_D7SERDES.Q2CH2_FDTX32
TCELL124:IMUX_LSR0SERDES.Q2D0_FCDERST
TCELL124:IMUX_LSR1SERDES.Q2D1_FCDERST
TCELL124:IMUX_CLK0_DELAYSERDES.Q2CH1_FIREFRXCLK
TCELL124:IMUX_CLK1_DELAYSERDES.Q2CH0_FIREFRXCLK
TCELL124:IMUX_CE0SERDES.Q2CH1_FCDFEUPD
TCELL124:IMUX_CE1SERDES.Q2CH2_FCDFEUPD
TCELL124:IMUX_CE2SERDES.Q2CH3_FCDFEUPD
TCELL124:OUT_F0SERDES.Q2CH3_FDRX13
TCELL124:OUT_F1SERDES.Q2CH3_FDRX12
TCELL124:OUT_F2SERDES.Q2CH3_FDRX11
TCELL124:OUT_F3SERDES.Q2CH3_FDRX10
TCELL124:OUT_F4SERDES.Q2CH3_FDRX9
TCELL124:OUT_F5SERDES.Q2CH3_FDRX8
TCELL124:OUT_F6SERDES.Q2CH2_FDRX47
TCELL124:OUT_F7SERDES.Q2CH2_FDRX46
TCELL124:OUT_Q0SERDES.Q2CH3_FDRX5
TCELL124:OUT_Q1SERDES.Q2CH3_FDRX4
TCELL124:OUT_Q2SERDES.Q2CH3_FDRX3
TCELL124:OUT_Q3SERDES.Q2CH3_FDRX2
TCELL124:OUT_Q4SERDES.Q2CH3_FDRX1
TCELL124:OUT_Q5SERDES.Q2CH3_FDRX0
TCELL124:OUT_Q6SERDES.Q2CH2_FDRX39
TCELL124:OUT_Q7SERDES.Q2CH2_FDRX38
TCELL125:IMUX_A0SERDES.Q2CH2_FDTX49
TCELL125:IMUX_A1SERDES.Q2CH2_FDTX48
TCELL125:IMUX_A2SERDES.Q2CH2_FDTX47
TCELL125:IMUX_A3SERDES.Q2CH2_FDTX46
TCELL125:IMUX_A6SERDES.Q2CH2_FDTX27
TCELL125:IMUX_A7SERDES.Q2CH2_FDTX26
TCELL125:IMUX_B0SERDES.Q2CH2_FDTX43
TCELL125:IMUX_B1SERDES.Q2CH2_FDTX42
TCELL125:IMUX_B2SERDES.Q2CH2_FDTX41
TCELL125:IMUX_B3SERDES.Q2CH2_FDTX40
TCELL125:IMUX_B6SERDES.Q2CH2_FDTX21
TCELL125:IMUX_B7SERDES.Q2CH2_FDTX20
TCELL125:IMUX_C0SERDES.Q2CH2_FDTX37
TCELL125:IMUX_C1SERDES.Q2CH2_FDTX36
TCELL125:IMUX_C2SERDES.Q2CH2_FDTX35
TCELL125:IMUX_C3SERDES.Q2CH2_FDTX34
TCELL125:IMUX_C6SERDES.Q2CH2_FDTX15
TCELL125:IMUX_C7SERDES.Q2CH2_FDTX14
TCELL125:IMUX_D0SERDES.Q2CH2_FDTX31
TCELL125:IMUX_D1SERDES.Q2CH2_FDTX30
TCELL125:IMUX_D2SERDES.Q2CH2_FDTX29
TCELL125:IMUX_D3SERDES.Q2CH2_FDTX28
TCELL125:IMUX_D6SERDES.Q2CH2_FDTX9
TCELL125:IMUX_D7SERDES.Q2CH2_FDTX8
TCELL125:IMUX_LSR0SERDES.Q2CH0_FCPCSTXRST
TCELL125:IMUX_LSR1SERDES.Q2CH1_FCPCSTXRST
TCELL125:IMUX_CLK0_DELAYSERDES.Q2CH3_FIREFRXCLK
TCELL125:IMUX_CLK1_DELAYSERDES.Q2CH2_FIREFRXCLK
TCELL125:OUT_F0SERDES.Q2CH2_FDRX45
TCELL125:OUT_F1SERDES.Q2CH2_FDRX44
TCELL125:OUT_F2SERDES.Q2CH2_FDRX43
TCELL125:OUT_F3SERDES.Q2CH2_FDRX42
TCELL125:OUT_F4SERDES.Q2CH2_FDRX41
TCELL125:OUT_F5SERDES.Q2CH2_FDRX40
TCELL125:OUT_F6SERDES.Q2CH2_FDRX31
TCELL125:OUT_F7SERDES.Q2CH2_FDRX30
TCELL125:OUT_Q0SERDES.Q2CH2_FDRX37
TCELL125:OUT_Q1SERDES.Q2CH2_FDRX36
TCELL125:OUT_Q2SERDES.Q2CH2_FDRX35
TCELL125:OUT_Q3SERDES.Q2CH2_FDRX34
TCELL125:OUT_Q4SERDES.Q2CH2_FDRX33
TCELL125:OUT_Q5SERDES.Q2CH2_FDRX32
TCELL125:OUT_Q6SERDES.Q2CH2_FDRX23
TCELL125:OUT_Q7SERDES.Q2CH2_FDRX22
TCELL126:IMUX_A0SERDES.Q2CH2_FDTX25
TCELL126:IMUX_A1SERDES.Q2CH2_FDTX24
TCELL126:IMUX_A2SERDES.Q2CH2_FDTX23
TCELL126:IMUX_A3SERDES.Q2CH2_FDTX22
TCELL126:IMUX_A6SERDES.Q2CH2_FDTX3
TCELL126:IMUX_A7SERDES.Q2CH2_FDTX2
TCELL126:IMUX_B0SERDES.Q2CH2_FDTX19
TCELL126:IMUX_B1SERDES.Q2CH2_FDTX18
TCELL126:IMUX_B2SERDES.Q2CH2_FDTX17
TCELL126:IMUX_B3SERDES.Q2CH2_FDTX16
TCELL126:IMUX_B6SERDES.Q2CH1_FDTX47
TCELL126:IMUX_B7SERDES.Q2CH1_FDTX46
TCELL126:IMUX_C0SERDES.Q2CH2_FDTX13
TCELL126:IMUX_C1SERDES.Q2CH2_FDTX12
TCELL126:IMUX_C2SERDES.Q2CH2_FDTX11
TCELL126:IMUX_C3SERDES.Q2CH2_FDTX10
TCELL126:IMUX_C6SERDES.Q2CH1_FDTX41
TCELL126:IMUX_C7SERDES.Q2CH1_FDTX40
TCELL126:IMUX_D0SERDES.Q2CH2_FDTX7
TCELL126:IMUX_D1SERDES.Q2CH2_FDTX6
TCELL126:IMUX_D2SERDES.Q2CH2_FDTX5
TCELL126:IMUX_D3SERDES.Q2CH2_FDTX4
TCELL126:IMUX_D6SERDES.Q2CH1_FDTX35
TCELL126:IMUX_D7SERDES.Q2CH1_FDTX34
TCELL126:IMUX_LSR0SERDES.Q2CH2_FCPCSTXRST
TCELL126:IMUX_LSR1SERDES.Q2CH3_FCPCSTXRST
TCELL126:IMUX_CLK0_DELAYSERDES.Q2CH1_FIRCLK
TCELL126:IMUX_CLK1_DELAYSERDES.Q2CH0_FIRCLK
TCELL126:OUT_F0SERDES.Q2CH2_FDRX29
TCELL126:OUT_F1SERDES.Q2CH2_FDRX28
TCELL126:OUT_F2SERDES.Q2CH2_FDRX27
TCELL126:OUT_F3SERDES.Q2CH2_FDRX26
TCELL126:OUT_F4SERDES.Q2CH2_FDRX25
TCELL126:OUT_F5SERDES.Q2CH2_FDRX24
TCELL126:OUT_F6SERDES.Q2CH2_FDRX15
TCELL126:OUT_F7SERDES.Q2CH2_FDRX14
TCELL126:OUT_Q0SERDES.Q2CH2_FDRX21
TCELL126:OUT_Q1SERDES.Q2CH2_FDRX20
TCELL126:OUT_Q2SERDES.Q2CH2_FDRX19
TCELL126:OUT_Q3SERDES.Q2CH2_FDRX18
TCELL126:OUT_Q4SERDES.Q2CH2_FDRX17
TCELL126:OUT_Q5SERDES.Q2CH2_FDRX16
TCELL126:OUT_Q6SERDES.Q2CH2_FDRX7
TCELL126:OUT_Q7SERDES.Q2CH2_FDRX6
TCELL127:IMUX_A0SERDES.Q2CH2_FDTX1
TCELL127:IMUX_A1SERDES.Q2CH2_FDTX0
TCELL127:IMUX_A2SERDES.Q2CH1_FDTX49
TCELL127:IMUX_A3SERDES.Q2CH1_FDTX48
TCELL127:IMUX_B0SERDES.Q2CH1_FDTX45
TCELL127:IMUX_B1SERDES.Q2CH1_FDTX44
TCELL127:IMUX_B2SERDES.Q2CH1_FDTX43
TCELL127:IMUX_B3SERDES.Q2CH1_FDTX42
TCELL127:IMUX_C0SERDES.Q2CH1_FDTX39
TCELL127:IMUX_C1SERDES.Q2CH1_FDTX38
TCELL127:IMUX_C2SERDES.Q2CH1_FDTX37
TCELL127:IMUX_C3SERDES.Q2CH1_FDTX36
TCELL127:IMUX_D0SERDES.Q2CH1_FDTX33
TCELL127:IMUX_D1SERDES.Q2CH1_FDTX32
TCELL127:IMUX_D2SERDES.Q2CH1_FDTX31
TCELL127:IMUX_D3SERDES.Q2CH1_FDTX30
TCELL127:IMUX_CLK0_DELAYSERDES.Q2CH3_FIRCLK
TCELL127:IMUX_CLK1_DELAYSERDES.Q2CH2_FIRCLK
TCELL127:OUT_F0SERDES.Q2CH2_FDRX13
TCELL127:OUT_F1SERDES.Q2CH2_FDRX12
TCELL127:OUT_F2SERDES.Q2CH2_FDRX11
TCELL127:OUT_F3SERDES.Q2CH2_FDRX10
TCELL127:OUT_F4SERDES.Q2CH2_FDRX9
TCELL127:OUT_F5SERDES.Q2CH2_FDRX8
TCELL127:OUT_Q0SERDES.Q2CH2_FDRX5
TCELL127:OUT_Q1SERDES.Q2CH2_FDRX4
TCELL127:OUT_Q2SERDES.Q2CH2_FDRX3
TCELL127:OUT_Q3SERDES.Q2CH2_FDRX2
TCELL127:OUT_Q4SERDES.Q2CH2_FDRX1
TCELL127:OUT_Q5SERDES.Q2CH2_FDRX0
TCELL128:IMUX_A0SERDES.Q2CH1_FDTX29
TCELL128:IMUX_A1SERDES.Q2CH1_FDTX28
TCELL128:IMUX_A2SERDES.Q2CH1_FDTX27
TCELL128:IMUX_A3SERDES.Q2CH1_FDTX26
TCELL128:IMUX_A4SERDES.Q2CH1_FDTX25
TCELL128:IMUX_A5SERDES.Q2CH1_FDTX24
TCELL128:IMUX_B0SERDES.Q2CH1_FDTX23
TCELL128:IMUX_B1SERDES.Q2CH1_FDTX22
TCELL128:IMUX_B2SERDES.Q2CH1_FDTX21
TCELL128:IMUX_B3SERDES.Q2CH1_FDTX20
TCELL128:IMUX_B4SERDES.Q2CH1_FDTX19
TCELL128:IMUX_B5SERDES.Q2CH1_FDTX18
TCELL128:IMUX_C0SERDES.Q2CH1_FDTX17
TCELL128:IMUX_C1SERDES.Q2CH1_FDTX16
TCELL128:IMUX_C2SERDES.Q2CH1_FDTX15
TCELL128:IMUX_C3SERDES.Q2CH1_FDTX14
TCELL128:IMUX_C4SERDES.Q2CH1_FDTX13
TCELL128:IMUX_C5SERDES.Q2CH1_FDTX12
TCELL128:IMUX_D0SERDES.Q2CH1_FDTX11
TCELL128:IMUX_D1SERDES.Q2CH1_FDTX10
TCELL128:IMUX_D2SERDES.Q2CH1_FDTX9
TCELL128:IMUX_D3SERDES.Q2CH1_FDTX8
TCELL128:IMUX_D4SERDES.Q2CH1_FDTX7
TCELL128:IMUX_D5SERDES.Q2CH1_FDTX6
TCELL128:IMUX_LSR0SERDES.Q2CH0_FCPCSRXRST
TCELL128:IMUX_LSR1SERDES.Q2CH1_FCPCSRXRST
TCELL128:IMUX_CLK0_DELAYSERDES.Q2CH0_FITCLK
TCELL128:IMUX_CLK1_DELAYSERDES.Q2CH1_FITCLK
TCELL128:OUT_F0SERDES.Q2CH1_FDRX47
TCELL128:OUT_F1SERDES.Q2CH1_FDRX46
TCELL128:OUT_F2SERDES.Q2CH1_FDRX45
TCELL128:OUT_F3SERDES.Q2CH1_FDRX44
TCELL128:OUT_F4SERDES.Q2CH1_FDRX43
TCELL128:OUT_F5SERDES.Q2CH1_FDRX42
TCELL128:OUT_F6SERDES.Q2CH1_FDRX41
TCELL128:OUT_F7SERDES.Q2CH1_FDRX40
TCELL128:OUT_Q0SERDES.Q2CH1_FDRX39
TCELL128:OUT_Q1SERDES.Q2CH1_FDRX38
TCELL128:OUT_Q2SERDES.Q2CH1_FDRX37
TCELL128:OUT_Q3SERDES.Q2CH1_FDRX36
TCELL128:OUT_Q4SERDES.Q2CH1_FDRX35
TCELL128:OUT_Q5SERDES.Q2CH1_FDRX34
TCELL128:OUT_Q6SERDES.Q2CH1_FDRX33
TCELL128:OUT_Q7SERDES.Q2CH1_FDRX32
TCELL129:IMUX_A0SERDES.Q2CH1_FDTX5
TCELL129:IMUX_A1SERDES.Q2CH1_FDTX4
TCELL129:IMUX_A2SERDES.Q2CH1_FDTX3
TCELL129:IMUX_A3SERDES.Q2CH1_FDTX2
TCELL129:IMUX_A4SERDES.Q2CH1_FDTX1
TCELL129:IMUX_A5SERDES.Q2CH1_FDTX0
TCELL129:IMUX_B0SERDES.Q2CH0_FDTX49
TCELL129:IMUX_B1SERDES.Q2CH0_FDTX48
TCELL129:IMUX_B2SERDES.Q2CH0_FDTX47
TCELL129:IMUX_B3SERDES.Q2CH0_FDTX46
TCELL129:IMUX_B4SERDES.Q2CH0_FDTX45
TCELL129:IMUX_B5SERDES.Q2CH0_FDTX44
TCELL129:IMUX_C0SERDES.Q2CH0_FDTX43
TCELL129:IMUX_C1SERDES.Q2CH0_FDTX42
TCELL129:IMUX_C2SERDES.Q2CH0_FDTX41
TCELL129:IMUX_C3SERDES.Q2CH0_FDTX40
TCELL129:IMUX_C4SERDES.Q2CH0_FDTX39
TCELL129:IMUX_C5SERDES.Q2CH0_FDTX38
TCELL129:IMUX_D0SERDES.Q2CH0_FDTX37
TCELL129:IMUX_D1SERDES.Q2CH0_FDTX36
TCELL129:IMUX_D2SERDES.Q2CH0_FDTX35
TCELL129:IMUX_D3SERDES.Q2CH0_FDTX34
TCELL129:IMUX_D4SERDES.Q2CH0_FDTX33
TCELL129:IMUX_D5SERDES.Q2CH0_FDTX32
TCELL129:IMUX_LSR0SERDES.Q2CH2_FCPCSRXRST
TCELL129:IMUX_LSR1SERDES.Q2CH3_FCPCSRXRST
TCELL129:IMUX_CLK0_DELAYSERDES.Q2CH2_FITCLK
TCELL129:IMUX_CLK1_DELAYSERDES.Q2CH3_FITCLK
TCELL129:OUT_F0SERDES.Q2CH1_FDRX31
TCELL129:OUT_F1SERDES.Q2CH1_FDRX30
TCELL129:OUT_F2SERDES.Q2CH1_FDRX29
TCELL129:OUT_F3SERDES.Q2CH1_FDRX28
TCELL129:OUT_F4SERDES.Q2CH1_FDRX27
TCELL129:OUT_F5SERDES.Q2CH1_FDRX26
TCELL129:OUT_F6SERDES.Q2CH1_FDRX25
TCELL129:OUT_F7SERDES.Q2CH1_FDRX24
TCELL129:OUT_Q0SERDES.Q2CH1_FDRX23
TCELL129:OUT_Q1SERDES.Q2CH1_FDRX22
TCELL129:OUT_Q2SERDES.Q2CH1_FDRX21
TCELL129:OUT_Q3SERDES.Q2CH1_FDRX20
TCELL129:OUT_Q4SERDES.Q2CH1_FDRX19
TCELL129:OUT_Q5SERDES.Q2CH1_FDRX18
TCELL129:OUT_Q6SERDES.Q2CH1_FDRX17
TCELL129:OUT_Q7SERDES.Q2CH1_FDRX16
TCELL130:IMUX_A0SERDES.Q2CH0_FDTX31
TCELL130:IMUX_A1SERDES.Q2CH0_FDTX30
TCELL130:IMUX_A2SERDES.Q2CH0_FDTX29
TCELL130:IMUX_A3SERDES.Q2CH0_FDTX28
TCELL130:IMUX_A4SERDES.Q2CH0_FDTX27
TCELL130:IMUX_A5SERDES.Q2CH0_FDTX26
TCELL130:IMUX_B0SERDES.Q2CH0_FDTX25
TCELL130:IMUX_B1SERDES.Q2CH0_FDTX24
TCELL130:IMUX_B2SERDES.Q2CH0_FDTX23
TCELL130:IMUX_B3SERDES.Q2CH0_FDTX22
TCELL130:IMUX_B4SERDES.Q2CH0_FDTX21
TCELL130:IMUX_B5SERDES.Q2CH0_FDTX20
TCELL130:IMUX_C0SERDES.Q2CH0_FDTX19
TCELL130:IMUX_C1SERDES.Q2CH0_FDTX18
TCELL130:IMUX_C2SERDES.Q2CH0_FDTX17
TCELL130:IMUX_C3SERDES.Q2CH0_FDTX16
TCELL130:IMUX_C4SERDES.Q2CH0_FDTX15
TCELL130:IMUX_C5SERDES.Q2CH0_FDTX14
TCELL130:IMUX_D0SERDES.Q2CH0_FDTX13
TCELL130:IMUX_D1SERDES.Q2CH0_FDTX12
TCELL130:IMUX_D2SERDES.Q2CH0_FDTX11
TCELL130:IMUX_D3SERDES.Q2CH0_FDTX10
TCELL130:IMUX_D4SERDES.Q2CH0_FDTX9
TCELL130:IMUX_D5SERDES.Q2CH0_FDTX8
TCELL130:IMUX_LSR0SERDES.Q2CH0_FCRRST
TCELL130:IMUX_LSR1SERDES.Q2CH1_FCRRST
TCELL130:IMUX_CLK0_DELAYSERDES.Q2_FIGRPFBRRCLK1
TCELL130:IMUX_CLK1_DELAYSERDES.Q2_FIGRPFBRRCLK0
TCELL130:OUT_F0SERDES.Q2CH1_FDRX15
TCELL130:OUT_F1SERDES.Q2CH1_FDRX14
TCELL130:OUT_F2SERDES.Q2CH1_FDRX13
TCELL130:OUT_F3SERDES.Q2CH1_FDRX12
TCELL130:OUT_F4SERDES.Q2CH1_FDRX11
TCELL130:OUT_F5SERDES.Q2CH1_FDRX10
TCELL130:OUT_F6SERDES.Q2CH1_FDRX9
TCELL130:OUT_F7SERDES.Q2CH1_FDRX8
TCELL130:OUT_Q0SERDES.Q2CH1_FDRX7
TCELL130:OUT_Q1SERDES.Q2CH1_FDRX6
TCELL130:OUT_Q2SERDES.Q2CH1_FDRX5
TCELL130:OUT_Q3SERDES.Q2CH1_FDRX4
TCELL130:OUT_Q4SERDES.Q2CH1_FDRX3
TCELL130:OUT_Q5SERDES.Q2CH1_FDRX2
TCELL130:OUT_Q6SERDES.Q2CH1_FDRX1
TCELL130:OUT_Q7SERDES.Q2CH1_FDRX0
TCELL131:IMUX_A0SERDES.Q2CH0_FDTX7
TCELL131:IMUX_A1SERDES.Q2CH0_FDTX6
TCELL131:IMUX_A2SERDES.Q2CH0_FDTX5
TCELL131:IMUX_A3SERDES.Q2CH0_FDTX4
TCELL131:IMUX_A4SERDES.Q2CH0_FDTX3
TCELL131:IMUX_A5SERDES.Q2CH0_FDTX2
TCELL131:IMUX_B0SERDES.Q2CH0_FDTX1
TCELL131:IMUX_B1SERDES.Q2CH0_FDTX0
TCELL131:IMUX_B2SERDES.Q2CH0_FCPCIEDETEN
TCELL131:IMUX_B3SERDES.Q2CH1_FCPCIEDETEN
TCELL131:IMUX_B4SERDES.Q2CH2_FCPCIEDETEN
TCELL131:IMUX_B5SERDES.Q2CH3_FCPCIEDETEN
TCELL131:IMUX_C0SERDES.Q2CH0_FCRXPOLARITY
TCELL131:IMUX_C1SERDES.Q2CH1_FCRXPOLARITY
TCELL131:IMUX_C2SERDES.Q2CH2_FCRXPOLARITY
TCELL131:IMUX_C3SERDES.Q2CH3_FCRXPOLARITY
TCELL131:IMUX_C4SERDES.Q2CH0_FCWORDALGNEN
TCELL131:IMUX_C5SERDES.Q2CH1_FCWORDALGNEN
TCELL131:IMUX_D0SERDES.Q2CH2_FCWORDALGNEN
TCELL131:IMUX_D1SERDES.Q2CH3_FCWORDALGNEN
TCELL131:IMUX_D2SERDES.Q2CH0_FCLSMEN
TCELL131:IMUX_D3SERDES.Q2CH1_FCLSMEN
TCELL131:IMUX_D4SERDES.Q2CH2_FCLSMEN
TCELL131:IMUX_D5SERDES.Q2CH3_FCLSMEN
TCELL131:IMUX_LSR0SERDES.Q2CH2_FCRRST
TCELL131:IMUX_LSR1SERDES.Q2CH3_FCRRST
TCELL131:IMUX_CLK0_DELAYSERDES.Q2_FIGRPFBTWCLK1
TCELL131:IMUX_CLK1_DELAYSERDES.Q2_FIGRPFBTWCLK0
TCELL131:OUT_F0SERDES.Q2CH0_FDRX47
TCELL131:OUT_F1SERDES.Q2CH0_FDRX46
TCELL131:OUT_F2SERDES.Q2CH0_FDRX45
TCELL131:OUT_F3SERDES.Q2CH0_FDRX44
TCELL131:OUT_F4SERDES.Q2CH0_FDRX43
TCELL131:OUT_F5SERDES.Q2CH0_FDRX42
TCELL131:OUT_F6SERDES.Q2CH0_FDRX41
TCELL131:OUT_F7SERDES.Q2CH0_FDRX40
TCELL131:OUT_Q0SERDES.Q2CH0_FDRX39
TCELL131:OUT_Q1SERDES.Q2CH0_FDRX38
TCELL131:OUT_Q2SERDES.Q2CH0_FDRX37
TCELL131:OUT_Q3SERDES.Q2CH0_FDRX36
TCELL131:OUT_Q4SERDES.Q2CH0_FDRX35
TCELL131:OUT_Q5SERDES.Q2CH0_FDRX34
TCELL131:OUT_Q6SERDES.Q2CH0_FDRX33
TCELL131:OUT_Q7SERDES.Q2CH0_FDRX32
TCELL132:IMUX_A0SERDES.Q2CH0_FCCDRFORCEDLOCK
TCELL132:IMUX_A1SERDES.Q2CH1_FCCDRFORCEDLOCK
TCELL132:IMUX_A2SERDES.Q2CH2_FCCDRFORCEDLOCK
TCELL132:IMUX_A3SERDES.Q2CH3_FCCDRFORCEDLOCK
TCELL132:IMUX_A4SERDES.Q2CH0_FCPLLLOL
TCELL132:IMUX_A5SERDES.Q2CH1_FCPLLLOL
TCELL132:IMUX_B0SERDES.Q2CH2_FCPLLLOL
TCELL132:IMUX_B1SERDES.Q2CH3_FCPLLLOL
TCELL132:IMUX_B2SERDES.Q2CH0_FDLDRTX
TCELL132:IMUX_B3SERDES.Q2CH1_FDLDRTX
TCELL132:IMUX_B4SERDES.Q2CH2_FDLDRTX
TCELL132:IMUX_B5SERDES.Q2CH3_FDLDRTX
TCELL132:IMUX_C0SERDES.Q2CH0_FCTXMARGIN2
TCELL132:IMUX_C1SERDES.Q2CH0_FCTXMARGIN1
TCELL132:IMUX_C2SERDES.Q2CH0_FCTXMARGIN0
TCELL132:IMUX_C3SERDES.Q2CH1_FCTXMARGIN2
TCELL132:IMUX_C4SERDES.Q2CH1_FCTXMARGIN1
TCELL132:IMUX_C5SERDES.Q2CH1_FCTXMARGIN0
TCELL132:IMUX_D0SERDES.Q2CH2_FCTXMARGIN2
TCELL132:IMUX_D1SERDES.Q2CH2_FCTXMARGIN1
TCELL132:IMUX_D2SERDES.Q2CH2_FCTXMARGIN0
TCELL132:IMUX_D3SERDES.Q2CH3_FCTXMARGIN2
TCELL132:IMUX_D4SERDES.Q2CH3_FCTXMARGIN1
TCELL132:IMUX_D5SERDES.Q2CH3_FCTXMARGIN0
TCELL132:IMUX_LSR0SERDES.Q2CH0_FCTRST
TCELL132:IMUX_LSR1SERDES.Q2CH1_FCTRST
TCELL132:IMUX_CLK0_DELAYSERDES.Q2_FISYNCCLK
TCELL132:IMUX_CLK1_DELAYSERDES.Q2_FIRXTESTCLK
TCELL132:OUT_F0SERDES.Q2CH0_FDRX31
TCELL132:OUT_F1SERDES.Q2CH0_FDRX30
TCELL132:OUT_F2SERDES.Q2CH0_FDRX29
TCELL132:OUT_F3SERDES.Q2CH0_FDRX28
TCELL132:OUT_F4SERDES.Q2CH0_FDRX27
TCELL132:OUT_F5SERDES.Q2CH0_FDRX26
TCELL132:OUT_F6SERDES.Q2CH0_FDRX25
TCELL132:OUT_F7SERDES.Q2CH0_FDRX24
TCELL132:OUT_Q0SERDES.Q2CH0_FDRX23
TCELL132:OUT_Q1SERDES.Q2CH0_FDRX22
TCELL132:OUT_Q2SERDES.Q2CH0_FDRX21
TCELL132:OUT_Q3SERDES.Q2CH0_FDRX20
TCELL132:OUT_Q4SERDES.Q2CH0_FDRX19
TCELL132:OUT_Q5SERDES.Q2CH0_FDRX18
TCELL132:OUT_Q6SERDES.Q2CH0_FDRX17
TCELL132:OUT_Q7SERDES.Q2CH0_FDRX16
TCELL133:IMUX_CLK1_DELAYSERDES.Q2_FITXTESTCLK
TCELL133:OUT_F0SERDES.Q2CH0_FDRX15
TCELL133:OUT_F1SERDES.Q2CH0_FDRX14
TCELL133:OUT_F2SERDES.Q2CH0_FDRX13
TCELL133:OUT_F3SERDES.Q2CH0_FDRX12
TCELL133:OUT_F4SERDES.Q2CH0_FDRX11
TCELL133:OUT_F5SERDES.Q2CH0_FDRX10
TCELL133:OUT_F6SERDES.Q2CH0_FDRX9
TCELL133:OUT_F7SERDES.Q2CH0_FDRX8
TCELL133:OUT_Q0SERDES.Q2CH0_FDRX7
TCELL133:OUT_Q1SERDES.Q2CH0_FDRX6
TCELL133:OUT_Q2SERDES.Q2CH0_FDRX5
TCELL133:OUT_Q3SERDES.Q2CH0_FDRX4
TCELL133:OUT_Q4SERDES.Q2CH0_FDRX3
TCELL133:OUT_Q5SERDES.Q2CH0_FDRX2
TCELL133:OUT_Q6SERDES.Q2CH0_FDRX1
TCELL133:OUT_Q7SERDES.Q2CH0_FDRX0
TCELL134:OUT_F0SERDES.Q2EA0_CORXDATA13
TCELL134:OUT_F1SERDES.Q2EA0_CORXDATA10
TCELL134:OUT_F2SERDES.Q2EA0_CORXDATA14
TCELL134:OUT_F3SERDES.Q2EA0_CORXDATA12
TCELL134:OUT_F4SERDES.Q2EA0_CORXDATA9
TCELL134:OUT_F5SERDES.Q2EA0_CORXDATA11
TCELL134:OUT_F6SERDES.Q2EA0_CORXDATA15
TCELL134:OUT_F7SERDES.Q2EA0_CORXDATA8
TCELL134:OUT_Q0SERDES.Q2EA0_CORXDATA6
TCELL134:OUT_Q1SERDES.Q2X_TOSCANOUT23
TCELL134:OUT_Q2SERDES.Q2EA0_CORXDATA5
TCELL134:OUT_Q3SERDES.Q2EA0_CORXDATA4
TCELL134:OUT_Q4SERDES.Q2EA0_CORXDATA7
TCELL134:OUT_Q5SERDES.Q2EA2_CORXDATA10
TCELL134:OUT_Q6SERDES.Q2EA2_CORXDATA12
TCELL134:OUT_Q7SERDES.Q2EA0_CORXDATA3
TCELL135:OUT_F0SERDES.Q2EA2_CORXDATA13
TCELL135:OUT_F1SERDES.Q2EA2_CORXDATA11
TCELL135:OUT_F2SERDES.Q2EA2_CORXDATA14
TCELL135:OUT_F3SERDES.Q2EA2_CORXDATA8
TCELL135:OUT_F4SERDES.Q2EA2_CORXDATA9
TCELL135:OUT_F5SERDES.Q2EA0_CORXDATA2
TCELL135:OUT_Q0SERDES.Q2EA0_CORXLASTBYTEVLD
TCELL135:OUT_Q1SERDES.Q2EA0_CORXDATA1
TCELL135:OUT_Q2SERDES.Q2EA0_CORXDATA0
TCELL135:OUT_Q3SERDES.Q2EA2_CORXDATA15
TCELL135:OUT_Q4SERDES.Q2EA0_CORXWRITE
TCELL135:OUT_Q5SERDES.Q2EA2_COTXREAD
TCELL136:OUT_F0SERDES.Q2EA0_CORXFIFOFULLERROR
TCELL136:OUT_F1SERDES.Q2EA0_CORXEOF
TCELL136:OUT_F2SERDES.Q2EA0_CORXERROR
TCELL136:OUT_F3SERDES.Q2EA2_COTXDISCFRM
TCELL136:OUT_F4SERDES.Q2EA2_CORXDATA2
TCELL136:OUT_F5SERDES.Q2EA2_CORXLASTBYTEVLD
TCELL136:OUT_F6SERDES.Q2EA2_CORXDATA4
TCELL136:OUT_F7SERDES.Q2EA2_CORXDATA3
TCELL136:OUT_Q0SERDES.Q2EA2_CORXDATA1
TCELL136:OUT_Q1SERDES.Q2EA2_CORXDATA7
TCELL136:OUT_Q2SERDES.Q2EA2_CORXDATA5
TCELL136:OUT_Q3SERDES.Q2EA2_COTXSTATEN
TCELL136:OUT_Q4SERDES.Q2EA2_CORXDATA6
TCELL136:OUT_Q5SERDES.Q2EA0_CORXSTATVEC0
TCELL136:OUT_Q6SERDES.Q2EA2_COTXDONE
TCELL136:OUT_Q7SERDES.Q2EA2_COTXSTATVEC7
TCELL137:OUT_F0SERDES.Q2EA2_CORXDATA0
TCELL137:OUT_F1SERDES.Q2EA0_CORXSTATVEC1
TCELL137:OUT_F2SERDES.Q2EA2_COTXSTATVEC0
TCELL137:OUT_F3SERDES.Q2EA2_GOTXMACDATA1
TCELL137:OUT_F4SERDES.Q2EA2_GOTXMACDATA3
TCELL137:OUT_F5SERDES.Q2EA2_COTXSTATVEC4
TCELL137:OUT_F6SERDES.Q2EA2_CORXFIFOFULLERROR
TCELL137:OUT_F7SERDES.Q2EA0_CORXSTATVEC2
TCELL137:OUT_Q0SERDES.Q2EA2_GOTXMACDATA4
TCELL137:OUT_Q1SERDES.Q2EA2_COTXSTATVEC5
TCELL137:OUT_Q2SERDES.Q2EA2_COTXSTATVEC6
TCELL137:OUT_Q3SERDES.Q2EA2_GOTXMACDATA2
TCELL137:OUT_Q4SERDES.Q2EA0_CORXSTATVEC4
TCELL137:OUT_Q5SERDES.Q2EA2_GOTXMACDATA5
TCELL137:OUT_Q6SERDES.Q2EA2_COTXSTATVEC1
TCELL137:OUT_Q7SERDES.Q2EA3_CORXDATA11
TCELL138:OUT_F0SERDES.Q2X_TOSCANOUT9
TCELL138:OUT_F1SERDES.Q2EA2_CORXWRITE
TCELL138:OUT_F2SERDES.Q2EA3_CORXDATA12
TCELL138:OUT_F3SERDES.Q2EA0_CORXSTATVEC3
TCELL138:OUT_F4SERDES.Q2EA2_COTXSTATVEC3
TCELL138:OUT_F5SERDES.Q2EA2_GOTXMACDATA6
TCELL138:OUT_F6SERDES.Q2EA2_CORXEOF
TCELL138:OUT_F7SERDES.Q2EA3_CORXDATA14
TCELL138:OUT_Q0SERDES.Q2EA2_COTXSTATVEC2
TCELL138:OUT_Q1SERDES.Q2EA3_CORXDATA13
TCELL138:OUT_Q2SERDES.Q2EA0_CORXSTATEN
TCELL138:OUT_Q3SERDES.Q2X_TOSCANOUT7
TCELL138:OUT_Q4SERDES.Q2EA0_CORXSTATVEC7
TCELL138:OUT_Q5SERDES.Q2EA3_CORXDATA10
TCELL138:OUT_Q6SERDES.Q2EA0_CORXSTATVEC5
TCELL138:OUT_Q7SERDES.Q2EA3_CORXDATA9
TCELL139:OUT_F0SERDES.Q2EA0_CORXSTATVEC6
TCELL139:OUT_F1SERDES.Q2X_TOSCANOUT24
TCELL139:OUT_F2SERDES.Q2EA3_CORXDATA8
TCELL139:OUT_F3SERDES.Q2EA3_CORXDATA15
TCELL139:OUT_F4SERDES.Q2EA2_CORXERROR
TCELL139:OUT_F5SERDES.Q2EA1_CORXDATA11
TCELL139:OUT_F6SERDES.Q2EA1_CORXDATA12
TCELL139:OUT_F7SERDES.Q2EA1_CORXDATA10
TCELL139:OUT_Q0SERDES.Q2EA2_GOTXMACDATA7
TCELL139:OUT_Q1SERDES.Q2EA1_CORXDATA13
TCELL139:OUT_Q2SERDES.Q2EA1_CORXDATA9
TCELL139:OUT_Q3SERDES.Q2EA2_CORXSTATVEC5
TCELL139:OUT_Q4SERDES.Q2EA1_CORXDATA14
TCELL139:OUT_Q5SERDES.Q2EA2_CORXSTATEN
TCELL139:OUT_Q6SERDES.Q2EA2_CORXSTATVEC4
TCELL139:OUT_Q7SERDES.Q2EA3_COTXSTATVEC3
TCELL140:OUT_F0SERDES.Q2EA3_COTXDISCFRM
TCELL140:OUT_F1SERDES.Q2EA3_COTXSTATVEC4
TCELL140:OUT_F2SERDES.Q2EA3_COTXSTATVEC7
TCELL140:OUT_F3SERDES.Q2X_TOSCANOUT10
TCELL140:OUT_F4SERDES.Q2EA2_CORXSTATVEC6
TCELL140:OUT_F5SERDES.Q2EA3_COTXSTATVEC1
TCELL140:OUT_F6SERDES.Q2EA1_CORXDATA15
TCELL140:OUT_F7SERDES.Q2EA3_COTXREAD
TCELL140:OUT_Q0SERDES.Q2EA3_COTXSTATEN
TCELL140:OUT_Q1SERDES.Q2EA3_COTXSTATVEC5
TCELL140:OUT_Q2SERDES.Q2EA2_CORXSTATVEC3
TCELL140:OUT_Q3SERDES.Q2EA1_CORXDATA8
TCELL140:OUT_Q4SERDES.Q2EA3_CORXLASTBYTEVLD
TCELL140:OUT_Q5SERDES.Q2EA2_GOTXMACERR
TCELL140:OUT_Q6SERDES.Q2EA3_COTXDONE
TCELL140:OUT_Q7SERDES.Q2EA2_CORXSTATVEC7
TCELL145:IMUX_A0SERDES.Q2EA0_CITXDATA11
TCELL145:IMUX_A1SERDES.Q2EA0_CITXDATA12
TCELL145:IMUX_A2SERDES.Q2EA0_CITXDATA14
TCELL145:IMUX_A3SERDES.Q2EA0_CITXDATA10
TCELL145:IMUX_A4SERDES.Q2EA0_CITXDATA9
TCELL145:IMUX_A5SERDES.Q2EA0_CITXDATA8
TCELL145:IMUX_B0SERDES.Q2EA2_CITXDATA10
TCELL145:IMUX_B1SERDES.Q2EA2_CITXDATA11
TCELL145:IMUX_B2SERDES.Q2EA2_CITXDATA9
TCELL145:IMUX_B3SERDES.Q2EA2_CITXDATA12
TCELL145:IMUX_B4SERDES.Q2EA0_CITXDATA15
TCELL145:IMUX_B5SERDES.Q2EA0_CITXDATA0
TCELL145:IMUX_C0SERDES.Q2EA2_CITXDATA13
TCELL145:IMUX_C1SERDES.Q2EA0_CITXDATA13
TCELL145:IMUX_C2SERDES.Q2EA0_CITXLASTBYTEVLD
TCELL145:IMUX_C3SERDES.Q2EA0_CITXDATA6
TCELL145:IMUX_C4SERDES.Q2EA2_CITXDATA6
TCELL145:IMUX_C5SERDES.Q2EA0_CITXDATA7
TCELL145:IMUX_D0SERDES.Q2EA2_CITXDATA8
TCELL145:IMUX_D1SERDES.Q2EA2_CITXDATA5
TCELL145:IMUX_D2SERDES.Q2EA2_CITXDATA7
TCELL145:IMUX_D3SERDES.Q2EA0_CITXDATA4
TCELL145:IMUX_D4SERDES.Q2EA2_CITXDATA14
TCELL145:IMUX_D5SERDES.Q2EA2_CITXDATA4
TCELL145:IMUX_LSR0SERDES.Q2EA2_KIRSTN
TCELL145:IMUX_LSR1SERDES.Q2EA0_KIRSTN
TCELL145:IMUX_CLK0_DELAYSERDES.Q2EA0_KIRXTXFECLK
TCELL145:IMUX_CLK1_DELAYSERDES.Q2EA0_KIRXMACCLK
TCELL145:IMUX_CE0SERDES.Q2X_TISCANIN2
TCELL145:IMUX_CE1SERDES.Q2X_TISCANIN3
TCELL145:IMUX_CE2SERDES.Q2X_TISCANIN22
TCELL145:IMUX_CE3SERDES.Q2X_TISCANIN23
TCELL145:OUT_F0SERDES.Q2EA2_CORXSTATVEC2
TCELL145:OUT_F1SERDES.Q2EA2_CORXSTATVEC0
TCELL145:OUT_F2SERDES.Q2EA3_COTXSTATVEC0
TCELL145:OUT_F3SERDES.Q2EA2_CORXSTATVEC1
TCELL145:OUT_F4SERDES.Q2EA2_GOTXMACWR
TCELL145:OUT_F5SERDES.Q2EA3_COTXSTATVEC6
TCELL145:OUT_F6SERDES.Q2EA3_COTXSTATVEC2
TCELL145:OUT_F7SERDES.Q2EA1_CORXLASTBYTEVLD
TCELL145:OUT_Q0SERDES.Q2EA3_CORXFIFOFULLERROR
TCELL145:OUT_Q1SERDES.Q2EA3_CORXDATA0
TCELL145:OUT_Q2SERDES.Q2EA3_CORXWRITE
TCELL145:OUT_Q3SERDES.Q2EA2_KORXMACCLKEN
TCELL145:OUT_Q4SERDES.Q2EA3_CORXDATA2
TCELL145:OUT_Q5SERDES.Q2EA3_CORXDATA7
TCELL145:OUT_Q6SERDES.Q2EA3_CORXDATA3
TCELL145:OUT_Q7SERDES.Q2EA3_CORXDATA1
TCELL146:IMUX_A0SERDES.Q2EA2_CITXDATA3
TCELL146:IMUX_A1SERDES.Q2EA0_CITXDATA2
TCELL146:IMUX_A2SERDES.Q2EA0_CITXDATA5
TCELL146:IMUX_A3SERDES.Q2EA2_CITXDATA2
TCELL146:IMUX_A4SERDES.Q2EA2_CITXDATA15
TCELL146:IMUX_A5SERDES.Q2EA0_CITXDATA3
TCELL146:IMUX_B0SERDES.Q2EA2_CITXDATA1
TCELL146:IMUX_B1SERDES.Q2EA0_CITXDATA1
TCELL146:IMUX_B2SERDES.Q2EA2_CITXDATA0
TCELL146:IMUX_B3SERDES.Q2EA2_CITXLASTBYTEVLD
TCELL146:IMUX_B4SERDES.Q2EA3_CITXDATA10
TCELL146:IMUX_B5SERDES.Q2EA0_CITXEOF
TCELL146:IMUX_C0SERDES.Q2EA3_CITXDATA11
TCELL146:IMUX_C1SERDES.Q2EA2_CITXEOF
TCELL146:IMUX_C2SERDES.Q2EA3_CITXDATA12
TCELL146:IMUX_C3SERDES.Q2EA3_CITXDATA9
TCELL146:IMUX_C4SERDES.Q2EA3_CITXDATA8
TCELL146:IMUX_C5SERDES.Q2EA3_CITXDATA13
TCELL146:IMUX_D0SERDES.Q2EA3_CITXDATA14
TCELL146:IMUX_D1SERDES.Q2EA3_CITXDATA7
TCELL146:IMUX_D2SERDES.Q2EA3_CITXDATA1
TCELL146:IMUX_D3SERDES.Q2EA3_CITXDATA6
TCELL146:IMUX_D4SERDES.Q2EA3_CITXDATA0
TCELL146:IMUX_D5SERDES.Q2EA3_CITXDATA15
TCELL146:IMUX_LSR0SERDES.Q2EA1_KIRSTN
TCELL146:IMUX_LSR1SERDES.Q2EA3_KIRSTN
TCELL146:IMUX_CLK0_DELAYSERDES.Q2EA2_KITXMACCLK
TCELL146:IMUX_CLK1_DELAYSERDES.Q2EA2_KIRXTXFECLK
TCELL146:IMUX_CE0SERDES.Q2X_TISCANIN21
TCELL146:IMUX_CE1SERDES.Q2X_TISCANIN9
TCELL146:IMUX_CE2SERDES.Q2X_TISCANIN5
TCELL146:IMUX_CE3SERDES.Q2X_TISCANIN7
TCELL146:OUT_F0SERDES.Q2EA3_CORXDATA4
TCELL146:OUT_F1SERDES.Q2X_TOSCANOUT22
TCELL146:OUT_F2SERDES.Q2EA1_CORXDATA2
TCELL146:OUT_F3SERDES.Q2EA3_CORXDATA5
TCELL146:OUT_F4SERDES.Q2EA1_CORXEOF
TCELL146:OUT_F5SERDES.Q2EA1_CORXDATA6
TCELL146:OUT_F6SERDES.Q2EA1_CORXDATA4
TCELL146:OUT_F7SERDES.Q2EA1_CORXWRITE
TCELL146:OUT_Q0SERDES.Q2EA3_CORXDATA6
TCELL146:OUT_Q1SERDES.Q2EA1_CORXFIFOFULLERROR
TCELL146:OUT_Q2SERDES.Q2EA1_CORXDATA5
TCELL146:OUT_Q3SERDES.Q2EA1_CORXDATA3
TCELL146:OUT_Q4SERDES.Q2EA1_CORXERROR
TCELL146:OUT_Q5SERDES.Q2EA1_CORXDATA1
TCELL146:OUT_Q6SERDES.Q2EA1_CORXDATA7
TCELL146:OUT_Q7SERDES.Q2EA1_CORXDATA0
TCELL147:IMUX_A0SERDES.Q2EA3_CITXDATA5
TCELL147:IMUX_A1SERDES.Q2EA3_CITXDATA3
TCELL147:IMUX_A2SERDES.Q2EA3_CITXDATA4
TCELL147:IMUX_A3SERDES.Q2EA3_CITXLASTBYTEVLD
TCELL147:IMUX_A4SERDES.Q2EA3_CITXDATA2
TCELL147:IMUX_A5SERDES.Q2EA2_CITXEMPTY
TCELL147:IMUX_B0SERDES.Q2EA0_CIRXFULL
TCELL147:IMUX_B1SERDES.Q2EA2_CITXDATAAVAIL
TCELL147:IMUX_B2SERDES.Q2EA2_CITXFIFOCTRL
TCELL147:IMUX_B3SERDES.Q2EA2_CITXFORCEERR
TCELL147:IMUX_B4SERDES.Q2EA3_CITXEOF
TCELL147:IMUX_B5SERDES.Q2EA2_CIRXFULL
TCELL147:IMUX_C0SERDES.Q2EA2_CITXPAUSREQ
TCELL147:IMUX_C1SERDES.Q2EA3_CITXEMPTY
TCELL147:IMUX_C2SERDES.Q2EA3_CITXDATAAVAIL
TCELL147:IMUX_C3SERDES.Q2EA2_GISYNCCRS
TCELL147:IMUX_C4SERDES.Q2EA2_GISYNCCOL
TCELL147:IMUX_C5SERDES.Q2EA3_CITXFIFOCTRL
TCELL147:IMUX_D0SERDES.Q2EA3_CIRXFULL
TCELL147:IMUX_D1SERDES.Q2EA2_CITXPAUSTIM1
TCELL147:IMUX_D2SERDES.Q2EA2_CITXPAUSTIM0
TCELL147:IMUX_D3SERDES.Q2EA2_CITXPAUSTIM15
TCELL147:IMUX_D4SERDES.Q2EA2_CITXPAUSTIM5
TCELL147:IMUX_D5SERDES.Q2EA2_CITXPAUSTIM2
TCELL147:IMUX_LSR0SERDES.Q2X_TISCANRSTN
TCELL147:IMUX_LSR1SERDES.Q2X_TISCANMODE
TCELL147:IMUX_CLK0_DELAYSERDES.Q2EA2_KIRXMACCLK
TCELL147:IMUX_CLK1_DELAYSERDES.Q2EA3_KIRXTXFECLK
TCELL147:IMUX_CE0SERDES.Q2X_TISCANIN0
TCELL147:IMUX_CE1SERDES.Q2X_TISCANIN10
TCELL147:IMUX_CE2SERDES.Q2X_TISCANIN8
TCELL147:IMUX_CE3SERDES.Q2X_TISCANIN1
TCELL147:OUT_F0SERDES.Q2EA1_CORXSTATVEC1
TCELL147:OUT_F1SERDES.Q2EA1_CORXSTATVEC0
TCELL147:OUT_F2SERDES.Q2EA1_CORXSTATVEC2
TCELL147:OUT_F3SERDES.Q2EA3_CORXEOF
TCELL147:OUT_F4SERDES.Q2EA2_GODISCARDFCS
TCELL147:OUT_F5SERDES.Q2EA1_CORXSTATVEC7
TCELL147:OUT_F6SERDES.Q2EA1_CORXSTATVEC6
TCELL147:OUT_F7SERDES.Q2EA1_CORXSTATVEC5
TCELL147:OUT_Q0SERDES.Q2EA1_CORXSTATVEC3
TCELL147:OUT_Q1SERDES.Q2EA3_GOTXMACDATA0
TCELL147:OUT_Q2SERDES.Q2EA1_CORXSTATEN
TCELL147:OUT_Q3SERDES.Q2X_TOSCANOUT8
TCELL147:OUT_Q4SERDES.Q2EA1_CORXSTATVEC4
TCELL147:OUT_Q5SERDES.Q2EA3_GOTXMACDATA2
TCELL147:OUT_Q6SERDES.Q2EA3_GOTXMACWR
TCELL147:OUT_Q7SERDES.Q2EA3_GOTXMACDATA7
TCELL148:IMUX_A0SERDES.Q2EA2_CITXPAUSTIM14
TCELL148:IMUX_A1SERDES.Q2EA2_KITXMACCLKENEXT
TCELL148:IMUX_A2SERDES.Q2EA3_CITXFORCEERR
TCELL148:IMUX_A3SERDES.Q2EA2_CITXPAUSTIM13
TCELL148:IMUX_A4SERDES.Q2EA1_CIRXFULL
TCELL148:IMUX_A5SERDES.Q2EA2_CITXPAUSTIM8
TCELL148:IMUX_B0SERDES.Q2EA2_CITXPAUSTIM7
TCELL148:IMUX_B1SERDES.Q2EA2_CITXPAUSTIM12
TCELL148:IMUX_B2SERDES.Q2EA2_CITXPAUSTIM9
TCELL148:IMUX_B3SERDES.Q2EA2_CITXPAUSTIM3
TCELL148:IMUX_B4SERDES.Q2EA2_CITXPAUSTIM11
TCELL148:IMUX_B5SERDES.Q2EA2_CITXPAUSTIM10
TCELL148:IMUX_C0SERDES.Q2EA2_CITXPAUSTIM4
TCELL148:IMUX_C1SERDES.Q2EA2_CITXPAUSTIM6
TCELL148:IMUX_C2SERDES.Q2EA3_CITXPAUSREQ
TCELL148:IMUX_C3SERDES.Q2EA2_GISYNCRXD1
TCELL148:IMUX_C4SERDES.Q2EA2_GIIPGSHRINK
TCELL148:IMUX_C5SERDES.Q2EA2_GISYNCRXD3
TCELL148:IMUX_D0SERDES.Q2EA2_CIRXIGNOREPKT
TCELL148:IMUX_D1SERDES.Q2EA2_GISYNCRXDV
TCELL148:IMUX_D2SERDES.Q2EA2_GINONPADRXDV
TCELL148:IMUX_D3SERDES.Q2EA2_GISYNCRXD2
TCELL148:IMUX_D4SERDES.Q2EA2_GISYNCRXER
TCELL148:IMUX_D5SERDES.Q2EA2_GISYNCRXD7
TCELL148:IMUX_LSR0SERDES.Q2EB0_KIRSTN
TCELL148:IMUX_LSR1SERDES.Q2X_IRESETN
TCELL148:IMUX_CLK0_DELAYSERDES.Q2EA3_KITXMACCLK
TCELL148:IMUX_CLK1_DELAYSERDES.Q2EA3_KIRXMACCLK
TCELL148:IMUX_CE0SERDES.Q2X_TISCANIN6
TCELL148:IMUX_CE1SERDES.Q2X_TISCANIN29
TCELL148:IMUX_CE2SERDES.Q2X_TISCANIN25
TCELL148:IMUX_CE3SERDES.Q2X_TISCANIN11
TCELL148:OUT_F0SERDES.Q2EA3_GOTXMACDATA6
TCELL148:OUT_F1SERDES.Q2EA3_CORXERROR
TCELL148:OUT_F2SERDES.Q2EA3_GOTXMACDATA3
TCELL148:OUT_F3SERDES.Q2EA3_GOTXMACERR
TCELL148:OUT_F4SERDES.Q2EA3_GOTXMACDATA4
TCELL148:OUT_F5SERDES.Q2EA3_GOTXMACDATA5
TCELL148:OUT_F6SERDES.Q2EA2_KOGBITEN
TCELL148:OUT_F7SERDES.Q2EA2_GOTXMACDATA0
TCELL148:OUT_Q0SERDES.Q2EA3_CORXSTATEN
TCELL148:OUT_Q1SERDES.Q2EA3_CORXSTATVEC0
TCELL148:OUT_Q2SERDES.Q2EA3_CORXSTATVEC2
TCELL148:OUT_Q3SERDES.Q2EA3_CORXSTATVEC1
TCELL148:OUT_Q4SERDES.Q2EA3_CORXSTATVEC3
TCELL148:OUT_Q5SERDES.Q2EA3_CORXSTATVEC4
TCELL148:OUT_Q6SERDES.Q2EA3_CORXSTATVEC7
TCELL148:OUT_Q7SERDES.Q2EA3_GODISCARDFCS
TCELL149:IMUX_A0SERDES.Q2EA2_GISYNCRXD0
TCELL149:IMUX_A1SERDES.Q2EA2_GISYNCNIBDRIB
TCELL149:IMUX_A2SERDES.Q2EA2_GISYNCRXD6
TCELL149:IMUX_A3SERDES.Q2EA2_GISYNCRXD5
TCELL149:IMUX_A4SERDES.Q2EA2_GISYNCRXD4
TCELL149:IMUX_A5SERDES.Q2EA3_GISYNCCOL
TCELL149:IMUX_B0SERDES.Q2EA3_GISYNCCRS
TCELL149:IMUX_B1SERDES.Q2EA1_CITXDATA11
TCELL149:IMUX_B2SERDES.Q2EA1_CITXDATA8
TCELL149:IMUX_B3SERDES.Q2EA1_CITXDATA10
TCELL149:IMUX_B4SERDES.Q2EA1_CITXDATA9
TCELL149:IMUX_B5SERDES.Q2EA2_KITXGMIILPBK
TCELL149:IMUX_C0SERDES.Q2EA2_KIRXMACCLKENEXT
TCELL149:IMUX_C1SERDES.Q2EA1_CITXDATA12
TCELL149:IMUX_C2SERDES.Q2EA1_CITXDATA7
TCELL149:IMUX_C3SERDES.Q2EA1_CITXDATA14
TCELL149:IMUX_C4SERDES.Q2EA1_CITXDATA13
TCELL149:IMUX_C5SERDES.Q2EA3_CITXPAUSTIM15
TCELL149:IMUX_D0SERDES.Q2EA3_CITXPAUSTIM14
TCELL149:IMUX_D1SERDES.Q2EA1_CITXDATA5
TCELL149:IMUX_D2SERDES.Q2EA1_CITXDATA6
TCELL149:IMUX_D3SERDES.Q2EA1_CITXDATA2
TCELL149:IMUX_D4SERDES.Q2EA3_CITXPAUSTIM10
TCELL149:IMUX_D5SERDES.Q2EA3_CITXPAUSTIM9
TCELL149:IMUX_LSR0SERDES.Q2EB2_KIRSTN
TCELL149:IMUX_LSR1SERDES.Q2EB3_KIRSTN
TCELL149:IMUX_CLK0_DELAYSERDES.Q2EA1_KIRXTXFECLK
TCELL149:IMUX_CLK1_DELAYSERDES.Q2EA1_KIRXMACCLK
TCELL149:IMUX_CE0SERDES.Q2X_TISCANIN24
TCELL149:IMUX_CE1SERDES.Q2X_TISCANIN13
TCELL149:IMUX_CE2SERDES.Q2X_TISCANIN12
TCELL149:IMUX_CE3SERDES.Q2X_TISCANIN15
TCELL149:OUT_F0SERDES.Q2EA3_CORXSTATVEC6
TCELL149:OUT_F1SERDES.Q2EA3_CORXSTATVEC5
TCELL149:OUT_F2SERDES.Q2EA0_KORXMACCLKEN
TCELL149:OUT_F3SERDES.Q2EA0_COTXREAD
TCELL149:OUT_F4SERDES.Q2EA0_COTXSTATVEC7
TCELL149:OUT_F5SERDES.Q2EA0_GODISCARDFCS
TCELL149:OUT_F6SERDES.Q2X_TOSCANOUT21
TCELL149:OUT_F7SERDES.Q2EA3_KOGBITEN
TCELL149:OUT_Q0SERDES.Q2EA3_GOTXMACDATA1
TCELL149:OUT_Q1SERDES.Q2EA1_COTXSTATVEC7
TCELL149:OUT_Q2SERDES.Q2EA1_COTXSTATVEC3
TCELL149:OUT_Q3SERDES.Q2EA1_COTXSTATVEC5
TCELL149:OUT_Q4SERDES.Q2EA1_COTXSTATVEC6
TCELL149:OUT_Q5SERDES.Q2X_TOSCANOUT2
TCELL149:OUT_Q6SERDES.Q2EA3_KORXMACCLKEN
TCELL149:OUT_Q7SERDES.Q2EA1_COTXREAD
TCELL150:IMUX_A0SERDES.Q2EA3_CITXPAUSTIM12
TCELL150:IMUX_A1SERDES.Q2EA3_CITXPAUSTIM8
TCELL150:IMUX_A2SERDES.Q2EA1_CITXDATA4
TCELL150:IMUX_A3SERDES.Q2EA3_CITXPAUSTIM7
TCELL150:IMUX_A4SERDES.Q2EA1_CITXDATA15
TCELL150:IMUX_A5SERDES.Q2EA3_CITXPAUSTIM0
TCELL150:IMUX_B0SERDES.Q2EA1_CITXDATA3
TCELL150:IMUX_B1SERDES.Q2EA3_CITXPAUSTIM13
TCELL150:IMUX_B2SERDES.Q2EA1_CITXDATA1
TCELL150:IMUX_B3SERDES.Q2EA3_CITXPAUSTIM6
TCELL150:IMUX_B4SERDES.Q2EA3_CITXPAUSTIM5
TCELL150:IMUX_B5SERDES.Q2EA3_CITXPAUSTIM11
TCELL150:IMUX_C0SERDES.Q2EA3_CITXPAUSTIM3
TCELL150:IMUX_C1SERDES.Q2EA3_CITXPAUSTIM1
TCELL150:IMUX_C2SERDES.Q2EA3_CITXPAUSTIM2
TCELL150:IMUX_C3SERDES.Q2EA1_CITXLASTBYTEVLD
TCELL150:IMUX_C4SERDES.Q2EA3_CITXPAUSTIM4
TCELL150:IMUX_C5SERDES.Q2EA1_CITXDATA0
TCELL150:IMUX_D0SERDES.Q2EA3_KITXMACCLKENEXT
TCELL150:IMUX_D1SERDES.Q2EA0_CITXEMPTY
TCELL150:IMUX_D2SERDES.Q2EA1_CITXEOF
TCELL150:IMUX_D3SERDES.Q2EA0_CITXDATAAVAIL
TCELL150:IMUX_D4SERDES.Q2EA1_CITXDATAAVAIL
TCELL150:IMUX_D5SERDES.Q2EA1_CITXEMPTY
TCELL150:IMUX_LSR0SERDES.Q2EB1_KIRSTN
TCELL150:IMUX_LSR1SERDES.Q2X_TISCANEN
TCELL150:IMUX_CLK0_DELAYSERDES.Q2EA1_KITXMACCLK
TCELL150:IMUX_CLK1_DELAYSERDES.Q2EA0_KITXMACCLK
TCELL150:IMUX_CE0SERDES.Q2X_TIBISTBANKSEL1
TCELL150:IMUX_CE1SERDES.Q2X_TIBISTBANKSEL2
TCELL150:IMUX_CE2SERDES.Q2X_TIBISTBANKSEL3
TCELL150:IMUX_CE3SERDES.Q2X_TIBISTBANKSEL0
TCELL150:OUT_F0SERDES.Q2EA1_GODISCARDFCS
TCELL150:OUT_F1SERDES.Q2EA1_KORXMACCLKEN
TCELL150:OUT_F2SERDES.Q2EA0_COTXSTATVEC5
TCELL150:OUT_F3SERDES.Q2EA0_COTXSTATVEC0
TCELL150:OUT_F4SERDES.Q2EA0_COTXSTATVEC3
TCELL150:OUT_F5SERDES.Q2EA0_COTXSTATVEC6
TCELL150:OUT_F6SERDES.Q2EA0_COTXSTATVEC2
TCELL150:OUT_F7SERDES.Q2EA1_COTXDISCFRM
TCELL150:OUT_Q0SERDES.Q2EA0_COTXDISCFRM
TCELL150:OUT_Q1SERDES.Q2EA1_KOGBITEN
TCELL150:OUT_Q2SERDES.Q2EA0_KOGBITEN
TCELL150:OUT_Q3SERDES.Q2EA0_COTXDONE
TCELL150:OUT_Q4SERDES.Q2X_TOSCANOUT3
TCELL150:OUT_Q5SERDES.Q2X_TOSCANOUT26
TCELL150:OUT_Q6SERDES.Q2EA0_COTXSTATEN
TCELL150:OUT_Q7SERDES.Q2EA1_COTXSTATEN
TCELL151:IMUX_A0SERDES.Q2EA0_CIRXIGNOREPKT
TCELL151:IMUX_A1SERDES.Q2EA3_CIRXIGNOREPKT
TCELL151:IMUX_A2SERDES.Q2EA3_GISYNCRXDV
TCELL151:IMUX_A3SERDES.Q2EA3_GISYNCNIBDRIB
TCELL151:IMUX_A4SERDES.Q2EA3_GISYNCRXER
TCELL151:IMUX_A5SERDES.Q2EA0_GINONPADRXDV
TCELL151:IMUX_B0SERDES.Q2EA3_GINONPADRXDV
TCELL151:IMUX_B1SERDES.Q2EA3_GISYNCRXD7
TCELL151:IMUX_B2SERDES.Q2EA0_GISYNCRXDV
TCELL151:IMUX_B3SERDES.Q2EA0_GISYNCNIBDRIB
TCELL151:IMUX_B4SERDES.Q2EA3_GISYNCRXD6
TCELL151:IMUX_B5SERDES.Q2EA3_GISYNCRXD3
TCELL151:IMUX_C0SERDES.Q2EA3_GISYNCRXD5
TCELL151:IMUX_C1SERDES.Q2EA3_GIIPGSHRINK
TCELL151:IMUX_C2SERDES.Q2EA3_GISYNCRXD0
TCELL151:IMUX_C3SERDES.Q2EA0_CITXPAUSTIM13
TCELL151:IMUX_C4SERDES.Q2EA0_CITXPAUSTIM12
TCELL151:IMUX_C5SERDES.Q2EA0_CITXPAUSTIM4
TCELL151:IMUX_D0SERDES.Q2EA3_GISYNCRXD1
TCELL151:IMUX_D1SERDES.Q2EA0_CITXPAUSTIM11
TCELL151:IMUX_D2SERDES.Q2EA0_GISYNCRXER
TCELL151:IMUX_D3SERDES.Q2EA0_GISYNCRXD7
TCELL151:IMUX_D4SERDES.Q2EA0_CITXPAUSTIM6
TCELL151:IMUX_D5SERDES.Q2EA3_GISYNCRXD4
TCELL151:IMUX_LSR0SERDES.Q2X_TIBISTTESTMODE
TCELL151:IMUX_CLK0_DELAYSERDES.Q2EB0_KIRXMACCLK
TCELL151:IMUX_CLK1_DELAYSERDES.Q2EB0_KIRXTXFECLK
TCELL151:IMUX_CE0SERDES.Q2X_TIBISTWA7
TCELL151:IMUX_CE1SERDES.Q2X_TIBISTREN
TCELL151:IMUX_CE2SERDES.Q2X_TIBISTWA2
TCELL151:IMUX_CE3SERDES.Q2X_TIBISTWA3
TCELL151:OUT_F0SERDES.Q2EA1_COTXDONE
TCELL151:OUT_F1SERDES.Q2EA0_COTXSTATVEC1
TCELL151:OUT_F2SERDES.Q2EA0_COTXSTATVEC4
TCELL151:OUT_F3SERDES.Q2EA1_COTXSTATVEC0
TCELL151:OUT_F4SERDES.Q2EA1_COTXSTATVEC4
TCELL151:OUT_F5SERDES.Q2EA1_COTXSTATVEC1
TCELL151:OUT_F6SERDES.Q2EA1_COTXSTATVEC2
TCELL151:OUT_F7SERDES.Q2EA0_GOTXMACDATA6
TCELL151:OUT_Q0SERDES.Q2EA0_GOTXMACDATA7
TCELL151:OUT_Q1SERDES.Q2EA0_GOTXMACWR
TCELL151:OUT_Q2SERDES.Q2EA0_GOTXMACDATA5
TCELL151:OUT_Q3SERDES.Q2EA0_GOTXMACDATA4
TCELL151:OUT_Q4SERDES.Q2EA1_GOTXMACDATA0
TCELL151:OUT_Q5SERDES.Q2EA0_GOTXMACDATA3
TCELL151:OUT_Q6SERDES.Q2EA1_GOTXMACWR
TCELL151:OUT_Q7SERDES.Q2EA0_GOTXMACDATA2
TCELL152:IMUX_A2SERDES.Q2EA0_CITXPAUSTIM5
TCELL152:IMUX_A3SERDES.Q2EA0_CITXPAUSTIM3
TCELL152:IMUX_A4SERDES.Q2EA0_GIIPGSHRINK
TCELL152:IMUX_A5SERDES.Q2EA3_GISYNCRXD2
TCELL152:IMUX_B2SERDES.Q2EA0_CITXPAUSTIM1
TCELL152:IMUX_B3SERDES.Q2EA0_CITXPAUSTIM2
TCELL152:IMUX_B4SERDES.Q2EA0_CITXPAUSTIM10
TCELL152:IMUX_B5SERDES.Q2EA0_CITXPAUSTIM14
TCELL152:IMUX_C2SERDES.Q2EA0_CITXPAUSTIM7
TCELL152:IMUX_C3SERDES.Q2EA0_CITXPAUSTIM9
TCELL152:IMUX_C4SERDES.Q2EA0_CITXPAUSTIM0
TCELL152:IMUX_C5SERDES.Q2EA0_CITXPAUSTIM8
TCELL152:IMUX_D2SERDES.Q2EA0_CITXPAUSTIM15
TCELL152:IMUX_D3SERDES.Q2EA3_KITXGMIILPBK
TCELL152:IMUX_D4SERDES.Q2EA0_GISYNCRXD6
TCELL152:IMUX_D5SERDES.Q2EA0_GISYNCRXD5
TCELL152:IMUX_CLK1_DELAYSERDES.Q2EB0_KITXMACCLK
TCELL152:IMUX_CE1SERDES.Q2X_TIBISTWA4
TCELL152:IMUX_CE2SERDES.Q2X_TIBISTWA5
TCELL152:IMUX_CE3SERDES.Q2X_TIBISTTDI0
TCELL152:OUT_F2SERDES.Q2EA1_GOTXMACDATA3
TCELL152:OUT_F3SERDES.Q2EA1_GOTXMACDATA5
TCELL152:OUT_F4SERDES.Q2EA1_GOTXMACDATA2
TCELL152:OUT_F5SERDES.Q2EA1_GOTXMACDATA4
TCELL152:OUT_F6SERDES.Q2EA1_GOTXMACERR
TCELL152:OUT_F7SERDES.Q2EA1_GOTXMACDATA7
TCELL152:OUT_Q2SERDES.Q2EA1_GOTXMACDATA6
TCELL152:OUT_Q3SERDES.Q2EA0_GOTXMACDATA0
TCELL152:OUT_Q4SERDES.Q2EA0_GOTXMACERR
TCELL152:OUT_Q6SERDES.Q2EA1_GOTXMACDATA1
TCELL152:OUT_Q7SERDES.Q2X_TOSCANOUT12
TCELL153:IMUX_A0SERDES.Q2EA3_KIRXMACCLKENEXT
TCELL153:IMUX_A1SERDES.Q2EA1_CITXPAUSTIM3
TCELL153:IMUX_A2SERDES.Q2EA1_CITXPAUSTIM2
TCELL153:IMUX_A3SERDES.Q2EA0_GISYNCRXD0
TCELL153:IMUX_A4SERDES.Q2EA0_GISYNCRXD4
TCELL153:IMUX_A5SERDES.Q2EA1_CITXPAUSTIM13
TCELL153:IMUX_B0SERDES.Q2EA0_GISYNCRXD1
TCELL153:IMUX_B1SERDES.Q2EA1_CITXPAUSTIM4
TCELL153:IMUX_B2SERDES.Q2EA1_CITXPAUSTIM5
TCELL153:IMUX_B3SERDES.Q2EA1_CITXPAUSTIM6
TCELL153:IMUX_B4SERDES.Q2EA1_CITXPAUSTIM14
TCELL153:IMUX_B5SERDES.Q2EA0_GISYNCRXD3
TCELL153:IMUX_C0SERDES.Q2EA1_KITXMACCLKENEXT
TCELL153:IMUX_C1SERDES.Q2EA0_KITXMACCLKENEXT
TCELL153:IMUX_C2SERDES.Q2EA0_CITXPAUSREQ
TCELL153:IMUX_C3SERDES.Q2EA0_GISYNCRXD2
TCELL153:IMUX_C4SERDES.Q2EA1_CITXPAUSTIM12
TCELL153:IMUX_C5SERDES.Q2EA1_CITXFIFOCTRL
TCELL153:IMUX_D0SERDES.Q2EA1_CITXPAUSTIM1
TCELL153:IMUX_D1SERDES.Q2EA1_CITXPAUSTIM0
TCELL153:IMUX_D2SERDES.Q2EA1_CITXPAUSTIM7
TCELL153:IMUX_D3SERDES.Q2EA1_CITXPAUSTIM11
TCELL153:IMUX_D4SERDES.Q2EA1_CITXPAUSTIM10
TCELL153:IMUX_D5SERDES.Q2EA1_CITXPAUSTIM8
TCELL153:IMUX_CLK0_DELAYSERDES.Q2EB1_KIRXMACCLK
TCELL153:IMUX_CLK1_DELAYSERDES.Q2EB1_KITXMACCLK
TCELL153:IMUX_CE0SERDES.Q2X_TIBISTWA6
TCELL153:IMUX_CE1SERDES.Q2X_TIBISTWEN
TCELL153:IMUX_CE2SERDES.Q2X_TIBISTTDI1
TCELL153:IMUX_CE3SERDES.Q2X_TIBISTTDI2
TCELL153:OUT_F0SERDES.Q2X_TOSCANOUT6
TCELL153:OUT_F1SERDES.Q2X_TOSCANOUT4
TCELL153:OUT_F2SERDES.Q2X_TOSCANOUT25
TCELL153:OUT_F3SERDES.Q2X_TOSCANOUT11
TCELL153:OUT_F4SERDES.Q2X_TOSCANOUT1
TCELL153:OUT_F5SERDES.Q2EA0_GOTXMACDATA1
TCELL153:OUT_F6SERDES.Q2X_TOSCANOUT13
TCELL153:OUT_F7SERDES.Q2X_TOSCANOUT14
TCELL153:OUT_Q0SERDES.Q2X_CSO132
TCELL153:OUT_Q1SERDES.Q2X_CSO62
TCELL153:OUT_Q2SERDES.Q2X_CSO94
TCELL153:OUT_Q3SERDES.Q2X_CSO89
TCELL153:OUT_Q4SERDES.Q2X_CSO61
TCELL153:OUT_Q5SERDES.Q2X_CSO7
TCELL153:OUT_Q6SERDES.Q2X_CSO2
TCELL153:OUT_Q7SERDES.Q2X_CSO32
TCELL154:IMUX_A0SERDES.Q2EA1_CITXPAUSTIM15
TCELL154:IMUX_A1SERDES.Q2EA1_CITXPAUSTIM9
TCELL154:IMUX_A2SERDES.Q2EA0_KITXGMIILPBK
TCELL154:IMUX_A3SERDES.Q2EA0_KIRXMACCLKENEXT
TCELL154:IMUX_A4SERDES.Q2EA1_CIRXIGNOREPKT
TCELL154:IMUX_A5SERDES.Q2EA1_CITXFORCEERR
TCELL154:IMUX_B0SERDES.Q2EA1_GISYNCRXDV
TCELL154:IMUX_B1SERDES.Q2EA1_CITXPAUSREQ
TCELL154:IMUX_B2SERDES.Q2EA0_CITXFORCEERR
TCELL154:IMUX_B3SERDES.Q2EA1_GISYNCNIBDRIB
TCELL154:IMUX_B4SERDES.Q2EA1_GINONPADRXDV
TCELL154:IMUX_B5SERDES.Q2EA0_GISYNCCRS
TCELL154:IMUX_C0SERDES.Q2EA1_GISYNCRXER
TCELL154:IMUX_C1SERDES.Q2EA0_GISYNCCOL
TCELL154:IMUX_C2SERDES.Q2EA1_GISYNCRXD3
TCELL154:IMUX_C3SERDES.Q2EA1_GISYNCRXD7
TCELL154:IMUX_C4SERDES.Q2EA1_GIIPGSHRINK
TCELL154:IMUX_C5SERDES.Q2EA1_GISYNCRXD0
TCELL154:IMUX_D0SERDES.Q2EA1_GISYNCRXD5
TCELL154:IMUX_D1SERDES.Q2EA1_GISYNCRXD6
TCELL154:IMUX_D2SERDES.Q2EA1_GISYNCRXD1
TCELL154:IMUX_D3SERDES.Q2EA1_GISYNCRXD4
TCELL154:IMUX_D4SERDES.Q2EA1_GISYNCRXD2
TCELL154:IMUX_D5SERDES.Q2EA1_KIRXMACCLKENEXT
TCELL154:IMUX_CLK0_DELAYSERDES.Q2EB1_KIRXTXFECLK
TCELL154:IMUX_CLK1_DELAYSERDES.Q2EB2_KIRXMACCLK
TCELL154:IMUX_CE0SERDES.Q2X_TIBISTTDI3
TCELL154:IMUX_CE1SERDES.Q2X_TIBISTTDI33
TCELL154:IMUX_CE2SERDES.Q2X_TIBISTTDI35
TCELL154:IMUX_CE3SERDES.Q2X_TIBISTTDI6
TCELL154:OUT_F0SERDES.Q2X_CSO36
TCELL154:OUT_F1SERDES.Q2X_CSO56
TCELL154:OUT_F2SERDES.Q2X_CSO57
TCELL154:OUT_F3SERDES.Q2X_CSO88
TCELL154:OUT_F4SERDES.Q2X_CSO63
TCELL154:OUT_F5SERDES.Q2X_CSO58
TCELL154:OUT_F6SERDES.Q2X_CSO90
TCELL154:OUT_F7SERDES.Q2X_CSO92
TCELL154:OUT_Q0SERDES.Q2X_CSO128
TCELL154:OUT_Q1SERDES.Q2X_CSO136
TCELL154:OUT_Q2SERDES.Q2X_CSO120
TCELL154:OUT_Q3SERDES.Q2X_CSO91
TCELL154:OUT_Q4SERDES.Q2X_CSO44
TCELL154:OUT_Q5SERDES.Q2X_CSO93
TCELL154:OUT_Q6SERDES.Q2X_CSO40
TCELL154:OUT_Q7SERDES.Q2X_CSO3
TCELL155:IMUX_A0SERDES.Q2EA0_CITXFIFOCTRL
TCELL155:IMUX_A1SERDES.Q2EA1_KITXGMIILPBK
TCELL155:IMUX_A2SERDES.Q2EA1_GISYNCCRS
TCELL155:IMUX_A3SERDES.Q2EA1_GISYNCCOL
TCELL155:IMUX_B0SERDES.Q2EB0_GISYNCRXER
TCELL155:IMUX_B1SERDES.Q2EB0_GINONPADRXDV
TCELL155:IMUX_B2SERDES.Q2EB0_GISYNCRXD6
TCELL155:IMUX_B3SERDES.Q2EB0_GIIPGSHRINK
TCELL155:IMUX_C0SERDES.Q2EB0_GISYNCRXDV
TCELL155:IMUX_C1SERDES.Q2EB0_GISYNCRXD3
TCELL155:IMUX_C2SERDES.Q2EB0_GISYNCNIBDRIB
TCELL155:IMUX_C3SERDES.Q2EB0_GISYNCRXD0
TCELL155:IMUX_D0SERDES.Q2EB0_GISYNCRXD2
TCELL155:IMUX_D1SERDES.Q2EB0_CIRXIGNOREPKT
TCELL155:IMUX_D2SERDES.Q2EB0_GISYNCRXD5
TCELL155:IMUX_D3SERDES.Q2EB0_GISYNCRXD4
TCELL155:IMUX_CLK0_DELAYSERDES.Q2X_ITXMACCLK
TCELL155:IMUX_CE0SERDES.Q2X_TIBISTTDI34
TCELL155:IMUX_CE1SERDES.Q2X_TIBISTTDI5
TCELL155:IMUX_CE3SERDES.Q2X_TIBISTTDI4
TCELL155:OUT_F0SERDES.Q2X_CSO60
TCELL155:OUT_F1SERDES.Q2X_CSO5
TCELL155:OUT_F2SERDES.Q2X_CSO6
TCELL155:OUT_F3SERDES.Q2X_CSO95
TCELL155:OUT_F6SERDES.Q2X_CSO124
TCELL155:OUT_F7SERDES.Q2X_CSO59
TCELL155:OUT_Q0SERDES.Q2X_CSO4
TCELL155:OUT_Q1SERDES.Q2X_CSO1
TCELL155:OUT_Q2SERDES.Q2X_CSO0
TCELL155:OUT_Q3SERDES.Q2X_CSO103
TCELL155:OUT_Q6SERDES.Q2X_CSO100
TCELL155:OUT_Q7SERDES.Q2X_CSO98
TCELL156:IMUX_A0SERDES.Q2EB0_GISYNCRXD7
TCELL156:IMUX_A1SERDES.Q2EB0_GISYNCRXD1
TCELL156:IMUX_A2SERDES.Q2EB0_KITXGMIILPBK
TCELL156:IMUX_A3SERDES.Q2EB0_KIRXMACCLKENEXT
TCELL156:IMUX_A4SERDES.Q2EB0_KITXMACCLKENEXT
TCELL156:IMUX_A5SERDES.Q2EB0_CITXDATA4
TCELL156:IMUX_B0SERDES.Q2EB0_CITXDATA5
TCELL156:IMUX_B1SERDES.Q2EB0_CITXDATA6
TCELL156:IMUX_B2SERDES.Q2EB0_CITXPAUSTIM2
TCELL156:IMUX_B3SERDES.Q2EB0_CITXPAUSTIM3
TCELL156:IMUX_B4SERDES.Q2EB0_CITXDATA1
TCELL156:IMUX_B5SERDES.Q2EB0_CITXPAUSTIM14
TCELL156:IMUX_C0SERDES.Q2EB0_CITXDATA3
TCELL156:IMUX_C1SERDES.Q2EB0_CITXPAUSTIM6
TCELL156:IMUX_C2SERDES.Q2EB0_CITXDATA2
TCELL156:IMUX_C3SERDES.Q2EB0_CITXPAUSTIM13
TCELL156:IMUX_C4SERDES.Q2EB0_CITXDATA7
TCELL156:IMUX_C5SERDES.Q2EB0_CITXPAUSTIM7
TCELL156:IMUX_D0SERDES.Q2EB0_CITXPAUSTIM5
TCELL156:IMUX_D1SERDES.Q2EB0_CITXPAUSTIM4
TCELL156:IMUX_D2SERDES.Q2EB0_CITXPAUSTIM12
TCELL156:IMUX_D3SERDES.Q2EB0_CITXPAUSTIM11
TCELL156:IMUX_D4SERDES.Q2EB0_CITXPAUSTIM8
TCELL156:IMUX_D5SERDES.Q2EB0_CITXPAUSTIM1
TCELL156:IMUX_CLK0_DELAYSERDES.Q2EB2_KITXMACCLK
TCELL156:IMUX_CLK1_DELAYSERDES.Q2EB2_KIRXTXFECLK
TCELL156:IMUX_CE0SERDES.Q2X_TIBISTTDI32
TCELL156:IMUX_CE1SERDES.Q2X_TIBISTTDI8
TCELL156:IMUX_CE2SERDES.Q2X_TIBISTTDI9
TCELL156:IMUX_CE3SERDES.Q2X_TIBISTTDI7
TCELL156:OUT_F0SERDES.Q2X_CSO101
TCELL156:OUT_F1SERDES.Q2X_CSO102
TCELL156:OUT_F2SERDES.Q2X_CSO137
TCELL156:OUT_F3SERDES.Q2X_CSO99
TCELL156:OUT_F4SERDES.Q2X_CSO133
TCELL156:OUT_F5SERDES.Q2X_CSO125
TCELL156:OUT_F6SERDES.Q2X_CSO97
TCELL156:OUT_F7SERDES.Q2X_CSO96
TCELL156:OUT_Q0SERDES.Q2X_CSO69
TCELL156:OUT_Q1SERDES.Q2X_CSO121
TCELL156:OUT_Q2SERDES.Q2X_CSO45
TCELL156:OUT_Q3SERDES.Q2X_GSO4
TCELL156:OUT_Q4SERDES.Q2X_CSO129
TCELL156:OUT_Q5SERDES.Q2X_CSO70
TCELL156:OUT_Q6SERDES.Q2X_CSO71
TCELL156:OUT_Q7SERDES.Q2X_CSO68
TCELL157:IMUX_A0SERDES.Q2EB0_CITXPAUSTIM10
TCELL157:IMUX_A1SERDES.Q2EB0_CITXPAUSTIM9
TCELL157:IMUX_A2SERDES.Q2EB0_CITXPAUSTIM0
TCELL157:IMUX_A3SERDES.Q2EB0_CITXDATA0
TCELL157:IMUX_A4SERDES.Q2EB0_CITXPAUSTIM15
TCELL157:IMUX_A5SERDES.Q2EB0_CITXEOF
TCELL157:IMUX_B0SERDES.Q2EB0_GISYNCCOL
TCELL157:IMUX_B1SERDES.Q2EB0_GISYNCCRS
TCELL157:IMUX_B2SERDES.Q2EB0_CITXDATAAVAIL
TCELL157:IMUX_B3SERDES.Q2EB0_CITXPAUSEREQ
TCELL157:IMUX_B4SERDES.Q2EB1_GINONPADRXDV
TCELL157:IMUX_B5SERDES.Q2EB1_GISYNCRXDV
TCELL157:IMUX_C0SERDES.Q2EB1_GISYNCRXD0
TCELL157:IMUX_C1SERDES.Q2EB1_GISYNCRXER
TCELL157:IMUX_C2SERDES.Q2EB1_GISYNCNIBDRIB
TCELL157:IMUX_C3SERDES.Q2EB1_GISYNCRXD7
TCELL157:IMUX_C4SERDES.Q2EB1_GISYNCRXD5
TCELL157:IMUX_C5SERDES.Q2EB1_GISYNCRXD4
TCELL157:IMUX_D0SERDES.Q2EB1_GISYNCRXD2
TCELL157:IMUX_D1SERDES.Q2EB1_GISYNCRXD6
TCELL157:IMUX_D2SERDES.Q2EB1_GISYNCRXD3
TCELL157:IMUX_D3SERDES.Q2EB1_CIRXIGNOREPKT
TCELL157:IMUX_D4SERDES.Q2EB0_CITXFIFOCTRL
TCELL157:IMUX_D5SERDES.Q2EB1_GIIPGSHRINK
TCELL157:IMUX_CLK0_DELAYSERDES.Q2X_IRXMACCLK
TCELL157:IMUX_CLK1_DELAYSERDES.Q2EB3_KIRXMACCLK
TCELL157:IMUX_CE0SERDES.Q2X_TIBISTRA7
TCELL157:IMUX_CE1SERDES.Q2X_TIBISTWA0
TCELL157:IMUX_CE2SERDES.Q2X_TISCANIN28
TCELL157:IMUX_CE3SERDES.Q2X_TIBISTTDI31
TCELL157:OUT_F0SERDES.Q2X_GSO11
TCELL157:OUT_F1SERDES.Q2X_GSO15
TCELL157:OUT_F2SERDES.Q2X_GSO19
TCELL157:OUT_F3SERDES.Q2X_GSO20
TCELL157:OUT_F4SERDES.Q2X_CSO64
TCELL157:OUT_F5SERDES.Q2X_CSO65
TCELL157:OUT_F6SERDES.Q2X_CSO66
TCELL157:OUT_F7SERDES.Q2X_CSO67
TCELL157:OUT_Q0SERDES.Q2X_GSO16
TCELL157:OUT_Q1SERDES.Q2X_GSO18
TCELL157:OUT_Q2SERDES.Q2X_GSO22
TCELL157:OUT_Q3SERDES.Q2X_GSO13
TCELL157:OUT_Q4SERDES.Q2X_GSO17
TCELL157:OUT_Q5SERDES.Q2X_GSO10
TCELL157:OUT_Q6SERDES.Q2X_GSO21
TCELL157:OUT_Q7SERDES.Q2X_GSO9
TCELL158:IMUX_A0SERDES.Q2EB0_CITXEMPTY
TCELL158:IMUX_A1SERDES.Q2EB1_GISYNCRXD1
TCELL158:IMUX_A2SERDES.Q2EB1_KITXGMIILPBK
TCELL158:IMUX_A3SERDES.Q2EB0_CITXFORCEERR
TCELL158:IMUX_A6SERDES.Q2EB2_GISYNCRXD1
TCELL158:IMUX_A7SERDES.Q2EB2_GISYNCRXD4
TCELL158:IMUX_B0SERDES.Q2EB1_KIRXMACCLKENEXT
TCELL158:IMUX_B1SERDES.Q2EB2_CIRXIGNOREPKT
TCELL158:IMUX_B2SERDES.Q2EB1_KITXMACCLKENEXT
TCELL158:IMUX_B3SERDES.Q2EB2_GISYNCRXDV
TCELL158:IMUX_B6SERDES.Q2EB1_CITXPAUSTIM3
TCELL158:IMUX_B7SERDES.Q2EB1_CITXPAUSTIM2
TCELL158:IMUX_C0SERDES.Q2EB2_GINONPADRXDV
TCELL158:IMUX_C1SERDES.Q2EB2_GISYNCNIBDRIB
TCELL158:IMUX_C2SERDES.Q2EB2_GISYNCRXER
TCELL158:IMUX_C3SERDES.Q2EB2_GISYNCRXD0
TCELL158:IMUX_C6SERDES.Q2EB1_CITXPAUSTIM8
TCELL158:IMUX_C7SERDES.Q2EB1_CITXPAUSTIM7
TCELL158:IMUX_D0SERDES.Q2EB2_GISYNCRXD2
TCELL158:IMUX_D1SERDES.Q2EB2_GISYNCRXD7
TCELL158:IMUX_D2SERDES.Q2EB2_GIIPGSHRINK
TCELL158:IMUX_D3SERDES.Q2EB2_GISYNCRXD6
TCELL158:IMUX_D6SERDES.Q2EB1_CITXPAUSTIM14
TCELL158:IMUX_D7SERDES.Q2EB1_CITXPAUSTIM15
TCELL158:IMUX_CLK1_DELAYSERDES.Q2EB3_KITXMACCLK
TCELL158:IMUX_CE0SERDES.Q2X_TIBISTTDI13
TCELL158:IMUX_CE1SERDES.Q2X_TIBISTTDI11
TCELL158:IMUX_CE2SERDES.Q2X_TIBISTTDI10
TCELL158:IMUX_CE3SERDES.Q2X_TIBISTTDI30
TCELL158:OUT_F0SERDES.Q2X_GSO1
TCELL158:OUT_F1SERDES.Q2X_GSO5
TCELL158:OUT_F2SERDES.Q2X_GSO12
TCELL158:OUT_F3SERDES.Q2X_GSO14
TCELL158:OUT_F4SERDES.Q2X_GSO8
TCELL158:OUT_F5SERDES.Q2X_GSO23
TCELL158:OUT_F6SERDES.Q2X_CSO33
TCELL158:OUT_F7SERDES.Q2X_KSO7
TCELL158:OUT_Q0SERDES.Q2X_TOSCANOUT15
TCELL158:OUT_Q1SERDES.Q2X_KSO0
TCELL158:OUT_Q2SERDES.Q2X_KSO1
TCELL158:OUT_Q3SERDES.Q2X_KSO3
TCELL158:OUT_Q4SERDES.Q2X_KSO4
TCELL158:OUT_Q5SERDES.Q2X_KSO5
TCELL158:OUT_Q6SERDES.Q2X_GSO41
TCELL158:OUT_Q7SERDES.Q2X_GSO42
TCELL159:IMUX_A0SERDES.Q2EB2_GISYNCRXD5
TCELL159:IMUX_A1SERDES.Q2EB1_CITXPAUSTIM1
TCELL159:IMUX_A2SERDES.Q2EB2_GISYNCRXD3
TCELL159:IMUX_A3SERDES.Q2EB1_CITXPAUSTIM0
TCELL159:IMUX_A6SERDES.Q2EB2_KIRXMACCLKENEXT
TCELL159:IMUX_A7SERDES.Q2EB1_CITXDATA2
TCELL159:IMUX_B0SERDES.Q2EB0_CIRXFULL
TCELL159:IMUX_B1SERDES.Q2EB1_CITXPAUSTIM4
TCELL159:IMUX_B2SERDES.Q2EB1_CITXPAUSTIM6
TCELL159:IMUX_B3SERDES.Q2EB1_CITXPAUSTIM5
TCELL159:IMUX_B6SERDES.Q2EB1_CITXDATA7
TCELL159:IMUX_B7SERDES.Q2EB1_CITXDATA0
TCELL159:IMUX_C0SERDES.Q2EB1_CITXPAUSTIM11
TCELL159:IMUX_C1SERDES.Q2EB1_CITXPAUSTIM10
TCELL159:IMUX_C2SERDES.Q2EB1_CITXPAUSTIM9
TCELL159:IMUX_C3SERDES.Q2EB1_CITXPAUSTIM12
TCELL159:IMUX_C6SERDES.Q2EB2_CITXPAUSTIM6
TCELL159:IMUX_C7SERDES.Q2EB2_CITXPAUSTIM5
TCELL159:IMUX_D0SERDES.Q2EB1_CITXPAUSTIM13
TCELL159:IMUX_D1SERDES.Q2EB2_KITXGMIILPBK
TCELL159:IMUX_D2SERDES.Q2EB1_GISYNCCRS
TCELL159:IMUX_D3SERDES.Q2EB1_GISYNCCOL
TCELL159:IMUX_D6SERDES.Q2EB2_CITXPAUSTIM4
TCELL159:IMUX_D7SERDES.Q2EB2_CITXPAUSTIM14
TCELL159:IMUX_CLK1_DELAYSERDES.Q2EB3_KIRXTXFECLK
TCELL159:IMUX_CE0SERDES.Q2X_TIBISTTDI28
TCELL159:IMUX_CE1SERDES.Q2X_TIBISTTDI15
TCELL159:IMUX_CE2SERDES.Q2X_TIBISTTDI12
TCELL159:IMUX_CE3SERDES.Q2X_TIBISTTDI17
TCELL159:OUT_F0SERDES.Q2X_GSO2
TCELL159:OUT_F1SERDES.Q2X_GSO3
TCELL159:OUT_F2SERDES.Q2X_GSO6
TCELL159:OUT_F3SERDES.Q2X_GSO7
TCELL159:OUT_F4SERDES.Q2X_GSO26
TCELL159:OUT_F5SERDES.Q2X_GSO40
TCELL159:OUT_F6SERDES.Q2X_CSO14
TCELL159:OUT_F7SERDES.Q2X_CSO15
TCELL159:OUT_Q0SERDES.Q2X_GSO43
TCELL159:OUT_Q1SERDES.Q2X_CSO8
TCELL159:OUT_Q2SERDES.Q2X_CSO10
TCELL159:OUT_Q3SERDES.Q2X_CSO37
TCELL159:OUT_Q4SERDES.Q2X_CSO12
TCELL159:OUT_Q5SERDES.Q2X_CSO13
TCELL159:OUT_Q6SERDES.Q2X_CSO110
TCELL159:OUT_Q7SERDES.Q2X_CSO111
TCELL160:IMUX_A0SERDES.Q2EB1_CITXDATA6
TCELL160:IMUX_A1SERDES.Q2EB1_CITXEOF
TCELL160:IMUX_A2SERDES.Q2EB1_CITXDATA3
TCELL160:IMUX_A3SERDES.Q2EB1_CITXDATA5
TCELL160:IMUX_A6SERDES.Q2EB1_CITXFORCEERR
TCELL160:IMUX_A7SERDES.Q2EB2_CITXPAUSTIM3
TCELL160:IMUX_B0SERDES.Q2EB1_CITXDATA1
TCELL160:IMUX_B1SERDES.Q2EB1_CITXDATA4
TCELL160:IMUX_B2SERDES.Q2EB1_CIRXFULL
TCELL160:IMUX_B3SERDES.Q2EB1_CITXEMPTY
TCELL160:IMUX_B6SERDES.Q2EB2_CITXPAUSTIM11
TCELL160:IMUX_B7SERDES.Q2EB2_CITXPAUSTIM15
TCELL160:IMUX_C0SERDES.Q2EB2_CITXPAUSTIM7
TCELL160:IMUX_C1SERDES.Q2EB2_KITXMACCLKENEXT
TCELL160:IMUX_C2SERDES.Q2EB2_CITXPAUSTIM8
TCELL160:IMUX_C3SERDES.Q2EB1_CITXPAUSEREQ
TCELL160:IMUX_C6SERDES.Q2X_ITXDATA35
TCELL160:IMUX_C7SERDES.Q2X_ITXDATA32
TCELL160:IMUX_D0SERDES.Q2EB2_CITXPAUSTIM13
TCELL160:IMUX_D1SERDES.Q2EB2_CITXPAUSTIM12
TCELL160:IMUX_D2SERDES.Q2EB2_CITXPAUSTIM2
TCELL160:IMUX_D3SERDES.Q2EB2_CITXPAUSTIM9
TCELL160:IMUX_D6SERDES.Q2X_ITXDATA29
TCELL160:IMUX_D7SERDES.Q2X_ITXDATA31
TCELL160:IMUX_CE0SERDES.Q2X_TIBISTRA6
TCELL160:IMUX_CE1SERDES.Q2X_TIBISTTDI19
TCELL160:IMUX_CE2SERDES.Q2X_TIBISTTDI26
TCELL160:IMUX_CE3SERDES.Q2X_TIBISTTDI22
TCELL160:OUT_F0SERDES.Q2X_CSO41
TCELL160:OUT_F1SERDES.Q2X_CSO75
TCELL160:OUT_F2SERDES.Q2X_CSO79
TCELL160:OUT_F3SERDES.Q2X_CSO106
TCELL160:OUT_F4SERDES.Q2X_CSO108
TCELL160:OUT_F5SERDES.Q2X_CSO109
TCELL160:OUT_F6SERDES.Q2X_CSO126
TCELL160:OUT_F7SERDES.Q2X_GSO33
TCELL160:OUT_Q0SERDES.Q2X_CSO130
TCELL160:OUT_Q1SERDES.Q2X_CSO134
TCELL160:OUT_Q2SERDES.Q2X_GSO0
TCELL160:OUT_Q3SERDES.Q2X_CSO9
TCELL160:OUT_Q4SERDES.Q2X_CSO105
TCELL160:OUT_Q5SERDES.Q2X_CSO107
TCELL160:OUT_Q6SERDES.Q2X_CSO122
TCELL160:OUT_Q7SERDES.Q2X_CSO138
TCELL161:IMUX_A0SERDES.Q2EB2_CITXPAUSTIM1
TCELL161:IMUX_A1SERDES.Q2EB2_CITXPAUSTIM0
TCELL161:IMUX_A2SERDES.Q2EB2_CITXPAUSTIM10
TCELL161:IMUX_A3SERDES.Q2EB1_CITXFIFOCTRL
TCELL161:IMUX_A6SERDES.Q2X_ITXDATA37
TCELL161:IMUX_A7SERDES.Q2X_ITXDATA51
TCELL161:IMUX_B0SERDES.Q2EB1_CITXDATAAVAIL
TCELL161:IMUX_B1SERDES.Q2EB2_CIRXFULL
TCELL161:IMUX_B2SERDES.Q2X_ITXDATA23
TCELL161:IMUX_B3SERDES.Q2X_ITXDATA30
TCELL161:IMUX_B6SERDES.Q2X_ITXDATA49
TCELL161:IMUX_B7SERDES.Q2X_ITXDATA26
TCELL161:IMUX_C0SERDES.Q2X_ITXDATA34
TCELL161:IMUX_C1SERDES.Q2X_ITXDATA48
TCELL161:IMUX_C2SERDES.Q2X_ITXDATA46
TCELL161:IMUX_C3SERDES.Q2X_ITXDATA45
TCELL161:IMUX_C6SERDES.Q2X_ITXDATA10
TCELL161:IMUX_C7SERDES.Q2X_ITXDATA12
TCELL161:IMUX_D0SERDES.Q2X_ITXDATA28
TCELL161:IMUX_D1SERDES.Q2X_ITXDATA47
TCELL161:IMUX_D2SERDES.Q2X_ITXDATA24
TCELL161:IMUX_D3SERDES.Q2X_ITXDATA36
TCELL161:IMUX_D6SERDES.Q2X_ITXDATA27
TCELL161:IMUX_D7SERDES.Q2X_ITXDATA25
TCELL161:IMUX_CE0SERDES.Q2X_TIBISTTDI14
TCELL161:IMUX_CE1SERDES.Q2X_TIBISTTDI29
TCELL161:IMUX_CE2SERDES.Q2X_TIBISTTDI20
TCELL161:IMUX_CE3SERDES.Q2X_TIBISTRA3
TCELL161:OUT_F0SERDES.Q2X_GSO25
TCELL161:OUT_F1SERDES.Q2X_GSO31
TCELL161:OUT_F2SERDES.Q2X_GSO34
TCELL161:OUT_F3SERDES.Q2X_GSO35
TCELL161:OUT_F4SERDES.Q2X_KSO14
TCELL161:OUT_F5SERDES.Q2X_GSO38
TCELL161:OUT_F6SERDES.Q2X_CSO74
TCELL161:OUT_F7SERDES.Q2X_CSO73
TCELL161:OUT_Q0SERDES.Q2X_CSO104
TCELL161:OUT_Q1SERDES.Q2X_CSO78
TCELL161:OUT_Q2SERDES.Q2X_GSO39
TCELL161:OUT_Q3SERDES.Q2X_CSO77
TCELL161:OUT_Q4SERDES.Q2X_GSO37
TCELL161:OUT_Q5SERDES.Q2X_CSO76
TCELL161:OUT_Q6SERDES.Q2X_GSO30
TCELL161:OUT_Q7SERDES.Q2X_GSO29
TCELL162:IMUX_A0SERDES.Q2X_ITXDATA53
TCELL162:IMUX_A1SERDES.Q2X_ITXDATA52
TCELL162:IMUX_A2SERDES.Q2X_ITXDATA41
TCELL162:IMUX_A3SERDES.Q2X_ITXDATA40
TCELL162:IMUX_A6SERDES.Q2X_ITXDATA19
TCELL162:IMUX_A7SERDES.Q2X_ITXDATA55
TCELL162:IMUX_B0SERDES.Q2X_ITXDATA22
TCELL162:IMUX_B1SERDES.Q2X_ITXDATA44
TCELL162:IMUX_B2SERDES.Q2X_ITXDATA21
TCELL162:IMUX_B3SERDES.Q2X_ITXDATA9
TCELL162:IMUX_B6SERDES.Q2X_ITXDATA8
TCELL162:IMUX_B7SERDES.Q2X_ITXDATA7
TCELL162:IMUX_C0SERDES.Q2X_ITXDATA33
TCELL162:IMUX_C1SERDES.Q2X_ITXDATA42
TCELL162:IMUX_C2SERDES.Q2X_ITXDATA38
TCELL162:IMUX_C3SERDES.Q2X_ITXDATA39
TCELL162:IMUX_C6SERDES.Q2X_ITXDATA43
TCELL162:IMUX_C7SERDES.Q2EB3_CITXPAUSTIM6
TCELL162:IMUX_D0SERDES.Q2X_ITXDATA13
TCELL162:IMUX_D1SERDES.Q2X_ITXDATA54
TCELL162:IMUX_D2SERDES.Q2X_ITXDATA14
TCELL162:IMUX_D3SERDES.Q2X_ITXDATA20
TCELL162:IMUX_D6SERDES.Q2EB3_CITXPAUSTIM4
TCELL162:IMUX_D7SERDES.Q2EB3_CITXPAUSTIM1
TCELL162:IMUX_CE0SERDES.Q2X_TIBISTTDI18
TCELL162:IMUX_CE1SERDES.Q2X_TIBISTTDI24
TCELL162:IMUX_CE2SERDES.Q2X_TIBISTTDI16
TCELL162:IMUX_CE3SERDES.Q2X_TIBISTRA1
TCELL162:OUT_F0SERDES.Q2X_KSO11
TCELL162:OUT_F1SERDES.Q2X_CSO72
TCELL162:OUT_F2SERDES.Q2X_KSO17
TCELL162:OUT_F3SERDES.Q2X_KSO2
TCELL162:OUT_F4SERDES.Q2X_CSO11
TCELL162:OUT_F5SERDES.Q2X_GSO32
TCELL162:OUT_F6SERDES.Q2X_GSO36
TCELL162:OUT_F7SERDES.Q2X_KSO18
TCELL162:OUT_Q0SERDES.Q2X_GSO28
TCELL162:OUT_Q1SERDES.Q2X_GSO27
TCELL162:OUT_Q2SERDES.Q2X_KSO12
TCELL162:OUT_Q3SERDES.Q2X_KSO8
TCELL162:OUT_Q4SERDES.Q2X_KSO9
TCELL162:OUT_Q5SERDES.Q2X_TOSCANOUT27
TCELL162:OUT_Q6SERDES.Q2X_KSO15
TCELL162:OUT_Q7SERDES.Q2X_TOSCANOUT20
TCELL163:IMUX_A0SERDES.Q2X_ITXDATA11
TCELL163:IMUX_A1SERDES.Q2X_ITXDATA4
TCELL163:IMUX_A2SERDES.Q2X_ITXDATA5
TCELL163:IMUX_A3SERDES.Q2X_ITXDATA50
TCELL163:IMUX_B0SERDES.Q2X_ITXDATA56
TCELL163:IMUX_B1SERDES.Q2X_ITXDATA6
TCELL163:IMUX_B2SERDES.Q2X_ITXDATA16
TCELL163:IMUX_B3SERDES.Q2EB3_CITXPAUSTIM12
TCELL163:IMUX_C0SERDES.Q2EB3_CITXPAUSTIM5
TCELL163:IMUX_C1SERDES.Q2EB3_CITXPAUSTIM7
TCELL163:IMUX_C2SERDES.Q2X_ITXDATA18
TCELL163:IMUX_C3SERDES.Q2EB3_CITXPAUSTIM14
TCELL163:IMUX_D0SERDES.Q2EB3_CITXPAUSTIM0
TCELL163:IMUX_D1SERDES.Q2X_ITXDATA17
TCELL163:IMUX_D2SERDES.Q2X_ITXDATA15
TCELL163:IMUX_D3SERDES.Q2X_ITXDATA3
TCELL163:IMUX_CE0SERDES.Q2X_TIBISTRA2
TCELL163:IMUX_CE1SERDES.Q2X_TIBISTRA0
TCELL163:IMUX_CE2SERDES.Q2X_TIBISTTDI27
TCELL163:OUT_F0SERDES.Q2X_GSO24
TCELL163:OUT_F1SERDES.Q2X_TOSCANOUT0
TCELL163:OUT_F2SERDES.Q2X_KSO16
TCELL163:OUT_F3SERDES.Q2X_TOSCANOUT5
TCELL163:OUT_F4SERDES.Q2X_KSO10
TCELL163:OUT_F5SERDES.Q2X_KSO13
TCELL163:OUT_Q0SERDES.Q2X_KSO19
TCELL163:OUT_Q1SERDES.Q2X_KSO6
TCELL163:OUT_Q2SERDES.Q2X_CSO135
TCELL163:OUT_Q3SERDES.Q2X_CSO114
TCELL163:OUT_Q4SERDES.Q2X_CSO113
TCELL163:OUT_Q5SERDES.Q2X_CSO131
TCELL164:IMUX_A0SERDES.Q2EB3_CITXPAUSTIM13
TCELL164:IMUX_A1SERDES.Q2EB3_KITXMACCLKENEXT
TCELL164:IMUX_A2SERDES.Q2EB3_CITXPAUSTIM3
TCELL164:IMUX_A3SERDES.Q2EB3_KIRXMACCLKENEXT
TCELL164:IMUX_A4SERDES.Q2EB3_CITXPAUSTIM2
TCELL164:IMUX_A5SERDES.Q2EB3_KITXGMIILPBK
TCELL164:IMUX_B0SERDES.Q2EB3_CITXPAUSTIM10
TCELL164:IMUX_B1SERDES.Q2EB3_CITXPAUSTIM11
TCELL164:IMUX_B2SERDES.Q2EB3_CITXPAUSTIM9
TCELL164:IMUX_B3SERDES.Q2EB3_CITXPAUSTIM8
TCELL164:IMUX_B4SERDES.Q2X_ITXDATA2
TCELL164:IMUX_B5SERDES.Q2EB3_CITXPAUSTIM15
TCELL164:IMUX_C0SERDES.Q2EB2_GISYNCCRS
TCELL164:IMUX_C1SERDES.Q2X_ITXDATA57
TCELL164:IMUX_C2SERDES.Q2X_ITXDATA58
TCELL164:IMUX_C3SERDES.Q2X_ITXDATA1
TCELL164:IMUX_C4SERDES.Q2EB2_GISYNCCOL
TCELL164:IMUX_C5SERDES.Q2X_ITXDATA0
TCELL164:IMUX_D0SERDES.Q2X_ITXDATA59
TCELL164:IMUX_D1SERDES.Q2EB3_GIIPGSHRINK
TCELL164:IMUX_D2SERDES.Q2X_ITXDATA60
TCELL164:IMUX_D3SERDES.Q2EB3_GISYNCRXD7
TCELL164:IMUX_D4SERDES.Q2EB3_GISYNCRXD5
TCELL164:IMUX_D5SERDES.Q2EB3_CIRXIGNOREPKT
TCELL164:IMUX_CE0SERDES.Q2X_TIBISTWA1
TCELL164:IMUX_CE1SERDES.Q2X_TIBISTTDI21
TCELL164:IMUX_CE2SERDES.Q2X_TIBISTRA5
TCELL164:IMUX_CE3SERDES.Q2X_TIBISTTDI25
TCELL164:OUT_F0SERDES.Q2X_CSO112
TCELL164:OUT_F1SERDES.Q2X_CSO116
TCELL164:OUT_F2SERDES.Q2X_CSO115
TCELL164:OUT_F3SERDES.Q2X_CSO127
TCELL164:OUT_F4SERDES.Q2X_CSO117
TCELL164:OUT_F5SERDES.Q2X_CSO34
TCELL164:OUT_F6SERDES.Q2X_CSO118
TCELL164:OUT_F7SERDES.Q2X_CSO119
TCELL164:OUT_Q0SERDES.Q2X_CSO140
TCELL164:OUT_Q1SERDES.Q2X_CSO139
TCELL164:OUT_Q2SERDES.Q2X_CSO80
TCELL164:OUT_Q3SERDES.Q2X_TOSCANOUT19
TCELL164:OUT_Q4SERDES.Q2X_CSO81
TCELL164:OUT_Q5SERDES.Q2X_CSO85
TCELL164:OUT_Q6SERDES.Q2X_CSO23
TCELL164:OUT_Q7SERDES.Q2X_CSO87
TCELL165:IMUX_A0SERDES.Q2EB3_GISYNCRXD4
TCELL165:IMUX_A1SERDES.Q2X_ITXDATA61
TCELL165:IMUX_A2SERDES.Q2EB3_GISYNCRXD6
TCELL165:IMUX_A3SERDES.Q2EB3_GINONPADRXDV
TCELL165:IMUX_A4SERDES.Q2EB3_GISYNCRXD3
TCELL165:IMUX_A5SERDES.Q2EB3_GISYNCRXD0
TCELL165:IMUX_B0SERDES.Q2EB3_GISYNCRXDV
TCELL165:IMUX_B1SERDES.Q2X_ITXBYTEN2
TCELL165:IMUX_B2SERDES.Q2X_ITXDATA62
TCELL165:IMUX_B3SERDES.Q2EB3_GISYNCNIBDRIB
TCELL165:IMUX_B4SERDES.Q2EB3_GISYNCRXER
TCELL165:IMUX_B5SERDES.Q2EB3_GISYNCRXD2
TCELL165:IMUX_C0SERDES.Q2EB3_GISYNCRXD1
TCELL165:IMUX_C1SERDES.Q2X_ITXBYTEN1
TCELL165:IMUX_C2SERDES.Q2X_ITXDATA63
TCELL165:IMUX_C3SERDES.Q2X_ITXBYTEN0
TCELL165:IMUX_C4SERDES.Q2X_ITXFORCEERR
TCELL165:IMUX_C5SERDES.Q2X_ITXEMPTY
TCELL165:IMUX_D0SERDES.Q2X_ITXDATAAVAIL
TCELL165:IMUX_D1SERDES.Q2X_ITXEOF
TCELL165:IMUX_D2SERDES.Q2EB2_CITXPAUSEREQ
TCELL165:IMUX_D3SERDES.Q2EB2_CITXEOF
TCELL165:IMUX_D4SERDES.Q2EB2_CITXFORCEERR
TCELL165:IMUX_D5SERDES.Q2EB2_CITXFIFOCTRL
TCELL165:IMUX_CE0SERDES.Q2X_TIBISTTDI23
TCELL165:IMUX_CE1SERDES.Q2X_TIBISTRA4
TCELL165:IMUX_CE2SERDES.Q2X_TISCANIN17
TCELL165:IMUX_CE3SERDES.Q2X_TISCANIN4
TCELL165:OUT_F0SERDES.Q2X_CSO83
TCELL165:OUT_F1SERDES.Q2X_CSO18
TCELL165:OUT_F2SERDES.Q2X_TOSCANOUT16
TCELL165:OUT_F3SERDES.Q2X_CSO84
TCELL165:OUT_F4SERDES.Q2X_CSO22
TCELL165:OUT_F5SERDES.Q2X_CSO82
TCELL165:OUT_F6SERDES.Q2X_CSO86
TCELL165:OUT_F7SERDES.Q2X_CSO42
TCELL165:OUT_Q0SERDES.Q2X_CSO17
TCELL165:OUT_Q1SERDES.Q2X_CSO16
TCELL165:OUT_Q2SERDES.Q2X_CSO21
TCELL165:OUT_Q3SERDES.Q2X_CSO38
TCELL165:OUT_Q4SERDES.Q2X_CSO123
TCELL165:OUT_Q5SERDES.Q2X_CSO46
TCELL165:OUT_Q6SERDES.Q2X_CSO20
TCELL165:OUT_Q7SERDES.Q2X_CSO19
TCELL166:IMUX_A0SERDES.Q2EB2_CITXDATAAVAIL
TCELL166:IMUX_A1SERDES.Q2EB2_CITXDATA0
TCELL166:IMUX_A2SERDES.Q2EB3_CIRXFULL
TCELL166:IMUX_A3SERDES.Q2EB2_CITXEMPTY
TCELL166:IMUX_A4SERDES.Q2EB2_CITXDATA2
TCELL166:IMUX_A5SERDES.Q2X_IIGNOREPKT
TCELL166:IMUX_B0SERDES.Q2EB2_CITXDATA1
TCELL166:IMUX_B1SERDES.Q2EB2_CITXDATA7
TCELL166:IMUX_B2SERDES.Q2EB2_CITXDATA3
TCELL166:IMUX_B3SERDES.Q2EB2_CITXDATA5
TCELL166:IMUX_B4SERDES.Q2EB2_CITXDATA4
TCELL166:IMUX_B5SERDES.Q2EB3_GISYNCCRS
TCELL166:IMUX_C0SERDES.Q2EB3_GISYNCCOL
TCELL166:IMUX_C1SERDES.Q2EB2_CITXDATA6
TCELL166:IMUX_C2SERDES.Q2X_ITXPAUSREQ
TCELL166:IMUX_C3SERDES.Q2EB3_CITXPAUSEREQ
TCELL166:IMUX_C4SERDES.Q2EB3_CITXFORCEERR
TCELL166:IMUX_C5SERDES.Q2EB3_CITXFIFOCTRL
TCELL166:IMUX_D0SERDES.Q2X_ITXPAUSTIM11
TCELL166:IMUX_D1SERDES.Q2X_ITXPAUSTIM9
TCELL166:IMUX_D2SERDES.Q2X_ITXPAUSTIM0
TCELL166:IMUX_D3SERDES.Q2X_ITXPAUSTIM12
TCELL166:IMUX_D4SERDES.Q2X_ITXPAUSTIM8
TCELL166:IMUX_D5SERDES.Q2X_ITXPAUSTIM15
TCELL166:IMUX_CE0SERDES.Q2X_TISCANIN19
TCELL166:IMUX_CE1SERDES.Q2X_TISCANIN16
TCELL166:IMUX_CE2SERDES.Q2X_TISCANIN27
TCELL166:IMUX_CE3SERDES.Q2X_TISCANIN20
TCELL166:OUT_F0SERDES.Q2X_CSO54
TCELL166:OUT_F1SERDES.Q2X_TOSCANOUT17
TCELL166:OUT_F2SERDES.Q2X_CSO52
TCELL166:OUT_F3SERDES.Q2X_CSO55
TCELL166:OUT_F4SERDES.Q2X_CSO53
TCELL166:OUT_F5SERDES.Q2X_CSO51
TCELL166:OUT_F6SERDES.Q2X_CSO49
TCELL166:OUT_F7SERDES.Q2X_CSO50
TCELL166:OUT_Q0SERDES.Q2X_CSO48
TCELL166:OUT_Q1SERDES.Q2X_CSO47
TCELL166:OUT_Q2SERDES.Q2X_CSO26
TCELL166:OUT_Q3SERDES.Q2X_CSO43
TCELL166:OUT_Q4SERDES.Q2X_CSO30
TCELL166:OUT_Q5SERDES.Q2X_CSO35
TCELL166:OUT_Q6SERDES.Q2X_CSO39
TCELL166:OUT_Q7SERDES.Q2X_CSO27
TCELL167:IMUX_A0SERDES.Q2X_ITXPAUSTIM14
TCELL167:IMUX_A1SERDES.Q2X_ITXPAUSTIM10
TCELL167:IMUX_A2SERDES.Q2X_ITXPAUSTIM13
TCELL167:IMUX_A3SERDES.Q2X_ITXPAUSTIM6
TCELL167:IMUX_A4SERDES.Q2X_ITXPAUSTIM4
TCELL167:IMUX_A5SERDES.Q2X_ITXPAUSTIM5
TCELL167:IMUX_B0SERDES.Q2X_ITXPAUSTIM7
TCELL167:IMUX_B1SERDES.Q2X_ITXPAUSTIM1
TCELL167:IMUX_B2SERDES.Q2X_ITXPAUSTIM3
TCELL167:IMUX_B3SERDES.Q2X_ITXPAUSTIM2
TCELL167:IMUX_B4SERDES.Q2EB3_CITXEOF
TCELL167:IMUX_B5SERDES.Q2EB3_CITXEMPTY
TCELL167:IMUX_C0SERDES.Q2EB3_CITXDATAAVAIL
TCELL167:IMUX_C1SERDES.Q2EB3_CITXDATA3
TCELL167:IMUX_C2SERDES.Q2EB3_CITXDATA0
TCELL167:IMUX_C3SERDES.Q2EB3_CITXDATA6
TCELL167:IMUX_C4SERDES.Q2EB3_CITXDATA5
TCELL167:IMUX_C5SERDES.Q2EB3_CITXDATA7
TCELL167:IMUX_D0SERDES.Q2EB3_CITXDATA1
TCELL167:IMUX_D1SERDES.Q2EB3_CITXDATA4
TCELL167:IMUX_D2SERDES.Q2EB3_CITXDATA2
TCELL167:IMUX_D3SERDES.Q2X_ITXMSG52
TCELL167:IMUX_D4SERDES.Q2X_ITXMSG55
TCELL167:IMUX_D5SERDES.Q2X_ITXMSG53
TCELL167:IMUX_CE0SERDES.Q2X_TISCANIN14
TCELL167:IMUX_CE1SERDES.Q2X_TISCANIN18
TCELL167:IMUX_CE2SERDES.Q2X_TISCANIN26
TCELL167:OUT_F0SERDES.Q2X_CSO25
TCELL167:OUT_F1SERDES.Q2X_CSO24
TCELL167:OUT_F2SERDES.Q2X_CSO28
TCELL167:OUT_F3SERDES.Q2X_CSO31
TCELL167:OUT_F4SERDES.Q2X_CSO29
TCELL167:OUT_F5SERDES.Q2X_TOSCANOUT18
TCELL167:OUT_F6SERDES.Q2X_TOSCANOUT28
TCELL168:IMUX_A0SERDES.Q2X_ITXMSG56
TCELL168:IMUX_A1SERDES.Q2X_ITXMSG54
TCELL168:IMUX_A2SERDES.Q2X_ITXMSG50
TCELL168:IMUX_A3SERDES.Q2X_ITXMSG51
TCELL168:IMUX_A4SERDES.Q2X_ITXMSG57
TCELL168:IMUX_A5SERDES.Q2X_ITXMSG49
TCELL168:IMUX_B0SERDES.Q2X_ITXMSG48
TCELL168:IMUX_B1SERDES.Q2X_ITXMSG58
TCELL168:IMUX_B2SERDES.Q2X_ITXMSG59
TCELL168:IMUX_B3SERDES.Q2X_ITXMSG60
TCELL168:IMUX_B4SERDES.Q2X_ITXMSG47
TCELL168:IMUX_B5SERDES.Q2X_ITXMSG46
TCELL168:IMUX_C0SERDES.Q2X_ITXMSG45
TCELL168:IMUX_C1SERDES.Q2X_ITXMSG0
TCELL168:IMUX_C2SERDES.Q2X_ITXMSG1
TCELL168:IMUX_C3SERDES.Q2X_ITXMSG44
TCELL168:IMUX_C4SERDES.Q2X_ITXMSG2
TCELL168:IMUX_C5SERDES.Q2X_ITXMSG3
TCELL168:IMUX_D0SERDES.Q2X_ITXMSG4
TCELL168:IMUX_D1SERDES.Q2X_ITXMSG61
TCELL168:IMUX_D2SERDES.Q2X_ITXMSG5
TCELL168:IMUX_D3SERDES.Q2X_ITXMSG6
TCELL168:IMUX_D4SERDES.Q2X_ITXMSG7
TCELL168:IMUX_D5SERDES.Q2X_ITXMSG8
TCELL169:IMUX_A0SERDES.Q2X_ITXMSG9
TCELL169:IMUX_A1SERDES.Q2X_ITXMSG10
TCELL169:IMUX_A2SERDES.Q2X_ITXMSG43
TCELL169:IMUX_A3SERDES.Q2X_ITXMSG11
TCELL169:IMUX_A4SERDES.Q2X_ITXMSG12
TCELL169:IMUX_A5SERDES.Q2X_ITXMSG13
TCELL169:IMUX_B0SERDES.Q2X_ITXMSG14
TCELL169:IMUX_B1SERDES.Q2X_ITXMSG15
TCELL169:IMUX_B2SERDES.Q2X_ITXMSG16
TCELL169:IMUX_B3SERDES.Q2X_ITXMSG17
TCELL169:IMUX_B4SERDES.Q2X_ITXMSG18
TCELL169:IMUX_B5SERDES.Q2X_ITXMSG19
TCELL169:IMUX_C0SERDES.Q2X_ITXMSG42
TCELL169:IMUX_C1SERDES.Q2X_ITXMSG20
TCELL169:IMUX_C2SERDES.Q2X_ITXMSG21
TCELL169:IMUX_C3SERDES.Q2X_ITXMSG22
TCELL169:IMUX_C4SERDES.Q2X_ITXMSG23
TCELL169:IMUX_C5SERDES.Q2X_ITXMSG24
TCELL169:IMUX_D0SERDES.Q2X_ITXMSG62
TCELL169:IMUX_D1SERDES.Q2X_ITXMSG25
TCELL169:IMUX_D2SERDES.Q2X_ITXMSG41
TCELL169:IMUX_D3SERDES.Q2X_ITXMSG37
TCELL169:IMUX_D4SERDES.Q2X_ITXMSG26
TCELL169:IMUX_D5SERDES.Q2X_ITXMSG27
TCELL170:IMUX_A0SERDES.Q2X_ITXMSG28
TCELL170:IMUX_A1SERDES.Q2X_ITXMSG29
TCELL170:IMUX_A2SERDES.Q2X_ITXMSG30
TCELL170:IMUX_A3SERDES.Q2X_ITXMSG31
TCELL170:IMUX_A4SERDES.Q2X_ITXMSG40
TCELL170:IMUX_A5SERDES.Q2X_ITXMSG32
TCELL170:IMUX_B0SERDES.Q2X_ITXMSG33
TCELL170:IMUX_B1SERDES.Q2X_ITXMSG34
TCELL170:IMUX_B2SERDES.Q2X_ITXMSG35
TCELL170:IMUX_B3SERDES.Q2X_ITXMSG36
TCELL170:IMUX_B4SERDES.Q2X_ITXMSG38
TCELL170:IMUX_B5SERDES.Q2X_ITXMSG39
TCELL170:IMUX_C0SERDES.Q2X_ITSMSGAVAIL
TCELL170:IMUX_C1SERDES.Q2X_ITXMSG63
TCELL176:IMUX_A0SERDES.CORNER_LSPLLPWRUP
TCELL176:IMUX_B0SERDES.CORNER_FCSYNCTOGGLE
TCELL176:IMUX_C0SERDES.CORNER_FCSCANMODE
TCELL176:IMUX_LSR0SERDES.CORNER_LSPLLRST
TCELL176:IMUX_CLK0_DELAYSERDES.CORNER_LSPLLREFCLKI
TCELL176:OUT_F0SERDES.CORNER_FOREFCK2CORE
TCELL176:OUT_Q0SERDES.CORNER_LSPLLLOL