SERDES
Tile SERDES1
Cells: 62
Bel SERDES
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| TCELL44:IMUX_C2 | SERDES.Q0P_HALMSTWBVLD4 | 
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| TCELL44:IMUX_D1 | SERDES.Q0P_HALMSTREQDES27 | 
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| TCELL44:OUT_Q3 | SERDES.Q0P_HALTGTREQDES117 | 
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| TCELL44:OUT_Q5 | SERDES.Q0P_HALTGTREQDES114 | 
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Tile SERDES2
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| TCELL69:IMUX_C3 | SERDES.Q1EA3_GISYNCRXER | 
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| TCELL69:IMUX_C6 | SERDES.Q1EA3_GINONPADRXDV | 
| TCELL69:IMUX_C7 | SERDES.Q1EA3_GISYNCRXD0 | 
| TCELL69:IMUX_D2 | SERDES.Q1EA3_GISYNCRXD6 | 
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| TCELL69:IMUX_D4 | SERDES.Q1EA3_GISYNCRXD2 | 
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| TCELL80:IMUX_C4 | SERDES.Q1S_OLLMEFPTR13 | 
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| TCELL81:OUT_Q3 | SERDES.Q1S_RESPTIMEOUT14 | 
| TCELL81:OUT_Q4 | SERDES.Q1S_RESPTIMEOUT10 | 
| TCELL81:OUT_Q5 | SERDES.Q1S_RESPTIMEOUT13 | 
| TCELL81:OUT_Q6 | SERDES.Q1S_RESPTIMEOUT11 | 
| TCELL81:OUT_Q7 | SERDES.Q1S_RESPTIMEOUT12 | 
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| TCELL82:IMUX_A6 | SERDES.Q1S_TLNKD40 | 
| TCELL82:IMUX_A7 | SERDES.Q1S_TLNKD39 | 
| TCELL82:IMUX_B2 | SERDES.Q1S_TLNKD50 | 
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| TCELL83:IMUX_D7 | SERDES.Q1S_TLNKD25 | 
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| TCELL83:IMUX_CE1 | SERDES.Q1S_TISCANI8 | 
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| TCELL83:IMUX_CE3 | SERDES.Q1S_TISCANI7 | 
| TCELL83:OUT_F0 | SERDES.Q1S_STATUS5 | 
| TCELL83:OUT_F1 | SERDES.Q1S_STATUS0 | 
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| TCELL83:OUT_F7 | SERDES.Q1S_TXINITN | 
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| TCELL83:OUT_Q1 | SERDES.Q1S_TXFLOWCTRLSTATE1 | 
| TCELL83:OUT_Q2 | SERDES.Q1S_STATUS4 | 
| TCELL83:OUT_Q3 | SERDES.Q1S_TISCANO24 | 
| TCELL83:OUT_Q4 | SERDES.Q1S_STATUS2 | 
| TCELL83:OUT_Q5 | SERDES.Q1S_TISCANO25 | 
| TCELL83:OUT_Q6 | SERDES.Q1S_TISCANO26 | 
| TCELL83:OUT_Q7 | SERDES.Q1S_STATUS18 | 
| TCELL84:IMUX_A2 | SERDES.Q1S_TLNKREM1 | 
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| TCELL84:IMUX_A4 | SERDES.Q1S_TLNKD0 | 
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| TCELL84:IMUX_A6 | SERDES.Q1S_TLNKD4 | 
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| TCELL84:IMUX_B2 | SERDES.Q1S_TLNKD10 | 
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| TCELL84:IMUX_B6 | SERDES.Q1S_TLNKSRCRDYN | 
| TCELL84:IMUX_B7 | SERDES.Q1S_TLNKD2 | 
| TCELL84:IMUX_C2 | SERDES.Q1S_TLNKD20 | 
| TCELL84:IMUX_C3 | SERDES.Q1S_TLNKD18 | 
| TCELL84:IMUX_C4 | SERDES.Q1S_TLNKSRCDSCN | 
| TCELL84:IMUX_C5 | SERDES.Q1S_TLNKD12 | 
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| TCELL99:IMUX_D3 | SERDES.Q1CH3_FDTX11 | 
| TCELL99:IMUX_D4 | SERDES.Q1CH3_FDTX12 | 
| TCELL99:IMUX_D5 | SERDES.Q1CH3_FDTX13 | 
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Tile SERDES3
Cells: 177
Bel SERDES
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| TCELL63:IMUX_B0 | SERDES.Q1EA1_CITXPAUSTIM13 | 
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| TCELL63:OUT_Q4 | SERDES.Q1EA3_COTXSTATVEC2 | 
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| TCELL64:IMUX_A1 | SERDES.Q1EA0_GISYNCCRS | 
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| TCELL64:IMUX_A3 | SERDES.Q1EA3_CITXEMPTY | 
| TCELL64:IMUX_A4 | SERDES.Q1EA3_CITXPAUSREQ | 
| TCELL64:IMUX_A5 | SERDES.Q1EA3_CITXPAUSTIM13 | 
| TCELL64:IMUX_B0 | SERDES.Q1EA0_CITXPAUSTIM0 | 
| TCELL64:IMUX_B1 | SERDES.Q1EA0_CITXPAUSTIM14 | 
| TCELL64:IMUX_B2 | SERDES.Q1EA1_CIRXFULL | 
| TCELL64:IMUX_B3 | SERDES.Q1EA0_CITXFIFOCTRL | 
| TCELL64:IMUX_B4 | SERDES.Q1EA0_GISYNCCOL | 
| TCELL64:IMUX_B5 | SERDES.Q1EA1_GISYNCCOL | 
| TCELL64:IMUX_C0 | SERDES.Q1EA0_CITXPAUSTIM10 | 
| TCELL64:IMUX_C1 | SERDES.Q1EA0_CITXPAUSTIM4 | 
| TCELL64:IMUX_C2 | SERDES.Q1EA0_CITXPAUSTIM8 | 
| TCELL64:IMUX_C3 | SERDES.Q1EA0_CITXFORCEERR | 
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| TCELL64:IMUX_D0 | SERDES.Q1EA1_CITXFORCEERR | 
| TCELL64:IMUX_D1 | SERDES.Q1EA0_CITXPAUSTIM3 | 
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| TCELL64:IMUX_D3 | SERDES.Q1EA0_CITXPAUSTIM1 | 
| TCELL64:IMUX_D4 | SERDES.Q1EA0_CITXPAUSTIM7 | 
| TCELL64:IMUX_D5 | SERDES.Q1EA0_CITXPAUSTIM9 | 
| TCELL64:OUT_F0 | SERDES.Q1EA2_COTXSTATVEC0 | 
| TCELL64:OUT_F1 | SERDES.Q1EA2_GOTXMACDATA6 | 
| TCELL64:OUT_F2 | SERDES.Q1EA2_COTXSTATVEC7 | 
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| TCELL64:OUT_Q1 | SERDES.Q1S_TOMBISTDO7 | 
| TCELL64:OUT_Q2 | SERDES.Q1EA2_COTXSTATVEC4 | 
| TCELL64:OUT_Q3 | SERDES.Q1EA2_COTXSTATVEC2 | 
| TCELL64:OUT_Q4 | SERDES.Q1EA0_CORXDATA14 | 
| TCELL64:OUT_Q5 | SERDES.Q1EA2_COTXSTATVEC1 | 
| TCELL65:IMUX_A2 | SERDES.Q1EA3_CITXFIFOCTRL | 
| TCELL65:IMUX_A3 | SERDES.Q1EA2_CITXPAUSREQ | 
| TCELL65:IMUX_A4 | SERDES.Q1EA1_KITXMACCLKENEXT | 
| TCELL65:IMUX_A5 | SERDES.Q1EA0_CIRXFULL | 
| TCELL65:IMUX_A6 | SERDES.Q1EA3_GISYNCCOL | 
| TCELL65:IMUX_A7 | SERDES.Q1EA3_GISYNCCRS | 
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| TCELL65:IMUX_B3 | SERDES.Q1EA3_CITXPAUSTIM11 | 
| TCELL65:IMUX_B4 | SERDES.Q1EA3_CITXPAUSTIM1 | 
| TCELL65:IMUX_B5 | SERDES.Q1EA3_CITXPAUSTIM3 | 
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| TCELL65:IMUX_C3 | SERDES.Q1EA3_CITXPAUSTIM7 | 
| TCELL65:IMUX_C4 | SERDES.Q1EA3_CITXPAUSTIM2 | 
| TCELL65:IMUX_C5 | SERDES.Q1EA3_CITXPAUSTIM8 | 
| TCELL65:IMUX_C6 | SERDES.Q1EA3_CITXPAUSTIM14 | 
| TCELL65:IMUX_C7 | SERDES.Q1EA3_CITXFORCEERR | 
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| TCELL65:IMUX_D3 | SERDES.Q1EA3_CITXPAUSTIM12 | 
| TCELL65:IMUX_D4 | SERDES.Q1EA3_CITXPAUSTIM5 | 
| TCELL65:IMUX_D5 | SERDES.Q1EA3_CITXPAUSTIM4 | 
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| TCELL65:OUT_F7 | SERDES.Q1EA0_CORXDATA4 | 
| TCELL65:OUT_Q0 | SERDES.Q1EA0_CORXDATA13 | 
| TCELL65:OUT_Q1 | SERDES.Q1EA0_CORXDATA10 | 
| TCELL65:OUT_Q2 | SERDES.Q1EA0_CORXDATA15 | 
| TCELL65:OUT_Q3 | SERDES.Q1EA0_CORXDATA11 | 
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| TCELL65:OUT_Q5 | SERDES.Q1S_TOMBISTDO10 | 
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| TCELL65:OUT_Q7 | SERDES.Q1EA0_CORXDATA12 | 
| TCELL66:IMUX_A2 | SERDES.Q1EA0_CIRXIGNOREPKT | 
| TCELL66:IMUX_A3 | SERDES.Q1EA0_GISYNCRXD0 | 
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| TCELL66:IMUX_A6 | SERDES.Q1EA0_GISYNCRXDV | 
| TCELL66:IMUX_A7 | SERDES.Q1EA2_CITXPAUSTIM0 | 
| TCELL66:IMUX_B2 | SERDES.Q1EA3_KITXGMIILPBK | 
| TCELL66:IMUX_B3 | SERDES.Q1EA2_CITXFORCEERR | 
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| TCELL66:IMUX_B7 | SERDES.Q1EA2_CITXFIFOCTRL | 
| TCELL66:IMUX_C2 | SERDES.Q1EA0_GISYNCRXD4 | 
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| TCELL66:IMUX_C5 | SERDES.Q1EA0_GISYNCRXD6 | 
| TCELL66:IMUX_C6 | SERDES.Q1EA0_GISYNCRXD2 | 
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| TCELL66:IMUX_D2 | SERDES.Q1EA3_KITXMACCLKENEXT | 
| TCELL66:IMUX_D3 | SERDES.Q1EA1_KITXGMIILPBK | 
| TCELL66:IMUX_D4 | SERDES.Q1EA0_KITXGMIILPBK | 
| TCELL66:IMUX_D5 | SERDES.Q1EA0_KIRXMACCLKENEXT | 
| TCELL66:IMUX_D6 | SERDES.Q1EA1_KIRXMACCLKENEXT | 
| TCELL66:IMUX_D7 | SERDES.Q1EA0_GISYNCRXD1 | 
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| TCELL67:IMUX_B2 | SERDES.Q1EA2_CITXPAUSTIM6 | 
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| TCELL67:IMUX_B4 | SERDES.Q1EA2_CITXPAUSTIM14 | 
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| TCELL67:IMUX_D4 | SERDES.Q1EA2_CITXPAUSTIM3 | 
| TCELL67:IMUX_D5 | SERDES.Q1EA2_CITXPAUSTIM15 | 
| TCELL67:IMUX_D6 | SERDES.Q1EA2_CITXPAUSTIM7 | 
| TCELL67:IMUX_D7 | SERDES.Q1EA2_CITXPAUSTIM11 | 
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| TCELL67:OUT_F1 | SERDES.Q1S_TOMBISTDO21 | 
| TCELL67:OUT_F2 | SERDES.Q1S_TOMBISTDO23 | 
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| TCELL67:OUT_F7 | SERDES.Q1EA3_CORXSTATEN | 
| TCELL67:OUT_Q0 | SERDES.Q1S_TOMBISTDO17 | 
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| TCELL68:IMUX_D2 | SERDES.Q1EA3_GISYNCRXD6 | 
| TCELL68:IMUX_D3 | SERDES.Q1EA3_GISYNCRXD4 | 
| TCELL68:IMUX_D4 | SERDES.Q1EA3_GISYNCRXD2 | 
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| TCELL70:IMUX_C2 | SERDES.Q1S_TIMBISTWA1 | 
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| TCELL70:OUT_F1 | SERDES.Q1EA2_CORXSTATVEC1 | 
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| TCELL70:OUT_F5 | SERDES.Q1EA1_CORXSTATVEC0 | 
| TCELL70:OUT_Q0 | SERDES.Q1EA1_CORXSTATVEC5 | 
| TCELL70:OUT_Q1 | SERDES.Q1EA2_CORXSTATVEC0 | 
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| TCELL70:OUT_Q5 | SERDES.Q1EA2_CORXWRITE | 
| TCELL71:IMUX_A2 | SERDES.Q1S_TIMBISTSDI33 | 
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| TCELL71:IMUX_A6 | SERDES.Q1S_TIMBISTSDI31 | 
| TCELL71:IMUX_A7 | SERDES.Q1S_TIMBISTSDI30 | 
| TCELL71:IMUX_B2 | SERDES.Q1S_TIMBISTRE | 
| TCELL71:IMUX_B3 | SERDES.Q1S_TIMBISTWE | 
| TCELL71:IMUX_B4 | SERDES.Q1S_TIMBISTSDI16 | 
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| TCELL71:IMUX_B7 | SERDES.Q1S_TIMBISTSDI34 | 
| TCELL71:IMUX_C2 | SERDES.Q1S_TIMBISTBANKSEL2 | 
| TCELL71:IMUX_C3 | SERDES.Q1S_TIMBISTRA0 | 
| TCELL71:IMUX_C4 | SERDES.Q1S_TIMBISTRA1 | 
| TCELL71:IMUX_C5 | SERDES.Q1S_TIMBISTBANKSEL1 | 
| TCELL71:IMUX_C6 | SERDES.Q1S_TIMBISTSDI14 | 
| TCELL71:IMUX_C7 | SERDES.Q1S_TIMBISTSDI15 | 
| TCELL71:IMUX_D2 | SERDES.Q1S_TIMBISTWA7 | 
| TCELL71:IMUX_D3 | SERDES.Q1S_TIMBISTRA3 | 
| TCELL71:IMUX_D4 | SERDES.Q1S_TIMBISTRA2 | 
| TCELL71:IMUX_D5 | SERDES.Q1S_TIMBISTSDI13 | 
| TCELL71:IMUX_D6 | SERDES.Q1S_TIMBISTBANKSEL0 | 
| TCELL71:IMUX_D7 | SERDES.Q1S_TIMBISTBANKSEL3 | 
| TCELL71:OUT_F0 | SERDES.Q1EA1_CORXFIFOFULLERROR | 
| TCELL71:OUT_F1 | SERDES.Q1EA1_CORXDATA2 | 
| TCELL71:OUT_F2 | SERDES.Q1EA2_CORXDATA11 | 
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| TCELL72:IMUX_D2 | SERDES.Q1S_TIMBISTSDI18 | 
| TCELL72:IMUX_D3 | SERDES.Q1S_TIMBISTSDI19 | 
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| TCELL74:IMUX_A2 | SERDES.Q1S_TPORTTDI45 | 
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| TCELL145:IMUX_B3 | SERDES.Q2EA2_CITXDATA12 | 
| TCELL145:IMUX_B4 | SERDES.Q2EA0_CITXDATA15 | 
| TCELL145:IMUX_B5 | SERDES.Q2EA0_CITXDATA0 | 
| TCELL145:IMUX_C0 | SERDES.Q2EA2_CITXDATA13 | 
| TCELL145:IMUX_C1 | SERDES.Q2EA0_CITXDATA13 | 
| TCELL145:IMUX_C2 | SERDES.Q2EA0_CITXLASTBYTEVLD | 
| TCELL145:IMUX_C3 | SERDES.Q2EA0_CITXDATA6 | 
| TCELL145:IMUX_C4 | SERDES.Q2EA2_CITXDATA6 | 
| TCELL145:IMUX_C5 | SERDES.Q2EA0_CITXDATA7 | 
| TCELL145:IMUX_D0 | SERDES.Q2EA2_CITXDATA8 | 
| TCELL145:IMUX_D1 | SERDES.Q2EA2_CITXDATA5 | 
| TCELL145:IMUX_D2 | SERDES.Q2EA2_CITXDATA7 | 
| TCELL145:IMUX_D3 | SERDES.Q2EA0_CITXDATA4 | 
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| TCELL145:IMUX_D5 | SERDES.Q2EA2_CITXDATA4 | 
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| TCELL145:OUT_F6 | SERDES.Q2EA3_COTXSTATVEC2 | 
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| TCELL146:IMUX_LSR1 | SERDES.Q2EA3_KIRSTN | 
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| TCELL146:IMUX_CE1 | SERDES.Q2X_TISCANIN9 | 
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| TCELL146:OUT_Q0 | SERDES.Q2EA3_CORXDATA6 | 
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| TCELL146:OUT_Q4 | SERDES.Q2EA1_CORXERROR | 
| TCELL146:OUT_Q5 | SERDES.Q2EA1_CORXDATA1 | 
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| TCELL146:OUT_Q7 | SERDES.Q2EA1_CORXDATA0 | 
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| TCELL147:IMUX_B3 | SERDES.Q2EA2_CITXFORCEERR | 
| TCELL147:IMUX_B4 | SERDES.Q2EA3_CITXEOF | 
| TCELL147:IMUX_B5 | SERDES.Q2EA2_CIRXFULL | 
| TCELL147:IMUX_C0 | SERDES.Q2EA2_CITXPAUSREQ | 
| TCELL147:IMUX_C1 | SERDES.Q2EA3_CITXEMPTY | 
| TCELL147:IMUX_C2 | SERDES.Q2EA3_CITXDATAAVAIL | 
| TCELL147:IMUX_C3 | SERDES.Q2EA2_GISYNCCRS | 
| TCELL147:IMUX_C4 | SERDES.Q2EA2_GISYNCCOL | 
| TCELL147:IMUX_C5 | SERDES.Q2EA3_CITXFIFOCTRL | 
| TCELL147:IMUX_D0 | SERDES.Q2EA3_CIRXFULL | 
| TCELL147:IMUX_D1 | SERDES.Q2EA2_CITXPAUSTIM1 | 
| TCELL147:IMUX_D2 | SERDES.Q2EA2_CITXPAUSTIM0 | 
| TCELL147:IMUX_D3 | SERDES.Q2EA2_CITXPAUSTIM15 | 
| TCELL147:IMUX_D4 | SERDES.Q2EA2_CITXPAUSTIM5 | 
| TCELL147:IMUX_D5 | SERDES.Q2EA2_CITXPAUSTIM2 | 
| TCELL147:IMUX_LSR0 | SERDES.Q2X_TISCANRSTN | 
| TCELL147:IMUX_LSR1 | SERDES.Q2X_TISCANMODE | 
| TCELL147:IMUX_CLK0_DELAY | SERDES.Q2EA2_KIRXMACCLK | 
| TCELL147:IMUX_CLK1_DELAY | SERDES.Q2EA3_KIRXTXFECLK | 
| TCELL147:IMUX_CE0 | SERDES.Q2X_TISCANIN0 | 
| TCELL147:IMUX_CE1 | SERDES.Q2X_TISCANIN10 | 
| TCELL147:IMUX_CE2 | SERDES.Q2X_TISCANIN8 | 
| TCELL147:IMUX_CE3 | SERDES.Q2X_TISCANIN1 | 
| TCELL147:OUT_F0 | SERDES.Q2EA1_CORXSTATVEC1 | 
| TCELL147:OUT_F1 | SERDES.Q2EA1_CORXSTATVEC0 | 
| TCELL147:OUT_F2 | SERDES.Q2EA1_CORXSTATVEC2 | 
| TCELL147:OUT_F3 | SERDES.Q2EA3_CORXEOF | 
| TCELL147:OUT_F4 | SERDES.Q2EA2_GODISCARDFCS | 
| TCELL147:OUT_F5 | SERDES.Q2EA1_CORXSTATVEC7 | 
| TCELL147:OUT_F6 | SERDES.Q2EA1_CORXSTATVEC6 | 
| TCELL147:OUT_F7 | SERDES.Q2EA1_CORXSTATVEC5 | 
| TCELL147:OUT_Q0 | SERDES.Q2EA1_CORXSTATVEC3 | 
| TCELL147:OUT_Q1 | SERDES.Q2EA3_GOTXMACDATA0 | 
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| TCELL147:OUT_Q3 | SERDES.Q2X_TOSCANOUT8 | 
| TCELL147:OUT_Q4 | SERDES.Q2EA1_CORXSTATVEC4 | 
| TCELL147:OUT_Q5 | SERDES.Q2EA3_GOTXMACDATA2 | 
| TCELL147:OUT_Q6 | SERDES.Q2EA3_GOTXMACWR | 
| TCELL147:OUT_Q7 | SERDES.Q2EA3_GOTXMACDATA7 | 
| TCELL148:IMUX_A0 | SERDES.Q2EA2_CITXPAUSTIM14 | 
| TCELL148:IMUX_A1 | SERDES.Q2EA2_KITXMACCLKENEXT | 
| TCELL148:IMUX_A2 | SERDES.Q2EA3_CITXFORCEERR | 
| TCELL148:IMUX_A3 | SERDES.Q2EA2_CITXPAUSTIM13 | 
| TCELL148:IMUX_A4 | SERDES.Q2EA1_CIRXFULL | 
| TCELL148:IMUX_A5 | SERDES.Q2EA2_CITXPAUSTIM8 | 
| TCELL148:IMUX_B0 | SERDES.Q2EA2_CITXPAUSTIM7 | 
| TCELL148:IMUX_B1 | SERDES.Q2EA2_CITXPAUSTIM12 | 
| TCELL148:IMUX_B2 | SERDES.Q2EA2_CITXPAUSTIM9 | 
| TCELL148:IMUX_B3 | SERDES.Q2EA2_CITXPAUSTIM3 | 
| TCELL148:IMUX_B4 | SERDES.Q2EA2_CITXPAUSTIM11 | 
| TCELL148:IMUX_B5 | SERDES.Q2EA2_CITXPAUSTIM10 | 
| TCELL148:IMUX_C0 | SERDES.Q2EA2_CITXPAUSTIM4 | 
| TCELL148:IMUX_C1 | SERDES.Q2EA2_CITXPAUSTIM6 | 
| TCELL148:IMUX_C2 | SERDES.Q2EA3_CITXPAUSREQ | 
| TCELL148:IMUX_C3 | SERDES.Q2EA2_GISYNCRXD1 | 
| TCELL148:IMUX_C4 | SERDES.Q2EA2_GIIPGSHRINK | 
| TCELL148:IMUX_C5 | SERDES.Q2EA2_GISYNCRXD3 | 
| TCELL148:IMUX_D0 | SERDES.Q2EA2_CIRXIGNOREPKT | 
| TCELL148:IMUX_D1 | SERDES.Q2EA2_GISYNCRXDV | 
| TCELL148:IMUX_D2 | SERDES.Q2EA2_GINONPADRXDV | 
| TCELL148:IMUX_D3 | SERDES.Q2EA2_GISYNCRXD2 | 
| TCELL148:IMUX_D4 | SERDES.Q2EA2_GISYNCRXER | 
| TCELL148:IMUX_D5 | SERDES.Q2EA2_GISYNCRXD7 | 
| TCELL148:IMUX_LSR0 | SERDES.Q2EB0_KIRSTN | 
| TCELL148:IMUX_LSR1 | SERDES.Q2X_IRESETN | 
| TCELL148:IMUX_CLK0_DELAY | SERDES.Q2EA3_KITXMACCLK | 
| TCELL148:IMUX_CLK1_DELAY | SERDES.Q2EA3_KIRXMACCLK | 
| TCELL148:IMUX_CE0 | SERDES.Q2X_TISCANIN6 | 
| TCELL148:IMUX_CE1 | SERDES.Q2X_TISCANIN29 | 
| TCELL148:IMUX_CE2 | SERDES.Q2X_TISCANIN25 | 
| TCELL148:IMUX_CE3 | SERDES.Q2X_TISCANIN11 | 
| TCELL148:OUT_F0 | SERDES.Q2EA3_GOTXMACDATA6 | 
| TCELL148:OUT_F1 | SERDES.Q2EA3_CORXERROR | 
| TCELL148:OUT_F2 | SERDES.Q2EA3_GOTXMACDATA3 | 
| TCELL148:OUT_F3 | SERDES.Q2EA3_GOTXMACERR | 
| TCELL148:OUT_F4 | SERDES.Q2EA3_GOTXMACDATA4 | 
| TCELL148:OUT_F5 | SERDES.Q2EA3_GOTXMACDATA5 | 
| TCELL148:OUT_F6 | SERDES.Q2EA2_KOGBITEN | 
| TCELL148:OUT_F7 | SERDES.Q2EA2_GOTXMACDATA0 | 
| TCELL148:OUT_Q0 | SERDES.Q2EA3_CORXSTATEN | 
| TCELL148:OUT_Q1 | SERDES.Q2EA3_CORXSTATVEC0 | 
| TCELL148:OUT_Q2 | SERDES.Q2EA3_CORXSTATVEC2 | 
| TCELL148:OUT_Q3 | SERDES.Q2EA3_CORXSTATVEC1 | 
| TCELL148:OUT_Q4 | SERDES.Q2EA3_CORXSTATVEC3 | 
| TCELL148:OUT_Q5 | SERDES.Q2EA3_CORXSTATVEC4 | 
| TCELL148:OUT_Q6 | SERDES.Q2EA3_CORXSTATVEC7 | 
| TCELL148:OUT_Q7 | SERDES.Q2EA3_GODISCARDFCS | 
| TCELL149:IMUX_A0 | SERDES.Q2EA2_GISYNCRXD0 | 
| TCELL149:IMUX_A1 | SERDES.Q2EA2_GISYNCNIBDRIB | 
| TCELL149:IMUX_A2 | SERDES.Q2EA2_GISYNCRXD6 | 
| TCELL149:IMUX_A3 | SERDES.Q2EA2_GISYNCRXD5 | 
| TCELL149:IMUX_A4 | SERDES.Q2EA2_GISYNCRXD4 | 
| TCELL149:IMUX_A5 | SERDES.Q2EA3_GISYNCCOL | 
| TCELL149:IMUX_B0 | SERDES.Q2EA3_GISYNCCRS | 
| TCELL149:IMUX_B1 | SERDES.Q2EA1_CITXDATA11 | 
| TCELL149:IMUX_B2 | SERDES.Q2EA1_CITXDATA8 | 
| TCELL149:IMUX_B3 | SERDES.Q2EA1_CITXDATA10 | 
| TCELL149:IMUX_B4 | SERDES.Q2EA1_CITXDATA9 | 
| TCELL149:IMUX_B5 | SERDES.Q2EA2_KITXGMIILPBK | 
| TCELL149:IMUX_C0 | SERDES.Q2EA2_KIRXMACCLKENEXT | 
| TCELL149:IMUX_C1 | SERDES.Q2EA1_CITXDATA12 | 
| TCELL149:IMUX_C2 | SERDES.Q2EA1_CITXDATA7 | 
| TCELL149:IMUX_C3 | SERDES.Q2EA1_CITXDATA14 | 
| TCELL149:IMUX_C4 | SERDES.Q2EA1_CITXDATA13 | 
| TCELL149:IMUX_C5 | SERDES.Q2EA3_CITXPAUSTIM15 | 
| TCELL149:IMUX_D0 | SERDES.Q2EA3_CITXPAUSTIM14 | 
| TCELL149:IMUX_D1 | SERDES.Q2EA1_CITXDATA5 | 
| TCELL149:IMUX_D2 | SERDES.Q2EA1_CITXDATA6 | 
| TCELL149:IMUX_D3 | SERDES.Q2EA1_CITXDATA2 | 
| TCELL149:IMUX_D4 | SERDES.Q2EA3_CITXPAUSTIM10 | 
| TCELL149:IMUX_D5 | SERDES.Q2EA3_CITXPAUSTIM9 | 
| TCELL149:IMUX_LSR0 | SERDES.Q2EB2_KIRSTN | 
| TCELL149:IMUX_LSR1 | SERDES.Q2EB3_KIRSTN | 
| TCELL149:IMUX_CLK0_DELAY | SERDES.Q2EA1_KIRXTXFECLK | 
| TCELL149:IMUX_CLK1_DELAY | SERDES.Q2EA1_KIRXMACCLK | 
| TCELL149:IMUX_CE0 | SERDES.Q2X_TISCANIN24 | 
| TCELL149:IMUX_CE1 | SERDES.Q2X_TISCANIN13 | 
| TCELL149:IMUX_CE2 | SERDES.Q2X_TISCANIN12 | 
| TCELL149:IMUX_CE3 | SERDES.Q2X_TISCANIN15 | 
| TCELL149:OUT_F0 | SERDES.Q2EA3_CORXSTATVEC6 | 
| TCELL149:OUT_F1 | SERDES.Q2EA3_CORXSTATVEC5 | 
| TCELL149:OUT_F2 | SERDES.Q2EA0_KORXMACCLKEN | 
| TCELL149:OUT_F3 | SERDES.Q2EA0_COTXREAD | 
| TCELL149:OUT_F4 | SERDES.Q2EA0_COTXSTATVEC7 | 
| TCELL149:OUT_F5 | SERDES.Q2EA0_GODISCARDFCS | 
| TCELL149:OUT_F6 | SERDES.Q2X_TOSCANOUT21 | 
| TCELL149:OUT_F7 | SERDES.Q2EA3_KOGBITEN | 
| TCELL149:OUT_Q0 | SERDES.Q2EA3_GOTXMACDATA1 | 
| TCELL149:OUT_Q1 | SERDES.Q2EA1_COTXSTATVEC7 | 
| TCELL149:OUT_Q2 | SERDES.Q2EA1_COTXSTATVEC3 | 
| TCELL149:OUT_Q3 | SERDES.Q2EA1_COTXSTATVEC5 | 
| TCELL149:OUT_Q4 | SERDES.Q2EA1_COTXSTATVEC6 | 
| TCELL149:OUT_Q5 | SERDES.Q2X_TOSCANOUT2 | 
| TCELL149:OUT_Q6 | SERDES.Q2EA3_KORXMACCLKEN | 
| TCELL149:OUT_Q7 | SERDES.Q2EA1_COTXREAD | 
| TCELL150:IMUX_A0 | SERDES.Q2EA3_CITXPAUSTIM12 | 
| TCELL150:IMUX_A1 | SERDES.Q2EA3_CITXPAUSTIM8 | 
| TCELL150:IMUX_A2 | SERDES.Q2EA1_CITXDATA4 | 
| TCELL150:IMUX_A3 | SERDES.Q2EA3_CITXPAUSTIM7 | 
| TCELL150:IMUX_A4 | SERDES.Q2EA1_CITXDATA15 | 
| TCELL150:IMUX_A5 | SERDES.Q2EA3_CITXPAUSTIM0 | 
| TCELL150:IMUX_B0 | SERDES.Q2EA1_CITXDATA3 | 
| TCELL150:IMUX_B1 | SERDES.Q2EA3_CITXPAUSTIM13 | 
| TCELL150:IMUX_B2 | SERDES.Q2EA1_CITXDATA1 | 
| TCELL150:IMUX_B3 | SERDES.Q2EA3_CITXPAUSTIM6 | 
| TCELL150:IMUX_B4 | SERDES.Q2EA3_CITXPAUSTIM5 | 
| TCELL150:IMUX_B5 | SERDES.Q2EA3_CITXPAUSTIM11 | 
| TCELL150:IMUX_C0 | SERDES.Q2EA3_CITXPAUSTIM3 | 
| TCELL150:IMUX_C1 | SERDES.Q2EA3_CITXPAUSTIM1 | 
| TCELL150:IMUX_C2 | SERDES.Q2EA3_CITXPAUSTIM2 | 
| TCELL150:IMUX_C3 | SERDES.Q2EA1_CITXLASTBYTEVLD | 
| TCELL150:IMUX_C4 | SERDES.Q2EA3_CITXPAUSTIM4 | 
| TCELL150:IMUX_C5 | SERDES.Q2EA1_CITXDATA0 | 
| TCELL150:IMUX_D0 | SERDES.Q2EA3_KITXMACCLKENEXT | 
| TCELL150:IMUX_D1 | SERDES.Q2EA0_CITXEMPTY | 
| TCELL150:IMUX_D2 | SERDES.Q2EA1_CITXEOF | 
| TCELL150:IMUX_D3 | SERDES.Q2EA0_CITXDATAAVAIL | 
| TCELL150:IMUX_D4 | SERDES.Q2EA1_CITXDATAAVAIL | 
| TCELL150:IMUX_D5 | SERDES.Q2EA1_CITXEMPTY | 
| TCELL150:IMUX_LSR0 | SERDES.Q2EB1_KIRSTN | 
| TCELL150:IMUX_LSR1 | SERDES.Q2X_TISCANEN | 
| TCELL150:IMUX_CLK0_DELAY | SERDES.Q2EA1_KITXMACCLK | 
| TCELL150:IMUX_CLK1_DELAY | SERDES.Q2EA0_KITXMACCLK | 
| TCELL150:IMUX_CE0 | SERDES.Q2X_TIBISTBANKSEL1 | 
| TCELL150:IMUX_CE1 | SERDES.Q2X_TIBISTBANKSEL2 | 
| TCELL150:IMUX_CE2 | SERDES.Q2X_TIBISTBANKSEL3 | 
| TCELL150:IMUX_CE3 | SERDES.Q2X_TIBISTBANKSEL0 | 
| TCELL150:OUT_F0 | SERDES.Q2EA1_GODISCARDFCS | 
| TCELL150:OUT_F1 | SERDES.Q2EA1_KORXMACCLKEN | 
| TCELL150:OUT_F2 | SERDES.Q2EA0_COTXSTATVEC5 | 
| TCELL150:OUT_F3 | SERDES.Q2EA0_COTXSTATVEC0 | 
| TCELL150:OUT_F4 | SERDES.Q2EA0_COTXSTATVEC3 | 
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| TCELL150:OUT_F6 | SERDES.Q2EA0_COTXSTATVEC2 | 
| TCELL150:OUT_F7 | SERDES.Q2EA1_COTXDISCFRM | 
| TCELL150:OUT_Q0 | SERDES.Q2EA0_COTXDISCFRM | 
| TCELL150:OUT_Q1 | SERDES.Q2EA1_KOGBITEN | 
| TCELL150:OUT_Q2 | SERDES.Q2EA0_KOGBITEN | 
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| TCELL163:OUT_Q3 | SERDES.Q2X_CSO114 | 
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| TCELL164:IMUX_A4 | SERDES.Q2EB3_CITXPAUSTIM2 | 
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