Digital Clock Managers
Tile DCM
Cells: 4
Bel DCM0
| Pin | Direction | Wires |
|---|---|---|
| CKINT0 | input | CELL0.IMUX.CLK0 |
| CKINT1 | input | CELL0.IMUX.CLK1 |
| CKINT2 | input | CELL0.IMUX.CLK2 |
| CKINT3 | input | CELL0.IMUX.CLK3 |
| CLK0 | output | CELL2.OUT.BEST0.TMIN |
| CLK180 | output | CELL2.OUT.BEST1.TMIN |
| CLK270 | output | CELL1.OUT.BEST0.TMIN |
| CLK2X | output | CELL1.OUT.BEST2.TMIN |
| CLK2X180 | output | CELL1.OUT.BEST1.TMIN |
| CLK90 | output | CELL2.OUT.BEST2.TMIN |
| CLKDV | output | CELL0.OUT.BEST0.TMIN |
| CLKFB_TEST | output | CELL2.TEST0 |
| CLKFX | output | CELL3.OUT.BEST1.TMIN |
| CLKFX180 | output | CELL3.OUT.BEST2.TMIN |
| CLKIN_TEST | output | CELL3.TEST0 |
| CLK_IN0 | input | CELL0.IMUX.CLK0 |
| CONCUR | output | CELL3.OUT.BEST0.TMIN |
| CTLGO | input | CELL0.IMUX.IMUX7 |
| CTLMODE | input | CELL0.IMUX.CE0 |
| CTLOSC1 | input | CELL0.IMUX.IMUX5 |
| CTLOSC2 | input | CELL0.IMUX.IMUX6 |
| CTLSEL0 | input | CELL0.IMUX.IMUX0 |
| CTLSEL1 | input | CELL0.IMUX.IMUX1 |
| CTLSEL2 | input | CELL0.IMUX.IMUX2 |
| DADDR0 | input | CELL3.IMUX.IMUX0 |
| DADDR1 | input | CELL3.IMUX.IMUX1 |
| DADDR2 | input | CELL3.IMUX.IMUX2 |
| DADDR3 | input | CELL3.IMUX.IMUX3 |
| DADDR4 | input | CELL3.IMUX.IMUX4 |
| DADDR5 | input | CELL3.IMUX.IMUX5 |
| DADDR6 | input | CELL3.IMUX.IMUX6 |
| DCLK | input | CELL2.IMUX.CLK0 |
| DEN | input | CELL2.IMUX.CE1 |
| DI0 | input | CELL2.IMUX.IMUX0 |
| DI1 | input | CELL2.IMUX.IMUX1 |
| DI10 | input | CELL1.IMUX.IMUX2 |
| DI11 | input | CELL1.IMUX.IMUX3 |
| DI12 | input | CELL1.IMUX.IMUX4 |
| DI13 | input | CELL1.IMUX.IMUX5 |
| DI14 | input | CELL1.IMUX.IMUX6 |
| DI15 | input | CELL1.IMUX.IMUX7 |
| DI2 | input | CELL2.IMUX.IMUX2 |
| DI3 | input | CELL2.IMUX.IMUX3 |
| DI4 | input | CELL2.IMUX.IMUX4 |
| DI5 | input | CELL2.IMUX.IMUX5 |
| DI6 | input | CELL2.IMUX.IMUX6 |
| DI7 | input | CELL2.IMUX.IMUX7 |
| DI8 | input | CELL1.IMUX.IMUX0 |
| DI9 | input | CELL1.IMUX.IMUX1 |
| DO0 | output | CELL3.OUT.BEST4.TMIN |
| DO1 | output | CELL3.OUT.BEST5.TMIN |
| DO10 | output | CELL1.OUT.BEST6.TMIN |
| DO11 | output | CELL1.OUT.BEST7.TMIN |
| DO12 | output | CELL0.OUT.BEST4.TMIN |
| DO13 | output | CELL0.OUT.BEST5.TMIN |
| DO14 | output | CELL0.OUT.BEST6.TMIN |
| DO15 | output | CELL0.OUT.BEST7.TMIN |
| DO2 | output | CELL3.OUT.BEST6.TMIN |
| DO3 | output | CELL3.OUT.BEST7.TMIN |
| DO4 | output | CELL2.OUT.BEST4.TMIN |
| DO5 | output | CELL2.OUT.BEST5.TMIN |
| DO6 | output | CELL2.OUT.BEST6.TMIN |
| DO7 | output | CELL2.OUT.BEST7.TMIN |
| DO8 | output | CELL1.OUT.BEST4.TMIN |
| DO9 | output | CELL1.OUT.BEST5.TMIN |
| DRDY | output | CELL3.OUT.SEC2.TMIN |
| DWE | input | CELL2.IMUX.CE0 |
| FREEZE_DFS | input | CELL1.IMUX.SR1 |
| FREEZE_DLL | input | CELL1.IMUX.SR0 |
| LOCKED | output | CELL3.OUT.SEC0.TMIN |
| PSCLK | input | CELL2.IMUX.CLK1 |
| PSDONE | output | CELL3.OUT.SEC1.TMIN |
| PSEN | input | CELL0.IMUX.IMUX4 |
| PSINCDEC | input | CELL0.IMUX.IMUX3 |
| RST | input | CELL3.IMUX.SR0 |
Bel wires
| Wire | Pins |
|---|---|
| CELL0.IMUX.CLK0 | DCM0.CKINT0, DCM0.CLK_IN0 |
| CELL0.IMUX.CLK1 | DCM0.CKINT1 |
| CELL0.IMUX.CLK2 | DCM0.CKINT2 |
| CELL0.IMUX.CLK3 | DCM0.CKINT3 |
| CELL0.IMUX.CE0 | DCM0.CTLMODE |
| CELL0.IMUX.IMUX0 | DCM0.CTLSEL0 |
| CELL0.IMUX.IMUX1 | DCM0.CTLSEL1 |
| CELL0.IMUX.IMUX2 | DCM0.CTLSEL2 |
| CELL0.IMUX.IMUX3 | DCM0.PSINCDEC |
| CELL0.IMUX.IMUX4 | DCM0.PSEN |
| CELL0.IMUX.IMUX5 | DCM0.CTLOSC1 |
| CELL0.IMUX.IMUX6 | DCM0.CTLOSC2 |
| CELL0.IMUX.IMUX7 | DCM0.CTLGO |
| CELL0.OUT.BEST0.TMIN | DCM0.CLKDV |
| CELL0.OUT.BEST4.TMIN | DCM0.DO12 |
| CELL0.OUT.BEST5.TMIN | DCM0.DO13 |
| CELL0.OUT.BEST6.TMIN | DCM0.DO14 |
| CELL0.OUT.BEST7.TMIN | DCM0.DO15 |
| CELL1.IMUX.SR0 | DCM0.FREEZE_DLL |
| CELL1.IMUX.SR1 | DCM0.FREEZE_DFS |
| CELL1.IMUX.IMUX0 | DCM0.DI8 |
| CELL1.IMUX.IMUX1 | DCM0.DI9 |
| CELL1.IMUX.IMUX2 | DCM0.DI10 |
| CELL1.IMUX.IMUX3 | DCM0.DI11 |
| CELL1.IMUX.IMUX4 | DCM0.DI12 |
| CELL1.IMUX.IMUX5 | DCM0.DI13 |
| CELL1.IMUX.IMUX6 | DCM0.DI14 |
| CELL1.IMUX.IMUX7 | DCM0.DI15 |
| CELL1.OUT.BEST0.TMIN | DCM0.CLK270 |
| CELL1.OUT.BEST1.TMIN | DCM0.CLK2X180 |
| CELL1.OUT.BEST2.TMIN | DCM0.CLK2X |
| CELL1.OUT.BEST4.TMIN | DCM0.DO8 |
| CELL1.OUT.BEST5.TMIN | DCM0.DO9 |
| CELL1.OUT.BEST6.TMIN | DCM0.DO10 |
| CELL1.OUT.BEST7.TMIN | DCM0.DO11 |
| CELL2.IMUX.CLK0 | DCM0.DCLK |
| CELL2.IMUX.CLK1 | DCM0.PSCLK |
| CELL2.IMUX.CE0 | DCM0.DWE |
| CELL2.IMUX.CE1 | DCM0.DEN |
| CELL2.IMUX.IMUX0 | DCM0.DI0 |
| CELL2.IMUX.IMUX1 | DCM0.DI1 |
| CELL2.IMUX.IMUX2 | DCM0.DI2 |
| CELL2.IMUX.IMUX3 | DCM0.DI3 |
| CELL2.IMUX.IMUX4 | DCM0.DI4 |
| CELL2.IMUX.IMUX5 | DCM0.DI5 |
| CELL2.IMUX.IMUX6 | DCM0.DI6 |
| CELL2.IMUX.IMUX7 | DCM0.DI7 |
| CELL2.OUT.BEST0.TMIN | DCM0.CLK0 |
| CELL2.OUT.BEST1.TMIN | DCM0.CLK180 |
| CELL2.OUT.BEST2.TMIN | DCM0.CLK90 |
| CELL2.OUT.BEST4.TMIN | DCM0.DO4 |
| CELL2.OUT.BEST5.TMIN | DCM0.DO5 |
| CELL2.OUT.BEST6.TMIN | DCM0.DO6 |
| CELL2.OUT.BEST7.TMIN | DCM0.DO7 |
| CELL2.TEST0 | DCM0.CLKFB_TEST |
| CELL3.IMUX.SR0 | DCM0.RST |
| CELL3.IMUX.IMUX0 | DCM0.DADDR0 |
| CELL3.IMUX.IMUX1 | DCM0.DADDR1 |
| CELL3.IMUX.IMUX2 | DCM0.DADDR2 |
| CELL3.IMUX.IMUX3 | DCM0.DADDR3 |
| CELL3.IMUX.IMUX4 | DCM0.DADDR4 |
| CELL3.IMUX.IMUX5 | DCM0.DADDR5 |
| CELL3.IMUX.IMUX6 | DCM0.DADDR6 |
| CELL3.OUT.BEST0.TMIN | DCM0.CONCUR |
| CELL3.OUT.BEST1.TMIN | DCM0.CLKFX |
| CELL3.OUT.BEST2.TMIN | DCM0.CLKFX180 |
| CELL3.OUT.BEST4.TMIN | DCM0.DO0 |
| CELL3.OUT.BEST5.TMIN | DCM0.DO1 |
| CELL3.OUT.BEST6.TMIN | DCM0.DO2 |
| CELL3.OUT.BEST7.TMIN | DCM0.DO3 |
| CELL3.OUT.SEC0.TMIN | DCM0.LOCKED |
| CELL3.OUT.SEC1.TMIN | DCM0.PSDONE |
| CELL3.OUT.SEC2.TMIN | DCM0.DRDY |
| CELL3.TEST0 | DCM0.CLKIN_TEST |
Bitstream
| DCM0:BGM_CONFIG_REF_SEL | 3.F20.B15 |
|---|---|
| DCLK | 0 |
| CLKIN | 1 |
| DCM0:BGM_DIVIDE | 3.F19.B74 | 3.F19.B73 | 3.F19.B72 | 3.F19.B71 | 3.F19.B70 | 3.F19.B69 |
|---|---|---|---|---|---|---|
| DCM0:BGM_MULTIPLY | 3.F19.B66 | 3.F19.B65 | 3.F19.B64 | 3.F19.B63 | 3.F19.B62 | 3.F19.B61 |
| non-inverted | [5] | [4] | [3] | [2] | [1] | [0] |
| DCM0:BGM_LDLY | 3.F20.B12 | 3.F20.B11 | 3.F20.B10 |
|---|---|---|---|
| DCM0:BGM_SAMPLE_LEN | 3.F19.B9 | 3.F19.B8 | 3.F19.B7 |
| DCM0:BGM_SDLY | 3.F20.B9 | 3.F20.B8 | 3.F20.B7 |
| DCM0:BGM_VLDLY | 3.F20.B6 | 3.F20.B5 | 3.F20.B4 |
| DCM0:BGM_VSDLY | 3.F20.B3 | 3.F20.B2 | 3.F20.B1 |
| DCM0:DCM_VREG_PHASE_MARGIN | 2.F19.B54 | 2.F19.B53 | 2.F19.B52 |
| DCM0:DFS_AVE_FREQ_SAMPLE_INTERVAL | 1.F19.B3 | 1.F19.B2 | 1.F19.B1 |
| DCM0:DLL_PD_DLY_SEL | 3.F20.B71 | 3.F20.B70 | 3.F20.B69 |
| non-inverted | [2] | [1] | [0] |
| DCM0:BGM_MODE | 3.F19.B2 | 3.F19.B1 |
|---|---|---|
| BG_SNAPSHOT | 0 | 0 |
| ABS_FREQ_SNAPSHOT | 1 | 0 |
| ABS_FREQ_REF | 1 | 1 |
| DCM0:BGM_VADJ | 3.F19.B6 | 3.F19.B5 | 3.F19.B4 | 3.F19.B3 |
|---|---|---|---|---|
| DCM0:CLKDV_COUNT_FALL | 3.F20.B36 | 3.F20.B35 | 3.F20.B34 | 3.F20.B33 |
| DCM0:CLKDV_COUNT_FALL_2 | 3.F20.B32 | 3.F20.B31 | 3.F20.B30 | 3.F20.B29 |
| DCM0:CLKDV_COUNT_MAX | 3.F20.B28 | 3.F20.B27 | 3.F20.B26 | 3.F20.B25 |
| DCM0:DCM_VBG_SEL | 2.F19.B49 | 2.F19.B48 | 2.F19.B47 | 2.F19.B46 |
| DCM0:DFS_AVE_FREQ_ADJ_INTERVAL | 1.F19.B7 | 1.F19.B6 | 1.F19.B5 | 1.F19.B4 |
| DCM0:DUTY_CYCLE_CORRECTION | 3.F20.B56 | 3.F20.B55 | 3.F20.B54 | 3.F20.B53 |
| non-inverted | [3] | [2] | [1] | [0] |
| DCM0:CLKDV_MODE | 3.F20.B16 |
|---|---|
| HALF | 0 |
| INT | 1 |
| DCM0:CLKDV_PHASE_FALL | 3.F20.B22 | 3.F20.B21 |
|---|---|---|
| DCM0:CLKDV_PHASE_RISE | 3.F20.B24 | 3.F20.B23 |
| DCM0:DCM_VBG_PD | 2.F19.B51 | 2.F19.B50 |
| DCM0:DFS_COIN_WINDOW | 1.F19.B15 | 1.F19.B14 |
| DCM0:DFS_HARDSYNC | 0.F19.B68 | 0.F19.B67 |
| DCM0:DLL_TEST_MUX_SEL | 3.F20.B50 | 3.F20.B49 |
| non-inverted | [1] | [0] |
| DCM0:CLKFB_ENABLE | 0.F19.B73 |
|---|---|
| DCM0:CLKFB_FEEDBACK | 2.F19.B5 |
| DCM0:CLKFB_IOB | 0.F20.B46 |
| DCM0:CLKIN_DIVIDE_BY_2 | 0.F19.B24 |
| DCM0:CLKIN_ENABLE | 0.F19.B25 |
| DCM0:CLKIN_IOB | 0.F20.B47 |
| DCM0:DCM_CLKDV_CLKFX_ALIGNMENT | 0.F19.B66 |
| DCM0:DCM_EXT_FB_EN | 0.F20.B27 |
| DCM0:DCM_UNUSED_TAPS_POWERDOWN | 1.F19.B55 |
| DCM0:DCM_VREG_ENABLE | 2.F19.B45 |
| DCM0:DFS_EARLY_LOCK | 0.F19.B70 |
| DCM0:DFS_ENABLE | 0.F19.B69 |
| DCM0:DFS_EXTEND_FLUSH_TIME | 1.F19.B11 |
| DCM0:DFS_EXTEND_HALT_TIME | 1.F19.B13 |
| DCM0:DFS_EXTEND_RUN_TIME | 1.F19.B12 |
| DCM0:DFS_FEEDBACK | 0.F20.B23 |
| DCM0:DFS_NON_STOP | 0.F20.B25 |
| DCM0:DFS_SKIP_FINE | 0.F20.B24 |
| DCM0:DFS_TRACKMODE | 0.F19.B26 |
| DCM0:DLL_CTL_SEL_CLKIN_DIV2 | 0.F19.B65 |
| DCM0:DLL_DESKEW_LOCK_BY1 | 2.F19.B2 |
| DCM0:DLL_PERIOD_LOCK_BY1 | 2.F19.B1 |
| DCM0:DLL_PHASE_DETECTOR_AUTO_RESET | 0.F19.B74 |
| DCM0:DLL_PHASE_SHIFT_LOCK_BY1 | 1.F19.B48 |
| DCM0:DLL_ZD2_EN | 2.F19.B6 |
| DCM0:DRP40_MASK | 0.F20.B18 |
| DCM0:DRP41_MASK | 0.F20.B38 |
| DCM0:DRP42_MASK | 0.F20.B58 |
| DCM0:DRP43_MASK | 0.F20.B78 |
| DCM0:DRP44_MASK | 1.F20.B18 |
| DCM0:DRP45_MASK | 1.F20.B38 |
| DCM0:DRP46_MASK | 1.F20.B58 |
| DCM0:DRP47_MASK | 1.F20.B78 |
| DCM0:DRP48_MASK | 2.F20.B18 |
| DCM0:DRP49_MASK | 2.F20.B38 |
| DCM0:DRP4A_MASK | 2.F20.B58 |
| DCM0:DRP4B_MASK | 2.F20.B78 |
| DCM0:DRP4C_MASK | 3.F20.B18 |
| DCM0:DRP4D_MASK | 3.F20.B38 |
| DCM0:DRP4E_MASK | 3.F20.B58 |
| DCM0:DRP4F_MASK | 3.F20.B78 |
| DCM0:DRP50_MASK | 0.F19.B18 |
| DCM0:DRP51_MASK | 0.F19.B38 |
| DCM0:DRP52_MASK | 0.F19.B58 |
| DCM0:DRP53_MASK | 0.F19.B78 |
| DCM0:DRP54_MASK | 1.F19.B18 |
| DCM0:DRP55_MASK | 1.F19.B38 |
| DCM0:DRP56_MASK | 1.F19.B58 |
| DCM0:DRP57_MASK | 1.F19.B78 |
| DCM0:DRP58_MASK | 2.F19.B18 |
| DCM0:DRP59_MASK | 2.F19.B38 |
| DCM0:DRP5A_MASK | 2.F19.B58 |
| DCM0:DRP5B_MASK | 2.F19.B78 |
| DCM0:DRP5C_MASK | 3.F19.B18 |
| DCM0:DRP5D_MASK | 3.F19.B38 |
| DCM0:DRP5E_MASK | 3.F19.B58 |
| DCM0:DRP5F_MASK | 3.F19.B78 |
| DCM0:ENABLE.CLK0 | 3.F20.B41 |
| DCM0:ENABLE.CLK180 | 3.F20.B43 |
| DCM0:ENABLE.CLK270 | 3.F20.B44 |
| DCM0:ENABLE.CLK2X | 3.F20.B45 |
| DCM0:ENABLE.CLK2X180 | 3.F20.B46 |
| DCM0:ENABLE.CLK90 | 3.F20.B42 |
| DCM0:ENABLE.CLKDV | 3.F20.B47 |
| DCM0:ENABLE.CLKFX | 0.F19.B30 |
| DCM0:ENABLE.CLKFX180 | 0.F19.B29 |
| DCM0:ENABLE.CONCUR | 0.F19.B31 |
| DCM0:ENABLE.GIOB0 | 0.F21.B30 |
| DCM0:ENABLE.GIOB1 | 0.F21.B31 |
| DCM0:ENABLE.GIOB10 | 0.F21.B40 |
| DCM0:ENABLE.GIOB11 | 0.F21.B41 |
| DCM0:ENABLE.GIOB12 | 0.F21.B42 |
| DCM0:ENABLE.GIOB13 | 0.F21.B43 |
| DCM0:ENABLE.GIOB14 | 0.F21.B44 |
| DCM0:ENABLE.GIOB15 | 0.F21.B45 |
| DCM0:ENABLE.GIOB2 | 0.F21.B32 |
| DCM0:ENABLE.GIOB3 | 0.F21.B33 |
| DCM0:ENABLE.GIOB4 | 0.F21.B34 |
| DCM0:ENABLE.GIOB5 | 0.F21.B35 |
| DCM0:ENABLE.GIOB6 | 0.F21.B36 |
| DCM0:ENABLE.GIOB7 | 0.F21.B37 |
| DCM0:ENABLE.GIOB8 | 0.F21.B38 |
| DCM0:ENABLE.GIOB9 | 0.F21.B39 |
| DCM0:ENABLE.HCLK0 | 0.F21.B22 |
| DCM0:ENABLE.HCLK1 | 0.F21.B23 |
| DCM0:ENABLE.HCLK2 | 0.F21.B24 |
| DCM0:ENABLE.HCLK3 | 0.F21.B25 |
| DCM0:ENABLE.HCLK4 | 0.F21.B26 |
| DCM0:ENABLE.HCLK5 | 0.F21.B27 |
| DCM0:ENABLE.HCLK6 | 0.F21.B28 |
| DCM0:ENABLE.HCLK7 | 0.F21.B29 |
| DCM0:ENABLE.MGT0 | 0.F21.B46 |
| DCM0:ENABLE.MGT1 | 0.F21.B47 |
| DCM0:ENABLE.MGT2 | 0.F21.B48 |
| DCM0:ENABLE.MGT3 | 0.F21.B49 |
| DCM0:PHASE_SHIFT_NEGATIVE | 1.F19.B31 |
| DCM0:PMCD_SYNC | 3.F20.B68 |
| DCM0:PS_CENTERED | 1.F19.B42 |
| DCM0:PS_DIRECT | 1.F19.B41 |
| DCM0:PS_ENABLE | 1.F19.B44 |
| DCM0:STARTUP_WAIT | 0.F19.B75 |
| DCM0:UNK_ALWAYS_SET | 1.F19.B50 |
| non-inverted | [0] |
| DCM0:CLKFX_DIVIDE | 0.F19.B45 | 0.F19.B44 | 0.F19.B43 | 0.F19.B42 | 0.F19.B41 |
|---|---|---|---|---|---|
| DCM0:CLKFX_MULTIPLY | 0.F19.B5 | 0.F19.B4 | 0.F19.B3 | 0.F19.B2 | 0.F19.B1 |
| DCM0:DCM_PULSE_WIDTH_CORRECTION_HIGH | 1.F20.B10 | 1.F20.B9 | 1.F20.B8 | 1.F20.B7 | 1.F20.B6 |
| DCM0:DCM_PULSE_WIDTH_CORRECTION_LOW | 1.F20.B5 | 1.F20.B4 | 1.F20.B3 | 1.F20.B2 | 1.F20.B1 |
| DCM0:DESKEW_ADJUST | 0.F20.B45 | 0.F20.B44 | 0.F20.B43 | 0.F20.B42 | 0.F20.B41 |
| non-inverted | [4] | [3] | [2] | [1] | [0] |
| DCM0:CLK_FEEDBACK | 0.F20.B22 | 0.F20.B21 |
|---|---|---|
| 1X | 0 | 0 |
| 2X | 0 | 1 |
| NONE | 1 | 0 |
| DCM0:DCM_LOCK_HIGH | 2.F19.B10 |
|---|---|
| DCM0:DFS_EN_RELRST | 0.F19.B23 |
| DCM0:INV.CTLGO | 0.F18.B60 |
| DCM0:INV.CTLOSC1 | 0.F18.B61 |
| DCM0:INV.CTLOSC2 | 0.F18.B21 |
| DCM0:INV.CTLSEL0 | 0.F18.B19 |
| DCM0:INV.CTLSEL1 | 0.F18.B58 |
| DCM0:INV.CTLSEL2 | 0.F18.B18 |
| DCM0:INV.DADDR0 | 3.F18.B19 |
| DCM0:INV.DADDR1 | 3.F18.B58 |
| DCM0:INV.DADDR2 | 3.F18.B18 |
| DCM0:INV.DADDR3 | 3.F18.B57 |
| DCM0:INV.DADDR4 | 3.F18.B22 |
| DCM0:INV.DADDR5 | 3.F18.B61 |
| DCM0:INV.DADDR6 | 3.F18.B21 |
| DCM0:INV.DI0 | 2.F18.B19 |
| DCM0:INV.DI1 | 2.F18.B58 |
| DCM0:INV.DI10 | 1.F18.B18 |
| DCM0:INV.DI11 | 1.F18.B57 |
| DCM0:INV.DI12 | 1.F18.B22 |
| DCM0:INV.DI13 | 1.F18.B61 |
| DCM0:INV.DI14 | 1.F18.B21 |
| DCM0:INV.DI15 | 1.F18.B60 |
| DCM0:INV.DI2 | 2.F18.B18 |
| DCM0:INV.DI3 | 2.F18.B57 |
| DCM0:INV.DI4 | 2.F18.B22 |
| DCM0:INV.DI5 | 2.F18.B61 |
| DCM0:INV.DI6 | 2.F18.B21 |
| DCM0:INV.DI7 | 2.F18.B60 |
| DCM0:INV.DI8 | 1.F18.B19 |
| DCM0:INV.DI9 | 1.F18.B58 |
| DCM0:INV.PSEN | 0.F18.B22 |
| DCM0:INV.PSINCDEC | 0.F18.B57 |
| inverted | ~[0] |
| DCM0:DCM_PERFORMANCE_MODE | 2.F19.B41 |
|---|---|
| MAX_RANGE | 0 |
| MAX_SPEED | 1 |
| DCM0:DCM_VREF_SOURCE | 2.F19.B44 | 2.F19.B43 | 2.F19.B42 |
|---|---|---|---|
| VDD_VBG | 0 | 0 | 0 |
| BGM_SNAP | 1 | 0 | 0 |
| BGM_ABS_SNAP | 1 | 1 | 0 |
| BGM_ABS_REF | 1 | 1 | 1 |
| DCM0:DFS_AVE_FREQ_GAIN | 1.F19.B10 | 1.F19.B9 | 1.F19.B8 |
|---|---|---|---|
| 0.5 | 0 | 0 | 1 |
| 0.25 | 0 | 1 | 0 |
| 0.125 | 0 | 1 | 1 |
| 1.0 | 1 | 0 | 0 |
| 2.0 | 1 | 0 | 1 |
| 4.0 | 1 | 1 | 0 |
| 8.0 | 1 | 1 | 1 |
| DCM0:DFS_COARSE_SEL | 0.F19.B71 |
|---|---|
| DCM0:DFS_FINE_SEL | 0.F19.B72 |
| DCM0:DFS_TP_SEL | 0.F19.B62 |
| LEVEL | 0 |
| LEGACY | 1 |
| DCM0:DFS_FREQUENCY_MODE | 0.F20.B26 |
|---|---|
| LOW | 0 |
| HIGH | 1 |
| DCM0:DFS_OSCILLATOR_MODE | 0.F19.B64 | 0.F19.B63 |
|---|---|---|
| PHASE_FREQ_LOCK | 0 | 0 |
| FREQ_LOCK | 0 | 1 |
| AVE_FREQ_LOCK | 1 | 0 |
| DCM0:DFS_SPARE | 0.F20.B16 | 0.F20.B15 | 0.F20.B14 | 0.F20.B13 | 0.F20.B12 | 0.F20.B11 | 0.F20.B10 | 0.F20.B9 | 0.F20.B8 | 0.F20.B7 | 0.F20.B6 | 0.F20.B5 | 0.F20.B4 | 0.F20.B3 | 0.F20.B2 | 0.F20.B1 |
|---|---|---|---|---|---|---|---|---|---|---|---|---|---|---|---|---|
| DCM0:DLL_SPARE | 2.F20.B16 | 2.F20.B15 | 2.F20.B14 | 2.F20.B13 | 2.F20.B12 | 2.F20.B11 | 2.F20.B10 | 2.F20.B9 | 2.F20.B8 | 2.F20.B7 | 2.F20.B6 | 2.F20.B5 | 2.F20.B4 | 2.F20.B3 | 2.F20.B2 | 2.F20.B1 |
| DCM0:DRP40 | 0.F20.B16 | 0.F20.B15 | 0.F20.B14 | 0.F20.B13 | 0.F20.B12 | 0.F20.B11 | 0.F20.B10 | 0.F20.B9 | 0.F20.B8 | 0.F20.B7 | 0.F20.B6 | 0.F20.B5 | 0.F20.B4 | 0.F20.B3 | 0.F20.B2 | 0.F20.B1 |
| DCM0:DRP41 | 0.F20.B36 | 0.F20.B35 | 0.F20.B34 | 0.F20.B33 | 0.F20.B32 | 0.F20.B31 | 0.F20.B30 | 0.F20.B29 | 0.F20.B28 | 0.F20.B27 | 0.F20.B26 | 0.F20.B25 | 0.F20.B24 | 0.F20.B23 | 0.F20.B22 | 0.F20.B21 |
| DCM0:DRP42 | 0.F20.B56 | 0.F20.B55 | 0.F20.B54 | 0.F20.B53 | 0.F20.B52 | 0.F20.B51 | 0.F20.B50 | 0.F20.B49 | 0.F20.B48 | 0.F20.B47 | 0.F20.B46 | 0.F20.B45 | 0.F20.B44 | 0.F20.B43 | 0.F20.B42 | 0.F20.B41 |
| DCM0:DRP43 | 0.F20.B76 | 0.F20.B75 | 0.F20.B74 | 0.F20.B73 | 0.F20.B72 | 0.F20.B71 | 0.F20.B70 | 0.F20.B69 | 0.F20.B68 | 0.F20.B67 | 0.F20.B66 | 0.F20.B65 | 0.F20.B64 | 0.F20.B63 | 0.F20.B62 | 0.F20.B61 |
| DCM0:DRP44 | 1.F20.B16 | 1.F20.B15 | 1.F20.B14 | 1.F20.B13 | 1.F20.B12 | 1.F20.B11 | 1.F20.B10 | 1.F20.B9 | 1.F20.B8 | 1.F20.B7 | 1.F20.B6 | 1.F20.B5 | 1.F20.B4 | 1.F20.B3 | 1.F20.B2 | 1.F20.B1 |
| DCM0:DRP45 | 1.F20.B36 | 1.F20.B35 | 1.F20.B34 | 1.F20.B33 | 1.F20.B32 | 1.F20.B31 | 1.F20.B30 | 1.F20.B29 | 1.F20.B28 | 1.F20.B27 | 1.F20.B26 | 1.F20.B25 | 1.F20.B24 | 1.F20.B23 | 1.F20.B22 | 1.F20.B21 |
| DCM0:DRP46 | 1.F20.B56 | 1.F20.B55 | 1.F20.B54 | 1.F20.B53 | 1.F20.B52 | 1.F20.B51 | 1.F20.B50 | 1.F20.B49 | 1.F20.B48 | 1.F20.B47 | 1.F20.B46 | 1.F20.B45 | 1.F20.B44 | 1.F20.B43 | 1.F20.B42 | 1.F20.B41 |
| DCM0:DRP47 | 1.F20.B76 | 1.F20.B75 | 1.F20.B74 | 1.F20.B73 | 1.F20.B72 | 1.F20.B71 | 1.F20.B70 | 1.F20.B69 | 1.F20.B68 | 1.F20.B67 | 1.F20.B66 | 1.F20.B65 | 1.F20.B64 | 1.F20.B63 | 1.F20.B62 | 1.F20.B61 |
| DCM0:DRP48 | 2.F20.B16 | 2.F20.B15 | 2.F20.B14 | 2.F20.B13 | 2.F20.B12 | 2.F20.B11 | 2.F20.B10 | 2.F20.B9 | 2.F20.B8 | 2.F20.B7 | 2.F20.B6 | 2.F20.B5 | 2.F20.B4 | 2.F20.B3 | 2.F20.B2 | 2.F20.B1 |
| DCM0:DRP49 | 2.F20.B36 | 2.F20.B35 | 2.F20.B34 | 2.F20.B33 | 2.F20.B32 | 2.F20.B31 | 2.F20.B30 | 2.F20.B29 | 2.F20.B28 | 2.F20.B27 | 2.F20.B26 | 2.F20.B25 | 2.F20.B24 | 2.F20.B23 | 2.F20.B22 | 2.F20.B21 |
| DCM0:DRP4A | 2.F20.B56 | 2.F20.B55 | 2.F20.B54 | 2.F20.B53 | 2.F20.B52 | 2.F20.B51 | 2.F20.B50 | 2.F20.B49 | 2.F20.B48 | 2.F20.B47 | 2.F20.B46 | 2.F20.B45 | 2.F20.B44 | 2.F20.B43 | 2.F20.B42 | 2.F20.B41 |
| DCM0:DRP4B | 2.F20.B76 | 2.F20.B75 | 2.F20.B74 | 2.F20.B73 | 2.F20.B72 | 2.F20.B71 | 2.F20.B70 | 2.F20.B69 | 2.F20.B68 | 2.F20.B67 | 2.F20.B66 | 2.F20.B65 | 2.F20.B64 | 2.F20.B63 | 2.F20.B62 | 2.F20.B61 |
| DCM0:DRP4C | 3.F20.B16 | 3.F20.B15 | 3.F20.B14 | 3.F20.B13 | 3.F20.B12 | 3.F20.B11 | 3.F20.B10 | 3.F20.B9 | 3.F20.B8 | 3.F20.B7 | 3.F20.B6 | 3.F20.B5 | 3.F20.B4 | 3.F20.B3 | 3.F20.B2 | 3.F20.B1 |
| DCM0:DRP4D | 3.F20.B36 | 3.F20.B35 | 3.F20.B34 | 3.F20.B33 | 3.F20.B32 | 3.F20.B31 | 3.F20.B30 | 3.F20.B29 | 3.F20.B28 | 3.F20.B27 | 3.F20.B26 | 3.F20.B25 | 3.F20.B24 | 3.F20.B23 | 3.F20.B22 | 3.F20.B21 |
| DCM0:DRP4E | 3.F20.B56 | 3.F20.B55 | 3.F20.B54 | 3.F20.B53 | 3.F20.B52 | 3.F20.B51 | 3.F20.B50 | 3.F20.B49 | 3.F20.B48 | 3.F20.B47 | 3.F20.B46 | 3.F20.B45 | 3.F20.B44 | 3.F20.B43 | 3.F20.B42 | 3.F20.B41 |
| DCM0:DRP4F | 3.F20.B76 | 3.F20.B75 | 3.F20.B74 | 3.F20.B73 | 3.F20.B72 | 3.F20.B71 | 3.F20.B70 | 3.F20.B69 | 3.F20.B68 | 3.F20.B67 | 3.F20.B66 | 3.F20.B65 | 3.F20.B64 | 3.F20.B63 | 3.F20.B62 | 3.F20.B61 |
| DCM0:DRP50 | 0.F19.B16 | 0.F19.B15 | 0.F19.B14 | 0.F19.B13 | 0.F19.B12 | 0.F19.B11 | 0.F19.B10 | 0.F19.B9 | 0.F19.B8 | 0.F19.B7 | 0.F19.B6 | 0.F19.B5 | 0.F19.B4 | 0.F19.B3 | 0.F19.B2 | 0.F19.B1 |
| DCM0:DRP51 | 0.F19.B36 | 0.F19.B35 | 0.F19.B34 | 0.F19.B33 | 0.F19.B32 | 0.F19.B31 | 0.F19.B30 | 0.F19.B29 | 0.F19.B28 | 0.F19.B27 | 0.F19.B26 | 0.F19.B25 | 0.F19.B24 | 0.F19.B23 | 0.F19.B22 | 0.F19.B21 |
| DCM0:DRP52 | 0.F19.B56 | 0.F19.B55 | 0.F19.B54 | 0.F19.B53 | 0.F19.B52 | 0.F19.B51 | 0.F19.B50 | 0.F19.B49 | 0.F19.B48 | 0.F19.B47 | 0.F19.B46 | 0.F19.B45 | 0.F19.B44 | 0.F19.B43 | 0.F19.B42 | 0.F19.B41 |
| DCM0:DRP53 | 0.F19.B76 | 0.F19.B75 | 0.F19.B74 | 0.F19.B73 | 0.F19.B72 | 0.F19.B71 | 0.F19.B70 | 0.F19.B69 | 0.F19.B68 | 0.F19.B67 | 0.F19.B66 | 0.F19.B65 | 0.F19.B64 | 0.F19.B63 | 0.F19.B62 | 0.F19.B61 |
| DCM0:DRP54 | 1.F19.B16 | 1.F19.B15 | 1.F19.B14 | 1.F19.B13 | 1.F19.B12 | 1.F19.B11 | 1.F19.B10 | 1.F19.B9 | 1.F19.B8 | 1.F19.B7 | 1.F19.B6 | 1.F19.B5 | 1.F19.B4 | 1.F19.B3 | 1.F19.B2 | 1.F19.B1 |
| DCM0:DRP55 | 1.F19.B36 | 1.F19.B35 | 1.F19.B34 | 1.F19.B33 | 1.F19.B32 | 1.F19.B31 | 1.F19.B30 | 1.F19.B29 | 1.F19.B28 | 1.F19.B27 | 1.F19.B26 | 1.F19.B25 | 1.F19.B24 | 1.F19.B23 | 1.F19.B22 | 1.F19.B21 |
| DCM0:DRP56 | 1.F19.B56 | 1.F19.B55 | 1.F19.B54 | 1.F19.B53 | 1.F19.B52 | 1.F19.B51 | 1.F19.B50 | 1.F19.B49 | 1.F19.B48 | 1.F19.B47 | 1.F19.B46 | 1.F19.B45 | 1.F19.B44 | 1.F19.B43 | 1.F19.B42 | 1.F19.B41 |
| DCM0:DRP57 | 1.F19.B76 | 1.F19.B75 | 1.F19.B74 | 1.F19.B73 | 1.F19.B72 | 1.F19.B71 | 1.F19.B70 | 1.F19.B69 | 1.F19.B68 | 1.F19.B67 | 1.F19.B66 | 1.F19.B65 | 1.F19.B64 | 1.F19.B63 | 1.F19.B62 | 1.F19.B61 |
| DCM0:DRP58 | 2.F19.B16 | 2.F19.B15 | 2.F19.B14 | 2.F19.B13 | 2.F19.B12 | 2.F19.B11 | 2.F19.B10 | 2.F19.B9 | 2.F19.B8 | 2.F19.B7 | 2.F19.B6 | 2.F19.B5 | 2.F19.B4 | 2.F19.B3 | 2.F19.B2 | 2.F19.B1 |
| DCM0:DRP59 | 2.F19.B36 | 2.F19.B35 | 2.F19.B34 | 2.F19.B33 | 2.F19.B32 | 2.F19.B31 | 2.F19.B30 | 2.F19.B29 | 2.F19.B28 | 2.F19.B27 | 2.F19.B26 | 2.F19.B25 | 2.F19.B24 | 2.F19.B23 | 2.F19.B22 | 2.F19.B21 |
| DCM0:DRP5A | 2.F19.B56 | 2.F19.B55 | 2.F19.B54 | 2.F19.B53 | 2.F19.B52 | 2.F19.B51 | 2.F19.B50 | 2.F19.B49 | 2.F19.B48 | 2.F19.B47 | 2.F19.B46 | 2.F19.B45 | 2.F19.B44 | 2.F19.B43 | 2.F19.B42 | 2.F19.B41 |
| DCM0:DRP5B | 2.F19.B76 | 2.F19.B75 | 2.F19.B74 | 2.F19.B73 | 2.F19.B72 | 2.F19.B71 | 2.F19.B70 | 2.F19.B69 | 2.F19.B68 | 2.F19.B67 | 2.F19.B66 | 2.F19.B65 | 2.F19.B64 | 2.F19.B63 | 2.F19.B62 | 2.F19.B61 |
| DCM0:DRP5C | 3.F19.B16 | 3.F19.B15 | 3.F19.B14 | 3.F19.B13 | 3.F19.B12 | 3.F19.B11 | 3.F19.B10 | 3.F19.B9 | 3.F19.B8 | 3.F19.B7 | 3.F19.B6 | 3.F19.B5 | 3.F19.B4 | 3.F19.B3 | 3.F19.B2 | 3.F19.B1 |
| DCM0:DRP5D | 3.F19.B36 | 3.F19.B35 | 3.F19.B34 | 3.F19.B33 | 3.F19.B32 | 3.F19.B31 | 3.F19.B30 | 3.F19.B29 | 3.F19.B28 | 3.F19.B27 | 3.F19.B26 | 3.F19.B25 | 3.F19.B24 | 3.F19.B23 | 3.F19.B22 | 3.F19.B21 |
| DCM0:DRP5E | 3.F19.B56 | 3.F19.B55 | 3.F19.B54 | 3.F19.B53 | 3.F19.B52 | 3.F19.B51 | 3.F19.B50 | 3.F19.B49 | 3.F19.B48 | 3.F19.B47 | 3.F19.B46 | 3.F19.B45 | 3.F19.B44 | 3.F19.B43 | 3.F19.B42 | 3.F19.B41 |
| DCM0:DRP5F | 3.F19.B76 | 3.F19.B75 | 3.F19.B74 | 3.F19.B73 | 3.F19.B72 | 3.F19.B71 | 3.F19.B70 | 3.F19.B69 | 3.F19.B68 | 3.F19.B67 | 3.F19.B66 | 3.F19.B65 | 3.F19.B64 | 3.F19.B63 | 3.F19.B62 | 3.F19.B61 |
| DCM0:FACTORY_JF | 2.F19.B36 | 2.F19.B35 | 2.F19.B34 | 2.F19.B33 | 2.F19.B32 | 2.F19.B31 | 2.F19.B30 | 2.F19.B29 | 2.F19.B28 | 2.F19.B27 | 2.F19.B26 | 2.F19.B25 | 2.F19.B24 | 2.F19.B23 | 2.F19.B22 | 2.F19.B21 |
| non-inverted | [15] | [14] | [13] | [12] | [11] | [10] | [9] | [8] | [7] | [6] | [5] | [4] | [3] | [2] | [1] | [0] |
| DCM0:DLL_CONTROL_CLOCK_SPEED | 0.F19.B76 |
|---|---|
| HALF | 0 |
| QUARTER | 1 |
| DCM0:DLL_DEAD_TIME | 3.F19.B36 | 3.F19.B35 | 3.F19.B34 | 3.F19.B33 | 3.F19.B32 | 3.F19.B31 | 3.F19.B30 | 3.F19.B29 |
|---|---|---|---|---|---|---|---|---|
| DCM0:DLL_DESKEW_MAXTAP | 2.F19.B76 | 2.F19.B75 | 2.F19.B74 | 2.F19.B73 | 2.F19.B72 | 2.F19.B71 | 2.F19.B70 | 2.F19.B69 |
| DCM0:DLL_DESKEW_MINTAP | 2.F19.B68 | 2.F19.B67 | 2.F19.B66 | 2.F19.B65 | 2.F19.B64 | 2.F19.B63 | 2.F19.B62 | 2.F19.B61 |
| DCM0:DLL_LIVE_TIME | 3.F19.B28 | 3.F19.B27 | 3.F19.B26 | 3.F19.B25 | 3.F19.B24 | 3.F19.B23 | 3.F19.B22 | 3.F19.B21 |
| DCM0:DLL_PHASE_SHIFT_HFC | 1.F19.B76 | 1.F19.B75 | 1.F19.B74 | 1.F19.B73 | 1.F19.B72 | 1.F19.B71 | 1.F19.B70 | 1.F19.B69 |
| DCM0:DLL_PHASE_SHIFT_LFC | 1.F19.B68 | 1.F19.B67 | 1.F19.B66 | 1.F19.B65 | 1.F19.B64 | 1.F19.B63 | 1.F19.B62 | 1.F19.B61 |
| DCM0:DLL_SETTLE_TIME | 3.F19.B48 | 3.F19.B47 | 3.F19.B46 | 3.F19.B45 | 3.F19.B44 | 3.F19.B43 | 3.F19.B42 | 3.F19.B41 |
| non-inverted | [7] | [6] | [5] | [4] | [3] | [2] | [1] | [0] |
| DCM0:DLL_FREQUENCY_MODE | 2.F19.B8 | 2.F19.B7 |
|---|---|---|
| LOW | 0 | 0 |
| HIGH_SER | 0 | 1 |
| HIGH | 1 | 1 |
| DCM0:DLL_PHASE_DETECTOR_MODE | 2.F19.B9 |
|---|---|
| LEVEL | 0 |
| ENHANCED | 1 |
| DCM0:DLL_PHASE_SHIFT_CALIBRATION | 1.F19.B45 | 1.F19.B46 |
|---|---|---|
| AUTO_DPS | 0 | 0 |
| MASK | 0 | 1 |
| CONFIG | 1 | 0 |
| AUTO_ZD2 | 1 | 1 |
| DCM0:MUX.BUSOUT0 | 0.F21.B60 | 0.F21.B59 | 0.F21.B58 | 0.F21.B55 | 0.F21.B56 | 0.F21.B54 | 0.F21.B57 | 3.F21.B24 |
|---|---|---|---|---|---|---|---|---|
| DCM0:MUX.BUSOUT1 | 0.F21.B67 | 0.F21.B66 | 0.F21.B65 | 0.F21.B62 | 0.F21.B63 | 0.F21.B61 | 0.F21.B64 | 3.F21.B25 |
| DCM0:MUX.BUSOUT10 | 1.F21.B52 | 1.F21.B51 | 1.F21.B50 | 1.F21.B47 | 1.F21.B48 | 1.F21.B46 | 1.F21.B49 | 3.F21.B34 |
| DCM0:MUX.BUSOUT11 | 1.F21.B59 | 1.F21.B58 | 1.F21.B57 | 1.F21.B54 | 1.F21.B55 | 1.F21.B53 | 1.F21.B56 | 3.F21.B35 |
| DCM0:MUX.BUSOUT12 | 1.F21.B66 | 1.F21.B65 | 1.F21.B64 | 1.F21.B61 | 1.F21.B62 | 1.F21.B60 | 1.F21.B63 | 3.F21.B36 |
| DCM0:MUX.BUSOUT13 | 2.F21.B1 | 2.F21.B0 | 1.F21.B71 | 1.F21.B68 | 1.F21.B69 | 1.F21.B67 | 1.F21.B70 | 3.F21.B37 |
| DCM0:MUX.BUSOUT14 | 2.F21.B8 | 2.F21.B7 | 2.F21.B6 | 2.F21.B3 | 2.F21.B4 | 2.F21.B2 | 2.F21.B5 | 3.F21.B38 |
| DCM0:MUX.BUSOUT15 | 2.F21.B15 | 2.F21.B14 | 2.F21.B13 | 2.F21.B10 | 2.F21.B11 | 2.F21.B9 | 2.F21.B12 | 3.F21.B39 |
| DCM0:MUX.BUSOUT16 | 2.F21.B22 | 2.F21.B21 | 2.F21.B20 | 2.F21.B17 | 2.F21.B18 | 2.F21.B16 | 2.F21.B19 | 3.F21.B40 |
| DCM0:MUX.BUSOUT17 | 2.F21.B29 | 2.F21.B28 | 2.F21.B27 | 2.F21.B24 | 2.F21.B25 | 2.F21.B23 | 2.F21.B26 | 3.F21.B41 |
| DCM0:MUX.BUSOUT18 | 2.F21.B36 | 2.F21.B35 | 2.F21.B34 | 2.F21.B31 | 2.F21.B32 | 2.F21.B30 | 2.F21.B33 | 3.F21.B42 |
| DCM0:MUX.BUSOUT19 | 2.F21.B43 | 2.F21.B42 | 2.F21.B41 | 2.F21.B38 | 2.F21.B39 | 2.F21.B37 | 2.F21.B40 | 3.F21.B43 |
| DCM0:MUX.BUSOUT2 | 0.F21.B74 | 0.F21.B73 | 0.F21.B72 | 0.F21.B69 | 0.F21.B70 | 0.F21.B68 | 0.F21.B71 | 3.F21.B26 |
| DCM0:MUX.BUSOUT20 | 3.F21.B2 | 3.F21.B1 | 3.F21.B0 | 2.F21.B45 | 2.F21.B46 | 2.F21.B44 | 2.F21.B47 | 3.F21.B44 |
| DCM0:MUX.BUSOUT21 | 3.F21.B9 | 3.F21.B8 | 3.F21.B7 | 3.F21.B4 | 3.F21.B5 | 3.F21.B3 | 3.F21.B6 | 3.F21.B45 |
| DCM0:MUX.BUSOUT22 | 3.F21.B16 | 3.F21.B15 | 3.F21.B14 | 3.F21.B11 | 3.F21.B12 | 3.F21.B10 | 3.F21.B13 | 3.F21.B46 |
| DCM0:MUX.BUSOUT23 | 3.F21.B23 | 3.F21.B22 | 3.F21.B21 | 3.F21.B18 | 3.F21.B19 | 3.F21.B17 | 3.F21.B20 | 3.F21.B47 |
| DCM0:MUX.BUSOUT3 | 1.F21.B3 | 1.F21.B2 | 1.F21.B1 | 0.F21.B76 | 0.F21.B77 | 0.F21.B75 | 1.F21.B0 | 3.F21.B27 |
| DCM0:MUX.BUSOUT4 | 1.F21.B10 | 1.F21.B9 | 1.F21.B8 | 1.F21.B5 | 1.F21.B6 | 1.F21.B4 | 1.F21.B7 | 3.F21.B28 |
| DCM0:MUX.BUSOUT5 | 1.F21.B17 | 1.F21.B16 | 1.F21.B15 | 1.F21.B12 | 1.F21.B13 | 1.F21.B11 | 1.F21.B14 | 3.F21.B29 |
| DCM0:MUX.BUSOUT6 | 1.F21.B24 | 1.F21.B23 | 1.F21.B22 | 1.F21.B19 | 1.F21.B20 | 1.F21.B18 | 1.F21.B21 | 3.F21.B30 |
| DCM0:MUX.BUSOUT7 | 1.F21.B31 | 1.F21.B30 | 1.F21.B29 | 1.F21.B26 | 1.F21.B27 | 1.F21.B25 | 1.F21.B28 | 3.F21.B31 |
| DCM0:MUX.BUSOUT8 | 1.F21.B38 | 1.F21.B37 | 1.F21.B36 | 1.F21.B33 | 1.F21.B34 | 1.F21.B32 | 1.F21.B35 | 3.F21.B32 |
| DCM0:MUX.BUSOUT9 | 1.F21.B45 | 1.F21.B44 | 1.F21.B43 | 1.F21.B40 | 1.F21.B41 | 1.F21.B39 | 1.F21.B42 | 3.F21.B33 |
| PASS | 0 | 0 | 0 | 0 | 0 | 0 | 0 | 0 |
| CLK0 | 0 | 0 | 1 | 0 | 0 | 0 | 1 | 1 |
| CONCUR | 0 | 0 | 1 | 0 | 0 | 1 | 0 | 1 |
| CLKFX180 | 0 | 0 | 1 | 0 | 1 | 0 | 0 | 1 |
| CLKFX | 0 | 0 | 1 | 1 | 0 | 0 | 0 | 1 |
| CLK90 | 0 | 1 | 0 | 0 | 0 | 0 | 1 | 1 |
| CLK180 | 0 | 1 | 0 | 0 | 0 | 1 | 0 | 1 |
| CLK_IN0 | 0 | 1 | 0 | 0 | 1 | 0 | 0 | 1 |
| LOCKED | 0 | 1 | 0 | 1 | 0 | 0 | 0 | 1 |
| CLKDV | 1 | 0 | 0 | 0 | 0 | 0 | 1 | 1 |
| CLK270 | 1 | 0 | 0 | 0 | 0 | 1 | 0 | 1 |
| CLK2X | 1 | 0 | 0 | 0 | 1 | 0 | 0 | 1 |
| CLK2X180 | 1 | 0 | 0 | 1 | 0 | 0 | 0 | 1 |
| DCM0:MUX.CLKFB | 0.F21.B14 | 0.F21.B21 | 0.F21.B16 | 0.F21.B15 | 0.F21.B13 | 0.F21.B12 | 0.F21.B11 | 0.F21.B20 | 0.F21.B19 | 0.F21.B18 | 0.F21.B17 |
|---|---|---|---|---|---|---|---|---|---|---|---|
| DCM0:MUX.CLKIN | 0.F21.B3 | 0.F21.B10 | 0.F21.B5 | 0.F21.B4 | 0.F21.B2 | 0.F21.B1 | 0.F21.B0 | 0.F21.B9 | 0.F21.B8 | 0.F21.B7 | 0.F21.B6 |
| HCLK0 | 0 | 0 | 0 | 0 | 0 | 0 | 0 | 0 | 0 | 0 | 0 |
| HCLK1 | 0 | 0 | 0 | 0 | 0 | 0 | 0 | 0 | 0 | 1 | 1 |
| HCLK2 | 0 | 0 | 0 | 0 | 0 | 0 | 0 | 0 | 1 | 0 | 1 |
| HCLK3 | 0 | 0 | 0 | 0 | 0 | 0 | 0 | 1 | 0 | 0 | 1 |
| HCLK4 | 0 | 0 | 0 | 0 | 0 | 1 | 1 | 0 | 0 | 0 | 0 |
| HCLK5 | 0 | 0 | 0 | 0 | 0 | 1 | 1 | 0 | 0 | 1 | 1 |
| HCLK6 | 0 | 0 | 0 | 0 | 0 | 1 | 1 | 0 | 1 | 0 | 1 |
| HCLK7 | 0 | 0 | 0 | 0 | 0 | 1 | 1 | 1 | 0 | 0 | 1 |
| GIOB0 | 0 | 0 | 0 | 0 | 1 | 0 | 1 | 0 | 0 | 0 | 0 |
| GIOB1 | 0 | 0 | 0 | 0 | 1 | 0 | 1 | 0 | 0 | 1 | 1 |
| GIOB2 | 0 | 0 | 0 | 0 | 1 | 0 | 1 | 0 | 1 | 0 | 1 |
| GIOB3 | 0 | 0 | 0 | 0 | 1 | 0 | 1 | 1 | 0 | 0 | 1 |
| GIOB4 | 0 | 0 | 0 | 1 | 0 | 0 | 1 | 0 | 0 | 1 | 1 |
| GIOB5 | 0 | 0 | 0 | 1 | 0 | 0 | 1 | 0 | 1 | 0 | 1 |
| GIOB6 | 0 | 0 | 0 | 1 | 0 | 0 | 1 | 1 | 0 | 0 | 1 |
| GIOB7 | 0 | 0 | 1 | 0 | 0 | 0 | 1 | 0 | 0 | 0 | 0 |
| GIOB8 | 0 | 0 | 1 | 0 | 0 | 0 | 1 | 0 | 0 | 1 | 1 |
| GIOB9 | 0 | 0 | 1 | 0 | 0 | 0 | 1 | 0 | 1 | 0 | 1 |
| GIOB10 | 0 | 0 | 1 | 0 | 0 | 0 | 1 | 1 | 0 | 0 | 1 |
| CKINT3 | 0 | 1 | 0 | 0 | 0 | 0 | 0 | 0 | 0 | 0 | 0 |
| CKINT2 | 0 | 1 | 0 | 0 | 0 | 0 | 0 | 0 | 0 | 1 | 1 |
| CKINT1 | 0 | 1 | 0 | 0 | 0 | 0 | 0 | 0 | 1 | 0 | 1 |
| CKINT0 | 0 | 1 | 0 | 0 | 0 | 0 | 0 | 1 | 0 | 0 | 1 |
| MGT3 | 0 | 1 | 0 | 0 | 1 | 0 | 1 | 0 | 0 | 0 | 0 |
| MGT2 | 0 | 1 | 0 | 0 | 1 | 0 | 1 | 0 | 0 | 1 | 1 |
| MGT0 | 0 | 1 | 0 | 1 | 0 | 0 | 1 | 0 | 0 | 0 | 0 |
| BUSOUT1 | 0 | 1 | 0 | 1 | 0 | 0 | 1 | 0 | 0 | 1 | 1 |
| BUSOUT0 | 0 | 1 | 0 | 1 | 0 | 0 | 1 | 0 | 1 | 0 | 1 |
| GIOB15 | 0 | 1 | 0 | 1 | 0 | 0 | 1 | 1 | 0 | 0 | 1 |
| GIOB14 | 0 | 1 | 1 | 0 | 0 | 0 | 1 | 0 | 0 | 0 | 0 |
| GIOB13 | 0 | 1 | 1 | 0 | 0 | 0 | 1 | 0 | 0 | 1 | 1 |
| GIOB12 | 0 | 1 | 1 | 0 | 0 | 0 | 1 | 0 | 1 | 0 | 1 |
| GIOB11 | 0 | 1 | 1 | 0 | 0 | 0 | 1 | 1 | 0 | 0 | 1 |
| MGT1 | 1 | 1 | 0 | 0 | 0 | 0 | 1 | 1 | 0 | 0 | 1 |
| DCM0:PHASE_SHIFT | 1.F19.B30 | 1.F19.B29 | 1.F19.B28 | 1.F19.B27 | 1.F19.B26 | 1.F19.B25 | 1.F19.B24 | 1.F19.B23 | 1.F19.B22 | 1.F19.B21 |
|---|---|---|---|---|---|---|---|---|---|---|
| non-inverted | [9] | [8] | [7] | [6] | [5] | [4] | [3] | [2] | [1] | [0] |
| DCM0:PS_MODE | 1.F19.B43 |
|---|---|
| CLKFB | 0 |
| CLKIN | 1 |