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Configuration Center

TODO: document

Tile CFG

Cells: 50 IRIs: 0

Bel PMVIOB

virtex7 CFG bel PMVIOB
PinDirectionWires
A0inputTCELL25:IMUX.IMUX24
A1inputTCELL25:IMUX.IMUX25
ENinputTCELL25:IMUX.IMUX26
OoutputTCELL25:OUT21
ODIV2outputTCELL25:OUT20
ODIV4outputTCELL25:OUT19

Bel BSCAN0

virtex7 CFG bel BSCAN0
PinDirectionWires
CAPTUREoutputTCELL22:OUT22
DRCKoutputTCELL22:OUT20
RESEToutputTCELL22:OUT18
RUNTESToutputTCELL22:OUT8
SELoutputTCELL22:OUT14
SHIFToutputTCELL23:OUT16
TCKoutputTCELL23:OUT14
TDIoutputTCELL23:OUT12
TDOinputTCELL23:IMUX.IMUX33
TMSoutputTCELL23:OUT10
UPDATEoutputTCELL22:OUT16

Bel BSCAN1

virtex7 CFG bel BSCAN1
PinDirectionWires
CAPTUREoutputTCELL22:OUT23
DRCKoutputTCELL22:OUT21
RESEToutputTCELL22:OUT19
RUNTESToutputTCELL22:OUT9
SELoutputTCELL22:OUT15
SHIFToutputTCELL23:OUT17
TCKoutputTCELL23:OUT15
TDIoutputTCELL23:OUT13
TDOinputTCELL23:IMUX.IMUX34
TMSoutputTCELL23:OUT11
UPDATEoutputTCELL22:OUT17

Bel BSCAN2

virtex7 CFG bel BSCAN2
PinDirectionWires
CAPTUREoutputTCELL31:OUT11
DRCKoutputTCELL30:OUT22
RESEToutputTCELL30:OUT20
RUNTESToutputTCELL31:OUT13
SELoutputTCELL30:OUT16
SHIFToutputTCELL31:OUT21
TCKoutputTCELL31:OUT19
TDIoutputTCELL31:OUT17
TDOinputTCELL31:IMUX.IMUX38
TMSoutputTCELL31:OUT15
UPDATEoutputTCELL30:OUT18

Bel BSCAN3

virtex7 CFG bel BSCAN3
PinDirectionWires
CAPTUREoutputTCELL31:OUT12
DRCKoutputTCELL30:OUT23
RESEToutputTCELL30:OUT21
RUNTESToutputTCELL31:OUT14
SELoutputTCELL30:OUT17
SHIFToutputTCELL31:OUT22
TCKoutputTCELL31:OUT20
TDIoutputTCELL31:OUT18
TDOinputTCELL31:IMUX.IMUX39
TMSoutputTCELL31:OUT16
UPDATEoutputTCELL30:OUT19

Bel ICAP0

virtex7 CFG bel ICAP0
PinDirectionWires
CLKinputTCELL26:IMUX.CLK1
CSIBinputTCELL31:IMUX.IMUX40
I0inputTCELL24:IMUX.IMUX28
I1inputTCELL24:IMUX.IMUX29
I10inputTCELL24:IMUX.IMUX38
I11inputTCELL24:IMUX.IMUX39
I12inputTCELL24:IMUX.IMUX40
I13inputTCELL24:IMUX.IMUX41
I14inputTCELL24:IMUX.IMUX42
I15inputTCELL24:IMUX.IMUX43
I16inputTCELL25:IMUX.IMUX27
I17inputTCELL25:IMUX.IMUX28
I18inputTCELL25:IMUX.IMUX29
I19inputTCELL25:IMUX.IMUX30
I2inputTCELL24:IMUX.IMUX30
I20inputTCELL25:IMUX.IMUX31
I21inputTCELL25:IMUX.IMUX32
I22inputTCELL25:IMUX.IMUX33
I23inputTCELL25:IMUX.IMUX34
I24inputTCELL25:IMUX.IMUX35
I25inputTCELL25:IMUX.IMUX36
I26inputTCELL25:IMUX.IMUX37
I27inputTCELL25:IMUX.IMUX38
I28inputTCELL25:IMUX.IMUX39
I29inputTCELL25:IMUX.IMUX40
I3inputTCELL24:IMUX.IMUX31
I30inputTCELL25:IMUX.IMUX41
I31inputTCELL25:IMUX.IMUX42
I4inputTCELL24:IMUX.IMUX32
I5inputTCELL24:IMUX.IMUX33
I6inputTCELL24:IMUX.IMUX34
I7inputTCELL24:IMUX.IMUX35
I8inputTCELL24:IMUX.IMUX36
I9inputTCELL24:IMUX.IMUX37
O0outputTCELL24:OUT16
O1outputTCELL24:OUT17
O10outputTCELL24:OUT10
O11outputTCELL24:OUT11
O12outputTCELL24:OUT12
O13outputTCELL24:OUT13
O14outputTCELL24:OUT14
O15outputTCELL24:OUT15
O16outputTCELL25:OUT16
O17outputTCELL25:OUT17
O18outputTCELL24:OUT18
O19outputTCELL24:OUT19
O2outputTCELL23:OUT18
O20outputTCELL24:OUT20
O21outputTCELL24:OUT21
O22outputTCELL24:OUT22
O23outputTCELL24:OUT23
O24outputTCELL24:OUT8
O25outputTCELL24:OUT9
O26outputTCELL25:OUT10
O27outputTCELL25:OUT11
O28outputTCELL25:OUT12
O29outputTCELL25:OUT13
O3outputTCELL23:OUT19
O30outputTCELL25:OUT14
O31outputTCELL25:OUT15
O4outputTCELL23:OUT20
O5outputTCELL23:OUT21
O6outputTCELL23:OUT22
O7outputTCELL23:OUT23
O8outputTCELL23:OUT8
O9outputTCELL23:OUT9
RDWRBinputTCELL31:IMUX.IMUX41

Bel ICAP1

virtex7 CFG bel ICAP1
PinDirectionWires
CLKinputTCELL40:IMUX.CLK1
CSIBinputTCELL31:IMUX.IMUX43
I0inputTCELL32:IMUX.IMUX28
I1inputTCELL32:IMUX.IMUX29
I10inputTCELL32:IMUX.IMUX38
I11inputTCELL32:IMUX.IMUX39
I12inputTCELL32:IMUX.IMUX40
I13inputTCELL32:IMUX.IMUX41
I14inputTCELL32:IMUX.IMUX42
I15inputTCELL32:IMUX.IMUX43
I16inputTCELL33:IMUX.IMUX28
I17inputTCELL33:IMUX.IMUX29
I18inputTCELL33:IMUX.IMUX30
I19inputTCELL33:IMUX.IMUX31
I2inputTCELL32:IMUX.IMUX30
I20inputTCELL33:IMUX.IMUX32
I21inputTCELL33:IMUX.IMUX33
I22inputTCELL33:IMUX.IMUX34
I23inputTCELL33:IMUX.IMUX35
I24inputTCELL33:IMUX.IMUX36
I25inputTCELL33:IMUX.IMUX37
I26inputTCELL33:IMUX.IMUX38
I27inputTCELL33:IMUX.IMUX39
I28inputTCELL33:IMUX.IMUX40
I29inputTCELL33:IMUX.IMUX41
I3inputTCELL32:IMUX.IMUX31
I30inputTCELL33:IMUX.IMUX42
I31inputTCELL33:IMUX.IMUX43
I4inputTCELL32:IMUX.IMUX32
I5inputTCELL32:IMUX.IMUX33
I6inputTCELL32:IMUX.IMUX34
I7inputTCELL32:IMUX.IMUX35
I8inputTCELL32:IMUX.IMUX36
I9inputTCELL32:IMUX.IMUX37
O0outputTCELL31:OUT23
O1outputTCELL32:OUT12
O10outputTCELL32:OUT21
O11outputTCELL32:OUT22
O12outputTCELL32:OUT23
O13outputTCELL33:OUT12
O14outputTCELL33:OUT13
O15outputTCELL33:OUT14
O16outputTCELL33:OUT15
O17outputTCELL33:OUT16
O18outputTCELL33:OUT17
O19outputTCELL33:OUT18
O2outputTCELL32:OUT13
O20outputTCELL33:OUT19
O21outputTCELL33:OUT20
O22outputTCELL33:OUT21
O23outputTCELL33:OUT22
O24outputTCELL33:OUT23
O25outputTCELL34:OUT10
O26outputTCELL34:OUT11
O27outputTCELL34:OUT12
O28outputTCELL34:OUT13
O29outputTCELL34:OUT14
O3outputTCELL32:OUT14
O30outputTCELL34:OUT15
O31outputTCELL34:OUT16
O4outputTCELL32:OUT15
O5outputTCELL32:OUT16
O6outputTCELL32:OUT17
O7outputTCELL32:OUT18
O8outputTCELL32:OUT19
O9outputTCELL32:OUT20
RDWRBinputTCELL31:IMUX.IMUX42

Bel STARTUP

virtex7 CFG bel STARTUP
PinDirectionWires
CFGCLKoutputTCELL30:OUT14
CFGMCLKoutputTCELL25:OUT18
CLKinputTCELL25:IMUX.CLK1
EOSoutputTCELL29:OUT23
GSRinputTCELL28:IMUX.IMUX40
GTSinputTCELL28:IMUX.IMUX39
KEYCLEARBinputTCELL28:IMUX.IMUX36
PACKinputTCELL28:IMUX.IMUX43
PREQoutputTCELL29:OUT22
USRCCLKOinputTCELL27:IMUX.CLK1
USRCCLKTSinputTCELL28:IMUX.IMUX38
USRDONEOinputTCELL28:IMUX.IMUX42
USRDONETSinputTCELL28:IMUX.IMUX41

Bel CAPTURE

virtex7 CFG bel CAPTURE
PinDirectionWires
CAPinputTCELL28:IMUX.IMUX37
CLKinputTCELL29:IMUX.CLK1

Bel DCIRESET

virtex7 CFG bel DCIRESET
PinDirectionWires
LOCKEDoutputTCELL29:OUT21
RSTinputTCELL28:IMUX.IMUX35

Bel FRAME_ECC

virtex7 CFG bel FRAME_ECC
PinDirectionWires
CRCERRORoutputTCELL30:OUT15
ECCERRORoutputTCELL29:OUT20
ECCERRORSINGLEoutputTCELL28:OUT23
FAR0outputTCELL26:OUT10
FAR1outputTCELL26:OUT11
FAR10outputTCELL26:OUT20
FAR11outputTCELL26:OUT21
FAR12outputTCELL26:OUT22
FAR13outputTCELL26:OUT23
FAR14outputTCELL26:OUT8
FAR15outputTCELL26:OUT9
FAR16outputTCELL27:OUT10
FAR17outputTCELL27:OUT11
FAR18outputTCELL27:OUT12
FAR19outputTCELL27:OUT13
FAR2outputTCELL26:OUT12
FAR20outputTCELL27:OUT14
FAR21outputTCELL27:OUT15
FAR22outputTCELL27:OUT16
FAR23outputTCELL27:OUT17
FAR24outputTCELL27:OUT18
FAR25outputTCELL27:OUT19
FAR3outputTCELL26:OUT13
FAR4outputTCELL26:OUT14
FAR5outputTCELL26:OUT15
FAR6outputTCELL26:OUT16
FAR7outputTCELL26:OUT17
FAR8outputTCELL26:OUT18
FAR9outputTCELL26:OUT19
SYNBIT0outputTCELL28:OUT18
SYNBIT1outputTCELL28:OUT19
SYNBIT2outputTCELL28:OUT20
SYNBIT3outputTCELL28:OUT21
SYNBIT4outputTCELL28:OUT22
SYNDROME0outputTCELL21:OUT14
SYNDROME1outputTCELL21:OUT15
SYNDROME10outputTCELL22:OUT10
SYNDROME11outputTCELL22:OUT11
SYNDROME12outputTCELL22:OUT12
SYNDROME2outputTCELL21:OUT16
SYNDROME3outputTCELL21:OUT17
SYNDROME4outputTCELL21:OUT18
SYNDROME5outputTCELL21:OUT19
SYNDROME6outputTCELL21:OUT20
SYNDROME7outputTCELL21:OUT21
SYNDROME8outputTCELL21:OUT22
SYNDROME9outputTCELL21:OUT23
SYNDROMEVALIDoutputTCELL22:OUT13
SYNWORD0outputTCELL27:OUT20
SYNWORD1outputTCELL27:OUT21
SYNWORD2outputTCELL27:OUT22
SYNWORD3outputTCELL27:OUT23
SYNWORD4outputTCELL27:OUT8
SYNWORD5outputTCELL27:OUT9
SYNWORD6outputTCELL28:OUT17

Bel USR_ACCESS

virtex7 CFG bel USR_ACCESS
PinDirectionWires
CFGCLKoutputTCELL25:OUT9
DATA0outputTCELL20:OUT11
DATA1outputTCELL20:OUT12
DATA10outputTCELL19:OUT21
DATA11outputTCELL19:OUT22
DATA12outputTCELL19:OUT23
DATA13outputTCELL19:OUT10
DATA14outputTCELL19:OUT11
DATA15outputTCELL20:OUT10
DATA16outputTCELL21:OUT11
DATA17outputTCELL21:OUT12
DATA18outputTCELL20:OUT13
DATA19outputTCELL20:OUT14
DATA2outputTCELL19:OUT13
DATA20outputTCELL20:OUT15
DATA21outputTCELL20:OUT16
DATA22outputTCELL20:OUT17
DATA23outputTCELL20:OUT18
DATA24outputTCELL20:OUT19
DATA25outputTCELL20:OUT20
DATA26outputTCELL20:OUT21
DATA27outputTCELL20:OUT22
DATA28outputTCELL20:OUT23
DATA29outputTCELL20:OUT8
DATA3outputTCELL19:OUT14
DATA30outputTCELL20:OUT9
DATA31outputTCELL21:OUT10
DATA4outputTCELL19:OUT15
DATA5outputTCELL19:OUT16
DATA6outputTCELL19:OUT17
DATA7outputTCELL19:OUT18
DATA8outputTCELL19:OUT19
DATA9outputTCELL19:OUT20
DATAVALIDoutputTCELL21:OUT13

Bel DNA_PORT

virtex7 CFG bel DNA_PORT
PinDirectionWires
CLKinputTCELL28:IMUX.CLK1
DINinputTCELL45:IMUX.IMUX43
DOUToutputTCELL45:OUT23
READinputTCELL45:IMUX.IMUX41
SHIFTinputTCELL45:IMUX.IMUX42

Bel EFUSE_USR

virtex7 CFG bel EFUSE_USR
PinDirectionWires
EFUSEUSR0outputTCELL46:OUT16
EFUSEUSR1outputTCELL46:OUT17
EFUSEUSR10outputTCELL47:OUT18
EFUSEUSR11outputTCELL47:OUT19
EFUSEUSR12outputTCELL47:OUT20
EFUSEUSR13outputTCELL47:OUT21
EFUSEUSR14outputTCELL47:OUT22
EFUSEUSR15outputTCELL47:OUT23
EFUSEUSR16outputTCELL48:OUT16
EFUSEUSR17outputTCELL48:OUT17
EFUSEUSR18outputTCELL48:OUT18
EFUSEUSR19outputTCELL48:OUT19
EFUSEUSR2outputTCELL46:OUT18
EFUSEUSR20outputTCELL48:OUT20
EFUSEUSR21outputTCELL48:OUT21
EFUSEUSR22outputTCELL48:OUT22
EFUSEUSR23outputTCELL48:OUT23
EFUSEUSR24outputTCELL49:OUT16
EFUSEUSR25outputTCELL49:OUT17
EFUSEUSR26outputTCELL49:OUT18
EFUSEUSR27outputTCELL49:OUT19
EFUSEUSR28outputTCELL49:OUT20
EFUSEUSR29outputTCELL49:OUT21
EFUSEUSR3outputTCELL46:OUT19
EFUSEUSR30outputTCELL49:OUT22
EFUSEUSR31outputTCELL49:OUT23
EFUSEUSR4outputTCELL46:OUT20
EFUSEUSR5outputTCELL46:OUT21
EFUSEUSR6outputTCELL46:OUT22
EFUSEUSR7outputTCELL46:OUT23
EFUSEUSR8outputTCELL47:OUT16
EFUSEUSR9outputTCELL47:OUT17

Bel CFG_IO_ACCESS

virtex7 CFG bel CFG_IO_ACCESS
PinDirectionWires
CCLKoutputTCELL34:OUT18
CFGDATA0outputTCELL35:OUT13
CFGDATA1outputTCELL35:OUT14
CFGDATA10outputTCELL35:OUT23
CFGDATA11outputTCELL42:OUT20
CFGDATA12outputTCELL42:OUT21
CFGDATA13outputTCELL42:OUT22
CFGDATA14outputTCELL42:OUT23
CFGDATA15outputTCELL43:OUT16
CFGDATA16outputTCELL43:OUT17
CFGDATA17outputTCELL43:OUT18
CFGDATA18outputTCELL43:OUT19
CFGDATA19outputTCELL43:OUT20
CFGDATA2outputTCELL35:OUT15
CFGDATA20outputTCELL43:OUT21
CFGDATA21outputTCELL43:OUT22
CFGDATA22outputTCELL43:OUT23
CFGDATA23outputTCELL44:OUT22
CFGDATA24outputTCELL44:OUT23
CFGDATA25outputTCELL45:OUT16
CFGDATA26outputTCELL45:OUT17
CFGDATA27outputTCELL45:OUT18
CFGDATA28outputTCELL45:OUT19
CFGDATA29outputTCELL45:OUT20
CFGDATA3outputTCELL35:OUT16
CFGDATA30outputTCELL45:OUT21
CFGDATA31outputTCELL45:OUT22
CFGDATA4outputTCELL35:OUT17
CFGDATA5outputTCELL35:OUT18
CFGDATA6outputTCELL35:OUT19
CFGDATA7outputTCELL35:OUT20
CFGDATA8outputTCELL35:OUT21
CFGDATA9outputTCELL35:OUT22
INITBIoutputTCELL34:OUT19
INITBOinputTCELL34:IMUX.IMUX39
MASTERoutputTCELL34:OUT17
MODE0outputTCELL34:OUT22
MODE1outputTCELL34:OUT23
MODE2outputTCELL35:OUT12
PUDCBoutputTCELL34:OUT21
RDWRBoutputTCELL34:OUT20
TDOinputTCELL34:IMUX.IMUX38
VGGCOMPOUToutputTCELL19:OUT12

Bel wires

virtex7 CFG bel wires
WirePins
TCELL19:OUT10USR_ACCESS.DATA13
TCELL19:OUT11USR_ACCESS.DATA14
TCELL19:OUT12CFG_IO_ACCESS.VGGCOMPOUT
TCELL19:OUT13USR_ACCESS.DATA2
TCELL19:OUT14USR_ACCESS.DATA3
TCELL19:OUT15USR_ACCESS.DATA4
TCELL19:OUT16USR_ACCESS.DATA5
TCELL19:OUT17USR_ACCESS.DATA6
TCELL19:OUT18USR_ACCESS.DATA7
TCELL19:OUT19USR_ACCESS.DATA8
TCELL19:OUT20USR_ACCESS.DATA9
TCELL19:OUT21USR_ACCESS.DATA10
TCELL19:OUT22USR_ACCESS.DATA11
TCELL19:OUT23USR_ACCESS.DATA12
TCELL20:OUT8USR_ACCESS.DATA29
TCELL20:OUT9USR_ACCESS.DATA30
TCELL20:OUT10USR_ACCESS.DATA15
TCELL20:OUT11USR_ACCESS.DATA0
TCELL20:OUT12USR_ACCESS.DATA1
TCELL20:OUT13USR_ACCESS.DATA18
TCELL20:OUT14USR_ACCESS.DATA19
TCELL20:OUT15USR_ACCESS.DATA20
TCELL20:OUT16USR_ACCESS.DATA21
TCELL20:OUT17USR_ACCESS.DATA22
TCELL20:OUT18USR_ACCESS.DATA23
TCELL20:OUT19USR_ACCESS.DATA24
TCELL20:OUT20USR_ACCESS.DATA25
TCELL20:OUT21USR_ACCESS.DATA26
TCELL20:OUT22USR_ACCESS.DATA27
TCELL20:OUT23USR_ACCESS.DATA28
TCELL21:OUT10USR_ACCESS.DATA31
TCELL21:OUT11USR_ACCESS.DATA16
TCELL21:OUT12USR_ACCESS.DATA17
TCELL21:OUT13USR_ACCESS.DATAVALID
TCELL21:OUT14FRAME_ECC.SYNDROME0
TCELL21:OUT15FRAME_ECC.SYNDROME1
TCELL21:OUT16FRAME_ECC.SYNDROME2
TCELL21:OUT17FRAME_ECC.SYNDROME3
TCELL21:OUT18FRAME_ECC.SYNDROME4
TCELL21:OUT19FRAME_ECC.SYNDROME5
TCELL21:OUT20FRAME_ECC.SYNDROME6
TCELL21:OUT21FRAME_ECC.SYNDROME7
TCELL21:OUT22FRAME_ECC.SYNDROME8
TCELL21:OUT23FRAME_ECC.SYNDROME9
TCELL22:OUT8BSCAN0.RUNTEST
TCELL22:OUT9BSCAN1.RUNTEST
TCELL22:OUT10FRAME_ECC.SYNDROME10
TCELL22:OUT11FRAME_ECC.SYNDROME11
TCELL22:OUT12FRAME_ECC.SYNDROME12
TCELL22:OUT13FRAME_ECC.SYNDROMEVALID
TCELL22:OUT14BSCAN0.SEL
TCELL22:OUT15BSCAN1.SEL
TCELL22:OUT16BSCAN0.UPDATE
TCELL22:OUT17BSCAN1.UPDATE
TCELL22:OUT18BSCAN0.RESET
TCELL22:OUT19BSCAN1.RESET
TCELL22:OUT20BSCAN0.DRCK
TCELL22:OUT21BSCAN1.DRCK
TCELL22:OUT22BSCAN0.CAPTURE
TCELL22:OUT23BSCAN1.CAPTURE
TCELL23:IMUX.IMUX33BSCAN0.TDO
TCELL23:IMUX.IMUX34BSCAN1.TDO
TCELL23:OUT8ICAP0.O8
TCELL23:OUT9ICAP0.O9
TCELL23:OUT10BSCAN0.TMS
TCELL23:OUT11BSCAN1.TMS
TCELL23:OUT12BSCAN0.TDI
TCELL23:OUT13BSCAN1.TDI
TCELL23:OUT14BSCAN0.TCK
TCELL23:OUT15BSCAN1.TCK
TCELL23:OUT16BSCAN0.SHIFT
TCELL23:OUT17BSCAN1.SHIFT
TCELL23:OUT18ICAP0.O2
TCELL23:OUT19ICAP0.O3
TCELL23:OUT20ICAP0.O4
TCELL23:OUT21ICAP0.O5
TCELL23:OUT22ICAP0.O6
TCELL23:OUT23ICAP0.O7
TCELL24:IMUX.IMUX28ICAP0.I0
TCELL24:IMUX.IMUX29ICAP0.I1
TCELL24:IMUX.IMUX30ICAP0.I2
TCELL24:IMUX.IMUX31ICAP0.I3
TCELL24:IMUX.IMUX32ICAP0.I4
TCELL24:IMUX.IMUX33ICAP0.I5
TCELL24:IMUX.IMUX34ICAP0.I6
TCELL24:IMUX.IMUX35ICAP0.I7
TCELL24:IMUX.IMUX36ICAP0.I8
TCELL24:IMUX.IMUX37ICAP0.I9
TCELL24:IMUX.IMUX38ICAP0.I10
TCELL24:IMUX.IMUX39ICAP0.I11
TCELL24:IMUX.IMUX40ICAP0.I12
TCELL24:IMUX.IMUX41ICAP0.I13
TCELL24:IMUX.IMUX42ICAP0.I14
TCELL24:IMUX.IMUX43ICAP0.I15
TCELL24:OUT8ICAP0.O24
TCELL24:OUT9ICAP0.O25
TCELL24:OUT10ICAP0.O10
TCELL24:OUT11ICAP0.O11
TCELL24:OUT12ICAP0.O12
TCELL24:OUT13ICAP0.O13
TCELL24:OUT14ICAP0.O14
TCELL24:OUT15ICAP0.O15
TCELL24:OUT16ICAP0.O0
TCELL24:OUT17ICAP0.O1
TCELL24:OUT18ICAP0.O18
TCELL24:OUT19ICAP0.O19
TCELL24:OUT20ICAP0.O20
TCELL24:OUT21ICAP0.O21
TCELL24:OUT22ICAP0.O22
TCELL24:OUT23ICAP0.O23
TCELL25:IMUX.CLK1STARTUP.CLK
TCELL25:IMUX.IMUX24PMVIOB.A0
TCELL25:IMUX.IMUX25PMVIOB.A1
TCELL25:IMUX.IMUX26PMVIOB.EN
TCELL25:IMUX.IMUX27ICAP0.I16
TCELL25:IMUX.IMUX28ICAP0.I17
TCELL25:IMUX.IMUX29ICAP0.I18
TCELL25:IMUX.IMUX30ICAP0.I19
TCELL25:IMUX.IMUX31ICAP0.I20
TCELL25:IMUX.IMUX32ICAP0.I21
TCELL25:IMUX.IMUX33ICAP0.I22
TCELL25:IMUX.IMUX34ICAP0.I23
TCELL25:IMUX.IMUX35ICAP0.I24
TCELL25:IMUX.IMUX36ICAP0.I25
TCELL25:IMUX.IMUX37ICAP0.I26
TCELL25:IMUX.IMUX38ICAP0.I27
TCELL25:IMUX.IMUX39ICAP0.I28
TCELL25:IMUX.IMUX40ICAP0.I29
TCELL25:IMUX.IMUX41ICAP0.I30
TCELL25:IMUX.IMUX42ICAP0.I31
TCELL25:OUT9USR_ACCESS.CFGCLK
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62 - - - - - - - - - - - - - - - - - - - - - - - - - - - -
61 - - - - - - - - - - - - - - - - - - - - - - - - - - - -
60 - - - - - - - - - - - - - - - - - - - - - - - - - - - MISC:M2PIN[1]
59 - - - - - - - - - - - - - - - - - - - - - - - - - - - -
58 - - - - - - - - - - - - - - - - - - - - - - - - - - MISC:M1PIN[0] -
57 - - - - - - - - - - - - - - - - - - - - - - - - - - - -
56 - - - - - - - - - - - - - - - - - - - - - - - - - - - -
55 - - - - - - - - - - - - - - - - - - - - - - - - - - - MISC:M1PIN[1]
54 - - - - - - - - - - - - - - - - - - - - - - - - - - - -
53 - - - - - - - - - - - - - - - - - - - - - - - - - - MISC:M0PIN[0] -
52 - - - - - - - - - - - - - - - - - - - - - - - - - - - -
51 - - - - - - - - - - - - - - - - - - - - - - - - - - - -
50 - - - - - - - - - - - - - - - - - - - - - - - - - - - MISC:M0PIN[1]
49 - - - - - - - - - - - - - - - - - - - - - - - - - - - -
48 - - - - - - - - - - - - - - - - - - - - - - - - - - - -
47 - - - - - - - - - - - - - - - - - - - - - - - - - - - -
46 - - - - - - - - - - - - - - - - - - - - - - - - - - - -
45 - - - - - - - - - - - - - - - - - - - - - - - - - - - -
44 - - - - - - - - - - - - - - - - - - - - - - - - - - - -
43 - - - - - - - - - - - - - - - - - - - - - - - - - - - -
42 - - - - - - - - - - - - - - - - - - - - - - - - - - - -
41 - - - - - - - - - - - - - - - - - - - - - - - - - - - -
40 - - - - - - - - - - - - - - - - - - - - - - - - - - - -
39 - - - - - - - - - - - - - - - - - - - - - - - - - - - -
38 - - - - - - - - - - - - - - - - - - - - - - - - - - - -
37 - - - - - - - - - - - - - - - - - - - - - - - - - - - -
36 - - - - - - - - - - - - - - - - - - - - - - - - - - - -
35 - - - - - - - - - - - - - - - - - - - - - - - - - - - -
34 - - - - - - - - - - - - - - - - - - - - - - - - - - - -
33 - - - - - - - - - - - - - - - - - - - - - - - - - - - -
32 - - - - - - - - - - - - - - - - - - - - - - - - - - - -
31 - - - - - - - - - - - - - - - - - - - - - - - - - - - -
30 - - - - - - - - - - - - - - - - - - - - - - - - - - - -
29 - - - - - - - - - - - - - - - - - - - - - - - - - - - -
28 - - - - - - - - - - - - - - - - - - - - - - - - - - - -
27 - - - - - - - - - - - - - - - - - - - - - - - - - - - -
26 - - - - - - - - - - - - - - - - - - - - - - - - - - - -
25 - - - - - - - - - - - - - - - - - - - - - - - - - - - -
24 - - - - - - - - - - - - - - - - - - - - - - - - - - - -
23 - - - - - - - - - - - - - - - - - - - - - - - - - - - -
22 - - - - - - - - - - - - - - - - - - - - - - - - - - - -
21 - - - - - - - - - - - - - - - - - - - - - - - - - - - -
20 - - - - - - - - - - - - - - - - - - - - - - - - - - - -
19 - - - - - - - - - - - - - - - - - - - - - - - - - - - -
18 - - - - - - - - - - - - - - - - - - - - - - - - - - - -
17 - - - - - - - - - - - - - - - - - - - - - - - - - - - -
16 - - - - - - - - - - - - - - - - - - - - - - - - - - - -
15 - - - - - - - - - - - - - - - - - - - - - - - - - - - -
14 - - - - - - - - - - - - - - - - - - - - - - - - - - - -
13 - - - - - - - - - - - - - - - - - - - - - - - - - - - -
12 - - - - - - - - - - - - - - - - - - - - - - - - - - - -
11 - - - - - - - - - - - - - - - - - - - - - - - - - - - -
10 - - - - - - - - - - - - - - - - - - - - - - - - - - - -
9 - - - - - - - - - - - - - - - - - - - - - - - - - - - -
8 - - - - - - - - - - - - - - - - - - - - - - - - - - - -
7 - - - - - - - - - - - - - - - - - - - - - - - - - - - -
6 - - - - - - - - - - - - - - - - - - - - - - - - - - - -
5 - - - - - - - - - - - - - - - - - - - - - - - - - - - -
4 - - - - - - - - - - - - - - - - - - - - - - - - - - - -
3 - - - - - - - - - - - - - - - - - - - - - - - - - - - -
2 - - - - - - - - - - - - - - - - - - - - - - - - - - - -
1 - - - - - - - - - - - - - - - - - - - - - - - - - - - -
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BitFrame
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63 - - - - - - - - - - - - - - - - - - - - - - - - - - - MISC:TDOPIN[0]
62 - - - - - - - - - - - - - - - - - - - - - - - - - - - -
61 - - - - - - - - - - - - - - - - - - - - - - - - - - - -
60 - - - - - - - - - - - - - - - - - - - - - - - - - - - MISC:TDOPIN[1]
59 - - - - - - - - - - - - - - - - - - - - - - - - - - - -
58 - - - - - - - - - - - - - - - - - - - - - - - - - - MISC:TMSPIN[0] -
57 - - - - - - - - - - - - - - - - - - - - - - - - - - - -
56 - - - - - - - - - - - - - - - - - - - - - - - - - - - -
55 - - - - - - - - - - - - - - - - - - - - - - - - - - - MISC:TMSPIN[1]
54 - - - - - - - - - - - - - - - - - - - - - - - - - - - -
53 - - - - - - - - - - - - - - - - - - - - - - - - - - MISC:TDIPIN[0] -
52 - - - - - - - - - - - - - - - - - - - - - - - - - - - -
51 - - - - - - - - - - - - - - - - - - - - - - - - - - - -
50 - - - - - - - - - - - - - - - - - - - - - - - - - - - MISC:TDIPIN[1]
49 - - - - - - - - - - - - - - - - - - - - - - - - - - - -
48 - - - - - - - - - - - - - - - - - - - - - - - - - - - -
47 - - - - - - - - - - - - - - - - - - - - - - - - - - - MISC:DONEPIN[0]
46 - - - - - - - - - - - - - - - - - - - - - - - - - - - -
45 - - - - - - - - - - - - - - - - - - - - - - - - - - - -
44 - - - - - - - - - - - - - - - - - - - - - - - - - - - MISC:INITPIN[0]
43 - - - - - - - - - - - - - - - - - - - - - - - - - - - -
42 - - - - - - - - - - - - - - - - - - - - - - - - - - MISC:PROGPIN[0] -
41 - - - - - - - - - - - - - - - - - - - - - - - - - - - -
40 - - - - - - - - - - - - - - - - - - - - - - - - - - - -
39 - - - - - - - - - - - - - - - - - - - - - - - - - - - -
38 - - - - - - - - - - - - - - - - - - - - - - - - - - - -
37 - - - - - - - - - - - - - - - - - - - - - - - - - - - -
36 - - - - - - - - - - - - - - - - - - - - - - - - - - - -
35 - - - - - - - - - - - - - - - - - - - - - - - - - - - -
34 - - - - - - - - - - - - - - - - - - - - - - - - - - - -
33 - - - - - - - - - - - - - - - - - - - - - - - - - - - -
32 - - - - - - - - - - - - - - - - - - - - - - - - - - - -
31 - - - - - - - - - - - - - - - - - - - - - - - - - - - -
30 - - - - - - - - - - - - - - - - - - - - - - - - - - - -
29 - - - - - - - - - - - - - - - - - - - - - - - - - - - -
28 - - - - - - - - - - - - - - - - - - - - - - - - - - - -
27 - - - - - - - - - - - - - - - - - - - - - - - - - - - -
26 - - - - - - - - - - - - - - - - - - - - - - - - - - - -
25 - - - - - - - - - - - - - - - - - - - - - - - - - - - -
24 - - - - - - - - - - - - - - - - - - - - - - - - - - - -
23 - - - - - - - - - - - - - - - - - - - - - - - - - - - -
22 - - - - - - - - - - - - - - - - - - - - - - - - - - - -
21 - - - - - - - - - - - - - - - - - - - - - - - - - - - -
20 - - - - - - - - - - - - - - - - - - - - - - - - - - - -
19 - - - - - - - - - - - - - - - - - - - - - - - - - - - -
18 - - - - - - - - - - - - - - - - - - - - - - - - - - - -
17 - - - - - - - - - - - - - - - - - - - - - - - - - - - -
16 - - - - - - - - - - - - - - - - - - - - - - - - - - - -
15 - - - - - - - - - - - - - - - - - - - - - - - - - - - -
14 - - - - - - - - - - - - - - - - - - - - - - - - - - - -
13 - - - - - - - - - - - - - - - - - - - - - - - - - - - -
12 - - - - - - - - - - - - - - - - - - - - - - - - - - - -
11 - - - - - - - - - - - - - - - - - - - - - - - - - - - -
10 - - - - - - - - - - - - - - - - - - - - - - - - - - - -
9 - - - - - - - - - - - - - - - - - - - - - - - - - - - -
8 - - - - - - - - - - - - - - - - - - - - - - - - - - - -
7 - - - - - - - - - - - - - - - - - - - - - - - - - - - -
6 - - - - - - - - - - - - - - - - - - - - - - - - - - - -
5 - - - - - - - - - - - - - - - - - - - - - - - - - - - -
4 - - - - - - - - - - - - - - - - - - - - - - - - - - - -
3 - - - - - - - - - - - - - - - - - - - - - - - - - - - -
2 - - - - - - - - - - - - - - - - - - - - - - - - - - - -
1 - - - - - - - - - - - - - - - - - - - - - - - - - - - -
0 - - - - - - - - - - - - - - - - - - - - - - - - - - - -
virtex7 CFG bittile 32
BitFrame
virtex7 CFG bittile 33
BitFrame
0 1 2 3 4 5 6 7 8 9 10 11 12 13 14 15 16 17 18 19 20 21 22 23 24 25 26 27
63 - - - - - - - - - - - - - - - - - - - - - - - - - - ICAP1:ENABLE[1] ICAP0:ENABLE[2]
62 - - - - - - - - - - - - - - - - - - - - - - - - - - ICAP1:ENABLE[0] ICAP0:ENABLE[1]
61 - - - - - - - - - - - - - - - - - - - - - - - - - - ICAP0:ENABLE[0] ICAP1:ENABLE[2]
60 - - - - - - - - - - - - - - - - - - - - - - - - - - ICAP_COMMON:ICAP_WIDTH[1] BSCAN_COMMON:DISABLE_JTAG[2]
59 - - - - - - - - - - - - - - - - - - - - - - - - - - ICAP_COMMON:ICAP_WIDTH[0] BSCAN_COMMON:DISABLE_JTAG[1]
58 - - - - - - - - - - - - - - - - - - - - - - - - - - BSCAN_COMMON:DISABLE_JTAG[0] ICAP_COMMON:ICAP_WIDTH[2]
57 - - - - - - - - - - - - - - - - - - - - - - - - - - STARTUP:GTS_GSR_ENABLE[1] ICAP_COMMON:ICAP_WIDTH[5]
56 - - - - - - - - - - - - - - - - - - - - - - - - - - STARTUP:GTS_GSR_ENABLE[0] ICAP_COMMON:ICAP_WIDTH[4]
55 - - - - - - - - - - - - - - - - - - - - - - - - - - ICAP_COMMON:ICAP_WIDTH[3] STARTUP:GTS_GSR_ENABLE[2]
54 - - - - - - - - - - - - - - - - - - - - - - - - - - STARTUP:PROG_USR[1] STARTUP:USRCCLK_ENABLE[2]
53 - - - - - - - - - - - - - - - - - - - - - - - - - - STARTUP:PROG_USR[0] STARTUP:USRCCLK_ENABLE[1]
52 - - - - - - - - - - - - - - - - - - - - - - - - - - STARTUP:USRCCLK_ENABLE[0] STARTUP:PROG_USR[2]
51 - - - - - - - - - - - - - - - - - - - - - - - - - - CFG_IO_ACCESS:ENABLE[1] -
50 - - - - - - - - - - - - - - - - - - - - - - - - - - CFG_IO_ACCESS:ENABLE[0] -
49 - - - - - - - - - - - - - - - - - - - - - - - - - - - CFG_IO_ACCESS:ENABLE[2]
48 - - - - - - - - - - - - - - - - - - - - - - - - - - - -
47 - - - - - - - - - - - - - - - - - - - - - - - - - - ~BSCAN_COMMON:USERID[30] ~BSCAN_COMMON:USERID[31]
46 - - - - - - - - - - - - - - - - - - - - - - - - - - ~BSCAN_COMMON:USERID[28] ~BSCAN_COMMON:USERID[29]
45 - - - - - - - - - - - - - - - - - - - - - - - - - - ~BSCAN_COMMON:USERID[26] ~BSCAN_COMMON:USERID[27]
44 - - - - - - - - - - - - - - - - - - - - - - - - - - ~BSCAN_COMMON:USERID[24] ~BSCAN_COMMON:USERID[25]
43 - - - - - - - - - - - - - - - - - - - - - - - - - - ~BSCAN_COMMON:USERID[22] ~BSCAN_COMMON:USERID[23]
42 - - - - - - - - - - - - - - - - - - - - - - - - - - ~BSCAN_COMMON:USERID[20] ~BSCAN_COMMON:USERID[21]
41 - - - - - - - - - - - - - - - - - - - - - - - - - - ~BSCAN_COMMON:USERID[18] ~BSCAN_COMMON:USERID[19]
40 - - - - - - - - - - - - - - - - - - - - - - - - - - ~BSCAN_COMMON:USERID[16] ~BSCAN_COMMON:USERID[17]
39 - - - - - - - - - - - - - - - - - - - - - - - - - - ~BSCAN_COMMON:USERID[14] ~BSCAN_COMMON:USERID[15]
38 - - - - - - - - - - - - - - - - - - - - - - - - - - ~BSCAN_COMMON:USERID[12] ~BSCAN_COMMON:USERID[13]
37 - - - - - - - - - - - - - - - - - - - - - - - - - - ~BSCAN_COMMON:USERID[10] ~BSCAN_COMMON:USERID[11]
36 - - - - - - - - - - - - - - - - - - - - - - - - - - ~BSCAN_COMMON:USERID[8] ~BSCAN_COMMON:USERID[9]
35 - - - - - - - - - - - - - - - - - - - - - - - - - - ~BSCAN_COMMON:USERID[6] ~BSCAN_COMMON:USERID[7]
34 - - - - - - - - - - - - - - - - - - - - - - - - - - ~BSCAN_COMMON:USERID[4] ~BSCAN_COMMON:USERID[5]
33 - - - - - - - - - - - - - - - - - - - - - - - - - - ~BSCAN_COMMON:USERID[2] ~BSCAN_COMMON:USERID[3]
32 - - - - - - - - - - - - - - - - - - - - - - - - - - ~BSCAN_COMMON:USERID[0] ~BSCAN_COMMON:USERID[1]
31 - - - - - - - - - - - - - - - - - - - - - - - - - - - -
30 - - - - - - - - - - - - - - - - - - - - - - - - - - - -
29 - - - - - - - - - - - - - - - - - - - - - - - - - - - -
28 - - - - - - - - - - - - - - - - - - - - - - - - - - - -
27 - - - - - - - - - - - - - - - - - - - - - - - - - - - -
26 - - - - - - - - - - - - - - - - - - - - - - - - - - - -
25 - - - - - - - - - - - - - - - - - - - - - - - - - - MISC:DCI_CLK_ENABLE[2] MISC:DCI_CLK_ENABLE[5]
24 - - - - - - - - - - - - - - - - - - - - - - - - - - MISC:DCI_CLK_ENABLE[1] MISC:DCI_CLK_ENABLE[4]
23 - - - - - - - - - - - - - - - - - - - - - - - - - - MISC:DCI_CLK_ENABLE[0] MISC:DCI_CLK_ENABLE[3]
22 - - - - - - - - - - - - - - - - - - - - - - - - - - DCIRESET:ENABLE[1] -
21 - - - - - - - - - - - - - - - - - - - - - - - - - - DCIRESET:ENABLE[0] -
20 - - - - - - - - - - - - - - - - - - - - - - - - - - - DCIRESET:ENABLE[2]
19 - - - - - - - - - - - - - - - - - - - - - - - - - - BSCAN2:ENABLE BSCAN3:ENABLE
18 - - - - - - - - - - - - - - - - - - - - - - - - - - BSCAN0:ENABLE BSCAN1:ENABLE
17 - - - - - - - - - - - - - - - - - - - - - - - - - - STARTUP:GTS_SYNC STARTUP:GSR_SYNC
16 - - - - - - - - - - - - - - - - - - - - - - - - - - - -
15 - - - - - - - - - - - - - - - - - - - - - - - - - - - STARTUP:KEY_CLEAR_ENABLE[2]
14 - - - - - - - - - - - - - - - - - - - - - - - - - - - STARTUP:KEY_CLEAR_ENABLE[1]
13 - - - - - - - - - - - - - - - - - - - - - - - - - - STARTUP:KEY_CLEAR_ENABLE[0] -
12 - - - - - - - - - - - - - - - - - - - - - - - - - - - -
11 - - - - - - - - - - - - - - - - - - - - - - - - - - - -
10 - - - - - - - - - - - - - - - - - - - - - - - - - - - -
9 - - - - - - - - - - - - - - - - - - - - - - - - - - - -
8 - - - - - - - - - - - - - - - - - - - - - - - - - - - -
7 - - - - - - - - - - - - - - - - - - - - - - - - - - - -
6 - - - - - - - - - - - - - - - - - - - - - - - - - - - -
5 - - - - - - - - - - - - - - - - - - - - - - - - - - - -
4 - - - - - - - - - - - - - - - - - - - - - - - - - - - -
3 - - - - - - - - - - - - - - - - - - - - - - - - - - - -
2 - - - - - - - - - - - - - - - - - - - - - - - - - - - -
1 - - - - - - - - - - - - - - - - - - - - - - - - - - - -
0 - - - - - - - - - - - - - - - - - - - - - - - - - - - -
virtex7 CFG bittile 34
BitFrame
0 1 2 3 4 5 6 7 8 9 10 11 12 13 14 15 16 17 18 19 20 21 22 23 24 25 26 27
31 - - - - - - - - - - - - - - - - - - - - - - - - - - - MISC:CCLKPIN[0]
30 - - - - - - - - - - - - - - - - - - - - - - - - - - - -
29 - - - - - - - - - - - - - - - - - - - - - - - - - - - -
28 - - - - - - - - - - - - - - - - - - - - - - - - - - - -
27 - - - - - - - - - - - - - - - - - - - - - - - - - - - MISC:TCKPIN[0]
26 - - - - - - - - - - - - - - - - - - - - - - - - - - - -
25 - - - - - - - - - - - - - - - - - - - - - - - - - - MISC:TCKPIN[1] -
24 - - - - - - - - - - - - - - - - - - - - - - - - - - - -
23 - - - - - - - - - - - - - - - - - - - - - - - - - - - -
22 - - - - - - - - - - - - - - - - - - - - - - - - - - - -
21 - - - - - - - - - - - - - - - - - - - - - - - - - - - -
20 - - - - - - - - - - - - - - - - - - - - - - - - - - - -
19 - - - - - - - - - - - - - - - - - - - - - - - - - - - -
18 - - - - - - - - - - - - - - - - - - - - - - - - - - - -
17 - - - - - - - - - - - - - - - - - - - - - - - - - - - -
16 - - - - - - - - - - - - - - - - - - - - - - - - - - - -
15 - - - - - - - - - - - - - - - - - - - - - - - - - - - -
14 - - - - - - - - - - - - - - - - - - - - - - - - - - - -
13 - - - - - - - - - - - - - - - - - - - - - - - - - - - -
12 - - - - - - - - - - - - - - - - - - - - - - - - - - - -
11 - - - - - - - - - - - - - - - - - - - - - - - - - - - -
10 - - - - - - - - - - - - - - - - - - - - - - - - - - - -
9 - - - - - - - - - - - - - - - - - - - - - - - - - - - -
8 - - - - - - - - - - - - - - - - - - - - - - - - - - - -
7 - - - - - - - - - - - - - - - - - - - - - - - - - - - DNA_PORT:ENABLE[2]
6 - - - - - - - - - - - - - - - - - - - - - - - - - - - -
5 - - - - - - - - - - - - - - - - - - - - - - - - - - DNA_PORT:ENABLE[0] -
4 - - - - - - - - - - - - - - - - - - - - - - - - - - - -
3 - - - - - - - - - - - - - - - - - - - - - - - - - - - -
2 - - - - - - - - - - - - - - - - - - - - - - - - - - - DNA_PORT:ENABLE[1]
1 - - - - - - - - - - - - - - - - - - - - - - - - - - - -
0 - - - - - - - - - - - - - - - - - - - - - - - - - - - -
BSCAN0:ENABLE 33.26.18
BSCAN1:ENABLE 33.27.18
BSCAN2:ENABLE 33.26.19
BSCAN3:ENABLE 33.27.19
STARTUP:GSR_SYNC 33.27.17
STARTUP:GTS_SYNC 33.26.17
non-inverted [0]
BSCAN_COMMON:DISABLE_JTAG 33.27.60 33.27.59 33.26.58
CFG_IO_ACCESS:ENABLE 33.27.49 33.26.51 33.26.50
DCIRESET:ENABLE 33.27.20 33.26.22 33.26.21
DNA_PORT:ENABLE 34.27.7 34.27.2 34.26.5
ICAP0:ENABLE 33.27.63 33.27.62 33.26.61
ICAP1:ENABLE 33.27.61 33.26.63 33.26.62
STARTUP:GTS_GSR_ENABLE 33.27.55 33.26.57 33.26.56
STARTUP:KEY_CLEAR_ENABLE 33.27.15 33.27.14 33.26.13
STARTUP:PROG_USR 33.27.52 33.26.54 33.26.53
STARTUP:USRCCLK_ENABLE 33.27.54 33.27.53 33.26.52
non-inverted [2] [1] [0]
BSCAN_COMMON:USERID 33.27.47 33.26.47 33.27.46 33.26.46 33.27.45 33.26.45 33.27.44 33.26.44 33.27.43 33.26.43 33.27.42 33.26.42 33.27.41 33.26.41 33.27.40 33.26.40 33.27.39 33.26.39 33.27.38 33.26.38 33.27.37 33.26.37 33.27.36 33.26.36 33.27.35 33.26.35 33.27.34 33.26.34 33.27.33 33.26.33 33.27.32 33.26.32
inverted ~[31] ~[30] ~[29] ~[28] ~[27] ~[26] ~[25] ~[24] ~[23] ~[22] ~[21] ~[20] ~[19] ~[18] ~[17] ~[16] ~[15] ~[14] ~[13] ~[12] ~[11] ~[10] ~[9] ~[8] ~[7] ~[6] ~[5] ~[4] ~[3] ~[2] ~[1] ~[0]
ICAP_COMMON:ICAP_WIDTH 33.27.57 33.27.56 33.26.55 33.27.58 33.26.60 33.26.59
X32 0 0 0 0 0 0
X8 0 0 0 1 1 1
X16 1 1 1 0 0 0
MISC:CCLKPIN 34.27.31
MISC:DONEPIN 31.27.47
MISC:INITPIN 31.27.44
MISC:PROGPIN 31.26.42
PULLUP 0
PULLNONE 1
MISC:DCI_CLK_ENABLE 33.27.25 33.27.24 33.27.23 33.26.25 33.26.24 33.26.23
non-inverted [5] [4] [3] [2] [1] [0]
MISC:M0PIN 30.27.50 30.26.53
MISC:M1PIN 30.27.55 30.26.58
MISC:M2PIN 30.27.60 30.27.63
MISC:TCKPIN 34.26.25 34.27.27
MISC:TDIPIN 31.27.50 31.26.53
MISC:TDOPIN 31.27.60 31.27.63
MISC:TMSPIN 31.27.55 31.26.58
PULLUP 0 0
PULLNONE 0 1
PULLDOWN 1 1

Tile SYSMON

Cells: 25 IRIs: 0

Bel SYSMON

virtex7 SYSMON bel SYSMON
PinDirectionWires
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RESETinputTCELL2:IMUX.CTRL1
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non-inverted [15] [14] [13] [12] [11] [10] [9] [8] [7] [6] [5] [4] [3] [2] [1] [0]
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inverted ~[0]